CN104038186A - 一种迟滞比较器 - Google Patents
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Abstract
本发明提供一种迟滞比较器，在参考电压与放大器正相输入端之间接有电阻，电阻并联后与另一个电阻串联接在所述放大器正相输入端与地之间，所述放大器输出控制一个开关，所述开关接在一个所述并联电阻与地之间；所述并联电阻大于等于2个；所述开关为NMOS管；所述NMOS管的宽长比（W/L）大于1。本发明阈值电压和稳定且抗干扰能力强。
Description
技术领域
本发明涉及一种集成电路领域，特别涉及用于模拟集成电路中实现简单性能可靠地迟滞比较器。
背景技术
在集成电路的中，比较器是常用的器件，为了增加比较器的抗干扰能力，经常将比较器设置为迟滞比较器。目前的通常的做法是将输出反馈控制输入端的分压电阻电压（例如申请号为201110076223.2的中国专利）。
这样的方案主要存在以下缺陷：
输入端电压是变化的，将输出反馈控制输入端的分压电阻前后所得到的电压不稳定，造成比较器抗干扰能力差。
发明内容
为解决传统方案迟滞比较器存在的问题，本发明提供一种新的迟滞比较器，抗干扰能力强，且实现简单。
本发明的解决方案如下：
一种迟滞比较器，在参考电压与放大器正相输入端之间接有电阻，电阻并联后与另一个电阻串联接在所述放大器正相输入端与地之间，所述放大器输出控制一个开关，所述开关接在一个所述并联电阻与地之间；
所述并联电阻大于等于2个；
所述开关为NMOS管；所述NMOS管的宽长比（W/L）大于1。
本发明具有以下优点：
1. 阈值电压 和稳定。
2.抗干扰能力强。
附图说明
图1为本发明的示意图。
具体实施方式
如图1所示，1为普通的放大器；2为开关，实际电路中可以用NMOS管作为开关2，为了减少NMOS管的导通电阻，这里的NMOS管的宽长比（W/L）尽量大，至少大于1。3、4、 5和6分别为电阻R1、R2、 R3和R4。
输入信号Vi接放大器的反相输入端，参考电压Vref接放大器的正相输入端。电阻R1接在参考电压Vref与正相输入端之间， 电阻R3和电阻R4并联后与电阻R2串联接在放大器正相输入端与地之间。
根据应用的不同，并联电阻的个数可以更多，不仅只有电阻R3和电阻R4两个并联电阻。放大器1的输出电压Vout反馈控制开关2，开关2接在电阻R4和地之间。根据输出电压Vout值得不同，用于控制开关2的开、关状态。
迟滞比较器的两个窗口电压通过改变电阻阻值进行调节。它是将参考电压经电阻分压后送给比较器的同相输入端，分压比受放大器1的输出电压Vout控制。
由图1可知：
由上述公式可见，迟滞比较器的阈值电压和取决于电阻值以及参考电压Vref。这里因为Vref是一个固定的参考值，电阻值也是固定的，所以比较电压和很稳定，受干扰的影响很小。电阻R1、R2、 R3和R4值的大小，可以根据迟滞比较器的具体应用确定，与所应用的功耗、电流、面积等有关。实际应用中，迟滞比较器的窗口电压（）的设定要做折中考虑，如果过大，比较响应时间会长；如果过小，抗噪声能力会小。
Claims (4)
1.一种迟滞比较器，其特征在于：在参考电压与放大器正相输入端之间接有电阻，电阻并联后与另一个电阻串联接在所述放大器正相输入端与地之间，所述放大器输出控制一个开关，所述开关接在一个所述并联电阻与地之间。
2.根据权利要求1所述的迟滞比较器，其特征在于：所述并联电阻大于等于2个。
3.根据权利要求1所述的迟滞比较器，其特征在于：所述开关为NMOS管。
4.根据权利要求3所述的迟滞比较器，其特征在于：所述NMOS管的宽长比（W/L）大于1。
Priority Applications (1)
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| CN201310623517.1A CN104038186A (zh) | 2013-11-30 | 2013-11-30 | 一种迟滞比较器 |
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Country Status (1)
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| CN (1) | CN104038186A (zh) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110729989A (zh) * | 2019-12-17 | 2020-01-24 | 峰岹科技（深圳）有限公司 | 迟滞比较器电路 |
| CN115225067A (zh) * | 2022-09-09 | 2022-10-21 | 深圳市汇顶科技股份有限公司 | 基于运放的迟滞比较器和芯片 |
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2013
- 2013-11-30 CN CN201310623517.1A patent/CN104038186A/zh active Pending
Cited By (3)
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| CN110729989A (zh) * | 2019-12-17 | 2020-01-24 | 峰岹科技（深圳）有限公司 | 迟滞比较器电路 |
| CN115225067A (zh) * | 2022-09-09 | 2022-10-21 | 深圳市汇顶科技股份有限公司 | 基于运放的迟滞比较器和芯片 |
| CN115225067B (zh) * | 2022-09-09 | 2023-03-10 | 深圳市汇顶科技股份有限公司 | 基于运放的迟滞比较器和芯片 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| WD01 | Invention patent application deemed withdrawn after publication |
Application publication date: 20140910 |