CN103488606A - 基于节点控制器的请求响应方法和装置 - Google Patents
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Abstract
本发明实施例公开了一种基于节点控制器的请求响应方法和装置,所述方法包括:第一节点控制器接收第一报文;获取信息目录,在信息目录中查询第一报文所请求的内存地址是否被第二节点控制器占用;如果第一报文所请求的内存地址被第二节点控制器占用了,则查询节点在位信息,用以确定第二节点控制器是否存在;当确定第二节点控制器不存在时,生成无效响应报文并发送;其中,无效响应报文的目的节点号DNID为第一报文的源节点号SNID;无效响应报文的SNID为第一报文的DNID。
Description
技术领域
本发明涉及通信技术领域,尤其涉及一种基于节点控制器的请求响应方法和装置。
背景技术
系统体系结构上的现代高级特性使处理器(CPU)具备了错误报告与错误更正的能力,且支持CPU热插拔的技术。一些代工生产商已经支持了非一致内存访问(Non-Uniform Memory Access,NUMA)硬件的热插拔,即物理节点的插入与移除。这种高级特性需要内核在必要时能移除正在使用的CPU。比如,为了远程访问服务(Remote Access Service,RAS)的需要,必须将一个执行恶意代码的CPU保持在系统执行路径之外。因此,在Linux内核中需要支持CPU热插拔技术。操作系统(OS)对CPU逻辑下线,操作系统将不再使用被下线的CPU线程,原来绑定在上面的进程和中断也被迁移到其他线程上。
在基于多节点互联情况下,可以对某节点上的节点控制器(NC)或某个CPU进行热移除。如果需要对NC进行逻辑上和物理上的移除,除了上面介绍的CPU节点移除的操作外,OS还会将节点内的内存下线,OS将节点内地址空间上正在使用的数据迁移到其他节点的内存上,并不再分配新的内存空间到这段地址。假设系统中存在NC0、NC1、NC2和NC3,其中,对NC3进行移除,则将NC3节点上所有CPU的所有服务都被迁移后,不会有任何东西运行在NC3节点上的CPU内,且其他节点不会使用NC3节点上的内存,NC3节点也不会访问其他节点上的内存。但是由于NC上有目录信息,NC3之前占用其他节点上内存数据的信息可能会保留。
假设NC0上某个内存地址Addr0的数据被NC3占用,则对NC3进行逻辑移除时,会有如下几种情况:
表1
表1表示NC3上某个CPU独占NC0内存地址Addr0,则NC0目录信息记录为E状态,且NC3独占。若NC3上此CPU对此地址上的数据进行了修改,则对NC3进行逻辑移除时,数据会写回NC0上某个CPU的内存上,则目录信息更新为I状态。
表2
表2表示NC3上某个CPU独占NC0内存地址Addr0,则NC0目录信息记录为E状态,且NC3独占。但NC3上此CPU没有对此地址上的数据进行修改,则对NC3进行逻辑移除时,此数据不会写回NC0上某个CPU的内存上,则目录信息仍然表示NC3独占Addr0上的数据。
表3
表3表示NC3上某个CPU共享NC0内存地址Addr0,则NC0目录信息记录为S状态,且NC3和NC1共享。如果对NC节点进行逻辑移除时,此数据不会写回NC0上某个CPU的内存上,则目录信息仍然表示NC3和NC1共享Addr0上的数据。
后面两种情况下,如果不对NC0上的目录信息进行刷新,则如果NC0内的CPU0要独占Addr0的数据,根据CC协议,就会对NC3发侦听消息,此时如果NC3已经被物理移除,则会导致侦听消息无法响应,系统挂死。
现有解决方法是:在对NC3进行物理移除前,其他NC节点内的CPU都针对本节点所有内存地址空间向远端节点发出独占请求,当所有内存地址通过这种方式刷新完毕后,表2和表3的目录状态分别变为如下如表4、表5所示:
表4
表5
其他节点不会再有NC3占用的目录状态信息,都变为无效。此时对NC3进行物理移除,可以确保系统不会被挂死。
但是应用此方法在对节点移除时,需要其他节点把本地内存都刷新一遍,因此非常占用OS的使用时间,会导致系统响应很慢,系统性能极大下降。实测中,如果对单节点内256Gb内存进行刷新,且BIOS占用CPU60-70%的时间片,则需要大约20分钟完成,此期间OS的响应变得很慢,用户基本不可接受。且单节点内存越大,系统规模越大,刷新内存所需的时间越长。
发明内容
本发明实施例提供了一种侦听相应方法和装置,可以在一个节点控制器(NC)移除时配置其他NC的信息目录,从而更新记录每个节点控制器的内存地址被被移除NC节点所占用的信息,而无需对每个节点的CPU进行内存刷新,从而实现由当前NC来解决对发往被移除节点的侦听或请求的处理,直接将侦听请求转为无效响应,极大的提高了系统的性能及可靠性。
第一方面,本发明实施例提供了一种基于节点控制器的请求响应方法,所述方法包括:
第一节点控制器接收第一报文;所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的请求报文;
获取信息目录,在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;
如果所述第一报文所请求的内存地址被所述第二节点控制器占用了,则查询节点在位信息,用以确定所述第二节点控制器是否存在;
当确定所述第二节点控制器不存在时,生成无效响应报文并发送;其中,所述无效响应报文的目的节点号DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
在第一种可能的实现方式中,当确定所述第二节点控制器不存在时,生成无效响应报文并发送之后,所述方法还包括:
在所述信息目录中更改所述第一节点控制器的内存地址被第二节点控制器所占用的信息,将所述被第二节点控制器占用内存地址释放,并更新所述节点在位信息将所述第二节点控制器的信息更新为不存在。
在第二种可能的实现方式中,所述方法还包括:
如果所述第二节点控制器存在,则对所述第一报文进行处理生成第二报文,把所述第二报文发送到所述第二节点控制器接口。
在第三种可能的实现方式中,如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,所述方法还包括:
当所述第一报文为所述第一节点控制器上的第一处理器接口发送的侦听报文时,则生成无效响应报文发送给第一处理器接口。
在第四种可能的实现方式中,如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,所述方法还包括:
当所述第一报文为来自第三节点控制器接口的数据或状态请求报文时,则向第一处理器接口发送所述请求报文,用以使所述第一处理器记录所述请求的信息。
第二方面,本发明实施例提供了一种基于节点控制器的请求响应方法,所述方法包括:
第一节点控制器接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
获取处理器在位信息;所述处理器在位信息包括所在当前节点上的处理器是否存在的信息;
如果所述第一处理器不存在,则生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
在第一种可能的实现方式中,所述方法还包括:
如果所述第一处理器存在,则发送所述侦听报文到所述第一处理器接口。
在第二种可能的实现方式中,所述方法还包括:
当所述第一处理器被移除时,在所述处理器在位信息中更新所述第一处理器的记录信息,将所述第一处理器的记录信息更新为不存在。
第三方面,本发明实施例提供了一种请求响应装置,所述装置包括:
接收单元,用于接收第一报文,所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的数据或状态请求报文;
获取单元,用于获取信息目录,所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;
第一识别单元,用于在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;
第二识别单元,如果所述第一报文所请求的内存地址被所述第二节点控制器占用了,则所述第二识别单元查询节点在位信息,用以确定所述第二节点控制器是否存在;
处理单元,用于当确定所述第二节点控制器不存在时,生成无效响应报文并发送;其中,所述无效响应报文的目的节点号DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
在第一种可能的实现方式中,所述装置还包括:信息目录管理单元,用于在所述信息目录中更改所述第一节点控制器的内存地址被第二节点控制器所占用的信息,将所述被第二节点控制器占用内存地址释放,并更新所述节点在位信息,将所述第二节点控制器的信息更新为不存在。
在第二种可能的实现方式中,所述处理单元还用于:
如果所述第二节点控制器存在,则对所述第一报文进行处理生成第二报文,把所述第二报文发送到所述第二节点控制器接口。
在第三种可能的实现方式中,所述处理单元还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为所述第一节点控制器上的第一处理器接口发送的侦听报文时,则生成无效响应报文发送给第一处理器接口。
在第四种可能的实现方式中,所述处理单元还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为来自第三节点控制器接口的数据或状态请求报文时,则向第一处理器接口发送所述请求报文,用以使所述第一处理器记录所述请求的信息。
在第四方面,本发明实施例提供了一种请求响应装置,所述装置包括:
接收单元,接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
获取单元,获取处理器在位信息;所述处理器在位信息包括所在当前节点上的处理器是否存在的信息;
识别单元,用于根据所述处理器在位信息识别所述第一处理器是否存在;
处理单元,如果所述第一处理器不存在,则生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述侦听报文的源节点号SNID;所述无效响应报文的SNID为所述侦听报文的DNID。
在第一种可能的实现方式中,所述处理单元还用于:
如果所述第一处理器存在,则发送所述侦听报文到所述第一处理器接口。
在第二种可能的实现方式中,所述装置还包括处理器在位信息管理单元,用于当所述第一处理器被移除时,在所述处理器在位信息中更新所述第一处理器的记录信息,将所述第一处理器的记录信息更新为不存在。
本发明实施例的侦听相应方法和装置,通过在信息目录中查询来自CPU接口的侦听报文或者来自其他节点控制器接口的数据或状态请求报文所请求的内存地址是否被另一个节点控制器所占用,从而确定侦听或请求报文是否是发往被移除的节点的,从而实现由当前NC来解决对发往被移除节点的侦听或请求的处理,直接将侦听或请求转为无效响应,极大的提高了系统的性能及可靠性。
附图说明
图1为本发明实施例一提供的多节点互联示意图;
图2为本发明实施例一提供的报文发送和响应的泳道图;
图3为本发明实施例一提供的基于节点控制器的请求响应方法流程图;
图4为本发明实施例二提供的多节点互联示意图;
图5为本发明实施例二提供的报文发送和响应的泳道图;
图6为本发明实施例二提供的基于节点控制器的请求响应方法流程图;
图7为本发明实施例三提供的请求响应装置的结构示意图;
图8为本发明实施例四提供的请求响应装置的结构示意图。
下面通过附图和实施例,对本发明实施例的技术方案做进一步的详细描述。
具体实施方式
下面以图1、图2并结合图3为例详细说明本发明实施例一提供的基于节点控制器的请求响应方法。本发明实施例一提供的方法,可以应用于在多节点互联系统中,发生节点热移除的情况下。其中,图1为本发明实施例一提供的多节点互联示意图;图2为本发明实施例一提供的报文发送和响应的泳道图;图3为本发明实施例一提供的基于节点控制器的请求响应方法流程图。在如图1所示的多节点互联系统中,节点控制器NC0接收到CPU0发送的第一报文,NC0通过查询信息目录确定第一报文所请求侦听的内存地址是否被NC3所占用。如果确定被占用了,NC0会查询节点在位信息,确定NC3节点是否存在。如果NC3节点是被移除的,那么直接由NC0产生失效响应报文返回给CPU0。从而实现由当前节点控制器NC0来解决对发往被移除节点NC3的第一报文的处理,直接将侦听请求转为无效响应,发送无效响应报文给CPU0,从而极大的提高了系统的性能及可靠性。
具体的基于节点控制器的请求响应方法如图3所示,包括如下步骤:
步骤310,第一节点控制器接收第一报文;所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的请求报文;
具体的,侦听报文是用于查询外部其他节点是否占有本节点某个内存地址上的数据;请求报文是用于获取被请求节点的某个内存地址上的数据。
在一个例子中,如图2所示,CPU0是NC0上的处理器,NC0接收来自CPU0经过协议处理后的SnpInvOwn报文,该SnpInvOwn报文的DNID对应节点控制器NC3。
步骤320,获取信息目录,在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;
具体的,NC0在对发送的侦听请求进行协议处理的过程中,获取信息目录,在信息目录中SnpInvOwn报文所侦听的内存地址是否被NC3占用。所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;在本例中,NC0的信息目录中记录了NC0的内存地址被NC1、NC2和NC3所占用的信息。
步骤330,确定所述内存地址是否被第二节点控制器占用;
具体的,根据上述信息目录中记录的信息确定CPU0要求侦听的内存地址是否被NC3所占用。
如果NC3占用了所述内存地址,执行步骤360;
步骤360,查询节点在位信息,用以确定所述第二节点控制器是否存在;
具体的,节点在位信息是指NC内配置的记录NC域内其他节点是否存在的信息,通过查询该信息,可以确定NC3是否存在。如果确定NC3存在,则执行步骤370,否则执行步骤380、390。
步骤370,对第一报文进行处理,生成第二报文发送到第二节点控制器接口。
具体的,如果NC3存在,则NC0根据接收到SnpInvOwn报文生成相应的NC域的侦听报文发送到NC3接口。
步骤380,生成无效响应报文,所述无效响应报文的DNID为第一报文的SNID,无效响应报文的SNID为第一报文的DNID。
具体的,当查询节点在位信息确定NC3不存在,则NC0直接根据接收到的侦听请求生成无效相应报文RspI,发送给CPU0,通知CPU0它所发出请求侦听的NC3不在位。其中,无效响应报文RspI中的DNID为SnpInvOwn中的源节点号SNID;无效响应报文RspI中的SNID为SnpInvOwn中的DNID。
步骤390,在信息目录中更改第一节点控制器的内存地址被占用的信息,将所述被第二节点控制器占用内存地址释放,并更新信息目录,将所述第二节点控制器的信息更新为不存在。
具体的,更新节点在位信息,记录NC3被移除的信息,并在信息目录中更改NC0的内存地址被NC3所占用的信息,将该内存地址释放。
此外,当所述内存地址没有被第二节点控制器所占用,且第一节点控制器接收到的第一报文为来自第一处理器的侦听报文时,在步骤330之后还包括:
步骤340,生成无效响应报文发送给第一处理器接口;
具体的,NC0直接根据接收到的侦听请求生成无效相应报文RspI,发送给CPU0,通知CPU0它所发出请求侦听的NC3不在位。其中,无效响应报文RspI中的DNID为SnpInvOwn中的源节点号SNID;无效响应报文RspI中的SNID为SnpInvOwn中的DNID。
此外,当所述内存地址没有被第二节点控制器所占用,且第一节点控制器接收到的第一报文为来自其他节点控制器的请求报文时,在步骤330之后还包括:
步骤350,向第一节点控制器的第一处理器接口发送请求。
在另一个例子中,当接收到的SnpInvOwn报文为NC1发送的请求报文,是对NC0节点的CPU0的内存地址空间发送的占位请求,如果查询后NC0确定所请求的内存地址没有被NC3占用,则直接将该请求发送给CPU0。
此外,在其他时刻发生NC域内的某个NC节点被移除时,其他NC节点的节点在位信息会对被移除节点进行相应的记录。
通过采用本实施例一提供的基于节点控制器的请求响应方法,在节点控制器中简单配置其他NC是否在位的信息,当一个NC节点移除时,更新相应的节点在位信息,以及在目录信息中更新被移除节点的占位信息,从而无需在节点移除时对系统内的每个节点的CPU进行内存刷新,由此实现由NC来解决对发往被移除节点的报文的处理,直接将侦听请求转为无效响应进行反馈,极大的提高了系统的性能及可靠性。
下面以图4、图5并结合图6为例详细说明本发明实施例二提供的基于节点控制器的请求响应方法。本发明实施例二提供的方法,可以应用于在多节点互联系统中,发生节点上的某个处理器被热移除的情况下。其中,图4为本发明实施例二提供的多节点互联示意图;图5为本发明实施例二提供的报文发送和响应的泳道图;图6为本发明实施例二提供的基于节点控制器的请求响应方法流程图。在如图4所示的多节点互联系统中,NC3节点上的CPU_b被移除,当节点控制器NC3接收到NC0发送的侦听报文是发送到CPU_b时,NC3就可以通过查询处理器在位信息,从而确定侦听报文是要发往已经被移除的处理器CPU_b的。从而由节点控制器NC3来解决对发往被移除处理器CPU_b的侦听报文的处理,直接将侦听请求转为无效响应,发送无效响应报文给NC0,从而极大的提高了系统的性能及可靠性。
具体的基于节点控制器的请求响应方法如图6所示,包括如下步骤:
步骤610,第一节点控制器接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
具体的,在一个例子中,如图5所示,NC0对来自CPU0发送的侦听经过协议处理后产生SnpInvOwn报文,并发送给NC3,该SnpInvOwn报文的DNID对应节点控制器NC3上的CPU_b的,也就是说该SnpInvOwn报文是发往CPU_b的。
步骤620,获取处理器在位信息;所述处理器在位信息包括所在当前节点控制器的处理器是否存在的信息;
具体的,NC3在对发送的侦听进行协议处理的过程中,获取处理器在位信息。处理器在位信息为预先配置的信息,用来记录当前节点中的处理器在位信息。
步骤630,根据所述处理器在位信息确定所述第一处理器是否存在;
具体的,如果NC3中CPU_b不存在,则执行步骤640,;
如果NC3中CPU_b存在,则执行步骤650。
步骤640,生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
具体的,在本例中,NC3根据处理器在位信息识别CPU_b不存在。NC3直接根据接收到的侦听请求生成无效相应报文RspI,发送给NC0,再由NC0处理后发送给CPU0,通知CPU0它所发出请求侦听的CPU_b不存在。其中,无效响应报文RspI中的目的节点号DNID为SnpInvOwn报文中的源节点号SNID;无效响应报文RspI中的SNID为SnpInvOwn报文中的DNID。
步骤650,发送所述侦听报文到所述第一处理器接口。
具体的,如果NC3根据处理器在位信息识别CPU_b存在,则NC3发送侦听到CPU_b的接口。
该方法还包括,当发生节点上的处理器被热移除时,更新该节点上的处理器在位信息,将处理器被移除的信息记录在处理器在位信息中,将该处理器的记录信息更新为不存在。
通过采用本实施例二提供的侦听相应方法,在节点控制器中简单配置该节点上的处理器是否在位的信息,当一个处理器被移除时,更新相应的处理器在位信息,从而无需在一个处理器移除时对系统内的每个节点的CPU进行内存刷新,由此实现由NC来解决对发往被移除处理器的报文的处理,直接将侦听请求转为无效响应进行反馈,极大的提高了系统的性能及可靠性。
相应的,本发明还公开了一种请求响应的装置,如图7所示,本实施例请求响应装置包括:接收单元710、获取单元720、第一识别单元730、第二识别单元740和处理单元750。本发明实施例的请求响应装置可以为一多节点互联网络中的节点控制器。具体的,可以是一个节点控制器芯片或者是一个具有节点控制器芯片的电路板。
接收单元710,用于接收第一报文,所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的数据或状态请求报文;
获取单元720,用于获取信息目录,所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;
第一识别单元730,用于在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;
第二识别单元740,如果所述第一报文所请求的内存地址被所述第二节点控制器占用了,则所述第二识别单元查询节点在位信息,用以确定所述第二节点控制器是否存在;
处理单元750,用于当确定所述第二节点控制器不存在时,生成无效响应报文并发送;其中,所述无效响应报文的目的节点号DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
进一步的,请求响应装置还包括信息目录管理单元760,用于在所述信息目录中更改所述第一节点控制器的内存地址被第二节点控制器所占用的信息,将所述被第二节点控制器占用内存地址释放,并更新所述节点在位信息,将所述第二节点控制器的信息更新为不存在。
进一步的,处理单元750还用于:
如果所述第二节点控制器存在,则对所述第一报文进行处理,生成第二报文发送到所述第二节点控制器接口。
进一步的,所述处理单元750还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为所述第一节点控制器上的第一处理器接口发送的侦听报文时,则生成无效响应报文发送给第一处理器接口。
进一步的,所述处理单元750还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为来自第三节点控制器接口的数据或状态请求报文时,则向第一处理器接口发送所述请求报文,用以使所述第一处理器记录所述请求的信息。
本实施例提供的请求响应装置通过在装置中配置节点在位信息,并且在系统中一个NC节点移除时对节点在位信息进行更新,从而当有发往被移除节点的报文时,可以直接将侦听请求转为无效相应进行反馈,而无需在节点移除时对系统内的每个节点的CPU进行内存刷新来实现节点移除的记录更新,极大的提高了系统的性能及可靠性。
相应的,本发明还公开了另一种侦听响应的装置,如图8所示,本实施例请求响应装置包括:接收单元810、获取单元820、识别单元830和处理单元840。本发明实施例的请求响应装置具体可以为一多节点互联网络中的节点控制器。具体的,可以是一个节点控制器芯片或者是一个具有节点控制器芯片的电路板。
接收单元810,接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
获取单元820,获取处理器在位信息;所述处理器在位信息包括所在当前节点上的处理器是否存在的信息;;
识别单元830,用于根据所述处理器在位信息识别所述第一处理器是否存在;
处理单元840,如果所述第一处理器不存在,则生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述侦听报文的源节点号SNID;所述无效响应报文的SNID为所述侦听报文的DNID。
进一步的,处理单元840还用于:
如果所述第一处理器存在,则发送所述侦听报文到所述第一处理器接口。
进一步的,所述装置还包括处理器在位信息管理单元850,用于当所述第一处理器被移除时,在所述处理器在位信息中更新所述第一处理器的记录信息,将所述第一处理器的记录信息更新为不存在。
本实施例提供的请求响应装置通过在装置中配置当前节点上的处理器在位信息,并且在当前节点上一个处理器发生移除时对处理器在位信息进行更新,从而当有发往被移除处理器的侦听时,可以直接将侦听请求转为无效相应进行反馈,从而无需在一个处理器移除时对系统内的每个节点的CPU进行内存刷新来记录更新,极大的提高了系统的性能及可靠性。
专业人员应该还可以进一步意识到,结合本文中所公开的实施例描述的各示例的单元及算法步骤,能够以电子硬件、计算机软件或者二者的结合来实现,为了清楚地说明硬件和软件的可互换性,在上述说明中已经按照功能一般性地描述了各示例的组成及步骤。这些功能究竟以硬件还是软件方式来执行,取决于技术方案的特定应用和设计约束条件。专业技术人员可以对每个特定的应用来使用不同方法来实现所描述的功能,但是这种实现不应认为超出本发明的范围。
结合本文中所公开的实施例描述的方法或算法的步骤可以用硬件、处理器执行的软件模块,或者二者的结合来实施。软件模块可以置于随机存储器(RAM)、内存、只读存储器(ROM)、电可编程ROM、电可擦除可编程ROM、寄存器、硬盘、可移动磁盘、CD-ROM、或技术领域内所公知的任意其它形式的存储介质中。
以上所述的具体实施方式,对本发明的目的、技术方案和有益效果进行了进一步详细说明,所应理解的是,以上所述仅为本发明的具体实施方式而已,并不用于限定本发明的保护范围,凡在本发明的精神和原则之内,所做的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。
Claims (16)
1.一种基于节点控制器的请求响应方法,其特征在于,所述方法包括:
第一节点控制器接收第一报文;所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的请求报文;
获取信息目录,在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;
如果所述第一报文所请求的内存地址被所述第二节点控制器占用了,则查询节点在位信息,用以确定所述第二节点控制器是否存在;
当确定所述第二节点控制器不存在时,生成无效响应报文并发送;其中,所述无效响应报文的目的节点号DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
2.根据权利要求1所述的方法,其特征在于,当确定所述第二节点控制器不存在时,生成无效响应报文并发送之后,所述方法还包括:
在所述信息目录中更改所述第一节点控制器的内存地址被第二节点控制器所占用的信息,将所述被第二节点控制器占用内存地址释放,并更新所述节点在位信息,将所述第二节点控制器的信息更新为不存在。
3.根据权利要求1所述的方法,其特征在于,所述方法还包括:
如果所述第二节点控制器存在,则对所述第一报文进行处理生成第二报文,把所述第二报文发送到所述第二节点控制器接口。
4.根据权利要求1所述的方法,其特征在于,如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,所述方法还包括:
当所述第一报文为所述第一节点控制器上的第一处理器接口发送的侦听报文时,则生成无效响应报文发送给第一处理器接口。
5.根据权利要求1所述的方法,其特征在于,如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,所述方法还包括:
当所述第一报文为来自第三节点控制器接口的数据或状态请求报文时,则向第一节点控制器的第一处理器接口发送所述请求报文,用以使所述第一处理器记录所述请求的信息。
6.一种基于节点控制器的请求响应方法,其特征在于,所述方法包括:
第一节点控制器接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
获取处理器在位信息;所述处理器在位信息包括所在当前节点上的处理器是否存在的信息;
如果所述第一处理器不存在,则生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
7.根据权利要求6所述的方法,其特征在于,所述方法还包括:
如果所述第一处理器存在,则发送所述侦听报文到所述第一处理器接口。
8.根据权利要求6所述的方法,其特征在于,所述方法还包括:
当所述第一处理器被移除时,在所述处理器在位信息中更新所述第一处理器的记录信息,将所述第一处理器的记录信息更新为不存在。
9.一种请求响应装置,其特征在于,所述装置包括:
接收单元,用于接收第一报文,所述第一报文为来自CPU接口的侦听报文或者来自其他节点控制器接口的数据或状态请求报文;
获取单元,用于获取信息目录,所述信息目录包括当前节点控制器的内存地址被其他节点控制器所占用的信息;
第一识别单元,用于在所述信息目录中查询所述第一报文所请求的内存地址是否被所述第二节点控制器占用;
第二识别单元,如果所述第一报文所请求的内存地址被所述第二节点控制器占用了,则所述第二识别单元查询节点在位信息,用以确定所述第二节点控制器是否存在;
处理单元,用于当确定所述第二节点控制器不存在时,生成无效响应报文并发送;其中,所述无效响应报文的目的节点号DNID为所述第一报文的源节点号SNID;所述无效响应报文的SNID为所述第一报文的DNID。
10.根据权利要求9所述的装置,其特征在于,所述装置还包括:信息目录管理单元,用于在所述信息目录中更改所述第一节点控制器的内存地址被第二节点控制器所占用的信息,将所述被第二节点控制器占用内存地址释放,并更新所述节点在位信息,将所述第二节点控制器的信息更新为不存在。
11.根据权利要求9所述的装置,其特征在于,所述处理单元还用于:
如果所述第二节点控制器存在,则对所述第一报文进行处理生成第二报文,把所述第二报文发送到所述第二节点控制器接口。
12.根据权利要求9所述的装置,其特征在于,所述处理单元还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为所述第一节点控制器上的第一处理器接口发送的侦听报文时,则生成无效响应报文发送给第一处理器接口。
13.根据权利要求9所述的装置,其特征在于,所述处理单元还用于:
如果所述第一报文所请求的内存地址没有被所述第二节点控制器占用,则当所述第一报文为来自第三节点控制器接口的数据或状态请求报文时,则向第一处理器接口发送所述请求报文,用以使所述第一处理器记录所述请求的信息。
14.一种请求响应装置,其特征在于,所述装置包括:
接收单元,接收第二节点控制器接口发送的侦听报文;所述侦听报文的目的节点号DNID为第一处理器;
获取单元,获取处理器在位信息;所述处理器在位信息包括所在当前节点上的处理器是否存在的信息;
识别单元,用于根据所述处理器在位信息识别所述第一处理器是否存在;
处理单元,如果所述第一处理器不存在,则生成无效响应报文发送给第二节点控制器接口;其中,所述无效响应报文的DNID为所述侦听报文的源节点号SNID;所述无效响应报文的SNID为所述侦听报文的DNID。
15.根据权利要求14所述的装置,其特征在于,所述处理单元还用于:
如果所述第一处理器存在,则发送所述侦听报文到所述第一处理器接口。
16.根据权利要求14所述的装置,其特征在于,所述装置还包括处理器在位信息管理单元,用于当所述第一处理器被移除时,在所述处理器在位信息中更新所述第一处理器的记录信息,将所述第一处理器的记录信息更新为不存在。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201310410556.3A CN103488606B (zh) | 2013-09-10 | 2013-09-10 | 基于节点控制器的请求响应方法和装置 |
PCT/CN2014/085969 WO2015035882A1 (zh) | 2013-09-10 | 2014-09-05 | 基于节点控制器的请求响应方法和装置 |
EP17200376.6A EP3355181B1 (en) | 2013-09-10 | 2014-09-05 | Method and apparatus for responding to request based on node controller |
EP14843838.5A EP3046035B1 (en) | 2013-09-10 | 2014-09-05 | Request response method and device based on a node controller |
US15/066,623 US10324646B2 (en) | 2013-09-10 | 2016-03-10 | Node controller and method for responding to request based on node controller |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201310410556.3A CN103488606B (zh) | 2013-09-10 | 2013-09-10 | 基于节点控制器的请求响应方法和装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN103488606A true CN103488606A (zh) | 2014-01-01 |
CN103488606B CN103488606B (zh) | 2016-08-17 |
Family
ID=49828850
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201310410556.3A Active CN103488606B (zh) | 2013-09-10 | 2013-09-10 | 基于节点控制器的请求响应方法和装置 |
Country Status (4)
Country | Link |
---|---|
US (1) | US10324646B2 (zh) |
EP (2) | EP3355181B1 (zh) |
CN (1) | CN103488606B (zh) |
WO (1) | WO2015035882A1 (zh) |
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EP3046035A1 (en) | 2016-07-20 |
EP3046035A4 (en) | 2016-10-05 |
US10324646B2 (en) | 2019-06-18 |
US20160196087A1 (en) | 2016-07-07 |
CN103488606B (zh) | 2016-08-17 |
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Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant |