CN103426416B - 一种显示驱动电路及其驱动方法、显示装置 - Google Patents
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Abstract
本发明提供一种显示驱动电路及其驱动方法、显示装置，涉及显示技术领域。可以解决阵列基板中线贯穿不良的现象，从而提升显示器件的质量和显示效果。显示驱动电路包括控制单元和输出单元，控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接输出单元，该输出单元还连接像素电路，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号通过输出单元输出至像素电路。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种显示驱动电路及其驱动方法、显示装置。
背景技术
TFT-LCD（Thin Film Transistor Liquid Crystal Display，薄膜晶体管-液晶显示器）作为一种平板显示装置，因其具有体积小、功耗低、无辐射以及制作成本相对较低等特点，越来越多地被应用于高性能显示领域当中。TFT-LCD由阵列基板和彩膜基板构成。在阵列基板和彩膜基板中充入液晶，通过控制液晶的偏转，从而实现对背光光线强弱的控制，强弱不同的背光通过彩膜基板，实现图像显示。现有TFT-LCD的制造工艺主要包括四个阶段，分别为彩色滤光片制备、Array（阵列基板制造）工艺、Cell（液晶盒制备）工艺以及Module（模块组装）工艺。作为TFT-LCD生产的一个重要环节，Array工艺通常是在一张玻璃基板上通过横纵交叉的栅线和数据线划分形成独立的TFT阵列电路，每个阵列电路分别对应一个显示像素，阵列电路的质量将直接影响产品的显示质量。
在现有的Array工艺中，为了向栅线或数据线逐行或逐列的输入信号，通常在阵列基板的可视区以外设计有驱动电路，在实际生产或使用的过程中，由于该驱动电路极容易受到灰尘或静电的破坏，这将使得该电路的某行或某列失效，从而导致阵列基板的个别行或列无法显示图像，产生线贯穿不良的现象，使得阵列基板的质量大幅降低。然而由于制造阵列基板的工艺复杂，不能完全避免制程过程中灰尘或静电的影响，因此无法有效解决阵列基板的线贯穿不良的问题，从而影响显示器件的显示效果，降低产品的质量。
发明内容
本发明的实施例提供一种显示驱动电路及其驱动方法、显示装置。可以解决阵列基板中线贯穿不良的现象，从而提升显示器件的质量和显示效果。
为达到上述目的，本发明的实施例采用如下技术方案：
本发明的实施例提供一种显示驱动电路，所述显示驱动电路与像素电路相连接，所述像素电路包括栅线和数据线，所述栅线和所述数据线交叉界定像素单元，所述显示驱动电路包括：控制单元和输出单元；
所述控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接所述输出单元，用于根据所述第一信号线和所述第二信号线输入的驱动信号打开所述输出单元；
所述输出单元连接所述像素电路，当所述第一信号线或所述第二信号线中至少一条信号线有信号输入时，所述输入的驱动信号通过所述输出单元输出至所述像素电路。
所述控制单元包括：
第一晶体管，所述第一晶体管的栅极与所述第一信号线的输出端相连接；
与非门，所述与非门的第一输入端与所述第一信号线的输出端相连接；所述与非门的第二输入端与第二信号线的输出端和第一晶体管的漏极相连接；
或门，所述或门的第一输入端与所述与非门的输出端相连接；所述或门的第二输入端与所述第一晶体管的源级相连接。
所述输出单元包括：
第二晶体管，所述第二晶体管的源级与所述第一信号线的输出端相连接，所述第二晶体管的栅极与所述控制单元的输出端相连接；
第三晶体管，所述第三晶体管的源级与所述第二信号线的输出端相连接；所述第三晶体管的漏极与所述第二晶体管的漏极相连接，所述第三晶体管的栅极与所述控制单元的输出端相连接。
所述第一信号线和所述第二信号线为相邻的栅线，所述控制单元的输出端与所述像素电路中的栅线相连接。
所述第一信号线和所述第二信号线为相邻的数据线，所述控制单元的输出端与所述像素电路中的数据线相连接。
本发明实施例的另一方面，提供一种显示装置，包括如上所述的显示驱动电路。
本发明实施例的又一方面，提供一种显示驱动电路的驱动方法，所述显示驱动电路与像素电路相连接，所述像素电路包括栅线和数据线，所述栅线和所述数据线交叉界定像素单元，所述方法包括：
第一信号线和第二线号线向控制单元的输入端输入驱动信号；
所述控制单元根据所述第一信号线和所述第二信号线输入的驱动信号打开与所述控制单元相连接的输出单元；
当所述第一信号线或所述第二信号线中至少一条信号线有信号输入时，所述输入的驱动信号通过所述输出单元输出至所述像素电路。
所述第一信号线和所述第二信号线为相邻的栅线，所述控制单元向所述像素电路中的栅线输出所述驱动信号。
所述第一信号线和所述第二信号线为相邻的数据线，所述控制单元向所述像素电路中的数据线输出所述驱动信号。
本发明实施例提供一种显示驱动电路及其驱动方法、显示装置，通过设置与像素电路相连接的显示驱动电路，该显示驱动电路包括控制单元和输出单元，该控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接输出单元。这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路，从而可以解决阵列基板中线贯穿不良的现象，并提升显示器件的质量和显示效果。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的显示驱动电路的结构示意图；
图2为本发明实施例提供的显示驱动电路的连接结构示意图；
图3为本发明实施例提供的一种逻辑门的输入输出真值表；
图4为本发明实施例提供的另一种逻辑门的输入输出真值表；
图5为本发明实施例提供的显示驱动电路的输入输出真值表。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供一种显示驱动电路10，如图1所示，该显示驱动电路10与像素电路20相连接，像素电路20包括栅线和数据线（图中未示出），栅线和数据线交叉界定该像素单元。该显示驱动电路10可以包括：控制单元11和输出单元12。
控制单元11的输入端分别连接第一信号线30和第二信号线31，其输出端连接输出单元12，可以用于根据第一信号线30和第二信号线31输入的驱动信号打开输出单元12。
输出单元12可以连接像素电路20，当第一信号线30或第二信号线31中至少一条信号线有信号输入时，输入的驱动信号通过输出单元12输出至像素电路20。
本发明实施例提供一种显示驱动电路，通过设置与像素电路相连接的显示驱动电路，该显示驱动电路包括控制单元和输出单元，该控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接输出单元。这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路，从而可以解决阵列基板中线贯穿不良的现象，并提升显示器件的质量和显示效果。
进一步地，如图2所示，控制单元11可以包括：
第一晶体管110，第一晶体管110的栅极与第一信号线30的输出端相连接。
与非门111，该与非门111的第一输入端A与第一信号线30的输出端相连接；与非门111的第二输入端B与第二信号线31的输出端和第一晶体管110的漏极相连接。
或门112，该或门112的第一输入端Y与与非门111的输出端相连接；或门112的第二输入端X与第一晶体管110的源级相连接。
这样一来，通过给控制单元接入两条信号线：第一信号线和第二信号线，当这两条信号线中的任一条由于受到灰尘或静电的破坏导致线贯穿不良时，驱动信号仍然可以通过另外一条信号线输入至控制单元，从而保证输入信号不失效。
进一步地，如图2所示，输出单元12可以包括：
第二晶体管121，该第二晶体管121的源级与第一信号线30的输出端相连接，第二晶体管121的栅极与述控制单元11的输出端相连接。
第三晶体管122，该第三晶体管122的源级与第二信号线32的输出端相连接；第三晶体管122的漏极与第二晶体管121的漏极相连接，第三晶体管122的栅极与控制单元11的输出端相连接。
这样一来，可以根据第一信号线和第二信号线输入的驱动信号打开该输出单元，从而使得该驱动信号通过输出单元输出至像素电路。
进一步地，第一信号线30和第二信号线31可以为相邻的栅线，控制单元11的输出端与像素电路20中的栅线相连接。
或者，第一信号线30和第二信号线31可以为相邻的数据线，所述控制单元11的输出端与像素电路20中的数据线相连接。
这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路中的栅线或数据线，从而保证像素电路中的各行栅线或各列数据线中的信号不失效。
第一信号线30和第二信号线31采用这样一种相邻的布线方式比较容易实现，从而减少加工过程中工作人员的工作时间，提高生产效率。
需要说明的是，第一信号线30和第二信号线31的位置可以根据生产加工需要任意设置，比如，第一信号线30设置于该显示驱动电路的最上端，而第二信号线31设置于该显示驱动电路的最下端。本发明实施例是以第一信号线30和第二信号线31为相邻的栅线为例进行的说明，其他对于第一信号线30和第二信号线31位置的设置不再一一赘述，但都应当纳入本发明的保护范围之内。
本发明实施例提供一种显示装置，包括如上任意一种显示驱动电路，具有与本发明前述实施例提供的显示驱动电路相同的有益效果，由于显示驱动电路在前述实施例中已经进行了详细说明，此处不再赘述。
本发明实施例提供一种显示装置，该显示装置包括显示驱动电路，通过设置与像素电路相连接的显示驱动电路，该显示驱动电路包括控制单元和输出单元，该控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接输出单元。这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路，从而可以解决阵列基板中线贯穿不良的现象，并提升显示器件的质量和显示效果。
本发明实施例提供一种显示驱动电路的驱动方法，显示驱动电路10与像素电路20相连接，像素电路20包括栅线和数据线，栅线和数据线交叉界定像素单元，该方法包括：
S101、第一信号线30和第二线号线31向控制单元11的输入端输入驱动信号。
S102、控制单元11根据第一信号线30和第二信号线31输入的驱动信号打开与控制单元11相连接的输出单元12。
S103、当第一信号线30或第二信号线31中至少一条信号线有信号输入时，输入的驱动信号通过输出单元12输出至像素电路20。
本发明实施例提供一种显示驱动电路的驱动方法，通过设置与像素电路相连接的显示驱动电路，该显示驱动电路包括控制单元和输出单元，该控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接输出单元。这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路，从而可以解决阵列基板中线贯穿不良的现象，并提升显示器件的质量和显示效果。
进一步地，第一信号线30和第二信号线31可以为相邻的栅线，控制单元11向像素电路20中的栅线输出该驱动信号。
或者，第一信号线30和第二信号线31可以为相邻的数据线，控制单元11向像素电路20中的数据线输出该驱动信号。
这样一来，当第一信号线或第二信号线中至少一条信号线有信号输入时，输入的驱动信号仍然可以通过该显示驱动电路输出至像素电路中的栅线或数据线，从而保证像素电路中的各行栅线或各列数据线中的信号不失效。
第一信号线30和第二信号线31采用这样一种相邻的布线方式比较容易实现，从而减少加工过程中工作人员的工作时间，提高生产效率。
需要说明的是，第一信号线30和第二信号线31的位置可以根据生产加工需要任意设置，比如，第一信号线30设置于该显示驱动电路的最上端，而第二信号线31设置于该显示驱动电路的最下端。本发明实施例是以第一信号线30和第二信号线31为相邻的栅线为例进行的说明，其他对于第一信号线30和第二信号线31位置的设置不再一一赘述，但都应当纳入本发明的保护范围之内。
需要说明的是，可以通过图3所示的与非门111的输入输出真值表以及图4所示的或门112的输入输出真值表得出如图5所示的该显示驱动电路的输入输出真值表。
以下结合图2、图3、图4、图5对该显示驱动电路的驱动方法进行详细的举例说明。
例一：
S201、第一信号线30向控制单元11的输入端输入驱动信号1stline=1，第一晶体管110导通，以及第二线号线31向控制单元11的输入端输入驱动信号2ed line=1。
S202、控制单元11中与非门111的第一输入端A与第一信号线30的输出端相连接，所以第一输入端A输入1，第二输入端B与第二信号线的输出端相连接，所以第二输入端B输入1，如图3所示，该与非门输出为0。
因此，与与非门111的输出端相连接的或门112的第一输入端Y输入0；与第一晶体管110的源级相连接的或门112的第二输入端X输入1，如图4所示，该或门输出为1，即该控制单元11输出为1。
S203、与控制单元11的输入端连接输出单元12打开，即第二晶体管121，第三晶体管122导通。
S204、第一信号线30以及第二信号线31输入的驱动信号通过输出单元12输出至像素电路20。
例二：
S301、第一信号线30向控制单元11的输入端输入驱动信号1stline=1，第一晶体管110导通，以及第二线号线31向控制单元11的输入端输入驱动信号2ed line=0。
S302、控制单元11中与非门111的第一输入端A与第一信号线30的输出端相连接，所以第一输入端A输入1，第二输入端B与第二信号线的输出端相连接，所以第二输入端B输入0，如图3所示，该与非门输出为1。
因此，与与非门111的输出端相连接的或门112的第一输入端Y输入1；与第一晶体管110的源级相连接的或门112的第二输入端X输入0，如图4所示，该或门输出为1，即该控制单元11输出为1。
S303、与控制单元11的输入端连接输出单元12打开，即第二晶体管121，第三晶体管122导通。
S304、第一信号线30输入的驱动信号通过输出单元12输出至像素电路20。
例三：
S401、第一信号线30向控制单元11的输入端输入驱动信号1stline=0，第一晶体管110关闭，以及第二线号线31向控制单元11的输入端输入驱动信号2ed line=1。
S402、控制单元11中与非门111的第一输入端A与第一信号线30的输出端相连接，所以第一输入端A输入0，第二输入端B与第二信号线的输出端相连接，所以第二输入端B输入1，如图3所示，该与非门输出为1。
因此，与与非门111的输出端相连接的或门112的第一输入端Y输入1；与第一晶体管110的源级相连接的或门112的第二输入端X输入0，如图4所示，该或门输出为1，即该控制单元11输出为1。
S403、与控制单元11的输入端连接输出单元12打开，即第二晶体管121，第三晶体管122导通。
S404、第二信号线31输入的驱动信号通过输出单元12输出至像素电路20。
本领域普通技术人员可以理解：实现上述方法实施例的全部或部分步骤可以通过程序指令相关的硬件来完成，前述的程序可以存储于一计算机可读取存储介质中，该程序在执行时，执行包括上述方法实施例的步骤；而前述的存储介质包括：ROM、RAM、磁碟或者光盘等各种可以存储程序代码的介质。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。
Claims (9)
1.一种显示驱动电路，所述显示驱动电路与像素电路相连接，所述像素电路包括栅线和数据线，所述栅线和所述数据线交叉界定像素单元，其特征在于，所述显示驱动电路包括：控制单元和输出单元；
所述控制单元的输入端分别连接第一信号线和第二信号线，其输出端连接所述输出单元，用于根据所述第一信号线和所述第二信号线输入的驱动信号打开所述输出单元；
所述输出单元连接所述像素电路，当所述第一信号线或所述第二信号线中至少一条信号线有信号输入时，所述输入的驱动信号通过所述输出单元输出至所述像素电路。
2.根据权利要求1所述的显示驱动电路，其特征在于，所述控制单元包括：
第一晶体管，所述第一晶体管的栅极与所述第一信号线的输出端相连接；
与非门，所述与非门的第一输入端与所述第一信号线的输出端相连接；所述与非门的第二输入端与第二信号线的输出端和第一晶体管的漏极相连接；
或门，所述或门的第一输入端与所述与非门的输出端相连接；所述或门的第二输入端与所述第一晶体管的源级相连接。
3.根据权利要求1所述的显示驱动电路，其特征在于，所述输出单元包括：
第二晶体管，所述第二晶体管的源级与所述第一信号线的输出端相连接，所述第二晶体管的栅极与所述控制单元的输出端相连接；
第三晶体管，所述第三晶体管的源级与所述第二信号线的输出端相连接；所述第三晶体管的漏极与所述第二晶体管的漏极相连接，所述第三晶体管的栅极与所述控制单元的输出端相连接。
4.根据权利要求1-3任一项所述的显示驱动电路，其特征在于，所述第一信号线和所述第二信号线为相邻的栅线，所述显示驱动电路的输出端与所述像素电路中的栅线相连接。
5.根据权利要求1-3任一项所述的显示驱动电路，其特征在于，所述第一信号线和所述第二信号线为相邻的数据线，所述显示驱动电路的输出端与所述像素电路中的数据线相连接。
6.一种显示装置，其特征在于，包括如权利要求1-5任一所述的显示驱动电路。
7.一种显示驱动电路的驱动方法，所述显示驱动电路与像素电路相连接，所述像素电路包括栅线和数据线，所述栅线和所述数据线交叉界定像素单元，其特征在于，所述方法包括：
第一信号线和第二线号线向控制单元的输入端输入驱动信号；
所述控制单元根据所述第一信号线和所述第二信号线输入的驱动信号打开与所述控制单元相连接的输出单元；
当所述第一信号线或所述第二信号线中至少一条信号线有信号输入时，所述输入的驱动信号通过所述输出单元输出至所述像素电路。
8.根据权利要求7所述的驱动方法，其特征在于，所述第一信号线和所述第二信号线为相邻的栅线，所述显示驱动电路向所述像素电路中的栅线输出所述驱动信号。
9.根据权利要求7所述的驱动方法，其特征在于，所述第一信号线和所述第二信号线为相邻的数据线，所述显示驱动电路向所述像素电路中的数据线输出所述驱动信号。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant |