CN103037222A - 一种并行数字视频信号的压缩传输装置和方法 - Google Patents

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张孝峥
杜宏
王晓峰
倪菊艳
王英胜
郭伟
刘淑云
秦叔敏
陈晚如
洪汀
张鹏
李丽丹
刘倩
王永山
姜哲
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Abstract

本发明提供一种并行数字视频信号的压缩传输装置以及传输方法，在数据串化器、数据解串器低频输入时钟受限下，传输低频数字视频并行数据。在本发明提供的并行数字视频信号的压缩传输装置与传输方法中，将并行视频数据的时钟通过所述第一可编程逻辑器件中的第一锁相环进行倍频，以满足数据串化器最低输入频率；通过数据串化器将并行数据压缩成高速串行数据进行传输，接收端通过数据解串器将串行数据解压缩成并行数据输入给第二可编程逻辑器件，通过第二可编程逻辑器件中的第二锁相环将解调时钟进行降频还原处理成原始时钟，同数据一起输出给显示装置。

Description

一种并行数字视频信号的压缩传输装置和方法
技术领域
本发明涉及视频图像信号处理技术领域，具体涉及并行数字视频信号的压缩传输装置和方法。
背景技术
传统的并行数字视频信号多采用并行RS422传输数据，但这种传输方式远不能满足集成化系统要求信号紧凑结构的要求，且电缆较复杂，可靠性差。
发明内容
本发明要解决上述背景技术中提到的技术问题，提供一种在数据串化器、数据解串器低频输入时钟受限下，传输低频数字视频并行数据。
根据本发明提供的一种并行数字视频信号的压缩传输装置，其特征在于，包括：第一可编程逻辑器件，接收视频输入并行数字信号；第一可编程逻辑器件内设置第一锁相环，所述第一锁相环将时钟进行倍频；与第一可编程逻辑器件相连接的数据串化器，所述数据串化器用于将并行数据压缩成串行数据；与上述数据串化器相连接的数据解串器，将串行数据解压缩成并行数据；与数据解串器相连的第二可编程逻辑器件，所述第二可编程逻辑器件内设置有第二锁相环，所述第二锁相环将时钟进行降频。
本发明还提供一种并行数字视频信号的压缩传输方法，其特征在于，包括：将并行视频数据的时钟通过所述第一可编程逻辑器件中的第一锁相环进行倍频，以满足数据串化器最低输入频率；通过数据串化器将并行数据压缩成高速串行数据进行传输，接收端通过数据解串器将串行数据解压缩成并行数据输入给第二可编程逻辑器件，通过第二可编程逻辑器件中的第二锁相环将解调时钟进行降频还原处理成原始时钟，同数据一起输出给显示装置。
通过以上并行数字视频信号的压缩传输装置和方法，有效提高了信号传输的可靠性，降低了信号传输路径的复杂度。
附图说明
图1为本发明并行数字视频信号的压缩传输装置的逻辑框架图。
具体实施方式
为使本发明的目的、内容、和优点更加清楚，下面结合附图和实施例，对本发明的具体实施方式作进一步详细描述。
本发明的并行数字视频信号的压缩传输装置包括：第一可编程逻辑器件1，用于接收视频输入并行数字信号，第一可编程逻辑器件1内设置第一锁相环11，所述第一锁相环用于在所述第一可编程逻辑器件的控制下将时钟进行倍频；与第一可编程逻辑器件1相连接的数据串化器2，所述数据串化器2用于将并行数据压缩成串行数据；与上述数据串化器相连接的数据解串器3，所述数据解串器3用于将串行数据解压缩成并行数据；与数据解串器3相连的第二可编程逻辑器件4，用于向显示装置输出数据，所述第二可编程逻辑器件4内设置有第二锁相环41，所述第二锁相环41用于在所述第二可编程逻辑器件的控制下将时钟进行降频。
应用上述数字视频信号的压缩传输装置时，将并行视频数据的时钟通过所述第一可编程逻辑器件1中的第一锁相环11进行倍频，以满足数据串化器最低输入频率，之后通过数据串化器2将并行数据压缩成高速串行LVDS(Low-Voltage Differential Signaling)数据进行传输，接收端通过数据解串器3将串行数据解压缩成并行数据输入给第二可编程逻辑器件4，通过第二可编程逻辑器件4中的第二锁相环41将解调时钟进行降频还原处理成原始时钟，同数据一起输出给显示装置。
通过以上并行数字视频信号的压缩传输装置和方法，有效提高了信号传输的可靠性，降低了信号传输路径的复杂度。
以上所述仅是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明技术原理的前提下，还可以做出若干改进和变形，这些改进和变形也应视为本发明的保护范围。

Claims (2)

1.一种并行数字视频信号的压缩传输装置，其特征在于，包括：
第一可编程逻辑器件(1)，接收视频输入并行数字信号；
第一可编程逻辑器件(1)内设置第一锁相环(11)，所述第一锁相环将时钟进行倍频；
与第一可编程逻辑器件(1)相连接的数据串化器(2)，所述数据串化器(2)用于将并行数据压缩成串行数据；
与上述数据串化器(2)相连接的数据解串器(3)，将串行数据解压缩成并行数据；
与数据解串器(3)相连的第二可编程逻辑器件(4)，所述第二可编程逻辑器件(4)内设置有第二锁相环(41)，所述第二锁相环(41)将时钟进行降频。
2.一种应用权利要求1所述并行数字视频信号的压缩传输装置的压缩传输方法，其特征在于，包括：
将并行视频数据的时钟通过所述第一可编程逻辑器件(1)中的第一锁相环(11)进行倍频，以满足数据串化器最低输入频率；
通过数据串化器(2)将并行数据压缩成高速串行数据进行传输，接收端通过数据解串器(3)将串行数据解压缩成并行数据输入给第二可编程逻辑器件(4)，通过第二可编程逻辑器件(4)中的第二锁相环(41)将解调时钟进行降频还原处理成原始时钟，同数据一起输出给显示装置。
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PB01 Publication
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C12 Rejection of a patent application after its publication
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