CN103021338B - 像素电路及其驱动方法、显示装置 - Google Patents

Abstract

本发明提供像素电路及其驱动方法、显示装置，涉及显示技术领域，能够解决图像显示不均匀的问题，同时提高OLED的使用寿命。本发明的像素电路包括：第一开关管的源极输入电源电压信号；与第一开关管的漏极连接的第二开关管的源极；第三开关管的栅极与第二开关管的栅极连接，第三开关管的源极接收数据信号；与第三开关管的漏极连接的第五开关管的漏极，第五开关管的源极与第一开关管的源极连接；与第二开关管的漏极连接的驱动晶体管的栅极，驱动晶体管的源极与第二开关管的源极连接；与驱动晶体管的漏极连接的第四开关管的源极，第四开关管的漏极与地线连接；设置于第一极点与第二极点之间的电容。

Description

像素电路及其驱动方法、显示装置

技术领域

本发明涉及显示技术领域，尤其涉及像素电路及其驱动方法、显示装置。

背景技术

OLED(Organic Light-Emitting Diode，有机发光二极管)显示器是目前平板显示器领域的研究热点之一，与传统的液晶显示器相比，OLED显示器具有低能耗、低成本、自发光、宽视角及响应快等优点，随着OLED的发展，目前的手机、平板电脑及数码相机等显示装置已经开始慢慢取代传统的液晶显示器。

在OLED显示器中，像素电路是其核心部分，与传统的液晶显示器利用稳定的电压来控制其亮度相比，OLED显示器需要稳定的电流来控制OLED发光。如图1所示，为现有技术的像素电路1，包括：一个开关晶体管10、一个驱动晶体管11和一个存储电容12，当扫描信号VSCAN选择某一行时，扫描信号电压为低电平，开关晶体管10打开，数据信号Vdata将电压写入存储电容12中，当该行扫描结束后，扫描信号电压变为高电平，开关晶体管10截止，存储电容12上的电压通过驱动晶体管11的栅极打开驱动晶体管11，以使得驱动晶体管11产生电流来驱动OLED 13，从而保证OLED 13在一帧内持续发光，同时，流过驱动晶体管11的饱和电流为I_OLED＝K(V_GS-V_th)²，然而，由于各个像素点的驱动晶体管11的阈值电压会随着工艺制程和器件老化等原因出现漂移，导致流过每个像素点OLED 13的电流也随着阈值电压的变化而变化，从而使得显示亮度不均匀，影响了图像的显示效果。

发明内容

本发明的实施例提供像素电路及其驱动方法、显示装置，能够解决图像显示不均匀的问题，同时提高OLED的使用寿命。

为达到上述目的，本发明的实施例采用如下技术方案：

一种像素电路，包括：

第一开关管，所述第一开关管的源极输入电源电压信号，所述第一开关管的栅极接收第二扫描信号，其中，所述第二扫描信号用于控制所述第一开关管导通或截止；

第二开关管，所述第二开关管的源极与所述第一开关管的漏极连接；

第三开关管，所述第三开关管的栅极和所述第二开关管的栅极接收第一扫描信号，所述第三开关管的源极接收数据信号，其中，所述第一扫描信号用于控制所述第二开关管和所述第三开关管导通或截止；

第五开关管，所述第五开关管的漏极与所述第三开关管的漏极连接，所述第五开关管的源极与所述第一开关管的源极连接，所述第五开关管的栅极接收第一控制信号，其中，所述第一控制信号用于控制所述第五开关管导通或截止；

驱动晶体管，所述驱动晶体管的栅极与所述第二开关管的漏极连接，所述驱动晶体管的源极与所述第二开关管的源极连接；

第四开关管，所述第四开关管的源极与所述驱动晶体管的漏极连接，所述第四开关管的栅极接收第三扫描信号，所述第四开关管的漏极与地线连接，其中，所述第三扫描信号用于控制所述第四开关管导通或截止；

设置于第一极点与第二极点之间的电容，所述第一极点为所述第三开关管的漏极与所述第五开关管的漏极的连接点，所述第二极点为所述第二开关管的漏极与所述驱动晶体管的栅极的连接点。

所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管、所述第五开关管及所述驱动晶体管均为N型薄膜晶体管。

当所述第四开关管为P型薄膜晶体管时，所述第三扫描信号与所述第二扫描信号相同，所述第四开关管的栅极接收所述第二扫描信号。

一种显示装置，包括上述所述的像素电路。

一种像素电路的驱动方法，包括：

在重置阶段内，第一扫描信号控制第二开关管和第三开关管导通，第二扫描信号控制第一开关管导通，电源电压信号通过所述第一开关管和所述第二开关管为第二极点充电，数据信号通过所述第三开关管为第一极点充电，第三扫描信号控制第四开关管导通，第五开关管截止；

在补偿阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管导通，所述第三扫描信号控制所述第四开关管导通，驱动晶体管的栅极和源极连接，所述第二极点通过所述驱动晶体管和所述第四开关管放电，所述数据信号通过所述第三开关管保持所述电容的所述第一极点的电压，所述电容两端的电压差为第一电压差，所述第一开关管和所述第五开关管截止；

在缓冲阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管截止，所述第三扫描信号控制所述第四开关管导通，所述第一控制信号控制所述第五开关管导通，所述电源电压信号通过所述第五开关管继续保持所述第一极点与所述第二极点之间的电压差仍为所述第一电压差，所述第一开关管、所述第二开关管以及所述第三开关管截止；

在发光阶段内，所述第二扫描信号控制所述第一开关管导通，所述电源电压信号通过所述第一开关管和所述驱动晶体管驱动发光元件发光，所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管截止。

所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管、所述第五开关管及所述驱动晶体管均为N型薄膜晶体管。

本发明提供像素电路及其驱动方法、显示装置，像素电路包括第一开关管，第一开关管的源极输入电源电压信号，第一开关管的栅极接收第二扫描信号，其中，第二扫描信号用于控制第一开关管导通或截止，第二开关管的源极与第一开关管的漏极连接，第三开关管的栅极和第二开关管的栅极接收第一扫描信号，第三开关管的源极接收数据信号，其中，第一扫描信号用于控制第二开关管和第三开关管导通或截止，第五开关管的漏极与第三开关管的漏极连接，第五开关管的源极与第一开关管的源极连接，第五开关管的栅极接收第一控制信号，其中，第一控制信号用于控制第五开关管导通或截止，驱动晶体管的栅极与第二开关管的漏极连接，驱动晶体管的源极与第二开关管的源极连接，第四开关管的源极与驱动晶体管的漏极连接，第四开关管的栅极接收第三扫描信号，第四开关管的漏极与地线连接，其中，第三扫描信号用于控制第四开关管导通或截止，设置于第一极点与第二极点之间的电容，第一极点为第三开关管的漏极与第五开关管的漏极的连接点，第二极点为第二开关管的漏极与驱动晶体管的栅极的连接点。通过该方案，由于该像素电路的设计，以使得流过每个像素点OLED的电流不随着驱动晶体管阈值电压的变化而变化，从而保证了图像显示的均匀性，同时由于像素电路的补偿阶段和缓冲阶段无电流流过OLED，因此，提高了OLED的使用寿命。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。

图1为现有技术提供的像素电路示意图；

图2为本发明实施例提供的像素电路示意图一；

图3为本发明实施例提供的像素电路示意图二；

图4为本发明实施例提供的像素电路的时序图一；

图5为本发明实施例提供的像素电路的时序图二；

图6为本发明实施例提供的像素电路的驱动方法流程图。

具体实施方式

下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。

如图2所示，本发明实施例提供一种像素电路2，包括：

第一开关管200，第一开关管200的源极与电源Vdd连接，第一开关管200的栅极接收第二扫描信号VSCAN2，其中，第二扫描信号VSCAN2用于控制第一开关管200导通或截止。

与第一开关管200连接的第二开关管201，第二开关管201的源极与第一开关管200的漏极连接。

第三开关管202的栅极和第二开关管201的栅极接收第一扫描信号VSCAN1，第三开关管202的源极接收数据信号Vdata，其中，第一扫描信号VSCAN1用于控制第二开关管201和第三开关管202导通或截止。

与第三开关管202及第一开关管200连接的第五开关管204，第五开关管204的漏极与第三开关管202的漏极连接，第五开关管204的源极与第一开关管200的源极连接，第五开关管204的栅极接收第一控制信号EM，其中，第一控制信号EM用于控制第五开关管204导通或截止。

与第二开关管201连接的驱动晶体管205，驱动晶体管205的栅极与第二开关管201的漏极连接，驱动晶体管205的源极与第二开关管201的源极连接。

与驱动晶体管205连接的第四开关管203，第四开关管203的源极与驱动晶体管205的漏极连接，第四开关管203的栅极接收第三扫描信号VSCAN3，第四开关管203的漏极与地线连接，其中，第三扫描信号VSCAN3用于控制第四开关管203导通或截止。

设置于第一极点B与第二极点A之间的电容206，第一极点B为第三开关管202的漏极与第五开关管204的漏极的连接点，第二极点A为第二开关管201的漏极与驱动晶体管205的栅极的连接点。

进一步地，第一开关管200、第二开关管201、第三开关管202、第四开关管203、第五开关管204及驱动晶体管205均可以为N型薄膜晶体管。

示例性的，若第一扫描信号VSCAN1为高电平，则第二开关管201和第三开关管202导通，数据信号Vdata将数据存入电容206；相反的，若第一扫描信号VSCAN1为低电平，则第二开关管201和第三开关管202截止，数据信号Vdata停止将数据存入电容206。

若第二扫描信号VSCAN2为高电平，则第一开关管200导通；相反的，若第二扫描信号VSCAN2为低电平，则第一开关管200截止。

若第一控制信号EM为高电平，则第五开关管204导通；相反的，若第一控制信号EM为低电平，则第五开关管204截止。

若第三扫描信号VSCAN3为高电平，则第四开关管203导通；相反的，若第三扫描信号VSCAN3为低电平，则第四开关管203截止。

本发明实施例还提供一种像素电路，如图3所示，该像素电路为在如图2所示的像素电路中去掉了第三扫描信号VSCAN3，同时将第四开关管设置为P型薄膜晶体管。

进一步地，第四开关管203与第一开关管200连接，第四开关管203的源极与驱动晶体管205的漏极连接，第四开关管203的栅极和第一开关管200的栅极接收第二扫描信号VSCAN2，第四开关管203的漏极与地线连接，其中，第二扫描信号VSCAN2用于控制第四开关管203和第一开关管200导通或截止。

进一步地，第一开关管、第二开关管、第三开关管、第五开关管及驱动晶体管均可以为N型薄膜晶体管，第四开关管可以为P型薄膜晶体管。

示例性的，若第二扫描信号VSCAN2为高电平，则第四开关管203截止；相反的，若第二扫描信号VSCAN2为低电平，则第四开关管203导通。

需要说明的是，若第四开关管203为N型薄膜晶体管，则第四开关管203的栅极接收第三扫描信号VSCAN3；若第四开关管203为P型薄膜晶体管，则第四开关管203的栅极接收第二扫描信号VSCAN2；也就是说，第四开关管203为N型薄膜晶体管时，第三扫描信号VSCAN3控制第四开关管203的导通或截止；第四开关管203为P型薄膜晶体管时，第二扫描信号VSCAN2控制第四开关管203的导通或截止。

本发明实施例提供一种像素电路，包括第一开关管，第一开关管的源极输入电源电压信号，第一开关管的栅极接收第二扫描信号，其中，第二扫描信号用于控制第一开关管导通或截止，与第一开关管连接的第二开关管，第二开关管的源极与第一开关管的漏极连接，第三开关管的栅极和第二开关管的栅极接收第一扫描信号，第三开关管的源极接收数据信号，其中，第一扫描信号用于控制第二开关管和第三开关管导通或截止，与第三开关管及第一开关管连接的第五开关管，第五开关管的漏极与第三开关管的漏极连接，第五开关管的源极与第一开关管的源极连接，第五开关管的栅极接收第一控制信号，其中，第一控制信号用于控制第五开关管导通或截止，与第二开关管连接的驱动晶体管，驱动晶体管的栅极与第二开关管的漏极连接，驱动晶体管的源极与第二开关管的源极连接，与驱动晶体管连接的第四开关管，第四开关管的源极与驱动晶体管的漏极连接，第四开关管的栅极接收第三扫描信号，第四开关管的漏极与地线连接，其中，第三扫描信号用于控制第四开关管导通或截止，设置于第一极点与第二极点之间的电容，第一极点为第三开关管的漏极与第五开关管的漏极的连接点，第二极点为第二开关管的漏极与驱动晶体管的栅极的连接点。通过该方案，由于该像素电路的设计，以使得流过每个像素点OLED的电流不随着驱动晶体管阈值电压的变化而变化，从而保证了图像显示的均匀性，同时由于像素电路的补偿阶段和缓冲阶段无电流流过OLED，因此，提高了OLED的使用寿命。

本发明实施例提供一种像素电路的驱动方法，该方法对应于第四开关管为N型薄膜晶体管，包括：

在重置阶段内，第一扫描信号控制第二开关管和第三开关管导通，第二扫描信号控制第一开关管导通，电源电压信号通过所述第一开关管和所述第二开关管为第二极点充电，数据信号通过所述第三开关管为第一极点充电，第三扫描信号控制第四开关管导通，第五开关管截止；

在补偿阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管导通，所述第三扫描信号控制所述第四开关管导通，驱动晶体管的栅极和源极连接，所述第二极点通过所述驱动晶体管和所述第四开关管放电，所述数据信号通过所述第三开关管保持所述电容的所述第一极点的电压，所述电容两端的电压差为第一电压差，所述第一开关管和所述第五开关管截止；

在缓冲阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管截止，所述第三扫描信号控制所述第四开关管导通，所述第一控制信号控制所述第五开关管导通，所述电源电压信号通过所述第五开关管继续保持所述第一极点与所述第二极点之间的电压差仍为所述第一电压差，所述第一开关管、所述第二开关管以及所述第三开关管截止；

在发光阶段内，所述第二扫描信号控制所述第一开关管导通，所述电源电压信号通过所述第一开关管和所述驱动晶体管驱动发光元件发光，所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管截止。

进一步地，第一开关管、第二开关管、第三开关管、第四开关管、第五开关管及驱动晶体管均可以为N型薄膜晶体管。

具体的，如图6所示，对应于图4的时序图，如图2所示的像素电路2的驱动方法包括：

S101、在重置阶段C内，第一扫描信号VSCAN1控制第二开关管201和第三开关管202导通，第二扫描信号VSCAN2控制第一开关管200导通，电源电压信号Vdd通过第一开关管200和第二开关管201为第二极点A充电，数据信号Vdata通过第三开关管202为第一极点B充电，第三扫描信号VSCAN3控制第四开关管203导通，第五开关管204截止。

示例性的，参照图2及图4，在重置阶段C内，第一扫描信号VSCAN1和第二扫描信号VSCAN2均为高电平，则第一开关管200、第二开关管201以及第三开关管202均导通，电源电压信号Vdd通过第一开关管200和第二开关管201为电容206的第二极点A充电，数据信号Vdata通过第三开关管202为电容206的第一极点B充电，第三扫描信号VSCAN3为高电平，则第四开关管203也导通，第一控制信号EM为低电平，则第五开关管204截止，在此过程中，若电源电压为V_dd，则电容206的第二极点A通过第一开关管200和第二开关管201充电至V_dd，若数据信号Vdata的电压为V_data，由于电容206的第一极点B通过第三开关管202接数据信号Vdata，因此，B点电压为V_data。

需要说明的是，在重置阶段C内，驱动电路中电流的流向分别为由电源电压信号Vdd流至第一开关管200，由第一开关管200流至第二开关管201，再由第二开关管201流至电容206，及由数据信号Vdata流至第三开关管202，再由第三开关管202流至电容206。

S102、在补偿阶段D内，第一扫描信号VSCAN1控制第二开关管201和第三开关管202导通，第三扫描信号VSCAN3控制第四开关管203导通，驱动晶体管205的栅极和源极连接，所述第二极点A通过驱动晶体管205和第四开关管203放电，数据信号通过第三开关管保持电容206的第一极点B的电压，第一极点B与第二极点A之间的电压差为第一电压差，第一开关管200和第五开关管204截止。

示例性的，在补偿阶段D内，第一扫描信号VSCAN1为高电平，则第二开关管201和第三开关管202导通，第三扫描信号VSCAN3为高电平，则第四开关管203导通，驱动晶体管205的栅极和源极连接，所述第二极点A通过驱动晶体管205和第四开关管203放电，数据信号通过第三开关管保持电容206的第一极点B的电压，电容206两端的电压差为第一电压差，第二扫描信号VSCAN2变为低电平使得第一开关管200截止，第一控制信号EM为低电平，则第五开关管204截止，在此过程中，电容206的第二极点A通过第二开关管201、驱动晶体管205以及第四开关管203开始放电，一直放电至驱动晶体管205的阈值电压V_th为止，也就是说，电容206的第二极点A放电后，A点的电压为V_th，由于电容206的第一极点B通过第三开关管202与数据信号Vdata连接，数据信号Vdata的电压无变化，因此，B点电压仍为V_data。

需要说明的是，该补偿阶段D持续时间相对较长，一方面是为了能够使得电容206的第二极点A充分放电，另一方面可以更好地稳定电容206两端，即第二极点A和第一极点B之间的电压差值。

进一步地，在补偿阶段D内，驱动电路中电流的流向分别为由电容206流至第二开关管201，由第二开关管201流至驱动晶体管205，由驱动晶体管205流至第四开关管203，再由第四开关管203流至地线，及由数据信号Vdata流至第三开关管202，再由第三开关管202流至电容206。

可以理解的是，在该补偿过程D中，由于第四开关管203导通，使得放电电流不会流过OLED 207，因此，在一定程度上降低了OLED207的损耗。

S103、在缓冲阶段E内，第一扫描信号VSCAN1控制所述第二开关管201和第三开关管202截止，第三扫描信号VSCAN3控制第四开关管203导通，第一控制信号EM控制第五开关管204导通，电源电压信号Vdd通过第五开关管204继续保持第一极点B与第二极点A之间的电压差仍为第一电压差，第一开关管200、第二开关管201以及第三开关管202截止。

示例性的，在缓冲阶段E内，第三扫描信号VSCAN3为高电平，则第四开关管203导通，第二扫描信号VSCAN2为低电平，则第一开关管200截止，第一控制信号EM变为高电平，则第五开关管204导通，第一扫描信号VSCAN1变为低电平，则第二开关管201和第三开关管202均截止，在此过程中，由于电容206的第一极点B通过第五开关管204接电源电压信号Vdd，因此，B点的电压由V_data变为V_dd，又由于电容206的第二极点A在该像素电路中是浮接的，所述浮接是指电容器件在电路中既不接电源也不接地线的一种连接方法，正是由于电容206的第二极点A是浮接的，因此，才使得电容206两端，即第二极点A和第一极点B的电压实现等量跳变，也就是说，电容206两端，即第二极点A和第一极点B之间的电压差仍然保持原来的电压差，即该电压差为上述补偿阶段中电容206两端第二极点A和第一极点B之间的电压差，为V_th-V_data，此时，A点的电压变为V_dd+V_th-V_data。

需要说明的是，V_data在重置阶段C内和补偿阶段D内设置为低电平的目的是为了保证第三开关管202在这两个阶段内能够更好的导通；相反的，V_data在缓冲阶段E内和发光阶段F内设置为高电平的目的是为了保证第三开关管202在这两个阶段内能够更好的截止，那么，可以理解的是，V_data的高低电平设置可根据实际驱动电路的设计进行适应性调整，本发明不做限制。

需要说明的是，在缓冲阶段E内，驱动电路中电流的流向为由电源电压信号Vdd流至第五开关管204，再由第五开关管204流至电容206。

S104、在发光阶段F内，第二扫描信号VSCAN2控制第一开关管200导通，电源电压信号Vdd通过第一开关管200和驱动晶体管205驱动发光元件发光，第二开关管201、第三开关管202、第四开关管203以及第五开关管204截止。

示例性的，在发光阶段F内，第二扫描信号VSCAN2变为高电平，则第一开关管200导通，第一扫描信号VSCAN1为低电平，则第二开关管201和第三开关管202均截止，第一控制信号EM变为低电平，则第五开关管204截止，第三扫描信号VSCAN3变为低电平，则第四开关管203截止，在此过程中，电流由电源电压信号Vdd流至第一开关管200，由第一开关管200流至驱动晶体管205，最终由驱动晶体管205驱动OLED 207发光，此时，驱动晶体管205的栅极电压即为上述缓冲阶段E内的电容206的第二极点A的电压V_dd+V_th-V_data，驱动晶体管205的源极电压即为电源电压V_dd，根据驱动晶体管205的饱和电流公式可得，流过OLED 207的电流I_OLED＝K(V_GS-V_th)²，其中，V_GS表示驱动晶体管205栅极和源极的电压差，V_th表示驱动晶体管205的阈值电压，K为一个常数，它是由材料的迁移率、晶体管沟道的长度和宽度以及电容的容量来决定的。

也就是说，V_GS＝V_dd+V_th-V_data-V_dd＝V_th-V_data，根据上述计算的各个电压值，可得：

I_OLED＝K(V_th-V_data-V_th)²＝K·V_daat ²

由上式可以看出，此时OLED 207的发光电流已经完全不受驱动晶体管205的阈值电压V_th的影响了，而仅仅由数据信号Vdata的电压V_data来决定，这样，彻底解决了驱动晶体管205的阈值电压由于工艺制程和器件老化等原因出现漂移时对流过像素点OLED 207的电流产生影响的问题，从而保证了流过像素点OLED 207的电流保持均一和OLED 207能正常工作，以使得图像显示均匀。

进一步地，本发明实施例还提供一种像素电路的驱动方法，该方法对应于第四开关管为P型薄膜晶体管，包括：

在所述重置阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管导通，所述第二扫描信号控制所述第一开关管导通，所述电源电压信号通过所述第一开关管和所述第二开关管为所述第二极点充电，所述数据信号通过所述第三开关管为所述第一极点充电，所述第四开关管和所述第五开关管截止；

在所述补偿阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管导通，所述第二扫描信号控制所述第四开关管导通，驱动晶体管的栅极和源极连接，所述第二极点通过所述驱动晶体管和所述第四开关管放电，所述数据信号通过所述第三开关管保持所述电容的所述第一极点的电压，所述电容两端的电压差为第一电压差，所述第一开关管和所述第五开关管截止；

在所述缓冲阶段内，所述第二扫描信号控制所述第四开关管导通，所述第一控制信号控制所述第五开关管导通，所述电源电压信号通过所述第五开关管继续保持所述第一极点与所述第二极点之间的电压差仍为所述第一电压差，所述第一开关管、所述第二开关管以及所述第三开关管截止；

在所述发光阶段内，所述第二扫描信号控制所述第一开关管导通，所述电源电压信号通过所述第一开关管和所述驱动晶体管驱动所述发光元件发光，所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管截止。

进一步地，第一开关管200、第二开关管201、第三开关管202、第五开关管204及驱动晶体管205均为N型薄膜晶体管，第四开关管203为P型薄膜晶体管。

需要说明的是，上述两种像素电路的驱动方法中不同的地方是：如图2所示的像素电路中，第四开关管203为N型薄膜晶体管，且通过第三扫描信号VSCAN3控制第四开关管203的导通或截止，另，参照图4，由于在重置阶段C内，第三扫描信号VSCAN3为高电平，因此，第四开关管203导通，从而，保证无电流流过OLED 207；如图3所示的像素电路中，第四开关管203为P型薄膜晶体管，且通过第二扫描信号VSCAN2控制第四开关管203的导通或截止，另，参照图5，由于在重置阶段C内，第二扫描信号VSCAN2为高电平，因此，第四开关管203截止，从而，将有少量电流流过OLED 207。

进一步地，上述两种像素电路的驱动方法，除了以上描述的第四开关管203及其控制信号的不同之外，其余在重置阶段、补偿阶段、缓冲阶段和发光阶段的驱动方法均是类似的，此处将不再赘述。

需要说明的是，如图3所示，第四开关管203为P型薄膜晶体管时，参照图5，在上述重置阶段C内，由于第四开关管203是截止的，因此，会有少量的电流流过OLED 207，但是这个过程持续的时间非常短，基本上不会对像素点产生影响。可以看到的是，这种像素电路中第一开关管200和第四开关管203同时受第二扫描信号VSCAN2的控制，这样，虽然可以实现信号线的兼容，减少信号线的数量，但是第四开关管203是整个像素电路中唯一的P型薄膜晶体管，在制作该像素电路的过程中，使得工艺制程相对增加。

进一步地，如图2所示的像素电路，为在图3所示的像素电路中增加一条第三扫描信号VSCAN3的同时，再将第四开关管203设置为N型薄膜晶体管，如图4所示，该电路在重置阶段C内，由于第三扫描信号VSCAN3为高电平，则通过第三扫描信号VSCAN3控制第四开关管203导通，以使得在重置阶段C内，电容206的第二极点A充电过程中无电流流过OLED 207。

需要说明的是，若需要克服如图3所示的像素电路在重置阶段C内，有少量电流流过OLED 207的情况，则除了采用上述如图2所示的增加第三扫描信号VSCAN3的同时将第四开关管203设置为N型薄膜晶体管的方式以外，还可以采用其他的方式，如在本发明实施例提供的如图3所示的像素电路的基础上，再在驱动晶体管205的源极或漏极增加一个开关管，从而以使得如图3所示的像素电路在重置阶段C内无电流通过驱动晶体管205和/或OLED 207，对于克服重置阶段C内，有少量电流流过OLED 207的情况的实现方式，本发明不做限制。

本发明实施例提供的像素电路的驱动方法，包括在重置阶段内，第一扫描信号控制第二开关管和第三开关管导通，第二扫描信号控制第一开关管导通，电源电压信号通过第一开关管和第二开关管为第二极点充电，数据信号通过第三开关管为第一极点充电，第三扫描信号控制第四开关管导通，第五开关管截止，在补偿阶段内，第一扫描信号控制第二开关管和第三开关管导通，第三扫描信号控制第四开关管导通，通过驱动晶体管和第四开关管为第二极点放电，数据信号通过第三开关管保持第一极点的电压，以保持第一极点与第二极点之间的电压差为第一电压差，第一开关管和第五开关管截止，在缓冲阶段内，第三扫描信号控制第四开关管导通，第一控制信号控制第五开关管导通，通过第四开关管和第五开关管保持第一极点与第二极点之间的电压差仍为第一电压差，第一开关管、第二开关管以及第三开关管截止，在发光阶段内，第二扫描信号控制第一开关管导通，电源电压信号通过第一开关管驱动发光元件发光，第二开关管、第三开关管、第四开关管以及第五开关管截止。通过该方案，由于该像素电路的设计，以使得流过每个像素点OLED的电流不随着驱动晶体管阈值电压的变化而变化，从而保证了图像显示的均匀性，同时由于像素电路的补偿阶段和缓冲阶段无电流流过OLED，因此，提高了OLED的使用寿命。

本发明实施例提供一种显示装置，包括以上实施例提供的像素电路，所述像素电路已在上述实施例中做了详细的说明，此处不再赘述。

以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (6)

1.一种像素电路，其特征在于，包括：

第一开关管，所述第一开关管的源极输入电源电压信号，所述第一开关管的栅极接收第二扫描信号，其中，所述第二扫描信号用于控制所述第一开关管导通或截止；

第二开关管，所述第二开关管的源极与所述第一开关管的漏极连接；

第三开关管，所述第三开关管的栅极和所述第二开关管的栅极接收第一扫描信号，所述第三开关管的源极接收数据信号，其中，所述第一扫描信号用于控制所述第二开关管和所述第三开关管导通或截止；

第五开关管，所述第五开关管的漏极与所述第三开关管的漏极连接，所述第五开关管的源极与所述第一开关管的源极连接，所述第五开关管的栅极接收第一控制信号，其中，所述第一控制信号用于控制所述第五开关管导通或截止；

驱动晶体管，所述驱动晶体管的栅极与所述第二开关管的漏极连接，所述驱动晶体管的源极与所述第二开关管的源极连接；

第四开关管，所述第四开关管的源极与所述驱动晶体管的漏极连接，所述第四开关管的栅极接收第三扫描信号，所述第四开关管的漏极与地线连接，其中，所述第三扫描信号用于控制所述第四开关管导通或截止；

设置于第一极点与第二极点之间的电容，所述第一极点为所述第三开关管的漏极与所述第五开关管的漏极的连接点，所述第二极点为所述第二开关管的漏极与所述驱动晶体管的栅极的连接点。

2.根据权利要求1所述的像素电路，其特征在于，

所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管、所述第五开关管及所述驱动晶体管均为N型薄膜晶体管。

3.根据权利要求1所述的像素电路，其特征在于，所述第一开关管、所述第二开关管、所述第三开关管、所述第五开关管及所述驱动晶体管均为N型薄膜晶体管，所述第四开关管为P型薄膜晶体管，

当所述第四开关管为P型薄膜晶体管时，所述第三扫描信号与所述第二扫描信号相同，所述第四开关管的栅极接收所述第二扫描信号。

4.一种显示装置，其特征在于，包括如权利要求1至3任一所述的像素电路。

5.一种像素电路的驱动方法，适用于权利要求1所述的像素电路，其特征在于，包括：

在重置阶段内，第一扫描信号控制第二开关管和第三开关管导通，第二扫描信号控制第一开关管导通，电源电压信号通过所述第一开关管和所述第二开关管为第二极点充电，数据信号通过所述第三开关管为第一极点充电，第三扫描信号控制第四开关管导通，第五开关管截止；

在补偿阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管导通，所述第三扫描信号控制所述第四开关管导通，驱动晶体管的栅极和源极连接，所述第二极点通过所述驱动晶体管和所述第四开关管放电，所述数据信号通过所述第三开关管保持所述电容的所述第一极点的电压，所述电容两端的电压差为第一电压差，所述第一开关管和所述第五开关管截止；

在缓冲阶段内，所述第一扫描信号控制所述第二开关管和所述第三开关管截止，所述第三扫描信号控制所述第四开关管导通，所述第一控制信号控制所述第五开关管导通，所述电源电压信号通过所述第五开关管继续保持所述第一极点与所述第二极点之间的电压差仍为所述第一电压差，所述第一开关管、所述第二开关管以及所述第三开关管截止；

在发光阶段内，所述第二扫描信号控制所述第一开关管导通，所述电源电压信号通过所述第一开关管和所述驱动晶体管驱动发光元件发光，所述第二开关管、所述第三开关管、所述第四开关管以及所述第五开关管截止。

6.根据权利要求5所述的像素电路的驱动方法，其特征在于，

所述第一开关管、所述第二开关管、所述第三开关管、所述第四开关管、所述第五开关管及所述驱动晶体管均为N型薄膜晶体管。