CN102866757A - 放电电路 - Google Patents

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Abstract

一种放电电路，用于为一电脑系统放电。放电电路包括多个供电单元及一电源连接器。每个供电单元包括一供电模块、多个稳压电容、一二极管及一电阻。每个供电模块包括二个输出端。多个稳压电容与电阻并联在供电模块的二个输出端上。电源连接器包括一PS-ON引脚。放电电路进一步包括一开关电路。开关电路包括一N-MOS管。N-MOS管的漏极电性连接至多个稳压电容的阴极。N-MOS管的源极接地。N-MOS管的栅极电性连接至电源连接器的PS-ON引脚。当电脑系统处于重启或休眠等非正常工作状态时，电源连接器的PS-ON引脚输出一高电平，N-MOS管导通，同时，多个供电单元停止供电，多个稳压电容开始放电，并经过电阻及N-MOS管导入至地。本发明的放电电路能快速放电且节能。

Description

放电电路
技术领域
本发明涉及一种放电电路。
背景技术
电脑主板都是通过开关电源输出的5V,3.3V,12V等电源经过DC-DC电路转换为低压大电流后为各个不同的单元或芯片供电。在实际应用中经常发现在关机后快速重启时有时很难启动，原因主要为一些低压大电流电源输出端因稳压需要并联了很多的电容，导致放电缓慢，造成在重启或开机时产生时序错误。然而，业界为了解决上述问题一般的做法是在电容上并联放电电阻，以便在关机时能透过该放电电阻放电。此方法虽然可以解决放电问题，但是由于电阻是耗能元件，因此会导致能量的损耗，造成效率低下，不符合当前的低碳环保的要求。
发明内容
有鉴于此，有必要提供一种能快速放电，又节能的放电电路。
一种放电电路，用于为一电脑系统放电。所述放电电路包括多个供电单元及一电源连接器。每个供电单元包括一供电模块、多个稳压电容、一二极管及一电阻。每个供电模块包括二个输出端。多个稳压电容与电阻并联在所述供电模块的二个输出端上。所述电源连接器包括一PS-ON引脚。所述放电电路进一步包括一开关电路。所述开关电路包括一N-MOS管。所述N-MOS管的漏极电性连接至所述多个稳压电容的阴极。所述N-MOS管的源极接地。所述N-MOS管的栅极电性连接至所述电源连接器的PS-ON引脚。当电脑系统处于重启或休眠等非正常工作状态时，所述电源连接器的PS-ON引脚输出一高电平，所述N-MOS管导通，同时，多个供电单元停止供电，所述多个稳压电容开始放电，并经过所述电阻及所述N-MOS管导入至地。
相对于现有技术，本发明提供的放电电路进一步包括一开关电路，当电脑系统处于重启或休眠等非正常工作状态时，所述多个稳压电容开始放电，并经过所述电阻及所述N-MOS管导入至地，因此，可快速放电。而当电脑系统正常工作状态时，多个所述电阻分别被多个所述稳压电容电容短路而均无功耗，满足节能的要求。
附图说明
图1为本发明实施方式提供的放电电路的示意图。
主要元件符号说明
放电电路 100
CPU供电单元 10
北桥芯片供电单元 20
南桥芯片供电单元 30
系统电源供电单元 40
开关电路 50
电源连接器 60
第一供电模块 11
第一稳压电容 C1
第二稳压电容 C2
第三稳压电容 C3
第四稳压电容 C4
第一二极管 D1
第一电阻 R1
第一输出端 111
第二输出端 112
CPU电源输出端 12
第二供电模块 21
第五稳压电容 C5
第六稳压电容 C6
第七稳压电容 C7
第八稳压电容 C8
第二二极管 D2
第二电阻 R2
第三输出端 211
第四输出端 212
北桥芯片电源输出端 22
第三供电模块 31
第九稳压电容 C9
第十稳压电容 C10
第十一稳压电容 C11
第十二稳压电容 C12
第三二极管 D3
第三电阻 R3
第五输出端 311
第六输出端 312
南桥芯片电源输出端 32
第四供电模块 41
第十三稳压电容 C13
第十四稳压电容 C14
第十五稳压电容 C15
第十六稳压电容 C16
第四二极管 D4
第四电阻 R4
第七输出端 411
第八输出端 412
电源输出端 42
开关管 M
分压电阻 R5
栅极 G
漏极 D
源极 S
PS-ON引脚 61
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
请参阅图1，本发明实施方式提供的放电电路100为一电脑系统放电（图未示）。所述放电电路100包括一CPU供电单元10、一北桥芯片供电单元20、一南桥芯片供电单元30、一系统电源供电单元40、一开关电路50、及一电源连接器60。
所述CPU供电单元10包括一第一供电模块11、一第一稳压电容C1、一第二稳压电容C2、一第三稳压电容C3、一第四稳压电容C4、一第一二极管D1及一第一电阻R1。所述第一供电模块11包括一第一输出端111及一第二输出端112。所述第一稳压电容C1、第二稳压电容C2、第三稳压电容C3、第四稳压电容C4及第一二极管D1的阳极均电性连接至所述第一输出端111。所述第一稳压电容C1、第二稳压电容C2、第三稳压电容C3、第四稳压电容C4的阴极均电性连接至所述第二输出端112。所述第一二极管D1的阴极通过所述第一电阻R1电性连接至所述第二输出端112。所述CPU供电单元10还包括一CPU电源输出端12，用于输出CPU工作时的工作电源。所述CPU电源输出端12电性连接至所述第三稳压电容C3的阳极。
所述北桥芯片供电单元20包括一第二供电模块21、一第五稳压电容C5、一第六稳压电容C6、一第七稳压电容C7、一第八稳压电容C8、一第二二极管D2及一第二电阻R2。所述第二供电模块21包括一第三输出端211及一第四输出端212。所述第五稳压电容C5、第六稳压电容C6、第七稳压电容C7、第八稳压电容C8、及第二二极管D2的阳极均电性连接至所述第三输出端211。所述第五稳压电容C5、第六稳压电容C6、第七稳压电容C7、第八稳压电容C8的阴极均电性连接至所述第四输出端212。所述第二二极管D2的阴极通过所述第二电阻R2电性连接至所述第四输出端212。所述北桥芯片供电单元20还包括一北桥芯片电源输出端22，用于输出北桥芯片工作时的工作电源。所述北桥芯片电源输出端22电性连接至所述第七稳压电容C7的阳极。
所述南桥芯片供电单元30包括一第三供电模块31、一第九稳压电容C9、一第十稳压电容C10、一第十一稳压电容C11、一第十二稳压电容C12、一第三二极管D3及一第三电阻R3。所述第三供电模块31包括一第五输出端311及一第六输出端312。所述第九稳压电容C9、第十稳压电容C10、第十一稳压电容C11、第十二稳压电容C12、及第三二极管D3的阳极均电性连接至所述第五输出端311。所述第九稳压电容C9、第十稳压电容C10、第十一稳压电容C11、第十二稳压电容C12的阴极均电性连接至所述第六输出端312。所述第三二极管D3的阴极通过所述第三电阻R3电性连接至所述第六输出端312。所述南桥芯片供电单元30还包括一南桥芯片电源输出端32，用于输出南桥芯片工作时的工作电源。所述南桥芯片电源输出端32电性连接至所述第十一稳压电容C11的阳极。
所述系统电源供电单元40包括一第四供电模块41、一第十三稳压电容C13、一第十四稳压电容C14、一第十五稳压电容C15、一第十六稳压电容C16、一第四二极管D4及一第四电阻R4。所述第四供电模块41包括一第七输出端411及一第八输出端412。所述第十三稳压电容C13、第十四稳压电容C14、第十五稳压电容C15、第十六稳压电容C16、及第四二极管D4的阳极均电性连接至所述第七输出端411。所述第十三稳压电容C13、第十四稳压电容C14、第十五稳压电容C15、第十六稳压电容C16的阴极均电性连接至所述第八输出端412。所述第四二极管D4的阴极通过所述第四电阻R4电性连接至所述第八输出端412。所述系统电源供电单元40还包括一电源输出端42，用于输出系统工作时的工作电源。所述电源输出端42电性连接至所述第十五稳压电容C15的阳极。
所述开关电路50包括一开关管M及一分压电阻R5。本实施方式中，所述开关管M为N-MOS管。所述开关管M的漏极D分别通过所述第一、第二、第三、第四电阻R1、R2、R3、R4电性连接至所述第一、第二、第三、第四二极管D1、D2、D3、D4的阴极。所述开关管M的源极S接地。可以理解的是，所述开关管M也可以为PNP型三极管。
本实施方式中，所述电源连接器60为一公连接器，其包括一PS-ON引脚61。所述PS-ON引脚61通过所述开关电路50的分压电阻R5电性连接至所述开关管M的栅极G。
当电脑系统正常工作状态时，所述电源连接器60的PS-ON引脚61输出一低电平，所述开关管M截止。同时，所述第一供电模块11输出工作电源，并通过所述第一稳压电容C1、第二稳压电容C2、第三稳压电容C3、第四稳压电容C4稳压后输出稳定的电压至所述CPU电源输出端12；所述第二供电模块21输出工作电源，并过所述第五稳压电容C5、第六稳压电容C6、第七稳压电容C7、第八稳压电容C8稳压后，输出稳定的电压至所述北桥芯片电源输出端22；所述第三供电模块31输出工作电源，并通过所述第九稳压电容C9、第十稳压电容C10、第十一稳压电容C11、第十二稳压电容C12稳压后，输出稳定的电压至所述南桥芯片电源输出端32；所述第四供电模块41输出工作电源，并通过所述十三稳压电容C13、第十四稳压电容C14、第十五稳压电容C15、第十六稳压电容C16稳压后，输出稳定的电压所述电源输出端42。而此时，所述第一、第二、第三、第四电阻R1、R2、R3、R4分别被所述第四、第八、第十二、第十六稳压电容C4、C8、C12、C16电容短路而均无功耗，满足节能的要求。
当电脑系统处于重启或休眠等非正常工作状态时，所述电源连接器60的PS-ON引脚61输出一高电平，所述开关管M导通。所述第一供电模块11、所述第二供电模块21、所述第三供电模块31及所述第四供电模块41均停止供电，同时，所述CPU供电单元10的所述第一稳压电容C1、第二稳压电容C2、第三稳压电容C3、第四稳压电容C4开始放电，并经过所述第一二极管D1、第一电阻R1及所述开关管M导入至地；所述北桥芯片供电单元20的第五稳压电容C5、第六稳压电容C6、第七稳压电容C7、第八稳压电容C8开始放电，并经过所述第二二极管D2、第二电阻R2及所述开关管M导入至地；所述南桥芯片供电单元30的第九稳压电容C9、第十稳压电容C10、第十一稳压电容C11、第十二稳压电容C12开始放电，并经过所述第三二极管D3、第三电阻R3及所述开关管M导入至地；所述系统电源供电单元40的第十三稳压电容C13、第十四稳压电容C14、第十五稳压电容C15、及第十六稳压电容C16也开始放电，并经过所述第四二极管D4、第四电阻R4及所述开关管M导入至地。
所述放电电路进一步包括一开关电路，当电脑系统处于重启或休眠等非正常工作状态时，所述多个稳压电容开始放电，并经过所述电阻及所述N-MOS管导入至地，因此，可快速放电。而当电脑系统正常工作状态时，多个所述电阻分别被多个所述稳压电容电容短路而均无功耗，满足节能的要求。
可以理解的是，对于本领域的普通技术人员来说，可以根据本发明的技术构思做出其它各种相应的改变与变形，而所有这些改变与变形都应属于本发明权利要求的包括范围。

Claims (10)

1.一种放电电路，用于为一电脑系统放电，所述放电电路包括多个供电单元及一电源连接器，每个供电单元包括一供电模块、多个稳压电容、一二极管及一电阻，每个供电模块包括二个输出端，多个稳压电容与电阻并联在所述供电模块的二个输出端上，所述电源连接器包括一PS-ON引脚，其特征在于：所述放电电路进一步包括一开关电路，所述开关电路包括一N-MOS管，所述N-MOS管的漏极电性连接至所述多个稳压电容的阴极，所述N-MOS管的源极接地，所述N-MOS管的栅极电性连接至所述电源连接器的PS-ON引脚，当电脑系统处于重启或休眠等非正常工作状态时，所述电源连接器的PS-ON引脚输出一高电平，所述N-MOS管导通，同时，多个供电单元停止供电，所述多个稳压电容开始放电，并经过所述电阻及所述N-MOS管导入至地。
2.如权利要求1所述的放电电路，其特征在于：所述多个供电单元包括一CPU供电单元，所述CPU供电单元包括一第一供电模块、一第一稳压电容、一第二稳压电容、一第三稳压电容、一第四稳压电容、一第一电阻，所述第一供电模块包括一第一输出端及一第二输出端，所述第一稳压电容、第二稳压电容、第三稳压电容、第四稳压电容均电性连接至所述第一输出端，所述第一稳压电容、第二稳压电容、第三稳压电容、第四稳压电容的阴极均电性连接至所述第二输出端，所述CPU供电单元还包括一CPU电源输出端，所述CPU电源输出端电性连接至所述第三稳压电容的阳极。
3.如权利要求2所述的放电电路，其特征在于：所述CPU供电单元进一步包括一第一二极管，所述第一二极管的阳极电性连接至所述第一输出端，所述第一二极管的阴极，所述第一二极管的阴极通过所述第一电阻电性连接至所述第二输出端。
4.如权利要求1所述的放电电路，其特征在于：所述多个供电单元包括一北桥芯片供电单元，所述北桥芯片供电单元包括一第二供电模块、一第五稳压电容、一第六稳压电容、一第七稳压电容、一第八稳压电容、及一第二电阻，所述第二供电模块包括一第三输出端及一第四输出端，所述第五稳压电容、第六稳压电容、第七稳压电容、第八稳压电容的阳极均电性连接至所述第三输出端，所述第五稳压电容、第六稳压电容、第七稳压电容、第八稳压电容的阴极均电性连接至所述第四输出端，所述北桥芯片供电单元还包括一北桥芯片电源输出端，所述北桥芯片电源输出端电性连接至所述第七稳压电容的阳极。
5.如权利要求4所述的放电电路，其特征在于：所述北桥芯片供电单元包括一第二二极管，所述第二二极管的阳极电性连接至所述第三输出端，所述第二二极管的阴极通过所述第二电阻电性连接至所述第四输出端。
6.如权利要求1所述的放电电路，其特征在于：所述多个供电单元包括一南桥芯片供电单元，所述南桥芯片供电单元包括一第三供电模块、一第九稳压电容、一第十稳压电容、一第十一稳压电容、一第十二稳压电容、及一第三电阻，所述第三供电模块包括一第五输出端及一第六输出端，所述第九稳压电容、第十稳压电容、第十一稳压电容、第十二稳压电容均电性连接至所述第五输出端，所述第九稳压电容、第十稳压电容、第十一稳压电容、第十二稳压电容的阴极均电性连接至所述第六输出端，所述南桥芯片供电单元还包括一南桥芯片电源输出端，所述南桥芯片电源输出端电性连接至所述第十一稳压电容的阳极。
7.如权利要求6所述的放电电路，其特征在于：所述南桥芯片供电单元包括一第三二极管，所述第三二极管的阳极电性连接至所述第五输出端，所述第三二极管的阴极通过所述第三电阻电性连接至所述第六输出端。
8.如权利要求1所述的放电电路，其特征在于：所述多个供电单元包括一系统电源供电单元，所述系统电源供电单元包括一第四供电模块、一第十三稳压电容、一第十四稳压电容、一第十五稳压电容、一第十六稳压电容及一第四电阻，所述第四供电模块包括一第七输出端及一第八输出端，所述第十三稳压电容、第十四稳压电容、第十五稳压电容、第十六稳压电容的阳极均电性连接至所述第七输出端，所述第十三稳压电容、第十四稳压电容、第十五稳压电容、第十六稳压电容的阴极均电性连接至所述第八输出端，所述系统电源供电单元还包括一电源输出端电性连接至所述第十五稳压电容的阳极。
9.如权利要求8所述的放电电路，其特征在于：所述系统电源供电单元进一步包括一第四二极管，所述第四二极管的阳极均电性连接至所述第七输出端，所述第四二极管的阴极通过所述第四电阻电性连接至所述第八输出端。
10.如权利要求1所述的放电电路，其特征在于：所述开关电路进一步包括一分压电阻，所述电源连接器的PS-ON引脚通过所述分压电阻电性连接至所述N-MOS的栅极。
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