CN102007823B - 电连接器和用于电连接器的电路板 - Google Patents

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Abstract

本发明涉及一种用于电连接器(400)的印刷电路板(100)，所述印刷电路板包括设置在所述印刷电路板(100)的第一端(112)的多对第一接触部(110)和设置在第二端(122)的多对第二接触部(120)，其中，每个第一接触部(110)经由第一导体(115.1-115.8)连接至第二接触部(120)，其中，所述第一导体(115.1-115.8)至少设置在所述印刷电路板(110)的第一侧(104)上，其中，第二导体(125.2，125.4，125.6，125.8；135.1，135.3，135.5，135.7)设置在所述印刷电路板(100)的另一侧(106)上，并且连接至第一接触部(110)或第二接触部(120)，其中，第二导体(135.1，135.3，135.5，135.7)与每个第一接触部(110)对的第一接触部(110.1，110.3，110.5，110.7)关联，其中，所述第一接触部(110)的相邻的第二导体(135.1，135.3，135.5，135.7)包括彼此至少部分平行的段，且所述第二导体与每个第二接触部(120)对的第二接触部(120.2，120.4，120.6，120.8)关联，其中，所述第二接触部的相邻的第二导体(125.2，125.4，125.6，125.8)包括彼此至少部分平行的段，其中，连接至所述第二导体(135.1，135.3，135.5，135.7)的所述第一接触部(110.1，110.3，110.5，110.7)未连接至连接至所述第二导体(125.2，125.4，125.6，125.8)的所述第二接触部(120.2，120.4，120.6，120.8)，其中，所述第一接触部(110)处的所述第二导体(135.1，135.3，135.5，135.7)形成第一耦合区域，且所述第二接触部(120)处的所述第二导体(125.2，125.4，125.6，125.8)形成第二耦合区域。

Description

电连接器和用于电连接器的电路板
技术领域
本发明涉及电连接器和用于电连接器的印刷电路板。
背景技术
在具有绞合导线的电缆端接于印刷电路板(PCB)上时，导线必需被解开并展开，使得导线能够端接于沿PCB的一个边缘的线。导线的此解开在一些导线之间引入了不利的感应信号耦合(串扰)。另外，由于连接器自身的配置以及电连接器内导体的相对位置，可以产生耦合至电连接器中的导线或其它导体的进一步不利的感应信号。
许多电连接器尺寸小，这迫使那些电连接器所使用的任何PCB也小。因此，用于在电连接器的PCB上布置导体的可用空间受到限制。
发明内容
本发明基于提供用于电连接器的印刷电路板和这样的连接器的技术问题，借助于该印刷电路板和连接器能够补偿信号耦合。
通过包括权利要求1和10的特征的主题提供了该技术问题的解决方案。本发明的进一步有利的配置显现于从属权利要求。
为此目的，用于电连接器的印刷电路板包括布置在所述印刷电路板的第一端的多对第一接触部和布置在第二端的多对第二接触部，其中，第一接触部经由第一电路迹线分别连接至第二接触部，其中，所述第一电路迹线至少布置在所述印刷电路板的第一侧上，其中，第二电路迹线布置在所述印刷电路板的另一侧上，所述第二电路迹线连接至第一接触部或第二接触部，其中，第一接触部对的第一接触部分别分配给第二电路迹线，其中，所述第一接触部的相邻的第二电路迹线具有相对于彼此至少部分平行的部分，且第二接触部对的第二接触部分别分配给第二电路迹线，其中，所述第二接触部的相邻的第二电路迹线具有相对于彼此至少部分平行的部分，其中，连接至所述第二电路迹线的所述第一接触部未连接至连接至所述第二电路迹线的所述第二接触部，其中，所述第一接触部处的所述第二电路迹线形成第一耦合区域，且所述第二接触部处的所述第二电路迹线形成第二耦合区域。
在一个优选实施例中，接触部对的第一电路迹线借助于电镀通孔分别与所述接触部对的关联的另一第一电路迹线交叉，结果提供了另一补偿区域或耦合区域。因此，优选地，在相对端的关联的第一和第二接触部也顺时针成对延伸。在此情况下，成对关联的第一电路迹线优选地以基本平行的方式延伸，其中，进一步优选地，电路迹线的交叉点位于第二接触部附近。
在另一优选实施例中，所述第二电路迹线经由所述电镀通孔连接至所述第二接触部。
在另一优选实施例中，在所述印刷电路板中在所述第二接触部对之间引入了缝隙和/或在第二接触部对的接触部之间引入了缝隙。
优选地，第二耦合区域至少部分地布置于所述缝隙和所述第一耦合区域之间。
第一感应耦合区域(第二电路迹线的平行部分)的长度优选地小于第二感应耦合区域(第二电路迹线的平行部分)的长度。独立的第一感应耦合区域和/或第二感应耦合区域的长度优选地不是一致的，而是均具有不同长度。第一感应耦合区域中的每一个可以取向为基本垂直于第二感应耦合区域中的相应的一个的至少一部分。所述第一感应耦合区域可以与相应的第二感应耦合区域基本相邻设置。
第一感应耦合区域可以与相应的缝隙纵向对准，即它们平行于缝隙的纵向方向。耦合至所述第二接触部对的一个接触部的所述第二电路迹线的每一个围绕相应的缝隙的内端延伸。
第二电路迹线的平行且相邻的部分可以设置为使得在第二感应耦合区域中基本彼此套入。
至少一个第二感应耦合区域的长度与相应的至少一个第一感应耦合区域的长度的比率为约1.1∶1或大于1.1∶1。所述比率可以为约3∶1或小于3∶1。更具体地，比率可以在1.25∶1和2.5∶1之间。对于关联的第一和第二感应耦合区域中的不同的感应耦合区域，比率可以不同。印刷电路板从第一端至第二端的长度可以约为35mm。中心缝隙可以比所有其它缝隙长。
在优选实施例中，所述第一接触部实施为绝缘位移接触部。
另一实施例涉及包括上述PCB的电连接器。所述PCB可以至少部分设置于电连接器的外壳内。外壳可以包括绝缘遮蔽物，该绝缘遮蔽物是活动的以暴露第二接触部用于直接电连接。
附图说明
以下将参照附图进一步详细描述实施例，其中：
图1是用于电连接器的印刷电路板的第一侧的示意性平面视图；
图2是图1的印刷电路板的侧视图；
图3是图1的印刷电路板的第二侧的底视图；
图4是具有根据图1的印刷电路板的电连接器的分解视图；
图5是图1中所示的电路迹线的放大视图；以及
图6是图3中所示的电路迹线的放大视图。
具体实施方式
描述的实施例总体涉及用于电连接器400的印刷电路板100(PCB)和包括该PCB 100的电连接器400。
图1、2和3是PCB 100的示意图，图4示出了在电连接400中的使用环境中的PCB 100。图5和6示例PCB 100的每一侧上的电路迹线的配置。
首先参照图1、2和3，进一步详细地描述了PCB 100。PCB 100由厚度为X的玻璃纤维基底102形成，并且该基底102具有安置于其上或其中的导电接触部和电路迹线。厚度X可以在1至2mm之间，例如约1.3mm。PCB 100具有在PCB 100的第一端112的多个第一接触部110和在PCB 100的第二端122的多个第二接触部120。第一接触部110是导电的并形成为例如绝缘位移接触部，用于电接触绝缘导线或电缆的芯。第一接触部110延伸至PCB 100的两侧104、106。第二接触部120是导电的并包括针式接触部，该针式接触部意在由电连接器400将要连接的部件中的弹簧接触部容纳。
PCB 100具有印刷于基底102的第一侧104上的第一组第一电路迹线115，例如使用刻蚀工艺。第一电路迹线115可以为约1mm宽，并且例如由铜形成。每个第一电路迹线115将一个第一接触部110耦合至一个第二接触部120或将它们进行连接。
在图中所示例的范例中，PCB 100具有在第一端112的八个接触部110.1至110.8和在第二端122的八个接触部120.1至120.8，八个电路迹线115.1至115.8将相应的第一接触部110.1至110.8连接至第二接触部120.1至120.8。
作为用于减轻电缆和电连接器的分开和解开的导体引入的串扰的影响的补偿装置的第一部分，每隔一个电路迹线的电路迹线115(例如115.2、115.4、115.6以及115.8)配置为与其电路迹线115的成对关联的电路迹线(例如115.1、115.3、115.5以及115.7)交叉，优选地以直角相交。这是如下实现的：每个电路迹线对的一个电路迹线(115.2、115.4、115.6以及115.8)从第一侧104延伸穿过PCB 100的基底102中的通孔130到达PCB 100的第二侧106，在此其与未中断的(unbroken)电路迹线(115.1、115.3、115.5以及115.7)交叉并经由另一通孔130被引导回第一侧104，以最终连接至第二接触部120。替代地，第一电路迹线也能够连接至第二侧106上的第二接触部120，结果能够去除第二通孔130。这预示第二接触部120与第一接触部110那样延伸至两侧104、106。
例如，如图1和3中所示例的，电路迹线115在第一侧104上是未中断的，而电路迹线115.2的路径在第一侧104上被通孔130或电镀通孔中断，通孔130或电镀通孔中设置有导电材料用于维持第一和第二侧104、106上的电路迹线之间的电连接。从而，电路迹线115.2简单地(briefly)在第二侧106上在通孔130的点之间有效地继续其路路径。第二侧106上的通孔130之间的此导电部分优选地以直角行进至第一侧104上的电路迹线115.1的成角度部分，电路迹线115在交叉时互相没有物理接触，因为它们安置于玻璃纤维基底102的相反侧104、106上。
第一侧104上的相邻迹线115彼此有效地配对。以此方式，电路迹线115.1与115.2配对、电路迹线115.3与115.4配对、电路迹线115.5与115.6配对、以及电路迹线115.7与115.8配对。对于第一电路迹线115的每一个该配对，每一对的电路迹线在它们的长度的实质部分上彼此平行地延伸，这在图1中示例的范例中是明显地。沿着电路迹线115彼此平行并相邻的导体对的部分，发生了从第一电路迹线115到其它电路迹线115的信号的感应耦合。能够选择此感应耦合并将其配置为补偿电连接器400内(但在PCB 100外部)的串扰，由此减小经由每个电路迹线115传播的信号的恶化。该恶化能够导致不可接受的高误差率，这减小了电连接器400的最大通信速度。
为了改善电路迹线115的对之间的感应耦合的补偿效果，在第二侧106上布置第二电路迹线125和135。电路迹线125和135可以为约1mm宽并可以使用刻蚀工艺由铜形成。电路迹线125和135配置为提供电路迹线125和135的非相邻的迹线间的另外的感应耦合量作为精细调节电路迹线115间的感应耦合提供的补偿的方式，以实现第一电路迹线115和第二电路迹线125、135间的大体平衡的感应耦合。此平衡的感应耦合有助于减小误差率并由此容许较高的传输比特率通过电连接器400。
第二电路迹线125经由朝向第二端122安置的通孔130耦合至第一电路迹线115或第二接触部120。第二电路迹线125仅与第一电路迹线115中的每相隔一个电路迹线的电路迹线耦合。从而，在图3中所示的范例中，第二电路迹线125.2、125.4、125.6和125.8经由通孔130分别耦合至第一电路迹线115.2、115.4、115.6和115.8。
类似地，第二电路迹线135经由相应的第一接触部110与第一电路迹线115中的每相隔一个电路迹线的电路迹线耦合。从而，在图3所示的范例中，第二电路迹线135.1、135.3、135.5和135.7经由相应的第一接触部110.1、110.3、110.5和110.7耦合至第一电路迹线115.1、115.3、115.5和115.7。
如图1和3中所示例的，第二接触部120均由形成于PCB 100的基底102中并从第二端122向内沿纵向方向朝第一端112延伸的一个或两个缝隙与一个或两个相邻接触部分开。该缝隙用于分开接触部120并用于容纳机械结构于容纳插口中，在电连接器400使用时，PCB 100的第二端1222将容纳于容纳插口中。
在图1和3所示例的范例中，八个接触部120.1至120.8由七个缝隙142、144、146、152、154、156和158分开。七个缝隙中的中间缝隙144位于PCB的横向中心并是缝隙中最长的，约为18mm长。在缝隙144的任一横向侧是较小的缝隙154和156，均小于中间缝隙144的长度的一半，或约为8至8.5mm，并小于中间缝隙144的宽度的一半。中间缝隙144位于接触部120.4和120.5之间，而较短的缝隙154位于接触部120.3和120.4之间，并且较短的缝隙156位于接触部120.5和120.6之间。较短的缝隙152和158与缝隙154和156具有相同尺寸并且分别位于接触部120.1与120.2之间和120.7与120.8之间。缝隙142和146比中间缝隙144短，但是具有相同的宽度。缝隙142位于接触部120.2和120.3之间，而缝隙146位于接触部120.6和120.7之间。缝隙142和146具有相同尺寸并均为约15mm长。
PCB 100从第一端112至第二端122的(纵向)长度可以为约35mm，而横向宽度在第二端122可以为约30mm。基底102在其外部横向边缘的部分上成锥形，使得PCB 100在第一端112的横向宽度小于在第二端122的横向宽度约1mm至2mm。
现在参照图4，进一步详细地描述电连接器400。电连接器400具有下部外壳410、上部外壳420、电缆连接器部分430和绝缘遮蔽物(shield)440。下部外壳410和上部外壳420是可连接的，以便至少部分地包围PCB 100。第一接触部110安置于第二外壳420内，使得能够容纳来自解开的电缆435并通过电缆连接器部分430展开的导线。第二接触部120部分或完全突出通过下部外壳410。
电连接器400还包括偏置部件450，诸如弹簧，用于将绝缘遮蔽物440朝向第一位置偏置，在第一位置中，绝缘遮蔽物440覆盖并基本上遮蔽第二接触部120以免直接相互接触。绝缘遮蔽物440沿耦合的下部和上部外壳410、420在第一位置和第二位置之间可滑动移动，在第二位置中，绝缘遮蔽物440缩进以暴露第二接触部120，用于直接连接至具有弹簧接触部的容纳插口。偏置元件450弹性地可偏离，并且将绝缘遮蔽物440从第二位置偏置开并朝向第一位置。
电缆连接器部分430可以以搭扣配合啮合连接至上部外壳420。通过在绝缘遮蔽物440的每一侧上的插口442内容纳配准突起412，绝缘遮蔽物440耦合至下部外壳410。插口442形成得足够长，以容许绝缘遮蔽物440在第一和第二位置之间行进，同时保持其中突起412的配准。
现在参照图5和6，进一步详细地描述基底102上的导体115、125和135的配置。如图5中所示的范例中所示例，第一电路迹线115成对布置，并具有长的部分，在该长的部分中，每对电路迹线基本彼此平行且紧密相邻。这些部分的长度可以为约14mm的量级，并且在这些部分中，每一对内的导体115的间隔可以为约1mm，但是可以稍微更小或更大。这些平行并相邻的部分用作主补偿机构以补偿在电导体400的其它部分中引起的串扰。可以认为，该串扰引起负面的或不利的感应信号耦合，而电路迹线115的平行且相邻的部分中的感应耦合引起正面的或平衡感应信号耦合，以抵消电连接器400中产生的串扰的不利影响。
电路迹线115的平行且相邻的部分也可以视为具有特定长度的感应耦合区域，其中，它们基本平行且相邻。
如图6中所示例的，电路迹线125和135还具有感应耦合区域，其中电路迹线基本平行且相邻，虽然这些区域的长度比电路迹线115的那些的长度短并且区域与区域之间稍微不同。与电路迹线115不同，电路迹线125和135耦合至第一接触部110和第二接触部120中的每相隔一个接触部的接触部，如图6中所示例的。在第一端112，电路迹线135.1、135.3、135.5和135.7分别耦合至接触部110.1、110.3、110.5和110.7。
电路迹线135.3和135.5各具有两个分支，而电路迹线135.1和135.7仅以单个分支形成。电路迹线135.3的一个分支布置为朝向电路迹线135.1延伸，使得该分支的至少一部分能够与电路迹线135.1沿与缝隙142对准的纵向取向形成平行且相邻的感应耦合区域(分别见图1和3)。类似地，电路迹线135.3的第二分支朝向电路迹线135.5的第一分支延伸以形成在与缝隙144对准的纵向方向上彼此相邻且平行的感应耦合区域。电路迹线135.5的第二分支朝向电路迹线135.7延伸，并且那些电路迹线均彼此基本平行且相邻地延伸，以限定在与缝隙146对准的纵向方向上取向的另一感应耦合区域。
电路迹线125.2、125.4、125.6和125.8布置为至少部分地与那些电路迹线中的相邻的一个相邻且平行地延伸。如图6中所示例的，电路迹线125.2和125.8均仅以单个分支形成，而电路迹线125.4和125.6均具有两个分支。电路迹线125的每一个具有在通孔130之间延伸的部分(见图1和3)，通孔130将每个电路迹线125耦合至第一电路迹线115中的一个。电路迹线125受到缝隙142、144和146的限制，因为那些缝隙142、144、146将每个电路迹线125与其相邻的电路迹线125部分分开。缝隙142、144和146使得电路迹线125围绕那些缝隙142、144、146的内部端有效地弯曲或成钩形。
如图6中所示例的范例中明显可见的，电路迹线125.2至少部分纵向地延伸并围绕电路迹线125.4的第一分支的部分和缝隙142成钩形。存在由电路迹线125.2和125.4限定的感应耦合区域部分。此感应耦合区域在缝隙142和由电路迹线135.1和135.3限定的感应耦合区域之间，电路迹线135.1、135.3部分垂直于电路迹线125.2、125.4。电路迹线125.4的第一分支也围绕电路迹线125.2内侧的缝隙142成钩形。从而，电路迹线125.2和125.4限定感应耦合区域，在该区域中它们彼此基本平行且相邻。此感应耦合区域不是完全线性的，而是由相对于彼此成角度的基本线性的平行且相邻的部分构成。此形式可以描述为弯曲的或非线性的，虽然其实际上由线性段构成。
以类似的方式，电路迹线125.4的第二分支至少部分围绕缝隙144伸并套入有电路迹线125.6的第一分支，以形成感应耦合区域，那些电路迹线125.4、125.6在感应耦合区域中彼此基本平行且相邻。此感应耦合区域由分开的成角度的均为线性的段构成，但是其效果是感应耦合区域作为整体不是线性的。感应耦合区域的至少一段设置于基底102的部分中的横向取向上，该部分在缝隙144与由电路迹线135.3和135.5限定的感应耦合区域纵向中间。
电路迹线125.6的第二分支以限定感应耦合区域的方式套入有电路迹线125.8，那些电路迹线在该感应耦合区域中彼此基本平行且相邻。此感应耦合区域由相对于彼此成角度的线性段构成，其效果是感应耦合区域看起来围绕缝隙146的端部成钩形。感应耦合区域的至少一段横向取向并安置为在缝隙146与由电路迹线135.5和135.7限定的感应耦合区域的纵向中间。
电路迹线125限定的感应耦合区域安置于缝隙142、144和146与由电路迹线135限定的纵向对应的感应耦合区域的中间。
由电路迹线125和135限定的每个感应耦合区域具有不同的长度。然而，由电路迹线135限定的每个感应耦合区域比与其纵向对应的由电路迹线125限定的感应耦合区域的长度小。从而，例如，由电路迹线135.1和135.3限定的纵向取向的感应耦合区域可以约为5.1mm长，而由电路迹线125.2和125.4限定的对应的感应耦合区可以具有6.5mm的长度。这给出了约1.25∶1的长度比率，有利于由电路迹线125.2和125.4限定的感应耦合区域。可以将此比率减小至，例如约1.1∶1，或可以增大此比率，取决于期望的感应耦合的精细调节的水平。
在另一范例中，由电路迹线135.3和135.5限定的感应耦合区域的长度可以约为3.3mm，而由电路迹线125.4和125.6限定的感应耦合区域的长度可以约为8.1mm。这给出了约2.5∶1的长度比率，有利于由电路迹线125.4和125.6限定的感应耦合区域。可以将此比率增大至，例如约3∶1，或甚至增大至5∶1，或可以减小此比率，取决于期望的感应耦合的精细调节的水平。
在另一范例中，由电路迹线135.5和135.7限定的感应耦合区域的长度可以约为5.7mm，而由电路迹线125.6和125.8限定的对应的感应耦合区域的长度可以约为10mm。这给出了约1.75的长度比率，有利于由电路迹线125.6和125.8限定的感应耦合区域。如上述其它长度比率一样，可以修改此比率，以将其增大或减小，以合适地精细调节感应耦合用于补偿电连接器400中的串扰的不利影响。总体上，由电路迹线125限定的感应耦合区域的长度应当比由电路迹线135限定的感应耦合区域的长度长，其比率在1.1∶1和5∶1之间。该比率可以可选地在1.25∶1和2.5∶1之间。
应当注意，图6中所示的电路迹线的配置对应于图3中所示的电路迹线的配置，虽然图3示出了从底侧106观看的电路迹线，而图6中所示的那些电路迹线的视图是从顶侧示出的(即，从第一面104朝向第二面106观看)。还应当注意，没有示出通孔130或电镀通孔。
对本领域技术人员来说，不脱离于此参照附图描述的实施例的精神和范围，可以对描述的实施例进行修改是明显的。例如，PCB可以是具有布置在中间层上的电路迹线125、135的多层PCB。
此说明书中对任何现有公开(或从其推导的信息)、或对任何已知事件的引用不是并且不应视为承认或接受或以任何形式暗示该现有公开(或从其推导的信息)或已知事件形成了此说明书涉及的努力领域中的公知技术。
在整个此说明书和以下的权利要求中，除非上下文另外要求，词语“包括”和其变形应理解为暗示包括阐述的整体或步骤，或整体或步骤构成的组，但是不排除任何其它的整体或步骤，或整体或步骤构成的组。
参考符号列表
100印刷电路板
102玻璃纤维基底
104第一侧
106第二侧
110.1-110.8第一接触部
112第一端
115.1-115.8电路迹线
120.1-120.8第二接触部
122第二端
125.2，125.4，125.6，125.8第二电路迹线
130通孔
135.1，135.3，135.5，135.7第二电路迹线
142，144，146缝隙
152，154，156，158缝隙
400连接器
410下部外壳
412突起
420上部外壳
430电缆连接器部分
435电缆
440绝缘遮蔽物
442缝隙
450偏置元件

Claims (9)

1.一种用于电连接器（400）的印刷电路板（100），所述印刷电路板包括布置在所述印刷电路板（100）的第一端（112）的多对第一接触部（110）和布置在第二端（122）的多对第二接触部（120），其中，第一接触部（110）经由第一电路迹线（115.1-115.8）分别连接至第二接触部（120），其中，所述第一电路迹线（115.1-115.8）至少布置在所述印刷电路板（110）的第一侧（104）上，其中，第二电路迹线和第三电路迹线（125.2，125.4，125.6，125.8；135.1，135.3，135.5，135.7）布置在所述印刷电路板（100）的另一侧（106）上，所述第二电路迹线连接至第二接触部（120）并且所述第三电路迹线连接至第一接触部（110），其中，第一接触部（110）对的第一接触部（110.1，110.3，110.5，110.7）分别分配给第三电路迹线（135.1，135.3，135.5，135.7），其中，所述第一接触部（110）的相邻的第三电路迹线（135.1，135.3，135.5，135.7）具有相对于彼此至少部分平行的部分，且第二接触部（120）对的第二接触部（120.2，120.4，120.6，120.8）分别分配给第二电路迹线（125.2，125.4，125.6，125.8），其中，所述第二接触部的相邻的第二电路迹线（125.2，125.4，125.6，125.8）具有相对于彼此至少部分平行的部分，其中，连接至所述第三电路迹线（135.1，135.3，135.5，135.7）的所述第一接触部（110.1，110.3，110.5，110.7）未连接至连接至所述第二电路迹线（125.2，125.4，125.6，125.8）的所述第二接触部（120.2，120.4，120.6，120.8），其中，所述第一接触部（110）处的所述第三电路迹线（135.1，135.3，135.5，135.7）形成第一耦合区域，且所述第二接触部（120）处的所述第二电路迹线（125.2，125.4，125.6，125.8）形成第二耦合区域，其中，接触部对的第一电路迹线（115.2，115.4，115.6，115.8）借助于电镀通孔（130）分别与所述接触部对的关联的另一第一电路迹线（115.1，115.3，115.5，115.7）交叉。
2.如权利要求1所述的印刷电路板，其特征在于，所述第二电路迹线（125.2，125.4，125.6，126.8）经由所述电镀通孔（130）连接至所述第二接触部（120.2，120.4，120.6，120.8）。
3.如任一前述权利要求所述的印刷电路板，其特征在于，在所述印刷电路板（100）中在第二接触部对（120.1，120.2；120.3，120.4；120.5，120.6；120.7，120.8）之间引入了第一缝隙（142，144，146）和/或在第二接触部（120）对的接触部之间引入了第二缝隙（152，154，156，158）。
4.如权利要求3所述的印刷电路板，其特征在于，第二耦合区域至少部分地布置于所述第一缝隙（142，144，146）和所述第一耦合区域之间。
5.如权利要求1-2中任一项所述的印刷电路板，其特征在于，所述第一接触部（110）处的所述第三电路迹线（135.1，135.3，135.5，135.7）取向为至少部分垂直于所述第二接触部处的所述第二电路迹线（125.2，125.4，125.6，125.8）。
6.如权利要求3所述的印刷电路板，其特征在于，所述第二接触部（120）处的所述第二电路迹线（125.2，125.4，125.6，125.8）至少部分围绕相应的所述第一缝隙（142，144，146）中的一个的内端延伸。
7.如权利要求1-2中任一项所述的印刷电路板，其特征在于，至少一个第二耦合区域的长度与相应的相邻第一耦合区域的长度的比率为1.1：1至3：1。
8.如权利要求1-2中任一项所述的印刷电路板，其特征在于，所述第一接触部（110）实施为绝缘位移接触部。
9.一种电连接器，其特征在于，所述电连接器包括任一前述权利要求所述的印刷电路板（100）。
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