CN101727158B - 主板供电电路 - Google Patents

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Abstract

一种主板供电电路，包括一第一、一第二NMOS场效应管、一第一电容、一第一电感及一延时电路，所述第一NMOS场效应管的栅极与一电压调节模块的一高端门极驱动输出引脚相连，其源极与所述电压调节模块的一相位引脚相连，并通过所述第一电容与电压调节模块的一驱动引脚相连，同时还通过所述第一电感与一内存控制中心相连，其漏极与一系统电源相连；所述第二NMOS场效应管的栅极与所述电压调节模块的一低端门极驱动输出引脚相连，其源极接地，其漏极与所述第一NMOS场效应管的源极及延时电路相连。所述主板供电电路控制所述第一、第二NMOS场效应管交替导通并经过所述延时电路提供一稳定的电压脉冲信号为所述内存控制中心供电。

Description

主板供电电路
技术领域
本发明涉及一种主板供电电路。
背景技术
电脑主板上的供电电路通常用于给主板上的不同芯片及零组件供电，其中包括给主板上的一MCH(Memory Controller Hub，内存控制中心，即传统意义上的北桥芯片)提供一1.25V的电压脉冲信号。主板的MCH负责连接CPU，AGP总线和内存。然而，由于现有主板供电电路提供给MCH的1.25V电压脉冲信号存在干扰信号，因而不够稳定，导致计算机经常出现死机。
发明内容
鉴于上述内容，有必要提供一种主板供电电路，可提供稳定的电压脉冲信号给内存控制中心。
一种主板供电电路，包括一第一NMOS场效应管、一第二NMOS场效应管、一第一电容、一第一电感以及一延时电路，所述第一NMOS场效应管的栅极与一电压调节模块的一高端门极驱动输出引脚相连，所述第一NMOS场效应管的源极与所述电压调节模块的一相位引脚相连，并通过所述第一电容与所述电压调节模块的一驱动引脚相连，同时还通过所述第一电感与一内存控制中心相连，所述第一NMOS场效应管的漏极与一系统电源相连；所述第二NMOS场效应管的栅极与所述电压调节模块的一低端门极驱动输出引脚相连，所述第二NMOS场效应管的源极接地，其漏极与所述第一NMOS场效应管的源极及所述延时电路相连；其中，所述电压调节模块的高端门极驱动输出引脚及低端门极驱动输出引脚分别用于驱动所述第一NMOS场效应管及第二NMOS场效应管，所述相位引脚输出一电压脉冲信号通过所述第一NMOS场效应管及第二NMOS场效应管交替导通为所述内存控制中心供电。
上述主板供电电路通过所述第二NMOS场效应管、第一NMOS场效应管交替导通，并经过所述延时电路为所述内存控制中心提供一稳定的电压脉冲信号。
附图说明
图1为本发明主板供电电路的较佳实施方式的电路图。
具体实施方式
下面参照附图结合具体实施方式对本发明作进一步的描述：
请参照图1，本发明主板供电电路的较佳实施方式包括一第一NMOS场效应管Q1、一第二NMOS场效应管Q2、两电感L1和L2、五电阻R1、R2、R3、R4和R5、六电容C1、C2、C3、C4、C5和C6、一VRM(Voltage Regulator Module，电压调节模块)10以及一PWM(Pulse WidthModulation，脉冲宽度调制)控制器20。
所述第一NMOS场效应管Q1的栅极通过所述电阻R1与所述VRM10的一UGATE(Upper Gatedrive output，第一门极驱动输出)引脚相连。所述第一NMOS场效应管Q1的源极与所述VRM10的一PHASE(相位)引脚相连，并经过所述电感L1与一MCH(Memory Controller Hub，内存控制中心)30相连，同时还依次通过所述电容C1以及电阻R2与所述VRM10的一BOOT(驱动)引脚相连。其中，所述电感L1可提供分流、滤波等作用。所述第一NMOS场效应管Q1的漏极通过所述电感L2与一电压为12V的系统电源12V_SYS相连，同时还分别通过所述电容C2、C3以及C4接地。
所述第二NMOS场效应管Q2的栅极通过所述电阻R3与所述VRM10的一LGATE(Lower Gatedrive output，第二门极驱动输出)引脚相连。所述第二NMOS场效应管Q2的源极接地。所述第二NMOS场效应管Q2的漏极与所述第一NMOS场效应管Q1的源极相连，并通过所述电阻R4与所述PWM(Pulse Width Modulation，脉冲宽度调制)控制器20的一VTT_OPS(Externalbuffer PWM current protection signal，过电流保护)引脚相连，所述VTT_OPS引脚用于为所述主板供电电路提供过电流保护作用。所述第二NMOS场效应管Q2的漏极还与一RC延时电路40相连。所述RC延时电路40包括所述电阻R5和所述电容C5。所述R5的电阻值介于2.09Ohm-2.31Ohm之间，所述电容C5的电容值为1nF。所述电阻R5的一端与所述第二NMOS场效应管Q2的漏极相连，另一端通过所述电容C5接地。其中，所述VRM10的UGATE引脚和LGATE引脚交替输出高电平信号驱动所述第一NMOS场效应管Q1、第二NMOS场效应管Q2导通，所述PHASE引脚通过所述第一NMOS场效应管Q1、第二NMOS场效应管Q2交替导通为所述MCH 30提供一1.25V的电压脉冲信号。
所述VRM10还包括一PVCC(Upper gate drive supply bias，高端门极驱动电压)引脚、一VCC(+12 Supply voltage，电压)引脚、一PWM(Input PWM signal for controllingthe driver，脉冲宽度调制)引脚以及一GND(接地)引脚，所述PVCC引脚及VCC引脚与所述系统电源12_SYS相连，并通过所述电容C6接地。所述VRM10的PWM引脚与所述PWM控制器20的一VTT_PWM(脉冲宽度调制电压)引脚相连。所述GND引脚接地。
当所述VRM10启动时，所述VCC引脚的工作电压未达到额定工作值12V时，所述UGATE引脚及LGATE引脚输出均为低电平，所述第一NMOS场效应管Q1及第二NMOS场效应管Q2均截止。当所述VCC引脚的工作电压达到额定工作值12V时，所述PWM控制器20的VTT_PWM引脚输出一PWM信号给所述VRM10的PWM引脚，使所述VRM10的UGATE引脚和LGATE引脚轮流输出高/低电平信号从而控制所述第一NMOS场效应管Q1及第二NMOS场效应管Q2交替导通。具体工作原理如下：开始时，从所述PWM控制器20输入到所述VRM10的PWM信号为低电平，所述LGATE引脚输出高电平使第二NMOS场效应管Q2导通，所述第一NMOS场效应管Q1截止，所述电容C1被充电。当PWM信号上升为高电平时，所述LGATE引脚输出低电平使所述第二NMOS场效应管Q2截止，所述电容C1被充电至12V，其内部储存的电能使所述BOOT引脚和UGATE引脚之间的内部开关(图未示)导通，所述UGATE输出高电平使所述第一NMOS场效应管Q1导通。当PWM信号又下降为低电平时，所述UGATE引脚输出低电平使所述第一NMOS场效应管Q1截止，所述LGATE引脚输出高电平时使所述第二NMOS场效应管Q2导通，即实现所述第一NMOS场效应管Q1及第二NMOS场效应管Q2交替导通，使所述VRM10的PHASE引脚提供1.25V的电压脉冲信号给所述MCH30。所述RC延时电路40将所述VRM 10的PHASE引脚输出的1.25V电压脉冲信号进行时序延时，从而降低现有技术中干扰信号对1.25V电压脉冲信号的影响，使得本发明主板供电电路相较于现有主板供电电路能够提供稳定的1.25V电压脉冲信号为所述MCH 30供电。
本较佳实施例中，所述电感L2、电容C2、C3、C4、C6用于滤波，在其他实施例中可选择性地省略以节约成本。
上述主板供电电路通过所述第一NMOS场效应管Q1、第二NMOS场效应管Q2交替导通并经过所述RC延时电路40为所述MCH30提供一稳定的1.25V电压脉冲信号。

Claims (10)

1.一种主板供电电路，包括一第一NMOS场效应管、一第二NMOS场效应管、一第一电容、一第一电感以及一延时电路，所述第一NMOS场效应管的栅极与一电压调节模块的一高端门极驱动输出引脚相连，所述第一NMOS场效应管的源极与所述电压调节模块的一相位引脚相连，并通过所述第一电容与所述电压调节模块的一驱动引脚相连，同时还通过所述第一电感与一内存控制中心相连，所述第一NMOS场效应管的漏极与一系统电源相连；所述第二NMOS场效应管的栅极与所述电压调节模块的一低端门极驱动输出引脚相连，所述第二NMOS场效应管的源极接地，其漏极与所述第一NMOS场效应管的源极及所述延时电路相连；其中，所述电压调节模块的高端门极驱动输出引脚及低端门极驱动输出引脚分别用于驱动所述第一NMOS场效应管及第二NMOS场效应管，所述相位引脚输出一电压脉冲信号通过所述第一NMOS场效应管及第二NMOS场效应管交替导通为所述内存控制中心供电。
2.如权利要求1所述的主板供电电路，其特征在于：所述第一NMOS场效应管的漏极通过一第二电感与所述系统电源相连。
3.如权利要求1所述的主板供电电路，其特征在于：所述第二NMOS场效应管的漏极还通过一电阻与一脉冲宽度调制控制器的一过电流保护引脚相连。
4.如权利要求3所述的主板供电电路，其特征在于：所述电压调节模块还包括一高端门极驱动电压引脚、一电压引脚、一脉冲宽度调制引脚以及一接地引脚，所述高端门极驱动电压引脚与所述电压引脚相连，并与所述系统电源相连，同时还通过一第二电容接地；所述脉冲宽度调制引脚与所述脉冲宽度调制控制器的一脉冲宽度调制电压引脚相连以接收一脉冲宽度调制信号；所述接地引脚接地。
5.如权利要求1所述的主板供电电路，其特征在于：所述第一NMOS场效应管的栅极通过一电阻与所述电压调节模块的高端门极驱动输出引脚相连。
6.如权利要求1所述的主板供电电路，其特征在于：所述第一电容通过一电阻与所述电压调节模块的驱动引脚相连。
7.如权利要求1所述的主板供电电路，其特征在于：所述第二NMOS场效应管的栅极通过一电阻与所述电压调节模块的低端门极驱动输出引脚相连。
8.如权利要求1所述的主板供电电路，其特征在于：所述第一NMOS场效应管的漏极还分别通过一第二电容、一第三电容及一第四电容接地。
9.如权利要求1所述的主板供电电路，其特征在于：所述延时电路包括一电阻及一第二电容，所述电阻的一端与所述第二NMOS场效应管的漏极相连，另一端通过所述第二电容接地。
10.如权利要求9所述的主板供电电路，其特征在于：所述电阻的电阻值介于2.09欧姆-2.31欧姆之间，所述第二电容的电容值为1nF。
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