CN101371587B - 适于接收经编码的视频信息的系统和方法 - Google Patents

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Abstract

一种视频流(例如H.264视频)包含经帧内编码的部分。解码经帧内编码的部分利用解码所述帧中的一个或一个以上其它部分(称为前驱)的结果。帧重构涉及识别不具有尚未解码的前驱部分的部分且接着起始对所述经识别部分的解码。当对一部分的解码大致完成时，接着检验待解码的剩余部分以识别不具有尚未解码的前驱的部分。通过实施此方法，可同时解码多个部分。可在不同的工作实体上解码每一部分，从而增加对整个帧的解码速率。由于对前驱进行解块滤波会毁坏对其它部分进行帧内解码时所需的信息，因此将经预滤波的前驱信息存储于缓冲器中以供随后在帧内解码期间使用，从而促进对多个部分的同时解码。

Description

适于接收经编码的视频信息的系统和方法
技术领域
所揭示的实施例涉及视频解码。
背景技术
蜂窝式电话向其用户提供远多于仅进行无线电话呼叫和接收无线电话呼叫能力的功能性。蜂窝式电话制造商将越来越多的功能性并入其蜂窝式电话中以针对用户的兴趣来与其它蜂窝式电话制造商进行竞争，举例来说，蜂窝式电话制造商可将视频接收能力嵌入其蜂窝式电话中。蜂窝式电话将能够用来接收从卫星传输的压缩视频信息流、将所述压缩视频信息解码成视频、及在蜂窝式电话的显示器上显示所述视频。因此，蜂窝式电话用户可在蜂窝式电话的显示器上观看卫星电势节目。然而，制造商也想廉价地制造蜂窝式电话。在一个实例中，使用较陈旧的半导体处理技术来实现蜂窝式电话的数字处理电路，以降低制作蜂窝式电话的集成电路的成本。使用较陈旧处理技术比使用更高速度的较新处理技术更便宜。
在一个实例中，较陈旧处理技术限制可实现到约一百兆赫的数字信号处理器的时钟速度。期望能够使用此较陈旧技术来对VGA(640x480像素)压缩视频信息进行每秒三十个帧的视频解码，以及在蜂窝式电话的显示器上实时显示所得VGA分辨率的视频。遗憾的是，一百兆赫的数字信号处理器不具有充足的通过量来实施所需量的处理。以每秒三十个帧对VGA视频流进行解码将需要具有250到300兆赫时钟频率的数字信号处理器。因此，如果使用廉价的半导体处理技术，那么蜂窝式电话仅可能以所需的每秒三十个帧的帧速率来显示三分之一的所需分辨率图像。
除成本之外，也可存在的原因是限制对蜂窝式电话内的数字信号处理电路进行时钟计时的时钟信号的频率。
发明内容
期望的一种解决方案是在不限制可在蜂窝式电话上解码和观看的视频的分辨率的情况下允许使用受限制的时钟速率。
某一量的经编码视频(举例来说，H.264视频或MPEG4视频)包含一序列的经编码部分。每一经编码部分含有关于如何重构所述视频的帧中的对应像素宏块的信息。某些部分是经帧内编码的。对经帧内编码部分的解码利用解码一个或一个以上其它部分的结果。可将所述其它部分称为“前驱”。整个视频帧的重构涉及识别不具有尚未解码的前驱部分的部分。可在此识别中使用称为“前驱表”的表。接着起始对每一此经识别部分的解码。在大致完成对一部分的解码(至少重构到高达解块点)时，接着检验待解码的剩余部分以识别不具有尚未解码的前驱的部分。同样，接着起始对每一此经识别部分的解码。重复识别不具有未解码前驱的部分且接着起始对那些经识别部分的解码的此过程直到已解码所述帧的所有部分。
通过实施此方法，起始对多个部分的解码以便同时解码多个部分。可在不同的工作实体上解码每一此部分，借此与一次仅可解码一个部分的解码方法相比增加对整个帧的解码速率。由于对经重构前驱宏块的解块滤波可毁坏在对其它相依部分进行帧内解码时所需的信息(经重构除且经预滤波的信息)，因此将经预滤波的前驱信息存储在缓冲器中以供随后在对相依部分进行帧内解码期间使用，借此促进对多个部分的同时解码。
在一实施例中，对多个经帧内编码的宏块信息部分(EMIP)的同时解码涉及对第一经帧内编码的EMIP的解码和对第二经帧内编码的EMIP的解码，对所述第一经帧内编码的EMIP的所述解码花费的时间比对所述第二经帧内编码的EMIP的所述解码长。
在一个实施例中，将所述量的经编码视频作为网络抽象层(NAL)单元位流接收到蜂窝式电话上。所述蜂窝式电话内的基带处理器集成电路中的一组并行数字信号处理器对所述位流进行实时解码。因此，所述基带处理器集成电路包含视频CODEC(编码器/解码器)功能性。在所述方法识别可同时解码的部分之后，由各种并行数字信号处理器来并行解码所述经识别部分。通过在多个数字信号处理器上分配工作负载，可以充足高的帧速率来再现较高分辨率的视频帧，而未必增加所述基带处理器集成电路内的数字信号处理器的最大处理器时钟速率。将所得高分辨率的视频帧从所述基带处理器集成电路输出并再现于蜂窝式电话的显示器上以供观看。在一个实例中，将彩色VGA帧(640x480像素)的H.264视频流接收到蜂窝式电话上并使用一组并行数字信号处理器以每秒三十个帧的帧速率来实时解码，其中所述数字信号处理器的每一者具有一百兆赫的最大时钟速率。
以下详细说明中描述额外方法和结构。此发明内容的意图不在于界定本发明。本发明由权利要求书界定。
附图说明
图1是根据一个新颖方面的移动通讯装置的框图。
图2是接收到图1的移动通信装置上的视频流的简化图。
图3图解说明将从图2的视频流重构的一个帧。
图4是图解说明可如何根据H.264标准来重构图3的帧的简化图。
图5是图解说明由图1的移动通信装置实施的新颖方法的流程图。
图6图解说明归因于H.264标准的前驱宏块关系。
图7是宏块帧的图式。图2的视频流中存在针对图7的帧中的每一宏块的经编码宏块信息部分(EMIP)。
图8-10图解说明产生前驱表的步骤。
图11是从实施图8-10的步骤所产生的前驱表的图式。
图12-23图解说明实施图5的方法的步骤以重构以图2的流形式传送到图1的移动通信装置的视频帧的结果。
图24图解说明在对宏块X进行帧内解码时可能需要的经重构值(经重构但未经滤波的值)带。
图25及26图解说明以经预滤波信息加载缓冲器以供随后在所述帧内的随后帧内解码时使用。
图27图解说明针对MPEG4编码算法的前驱宏块关系。
具体实施方式
图1是移动通信装置1的框图。在此实例中，移动通信装置1是蜂窝式电话，其包含射频集成电路(RFIC)2、基带处理器集成电路(BPIC)3和显示器4。RFIC 2包含模拟电路，其用于从天线5接收RF蜂窝式电话信号、处理信号并将其转换成数字形式以及将所得数字信息传递到BPIC 3。RFIC 2也包含用于以下操作的电路：从BPIC 3接收数字信息、处理数字信息并将其转换成模拟形式以及从天线5传输信息作为RF信号。除支持蜂窝式电话通信外，BPIC 3还用作用于运行各种应用层程序的硬件平台。所述实例中的此一应用是视频解码应用。BPIC 3包含视频CODEC(编码器/解码器)功能性。以H.264格式的视频信息流是从卫星传输的。视频RF信号由RFIC 2接收并以H.264网络抽象层(NAL)单元的位流6的形式传递到BPIC 3。根据协议将位流6分段并传递到BPIC 3。BPIC 3的ARM处理器部分7根据所述协议再汇编位流6并将呈NAL单元9形式的位流6置于存储器8中。
图2视频信息位流6的简化图。在此处图解说明的简化实例中，位流6包含一二十个宏块信息部分的序列。在图2中这些宏块信息部分被标记为0到19。每一部分包含三个子部分，此处将其称为“经编码的宏块信息部分”(EMIP)。举例来说，假定宏块信息部分MB0在位流7中。此部分MB0包含：第一EMIP 10，其指示如何重构宏块MB0的Y亮度信息；第二EMIP 11，其指示如何重构宏块MB0的Cr色度信息；和第三EMIP 12，其指示如何重构宏块MB0的Cb色度信息。在此特定实例中，宏块是16x16像素信息块。
可将其中每一像素包含亮度和色度信息的像素信息帧组织成三个帧(也称为字段)，一个用于Y亮度、一个用于Cr色度且一个用于Cb色度。当在显示器4上再现帧时，来自三个帧的对应亮度和色度值被组合并在红色-绿色-蓝色(RGB)色空间中转换。YCrCb到RGB的转换由BPIC 3的移动显示器处理器(MDP)部分13来执行。将RGB像素信息供应到显示器4以供再现。
图3图解说明亮度帧。图2的部分MB0的EMIP 10含有关于如何为图3的帧中的宏块MB0重构亮度信息的信息，图2的部分MB1中的亮度信息EMIP含有关于如何为图3的宏块MB1重构亮度信息的信息等等。
图4是图解说明可如何根据H.264标准来重构图3的帧的简化图。采用简化术语来促进对图4中所描绘的过程的解释。对于有关如何处理NAL单元位流以及如何重构视频信息帧的额外细节，参见H.264标准(举例来说，参见ITU-T视频编码专家组(VCEG)，建议H.264/ISO/1EC 14496-10“先进的视频编码”2003)。简化以下对应于图4的说明是出于说明性目的，因为其表示H.264/AVC依从解码器的单线程实施方案。
ARM处理器部分7从存储器8检索NAL单元9。NAL单元9包含标头和其它信息。每一NAL标头的含义由H.264标准规定。如块14所指示对NAL标头进行译码，且如块15所指示对剩余信息执行熵拆包。所述剩余信息包含符号。在表中查找每一符合以识别对应的位串。将所得位串(其对应于所述符合)并置以形成经量化的系数(X)流。对块14和15两者的处理均由ARM处理器7来执行，且将所得经量化系数流以及经译码的标头信息写回到存储器8中。在此实例中，可以约1千兆赫来对ARM处理器7进行时钟计时。
已认识到在此项技术中可将对块14的NAL标头译码称为“NAL标头解码”且在此项技术中可将对块15的熵拆包称为“熵解码”。然而，此处不将对块14和15的处理称为解码。而是，此处将术语“解码”用于描述其它处理，包含逆变换、帧间解码、帧内解码(参见图4中的虚线42)。
基带处理器集成电路3的数字信号处理器(DSP)部分16检索经量化系数(X)并根据H.264标准重新换算所述系数。此重新换算反转在对帧进行H.264编码期间所执行的换算。此重新换算由图4的块17来图解说明。DSP部分16和ARM处理器部分7两者可从存储器8读取以及写入到存储器8。存储器8是处理器可读媒体。ARM处理器部分7和DSP部分16两者均执行存储在其它处理器可读媒体(未显示)上的单独指令集，所述其它处理器可读媒体分别是ARM处理器部分7和DSP部分165的一部分。
DSP部分16接着根据H.264标准中的规定来对经重新换算的系数进行逆变换。此逆变换反转在对帧进行H.264编码期间所执行的变换。逆变换的应用由图4的块18图解说明。结果是像素的差别信息(D)。按宏块扫描线次序来排序差别像素值以便首先输出第一宏块的差别像素值，且接着输出第二宏块的差别像素值且依此类推。
差别像素信息(D)宏块已经帧间编码或经帧内编码。在图4的实例中，“经帧间编码”意指至少部分地基于来自另一帧(不是当前正被重构的帧)中的另一块的像素信息来编码宏块。举例来说，可通过从先前帧(视频信息中先于正被重构帧的帧)中的对应宏块中减去正被编码宏块来对差别像素信息(D)进行帧间编码。接着对此差别像素信息进行变换、量化、换算、打包以及熵打包以形成经帧间编码的EMIP。
“帧内编码”意指至少部分地基于来自当前帧中的另一块的像素信息来对宏块进行编码。举例来说，可通过从沿着相同帧中的相邻宏块的边缘的像素信息中减去正被编码宏块的像素信息来对差别像素信息(D)进行帧内编码。接着对此差别像素信息进行变换、量化、换算、打包以及熵打包以形成经帧内编码的EMIP。对于额外的细节，参见H.264标准。
举例来说，如果正被解码的当前EMIP是经帧间编码的EMIP，那么块19致使将来自先前帧的合适像素供应(在图4中由开关符合20来符号化)到加法器(在图4中由加法节点符号21来符号化)。从宏块所供应的像素称为预测宏块(P)。将差别宏块(D)像素值添加到宏块P像素值以产生经重构(但未经滤波)宏块(UF)的像素值。另一方面，如果正被解码的当前EMIP是经帧内编码的EMIP，那么块22和23致使将当前帧的先前经解码宏块的一部分供应(在图4中由开关符号20来符号化)到加法器21。所供应宏块的所述部分称为预测宏块(P)。将差别宏块D的每一像素值添加到来自宏块P的像素值以产生经重构(但未经滤波)宏块(UF)的像素值。在此帧内解码中，应注意预测宏块(P)的所述部分不是取自解块滤波器块25的输出的经滤波宏块的一部分，而是取自加法器21的输出的经预滤波宏块的一部分。有多种方式将预测宏块(P)的所述部分用于从经帧内编码的EMIP产生经重构的宏块。对于这些多种方式的细节，参见H.264标准。
正被解码的当前EMIP是帧间编码的还是帧内编码的是由位流中的标头信息确定的。图4的块24使用此标头信息来控制采用帧间解码还是采用帧内解码。因此将块24图解说明为控制开关符号20的位置。
此经重构宏块的帧可在所述帧的各种宏块之间呈现块效应和不连续性。根据H.264，对相邻的经重构宏块之间的边界进行滤波以帮助降低块效应。此滤波有时称为“解块滤波”且在图4中由块23来表示。解块滤波器25输出经重构且经滤波的当前宏块(F)26。将宏块(F)26与相同帧中的其它类似经重构宏块一起存储于存储器8中以便产生经重构宏块的整个帧27。经重构帧27存储于图1中的存储器8中。如上所解释，移动显示器处理器13检索帧27、将其转换成RGB格式并将RGB像素帧供应到显示器4以供再现。当开始将NAL单元进一步解码成对应于下一帧的位流6时，便可使用刚刚完成的经重构及经滤波的帧27来解码经帧间编码的EMIP。图4中由块19来图解说明对此先前经重构及经滤波帧的存储。在当前所述实施例中，是使用BPIC 3以每秒三十个VGA(640x480像素)帧的速率来解码H.264位流。BPIC 3具有一个ARM处理器7(1千兆赫最大时钟速率)和DSP 16，DSP 16涉及六个并行DSP处理器(每一DSP处理器具有100MHz的最大时钟速率)。
图5是图解说明新颖方法的流程图，所述新颖方法允许一百兆赫的DSP处理器以每秒三十个帧的速率来将NAL单元的H.264位流解码成VGA。图5的方法涉及可称为“前驱表”的内容。以下将解释如何导出前驱表。在解释前驱表之后，接着解释图5的方法中的各步骤。
图6图解说明一组五个宏块A、B、C、D和X。宏块X是待解码的当前宏块。由于使用H.264中的帧内编码各解块，对宏块X的解码可需要解码宏块C和D的结果。因此在大致上已对宏块C和D进行解码(重新换算、逆变换及重构至少到高达解块点)之前，不能执行对宏块X的解码。这是因为如果宏块X是经帧内编码的，那么其解码将需要图4中的块22含有经重构(当未经滤波)宏块C和D。因此，将宏块C和D说成是宏块X的“前驱”宏块。此关系(取决于所采用帧内编码各解块的类型的细节)用于产生前驱表。
图7是宏块帧的图式。每一宏块右上角落处的数目是宏块数目。每一宏块中心处的数目是所述宏块的前驱计数值。最初，表中的所有前驱计数值是未知的且因此在图7中表示为“X”。
在第一步骤中，相对于图7的帧来放置图6的宏块结构，以使得图6的宏块结构的宏块X设置于图7的宏块MB0上方。此在图8的左边部分中予以图解说明。变暗的宏块表示图6的宏块结构的宏块。如由图8所指示，由于宏块C和D在帧边界的外侧，因此可对宏块X进行解码而无需等待对任何其它宏块的解码。因此将宏块MB0说成是不具有前驱。如图8的右边部分中所图解说明，MB0的前驱计数值是零(此表示MB0不具有前驱)。
接下来，将图6的宏块结构向右移位以使得图6的宏块结构的宏块X设置于宏块MB1上方。此在图9的左边部分中予以图解说明。宏块C仍在帧边界的外侧，但宏块D现在在MB1上方.因此，必须可对宏块MB1进行解码之前对宏块MB0进行解码。因此将MB1说成是具有一个前驱宏块(MB0)。如图9的右边部分中所图解说明，MB1的前驱计数值是1(此表示MB1具有一个前驱)。
接下来，将图6的宏块结构向右移位以使得图6的宏块结构的宏块X设置于宏块MB2上方。此在图10的左边部分中予以图解说明。宏块C仍在帧边界的外侧，但宏块D现在在MB1上方。因此，必须在可对宏块MB2进行解码之前对宏块MB1进行解码。因此将MB2说成是具有一个前驱宏块(MB1)。如图10的右边部分中所图解说明，MB2的前驱计数值是1(此表示MB2具有一个前驱)。
针对图7的帧的多个行，按扫描线次序从左到右逐行地向下重复跨越所述帧的宏块移位图6的宏块结构的此过程直到填入前驱表中的每一前驱计数值。
图11图解说明所得前驱表。此表用于图5的方法。最初，在图5的方法中，接收视频信息(在图5中的步骤100)。视频信息包含帧的多个EMIP。一些EMIP是经帧间编码的，且另一些EMIP是经帧内编码的。举例来说，视频信息可以是图1的位流6。
接下来(步骤101)，识别不具有尚未解码的前驱EMIP的一个或一个以上EMIP。在一个实例中，在DSP 16上执行的控制实体过程从存储器8中检索图11的前驱表。MB0的零前驱计数值指示MB0的EMIP是不具有仍未解码的前驱EMIP的EMIP。
接下来(步骤102)，起始对步骤101中所识别的EMIP的解码。对这些EMIP的每一者的解码是由不同的工作实体来执行。在一个实例中，DSP 16包含六个并行DSP处理器。每一DSP处理器均以一百兆赫速率来时钟计时。采用管道式架构，其中使用经交错的一百兆赫时钟信号对每一相应DSP处理器进行时钟计时。从在DSP 16上执行的软件的观点来看，似乎可使用六个单独的DSP处理器来执行代码。每一DSP处理器执行单独的指令线程且被视为不同工作实体。所有线程从单独的队列接收要做的工作。
在当前所述的实例中，在步骤101中仅识别出一个EMIP且此是MB0的EMIP。将MB0的此EMIP置于共享队列上。第一线程(在图1中标记为T1)拾取MB0的此EMIP用于在第一虚拟DSP处理器上进行解码并根据图4的方法来解码MB0的EMIP。
图12图解说明处理中的此阶段。只要对EMIP未大致完成(大致完成意指解码完成到获得经重构但未经滤波宏块(UF)的点)，此状态持续。当确定已经大致上完成了对EMIP的解码(步骤103)时，那么过程流便返回到步骤101。在图32-23的图式中，将其EMIP已经大致解码的宏块表示为填有交叉影线的块。从步骤103，解码还继续以便对经重构宏块(UF)进行解块滤波以产生经重构且经滤波的宏块。输出所得经重构且经滤波的宏块(步骤104)并将其积累起来以开始经重构且经滤波的帧的形成。
在当前所述实例中，一旦大致上完成了对宏块MBO的解码，便使用图12的前驱表来执行不具有前驱EMIP的一个或一个以上EMIP的识别(步骤101)。在前驱表中，将MB0是其前驱的所有宏块的前驱计数值递减1。将其递减1是因为其前驱(MB0)中的一者现在已充分解码。在当前所述实例中，MB0是MB1的前驱。如由图13所指示，将MB1的前驱计数值从1递减到0。其前驱计数值为0的任何宏块都不具有任何前驱。因此，在步骤101中将MB1识别为是不具有尚未解码的前驱EMIP的EMIP。
接下来(步骤102)，起始对MB1的EMIP的解码。在当前实例中，将MB1的EMIP置于共享队列上。由于线程T1现在是空闲的，因此线程T1可从队列中检索MB1的EMIP且开始对其进行解码。当对MB1的EMIP的解码已经大致完成(步骤103)时，那么处理便返回到步骤101。解码还继续以便对MB1的经重构宏块(UF)进行解块滤波以产生MB1的经重构且经滤波的宏块。
当对MB1的EMIP的解码致使处理返回到步骤101时，将MB1是其前驱的所有宏块的前驱计数值递减。如图14中所图解说明，此导致宏块MB2和MB5的前驱计数值被递减。应注意图6的宏块相依结构指示MB1是MB2和MB5两者的前驱。递减导致宏块MB2和MB5的前驱计数值从1改变到0。因此在步骤101中将MB2和MB5的EMIP识别为是不具有尚未解码的前驱EMIP的EMIP。
在当前所述实例中，将MB2和MB5的EMIP推到共享工作队列上作为针对先前MB的最后一个处理步骤。DSP线程T1从队列中取出MB2的EMP，且线程T2从队列中取出MB5的EMIP。此是图15中所图解说明的处理状态。此时，使用多个不同的工作实体(在此情况下，两个线程)来对不仅一个而是两个EMIP同时进行解码。
当这些EMIP中的一者被大致解码时，那么处理便从决策步骤103向后接续到步骤101。在当前所述的简化实例中，对所有EMIP的解码花费相同的时间量。因此，在步骤103中将MB2的EMIP和MB5的EMIP同时确定为被大致解码。经大致解码的MB2是MB3和MB6两者的前驱。因此，步骤101涉及将MB3和MB6的前驱计数值递减。同样，经大致解码的MB5是MB6的前驱。因此，步骤101涉及将MB3的前驱计数值递减一次且涉及将MB6的前驱计数值递减两次。如图16中所图解说明，将MB3和MB6的前驱计数值降低到0。由于MB3和MB6的前驱计数值为零，因此将其EMIP识别(步骤101)为是不具有尚未解码的前驱EMIP的EMPS。起始对经识别EMIP的解码(步骤102)。如图16中所图解说明，将MB3和MB6的EMIP推到共享队列上。线程T1从队列中取出MB3的EMIP且线程T2从队列中取出MB6的EMIP。因此，通过不同的工作实体(在此情况下，不同的线程)对MB3和MB6的EMIP同时进行解码。
处理以此方式跨越帧的宏块而继续进行。在当前所述实例中，通过图16-23的图式的序列来陈述对EMIP的处理。应注意控制实体实施的方法(在DSP 16上执行的过程)致使在整个过程中的不同点(参见图16和18)来同时处理三个EMIP。在图1中，以DSP 16内的块来图解说明执行此并行处理的三个工作实体(三个指令线程T1、T2和T3)。
用于经预滤波值的缓冲器：同时对一群组EMIP进行解码是可能的，因为解码所述群组中的每一EMIP所需的信息并不依赖于解码所述群组中待同时解码的其它EMIP的结果。如图6中所指示，对宏块X的经帧内编码EMIP的解码需要首先对宏块C和D的EMIP进行解码。更明确来说，对宏块X的帧内解码可能需要所述解码由沿着宏块B的底边缘的值带引起且可能需要所述解码由沿着宏块D的右边缘的值带引起且可能需要所述解码由宏块A的右下角落处的小值块引起。图24图解说明在对宏块X进行帧内解码时可能需要的此值带。在H.264的实例中，此带是一个值宽且沿着宏块D的右边缘向上延伸穿过宏块A右下角(一个值)并从左到右跨越宏块B的底边缘，且在所述路途的约四分之一处延伸到宏块C中。
在以上陈述的图12-23的解码流中对MB7的解码中，如果将MB7的EMIP重构以产生经预滤波的宏块值(UF)，并接着在继续解码下一EMIP之前对那些经预滤波的宏块值(UF)进行解块滤波，且如果未存储经预滤波的宏块值(UF)，那么在对宏块MB8的EMIP进行解码(参见图17)时，针对MB7的右边缘的经预滤波宏块值(UF)将不能用于对MB8的EMIP的帧内解码。类似地，在对宏块MB12的EMIP进行解码(参见图1.8)时，针对MB7的底边缘的经预滤波宏块值(UF)将不能用于对MB12的EMIP的帧内解码。为存取这些经预滤波值以用于对其它宏块的EMIP的后续解码，在进行解块滤波之前将正被解码的EMIP的底边缘经预滤波值带存储到缓冲器中。类似地，为存取这些经预滤波值以用于对其它宏块的EMIP的后续解码，将正被解码的EMIP的右边缘经预滤波值带存储到缓冲器中。
图25图解说明缓冲器28，其用于存储供在对相同帧中的后续EMIP进行解码时使用的经预滤波的重构值。缓冲器28包含数个垂直延伸的列区段29-32和数个水平延伸的行区段33-37。箭头38图解说明当对宏块MB7的EMIP的解码大致完成时，将沿着其底边缘的经预滤波值带存储于缓冲器28的对应部分35中。部分35是缓冲器28对应于含有宏块MB7的宏块列的部分。这些值保持在缓冲器28中直到对宏块MB12的EMIP进行解码。在对宏块MB12的EMIP进行解码时，可使用缓冲器28的部分35中的值来进行帧内解码。帧的宏块的优先次序确保在宏块MB12的EMIP之前所述列中没有宏块的EMIP将被解码。因此，当列中的宏块的EMIP大致完成时，便将其底部的经预滤波值带写入到缓冲器28对应于所述列的部分中。接着可将这些存储的经预滤波值用于对所述列中正下方的宏块EMIP的解码。
图26图解说明当对宏块MB7的EMIP的解码大致完成时，将沿着其右边缘的经预滤波值带存储到缓冲器28的对应部分30中。部分30是缓冲器28对应于含有宏块MB7的宏块行的部分。这些值保持在缓冲器28中直到对宏块MB8的EMIP进行解码。在对宏块MB8的EMIP进行解码时，可使用缓冲器28的部分30中的值来进行帧内解码。宏块的优先次序确保在宏块MB8的EMIP之前所述行中没有宏块的EMIP将被解码。因此，当行中的宏块的EMIP大致完成时，便将其右边缘的经预滤波值带写入到缓冲器28对应于所述行的部分中。接着可将这些存储的经预滤波值用于对所述行中正右方的宏块EMIP的解码。
从图24中注意到对宏块X的EMIP进行帧内解码可能需要来自宏块A的经重构但未经滤波的值(宏块A的右下角落)。因此部分30-32的每一者在所述部分的顶部处含有额外值。在图26的实例中，当对宏块MB7的解码大致完成时，将MB7中的右边缘的经预滤波值带写入到缓冲器28中的下部分30中且将来自部分35的右边角落的经预滤波值写入到部分30的顶部。部分35的右边角落是对MB2的先前处理的结果。接着将MB7的底部水平边缘带写入到缓冲器28中的部分35，如图25中所图解说明。接着对宏块MB8的EMIP的帧内解码可使用列部分30顶部中的值、以及列部分30底部中的值以及行部分36中的值。可将部分29-32称为缓冲器28的“列”部分，这是因为部分29-32形成列(即便每一部分29-32对应于一宏块行)。可将部分33-37称为缓冲器28的“行”部分，这是因为部分33-37形成行(即便每一部分33-37对应于一宏块列)。在一个有利方面中，将缓冲器28设置在DSP 16内的存储器中而不是设置在存储器8中以降低DSP 16执行帧内解码操作所需的跨越总线41的存储器存取次数。虽然以上正文中将图25图解说明及描述为在图26之前，但由图26中的线39和40所图解说明的列缓冲器更新操作是在由图25中的线38所描述的操作之前执行的。
除H.264之外的解码算法：以上陈述的用于同时解码多个EMIP的方法可应用于解码使用除H.264以外的编码算法编码的EMIP。提供以上对H.264EMIP的解码的说明作为实例。为将所述方法应用于解码使用另一编码算法编码的EMIP，确定将根据所述编码算法解码的块的前驱。在一个实例中，接着应用这些前驱与待解码的所述块的关系应以产生前驱表。接着将所述前驱表用于对EMIP的解码以确定既定EMIP的所有前驱何时已被充分解码。当确定了既定EMIP的所有前驱已被充分解码时，接着起始对既定EMIP的解码。可在不同的工作实体上起始对EMIP的解码以便同时对多个EMIP进行解码。
图27图解说明用于MPEG4编码算法的前驱宏块关系。在图27中所图解说明的所述组的四个宏块A、B、C和X中，宏块X是待解码的当前宏块。宏块B和D是宏块X的前驱。以采用图6的前驱关系来产生用于H.264的图11的前驱表相同的方式，采用图27中所图解说明的前驱关系来产生用于MPEG4的前驱表。采用类似图25和26中的缓冲器28的缓冲器来存储在对一个EMIP进行MPEG4解码中所产生的经预滤波且经重构的值。可在随后使用所存储的经预滤波且经重构的值来对所述帧中的另一EMIP进行帧内解码。以此方式，可利用此专利文件中陈述的用于同时解码多个EMIP的方法来解码使用除H.264和MPEG4以外的编码算法编码的视频信息。
尽管上文出于指导目的而描述某些特定实施例，但是本发明并不限于此。不需要以信息流形式将经编码的视频信息接收到解码装置上，而是通过从存储器中读取经编码的视频信息而将其接收到解码装置上。举例来说，可将存储器中的经编码视频作为文件来存储和检索。能够解码EMIP的工作实体可以是软件线程，以使得图5的整体方法在软件中实现。另一选择是，工作实体可以是不同的专用硬件处理单元。可使用软件来将对EMIP的解码推到用于这些专用硬件处理单元的队列上。另一选择是，可使用专用硬件来将对EMIP的解码推到用于硬件处理单元的队列上。所述解码方法未必体现于移动通信装置上，而是可体现于另一装置上。在一个实施例中，所述解码方法由在个人计算机上执行的视频读取器(举例来说，视窗媒体播放器)应用程序来执行。所述解码方法可由体现于电视、视频磁盘播放器以及其它视频解码和观看装置中的视频解码硬件及/或软件来执行。因此，可在不违背权利要求书中所陈述的本发明范围的前提下实践所述特定实施例的各种特征的各种修改、变型及组合。

Claims (20)

1.一种适于接收经编码的视频信息的方法，其包括：
(a)接收多个帧的视频信息，其中所述帧中的一者的所述视频信息包括多个经编码的宏块信息部分EMIP，其中所述EMIP中的一些EMIP是经帧间编码的，且其中所述EMIP中的其它EMIP是经帧内编码的；
(b)识别所述一个帧中不具有尚未解码的前驱EMIP的一个或一个以上所述EMIP；所述识别涉及使用前驱表，所述前驱表包含所述帧的每一EMIP的前驱计数值，其中特定EMIP的所述前驱计数值指示尚未解码的前驱EMIP的数目；
(c)起始对在(b)中所识别的每一EMIP的解码；及
(d)在大致完成对(c)中所起始的任一EMIP的所述解码之后返回到(b)，其中通过同时对多个经帧内编码的EMIP进行解码来执行(b)、(c)和(d)多次。
2.如权利要求1所述的方法，其中所述视频信息包括以下中的至少一者：H.264视频信息和MPEG4视频信息。
3.如权利要求1所述的方法，其中在(c)中所起始的所述解码包括：1)产生经预滤波的经重构像素信息宏块，和2)对所述经预滤波的经重构像素信息宏块进行解块滤波以产生经滤波的经重构像素信息宏块。
4.如权利要求3所述的方法，其中所述返回到(b)在与所述解块滤波正发生的相同时间发生。
5.如权利要求3所述的方法，其中所述返回到(b)在已完成所述解块滤波之后发生。
6.如权利要求3所述的方法，其中在(d)中的所述大致完成后，存储部分或全部的所述经预滤波的经重构像素信息宏块，且其中随后在对所述帧的所述EMIP中的另一者的帧内解码中使用所述部分或全部的所述经预滤波的经重构像素信息宏块的所存储信息。
7.如权利要求1所述的方法，其中对所述多个经帧内编码的EMIP的所述同时解码涉及对第一经帧内编码的EMIP的解码和对第二经帧内编码的EMIP的解码，对所述第一经帧内编码的EMIP的所述解码花费的时间比对所述第二经帧内编码的EMIP的所述解码长。
8.如权利要求1所述的方法，其进一步包括：
在完成或大致完成对经帧内编码的EMIP的前驱EMIP中的一者的解码后，递减所述经帧内编码的EMIP的所述前驱计数值。
9.如权利要求1所述的方法，其中(b)涉及识别所述一个帧中不具有尚未解码的前驱EMIP的多个EMIP，且其中(c)涉及起始对在(b)中所识别的所述多个EMIP的每一者的解码。
10.如权利要求1所述的方法，其中所述帧是亮度信息帧，所述视频信息进一步包括对应于所述亮度信息帧的两个色度信息帧。
11.如权利要求1所述的方法，其中(c)的所述起始涉及：1)起始通过第一线程对第一EMIP的解码，和2)起始通过第二线程对第二EMIP的解码。
12.如权利要求1所述的方法，其中(c)的所述起始涉及：1)起始通过第一硬件解码引擎对第一EMIP的解码，和2)起始通过第二硬件解码引擎对第二EMIP的解码。
13.如权利要求1所述的方法，其中在(a)中接收的所述视频信息包括网络抽象层(NAL)单元流。
14.如权利要求1所述的方法，其中将所述视频信息存储在存储器中，且其中在(a)中将所述视频信息从所述存储器接收到基带处理集成电路上。
15.一种适于接收经编码的视频信息的系统，所述经编码的视频信息包含经帧内编码的部分和经帧间编码的部分，所述系统包括：
多个工作实体，其中每一工作实体可操作以对所述经编码的视频信息的一部分进行视频帧内解码以产生经重构量的像素信息；及
控制实体，其可操作的使用前驱表来识别不具有尚未视频解码的任何前驱部分的一个或一个以上部分，所述前驱表包含对应于每一部分的前驱计数值，其中特定部分的所述前驱计数值指示尚未解码的前驱部分的数目；所述控制实体接着致使所述多个工作实体中的选定一者对所述经识别部分的每一者进行视频解码，其中所述控制实体致使所述多个工作实体对所识别的部分进行解码，以使得同时对至少一些所述经帧内编码的部分进行帧内解码且使得产生经重构的像素信息帧。
16.如权利要求15所述的系统，其中所述工作实体取自由以下组成的群组：指令线程、专用硬件处理单元。
17.如权利要求15所述的系统，其中接收到所述系统上的所述经编码的视频信息取自由以下组成的群组：H.264经视频编码的信息、MPEG4经视频编码的信息。
18.如权利要求15所述的系统，其中所述系统取自由以下组成的群组：基带处理器集成电路、视频CODEC(编码器/解码器)集成电路、个人计算机和在所述个人计算机上执行的视频解码应用层软件。
19.一种适于接收经编码的视频信息的系统，所述经编码的视频信息包含经帧内编码的部分和经帧间编码的部分，所述系统包括：
多个工作实体，其中每一工作实体可操作以对所述经编码的视频信息的一部分进行视频帧内解码以产生经重构量的像素信息；及
用于以下操作的装置：1)使用前驱表来识别不具有尚未视频解码的任何前驱部分的一个或一个以上部分，所述前驱表包含对应于每一部分的前驱计数值，其中特定部分的所述前驱计数值指示尚未解码的前驱部分的数目；及2)致使所述多个工作实体中的选定一者对所述经识别部分的每一者进行视频解码。
20.如权利要求19所述的系统，其中至少一些所述经帧内编码的部分是同时帧内解码的。
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