CN101303841A - 液晶显示器件 - Google Patents

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Abstract

本发明公开了一种具有简化的印刷电路板(PCB)的液晶显示器件(LCD)。所述LCD器件包括：LCD面板，包括第一数据线组、第二数据线组、和从所述第一和第二数据线组分离的玻上线(LOG)配线；第一集成电路(IC)组，将数字视频数据转换为数据电压，并将所述数据电压施加给第一数据线组；第一源PCB，第一IC组中的IC与其连接；第二IC组，用于经由第一源PCB和LOG配线接收所述时序控制信号和数字视频数据，将所述数字视频数据转换为数据电压，并将所述数据电压施加给第二数据线组；第二PCB，第二IC组中的IC与其连接；时序控制器，包括单输出端口以输出所述时序控制信号和数字视频数据；控制PCB，所述时序控制器安装在其上；以及连接器，连接到控制PCB和第一源PCB。

Description

液晶显示器件
本申请要求享有2007年5月11日提出的申请号为No.10-2007-0046120的韩国专利申请的权益，在此结合其全部内容作为参考。
技术领域
本发明涉及一种液晶显示(LCD)器件，尤其涉及一种具有简化的印刷电路板(PCB)的LCD器件。
背景技术
LCD器件通过控制液晶单元依照视频信号的透光率来显示图像。参照图1，示出了有源矩阵型LCD器件。在这种有源矩阵型LCD器件中，由在各个液晶单元Clc中形成的薄膜晶体管(TFT)开关施加给液晶单元Clc的数据电压，用于主动控制数据，以获得移动图像的显示质量的提高。图1中，附图标记“Cst”表示存储电容器，用来保持在相关液晶单元Clc中充电的数据电压，附图标记“DL”表示施加有数据电压的数据线，而附图标记“GL”表示施加有扫描电压的栅线。
对于LCD器件，正在开发中等和大尺寸型号以及小尺寸型号，与具有大屏幕尺寸的电视机和监视器近来的发展保持同步。如图2所示，这种LCD器件包括控制PCB 20、源PCB 22、源PCB 22和控制PCB 20之间连接的电缆21、和连接到源PCB 22和LCD面板25的多个源薄膜上芯片(COF)24。
每个源COF 24电连接到源PCB 22和LCD面板25的数据焊盘。数据集成电路(IC)23安装在每个源COF 24上。
信号线在源PCB 22上形成，以从控制PCB 20转移数字视频数据和时序控制信号。
控制电路、数据转移电路等安装在控制PCB 20上。控制PCB 20向数据IC 23提供数据，并且经由电缆21向源PCB 22提供时序控制信号以控制数据IC 23的操作。
由于在如图2所示的LCD器件中，LCD面板25具有增加的尺寸，数据线的数目和源COF 24的数目相应地增加。因此，源PCB 22的尺寸增加。在这种情况下，在对准源COF 24和源PCB 22中存在困难。此外，不能通过现有的自动安装设备，比如表面安装技术(SMT)设备处理如上所述具有增加的尺寸的源PCB 22，因为该设备是为具有比大尺寸的源PCB 22小的尺寸的源PCB设计的。此外，由于LCD设备具有增加的尺寸，比如内存的电路设备的数目增加，并且输出管脚的数目增加。由于这个原因，存在控制PCB 20的制造成本增加的问题。
发明内容
因此，本发明涉及一种液晶显示器件，其基本上消除由于现有技术的局限性和缺陷引起的一个或多个问题。
本发明的一个目的在于提供一种液晶显示器件，其包括具有分开的结构的源印刷电路板(PCB)，以减小控制PCB的尺寸和输出管脚的数目。
本发明的其它优点、目的和特征将在说明书中部分阐明，熟悉本领域的技术人员从说明书可以明白，或可以通过本发明的实施方式理解。本发明的目的和其它优点将通过说明书和权利要求书以及附图所指出的结构来实现和获得。
为了获得这些目的和其它的优点并根据本发明的目的，如在此具体和广泛描述的，一种液晶显示器件包括：液晶显示面板，包括第一数据线组、第二数据线组、和从所述第一和第二数据线组分离的玻上线(LOG)配线；第一集成电路(IC)组，根据时序控制信号运行，以将数字视频数据转换为数据电压，并且将所述数据电压施加给所述第一数据线组；第一源印刷电路板(PCB)，包括在所述第一集成电路组中的集成电路与其连接；第二集成电路组，用于经由所述第一源印刷电路板和所述LOG配线接收所述时序控制信号和所述数字视频数据，并且根据所述时序控制信号运行，以将数字视频数据转换为数据电压，并且将所述数据电压施加给所述第二数据线组；第二PCB，包括在所述第二集成电路组中的集成电路与其连接；时序控制器，包括单输出端口以输出所述时序控制信号和所述数字视频数据；控制PCB，所述时序控制器安装在其上；以及连接器，连接到所述控制PCB和所述第一源PCB，以将通过所述时序控制器的单输出端口输出的所述时序控制信号和所述数字视频数据转移到所述第一源印刷电路板，其中所述第一和第二集成电路组的每个集成电路包括一极性控制信号(POL)产生器，用于使用一部分所述时序控制信号，产生极性控制信号以控制所述数据电压的极性。
所述POL产生器利用栅起动脉冲和源输出使能信号来产生所述极性控制信号，其中所述栅起动脉冲指示起动水平线，从所述起动水平线开始一个垂直周期的扫描操作，用于显示一个帧，并且所述源输出使能信号使能所述数字视频数据被输出。
所述POL产生器包括第一D触发器，使用所述源输出使能信号作为输入时钟，所述第一D触发器产生在参照每个垂直周期产生的所述源输出使能信号的上升边缘的逻辑状态中反相的第一极性控制信号；第二D触发器，使用所述栅起动脉冲作为输入时钟，所述第二D触发器产生在参照每个垂直周期产生的所述栅起动脉冲的上升边缘的逻辑状态中反相的选择信号；和乘法器，用于接收所述第一极性控制信号和第二极性控制信号，该第二极性控制信号具有与所述第一极性控制信号相反的逻辑值，并且响应所述选择信号，以一个垂直周期的间隔交替地输出所述第一和第二极性控制信号。
所述第一D触发器可以包括经由反相器互相电连接的非反相输出端子和输入端子。所述反相器可以接收从所述第一D触发器的非反相输出端子反馈的所述第一极性控制信号，并且可以输出反馈信号作为所述第二极性控制信号。
所述控制PCB包括用于产生驱动所述液晶显示面板需要的驱动电压的电压产生器。
所述第一和第二集成电路组的每个集成电路(IC)可以安装在薄膜上芯片(COF)和载带封装之一上，在其上形成用于转移所述时序控制信号、所述数字视频数据和所述驱动电压的虚拟配线。
所述时序控制器可以包括2-端口扩展器，用于将以输入频率输入的数字视频数据RGB分为奇数像素数据和偶数像素数据，并且以对应输入频率的1/2的频率提供分离的奇数和偶数像素数据；以及数据调制器，用于调制来自所述2-端口扩展器的奇数和偶数像素数据，以减少从所述单输出端口输出的数字视频数据的摆动宽度，所述数据调制器以对应2倍输入频率的频率输出所述数字视频数据。
所述数据调制器可以根据迷你低压差分信号(LVDS)方案和小摆动差分信号(RSDS)方案之一调试所述数字视频数据。
所述第一和第二集成电路组的每一个还可以包括用于恢复调制的数字视频数据的数据恢复器。
应该理解，本发明上面的概括性描述和下面的详细说明都是示例性和解释性的，其目的在于对本发明的权利要求作进一步解释。
附图说明
本申请所包含的附图用于进一步理解本发明，其与说明书相结合并构成本申请的一部分，所示的本发明的实施方式与说明书一起解释本发明的原理。
在图中：
图1是表示液晶显示(LCD)器件的一个液晶单元的等效电路图；
图2是表示具有单个源PCB的LCD器件的图；
图3是表示根据本发明一示例性实施方式的LCD器件的方框图；
图4是具体地示出图3中的时序控制器和各个数据IC之间的连接结构的示图；
图5是在源薄膜上芯片(COF)上形成的虚拟配线和在LCD面板的基板上形成的玻上线(LOG)配线的平面图；
图6是示出了包括在图3和4所示的时序控制器中的数据处理器的详细配置的方框图；
图7和8是表示来自图6所示的数据调制器的输出的示例的波形图；
图9是图4所示的时序控制器和各个数据IC之间建立的信号转移路径的示图；
图10是表示图4所示一个数据IC的详细配置的方框图；
图11是表示图10所示的POL产生器的一个示例的电路图；
图12是描述图11的示例中产生的极性控制信号的波形图；
图13是表示图10所示的POL产生电路的另一示例的电路图；
图14是表示图13的示例中产生的极性控制信号的波形图；
图15是表示图10所示的伽玛补偿电压产生器的详细配置的方框图；
图16是表示图10所示的数字/模拟转换器(DAC)的详细配置的方框图。
具体实施方式
现在详细参照附图所示的示例，说明本发明的优选实施方式。尽可能的，相同的附图标记在所有的图中指代相同或相似的部分。
下文中，将参照图3到16说明根据本发明的优选实施方式。
参照图3，示出了根据本发明一示例性实施方式的液晶显示(LCD)器件。LCD器件包括LCD面板30、时序控制器31、数据驱动电路32、和栅驱动电路33。
LCD面板30包括两个玻璃基板，在基板之间密封液晶分子。LCD面板30还包括排列成矩阵形式的m×n个液晶单元Clc，形成m条数据线D1到Dm和n条栅线G1到Gn的交叉点结构。
在LCD面板30的下玻璃基板上形成数据线D1到Dm、栅线G1到Gn、薄膜晶体管(TFT)、连接到TFT的各液晶单元Clc的像素电极1、和存储电容器Cst。玻上线(LOG)配线形成在LCD面板30的下玻璃基板上，以在源PCB之间转移数字视频数据、时序控制信号、驱动电压等，将在后面描述。
黑矩阵、滤色片、和公共电极2形成在LCD面板30的上玻璃基板上。在比如扭曲向列(TN)模式或垂直对准(VA)模式的垂直电场驱动系统中，如上所述，公共电极2形成在上玻璃基板上。另一方面，在比如共平面开关(IPS)模式或边缘场开关(FFS)模式的水平电场驱动系统中，公共电极2与像素电极1一起形成在下玻璃基板上。具有互相正交的光轴的偏振板分别连接到上、下玻璃基板。对准薄膜形成在每个偏振板和液晶之间的接口，以设置液晶的预倾斜的角度。
时序控制器31接收比如垂直/水平同步信号的时序信号、数据使能信号、和时钟信号，并且基于接收的时序信号，产生数据时序控制信号以控制数据驱动电路32的运行时序，并产生栅时序控制信号以控制栅驱动电路33的运行时序。栅时序控制信号包括栅起动脉冲GSP、栅移位时钟信号GSC、栅输出使能信号GOE等。栅起动脉冲GSP是指示将第一扫描脉冲提供给起动水平线的时序控制信号，从该水平线开始一个垂直周期的扫描操，用于显示一个帧。栅移位时钟信号GSC是时序控制信号，其被输入到栅驱动电路33中包括的移位寄存器，以顺序移位栅起动脉冲GSP。栅移位时钟信号GSC具有对应TFT的开(ON)周期的脉宽。栅输出使能信号GOE使能从栅驱动电路33的输出。数据时序控制信号包括源采样时钟SSC、源输出使能信号SOE等等。源采样时钟SSC基于上升或下降边缘使能数据驱动电路32的数据闭锁操作。源输出使能信号SOE等等使能来自数据驱动电路32的输出。时序控制器31还将数字视频数据分为奇数像素数据RGBodd和偶数像素数据RGBeven，并且将分离的数据提供给数据驱动电路32。为了减少数据转移路径中的电磁干扰(EMI)并且减小数据电压的摆动宽度，时序控制器按照迷你低压差分信号(LVDS)方案或小摆动差分信号(RSDS)方案调制数据RGBodd和RGBeven，并且将调制的数据提供给数据驱动电路32。
数据驱动电路32使用来自时序控制器31的栅起动脉冲GSP和源输出使能信号SOE产生极性控制信号POL。极性控制信号POL指示将数据电压的极性施加给液晶单元Clc。数据驱动电路32还在时序控制器31的控制之下闭锁数字视频数据RGBodd和RGBeven。数据驱动电路32还根据极性控制信号POL将闭锁的数字视频数据RGBodd和RGBeven转换为正/负模拟伽玛补偿电压，并且从而产生正/负模拟数据电压。来自数据驱动电路32的数据电压施加给数据线D1到Dm。
栅驱动电路33包括多个各自包括移位寄存器的栅集成电路(IC)、用于将移位寄存器的输出信号转换为具有适合于驱动相关液晶单元的TFT的摆动宽度的信号的水平移位器，以及连接在水平移位器和相关的栅线G1到Gn之一之间的输出缓冲器。栅驱动电路33顺序向栅线G1到Gn施加扫描脉冲。栅驱动电路33的每个栅IC安装在薄膜上芯片(COF)或载带封装(TCP)之上，并且连接到形成在LCD面板30的下玻璃基板上的栅焊盘。可选地，栅驱动电路33的每个栅IC可以按照玻上芯片工艺直接连接到LCD面板30的下玻璃基板。同时，栅驱动电路33可以使用面板内栅极(gate-in-panel)工艺与数据线D1到Dm、栅线G1到Gn、和TFT同时直接在LCD面板30的下玻璃基板上形成，这些构成像素阵列。栅驱动电路33排列在LCD面板30的相反的横向侧面，以符合LCD面板30的大尺寸趋势。按照该排列，可以防止在配置为通过长栅线提供扫描脉冲的大尺寸LCD面板中，扫描脉冲由于RC延迟而失真。
图4示出了图3所示的LCD面板30、数据驱动电路32、和时序控制器31的装配状态。图5示出了在LCD面板30的一个基板上形成的源COF和LOG配线上形成的虚拟配线。
参照图4和5，数据驱动电路32包括多个第一数据IC 32a和多个第二数据IC 32b。
数据IC 32a和32b分别安装在源COF 42上。每个源COF 42可以由TCP替代。源COF 42连接到源PCB，源PCB被分为两部分，即，第一源PCB 41A和第二源PCB 41B。也就是说，两组源COF 42分别连接到第一和第二源PCB41A和41B。每个源COF 42具有电连接到相关的第一或第二源PCB 41A或41B的输出端子之一。每个源COF 42还具有电连接到在LCD面板30的下玻璃基板上形成的数据焊盘之一的输出端子。如图5所示，虚拟配线51形成在每个源COF 42上，以转移时序控制信号和驱动电压。LOG配线45形成在连接到第一源PCB 41A的源COF 42之中相邻第二源PCB 41B的源COF 42和连接到第二源PCB 41B的源COF 42之中相邻第一源PCB 41A的源COF 42之间的LCD面板30的下玻璃基板上。LOG配线45分别起到转移数字视频数据RGBodd和RGBeven、转移包括进位信号的时序控制信号和转移驱动电压的作用。在根据本发明的LCD器件中，依照LOG配线45的使用取消一个柔性扁形电缆(FFC)43。因此，可以简化源PCB 41A和41B到控制PCB 40的连接结构，从而减少使用的元件的数目。同时，有必要将LOG配线45的数目减到最少，这是因为由于采用的工艺的特性，LOG配线45的形成区域是有限的。为此，在根据本发明的LCD器件中，取消了LOG配线45之中转移极性控制信号POL的LOG配线。适当的，每个数据IC 32a和32b使用栅起动脉冲GSP和源输出使能信号SOE产生极性控制信号POL。这将参照图11到14在后面详细描述。从其移除转移极性控制信号POL的LOG配线的区域可以用于转移驱动电压的LOG配线线宽的增加。依照转移驱动电压的LOG配线的增加的线宽，可以减少由LOG配线引起的压降，并且从而使第一和第二源PCB 41A和41B之间的伽玛补偿电压VGH和VGL的差减到最小。
转移数字视频数据RGBodd和RGBeven的总线配线、转移栅时序控制信号和数据时序控制信号的总线配线、和转移驱动电压的总线配线形成在第一和第二源PCB 41A和41B的每一个上。
第一源PCB 41A具有经由FFC 43电连接到形成在控制PCB 40上的连接配线44的输入端子。另一方面，第二源PCB 41B没有连接到控制PCB 40。源PCB 41A和41B经由LOG配线45和源COF 42互相电连接。因此，第一源PCB 41A经由形成在控制PCB 40上的连接配线44从控制PCB 40接收数字视频数据RGBodd和RGBeven、时序控制信号、和驱动电压。第二源PCB 41B经由LOG配线45和源COF 42从第一源PCB 41A接收数字视频数据RGBodd和RGBeven、时序控制信号、和驱动电压。提供给第一源PCB 41A的栅时序控制信号经由形成在第一源PCB 41A上的总线配线提供给设置在LCD面板30右侧的栅驱动电路。经由LOG配线45提供给第二源PCB 41B的栅时序控制信号经由在形成第二源PCB 41B上的总线配线提供给设置在LCD面板30左侧的栅驱动电路。
连接配线44与时序控制器31、EEPROM 31a、和起到为LCD显示面板30产生驱动电压作用的比如DC-DC转换器的电路一起形成在控制PCB 40上。从DC-DC转换器产生的驱动电压包括栅高电压Vgh、栅低电压Vgl、公共电压Vcom、高电平电源电压Vdd、低电平电源电压Vss、和在高电平电源电压Vdd和低电平电源电压Vss之间分配的多个伽玛基准电压。伽玛基准电压被再分配为模拟伽玛补偿电压，从而模拟伽玛补偿电压的数目对应于由数据IC 32a和32b中的数字视频数据RGBodd和RGBeven的比特表示的灰度值的数目。栅高电压Vgh和栅低电压Vgl分别是扫描脉冲的高和低摆动电压。EEPROM 31a存储有关于从时序控制器31产生的时序控制信号对于不同模式的波形选项信息。这样，EEPROM 31a根据来自用户的命令，向时序控制器31提供所选模式的波形信息。时序控制器31基于来自EEPROM 31a的波形选项信息，产生对应所选模式的时序控制信号。这样，根据不同的模式，分别从时序控制器31产生不同的时序控制信号。
在控制PCB 40上形成的连接配线44将时序控制器31的单输出端口63连接到FFC 43。图6示出了时序控制器31的单输出端口63。经由连接配线44将从DC-DC转换器产生的数字视频数据RGBodd和RGBeven和时序控制信号、以及驱动电压发送到FFC 43。
图6是表示时序控制器31的数据处理部分的示图。
参照图6，时序控制器31包括2-端口扩展器61和数据调制器62。
2-端口扩展器61在某一输入频率f将来自系统主板的数字视频数据RGB分为奇数像素数据RGBodd和偶数像素数据RGBeven，并且将分离的数据RGBodd和RGBeven以1/2频率f/2提供给数据调制器62。转移频率减小到1/2的原因在于在1/2频率可以减小电磁干扰(EMI)。从2一端口扩展器61输出的数据RGBodd和RGBeven的摆动宽度相对较宽，例如，大约对应晶体管到晶体管(TTL)电平的3.3V。
数据调制器62调制从2一端口扩展器61发送的数据RGBodd和RGBeven，以将数据RGBodd和RGBeven的摆动宽度减小到大约300到600mV。数据调制器62还按照4倍加速的迷你LVDS时钟，将数据RGBodd和RGBeven的频率增加到2倍输入频率f，即，到频率2f。虽然从数据调制器62输出的数据RGBodd和RGBeven的频率增加到2倍输入频率f，即，到频率2f，但是由于数据RGBodd和RGBeven的摆动宽度具有大约300到600mV的相当小的值，EMI没有或很少的增加。数据调制器62输出包括3对奇数像素数据RGBodd、3对偶数像素数据RGBeven、和1对迷你时钟迷你CLK的信号。每个信号对包括正信号和负信号。同时，数据调制器62可以按照RSDS方案执行数据调制。
图7和8示出了从数据调制器62输出的数据的示例。示出的示例对应以迷你LVDS方案调制的数据的示例。
在图7中，“数据CLK”表示从系统的主板产生的数据时钟，而“迷你LVDSCLK”表示从数据调制器62产生的时钟，然后和数据一起转移。同样，“迷你LVDS RGB”表示由数据调制器62调制的正数据波形，从而正数据波形包括复位波形。数据调制器62还产生具有与正数据波形相反的相位的负数据波形。这样，数据调制器62转移6个每个包括正数据波形P和负数据波形N的数据对，以及一个迷你LVDS时钟对到数据IC 32a和32b。采样第一数据的数据IC将在复位波形复位之后，识别起动脉冲开始，作为数据采样起始点，并且在起始脉冲开始之后开始采样数据。因此，对于时序控制器31不需要通过单独的配线提供源起始脉冲SSP。
图9示出了时序控制器31和各自的数据IC 32a和32b之间建立的信号转移路径。
参照图9，来自由时序控制器31以迷你LVDS或RSDS方案调制的数字视频数据之中的右数据RGBodd和RGBeven经由时序控制器31的单输出端口63、连接配线44、和FFC 43被转移到连接第一源PCB 41A的第一数据IC 32a。右数据RGBodd和RGBeven将在LCD面板30的屏幕的右半部分上显示。另一方面，由时序控制器31以迷你LVDS或RSDS方案调制的左数据RGBodd和RGBeven经由时序控制器31的单输出端口63、连接配线44、第一源PCB41A、源COF 42的虚拟配线51、LCD面板30的LOG配线45被转移到连接第二源PCB 41B的第二数据IC 32b。左数据RGBodd和RGBeven将在LCD面板30的屏幕的左半部分上显示。
从时序控制器31产生的数据时序控制信号经由时序控制器31的单输出端口63、连接配线44、和FFC 43被转移到连接第一源PCB 41A的第一数据IC32a。数据时序控制信号还经由时序控制器31的单输出端口63、连接配线44、第一源PCB 41A、源COF 42的虚拟配线51、LCD面板30的LOG配线45被转移到连接第二源PCB 41B的第二数据IC 32b。
如图7和8所示，采样起动脉冲之后的第一数据的最左边的数据IC 32b，在采样对应最左边的数据IC 32b的输出通道的数目的数量的第一数据之后，产生表示第一数据之后的数据采样时序的进位信号进位。然后最左边的数据IC 32b将进位信号进位提供给在右边方向相邻最左边的数据IC 32b的数据IC32b。这样，进位信号进位被顺序转移到相邻的数据IC 32b。通过在LCD面板30上形成的LOG配线45获得第一和第二源PCB 41A和41B之间的进位信号进位的转移。同时，数据IC 32a和32b的数据采样方向可以改变为相反的方向。在这种情况下，在相反的方向执行第一和第二源PCB 41A和41B之间的进位信号进位的转移。
从安装在控制PCB 40上的DC-DC转换器产生的驱动电压经由DC-DC转换器各自的输出端子、连接配线44、和FFC 43被转移到连接第一源PCB 41A的第一数据IC 32a。驱动电压还经由DC-DC转换器各自的输出端子、连接配线44、第一源PCB 41A、源COF 42的虚拟配线51、LCD面板30的LOG配线45被转移到连接第二源PCB 41B的第二数据IC 32b。
图10到12是表示一个第一数据IC 32a的详细配置的电路图。
参照图10到12，每个第一数据IC 32a包括移位寄存器91、数据恢复器92、第一闭锁阵列93、第二闭锁阵列94、POL产生器95、伽玛补偿电压产生器96、数字/模拟转换器(DAC)97、电荷共享电路98、输出电路99。
数据恢复器92临时存储由时序控制器31分离的奇数像素数据RGBodd和偶数像素数据RGBeven，并且按照对应由时序控制器31施加给数据的调制方案的解调方案恢复调制数据。例如，如图8所示，数据恢复器92以为具有高逻辑值的正数据产生“1”，并为具有低逻辑值的正数据产生“0”的方式恢复数据。数据恢复器92向第一闭锁阵列93提供恢复的数据RGBodd和RGBeven。
移位寄存器91按照源采样时钟SSC移位采样信号。移位寄存器91还在施加给移位寄存器91的数据的数量超过第一闭锁阵列93中的闭锁的数目时，产生进位信号进位。采样第一数据的第一数据IC 32a的移位寄存器91确定在提供数据前经由数据总线提供的复位信号，和起动脉冲之后提供的数据，作为首先采样的数据。
第一闭锁阵列93响应从移位寄存器91顺序输入的采样信号，采样数字视频数据RGBodd和RGBeven，并且对于每个水平线闭锁采样的数字视频数据RGBodd和RGBeven，并且同时输出闭锁的一个水平线数据。
第二闭锁阵列94闭锁从第一闭锁阵列93输入的一个水平线的数据RGBodd和RGBeven，并且与其余的数据IC的第二闭锁阵列94同时，在源输出使能信号SOE的低逻辑周期中输出闭锁的数字视频数据RGBodd和RGBeven。
如图11和12所示，POL产生器95包括第一D触发器951、第二D触发器952、反相器953、和乘法器954。
第一D触发器951使用源输出使能信号SOE作为输入时钟C1，该源输出使能信号SOE以一个水平周期1H的间隔产生。第一D触发器951具有经由反相器953连接到第一D触发器951的输入端子D1的非反相输出端子Q1。栅起动脉冲GSP施加给第一D触发器951的一组端子S。第一D触发器951响应栅起动脉冲GSP，将从非反相输出端子Q1输出的第一极性控制信号POL1的极性初始化为“+”。反相器953反相从第一D触发器951的非反相输出端子Q1反馈的第一极性控制信号POL1，并且将反向的信号输入到第一D触发器951的输入端子D。第一D触发器951闭锁来自第一极性控制信号POL1的反相输入，并且输出与源输出使能信号SOE的上升边缘同步的闭锁信号。这样，第一D触发器951起到延迟来自第一极性控制信号POL1的反相信号一个水平周期的作用。因此，第一极性控制信号POL1的逻辑值以一个水平周期的间隔反相。相反的，第二极性控制信号2具有与第一极性控制信号POL1相反的相位，这是因为其没有由第一D触发器951延迟。
第二D触发器952使用栅起动脉冲GSP作为输入时钟C2，该栅起动脉冲GSP以一个水平周期1V的间隔产生。第二D触发器952具有连接到第二D触发器952的复位端子R和乘法器954的控制端子的非反相输出端子Q2。第二D触发器952还具有连接到D触发器的输入端子D2。按照这种结构，第二D触发器952以当在栅起动脉冲GSP的上升边缘之前产生的输出是“1”时输出复位信号，并且当在栅起动脉冲GSP的上升边缘之后产生的输出是“0”时输出来自高电平电压源VCC的电压的方式，参照栅起动脉冲GSP的上升边缘输出选择信号SEL。这样，第二D触发器952以一个垂直周期的间隔，反相从非反相输出端子Q2输出的选择信号SEL的逻辑值。
乘法器954响应来自第二D触发器952的选择信号SEL，以一个垂直周期的间隔交替地选择第一和第二极性控制信号POL1和POL2，并且输出选择的信号作为最终极性控制信号POL。这样，如图12所示，最终极性控制信号POL不仅以一个水平周期的间隔，而且以一个垂直周期的间隔，逻辑值被反相。
同时，可以如图13所示实现POL产生器95。在图13的情况下，第一D触发器951响应栅起动脉冲GSP，将从非反相输出端子Q1输出的第一极性控制信号POL1的极性初始化为“-”，以产生如图14所示的最终极性控制信号POL。
如图15所示，伽玛补偿电压产生器96再分配多个伽玛基准电压，该伽玛基准电压在高电平电源电压Vdd和低电平电源电压Vss之间分配，从而再分配的伽玛基准电压的数目对应由数字视频数据RGBodd和RGBeven的比特表示的灰度值“i”的数目。伽玛补偿值产生器96产生对应各自的灰度值的正伽玛补偿电压VGH0到VGH(i-1)，和对应各自的灰度值的负伽玛补偿电压VGL0到VGL(i-1)。为此，伽玛补偿电压产生器96包括包含有串联在高电平电压Vdd和低电平电源电压Vss之间的多个电压分配寄存器R01到Ri1和多个电压分配寄存器R02到Ri2的寄存器串。
如图16所示，DAC 97包括向其施加正伽玛补偿电压VGH的P-解码器(PDEC)101、向其施加负伽玛补偿电压VGL的N-解码器(NDEC)102、和每一个连接到相关的PDEC 101之一和相关的NDEC 102之一的乘法器103，以响应极性控制信号POL，选择来自相关的PDEC 101的输出或来自相关的NDEC 102的输出。每个PDEC 101解码从相关的第二闭锁阵列94输入的数字视频数据RGBodd和RGBeven，并且对应解码的数字视频数据的灰度值，输出正伽玛补偿电压VGH。每个NDEC 102解码从相关的第二闭锁阵列94输入的数字视频数据RGBodd和RGBeven，并且对应解码的数字视频数据的灰度值，输出负伽玛补偿电压VGL。每个乘法器103响应极性控制信号POL选择正伽玛补偿电压VGH或负伽玛补偿电压VGL。
电荷共享电路98在源输出使能信号SOE的高逻辑周期中短路相邻的数据输出通道，从而输出相邻数据电压的平均电压作为电荷共享电压。电荷共享电路98还向源输出使能信号SOE的高逻辑周期中的数据输出通道提供公共电压Vcom，以减小正负数据电压之间的数据电压摆动宽度。
输出电路99包括用于最小化提供给数据线D1到Dk的模拟数据电压的信号衰减的缓冲器。
每个第二数据IC 32b与每个第一数据IC 32a依次具有相同的结构。
从以上说明中显而易见，根据本发明的LCD器件包括分配的源PCB结构、和用于其时序控制器的输出部分的单输出端口，从而获得其控制PCB的尺寸的减小和输出管脚的数目的减少。
在根据本发明的LCD器件中，还可以使用在LCD面板上形成的LOG配线取消一个FFC，从而简化源PCB和控制PCB之间的连接结构并且减少使用的元件的数目。
此外，使用一部分时序控制信号，通过产生数据IC中的极性控制信号，可以取消用于转移极性控制信号的LOG配线。这样，在根据本发明的LCD器件中，可以减少时序控制器的负载。同样，从其移除LOG配线的区域，可以用于用来转移驱动电压的LOG配线的线宽的增加。
显然，对于熟悉本领域的技术人员来说在不脱离本发明精神或范围的情况下，对本发明可以进行各种修改和变形。从而，本发明意在覆盖落入所附权利要求书及其等同物范围内的本发明的修改和变形。

Claims (9)

1、一种液晶显示器件，包括：
液晶显示面板，包括第一数据线组、第二数据线组、和从所述第一和第二数据线组分离的玻上线配线；
第一集成电路组，根据时序控制信号运行，以将数字视频数据转换为数据电压，并且将所述数据电压施加给所述第一数据线组；
第一源印刷电路板，包括在所述第一集成电路组中的集成电路与其连接；
第二集成电路组，用于经由所述第一源印刷电路板和所述玻上线配线接收所述时序控制信号和所述数字视频数据，并且根据所述时序控制信号运行，以将数字视频数据转换为数据电压，并且将所述数据电压施加给所述第二数据线组；
第二印刷电路板，包括在所述第二集成电路组中的集成电路与其连接；
时序控制器，包括单输出端口以输出所述时序控制信号和所述数字视频数据；
控制印刷电路板，所述时序控制器安装在其上；以及
连接器，连接到所述控制印刷电路板和所述第一源印刷电路板，以将通过所述时序控制器的单输出端口输出的所述时序控制信号和所述数字视频数据转移到所述第一源印刷电路板，
其中所述第一和第二集成电路组的每个集成电路包括一极性控制信号产生器，用于使用一部分所述时序控制信号，产生极性控制信号以控制所述数据电压的极性。
2、根据权利要求1所述的液晶显示器件，其特征在于，所述极性控制信号产生器使用栅起动脉冲和源输出使能信号来产生所述极性控制信号，其中所述栅起动脉冲指示起动水平线，从所述起动水平线开始一个垂直周期的扫描操作，用于显示一个帧，并且所述源输出使能信号使能所述数字视频数据被输出。
3、根据权利要求2所述的液晶显示器件，其特征在于，所述极性控制信号产生器包括：
第一D触发器，使用所述源输出使能信号作为输入时钟，所述第一D触发器产生在参照每个垂直周期产生的所述源输出使能信号的上升边缘的逻辑状态中反相的第一极性控制信号；
第二D触发器，使用所述栅起动脉冲作为输入时钟，所述第二D触发器产生在参照每个垂直周期产生的所述栅起动脉冲的上升边缘的逻辑状态中反相的选择信号；
乘法器，用于接收所述第一极性控制信号和第二极性控制信号，该第二极性控制信号具有与所述第一极性控制信号相反的逻辑值，并且响应所述选择信号，以一个垂直周期的间隔交替地输出所述第一和第二极性控制信号。
4、根据权利要求3所述的液晶显示器件，其特征在于，
所述第一D触发器包括经由反相器互相电连接的非反相输出端子和输入端子；以及
所述反相器接收从所述第一D触发器的非反相输出端子反馈的所述第一极性控制信号，并且输出反馈信号作为所述第二极性控制信号。
5、根据权利要求1所述的液晶显示器件，其特征在于，所述控制印刷电路板包括用于产生驱动所述液晶显示面板需要的驱动电压的电压产生器。
6、根据权利要求5所述的液晶显示器件，其特征在于，所述第一和第二集成电路组的每个集成电路安装在薄膜上芯片和载带封装之一上，在其上形成用于转移所述时序控制信号、所述数字视频数据和所述驱动电压的虚拟配线。
7、根据权利要求1所述的液晶显示器件，其特征在于，所述时序控制器包括：
2-端口扩展器，用于将以输入频率输入的数字视频数据RGB分为奇数像素数据和偶数像素数据，并且以对应输入频率的1/2的频率提供分离的奇数和偶数像素数据；以及
数据调制器，用于调制来自所述2-端口扩展器的奇数和偶数像素数据，以减少从所述单输出端口输出的数字视频数据的摆动宽度，所述数据调制器以对应2倍输入频率的频率输出所述数字视频数据。
8、根据权利要求7所述的液晶显示器件，其特征在于，所述数据调制器根据迷你低压差分信号方案和小摆动差分信号方案之一调试所述数字视频数据。
9、根据权利要求8所述的液晶显示器件，其特征在于，所述第一和第二集成电路组的每一个还包括用于恢复调制的数字视频数据的数据恢复器。
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