KR101773194B1 - 표시장치 - Google Patents

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Abstract

본 발명의 실시예는, 게이트신호를 공급하는 게이트구동부가 내재된 패널; 데이터신호와 제어신호를 공급하는 영상처리부가 실장된 메인보드; 및 연성회로보드로 형성되어 상기 패널과 상기 메인보드를 상호 연결하고, 상기 연성회로보드에는 상기 패널에 데이터신호를 공급하는 데이터구동부와, 상기 메인보드로부터 상기 데이터신호와 상기 제어신호를 전달받아 상기 데이터구동부 및 상기 패널의 게이트 구동부를 제어하는 타이밍제어부가 함께 실장 되어 상기 타이밍제어부와 상기 데이터구동부 간의 임피던스 매칭이 생략된 구조를 갖는 컨트롤보드;를 포함하는 표시장치를 제공한다.

Description

표시장치{Display Device}
본 발명의 실시예는 표시장치에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결 매체인 표시장치의 시장이 커지고 있다. 이에 따라, 유기전계발광표시장치(Organic Light Emitting Display: OLED), 액정표시장치(Liquid Crystal Display: LCD) 및 플라즈마표시장치(Plasma Display Panel: PDP) 등과 같은 표시장치의 사용이 증가하고 있다.
앞서 설명한 표시장치 중 일부 예컨대, 액정표시장치나 유기전계발광표시장치로 제작된 표시장치는 패널에 포함된 서브 픽셀들이 타이밍제어부, 데이터구동부 및 스캔구동부 등에 의해 구동된다.
액정표시패널이나 유기전계발광표시패널로 제작된 대형 텔레비전이나 모니터 등의 종래 표시장치는 메인보드, 컨트롤보드 및 구동보드로 구성되어 있고, 각 보드들은 적어도 2개의 연성케이블(Flexible Flat Cable; FFC)에 의해 연결된다.
각 보드들은 인쇄회로보드(Printed Circuit Board; PCB)로 형성되며, 각 보드들 중 메인보드에는 영상처리를 수행하는 영상처리부 등이 실장되고 컨트롤보드에는 타이밍제어부 등이 실장되며 구동보드에는 데이터구동부 및 스캔구동부 등이 실장되는 것이 일반적이다.
한편, 종래에는 대형 표시장치를 제작할 때, 패널을 구동하기 위한 장치가 적어도 3개의 보드로 구분되어 형성되어 있어 적어도 2개의 연성케이블이 요구된다. 이로 인하여, 각종 신호들은 각 보드들과 연성케이블들을 거치면서 임피던스 미스 매칭에 의한 신호의 왜곡현상을 유발하게 된다. 따라서, 종래에는 입출력 각각의 임피던스를 매칭시키기 위해 시뮬레이션을 통한 수많은 수정 작업을 수행하고 있으며 이에 따른 업무손실과 제작비용을 가중시키고 있다. 또한, 종래 대형 표시장치는 적어도 3개의 보드를 구성해야 함으로써 공간적인 제약과 제품의 비용 상승을 초래하고 있어 이의 개선이 요구된다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명의 실시예는, 타이밍제어부와 데이터구동부 간의 임피던스 정합 공정을 생략함과 더불어 공정의 단순화와 보드의 크기를 줄여 회로의 성능 향상을 기대할 수 있는 표시장치를 제공하는 것이다.
상술한 과제 해결 수단으로 본 발명의 실시예는, 게이트신호를 공급하는 게이트구동부가 내재된 패널; 데이터신호와 제어신호를 공급하는 영상처리부가 실장된 메인보드; 및 연성회로보드로 형성되어 상기 패널과 상기 메인보드를 상호 연결하고, 상기 연성회로보드에는 상기 패널에 데이터신호를 공급하는 데이터구동부와, 상기 메인보드로부터 상기 데이터신호와 상기 제어신호를 전달받아 상기 데이터구동부 및 상기 패널의 게이트 구동부를 제어하는 타이밍제어부가 함께 실장 되어 상기 타이밍제어부와 상기 데이터구동부 간의 임피던스 매칭이 생략된 구조를 갖는 컨트롤보드;를 포함하는 표시장치를 제공한다.
컨트롤보드는, 패널과 연결되는 일측 연결부가 N개(N은 2 이상 정수)로 분할될 수 있다.
컨트롤보드는, M개(M은 2 이상 정수)의 연성케이블들에 의해 패널과 연결될 수 있다.
M개의 연성케이블들은, 컨트롤보드와 패널 각각에 본딩 방식으로 부착될 수 있다.
컨트롤보드는, 메인보드와 연결되는 타측 연결부가 L개(L은 2 이상 정수)로 분할될 수 있다.
컨트롤보드는, J개(J는 2 이상 정수)의 연성케이블들에 의해 메인보드와 연결될 수 있다.
J개의 연성케이블들은, 컨트롤보드와 메인보드 각각에 커넥터 방식으로 부착될 수 있다.
패널은, 액정패널 또는 유기전계발광표시패널일 수 있다.
본 발명의 실시예는, 타이밍제어부와 데이터구동부를 하나의 보드에 실장하여 이들 간의 임피던스 정합 공정을 생략함과 더불어 공정의 단순화와 보드의 크기를 줄여 회로의 성능 향상을 기대할 수 있는 표시장치를 제공하는 효과가 있다.
도 1은 표시장치의 개략적인 블록도.
도 2는 유기전계발광표시패널의 서브 픽셀 회로 구성 예시도.
도 3은 액정표시패널의 서브 픽셀 회로 구성 예시도.
도 4는 본 발명의 제1실시예에 따른 표시장치의 구성 예시도.
도 5는 본 발명의 제2실시예에 따른 표시장치의 구성 예시도.
도 6은 종래 표시장치와 실시예의 표시장치에 포함된 보드들을 비교 설명하기 위한 도면.
도 7은 도 6에서의 임피던스 정합에 따른 미스매칭과 매칭을 나타낸 도면.
도 8은 종래 표시장치와 실시예의 표시장치에 포함된 컨트롤보드를 비교 설명하기 위한 도면.
이하, 본 발명의 실시를 위한 구체적인 내용을 첨부된 도면을 참조하여 설명한다.
도 1은 표시장치의 개략적인 블록도 이고, 도 2는 유기전계발광표시패널의 서브 픽셀 회로 구성 예시도 이며, 도 3은 액정표시패널의 서브 픽셀 회로 구성 예시도 이다.
도 1에 도시된 바와 같이, 표시장치에는 영상처리부(MCU), 타이밍제어부(TCN), 게이트구동부(SDRV), 데이터구동부(DDRV) 및 패널(PNL)이 포함된다.
영상처리부(MCU)는 외부로부터 공급된 영상신호를 신호처리하여 데이터신호(DATA)를 생성함과 더불어 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK)와 같은 각종 제어신호를 생성하여 타이밍제어부(TCN)에 공급한다.
타이밍제어부(TCN)는 영상처리부(MCU)로부터 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK), 데이터신호(DDATA)를 공급받는다. 타이밍제어부(TCN)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK) 등의 타이밍신호를 이용하여 데이터구동부(DDRV)와 게이트구동부(SDRV)의 동작 타이밍을 제어한다. 타이밍제어부(TCN)는 1 수평기간의 데이터 인에이블 신호(DE)를 카운트하여 프레임기간을 판단할 수 있으므로 외부로부터 공급되는 수직 동기신호(Vsync)와 수평 동기신호(Hsync)는 생략될 수 있다. 타이밍제어부(TCN)에서 생성되는 제어신호들에는 게이트구동부(SDRV)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)와 데이터구동부(DDRV)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)가 포함될 수 있다. 게이트 타이밍 제어신호(GDC)에는 게이트 스타트 펄스(Gate Start Pulse, GSP), 게이트 시프트 클럭(Gate Shift Clock, GSC), 게이트 출력 인에이블신호(Gate Output Enable, GOE) 등이 포함된다. 게이트 스타트 펄스(GSP)는 첫 번째 게이트신호가 발생하는 게이트 드라이브 IC(Integrated Circuit)에 공급된다. 게이트 시프트 클럭(GSC)은 게이트 드라이브 IC들에 공통으로 입력되는 클럭신호로써 게이트 스타트 펄스(GSP)를 시프트시키기 위한 클럭신호이다. 게이트 출력 인에이블신호(GOE)는 게이트 드라이브 IC들의 출력을 제어한다. 데이터 타이밍 제어신호(DDC)에는 소스 스타트 펄스(Source, Start Pulse, SSP), 소스 샘플링 클럭(Source Sampling Clock, SSC), 소스 출력 인에이블신호(Source Output Enable, SOE) 등이 포함된다. 소스 스타트 펄스(SSP)는 데이터구동부(DDRV)의 데이터 샘플링 시작 시점을 제어한다. 소스 샘플링 클럭(SSC)은 라이징 또는 폴링 에지에 기준하여 데이터구동부(DDRV) 내에서 데이터의 샘플링 동작을 제어하는 클럭신호이다. 소스 출력 인에이블신호(SOE)는 데이터구동부(DDRV)의 출력을 제어한다. 한편, 데이터구동부(DDRV)에 공급되는 소스 스타트 펄스(SSP)는 데이터전송 방식에 따라 생략될 수도 있다.
게이트구동부(SDRV)는 타이밍제어부(TCN)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 패널(PNL)에 포함된 서브 픽셀들(SP)의 트랜지스터들이 동작 가능한 게이트 구동전압의 스윙폭으로 신호의 레벨을 시프트시키면서 게이트신호를 순차적으로 생성한다. 게이트구동부(SDRV)에는 게이트라인들(SL1~SLm)을 통해 생성된 게이트신호를 패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다. 게이트구동부(SDRV)는 게이트인패널(Gate In Panel; GIP) 방식으로 패널(PNL)에 직접 형성되거나 패널(PNL)의 외부에 형성된다.
데이터구동부(DDRV)는 타이밍제어부(TCN)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍제어부(TCN)로부터 공급되는 디지털 형태의 데이터신호(DDATA)를 샘플링하고 래치하여 병렬 데이터 체계의 데이터로 변환한다. 데이터구동부(DDRV)는 병렬 데이터 체계의 데이터로 변환할 때, 디지털 형태의 데이터신호(DDATA)를 감마 기준전압으로 변환하여 아날로그 형태의 데이터신호(ADATA)로 변환한다. 데이터구동부(DDRV)는 데이터라인들(DL1~DLn)을 통해 변환된 데이터신호(ADATA)를 패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다.
패널(PNL)은 매트릭스형태로 배치된 적색, 녹색 및 청색(이하 RGB로 약기함)의 서브 픽셀(SP)을 포함한다. 패널(PNL)은 유기전계발광표시패널 또는 액정표시패널로 구성될 수 있다. 패널(PNL)이 유기전계발광표시패널로 구성된 경우 서브 픽셀은 다음의 도 2와 같은 회로 구성을 가질 수 있다. 스위칭 트랜지스터(T1)는 게이트신호가 공급되는 게이트라인(SL1)에 게이트가 연결되고 데이터신호가 공급되는 데이터라인(DL1)에 일단이 연결되며 제1노드(n1)에 타단이 연결된다. 구동 트랜지스터(T2)는 제1노드(n1)에 게이트가 연결되고 고 전위의 구동 전원(Vdd)이 공급되는 제1전원 배선(VDD)에 연결된 제2노드(n2)에 일단이 연결되며 제3노드(n3)에 타단이 연결된다. 스토리지커패시터(Cst)는 제1노드(n1)에 일단이 연결되고 제2노드(n2)에 타단이 연결된다. 유기 발광다이오드(D)는 구동 트랜지스터(T2)의 타단에 연결된 제3노드(n3)에 애노드가 연결되고 저 전위의 구동 전원(Vss)이 공급되는 제2전원 배선(VSS)에 캐소드가 연결된다. 이와 같은 서브 픽셀(SP) 구조를 갖는 유기전계발광표시패널은 게이트라인(SL1)을 통해 공급되는 게이트신호와, 데이터라인(DL1)을 통해 공급되는 데이터신호에 따라 각 서브 픽셀에 포함된 발광층이 발광을 함으로써 화상을 표시할 수 있다.
이와 달리, 패널(PNL)이 액정표시패널로 구성된 경우 서브 픽셀(SP)은 다음의 도 3과 같은 회로 구성을 가질 수 있다. 스위칭 트랜지스터(TFT)는 게이트신호가 공급되는 게이트라인(SL1)에 게이트가 연결되고 데이터신호가 공급되는 데이터라인(DL1)에 일단이 연결되며 제1노드(n1)에 타단이 연결된다. 액정셀(Clc)의 일측에 위치하는 화소전극(1)은 스위칭 트랜지스터(TFT)의 타단에 연결된 제1노드(n1)에 일단이 연결되며 액정셀(Clc)의 타측에 위치하는 공통전극(2)은 공통전압배선(Vcom)에 연결된다. 스토리지커패시터(Cst)는 제1노드(n1)에 일단이 연결되며 공통전압배선(Vcom)에 타단이 연결된다. 이와 같은 서브 픽셀(SP) 구조를 갖는 액정표시패널은 게이트라인(SL1)을 통해 공급되는 게이트신호와 데이터라인(DL1)을 통해 공급되는 데이터신호에 따라 각 서브 픽셀에 포함된 액정층의 변화에 따른 광의 투과로 화상을 표시할 수 있다.
위의 설명에서, 도 2 및 도 3은 서브 픽셀에 대한 이해를 돕기 위해 통상의 회로 구성을 도시 및 설명한 것일 뿐 실시예는 이에 한정되지 않는다.
이하, 본 발명의 실시예에 따른 표시장치에 대해 더욱 자세히 설명한다.
도 4는 본 발명의 제1실시예에 따른 표시장치의 구성 예시도이고, 도 5는 본 발명의 제2실시예에 따른 표시장치의 구성 예시도이다.
도 4 및 도 5에 도시된 바와 같이, 표시장치에는 패널(PNL), 컨트롤보드(CBD) 및 메인보드(MBD)가 포함된다.
패널(PNL)에는 도 2 및 도 3에서 설명된 바와 같은 서브 픽셀들(SP)이 형성됨과 아울러 게이트신호를 공급하는 게이트구동부(SDRV)가 내재된다. 게이트구동부(SDRV)는 게이트인패널(Gate In Panel) 방식으로 서브 픽셀들(SP)에 포함된 박막 트랜지스터 공정시 패널(PNL)의 외곽에 형성된다.
컨트롤보드(CBD)에는 패널(PNL)에 데이터신호를 공급하는 데이터구동부(DDRV)와 더불어 게이트구동부(SDRV) 및 데이터구동부(DDRV)를 제어하는 타이밍제어부(TCN)가 함께 실장된다. 컨트롤보드(CBD)는 연성회로보드(Flexible Printed Circuit; FPC)로 형성된다.
컨트롤보드(CBD)는 메인보드(MBD)와 연결되는 타측 연결부(CN2)가 L개(L은 2 이상 정수)로 분할된다. 컨트롤보드(CBD)의 타측 연결부(CN2)는 J개(J는 2 이상 정수)의 연성케이블들(FFC2)에 의해 메인보드(MBD)와 연결된다. 이때, J개의 연성케이블들(FFC2)은 컨트롤보드(CBD)와 메인보드(MBD)에 각각 형성된 커넥터들(CON)에 의해 커넥터 방식으로 부착된다.
메인보드(MBD)에는 타이밍제어부(TCN)에 데이터신호와 제어신호를 공급하는 영상처리부(MCU)가 실장된다. 메인보드(MBD)는 인쇄회로보드(Printed Circuit Board)로 형성되며 이는 컨트롤보드(CBD)에 연결된다.
한편, 실시예에 따른 컨트롤보드(CBD)는 타이밍제어부(TCN)와 데이터구동부(DDRV) 간의 임피던스 매칭이 생략된 구조를 갖도록 하나의 보드 상에 데이터구동부(DDRV)와 타이밍제어부(TCN)가 실장되어 패널(PNL)에 연결된다. 즉, 타이밍제어부(TCN)와 데이터구동부(DDRV)가 컨트롤보드(CBD)에 함께 실장되어 있어 이들 간의 신호 전송 왜곡을 방지할 수 있으므로 임피던스 정합이 불요하다.
위와 같이 패널(PNL), 컨트롤보드(CBD) 및 메인보드(MBD)로 구성된 표시장치는 임피던스 정합의 간소화 및 신호의 왜곡을 줄이기 위해 타이밍제어부(TCN)와 데이터구동부(DDRV)를 컨트롤보드(CBD)에 함께 실장함과 더불어 공정의 단순화에 따른 편의성을 제공하기 위해 다음과 같이 연결된다.
도 4의 제1실시예와 같이, 컨트롤보드(CBD)는 패널(PNL)과 연결되는 일측 연결부(CN1)가 N개(N은 2 이상 정수)로 분할된 구조를 갖는다. 제1실시예는 컨트롤보드(CBD)로부터 연장된 일측 연결부(CN1)에 형성된 배선을 그대로 패널(PNL)에 연결하여 사용하므로 임피던스 정합시 공정 상의 이점을 줄 수 있게 된다. 이와 더불어, 제1실시예는 컨트롤보드(CBD)로부터 분할되어 연장된 일측 연결부(CN1)가 케이블 역할을 하므로 별도의 케이블 미사용에 따른 공정의 단순화를 꽤 할 수 있다.
도 5의 제2실시예와 같이, 컨트롤보드(CBD)는 패널(PNL)과 연결되는 일측 연결부(CN1)에 부착된 M개(M은 2 이상 정수)의 연성케이블들(FFC1)에 의해 패널(PNL)과 연결된다. 이때, M개의 연성케이블들(FFC1)은 컨트롤보드(CBD)와 패널(PNL) 각각에 본딩 방식으로 부착된다. 제2실시예는 본딩 방식으로 부착된 M개의 연성케이블들(FFC1)을 이용하여 컨트롤보드(CBD)와 패널(PNL)을 연결하므로 임피던스 정합시 공정 상의 이점을 줄 수 있게 된다. 이와 더불어, 제2실시예는 컨트롤보드(CBD)의 일측 연결부(CN1)에 본딩 방식으로 부착된 M개의 연성케이블들(FFC1)을 이용하므로 별도의 커넥터 미사용에 따른 공정의 단순화를 꽤 할 수 있다.
앞서 설명한 바와 같이, 제1 및 제2실시예는 타이밍제어부(TCN)와 데이터구동부(DDRV) 간의 임피던스 매칭이 생략된 구조로 형성됨과 더불어 공정의 단순화를 꽤 할 수 있도록 제작된다.
제1 및 제2실시예와 같이 표시장치에 포함된 보드들을 2개로 구성하게 되면 종래 구조 대비 임피던스 정합의 간소화 및 공정의 단순화를 꽤 할 수 있는데 이의 설명은 이하에서 더욱 자세히 설명한다.
도 6은 종래 표시장치와 실시예의 표시장치에 포함된 보드들을 비교 설명하기 위한 도면이고, 도 7은 도 6에서의 임피던스 정합에 따른 미스매칭과 매칭을 나타낸 도면이다.
도 6의 종래 표시장치는 패널(PNL), 구동보드(DBD), 컨트롤보드(CBD) 및 메인보드(MBD)로 구성된다. 패널(PNL)에는 서브 픽셀들(SP)이 형성됨과 더불어 게이트구동부(SDRV)가 내재된다.
구동보드(DBD)에는 데이터구동부(DDRV)가 실장되고 컨트롤보드(CBD)에는 타이밍제어부(TCN)가 실장되며 메인보드(MBD)에는 영상처리부(MCU)가 실장된다. 구동보드(DBD), 컨트롤보드(CBD) 및 메인보드(MBD)는 모두 인쇄회로보드(PCB)로 형성된다.
구동보드(DBD)와 패널(PNL)은 구동보드(DBD)에 형성된 제1커넥터들(CON1)에 결합된 제1연성케이블들(FFC1)에 의해 연결된다. 그리고 컨트롤보드(CBD)와 구동보드(DBD)는 보드들에 각각 형성된 제2커넥터들(CON2)에 결합된 제2연성케이블들(FFC2)에 의해 연결된다. 그리고 메인보드(MBD)와 컨트롤보드(CBD)는 보드들에 각각 형성된 제3커넥터들(CON3)에 결합된 제3연성케이블들(FFC3)에 의해 연결된다.
위와 같이, 종래 표시장치는 패널(PNL), 구동보드(DBD), 컨트롤보드(CBD) 및 메인보드(MBD)로 구성되어 있어 제1영역(P1)과 제2영역(P2)에서 상호 구분된 보드들로부터 출력되는 신호의 왜곡을 방지하기 위해 임피던스 정합을 수행해야 한다. 또한, 보드들이 3개로 구분되어 있고 이들을 연결하기 위해 커넥터들과 케이블들을 사용해야 하므로 공정의 단순화를 꽤 할 수 없다.
반면, 도 6의 실시예는 앞서 설명한 바와 같이 구동보드(DBD)와 컨트롤보드(CBD)가 하나로 통합되어 있어 이들 간의 임피던스 정합이 생략되고 필요시 제1영역(P1)에서만 임피던스 정합을 수행하면 되므로 종래 표시장치 대비 임피던스 정합시 공정 상의 이점을 줄 수 있게 된다. 이와 더불어, 실시예는 도 4 및 도 5에서와 같이 컨트롤보드(CBD)와 패널(PNL)을 연결할 때 사용되는 별도의 케이블이나 커넥터를 미사용할 수 있게 되므로 공정의 단순화를 꽤 할 수 있다.
그러므로, 종래 표시장치는 임피던스 정합 공정을 수행하더라도 도 7의 (a)와 같이 미스매칭(Mismatching) 확률이 매우 높게 나타나는 반면, 실시예의 표시장치는 도 7의 (b)와 같이 매칭(Matching) 확률이 매우 높게 나타나 회로의 성능 향상과 안정적인 신호 전송이 가능하게 된다.
이와 더불어, 실시예는 위와 같은 구조를 이용함으로써 종래 구조 대비 컨트롤보드의 크기를 줄일 수 있다.
도 8은 종래 표시장치와 실시예의 표시장치에 포함된 컨트롤보드를 비교 설명하기 위한 도면이다. 도 8에 도시된 컨트롤보드의 비교 도면은 특정 크기의 표시장치를 구성할 때의 비교예임을 참조한다.
도 8의 종래 표시장치는 인쇄회로보드로 형성된 컨트롤보드(CBD)를 사용하므로 패널이나 메인보드와의 연결을 시도할 때, 적어도 6개의 커넥터들과 2개의 연성케이블들(영역1 참조)이 요구되므로 공정이 복잡해진다. 이와 더불어, 공간이 한정되어 있어 타이밍제어부(TCN)와 주변 장치들을 컨트롤보드(CBD)에 실장 하려면 보드를 크게 형성해야만 한다.
반면, 도 8의 실시예의 표시장치는 연성회로보드로 형성된 컨트롤보드(CBD)를 사용하므로 패널이나 메인보드와의 연결을 시도할 때, 적어도 2개의 커넥터들만 요구되므로 공정이 단순해진다. 이와 더불어, 컨트롤보드(CBD)로부터 연장된 부분(영역2 참조)에 주변 장치들을 실장할 수 있게 되므로 컨트롤보드(CBD) 내에 타이밍제어부(TCN)과 데이터구동부(DDRV)를 함께 실장 하더라도 크기를 축소할 수 있는 사이즈 축소 가능 영역을 마련할 수 있게 된다.
그러므로, 실시예의 표시장치에 사용되는 컨트롤보드(CBD)는 종래 구조 대비 임피던스 매칭이 용이함은 물론 보드의 크기를 줄일 수 있도록 설계가 가능함은 물론 패턴의 길이 또한 줄어들게 되므로 회로의 성능 향상을 기대할 수 있게 된다.
이상 본 발명의 실시예는 타이밍제어부와 데이터구동부를 하나의 보드에 실장하여 이들 간의 임피던스 정합 공정을 생략함과 더불어 공정의 단순화와 보드의 크기를 줄여 회로의 성능 향상을 기대할 수 있는 표시장치를 제공하는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
MCU: 영상처리부 TCN: 타이밍제어부
SDRV: 게이트구동부 DDRV: 데이터구동부
PNL: 패널 SP: 서브 픽셀들
MBD: 메인보드 CBD: 컨트롤보드

Claims (8)

  1. 게이트신호를 공급하는 게이트구동부가 내재된 패널;
    데이터신호와 제어신호를 공급하는 영상처리부가 실장된 메인보드; 및
    연성회로보드로 형성되어 상기 패널과 상기 메인보드를 상호 연결하고, 상기 연성회로보드에는 상기 패널에 데이터신호를 공급하는 데이터구동부와, 상기 메인보드로부터 상기 데이터신호와 상기 제어신호를 전달받아 상기 데이터구동부 및 상기 패널의 게이트 구동부를 제어하는 타이밍제어부가 함께 실장 되어 상기 타이밍제어부와 상기 데이터구동부 간의 임피던스 매칭이 생략된 구조를 갖는 컨트롤보드;
    를 포함하는 표시장치.
  2. 제1항에 있어서,
    상기 컨트롤보드는,
    상기 패널과 연결되는 일측 연결부가 N개(N은 2 이상 정수)로 분할된 것을 특징으로 하는 표시장치.
  3. 제1항에 있어서,
    상기 컨트롤보드는,
    M개(M은 2 이상 정수)의 연성케이블들에 의해 상기 패널과 연결된 것을 특징으로 하는 표시장치.
  4. 제3항에 있어서,
    상기 M개의 연성케이블들은,
    상기 컨트롤보드와 상기 패널 각각에 본딩 방식으로 부착된 것을 특징으로 하는 표시장치.
  5. 제1항에 있어서,
    상기 컨트롤보드는,
    상기 메인보드와 연결되는 타측 연결부가 L개(L은 2 이상 정수)로 분할된 것을 특징으로 하는 표시장치.
  6. 제1항에 있어서,
    상기 컨트롤보드는,
    J개(J는 2 이상 정수)의 연성케이블들에 의해 상기 메인보드와 연결된 것을 특징으로 하는 표시장치.
  7. 제6항에 있어서,
    상기 J개의 연성케이블들은,
    상기 컨트롤보드와 상기 메인보드 각각에 커넥터 방식으로 부착된 것을 특징으로 하는 표시장치.
  8. 제1항에 있어서,
    상기 패널은,
    액정패널 또는 유기전계발광표시패널인 것을 특징으로 하는 표시장치.
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