CN101211423A - Cpu与逻辑加密双用智能卡及其数据同步方法 - Google Patents

Cpu与逻辑加密双用智能卡及其数据同步方法 Download PDF

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Abstract

本发明公开了一种CPU与逻辑加密双用智能卡及其数据同步方法。现有CPU与逻辑加密双用智能卡，不能解决二者数据同步的问题。为解决上述问题，本发明CPU与逻辑加密双用智能卡及其数据同步方法的技术方案为：CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块，所述数据格式转化模块将数据转发给CPU控制存储区，CPU命令处理模块再控制CPU控制存储区，将CPU卡数据通过数据格式转化模块发送给逻辑加密存储区访问控制模块，所述逻辑加密存储区访问控制模块将CPU卡数据写入逻辑加密存储区。本发明适用于智能卡领域。

Description

CPU与逻辑加密双用智能卡及其数据同步方法
技术领域
本发明涉及一种智能卡数据存储装置及内部数据同步方法，主要是涉及CPU与逻辑加密双用智能卡及其数据同步方法。
背景技术
逻辑加密卡和CPU卡都是IC卡的一种。CPU卡同逻辑加密卡相比具有处理速度快，安全性高，灵活性大等优点，正在逐步的取代逻辑加密卡。但是逻辑加密卡已经在很多项目中应用，如果直接使用CPU卡替换逻辑加密卡，势必会导致现有的逻辑加密读卡装置和终端全部要更换，这样做的成本过大，难以接受。为了解决这一问题，有些芯片厂商提供了一种新的CPU芯片：增加了逻辑加密电路和逻辑加密存储区。使用这种芯片封装成的卡片既可以当作CPU卡使用，也可以当作逻辑加密卡使用。也就是说同一张卡片既可以支持读CPU卡终端，也可以支持读逻辑加密卡终端。解决了硬件问题，还有软件问题：卡片当作CPU卡使用时，数据保存在CPU控制存储区；卡片当作逻辑加密卡使用时，数据保存在逻辑加密存储区，这样实现了逻辑加密卡和CPU卡在硬件表现上是一张卡片，一个整体，但是二者之间的数据是不一致的。当逻辑加密卡和CPU卡作为一个共同应用时，要求这两个存储区内相应的数据应该是一致的，从而保证在逻辑加密卡终端环境和CPU卡终端环境分别保持一个正确的状态，但目前还不能解决二者数据同步的问题。
发明内容
针对现有技术存在的缺陷和不足，本发明提供一种CPU与逻辑加密双用智能卡及其数据同步方法，能够保证逻辑加密卡和CPU卡内存储的数据与外界通信时保持一致。
为了达到上述发明目的，本发明CPU与逻辑加密双用智能卡，包括用于与CPU读卡装置进行通信的CPU卡系统和用于与逻辑加密读卡装置进行通信的逻辑加密卡系统，所述CPU卡系统包括用于存储CPU卡数据的CPU控制存储区，所述逻辑加密卡系统包括用于存储逻辑加密卡数据的逻辑加密存储区，CPU卡系统还包括用于CPU控制存储区和逻辑加密存储区进行数据同步的数据同步装置，所述数据同步装置分别与CPU控制存储区和逻辑加密存储区相连。
上述的CPU与逻辑加密双用智能卡中，所述数据同步装置包括：
CPU命令处理模块：对逻辑加密存储区访问控制模块和CPU控制存储区进行控制，完成CPU控制存储区与逻辑加密存储区的数据交互；
数据格式转换模块：完成逻辑加密卡数据与CPU卡数据的格式转换；
逻辑加密存储区访问控制模块：完成对逻辑加密存储区中的逻辑加密卡数据的读取和写入；
其中，CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块，所述数据格式转换模块将数据转发给CPU控制存储区，CPU命令处理模块再控制CPU控制存储区，将CPU卡数据通过数据格式转换模块发送给逻辑加密存储区访问控制模块，所述逻辑加密存储区访问控制模块将CPU卡数据写入逻辑加密存储区。
本发明同时提供了一种CPU与逻辑加密双用智能卡的数据同步方法，包括以下步骤：
(1)每次CPU卡系统与CPU读卡装置通信前，调用逻辑加密卡数据更新CPU卡数据；
(2)CPU卡系统与CPU读卡装置完成通信，如果通信内容为CPU读卡装置读取CPU卡数据，步骤结束；如果通信内容为CPU读卡装置修改CPU卡数据，进入下一步骤；
(3)调用CPU卡数据更新逻辑加密卡数据。
具体的，步骤(1)包括以下步骤：
(11)CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块；
(12)数据格式转换模块将所述数据的数据格式由逻辑加密卡格式转换为CPU卡格式，转发给CPU控制存储区，更新CPU控制存储区中的数据。
进一步的，步骤(2)中通信内容如果是CPU读卡装置修改CPU卡数据，则通信过程具体为：CPU控制存储区备份当前数据后，接受CPU读卡装置对CPU卡数据的修改，如果修改成功，进入步骤(3)；否则，用备份数据还原当前数据，步骤结束。
具体的，步骤(3)包括以下步骤：
(31)CPU命令处理模块控制CPU控制存储区，将CPU卡数据发送给数据格式转换模块；
(32)数据格式转换模块将所述数据的数据格式由CPU卡格式转换为逻辑加密卡格式，转发给逻辑加密存储区访问控制模块；
(33)逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区。
作为改进，步骤(33)具体为：逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区，如果写入成功，步骤结束；如果写入失败，CPU控制存储区用备份数据还原当前数据，步骤结束。
本发明通过分别与CPU控制存储区和逻辑加密存储区相连的数据同步装置，在CPU卡系统每次与外界通信前调用逻辑加密卡数据更新CPU卡数据，如果CPU卡系统与外界通信后CPU卡数据发生改变，数据同步装置再调用CPU卡数据更新逻辑加密卡数据，这样，可以保证CPU卡系统每次与外界通信前后，CPU卡数据都与逻辑加密卡数据保持一致，进而真正实现一卡双用。
附图说明
图1为本发明CPU与逻辑加密双用智能卡结构图；
图2为本发明CPU与逻辑加密双用智能卡及其数据同步流程图。
具体实施方式
下面结合附图对本发明作进一步的详细说明：
如图1所示，本发明CPU与逻辑加密双用智能卡，包括用于与CPU读卡装置进行通信的CPU卡系统和用于与逻辑加密读卡装置进行通信的逻辑加密卡系统，所述CPU卡系统包括用于存储CPU卡数据的CPU控制存储区，所述逻辑加密卡系统包括用于存储逻辑加密卡数据的逻辑加密存储区，本装置的主要发明点在于：CPU卡系统还包括用于CPU控制存储区和逻辑加密存储区进行数据同步的数据同步装置，所述数据同步装置分别与CPU控制存储区和逻辑加密存储区相连。
所述数据同步装置包括：
CPU命令处理模块：对逻辑加密存储区访问控制模块和CPU控制存储区进行控制，完成CPU控制存储区与逻辑加密存储区的数据交互；
数据格式转换模块：完成逻辑加密卡数据与CPU卡数据的格式转换；
逻辑加密存储区访问控制模块：完成对逻辑加密存储区中的逻辑加密卡数据的读取和写入；
该装置的工作过程如下：CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块，所述数据格式转换模块将数据转发给CPU控制存储区，CPU命令处理模块再控制CPU控制存储区，将CPU卡数据通过数据格式转换模块发送给逻辑加密存储区访问控制模块，所述逻辑加密存储区访问控制模块将CPU卡数据写入逻辑加密存储区。
针对上述装置的CPU卡系统与逻辑加密卡系统的数据同步方法，包括以下步骤：
(1)每次CPU卡系统与CPU读卡装置通信前，调用逻辑加密卡数据更新CPU卡数据。
步骤(1)具体包括以下步骤：
(11)CPU命令处理模块检测到CPU读卡装置，判断将要进行通信，在CPU卡系统与CPU读卡装置通信前，CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块；
(12)数据格式转换模块将所述数据的数据格式由逻辑加密卡格式转换为CPU卡格式，转发给CPU控制存储区，更新CPU控制存储区中的数据。
(2)CPU卡系统与CPU读卡装置完成通信，如果通信内容为CPU读卡装置读取CPU卡数据，步骤结束；如果通信内容为CPU读卡装置修改CPU卡数据，进入下一步骤。
为了提高通信操作的可靠性，步骤(2)中通信内容如果是CPU读卡装置修改CPU卡数据，则通信过程具体为：CPU控制存储区备份当前数据后，接受CPU读卡装置对CPU卡数据的修改，如果修改成功，进入步骤(3)；否则，用备份数据还原当前数据，步骤结束。
(3)调用CPU卡数据更新逻辑加密卡数据。
步骤(3)包括以下步骤：
(31)CPU命令处理模块控制CPU控制存储区，将CPU卡数据发送给数据格式转换模块；
(32)数据格式转换模块将所述数据的数据格式由CPU卡格式转换为逻辑加密卡格式，转发给逻辑加密存储区访问控制模块；
(33)逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区。
同样，为了提高通信操作的可靠性，步骤(33)中，逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区，如果写入成功，步骤结束；如果写入失败，CPU控制存储区用备份数据还原当前数据，步骤结束。
本方法主要是基于下面的思路：逻辑加密卡系统由于不具有类似中央处理器的可对系统进行控制操作的控制芯片，所以不具有访问CPU卡系统的能力，这样，想达到CPU卡系统与逻辑加密卡系统的数据同步就必须依靠CPU卡系统来完成。
具体的，利用本发明的装置，CPU命令处理模块只在CPU卡系统每次与外界(CPU读卡装置)进行通信之前，控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块，所述数据格式转换模块将数据转发给CPU控制存储区，完成CPU卡系统与逻辑加密卡系统的第一次数据同步，在本次数据同步之前，逻辑加密卡系统可能已经数次与外界(逻辑加密读卡装置)进行了通信，这期间并不需要进行同步操作，因为CPU卡系统与逻辑加密卡系统的数据不统一，只有在CPU卡系统与逻辑加密卡系统都分别与外界通信时才会产生不良后果(例如造成外界读卡系统计费不统一)，所以只要在CPU卡系统每次与外界进行通信之前使CPU控制存储区的数据与逻辑加密存储区中的数据保持一致即可。日常生活中，CPU卡系统与外界的通信内容分为两种：CPU读卡装置读取CPU卡数据和CPU读卡装置修改CPU卡数据。所述CPU读卡装置读取CPU卡数据可以理解为持卡人只想通过CPU读卡装置或终端查看本卡内的数据信息(比如卡内存有多少钱)，这种操作不会更改CPU控制存储区内的数据，所以本次通信完成后无需使逻辑加密存储区与CPU控制存储区数据同步。所述CPU读卡装置修改CPU卡数据可以理解为持卡人通过CPU读卡装置改变了本卡内的数据信息(比如刷卡消费，刷卡前后卡内金额出现了变化)，由于这种操作改变了CPU控制存储区内的数据，使得CPU控制存储区和逻辑加密存储区的数据不再统一，所以本次通信完成后必须使逻辑加密存储区与CPU控制存储区数据同步。具体过程为：在CPU卡系统每次与外界(CPU读卡装置)进行通信(CPU读卡装置修改CPU卡数据)之后，CPU命令处理模块再控制CPU控制存储区，将CPU卡数据通过数据格式转换模块发送给逻辑加密存储区访问控制模块，所述逻辑加密存储区访问控制模块将CPU卡数据写入逻辑加密存储区。这样，在第二次数据同步后，实现了逻辑加密存储区中的数据与CPU控制存储区的数据保持一致，从而完成了本次CPU卡系统与逻辑加密卡系统的数据同步。
下面以一个钱包应用的实施例详细介绍本方法的流程：
如图2所示，当操作CPU控制存储区内和逻辑加密存储区相对应的数据时(比如一个钱包应用，那么在逻辑加密存储区和CPU控制存储区都保存着钱的金额，这个金额就是对应数据)，需要启动数据同步，流程如下：
1、本发明CPU与逻辑加密双用智能卡与某个计费式的CPU读卡装置建立联系；
2、CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的金额数据给数据格式转换模块，读取成功，进入下一步；否则，向CPU读卡装置返回操作失败信息，进入步骤11；
3、数据格式转换模块将所述金额数据的数据格式由逻辑加密卡格式转换为CPU卡格式，转发给CPU控制存储区，如果转化后金额数据与CPU控制存储区内的金额数据不一致，进入下一步；否则，进入步骤5；
4、使用转化后金额数据更新CPU控制存储区内的金额数据，如果更新成功，进入下一步；否则，向CPU读卡装置返回操作失败信息，进入步骤11；
5、CPU卡系统与CPU读卡装置完成通信，如果通信内容为CPU读卡装置读取CPU卡金额数据，进入步骤11；如果通信内容为CPU读卡装置修改CPU卡金额数据，进入下一步；
6、CPU控制存储区备份当前金额数据，备份成功进入下一步；否则，向CPU读卡装置返回操作失败信息，进入步骤11；
7、接受CPU读卡装置对CPU卡金额数据的修改，如果修改成功，进入下一步；否则，用备份金额数据还原CPU控制存储区的当前金额数据，向CPU读卡装置返回操作失败信息，进入步骤11；
8、CPU命令处理模块控制CPU控制存储区，将CPU卡金额数据发送给数据格式转换模块；
9、数据格式转换模块将所述金额数据的数据格式由CPU卡格式转换为逻辑加密卡格式，转发给逻辑加密存储区访问控制模块；
10、逻辑加密存储区访问控制模块用所述CPU卡金额数据更新逻辑加密存储区，如果更新成功，进入下一步；否则，CPU控制存储区用备份金额数据还原当前金额数据，向CPU读卡装置返回操作失败信息，进入下一步；
11、步骤结束。
通过本发明的装置和方法可以有效保证逻辑加密卡系统和CPU卡系统内存储的数据保持一致，虽然对逻辑加密存储区的数据操作会暂时的导致两个存储区内数据不同步，但是通过对CPU控制存储区内数据的操作总可以使两个存储区内数据同步，用户不会感觉到不同步的存在。
这里需要指出的是，上面给出的只是本发明的优选实施例，本发明还可以举出很多其它的实施例，比如实施的领域不局限于钱包应用，还可以是电表、水表等一切需要一张智能卡就可与各种不同类型的读卡装置进行数据交互的领域。另外，本发明中的应用也不应局限于逻辑加密卡系统和CPU卡系统之间，也可以是CPU卡系统与其它卡载数据读写系统(比如只读卡系统)之间的数据同步，其流程与本实施例实质相同，也属于本发明保护范畴之内。

Claims (7)

1.一种CPU与逻辑加密双用智能卡，包括用于与CPU读卡装置进行通信的CPU卡系统和用于与逻辑加密读卡装置进行通信的逻辑加密卡系统，所述CPU卡系统包括用于存储CPU卡数据的CPU控制存储区，所述逻辑加密卡系统包括用于存储逻辑加密卡数据的逻辑加密存储区，其特征在于：CPU卡系统还包括用于CPU控制存储区和逻辑加密存储区进行数据同步的数据同步装置，所述数据同步装置分别与CPU控制存储区和逻辑加密存储区相连。
2.根据权利要求1所述的CPU与逻辑加密双用智能卡，其特征在于：所述数据同步装置包括：
CPU命令处理模块：对逻辑加密存储区访问控制模块和CPU控制存储区进行控制，完成CPU控制存储区与逻辑加密存储区的数据交互；
数据格式转换模块：完成逻辑加密卡数据与CPU卡数据的格式转换；
逻辑加密存储区访问控制模块：完成对逻辑加密存储区中的逻辑加密卡数据的读取和写入；
其中，CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块，所述数据格式转换模块将数据转发给CPU控制存储区，CPU命令处理模块再控制CPU控制存储区，将CPU卡数据通过数据格式转换模块发送给逻辑加密存储区访问控制模块，所述逻辑加密存储区访问控制模块将CPU卡数据写入逻辑加密存储区。
3.一种CPU与逻辑加密双用智能卡的数据同步方法，其特征在于：包括以下步骤：
(1)每次CPU卡系统与CPU读卡装置通信前，调用逻辑加密卡数据更新CPU卡数据；
(2)CPU卡系统与CPU读卡装置完成通信，如果通信内容为CPU读卡装置读取CPU卡数据，步骤结束；如果通信内容为CPU读卡装置修改CPU卡数据，进入下一步骤；
(3)调用CPU卡数据更新逻辑加密卡数据。
4.根据权利要求3所述的CPU与逻辑加密双用智能卡的数据同步方法，其特征在于：步骤(1)包括以下步骤：
(11)CPU命令处理模块控制逻辑加密存储区访问控制模块，读取逻辑加密存储区的数据给数据格式转换模块；
(12)数据格式转换模块将所述数据的数据格式由逻辑加密卡格式转换为CPU卡格式，转发给CPU控制存储区，更新CPU控制存储区中的数据。
5.根据权利要求3所述的CPU与逻辑加密双用智能卡的数据同步方法，其特征在于：步骤(2)中通信内容如果是CPU读卡装置修改CPU卡数据，则通信过程具体为：CPU控制存储区备份当前数据后，接受CPU读卡装置对CPU卡数据的修改，如果修改成功，进入步骤(3)；否则，用备份数据还原当前数据，步骤结束。
6.根据权利要求3所述的CPU与逻辑加密双用智能卡的数据同步方法，其特征在于：步骤(3)包括以下步骤：
(31)CPU命令处理模块控制CPU控制存储区，将CPU卡数据发送给数据格式转换模块；
(32)数据格式转换模块将所述数据的数据格式由CPU卡格式转换为逻辑加密卡格式，转发给逻辑加密存储区访问控制模块；
(33)逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区。
7.根据权利要求5或6所述的CPU与逻辑加密双用智能卡的数据同步方法，其特征在于：步骤(33)具体为：逻辑加密存储区访问控制模块将所述CPU卡数据写入逻辑加密存储区，如果写入成功，步骤结束；如果写入失败，CPU控制存储区用备份数据还原当前数据，步骤结束。
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