JPS6358504B2 - - Google Patents

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JPS6358504B2
JPS6358504B2 JP17226381A JP17226381A JPS6358504B2 JP S6358504 B2 JPS6358504 B2 JP S6358504B2 JP 17226381 A JP17226381 A JP 17226381A JP 17226381 A JP17226381 A JP 17226381A JP S6358504 B2 JPS6358504 B2 JP S6358504B2
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JP
Japan
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data
transmission
circuit
destination
terminal
Prior art date
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JP17226381A
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Japanese (ja)
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JPS5873261A (en
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks
    • H04L12/54Store-and-forward switching systems 

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)

Description

【発明の詳細な説明】 本発明は、蓄積交換機能を有するデータ伝送装
置を相互に接続し任意のデータ伝送装置間でデー
タ伝送を行う蓄積交換型データ伝送方式に関す
る。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a store-and-forward data transmission system in which data transmission devices having a store-and-forward function are interconnected and data is transmitted between arbitrary data transmission devices.

従来の蓄積交換型データ伝送方式におけるデー
タ伝送を具体例を挙げて説明する。第1図に示す
ように、データ伝送装置ST1〜ST4が相互に接
続されている。また各装置には端末TM1〜TM
8が接続され、各端末からは第2図に示す送信デ
ータが出力される。このデータは、送信先の端局
および端末を示す宛先アドレス(ADD)、送信情
報(DATA)およびそれらの符号誤りを検出す
るための誤り検出符号(CHK)から構成されて
いる。
Data transmission in a conventional store-and-forward data transmission system will be explained using a specific example. As shown in FIG. 1, data transmission devices ST1 to ST4 are interconnected. Each device also has terminals TM1 to TM.
8 are connected, and the transmission data shown in FIG. 2 is output from each terminal. This data consists of a destination address (ADD) indicating the destination terminal station and terminal, transmission information (DATA), and an error detection code (CHK) for detecting code errors.

送信部では、端末からの送信データを受信し、
受信を完了した時点で符号誤りの有無を判断し、
正しいと判断された場合は、アドレス部の示す伝
送装置へ転送し、誤りと判断された場合は転送し
ない。各伝送装置間のデータ転送は、例えばパケ
ツト交換方式により行われる。パケツト交換方式
においては、第1図の装置ST1からST3へデー
タを転送する場合、装置ST2あるいはST4を中
継して伝送効率が良くなるようなあるいは伝送遅
延時間が短かくなるような長さのパケツトに分割
されて(第3図a〜d)送信側へ転送される。
The transmitter receives the transmitted data from the terminal,
When reception is completed, it is determined whether there is a code error or not.
If it is determined to be correct, it is transferred to the transmission device indicated by the address field; if it is determined to be incorrect, it is not transferred. Data transfer between each transmission device is performed by, for example, a packet switching method. In the packet switching method, when data is transferred from device ST1 to ST3 in Figure 1, a packet of a length that improves transmission efficiency or shortens transmission delay time is relayed through device ST2 or ST4. (Fig. 3, a to d) and transferred to the transmitting side.

受信局では、順次送信されてくるパケツトを受
信し、全てのパケツトが整つた時転で第2図に示
すデータ形式に戻され、端末へ受信データを出力
する。しかしながら、このような方式では、送信
部において端末から出力される送信データの受信
が全て完了した時点で、送信先装置への転送が開
始されるため、第3図に示すように伝送遅延時間
が大きくなるという欠点を有する。
The receiving station receives the sequentially transmitted packets, converts them back to the data format shown in FIG. 2 when all the packets are completed, and outputs the received data to the terminal. However, in such a system, the transmission to the destination device is started once the transmitter has completed receiving all the transmission data output from the terminal, so the transmission delay time is increased as shown in Figure 3. It has the disadvantage of being large.

本発明の目的は、データ伝送装置の送信部にお
いて端末からの送信データの受信が完了する以前
に転送を開始することにより上記欠点を解消した
データ伝送方式を提供することにある。
SUMMARY OF THE INVENTION An object of the present invention is to provide a data transmission system that eliminates the above-mentioned drawbacks by starting transfer before completion of reception of transmission data from a terminal in a transmission section of a data transmission device.

次に、図面を参照して本発明を詳細に説明す
る。
Next, the present invention will be explained in detail with reference to the drawings.

なお、以下の説明では、本発明を第1図に示す
ごとく、各データ伝送装置ST1〜ST4を相互に
接続してデータ交換網を構成し、各装置に接続さ
れた端末TM1〜TM8相互間でデータ伝送を行
うシステムに適した場合を例にとり説明する。
In the following explanation, the present invention will be explained as shown in FIG. 1, in which data transmission devices ST1 to ST4 are interconnected to form a data exchange network, and terminals TM1 to TM8 connected to each device are connected to each other. A case suitable for a system that transmits data will be explained as an example.

第2図で示すフオーマツトのデータが端末より
端局へ入力される。
Data in the format shown in FIG. 2 is input from the terminal to the terminal station.

装置ST1〜ST4の送信部では、端末TM1〜
TM8からの送信データを蓄積する一方データ量
を計数する。この計数値が一定値(第4図aに示
すN)に達すると、蓄積されているデータは、ア
ドレス部ADDの示す装置へ一つあるいは複数に
分割されて転送される(第4図b)。以後順次蓄
積されるデータを前記と同様な方法で転送する
(第4図c)。端末よりの送信データの受信を完了
した時点で符号誤りの有無を判定し、結果を送信
データ終了通知とともに送信先装置へ通知する。
このように、本発明の伝送方式においては、全デ
ータを受信する前に送信先装置へ転送を開始する
ことにより、データ伝送遅延時間を短かくするこ
とができる。
In the transmitting units of the devices ST1 to ST4, the terminals TM1 to
While accumulating the data sent from TM8, the amount of data is counted. When this count reaches a certain value (N shown in Figure 4a), the stored data is divided into one or more pieces and transferred to the device indicated by the address field ADD (Figure 4b). . Thereafter, the sequentially accumulated data is transferred in the same manner as described above (FIG. 4c). When the reception of the transmission data from the terminal is completed, the presence or absence of a code error is determined, and the result is notified to the destination device along with a transmission data end notification.
In this way, in the transmission method of the present invention, data transmission delay time can be shortened by starting transfer to the destination device before all data is received.

第5図は本発明のデータ伝送方式に使用される
データ伝送装置のブロツク図である。
FIG. 5 is a block diagram of a data transmission device used in the data transmission system of the present invention.

端末TMからの送信データAは受信インタフエ
ース回路1においてTTLレベル信号に変換され
た後送信バツフア回路5に入力されるとともにア
ドレス検出回路4において送信先の装置およびこ
の送信先装置に接続される端末のアドレスが検出
される。送信データ量検出回路6は送信バツフア
回路5に蓄積されたデータ数を計数し、一定値
(N)になるとパケツト組立回路7に通知する。
データの一定量蓄積の通知をうけたパケツト組立
回路7は、送信バツフア回路5のデータをパケツ
ト化し、パケツトのヘツダ部にアドレス検出回路
4から出力されるアドレスを付加し、パケツト交
換制御回路8へ入力する。データ終了検出回路2
は送信データの終了を検出し、この検出結果とデ
ータ誤り検出回路3にて検出したデータ誤りの有
無とをパケツト組立回路7に通知する。本通知を
うけたパケツト組立回路7は、データ誤りの有無
を表示したデータ終了通知パケツトを作成す
る。パケツト交換制御回路8は、パケツト交換プ
ロトコルに従つて、終了通知パケツトを送信先装
置へ転送する。
Transmission data A from the terminal TM is converted into a TTL level signal in the reception interface circuit 1, and then inputted to the transmission buffer circuit 5, and is also sent to the address detection circuit 4 for the destination device and the terminal connected to this destination device. address is detected. The transmission data amount detection circuit 6 counts the number of data accumulated in the transmission buffer circuit 5, and notifies the packet assembly circuit 7 when it reaches a certain value (N).
The packet assembling circuit 7, which has been notified of the accumulation of a certain amount of data, packetizes the data in the transmission buffer circuit 5, adds the address output from the address detection circuit 4 to the header part of the packet, and sends the packet to the packet exchange control circuit 8. input. Data end detection circuit 2
detects the end of the transmitted data, and notifies the packet assembly circuit 7 of this detection result and the presence or absence of a data error detected by the data error detection circuit 3. Upon receiving this notification, the packet assembling circuit 7 creates a data end notification packet P indicating the presence or absence of data errors. The packet switching control circuit 8 transfers the completion notification packet to the destination device according to the packet switching protocol.

一方受信装置では、受信パケツトをパケツト分
解回路9にて分解し、データ部は受信バツフア回
路12に蓄積され、アドレス部はアドレス記憶回
路11へ与えられる。パケツト分解回路9は、送
信データ終了通知をうけとると、データ誤りの有
無を調べ、データ誤りがあれば受信バツフア回路
12のデータを廃棄し端末への出力を中止する。
データ誤りが無ければアドレス記憶回路11のア
ドレスにつづいて受信バツフア回路12の全デー
タおよび誤り検出符号作成回路10で作られた誤
り検出符号を選択回路13および送信インタフエ
ース回路14を介して、端末へ出力する。
On the other hand, in the receiving device, a received packet is decomposed by a packet decomposing circuit 9, a data portion is stored in a receiving buffer circuit 12, and an address portion is provided to an address storage circuit 11. When the packet disassembly circuit 9 receives the transmission data end notification, it checks whether there is a data error or not, and if there is a data error, it discards the data in the reception buffer circuit 12 and stops outputting it to the terminal.
If there is no data error, following the address in the address storage circuit 11, all the data in the reception buffer circuit 12 and the error detection code created by the error detection code creation circuit 10 are sent to the terminal via the selection circuit 13 and the transmission interface circuit 14. Output to.

以上のように、本発明では、端末からの送信デ
ータの入力が完了する以前に送信先装置へデータ
転送を開始しているため伝送遅延時間を短縮する
ことができる。
As described above, in the present invention, data transfer to the destination device is started before the input of transmission data from the terminal is completed, so that the transmission delay time can be reduced.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は交換型データ伝送方式のシステム構成
を示すブロツク図、第2図は交換型データ伝送方
式における端末とのデータ入出力フオーマツトを
示す図、第3図a〜dは従来の交換型データ伝送
方式を説明するタイムチヤート、第4図a〜dは
本発明の一実施例を説明するためのタイムチヤー
ト、第5図は本発明に使用される伝送装置のブロ
ツク図である。 第1図および第5図において、ST1〜ST4…
…データ伝送装置、TM1〜TM8……端末装
置、1……受信インタフエース回路、2……デー
タ終了検出回路、3……データ誤り検出回路、4
……アドレス検出回路、5……送信バツフア回
路、6……データ量検出回路、7……パケツト組
立回路、8……パケツト交換制御回路、9……パ
ケツト分解回路、10……誤り検出符号作成回
路、11……アドレス記憶回路、12……受信バ
ツフア回路、13……選択回路。
Figure 1 is a block diagram showing the system configuration of the switched data transmission system, Figure 2 is a diagram showing the data input/output format with a terminal in the switched data transmission system, and Figures 3a to 3d are diagrams showing the conventional switched data transmission system. 4A to 4D are time charts for explaining an embodiment of the present invention, and FIG. 5 is a block diagram of a transmission device used in the present invention. In Fig. 1 and Fig. 5, ST1 to ST4...
...Data transmission device, TM1 to TM8...Terminal device, 1...Reception interface circuit, 2...Data end detection circuit, 3...Data error detection circuit, 4
... Address detection circuit, 5 ... Transmission buffer circuit, 6 ... Data amount detection circuit, 7 ... Packet assembly circuit, 8 ... Packet exchange control circuit, 9 ... Packet disassembly circuit, 10 ... Error detection code creation circuit, 11... address storage circuit, 12... reception buffer circuit, 13... selection circuit;

Claims (1)

【特許請求の範囲】[Claims] 1 蓄積交換機能を有し、送信部および受信部を
有するデータ伝送装置を相互に接続し、任意のデ
ータ伝送装置間でデータ伝送を行う蓄積交換型デ
ータ伝送方式において、送信元の前記データ伝送
装置の送信部では、送信端末から供給された送信
データ量を監視し、該データ量が一定値に達した
ときに送信先の前記データ伝送装置へ前記データ
の転送を開始し、前記送信端末からの前記データ
が終了すると、このデータの誤まりの有無を表す
データ終了パケツトを送信し、前記送信先のデー
タ伝送装置の受信部では、前記データ終了パケツ
トから前記データのデータ誤りが判定されると、
その時点で前記送信先のデータ伝送装置内に存在
する前記データを破棄し、前記送信先データ伝送
装置の送信部から、この送信部に接続された受信
端末への前記データの送信を中止することを特徴
とする蓄積交換型データ伝送方式。
1. In a store-and-forward data transmission system in which data transmission devices having a store-and-forward function and a transmitter and a receiver are connected to each other and data is transmitted between arbitrary data transmitters, the data transmitter as the source The transmitting unit monitors the amount of data to be transmitted supplied from the transmitting terminal, and when the amount of data reaches a certain value, starts transferring the data to the data transmission device of the destination, and transmits the data from the transmitting terminal. When the data ends, a data end packet indicating the presence or absence of an error in this data is transmitted, and when the receiving section of the destination data transmission device determines a data error in the data from the data end packet,
Abandoning the data existing in the destination data transmission device at that point, and stopping the transmission of the data from the transmission section of the destination data transmission device to the receiving terminal connected to this transmission section. A store-and-forward data transmission system characterized by:
JP56172263A 1981-10-28 1981-10-28 Storage exchange type data transmission system Granted JPS5873261A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56172263A JPS5873261A (en) 1981-10-28 1981-10-28 Storage exchange type data transmission system

Applications Claiming Priority (1)

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JP56172263A JPS5873261A (en) 1981-10-28 1981-10-28 Storage exchange type data transmission system

Publications (2)

Publication Number Publication Date
JPS5873261A JPS5873261A (en) 1983-05-02
JPS6358504B2 true JPS6358504B2 (en) 1988-11-16

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ID=15938649

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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60145748A (en) * 1984-01-07 1985-08-01 Fujitsu Ltd Message transfer buffer system

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JPS54141504A (en) * 1978-04-26 1979-11-02 Fujitsu Ltd Message transfer system in packet exchange network
JPS5669944A (en) * 1979-11-09 1981-06-11 Sony Corp Stereophonic demodulating circuit

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JPS5873261A (en) 1983-05-02

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