WO2012106940A1 - 一种以太网设备处理方法和装置 - Google Patents

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WO2012106940A1
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message
chip
physical layer
packet
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陈元
陈国导
李晓栋
余忠洋
王苏
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华为技术有限公司
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00—Data switching networks
    • H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/40—Bus networks
    • H04L12/407—Bus networks with decentralised control
    • H04L12/413—Bus networks with decentralised control with random access, e.g. carrier-sense multiple-access with collision detection [CSMA-CD]

Definitions

  • the present invention relates to Ethernet communications. Background technique
  • the IEEE 1588 function is used to implement accurate time transmission based on Ethernet.
  • IEEE 1588 technology can timestamp Ethernet packets at the MAC (Medie ia Acces s Cont ro l) layer, and then use PHY (Phys i ca l Layer) to transmit Timestamp Ethernet packet.
  • the IEEE 1588 standard specifies that the time-stamped Ethernet packet transmission time on the PHY chip is less than a certain value and does not change to meet the accuracy of the Ethernet peer to recover the clock frequency and time with the 1588 timestamp packet. .
  • EEE IEEE Energy Efficient Ethernet
  • the EEE principle is to disable certain functions of the Ethernet PHY chip during idle periods of the network, and does not perform packet transmission including idle message transmission.
  • the IEEE 1588 clock transfer feature is a system feature that requires the phy chip to support no time delay or fixed delay.
  • the implementation of EEE energy-efficient Ethernet requires a buffer to implement switching between the low-power idle mode and the normal mode of the Ethernet port.
  • the present invention provides a physical layer chip in the first aspect.
  • the physical layer chip includes a physical coding sublayer module and a physical medium access sublayer, wherein the physical chip further includes a low power idle control client module and a time stamp module, and the low power idle control client
  • the module buffers the received packet and sends the packet to the physical coding sublayer module;
  • the physical coding sublayer module encodes the packet and sends the packet to
  • the timestamp module adds a tag with timestamp information to the encoded message, and then sends the tag to the physical medium receiving submodule; wherein the timestamp information is used to identify the physical layer.
  • the time at which the chip sends the message is used to identify the physical layer.
  • the present invention provides an Ethernet device in a second aspect.
  • the Ethernet device includes a media access control chip and a physical layer chip as described in the first aspect.
  • the physical layer chip buffers the packet after receiving the packet from the medium access control chip; and encodes the buffered packet to add the band.
  • a tag with timestamp information so that the Ethernet device sends the message; wherein the timestamp information is used to identify the time when the Ethernet device sends the message.
  • the invention provides a packet processing method for an Ethernet device in a third aspect.
  • the Ethernet device includes a medium access control chip and a physical layer chip.
  • the method is characterized in that, when the Ethernet device is awake from idle, the physical layer chip receives the packet from the medium access control chip, and buffers the received message; After the encoding is performed, the tag with the timestamp information is added, so that the Ethernet device sends the packet.
  • the timestamp information is used to identify the time when the Ethernet device sends the packet.
  • the present invention provides an Ethernet device in a fourth aspect.
  • the device includes a physical layer chip, wherein the physical layer chip includes a low power idle control client module and a selection switch; the selection switch sends the message in the first position without passing through the low power idle control client module, in the second The message is sent at the location through the low power idle control client module.
  • the invention provides a packet processing method for an Ethernet device in a fifth aspect.
  • the Ethernet device includes a physical layer chip, and the physical layer chip includes a low power idle control client module and a selection switch.
  • the method includes transmitting a message without a low power idle control client module when the selection switch is in the first position, and transmitting the message through the low power idle control client module when the selection switch is in the second position.
  • the invention enables the PHY chip to simultaneously support EEE functions and 1588 functions.
  • this issue Ming also provides a mechanism for choosing between EEE functionality and 1588 functionality.
  • FIG. 1 is a schematic diagram of an Ethernet device according to a first embodiment of the present invention
  • FIG. 2 is a diagram showing an example of functional blocks of the PHY chip of FIG. 1;
  • Figure 3 depicts the location of the time stamp (T imeS tamp ) information tag (Tag) in the 4 ⁇ text;
  • Figure 4 is a schematic illustration of a second embodiment of the present invention. detailed description
  • the Ethernet device includes a PHY chip and a MAC chip.
  • the PHY chip and the MAC chip are connected through a Media Independent Interface (MI I) to implement docking between the PHY chip and the MAC chip.
  • MI I Media Independent Interface
  • the PHY and the MAC exist in different layers of the same chip, so the PHY chip of the present invention should also cover the PHY layer in the chip, and the same MAC chip should also cover the chip.
  • the case of the MAC layer in .
  • the MAC chip is the media access controller.
  • the Ethernet MAC is defined by the IEEE-802. 3 Ethernet standard. It implements a data link layer that provides addressing mechanisms, data frame construction, data error checking, transport control, and a standard data interface to the network layer. Normally, the MAC or PHY chip can implement the Mi l interface.
  • the Mi l interface is an Ethernet industry standard defined by IEEE-802. It includes a data interface and a management interface between the MAC and the PHY.
  • the data interface includes two separate channels for the transmitter and receiver, respectively. Each channel has its own data, clock, and control signals.
  • the management interface is a dual signal interface: one is the clock signal and the other is the data signal.
  • the upper layer can monitor and control the PHY through the management interface.
  • the PHY chip is a physical interface transceiver that implements physical layer functions.
  • the physical layer defines the electrical and optical signals, line states, clock references, data encoding, and circuitry required for data transmission and reception, and provides a standard interface to data link layer devices.
  • the PHY chip is divided into physical coding sublayers according to logical functions (Phys i ca l Cod ing Sub-layer, referred to as PCS), physical media access sublayer (Physical Media Access, PMA for short), physical media related sublayer (Physical Media Dependent, referred to as PMD).
  • PCS Physical coding sublayers according to logical functions
  • PMA Physical Media Access
  • PMD Physical Media Dependent
  • the PCS sublayer maps well-defined Ethernet MAC functions to the functionality of existing coding and physical layer signaling systems.
  • the PMA sublayer provides continuous data transfer, such as execution and serial/serial conversion.
  • the PMA sublayer supports a variety of reliable coding schemes.
  • Each PMD sublayer can be supported with one code and adapted to a particular medium.
  • a fiber optic transceiver belongs to the PMD sublayer.
  • the PMD sublayer converts the signal onto a particular medium or vice versa.
  • the EEE LPI Client Low Power Idle Client
  • the EEE LPI Client Low Power Idle Client
  • the control turns off some functions of the PHY chip, and does not perform message transmission; when the network is awake again, the PHY chip buffers the accumulation of 4 pages due to the wake-up time, so that the Ethernet port is low in power consumption. Switch between idle mode and normal mode.
  • a timestamp module (not marked in FIG. 1) for time stamping Ethernet packets is set in the PHY chip to timestamp the Ethernet 4 packets flowing in the sending direction under the control of the LPI Client module. .
  • the timestamp can be derived from the precise clock that is externally supplied to the PHY chip.
  • the sending direction described here refers to the direction in which the packet is sent out from the Ethernet device, that is, the direction from the PCS -> PMA to the right shown in FIG.
  • the direction in which the Ethernet device receives 4 messages from the external Ethernet device is called the receiving direction, that is, the direction from the PMA -> PCS to the left as shown in Figure 1.
  • the above embodiment illustrates the case where the message received by the PHY chip does not have a time stamp.
  • the timestamp module replaces the existing timestamp in the packet with a new timestamp corresponding to the accurate clock obtained by itself.
  • the timestamp module can be in the PCS layer or the PMA layer. In a further example, the module may also exist independently between the PCS layer and the PMA layer of the PHY chip.
  • the LPI client module 221 in the PHY chip 220 receives the message sent by the MAC chip 210 through the UI interface (not shown), the first-in first-out (FIFO) buffer 222 in the LPI client module 221 reports The text is buffered and then sent to the PCS module 224; during normal service message transmission, the message enters and leaves the FIFO buffer 222 at the same rate, which is equivalent to no message buffer; but when the network wakes up from idle, the PHY The function of the chip being turned off when idle requires a certain time to re-enable. During this time (referred to as wake-up time), the LPI client module 221 controls the FIFO buffer 222 to buffer messages from the MAC chip.
  • wake-up time the LPI client module 221 controls the FIFO buffer 222 to buffer messages from the MAC chip.
  • the PCS module 224 After receiving the message, the PCS module 224 completes the message encoding; for example, the message sent by the MAC chip 210 to the PHY chip 220 is encoded into the GMI I format by the SGMI I format. Thereafter, it is sent to the time stamp module 226.
  • the timestamp module 226 adds a tag (Tag) with timestamp (TimeSamp) information to the received message.
  • a tag As shown in FIG. 3, in addition to the Preamb le preamble, SFD, the frame start tag, the DA destination address, and the SA source address, timestamp information is added, and the message may be an event defined by the 1588 standard ( Event ) message.
  • the timestamp module 226 includes an internal phase-locked loop for synchronizing an accurate clock outside the PHY chip to generate a timestamp. This module can add a tag (Tag) with timestamp (TimeS tamp) information to the Event message defined by the 1588 standard.
  • the time stamp module can be integrated in the PCS module or the PMA module, or the module can exist independently between the PCS module and the PMA module.
  • the message with the time stamped information tag is processed by the PMA module and/or the PMD module 229 and output via the physical line.
  • the timestamp information thus serves to identify when the Ethernet device sent the message.
  • the present invention overcomes the problem that the delay of the PTP mentioned above is not fixed through the FIFO, thereby effectively ensuring the recovery frequency by using the 1588 technology. And the accuracy of time.
  • the chip 220 identifies the ⁇ message in the receiving direction of the message received from the external Ethernet device.
  • the 1588 ⁇ 2 standard defines a method for recovering time using the timestamp information in the ⁇ message, which is not repeated here.
  • the invention provides a packet processing method for an Ethernet device in the second embodiment.
  • the Ethernet device includes a PHY chip.
  • the method includes: after the Ethernet device is woken up from idle, the PHY chip receives the packet from the MAC chip, and buffers the received packet; and encodes the buffered message to add a band.
  • the tag with the timestamp information, so that the Ethernet device sends the packet; wherein the timestamp information is used to identify the time when the Ethernet device sends the packet.
  • Figure 4 is a schematic illustration of a second embodiment of the EEE and 1588 functions in accordance with a third embodiment of the present invention.
  • an alternative switch 422 is provided between the EEE LPI Clent module 424 of the PHY chip and the Mi l interface (not shown), and the switch selection action can be implemented by writing to the register.
  • the switch 422 can be placed in position 1. At this time, the message does not pass through the EEE LPI Cl ent module 424, and the message sent by the MAC chip 410 to the PHY 420 chip through the Mi l interface is not buffered, and is directly encoded and decoded by the PCS module 426, and then passed through the PMA sublayer and The PMD sublayer is processed and output by the physical line.
  • the time stamping function of the Ethernet packet is previously completed by the MAC chip 410, and the PHY chip 420 only completes the transmission of the text. At this time, the time of the Ethernet 4 through the PHY chip 420 is fixed, and the accuracy of recovering the clock frequency and time using the IEEE 1588 technology is not affected.
  • switch 422 If switch 422 is selected to only support IEEE EEE functionality, switch 422 can be placed in position 0. At this time, the message output in the sending direction passes through the LPI Clent module 424, the PCS module 426, and the FIF0428 of the PHY chip, and can complete normal EEE auto-negotiation with the peer PHY chip, and can normally enter the LPI state, saving energy.
  • the present invention provides a packet processing method for an Ethernet device in the fourth embodiment.
  • the Ethernet device includes a PHY chip
  • the PHY chip includes a low power idle control client module and a selection switch.
  • the method includes transmitting a message without a low power idle control client module when the selection switch is in the first position, and transmitting the message through the low power idle control client module when the selection switch is in the second position.

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Description

一种以太网设备处理方法和装置 技术领域
本发明涉及以太网通信。 背景技术
在以太网网络通信中， IEEE 1588功能用于实现基于以太网 4艮文的 精确时间传输。 IEEE 1588技术可以在以太网的 MAC ( Med i a Acces s Cont ro l , 媒介接入控制） 层对以太网报文打时间戳， 再利用 PHY ( Phys i ca l Layer , 物理层） 芯片传输带有时间戳的以太网报文。 IEEE 1588标准规定带有时间戳的以太网报文在 PHY芯片的传输时间小于某 一数值， 且固定不变化， 才能满足以太网对端利用带 1588时间戳报文 恢复时钟频率和时间的精确度。
而在以太网网络中有时也需要利用 EEE ( IEEE Energy Eff i c i ency Ethernet , 即节能以太网）技术来实现以太网的能源节省。 EEE原理是 利用在网络空闲时期， 关闭以太网 PHY芯片的某些功能， 不进行包括空 闲报文传输在内的报文传输。
然而， 这两种技术各有特点，在现有的以太网网络中难以同时实现。
IEEE 1588时钟传递特性是一个系统特性， 要求 phy芯片必须支持无时 延或者是时延固定。 EEE节能以太网的实现要求提供緩存器， 实现以太 网端口在低功耗空闲模式与普通模式之间的切换。
在采用 EEE技术的情况下， 当网络被再次唤醒时， 由于唤醒需要一 定的时间， 要求 PHY芯片会緩存唤醒期间的报文，因此会造成一定的报 文积累。 而如果在同样的 PHY芯片上传递 IEEE 1588时钟， 带时间戳的 1588报文也会緩存在 PHY芯片中， 就会造成带时间戳的 1588报文通过 PHY芯片的时间不确定， 影响利用 IEEE 1588技术恢复频率和时间的精 确度。
然而， 鉴于以太网设备有节能的需求并且移动承载设备的以太网端 口存在支持 IEEE 1588的趋势，因此存在着在以太网设备中同时满足支 持 IEEE 1588和 EEE的需求。 发明内容
本发明的目的是提供解决上述问题的方案。
为此， 本发明在第一方面提供一种物理层芯片。 该物理层芯片包括 物理编码子层模块、 物理媒介接入子层， 其特征在于， 所述物理芯片还 包括低功耗空闲控制客户端模块和时间戳模块， 所述低功耗空闲控制客 户端模块在所述物理层芯片从空闲中被唤醒时， 对接收到的报文进行緩 存后发送给所述物理编码子层模块； 所述物理编码子层模块对所述报文 进行编码后发送给所述时间戳模块； 所述时间戳模块对进行编码后的报 文添加带有时间戳信息的标签， 然后发送给所述物理媒介接收子模块； 其中， 所述时间戳信息用于标识物理层芯片发送所述报文的时间。
本发明在第二方面提供一种以太网设备。 该以太网设备包括媒介接 入控制芯片和如第一方面所述的物理层芯片。 当所述以太网设备从空闲 中被唤醒时， 物理层芯片接收到来自媒介接入控制芯片的报文后， 对所 述报文进行緩存； 将緩存后的所述报文进行编码后添加带有时间戳信息 的标签， 以便以太网设备发送所述报文； 其中， 所述时间戳信息用于标 识以太网设备发送所述 4艮文的时间。
本发明在第三方面提供一种以太网设备的报文处理方法。 以太网设 备包括媒介接入控制芯片和物理层芯片。 该方法的特征在于， 在以太网 设备从空闲中被唤醒时， 所述物理层芯片接收来自媒介接入控制芯片的 报文后， 对接收到的报文进行緩存； 将緩存后的所述报文进行编码后添 加带有时间戳信息的标签， 以便以太网设备发送所述报文； 其中， 所述 时间戳信息用于标识以太网设备发送所述报文的时间。
本发明在第四方面提供一种以太网设备。 该设备包括物理层芯片， 其中所述物理层芯片包括低功耗空闲控制客户端模块和选择开关； 选择 开关在第一位置时发送报文不经过低功耗空闲控制客户端模块， 在第二 位置时发送报文经过低功耗空闲控制客户端模块。
本发明在第五方面提供一种以太网设备的报文处理方法。 其中， 以 太网设备包括物理层芯片， 所述物理层芯片包括低功耗空闲控制客户端 模块和选择开关。 所述方法包括当选择开关处于第一位置时发送报文不 经过低功耗空闲控制客户端模块， 当选择开关处于第二位置时发送报文 经过低功耗空闲控制客户端模块。
本发明使 PHY芯片能同时支持 EEE功能和 1588功能。 此外， 本发 明也提供了在 EEE功能和 1588功能之间选择的机制。 附图说明
下面将参照附图对本发明的具体实施例进行更详细的说明， 其中： 图 1是根据本发明的第一实施例的以太网设备示意图；
图 2是图 1的 PHY芯片的功能模块例示图；
图 3描述了时间戳 ( T imeS tamp )信息标签（Tag )在 4艮文的组成位 置；
图 4是根据本发明第二实施例的示意图。 具体实施方式
图 1是根据本发明的第一实施例的以太网设备示意图。如图 1所示， 该以太网设备包括 PHY芯片和 MAC芯片。 该 PHY芯片和 MAC芯片通过媒 体独立接口 ( Med i a Independent Int erface，下文简称 MI I )相连， 以 实现 PHY芯片和 MAC芯片的对接。 需要说明的是， 在特定场合下， PHY 和 MAC是以同一个芯片的不同层的形式存在， 因此本发明的 PHY芯片也 应当涵盖芯片中的 PHY层的情形，同理 MAC芯片也应当涵盖芯片中的 MAC 层的情形。
MAC芯片就是媒体接入控制器。以太网 MAC由 IEEE-802. 3以太网标 准定义。 它实现了一个数据链路层， 提供寻址机构、 数据帧的构建、 数 据差错检查、 传送控制、 向网络层提供标准的数据接口等功能。 通常情 况下， MAC芯片或 PHY芯片都可实现 Mi l接口。
Mi l接口是 IEEE-802. 3定义的以太网行业标准。它包括一个数据接 口， 以及一个 MAC和 PHY之间的管理接口。 数据接口包括分别用于发送 器和接收器的两条独立信道。 每条信道都有自己的数据、 时钟和控制信 号。 例如 Mi l数据接口可以需要 16个信号。 管理接口是个双信号接口： 一个是时钟信号， 另一个是数据信号。 通过管理接口， 上层能监视和控 制 PHY。
PHY芯片是物理接口收发器， 它实现物理层功能。 物理层定义了数 据传送与接收所需要的电与光信号、 线路状态、 时钟基准、 数据编码和 电路等， 并向数据链路层设备提供标准接口。
PHY芯片按照逻辑功能分为物理编码子层（Phys i ca l Cod ing Sub-layer , 简称为 PCS) , 物理媒介接入子层（Phys ical Media Access , 简称为 PMA) , 物理媒介相关子层（Physical Media Dependent, 简称为 PMD)。
PCS子层将经过完善定义的以太网 MAC功能映射到现存的编码和物 理层信号系统的功能上去。 PMA子层提供连续不断的数据传输， 比如执 行并串 /串并转换。 PMA子层支持各种可靠的编码方案。每个 PMD子层都 可用一个编码来支持并且与特殊介质适配。 例如， 光纤收发机属于 PMD 子层。 PMD子层将信号转换到特定介质上或反向转换。
根据本发明的实施例， 在 PHY芯片与 MAC芯片连接的一侧， 在 PHY 芯片的 PCS子层之前， 按照 IEEE 802.3协议增加 EEE LPI Client ( Low Power Idle Client，低功耗空闲控制客户端）模块， 用于实现 EEE功能。 即当网络空闲时， 控制关闭 PHY芯片的某些功能， 不进行报文传输； 当 网络被再次唤醒时， PHY芯片緩存由于唤醒时间造成的 4艮文积累， 以实 现以太网端口在低功耗空闲模式与普通模式之间的相互切换。
同时， 在 PHY芯片内设置给以太网报文打时间戳的时间戳模块 （图 1中未进行标记）， 以便在 LPI Client模块的控制下对沿发送方向流出 的以太网 4艮文打时间戳。 时间戳可来源于外部提供给 PHY芯片的精确时 钟。 利用本实施例， 即使 1588报文会緩存在 PHY芯片中， 也不会造成 15884艮文通过 PHY芯片的时间不确定， 而影响利用 IEEE 1588技术恢复 频率和时间的精确度。 由此， 实现 PHY芯片既可支持 EEE功能， 又可以 同时支持 1588功能。
这里所述的发送方向是指从本以太网设备向外发送报文的方向， 即 图 1所示的从 PCS -〉 PMA向右的方向。 相应地， 本以太网设备从外部以 太网设备接收 4艮文的方向称为接收方向， 即图 1所示的从 PMA -〉 PCS向 左的方向。
上述的实施例说明的是 PHY芯片接收的报文不带有时间戳的情形。 在一个例子中， 如果 PHY芯片接收的报文已带有时间戳， 该时间戳模块 用自己获取的精准时钟对应的新时间戳替换该该报文中已有的时间戳。
在一个例子中， 该时间戳模块可以在 PCS层或 PMA层中。 在进一步 的例子中， 所述模块也可以在该 PHY芯片的 PCS层和 PMA层之间独立存 在。
将上述的 PHY芯片内部的功能子层的执行主体分别对应到 PCS模 块、 PMA模块、 PMD模块， 则本实施例的 PHY芯片的功能实现过程如图 2 所示。
PHY芯片 220中的 LPI客户端模块 221接收到 MAC芯片 210通过 ΜΠ 接口 （未图示）发送过来的报文后， 所述 LPI客户端模块 221中的先入 先出 （FIFO )緩存器 222对报文进行緩存， 然后发送给 PCS模块 224 ; 在正常业务报文传输时， 报文进入和离开 FIFO緩存器 222的速率相同， 相当于没有报文緩存； 但当网络从空闲中被唤醒时， PHY芯片在空闲时 被关闭的功能需要一定时间来重新启用， 在这段时间内 （称为唤醒时 间） ， 所述 LPI客户端模块 221控制 FIFO緩存器 222緩存来自 MAC芯 片的报文。
PCS模块 224接收到报文后， 完成所述报文编码； 例如， 把 MAC芯 片 210发送给 PHY芯片 220的 4艮文由 SGMI I格式编码成 GMI I格式。 之 后， 发送给时间戳模块 226。
所述时间戳模块 226对接收到的报文添加带时间戳（ T imeS tamp ) 信息的标签（Tag ) 。 如图 3所示， 4艮文中除了 Preamb l e前导码、 SFD; 帧起始标记、 DA目的地址和 SA源地址外， 还增加了时间戳信息， 所述 报文可以是 1588标准定义的事件（Event )报文。 其中， 所述时间戳模 块 226包括内部锁相环， 用于同步于 PHY芯片外的精确时钟， 从而用来 生成时间戳。 该模块可以对 1588标准定义的事件（ Event )报文增加带 时间戳（ T imeS tamp )信息的标签（ Tag )。 该时间戳模块可以集成在 PCS 模块或 PMA模块中， 或者， 所述模块也可以于 PCS模块和 PMA模块之间 独立存在。
添加了带时间戳信息标签的报文通过 PMA模块和 /或 PMD模块 229 处理后经由物理线路输出。 所述时间戳信息因此起着标识以太网设备发 送所述 4艮文的时间。
由于时间戳是在通过 F I F0处理后添加到报文中， 因此本发明克服 了前文提到的 PTP ^艮文通过这个 FIFO的延时也不固定的问题， 进而有 效保证了利用 1588技术恢复频率和时间的精确度。
在自外部以太网设备接收报文的接收方向上，ΡΗΥ芯片 220识别 ΡΤΡ 报文。 1588 ν2标准定义了利用 ΡΤΡ报文中的时间戳信息恢复出时间的方 法， 本文不复赘述。
需要说明， FIFO可以用其它的緩存器来替代，实现报文的緩存功能。 本发明在第二个实施例中提供一种以太网设备的报文处理方法。 所 述以太网设备包括 PHY芯片。 所述方法包括在以太网设备从空闲中被唤 醒时， 所述 PHY芯片接收来自 MAC芯片的报文后， 对接收到的报文进行 緩存； 将緩存后的所述报文进行编码后添加带有时间戳信息的标签， 以 便以太网设备发送所述报文； 其中， 所述时间戳信息用于标识以太网设 备发送所述报文的时间。
图 4是根据本发明第三实施例的示意图，它示意描述了 EEE和 1588 功能二选一的情形。
如图 4所示， 采用在 PHY芯片的 EEE LPI Cl i ent 模块 424与 Mi l 接口 （未图示）之间设置一个二选一开关 422 , 开关选择动作可以通过 写寄存器实现。
如果选择 PHY芯片 420仅支持 IEEE 1588功能， 可以把开关 422置 于位置 1。 此时 4艮文不经过 EEE LPI Cl i ent模块 424 , MAC芯片 410通 过 Mi l接口送给 PHY420芯片的报文均不会緩存， 径直由 PCS模块 426 进行编解码处理， 然后经 PMA子层和 PMD子层处理后由物理线路输出。 以太网报文打时间戳功能事先由 MAC芯片 410完成， PHY芯片 420只完 成 4艮文的传输。 此时以太网 4艮文通过 PHY芯片 420的时间固定， 不影响 利用 IEEE 1588技术恢复时钟频率和时间的精确度。
如果开关 422选择仅支持 IEEE EEE功能， 可以把开关 422置于位 置 0。 此时， 沿发送方向输出的报文经过 PHY芯片的 LPI Cl i ent模块 424、 PCS模块 426和 FIF0428等， 可以与对端 PHY芯片完成正常的 EEE 自协商， 并且可实现正常进入 LPI状态， 节省能源。
本发明在第四实施例中提供一种以太网设备的报文处理方法。 其 中， 以太网设备包括 PHY芯片， 所述 PHY芯片包括低功耗空闲控制客户 端模块和选择开关。 所述方法包括当选择开关处于第一位置时发送报文 不经过低功耗空闲控制客户端模块， 当选择开关处于第二位置时发送报 文经过低功耗空闲控制客户端模块。
显而易见， 在此描述的本发明可以有许多变化， 这种变化不能认 为偏离本发明的精神和范围。 比如， 虽然上文结合 IEEE 1588对本发 明进行了详细描述， 但是本发明可以同样应用于其它的对频率和时间 精确度有要求的场合。 因此， 所有对本领域技术人员显而易见的改变， 都包括在本权利要求书的涵盖范围之内。

Claims

权利要求
1、 一种物理层芯片， 包括物理编码子层模块、 物理媒介接入子层， 其特征在于， 所述物理层芯片还包括低功耗空闲控制客户端模块和时间 戳模块，
所述低功耗空闲控制客户端模块在所述物理层芯片从空闲中被唤 醒时， 对接收到的报文进行緩存后发送给所述物理编码子层模块；
所述物理编码子层模块对所述报文进行编码后发送给所述时间戳 模块；
所述时间戳模块对进行编码后的报文添加带有时间戳信息的标签， 然后发送给所述物理媒介接收子模块； 其中， 所述时间戳信息用于标识 物理层芯片发送所述报文的时间。
2、 如权利要求 1 所述的物理层芯片， 其特征在于， 所述时间戳模 块集成在所述物理编码子层模块或物理媒介接入子层中。
3、 如权利要求 1 所述的物理层芯片， 其特征在于， 时间戳模块包 括锁相环， 用于同步于芯片外的时钟， 从而生成所述时间戳。
4、 如权利要求 1 所述的物理层芯片， 其特征在于， 所述低功耗空 闲控制客户端模块控制关闭所述物理层芯片的部分功能。
5、 如权利要求 1、 2、 3或 4所述的物理层芯片， 其特征在于， 所 述报文是符合 I EEE 1588标准的事件报文。
6、 如权利要求 1 所述的物理层芯片， 其特征在于， 所述低功耗空 闲控制客户端模块包括緩存模块。
7、 如权利要求 6 所述的物理层芯片， 其特征在于， 所述緩存模块 是先进先出緩存器。
8、 一种以太网设备， 包括媒介接入控制芯片和权利要求 1 _ 7任一 项所述的物理层芯片， 当所述以太网设备从空闲中被唤醒时， 物理层芯 片接收到来自媒介接入控制芯片的报文后， 对所述报文进行緩存； 将緩 存后的所述报文进行编码后添加带有时间戳信息的标签， 以便以太网设 备发送所述报文； 其中， 所述时间戳信息用于标识以太网设备发送所述 4艮文的时间。
9、 一种以太网设备处理方法， 以太网设备包括媒介接入控制芯片 和物理层芯片， 所述方法的特征在于， 在以太网设备从空闲中被唤醒时， 所述物理层芯片接收来自媒介接 入控制的报文后， 对接收到的报文进行緩存；
将緩存后的所述报文进行编码后添加带有时间戳信息的标签， 以便 以太网设备发送所述报文； 其中， 所述时间戳信息用于标识以太网设备 发送所述 4艮文的时间。
10、 如权利要求 9所述的方法， 其特征在于， 所述报文是符合 IEEE 1588标准的事件报文。
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