OSCILLOSCOPE NUMERIQUE MULTIVOIES
La présente invention concerne le domaine des oscilloscopes numériques multivoies. Ces oscilloscopes numériques peuvent être constitués par un équipement autonome comprenant 1 ' ensemble des moyens électroniques et informatiques, ainsi que le moyen d'affichage. Ils peuvent aussi être constitués par une carte ou un périphérique d'ordinateur. Dans ce cas, une partie des traitements des signaux et de l'affichage est réalisée sur un ordinateur que ce périphérique transforme en oscilloscope ou en analyseur logique. De tels oscilloscopes sont parfois désignés par le terme "DSO" (Digital Storage Oscilloscope). Les signaux électriques en entrée de chaque voie sont numérisés par un convertisseur analogique numérique commandé par une horloge ou base de temps de période programmable. A chaque front descendant de l'horloge (par exemple) une conversion analogique numérique est déclenchée et l'image numérique de la tension en entrée est écrite dans la ligne de mémoire "sortie" du module d'entrée. Cette donnée est ensuite écrite dans une ligne de la mémoire de données. Les données sont écrites dans la mémoire. Lorsque les "conditions de déclenchement" sont trouvées, la saisie continue jusqu'à ce que les données correspondant à ces conditions se trouvent dans la zone de mémoire sélectionnée par un circuit de déclenchement (trigger). Une partie de la mémoire est visualisée sur un écran de visualisation, et des fonctions de défilement permettent de déplacer la partie visualisée des signaux. Pour permettre l'analyse de signaux électriques non référencés par rapport au potentiel du châssis, il est nécessaire de prévoir une isolation électrique. Les signaux
analysés sont souvent des signaux complexes, comportant une composante de faible niveau superposée à un signal porteur de tension élevée. Afin de permettre une analyse pertinente de ces signaux, il est indispensable que les moyens d'isolation n'apportent aucune perturbation détectable aux signaux.
On a proposé dans le brevet américain US5517514 de réaliser un circuit pour l'amplification du signal d'entrée à large bande d'un oscilloscope, comprenant : • un amplificateur sur un trajet à niveau bas qui amplifie la tension de signal d'entrée à large bande et transmet une partie de cette tension allant d'une composante continue à une partie à basse fréquence de cette tension au moyen d'un optocoupleur qui forme une première partie d'une barrière isolante, à un dispositif de combinaison de signaux. • un amplificateur sur un trajet à niveau haut qui amplifie la tension de signal d'entrée à large bande et transmet une partie de ce signal allant d'une basse fréquence à une fréquence élevée par 1 ' intermédiaire d ' un enroulement primaire d ' un transformateur, qui forme une seconde partie de la barrière isolante, à un dispositif de combinaison de signaux. Le dispositif de combinaison de signaux possède des premier et second enroulements secondaires du transformateur recevant la partie allant de la composante continue jusqu'à une basse fréquence et la partie allant d'une basse fréquence à une fréquence élevée de la tension de signal d'entrée amplifiée. Les premier et second enroulements secondaires coopèrent avec 1 ' enroulement primaire de manière à produire un réseau de flux magnétique sensiblement nul dans le transformateur dans la gamme
allant de la composante continue jusqu'à la haute fréquence, de la tension de signal de sortie à large bande. Les fréquences de coupures haute et basse pour les circuits BF et HF respectivement, sont en chevauchement de sorte que le dispositif de combinaison de signaux produit une tension de signal de sortie à large bande ayant une réponse en amplitude plate. Cette solution consistant à procéder à une isolation au niveau du prétraitement analogique des signaux d'entrée est certes rationnelle, et correspond à la démarche naturelle de l'homme du métier. Elle permet d'utiliser des moyens d'isolation selon des modes de fonctionnement classiques, et la solution de l'invention susvisée permet de répondre de façon satisfaisante au problème de la largeur de la bande passante des signaux à analyser. Surtout, cette solution s'impose à l'homme du métier, car elle permet de traiter ensuite de façon classique la numérisation des signaux d'entrée, après la "barrière d ' isolation" .
Cette solution n'est pas totalement satisfaisante car quelles que soient les qualités et performances des moyens d'isolations, ils introduisent des perturbations (bruit, non-linéarité) sur le signal de chacune des voies, et de la diaphonie entre les signaux de voies distinctes.
Afin de répondre à cet inconvénient, 1 ' invention concerne selon son acception la plus générale un oscilloscope numérique multivoies, comportant une pluralité d'entrées analogiques, des circuits de traitement analogique des signaux d'entrée, des circuits d'échantillonnage, de numérisation, des moyens de déclenchement et de synchronisation des différentes voies
et des moyens d'isolation électrique, caractérisé en ce que, pour N voies, N étant supérieur à 1 et au plus égal au nombre total de voies, les circuits d'échantillonnage et de numérisation au moins sont situés entre l'entrée analogique et les moyens d'isolation. Selon une première variante, il comporte des moyens de resynchronisation des traces correspondant aux signaux d'entrée comportant une machine d'acquisition maître commandant chacune des machines d'acquisition des circuits d'échantillonnage de chacune des voies. Avantageusement, ladite machine d'acquisition maître est la machine d'acquisition de l'une des voies. De préférence, ladite machine d'acquisition maître comporte une Base de Temps principale délivrant un signal temporel distribué sur chaque voie. Optionnellement, ladite Base de Temps principale est située après les moyens d'isolation (côté châssis) et délivre une horloge d'échantillonnage CLK_Ech à toutes les voies. Selon un premier mode de réalisation, lesdits moyens d'isolation sont constitués par un ensemble de transformateurs . Avantageusement, lesdits transformateurs comportent des moyens de réjection du mode commun, par exemple un blindage électromagnétique ou un bobinage avec un point milieu. Selon un deuxième mode de réalisation, lesdits moyens d'isolation comportent des opto-coupleurs . Selon un troisième mode de réalisation, lesdits moyens d'isolation comportent un ensemble d'émission- réception radiofréquence. Selon un quatrième mode de réalisation, lesdits moyens d'isolation comportent des isolateurs magnétiques à effet hall ou à magnéto-résistance.
Selon une variante, une partie au moins des données échangées entre le châssis et les voies sont multiplexées . Selon une autre variante, lesdits moyens d'isolations sont une combinaison des moyens cités ci- dessus. Selon une autre variante, deux voies au moins comportent des circuits d'échantillonnage et de numérisation constitués par une base de temps, un circuit de déclenchement sur seuil (Trigger) fournissant à la machine d'acquisition un front correspondant au franchissement du seuil de déclenchement par le signal d'entrée. Avantageusement, lesdits circuits comportent en outre une mémoire tampon pour l'enregistrement des signaux numérisés, par exemple une mémoire analogique située entre le circuit d'échantillonnage et le circuit de numérisation, une mémoire numérique située entre le circuit de numérisation et les moyens d'isolation ou une mémoire numérique située après les moyens d'isolation. De préférence, chaque voie comporte un circuit d'identification et de mémorisation de la période d'horloge correspondant au trigger (photo-trig) . Ce circuit fournissant une information numérique d'identification de la période d'horloge transmise avec les échantillons du signal de la voie correspondante Selon un mode de réalisation particulier, l'oscilloscope selon l'invention comprend en outre pour chaque voie un circuit vernier constitué par un générateur de rampe réalisant une conversation « écart de temps/écart de tension » linéaire pour fournir une information représentative de l'intervalle de temps entre le front de trigger et le front d'horloge, ladite information étant
numérisée et transmise avec les échantillons du signal de la voie correspondante. Il comprend avantageusement des moyens de resynchronisation recevant les informations conditionnelles d'au moins une voie pour fournir à la machine d'acquisition maître un top départ. Selon une variante préférée, les machines d'acquisition esclaves commandent l'échantillonnage en attente du signal de fin d'acquisition de la machine d'acquisition maître. Selon une autre variante avantageuse, il comporte pour chaque voie une alimentation indépendante isolée et régulée pour l'alimentation des circuits en amont des moyens d'isolation Selon une variante, il comporte un processeur commandant la configuration des circuits et machines d'acquisition en fonction de paramètres choisis par un utilisateur, et assurant le traitement des données de chaque voie ainsi que les informations de service, pour calculer une représentation graphique fonction des signaux acquis sur les différentes voies.
La présente invention sera mieux comprise à la lecture de la description qui suit, concernant un exemple non limitatif de réalisation se référant aux dessins annexés où : la figure 1 représente une vue schématique d'un oscilloscope selon l'invention - La figure 2 représente une vue des circuits d'entrée (seules trois voies sont représentées). - La figure 3 représente une vue schématique d'une variante de réalisation des circuits d'acquisition des signaux dans laquelle le bloc 100 bases de temps est situé au potentiel du châssis
la figure 4 représente une vue de la machine d'acquisition. la figure 5 représente le schéma de principe de l'équipement, faisant apparaître les signaux de programmation échangés entre voies et châssis. La figure 1 représente 1 ' architecture générale d'un oscilloscope selon l'invention. Sur cette figure, les blocs (1 à 6) encadrés d'un trait gras correspondent à des circuits électroniques dont la masse électrique est isolée de la masse électrique des autres circuits. On constate qu'il existe donc une masse pour le circuit principal (1), une masse par voie d'entrée (2 à 5) et une masse pour l'interface de communication (6). La masse de l'interface de communication (6) est si possible raccordée à la terre. Le circuit principal (1) regroupe les moyens de visualisation des signaux ainsi que les moyens de commande. Il comporte un circuit de traitement des données d'entrée numériques constitué par un processeur (8) et un coprocesseur (7). Le coprocesseur (7) est constitué par un composant à haute intégration VLSI reconfigurable
FPGA (Field Programmable Gâte Array). Ce circuit principal (7) comporte également : - un contrôleur d'écran (9) - une mémoire vive graphique (10) - un module graphique VGA (11) - des modules d'interface mémoire (12), sonore (14), un contrôleur de communication (15) et un clavier (16) - un module de communication sans fil (17) selon le protocole BLUETHOOTH - un circuit d'interface RS232 et ETHERNET (18).
L'alimentation électrique est conçue de façon à respecter 1 ' isolation galvanique requise pour chaque circuit. Pour ce faire, le circuit principal (1) comprend un ensemble de batteries (20) et un circuit d'alimentation (60) fournissant les différentes tensions continues et alternatives nécessaires au fonctionnement des différents circuits. Chaque voie (2 à 5) comporte un transformateur (21, 31, 41, 51) associé à un circuit redresseur et à un régulateur de tension. Le primaire de tous les transformateurs de voies (21, 31, 41, 51) est alimenté par un hacheur en pont H par l'intermédiaire de circuits d'isolation respectivement (25, 35, 45, 55). Les circuits (2 à 5) de chaque voie comportent une entrée numérique (22, 32, 42, 52) recevant le signal provenant du convertisseur analogique-digital de la voie correspondante, ainsi qu'un circuit intégré (23, 33, 43, 53) réalisant les traitements de mise à l'échelle des signaux ainsi qu'un circuit intégré (24, 34, 44, 54) assurant les fonctions de mémorisation et de séquencement (base de temps, hold off, pré-trig, post-trig, photo-trig, vernier) regroupés sous le vocable : machine d'acquisition. Chaque circuit d'entrée (2 à 5) échange des informations numériques avec le circuit principal (1) via une liaison série de type synchrone bidirectionnel. Cette liaison est isolée par l'intermédiaire d'un circuit d'isolation (26, 36, 46, 56). Ces informations numériques échangées comprennent les signaux d'acquisition échantillonnés et numérisés, qui sont transmises depuis chacune des voies vers le circuit principal, et sont complétées par des signaux numériques de service, qui sont transmis par la carte à un ou plusieurs circuits d'entrée (2 à 5).
La figure 2 représente une vue des circuits d'entrée (seules trois voies sont représentées). Dans cet exemple de réalisation, chaque voie comporte : - un convertisseur analogique digital (27, 37, 47) - un circuit de déclenchement (28, 38, 48) - une base de temps (29, 39, 49) délivrant un signal d'horloge spécifique à la voie correspondante, - un circuit de numérisation et de mémorisation (24, 34, 44). La voie synchronisante constitue la voie maître et les autres voies sont des voies esclaves. La voie maître peut être l'une quelconque des voies (2 à 5), et ce choix peut être reconfiguré par l'utilisateur à tout moment. Afin d'obtenir un positionnement précis des signaux reconstitués, la voie maître doit échanger des signaux avec les voies esclaves. La machine d'acquisition de la voie maître est celle qui commande le déclenchement et l'arrêt de l'acquisition de toutes les voies lorsque les conditions logiques sont réunies. (La profondeur d'enregistrement est atteinte etc .. ) . Chaque voie esclave, comporte dans sa machine d'acquisition un ensemble de circuits identique à celui de la voie maître mais en configuration esclave. Cette configuration restreint les fonctionnalités de la machine. Désactivation du bloc de séquencement (40 fig. 2), et du traitement du trigger effectif (30 fig. 2). Le bloc Filtrage trigger (10 fig. 2) sera utilisé dans le cas d'un déclenchement multivoies. . Alternativement, selon une variante de réalisation représentée en figure 3, une base de temps 30
(fig. 2) maître est implantée sur le circuit principal (1) et délivre un signal d'horloge CLK_Ech distribué aux différentes voies (2 à 5). La machine d'entrée est représentée en figure 4 dans une configuration préférée gère l'ensemble des signaux numériques nécessaires au déroulement d'une acquisition. La disposition des différents blocs fonctionnels de la machine vis-à-vis de la barrière d'isolation des voies, donne lieu à des variantes de la présente invention à détailler plus loin. Selon la configuration préférée, tous les blocs sauf le bloc 100 « logique déclenchement multivoies » sont dupliqués autant de fois que l'oscilloscope final comporte de voies. Ce bloc 100 est centralisé. Il est au potentiel électrique du châssis. La figure 5 représente le schéma de principe de l'équipement, faisant apparaître les signaux de programmation échangés entre voies et châssis : - D_CLOCK horloge de la liaison série : Signal particulier pour chacune des voies. - D_IN données sérialisées vers la voie : Signal particulier pour chacune des voies.
- D_OUT données sérialisées de la voie vers le châssis : Signal particulier pour chacune des voies.
Les signaux de services échangés entre voies et châssis sont les suivants :
CLK_REF horloge de référence servant à élaborer la ou les horloges d'échantillonnage CLK_Ech de chaque voie.
- CLK_Ech horloge d'échantillonnage élaboré par la base de temps 100. Ce signal peut-être soit centralisé et distribué aux voies, soit synthétisé localement sur les
voies. Dans ce cas, le signal de SYNC décrit plus loin assure la mise en phase des différents CLK_Ech.
- REQUEST Signal d'interruption de la voie vers l'unité centrale. Signal particulier pour chacune des voies.
- STOP_SYNC Ligne multiplexée commune à toutes les voies et au FPGA. Elle peut transmettre indifféremment le signal de STOP ou le top de synchronisation SYNC des bases de temps des voies lorsqu'elles sont délocalisées dans les voies. Signal bidirectionnel.
- Q_IN Qualifier ou Trigger Auxiliaire : signal issu du bloc de Logique Déclenchement Multivoies vers la voie maître. Facultatif.
- Q_OUT Qualifier ou Trigger_Filtré: signal de sortie du bloc 10 Filtrage Trigger à destination du bloc
Logique Déclenchement Multivoies. Signal particulier pour chacune des voies. Facultatif.
- EC_IO Signal partagé entre toutes les voies, bidirectionnel, permettant la signalisation de fin de comptage pour les triggers de type trig after count. Facultatif.
- A IM circuit d'alimentation en énergie des voies via un courant alternatif et des transformateurs.
Le déroulement d'une acquisition rapide (trop rapide pour que les échantillons puissent être transférés en temps réel vers l'unité centrale) met en œuvre les étapes suivantes :
Préparation : L'horloge CLK_REF étant préalablement établie sur les voies, l'unité centrale programme via la
liaison série la base de temps requise, et configure si nécessaire tous les registres des voies : calibre vertical, source et niveau de trigger, couplage, décalage en tension, etc.. L'unité centrale envoie via le FPGA sur la ligne STOP_SYNC une impulsion SYNC de synchronisation vers les voies. Cette impulsion permet le calage temporel des compteurs de base de temps propres à chaque voie. Le processeur doit également programmer la voie maître c'est-à-dire la voie qui sera sensible au trigger. Cette voie synchronise l'acquisition des autres voies via le signal de STOP. Ces deux signaux sont transmis sur la même liaison physique STOP_SYNC .
Attente du trigger L'unité centrale ordonne le départ via une commande spécifique sur la liaison série, l'acquisition commence, et le décomptage du prétrig est effectué. À la fin du prétrig, la voie maître devient sensible au trigger.
Trigger : Le premier front de trigger va faire basculer la voie maître dans le comptage du postrig. La datation du Trigger par rapport aux échantillons est assurée par les blocs Photo-Trig et Vernier.
Stop : En fin de postrig, la voie maître émet un stop sur la ligne STOP_SYNC. Le stop est émis par la voie maître vers elle-même et toutes les voies esclaves (une dans le cas de la figl) à cet instant l'acquisition est stoppée sur toutes les voies maître et esclave.
Vidage :
L'Opération de vidage est orchestrée par le circuit FPGA, elle consiste à transférer via la liaison série, l'ensemble des échantillons acquis vers la mémoire de travail de l'unité centrale. Pour ce-faire le FPGA qui pilote les liaisons séries des voies va procéder par DMA sur la mémoire de l'unité centrale.
Affichage : L'affichage est effectué à partir des informations contenues dans les échantillons transférés à l'aide d'un algorithme adapté.
Le déroulement d'une acquisition lente (les échantillons acquis sont immédiatement transférés en mémoire processeur) est décrit ci-après :
Préparation : L'unité centrale configure tous les registres des voies : calibre vertical, source et niveau de trigger, couplage, décalage en tension, etc..
Le FPGA assure le cadencement de l'échantillonnage. C'est la lecture d'échantillon courant qui engendre l'échantillonnage du suivant. Dans ce mode, les machines d'Acquisition de chaque voie génèrent l'horloge d'échantillonnage CLK_Ech à partir des trames de lecture d'échantillon émises par le FPGA. Les compteurs de base de temps des voies ne sont pas utilisés. Idem pour photo-trig et vernier.
Attente du trigger : L'unité centrale ordonne le départ via une commande spécifique sur la liaison série, l'acquisition commence, et le décomptage du prétrig est effectué. À la
fin du prétrig, la voie maître devient sensible au trigger.
Trigger : Le premier front de trigger va faire basculer la voie maître dans le comptage du postrig et engendrer un REQUEST. En fin de postrig, la voie maître émet un STOP sur la ligne STOP_SYNC.
Stop : Le STOP est émis par la voie maître vers elle-même et toutes les voies esclaves ainsi que vers le FPGA du châssis ; à cet instant l'acquisition est stoppée sur toutes les voies maître et esclave. Affichage : L'affichage est effectué à partir des informations contenues dans les échantillons transférés à l'aide d'un algorithme adapté.