TWI612420B - 硬碟提示燈的處理裝置 - Google Patents

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Abstract

一種硬碟提示燈的處理裝置，包括：第一處理器及第二處理器。第一處理器具有第一通訊接口、第二通訊接口及一第三通訊接口，第一通訊接口用以接收來自主機板的至少一通用串列輸入輸出訊號，第二通訊接口用以接收反應複數個硬碟狀態的複數個硬碟狀態資訊，第三通訊接口用以輸出串列資訊。第二處理器具有第四通訊接口及第五通訊接口，第四通訊接口電性耦接第三通訊接口並接收串列資訊，第五通訊接口電性耦接複數個硬碟提示燈，其中，第一處理器根據至少一通用串列輸入輸出訊號產生串列資訊，第二處理器根據串列資訊分別控制各硬碟提示燈的亮滅狀態。

Description

硬碟提示燈的處理裝置
本發明是屬於計算機技術領域，有關於硬碟提示燈訊號的處理，特別是一種硬碟提示燈的處理裝置。
目前的硬碟背板設計約可分為由微處理單元(Micro Control Unit, MCU)所組成的架構、主板控制器(Backplane Controller)所組成的架構或是複雜可程式邏輯裝置(Complex Programmable Logic Device, CPLD)所組成的架構。其中，MCU較難處理多組通用串列輸入輸出訊號(Serial General Purpose Input/ Output, SGPIO)的訊號。一顆MCU最多只能解譯四顆硬碟的訊號，而一顆MCU需要處理三種資料：解譯SGPIO訊號、閃爍LED及資訊傳輸。因此，假設需要支援三十二顆硬碟則必須使用八顆MCU。另外，以Backplane Controller所組成的架構在支援三十二顆硬碟時，同樣亦需使用多顆Backplane Controller，成本高且線路上的設計也較複雜。此外，CPLD雖然可處理較多組的SGPIO訊號，但CPLD的價格遠高於MCU。
前述三種架構的價格偏高且線路設計複雜，且若硬碟數量有所增減時，相對的會增加線路修改的複雜度，並且韌體(F/W)的更新也隨之複雜且耗時。
為了改善上述的缺憾，本發明提供一種硬碟提示燈的處理裝置，包括：第一處理器及第二處理器。第一處理器具有第一通訊接口、第二通訊接口及一第三通訊接口，第一通訊接口用以接收來自主機板的至少一通用串列輸入輸出訊號(SGPIO)，第二通訊接口用以接收反應複數個硬碟狀態的複數個硬碟狀態資訊，第三通訊接口用以輸出串列資訊。第二處理器具有第四通訊接口及第五通訊接口，第四通訊接口電性耦接第三通訊接口並接收串列資訊，第五通訊接口電性耦接複數個硬碟提示燈，其中，第一處理器根據至少一通用串列輸入輸出訊號產生串列資訊，第二處理器根據串列資訊分別控制各硬碟提示燈的亮滅狀態。
本發明的硬碟提示燈的處理裝置利用以第一處理器處理通用串列輸入輸出訊號，並藉由以第二處理器執行硬碟提示燈的亮滅狀態顯示，再以第二處理器提供彙整後的資訊傳輸給主機板。如此一來，僅需兩顆處理器即可支援控制多顆硬碟提示燈的亮滅狀態，而能夠降低成本，消耗功率較低，線路設計較為單純，且韌體的更新可以只針對第二處理器。再者，當硬碟數量需有所增減時，在線路的修改上也較容易。
圖1為本發明第一實施例之硬碟提示燈的處理裝置100的示意圖。請參照圖1，硬碟提示燈的處理裝置100包括：主機板30、第一處理器10及第二處理器20。第一處理器10、第二處理器20是嵌設於硬碟背板上(圖中未顯示)。在本發明的實施例中，硬碟背板係透過匯流排(Bus)與主機板30連接，匯流排例如為：周邊裝置連接快遞(Peripheral Component Interconnection Express, PCIe)或序列先進技術連接(Serial Advanced Technology Attachment, SATA)等。此外，硬碟提示燈的處理裝置100還可以包括複數個硬碟，此些硬碟係分別透過匯流排連接硬碟背板並與主機板30連接，但硬碟與硬碟背板間所傳遞的訊號資料和硬碟與主機板間所傳遞的訊號資料不同。
在第一實施例中，第一處理器10具有第一通訊接口11、第二通訊接口12及第三通訊接口13，第一通訊接口11用以接收來自主機板30的通用串列輸入輸出訊號SGPIO，第二通訊接口12用以接收反應複數個硬碟狀態的硬碟狀態資訊HDD_PRNT1~HDD_PRNTn，第三通訊接口13用以輸出串列資訊SINFO 。第二處理器20具有第四通訊接口21及第五通訊接口22，第四通訊接口21電性耦接第三通訊接口13並接收串列資訊SINFO ，第五通訊接口22電性耦接相應複數個硬碟的硬碟提示燈40。其中，硬碟提示燈40例如可為LED燈，但不以此為限。
第一處理器10根據通用串列輸入輸出訊號SGPIO產生串列資訊SINFO ，而第二處理器20接收串列資訊SINFO 並且根據串列資訊SINFO 分別控制各硬碟提示燈40的亮滅狀態。具體而言，單一個硬碟在一般情況下是藉由兩顆或三顆硬碟提示燈來顯示所屬硬碟的狀態，當多個硬碟電性耦接至主機板30時，主機板30係送出具有對應多個硬碟提示燈40的硬碟提示燈顯示資訊的通用串列輸入輸出訊號SGPIO至第一處理器10。接著，第一處理器10會將所接收到的通用串列輸入輸出訊號SGPIO分析以確認其資訊可對應到各個硬碟後，產生串列資訊SINFO 傳送給第二處理器20，第二處理器20就能根據串列資訊SINFO 分別控制各硬碟提示燈40的亮滅狀態。
其中，第一處理器10會將所接收到的通用串列輸入輸出訊號SGPIO與硬碟狀態資訊HDD_PRNT1~ HDD_PRNTn整合以產生串列資訊SINFO 。在此，硬碟狀態資訊HDD_PRNT1~HDD_PRNTn至少提供多個硬碟存在與否的資訊，進一步的，硬碟狀態資訊HDD_PRNT1~HDD_PRNTn還可以封包形式提供所對應的硬碟更多的相關資訊，且第一處理器10分別將硬碟狀態資訊HDD_PRNT1~ HDD_PRNTn與各個硬碟的硬碟提示燈顯示資訊整合以產生串列資訊SINFO 。
在一些實施例中，第二處理器20根據串列資訊SINFO 分別控制各硬碟提示燈40的亮滅狀態是藉由將各個硬碟的硬碟提示燈顯示資訊對應硬碟狀態對照表而決定硬碟提示燈40的亮滅狀態。舉例而言，第一處理器10將通用串列輸入輸出訊號SGPIO分析出多個具有三個位元的硬碟提示燈顯示資訊，其中每一硬碟提示燈顯示資訊係用以指示單一個硬碟的兩顆或三顆硬碟提示燈的硬碟狀態，再將多個硬碟提示燈顯示資訊以串列資訊SINFO 傳送給第二處理器20。
接著，第二處理器20藉由將各個硬碟的提示燈顯示資訊對應如表格1所示的硬碟狀態對照表，而決定硬碟提示燈40的亮滅狀態。在表格1中，預設硬碟提示燈顯示資訊的三個位元係分別以「0」或「1」表示，其中，硬碟狀態對照表可包括之六種硬碟狀態為：硬碟存在且在存取中的狀態(Activity)、硬碟存在且無存取狀態(No Activity)、硬碟存在並執行指令狀態(No Fail, Locate or Rebuild)、硬碟存在且存在錯誤狀態(Fail)、運作狀態(Locate)及重建狀態(Rebuild)。舉例而言，若硬碟提示燈顯示資訊的三個位元為「100」時，代表該顆硬碟的狀態為Activity，但不以此為限。在另一實施例中，硬碟提示燈顯示資訊的三個位元亦可分別以「0」、「1」或「X」表示，其中「X」代表此位元無需考量。硬碟提示燈顯示資訊的三個位元的表示方法或硬碟狀態對照表可依使用者的需求而定，並不以此為限。 表格1
Figure TWI612420BD00001
此外，如表格2所示，可預先設定六種硬碟狀態中每一硬碟狀態的資訊而使第二處理器20控制單一個硬碟的兩顆硬碟提示燈的顯示狀態，即控制「Activity LED」與「Status LED」的顯示狀態。舉例而言，當第一處理器10分析出具有三個位元的硬碟提示燈顯示資訊為「111」並傳送給第二處理器20後，第二處理器20可藉由硬碟狀態對照表，即參照表格1，而得知硬碟提示燈顯示資訊所代表的硬碟狀態為「Rebuild」，進而使第二處理器20控制兩顆硬碟提示燈的顯示狀態分別為：「Activity LED」以4Hz的頻率閃爍，而「Status LED」以1Hz的頻率閃爍。在本實施例中，表格2中的「OFF」表示硬碟提示燈為滅的狀態。然而表格2係用以舉例說明，本發明並不以此為限，本領域通常知識者應可依實際實施的需求而預先設定六種硬碟狀態之兩顆硬碟提示燈的顯示狀態的資訊。 表格2
Figure TWI612420BD00002
或者，如表格3所示，可預先設定六種硬碟狀態之每一硬碟狀態的資訊而使第二處理器20控制單一個硬碟的三顆硬碟提示燈的顯示狀態，即控制「Activity LED」、「Locate LED」與「Fail LED」的顯示狀態。在此，表格3中的「OFF」表示硬碟提示燈為滅的狀態，而「X」代表此硬碟提示燈的狀態無需考量，但不以此為限，端視使用者的需求而定。 表格3
Figure TWI612420BD00003
在一些實施例中，第一處理器10係為複雜可程式邏輯裝置(Complex Programmable Logic Device, CPLD)，而第二處理器20為微處理單元(Micro Control Unit, MCU)。或者，第一處理器10與第二處理器20皆是以微處理單元來實現。
在一些實施例中，第一處理器10解譯一組或多組的通用串列輸入輸出訊號SGPIO後，可透過積體電路匯流排（Inter-Integrated Circuit, I²C）、通用非同步收發傳輸器（Universal Asynchronous Receiver/Transmitter, UART）或串列外設介面（Serial Peripheral Interface, SPI）等傳輸介面傳輸資料給第二處理器20。
此外，主機板30可送出更新訊號SUPDATE 並透過I²C、UART、聯合測試工作組（Joint Test Action Group, JTAG）或SPI等傳輸介面而對第一處理器10或第二處理器20作韌體(F/W)的更新。值得一提的是，由於本發明主要是以第二處理器20控制硬碟提示燈40的狀態，因而韌體的更新亦可僅針對第二處理器20。
圖2為本發明之硬碟提示燈的處理裝置之另一實施態樣的示意圖。請參照圖2，硬碟提示燈的處理裝置300與硬碟提示燈的處理裝置100不同之處在於，硬碟提示燈的處理裝置300之第二處理器20還耦接複數個擴充的硬碟。詳言之，當硬碟的數量增加時，第二處理器20還可以第六通訊接口23接收來自主機板30的通用串列輸入輸出訊號SGPIO，並且以第七通訊接口24接收反應複數個擴充硬碟狀態的擴充硬碟狀態資訊HDD_PRNTn+1~ HDD_PRNTn+m。並且，第二處理器20根據來自主機板30的通用串列輸入輸出訊號SGPIO控制對應所擴充硬碟的硬碟提示燈40的亮滅狀態。也就是說，第二處理器20除了接收第一處理器10傳送的串列資訊SINFO 並根據串列資訊SINFO 分別控制各對應的硬碟提示燈40的亮滅狀態之外，第二處理器20亦可接收及解譯至少一組通用串列輸入輸出訊號SGPIO並控制相對應的硬碟提示燈40閃爍。
圖3為本發明之再一實施例之硬碟提示燈的處理裝置400的示意圖。此實施例之硬碟提示燈的處理裝置400與前述各實施例之硬碟提示燈的處理裝置不同之處在於，第一處理器10除了接收及解譯一組或多組的通用串列輸入輸出訊號SGPIO並將串列資訊SINFO 透過I²C、UART或SPI等傳輸介面傳送給第二處理器20之外，第一處理器10本身還控制部分的硬碟提示燈40閃爍。詳言之，硬碟提示燈的處理裝置400中第二處理器20根據串列資訊SINFO 而分別控制大部分的硬碟提示燈40的亮滅狀態，但第一處理器10可佐以控制少數硬碟提示燈40的亮滅狀態，以致於第一處理器10仍主要負責解譯通用串列輸入輸出訊號SGPIO，而第二處理器20仍主要負責控制大部分的硬碟提示燈40閃爍。
本發明的硬碟提示燈的處理裝置利用以第一處理器處理通用串列輸入輸出訊號，並藉由以第二處理器執行硬碟提示燈的亮滅狀態顯示，再以第二處理器提供彙整後的資訊傳輸給主機板。如此一來，僅需兩顆處理器即可支援控制多顆硬碟的硬碟提示燈的亮滅狀態，而能夠降低成本，消耗功率較低，線路設計較為單純，且韌體的更新可以只針對第二處理器。再者，當硬碟數量需有所增減時，在線路的修改上也較容易。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，因此本發明的保護範圍當視後附之申請專利範圍所界定者為準。
100、300、400‧‧‧硬碟提示燈的處理裝置
10‧‧‧第一處理器
11‧‧‧第一通訊接口
12‧‧‧第二通訊接口
13‧‧‧第三通訊接口
20‧‧‧第二處理器
21‧‧‧第四通訊接口
22‧‧‧第五通訊接口
23‧‧‧第六通訊接口
24‧‧‧第七通訊接口
30‧‧‧主機板
40‧‧‧硬碟提示燈
SGPIO‧‧‧通用串列輸入輸出訊號
HDD_PRNT1~HDD_PRNTn‧‧‧硬碟狀態資訊
HDD_PRNTn+1~HDD_PRNTn+m‧‧‧擴充硬碟狀態資訊
SINFO‧‧‧串列資訊
SUPDATE‧‧‧更新訊號
圖1為本發明第一實施例之硬碟提示燈的處理裝置的示意圖； 圖2為本發明之硬碟提示燈的處理裝置之另一實施態樣的示意圖； 圖3為本發明之再一實施例之硬碟提示燈的處理裝置的示意圖。
100‧‧‧硬碟提示燈的處理裝置
10‧‧‧第一處理器
11‧‧‧第一通訊接口
12‧‧‧第二通訊接口
13‧‧‧第三通訊接口
20‧‧‧第二處理器
21‧‧‧第四通訊接口
22‧‧‧第五通訊接口
30‧‧‧主機板
40‧‧‧硬碟提示燈
SGPIO‧‧‧通用串列輸入輸出訊號
HDD_PRNT1~HDD_PRNTn‧‧‧硬碟狀態資訊
SINFO‧‧‧串列資訊
SUPDATE‧‧‧更新訊號

Claims (13)

  1. 一種硬碟提示燈的處理裝置，包括： 一第一處理器，具有一第一通訊接口、一第二通訊接口及一第三通訊接口，該第一通訊接口用以接收來自一主機板的至少一通用串列輸入輸出訊號，該第二通訊接口用以接收反應複數個硬碟狀態的複數個硬碟狀態資訊，該第三通訊接口用以輸出一串列資訊；以及 一第二處理器，具有一第四通訊接口及一第五通訊接口，該第四通訊接口電性耦接該第三通訊接口並接收該串列資訊，該第五通訊接口電性耦接複數個硬碟提示燈； 其中，該第一處理器根據該至少一通用串列輸入輸出訊號產生該串列資訊，該第二處理器根據該串列資訊分別控制各該硬碟提示燈的亮滅狀態。
  2. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中，該第一處理器係為一微處理單元。
  3. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中，該第一處理器係為一複雜可程式邏輯裝置。
  4. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中，該第二處理器係為一微處理單元。
  5. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中，該些硬碟狀態資訊分別用以反應各該硬碟是否存在，並且該至少一通用串列輸入輸出訊號包括複數個硬碟提示燈顯示資訊，該第一處理器將該些硬碟提示燈顯示資訊與各該硬碟狀態資訊整合以產生該串列資訊。
  6. 如申請專利範圍第5項所述的硬碟提示燈的處理裝置，其中，該第二處理器接收該串列資訊後，將該些硬碟提示燈顯示資訊對應一硬碟狀態對照表而決定該些硬碟提示燈的亮滅狀態。
  7. 如申請專利範圍第6項所述的硬碟提示燈的處理裝置，其中，該硬碟狀態對照表包括：一硬碟存在且在存取中的狀態、一硬碟存在且無存取狀態、一硬碟存在並執行指令狀態、一硬碟存在且存在錯誤狀態、一運作狀態及一重建狀態。
  8. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中，部分的該些硬碟提示燈係電性耦接該第一處理器，且該第一處理器根據該至少一通用串列輸入輸出訊號控制耦接於該第一處理器的該些硬碟提示燈的亮滅狀態。
  9. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中該第二處理器更具有一第六通訊接口及一第七通訊接口，該第六通訊接口用以接收來自該主機板的另一通用串列輸入輸出訊號，該第七通訊接口用以接收反應複數個擴充硬碟狀態的複數個擴充硬碟狀態資訊，該第二處理器根據該另一通用串列輸入輸出訊號控制對應該些擴充硬碟的複數個硬碟提示燈的亮滅狀態。
  10. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中該第一處理器在解譯至少一組該通用串列輸入輸出訊號後，便透過一傳輸介面傳輸資料給該第二處理器。
  11. 如申請專利範圍第10項所述的硬碟提示燈的處理裝置，其中該傳輸介面包括是一積體電路匯流排、一通用非同步收發傳輸器或一串列外設介面。
  12. 如申請專利範圍第1項所述的硬碟提示燈的處理裝置，其中該主機板更包括送出一更新訊號並透過一傳輸介面而對該第一處理器與該第二處理器二者之至少其中之一作韌體的更新。
  13. 如申請專利範圍第12項所述的硬碟提示燈的處理裝置，其中該傳輸介面包括是一積體電路匯流排、一通用非同步收發傳輸器、一串列外設介面或一聯合測試工作組傳輸介面。
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