TWI385508B - 多相式電壓調整器系統 - Google Patents

多相式電壓調整器系統 Download PDF

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Description

多相式電壓調整器系統
本案係為一種多相式電壓調整器系統，尤指一種可隨負載之增加或減少而切換不同相位之多相式電壓調整器系統。
一般來說，電腦系統內中央處理器(CPU)的電源並不是直接由電源供應器所提供，主要原因為CPU所需的核心電壓(Vcore)是按照其負載的大小而不斷改變。由於核心電壓(Vcore)可能瞬間內增強或減弱，電源供應器是無法直接對如此突如其來的改變作出反應。為了解決此一問題，主機板上設有專為CPU供電的電壓調整器(Voltage Regulator Module，VRM)。
請參照第一圖，其所繪示為習知電腦主機板上的單相式電壓調整器(Single-Phase VRM)示意圖。單相式電壓調整器10主要包含一脈波寬度調變(Pulse Width Modulate，PWM)控制單元102、一PWM驅動單元(PWM Driver)104、一輸出單元106。其中，PWM控制單元102可以輸出一脈波信號(PWM信號)至PWM驅動單元104。
再者，PWM驅動單元104中有一引導邏輯電路(Steering Logic Circuit)1042以及二驅動電路(Driving Circuit)1044、1046。引導邏輯電路1042可根據PWM信號產生第一信號與第二信號，而二驅動電路1044、1046分別接收第一信號與第二信號後，產生第一驅動信號S1與第二驅動信號S2。
再者，輸出單元106中包含一上功率電晶體(Upper Power FET)M1、一下功率電晶體(Lower Power FET)M2、一輸出電感(Output Choke)L、一電流感測電阻(Current Sense Resistor)Rs、與一輸出電容(Output Capacitor)Co。其中，上功率電晶體M1汲極連接至一電源電壓Vcc，上功率電晶體M1閘極接收第一驅動信號S1，上功率電晶體M1源極連接至輸出電感L的第一端。下功率電晶體M2汲極連接至輸出電感L的第一端，下功率電晶體M2閘極接收第二驅動信號S2，下功率電晶體M2源極連接至接地端GND。再者，電流感測電阻Rs連接於輸出電感L的第二端與核心電壓輸出端Vcore之間。而輸出電容Co連接於核心電壓輸出端Vcore與接地端GND之間。
由於第一驅動信號S1與第二驅動信號S2的驅動，輸出電感L以及電流感測電阻Rs上會產生一輸出電流Io至核心電壓輸出端Vcore。根據輸出電流Io的大小可以得知CPU是處於高運轉負載(重載)或者是低運轉負載(輕載)。當偵測電流感測電阻RS上的感測電壓Vs而得CPU是處於重載時，PWM控制單元102可增加PWM信號的脈波寬度(Pulse Width)用以提高輸出電流Io；反之，當偵測電流感測電阻Rs上的感測電壓Vs得知CPU是處於輕載時，PWM控制單元102即減少PWM信號的脈波寬度，用以減少輸出電流Io。
電壓調整器的相位(Phase)愈多表示電壓調整器內含愈多的PWM驅動單元104與輸出單元106的組成。現今主機板上多會採用多相式電壓調整器(Multi-Phase VRM)。當CPU的負載較重時，多相式電壓調整器可提供足夠的核心電壓至CPU。
請參照第二圖，其所繪示為習知電腦主機板上的四相式電壓調整器對一CPU供電示意圖。四相式電壓調整器20主要包含一PWM控制單元202，四個PWM驅動單元204、206、208、210，與四個輸出單元212、214、216、218。
PWM控制單元202可以輸出四相脈波信號(PWM1信號、PWM2信號、PWM3信號、PWM4信號)分別至PWM驅動單元204、206、208、210。PWM驅動單元204搭配輸出單元212後可輸出具第一相位之核心電壓Vcore-1；PWM驅動單元206搭配輸出單元214後可輸出具第二相位之核心電壓Vcore-2；PWM驅動單元208搭配輸出單元216後可輸出具第三相位之核心電壓Vcore-3；PWM驅動單元210搭配輸出單元218後可輸出具第四相位之核心電壓Vcore-4。因此，CPU 22所需的核心電壓Vcore是由四相式電壓調整器20根據PWM1信號、PWM2信號、PWM3信號、PWM4信號來提供。
上述四個PWM驅動單元204、206、208、210的電路與第一圖中PWM驅動單元104的電路相同，且四個輸出單元212、214、216、218與第一圖中輸出單元106的電路相同，因此其動作原理不再贅述。
隨著電壓調整器相位數的增加，CPU的穩定度也同時提升。然而廠商也必須同時考慮電壓調整器的效率，越多相位的電壓調整器也會帶來更多的能源損耗，再加上電壓調整器在低負載下有效率偏低的問題。當CPU 22負載低於一最低負載時，CPU 22會發出一功率狀態指示器(Power State Indicator，PSI)信號，主機板即要求四相式電壓調整器20僅開啟單相位來對CPU 22供電，例如僅會以PWM驅動單元204搭配輸出單元212所輸出第一相位之核心電壓Vcore-1來對CPU 22供電，以實現電壓調整器VRM效率的較佳化。然而習用電壓調整器，僅能在四相供電與單相供電間切換(以四相式電壓調整器為例)，因此在注重節能減耗的今日，仍屬一種浪費。
本發明提供一種多相式電壓調整器系統，應用於一中央處理器，包含：一電壓調整器，連接至中央處理器，電壓調整器輸出一負載偵測電壓，且負載偵測電壓正比例於中央處理器的一實際負載；以及一相位控制電路，連接至電壓調整器，當負載偵測電壓上升至一第一電壓值時，相位控制電路輸出一第一準位相位切換信號至電壓調整器，當負載偵測電壓下降至一第二電壓值時，相位控制電路輸出第二準位相位切換信號至電壓調整器；其中，在接收第一準位相位切換信號後，電壓調整器對中央處理器所輸出之一核心電壓由N相轉為M相；在接收第二準位相位切換信號後，電壓調整器對中央處理器所輸出之核心電壓由M相轉為N相，且第一電壓值大於該第二電壓值，M大於N。
一種對中央處理器提供一核心電壓之方法，應用於一電壓調整器，該方法包含有：偵測中央處理器之一實際負載；以及若實際負載上升至一第一負載值時，電壓調整器對該中央處理器所輸出之核心電壓由N相改為M相，若中央處理器之實際負載下降至一第二負載值時，電壓調整器對中央處理器所輸出之核心電壓由M相改為N相；其中，M大於N，且第一負載值大於第二負載值。
本發明的多相式電壓調整器系統，可根據中央處理器實際的負載，對中央處理器提供不同相位之核心電壓，因此可大幅提高電壓調整器的節能效率。
請參照第三圖，其所繪示為本發明之多相式電壓調整器系統對CPU供電之方塊示意圖(以四相式電壓調整器系統為例)。多相式電壓調整器系統30主要包含一相位控制電路302與一電壓調整器304。相位控制電路302另包含一負載偵測電路3022、一第一開關電路3024、與一第二開關電路3026，其中，第一開關電路3024可根據負載偵測電路3022的驅動輸出二三相位切換信號(PWM2-3信號)至電壓調整器304；第二開關電路3026可根據負載偵測電路3022的驅動輸出三四相位切換信號(PWM3-4信號)至電壓調整器304。電壓調整器304可輸出具第一相位之核心電壓Vcore-1、具第二相位之核心電壓Vcore-2、具第三相位之核心電壓Vcore-3、具第四相位之核心電壓Vcore-4至CPU 32。
當CPU 32的負載降到最低負載時，CPU 32將發出PSI信號至電壓調整器304。電壓調整器304之一輸出電流監視腳位(Imon腳位)連接至負載偵測電路3022，其中Imon腳位可輸出一輸出電流線性電壓(Vmon)，此Vmon正比例於電壓調整器304對CPU 32所輸出之輸出電流Io(未示出)。舉例來說，當電壓調整器304對CPU 32所輸出之輸出電流Io為100A時，對應之Vmon為1V；當電壓調整器304對CPU 32所輸出之輸出電流Io為60A時，所對應之Vmon為0.6V。
本發明之多相式電壓調整器系統30即是利用負載偵測電路3022透過偵測Vmon的大小，來推算出CPU 32目前的實際負載。再藉由CPU 32目前的實際負載來驅動第一開關電路3024與第二開關電路3026的導通(ON)或截止(OFF)。第一開關電路3024與第二開關電路3026可分別輸出PWM2-3信號與PWM3-4信號至電壓調整器304。而電壓調整器304可根據PWM2-3信號與PWM3-4信號來決定對CPU 32的供電相位數。
假設在初始時CPU 32的負載為高運轉負載，此時負載偵測電路3022可根據所偵測Vmon的大小驅動第一開關電路3024與第二開關電路3026皆為截止(OFF)，使得第一開關電路3024與第二開關電路3026分別輸出之PWM2-3信號與PWM3-4信號皆為第一準位，而使電壓調整器304對CPU 32為四相供電。當負載偵測電路3022偵測出Vmon降至一第一電壓值時，即表示此時CPU 32的負載下降，此時負載偵測電路3022即可驅動第二開關電路3026為導通(ON)，而導通(ON)的第二開關電路3026輸出具第二準位之PWM3-4信號至電壓調整器304，電壓調整器304則會由原本的四相改以三相對CPU 32供電。當負載偵測電路3022偵測出Vmon持續降至一第二電壓值時，即表示此時CPU 32的負載更低，此時負載偵測電路3022即可驅動第一開關電路3024為導通(ON)，而導通(ON)的第一開關電路3024將輸出具第二準位之PWM2-3信號至電壓調整器304，由於PWM2-3信號由第一準位轉至第二準位，電壓調整器304則會由原本的三相改以二相對CPU 32供電。當CPU 32的負載持續低至最低負載時，中央處理器(CPU)32將發出PSI信號至電壓調整器304，電壓調整器304則會改以單相對CPU 32供電。
請參照第四圖，其所繪示為本發明之相位控制電路302之電路示意圖。相位控制電路302主要包含運算放大器OP1、OP2，電阻R1～R10，二極體D1、D2，與電晶體開關SW1、SW2。運算放大器OP1之正輸入端+IN1經由電阻R1連接至一第一電源電壓+3VSB，以及經由電阻R2連接至接地GND；運算放大器OP1之負輸入端-IN1用以接收由電壓調整器304所輸出之Vmon；運算放大器OP1之輸出端OUT1連接至二極體D1的陽極(Anode)且運算放大器OP1之正輸入端+IN1連接至二極體D1的陰極(Cathode)，以及經由電阻R5連接至第一電源電壓+3VSB；電晶體開關SW1之基極B經由電阻R7連接至運算放大器OP1之輸出端OUT1；電晶體開關SW1之集極C經由電阻R9連接至一第二電源電壓+5VSB，以及對電壓調整器304輸出PWM2-3信號；電晶體開關SW1之射極E連接至接地GND。
再者，運算放大器OP2之正輸入端+IN2經由電阻R3連接至第一電源電壓+3VSB，以及經由電阻R4連接至接地GND；運算放大器OP2之負輸入端-IN2用以接收由電壓調整器304所輸出之Vmon；運算放大器OP2之輸出端OUT2連接至二極體D2的陽極且運算放大器OP2之正輸入端+IN2連接至二極體D1的陰極，以及經由電阻R6連接至第一電源電壓+3VSB；電晶體開關SW2之基極B經由電阻R8連接至運算放大器OP2之輸出端OUT2；電晶體開關SW2之集極C經由電阻R10連接至第二電源電壓+5VSB，以及對電壓調整器304輸出PWM3-4信號；電晶體開關SW2之射極E連接至接地GND。
運算放大器OP1、OP2，電阻R1～R6，二極體D1、D2所組成之電路即為第三圖所示之負載偵測電路3022。電晶體開關SW1，電阻R7、R9所組成之電路即為第三圖所示之第一開關電路3024。電晶體開關SW2，電阻R8、R10所組成之電路即為第三圖所示之第二開關電路3026。
當輸出電流Io為80A，此時所對應之Vmon為0.8V。在運算放大器OP1中，由於正輸入端+IN1之電壓為0.3V(在電阻R1與電阻R2的串聯中，電源電壓+3VSB在電阻R2的分壓近似於0.3V)，且負輸入端-IN1之電壓為0.8V，因此輸出端OUT1將輸出一低準位電壓(設為0V)。此0V經由電阻R7導致電晶體開關SW1的截止(OFF)，因此，用以控制電壓調整器304二相供電與三相供電間切換的PWM2-3信號為高準位+5VSB。
在運算放大器OP2中，由於正輸入端+IN2之電壓為0.5V(在電阻R3與電阻R4的串聯中，電源電壓+3VSB在電阻R4的分壓近似於0.5V)，且負輸入端-IN2之電壓為0.8V，因此輸出端OUT2將輸出一低準位電壓(設為0V)。此0V經由電阻R8導致電晶體開關SW2的截止(OFF)，因此，用以控制電壓調整器304三相供電與四相供電間切換的PWM3-4信號亦為高準位(+5V)。(PWM2-3、PWM3-4)=(High、High)，此時電壓調整器304對CPU 32四相供電。
假設由於CPU 32負載下降，此時輸出電流Io從80A降至介於50A至30A間，例如40A。此時所對應之Vmon為0.4V。此時，用以控制電壓調整器304二相供電與三相供電間切換的PWM2-3信號仍為高準位+5VSB，在此不予贅述。然而在運算放大器OP2中，由於負輸入端-IN2之電壓已低於正輸入端+IN2之電壓，因此輸出端OUT2將輸出一高準位電壓(設為+5V)。此+5V經由電阻R8導致電晶體開關SW2的導通(ON)，因此，用以控制電壓調整器304三相供電與四相供電間切換的PWM3-4信號轉為低準位(0V)。(PWM2-3、PWM3-4)=(High、Low)，此時電壓調整器304對CPU三相供電。也就是說，一旦輸出電流Io降至低於50A，而使得運算放大器OP2之輸出端OUT2輸出一高準位電壓，本發明之相位控制電路302即可透過PWM3-4信號通知電壓調整器304由原本對CPU的四相供電改成三相供電。
假設由於CPU 32負載的持續下降，此時輸出電流(Io)從40A降至介於15A至30A，例如20A。此時所對應之Vmon為0.2V。此時，用以控制電壓調整器304三相供電與四相供電間切換的PWM3-4信號仍為低準位(+0)，在此不予贅述。然而在運算放大器OP1中，由於正輸入端+IN1之電壓已高於負輸入端-IN1之電壓，因此輸出端OUT1將輸出一高準位電壓(設為+5V)。此+5V經由電阻R7導致電晶體開關SW1的導通(ON)，因此，用以控制電壓調整器304二相供電與三相供電間切換的PWM2-3信號轉為低準位(0V)。(PWM2-3、PWM3-4)=(Low、Low)，此時電壓調整器304對CPU二相供電。也就是說，CPU的核心電流降至低於30A，而使得運算放大器OP1之輸出端OUT1輸出一高準位電壓，本發明之相位控制電路302即可透過PWM2-3信號通知電壓調整器304由原本CPU的三相供電改成二相供電。
假設由於CPU 32負載的持續下降，此時CPU 32的負載低至最低負載，亦即輸出電流Io從20A降至15A。由於CPU 32的負載低至最低負載，此時CPU 32將發出PSI信號至電壓調整器304，此時電壓調整器304會以單相位對CPU 32供電。也就是言兌，一旦CPU 32輸出PSI信號至電壓調整器304後，電壓調整器304將由原本對CPU的二相供電改成單相供電。
綜上所述，在輸出電流Io從接近滿載(例如100A)降至低於15A的過程中，在輸出電流Io高於50A前，(PWM2-3、PWM3-4)=(High、High)，此時電壓調整器304會以四相對CPU 32供電。在輸出電流Io降至介於50A與30A之間，(PWM2-3、PWM3-4)=(High、Low)，此時電壓調整器304會以三相對CPU 32供電。在輸出電流Io降至介於30A與15A之間，(PWM2-3、PWM3-4)=(Low、Low)，此時電壓調整器304會以二相對CPU 32供電。在輸出電流(Io)降至15A後，由於PSI信號的出現，此時電壓調整器304會以單相對CPU 32供電。
因此，藉由本發明之相位控制電路302，電壓調整器304可根據CPU 32的實際負載，在四相供電與三相供電、三相供電與二相供電、二相供電與單相供電間作切換，如此將可改善習用四相式電壓調整器只能在四相與單相供電間作切換。
此外，為避免由於輸出電流Io在50A附近間來回跳動而導致電壓調整器304在三相供電與四相供電間來回切換，反而造成能量的損耗，本發明之負載偵測電路3022另具有電壓遲滯功能。如第四圖所示，當輸出電流Io從高於50A降到低於50A的瞬間，亦即所對應之Vmon從高於0.5V降到低於0.5V的瞬間，運算放大器OP2之輸出端OUT2所輸出之高準位電壓(+5V)亦同時導通二極體D2，使得電阻R3與電阻R6產生並聯效應(電阻R3與電阻R6之第一端經由導通的二極體D2相連，電阻R3與電阻R6之第二端同時連接電源電壓(+3VSB))。如此一來，會造成運算放大器OP2之正輸入端(+IN2)之電壓瞬間由原本的0.5V提高至0.6V(在電阻R3先與電阻R6並聯再與電阻R4串聯的組態中，+3VSB在電阻R4的分壓近似於0.6V)。因此，一旦輸出電流Io在降到低於50A而導致電壓調整器(VRM)304由四相轉成三相對中央處理器(CPU)32供電後，輸出電流(Io)必需至少再上升至60A，才能使得運算放大器OP2之輸出端(OUT2)重新輸出一低準位電壓(0V)來截止電晶體開關SW2，使得PWM3-4信號重回高準位(+5V)而導致電壓調整器304再以四相對CPU 32供電。
請參照第五圖A，其所繪示為本發明之負載偵測電路3022所產生之電壓遲滯效果示意圖。首先，在輸出電流Io降到50A前，電壓調整器304以四相對CPU 32供電。當輸出電流Io降到50A後，電壓調整器304改以三相對CPU 32供電。當輸出電流Io回升到50A後，電壓調整器304仍以三相對CPU 32供電，而必須等到輸出電流Io升到60A後，電壓調整器304才會以四相對CPU 32供電。如此一來，藉由負載偵測電路3022所產生之電壓遲滯功能，將可避免輸出電流Io剛好在臨界點50A上下飄移而產生電壓調整器304在三相供電或四相供電間來回的切換。
同樣的，本發明之負載偵測電路3022所具有之電壓遲滯功能亦可避免輸出電流Io在30A附近來回跳動而導致電壓調整器304在二相供電與三相供電間來回切換。如第四圖所示，當輸出電流Io從高於30A降到低於30A的瞬間，亦即所對應之Vmon從高於0.3V降到低於0.3V的瞬間，運算放大器OP1之輸出端OUT1所輸出之高準位電壓(+5V)亦同時導通二極體D1，使得電阻R1與電阻R5產生並聯效應(電阻R1與電阻R5之第一端經由導通的二極體D1相連，電阻R1與電阻R5之第二端同時連接電源電壓(+3VSB))。如此一來，會造成運算放大器OP1之正輸入端(+IN1)之電壓瞬間由原本的0.3V提高至0.4V(在電阻R1先與電阻R5並聯再與電阻R2串聯的組態中，+3VSB在電阻R2的分壓近似於0.4V)，因此，一旦輸出電流Io在降到低於30A而導致電壓調整器304由三相轉成二相對CPU 32供電後，輸出電流Io必需至少再上升至40A，才能使得運算放大器OP1之輸出端OUT1重新輸出一低準位電壓(0V)來截止電晶體開關SW1，使得PWM2-3信號重回高準位(+5V)而導致電壓調整器304再以三相對CPU 32供電。
請參照第五圖B，其所繪示為本發明之負載偵測電路3022所產生之電壓遲滯效果示意圖。首先，在輸出電流(Io)降到30A前，電壓調整器304以三相對CPU 32供電。當輸出電流Io降到30A後，電壓調整器(VRM)304改以二相對CPU 32供電。當輸出電流(Io)回升到30A後，電壓調整器(VRM)304仍以二相對CPU 32供電，而必須等到輸出電流Io升到40A後，電壓調整器(VRM)304才會以三相對CPU 32供電。如此一來，將可避免輸出電流Io剛好在臨界點30A上下飄移而產生電壓調整器304在二相供電或三相供電間來回的切換。
同樣的，在輸出電流Io從低於15A不斷升至接近滿載100A的過程中，在輸出電流Io升至15A前，由於PSI信號的出現，此時電壓調整器304會以單相對CPU 32供電。在輸出電流Io升至15A後而低於40A，由於(PWM2-3、PWM3-4)=(L、L)且PSI信號的消失，此時電壓調整器(VRM)304會以二相對CPU 32供電。在輸出電流(Io)升至40A後而低於60A，由於(PWM2-3、PWM3-4)=(H、L)，此時電壓調整器304會以三相對CPU 32供電。在輸出電流Io高於60A後，由於(PWM2-3、PWM3-4)=(H、H)，此時電壓調整器304會以四相對CPU 32供電。
因此，過去習用之電壓調整器僅能依靠PSI信號在四相供電與單相供電間作切換，而透過本發明之相位控制電路302可使得電壓調整器304可根據CPU 32之實際負載，在一二相間、二三相間、與三四相間作切換。此外，透過本發明之相位控制電路302所產生之電壓遲滯效果，可避免輸出電流Io剛好在臨界點上下飄移而產生電壓調整器304在二相供電或三相供電、與三相供電或四相供電間來回的切換所造成能量的損耗。
本發明雖以四相式電壓調整器作說明，但並不以此為限，具任何相位之多相式電壓調整器皆可利用本發明之特徵達成不同相位間之切換。
綜上所述，雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作各種更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
本案圖式中所包含之各元件列示如下：
10、20、304．．．電壓調整器
102、202．．．脈波寬度調變控制單元
104、204、206、208、210．．．脈波寬度調變驅動單元
106、212、214、216、218．．．輸出單元
1042．．．引導邏輯電路
1044、1046．．．驅動電路
22、32．．．中央處理器
30．．．多相式電壓調整器系統
302．．．相位控制電路
3022．．．負載偵測電路
3024、3026．．．開關電路
M1、M2．．．功率電晶體
L．．．電感
Rs、R1、R2、R3、R4、R5、R6、R7、R8、R9、R10．．．電阻
Co．．．電容
OP1、OP2．．．運算放大器
D1、D2．．．二極體
SW1、SW2．．．電晶體開關
本案得藉由下列圖式及說明，俾得一更深入之了解：
第一圖所繪示為習知電腦主機板上的單相式電壓調整器示意圖。
第二圖所繪示為習知電腦主機板上的四相式電壓調整器對一中央處理器供電示意圖。
第三圖所繪示為本發明之多相式電壓調整器系統對一中央處理器供電之方塊示意圖。
第四圖所繪示為本發明之相位控制電路之電路示意圖。
第五圖A與B所繪示為本發明之負載偵測電路所產之電壓遲滯效果示意圖。
30．．．多相式電壓調整器系統
32．．．中央處理器
302．．．相位控制電路
3022．．．負載偵測電路
3024、3026．．．開關電路
304．．．電壓調整器

Claims (7)

  1. 一種多相式電壓調整器系統，應用於一中央處理器，包含：一電壓調整器，連接至該中央處理器，該電壓調整器輸出一負載偵測電壓，且該負載偵測電壓正比例於該中央處理器的一實際負載；以及一相位控制電路，包含，一第一開關電路，耦接於該電壓調整器；一第二開關電路，耦接於該電壓調整器；以及一負載偵測電路，耦接於該第一開關電路、該第二開關電路以及該電壓調整器，並接收該負載偵測電壓。
  2. 如申請專利範圍第1項所述之多相式電壓調整器系統，其中，當該負載偵測電壓上升至一第一電壓值時，該相位控制電路輸出一第一準位相位切換信號至該電壓調整器；當該負載電壓下降至一第二電壓值時，該相位控制電路輸出一第二準位相位切換信號至該電壓調整器。
  3. 如申請專利範圍第2項所述之多相式電壓調整器系統，其中在接收該第一準位相位切換信號後，該電壓調整器對該中央處理器所輸出之一核心電壓由N相轉為M相；在接收該第二準位相位切換信號後，該電壓調整器對該中央處理器所輸出之該核心電壓由M相轉為N相，且該第一電壓值大於該第二電壓值，M大於N。
  4. 如申請專利範圍第3項所述之多相式電壓調整器系統， 其中N大於等於2。
  5. 如申請專利範圍第1項所之多相式電壓調整器系統，其中當該實際負載降至一最低負載時，該電壓調整器對該中央處理器所輸出之該核心電壓轉為單相。
  6. 一種對中央處理器提供一核心電壓之方法，應用於一電壓調整器，該方法包含有：偵測該中央處理器之一實際負載；以及若該實際負載上升至一第一負載值時，該電壓調整器對該中央處理器所輸出之該核心電壓由N相改為M相，若該中央處理器之該實際負載下降至一第二負載值時，該電壓調整器對該中央處理器所輸出之該核心電壓由M相改為N相；其中，M大於N，且該第一負載值大於該第二負載值。
  7. 如申請專利範圍第6項所述之對中央處理器提供核心電壓之方法，其中更包含當該中央處理器的負載降至一最低負載值時，該電壓調整器對該中央處理器所輸出之該核心電壓由二相改為單相；當該中央處理器的負載超過該最低負載值時，該電壓調整器對該中央處理器所輸出之該核心電壓由單相改為二相；且該最低負載值低於該第二負載值。
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