TWI278810B - Capacitive load driving circuit for driving capacitive loads such as pixels in plasma display panel, and plasma display apparatus - Google Patents

Capacitive load driving circuit for driving capacitive loads such as pixels in plasma display panel, and plasma display apparatus Download PDF

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TWI278810B
TWI278810B TW094107124A TW94107124A TWI278810B TW I278810 B TWI278810 B TW I278810B TW 094107124 A TW094107124 A TW 094107124A TW 94107124 A TW94107124 A TW 94107124A TW I278810 B TWI278810 B TW I278810B
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Makoto Onozawa
Shigetoshi Tomio
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Fujitsu Hitachi Plasma Display
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Description

1278810 九、發明說明： 【發明所屬技術領域】 相關申請案之交互參照 ▲本案係基於前案日本專利申請案第2〇〇4-!47752號，申 5請日2GG4年5月18日且請求該案之權益，職全文内容以引 用方式併入此處。 發明領域
本發明係有關-種電容性負載驅動電路及一種電㈣ 不裔裝置，更特別係有關一種於電衆顯示器面板(pDp)驅動 諸如像素之電容性負栽驅動電路，以及也關於一種電聚顯 示器裝置。 C 前:椅；j 發明背景 近年來，電漿顯示器裝置已經於商業上實作為薄型顯 不裔裝置。此處，於電漿顯示器面板驅動諸如像素之電容 Φ 丨生負載之電谷性負載驅動電路，當延遲時間使用延遲電路 调整時’可改變維持脈波之脈波寬度。舉例言之，若延遲 脈波之脈波寬度加大，則可能導致時間邊際縮小、出現異 ¥電流等。#反地’若維持脈波之脈波寬度縮Λί、，則雜訊 2〇可能豐加至維持電壓之上升波形及下降波形，其可能縮小 電漿顯示器裝置之操作邊際，且可能造成螢幕的閃爍。 因此希望提供一種電容性負載驅動電路，該電路經由 減少當使用延遲電路調整延遲時間之情況下可能出現之輸 出脈波寬度變化，而供給適當輸出電壓給該電容性負載。 5 1278810 也希望提供一種電漿顯示器裝置，其可對電漿顯示器面板 提供驅動電壓，而無時間邊際縮小、出現異常電流、雜訊 疊加等問題。 於先前技術，提示一種電漿顯示器裝置，其具有維持 5電路設計成可消除維持脈波之上升/下降時間及形狀之變 化，藉此可達成低功率消耗，同時避免功能異常(例如曰本 專利公開案第 2001-282181 號:EP1139323-A2)。 於先前技術，也提示一種電敷顯示器面板之驅動裝 置、驅動方法及驅動電路，其目的係為了經由降低驅動裝 10 置所含之各種元件之崩潰電壓來簡化電路組配結構及降低 製造成本（例如曰本專利公開案第2002-062844 號:US-6686912-B1)。 此外於AC PDP之驅動裝置，若電源回復電路無法適當 操作，則驅動裝置之輸出耗損增加，形成該驅動裝置之各 15 個組成元件所產生之熱量增加；為了解決此項問題，先前 技術提出一種電漿顯示器裝置，其無需經由使用高崩潰電 壓元件來組成驅動裝置，而仍可防止於電源回復電路功能 異常之情況下諸如元件崩潰所造成之損害（例如日本專利 公開案第 2002-215087號:US-2002/0097203-A1)。 20 先前技術及其相關問題於後文將參照附圖說明。 【發明内容】 發明概要 根據本發明提供一種電容性負載驅動電路，包含一輸 入端；一前緣延遲電路，其延遲經由該輸入端輸入之一輸 1278810 入信號前緣；一後緣延遲電路，其係延遲該輸入信號後緣； 一放大電路，其係放大經由該前緣延遲電路及該後緣延遲 電路所得之驅動控制信號；以及一輸出切換裝置，其係經 由該放大電路所驅動，其中該前緣延遲電路包括一第一時 5 間常數電路，其包含一第一電阻器及一第一電容器；該後 緣延遲電路包括一第二時間常數電路，其包含一第二電阻 器及一第二電容器；以及該驅動控制信號係經由一信號組 合電路所產生，其係組合該第一時間常數電路之輸出信號 與該第二時間常數電路之輸出信號。 10 一緩衝電路可設置於第一時間常數電路及第二時間常 數電路之任一者或二者個別之前端。信號組合電路可為及 閘。前緣之延遲時間可經由調整第一時間常數電路之第一 電阻器值而調整；後緣之延遲時間可經由調整第二時間常 數電路之第二電阻器值而調整。前緣之延遲時間可經由調 15 整第一時間常數電路之第一電容器值而調整；後緣之延遲 時間可經由調整第二時間常數電路之第二電容器值而調 整。 此外，根據本發明，提供一種用於矩陣定址平板顯示 器裝置之電容性負載驅動電路，該電路施加載明之電壓至 20 形成一顯示器元件之一電容性負載，該驅動電路包含一第 一信號線，其供給一第一電位給該電容性負載之一端；一 第一切換元件，其供給該第一電位至該第一信號線；一第 一驅動電路，其驅動該第一切換元件；一第二切換元件， 其供給一第二電位至該第一信號線；一第二驅動電路，其 1278810 驅動該第二切換元件；一第二信號線，其供給一第三電位 至該電容性負載之一端，該第三電位係與該第一電位不 同；一第一電容器連結於該第一信號線與該第二信號線 間，且可供給比第一電位及第二電位更低之電位給第一信 5 號線；一第三切換元件，其供給該第二電位給該第二信號 “線；一第三驅動電路，其驅動該第三切換元件；一第四切 換元件，其連結該第一信號線至該電容性負載之一端；一 第四驅動電路，其係驅動該第四切換元件；一第五切換元 # 件，其係連結該第二信號線至該電容性負載之一端；一第 10 五驅動電路，其係驅動該第五切換元件；以及一線圈電路， 其係連結於該第一信號線及第二信號線中之至少一者與供 給第二電位之一電源線間，其中該電容性負載驅動電路進 一步包括，於該第一驅動電路至第五驅動電路之一之前 端，一輸入端；一前緣延遲電路，其延遲經由該輸入端輸 15 入之一輸入信號前緣；以及一後緣延遲電路，其係延遲該 輸入信號後緣。 ^ 該輸入端、該延遲經由輸入端輸入之輸入信號前緣之 前緣延遲電路、以及該延遲輸入信號後緣之後緣延遲電路 可設置於第一驅動電路之前端。電容性負載驅動電路進一 20 步於該第二驅動電路之前端包括一輸入端，以及一延遲經 由該輸入端輸入之輸入信號前緣之前緣延遲電路。該電容 性負載驅動電路進一步於該第五驅動電路之前端包括一輸 入端，以及一延遲經由該輸入端輸入之輸入信號前緣之前 緣延遲電路；以及也包括於該第二驅動電路及第四驅動電 1278810 路各自之前端，一輸入端，以及—延遲經由該輸入端輸入 之輸入信號前緣之前緣延遲電路。 該第三切換元件可包含一電流輸出元件及一電流輸入 元件；以及該第三驅動電路可包含一電流輸出元件驅動電 5路其係驅動該電流輸出元件，以及包含一電流輸入元件驅 動電路其係驅動該電流輸入元件。電流輸出元件可為P通道 功率MOSFET，以及電流輸入元件可為^^通道功率M0SFET 或 IGBT。 延遲欲供給該電流輸出元件驅動電路之驅動信號前緣 10 之刚緣延遲電路、以及延遲欲供給該電流輸出元件驅動電 路之驅動信號後緣之後緣延遲電路可設置於該電流輸出元 件驅動電路之前端。延遲欲供給對應之驅動電路之驅動信 唬刖緣之4緣延遲電路、以及延遲欲供給對應驅動電路之 驅動後緣之後緣延遲電路可設置於該第一驅動電路、 15第-驅動電路、第四驅動電路、第五驅動電路、電流輸出 it件電路、及電流輸人元件驅動電路各自之前端。 〃’緣延遲電路可包括_第—時間常數電路，其包含 Γ 士 =阻器及一第一電容器；該後緣延遲電路包括一第 ^ ^數電路，其包含_第二電阻器及_第二電容器； 20 以及欲供认楚 弟—驅動電路至第五驅動電路之驅動控制信號 各自係緩由一扣 A第一昉 &旒組合電路而產生，該信號組合電路係细 ^栌日t間常數電路之輸出信號與第二時間常數電路之輕 二。緩衝電路可設置於第—時間常數電路及第二時段 申支”路之任〜者或二者各自之前端。 9 1278810 該信號組合電路可為及閘。前緣之延遲時間可經由調 整第一時間常數電路之第一電阻器值而調整；後緣之延遲 時間可經由調整第二時間常數電路之第二電阻器值而調 整。前緣之延遲時間可經由調整第一時間常數電路之第一 5 電容器值而調整；後緣之延遲時間可經由調整第二時間常 數電路之第二電容器值而調整。 一閘極耦合器係經由使用一發光元件、一光接收元 件、以及一放大電路組成，該閘極耦合器可用於第一驅動 電路至第五驅動電路中之至少一者。該閘極耦合器可個別 10 用於第四驅動電路及第五驅動電路。該閘極耦合器可個別 用於第一驅動電路、第二驅動電路、第四驅動電路及第五 驅動電路。 根據本發明也提供一種電漿顯示器裝置，包含多個X 電極；多個Y電極，Y電極係實質上平行於該多個X電極排 15 列，且介於多個Y電極與多個X電極間產生放電；一X電極 驅動電路，其係施加放電電壓至該多個X電極；以及一Y電 極驅動電路，其係施加放電電壓至該多個Y電極，以及其中 該X電極驅動電路或該Y電極驅動電路係使用電容性負載 驅動電路組成，其中該電容性負載驅動電路包含一輸入 20 端；一前緣延遲電路，其延遲經由該輸入端輸入之一輸入 信號前緣；一後緣延遲電路，其係延遲該輸入信號後緣； 一放大電路，其係放大經由該前緣延遲電路及該後緣延遲 電路所得之驅動控制信號；以及一輸出切換裝置，其係經 由該放大電路所驅動，其中該前緣延遲電路包括一第一時 10 1278810 間常數電路，其包含一第一電阻器及一第一電容器；該後 緣延遲電路包括一第二時間常數電路，·其包含一第二電阻 器及一第二電容器；以及該驅動控制信號係經由一信號組 合電路所產生，其係組合該第一時間常數電路之輸出信號 5 與該第二時間常數電路之輸出信號。 此外，根據本發明也提供一種電漿顯示器裝置，包含 多個X電極；多個Y電極，Y電極係實質上平行於該多個X 電極排列，且介於多個Y電極與多個X電極間產生放電；一 X電極驅動電路，其係施加放電電壓至該多個X電極；以及 10 一Y電極驅動電路，其係施加放電電壓至該多個Y電極，以 及其中該X電極驅動電路或該Y電極驅動電路係使用電容 性負載驅動電路組成，該驅動電路施加一載明之電壓至形 成一顯示器元件之一電容性負載，其中該電容性負載驅動 電路包含一第一信號線，其供給一第一電位給該電容性負 15 載之一端；一第一切換元件，其供給該第一電位至該第一 信號線；一第一驅動電路，其驅動該第一切換元件；一第 二切換元件，其供給一第二電位至該第一信號線；一第二 驅動電路，其驅動該第二切換元件；一第二信號線，其供 給一第三電位至該電容性負載之一端，該第三電位係與該 20 第一電位不同；一第一電容器連結於該第一信號線與該第 二信號線間，且可供給比第一電位及第二電位更低之電位 給第一信號線；一第三切換元件，其供給該第二電位給該 第二信號線；一第三驅動電路，其驅動該第三切換元件； 一第四切換元件，其連結該第一信號線至該電容性負載之 11 1278810 一端；一第四驅動電路，其係驅動該第四切換元件；一第 五切換元件，其係連結該第二信號線至該電容性負載之一 端；一第五驅動電路，其係驅動該第五切換元件；以及一 線圈電路，其係連結於該第一信號線及第二信號線中之至 5 少一者與供給第二電位之一電源線間，其中該電容性負載 驅動電路進一步包括，於該第一驅動電路至第五驅動電路 之一之前端，一輸入端；一前緣延遲電路，其延遲經由該 輸入端輸入之一輸入信號前緣；以及一後緣延遲電路，其 係延遲該輸入信號後緣。 10 該電容性負載驅動電路可為一維持電路，其係於一段 維持期間供給維持脈波給一電漿顯示器面板。該電容性負 載驅動電路可為一掃描電路，其於一段掃描期間供給掃描 脈波給一電漿顯示器面板。該電容性負載驅動電路可為一 維持/掃描共通電路，其係於一段維持期間供給維持脈波給 15 一電漿顯示器面板，以及於一段掃描期間供給掃描脈波給 一電漿顯示器面板。 圖式簡單說明 由後文參照附圖陳述之較佳具體例之說明將更了解本 發明，附圖者： 20 第1圖為概略組態圖，示意顯示可應用本發明之電漿顯 示器裝置； 第2圖為略圖，顯示用於驅動第1圖所示電漿顯示器裝 置之波形圖； 第3圖為概略組態圖，示意顯示可應用本發明之電漿顯 12 1278810 示器裝置之另一實施例； 第4A及4B圖為略圖，顯示於第3圖所示電漿顯示器裝 置，於維持放電期間所施加之驅動波形圖； 第5圖為電路圖，顯示先前技術之電漿顯示器裝置使用 5 之維持電路之一實施例； 第6圖為電路圖，顯示第5圖所示維持電路之延遲電路 之一實施例； 第7A、7B、7C及7D圖為略圖，說明於先前技術之維持 電路之放大電路，臨限值電壓與輸出脈波寬度間之關係； 10 第8A、8B及8C圖為略圖，說明於先前技術之維持電 路，延遲時間與輸出脈波寬度間之關係； 第9圖為略圖，顯示於先前技術之維持電路，當輸出脈 波寬度為大時之操作波形圖； 第10圖為略圖，顯示於先前技術之維持電路，當輸出 15 脈波寬度為小時之操作波形圖； 第11圖為方塊電路圖，顯示根據本發明之電容性負載 驅動電路之一實施例之概略組態； 第12圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第一具體例之主要部分； 20 第13圖為略圖，說明第12圖所示電容性負載驅動電路 之操作； 第14圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第二具體例之主要部分； 第15圖為電路圖，顯示根據本發明之電容性負載驅動 13 1278810 電路之第三具體例之主要部分； 第16圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第四具體例之主要部分； 第17圖為電路圖，示意顯示根據本發明之電容性負載 5 驅動電路之另一實施例之概略組態； 第18圖為略圖，說明第17圖所示電容性負載驅動電路 之操作； 第19圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第五具體例； 10 第20圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第六具體例； 第21圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第七具體例； 第22圖為電路圖，顯示根據本發明之電容性負載驅動 15 電路之第八具體例；以及 第23圖為電路圖，顯示根據本發明之電容性負載驅動 電路之修改例。 L賓方式]3 較佳實施例之詳細說明 20 近年來，電漿顯示器面板(PDP)已經於商業上實作為顯 示器面板來替代傳統的陰極射線管（CRT)，原因在於電漿顯 示器由於可自行發光性質因而可提供絕佳可視性，結構 薄，因而可達成大螢幕且快速回應之顯示。 於說明根據本發明之電容性負載驅動電路及電漿顯示 14 1278810 器裝置之較佳具體例之細節之前，後文將參照附圖說明根 據先前技術之電容性負載驅動電路及電漿顯示器裝置及其 相關問題。 第1圖為概略組態略圖，示意顯示應用本發明之電漿顯 5 示器裝置；此處所示電漿顯示器裝置為習知三電極表面放 •電式交流電漿顯示器裝置。第i圖中，參考號碼10為PDP、 11為第一電極(X電極）、12為第二電極(γ電極）、13為定址 電極以及14為掃描驅動器。 _ 如第1圖所示，於習知PDP 10, η個X電極11以及相等數 10目之Υ電極12(Υ1至γη)係彼此交錯以交插方式排列，形成 各由一個X電極11及其相鄰γ電極12組成之η對電極，於各 對X電極11與Υ電極12間引發放電造成發光。γ電極及X電 極被稱作為顯示電極；偶爾也稱作為維持電極。^個定址電 極13(Α1至Am)係與顯示電極成直角配置，一個顯示器單元 15形成於各個定址電極13與各對X電極η及γ電極丨2間之交 叉點。 ® Y電極12係連結至掃描驅動器14。掃插驅動器14包括開 關16，開關16之數目係等於γ電極之數目，關狀切換方 式讓來自-掃描信號產生電路15之掃描脈波於一段定址期 2〇間循序施加；以及讓來自γ維持電路19之維持脈波於一段維 持放電期間同時施加。Χ電極1]t係共通連結至乂維持電路 以及定址電極⑽連結至定址.鴨扣。影像信號處 理電路係於將影像信號轉換成為可於電浆顯示器裝置内 部處理之形式後，供給影像信號給定址電路17。一驅動控 15 1278810 制電路20產生且供給信號，該信號係用來控制該電漿顯示 器裝置之各個零組件。 第2圖為略圖，顯示驅動第1圖所示電漿顯示器裝置之 波形圖。 5 該電漿顯示器裝置係經由以預定時間間隔重新整理晝 面來顯示一畫面，一段顯示期稱作為一攔位。為了達成灰 階顯示，一欄位進一步被劃分成為多個子欄位，經由對各 個顯示單元之發光組合多個子欄位來產生該顯示。各個子 欄位係由一段復置期、一段定址期、及一段維持放電（維持) 10 期組成，於該復置期間全部顯示器單元皆被初始化；於該 定址期間全部顯示器單元皆被設定為對應於欲顯示之影像 之狀態；以及於該維持期間各個顯示器單元係根據如此設 定之狀態發光。於該維持放電期間，維持脈波係以交替方 式施加至X電極及Y電極，造成於定址期間已經被設定的顯 15 示器單元出現維持放電而發光，如此可維持由顯示單元發 光。 於該電漿顯示器裝置，於維持放電期間，需要以高頻 脈波形式，介於電極間施加最高約200伏特電壓；特別於使 用子欄位顯示體系之灰階顯示器情況下，脈波寬度為數微 20 秒。因電漿顯示器裝置係藉如此高電壓、高頻信號驅動， 故電漿顯示器裝置通常耗電量大，希望降低電漿顯示器裝 置之耗電量。 第3圖為概略組態圖，示意顯示應用本發明之電漿顯示 器裝置之另一範例；此處顯示揉用稱作為ALIS(表面交替點 16 1278810 亮）方法之電漿顯示器裝置。 如第3圖所示，於採用ALIS方法之PDP，η個Y電極（第 二電極）12-0及12-Ε及(η+1)個X電極（第一電極）1]μ〇Α1]μΕ
10 15 以交插方式交錯排列，介於每個相鄰顯示電極(γ電極與χ 電極）間造成顯示用發光。如此使用（2η+1)顯示電極，形成 2η顯示線。換言之ALIS方法經由使用第丨圖組配結構使用之 實質相等數目之顯示電極，可達成兩倍高之解析度。此外， 由於可有效使用放電空間，由於被電極等阻擋之光量減 少，故该方法具有可達成尚開口率因而達成高亮度之優 點。於ALIS方法，每個相鄰顯示電極間之空間係用來產生 顯示用放電，但此種放電並非跨整個螢幕同時出現。因此 採用所謂之交插掃描技術，其經由以時間分割方式掃描奇 編號線及偶編號線而產生_。換言之，於奇編號搁位， 奇編號線被賴’而於偶編號攔位偶職線被掃描，如此 經由組合奇編額位產生之_與偶編蘭位產生之顯示 而獲得完整顯示。 4
20 Y電極係連結至掃描驅動器14。掃描驅動器14包括開關 16，開關16之切換方式為—波係於定址期間循序施 加，而於_放電_，奇錢Yf極㈣錢結至第—Y 維持電路19-0,以及偶編號γ電極12_祕連結至第二Y 電路㈣。此時，奇編_極110係連結至第—X維 路㈣，以及偶職X電極叫係連結至第二χ Γ。定址電極13係連結至定㈣動㈣。影像信號^ 祕21及驅動控制電路2G係進行如同前文參照第！圖說明 17 1278810 之相同操作。 々β第圖為略圖，顯示於第3圖所示電漿ι貝干 器裝置，於維持放，如。q 圃/r丁电水頜不 & J間施加之驅動波形圖：第4A圖顯示奋 編號欄位之波形圖， 一 5
10 及弟4B圖顯示偶編號搁位之波形 圖。於奇編號欄位，雷反形 ^MVs施加至電極γι及χ2,同時維持 電極XI及Y2於地電位，如此造成電極χι與間以及電極 X2與Y2間出現放電，換言之奇編號顯示線出現放電。此時 於電極Y1與X2間之偶編號顯示線並未出現放電，原因在於 -電極間之電位差為零。同理，於偶編號攔位，電壓％施 加至電極XI及Y2，同時維持電極Υ1ΑΧ2於地電位，如此 造成電極Υ1與XI間以及電極丫2與]^2間出現放電，換言之 偶編號顯不線出現放電。此處不說明復置期及定址期之驅 動波形。 於先前技術，提出一種電漿顯示器裝置，其具有維持 15電路設計成可消除維持脈波之上升/下降時間及形狀變 化，藉此達成低耗電量，同時避免功能的異常(例如曰本專 利公開案第 2001 -282181 :ΕΡ-1139323-Α2)。 第5圖為電路圖，顯示先前技術電漿顯示器裝置使用之 維持電路(電容性負載驅動電路)之範例；此處所示維持電路 20 具有電源回復電路，其中回復電力之回復電路係與施加儲 存電力之施加電路分開。也設置產生信號VI至V4之電路， 但未顯示於此處。參考符號Cp表示於PDP(10)介於X電極與 Y電極間所形成之顯示器單元之驅動電容器（電容性負 載）。第5圖中，顯示電極之一之維持電路，但須注意可對 18 1278810 另一電極提供類似之維持電路。 首先，不含電源回復電路之維持電路包含切換元件（維 持輸出元件:η通道MOS電晶體）31及33、放大電路（驅動電 路)32及34及延遲電路（前緣延遲電路)51及52;另一方面， 5 電源回復電路包含切換元件37及40、放大電路38及41、及 延遲電路(前緣延遲電路)54及53。 輸入信號VI及V2係經由個別延遲電路51及52輸入放 大電路32及34 ;由個別放大電路32及34輸出之信號vgi及 VG2供給個別切換元件31及33之閘極。此處，當輸入信號 10 VI係於高位準「Η」時，切換元件31被導通，高位準「Η」 信號施加至電極(X電極或Υ電極）。此時，輸入信號V2係於 低位準「L」，因此切換元件33為OFF。於輸入信號VI變成 低位準「L」之同時，造成切換元件31的關斷，輸入信號 V2變成高位準「H」，造成切換元件33被導通，如此接地位 15 準電位施加至該電極。 另一方面，當於具有電源回復電路之維持電路施加維 持脈波時，於輸入信號VI變成高位準「H」前，輸入信號 V2變成低位準「L」，如此造成切換元件33被麟；隨後輸 入_V3進人高位準「H」，且切換元件爾導通，經由電 容器39、二極體42、線圈（電感)43及電容叫形成譜振= 路，儲存於電容H39之電力被供給電極，造成電極電位的 升南。恰在電極電位升高結束前，輸人信號V3進入低位準 「L」，造成祕it件40的_ ;且_，輸人信Ενι進人 高位準「H」，造成切換元件31的導通，如此維持電極電位 19 1278810 固定於Vs。 田、准持脈波之施加結束時，首先，輸入信號νι進入低 位準「L」，如此造成切換元件31之關斷；隨後，輸入信號 V4變成高位準「H」以及切換元件37導通，經由電容器39、 5 —極體36線圈35及電容nq形絲振電路，儲存於電容 為Cp之電荷供給電容器39，如此造成電纟器％之電壓升 回。藉此方式藉施加至該電極之維持脈波儲存於電容器Cp 之電力被回復，且儲存於電容器39。恰在電極電位下降結 束前，輸入信號V4進入低位準「L」，造成切換元件37之關 H)斷’以及同時’輸人信號V2進人高位準「H」，造成切換元 件33之導通，如此維持電極電位固定於地電位。於維持放 電期，前述操作重複與維持脈波同等多次。使用前述組配 結構，可減少與維持放電關聯之電力消耗。 第6圖為電路圖，顯示第5圖所示維持電路中之延遲電 15 路範例。 如第6圖所示，延遲電路51(52至54)為延遲經由輸入端 輸入之輸入#號V1(V2至V4)之前緣之電路，包含延遲電路 51(52至54)包含一電阻器（可變電阻元件）R及一電容器（電 容元件)C，且經由改變電阻器R之電阻值而控制輸入信號之 20延遲時間。換言之，延遲電路51、52、53及54補償於隨後 階段連結之個別放大電路32、34、41及38之延遲時間之變 化，藉此調整欲施加至各個切換元件之驅動脈波位相，讓 切換元件31、33、40及37可於適當時序被驅動。 如此變成可供給正確時序之維持脈波給電漿顯示器面 20 1278810 板’同時抑制由於放大電 量的增高。 路之延遲時間變化所造成 之耗電 =、7B、7C及_為略圖，說明於先前技術維持電 放大電路之臨限值電壓與輸出脈波寬度間之關係’更 特礼兒明别文簽照第5圖所述維持電路相關之問題。此外 第8A、犯及叱圖為略圖，說明於先前技術維持電路，延遲 ㈣與輸出脈波寬度間之關係；以及第9圖為略圖，顯示於 先前技術維持電路，當輸出脈波寬度大時之操作波形圖。' 第7A圖顯示驅動一個切換元件（31)之主要電路部分 1〇 (延遲電路51及放大電路32);此處，第6圖之電路組配結二 係採用於第5圖所示維持電路之延遲電路(51)。於第7a圖之 電路中，Vin(Vl)表示輸入信號，Vrc表示於延遲電路^之 電阻器R與電容器C間之連結節點之電壓，vth表示放大電 路32之臨限值電壓，以及v〇表示放大電路之輸出電壓。個 15別電壓Vin、Vrc、Vth、及之波形圖顯示於第7B至7D圖。 為求說明簡單，放大電路32之延遲時間假設為零。前文說 明也適用於使用其它延遲電路（52、53及54)及放大電路 (34、41及38)組成之主要電路部分。 首先，當放大電路32之臨限值電壓Vth為 20 Vth=Vthl=Vcc/2時，此處Vcc為輸入信號Vin之高位準rH」 電壓，通過電阻器R及電容器C之前緣(上升緣)之延遲時間 Τ1係等於後緣（下降緣）之延遲時間Τ2。如此，輸入信號之 脈波寬度Twin係等於放大電路32之輸出信號Vo之脈波寬度 Two。即使經由增加延遲電路51中之電阻器R之電阻值，來 21 1278810 延長延遲時間τι時，脈波寬度Two維持恆定(參考第8人圖）。 其次，當臨限值電壓Vth為Vth=Vth2<Vcc/2時，輸出波 形圖係如第7D圖之虛線顯示，換言之T1<T2，因此 Twin<Two。此種情況下，Τ1與Two間之關係為如第8Β圖所 5示，輸出信號ν〇之脈波寬度Two係隨著延遲時間T1之增加 而增加。則第5圖所示維持電路之個別信號之波形圖係如第 9圖之虛線顯示。第9圖中，實線顯示Twin=Tw〇之波形圖。 結果如第9圖所示，由信號VG2下降時間至信號VG1升 南時間容許之時間邊際TM1縮小，以及由信號VG1下降時 10間至信號VG2升高時間容許之時間邊際TM2縮小。提供時 間邊際TM1及TM2係為了防止切換元件3i(切換元件cu)及 33(CD)同時導通，且造成流過擊穿電流。此種時間邊際的 縮小將導致電路可靠度的劣化。 此外’如第9圖所示，因由信號VG2下降時間至信號 15 VG3上升時間之時間邊際TM3、以及由信號VG1下降時間至 信號VG4升高時間之時間邊際TM4也縮小，故某些情況下 可能出現切換元件33(CD)及40(LU)或切換元件3丨(CU)及 37(LD)之同時導通，結果造成異常電流之流經此等切換元 件。 20 當臨限值電壓Vth為Vth=Vth3>Vcc/2時，輸出波形圖係 如第侧之半虛線顯示，換言之T1>T2，因而Twin>Two。 此種情況下，T1與Twg間之關係為輸出信號％之脈波寬度 (輸出脈波寬度)Twop遺著延遲時間T1之延長而縮小，如第8(： 圖所不。第5圖所示維持電路之個別信號之波形圖係如第9 22 1278810 圖之虛線顯示。第9圖中，實線顯示Twin==Two時之波形圖。 第10圖為略圖，顯示於先前技術維持電路，當輸出脈 波寬度小之時之操作波形圖。 .如第10圖所示，當信號VG1及VG2之脈波寬度縮小 5時，切換元件31及33之ON時間縮短。如此導致即使於波形 圖必須固定於維持電源電壓Vs或地電位GND之期間，仍然 出現高阻抗態。結果，雜訊可能疊加於維持電壓（維持電路 之輸出電壓)Vout之高位準「H」期或低位準rL」期之波形 上。 10 另一方面，當信號VG3及VG4之脈波寬度縮小時，出 現下列可能：當切換元件37及40個別導通時，當信號VG3及 VG4下降時，切換元件37及4〇分別被迫關斷。若切換元件 37及40被迫關斷，切換元件37及4〇之耗電量增加，或雜訊 可能疊加於第10圖所示維持電壓Vout之上升波形及下降波 15 形。 若因高阻抗態導致出現雜訊，或雜訊疊加於維持電壓 之上升波形及下降波形，則電漿顯示器裝置之操作邊際縮 小，結果導致發生螢幕閃爍。 前文說明中，放大電路之延遲時間假設為零，但實際 20上，延遲時間也出現於放大電路，延遲時間因放大電路之 零組件變化等因素而改變。第5圖所示四個延遲電路(51、 52、53及54)個別組成為可彼此獨立調整前緣之延遲時間 τι，俾便吸收於對應放大電路(32、34、41及38)之延遲時 間變化。結果，與輸出信號Vo之脈波寬度（輪出脈波寬 23 1278810 = 個放:電-異。如此導致Μ 如時間邊際_小及里j w輸出脈波寬度增加時出現諸 寬度縮小時可能“：發展等問題’以及當輸出脈波 更加可能發生。匕？如雜訊疊加於維持電壓⑽之問題 由縮提供—種電容性負載媒動電路，其經 出現之整延遲時間之情況下，可能
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容性參恭 〜，度釔化，來供給適當輸出電壓給電 置，直=本發明之另-目的係提供—種電漿顯示器裝 ”可對電_㈣面板提供_電壓^會發生例 邊際縮小、出現異常電流、雜訊疊加等問題。 後文將參照附圖說明根據本發明之電容性負載驅動電
裝置之具體例之細節。此處須了解根據本 ㈣之顯示器裝置及其驅動方法非僅限於應用於採用ALIS 方法之電_示器裝置，反而可寬廣應用於採用多種其它 方法之電漿顯示器裝置。 第11圖為方塊電路圖，顯示根據本發明之電容性負載 驅動電路之一範例之產生組態。 由比較第11圖與第5圖顯然易知，第丨丨圖所示根據本發 20明之電容性負載驅動電路之範例係對應於一種電路，其中 第5圖所示先前技術維持電路（電容性負載驅動電路)之延遲 電路51至54分別係由前緣延遲電路651至654及後緣延遲電 路751至754組成。如此，驅動電容器Cp藉切換元件（維持輸 出元件:n通道MOS電晶體)31及33及放大電路（驅動電路)32 24 1278810 及34之驅動操作、電源回復電路藉切換元件37及40、放大 電路38及41、二極體36及42、線圈35及43及電容器39(Cp) 之操作等係與參照第5圖詳細說明之操作相同，此處不再重 複說明。 5 如第11圖所示，根據本發明之電容性負載驅動電路之 一實施例包含供延遲個別輸入信號VI及V2之前緣之前緣 延遲電路651及652 ;供延遲個別輸入信號VI及V2之後緣之 後緣延遲電路751及752;供放大經由個別前緣延遲電路651 及652及後緣延遲電路751及752所得之驅動控制信號之放 10 大電路32及34 ;及藉個別放大電路32及34所驅動之切換元 件31及33。此處前緣延遲電路(651、652)及後緣延遲電路 (751、752)係彼此並聯連結。 根據本發明之電容性負載驅動電路之該實施例進一步 包含供延遲個別輸入信號V3及V4之前緣之前緣延遲電路 15 653及654 ;供延遲個別輸入信號V3及V4之後緣之後緣延遲 電路753及754 ;供放大經由個別前緣延遲電路653及654及 後緣延遲電路753及754所得之驅動控制信號之放大電路41 及38 ;以及電源回復電路，如參照第5圖之說明，包含由個 別放大電路41及38所驅動之切換元件40及37、二極體36及 20 42、線圈35及43、及電容器39。此處前緣延遲電路(653、 654)與後緣延遲電路(753、754)係彼此並聯連結。 第12圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第一具體例之主要部分；以及第13圖為略圖，說明 第12圖所示電容性負載驅動電路之操作。 25 1278810 如第12圖所示，於第一具體例之電容性負載驅動電 路，前緣延遲電路651係由一時間常數電路組成，該時間常 數電路包含一非反相緩衝電路MA1、一電阻器RA1及一電 容器CA1 ;以及該後緣延遲電路751係由一時間常數電路組 5 成，該時間常數電路包含一非反相緩衝電路MA2、一電阻 器RA2及一電容器CA2。前緣延遲時間及後緣延遲時間分別 係經由調整電阻器RA1及RA2之值而調整。 此外，前緣延遲電路651之輸出信號及後緣延遲電路 751之輸出信號係於隨後階段藉及閘AND1組合而獲得輸出 10 信號(輸出電壓)Vo，如第13圖所示。 藉此方式，經由使用第12圖所示電路，可彼此獨立調 整前緣延遲時間及後緣延遲時間。此處，於第12圖所示電 路，前緣延遲電路651及後緣延遲電路751分別於個別時間 常數電路之前端設置緩衝電路MA1及MA2,來防止因前緣 15 延遲時間調整所造成之干擾導致後緣延遲時間的改變，同 時也防止因後緣延遲時間調整造成之干擾所導致前緣延遲 時間的改變。換言之，設置緩衝電路MA1及MA2，第一具 體例之電容性負載驅動電路可以較高準確度設定輸出電壓 Vo之脈波寬度。 20 第14圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第二具體例之主要部分。 經由比較第14圖與第12圖顯然易知，於第二具體例之 電容性負栽驅動電路，緩衝電路MA1由第12圖所示第一具 驵例之電各性負載驅動電路之前緣延遲電路651刪除，以及 26 1278810 緩衝電路MA2設置於後緣延遲電路751之時間常數電路前 端，來防止因後緣延遲時間調整時造成的干擾’導致前緣 延遲時間的改變。換言之，於第二具體例之電容性負載驅 動電路，輸出信號之脈波寬度可準確設定，設定方式係經 5 由首先改變電阻器RA1而調整前緣延遲時間，然後改變電 •阻器RA2來調整後緣延遲時間。根據第二具體例之電容性 負載驅動電路，由於無需於前緣延遲電路651設置緩衝電路 MA1，因而電路組配結構變簡化。 # 第15圖為電路圖，顯示根據本發明之電容性負載驅動 10 電路之第三具體例之主要部分。 由比較第15圖與第12圖顯然易知，於第三具體例之電 容性負載驅動電路，前緣延遲電路651之緩衝電路MA1及後 緣延遲電路751之緩衝電路MA2皆由第12圖所示第一具體 例之電容性負載驅動電路刪除。此種情況下，經由改變電 15 阻器RA1進行前緣延遲時間調整與經由改變電阻器RA2進 行後緣延遲時間調整彼此干擾，但可設定輸出信號Vo之脈 ^ 波寬度，例如經由重複調整電阻器RA1及RA2而設定脈波寬 度；此種組配結構適合用於需要經由刪除缓衝電路MA1及 MA2來進一步簡化電路之應用用途。 2〇 弟16圖為電路圖’顯不根據本發明之電容性負載驅動 電路之第四具體例之主要部分。 經由比較第16圖與第12圖顯然易知，於第四具體例之 電容性負載驅動電路，第12圖所示第一具體例之電容性負 載驅動電路之電阻器RA1及RA2係以定值電阻器替代，反而 27 1278810 電容器CA1及CA2形成為可變電容器，讓前緣延遲時間及後 緣延遲時間可經由改變個別電容器CA1及CA2而調整。即使 電容器CA1及CA2形成為可變電容器，如同前文第二具體例 及第三具體例之說明，仍可刪除設置於個別時間常數電路 5 前端之緩衝電路MA1及MA2中之一者或二者。 第17圖為電路圖，示意顯示根據本發明之電容性負載 驅動電路之另一範例之概略組配結構；第18圖為略圖，說 明第17圖所示電容性負載驅動電路之操作。第17圖所示電 路大致上係與例如日本專利申請案第2003-425666號揭示 10 之電路相同。 將參照第18圖，說明第17圖所示電容性負載驅動電路 之操作。 第18圖中，波形SW1至SW5為第17圖驅動開關SW1至 SW5之信號波形，當對應波形為高「H」時，開關SW1至SW5 15 為ON。換言之，如第18圖所示，於第17圖之電容性負載驅 動電路，開關SW4係於時間tl2被轉開，電源回復電流流經 線圈（電感)LA、二極體DA及開關SW4。於時間tl2，開關SW1 被轉開，充電電流由1/2 Vs電源供應器，經由開關SW1及 SW4流至電容性負載(驅動電容器）Cp。此時，開關SW3也被 2〇 轉開，充電電流經由開關SW3及電容器C1，流至電容性負 載Cp。 其次，於時間tl3，開關SW1、SW3及SW4被轉關；以 及於時間tl4，開關SW5被轉開。當開MSW5被轉開時，電 源回復電流由電容性負載Cp，經由二極體DB及線圈LB流 28 1278810 出。此外，於時間t15，開關SW2被轉開，放電電流經開關 SW5、電容器C1及開關SW2而由電容性負載Cp流出。 於前述操作中，第18圖以OUTC顯示之波形供給電容性 負載Cp。此外，本操作中，第π圖之電路圖之波形〇υτΑ 5 及0UTB分別於第18圖以實線曲線及虛線曲線之波形顯示。 第17圖所示電容性負載驅動電路中，當供給驅動脈波 給電容性負載Cp時，讓電源回復電流於脈波之上升期間係 經由線圈LA流動，以及於脈波之下降期間係經由線圈lb流 動，藉此減少開關SW1及SW2之切換電力損耗。當第π圖 10所示電容性負載驅動電路用來驅動電漿顯示器裝置時，以 簡單電路可降低驅動電路之耗電量。 第19至22圖為電路圖，顯示根據本發明之電容性負載 驅動電路之第五至第八具體例，各自顯示第17圖之電路之 特定組配結構範例。 15 由比較第19圖至第22圖與第17圖顯然易知，於根據第 五至第八具體例之電容性負載驅動電路，功率MOSFET用 作為開關SW1至SW5。此處，開關SW卜SW2、SW4及SW5 各自係由η通道MOS電晶體組成。另一方面，開關SW3包含 ρ通道MOS電晶體SW3P及η通道MOS電晶體SW3N，於該等 20 電晶體附接二極體DSW3P、DSW3N、及D3P、電阻器R3P 及電容器C3P。因開關SW3P(p通道MOS電晶體）為主動-低 元件，故反相器IN3P設置於驅動開關SW3P之放大電路 (173P)前端。根據第19至22圖所示第五至第八具體例之電容 性負載驅動電路個別之操作係與前文參照第17圖及第18圖 29 1278810 所述之操作大致相同。 如第19圖所示，於第五具體例之電容性負載驅動電路 中，閘極耦合器161、164及165分別用來驅動開關（功率 M0SFET)SW1、SW4及SW5，而放大電路 172、173P及 173N 5 分別用來驅動開關SW2、SW3P及SW3N。此外，於第五具 體例之電容性負載驅動電路，閘極耦合器16卜164及165及 放大電路172、173P及173N前方分別有延遲電路151、154 及155及延遲電路152、153P及153N。 # 此處，先前於第14圖顯示之電路組配結構例如被採用 10 於各個延遲電路151、152、153P、153N、154及155，延遲 電路各自獨立調整個別輸入信號Vinl、Vin2、Vin3P、 Vin3N、Vin4及Vin5之前緣及後緣，來正確控制對應開關 SW1、SW2、SW3P、SW3N、SW4及SW5之切換操作。延 遲電路之組配結構非僅限於第4圖所示之組配結構，也可採 15 用第12、15或16圖所示之電路組配結構；此外，也可採用 多種其它電路組配結構，包括後文將參照第23圖說明之電 ® 路組配結構，其中前緣延遲電路611與後緣延遲電路711係 串聯連結。閘極耦合器161、164及165各自係使用一發光元 件、一光接收元件、及一放大電路組成’因此即使輸入端 20 與輪出端之參考電壓不同，仍可準確傳輸信號。閘極耦合 器161、164及165也分別設置電阻器R161、R164及R165。 藉此方式，根據第五具體例之電容性負載驅動電路， 對各個開關SW1、SW2、SW3P、SW3N、SW4及SW5設置 延遲電路151、152、153P、153N、154及155，個別輸入信 30 1278810 號Vinl、Vin2、Vin3P、Vin3N、Vin4及Vin5之前緣延遲時 間及後緣延遲時間係彼此獨立調整，故可準確設定驅動脈 波位相及脈波寬度。 第20圖為電路圖，顯示根據本發明之電容性負載驅動 5 電路之第六具體例。 如第20圖所示，於第六具體例之電容性負載驅動電 路，開關SW2及SW4之延遲電路152及154各自係組成為包 含一可變電阻器及一電容器之前緣延遲電路。特定言之， 各自具有例如第14圖所示之相同組配結構之延遲電路151 10 及155，係設置於個別閘極耦合器161及165前端，閘極耦合 器供給驅動脈波給需要以高度準確度設定前緣延遲時間及 脈波寬度之開關SW1及SW5;另一方面，前緣延遲電路152a 及154a分別係設置於放大電路172及閘極耦合器164前端， 放大電路172及閘極耦合器164係供給驅動脈波給需要以高 15 度準確度設定前緣延遲時間之開關SW2及SW4。此處刪除 第19圖所示第五具體例之開關SW3P及SW3N之延遲電路 153P及 153N。 換言之，於第六具體例之電容性負載驅動電路，用於 以高度準確度設定前緣延遲時間及脈波寬度之延遲電路 20 151及155、以及用於以高度準確度設定前緣延遲時間之前 緣延遲電路152a及154a，係經由限制於第19圖之第五具體 例之電容性負載驅動電路要求高度準確度部分而設置；如 此比較第五具體例可簡化電路組配結構。此處須了解，延 遲電路151及155各自之組態非僅限於第14圖所示組態，以 31 1278810 及前緣延遲電路152a及154a之組態非僅限於第20圖所示組 態。 第21圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第七具體例。 5 經由比較第21圖與第20圖顯然易知，第七具體例之電 容性負載驅動電路與前文說明之第六具體例之電容性負載 驅動電路之差異在於，放大電路(緩衝電路）172係由閘極耦 合器162替換’以及差異在於開關SW1之延遲電路151係由 前緣延遲電路151a所替換。當閘極耦合器162係用作為驅動 10開關SW2之驅動電路時，因開關SW1及SW2之驅動電路之 組配結構製作為完全相同，故可減少例如當周圍溫度改變 於_€路所出現之輸人/輸出延遲時間之變化量。 第22圖為電路圖’顯示根據本發明之電容性負載驅動 電路之第八具體例。 15 如由比較第22圖與第20圖顯然易知，第八具體例之電 容性負載驅動電路與第六具體例之電容性負載驅動電路之 差異在於’開關SW4之前緣延遲電路154&及開關SW5之延 遲電路55更進一步被刪除。 換言之’於第八具體例之電容性負載驅動電路，要求 20高度準確度部分進一步限於第20圖所示第六具體例之電容 性負載驅動電路’以及用於以高度準確度設定前緣延遲時 間及脈波見度之延遲電路151係設置於閘極耦合器161前 端’閘極耦合裔驅動開關5界1至3”5中於設定前緣延遲時 間及脈波寬度時要求最高準確度之開關SW1，·而前緣延遲 32 1278810 電路152a係設置於放大電路172前端，放大電路172係驅動 設定前緣延遲時間時要求高度準確度之開關SW2。 第八具體例之電容性負載驅動電路例如係用作為電裝 顯示器裝置之驅動電路；此處，經由轉開開關SW1，供給 5 正向維持電壓給屬於電容性負載之電漿顯示器面板，以及 經由轉開開關SW2，供給負向維持電壓給電漿顯示器面 板，讓氣體放電電流流動。 藉此方式，第22圖所示第八具體例之電容性負栽驅動 電路，比第20圖所示第六具體例之電容性負載驅動電路達 10 成電路組配結構之更進一步簡化。 如前述第19圖至第22圖之具體例顯示，對於第19圖之 延遲電路151、152、153P、153N、154及155，經由組合前 緣延遲電路及後緣延遲電路組成之一延遲電路、經由組人 前緣延遲電路及一脈波寬度調整電路組成之一電路、以及 15 單獨由一前緣延遲電路組成之一電路，例如於使用電容十生 負載驅動電路作為電漿顯示器裝置之驅動電路時，可根據 所需驅動信號之時序準確度、以及容許之電路數量而將令亥 等電路以各種方式組合。 第23圖為電路圖’顯示根據本發明之電容性負載驅動 電路之延遲電路之修改例，其中前緣延遲電路611與後緣延 遲電路711係串聯連結。 如第23圖所示，前緣延遲電路611包含一可變電阻器 (可變電阻元件）1〇1、一電容器（電容元件）102、及一二極體 1 〇3，以及後緣延遲電路711包含《 —可變電阻器2〇1、一 ^ ^ 33 1278810 器202、及一二極體203。此處，於該前緣延遲電路611，可 變電阻器101係並聯連結於相對於輸入信號Vin(Vl)為反向 取向之二極體103，以及電容器丨〇2之一端係連結至可變電 阻器101與二極體103間之輸出端連結節點，而電容器1〇2之 5另一端係連結接地GND。另一方面，於後緣延遲電路711， 可變電阻器201係並聯至相對於輸入信號vin為正向取向之 一極體203 ’以及電容器202之一端係連結至可變電阻器2〇1 與一極體203間之輸出端連結節點，而其另一端係連結接地 GND。此處，正極性脈波信號係用作為輸入信號vin。 10 藉此方式，對第19至22圖所示本發明之第五至第八具 體例之電谷性負載驅動電路之延遲電路而言，可採用其中 前緣延遲電路與後緣延遲電路係串聯連結之電路組態，以 及可採用其中前緣延遲電路與後緣延遲電路係並聯連結之 電路組態，如第12圖及第14至16圖所示。 15 M電容㈣載_電路之具_各自當應用於電漿 顯示器裝置之_電路（諸如參照第旧至第侧之說明） 時可解決各項問題，諸如當調整維持電路之延遲時間時， 可能出現之時間邊際縮小、異常電流發生、以及雜訊疊加 等問題。 20 減本發明，可提供一種電容性負載驅動電路，其係 組配成經由減少於使用延遲電路調整延遲時間之情況下可 能發生之輸出信號脈波寬度改變之大 又之方式，供給適當輸出電 壓給該電容性負載。此外，根據本發明，可達成一種電藥 顯示器裝置，該裝置可對電漿顯示器面板提供驅動電壓而 34 1278810 不會出現諸如時間邊際縮小、異常電流發生、以及雜訊疊 加等問題。 本發明可寬廣應用於電漿顯示器裝置；例如本發明可 應用至用作為個人電腦、工作站等之顯示器裝置之電漿顯 5 示器裝置，或用作為掛在牆壁上之平板螢幕電視或廣告等 資訊顯示裝置之電漿顯示器裝置。 可未悖離本發明之範圍組構成多個不同之本發明之具 體例，但須了解除非如隨附之申請專利範圍定義，本發明 非僅囿限於本說明書所述之特定具體例。 10 【圖式簡單說明】 第1圖為概略組態圖，示意顯示可應用本發明之電漿顯 示器裝置； 第2圖為略圖，顯示用於驅動第1圖所示電漿顯示器裝 置之波形圖； 15 第3圖為概略組態圖，示意顯示可應用本發明之電漿顯 示器裝置之另一實施例； 第4A及4B圖為略圖，顯示於第3圖所示電漿顯示器裝 置，於維持放電期間所施加之驅動波形圖； 第5圖為電路圖，顯示先前技術之電漿顯示器裝置使用 20 之維持電路之一實施例； 第6圖為電路圖，顯示第5圖所示維持電路之延遲電路 之一實施例； 第7A、7B、7C及7D圖為略圖，說明於先前技術之維持 電路之放大電路，臨限值電壓與輸出脈波寬度間之關係； 35 1278810 第8A、8B及8C圖為略圖，說明於先前技術之維持電 路，延遲時間與輸出脈波寬度間之關係； 第9圖為略圖，顯示於先前技術之維持電路，當輸出脈 波寬度為大時之操作波形圖； 5 第10圖為略圖，顯示於先前技術之維持電路，當輸出 脈波寬度為小時之操作波形圖； 第11圖為方塊電路圖，顯示根據本發明之電容性負載 驅動電路之一實施例之概略組態； 修第12圖為電路圖，顯示根據本發明之電容性負載驅動 10 電路之第一具體例之主要部分； 第13圖為略圖，說明第12圖所示電容性負載驅動電路 之搡作； 第14圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第二具體例之主要部分； 15 第15圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第三具體例之主要部分； ® 第16圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第四具體例之主要部分； 第17圖為電路圖，示意顯示根據本發明之電容性負載 20 驅動電路之另一實施例之概略組態； 第18圖為略圖，說明第17圖所示電容性負載驅動電路 之操作； 第19圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第五具體例； 36 1278810 第20圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第六具體例； 第21圖為電路圖，顯示根據本發明之電容性負載驅動 電路之第七具體例； 5 第22圖為電路圖，顯示根據本發明之電容性負載驅動 • 電路之第八具體例；以及 第23圖為電路圖，顯示根據本發明之電容性負載驅動 電路之修改例。 # 【主要元件符號說明】 10…PDP，電漿顯示器面板 36...二極體 11…第一電極、X電極 37、40…切換元件 12…第二電極、Y電極 38、41··.放大電路 13...定址電極 39...電容器 14...掃描電極 42...二極體 15...掃描信號產生電路 43...線圈 16…開關 51、52…延遲電路 17...定址驅動器 53、54...延遲電路 18...X維持電路 101、201…可變電阻器 19...Y維持電路 102、202...電容器 20...驅動控制電路 103、203...二極體 21…影像信號處理電路 151-155…延遲電路 31、33…切換元件 152a、154a...前緣延遲電路 32、34...放大電路 161-165…閘極耦合器 35…線圈 172、173P、173N.··放大電路 37 1278810 6η、651-654...前緣延遲電路 7η、751-754·.·後緣延遲電路 AND1…及閘 CA1-2...電容器
Cp...驅動電容器、電容性負載 DA、DB...二極體 LA、LB…線圈 MA1-2...非反相緩衝電路 RA1-2...電阻器 SW1-5...開關 ΤΓ1-2...延遲時間 TM1-2...時間邊際
Twin…輸入信號之脈波寬度
Two...輸出信號之脈波寬度
Vin(Vl)···輸入信號(輸入電壓)
Vo···輸出信號(輸出電壓）
Vrc...連結節點電壓 Vth...臨限值電壓 38

Claims (1)

1278810 十、申請專利範圍： 1. 一種電容性負載驅動電路，包含： 一輸入端； 一前緣延遲電路，其延遲經由該輸入端輸入之一輸 5 入信號前緣； 一後緣延遲電路，其係延遲該輸入信號後緣； 一放大電路，其係放大經由該前緣延遲電路及該後 緣延遲電路所得之驅動控制信號；以及 一輸出切換裝置，其係經由該放大電路所驅動，其中 10 該前緣延遲電路包括一第一時間常數電路，其包含 一第一電阻器及一第一電容器； 該後緣延遲電路包括一第二時間常數電路，其包含 一第二電阻器及一第二電容器；以及 該驅動控制信號係經由一信號組合電路所產生，其 15 係組合該第一時間常數電路之輸出信號與該第二時間 常數電路之輸出信號。 2. 如申請專利範圍第1項之電容性負載驅動電路，其中一 緩衝電路可設置於第一時間常數電路及第二時間常數 電路之任一者或二者個別之前端。 20 3.如申請專利範圍第1項之電容性負載驅動電路，其中該 信號組合電路為一及閘。 4.如申請專利範圍第1項之電容性負載驅動電路，其中該 前緣之延遲時間可經由調整第一時間常數電路之第一 電阻器值而調整；後緣之延遲時間可經由調整第二時間 39 1278810 常數電路之第二電阻器值而調整。 5. 如申請專利範圍第1項之電容性負載驅動電路，其中該 前緣之延遲時間可經由調整第一時間常數電路之第一 電容器值而調整；後緣之延遲時間可經由調整第二時間 5 常數電路之第二電容器值而調整。 6. —種用於矩陣定址平板顯示器裝置之電容性負載驅動 電路，該電路施加載明之電壓至形成一顯示器元件之一 電容性負載，該驅動電路包含： 一第一信號線，其供給一第一電位給該電容性負載 10 之一端； 一第一切換元件，其供給該第一電位至該第一信號 線； 一第一驅動電路，其驅動該第一切換元件； 一第二切換元件，其供給一第二電位至該第一信號 15 線； 一第二驅動電路，其驅動該第二切換元件； 一第二信號線，其供給一第三電位至該電容性負載 之一端，該第三電位係與該第一電位不同； 一第一電容器連結於該第一信號線與該第二信號 20 線間，且可供給比第一電位及第二電位更低之電位給第 一信號線； 一第三切換元件，其供給該第二電位給該第二信號 線； 一第三驅動電路，其驅動該第三切換元件； 40 1278810 一第四切換元件，其連結該第一信號線至該電容性 負載之一端； 一第四驅動電路，其係驅動該第四切換元件； 一第五切換元件，其係連結該第二信號線至該電容 5 性負載之一端； 一第五驅動電路，其係驅動該第五切換元件；以及 一線圈電路，其係連結於該第一信號線及第二信號 線中之至少一者與供給第二電位之一電源線間，其中該 電容性負載驅動電路進一步包括，於該第一驅動電路至 10 第五驅動電路之一之前端， 一輸入端； 一前緣延遲電路，其延遲經由該輸入端輸入之一輸 入信號前緣；以及 一後緣延遲電路，其係延遲該輸入信號後緣。 15 7.如申請專利範圍第6項之電容性負載驅動電路，其中該 輸入端、該延遲經由輸入端輸入之輸入信號前緣之前緣 延遲電路、以及該延遲輸入信號後緣之後緣延遲電路可 設置於第一驅動電路之前端。 8.如申請專利範圍第7項之電容性負載驅動電路，其中該 20 電容性負載驅動電路進一步於該第二驅動電路之前端 包括， 一輸入端，以及 一延遲經由該輸入端輸入之輸入信號前緣之前緣 延遲電路。 41 1278810 9. 如申請專利範圍第7項之電容性負載驅動電路，其中該 電容性負載驅動電路進一步於該第五驅動電路之前端 包括， 一輸入端，以及 5 一延遲經由該輸入端輸入之輸入信號前緣之前緣 延遲電路，以及 也包括於該第二驅動電路及第四驅動電路各自之 前端， 一輸入端，以及 10 一延遲經由該輸入端輸入之輸入信號前緣之前緣 延遲電路。 10. 如申請專利範圍第6項之電容性負載驅動電路，其中該 第三切換元件可包含一電流輸出元件及一電流輸入元 件；以及該第三驅動電路可包含一電流輸出元件驅動電 15 路其係驅動該電流輸出元件，以及包含一電流輸入元件 驅動電路其係驅動該電流輸入元件。 11. 如申請專利範圍第10項之電容性負載驅動電路，其中該 電流輸出元件可為P通道功率MOSFET，以及電流輸入 元件可為N通道功率MOSFET或IGBT。 20 12.如申請專利範圍第11項之電容性負載驅動電路，其中該 延遲欲供給該電流輸出元件驅動電路之驅動信號前緣 之前緣延遲電路、以及延遲欲供給該電流輸出元件驅動 電路之驅動信號後緣之後緣延遲電路可設置於該電流 輸出元件驅動電路之前端。 42 1278810 13. 如申請專利範圍第11項之電容性負載驅動電路，其中該 延遲欲供給對應之驅動電路之驅動信號前緣之前緣延 遲電路、以及延遲欲供給對應驅動電路之驅動信號後緣 之後緣延遲電路可設置於該第一驅動電路、第二驅動電 5 路、第四驅動電路、第五驅動電路、電流輸出元件驅動 電路、及電流輸入元件驅動電路各自之前端。 14. 如申請專利範圍第6項之電容性負載驅動電路，其中， 該前緣延遲電路可包括一第一時間常數電路，其包 含一第一電阻器及一第一電容器； 10 該後緣延遲電路包括一第二時間常數電路，其包含 一第二電阻器及一第二電容器；以及 欲供給第一驅動電路至第五驅動電路之驅動控制 信號各自係經由一信號組合電路而產生，該信號組合電 路係組合第一時間常數電路之輸出信號與第二時間常 15 數電路之輸出信號。 15. 如申請專利範圍第14項之電容性負載驅動電路，其中一 缓衝電路可設置於第一時間常數電路及第二時間常數 電路之任一者或二者個別之前端。 16. 如申請專利範圍第14項之電容性負載驅動電路，其中該 20 信號組合電路為一及閘。 17. 如申請專利範圍第14項之電容性負載驅動電路，其中該 前緣之延遲時間可經由調整第一時間常數電路之第一 電阻器值而調整；後緣之延遲時間可經由調整第二時間 常數電路之第二電阻器值而調整。 43 1278810 18.如申請專利範圍第14項之電容性負載驅動電路，其中該 前緣之延遲時間可經由調整第一時間常數電路之第一 電容器值而調整；後緣之延遲時間可經由調整第二時間 常數電路之第二電容器值而調整。 5 19.如申請專利範圍第6項之電容性負載驅動電路，其中一 閘極耦合器係經由使用一發光元件、一光接收元件、以 及一放大電路組成，該閘極耦合器可用於第一驅動電路 至第五驅動電路中之至少一者。 20. 如申請專利範圍第19項之電容性負載驅動電路，其中該 10 閘極耦合器可個別用於第四驅動電路及第五驅動電路。 21. 如申請專利範圍第19項之電容性負載驅動電路，其中該 閘極耦合器可個別用於第一驅動電路、第二驅動電路、 第四驅動電路及第五驅動電路。 22. —種電漿顯示器裝置，包含： 15 多個X電極； 多個Y電極，Y電極係實質上平行於該多個X電極排 列，且介於多個Y電極與多個X電極間產生放電； 一X電極驅動電路，其係施加放電電壓至該多個X 電極，以及 20 一 Y電極驅動電路，其係施加放電電壓至該多個Y 電極，以及其中： 該X電極驅動電路或該Y電極驅動電路係使用電容性 負載驅動電路組成，其中該電容性負載驅動電路包含： 一輸入端； 44 1278810 一前緣延遲電路，其延遲經由該輸入端輸入之一輸入 信號前緣； 一後緣延遲電路，其係延遲該輸入信號後緣； 一放大電路，其係放大經由該前緣延遲電路及該後緣 5 延遲電路所得之驅動控制信號；以及 一輸出切換裝置，其係經由該放大電路所驅動，其中 該前緣延遲電路包括一第一時間常數電路，其包含一 第一電阻器及一第一電容器； 該後緣延遲電路包括一第二時間常數電路，其包含一 10 第二電阻器及一第二電容器；以及 該驅動控制信號係經由一信號組合電路所產生，其係 組合該第一時間常數電路之輸出信號與該第二時間常數電 路之輸出信號。 23. 如申請專利範圍第22項之電漿顯示器裝置，其中該電容 15 性負載驅動電路為一維持電路，其係於維持期期間供給 維持脈波給一電漿顯示器面板。 24. 如申請專利範圍第22項之電漿顯示器裝置，其中該電容 性負載驅動電路為一掃描電路，其係於掃描期期間供給 掃描脈波給一電漿顯示器面板。 20 25.如申請專利範圍第22項之電漿顯示器裝置，其中該電容 性負載驅動電路為一維持/掃描共通電路，其係於維持 期期間供給維持脈波給一電漿顯示器面板，以及於一掃 描期期間供給掃描脈波給一電漿顯示器面板。 26.—種電漿顯示器裝置，包含： 45 1278810 多個x電極， 多個Y電極，Y電極係實質上平行於該多個X電極排 列，且介於多個Y電極與多個X電極間產生放電； 一X電極驅動電路，其係施加放電電壓至該多個X 5 電極；以及 一Y電極驅動電路，其係施加放電電壓至該多個Y 電極，以及其中： 該X電極驅動電路或該Y電極驅動電路係使用電容 性負載驅動電路組成，該驅動電路施加一載明之電壓至 10 形成一顯示器元件之一電容性負載，其中該電容性負載 驅動電路包含： 一第一信號線，其供給一第一電位給該電容性負載 之一端； 一第一切換元件，其供給該第一電位至該第一信號 15 線； 一第一驅動電路，其驅動該第一切換元件； 一第二切換元件，其供給一第二電位至該第一信號 線； 一第二驅動電路，其驅動該第二切換元件； 20 一第二信號線，其供給一第三電位至該電容性負載 之一端，該第三電位係與該第一電位不同； 一第一電容器連結於該第一信號線與該第二信號 線間，且可供給比第一電位及第二電位更低之電位給第 一信號線； 46 1278810 一第三切換元件，其供給該第二電位給該第二信號 線； 一第三驅動電路，其驅動該第三切換元件； 一第四切換元件，其連結該第一信號線至該電容性 5 負載之一端； 一第四驅動電路，其係驅動該第四切換元件； 一第五切換元件，其係連結該第二信號線至該電容 性負載之一端； 一第五驅動電路，其係驅動該第五切換元件；以及 10 一線圈電路，其係連結於該第一信號線及第二信號 線中之至少一者與供給第二電位之一電源線間，其中該 電容性負載驅動電路進一步包括，於該第一驅動電路至 第五驅動電路之一之前端， 一輸入端； 15 一前緣延遲電路，其延遲經由該輸入端輸入之一輸 入信號前緣；以及 一後緣延遲電路，其係延遲該輸入信號後緣。 27. 如申請專利範圍第26項之電漿顯示器裝置，其中該電容 性負載驅動電路為一維持電路，其係於維持期期間供給 20 維持脈波給一電漿顯示器面板。 28. 如申請專利範圍第26項之電漿顯示器裝置，其中該電容 性負載驅動電路為一掃描電路，其係於掃描期期間供給 掃描脈波給一電漿顯示器面板。 29. 如申請專利範圍第26項之電漿顯示器裝置，其中該電容 47 1278810 性負載驅動電路為一維持/掃描共通電路，其係於維持 期期間供給維持脈波給一電漿顯示器面板，以及於一掃 描期期間供給掃描脈波給一電漿顯示器面板。
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Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100648707B1 (ko) * 2005-10-11 2006-11-23 삼성에스디아이 주식회사 플라즈마 표시 장치 및 이에 사용되는 전원 공급 장치
WO2009069194A1 (ja) * 2007-11-27 2009-06-04 Hitachi, Ltd. プラズマディスプレイ装置
KR20090126935A (ko) * 2008-06-05 2009-12-09 엘지전자 주식회사 플라즈마 디스플레이 장치
JP6817582B2 (ja) * 2015-06-10 2021-01-20 パナソニックＩｐマネジメント株式会社 スイッチ装置
CN110120197B (zh) * 2019-04-11 2024-03-08 深圳天源中芯半导体有限公司 一种省略外围电阻电容减少干扰的级联应用系统及其实现方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5442370A (en) * 1987-08-13 1995-08-15 Seiko Epson Corporation System for driving a liquid crystal display device
KR19980054998A (ko) 1996-12-27 1998-09-25 김광호 액정표시소자용 구동회로
JP3201603B1 (ja) 1999-06-30 2001-08-27 富士通株式会社 駆動装置、駆動方法およびプラズマディスプレイパネルの駆動回路
JP2001013917A (ja) * 1999-06-30 2001-01-19 Hitachi Ltd ディスプレイ装置
JP2001260358A (ja) * 2000-03-17 2001-09-25 Nec Corp インクジェット記録ヘッドの駆動装置及びその方法
JP3644867B2 (ja) 2000-03-29 2005-05-11 富士通日立プラズマディスプレイ株式会社 プラズマディスプレイ装置及びその製造方法
JP2002215087A (ja) 2001-01-19 2002-07-31 Fujitsu Hitachi Plasma Display Ltd プラズマディスプレイ装置およびその制御方法
JP2003330424A (ja) 2002-05-10 2003-11-19 Hitachi Ltd 液晶表示装置
JP4480341B2 (ja) * 2003-04-10 2010-06-16 日立プラズマディスプレイ株式会社 プラズマディスプレイ装置

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