TW202113604A - 適應性晶片上數位電力估計器 - Google Patents
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Abstract
描述用於實施一種即時調適權重之動態電力估計(dynamic power estimation, DPE)單元的系統、設備、及方法。一種系統包括一處理器、一DPE單元、及一電力管理單元(power management unit, PMU)。該DPE單元藉由將複數個權重乘以複數個計數器值而產生該處理器的一電力消耗估計,其中各權重乘以一對應計數器。該DPE單元計算該複數個權重及該複數個計數器之乘積的總和。將該累積總和使用作為該處理器之電力消耗的一估計。在一週期性基礎上,將該估計與一電流感測值比較,以測量誤差。若該誤差大於一臨限,則一晶片上學習演算法動態地調整該等權重。該PMU使用該等電力消耗估計將該處理器保持在一熱包封內。
Description
本文所述之實施例係關於計算系統的領域,且更具體地係關於動態地調整權重以便更準確地估計處理單元所消耗的電力。
當產生正由處理單元消耗之電力的估計時,該估計一般基於與該處理單元有關的離線假設。此等矽前(pre-silicon)估計係基於預期處理單元執行之工作量的類型。然而,此等估計一般無法提供正在消耗之即時電力的準確估計,其可根據所執行之應用程式及/或其他因子(例如,電力供應變動、溫度變化)而波動。
鑑於以上,期望用於產生電力消耗估計的經改良方法及機制。
設想用於實施一種即時調整權重之動態電力估計單元的系統、設備、及方法。在各種實施例中,一種計算系統包括一處理器、一動態電力估計單元、及一電力管理單元。在一實施例中,該動態電力估計單元藉由將複數個權重乘以複數個計數器值而產生該處理器的一電力消耗估計,其中各權重乘以一對應計數器。該動態電力估計單元計算該複數個權重及該複數個計數器之乘積的總和。將該累積總和使用作為該處理器之電力消耗的一估計。在一週期性基礎上,將該估計與一電流感測值比較,以測量誤差。若該誤差大於一臨限,則實施一晶片上學習(on-chip learning, OCL)演算法以動態地調整該等權重。藉由即時調整該等權重,產生更精確的電力消耗估計。該電力管理單元使用該等電力消耗估計將該處理器保持在一熱包封內。
參照下文描述及附圖,將進一步理解這些及其他實施例。
在下文描述中,提出許多具體細節,以提供對本揭露描述之實施例的透徹理解。然而,所屬技術領域中具有通常知識者應當認識到,可在沒有這些具體細節的情況下實施該等實施例。在一些情況下,為了便於圖解闡釋與避免模糊實施例的描述,未詳細展示熟知的電路、結構、與技術。
現在參考圖1,顯示計算系統100之一實施例的方塊圖。在一實施例中,計算系統100包括複數個組件,諸如處理單元105、網狀結構110、輸入/輸出(I/O)裝置120、動態電力估計器(dynamic power estimator, DPE) 125、電力管理單元(power management unit, PMU) 130、電力供應器135、快取/記憶體控制器140、記憶體145、及電流感測單元150。在其他實施例中,計算系統100包括其他組件及/或該等組件的一或多者被省略。此外,在其他實施例中,計算系統100的組件可以其他合適方式連接。
處理單元105代表任何數目及類型的處理單元(例如,中央處理單元(CPU)、圖形處理單元(GPU)、現場可程式化閘陣列(FPAG)、特定應用積體電路(ASIC)、數位信號處理器(DSP))。處理器單元105包括任何數目的核心(未圖示),其用於執行一特定指令集架構(instruction set architecture, ISA)的指令,其中該等指令包括作業系統指令及使用者應用程式指令。處理單元105亦包括事件計數器107,該等事件計數器代表任何數目及類型的事件計數器,其用於追蹤在一或多個應用程式執行期間發生之不同類型之事件的發生。此等事件可包括所執行的指令、快取未命中(cache miss)、記憶體請求、分頁表未命中(page table miss)、分支預測錯誤、及/或其他類型的事件。
如圖所示,處理單元105經由網狀結構110連接至一或多個I/O裝置120及快取/記憶體控制器140。再者,處理單元105經由快取/記憶體控制器140存取記憶體145。在一實施例中,記憶體145係外部電腦記憶體,諸如非揮發性記憶體或動態隨機存取記憶體(DRAM)。非揮發性記憶體可儲存用於計算系統100的一作業系統(OS)。可將軟體應用程式的指令載入處理單元105內的一快取記憶體子系統(未圖示)中。軟體應用程式可能已儲存在非揮發性記憶體、DRAM、及/或I/O裝置120的一者的一或多者中。處理單元105可從快取記憶體子系統載入軟體應用程式指令並處理該等指令。
網狀結構110可包括各種互連、匯流排、MUX、控制器等,且可經組態以促進計算系統100的各種元件之間的通訊。在一些實施例中,網狀結構110之部分可經組態以實施各種不同的通訊協定。在其他實施例中,網狀結構110可實施單一通訊協定,且耦接至網狀結構110之元件可在內部從單一通訊協定轉換成其他通訊協定。
快取/記憶體控制器140可經組態以管理網狀結構110與一或多個快取及/或記憶體(例如,非暫時性電腦可讀媒體)之間的資料傳輸。例如,快取/記憶體控制器140可耦接至一L3快取,該L3快取可繼而耦接至一系統記憶體(例如,記憶體145)。在其他實施例中,快取/記憶體控制器140可直接耦接至記憶體145。記憶體145可提供資料的非揮發性、隨機存取的輔助儲存器(secondary storage)。在一實施例中,記憶體145可包括一或多個硬碟機(hard disk drive, HDD)。在另一實施例中,記憶體145利用固態硬碟(solid-state drive, SSD)及/或DRAM。DRAM可係一種類型的動態隨機存取記憶體,該記憶體將資料的各位元儲存在積體電路內的一分開電容器中。不同於HDD及快閃記憶體,DRAM可係揮發性記憶體,而不係非揮發性記憶體。DRAM可包括多通道記憶體架構。此類型架構可藉由在其等之間加入更多通訊通道而增加將資料傳輸至快取/記憶體控制器140的速度。
I/O裝置120代表任何數目及類型的I/O及/或周邊裝置。I/O裝置120的一或多者可係顯示器,諸如觸控螢幕、現代電視、電腦監視器、或其他類型的顯示器。電腦監視器可包括薄膜電晶體液晶顯示器(TFT-LCD)面板。此外,顯示器可包括用於膝上型電腦及其他行動裝置的監視器。視訊圖形子系統(未圖示)可使用在顯示器與處理單元105之間。視訊圖形子系統可係主機板上的一張獨立卡,並包括一圖形處理單元(GPU)。I/O裝置120的一或多者可係一般使用的I/O裝置(諸如鍵盤、滑鼠、印表機、數據機等)的一者
電力供應器135提供電力供應電壓給系統100的各種組件。再者,在一實施例中,電力供應器135供應時脈頻率給需要時脈來操作的組件。例如,在此實施例中,電力供應器135包括一或多個鎖相迴路(phase-locked loop, PLL)(未圖示),其用於供應一或多個時脈給各種組件。替代地,PLL可與電力供應器135分開。電力管理單元(PMU) 130耦接至電力供應器135,且PMU 130基於系統100的即時操作狀況控制提供給各種組件的特定電壓及/或頻率。在一實施例中,將由DPE 125產生的電力消耗估計傳送至PMU 130,且PMU 130使用該電力消耗估計(亦即,電力消耗預測)判定是否增加或減少系統100之各種組件的電力效能狀態。例如,在一實施例中,若由DPE 125產生的電力消耗預測小於第一臨限,則PMU 130增加處理單元105及/或一或多個其他組件的電力效能狀態。替代地,若由DPE 125產生的電力消耗預測大於第二臨限,則在一實施例中,PMU 130減少處理單元105及/或一或多個其他組件的電力效能狀態。
在一實施例中,DPE 125藉由將係數127乘以計數器107而產生處理單元105的一電力消耗估計。在一實施例中,各計數器107有各自的係數127。在一實施例中,DPE 125計算各係數-計數器對之乘積的總和。例如,若有三個分開的計數器107及三個係數127,則將總和計算為coefficient_A * counter_A + coefficient_B * counter_B + coefficient_C * counter_C。在其他實施例中,其他數目的計數器107與係數127可一起相乘以產生總和。DPE 125接著基於在一給定數目之時脈循環上累積的此總和產生一電力消耗估計。應注意DPE 125可使用軟體及/或硬體的任何合適組合來實施。雖然將DPE 125顯示為計算系統100內的一獨立單元,但應瞭解到在其他實施例中,DPE 125可係系統100的一或多個其他單元的一部分或與該一或多個其他單元組合。例如,在另一實施例中,DPE 125及PMU 130係一起組合在單一單元中。系統100內之組件的其他配置及/或組合係可行且經設想的。
在一實施例中,在訓練階段期間,DPE 125比較電力消耗估計與由電流感測單元150提供的實際電力消耗資料。在一實施例中,電流感測單元150使用一或多個庫侖計數器產生處理單元105的實際電力消耗資料。如本文所使用的,「庫侖計數器」係定義為測量及維持由裝置使用之電流計數的裝置。在一實施例中,庫侖計數器使用具有供應至裝置之電壓的一串聯電流感測電阻器,並將橫跨該電阻器的電壓降使用作為電流的測量。在一實施例中,雖然系統100運行針對一終端使用者的真實世界應用程式,DPE 125運行基於電力消耗估計與實際電力消耗資料之間的誤差而動態地調整係數127的一演算法。藉由動態地調整係數127,DPE 125能夠產生追蹤處理單元105之即時行為的一電力消耗估計。替代地,系統100中的另一組件執行該演算法以動態地調整係數127。係數127的此動態調整幫助使由DPE 125產生的預測比若係數127係靜態地判定且在運行時間期間係固定的更準確。
在動態調整階段之後,DPE 125使用經更新係數127產生處理單元105的高度準確電力消耗預測。當改變系統100之各種組件的電力效能狀態時,此等準確的電力消耗預測幫助PMU 130作出更佳決策。額外地,DPE 125可在一規律或彈性間隔上重複動態調整階段,以防止係數127變得過時。在一些情形中,DPE 127回應於正在偵測之一給定事件而執行動態調整階段。例如,在一實施例中,回應於處理單元105執行先前尚未測試過的一新應用程式,DPE 127起始動態調整階段,使得係數127可適應該新應用程式。用於觸發訓練階段的其他事件係可行且經設想的。
應瞭解到,儘管從電力供應器135至系統100之組件的連接在圖1中呈現為如同其等共享一共同的跡線或匯流排,此僅出於說明之目的而顯示。從電力供應器135至各種組件的連接可彼此獨立,並可使用分開的實體跡線、電壓平面、導線、匯流排接腳、背板連接、或類似者。應注意其他實施例可包括組件的其他組合,其包括顯示於圖1之組件及/或其他組件的子集或超集。雖然可將一給定組件的一例項(instance)顯示於圖1中,但其他實施例可包括該給定組件的二或更多個例項。類似地,在整個此詳細說明中,即使僅顯示一給定組件的一例項,仍可包括該給定組件的二或更多個例項,及/或即使顯示多個例項,仍可使用僅包括一例項的實施例。額外地,應瞭解到在系統100的組件之間的連接可存在但未經圖示,以避免使圖式不易理解。
可將計算系統100的經繪示功能性併入在單一積體電路上。在另一實施例中,將經繪示功能性併入一電腦主機板上的一晶片組中。在一些實施例中,計算系統100可包括在一桌上型電腦或一伺服器中。在又另一實施例中,將經繪示功能性併入一或多個系統單晶片(system on chip, SOC)上的一或多個半導體晶粒。
現在轉至圖2,顯示晶片上學習系統205之一實施例的方塊圖。在一實施例中,將晶片上學習系統205實施在(圖1之)動態電力估計器125上。在另一實施例中,將晶片上學習系統205的第一部分實施在動態電力估計器125上,並將晶片上學習系統205的第二部分實施在(圖1之)處理單元107上。在其他實施例中,晶片上學習系統205係使用其他組件或一計算系統之組件的組合來實施。在一實施例中,晶片上學習系統205負責調整由動態電力估計單元210使用的權重220A-N,該等權重用於產生正由一處理單元或其他組件消耗之電力的估計。應注意,權重220A-N在本文中亦可稱為「係數」。計數器215A-N代表任何數目的計數器,其正在追踨與處理器的目前操作狀態相關聯之各種度量。一般而言,此等計數器215A-N追蹤代表或指示正由處理器消耗之電力的值。由計數器215A-N追蹤之事件的實例包括,但不限於,所執行的指令、快取記憶體請求、快取未命中、記憶體請求、分支錯誤預測等。應注意計數器215A-N亦可稱為「事件計數器」。
在一實施例中,動態電力估計單元210包括用於各計數器215A-N的權重220A-N。在一實施例中,各權重220A-N在各時脈循環中乘以對應的計數器215A-N。在其他實施例中,使用乘法操作以外的不同類型之算術或邏輯操作將各權重220A-N施加至對應計數器215A-N。在一實施例中,對於各時脈週期,加法器225產生計數器215A-N乘以權重220A-N之乘積的總和。接著,加法器227累積由加法器225針對「n」個時脈循環所提供的總和,其中「n」係根據實施例變化的一整數數目。在一些情形中,「n」的值係可程式化的,並在運行時間期間受到調整。加法器227的累積輸出係處理單元(例如,圖1之處理單元105)之電力消耗的預測。
電力消耗的預測係提供至比較器230。電流感測單元235基於由處理單元消耗的電流而產生電力的「真實(truth)」測量。此電力測量係發送至比較器230,以與由動態電力估計單元210產生的預測比較。由比較器230將二個值之間的差提供給學習演算法240。學習演算法240係使用硬體(例如,控制邏輯)及/或軟體的任何合適組合來實施。例如,學習演算法可單獨地以硬體、單獨地以軟體、或以混合式的硬體/軟體解決方案來實施。學習演算法240使用各種類型演算法之任何者,以基於預測與電力消耗的測量之間的差調整權重220A-N。例如,在一實施例中,學習演算法240使用一隨機梯度下降(stochastic gradient descent, SGD)演算法來調整及調諧由動態電力估計單元210使用的權重220A-N。動態電力估計單元210的此調諧係意欲使動態電力估計單元210在後續時脈循環中產生更準確的電力消耗預測。在其他實施例中,可由學習演算法240使用其他類型的演算法以調整權重220A-N。
現在參考圖3,顯示用於動態地調適電力估計權重之混合型晶片上學習(OCL)系統300之一實施例的方塊圖。在一實施例中,混合型OCL系統300包括用於在運行時間期間動態地更新權重305之硬體310與軟體320的組合。應瞭解到此混合型硬體/軟體系統僅係用於動態地調適電力估計權重之實施方案的一實例。在其他實施例中,可實施純硬體系統或純軟體系統,以動態地調適電力估計權重。在一實施例中,權重305之各者將大於或等於零。換言之,在此實施例中,權重305係非負的。硬體310包括具有複數個計數器335A-H之乘積單元330的數位電力估計器(DPE)總和。計數器335A-H的數目及類型根據實施例而變化。複數個計數器335A-H追蹤與一或多個處理單元、系統單晶片(SoC)、積體電路(IC)、或其他類型之組件或裝置相關聯的各種事件。
在一實施例中,權重305乘以對應計數器335A-H,以產生經累積且接著與由庫侖計數器340產生之真實值比較的一總和。在一實施例中,將由庫侖計數器340產生的平均真實值從權重305與計數器335A-H之乘積的該累積總和減去。該減去結果係提供給軟體320的誤差。該誤差亦可與一臨限比較,且亦將此比較結果提供給軟體320。在一實施例中,軟體320包括用於初始化針對λ(lambda)、ε(epsilon)、權重、及學習率之學習演算法變數的程式指令。此等程式指令可由任何類型的處理器執行,其中處理器及ISA的類型根據實施例而改變。
在一實施例中,當比較器的輸出等於一時,軟體320亦包括用於更新權重的程式指令。當誤差大於臨限時,比較器的輸出等於一。通常,只要誤差小於臨限,硬體310便可使用既有組之權重305。該既有組之權重305亦可稱為第一組權重。一旦誤差大於或等於臨限,軟體320將起始用於動態地更新權重305的一晶片上學習(OCL)常式來產生第二組權重,以便減少乘積單元330之DPE總和的輸出與由庫侖計數器340獲得的測量之間的誤差。在一實施例中,該OCL常式使用用於預訓練的第一演算法及用於後續迭代的第二演算法。在一實施例中,在預訓練模式期間使用的第一演算法係一調適性的梯度下降演算法。在此實施例中,在後續迭代期間使用的第二演算法係一調適性的差量(delta)演算法。在其他實施例中,其他類型的演算法可用於預訓練模式及/或用於OCL常式的後續迭代。
現在轉至圖4,顯示用於改善一處理器電力消耗估計之準確度的方法400的一實施例。為了討論的目的,以循序順序顯示此實施例(以及圖5及圖6)中的步驟。然而,在其他實施例中,一些步驟可依與所示不同的順序發生,一些步驟可同時執行,一些步驟可與其他步驟組合,且一些步驟可能不存在。
在各種實施例中,計算系統(例如,圖1之計算系統100)起始一訓練階段以訓練一動態電力估計單元(例如,圖1之動態電力估計器125)(方塊405)。在方塊405中,各種組件之任何者(諸如處理單元(例如,處理單元105)、動態電力估計單元、電力管理單元(例如,電力管理單元130)、或另一組件)可起始訓練。在訓練階段期間,計算系統比較動態電力估計單元的一預測與電力消耗的一電流感測測量(方塊410)。若預測與電力消耗的測量之間的差小於一臨限(條件方塊415的「是」分支),則藉由動態電力估計單元的預測會被電力管理單元(PMU)(例如,圖1的PMU 130)用來將一處理器(例如,圖1的處理器105)保持在一熱包封(亦即,熱設計點(thermal design point))內(方塊420)。否則,若預測與電力消耗的測量之間的差大於或等於臨限(條件方塊415的「否」分支),則一學習演算法調整動態電力估計單元的權重,以便減少預測與電力消耗的測量之間的差(方塊430)。實施一學習演算法的一實例係藉由(圖6之)方法600描述。在方塊430之後,方法400返回至方塊410。在方塊420之後,計算系統等待給定的一持續時間經過(方塊425),且接著方法400返回至方塊410。
現在參考圖5,顯示使用一學習演算法增加電力消耗預測之準確度的方法500的一實施例。系統(例如,圖1之計算系統100)使用一動態電力估計(DPE)單元(例如,圖1之動態電力估計器125)來產生一處理器(例如,圖1之處理器105)正在消耗多少電力的即時預測(方塊505)。其次,系統實施一學習演算法以動態地調適DPE單元的權重,以便增加電力消耗預測的準確度(方塊510)。然後,系統使用電力消耗預測來調整處理器的電力效能設定(方塊515)。例如,在一實施例中,若電力消耗預測小於一電力消耗目標,則增加處理器的電力效能狀態。否則,若電力消耗預測大於該電力消耗目標,則減少處理器的電力效能狀態。在方塊515之後,方法500結束。
現在轉至圖6,顯示使用一學習演算法設定權重的方法600的一實施例。一學習演算法接收一電力消耗估計與一電力消耗測量之間的誤差的指示(方塊605)。其次,學習演算法僅識別相關係數,並接著基於誤差的函數計算對於該等相關係數的調整(方塊610)。在一實施例中,將學習率施加至誤差,並接著將該學習率用來計算調整。然後,將經計算調整施加至所識別的係數(方塊615)。在方塊615之後,方法600結束。在學習演算法執行方法600之後,一動態電力估計單元使用經調整係數產生更準確的電力消耗估計。應注意學習演算法可使用軟體及/或硬體的任何合適組合來實施。
現在參考圖7,顯示系統700的一實施例的方塊圖。如圖所示,系統700可代表桌上型電腦710、膝上型電腦720、平板電腦730、手機或行動電話740、電視750(或經組態以耦接至電視的機上盒)、腕錶、或其他可穿戴物品760的晶片、電路系統、組件等、或其他。其他裝置係可行且經設想的。在所繪示的實施例中,系統700包括耦接至外部記憶體702之(圖1的)處理單元105的至少一例項。處理單元105可包括或耦接至一DPE單元及OCL演算法單元。在各種實施例中,處理單元105可包括在耦接至外部記憶體702、週邊裝置704、及電力供應器706的一系統單晶片(SoC)或積體電路(IC)內。
處理單元105耦接至一或多個週邊裝置704及外部記憶體702。亦提供電力供應器706,該電力供應器將供應電壓供應至CPU 105以及將一或多個供應電壓供應至記憶體702及/或週邊裝置704。在各種實施例中,電力供應器706可代表一電池組(例如,智慧型手機、膝上型電腦、或平板電腦中的一可再充電電池組)。在一些實施例中,可包括處理單元105之多於一個的例項(且亦可包括多於一個的外部記憶體702)。
記憶體702可係任何類型的記憶體,諸如動態隨機存取記憶體(DRAM)、同步DRAM (SDRAM)、雙倍資料速率(DDR、DDR2、DDR3等)的SDRAM(包括諸如mDDR3等的SDRAM的行動版本,及/或諸如LPDDR2等的SDRAM的低功率版本)、RAMBUS DRAM (RDRAM)、靜態RAM (SRAM)等。一或多個記憶體裝置可耦接至一電路板上,以形成記憶體模組,諸如單列記憶體模組(single inline memory module, SIMM)、雙列記憶體模組(dual inline memory module, DIMM)等。替代地,裝置可在疊層晶片(chip-on-chip)組態、疊層封裝(package-on-package)組態、或多晶片模組組態下以含有處理單元105的一SoC或IC來安裝。
週邊裝置704可取決於系統700的類型而包括任何所欲電路系統。例如,在一實施例中,週邊裝置704可包括用於各種類型無線通訊(諸如wifi、藍芽、蜂巢式、全球定位系統等)的裝置。週邊裝置704亦可包括額外儲存器,其包括RAM儲存器、固態儲存器、或硬碟儲存器。週邊裝置704可包括使用者介面裝置,諸如顯示螢幕(包括觸控顯示螢幕或多觸控顯示螢幕)、鍵盤、或其他輸入裝置、麥克風、揚聲器等。
在各種實施例中,軟體應用程式的程式指令可用於實施前文所述之方法及/或機制。程式指令可用高階程式設計語言(諸如C)描述硬體的行為。替代地,可使用硬體設計語言(HDL),諸如Verilog。程式指令可儲存在非暫態電腦可讀儲存媒體上。可用多種類型儲存媒體。在使用期間,可由電腦存取儲存媒體,以提供程式指令與伴隨的資料至用於程式執行的電腦。在一些實施例中,合成工具讀取程式指令,以產生包含來自合成庫的閘極清單之接線對照表。
應強調,上述實施例僅係實施方案的非限制性實例。對於所屬技術領域中具有通常知識者而言,一旦已完全瞭解上述揭示內容,則眾多變化及修改將變得顯而易見。意欲將以下申請專利範圍解釋為涵蓋所有此等變化及修改。
100:計算系統/系統
105:處理單元/處理器/CPU/處理器單元
107:事件計數器/計數器/處理單元
110:網狀結構
120:輸入/輸出(I/O)裝置
125:動態電力估計器(DPE)
127:係數/DPE
130:電力管理單元(PMU)
135:電力供應器
140:快取/記憶體控制器
145:記憶體
150:電流感測單元
205:晶片上學習系統
210:動態電力估計單元
215A:計數器
215B:計數器
215C:計數器
215N:計數器
220A:權重
220B:權重
220C:權重
220N:權重
225:加法器
227:加法器
230:比較器
235:電流感測單元
240:學習演算法
300:混合型晶片上學習(OCL)系統
305:權重
310:硬體
320:軟體
330:乘積單元
335A:計數器
335B:計數器
335C:計數器
335D:計數器
335E:計數器
335F:計數器
335G:計數器
335H:計數器
340:庫侖計數器
400:方法
405:方塊
410:方塊
415:條件方塊
420:方塊
425:方塊
430:方塊
500:方法
505:方塊
510:方塊
515:方塊
600:方法
605:方塊
610:方塊
615:方塊
700:系統
702:外部記憶體/記憶體
704:週邊裝置
706:電力供應器
710:桌上型電腦
720:膝上型電腦
730:平板電腦
740:手機或行動電話
750:電視
760:可穿戴物品
藉由參考下文描述結合附圖可更好地理解上述之方法與機構以及另外的優點,其中:
[圖1]係計算系統之一實施例的通用方塊圖。
[圖2]係繪示晶片上學習系統之一實施例的通用方塊圖。
[圖3]係繪示混合型晶片上學習(OCL)系統之一實施例的通用方塊圖。
[圖4]係用於改善處理器電力消耗估計之準確度的方法之一實施例的流程圖。
[圖5]係使用學習演算法增加電力消耗預測之準確度的方法之一實施例的流程圖。
[圖6]係使用學習演算法調整權重的方法之一實施例的流程圖。
[圖7]係系統之一實施例的方塊圖。
雖然本揭露內容中所描述之實施例可受到各種修改且具有替代形式,然而其特定實施例係以圖式中實例之方式展示,且將在本文中詳細說明。然而,應理解,圖式及其詳細說明並非意欲將實施例侷限於所揭示之具體形式,而是意欲涵括所有落於所附申請專利範圍的精神與範圍內的修改、均等例及替代例。如本申請案中各處所用,用語「可(may)」係以許可的意涵(即,意指具有可能性)使用,而非以強制意涵(即,意指必須)使用。同樣地,用語「包括(include, including, includes)」意指包括但不限於。
可敘述各種單元、電路、或其他組件為「經組態以(configured to)」執行一任務或多個任務。在這種情況下,「經組態以」是廣泛的結構敘述,通常意味著「具有電路系統」在操作期間執行該任務或多個任務。因而,即使當單元/電路/組件當前並不接通,該單元/電路/組件仍可經組態以執行任務。一般而言,形成對應於「經組態」之結構的電路系統可包括硬體電路。類似地,為了方便敘述,可以將各種單元/電路/組件敘述為執行一任務或多個任務。此種描述應被解讀成包括用語「經組態以」。描述一單元/電路/組件經組態以執行一或多個任務,明確地意欲不援引35 U.S.C. § 112(f)對該單元/電路/組件進行解讀。
100:計算系統/系統
105:處理單元/處理器/CPU
107:事件計數器/計數器/處理單元
110:網狀結構
120:輸入/輸出(I/O)裝置
125:動態電力估計器(DPE)
127:係數/DPE
130:電力管理單元(PMU)
135:電力供應器
140:快取/記憶體控制器
145:記憶體
150:電流感測單元
Claims (20)
- 一種系統,其包含: 一處理單元; 一動態電力估計器,其經組態以: 施加一第一組權重至複數個計數器值,以產生該處理單元之電力消耗的一第一預測; 判定該處理單元之電力消耗的該第一預測的一誤差; 基於該誤差,施加調整至該第一組權重,以建立一第二組權重;及 施加該第二組權重至該複數個計數器值,以產生該處理單元之電力消耗的一第二預測;及 一電力管理單元,其經組態以基於電力消耗的該第二預測調整該處理單元的一電力效能狀態。
- 如請求項1之系統,其中該複數個計數器值係得自追蹤與該處理單元之操作狀況相關聯之事件的複數個事件計數器。
- 如請求項1之系統,其中該動態電力估計器經組態以藉由比較該第一預測與一庫侖計數器的一值而判定該處理單元之電力消耗的該第一預測的一誤差。
- 如請求項1之系統,其中該電力管理單元經組態以回應於電力消耗的該第二預測小於一臨限而增加該處理單元的該電力效能狀態。
- 如請求項1之系統,其中該電力管理單元經組態以回應於電力消耗的該第二預測大於一臨限而減少該處理單元的該電力效能狀態。
- 如請求項1之系統,其中該動態電力估計器經組態以回應於該誤差大於一臨限而施加調整至該第一組權重以建立該第二組權重。
- 如請求項1之系統,其中該動態電力估計器經組態以回應於該處理單元執行一新應用程式而施加調整至該第一組權重以建立該第二組權重。
- 一種方法,其包含: 藉由一動態電力估計器將一第一組權重施加至複數個計數器值,以產生一處理單元之電力消耗的一第一預測; 判定該處理單元之電力消耗的該第一預測的一誤差; 基於該誤差,施加調整至該第一組權重,以建立一第二組權重;及 施加該第二組權重至該複數個計數器值,以產生該處理單元之電力消耗的一第二預測;及 基於電力消耗的該第二預測,藉由一電力管理單元調整該處理單元的一電力效能狀態。
- 如請求項8之方法,其中該複數個計數器值係得自追蹤與該處理單元之操作狀況相關聯之事件的複數個事件計數器。
- 如請求項8之方法,其進一步包含藉由比較該第一預測與由一庫侖計數器產生的一值而判定該處理單元之電力消耗的該第一預測的一誤差。
- 如請求項8之方法,其進一步包含回應於電力消耗的該第二預測小於一臨限而增加該處理單元的該電力效能狀態。
- 如請求項8之方法,其進一步包含回應於電力消耗的該第二預測大於一臨限而減少該處理單元的該電力效能狀態。
- 如請求項8之方法,其進一步包含回應於該誤差大於一臨限而施加調整至該第一組權重以建立該第二組權重。
- 如請求項8之方法,其進一步包含回應於該處理單元執行一新應用程式而施加調整至該第一組權重以建立該第二組權重。
- 一種設備,其包含: 複數個計數器; 一儲存單元,其經組態以儲存複數個權重; 一比較器;及 控制邏輯,其經組態以: 將該複數個權重乘以該複數個計數器,以產生電力消耗的一第一預測; 接收電力消耗的該第一預測的一誤差的一指示; 基於該誤差,施加調整至該複數個權重;及 在對該複數個權重的該等調整後,將該複數個權重乘以該複數個計數器,以產生電力消耗的一第二預測。
- 如請求項15之設備,其中該複數個計數器值係得自追蹤與一組件之操作狀況相關聯之事件的複數個事件計數器。
- 如請求項15之設備,其中該比較器經組態以產生電力消耗的該第一預測的該誤差。
- 如請求項17之設備,其中該比較器經組態以藉由比較電力消耗的第一預測與由一庫侖計數器產生的一值而產生該誤差。
- 如請求項15之設備,其中該控制邏輯經組態以將電力消耗的該第二預測傳送至一電力管理單元。
- 如請求項15之設備,其中該控制邏輯經組態以回應於該誤差大於一臨限而施加調整至該複數個權重。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US16/584,202 | 2019-09-26 | ||
US16/584,202 US10948957B1 (en) | 2019-09-26 | 2019-09-26 | Adaptive on-chip digital power estimator |
Publications (2)
Publication Number | Publication Date |
---|---|
TW202113604A true TW202113604A (zh) | 2021-04-01 |
TWI757870B TWI757870B (zh) | 2022-03-11 |
Family
ID=72521746
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW109131867A TWI757870B (zh) | 2019-09-26 | 2020-09-16 | 電力估計方法與設備以及相關計算系統 |
Country Status (5)
Country | Link |
---|---|
US (3) | US10948957B1 (zh) |
CN (1) | CN114424144B (zh) |
DE (1) | DE112020004583T5 (zh) |
TW (1) | TWI757870B (zh) |
WO (1) | WO2021061364A1 (zh) |
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- 2020-09-03 CN CN202080064538.2A patent/CN114424144B/zh active Active
- 2020-09-03 DE DE112020004583.8T patent/DE112020004583T5/de active Pending
- 2020-09-03 WO PCT/US2020/049162 patent/WO2021061364A1/en active Application Filing
- 2020-09-16 TW TW109131867A patent/TWI757870B/zh active
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2021
- 2021-03-15 US US17/201,143 patent/US11435798B2/en active Active
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---|---|
US20220413576A1 (en) | 2022-12-29 |
CN114424144A (zh) | 2022-04-29 |
TWI757870B (zh) | 2022-03-11 |
DE112020004583T5 (de) | 2022-06-02 |
US11435798B2 (en) | 2022-09-06 |
US20210200286A1 (en) | 2021-07-01 |
CN114424144B (zh) | 2023-06-20 |
US10948957B1 (en) | 2021-03-16 |
US20210096622A1 (en) | 2021-04-01 |
WO2021061364A1 (en) | 2021-04-01 |
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