TW201643726A - 介面供電電路 - Google Patents

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TW201643726A
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鄧均義
陳俊生
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鴻富錦精密工業（武漢）有限公司
鴻海精密工業股份有限公司
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    • G05—CONTROLLING; REGULATING
    • G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
    • G05F3/00—Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
    • G05F3/02—Regulating voltage or current

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Abstract

一種介面供電電路，包括供電單元、一連接所述供電單元之控制單元及一連接所述控制單元之偵測單元，所述偵測單元用於連接一介面，所述偵測單元用在於偵測到所述介面插接一設備後輸出一第一控制訊號及用在於偵測到所述介面沒有插接所述設備後輸出一第二控制訊號，所述控制單元於接收到所述第一控制訊號後導通，所述供電單元用在於所述控制單元導通後供電給所述介面，所述控制單元用在於接收到所述第二控制訊號後斷開所述供電單元與所述介面之連接。

Description

介面供電電路
本發明涉及一種介面供電電路。
一般電子裝置中包括複數用於連接外設之輸入輸出介面，某些介面，例如，PCIe介面，是最新之匯流排和介面標準。PCIe屬於高速串列點對點雙通道高頻寬傳輸，所連接之設備分配獨享通道頻寬，不共用匯流排頻寬，主要支援主動電源管理，錯誤報告，端對端之可靠性傳輸，熱插拔以及服務品質(QOS)等功能。習知電子裝置中之PCIe介面於閒置未插接PCIe設備時仍有供電電源供電給PCIe介面，從而產生功耗，並且當導電物質掉入PCIe介面時極易發生漏電。
鑒於以上內容，有必要提供一種於未插接PCIe設備時減少功耗及避免發生漏電之介面供電電路。
一種介面供電電路，包括一供電單元、一連接所述供電單元之控制單元及一連接所述控制單元之偵測單元，所述偵測單元用於連接一介面，所述偵測單元用在於偵測到所述介面插接一設備後輸出一第一控制訊號及用在於偵測到所述介面沒有插接所述設備後輸出一第二控制訊號，所述控制單元於接收到所述第一控制訊號後導通，所述供電單元用在於所述控制單元導通後供電給所述介面，所述控制單元用在於接收到所述第二控制訊號後斷開所述供電單元與所述介面之連接。
與習知技術相比，上述介面供電電路中，當所述介面插接所述設備後，所述控制單元導通，從而所述供電單供電給所述介面；當所述介面沒有插接所述設備後，所述控制單元斷開所述供電單元與所述介面之連接，從而減少功耗及避免產生漏電。
圖1係本發明介面供電電路之一較佳實施方式之一功能模組圖。
圖2係本發明介面供電電路之一較佳實施方式之一電路連接圖。
請參閱圖1，本發明之一較佳實施方式，一介面供電電路，包括一供電單元10、一控制單元20及一偵測單元30。所述供電單元10用於藉由所述控制單元20給一介面40供電。於一實施例中，所述介面40為一PCIe介面並用於插接一PCIe設備。
所述供電單元10包括一第一電源11、一第二電源13、及一第三電源15。於一實施例中，所述第一電源11用於提供一3V之電壓，所述第二電源13用於提供一3V之電壓，所述第三電源15用於提供一12V之電壓。
所述控制單元20包括一第一控制電路21、一第二控制電路23及一第三控制電路25。
所述偵測單元30包括一偵測晶片31及一第四控制電路33。於一實施例中，所述偵測晶片31為一PCH晶片，並用於偵測所述介面40是否插接PCIe設備。
請參閱圖2，所述第一控制電路21包括一第一電晶體Q1、一第一電阻R1及一第一電容C1。所述第二控制電路23包括一第二電晶體Q2、一第二電阻R2及一第二電容C2。所述第三控制電路25包括一第三電晶體Q3、一第三電阻R3及一第三電容C3。所述第一電晶體Q1、所述第二電晶體Q2及所述第三電晶體Q3均包括一控制端G、一第一連接端S及一第二連接端D。
所述第四控制電路33包括一第四電阻R4及一第四電源35。
所述介面40包括一控制引腳41、一第一電源引腳42、一第二電源引腳43及一第三電源引腳44。
所述偵測晶片31連接一節點37。所述節點37連接所述第四電阻R4之一端。所述第四電阻R4之另一端連接所述第四電源35。所述節點37連接所述介面40之控制引腳41。所述節點37連接所述第一電阻R1之一端。所述第一電阻R1之另一端連接所述第一電晶體Q1之控制端G。所述第一電晶體Q1之控制端G藉由所述第一電容C1連接所述第一電晶體Q1之第一連接端S。所述第一電晶體Q1之第二連接端D連接所述第一電源11。所述第一電晶體Q1之第一連接端S連接所述介面40之第一電源引腳42。
所述節點37連接所述第二電阻R2之一端。所述第二電阻R2之另一端連接所述連接所述第二電晶體Q2之控制端G。所述第二電晶體Q之控制端G藉由所述第二電容C2連接所述第二電晶體Q2之第一連接端S。所述第二電晶體Q2之第二連接端D連接所述第二電源13。所述第二電晶體Q2之第一連接端S連接所述介面40之第二電源引腳43。
所述節點37連接所述第三電阻R3之一端。所述第三電阻R3之另一端連接所述連接所述第三電晶體Q3之控制端G。所述第第三電晶體Q3之控制端G藉由所述第三電容C3連接所述第三電晶體Q3之第一連接端S。所述第二電晶體Q2之第二連接端D連接所述第三電源15。所述第三電晶體Q3之第一連接端S連接所述介面40之第三電源引腳44。
於一實施例中，所述第一電晶體Q1、所述第二電晶體Q2及所述第三電晶體Q3均為N溝道場效應管，每一控制端G對應所述N溝道場效應管之閘極，每一第一連接端S對應所述N溝道場效應管之源極，每一第二連接端D對應所述N溝道場效應管之汲極。
所述介面供電電路之工作原理為：當所述偵測晶片31偵測到所述介面40有插接PCIe設備時，所述偵測單元30輸出一低電平之第一控制訊號，所述第一電晶體Q1、所述第二電晶體Q2及所述第三電晶體Q3接收到所述低電平之第一控制訊號後均導通，所述第一電源11、所述第二電源13及所述第三電源15供電給所述介面40。當所述偵測晶片31偵測到所述介面40沒有插接PCIe設備時，所述偵測單元30輸出一高電平之第二控制訊號，所述第一電晶體Q1、所述第二電晶體Q2及所述第三電晶體Q3接收到所述高電平之第二控制訊號後均截止，所述第一電源11、所述第二電源13及所述第三電源15不供電給所述介面40，從而減少耗電，並防止導電物質掉入所述介面40產生之短路現象發生。
綜上所述，本發明確已符合發明專利之要件，遂依法提出專利申請。惟，以上所述者僅為本發明之較佳實施方式，自不能以此限制本案之申請專利範圍。舉凡熟悉本案技藝之人士爰依本發明之精神所作之等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
10‧‧‧供電單元
11‧‧‧第一電源
13‧‧‧第二電源
15‧‧‧第三電源
20‧‧‧控制單元
21‧‧‧第一控制電路
23‧‧‧第二控制電路
25‧‧‧第三控制電路
30‧‧‧偵測單元
31‧‧‧偵測晶片
33‧‧‧第四控制電路
35‧‧‧第四電源
37‧‧‧節點
40‧‧‧介面
41‧‧‧控制引腳
42‧‧‧第一電源引腳
43‧‧‧第二電源引腳
44‧‧‧第三電源引腳
無
10‧‧‧供電單元
11‧‧‧第一電源
13‧‧‧第二電源
15‧‧‧第三電源
20‧‧‧控制單元
21‧‧‧第一控制電路
23‧‧‧第二控制電路
25‧‧‧第三控制電路
30‧‧‧偵測單元
31‧‧‧偵測晶片
33‧‧‧第四控制電路
40‧‧‧介面

Claims (10)

  1. 一種介面供電電路，包括一供電單元、一連接所述供電單元之控制單元及一連接所述控制單元之偵測單元，所述偵測單元用於連接一介面，所述偵測單元用在於偵測到所述介面插接一設備後輸出一第一控制訊號及用在於偵測到所述介面沒有插接所述設備後輸出一第二控制訊號，所述控制單元於接收到所述第一控制訊號後導通，所述供電單元用在於所述控制單元導通後供電給所述介面，所述控制單元用在於接收到所述第二控制訊號後斷開所述供電單元與所述介面之連接。
  2. 如請求項第1項所述之介面供電電路，其中所述控制單元包括用於連接所述介面之一第一控制電路及一第二控制電路，所述供電單元包括一連接所述第一控制電路之第一電源及一連接所述第二控制電路之第二電源，所述第一控制電路及所述第二控制電路於接收到所述第一控制訊號後導通及用在於接收到所述第二控制訊號後斷開所述供電單元與所述介面之連接，所述第一電源用在於所述第一控制電路導通後供電給所述介面，所述第二電源用在於所述第二控制電路導通供電給所述介面。
  3. 如請求項第2項所述之介面供電電路，其中所述第一控制電路包括一第一電晶體，所述第一電晶體包括一控制端、一第一連接端及一第二連接端，所述第一電晶體之控制端連接所述偵測單元，所述第一電晶體之第一連接端用於連接所述介面，所述第一電晶體之第二連接端連接所述第一電源。
  4. 如請求項第3項所述之介面供電電路，其中所述第一控制電路還包括一第一電阻及一電容，所述第一電阻之一端連接所述偵測單元，所述第一電阻之另一端連接所述第一電晶體之控制端，所述第一電晶體之控制端與所述第一電晶體之第一連接端之間連接所述電容。
  5. 如請求項第4項所述之介面供電電路，其中所述偵測單元包括一用於連接所述介面之偵測晶片，所述偵測晶片用於偵測所述介面是否插接所述設備，所述偵測晶片與所述第一電晶體之控制端之間連接所述第一電阻。
  6. 如請求項第5項所述之介面供電電路，其中所述偵測單元還包括連接所述偵測晶片之第二電阻，所述第二電阻連接所述第一電阻。
  7. 如請求項第5項所述之介面供電電路，其中所述偵測晶片為一PCH晶片。
  8. 如請求項第2項所述之介面供電電路，其中所述第二控制電路包括一第二電晶體，所述電晶體包括一控制端、一第一連接端及一第二連接端，所述第二電晶體之控制端連接所述偵測單元，所述第二電晶體之第一連接端用於連接所述介面，所述第一電晶體之第二連接端連接所述第二電源。
  9. 如請求項第8項所述之介面供電電路，其中所述第二電晶體為N溝道場效應管，所述第二電晶體之控制端對應所述N溝道場效應管之閘極，所述第二電晶體之第一連接端對應所述N溝道場效應管之源極，所述第二電晶體之第二連接端D對應所述N溝道場效應管之汲極。
  10. 如請求項第1項所述之介面供電電路，其中所述介面為一PCIe介面。
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