TW201419252A - 顯示裝置 - Google Patents

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Abstract

一種顯示裝置包括液晶顯示面板、源極驅動器、閘極驅動器及時序控制器，且液晶顯示面板包括主掃描線、副掃描線、第一畫素及第二畫素。時序控制器控制該閘極驅動器於每一圖框時間內交錯輸出一主掃描訊號及一副掃描訊號，且相鄰之該主掃描訊號與該副掃描訊號之時間差係為一延遲時間值，而該主掃描訊號控制該第一畫素寫入該第一極性資料及該第二畫素寫入該第二極性資料，且該副掃描訊號控制該第一畫素及該第二畫素進行電荷分配；其中，該些圖框時間(frame time)具有至少兩種不同之該延遲時間值。

Description

顯示裝置
本揭露是有關於一種顯示裝置。
請同時參照第11圖及第12圖，第11圖繪示係為傳統液晶顯示面板與其畫素資料之部份示意圖，第12圖繪示係為傳統液晶面板產生單一線性殘影之示意圖。液晶顯示面板21包括第一極性資料線211、第二極性資料線212、主掃描線213、副掃描線214及畫素215(11)~215(16)。畫素215(11)~215(16)分別位於液晶顯示面板21之第11~16列。畫素215(11)、畫素215(13)及畫素215(15)耦接第一極性資料線211、主掃描線213及副掃描線214，且畫素215(12)、畫素215(14)及畫素215(16)耦接第二極性資料線212、主掃描線213及副掃描線214。第一極性資料線211上的第一極性資料D+大於等於共同電壓Vcom，而第二極性資料線212上的第二極性資料D-小於等於共同電壓Vcom。
然而，當寫入畫素215(14)之第一極性資料D+與寫入畫素215(12)之第一極性資料D+不同，且寫入畫素215(13)之第二極性資料D-與寫入畫素215(11)之第二極性資料D-相同時，將產生雜訊電壓。由於第一極性資料D+及第二極性資料D-分別寫入至畫素215(13)及畫素215(14)時，有其他畫素因受控於副掃描線214而開啟，因此導致雜訊電壓寫入其他畫素。如此一來，將於如 第12圖繪示於液晶顯示面板21顯示一條線性殘影210。
本揭露係有關於一種顯示裝置。
根據本揭露，提出一種顯示裝置。顯示裝置包括液晶顯示面板、源極驅動器、閘極驅動器及時序控制器，且液晶顯示面板包括第一極性資料線、第二極性資料線、主掃描線、副掃描線、第一畫素及第二畫素。第一畫素耦接第一極性資料線、主掃描線及副掃描線，且第二畫素耦接第二極性資料線、主掃描線及副掃描線。源極驅動器輸出第一極性資料至第一極性資料線，並輸出第二極性資料至第二極性資料線。閘極驅動器耦接主掃描線及副掃描線。時序控制器控制閘極驅動器於每一圖框時間內交錯輸出主掃描訊號及副掃描訊號，且相鄰之主掃描訊號與副掃描訊號之時間差係為延遲時間值。主掃描訊號控制第一畫素寫入第一極性資料及第二畫素寫入第二極性資料，且副掃描線控制第一畫素及第二畫素進行電荷分配。
根據本揭露，提出一種顯示裝置。顯示裝置包括液晶顯示面板、源極驅動器、閘極驅動器及時序控制器，且液晶顯示面板包括第一極性資料線、第二極性資料線、主掃描線、副掃描線、第一畫素及第二畫素。第一畫素耦接第一極性資料線、主掃描線及副掃描線，且第二畫素耦接第二極性資料線、主掃描線及副掃描線。源極驅動器輸出第一極性資料至第一極性資料線，並輸出第二極性資料至第二極性資料線。源極驅動器輸出第一極性資料至第一極性 資料線，並輸出第二極性資料至第二極性資料線。閘極驅動器耦接主掃描線及副掃描線。時序控制器控制閘極驅動器於每一圖框時間內交錯輸出主掃描訊號及副掃描訊號，且相鄰之主掃描訊號與副掃描訊號之時間差係為延遲時間值。主掃描訊號控制第一畫素寫入第一極性資料及第二畫素寫入第二極性資料，且副掃描訊號控制第一畫素及第二畫素進行電荷分配，副掃描訊號致能副掃描線之時間大於主掃描訊號致能該主掃描線之時間。
為了對本揭露之上述及其他方面有更佳的瞭解，下文特舉實施例，並配合所附圖式，作詳細說明如下：
第一實施例
請同時參照第1圖及第2圖，第1圖繪示係為依照第一實施例之一種顯示裝置之示意圖，第2圖繪示係為依照第一實施例之顯示面板之部份示意圖。顯示裝置1包括液晶顯示面板11、閘極驅動器12、源極驅動器13及時序控制器14。時序控制器14控制閘極驅動器12及源極驅動器13驅動液晶顯示面板11。
液晶顯示面板11包括第一極性資料線111、第二極性資料線112、主掃描線113、副掃描線114、第一畫素115及第二畫素116。第一畫素115耦接第一極性資料線111、主掃描線113及副掃描線114，且第二畫素116耦接第二極性資料線112、主掃描線113及副掃描線114。閘極驅動器12耦接主掃描線113及副掃描線114。源極驅動器13 耦接第一極性資料線111及第二極性資料線112。源極驅動器13輸出第一極性資料D+至第一極性資料線111，並輸出第二極性資料D-至第二極性資料線112。
第一畫素115進一步包括第一液晶電容CA1、第一電晶體TFT1、第二液晶電容CB1、第二電晶體TFT2及第一暗區電容CC1。第一電晶體TFT1係受控於主掃描訊號MS電性連接第一極性資料線111至第一液晶電容CA1。第二電晶體TFT2係受控於主掃描訊號MS電性連接第一極性資料線111至第二液晶電容CB1。第三電晶體TFT3係受控於副掃描訊號LCS電性連接第一暗區電容CC1至第二液晶電容CB1以進行電荷分配。
第二畫素116包括第三液晶電容CA2、第四電晶體TFT4、第四液晶電容CB2、第五電晶體TFT5、第二暗區電容CC2及第六電晶體TFT6。第四電晶體TFT4係受控於主掃描訊號MS電性連接第二極性資料線112至第三液晶電容CA2。第五電晶體TFT5係受控於主掃描訊號MS電性連接第二極性資料線112至第四液晶電容CB2。第六電晶體TFT6係受控於副掃描訊號LCS電性連接第二暗區電容CC2至第四液晶電容CB2以進行電荷分配。
時序控制器14控制閘極驅動器12於每一圖框時間內交錯輸出主掃描訊號MS及副掃描訊號LCS，且相鄰之主掃描訊號MS與副掃描訊號之時間差係為一延遲時間值。而主掃描訊號MS控制第一畫素115寫入第一極性資料D+至第一液晶電容CA1及第二液晶電容CB1，及控制第二畫素116寫入第二極性資料D-至第三液晶電容CA2及第四 液晶電容CB2。副掃描訊號LCS控制第一畫素115及第二畫素116進行電荷分配。
請同時參照第1圖、第3圖及第4圖，第3圖繪示係為依照第一實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖，第4圖繪示係為依照第一實施例將單一線性殘影分別於四個圖框時間顯示，因此會被分成四條線性殘影而使其亮度也會降低，如此，因為亮度之降低而降低人眼對此線性殘影之感覺。每一圖框時間內之副掃描訊號LCS係於主掃描訊號MS輸出後經延遲時間值△t輸出，該些圖框時間(frame time)具有至少兩種不同之該延遲時間值。為方便說明起見，第3圖繪示係以4個圖框時間及4個延遲時間值為例說明。延遲時間△t於圖框時間F(n)至F(n+3)分別對應至延遲時間值DT0至DT3。延遲時間值DT0至DT3彼此係不相同。
舉例來說，延遲時間值△t於圖框時間F(n)等於延遲時間值DT0，而延遲時間值DT0例如為5條掃描線開啟時間。由於副掃描訊號LCS及主掃描訊號MS係一次開啟兩列畫素，所以副掃描訊號LCS所開啟的畫素與主掃描訊號MS所開啟的畫素相差10列之掃描線開啟時間之值。當液晶顯示面板11中第24列之第二畫素116於圖框時間F(n)受控於主掃描訊號MS寫入第二極性資料D-時，第13列之第一畫素115及第14列之第二畫素116於圖框時間F(n)受控於副掃描訊號LCS進行電荷分配。
接著，延遲時間值△t於圖框時間F(n+1)等於延遲時間值DT1，而延遲時間值DT1例如為6條掃描線開啟時 間。由於副掃描訊號LCS及主掃描訊號MS係一次開啟兩列畫素，所以副掃描訊號LCS所開啟的畫素與主掃描訊號MS所開啟的畫素相差12列之掃描線開啟時間之值。當液晶顯示面板11中第24列之第二畫素116於圖框時間F(n+1)受控於主掃描訊號MS寫入第二極性資料D-時，第11列之第一畫素115及第12列之第二畫素116於圖框時間F(n+1)受控於副掃描訊號LCS進行電荷分配。
跟著，延遲時間值△t於圖框時間F(n+2)等於延遲時間值DT2，而延遲時間值DT2例如為7條掃描線開啟時間。由於副掃描訊號LCS及主掃描訊號MS係一次開啟兩列畫素，所以副掃描訊號LCS所開啟的畫素與主掃描訊號MS所開啟的畫素相差14列之掃描線開啟時間之值。當液晶顯示面板11中第24列之第二畫素116於圖框時間F(n+2)受控於主掃描訊號MS寫入第二極性資料D-時，第9列之第一畫素115及第10列之第二畫素116於圖框時間F(n+2)受控於副掃描訊號LCS進行電荷分配。
然後，延遲時間值△t於圖框時間F(n+3)等於延遲時間值DT3，而延遲時間值DT3例如為8條掃描線開啟時間。由於副掃描訊號LCS及主掃描訊號MS係一次開啟兩列畫素，所以副掃描訊號LCS所開啟的畫素與主掃描訊號MS所開啟的畫素相差16列之掃描線開啟時間之值。當液晶顯示面板11中第24列之第二畫素116於圖框時間F(n+3)受控於主掃描訊號MS寫入第二極性資料D-時，第7列之第一畫素115及第8列之第二畫素116於圖框時間F(n+3)受控於副掃描訊號LCS進行電荷分配。
資料耦合效應所產生的雜訊電壓會在不同的圖框時間寫入不同的列畫素。如此一來，原先的單一線性殘影將如第圖4繪示擴展為線性殘影110a、線性殘影110b、線性殘影110c及線性殘影110d。由於原先單一條線性殘影的亮度被均分為四份，使得殘影的亮度相對地下降，進而讓人眼感受不到殘影的存在。
請同時參照第1圖及第5圖，第5圖繪示係為施加電壓後液晶之穿透率變化示意圖。當施加電壓72於液晶顯示面板11，其液晶之穿透率變化如曲線71所繪示。液晶延遲時間T1表示施加電壓72於液晶顯示面板11後，其液晶之穿透率由0至10%的時間。穩態時間T2表示施加電壓72於液晶顯示面板11後，其液晶之穿透率由0至90%的時間。上升時間T3表示施加電壓72於液晶顯示面板11後，其液晶之穿透率由10%至90%的時間。
請同時參照第1圖、第5圖、第6圖及表1，第6圖繪示係為不同電壓變化區間之液晶延遲時間T1、穩態時間T2及上升時間T3之示意圖，表1係為不同面板尺寸。穩態時間T2及上升時間T3對應至左側縱座標，而液晶延遲時間T1對應至右側縱座標。根據穩態時間T2及上升時間T3可計算出液晶延遲時間T1。當電壓變化區間為1V~6V時，液晶延遲時間T1等於3.2毫秒。當電壓變化區間為1V~7V時，液晶延遲時間T1等於2毫秒。當電壓變化區間為1V~8V時，液晶延遲時間T1等於0.6毫秒。
液晶延遲時間T1’表示液晶之穿透率由0至1%的時間。當電壓變化區間為1V~6V時，液晶延遲時間T1’等 於320微秒。當電壓變化區間為1V~7V時，液晶延遲時間T1’等於200微秒。當電壓變化區間為1V~8V時，液晶延遲時間T1等於60微秒。
當液晶顯示面板11之畫面頻率為120Hz時，解析度4K2K、解析度FHD及解析度HD的單一條掃描線開啟時間分別為3.5微秒、7微秒及10微秒。當液晶顯示面板11之畫面頻率為60Hz時，解析度4K2K、解析度FHD及解析度HD的單一條掃描線開啟時間分別為7微秒、14微秒及20微秒。
前述不同延遲時間值之上限個數取決於液晶顯示面板11之上升時間的1%，即液晶延遲時間T1’。舉例來說，當液晶顯示面板11之解析度為4K2K且畫面頻率為120Hz，單一條掃描線開啟時間約為3.5微秒。320微秒除以3.5微秒約為91，而不同延遲時間值之上限個數即為91。換言之，原先的單一線性殘影最多可擴展為91條亮度較暗的線性殘影。
第二實施例
請參照第1圖及第7圖，第7圖繪示係為依照第二實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖。第二實施例與第一實施例主要不同之處在於時序控制器14控制閘極驅動器12更於圖框時間F(n+4)至F(n+7)輸出副掃描訊號LCS，且圖框時間F(n+4)至F(n+7)之副掃描訊號LCS分別與圖框時間F(n)至F(n+3)之副掃描訊號LCS相同。延遲時間值△t於圖框時間F(n+4)至F(n+7)分別對應至延遲時間值DT4至DT7。延遲時間值DT4至DT7彼此係不相同，且延遲時間值DT4至DT7分別等於延遲時間值DT0至DT3。
第三實施例
請參照第1圖及第8圖，第8圖繪示係為依照第三實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖。第三實施例與第二實施例主要不同之處在於延遲時間值△t於圖框時間F(n)至F(n+7)分別對應至延遲時間值DT0至DT7。延遲時間值DT0等於延遲時間值DT1，且延遲時間值DT2等於延遲時間值DT3。延遲時間值DT4等於延遲時間值DT5，且延遲時間值DT6等於延遲時間值DT7。延遲時間值DT0、延遲時間值D2、延遲時間值D4至延遲時間值D6彼此係不相同。
第四實施例
請參照第1圖及第9圖，第9圖繪示係為依照第四實 施例之主掃描訊號及副掃描訊號之訊號時序圖。第四實施例與第一實施例主要不同之處在於第四實施例之副掃描訊號LCS致能副掃描線114之時間大於主掃描訊號MS致能主掃描線113之時間。當主掃描訊號MS除能主掃描線113時，副掃描訊號LCS持續致能副掃描線114。換言之，副掃描線114被致能的時間遠大於被除能的時間。
第五實施例
請參照第1圖及第10圖，第10圖繪示係為依照第五實施例之主掃描訊號及副掃描訊號之訊號時序圖。第五實施例與第四實施例主要不同之處在於第五實施例之副掃描訊號LCS包括連續之數個掃描脈衝。由於副掃描訊號LCS所包含之掃描脈衝個數多於主掃描訊號MS所包含之掃描脈衝個數，因此副掃描訊號LCS致能副掃描線114之時間將大於主掃描訊號MS致能主掃描線113之時間。
綜上所述，雖然本揭露已以實施例揭露如上，然其並非用以限定本揭露。本揭露所屬技術領域中具有通常知識者，在不脫離本揭露之精神和範圍內，當可作各種之更動與潤飾。因此，本揭露之保護範圍當視後附之申請專利範圍所界定者為準。
1‧‧‧顯示裝置
11、21‧‧‧液晶顯示面板
12‧‧‧閘極驅動器
13‧‧‧源極驅動器
14‧‧‧時序控制器
71‧‧‧曲線
72‧‧‧電壓
110a~110d、210‧‧‧線性殘影
111、211‧‧‧第一極性資料線
112、212‧‧‧第二極性資料線
113‧‧‧主掃描線
114‧‧‧副掃描線
115‧‧‧第一畫素
116‧‧‧第二畫素
215(11)、215(12)、215(13)、215(14)、215(15)、215(15)‧‧‧畫素
CA1‧‧‧第一液晶電容
CB1‧‧‧第二液晶電容
CA2‧‧‧第三液晶電容
CB2‧‧‧第四液晶電容
CC1‧‧‧第一暗區電容
CC2‧‧‧第二暗區電容
第四電晶體TFT4、、第五電晶體TFT5、及第六電晶體TFT6。
D+‧‧‧第一極性資料
D-‧‧‧第二極性資料
DT0~DT7‧‧‧延遲時間值(與△t：延遲時間值擇一)
F(n)~F(n+7)‧‧‧圖框時間
LCS‧‧‧副掃描訊號
MS‧‧‧主掃描訊號
TFT1‧‧‧第一電晶體
TFT2‧‧‧第二電晶體
TFT3‧‧‧第三電晶體
TFT4‧‧‧第四電晶體
TFT5‧‧‧第五電晶體
TFT6‧‧‧第六電晶體
T1‧‧‧液晶延遲時間
T2‧‧‧穩態時間
T3‧‧‧上升時間
Vcom‧‧‧共同電壓
△t‧‧‧延遲時間值
第1圖繪示係為依照第一實施例之一種顯示裝置之示意圖。
第2圖繪示係為依照第一實施例之顯示面板之部份 示意圖。
第3圖繪示係為依照第一實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖。
第4圖繪示係為依照第一實施例將單一線性殘影的亮度分成四條線性殘影之示意圖。
第5圖繪示係為施加電壓後液晶之穿透率變化示意圖。
第6圖繪示係為不同電壓變化區間之液晶延遲時間T1、穩態時間T2及上升時間T3之示意圖。
第7圖繪示係為依照第二實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖。
第8圖繪示係為依照第三實施例之主掃描訊號及副掃描訊號於不同圖框時間之訊號時序圖。
第9圖繪示係為依照第四實施例之主掃描訊號及副掃描訊號之訊號時序圖。
第10圖繪示係為依照第五實施例之主掃描訊號及副掃描訊號之訊號時序圖。
第11圖繪示係為傳統液晶顯示面板與其畫素資料之部份示意圖。
第12圖繪示係為傳統液晶面板產生單一線性殘影之示意圖。
F(n)~F(n+3)‧‧‧圖框時間
△t‧‧‧延遲時間
DT0~DT3‧‧‧延遲時間值

Claims (10)

  1. 一種顯示裝置，包括：一液晶顯示面板，包括：複數第一極性資料線；複數第二極性資料線；複數主掃描線；複數副掃描線；複數第一畫素，每一該第一畫素耦接該第一極性資料線、該主掃描線及該副掃描線；複數第二畫素，每一該第二畫素耦接該第二極性資料線、該主掃描線及該副掃描線；一源極驅動器，用以輸出複數第一極性資料至對應之該等第一極性資料線，並輸出複數第二極性資料至對應之該等第二極性資料線；一閘極驅動器，耦接該等主掃描線及該等副掃描線；一時序控制器，用以控制該閘極驅動器於每一圖框時間內交錯輸出一主掃描訊號及一副掃描訊號，且相鄰之該主掃描訊號與該副掃描訊號之時間差係為一延遲時間值，而該主掃描訊號控制該第一畫素寫入該第一極性資料及該第二畫素寫入該第二極性資料，且該副掃描訊號控制該第一畫素及該第二畫素進行電荷分配；其中，該些圖框時間(frame time)具有至少兩種不同之該延遲時間值。
  2. 如申請專利範圍第1項所述之顯示裝置，其中該些圖框時間包括一第一圖框時間及一第二圖框時間，該些 延遲時間值包括一第一延遲時間值及一第二延遲時間值，該第一圖框時間及該第二畫框時間分別對應至該第一延遲時間值及該第二延遲時間值，該第一延遲時間值與該第二延遲時間值彼此不同。
  3. 如申請專利範圍第2項所述之顯示裝置，其中該些圖框時間包括一第三圖框時間及一第四圖框時間，該些延遲時間值包括一第三延遲時間值及一第四延遲時間值，該第三圖框時間及該第四圖框時間分別對應至該第三延遲時間值及該第四延遲時間值，該第一延遲時間值、該第二延遲時間值、該第三延遲時間值與該第四延遲時間值彼此不同。
  4. 如申請專利範圍第2項所述之顯示裝置，其中該些圖框時間包括一第三圖框時間及一第四圖框時間，該些延遲時間值包括一第三延遲時間值及一第四延遲時間值，該第三圖框時間及該第四圖框時間分別對應至該第三延遲時間值及該第四延遲時間值，該第三延遲時間值與該第一延遲時間值相同，且該第四延遲時間值與該第二延遲時間值相同。
  5. 如申請專利範圍第1項所述之顯示裝置，其中該第一畫素，包括：一第一液晶電容；一第一電晶體，係受控於該主掃描訊號電性連接該第一極性資料線至該第一液晶電容；一第二液晶電容；一第二電晶體，係受控於該主掃描訊號電性連接該第 一極性資料線至該第二液晶電容；一第一暗區電容；以及一第三電晶體，係受控於該副掃描訊號電性連接該第一暗區電容至該第二液晶電容；而該第二畫素，包括：一第三液晶電容；一第四電晶體，係受控於該主掃描訊號電性連接該第二極性資料線至該第三液晶電容；一第四液晶電容；一第五電晶體，係受控於該主掃描訊號電性連接該第二極性資料線至該第四液晶電容；一第二暗區電容；以及一第六電晶體，係受控於該副掃描訊號電性連接該第二暗區電容至該第四液晶電容。
  6. 如申請專利範圍第1項所述之顯示裝置，其中該時序控制器根據一畫面序號(Frame Number)調整該些延遲時間值。
  7. 如申請專利範圍第1項所述之顯示裝置，其中該些延遲時間值之上限個數取決於該液晶顯示面板之一上升時間的百分之一。
  8. 如申請專利範圍第7項所述之顯示裝置，其中該上升時間係為液晶分子於施加電壓後，穿透率由0改變至10%的時間。
  9. 一種顯示裝置，包括：一液晶顯示面板，包括： 複數第一極性資料線；複數第二極性資料線；複數主掃描線；複數副掃描線；複數第一畫素，每一該第一畫素耦接該第一極性資料線、該主掃描線及該副掃描線：複數第二畫素，每一該第二畫素耦接該第二極性資料線、該主掃描線及該副掃描線：一源極驅動器，用以輸出複數第一極性資料至對應之該等第一極性資料線，並輸出複數第二極性資料至對應之該等第二極性資料線；一閘極驅動器，耦接該等主掃描線及該等副掃描線；一時序控制器，用以控制該閘極驅動器於每一圖框時間內交錯輸出一主掃描訊號及一副掃描訊號，且相鄰之該主掃描訊號與該副掃描訊號之時間差係為一延遲時間值，而該主掃描訊號控制該第一畫素寫入該第一極性資料及該第二畫素寫入該第二極性資料，且該副掃描訊號控制該第一畫素及該第二畫素進行電荷分配，該副掃描訊號致能該副掃描線之時間大於該主掃描訊號致能該主掃描線之時間。
  10. 如申請專利範圍第9項所述之顯示裝置，其中當該主掃描訊號除能(disable)該主掃描線時，該副掃描訊號致能(enable)該副掃描線，且該副掃描訊號包括複數個掃描脈衝。
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