SU743183A1 - Pulse delay device - Google Patents
Pulse delay device Download PDFInfo
- Publication number
- SU743183A1 SU743183A1 SU772531510A SU2531510A SU743183A1 SU 743183 A1 SU743183 A1 SU 743183A1 SU 772531510 A SU772531510 A SU 772531510A SU 2531510 A SU2531510 A SU 2531510A SU 743183 A1 SU743183 A1 SU 743183A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- pulses
- integrator
- pulse
- outputs
- trigger
- Prior art date
Links
Landscapes
- Pulse Circuits (AREA)
Description
II
Изобретение относитс к импульсной технике, в именно к технике формировани и преобразовани импульсных сигналов в пигтазоне низких частот.The invention relates to a pulse technique, in particular to a technique for generating and converting pulse signals in a low frequency pigment zone.
Известны устройства а л задержки импупьсов , сопержешие формирователь, интег-; 5 ратор и пороговый каскап flT .Known devices and l delay impups, rival shaper, integ-; 5 rarator and flT threshold cascade.
Недостатком данного устройства вл етс зависимость величины фазовой задержки от изменени частоты спедовани задерживаемых импульсов.10The disadvantage of this device is the dependence of the magnitude of the phase delay on the change in the frequency of the delayed-pulse pulse 10.
Цель изобретени - обеспечение посто нства величины фазовой задержки в дие пазоне частот.The purpose of the invention is to provide a constant value of the phase delay in the frequency range.
Дл этого в устройство дл задержки импульсов, содержащее формирователь, )5 тегратор и пороговый каскад введены триггер, разделительные конденсаторы и дополнительные интегратор и пороговый каскад, причем входы интеграторов соединены с противофазными выходами формиро-20 ватеп , а выходы - через разпепительные конденсаторы соединены со входом nopotx вых каскадов, выходы которых соединены со входами Триггера.To do this, a trigger, separation capacitors and an additional integrator and a threshold stage are inserted into the pulse delay device containing the shaper, the 5th grader and the threshold stage, and the integrator inputs are connected to the anti-phase form-20 outputs, and the outputs are connected to the input capacitors nopotx output cascades whose outputs are connected to the trigger inputs.
На фиг. 1 представлена функциональна схема устройства; на фиг. 2 - диаграммы, по сн ющие принцип его работы.FIG. 1 shows a functional diagram of the device; in fig. 2 - diagrams explaining the principle of its work.
Устройство содержит формирователь 1, интеграторы 2 3, разделительные конденсаторы 4 и 5, пороговые каскады 6 иThe device contains a driver 1, integrators 2 3, separation capacitors 4 and 5, threshold stages 6 and
7и триггер 8, причем интеграторы 2 и 3 идентичны и содержат несимметричные7 and trigger 8, and integrators 2 and 3 are identical and contain asymmetrical
цепи зар да и разр да с возможностью регулировани одной из них. chains of charge and discharge with the possibility of regulating one of them.
Принцип действи устройства заключаветс в следующем.The principle of the device is as follows.
Импульсы со скважностью , nociyпающие на вход формировател , нормализуютс по амплитуде. С его выхоца (эпюры А и Б на фиг. 2) пр моугольные импульсы поступают на интеграторы 2 и 3, напр жение на выходе которых измен етс линейно в течение действи импульса. По окончании импульса напр жение на выходе интеграторов измен етс также линейно , но уже с иной (большей) скоростью по начального нулевого значени (эпюрыPulses with a duty cycle, which are input to the driver, are normalized in amplitude. From its output (diagrams A and B in Fig. 2), rectangular pulses are fed to integrators 2 and 3, the output voltage of which varies linearly during the action of the pulse. At the end of the pulse, the voltage at the output of the integrators also varies linearly, but already at a different (higher) speed at the initial zero value (plot
8и Г на фиг. 2), Благодар линейности фронтов пилообразньк импульсов на выходе интеграторов, амплитуда импульсов и посто дааа составл юща их последователь ности ваменаютс пропорционально изменению частоты входньвс импульсов: увеличив аетс при уменьшении частоты и уменьшаетс при ее увеличении. После фильтрации постр вной составл ющей полученных пилодбразных импульчрв момент прохождени напр жени через нулевое значение окааьшаетс сдвинут от начата импульса на посто нный фазовый утюл, независ щий от измен)9ни частоты следовани импульсов {еиюры Д и Е на фиг. 2). Величина этого фазового угла зависит от соотношени посто нных времени цепей зар да и разр да интеграторов 2 и 3. Так, при изменении посто нной времени цепи разр да интеграторов от нул до величины, равной посто нной времени цепи зар да, величина фазового сдвига импульсов на выходе уст ройства измен етс от- до . Регис-гриру с помощью пороговых каскадов момент прохождени напр жени пилообразных импульсов после разделительного конденсатора через нулевое значение, получают последовательность пр моугольных импульсов, начало которых сдвинуто относительно входных импульсов (эпюры ж и 3 на фиг. 2). Дл осуществлени неискаженной передачи импульсов (сохранени значени скважности ) выходные импульсы формируют с помощью триггера 8, который поочередно переключаетс передними фронтами импульсов, получаемых, на выходе пороговых ка(жадов 6 и 7. При иотользованин в устройстве современных операционных усилителей и компараггоров диапазон изменени частоты при сохранении посто нства фазовых соотно« шений между входными и выходными импульсами может достигать 5-6 октав. Принцип действи описываемого устройства ыовэт быть применен ив устройств вах фазовой и широтно-импульсной модул ции , формула изобретени Устройство дл задержки импульсов, содержащее формирователь, интегратор, пороговый каскад, отличающеес тем, что, с целью обеспечени посто нства величины фазовой задержки в диапазоне частот, в него введены триггер, разделительные конденсаторы и дополнительные интегратор и пороговый каскад, причем входы интеграторов соединены с противофазными выходами формировател , а выходы - через разделительные конденсеггоры соединены со входом поро1 чэвых каскадов, выходы которых соединены со входами триггера. Источники информации, прин тые во внимание при экспертизе 1. Авторское свидетельство СССР № 253130 от 27.04.67 (прототип).8 and G in FIG. 2) Due to the linearity of the front of the sawtooth pulses at the output of the integrators, the amplitude of the pulses and the constant component of the sequence are shifted in proportion to the change in the frequency of the input pulses: it increases with decreasing frequency and decreases with increasing. After filtering, the resulting component of the received pilod impulses, the moment of passing the voltage through the zero value, is shifted from the started pulse to a constant phase iron, independent of the change in the pulse frequency {D & E) in FIG. 2). The magnitude of this phase angle depends on the ratio of the time constant of the charge circuit and the discharge of integrators 2 and 3. Thus, when the time constant of the integrator discharge circuit changes from zero to a value equal to the time constant of the charge circuit, the magnitude of the phase shift of the pulses is The output of the device varies from one to the other. Using a threshold cascade, when the voltage of the sawtooth pulses after the separation capacitor passes through a zero value, the sequence grids are given a sequence of rectangular pulses, the beginning of which is shifted relative to the input pulses (plots and 3 in Fig. 2). To realize undistorted transmission of pulses (preserving the duty ratio), output pulses are generated using trigger 8, which alternately switches the leading edges of pulses received at the output of thresholds (circuits 6 and 7. With the use of modern operational amplifiers and comparaggors, maintaining a constant phase relationship between the input and output pulses can be 5-6 octaves. The principle of operation of the described device can be used Phase and pulse width modulation waveforms, claims The device for pulse delay, comprising a driver, an integrator, a threshold stage, characterized in that, in order to ensure the constant value of the phase delay in the frequency range, trigger, separation capacitors and additional integrator and threshold cascade, with the integrator inputs connected to the antiphase outputs of the imaging device, and the outputs are connected through separating condensers to the input of one or two cascades; tory connected to the trigger inputs. Sources of information taken into account during the examination 1. USSR Author's Certificate No. 253130 of April 27, 1967 (prototype).
ВК.VC.
Вых.Out
жwell
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU772531510A SU743183A1 (en) | 1977-10-13 | 1977-10-13 | Pulse delay device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU772531510A SU743183A1 (en) | 1977-10-13 | 1977-10-13 | Pulse delay device |
Publications (1)
Publication Number | Publication Date |
---|---|
SU743183A1 true SU743183A1 (en) | 1980-06-25 |
Family
ID=20727954
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU772531510A SU743183A1 (en) | 1977-10-13 | 1977-10-13 | Pulse delay device |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU743183A1 (en) |
-
1977
- 1977-10-13 SU SU772531510A patent/SU743183A1/en active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4415862A (en) | Pulse width modulation amplifier | |
JP4026879B2 (en) | Monolithic integrated frequency demodulation circuit | |
KR940704082A (en) | Switching amplifier | |
US4162455A (en) | Amplifier systems | |
ES8104680A1 (en) | Low frequency power amplifier and its use in an amplitude modulated transmitter. | |
GB1488584A (en) | Impulse response magnetic resonance spectrometer | |
SU743183A1 (en) | Pulse delay device | |
US3691470A (en) | Chopper amplifier | |
US2732527A (en) | Device for generation of pulses | |
SU1443125A1 (en) | Zero heat discriminator | |
SU822373A1 (en) | Signal generator | |
RU2259632C1 (en) | Method of the frequency band division of a transmitted signal and device for its realization | |
SU828366A1 (en) | Signal frequency doubler | |
SU661373A1 (en) | Quick-acting pulse amplitude converter | |
SU773917A1 (en) | Staircase signal generator | |
SU1252928A1 (en) | Level holder | |
US2591114A (en) | Frequency divider | |
SU853629A1 (en) | Timebase operational amplifier | |
SU1619390A1 (en) | Shaper of fm signals | |
SU1226640A1 (en) | Pulse-width modulator | |
JPS5940673Y2 (en) | division circuit | |
SU1161961A1 (en) | Multiplying device | |
SU924821A1 (en) | Multiphase pulsed synchronous-phase demodulator | |
SU576652A1 (en) | Device for controlling switching transistors of stabilized static converter | |
US2802106A (en) | Signal converter system |