KR970707498A - 간단해진 신호 처리기와 이 신호 처리기를 구비하는 수신기(Signal processor with reduced complexity, and receiver comprising such a signal processor) - Google Patents

간단해진 신호 처리기와 이 신호 처리기를 구비하는 수신기(Signal processor with reduced complexity, and receiver comprising such a signal processor)

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KR970707498A
KR970707498A KR1019970703012A KR19970703012A KR970707498A KR 970707498 A KR970707498 A KR 970707498A KR 1019970703012 A KR1019970703012 A KR 1019970703012A KR 19970703012 A KR19970703012 A KR 19970703012A KR 970707498 A KR970707498 A KR 970707498A
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KR
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signal processor
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control circuit
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KR1019970703012A
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KR100416328B1 (ko
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루디 요안 반 데 플라스케
게라두스 크리스티안 마리아 길리스
Original Assignee
요트. 게. 아. 롤페즈
필립스 일렉트로닉스 엔. 브이.
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Publication date
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    • G06F17/10—Complex mathematical operations
    • G06F17/17—Function evaluation by approximation methods, e.g. inter- or extrapolation, smoothing, least mean square method
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Abstract

신호처리기는 X-Y 로테이션 회로와 위상각 제어 회로를 구비하며, 입력위상의 근사에서 입력 백터의 로테이션에 의해 출력백터를 형성하는 상기 위상각 제어 회로에서, 상기 입력위상은 크기가 감소하는 일련의 연속한 위상각에 의해 근사된다. 본 발명에 따라, 위상각 제어 회로에서, 상기 일련의 위상각에서 위상각 표현의 확도는 상기 위상각의 크기에 의존하므로써, 위상각 제어 회로에서 계산을 행하는 횟수가 감소된다.

Description

간단해진 신호 처리기와 이 신호 처리기를 구비하는 수신기(Signal processor with reduced complexity and receiver comprising such a signal a signal processor)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 수신기의 실시례를 도시하는 도면.

Claims (3)

  1. 크기가 감소하는 일련의 위상각에서 입력백터를 출력백터로 연속적으로 로테이션하는 X-Y 로테이션 회로를 구비하는 신호처리기로서, 상기 X-Y 로테이션 회로는 입력백터를 인가하는 제1 및 제2입력과 출력백터를 공급하는 제1 및 제2출력과, 입력위상을 크기가 감소하는 일련의 위상각으로 근사하는 위상각 제어 회로를 구비하고, 상기 위상각 제어 회로는 입력 위상을 인가하는 위상 입력을 포함하는 신호처리기에 있어서, 상기 위상각 제어회로에서는 상기 크기가 감소하는 일련의 위상각에서 각 위상각은 입력 위상각의 크기에 의존하는 확도(accuracy)를 가지고 표현되는 것을 특징으로 X-Y 로테이션 회로를 구비한 신호처리기.
  2. 제1항에 있어서, 상기 위상각의 각각은 위상의 크기에 비례하는 확도를 가지고 표현되는 것을 특징으로 하는 X-Y 로테이션 회로를 구비한 신호처리기.
  3. 제1샘플링 주파수에서 반송 주파수에서 변조된 아날로그 신호를 디지탈방식으로 샘플링하는 A/D변환기를 구비하며, 상기 A/D변환기에서 상기 디지탈 변조된 신호의 반송 주파수 천이를 위해 신호처리기를 보함하는 디지탈 직교 혼합기 스테이지에 연속적으로 결합되는 수신기로서, 상기 디지탈 직교 혼합기 스테이지가 한쌍의 반송 주파수 변환 위상 직교 신호를 공급하는 제1 및 제2신호를 출력과, 직교 혼합기 스테이지의 위상 직교 신호를 선택하고, 제1샘플링 주파수에서 제2샘플링 주파수로 샘플링 주파수를 데시메이팅(decimating)하는 디지탈 필터 및 디지탈 변조 디바이스를 구비하는 수신기에 있어서, 상기 신호처리기는 제1항 또는 제2항에서의 신호처리기인 것을 특징으로 하는 수신기.
    ※ 참고사항: 최초출원 내용에 의하여 공개하는 것임.
KR1019970703012A 1995-08-30 1996-08-26 신호처리기및이신호처리기를구비한수신기 KR100416328B1 (ko)

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EP95202342.2 1995-08-30
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Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
AU3608199A (en) * 1999-04-23 2000-11-10 Nokia Networks Oy Qam modulator
US6443858B2 (en) 1999-07-27 2002-09-03 Callaway Golf Company Golf ball with high coefficient of restitution
US6478697B2 (en) 1999-07-27 2002-11-12 Callaway Golf Company Golf ball with high coefficient of restitution
DE10136071A1 (de) * 2001-07-25 2003-02-13 Infineon Technologies Ag Verfahren und Vorrichtung zur Kompensation eines Phasenfehlers eines Empfangs- und/oder Sendesystems mit I/Q-Schnittstelle

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3976869A (en) * 1974-09-27 1976-08-24 The Singer Company Solid state resolver coordinate converter unit
US3939330A (en) * 1974-10-10 1976-02-17 Westinghouse Electric Corporation Vector conversion system
US4843584A (en) * 1987-02-05 1989-06-27 Malaiperumal Sundaramurthy Cordic implementation of multi-dimensional plane rotation over the complex field
US4896287A (en) * 1988-05-31 1990-01-23 General Electric Company Cordic complex multiplier
US4945505A (en) * 1988-10-17 1990-07-31 Raytheon Company Cordic apparatus and method for approximating the magnitude and phase of a complex number
EP0365226A3 (en) * 1988-10-17 1991-02-20 Raytheon Company Cordic apparatus and method for approximating the magnitude and phase of a complex number
EP0453641B1 (de) * 1990-04-20 1997-03-12 Siemens Aktiengesellschaft CORDIC-Prozessor für Vektordrehungen in Carry-Save-Architektur
NL9002489A (nl) * 1990-11-15 1992-06-01 Philips Nv Ontvanger.

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DE69619963D1 (de) 2002-04-25
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