KR970049857A - 저전력 고속의 mpeg 비디오 가변 길이 디코더 - Google Patents

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KR970049857A KR1019960062003A KR19960062003A KR970049857A KR 970049857 A KR970049857 A KR 970049857A KR 1019960062003 A KR1019960062003 A KR 1019960062003A KR 19960062003 A KR19960062003 A KR 19960062003A KR 970049857 A KR970049857 A KR 970049857A
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Abstract

가변 길이 디코더(variable length decoder)는 헤더 분석기(header analyzer)에 접속된 비트스트림 공급기(bitstream feeder), 및 비트스트림 공급기에 결합된 블럭 데이타 디코더(block data decoder)를 포함한다.
비트스트림 공급기는 32-비트 비트스트림을 헤더 분석기, 블럭 데이타 디코더 및 제어 회로에 출력하기 위한 배럴 쉬프터(barrel shifter)를 포함한다. 헤더 분석기는 MPEG 헤더 층들의 개시 코드(start code)를 검출하고 인코딩된 비트스트림 내에 포함된 MPEG 층들의 파라미터들을 디코딩한다. 또한, 헤더 분석기는 64개 DCT 계수로 변환되어 있는 8X8 픽셀 데이타의 양자화 계수(quantization factors)를 디코딩한다. 블럭 데이타 디코더는 블럭 디코더에 접속된 매크로블럭 디코더를 포함한다. 매크로블럭 디코더를 포함한다. 매크로 블럭 디코더는 헤더-개시(header_startst)신호를 출력하고 블럭 디코더를 활성화 시킨다. 블럭 디코더는 비트스트림의 선정된 개수의 비트의 이진 패턴에 기초하여 각 6개 블럭 층들 내에 있는 64개 계수를 디코딩하기 위한 코드 테이블을 포함한다. 6개 블럭 층은 384개 클럭 싸이클 내에 디코딩한다. 제어 회로는 비트스트림 공급기, 헤더 분석기 및 블럭 데이타 디코더의 기능을 감시한다.

Description

저전력 고속의 MPEG 비디오 가변 길이 디코더
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 VDL를 도시하는 도면.

Claims (33)

  1. 비디오 화상(video picture)의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치에 있어서, 인코딩된 비트스트림을 공급하기 위한 비트스트림 공급기(bitstream feeder); 상기 인코딩된 비트스트림을 수신하고 상기 파라미터들을 추출하기 위해 상기 인코딩된 비트스트림을 디코딩하는 제1디코더; 및 상기 인코딩된 비트스트림을 수신하고 상기 비디오 데이타를 추출하기 위해 상기 인코딩된 비트스트림을 디코딩하는 제2디코더를 포함하며, 상기 제1 및 제2디코더 중 적어도 하나는 상기 공급기가 상기 인코딩된 비트스트림으로부터 규정된 개수의 비트를 버리도록 유발하도록 상기 비트스트림 공급기에 신호를 보내는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  2. 제1항에 있어서, 상기 비트스트림 공급기와 상기 제1디코더 및 상기 제2디코더의 기능을 제어하고 감시하기 위한 수단을 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  3. 제1항에 있어서, 상기 신호는 상기 파라미터들 및 비디오 데이타 중 하나를 디코딩하기 위해 상기 비트스트림 내에서 사용된 비트들의 규정된 개수를 나타내는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  4. 제3항에 있어서, 상기 비트스트림 공급기는 제1의 선정된 개수의 비트들을 저장하기 위한 제1레지스터 제2의 선정된 개수의 비트들을 저장하기 위한 제2레지스터; 및 상기 제1 및 제2레지스터에 결합되어, 상기 규정된 개수에 기초하여 상기 제1 및 제2선정된 개수의 비트들의 일부를 포함하는 상기 인코딩된 비트스트림을 출력하는 배럴 쉬프터(barrel shifter)를 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  5. 제4항에 있어서, 상기 비트스트림 공급기는 상기 규정된 개수를 이전 싸이클의 규정된 개수에 더하는가산기; 및 다음 번 싸이클 중에 상기 규정된 개수로서 사용될 가산된 합계를 저장하기 위한 제3레지스터를더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  6. 제4항에 있어서, 상기 비트스트림 공급기는 상기 규정된 개수가 프리셋 값과 같을 때 상기 제1레지스터에 저장된 상기 제1규정된 개수의 비트들 및 상기 제2레지스터에 저장된 상기 제2규정된 개수의 비트들 중 적어도 어느 한쪽을 버리기 위한 수단을 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  7. 제6항에 있어서, 상기 비트스트림 공급기는 상기 규정된 개수가 프리셋 값과 같을 때 상기 제1 및 제2레지스터에 대해 새로운 비트를 요청하는 신호를 발생하기 위한 수단을 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  8. 제1항에 있어서, 상기 제1디코더는 상기 인코딩된 비트스트림 내의 개시 코드를 탐색하고, 검출시에는 개시 코드를 출력하기 위한 수단; 상기 개시 코드가 프리셋 시퀀스로 검출되는지를 판정하기 위한 수단; 및 상기 판정 수단에 응답하여, 상기 파라미터들을 추출하기 위해 상기 인코딩된 비트들을 디코딩하기 위한 수단을 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  9. 제8항에 있어서, 상기 제1디코더는 다수의 헤더 분석기들을 포함하고, 상기 각 헤더 분석기는 상기 시퀀스 판정 수단으로부터의 대응하는 신호에 의해 활성화되며, 상기 인코딩된 비트스트림으로부터 디코딩된 파라미터들을 제1버스 상에 출력하고, 상기 제1버스 상의 파라미터 유형을 가리키는 신호를 제2버스 상에 출력하며, 매 클럭 싸이클마다 파라미터를 디코딩하기 위해 상기 인코딩된 비트스트림으로부터 사용된 비트들의 개수를 가리키는 규정된 수를 출력하는 것을 특징으로 하는 비디오 화상이 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  10. 제9항에 있어서, 상기 제1디코더는 상기 인코딩된 비트스트림을 압축하는데 사용되는 양자화 계수(quantization factor)들을 상기 인코딩된 비트스트림으로부터 디코딩하기 위해 양자화기 매트릭스 분석기를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  11. 제1항에 있어서, 상기 제2디코더는 상기 인코딩된 비트스트림으로부터 헤더 개시 파라미터를 디코딩하고, 디코딩 중에 사용되는 비트의 개수를 가리키는 상기 규정된 개수를 출력하기 위한 제1수단; 및 상기 인코딩된 비트스트림으로부터 상기 비디오 데이타를 디코딩하기 위한 제2수단을 포함하는 것을 특징으로하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  12. 제11항에 있어서, 상기 제2수단은 매 클럭 싸이클마다 하나의 비디오 계수(video coefficients)를 디코딩하는 것을 특징으로 하는 비디오 화상의 파라미터들 및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  13. 제11항에 있어서, 상기 제2수단은 상기 인코딩된 비트스트림의 이진 패턴을 인식하기 위해 코드 테이블에 기초한 조합 논리 회로를 포함하고, 상기 비디오 데이타의 값에 선행하여 프리셋된 개수의 이진 0을 제3버스 라인 상에 출력하는 실행 길이 디코더(run length decoder); 디코딩된 비디오 계수들(video coefficients)의 개수를 가리키는 카운트 값을 유지하며, 상기 카운트 값이 프리셋 개수에 도달할 때까지 상기 실행 길이 디코더를 인에이블하는 카운터; 및 매 클럭 싸이클마다 하나의 비디오 계수를 디코딩하기 위해 상기 인코딩된 비트스트림으로부터 사용된상기 규정된 개수의 비트들을 판정하기 위한 수단을 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들및 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 장치.
  14. M-비트 비트스트림으로부터 비디오 화상의 파라미터들과 비디오 데이타를 디코딩하는 장치에 M-비트 비트스트림을 제공하기 위해 저장 장치로부터 N-비트(N〉M)인코딩된 비트스트림을 수신하는 비트스트림 공급기에 있어서, 상기 N-비트 비트스트림 중 제1의 선정된 개수의 비트를 저장하기 위한 제1수단; 상기 N-비트 비트스트림 중 제2의 선정된 개수의 비트를 저장하기 위한 제2수단; 및 상기 제1 및 제2수단에 결합되어, 규정된 개수에 기초하여 상기 제1 및 제2의 선정된 개수의 비트들의 일부를 포함하는 상기 M-비트 비트스트림을 출력하는 배럴 쉬프터를 포함하는 것을 특징으로 하는 비트스트림 공급기.
  15. 제14항에 있어서, 상기 규정된 개수를 이전 싸이클에 대한 규정된 계수에 더하기 위한 가산기; 및 다음번 싸이클 중에 상기 규정된 개수로서 사용될 가산된 합계를 저장할 제3레지스터를 더 포함하는 것을 특징으로 하는 비트스트림 공급기.
  16. 제14항에 있어서, 상기 규정된 개수가 프리셋 값과 동일할 때 상기 제1수단에 저장된 상기 제1의 선정된 개수의 비트들과 상기 제2수단에 저장된 상기 제2의 선정된 개수의 비트들 중 적어도 어느 한 쪽을 버리기 위한 수단을 더 포함하는 것을 특징으로 하는 비트스트림 공급기.
  17. 제16항에 있어서, 상기 규정된 개수가 상기 프리셋 갑솨 같을 때 상기 제1 및 제2수단 중 적어도 하나에 대해 새로운 비트를 요청하는 신호를 발생하기 위한 수단을 더 포함하는 것을 특징으로 하는 비트스트림 공급기.
  18. MPEG 표준을 따르는 헤더 층들의 파라미터들을 추출하기 위한 인코딩된 비트스트림을 디코딩하는데 사용되는 가변 길이 디코더를 위한 장치에 있어서, 상기 인코딩된 비트스트림 내의 유효 개시 코드를 탐색하며, 검출시에 개시 코드 신호를 출력하기 위한 수단; 상기 개시 코드가 프리셋 시퀀스로 검출되는지를 판정하며, 검출시에 개시 코드 신호를 출력하기 위한 수단; 상기 파라미터들을 추출하기 위해 상기 인코딩된 비트스트림을 디코딩하기 위한 수단을 포함하는 것을 특징으로 하는 가변 길이 디코더를 위한 장치.
  19. 제18항에 있어서, 상기 디코딩 수단은 다수의 헤더 분석기들을 포함하고, 상기 각 헤더 분석기는 상기 시퀀스 판정 수단으로부터의 대응하는 신호에 의해 활성화되며, 상기 인코딩된 비트스트림으로부터 디코딩된 파라미터들을 제1버스 상에 출력하고 상기 제1버스 상의 파라미터 유형을 가리키는 신호를 제2버스 상에 출력하며, 매 클럭 싸이클마다 파라미터를 디코딩하기 위해 상기 인코딩된 비트스트림으로부터 사용된 비트의 개수를 가리키는 규정된 개수를 출력하는 것을 특징으로 하는 가변 길이 디코더를 위한 장치.
  20. 제19항에 있어서, 상기 디코딩 수단은 상기 인코딩된 비트스트림을 압축하는데 사용되는 양자화 계수를 상기 인코딩된 비트스트림으로부터 디코딩하기 위해 양자화기 매트릭스 분석기를 더 포함하는 것을 특징으로 하는 가변 길이 디코더를 위한 장치.
  21. MPEG 표준을 따르는 매트로블럭과 블럭 층들의 비디오 계수들을 추출하기 위해 인코딩된 비트스트림을 디코딩하는데 사용되는 가변 길이 디코더를 위한 장치에 있어서, 상기 인코딩된 비트스트림으로부터 헤더 개시 파라미터를 디코딩하기 위한 제1디코더; 및 상기 인코딩된 비트스트림으로부터 매 클럭 싸이클마다 하나의 비디오 계수를 디코딩하기 위한 제2디코더를 포함하는 것을 특징으로 하는 가변 길이 디코더를 위한 장치.
  22. 제21항에 있어서, 상기 제2디코더는 상기 인코딩된 비트스트림의 이진 패턴을 인식하기 위해 코드 테이블에 기초한 조합 논리 회로를 포함하고, 상기 비디오 계수 값에 선행하여 프리셋된 개수의 이진 0을 제3버스라인 상에 출력하는 실행 길이 디코더; 및 디코딩된 비디오 계수들의 개수를 나타내는 카운트 값을 유지하며, 상기 카운트 값이 프리셋 개수에 도달할 때까지 상기 실행 길이 디코더를 인에이블하는 카운터를 포함하는 것을 특징으로 하는 가변 길이 디코더를 위한 장치.
  23. 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법에 있어서, (a) 상기 인코딩된 비트스트림을 출력하는 단계; (b) 상기 파라미터들을 추출하기 위해 상기 인코딩된 비트스트림을 디코딩하는 단계; (c) 상기 비디오 데이타를 추출하기 위해 상기 인코딩된 비트스트림을 디코딩하는 단계; 및 (d) 상기 인코딩된 비트스트림으로부터 상기 규정된 개수의 비트들을 버리기 위해 사용되는 규정된 개수를 출력하는 단계를 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  24. 제23항에 있어서, 상기 규정된 개수는 상기 파라미터들과 비디오 데이타 중 하나를 디코딩하기 위해 상기 비트스트림 내에서 사용된 비트의 개수를 나타내는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  25. 제23항에 있어서, 상기 단계 (a)는 제1의 선정된 개수의 비트를 저장하는 단계; 제2의 선정된 개수의 비트를 저장하는 단계; 및 상기 규정된 개수에 기초하여 상기 제1 및 제2선정된 개수의 비트들 중 일부를 포함하는 상기 인코딩된 비트스트림을 출력하는 단계를 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  26. 제25항에 있어서, 상기 단계 (a)는 상기 선정된 개수를 이전 싸이클의 규정된 개수에 더하는 단계; 및 다음 번 싸이클 중에 상기 규정된 개수로서 사용될 가산된 합계를 저장하는 단계를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  27. 제24항에 있어서, 상기 단계 (a)는 상기 규정된 개수가 프리셋 값과 같을 때 상기 제1의 선정된 개수의 비트들 및 상기 제2의 선정된 개수의 비트들 중 적어도 어느 한 쪽을 버리는 단계를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 인코딩된 비트스트림을 디코딩하기 위한 방법.
  28. 제27항에 있어서, 상기 단계 (a)는 상기 규정된 개수가 프리셋 값과 같을때 새로운 비트들을 요구하는 신호를 발생하는 단계를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  29. 제23항에 있어서, 상기 단계 (b)는 상기 인코딩된 비트스트림 내의 개시 코드를 탐색하며, 검출 시에 개시 코드 신호를 출력하는 단계; 상기 개시 코드가 프리셋된 시퀀스로 검출되는지를 판정하는 단계; 및 상기 파라미터들을 추출하기 위해 상기 인코딩된 비트들을 디코딩하는 단계를 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  30. 제29항에 있어서, 상기 단계 (b)는 상기 인코딩된 비트스트림을 압축하는데 사용되는 양지화 계수들을 상기 인코딩된 비트스트림으로부터 디코딩하는 단계를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  31. 제23항에 있어서, 상기 단계 (c)는 상기 인코딩된 비트스트림으로부터 헤더 개시 파라미터를 디코딩하며, 디코딩 중에 사용된 비트의 개수를 가리키는 상기 규정된 개수를 출력하는 단계; 및 상기 인코딩된 비트스트림으로부터 상기 비디오 데이타를 디코딩하는 단계를 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
  32. 제31항에 있어서, 상기 단계 (c)는 매 클럭 싸이클마다 하나의 비디오 계수를 디코딩하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비스트림을 디코딩하기 위한 방법.
  33. 제31항에 있어서, 상기 단계 (c)는 상기 인코딩된 비트스트림의 이진 패턴을 인식하고, 상기 비디오 데이타의값에 선행하여 프리셋된 개수의 이진 0을 출력하는 단계; 디코딩된 비디오 계수들의 개수를 가리키는 카운트 값을 유지하는 단계; 및 매 클럭 싸이클마다 하나의 비디오 계수를 디코딩하기 위해 상기 인코딩된 비스트스트림으로부터 사용된 상기 규정된 개수의 비트를 판정하는 단계를 더 포함하는 것을 특징으로 하는 비디오 화상의 파라미터들과 비디오 데이타를 포함하는 인코딩된 비트스트림을 디코딩하기 위한 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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