KR950006567B1 - 패킷 교환 기능을 위한 내부 프로토콜 관리기와 운영체계와의 정합방법 - Google Patents

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Abstract

내용 없음.

Description

패킷 교환 기능을 위한 내부 프로토콜 관리기와 운영체계와의 정합방법
제1도는 본 발명이 적용되는 하드웨어 시스팀의 구성도.
제2도는 본 발명의 소프트웨어 블럭 구성도.
제3도는 본 발명의 전체 흐름도.
제4도 내지 제7도는 본 발명의 상세 흐름도.
* 도면의 주요 부분에 대한 부호의 설명
1 : 패킷계층 제어 프로세서(PLCP) 2 : 중앙처리장치 보드(MPMA)
3 : IPC제어 보드(PCCA) 4 : 패킷버스 정합 보드(PBIA)
5 : 프로세서 통신망(CIN) 6 : 패킷 버스(P 버스)
7 : 기억장치 8 : 이중포트 램(DPRAM)
본 발명은 종합정보통신망(ISDN) 기능을 갖는 전전자 교환시스템에서 패킷계층 제어 프로세서(Packet Layer Control Processor ; 이하, PLCP라 함)에서의 패킷 시스팀 내부 프로토콜 관리기(packet system Internal Protocol Handler ; 이하 PIPH라 함)와 운영체계와의 정합방법에 관한 것이다.
PLCP는 ISDN에서 패킷 메세지를 위한 특수 프로세서로 기존 전전자 교환기에서의 상위프로세서에 패킷 통신 기능을 추가한 것으로 이를 위한 특수한 기능이 요구된다. 즉 PLCP에는 기존 프로세서 통신(이하, IPC라 함)을 위한 메세지외에도 패킷 메세지를 처리하는 기능을 필요로 하게 된다.
상기 PIPH는 패킷 시스팀 내부 프로토콜 관리블럭으로서 PLCP에서 수행되며, 여러 사용자 프로세스들을 제어할 수 있어야 하고 사용자에게 프리미티브를 제공해야 하며, 운영체계의 프리미티브를 사용해야 소기의 목적을 달성할 수 있는 특수한 시스팀 소프트웨어 블럭이다.
따라서, 본 발명은 상기 특수 시스팀 소프트웨어 블럭이 시스팀메모리에 적재되어 수행될 수 있도록 사용자 및 운영체계와의 인터페이스를 정의하여 정합될 수 있도록 한 패킷 시스팀 내부 프로토콜 관리기와 운영체계와의 정합방법을 제공하는데 그 목적이 있다.
상기 목적을 달성하기 위하여 본 발명은, 주 제어기능을 하며 기억장치와 외부 보드와의 정합을 위한 이중포트 램(DPRAM)을 구비한 중앙처리장치 브도(MPMA), 프로세서 통신(IPC) 메세지 제어를 하는 IPC제어 보드(PCCA), 패킷 메세지 제어를 위한 패킷 버스 정합 보드(PBIA)로 구성되어 있으며, 상기 IPC제어 보드(PCCA)는 프로세서 통신망(CIN ; Control Interworking Network)에, 패킷버스 정합 보드(PBIA)는 P-버스에 접속되며, 상기 중앙처리장치 보드 내의 기억장치에 패킷처리기 블럭과 패킷 시스팀 내부 프로토콜 관리블럭(이하, PIPH라 함)을 탑재한 패킷계층 제어 프로세서(PLCP)에 적용되어 패킷 교환 기능을 위한 PIPH와 운영체계와의 정합을 수행하는 방법에 있어서 ; 프리미티브 0번을 통해서 PIPH의 초기화 수행하는 제 1단계, 상기 제 1단계 수행후, 사용자 모드 트랩을 사용하여 응용 소프트웨어와 PIPH간의 정합을 수행하는 제 2단계와, 상기 제 2단계 수행후, 시스팀 모드 트랩을 사용하여 PIPH와 운영체계의 정합을 수행하는 제 3단계와, 상기 제 3단계 수행후, 메세지 수신의 경우 운영체계과 PIPH간에 공통 수신 버퍼를 두어 운용하므로 정합을 수행하는 제 4단계와, 상기 제 3단계 수행후, 메세지 송신의 경우 송신 프리미티브를 제공하여 패킷 제어 보드로 메세지사 송신되게 하여 정합을 수행하는 제5단계를 포함하는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 일실시예를 상세히 설명한다.
제 1 도는 본 발명이 적용되는 하드웨어 구성도로서, 도면에서 1은 PLCP, 2는 중앙처리장치 보드(MPMA), 3은 IPC제어 보드(PCCA), 4는 패킷버스 정합 보드(PBIA), 5는 프로세서 통신망(CIN : Control Interworking Network), 6은 패킷 버스(P-버스), 7은 기억장치, 8은 이중포트 램(DPRAM)을 각각 나타낸다.
PLCP(1)는 주 제어기능을 하는 중앙처리장치 보드(2 : MPMA), IPC 메세지 제어를 하는 IPC제어 보드(3 : PCCA), 패킷 메세지 제어를 위한 패킷버스 정합 보드(4 : PBIA : Packet Bus Interface board Assembly)로 구성되어 있으며, IPC제어 보드(3 : PCCA)는 CIN(5)에, 패킷 버스 정합 보드(4 ; PBIA)는 P-버스(6)에 접속되어 다른 프로세서와 통신이 가능하도록 구성되어 있다.
그리고 중앙처리장치 보드(2) 내에는 기억장치(7 : MEMORY), 외부보드와의 정합을 위한 이중포트 램(8 : DPRAM)등이 존재한다.
제 2 도는 본 발명에 의한 소포트웨어 블럭의 구성도로서, 11은 응용소프트웨어 블럭, 12은 패킷 프로토콜 관리블럭, 13은 패킷 처리기, 14는 패킷보드 내의 휨웨어, 15는 정합기능부, 16은 패킷처리 기능부, 17은 초기화 기능부, 18은 사용자와 PIPH의 정합부, 19는 PIPH와 운영체계의 정합부, 20은 PIPH와 패킷처리 기간의 정합부를 각각 나타낸다.
도면에 도시한 바와 같이 본 발명에 의한 소프트웨어 블럭의 구성은, 제일 상위에 응용 레벨의 패킷 송/수신 요구를 하는 응용 소프트 웨어 블럭(11)이 있으며, 상기 응용 소프트웨어 블럭(11)에 패킷 처리 프리미티브들을 제공하며 프로토콜 관리를 행하는 패킷 시스템 내부 프로토콜 관리블럭(12 : 이하 PIPH라 함), 상기 PIPH(12)로 부터 물리적 송/수신 요구를 받아 수행하는 패킷 처리기(13), 물리적 송/수신 기능을 수행하는 패킷보드 내의 휨웨어(14)로 구별된다.
패킷 처리기(13)는 정합 기능부(15)와 패킷 처리 기능부(16)로 나누어지는데, 정합 기능부(15)는 다시 PIPH(12)의 초기화를 정의하는 초기화 기능부(17), 사용자와 PIPH(12)간의 인터페이스를 제공하는 사용자와 PIPH(12)의 정합부(18), PIPH(12)에서 운영체계의 요구를 PIPH(12)와 운영체계의 정합부(19), 패킷 메세지 송/수신을 위한 인터페이스를 정의한 PIPH(12)와 패킷처리기간의 정합부(20)로 구성된다.
본 발명은 제 1도의 기억장치(7) 내에 존재하는 소프트웨어로 제 2도에서의 패킷 처리기 (13)내의 정합 기능부(15)로, 응용 소프트웨어 블럭 (11)과 PIPH(12)간의 인터페이스, PIPH(12)와 운영 체계 및 패킷처리기 (13)와의 인터페이스를 정의, 기능을 실현함으로써 PLCP(1)에서 PIPH(12)와 운영체계의 정합 기능을 제공하도록 구성되어 있다.
제 3도는 본 발명의 전체 처리 흐름도이다.
우선, PIPH(12)의 초기화를 위한 방법을 정의하고(21), 사용자와 PIPH(12)간의 인터페이스를 구축하고(22), PIPH(12)와 운영체계간의 인터페이스를 구축(23)한다. 그리고 패킷버스 정합 보드(4)로 부터 메세지 송/수신 처리를 위해 패킷처리기 (13)와의 인터페이스를 구축하고 종료한다(24). 본 발명은 상기와 같은 처리절차에 의해 수행되어 PIPH(12)를 적재 및 수행하는데 필요한 모든 인터페이스를 정의 및, 실현하도록 구성되어 있다.
제 4도는 PIPH(12) 초기화 수행(제 3도의 21)의 상세 흐름도이다.
우선 PIPH(12)가 시스팀 메모리에 적재될 수 있도록 물리적 번지를 지정하고(31), 사용자로부터 디렉티브 0번을 받아들여(32), PIPH(12)의 프리미티브 0번을 호출한다(33).
제 5도는 사용자와 PIPH(12)간의 정합 수행(제 2도의 22)의 상세 흐름도이다.
사용자로부터 PIPH(12) 프리미티브 수행 요구가 들어오면(41), 사용자 모드 트랩을 사용한다(42). 시스팀 모드로 천이하여(43) PIPH(12)가 시스팀 모드 환경에서 수행되도록 하며, 디렉티브 번호와 파라메타 블럭의 주소가 입력 파라메타가 되도록 스택을 조정한다(44). 이후 해당 프리미티브를 호출한다(45). 프리미티브 수행 후에는 결과치를 되돌리고(46), 마지막으로 사용자 모드로 천이하고 사용자에게 제어권을 넘긴다 (47).
제 6도는 PIPH(12)와 운영체계의 정합 수행(제 3도의 23)의 상세 흐름도이다.
PIPH(12)에서 운영체계의 프리미티브 사용 요구가 있으면(51), 시스팀 모드 트랩을 사용하여(52), 요구 디렉티브 번호의 프리미티브를 호출하고(53) 수행결과를 되돌린다(54).
제 7도는 패킷 메세지 송/수신을 위한 패킷 처리기(13)와 PIPH(12)의 정합 수행(제 3도의 (24)의 상세 흐름도이다.
메세지 송/수신을 조사하여 (61), 송신의 경우 송신 프리미티브를 제공하여(62) 패킷버스 정합 보등(4 ; PBIA)로 메세지가 송신되게 한다(63). 수신의 경우 우선 PIPH(12)와 패킷 처리기(13)와의 공통 수신버퍼를 정의한다(64). 이후 패킷버스 정합 보드(4)로부터의 인터럽트를 감지하여(65) 정의된 공통 버퍼에 수신 메세지를 저장함(66)으로서 PIPH(12)에 메세지가 전달되게 한다.
따라서, 본 발명은 패킷 메세지 통신을 위한 프로세서인 PLCP(1)에서 패킷 시스팀 내부 프로토콜 관리 블럭인 PIPH(12)가 시스팀에 적재되어 그 기능을 수행할 수 있도록 PIPH(12)의 초기화, 사용자와 PIPH(12)간의 정합, PIPH(12)와 운영체계의 정합, PIPH(12)와 패킷 처리기간의 정합 기능을 수행하여 PIPH(12)의 실행환경을 제공함으로써 특수 시스팀 소프트웨어 블럭인 PIPH(12)와 기존의 운영체계간의 정합 기능을 수행할 수 있는 효과가 있다.

Claims (4)

  1. 주 제어기능을 하며 기억장치(7)와 외부 보드와의 정합을 위한 이중포트 램(8 : DPRAM)을 구비한 중앙처리장치 보드(2 : MPMA), 프로세서 통신(IPC) 메세지 제어를 하는 IPC제어 보드(3 : PCCA), 패킷 메세지 제어를 위한 패킷버스 정합 보드(4 : PBIA)로 구성되어 있으며, 상기 IPC제어 보드(3 ; PCCA)는 프로세서 통신망(5 ; CIN)에, 패킷버스 정합 보드(4 ; PBIA)는 P-버스(6)에 접속되며, 상기 중앙처리장치 보드(2) 내의 기억장치(7)에 패킷처리기 블럭(13)과 패킷 시스팀 내부 프로토콜 관리블럭(12 ; 이하, PIPH라 함)을 탑재한 패킷계층 제어 프로세서(1 ; PLCP)에 적용되어 패킷 교환 기능을 위한 PIPH(12)와 운영체계의 정합을 수행하는 방법에 있어서 ; 프리미티브 0번을 통해서 PIPH(12)의 초기화 수행하는 제1단계 (31 내지 33), 상기 제1단계(31 내지 33) 수행후, 사용자 모드 트랩을 사용하여 응용 소프트웨어와 PIPH(12)간의 정합을 수행하는 제2단계(41 내지 47)와, 상기 제2단계(41 내지 47) 수행후, 시스팀 모드 트랩을 사용하여 PIPH(12)와 운영체계의 정합을 수행하는 제3단계(51 내지 54)와, 상기 제3단계(51 내지 54) 수행후, 메세지 수신의 경우 운영체계와 PIPH(12)간에 공통 수신 버퍼를 두어 운용하므로 정합을 수행하는 제4단계(54 내지 56)와, 상기 제3단계(51 내지 54) 수행후, 메세지 송신의 경우 송신 프리미티브를 제공하여 패킷버스 정합 보드(4 ; PBIA)로 메세지가 송신되게 하여 정합을 수행하는 제5단계(62,63)를 포함하는 것을 특징으로 하는 PIPH(12)와 운영체계와의 정합방법.
  2. 제1항에 있어서, 상기 제1단계(31 내지 33)는, PIPH(12)가 시스팀 메모리에 적재될 수 있도록 물리적 번지를 지정하는 단계(31)와, 상기 단계(31) 수행후, 사용자로부터 디렉티브 0번을 받아들여 PIPH(12)의 프리미티브 0번을 호출하는 단계(32,33)를 포함하는 것을 특징으로 하는 PIPH(12)와 운영체계와의 정합방법.
  3. 제1항에 있어서, 상기 제2단계(41 내지 47)는, 사용자로부터 PIPH(12) 프리미티브 수행 요구가 들어오면, 사용자 모드 트랩을 사용하여 시스탬 모드로 천이하는 단계(41 내지 43)와, 상기 단계(41 내지 43)수행후. PIPH(12)가 시스팀 모드 환경에서 수행되도록 하며, 디렉티브 번호와 파라메타 블럭의 주소가 입력 파라메타가 되도록 스택을 조정하는 단계(44)와, 상기단계(44) 수행후, 해당 프리미티브를 호출하여 결과치를 되돌리고, 사용자 모드로 천이하여 사용자에게 제어권을 넘기는 단계(45 내지 47)를 포함하는 것을 특징으로 하는 PIPH(12)와 운영체계와의 정합 방법.
  4. 제1항에 있어서, 상기 제3단계(51 내지 54)는, PIPH(12)에서 운영체계의 프리미티브 사용 요구가 있으면, 시스팀 모드 트랩을 사용하는 단계(51,52)와, 상기 단계(51,52) 수행후, 요구 디렉티브 번호의 프리미트브를 호출하고 수행결과를 되돌리는 단계(53,54)를 포함하는 것을 특징으로 하는 PIPH(12)의 운영체계와의 정합방법.
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WO2017119702A1 (ko) * 2016-01-04 2017-07-13 김창호 대기전력을 차단하는 전원 어댑터 및 그 제어 방법

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