KR930015933A - 프라이머리 라인 터미네이션 보드 - Google Patents

프라이머리 라인 터미네이션 보드 Download PDF

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KR930015933A
KR930015933A KR1019910023133A KR910023133A KR930015933A KR 930015933 A KR930015933 A KR 930015933A KR 1019910023133 A KR1019910023133 A KR 1019910023133A KR 910023133 A KR910023133 A KR 910023133A KR 930015933 A KR930015933 A KR 930015933A
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김명석
남윤석
정희창
조규섭
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경상현
재단법인 한국전자통신연구소
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    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q11/00Selecting arrangements for multiplex systems

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)

Abstract

본 발명은 전전자 교환기에 종합 정보 통신망(ISDN)의 가입자-망간 접속 기능을 부가하기 위하여 개발된 ISDN 가입자 서브 시스팀(ISS)의 구성요소로서, 여러개의 ISDN 기본 접속 가입자를 다중 접속하여 각 가입자의 2B+D를 투명하게 1차군 속도로 전송하는 PLTB(Primary Line Termination Board)에 관한 것이다.
따라서, 본 발명은 프로세서 제어수단(21), 내부버스, D채널 처리수단(21), Cv1채널 처리수단(23), PCM접속수단(24), S-버스 접속수단(25), P-버스 접속수단(26), 일차군 속도 선로 정합수단(27), 및 시스템 버스로 구성되는 것을 특징으로 한다.

Description

프라이머리 라인 터미네이션 보드
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 프라이머리 라인 터미네이션 보드(이하 ‘TLTB’라 한다) 및 PMUX의 연결상태도, 제2도는 본 발명이 적용되는 ISDN 가입자 접속 서브시스팀의 구성도.

Claims (2)

  1. 다수의 ISDN 기본 접속 가입자를 다중 접속하여 각 가입자의 2B+D를 투명하게 1차군 속도로 전송하는 PLTB(Primary Line Termination Board)에 있어서 PLTB 전체를 제어하는 프로세서 제어수단(21)상기 프로세서 제어수단(21)에 연결된 내부버스 상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 할당된 해당 채널을 통해 HDLC프레임 형태로 전송하는데 가입자측으로 부터 수신한16kbps속도의 신호 및 패킷 정보를 수신하여 버퍼에 저장 및 마스터 측으로 송신하거나 상기 마스터 측으로부터 정보를 해당체널에 전송하는 D채널처리 수단(22)상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 가입자별로 할당되는 정보 HDLC프레임의 형태로 전송하는 Cv1채널 처리수단(23), 상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 가입자측과 약속된 가입자정보를 망측의 B채널 처리를 위한 스위치에 맵핑되도록 B채널의 위치를 재배열하는 PCM 접속수단(24), 상기 내부 버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 PLTB외에서의 처리기능을 지원하기 위해 S-버스를 통해 정보를 송수신하기 위한 S-버스접속수단(25), 상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 상기 D채널 처리 수단(22)으로부터 수신한 패킷 정보를 패킷처리부로 투명하게 전송하기 위한 P-버스접속수단(26), 상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따른 일차군 액세스의 선로 정합을 위한 일차군 속도 선로 정합수단(27), 및 상기 일차군 속도 선로 정합수단(27)과 D채널 처리수단(22)과 Cv1 채널처리수단(23)과 PCM 접속수단(24)에 연결되어 각 해당채널에 접속되거나 일련의 정보를 배열하므로써 약속된 채널할당을 통하여 정보를 송수신하며 V3 기준점으로 규정된 시스팀 버스로 구성되는 것을 특징으로 하는 PLTB.
  2. 제1항에 있어서, 상기 내부버스에 연결되어 상기 프로세서 제어수단(21)의 제어에 따라 PLTB 전체의 상태 또는 클럭을 감시하고 상기 일차군 속도 선로 정합수단(27)의 상태를 감지하는 상태표시수단(28)을 더 포함하여 구성되는 것을 특징으로 하는 PLTB.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910023133A 1991-12-17 1991-12-17 프라이머리 라인 터미네이션 보드(Primary Line Terminaion Board) KR940007554B1 (ko)

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