KR920004384B1 - Protection circuit for run-away of mpu - Google Patents
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Abstract
Description
제 1 도는 본 발명 회로의 블록 구성도.1 is a block diagram of a circuit of the present invention.
제 2 도는 본 발명의 회로도.2 is a circuit diagram of the present invention.
제 3 도의 (a)-(k)는 본 발명 회로의 각부 동작 파형도.(A)-(k) is an operation waveform diagram of each part of the circuit of this invention.
제 4 도는 최초 전원 인가시 저항(R1)양단의 전압 파형.4 is a voltage waveform across a resistor (R 1 ) at initial power-up.
제 5 도는 종래의 마이크로 프로세서의 폭주현상 방지회로의 블록 구성도.5 is a block diagram of a congestion prevention circuit of a conventional microprocessor.
제 6 도는 종래의 마이크로 프로세서에 접속된 구형파 확인부와 파워소자 구동부의 회로도.6 is a circuit diagram of a square wave checking unit and a power element driving unit connected to a conventional microprocessor.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 전원 공급부 2 : 파워 온 리세트 회로부1: power supply 2: power on reset circuit
3 : 마이크로 프로세서 4 : 폭주현상 방지 회로부3: microprocessor 4: congestion prevention circuit portion
5 : 표시부 6 : 키입력부5: display unit 6: key input unit
7 : 외부기기 구동부 8 : 외부기기7: external device driving unit 8: external device
9 : 인터럽트 신호 발생 회로부9: interrupt signal generating circuit
본 발명은 마이크로 프로세서로 제어되는 모든 전자, 전기 제품을 안전하게 동작시킬 수 있도록한 폭주현상(Run Away) 방지 회로에 관한 것으로, 특히 고주파 및 고전압을 사용하는 기기에서 마이크로 프로세서가 폭주되었을 경우 기기의 제어를 잘못하여 인명 또는 재산의 피해를 방지할 수 있도록 한 마이크로 프로세서의 폭주현상 방지회로에 관한 것이다.BACKGROUND OF THE
종래에 있어, 본 출원인이 앞서 제안한 바 있는 특허공고번호 제87-1728호의 '마이크로 프로세서의 런어웨이 방지 방법 및 장치'는 제 5 도에 나타낸 바와같이 릴레이(RY), 프로그램을 저장할 ROM, 각종 제어정보를 기록할 RAM, 구형파 확인부(2), 파워소자 구동부(3), 제어부(10), 키이 제어부(11), 디스플레이부(12), 소정워드를 저장하는 레지스터(13), 릴레이 구동 발생 신호부(14), 런어웨이 제어 신호부(15), 플랙상태 변환부(16) 및 런어웨이 검출부(17)와를 연결구성하여서된 것으로, 여기서 마이크로 프로세서(1)에 연결되는 구형파 확인부(2)와 파워 소자 구동부(3)는 제 6 도에 나타낸 바와같이 직류차단용 콘덴서(C2), 다이오드(D1), 저항 (R1-R3), 스위칭용 트랜지스터(T3)와 트랜지스터 (T1, T2), 저항(R4-R7), 콘덴서(C1)와를 각각 연결하여서 구성된 것으로, 그의 동작관계는 다음과 같다.In the related art, 'Applicant's method and apparatus for preventing runaway of a microprocessor' of Patent Publication No. 87-1728 previously proposed by the present applicant is a relay (RY), a ROM for storing a program, and various controls as shown in FIG. RAM to record information, square
먼저, 마이크로 프로세서(1)가 비정상적인 런어웨이 상태에 있을 때 그의 출력포트(RP)에서 '하이'신호가 계속 출력됨에 따라 직류차단용 콘덴서(C2)에 의해 트랜지스터(T3)가 오프되어 트랜지스터(T1, T2)도 오프되므로 릴레이(RY)도 오프되어 부하에 전원 공급이 중단된다. 그러나 이와같은 구성은 오동작 발생시 각종 부하에 공급되는 전원을 차단하므로 그 기능을 수행하나 마이크로 프로세서는 계속 오동작 상태에 있게 되어 마이크로 프로세서에 공급되는 전원 플러그를 뽑기전에는 기기를 재차 동작시킬 수가 없었다.First, the transistor T 3 is turned off by the DC blocking capacitor C 2 as the 'high' signal is continuously output from the output port RP thereof when the
만일 릴레이(RY)에 의해 마이크로 프로세서에 공급되는 전원이 동시에 차단되면 기기를 재 작동시킬 때 마이크로 프로세서에 전원을 공급할 수 있는 초기 전원 공급장치가 부가되어야만 하고, 또한 사용기기가 계속적으로 제한되어야만 하는 경우에는(예: 자동 배기장치) 오동작 후 다시 제어를 할 수 없는 문제점이 있었다.If the power supplied to the microprocessor by the relay RY is cut off at the same time, an initial power supply capable of supplying power to the microprocessor must be added when the unit is restarted, and the equipment used must be continuously restricted. (E.g., automatic exhaust system) has a problem that can not be controlled again after a malfunction.
본 발명은 이와같은 종래의 문제점을 해소시키기 위하여 통상적인 파워온 리세트 회로부에 키스캔 신호판단부와 리세트 앤드 리턴부로 구성되는 폭주현상 방지회로부를 부가시켜 마이크로 프로세서가 오동작을 할 경우 순간적으로 리세트시키고, 다시 회복시켜 마이크로 프로세서가 항상 기기를 제어할 수 있도록 하여 어떤 상황에서도 연속적으로 제어하지 않으면 않되는 기기(예 : 광산의 배기장치, 유독가스실의 개폐장치 및 전자레인지 등)를 안전하게 동작시켜 인명과 제품의 피해를 방지할 수 있도록 한 마이크로 프로세서의 폭주 방지회로를 제공하는 것을 목적으로 하는 것으로, 이하 첨부된 도면을 참조하여 본 발명을 상세히 설명하면 다음과 같다.The present invention adds a runaway prevention circuit portion consisting of a kisscan signal determination portion and a reset and return portion to a conventional power-on reset circuit portion in order to solve such a conventional problem, if the microprocessor malfunctions, Set it up and restore it so that the microprocessor can always control the device and safely operate any equipment that must be continuously controlled under any circumstances (e.g. mine exhaust, toxic gas chamber switchgear and microwave oven). An object of the present invention is to provide a congestion prevention circuit of a microprocessor capable of preventing damage to human life and products. Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.
제 1 도 및 제 2 도에 나타낸 바와 같이 본 발명 회로의 구성은 전원 공급부(1), 파워온 리세트 회로부(2), 마이크로 프로세서(3), 표시부(5), 키입력부(6), 외부기기 구동부(7), 외부기기(8) 및 인터럽트 발생회로부(9)와를 연결 구성한 마이크로 프로세서를 이용한 제어회로에 있어서, 상기 키입력부(6)의 출력단에 입력단이 연결된 키스캔 신호 판단부(41)와 리세트 앤드 리턴부(42)로 구성된 폭주현상 방지회로부(4)를 통해 파워온 리세트 회로부(2)를 연결하되 키스캔 신호 판단부(41)는 다이오드(D8, D9), 저항(R5-R9), 콘덴서(C1, C2) 및 트랜지스터(T3, T4)와로 연결 구성하고, 리세트 앤드 리턴부(42)는 저항(R10, R11)과 콘덴서(C3)와를 연결구성하여서 된 것으로, 여기서 미설명 부호 PT는 파워 트랜스, RY는 릴레이, D1-D11은 다이오드, T1, T2, T4는 트랜지스터, C4는 콘덴서, R1-R4, R12-R17은 저항, ZD1은 제너 다이오드, VSS, VDD는 전원단자, RESET는 리세트 단자, IN1-IN4는 키스캔 입력단자, DRI는 외부기기 제어단자, SC1-SC4는 키스캔 단자이고, INT는 인터럽트 단자이다.As shown in Figs. 1 and 2, the circuit of the present invention includes a
이와같이 구성된 본 발명 회로의 작용효과를 제 3 도의 (a)-(k) 및 제 4 도를 참조하여 설명하면 다음과 같다.The operation and effect of the circuit of the present invention configured as described above will be described with reference to FIGS. 3 (a)-(k) and 4.
먼저, 전원회로(1) 및 파워 온 리세트 회로부(2)의 파워 트랜스(PT)에 초기전원(AC)이 인가되면 정류 다이오드(D1, D2)를 통해 직류로 정류되어 제너다이오드(ZD1)에 인가되는데, 이때 0〈t〈t0구간에서는(제 4 도참조) 제너다이오드(ZD1)에 전류가 흐르지 않으므로 트랜지스터(T1)가 오프되어 트랜지스터(T2)가 온이되므로 마이크로 프로세서(3)가 리세트 되어 마이크로 프로세서(3)내의 프로그램 카운터는 최초 시작 번지로 되돌아 가게 된다.First, when the initial power source AC is applied to the power transformer PT of the
이후에 t〉t0구간이 되면 제너다이오드(ZD1)에 전류가 흐르므로 트랜지스터(T1)는 온이되고, 트랜지스터(T2)는 오프되어 마이크로 프로세서(3)의 리세트가 해제되므로 마이크로 프로세서(3)는 프로그램을 최초 번지부터 실행하게된다.Afterward, when t> t 0 , a current flows in the zener diode ZD 1 , and thus the transistor T 1 is turned on and the transistor T 2 is turned off to reset the
이때 인터럽트 신호 발생회로부(9)에 의해 인터럽트 신호가 발생되면 마이크로 프로세서(3)는 이를 인식하여 인터럽트 루틴 프로그램을 실행하게 되므로 구형파의 스캔 신호가 발생되어 마이크로 프로세서(3)의 키스캔 단자(SC1-SC4)를 통해 키 입력장치(6), 표시부(5) 및 폭주현상 방지회로부(4)에 각각 인가된다.At this time, when an interrupt signal is generated by the interrupt signal
또한, 마이크로 프로세서(3)의 키스캔 단자(SC1-SC2)의 출력파형은 정상 상태에서 스캔 신호가 제 3 도의 (c)-(f)의 T1구간에서와 같이 출력되나 폭주상태(즉 T1-T2구간)에서는 키스캔 신호가 발생되지 않고, 풀업 또는 풀다운이 되어 직류 신호가 출력된다.In addition, the output waveforms of the kisscan terminals SC 1 -SC 2 of the
따라서 정상 상태에서 폭주현상 방지회로부(4)의 A점의 스캔 신호가 '하이'일 때 트랜지스터(T3)가 온이되고, '로우'일 때 트랜지스터(T3)가 오프되는 온, 오프 동작을 반복하게 된다.Accordingly, in the normal state, the transistor T 3 is turned on when the scan signal of the point A of the congestion
이에 따라 저항(R8, R9)과 콘덴서(C1)로 구성되는 충방전 회로내의 콘덴서(C2)에는 음전하가 충전되어 일정한 값을 유지하게 되므로 트랜지스터(T4)가 계속 온이되어 P4지점에는 '하이'신호가 되므로 파워 온 리세트 회로부(2)내의 트랜지스터(T2)의 에미터 단자에도 '하이'신호가 인가되어 트랜지스터(T2)는 오프된 상태를 유지하게 되므로 정상 동작을 계속하게 된다.Accordingly, the capacitor C 2 in the charge / discharge circuit composed of the resistors R 8 and R 9 and the capacitor C 1 is charged with a negative charge to maintain a constant value, so that the transistor T 4 is kept on and P Since the point 4 is a 'high' signal, the 'high' signal is also applied to the emitter terminal of the transistor T 2 in the power-on
그러나 마이크로 프로세서(3)가 폭주상태에 있으면 인터럽트 신호가 발생되더라도 인터럽트 루틴이 수행되지 않으므로 마이크로 프로세서(3)의 키스캔 단자(SC1-SC4)에서 스캔 신호가 출력되지 않고 직류 전압이 출력되므로 폭주현상 방지회로부(4)의 A점에는 직류 전압이 공급된다.However, if the
따라서 이 직류 전압은 직류 차단용 콘덴서(C1)에 의해 차단되므로 트랜지스터(T3)가 오프된 상태를 유지하게 되고, 또한 트랜지스터(T4)도 오프되므로 P4점에는 '로우'(즉 VDD전압)신호가 인가된다. 이때 P5점의 전위는 '하이'(즉 접지전위)에서 '로우'로 내려가다가 다시 '하이'로 복귀된다.Therefore, since the DC voltage is cut off by the DC blocking capacitor C 1 , the transistor T 3 remains off, and since the transistor T 4 is also turned off, the point P 4 is low (ie, V). DD voltage) signal is applied. At this time, the potential at the point P 5 goes from 'high' (ie, ground potential) to 'low' and then returns to 'high' again.
즉, P4점의 순간적인 전압의 하강은 콘덴서(C3)를 통과하지만 P4점이 계속 직류전원(VDD) 전압을 유지하면 콘덴서(C3)에 의해 직류 전압이 차단되므로 다시 '하이'로 복귀하는 것이다.That is, the instantaneous voltage drop of the P 4 that is so passed through the condenser (C 3), but P 4 dots continued while maintaining the DC power supply (V DD) voltage is a DC voltage is blocked by the capacitor (C 3) back to 'high' To return.
따라서 파워 온 리세트 회로부(2)의 트랜지스터(T2)가 오프된 상태에서 온이 되었다가 다시 오프되므로 마이크로 프로세서(3)는 리세트가 걸렸다가 다시 해제되어 프로그램 카운터는 리세트 어드레스인 프로그램의 최초 번지로 되돌아가 다시 메인 프로그램을 수행하게 된다.Therefore, since the transistor T 2 of the power-on
또한, 메인 프로그램은 최초 사용자가 기록한 데이터가 기억된 RAM을 클리어시켜 각 출력단자를 '로우'로 한다음 모든 외부기기에 공급되는 전원을 차단시키기 위하여 마이크로 프로세서(3)의 외부기기 제어단자(DR1)를 통해 '로우'신호를 출력시키게 되므로 릴레이(RY)가 오프되어 외부기기에 공급되는 전원을 차단시킬 수 있게 된다.In addition, the main program clears the RAM in which the data recorded by the first user is stored so that each output terminal is 'low', and then the external device control terminal DR of the
따라서 마이크로 프로세서(3)는 폭주 후 다시 원래의 기능을 회복하여 항상 사용자가 제어할 수 있는 상태로 유지된다. 또한, 인터럽트 프로그램은 마이크로 프로세서(3)가 폭주를 일으켰을 때는 인터럽트 루틴을 실행하지 않으므로 스캔 신호가 나오지 않게 됨에 따라 마이크로 프로세서(3)의 키스캔 단자(SC1-SC4)의 전압은 풀업 또는 풀다운이 되고, 마이크로 프로세서(3)가 정상적으로 동작할때는 키스캔 단자(SC1-SC4)를 통해 구형파의 키스캔 신호가 출력되므로 마이크로 프로세서의 폭주 상태를 감지할 수 있게 된다.Therefore, the
한편, 제 3a 도는 P1점의 전압을 나타낸 것이고, (b)도는 인터럽트 신호를 나타낸 것이며, (h)도는 트랜지스터(T3)의 베이스 전압을 나타낸 것이고, (i)도는 트랜지스터(T3)의 콜렉터 전압을 나타낸 것이며, (k)도는 마이크로 프로세서(3)의 리세트단 신호를 나타낸 것이다.On the other hand, of the 3a turn will showing the voltage of the P 1 point, (b) turning will showing an interrupt signal, (h) turning will showing the base voltage of the transistor (T 3), (i) turning the transistor (T 3) The collector voltage is shown, and (k) shows the reset signal of the
이상에서 설명한 바와같이 본 발명에 의하면 마이크로 프로세서가 오동작을 할 때 칩을 순간적으로 리세트시켰다가 다시 회복시켜 마이크로 프로세서가 항상 다른 기기를 제어할 수 있는 상태로 유지시킬 수 있도록 하므로서 어떤 상황에서도 연속적으로 제어하지 않으면 안될 광산의 배기 장치나 유독가스실의 개폐 장치등에 적용할 경우 인명과 재산 및 제품의 피해를 사전에 방지할 수 있는 효과를 얻을 수 있는 것이다.As described above, according to the present invention, when a microprocessor malfunctions, the chip is instantly reset and then restored so that the microprocessor can always keep the other device in a controlled state. When applied to the exhaust system of the mine or the opening and closing device of the toxic gas chamber that should be controlled, it is possible to prevent the damage of life, property and products in advance.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890014905A KR920004384B1 (en) | 1989-10-17 | 1989-10-17 | Protection circuit for run-away of mpu |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890014905A KR920004384B1 (en) | 1989-10-17 | 1989-10-17 | Protection circuit for run-away of mpu |
Publications (2)
Publication Number | Publication Date |
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KR910008535A KR910008535A (en) | 1991-05-31 |
KR920004384B1 true KR920004384B1 (en) | 1992-06-04 |
Family
ID=19290765
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019890014905A KR920004384B1 (en) | 1989-10-17 | 1989-10-17 | Protection circuit for run-away of mpu |
Country Status (1)
Country | Link |
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KR (1) | KR920004384B1 (en) |
-
1989
- 1989-10-17 KR KR1019890014905A patent/KR920004384B1/en not_active IP Right Cessation
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Publication number | Publication date |
---|---|
KR910008535A (en) | 1991-05-31 |
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