KR900006723Y1 - Image mixing circuit for digital tv - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 본 고안 장치의 회로도.1 is a circuit diagram of the device of the present invention.
제2도 a~d는 제1도 회로중 각 부분에서의 파형도.2 is a waveform diagram of each part of the circuit of FIG.
본 고안은 TV 화면의 일부에 다른 채널 방송 화면이 표시되는 디지탈 TV수상기의 화상 혼합장치에 관한 것으로서 특히 차동증폭기로된 스위칭부, 혼합부, 레벨조절부 및 출력부를 설치하여된 디지탈 TV 수상기의 화상 혼합장치에 관한 것이다.The present invention relates to an image mixing device of a digital TV receiver in which a channel broadcasting screen is displayed on a part of a TV screen, and in particular, an image of a digital TV receiver provided with a switching unit, a mixing unit, a level control unit, and an output unit formed of a differential amplifier. It relates to a mixing device.
종래의 디지탈 TV에서는 다수개의 소자들을 이용한 복잡한 구성으로서 하나의 화면내에 조그마한 구획으로 된 화면을 표시하도록 하였으므로 회로가 복잡하여서 고장원인이 될뿐 아니라 제조 공정이 복잡하여지고 제조 원가가 높아지는 단점이 있다.In the conventional digital TV, as a complicated configuration using a plurality of elements is to display a screen with a small partition in one screen, the circuit is complicated, which causes not only a failure but also a complicated manufacturing process and a high manufacturing cost.
본 고안은 이러한 종래의 단점을 해결하기 위하여 트랜지스터들로 구성된 스위칭부, 혼합부, 레벨조절부 및 출력부만으로 화상 혼합장치를 구성하므로서 구성이 간단하여 고장개소가 거의 없을뿐 아니라 제조공정이 간단하며 동시에 제조원가가 낮으면서도 하나의 화면내에 조그마한 구획으로된 다른 화면을 표시하도록 할 수 있는 디지탈 TV수상기의 화상 혼합장치를 제공하는 것을 목적으로 하며, 이하 첨부된 도면을 참조하면서 본 고안의 구성 및 작용효과를 설명하면 다음과 같다.In order to solve the above disadvantages, the present invention consists of an image mixing device consisting of only a switching part, a mixing part, a level adjusting part, and an output part composed of transistors. At the same time, it is an object of the present invention to provide an image mixing device of a digital TV receiver capable of displaying different screens in small sections in one screen while having low manufacturing costs, and with reference to the accompanying drawings. When described as follows.
제1도를 참조하면 본 고안 장치는 주영상신호가 인가되는 입력(A) 을 에미터 접지 트랜지스터(Q1)와 저항(R2R3) 및 가변저항으로 된 레벨조절부(4)의 출력에 연결하여서 혼합부(2)내의 콜렉터 접지 트랜지스터(Q2)의 베이스에 연결하고, 혼합부(2)의 트랜지스터(Q2)의 에미터는 제어신호(B)가 접지 트랜지스터(Q5)의 베이스에 입력되고 트랜지스터(Q2) 콜렉터가 차동트랜지스터(Q3, Q4)의 트랜지스터(Q4)의 베이스에 연결된 스위칭부(1)의 트랜지스터(Q3)의 콜렉터에 연결함과 동시에 다이오드(D1)를 통하여 출력부(3)의 에미터 접지 트랜지스터(Q7)의 베이스에 연결하며, 혼합될 영상신호(C)가 베이스에 입력되는 혼합부(2)의 콜렉터 접지 트랜지스터(Q6)의 에미터는 스위칭부(1)의 트랜지스터(Q4)의 콜렉터에 연결함과 동시에 다이오드(D2)를 통하여 출력부(3)의 다이오드(D7)의 베이스에 연결하여된 구성으로서 여기에서, 미설명 부호 R4R12는 저항, D는 출력단자이다.Referring to FIG. 1, the device of the present invention outputs an input A to which a main video signal is applied, an emitter ground transistor Q 1 , a resistor R 2 R 3 , and a level adjusting unit 4 including a variable resistor. Is connected to the base of the collector ground transistor Q 2 in the mixing section 2 , and the emitter of the transistor Q 2 of the mixing section 2 has a control signal B at the base of the ground transistor Q 5 . input and the transistor (Q 2) collector is connected to the collector of the transistor (Q 3) of the differential transistors (Q 3, Q 4) transistor switching unit (1) connected to the base of (Q 4) of the box and at the same time the diode (D 1 ) is connected to the base of the emitter ground transistor Q 7 of the output unit 3, and the collector ground transistor Q 6 of the mixing unit 2 into which the image signal C to be mixed is input to the base. an emitter connected to the collector of the transistor (Q 4) of the switching unit (1) and at the same time through the diode (D 2) Here, as a configuration to connect the base of the diode (D 7) of ryeokbu 3, reference numeral 12 is a resistor R 4 R, D is an output terminal.
이러한 본 고안 장치의 작용효과는 제2a~d도를 참조하여 설명하면, 트랜지스터(Q3, Q4)는 차동증폭기를 형성하여 트랜지스터(Q3)의 베이스전압(Vcc)을 저항(R7, R8)으로 분압된 전압이 트랜지스터(Q4)의 베이스 전압보다 낮으면 트랜지스터(Q3)는 온 되고 높으면 오프되게 동작한다.The operational effects of the device of the present invention will be described with reference to FIGS. 2A to 2D, and the transistors Q 3 and Q 4 form a differential amplifier so as to reduce the base voltage Vcc of the transistor Q 3 to the resistors R 7 ,. When the voltage divided by R 8 is lower than the base voltage of the transistor Q 4 , the transistor Q 3 is turned on and is turned off when the voltage is high.
제2b도와 파형의 제어신호가 단자(B)에 가해지면 제2b도에서 시간(t)동안만 트랜지스터(Q5)가 온되어 트랜지스터(Q4)의 베이스전압이 트랜지스터(Q3)의 베이스 전압보다 낮도록 저항(R7, R8, R10, R11)을 정하면 트랜지스터(Q3)는 오프, 트랜지스터(Q4)는 온이 된다.When the control signal of FIG. 2b and the waveform is applied to the terminal B, the transistor Q 5 is turned on only for the time t in FIG. 2b, so that the base voltage of the transistor Q 4 becomes the base voltage of the transistor Q 3 . When the resistors R 7 , R 8 , R 10 , and R 11 are set to be lower, the transistor Q 3 is turned off and the transistor Q 4 is turned on.
제2b도에서 시간(t) 이외에도 트랜지스터(Q5)가 오프이므로 당연히 트랜지스터(Q4)의 베이스 전압이 트랜지스터(Q3)의 베이스 전압보다 높아 트랜지스터(Q3)는 온 트랜지스터(Q4)는 오프가 된다.No. 2b also at time (t) in addition to the transistor (Q 5) is turned off because of course the base voltage of the transistor (Q 4) becomes higher than the base voltage of the transistor (Q 3) transistor (Q 3) are turned on transistor (Q 4) is It turns off.
제2b도의 시간(t)동안 트랜지스터(Q4)가 온 되어 트랜지스터(Q6)에는 에미터에 바이어스가 저항(R9) 및 트랜지스터(Q4)를 통해 걸리게 되고 따라서 다이오드(D2)는 온되며, 트랜지스터(Q3)가 오프이므로 다이오드(D1)는 오프되며 트랜지스터(Q2)도 바이어스가 안 잡히게 된다.Transistor Q 4 is turned on during the time t of FIG. 2b so that the transistor Q 6 is biased by the emitter through resistor R 9 and transistor Q 4 and thus diode D 2 is turned on. Since the transistor Q 3 is off, the diode D 1 is off and the transistor Q 2 is not biased.
즉 제2c도와 같은 파형의 신호가 단자(C)로 입력되면 트랜지스터(Q6)를 통해 다이오드(D2)를 거쳐서 트랜지스터(Q7)의 베이스에 나타나게 되고 그것이 트랜지스터(Q7)의 단자(D)에 나타난다.That is, when a signal having a waveform as shown in FIG. 2C is input to the terminal C, the signal is displayed at the base of the transistor Q 7 through the transistor Q 6 through the diode D 2 , which is the terminal D of the transistor Q 7 . Appears in the
한편 제2b도에서 시간(t)이외의 시간에도 트랜지스터(Q5)가 오프이므로 트랜지스터(Q4)의 베이스에 트랜지스터(Q3)의 베이스 보다 전압이 많이 걸려 트랜지스터(Q4)는 오프, 트랜지스터(Q3)는 온 되어 위와 반대로 트랜지스터(Q2)가 저항(R9) 트랜지스터(Q3)를 통해 바이어스가 잡히게 되므로 트랜지스터(Q2)가 온되고 따라서 다이오드(D1)가 온 되며 다이오드(D2)는 오프된다.On the other hand, in FIG. 2B, since the transistor Q 5 is turned off even at a time other than the time t, the transistor Q 4 takes more voltage than the base of the transistor Q 3 at the base of the transistor Q 4 . Q 3 is on and vice versa, transistor Q 2 is biased through resistor R 9 transistor Q 3 so transistor Q 2 is on and diode D 1 is on and diode ( D 2 ) is off.
따라서 제2a도와 같은 파형의 신호가 입력단자(A)에 가해지면 트랜지스터(Q2)와 다이오드(D1)를 통해 에미터 접지 트랜지스터(Q7)를 통해 출력단자(D)에 나타난다.Accordingly, when a signal having a waveform as shown in FIG. 2A is applied to the input terminal A, the signal appears at the output terminal D through the emitter ground transistor Q 7 through the transistor Q 2 and the diode D 1 .
이때 트랜지스터(Q1) 및 저항(R2), 가변저항(VR1)으로된 레벨조절부(4)는 입력단자(A)에 입력되는 신호레벨과 단자(C)에 입력되는 혼합될 영상신호의 레벨을 맞추어 주기 위한 회로로서 가변저항(VR1)을 조정하므로서, 직류전압값일 변하게 되어 두개의 입력단자(A, C)의 레벨을 맞추어 준다.At this time, the level adjusting unit 4 composed of the transistor Q 1 , the resistor R 2 , and the variable resistor VR 1 has a signal level input to the input terminal A and a video signal to be input to the terminal C. By adjusting the variable resistor VR 1 as a circuit for matching the level of, the DC voltage value is changed to match the level of the two input terminals A and C.
위와 같이 2개의 영상입력과 하나의 제어입력으로 두개의 영상을 혼합하여 제2도 라와 같은 파형의 혼합된 신호가 출력단자(D)에 발생된다.As described above, two images are mixed with one image and one control input, and a mixed signal having a waveform as shown in FIG. 2 is generated at the output terminal D. FIG.
이상에서 설명된 바와같이 본 고안에 의하면 간단한 구성으로도 하나의 영상신호에 제어신호의 폭만큼 다른 영상신호를 삽입할 수 있어 TV 화면에 조그마한 구획으로 다른 영상을 표시할 수 있어 2개의 화면을 동시에 시청할 수 있는 것이다.As described above, according to the present invention, even with a simple configuration, a different video signal can be inserted into a single video signal by the width of a control signal, so that different images can be displayed in small sections on a TV screen. You can watch.
Claims (1)
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|---|---|---|---|
| KR2019870021092U KR900006723Y1 (en) | 1987-11-30 | 1987-11-30 | Image mixing circuit for digital tv |
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|---|---|---|---|
| KR2019870021092U KR900006723Y1 (en) | 1987-11-30 | 1987-11-30 | Image mixing circuit for digital tv |
Publications (2)
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| KR890012017U KR890012017U (en) | 1989-07-15 |
| KR900006723Y1 true KR900006723Y1 (en) | 1990-07-28 |
Family
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Family Applications (1)
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|---|---|---|---|
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Country Status (1)
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| KR (1) | KR900006723Y1 (en) |
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1987
- 1987-11-30 KR KR2019870021092U patent/KR900006723Y1/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
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| KR890012017U (en) | 1989-07-15 |
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