KR900000667Y1 - Pulse generating circuit - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 본 고안의 회로도.1 is a circuit diagram of the present invention.
제2도는 본 고안의 각부 파형도.2 is a waveform diagram of each part of the present invention.
제3도는 본 고안의 또 다른 실시 회로도.3 is another embodiment of the present invention.
제4도는 본 고안의 또 다른 실시 회로도의 각부 파형도.4 is a waveform diagram of each part of another embodiment of the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1, 2 : 펄스 발생부 D1, D6: 다이오드1, 2: pulse generator D 1 , D 6 : diode
Q1, Q2, Q3: 트랜지스터 IC1, IC2: 정전압 집적소자Q 1 , Q 2 , Q 3 : Transistor IC 1 , IC 2 : Constant Voltage Integrated Device
R1-R8: 저항 C1-C4: 콘덴서R 1 -R 8 : Resistor C 1 -C 4 : Capacitor
T : 트랜스T: trance
본 고안은 팬 히터의 모터 위상 제어 및 시계 기능의 계수를 위한 120HZ의 펄스를 발생시키는 펄스 발생회로로써 교류 전원에 동기되는 120HZ의 구형파 펄스를 모터의 위상 제어시 기준점이 되도록한 것이다.The present invention is a pulse generator circuit for generating 120HZ pulses for the motor phase control of the fan heater and the counting function of the clock heater.
종래에는 60HZ 또는 120HZ 의 펄스를 발생시키기 위해서는 발진용 크리스탈 및 발진용 집적소자와 분주기등이 필요하여 펄스 발생회로의 구성이 복잡하였으며 교류 부하에 대하여 위상 제어시에는 교류 전원선과 위상이 동기가 되지 않아 제로 크로싱(Zero Crossing)신호로 사용할 수 없게되는 단점이 있었다.Conventionally, in order to generate 60HZ or 120HZ pulse, oscillation crystal, oscillation integrated device and divider are needed, so the configuration of pulse generator is complicated. As a result, there was a disadvantage in that it could not be used as a zero crossing signal.
이와 같은 점을 감안하여 본 고안은 교류전원을 이용하여 직류 전원 회로에 공급하기 위한 트랜스포머(Trans former)의 2차축 교류의 정류된 파형을 사용하여 교류 전원에 동기되는 120HZ의 구형파 펄스를 구현해주도록한 것으로써 교류 위상 제어용 기준 펄스 또는 교류 전원 동기용 시계의 클럭으로 동작 시키도록 한 것이다.In view of the above, the present invention implements a square wave pulse of 120 HZ synchronized with the AC power using the rectified waveform of the secondary shaft AC of the transformer for supplying the DC power circuit using the AC power. In other words, it is operated by the clock of AC phase control reference pulse or AC power synchronization clock.
이를 첨부 도면에 의하여 상세히 설명하면 다음과 같다.This will be described in detail with reference to the accompanying drawings.
제1도는 본 고안의 회로도로써 교류(AC)전원이 인가되는 감압용 트랜스(T)의 2차측 출력전압은 정류용 다이오드(D1-D4)로 정류된후 평활용 콘덴서(C1)에 충전되어(-)전압용 정전압 집적소자(IC1: 7905)와 평활용 콘덴서(C2)에 의해 -5V로 출력되는 공지의 정전압 회로에 있어서, 다이오드(D3), (D4)의 애노드와 정전압 집적소자(IC1)사이에 역전위 차단용 다이오드(D5)를 연결하고 다이오드(D1-D4)로 정류된 전압은 저항(R1), (R2)으로 분배되어 트랜지스터(Q1)의 베이스에 인가되며 트랜지스터(Q)의 콜렉터 출력은 저항(R3), (R4)으로 분배되어 트랜지스터(Q2)의 베이스에 인가시킨후 트랜지스터(Q2)의 콜렉터측에는 풀 업 저항(R5)을 연결하여 펄스 발생부(1)를 구성한 것이다.1 is a circuit diagram of the present invention, the secondary output voltage of a pressure reducing transformer (T) to which an AC power is applied is rectified to the rectifying diodes D 1 to D 4 , and then to the smoothing capacitor C 1 . In the known constant voltage circuit which is charged and is output at -5V by the constant voltage integrated device (IC 1 : 7905) and the smoothing capacitor (C 2 ) for the negative voltage, the anode of the diodes (D 3 ) and (D 4 ) The reverse potential blocking diode (D 5 ) is connected between and the constant voltage integrated device (IC 1 ), and the voltage rectified by the diodes (D 1 -D 4 ) is distributed to the resistors (R 1 ), (R 2 ) and thus the transistor ( the collector outputs of the is applied to the base transistor (Q) of Q 1) is the resistance (R 3), (R 4 ) to the distribution side of the collector of the transistor (Q 2) that after the transistor (Q 2) applied to the base of the pull-up The pulse generator 1 is configured by connecting a resistor R 5 .
그리고 제3도는 본 고안의 또 다른 실시 회로도로써 정류용 다이오드(D1-D4)의 출력이 평활용 콘덴서(C3), (C4)와 (＋)전압용 정전압 집적소자(IC2)사이에 역전위 차단용 다이오드(D6)를 연결하고 다이오드(D1-D4)로 정류된 전압은 저항(R6), (R7)으로 분배되어 트랜지스터(Q3)의 베이스에 인가되게 연결하며 트랜지스터(Q3)의 콜렉터측에는 풀 업 저항(R8)을 연결하여 펄스 발생부(2)를 구성한 것이다.3 is another embodiment of the present invention, the output of the rectifying diodes (D 1- D 4 ) is a smoothing capacitor (C 3 ), (C 4 ) and (+) voltage constant voltage integrated device (IC 2 ) Connect the reverse potential blocking diode (D 6 ) between them and the voltage rectified by the diodes (D 1 -D 4 ) are distributed to the resistors (R 6 ), (R 7 ) and applied to the base of the transistor (Q 3 ). The pulse generator 2 is configured by connecting a pull-up resistor R 8 to the collector side of the transistor Q 3 .
이와 같이 구성된 본 고안의 작용 효과를 설명하면 제1도에서 교류(AC)전원이 인가되는 감압용 트랜스(T)의 2차측 출력 전압은 정류용 다이오드(D1-D4)에 의해 정류되어 제2a도에서와 같이 출력된후 역전위 차단용 다이오드(D5)에서 다시 정류된 전압은 평활용 콘덴서(C1)에 제2c도에서와 같이 충전되며 정전압 집적소자(IC1)에 의해 정류되어 -5V를 출력시키는 정전압 회로에 있어서, 정류용 다이오드(D1-D4)로 정류된 제2a도와 같은 전압은 0V에 연결된 저항(R1), (R2)으로 분배되어 트랜지스터(Q1)의 베이스에 인가되나 저항(R1)(R2)에 의해 분배된 전압이 제2a도에 표시된 바와 같은 PNP형 트랜지스터(Q1)의 "턴온"레벨 이상이 되면 트랜지스터(Q1)는 "턴 오프"되어 트랜지스터(Q1)의 콜렉터측에 전압이 인가되지 않아 저항(R3)(R4)을 통하여 연결된 트랜지스터(Q2)도 "턴오프"되므로써 트랜지스터(Q2)의 1콜렉터측으로 풀 업 저항(R5)을 통하여 0V 가 제2b도에서와 같이 출력되게 된다.Referring to the operation and effect of the present invention configured as described above, the secondary output voltage of the pressure reducing transformer (T) to which the AC power is applied in FIG. 1 is rectified by the rectifying diodes D 1 -D 4 . After output as shown in FIG. 2a, the voltage rectified again in the reverse potential blocking diode D 5 is charged to the smoothing capacitor C 1 as shown in FIG. 2c and rectified by the constant voltage integrated device IC 1 . In the constant voltage circuit for outputting -5V, the voltage as shown in FIG. 2a rectified by the rectifying diodes D 1 -D 4 is distributed to the resistors R 1 and R 2 connected to 0V, thereby providing a transistor Q 1 . applied to the base, but a resistance (R 1) (R 2) when the voltage is "turn-on" level or higher of the PNP-type transistor (Q 1) as indicated in claim 2a also distributed by the transistor (Q 1) is "turned off "it is not to be a voltage to the collector side of the transistor (Q 1) is connected through a resistor (R 3) (R 4) bit Register (Q 2) is also 0V so that the output, as in the Figure 2b doemeurosseo "off" through the transistor pull-up resistor (R 5) toward the collector of one (Q 2).
그러나 저항(R1), (R2)에 의해 분배된 전압이 PNP형 트랜지스터(Q1)의 "턴온"레벨 이하가 되면 트랜지스터(Q1)는 "턴 온"되어 트랜지스터(Q1)의 콜렉터 측에는 약 0V가 인가되게 되며 이러한 트랜지스터(Q1)의 콜렉터 출력은 -5V에 연결된 저항(R3), (R4)에 의해 분배되어 트랜지스터(Q2)의 베이스에 인가되므로써 트랜지스터(Q2)는 "턴온"되어 트랜지스터(Q2)의 콜렉터측 출력 전압은 제2b도에서와 같이 출력되며 이때의 출력 전압(Vb)는 Vb=-5V＋VCEQ2=-5V＋0.2V=-4.8V 로 표시된다.However, when the voltage divided by the resistors R 1 and R 2 falls below the "turn-on" level of the PNP transistor Q 1 , the transistor Q 1 is "turned on" and the collector of the transistor Q 1 . On the side, about 0V is applied, and the collector output of such transistor Q 1 is distributed by resistors R 3 and R 4 connected to -5V and applied to the base of transistor Q 2 , thereby providing transistor Q 2 . Is " turned on " so that the output voltage of the collector side of transistor Q 2 is output as shown in Fig. 2b, and the output voltage Vb is expressed as Vb = -5V + V CE Q 2 = -5V + 0.2V = -4.8V. do.
따라서 펄스 발생부(1)의 트랜지스터(Q2)의 콜렉터측으로는 제2b도에서와 같은 출력 전압이 주기 8.33㎳인 120HZ의 구형파로 출력되어 마이콤 또는 위상 제어회로에 인가시켜 주므로써 교류 전원이 제로 크로싱 신호로 사용할 수 있다.Accordingly, the AC power is zero because the output voltage as shown in FIG. 2B is output as a 120HZ square wave having a period of 8.33 kHz to the collector side of the transistor Q 2 of the pulse generator 1 and applied to a microcomputer or a phase control circuit. Can be used as a crossing signal.
이때 역전위 차단용 다이오드(D5)는 평활용 콘덴서(C1)에 전원 충전된 전압(Vc)보다 낮을 경우 "턴온"되며 평활용 콘덴서(C1)의 충전 전압(Vc)이 정류 전압보다 높을 경우 "턴 오프"되어 평활용 콘덴서(C1)의 충전 전압(Vc)의 영향이 정류 전압(Va)의 파형에 영향을 주지 않도록 한 것이다.The inverted upper blocking diode (D 5) for the more smoothing capacitor (C 1) power the filled case lower than the voltage (Vc) "turned on", and the rectified voltage charging voltage (Vc) of the capacitor (C 1) parallel to the When high, it is " turned off " so that the influence of the charging voltage Vc of the smoothing capacitor C 1 does not affect the waveform of the rectified voltage Va.
그리고 제3도는 본 고안의 또 다른 실시 회로도로써 정류용 다이오드(D1-D4)의 정류된 전압 평활용 콘덴서(C3), (C4)와 정전압 집적소자(IC2)를 통하여 출력되는 일반적인(＋)정전압 회로에 있어서, 정류용 다이오드(D1-D4)의 출력은 제4d도에서와 같이 출력되어 저항(R6), (R7)으로 분배된후 트랜지스터(Q3)의 "턴온"레벨 이상이 되면 트랜지스터(Q3)는 "턴온"되어 풀 업 저항(R8)이 연결된 트랜지스터(Q3)의 콜렉터축으로는 제4f도에서와 같은 파형이 출력되며 이때의 출력 전압(Vf)레벨은 트랜지스터(Q3)의 콜렉터에 에미터간 전압인 0.2V가 된다.3 is another circuit diagram of the present invention, which is output through the rectified voltage smoothing capacitors C 3 and C 4 and the constant voltage integrated device IC 2 of the rectifying diodes D 1 -D 4 . In a general positive voltage circuit, the outputs of the rectifying diodes D 1 -D 4 are output as shown in FIG. 4d and distributed to the resistors R 6 , R 7 and then to the transistor Q 3 . When the transistor Q 3 is at the "turn-on" level or higher, the transistor Q 3 is "turned on", and the waveform as shown in FIG. 4f is output to the collector axis of the transistor Q 3 to which the pull-up resistor R 8 is connected. (Vf) level is the emitter voltage of 0.2V to the collector of the transistor (Q 3).
그리고 저항(R6), (R7)으로 분배된 전압이 트랜지스터(Q3)의 "턴온" 레벨 이하가 되면 트랜지스터(Q3)는 "턴 오프"되어 콜렉터측으로는 풀 업 저항(R8)에 인가되는 5V 전압이 제4f도에서와 같이 출력되어지므로써 트랜지스터(Q3)의 콜렉터측 출력은 주기 8.3㎳ 인 120HZ의 구형파가 출력되어 마이콤 또는 위상 제어 회로에 인가시켜 교류 전원의 제로 크로싱 신호로 사용할 수 있는 것이다.And a resistance (R 6), (R 7 ) with when the distribution voltage is the "turn-on" level or less of the transistor (Q 3) transistor (Q 3) is "off" is the pull-up resistor side to the collector (R 8) Since the 5V voltage applied to is outputted as shown in FIG. 4f, the collector-side output of transistor Q 3 outputs a square wave of 120HZ with a period of 8.3 Hz, which is applied to a microcomputer or phase control circuit to generate a zero crossing signal of AC power. It can be used as.
이때 역전위 차단용 다이오드(D6)의 역할은 제1도에서 도시된 역전위 차단용 다이오드(D5)와 같은 역할을 하는 것으로 평활용 콘덴서(C3)의 충전 전압(Ve)의 영향이 정류 전압(Vd)의 파형에 영향을 주지 않기 위한 역전위 차단용인 것이다.At this time, the role of the reverse potential blocking diode (D 6 ) plays the same role as the reverse potential blocking diode (D 5 ) shown in FIG. 1, and the influence of the charging voltage (Ve) of the smoothing capacitor (C 3 ) is affected. It is for the reverse potential blocking so as not to affect the waveform of the rectified voltage Vd.
또한 본 고안에서 정전압 집적소자(IC1), (IC2)는 정전압 회로로 구성할 수 있는 것이다.In addition, in the present invention, the constant voltage integrated devices IC 1 and IC 2 may be configured as constant voltage circuits.
이상에서와 같이 본 고안은, 일반적인 정전압 회로에 있어서 트랜스 포머의 2차측 정류 파형을 이용하여 보다 간단한 회로로 입력 교류 전원에 동기되는 120HZ의 구형파 펄스를 발생시키도록 한 것으로써 교류 전원과 위상이 동기되므로 교류 부하의 위상 제어용 기준 펄스의 교류 전원 동기용 시계의 클럭으로 사용할 수 있는 효과가 있는 것이다.As described above, the present invention uses a secondary rectified waveform of a transformer in a general constant voltage circuit to generate a square wave pulse of 120 HZ synchronized with an input AC power source using a simpler circuit, thereby synchronizing the AC power source with the phase. Therefore, there is an effect that can be used as the clock of the AC power synchronization clock of the reference pulse for phase control of the AC load.
Claims (2)
Priority Applications (1)
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|---|---|---|---|
| KR2019870010082U KR900000667Y1 (en) | 1987-06-24 | 1987-06-24 | Pulse generating circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR2019870010082U KR900000667Y1 (en) | 1987-06-24 | 1987-06-24 | Pulse generating circuit |
Publications (2)
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| KR890001688U KR890001688U (en) | 1989-03-20 |
| KR900000667Y1 true KR900000667Y1 (en) | 1990-01-30 |
Family
ID=19264409
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR2019870010082U KR900000667Y1 (en) | 1987-06-24 | 1987-06-24 | Pulse generating circuit |
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| Country | Link |
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| KR (1) | KR900000667Y1 (en) |
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1987
- 1987-06-24 KR KR2019870010082U patent/KR900000667Y1/en not_active IP Right Cessation
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| Publication number | Publication date |
|---|---|
| KR890001688U (en) | 1989-03-20 |
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