KR890007510A - 메모리를 이용한 디지탈신호 발생장치 및 방법 - Google Patents
메모리를 이용한 디지탈신호 발생장치 및 방법 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 시스템도.
제3도는 (가)는 메모리에 저장된 파형도. (나)는 본 발명에 의한 출력 파형.
Claims (2)
- PCM방식 디지탈 오디오 시스템에 연구개발시 사용되는 디지탈 기준신호 발생회로에 있어서, 필요한 디지탈신호를 발생하기 위한 아날로그 시험신호 데이터를 발생하기 위한 키스캔부(10)와 상기 아날로그 시험 신호 데이터를 입력하여 디지탈 신호를 발생하기 위한 다수의 어드레스 데이터와 제어신호를 소정시간 주기마다 순차적으로 발생하는 마이크로콤퓨터(20)와, 상기 다수의 어드레스 데이터를 소정시간 주기로 순차적으로 입력하여 저장된 기준신호 데이터를 상기 다수의 어드레스 데이터에 해당하는 다수의 표본디지탈 데이터로 구성되는 디지탈 신호를 읽어내는 메모리(30)와, 상기 다수의 제어신호와 다수의 표본디지탈 데이터를 입력하여 상기 다수의 제어신호에 의해 상기 다수의 표본디지탈 데이터를 래치함으로서 디지탈신호를 출력하는 래치회로(40)로 구성함을 특징으로 하는 회로.
- PCM디지탈 오디오 시스템의 연구 개발시 사용되는 디지탈 기준신호 발생회로에 있어서, 필요한 디지탈 신호를 발생시키기 위한 아날로그 시험신호 주파수를 입력하는 과정과 상기 아날로그 시험신호 데이터에 의해 가산치 A를 다음과 같이 계산한 후 (A=아날로그 시험신호 주파수/기준신호 주파수) 소정 시간간격마다 상기 가산치로 S=S+A의 어드레스데이터와 제어신호를 순차적으로 발생 출력하는 과정과, 상기 어드레스 데이터를 입력하여 기록된 기준 신호 디지탈 데이터중 상기 어드레스 데이터에 해당하는 번지의 표본디지탈 데이터를 추출하는 과정과, 상기 표본디지탈 데이터를 상기 제어신호에 의해 래치출력하는 과정으로 구성됨을 특징으로 하는 디지탈 기준신호 발생방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR870011831A KR890007510A (ko) | 1987-10-24 | 1987-10-24 | 메모리를 이용한 디지탈신호 발생장치 및 방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| KR870011831A KR890007510A (ko) | 1987-10-24 | 1987-10-24 | 메모리를 이용한 디지탈신호 발생장치 및 방법 |
Publications (1)
| Publication Number | Publication Date |
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| KR890007510A true KR890007510A (ko) | 1989-06-20 |
Family
ID=68343736
Family Applications (1)
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| KR870011831A KR890007510A (ko) | 1987-10-24 | 1987-10-24 | 메모리를 이용한 디지탈신호 발생장치 및 방법 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR890007510A (ko) |
-
1987
- 1987-10-24 KR KR870011831A patent/KR890007510A/ko not_active IP Right Cessation
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