KR890007491A - 주파수 동기 루프용 주파수 검파기 - Google Patents

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휴렛트-팩카드 캄파니
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Abstract

내용 없음

Description

주파수 동기 루프용 주파수 검파기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명에 따라 구성된 주파수 검파기를 포함하는 주파수 합성 루프의 블럭도.
제 2 도는 제 1 도의 회로에 사용한 주파수 검파기의 기능 블럭도.
제 3도는 제 2 도의 주파수 검파기의 양호한 실시예를 도시한 상세한 개략도.

Claims (5)

  1. 기준 주파수 신호와 가변 주파수 신호를 수신하고, 가장 높은 주파수로된 기준 주파수 및 가변 주파수신호들중의 한 신호의 완전 사이클을 검파한 후, 기준 주파수 신호의 주파수와 가변 주파수 신호의 주파수 사이의 차함수인 차출력 신호를 발생시키기 위한 주파수 검파기 장치(100), 차출력 신호를 수신하고, 평활 제어 신호를 제공하기 위해 선정된 차단(cut-off)주파수 이상의 소정의 신호 성분을 이 출력 신호로부터 제거시키기 위한 저역 통과 필터 장치(120), 평활 제어 신호를 수신하고, 주파수가 평활 제어 신호의 함수인 출력 신호를 발생시키기 위한 전압 제어 발전기 장치(140), 및 주파수 검파기 장치(100)에 인가되는 가변 주파수 신호를 발생시키기 위해 조정가능한 요인에 의해 출력 신호의 주파수를 분할하기 위한 주파수 분할기 장치(160)으로 구성된 것을 특징으로 하는 주파수 합성기 회로.
  2. 제 1 항에 있어서, 주파수 검파기 장치(100)이, 기준 주파수 신호를 수신하기 위한 제 1 완전 사이클 검파기 장치(2), 가변 주파수 신호를 수신하기 위한 제 2 완전 사이크 검파기 장치(4), 및 기준 주파수 신호와 가변 주파수 신호를 수신하고, 가변 또는 기준 주파수 신호들 중 한 신호가 가장 늦은 시간에 그 사이클을 개시하는 함수로써 제 1 및 제 2 완전 사이클 검파기 장치(2,4)를 선택적으로 엔에이블시키기 위한 연속 제어 회로장치(6)으로 구성되고, 제 1 완전 사이클 검파기 장치(2)가 연속 제어 회로장치(6)에 의해 엔에이블될때, 기준 주파수 신호의 특정한 완전 사이클 수가 발생했다는 것을 나타내는 출력 신호를 발생시키기 위해 동작하고, 제 2 완전 사이클 검파기 장치(4)가 연속 제어 회로장치6)에 의해 엔에이블될때, 가변 주파수 신호의 특정한 완전 사이클 수가 발생했다는 것을 나타내는 출력 신호를 발생시키기 위하여 동작하는 것을 특징으로하는 주파수 합성기 회로.
  3. 제 2항에 있어서, 각각의 제 1 및 제 2 완전 사이클 검파기 장치(2,4)가 다수의 셋트-리셋트 플립플롭(10,20,30,40,50,60)으로 구성된 것을 특징으로 하는 주파수 합성기 회로.
  4. 기준 주파수 신호와 가변 주파수 신호를 수신하고, 가장 높은 주파수로된 기준 주파수 및 가변 주파수 신호중의 한 신호의 완전 사이클을 검파한 후, 기준 주파수 신호의 주파수와 가변 주파수 신호의 주파수 사이의 차함수인 차출력 신호를 발생시키기 위한 장치(2,4)로 구성된 것을 특징으로 한는 주파수 검파기.
  5. 기준 주파수 신호와 가변 주파수 신호를 수신하고, 가장 높은 주파수로된 기준 주파수 및 가변 주파수 신호중 한 신호의 완전 사이클을 검파한 후, 기준 주파수 신호의 주파수와 가변 주파수 신호의 주파수 사이의 차함수인 차출력 신호를 발생시키기 위한 주파수 검파기에 있어서, 기준 주파수 신호를 수신하기 위한 제 1 완전 사이클 검파기 장치(2), 기준 주파수 신호를 수신하기 위한 제 2 완전 사이클 검파기 장치(4), 기준 주파수 신호와 가변 주파수 신호를 수신하고, 가변 또는 기준 주파수 중 한 신호가 가장 늦은 시간에 그 사이클을 개시하는 함수로써 제1 및 제2완전 사이클 검파기 장치(2,4)를 선택적으로 엔에이블시키기 위한 연속제어회로장치(6), 연속 제어 회로 장치(6)에 의해 엔에이블될때, 기준 주파수 신호의 특정한 완전 사이클 수가 발생했다는 것을 나타내는 출력신호를 발생시키기 위하여 동작하는 제 1 완전 사이클 검파기 장치(2), 및 연속 제어 회로 장치(6)에 의해 엔에이블될때, 가변 주파수 신호의 특정한 완전 사이클 수가 발생했다는 것을 나타내는 출력 신호를 발생시키기 위하여 동작하는 제 2 완전 사이클 검파기장치(4)로 구성된 것을 특징으로 하는 주파수 검파기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019880013844A 1987-10-23 1988-10-22 주파수 동기 루프용 주파수 검파기 KR960011405B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US113,036 1987-10-23
US07/113,036 US4801894A (en) 1987-10-23 1987-10-23 Frequency detector for frequency locked loop

Publications (2)

Publication Number Publication Date
KR890007491A true KR890007491A (ko) 1989-06-20
KR960011405B1 KR960011405B1 (ko) 1996-08-22

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EP (1) EP0313206A3 (ko)
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JPH01157123A (ja) 1989-06-20
EP0313206A3 (en) 1990-03-14
US4801894A (en) 1989-01-31
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KR960011405B1 (ko) 1996-08-22

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