KR20240048898A - 동기 정류식 직류-직류 컨버터 - Google Patents

동기 정류식 직류-직류 컨버터 Download PDF

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김택무
이현재
박건호
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Abstract

인덕터; 상기 인덕터에 연결되어 상기 인덕터를 통해 흐르는 전류 경로를 결정하도록 사전 설정된 듀티비로 온/오프 되는 스위칭 소자; 상기 스위칭 소자의 오프 상태에서 온 되며 온-듀티비가 제어되는 동기 정류 FET; 및 상기 동기 정류 FET의 드레인-소스 전압을 사전 설정된 기준 전압과 비교하고, 상기 드레인-소스 전압과 사전 설정된 기준 전압을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하여 상기 동기 정류 FET의 온/오프 상태를 제어하는 컨트롤러를 포함하는 동기 정류식 직류-직류 컨버터가 개시된다.

Description

동기 정류식 직류-직류 컨버터{SYNCRONOUS RECTIFIER TYPE DC-DC CONVERTER}
본 발명은 동기 정류식 직류-직류 컨버터에 관한 것으로, 더욱 상세하게는 동기 정류를 위한 FET가 온 상태를 유지하는 시간을 간단하고 효과적으로 제어할 수 있는 동기 정류식 직류-직류 컨버터에 관한 것이다.
일반적으로 다이오드를 사용하는 비동기 정류식 직류-직류 컨버터는 다이오드의 순방향 전압 강하에 의한 손실이 크게 발생한다. 이러한 비동기 정류식 직류-직류 컨버터의 손실을 개선하고자 다이오드 대신 FET와 같은 스위치를 채용하여 효율을 개선한 동기 정류식 직류-직류 컨버터가 개발되었다.
동기 정류식 직류-직류 컨버터의 경우, 프리 휠링 구간에서 인덕터의 전류가 0(zero)가 되는 지점까지 FET를 온 시켜 동기 정류를 수행하는 구간을 정확히 지켜주어야 효율을 극대화할 수 있다.
종래에, 동기 정류를 위한 FET를 제어하는 방식은 인덕터 전류가 0이 되는 시점을 전류 검출 방식으로 결정하고 동기 정류를 위한 FET를 오프 시키는 방식이 적용되었다. 이러한 종래의 방법은, 전류 검출 기술이 매우 민감하고 노이즈 특성에 취약하며, 회로를 구현한 인쇄 회로 기판의 패턴 특성 등의 영향에 의해 인덕터 전류의 정확한 제로 크로스 시점을 검출하는 것이 매우 어려운 문제가 있다.
상기의 배경기술로서 설명된 사항들은 본 발명의 배경에 대한 이해 증진을 위한 것일 뿐, 이 기술분야에서 통상의 지식을 가진 자에게 이미 알려진 종래기술에 해당함을 인정하는 것으로 받아들여져서는 안 될 것이다.
한국공개특허 제10-2013-0008535호 한국등록특허 제10-2008-0102541호
이에 본 발명은, 노이즈나 회로 패턴 등과 같은 외부 요인에 영향을 받지 않고 간단하고 효과적으로 동기 정류를 위한 FET가 온 상태를 유지하는 시간을 제어할 수 있는 동기 정류식 직류-직류 컨버터를 제공하는 것을 해결하고자 하는 기술적 과제로 한다.
상기 기술적 과제를 해결하기 위한 수단으로서 본 발명은,
인덕터;
상기 인덕터에 연결되어 상기 인덕터를 통해 흐르는 전류 경로를 결정하도록 사전 설정된 듀티비로 온/오프 되는 스위칭 소자;
상기 스위칭 소자의 오프 상태에서 온 되며 온-듀티비가 제어되는 동기 정류 FET; 및
상기 동기 정류 FET의 드레인-소스 전압을 사전 설정된 기준 전압과 비교하고, 상기 드레인-소스 전압과 사전 설정된 기준 전압을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하여 상기 동기 정류 FET의 온/오프 상태를 제어하는 컨트롤러;
를 포함하는 동기 정류식 직류-직류 컨버터를 제공한다.
본 발명의 일 실시예에서, 상기 기준 전압은 상기 동기 정류 FET 내 바디 다이오드의 순방향 전압 강하에 상응하는 크기를 가질 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 일 사이클에서 상기 드레인-소스 전압이 상기 기준 전압보다 작은 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 드레인-소스 전압이 상기 기준 전압보다 작은 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시킬 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 일 사이클에서 상기 동기 정류 FET의 소스 전압이 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 큰 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 동기 정류 FET의 소스 전압이 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 큰 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시킬 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 상기 드레인-소스 전압과 상기 기준 전압을 비교하는 제1 비교기; 상기 드레인-소스 전압이 상기 기준 전압 보다 작은 경우 업카운트를 수행하고, 상기 드레인-소스 전압이 상기 기준 전압 보다 큰 경우 다운카운트를 수행하는 업다운 카운터; 사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및 상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기를 포함할 수 있다.
본 발명의 일 실시예에서, 상기 제1 비교기의 반전 입력단에는 상기 드레인-소스 전압이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 기준 전압이 입력될 수 있다.
본 발명의 일 실시예에서, 상기 제1 비교기의 반전 입력단에는 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 동기 정류 FET의 소스 전압이 입력될 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 상기 스위칭 소자의 오프 시점과 상기 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점까지를 상기 제1 비교기의 비교 결과를 유효하게 적용하는 구간으로 설정하는 검출 윈도를 더 포함할 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 상기 동기 정류 FET가 오프 되는 시점에 출력되는 상기 제1 비교기의 비교 결과를 배제하는 리딩 에지 블랭킹 회로를 더 포함할 수 있다.
상기 기술적 과제를 해결하기 위한 다른 수단으로서 본 발명은,
입력단에 일단이 연결된 스위칭 소자;
상기 스위칭 소자의 타단과 접지에 각각 드레인 및 소스가 연결되며 바디 다이오드를 포함하는 동기 정류 FET;
상기 스위칭 소자의 타단과 출력단에 각각 양단이 연결된 인덕터; 및
상기 동기 정류 FET의 드레인 전압과 사전 설정된 기준 전압을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하는 컨트롤러;
를 포함하는 동기 정류식 직류-직류 컨버터를 제공한다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 일 사이클에서 상기 드레인 전압이 상기 기준 전압보다 작은 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 드레인 전압이 상기 기준 전압보다 작은 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시킬 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 상기 드레인 전압과 상기 기준 전압을 비교하는 제1 비교기; 상기 드레인 전압이 상기 기준 전압 보다 작은 경우 업카운트를 수행하고, 상기 드레인 전압이 상기 기준 전압 보다 큰 경우 다운카운트를 수행하는 업다운 카운터; 사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및 상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기를 포함하며, 상기 제1 비교기의 반전 입력단에는 상기 드레인 전압이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 기준 전압이 입력될 수 있다.
상기 기술적 과제를 해결하기 위한 또 다른 수단으로서 본 발명은,
입력단에 일단이 연결된 인덕터;
상기 인덕터의 타단과 접지에 양단이 연결된 스위칭 소자;
출력단과 상기 인덕터의 타단에 각각 드레인 및 소스가 연결되며 바디 다이오드를 포함하는 동기 정류 FET; 및
상기 동기 정류 FET의 소스 전압과 상기 동기 정류 FET의 드레인 전압에 사전 설정된 기준 전압을 합산한 전압값을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하는 컨트롤러;
를 포함하는 정류식 직류-직류 컨버터를 제공한다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 일 사이클에서 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시킬 수 있다.
본 발명의 일 실시예에서, 상기 컨트롤러는, 상기 소스 전압과 상기 드레인 전압에 상기 기준 전압을 합산한 전압값을 비교하는 제1 비교기; 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 큰 경우 업카운트를 수행하고, 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 작은 경우 다운카운트를 수행하는 업다운 카운터; 사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및 상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기를 포함하며, 상기 제1 비교기의 반전 입력단에는 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 소스 전압이 입력될 수 있다.
상기 동기 정류식 직류-직류 컨버터에 따르면, 인덕터의 전류를 직접 검출하는 것이 아니라 동기 정류 FET의 드레인-소스 전압을 검출하여 동기 정류 FET의 온 상태 유지 시간을 제어하므로, 인덕터 전류를 검출하는 종래 기술에 비해 노이즈, 회로 패턴 등의 영향과 같은 외란에 강건하면서도 상대적으로 간단하게 동기 정류 FET의 온 상태 유지 시간을 제어할 수 있다.
본 발명에서 얻을 수 있는 효과는 이상에서 언급한 효과들로 제한되지 않으며, 언급하지 않은 또 다른 효과들은 아래의 기재로부터 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 명확하게 이해될 수 있을 것이다.
도 1은 본 발명의 일 실시예에 따른 동기 정류식 직류-직류 컨버터의 회로도이다.
도 2는 도 1에 도시된 직류-직류 컨버터의 동작을 도시한 파형도이다.
도 3는 컴퓨터 시뮬레이션 툴을 이용하여 도 1에 도시된 직류-직류 컨버터의 동작을 시뮬레이션 시킨 결과를 도시한 파형도이다.
도 4는 본 발명의 다른 실시예에 따른 동기 정류식 직류-직류 컨버터의 회로도이다.
도 5는 도 4에 도시된 직류-직류 컨버터의 동작을 도시한 파형도이다.
도 6은 컴퓨터 시뮬레이션 툴을 이용하여 도 4에 도시된 직류-직류 컨버터의 동작을 시뮬레이션 시킨 결과를 도시한 파형도이다.
이하, 첨부의 도면을 참조하여 본 발명의 다양한 실시예에 따른 동기 정류식 직류-직류 컨버터를 더욱 상세하게 설명하기로 한다.
본 발명의 이점 및 특징, 그리고 그것을 달성하는 방법은 첨부된 도면과 함께 상세하게 후술 되어 있는 실시예들을 참조하면 명확해질 것이다.
그러나, 본 발명은 이하에 개시되는 실시 예들에 의해 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시 예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
또한, 본 발명을 설명함에 있어 관련된 공지 기술 등이 본 발명의 요지를 흐리게 할 수 있다고 판단되는 경우 그에 관한 자세한 설명은 생략하기로 한다.
도 1은 본 발명의 일 실시예에 따른 동기 정류식 직류-직류 컨버터의 회로도이고, 도 2는 도 1에 도시된 직류-직류 컨버터의 동작을 도시한 파형도이며, 도 3는 컴퓨터 시뮬레이션 툴을 이용하여 도 1에 도시된 직류-직류 컨버터의 동작을 시뮬레이션 시킨 결과를 도시한 파형도이다.
또한, 도 4는 본 발명의 다른 실시예에 따른 동기 정류식 직류-직류 컨버터의 회로도이고, 도 5는 도 4에 도시된 직류-직류 컨버터의 동작을 도시한 파형도이며, 도 6은 컴퓨터 시뮬레이션 툴을 이용하여 도 4에 도시된 직류-직류 컨버터의 동작을 시뮬레이션 시킨 결과를 도시한 파형도이다.
더욱 상세하게, 도 1에 도시된 실시예의 직류-직류 컨버터는 입력 전압의 크기를 강압시켜 출력 전압을 생성하는 벅(buck) 컨버터이고, 도 4에 도시된 실시예의 직류-직류 컨버터는 입력 전압을 승압시켜 출력 전압을 생성하는 부스트(boost) 컨버터이다.
동기 정류를 실시하는 시간을 제어하는 본 발명의 특징은 벅 컨버터 및 부스트 컨버터에 공통적으로 적용될 수 있으며, 이하에서는 벅 컨버터와 부스트 컨버터의 예를 각각 구분하여 상세하게 설명하기로 한다.
벅 컨버터
도 1에 도시된 것과 같이, 본 발명의 일 실시예에 따른 동기 정류식 벅 컨버터는 입력단(Tin)에 일단이 연결된 스위칭 소자(11)와, 스위칭 소자(11)의 타단과 접지에 각각 드레인 및 소스가 연결되며 바디 다이오드(121)을 포함하는 동기 정류 FET(12)와, 스위칭 소자(11)의 타단과 출력단(Tout)에 각각 양단이 연결된 인덕터(13)와, 동기 정류 FET(12)의 드레인-소스 전압(VDS)과 사전 설정된 기준 전압을 비교한 결과에 기반하여 동기 정류 FET(12)가 온 상태를 유지하는 시간, 즉 온-듀티비를 결정하는 컨트롤러(100)를 포함하여 구성될 수 있다.
동기 정류식 벅 컨버터에서, 컨트롤러(100)는 동기 정류 FET(12)의 드레인과 소스가 도통 상태가 되는 온-듀티비를 제어하여 동기 정류를 달성하게 된다.
본 발명의 일 실시예에서, 컨트롤러(100)는 동기 정류 FET(12)의 드레인-소스 전압(VDS)를 입력 받고 드레인-소스 전압(VDS)과 사전 설정된 기준 전압을 비교하고 비교한 결과에 기반하여 동기 정류 FET(12)의 온-듀티비를 결정할 수 있다.
더욱 상세하게, 컨트롤러(100)는 사전 설정된 듀티비로 스위칭 하는 스위칭 소자(11)가 오프 되는 시점에 동기 정류 FET(12)를 턴온 시킬 수 있다. 실제로는 스위칭 소자(11)와 동기 정류 FET(12)가 동시에 온 되는 시간이 발생하는 것을 방지하기 위해 컨트롤러(100)는 스위칭 소자(11)가 오프된 이후 사전 설정된 데드 타임이 경과하면 동기 정류 FET(12)를 온 시킬 수 있다.
컨트롤러(100)는 최초 동작 시 동기 정류 FET(12)를 사전 설정된 최소 온 시간 동안 온 시키고 오프 시킬 수 있다. 이 경우, 동기 정류 FET(12)가 충분히 온 되는 시간, 즉 동기 정류를 수행할 수 있는 시간이 확보되지 못하게 되므로 동기 정류 FET(12)가 오프 되는 시점에서 동기 정류 FET(12) 내의 바디 다이오드(121)의 순방향 전압 강하에 해당하는 임계 전압(Vf)에 대응되는 전압 강하가 발생하여 동기 정류 FET(12)의 드레인-소스 전압은 임계 전압(Vf)에 대응되는 크기의 음의 전압값을 나타내게 된다.
이와 같이, 동기 정류 FET(12)의 드레인-소스 전압이 임계 전압(Vf)에 대응되는 크기의 음의 전압값을 갖는 경우, 컨트롤러(100)는 스위칭 되는 동기 정류 FET(12)의 그 다음 사이클의 온-듀티비(온 상태를 유지하는 시간)를 사전 설정된 크기로 증가시킬 수 있다.
이러한 온-듀티비를 증가시키는 컨트롤러(100)의 제어는, 동기 정류 FET(12)의 드레인-소스 전압이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 전압값을 갖지 않게 될 때까지 지속될 수 있다.
정류 FET(12)의 드레인-소스 전압이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 전압값을 갖지 않는 경우, 컨트롤러(100)는 스위칭 되는 동기 정류 FET(12)의 그 다음 사이클의 온-듀티비(온 상태를 유지하는 시간)를 사전 설정된 크기로 감소시킬 수 있다.
컨트롤러(100)는 전술한 것과 같은 동기 정류 FET(12)의 온-듀티비를 일정 시간 반복 수행함으로써, 정상 상태에서 동기 정류를 수행하는 구간을 최적으로 유지할 수 있게 된다.
이상에서 설명한 것과 같은 컨트롤러(100)의 제어를 구현하기 위해, 컨트롤러(100)는 동기 정류 FET(12)의 드레인-소스 전압(VDS)과 사전 설정된 기준 전압(Vref)을 비교하는 제1 비교기(101)와, 드레인-소스 전압(VDS)이 기준 전압(Vref) 보다 작은 경우 업카운트를 수행하고, 드레인-소스 전압(VDS)이 기준 전압(Vref) 보다 큰 경우 다운카운트를 수행하는 업다운 카운터(102)와, 사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기(103)와, 업다운 카운터(102)의 카운트값에 대응되는 아날로그 값과 톱니파 생성기(103)에서 생성된 톱니파를 비교하여 톱니파가 카운트 값에 대응되는 아날로그 값보다 커지는 시점에 동기 정류 FET(12)를 오프 시키는 제어신호를 출력하는 제2 비교기(104)를 포함할 수 있다.
제1 비교기(101)는 반전 입력단과 비반전 입력단을 가지며 두 입력단에 입력되는 아날로그 값의 크기를 비교한 결과를 디지털 값으로 출력할 수 있다.
벅 컨버터의 경우, 동기 정류 FET(12)의 소스가 접지 상태일 수 있으므로 동기 정류 FET(12)의 드레인의 전압을 검출함으로써 동기 정류 FET(12)의 드레인-소스 전압을 검출할 수 있고, 동기 정류 FET(12) 드레인의 전압 검출값이 제1 비교기(101)의 반전 입력단으로 입력될 수 있다.
비교기(101)의 비반전 입력단에는 기준 전압(Vref)가 입력될 수 있으며, 기준 전압(Vref)은 동기 정류 FET(12)의 드레인-소스 전압이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 값과 비교하게 되므로 음의 값을 갖음의 값을 가질 수 있다. 본 발명의 실시예는, 동기 정류 FET(12)의 드레인-소스 전압이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 값을 갖는지 검출하여야 하므로 기준 전압(Vref)은 임계 전압(Vf)의 크기를 고려하여 그에 상응하는 값을 갖도록 사전에 결정될 수 있다.
제1 비교기(101)는 비반전 입력단으로 입력된 기준 전압(Vref)이 반전 입력단으로 입력된 동기 정류 FET(12)의 드레인-소스 전압(VDS) 보다 큰 경우 디지털 신호의 하이 레벨을 출력하고 그 반대의 경우 로우 레벨을 출력할 수 있다.
업다운 카운터(102)는 제1 비교기(101)에서 하이 레벨이 출력되는 경우 업카운트를 수행할 수 있으며, 제1 비교기(101)에서 로우 레벨이 출력되는 경우 다운 카운트를 수행할 수 있다.
이러한 업다운 카운터(102)의 동작을 위해, 도 1에 도시된 실시예에서는, 카운터(105)와 SR 래치(106) 및 반전기(107)가 구비될 수 있다. 즉, 카운터(105), SR 래치(106) 및 반전기(107)는 업다운 카운터(102)의 업 카운팅 또는 다운 카운팅의 동작을 결정하기 위한 입력 신호를 생성하는데 사용되는 요소이다.
카운터(105)는 스위칭 소자(11)의 온/오프를 제어하기 위한 신호(GH1)를 클럭으로 입력 받고 제1 비교기(101)의 출력을 리셋 입력단으로 입력 받는 2 비트 카운터일 수 있다.
카운터(105)의 리셋이 활성화되지 않는 상태, 즉 카운터(105)의 리셋 입력단에 입력되는 신호가 로우 레벨인 경우에, 카운터(105)는 신호(GH1)의 한 클럭 당 출력을 한 단계씩 상승시키는 동작을 하게 된다.
예를 들어, 동기 정류 FET(12)의 드레인-소스 전압이 기준 전압 보다 작은 경우, 제1 비교기(101)에서 출력되는 하이 레벨 신호가 카운터(105)의 리셋 입력단로 입력되고, 카운터(105)는 신호(GH1)의 한 클럭만 카운트한 상태(D0는 하이 레벨, D1은 로우 레벨)를 유지하므로 SR 래치(106)의 세트 입력단에는 로우 레벨 신호가 입력된다. 한편, SR 래치(106)의 리셋 입력단에는 하이 레벨 신호가 입력되어 SR 래치(106)는 로우 레벨 신호를 출력하고, SR 래치(106)에서 출력된 로우 레벨 신호는 반전기(107)에 의해 하이 레벨로 반전되어 업다운 카운터(102)로 입력된다. 따라서, 업다운 카운터(102)는 업 카운팅 동작, 즉 카운트 값을 한 단계 증가시키게 된다.
반대로, 동기 정류 FET(12)의 드레인-소스 전압이 기준 전압 보다 작은 경우가 발생하지 않으면, 카운터(105)의 리셋 입력단에는 로우 레벨 신호가 입력되고, 그 다음 사이클에 신호(GH1)를 한 클럭 추가로 카운팅하게 되어 D0는 로우 레벨, D1은 하이 레벨을 출력하게 된다. 따라서, SR 래치(106)의 세트 입력단에는 하이 레벨 신호가 입력되고, 리셋 입력단에는 로우 레벨 신호가 입력되어 SR 래치(106)는 하이 레벨 신호를 출력하고, SR 래치(106)에서 출력된 하이 레벨 신호는 반전기(107)에 의해 로우 레벨로 반전되어 업다운 카운터(102)로 입력된다. 따라서, 업다운 카운터(102)는 다운 카운팅 동작, 즉 카운트 값을 한 단계 감소시키게 된다.
업다운 카운터(102)는 하이 레벨이 입력되는 경우 카운트값을 증가시키고 로우 레벨이 입력되는 경우 카운트값을 감소시키게 된다. 따라서, 동기 정류 FET(12)의 드레인-소스 전압(VDS)이 기준 전압(Vref)보다 작은 경우(동기 정류 FET(12)의 드레인-소스 전압(VDS)이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 값을 갖는 경우) 업다운 카운터(102)의 카운트값이 증가하게 되고, 동기 정류 FET(12)의 드레인-소스 전압(VDS)이 기준 전압(Vref) 보다 큰 경우(동기 정류 FET(12)의 드레인-소스 전압(VDS)이 바디 다이오드(121)의 임계 전압(Vf)에 대응되는 음의 값을 갖지 않는 경우) 업다운 카운터(102)의 카운트값이 감소하게 된다.
톱니파 생성기(103)는 스위칭 소자(11)의 스위칭 주기에 기반하여 업다운 카운터(102)의 카운트값에 대응되는 아날로그 값과 비교 가능한 적절한 진폭을 갖는 톱니파를 생성할 수 있다.
제2 비교기(104)는, 반전 입력단으로 업다운 카운터(102)의 카운트값에 대응되는 아날로그값을 입력 받고, 비반전 입력단으로 톱니파 생성기(103)에서 생성된 톱니파를 입력 받을 수 있다.
제2 비교기(104)의 반전 입력단으로 업다운 카운터(102)의 카운트값에 대응되는 아날로그값을 입력할 수 있도록, 컨트롤러(100)는 업다운 카운터(102)의 카운트값을 아날로그값으로 변환하는 디지털-아날로그 변환기(111)를 더 포함할 수 있다.
제2 비교기(104)는 톱니파의 크기가 업다운 카운터(102)의 카운트값에 대응되는 아날로그값 보다 큰 경우 하이 레벨의 디지털 신호를 출력할 수 있다.
SR 래치(112)는 동기 정류 FET(12)의 온/오프 상태를 제어하는 신호를 출력할 수 있다.
SR 래치(112)의 세트 입력단에는 스위칭 소자(11)의 온/오프를 제어하기 위한 신호(GH1)에 연동된 디지털 신호가 입력되고, 리셋 입력단에는 제2 비교기(104)에서 출력된 디지털 신호가 입력될 수 있다. 더욱 상세하게는, 스위칭 소자(11)의 온/오프를 제어하기 위한 신호(GH1)가 오프된 이후 사전 설정된 임의의 데드 타임(약 100 내지 200 ns)이 경과한 시점에 상승 에지를 갖는 짧은 펄스 신호가 SR 래치(112)의 세트 입력단에 입력될 수 있다. 즉, 도시하지는 않았지만, 스위칭 소자(11)의 온/오프를 제어하기 위한 신호(GH1)를 반전 시킨 신호의 상승 에지에 기반하여 짧은 펄스 신호를 생성하는 펄스 생성기의 출력 신호가 SR 래치(112)의 세트 신호로 입력될 수 있다.
SR 래치(112)는 스위칭 소자(11)이 오프되는 시점인 신호(GH1)가 로우 레벨로 전환되는 시점에 세트가 되는 클럭이 입력되어 하이 레벨 신호를 출력하고, SR 래치(112)에서 출력된 하이 레벨 신호가 동기 정류 FET(12)의 게이트로 인가되어 동기 정류 FET(12)가 온 될 수 있다.
또한, 제2 비교기(104)에서 출력된 디지털 신호가 하이 레벨인 경우, SR 래치(112)의 리셋 입력단에 하이 레벨 신호가 입력되어 SR 래치(112)가 리셋 되어 로우 레벨의 디지털 신호를 출력하게 된다. SR 래치(112)에서 출력된 로우 레벨 신호가 동기 정류 FET(12)의 게이트로 인가되어 동기 정류 FET(12)가 오프 될 수 있다.
한편, 본 발명의 일 실시예에서, 컨트롤러(100)는 스위칭 소자(11)의 오프 시점과 동기 정류 FET(12)의 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점까지를 제1 비교기(101)의 비교 결과를 유효하게 적용하는 구간으로 설정하는 검출 윈도(108)을 더 포함할 수 있다. 즉, 검출 윈도(108)는 스위칭 소자(11)의 오프 시점과 동기 정류 FET(12)의 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점까지 하이 레벨의 디지털 신호를 출력하도록 구현될 수 있다.
검출 윈도(108)의 출력과 제1 비교기(101)의 비교기의 비교결과는 AND 게이트 논리 소자(109)의 입력으로 제공됨으로써 검출 윈도(108)가 유효한 구간에서 하이 레벨을 출력하는 경우에 한해 제1 비교기(101)의 비교기의 하이 레벨 출력이 유효하게 업다운 카운터(102)로 출력될 수 있다.
이러한 검출 윈도(108)는 컨버터를 불연속 모드로 구동 시킬 때 인덕터(13)에 전류가 흐르지 않는 구간에서 링잉(ringing)에 의해 동기 정류 FET(12)의 드레인-소스 전압이 오검출되는 것을 방지하기 위해 적용될 수 있다.
또한, 본 발명의 일 실시예에서, 컨트롤러(100)는 동기 정류 FET(12)가 온 되는 시점에 출력되는 상기 제1 비교기의 비교 결과를 배제하는 리딩 에지 블랭킹 회로(110)를 더 포함할 수 있다.
전술한 것과 같이, 동기 정류 FET(12)는 스위칭 소자(11)가 오프된 후 사전 설정된 데드 타임이 경과한 후 온될 수 있다. 이러한 데드 타임으로 인해 동기 정류 FET(12)가 온 되는 시점에 동기 정류 FET(12)의 드레인-소스 전압(VDS)은 매우 짧은 시간 동안 음의 전압을 나타낼 수 있는데, 동기 정류 FET(12)가 온 되는 시점에 검출된 음의 전압을 제1 비교기(101)가 비교한 결과를 배제하기 위해 리딩 에지 블랭킹 회로(110)가 적용될 수 있다.
이상에서 설명한 것과 같은, 컨트롤러(100)의 벅 컨버터의 제어에 사용된 각종 파형이 도 2에 도시된다.
도 2를 참조하면, 동기 정류 FET(12)의 드레인-소스 전압(VDS)이 사전 설정된 기준 전압(Vref) 보다 커지는 경우가 발생하면, 다음 사이클에서 업다운 카운터의 카운터 값이 증가하게 되고, 업다운 카운터의 카운트값과 톱니파를 비교한 결과 톱니파가 카운트값 보다 커지는 시점에 동기 정류 FET(12)가 오프 되는 것을 확인할 수 있다.
또한, 동기 정류 FET(12)의 드레인-소스 전압(VDS)이 사전 설정된 기준 전압(Vref) 보다 커지는 경우가 발생하지 않으면, 다음 사이클에서 업다운 카운터의 카운터 값이 감소함을 확인할 수 있다.
또한, 검출 윈도(108)는 인덕터 전류가 흐르는 시점, 즉 스위칭 소자(11)의 오프 시점과 동기 정류 FET(12)의 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점에서 하이 레벨을 출력하여 링잉이 발생하는 구간에서 검출된 신호를 배제할 수 있음을 확인할 수 있다.
더하여, 도 3의 시뮬레이션 결과에서 확인할 수 있듯이, 정상 상태의 동작 구간에서 업다운 카운터(102)는 카운터값의 증가, 감소를 반복하여 출력함으로써 최적의 동기 정류 동작을 안정적으로 수행할 수 있게 동기 정류 FET(12)의 온/오프 시키고 있음을 확인할 수 있다.
부스트 컨버터
도 4에 도시된 것과 같이, 본 발명의 일 실시예에 따른 동기 정류식 부스트 컨버터는 입력단(Tin)에 일단이 연결된 인덕터(23)와 인덕터(23)의 타단과 접지에 양단이 연결된 스위칭 소자(21)와, 출력단(Tout)과 인덕터(23)의 타단에 각각 드레인 및 소스가 연결되며 바디 다이오드(221)을 포함하는 동기 정류 FET(22)와, 동기 정류 FET(22)의 드레인-소스 전압(VDS)과 사전 설정된 기준 전압을 비교한 결과에 기반하여 동기 정류 FET(22)가 온 상태를 유지하는 시간, 즉 온-듀티비를 결정하는 컨트롤러(200)를 포함하여 구성될 수 있다.
부스트 컨버터의 동기 정류 FET(22)의 제어 방식은 전술한 벅 컨버터의 동기 정류 FET(12)와 실질적으로 동일하다. 다만, 벅 컨버터의 경우 동기 정류 FET(12)의 소스가 접지에 연결되어 있으므로 동기 정류 FET(12)의 드레인의 전압만 검출함으로써 동기 정류 FET(12)의 드레인-소스 전압(VDS)의 검출이 가능하였고 검출된 동기 정류 FET(12)의 드레인-소스 전압(VDS)을 직접 기준 전압과 비교가 가능하였다. 그러나, 부스트 컨버터의 경우 동기 정류 FET(22)의 드레인은 출력단에 연결되고 소스는 인덕터(23)와 스위칭 소자(21)의 연결 노드에 연결되므로, 동기 정류 FET(22)의 드레인 전압과 소스 전압을 각각 검출할 필요가 있다.
따라서, 부스트 컨버터의 경우, 컨트롤러(200)는 동기 정류 FET(22)의 드레인 전압과 소스 전압을 각각 검출한 값을 입력 받고 드레인 전압에 기준 전압(Vref)를 더한 값과 소스 전압을 제1 비교기(201)의 반전 입력단과 비반전 입력단에 각각 입력하여 제1 비교기(201)에 의한 비교가 이루어지게 할 수 있다.
동기 정류 FET(12)의 바디 다이오드(221)의 순방향 전압 강하로 동기 정류 FET(12)에 음의 전압이 인가되는 경우에 드레인 전압에 기준 전압(Vref)를 더한 값이 동기 정류 FET(12)의 소스 전압(VS) 보다 작아지게 된다. 따라서, 드레인 전압(VD)에 기준 전압(Vref)를 더한 값과 소스 전압(VS)이 제1 비교기(201)의 반전 입력단과 비반전 입력단에 입력되는 경우, 제1 비교기(201)는 전술한 벅 컨버터의 제1 비교기(101)과 같이 동기 정류 FET(12)의 바디 다이오드(221)의 순방향 전압 강하로 동기 정류 FET(12)에 음의 전압이 인가되는 경우 하이 레벨의 디지털 값을 출력할 수 있고 그 반대의 경우 로우 레벨의 디지털 값을 출력할 수 있다.
부스트 컨버터의 컨트롤러(200)를 구성하는 업다운 카운터(202), 톱니파 생성기(203), 제2 비교기(204), 카운터(205), SR 래치(206, 212), 반전기(207), 검출 윈도(208), AND 게이트 논리 소자(209), 리딩 에지 블랭킹 회로(210), 디지털-아날로그 변환기(211)는, 전술한 벅 컨버터의 컨트롤러(100)의 대응되는 구성과 실질적으로 동일한 특징을 가지므로, 그에 대한 중복 설명은 생략하기로 한다.
컨트롤러(200)의 부스트 컨버터의 제어에 사용된 각종 파형이 도 5에 도시된다.
도 5를 참조하면, 동기 정류 FET(22)의 소스 전압(VS)이 드레인 전압(VD)과 기준 전압(Vref)를 합산한 전압값 보다 커지는 경우가 발생하면, 다음 사이클에서 업다운 카운터의 카운터 값이 증가하게 되고, 업다운 카운터의 카운트값과 톱니파를 비교한 결과 톱니파가 카운트값 보다 커지는 시점에 동기 정류 FET(12)가 오프 되는 것을 확인할 수 있다.
또한, 동기 정류 FET(22)의 소스 전압(VS)이 드레인 전압(VD)과 기준 전압(Vref)를 합산한 전압값 보다 커지는 경우가 발생하지 않으면, 다음 사이클에서 업다운 카운터의 카운터값이 감소하게 됨을 확인할 수 있다.
또한, 검출 윈도(208)는 인덕터 전류가 흐르는 시점, 즉 스위칭 소자(21)의 오프 시점과 동기 정류 FET(22)의 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점에서 하이 레벨을 출력하여 링잉이 발생하는 구간에서 검출된 신호를 배제할 수 있음을 확인할 수 있다.
더하여, 도 6의 시뮬레이션 결과에서 확인할 수 있듯이, 정상 상태의 동작 구간에서 업다운 카운터(202)는 카운터값의 증가, 감소를 반복하여 출력함으로써 최적의 동기 정류 동작을 안정적으로 수행할 수 있게 동기 정류 FET(12)의 온/오프 시키고 있음을 확인할 수 있다.
이상에서 설명한 바와 같이, 본 발명의 여러 실시형태에 따른 동기 정류식 직류-직류 컨버터는, 인덕터의 전류를 직접 검출하는 것이 아니라 동기 정류 FET의 드레인-소스 전압을 검출하여 동기 정류 FET의 온 상태 유지 시간을 제어하므로, 인덕터 전류를 검출하는 종래 기술에 비해 노이즈, 회로 패턴 등의 영향과 같은 외란에 강건하면서도 상대적으로 간단하게 동기 정류 FET의 온 상태 유지 시간을 제어할 수 있다.
이상에서 본 발명의 특정한 실시형태에 관련하여 도시하고 설명하였지만, 이하의 특허청구범위에 의해 제공되는 본 발명의 기술적 사상을 벗어나지 않는 한도 내에서, 본 발명이 다양하게 개량 및 변화될 수 있다는 것은 당 기술분야에서 통상의 지식을 가진 자에게 있어서 자명할 것이다.
11, 21: 스위칭 소자 12, 22: 동기 정류 FET
13, 23: 인덕터 100, 200: 컨트롤러
101, 201: 제1 비교기 102, 202: 업다운 카운터
103, 203: 톱니파 생성기 104, 204: 제2 비교기
105, 205: 카운터 106, 112, 206, 212: SR 래치
107, 207: 반전기 108, 208: 검출 윈도
109, 209: AND 게이트 논리 소자
110, 210: 리딩 에지 블랭킹 회로
111, 211: 디지털-아날로그 변환기

Claims (15)

  1. 인덕터;
    상기 인덕터에 연결되어 상기 인덕터를 통해 흐르는 전류 경로를 결정하도록 사전 설정된 듀티비로 온/오프 되는 스위칭 소자;
    상기 스위칭 소자의 오프 상태에서 온 되며 온-듀티비가 제어되는 동기 정류 FET; 및
    상기 동기 정류 FET의 드레인-소스 전압을 사전 설정된 기준 전압과 비교하고, 상기 드레인-소스 전압과 사전 설정된 기준 전압을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하여 상기 동기 정류 FET의 온/오프 상태를 제어하는 컨트롤러;
    를 포함하는 동기 정류식 직류-직류 컨버터.
  2. 청구항 1에 있어서,
    상기 기준 전압은 상기 동기 정류 FET 내 바디 다이오드의 순방향 전압 강하에 상응하는 크기를 갖는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  3. 청구항 1에 있어서, 상기 컨트롤러는,
    일 사이클에서 상기 드레인-소스 전압이 상기 기준 전압보다 작은 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 드레인-소스 전압이 상기 기준 전압보다 작은 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시키는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  4. 청구항 1에 있어서, 상기 컨트롤러는,
    일 사이클에서 상기 동기 정류 FET의 소스 전압이 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 동기 정류 FET의 소스 전압이 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시키는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  5. 청구항 1에 있어서, 상기 컨트롤러는,
    상기 드레인-소스 전압과 상기 기준 전압을 비교하는 제1 비교기;
    상기 드레인-소스 전압이 상기 기준 전압 보다 작은 경우 업카운트를 수행하고, 상기 드레인-소스 전압이 상기 기준 전압 보다 큰 경우 다운카운트를 수행하는 업다운 카운터;
    사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및
    상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기;
    를 포함하는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  6. 청구항 5에 있어서,
    상기 제1 비교기의 반전 입력단에는 상기 드레인-소스 전압이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 기준 전압이 입력되는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  7. 청구항 5에 있어서,
    상기 제1 비교기의 반전 입력단에는 상기 동기 정류 FET의 드레인 전압에 상기 기준 전압을 합산한 전압값이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 동기 정류 FET의 소스 전압이 입력되는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  8. 청구항 5에 있어서,
    상기 스위칭 소자의 오프 시점과 상기 드레인-소스 전압이 음(-)의 값에서 양(+)의 값으로 전환되는 시점까지를 상기 제1 비교기의 비교 결과를 유효하게 적용하는 구간으로 설정하는 검출 윈도를 더 포함하는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  9. 청구항 5에 있어서,
    상기 동기 정류 FET가 오프 되는 시점에 출력되는 상기 제1 비교기의 비교 결과를 배제하는 리딩 에지 블랭킹 회로를 더 포함하는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  10. 입력단에 일단이 연결된 스위칭 소자;
    상기 스위칭 소자의 타단과 접지에 각각 드레인 및 소스가 연결되며 바디 다이오드를 포함하는 동기 정류 FET;
    상기 스위칭 소자의 타단과 출력단에 각각 양단이 연결된 인덕터; 및
    상기 동기 정류 FET의 드레인 전압과 사전 설정된 기준 전압을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하는 컨트롤러;
    를 포함하는 동기 정류식 직류-직류 컨버터.
  11. 청구항 10에 있어서, 상기 컨트롤러는,
    일 사이클에서 상기 드레인 전압이 상기 기준 전압보다 작은 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 드레인 전압이 상기 기준 전압보다 작은 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시키는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  12. 청구항 10에 있어서, 상기 컨트롤러는,
    상기 드레인 전압과 상기 기준 전압을 비교하는 제1 비교기;
    상기 드레인 전압이 상기 기준 전압 보다 작은 경우 업카운트를 수행하고, 상기 드레인 전압이 상기 기준 전압 보다 큰 경우 다운카운트를 수행하는 업다운 카운터;
    사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및
    상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기를 포함하며,
    상기 제1 비교기의 반전 입력단에는 상기 드레인 전압이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 기준 전압이 입력되는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  13. 입력단에 일단이 연결된 인덕터;
    상기 인덕터의 타단과 접지에 양단이 연결된 스위칭 소자;
    출력단과 상기 인덕터의 타단에 각각 드레인 및 소스가 연결되며 바디 다이오드를 포함하는 동기 정류 FET; 및
    상기 동기 정류 FET의 소스 전압과 상기 동기 정류 FET의 드레인 전압에 사전 설정된 기준 전압을 합산한 전압값을 비교한 결과에 기반하여 상기 동기 정류 FET의 온-듀티비를 결정하는 컨트롤러;
    를 포함하는 정류식 직류-직류 컨버터.
  14. 청구항 13에 있어서, 상기 컨트롤러는,
    일 사이클에서 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 증가시키고, 일 사이클에서 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값보다 큰 경우가 발생하지 않으면 다음 사이클에서 상기 동기 정류 FET의 온-듀티비를 감소시키는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
  15. 청구항 13에 있어서, 상기 컨트롤러는,
    상기 소스 전압과 상기 드레인 전압에 상기 기준 전압을 합산한 전압값을 비교하는 제1 비교기;
    상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 큰 경우 업카운트를 수행하고, 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값 보다 작은 경우 다운카운트를 수행하는 업다운 카운터;
    사전 설정된 주기로 사전 설정된 진폭을 갖는 톱니파를 생성하는 톱니파 생성기; 및
    상기 업다운 카운터의 카운트값에 대응되는 아날로그 값과 상기 톱니파를 비교하여 상기 톱니파가 상기 아날로그 값 보다 커지는 시점에 상기 동기 정류 FET를 오프 시키는 제어신호를 출력하는 제2 비교기를 포함하며,
    상기 제1 비교기의 반전 입력단에는 상기 소스 전압이 상기 드레인 전압에 상기 기준 전압을 합산한 전압값이 입력되고, 상기 제1 비교기의 비반전 입력단에는 상기 소스 전압이 입력되는 것을 특징으로 하는 동기 정류식 직류-직류 컨버터.
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* Cited by examiner, † Cited by third party
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KR20080102541A (ko) 2007-05-21 2008-11-26 페어차일드코리아반도체 주식회사 스위치 제어 장치, 스위치 제어 방법 및 이를 이용하는컨버터
KR20130008535A (ko) 2010-02-18 2013-01-22 자틴 바산트 타카르 니코틴을 함유하는 소프트 젤라틴 알약

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