KR20240046858A - Display apparatus - Google Patents
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Abstract
본 발명은 사용자의 편의성을 향상시킬 수 있는 디스플레이 장치 및 그 제조방법을 위하여, 기판 상에 배치되며, 상호 이격되어 배치된 제1 화소 및 제2 화소 및 상기 제1 화소 및 상기 제2 화소 사이에 위치한 제1 관통홀을 구비하고, 상기 제1 화소는 제1 방향을 따라 연장되고, 상기 제2 화소는 상기 제1 방향과 교차하는 제2 방향을 따라 연장되는 디스플레이 장치 및 제조방법을 제공한다.The present invention provides a display device that can improve user convenience and a manufacturing method thereof, which is disposed on a substrate and includes first and second pixels spaced apart from each other and between the first pixel and the second pixel. A display device and manufacturing method are provided, including a first through-hole, wherein the first pixel extends along a first direction, and the second pixel extends along a second direction intersecting the first direction.
Description
본 발명은 디스플레이 장치에 관한 것으로서, 더 상세하게는 사용자의 편의성을 향상시킬 수 있는 디스플레이 장치에 관한 것이다.The present invention relates to a display device, and more specifically, to a display device that can improve user convenience.
근래에 디스플레이 장치는 그 용도가 다양해지고 있다. 특히, 디스플레이 장치의 두께가 얇아지고 무게가 가벼워 그 사용의 범위가 광범위해지고 있는 추세이다.Recently, the uses of display devices have become more diverse. In particular, the thickness of display devices is becoming thinner and lighter, and the scope of their use is expanding.
한편 근래에 디스플레이 장치는 휴대가 가능한 박형의 평판 형태의 디스플레이 장치로 대체되는 추세이다.Meanwhile, in recent years, display devices are being replaced by portable, thin, flat display devices.
그러나 이러한 종래의 평판 형태의 디스플레이 장치는 소정의 두께 및 제조 공정의 어려움으로 인하여 내구성을 향상하기 용이하지 않다. 특히, 최근 디스플레이 장치를 휴대 시 사용자의 의도에 따라 또는 제조 시에 변형, 예를 들면 휘거나 접는 등의 유연성을 요구하고 있는데, 이러한 유연성을 확보하면서 내구성을 유지하도록 디스플레이 장치를 제조하기 용이하지 않다.However, it is not easy to improve the durability of such conventional flat display devices due to the predetermined thickness and difficulties in the manufacturing process. In particular, recently, display devices have been required to be flexible, such as bending or folding, depending on the user's intention when carrying them or during manufacturing. However, it is not easy to manufacture display devices to ensure such flexibility while maintaining durability. .
이를 통하여 사용자의 편의성을 향상하는데 한계가 있다.There is a limit to improving user convenience through this.
본 발명은 상기와 같은 문제점을 포함하여 여러 문제점들을 해결하기 위한 것으로서, 사용자의 편의성을 향상시킬 수 있는 디스플레이 장치 및 그 제조방법을 제공하는 것을 목적으로 한다. 그러나 이러한 과제는 예시적인 것으로, 이에 의해 본 발명의 범위가 한정되는 것은 아니다.The present invention is intended to solve various problems including the problems described above, and its purpose is to provide a display device that can improve user convenience and a method of manufacturing the same. However, these tasks are illustrative and do not limit the scope of the present invention.
본 발명의 일 관점에 따르면, 기판; 상기 기판 상에 배치되며, 상호 이격되어 배치된 제1 화소 및 제2 화소; 및 상기 제1 화소 및 상기 제2 화소 사이에 위치한 제1 관통홀;을 구비하고, 상기 제1 화소는 제1 방향을 따라 연장되고, 상기 제2 화소는 상기 제1 방향과 교차하는 제2 방향을 따라 연장되는, 디스플레이 장치가 제공된다.According to one aspect of the present invention, a substrate; first and second pixels disposed on the substrate and spaced apart from each other; and a first through hole located between the first pixel and the second pixel, wherein the first pixel extends along a first direction, and the second pixel extends in a second direction intersecting the first direction. A display device extending along is provided.
전술한 것 외의 다른 측면, 특징, 이점이 이하의 도면, 특허청구범위 및 발명의 상세한 설명으로부터 명확해질 것이다. Other aspects, features and advantages in addition to those described above will become apparent from the following drawings, claims and detailed description of the invention.
이러한 일반적이고 구체적인 측면이 시스템, 방법, 컴퓨터 프로그램, 또는 어떠한 시스템, 방법, 컴퓨터 프로그램의 조합을 사용하여 실시될 수 있다.These general and specific aspects may be practiced using any system, method, computer program, or combination of any system, method, or computer program.
상기한 바와 같이 이루어진 본 발명의 일 실시예에 따르면, 사용자의 편의성을 향상시킬 수 있는 디스플레이 장치를 구현할 수 있다. 물론 이러한 효과에 의해 본 발명의 범위가 한정되는 것은 아니다.According to an embodiment of the present invention as described above, a display device that can improve user convenience can be implemented. Of course, the scope of the present invention is not limited by this effect.
도 1은 본 발명의 일 실시예에 관한 디스플레이 장치를 개략적으로 도시하는 평면도이다.
도 2는 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이다.
도 3은 도 2의 Ⅲ-Ⅲ선을 따라 취한 단면도이다.
도 4a 내지 도 4c는 도 2의 Ⅵ-Ⅵ선을 따라 취한 단면도들이다.
도 5는 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이다.
도 6은 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이다.
도 7은 도 6의 K부분을 확대하여 개략적으로 도시하는 평면도이다.
도 8 내지 도 12은 본 발명의 일 실시예에 관한 디스플레이 장치를 제조하는 제조공정을 개략적으로 도시하는 단면도들이다.1 is a plan view schematically showing a display device according to an embodiment of the present invention.
Figure 2 is an enlarged plan view schematically showing part A of Figure 1.
Figure 3 is a cross-sectional view taken along line III-III in Figure 2.
FIGS. 4A to 4C are cross-sectional views taken along line VI-VI in FIG. 2.
Figure 5 is an enlarged plan view schematically showing part A of Figure 1.
Figure 6 is a plan view schematically showing an enlarged portion of part A of Figure 1.
Figure 7 is an enlarged plan view schematically showing part K of Figure 6.
8 to 12 are cross-sectional views schematically showing a manufacturing process for manufacturing a display device according to an embodiment of the present invention.
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다. Since the present invention can be modified in various ways and can have various embodiments, specific embodiments will be illustrated in the drawings and described in detail in the detailed description. The effects and features of the present invention and methods for achieving them will become clear by referring to the embodiments described in detail below along with the drawings. However, the present invention is not limited to the embodiments disclosed below and may be implemented in various forms.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings. When describing with reference to the drawings, identical or corresponding components will be assigned the same reference numerals and redundant description thereof will be omitted. .
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다. Since the present invention can be modified in various ways and can have various embodiments, specific embodiments will be illustrated in the drawings and described in detail in the detailed description. The effects and features of the present invention and methods for achieving them will become clear by referring to the embodiments described in detail below along with the drawings. However, the present invention is not limited to the embodiments disclosed below and may be implemented in various forms.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings. When describing with reference to the drawings, identical or corresponding components will be assigned the same reference numerals and redundant description thereof will be omitted. .
이하의 실시예에서, 제1, 제2 등의 용어는 한정적인 의미가 아니라 하나의 구성 요소를 다른 구성 요소와 구별하는 목적으로 사용되었다. 또한, 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.In the following embodiments, terms such as first and second are used not in a limiting sense but for the purpose of distinguishing one component from another component. Additionally, singular expressions include plural expressions unless the context clearly dictates otherwise.
한편, 포함하다 또는 가지다 등의 용어는 명세서상에 기재된 특징, 또는 구성요소가 존재함을 의미하는 것이고, 하나 이상의 다른 특징들 또는 구성요소가 부가될 가능성을 미리 배제하는 것은 아니다. 또한, 막, 영역, 구성 요소 등의 부분이 다른 부분 "위에" 또는 "상에" 있다고 할 때, 다른 부분의 "바로 위에" 또는 "바로 상에" 있는 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 있는 경우도 포함한다. Meanwhile, terms such as include or have mean that the features or components described in the specification exist, and do not preclude the possibility of adding one or more other features or components. In addition, when a part of a membrane, region, component, etc. is said to be “on” or “on” another part, it does not only mean that it is “directly on” or “directly on” the other part, but also when it is said to be “directly on” or “immediately on” the other part, as well as other membranes in between. This also includes cases where areas, components, etc. are involved.
도면에서는 설명의 편의를 위하여 구성 요소들이 그 크기가 과장 또는 축소될 수 있다. 예컨대, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다.In the drawings, the sizes of components may be exaggerated or reduced for convenience of explanation. For example, the size and thickness of each component shown in the drawings are shown arbitrarily for convenience of explanation, so the present invention is not necessarily limited to what is shown.
x축, y축 및 z축은 직교 좌표계 상의 세 축으로 한정되지 않고, 이를 포함하는 넓은 의미로 해석될 수 있다. 예를 들어, x축, y축 및 z축은 서로 직교할 수도 있지만, 서로 직교하지 않는 서로 다른 방향을 지칭할 수도 있다.The x-axis, y-axis, and z-axis are not limited to the three axes in the Cartesian coordinate system and can be interpreted in a broad sense including these. For example, the x-axis, y-axis, and z-axis may be orthogonal to each other, but may also refer to different directions that are not orthogonal to each other.
어떤 실시예가 달리 구현 가능한 경우에 특정한 공정 순서는 설명되는 순서와 다르게 수행될 수도 있다. 예를 들어, 연속하여 설명되는 두 공정이 실질적으로 동시에 수행될 수도 있고, 설명되는 순서와 반대의 순서로 진행될 수 있다.In cases where an embodiment can be implemented differently, a specific process sequence may be performed differently from the described sequence. For example, two processes described in succession may be performed substantially at the same time, or may be performed in an order opposite to that in which they are described.
도 1은 본 발명의 일 실시예에 관한 디스플레이 장치를 개략적으로 도시하는 평면도이고, 도 2는 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이다.FIG. 1 is a plan view schematically showing a display device according to an embodiment of the present invention, and FIG. 2 is an enlarged plan view schematically showing part A of FIG. 1 .
도 1 및 도 2를 참조하면, 디스플레이 장치(1)는 기판(100)을 포함한다. 기판(100)상에는 표시 영역(DA) 및 비표시 영역(NDA)이 정의된다. 표시 영역(DA)에는 하나 이상의 화소(PU) 및 관통부(400)가 형성된다.1 and 2, the
기판(100)은 다양한 소재를 포함할 수 있다. 구체적으로 기판(100)은 유리, 금속 또는 유기물 기타 재질로 형성할 수 있다. 예를 들어, 기판(100)은 플렉서블 소재로 형성할 수 있다. 즉 기판(100)은 휘어지고 구부러지며 접거나 돌돌 말 수 있는 재질로 형성될 수 있다. 기판(100)을 형성하는 플렉서블 소재는 초박형 유리, 금속 또는 플라스틱일 수 있다. 기판(100)이 플라스틱을 포함하는 경우 플렉서블 기판(100)은 내열성 및 내구성이 우수하며, 곡면 구현이 가능한 특성을 가진 PET(Polyethylen terephthalate), PEN(Polyethylen naphthalate), 폴리이미드(Polyimide) 등과 같은 플라스틱재로 형성될 수 있다.The
이러한 기판(100)은 표시 영역(DA) 및 비표시 영역(NDA)으로 구획될 수 있다. 표시 영역(DA)은 복수개의 화소(PU)들이 배치되는 영역으로 화상이 표시될 수 있다. 표시 영역(DA)은 복수개의 화소(PU)들이 위치하는 화소영역과 화소영역 사이의 이격영역을 구비할 수 있다. 화소(PU)는 가시 광선을 구현할 수 있도록 표시 소자(미도시)를 구비할 수 있다.This
비표시 영역(NDA)은 표시 영역(DA)과 인접하도록 형성될 수 있다. 도 1에는 비표시 영역(NDA)이 표시 영역(DA)을 둘러싸도록 도시되어 있다. 다른 실시예로서 비표시 영역(NDA)은 표시 영역(DA)의 일 측면에 인접하도록 형성될 수 있다. 또 다른 실시예로서 비표시 영역(NDA)은 표시 영역(DA)의 두 개의 측면 또는 세 개의 측면에 인접하도록 형성될 수 있다. 또한, 경우에 따라 기판(100)상에 표시 영역(DA)만이 존재할 수 있다. 즉, 도시하지 않았으나 기판(100)에 비표시 영역(NDA)이 없이 표시 영역(DA)만 있을 수도 있다.The non-display area NDA may be formed adjacent to the display area DA. In FIG. 1, the non-display area NDA is shown to surround the display area DA. As another example, the non-display area NDA may be formed adjacent to one side of the display area DA. As another embodiment, the non-display area NDA may be formed adjacent to two or three sides of the display area DA. Additionally, in some cases, only the display area DA may exist on the
표시 영역(DA)에는 하나 이상의 화소(PU) 및 관통부(400)가 배치될 수 있다. 이때 일 화소(PU) 및 이와 인접한 다른 일 화소(PU)의 사이에는 이격영역(BA)이 배치될 수 있다. 관통부(400)는 이격영역(BA)에 배치될 수 있다. 경우에 따라 관통부(400)는 화소(PU)와 이격되도록 배치할 수 있다.One or more pixels PU and a penetrating
화소(PU)는 표시 소자를 구비하는데, 이는 유기발광소자일 수도 있고 액정 소자일 수도 있다. 이에 관하여는 자세히 후술한다.The pixel PU includes a display element, which may be an organic light emitting element or a liquid crystal element. This will be described in detail later.
관통부(400)는 기판(100)에 형성된다. 즉, 관통부(400)는 기판(100)을 관통하는 내측면을 갖도록 형성된다. 일 예로서 관통부(400)는 기판(100)의 일 영역을 식각등의 방법으로 제거하여 형성된 것일 수 있고, 또 다른 예로서 기판(100)의 제조 시 관통부(400)를 구비하도록 형성된 것일 수 있다. 기판(100)에 관통부(400)가 형성되는 과정의 예는 다양할 수 있고, 그 제조 방법에 제한은 없다. 관통부(400)는 화소(PU)와 이와 인접한 화소(PU)의 사이의 이격영역(BA)에 길게 연장된 형상을 가질 수 있다.The penetrating
관통부(400)는 제1 관통부(410) 및 제2 관통부(420)를 포함한다. 이격영역(BA)은 제1 이격영역(BA1) 및 제2 이격영역(BA2)를 구비한다. 제1 관통부(410)는 제1 이격영역(BA1)에 배치되고, 제2 관통부(420)는 제2 이격영역(BA2)에 배치된다. 이하 관통부(400)에 대하여 구체적으로 설명하기로 한다.The penetrating
먼저, 이격영역(BA)은 제1 이격영역(BA1) 및 제2 이격영역(BA2)를 구비한다. 제1 이격영역(BA1)은 제1 방향, 예를 들면 도 2의 X축 방향으로 서로 인접한 두 개의 화소(PU)의 사이의 영역으로 이해될 수 있다. 제2 이격영역(BA2)은 제1 방향과 교차하는 제2 방향, 예를 들면 도 2의 Y축 방향으로 서로 인접한 두 개의 화소(PU)의 사이의 영역으로 이해될 수 있다. 경우에 따라 제1 방향과 제2 방향으로 서로 직교할 수 있다.First, the separation area BA includes a first separation area BA1 and a second separation area BA2. The first spaced area BA1 may be understood as an area between two pixels PU adjacent to each other in a first direction, for example, the X-axis direction of FIG. 2 . The second spaced area BA2 may be understood as an area between two pixels PU adjacent to each other in a second direction intersecting the first direction, for example, the Y-axis direction of FIG. 2 . In some cases, the first direction and the second direction may be perpendicular to each other.
관통부(400)의 제1 관통부(410)는 제1 이격영역(BA1)에 배치될 수 있다. 제1 관통부(410)는 제1 방향(X축 방향)과 교차하는 방향, 예를 들면 제2 방향(Y축 방향)을 따라 길게 연장된 형태를 가질 수 있다.The first
본 발명의 일 실시예로, 제1 관통부(410)는 제1 이격영역(BA1)을 지나치도록 형성될 수 있는데, 예를 들면 제1 이격영역(BA1)을 연장한 영역과 제2 이격영역(BA2)을 연장한 영역이 중첩된 영역에 대응되도록 형성될 수 있다.In one embodiment of the present invention, the first penetrating
또한 제1 관통부(410)는 제1 방향으로 인접한 두 개의 화소(PU)사이의 제1 이격영역(BA1)뿐만 아니라, 상기 제1 방향으로 인접한 두 개의 화소(PU)와 각각 제2 방향으로 인접한 두 개의 화소(PU)들 사이의 제1 이격영역(BA1)에 까지 대응되도록 길게 연장된 형태를 가질 수 있다.In addition, the first penetrating
이를 통해 제1 관통부(410)는 제1 방향으로 인접한 두 개의 화소(PU)의 각각의 일 측면에 대응되고, 상기 제1 방향으로 인접한 두 개의 화소(PU)와 각각 제2 방향으로 인접한 두 개의 화소(PU)의 각각의 일 측면에 대응될 수 있다. 예를 들면 한 개의 제1 관통부(410)를 중심으로 주변에 4개의 화소(PU)가 대응되도록 배치될 수 있다.Through this, the first through
구체적으로 도 2에 도시된 것과 같이, 제1 관통부(410)의 상부에 제1 관통부(410)를 사이에 두고 좌우 양쪽에 2개의 화소(PU) 및 제1 관통부(410)의 하부에 제1 관통부(410)를 사이에 두고 좌우 양쪽에 2개의 화소(PU)가 대응되도록 배치될 수 있다.Specifically, as shown in FIG. 2, there are two pixels (PU) on both left and right sides of the
관통부(400)의 제2 관통부(420)는 제2 이격영역(BA2)에 배치될 수 있다. 제2 관통부(420)는 제2 방향과 교차하는 방향, 예를 들면 제1 방향을 따라 길게 연장된 형태를 가질 수 있다.The second
본 발명의 일 실시예로, 제2 관통부(420)는 제2 이격영역(BA2)을 지나치도록 형성될 수 있는데, 예를들면 제2 이격영역(BA2)을 연장한 영역과 제1 이격영역(BA1)을 연장한 영역이 중첩된 영역에 대응되도록 형성될 수 있다.In one embodiment of the present invention, the second penetrating
또한 제2 관통부(420)는 제2 방향으로 인접한 두 개의 화소(PU)사이의 제2 이격영역(BA2)뿐만 아니라, 상기 제2 방향으로 인접한 두 개의 화소(PU)와 각각 제1 방향으로 인접한 두 개의 화소(PU)들 사이의 제2 이격영역(BA2)에까지 대응되도록 길게 연장된 형태를 가질 수 있다.In addition, the second penetrating
이를 통해 제2 관통부(420)는 제2 방향으로 인접한 두 개의 화소(PU)의 각각의 일측면에 대응되고, 상기 제2 방향으로 인접한 두 개의 화소(PU)와 각각 제1 방향으로 인접한 두 개의 화소(PU)의 각각의 일측면에 대응될 수 있다. 예를들면 한 개의 제2 관통부(420)를 중심으로 4개의 화소(PU)가 대응되도록 배치될 수 있다. Through this, the second through
구체적으로 도 2에 도시된 것과 같이, 제2 관통부(420)의 좌측에 제2 관통부(420)를 기준으로 상하 양쪽에 2개의 화소(PU) 및 제2 관통부(420)의 우측에 제2 관통부(420)를 기준으로 상하 양쪽에 2개의 화소(PU) 배치될 수 있다.Specifically, as shown in FIG. 2, there are two pixels (PU) on the left side of the second penetrating
한편, 제1 관통부(410) 및 제2 관통부(420)는 서로 이격될 수 있다. 도 2를 참조하면 본 실시예의 디스플레이 장치(1)는 기판(100)에 관통부(400)가 형성되고, 관통부(400)가 복수의 제1 관통부(410) 및 복수의 제2 관통부(420)를 구비할 수 있다.Meanwhile, the
또한 복수의 제1 관통부(410) 중 서로 인접한 2 개의 제1 관통부(410)의 사이에 제2 관통부(420)가 배치될 수 있다. 복수의 제2 관통부(420) 중 서로 인접한 2 개의 제2 관통부(420)의 사이에 제1 관통부(410)가 배치될 수 있다.Additionally, among the plurality of
도 3은 도 2의 Ⅲ-Ⅲ선을 따라 취한 단면도이다. 도 3에서는 본 발명의 일 실시예에 따른 디스플레이 장치의 표시 영역(DA)에 대해 자세히 설명한다. 상술한 것과 같이 본 발명의 표시 영역(DA)에 배치된 표시 소자들은 유기발광소자일 수도 있고, 액정 소자일 수도 있다. 본 실시예에서는 유기발광소자를 구비한 디스플레이 장치에 관하여 설명하기로 한다.Figure 3 is a cross-sectional view taken along line III-III in Figure 2. In Figure 3, the display area (DA) of the display device according to an embodiment of the present invention is described in detail. As described above, the display elements disposed in the display area DA of the present invention may be organic light emitting elements or liquid crystal elements. In this embodiment, a display device equipped with an organic light emitting element will be described.
도 3을 참조하면, 기판 상에 박막트랜지스터(TFT) 및 커패시터가 배치되고, 박막트랜지스터(TFT)와 전기적으로 연결되는 유기발광소자가 배치될 수 있다. 박막트랜지스터(TFT)는 비정질실리콘, 다결정실리콘 또는 유기반도체물질을 포함하는 반도체층(120), 게이트전극(140), 소스전극(160) 및 드레인전극(162)을 포함한다. 이하 박막트랜지스터(TFT)의 일반적인 구성을 자세히 설명한다.Referring to FIG. 3, a thin film transistor (TFT) and a capacitor may be disposed on a substrate, and an organic light emitting device electrically connected to the thin film transistor (TFT) may be disposed. A thin film transistor (TFT) includes a
먼저 기판(100) 상에는 기판(100)의 면을 평탄화하기 위해 또는 박막트랜지스터(TFT)의 반도체층(120)으로 불순물 등이 침투하는 것을 방지하기 위해, 실리콘옥사이드 또는 실리콘나이트라이드 등으로 형성된 버퍼층(110)이 배치되고, 이 버퍼층(110) 상에 반도체층(120)이 위치하도록 할 수 있다.First, on the
반도체층(120)의 상부에는 게이트전극(140)이 배치되는데, 이 게이트전극(140)에 인가되는 신호에 따라 소스전극(160) 및 드레인전극(162)이 전기적으로 소통된다. 게이트전극(140)은 인접층과의 밀착성, 적층되는 층의 표면 평탄성 그리고 가공성 등을 고려하여, 예컨대 알루미늄(Al), 백금(Pt), 팔라듐(Pd), 은(Ag), 마그네슘(Mg), 금(Au), 니켈(Ni), 네오디뮴(Nd), 이리듐(Ir), 크롬(Cr), 리튬(Li), 칼슘(Ca), 몰리브덴(Mo), 티타늄(Ti), 텅스텐(W), 구리(Cu) 중 하나 이상의 물질로 단층 또는 다층으로 형성될 수 있다.A
이때 반도체층(120)과 게이트전극(140)과의 절연성을 확보하기 위하여, 실리콘옥사이드 및/또는 실리콘나이트라이드 등으로 형성되는 게이트절연막(130)이 반도체층(120)과 게이트전극(140) 사이에 개재될 수 있다.At this time, in order to ensure insulation between the
게이트전극(140)의 상부에는 층간절연막(150)이 배치될 수 있는데, 이는 실리콘옥사이드 또는 실리콘나이트라이드 등의 물질로 단층으로 형성되거나 또는 다층으로 형성될 수 있다.An interlayer insulating
층간절연막(150)의 상부에는 소스전극(160) 및 드레인전극(162)이 배치된다. 소스전극(160) 및 드레인전극(162)은 층간절연막(150)과 게이트절연막(130)에 형성되는 컨택홀을 통하여 반도체층(120)에 각각 전기적으로 연결된다. 소스전극(160) 및 드레인전극(162)은 도전성 등을 고려하여 예컨대 알루미늄(Al), 백금(Pt), 팔라듐(Pd), 은(Ag), 마그네슘(Mg), 금(Au), 니켈(Ni), 네오디뮴(Nd), 이리듐(Ir), 크롬(Cr), 리튬(Li), 칼슘(Ca), 몰리브덴(Mo), 티타늄(Ti), 텅스텐(W), 구리(Cu) 중 하나 이상의 물질로 단층 또는 다층으로 형성될 수 있다.A
한편 도면에는 도시되지 않았으나, 이러한 구조의 박막트랜지스터(TFT)의 보호를 위해 박막트랜지스터(TFT)를 덮는 보호막(미도시)이 배치될 수 있다. 보호막은 예컨대 실리콘옥사이드, 실리콘나이트라이드 또는 실리콘옥시나이트라이드 등과 같은 무기물로 형성될 수 있다.Meanwhile, although not shown in the drawing, a protective film (not shown) covering the thin film transistor (TFT) may be disposed to protect the thin film transistor (TFT) of this structure. The protective film may be formed of an inorganic material such as silicon oxide, silicon nitride, or silicon oxynitride.
한편, 기판(100)의 상에 제1 절연층(170)이 배치될 수 있다. 이 경우 제1 절연층(170)은 평탄화막일 수도 있고 보호막일 수도 있다. 이러한 제1 절연층(170)은 박막트랜지스터(TFT) 상부에 유기발광소자가 배치되는 경우 박막트랜지스터(TFT) 의 상면을 대체로 평탄화하게 하고, 박막트랜지스터(TFT) 및 각종 소자들을 보호하는 역할을 한다. 이러한 제1 절연층(170) 은 예컨대 아크릴계 유기물 또는 BCB(Benzocyclobutene) 등으로 형성될 수 있다. 이때 도 10에 도시된 것과 같이, 버퍼층(110), 게이트절연막(130), 층간절연막(150) 및 제1 절연층(170)은 기판(100)의 전면(全面)에 형성될 수 있다.Meanwhile, the first insulating
한편, 박막트랜지스터(TFT) 상부에는 제2 절연층(180)이 배치될 수 있다. 이경우 제2 절연층(180)은 화소정의막일 수 있다. 제2 절연층(180)은 상술한 제1 절연층(170) 상에 위치할 수 있으며, 개구를 가질 수 있다. 이러한 제2 절연층(180)은 기판(100) 상에 화소영역을 정의하는 역할을 한다.Meanwhile, a second insulating
이러한 제2 절연층(180)은 예컨대 유기 절연막으로 구비될 수 있다. 그러한 유기 절연막으로는 폴리메틸메타크릴레이트(PMMA)와 같은 아크릴계 고분자, 폴리스티렌(PS), phenol그룹을 갖는 고분자 유도체, 이미드계 고분자, 아릴에테르계 고분자, 아마이드계 고분자, 불소계고분자, p-자일렌계 고분자, 비닐알콜계 고분자 및 이들의 혼합물 등을 포함할 수 있다.This second insulating
한편, 제2 절연층(180) 상에는 유기발광소자(200)가 배치될 수 있다. 유기발광소자(200)는 화소전극(210), 발광층(EML: Emission Layer)을 포함하는 중간층(220) 및 대향전극(230)을 포함할 수 있다.Meanwhile, an organic
화소전극(210)은 (반)투명 전극 또는 반사형 전극으로 형성될 수 있다. (반)투명 전극으로 형성될 때에는 예컨대 ITO, IZO, ZnO, In2O3, IGO 또는 AZO로 형성될 수 있다. 반사형 전극으로 형성될 때에는 Ag, Mg, Al, Pt, Pd, Au, Ni, Nd, Ir, Cr 및 이들의 화합물 등으로 형성된 반사막과, ITO, IZO, ZnO, In2O3, IGO 또는 AZO로 형성된 층을 가질 수 있다. 물론 본 발명이 이에 한정되는 것은 아니고 다양한 재질로 형성될 수 있으며, 그 구조 또한 단층 또는 다층이 될 수 있는 등 다양한 변형이 가능하다.The
제2 절연층(180)에 의해 정의된 화소영역에는 중간층(220)이 각각 배치될 수 있다. 이러한 중간층(220)은 전기적 신호에 의해 빛을 발광하는 발광층(EML: Emission Layer)을 포함하며, 발광층(EML)을 이외에도 발광층(EML)과 화소전극(210) 사이에 배치되는 홀 주입층(HIL: Hole Injection Layer), 홀 수송층(HTL: Hole Transport Layer) 및 발광층(EML)과 대향전극(230) 사이에 배치되는 전자 수송층(ETL: Electron Transport Layer), 전자 주입층(EIL: Electron Injection Layer) 등이 단일 혹은 복합의 구조로 적층되어 형성될 수 있다. 물론 중간층(220)은 반드시 이에 한정되는 것은 아니고, 다양한 구조를 가질 수도 있음은 물론이다.The
발광층(EML)을 포함하는 중간층(220)을 덮으며 화소전극(210)에 대향하는 대향전극(230)이 기판(100) 전면(全面)에 걸쳐서 배치될 수 있다. 대향전극(230)은 (반)투명 전극 또는 반사형 전극으로 형성될 수 있다. The
대향전극(230)이 (반)투명 전극으로 형성될 때에는 일함수가 작은 금속 즉, Li, Ca, LiF/Ca, LiF/Al, Al, Ag, Mg 및 이들의 화합물로 형성된 층과 ITO, IZO, ZnO 또는 In2O3 등의 (반)투명 도전층을 가질 수 있다. 대향전극(230)이 반사형 전극으로 형성될 때에는 Li, Ca, LiF/Ca, LiF/Al, Al, Ag, Mg 및 이들의 화합물로 형성된 층을 가질 수 있다. 물론 대향전극(230)의 구성 및 재료가 이에 한정되는 것은 아니며 다양한 변형이 가능함은 물론이다.When the
한편 도 3을 참조하면, 유기발광소자(200)을 덮도록 기판(100) 상에 봉지층(300)이 배치될 수 있다. 도 3에는 도시되지 않았으나, 봉지층(300)은 하나 이상의 무기막(미도시)과 유기막(미도시)이 적층된 다층구조일 수 있다. 봉지층(300)을 다층구조로 형성하는 이유는, 봉지층(300)을 유기막 또는 무기막 만으로 형성할 경우 막 내부에 형성된 미세한 통로를 통해 외부로부터 산소나 수분 등이 침투하여 디스플레이부가 손상될 수 있기 때문이다. 이러한 봉지층(300)에 의해 화소부들이 외부와 차단되고 밀봉될 수 있다.Meanwhile, referring to FIG. 3, an
상기 유기막에 포함되는 유기물로는 예를 들어, 아크릴계 수지, 메타크릴계 수지, 폴리이소프렌, 비닐계 수지, 에폭시계 수지, 우레탄계 수지, 셀룰로오스계 수지 및 페릴렌계 수지로 이루어진 군으로부터 선택된 하나 이상의 물질을 포함할 수 있다.Organic materials included in the organic film include, for example, one or more materials selected from the group consisting of acrylic resin, methacrylic resin, polyisoprene, vinyl resin, epoxy resin, urethane resin, cellulose resin, and perylene resin. may include.
또한 무기막에 포함되는 무기물로는 예를 들어, 실리콘 질화물, 알루미늄 질화물, 지르코늄 질화물, 티타늄 질화물, 하프늄 질화물, 탄탈륨 질화물, 실리콘 산화물, 알루미늄 산화물, 티타늄 산화물, 주석 산화물, 세륨 산화물 및 실리콘 산화질화물(SiON)로 이루어진 군으로부터 선택된 하나 이상의 물질을 포함할 수 있다.Additionally, inorganic materials included in the inorganic film include, for example, silicon nitride, aluminum nitride, zirconium nitride, titanium nitride, hafnium nitride, tantalum nitride, silicon oxide, aluminum oxide, titanium oxide, tin oxide, cerium oxide, and silicon oxynitride ( It may contain one or more materials selected from the group consisting of (SiON).
도 4a 내지 도 4c는 도 2의 Ⅵ-Ⅵ선을 따라 취한 단면도들이다. 도 4a 내지 도 4c에서는 관통부(400)의 구조에 관한 실시예들을 설명한다.FIGS. 4A to 4C are cross-sectional views taken along line VI-VI in FIG. 2. 4A to 4C illustrate embodiments of the structure of the penetrating
도 4a 내지 도 4c를 참조하면, 이격영역(BA)에 관통부(400)가 배치될 수 있다. 도 4a내지 도 4c에서는 제1 이격영역(BA1)에 형성된 제1 관통부(410)의 단면을 도시하였으나, 제2 이격영역(BA2)에 형성된 제2 관통부(420) 역시 제1 관통부(410)와 동일한 구조를 가질 수 있다.Referring to FIGS. 4A to 4C , a penetrating
도 4a를 참조하면, 관통부(400)는 기판(100)을 관통하도록 형성되고, 기판(100)을 관통하는 내측의 내측면(400a)을 갖는다. 내측면(400a)은 기판(100)을 비롯하여 기판(100) 상에 배치된 하나 이상의 물질층들을 관통하며 형성된 단면을 의미한다. 일 실시예로 관통부(400)의 내측면(400a)은 기판(100)과 대략 수직으로 형성될 수 있다.Referring to FIG. 4A , the penetrating
한편, 유기발광소자 상에는 유기막과 무기막이 교번하여 적층되는 봉지층(300)이 배치될 수 있는데, 봉지층(300)은 관통부(400)의 내측면(400a)을 덮도록 배치될 수 있다. 봉지층(300)이 관통부(400)의 내측면(400a)까지 덮도록 배치되지 않으면, 관통부(400)의 내측면(400a)으로 인해 단면이 노출된 하나 이상의 물질층들로 습기나 불순물이 유입되어 각종 소자부들을 손상시킬 수 있다. 따라서 봉지층(300)이 관통부(400)의 내측면(400a)을 덮도록 밀봉되어야 본 발명의 일 실시예에 따른 디스플레이 장치의 신뢰성을 향상시킬 수 있다.Meanwhile, an
도 4b를 참조하면, 관통부(400)의 내측면(400a)은 경사를 갖도록 형성될 수 있다. 즉 관통부(400)의 내측면(400a)은 경사면일 수 있다. 관통부(400)의 내측면(400a)은 대향전극에서 기판(100) 측으로 갈수록 폭이 좁아지는 형상일 수 있다. 즉 관통부(400)의 내측면(400a)은 기판(100) 측이 개방된 V자 형상일 수 있다. 관통부(400)의 내측면(400a)의 경사는 기판(100)을 기준으로 예각을 이루며 형성될 수 있다.Referring to FIG. 4B, the
관통부(400)의 내측면(400a)이 경사를 갖는다는 것은, 기판(100) 상에 배치된 하나 이상의 물질층들을 관통하며 형성된 단면이 경사를 갖는다는 것을 의미한다. 이러한 인위적인 경사면을 형성하기 위해서는 물질층을 패터닝하는 과정에서 하프-톤 마스크나 슬릿 마스크 등을 이용할 수 있다. 다만 내측면(400a)에 경사면을 갖는 관통홀을 형성하기 위한 제조방법 특정한 방법에 제한되지 않는다. 이를 통해 봉지층(300)을 형성할 때, 봉지층(300)이 관통홀의 내측면(400a)을 덮기에 매우 용이할 수 있다.That the
도 4c를 참조하면, 관통부(400)는 기판(100)을 관통하도록 형성되고, 기판(100)을 관통하는 내측의 내측면(400a)을 갖는다. 내측면(400a)은 기판(100)을 비롯하여 기판(100) 상에 배치된 하나 이상의 물질층들(190)을 관통하며 형성된 단면을 의미한다. 하나 이상의 물질층들(190)은 예컨대, 기판(100) 상에 배치되는 버퍼층(110), 게이트절언막(130), 층간절연막(150), 제1 절연층(170) 및 제2 절연층(180) 일 수 있다. 따라서 관통부(400)의 내측면(400a)은 각각의 물질층들이 관통부(400)의 내측면(400a)에 대응하는 단부면들(110a, 130a, 150a, 170a, 180a)을 포함할 수 있다.Referring to FIG. 4C, the penetrating
한편 본 발명의 일 실시예로 관통부(400)의 내측면(400a)은 계단 형상으로 형성될 수 있다. 이는 상기 물질층들(190)의 단부면들(110a, 130a, 150a, 170a, 180a)이 각각 단차를 갖도록 형성되는 것을 의미한다. 관통부(400)의 내측면(400a)은 대향전극에서 기판(100) 측으로 갈수록 폭이 좁아지도록 형성될 수 있다. 즉 도 4c에서 일 단부면들(110a, 130a, 150a)이 관통부(400) 측으로 가장 돌출되도록 형성되고, 다른 단부면들(170a, 180a)이 단차를 갖도록 위에 적층될 수 있다. 물론 기판(100)(100)의 단부면(100a)는 일 단부면들(110a, 130a, 150a)과 동일한 면을 갖도록 형성되거나, 일 단부면들(110a, 130a, 150a) 보다 더 돌출되도록 형성될 수 있다.Meanwhile, in one embodiment of the present invention, the
도 4c에서는 버퍼층(110)의 단부면(110a), 게이트절연막(130)의 단부면(130a), 층간절연막(150)의 단부면(150a)가 동일한 면을 갖도록 형성되어 있다. 이는 제조 공정에서 반도체층(120)과 소스전극(160) 및 드레인전극(162)이 전기적으로 연결되도록 컨택홀을 형성하는 과정에, 버퍼층(110), 게이트절연막(130), 층간절연막(150)을 동시에 패터닝하기 때문인 것으로 이해될 수 있다. 다만 이에 한정되지 않고 경우에 따라서는 단부면들(110a, 130a, 150a)이 각각 단차를 갖도록 형성할 수도 있다. In FIG. 4C, the
한편 봉지층(300)이 유기발광소자를 밀봉하며 상기 단부면들(110a, 130a, 150a, 170a, 180a)을 덮도록 기판(100) 전면(全面)에 걸쳐 배치될 수 있다. 이러한 관통홀의 내측면 구조를 통해, 봉지층(300)을 형성할 때 봉지층(300)이 관통홀의 내측면(400a)을 덮기에 매우 용이할 수 있다. 따라서 봉지층(300)이 관통부(400)의 내측면(400a)을 덮도록 밀봉되어 디스플레이 장치의 신뢰성을 향상시킬 수 있다.Meanwhile, the
도 5은 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이다.Figure 5 is an enlarged plan view schematically showing part A of Figure 1.
도 5를 참조하면 디스플레이 장치(1)는 기판(100) 및 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)을 포함한다.Referring to FIG. 5, the
기판(100)상에는 표시 영역(DA) 및 비표시 영역(NDA)이 정의된다. 표시 영역(DA)에는 하나 이상의 화소(PU) 및 관통부(400)가 형성된다.A display area (DA) and a non-display area (NDA) are defined on the
기판(100)은 표시 영역(DA) 및 비표시 영역(NDA)으로 구획된다. 표시 영역(DA) 및 비표시 영역(NDA)의 위치 등에 대한 내용은 전술한 실시예와 동일하므로 구체적인 설명은 생략한다.The
표시 영역(DA)에는 하나 이상의 화소(PU) 및 관통부(400)가 형성된다. 화소(PU)는 가시 광선을 구현하는 하나 이상의 표시 소자(미도시)를 구비하는데, 이에 대하여는 전술한 실시예에서 설명한 바와 같고, 도 3에서 설명한 구조를 적용할 수도 있다.One or more pixels PU and a
관통부(400)는 기판(100)에 형성된다. 관통부(400) 및 이격 영역(BA)은 전술한 실시예에서 설명한 바와 같으므로 구체적인 설명은 생략한다.The penetrating
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 화소(PU)와 전기적으로 연결되는 배선으로서 관통부(400)와 중첩되지 않고 이격되도록 형성된다.One or more wires (SL1 to SL3, V1 to V3, and D1 to D3) are electrically connected to the pixel PU and are formed to be spaced apart from the through
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 하나 이상의 제1 배선(SL1 내지 SL3)을 포함할 수 있다.One or more wires (SL1 to SL3, V1 to V3, and D1 to D3) may include one or more first wires (SL1 to SL3).
하나 이상의 제1 배선(SL1 내지 SL3)은 화소(PU)에 전기적으로 연결된다. 선택적 실시예로서, 제1 배선(SL1)은 제1 방향(도 5의 X축 방향)으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다. 제1 배선(SL1)은 적어도 굴곡을 갖도록 형성된다. 즉 제1 배선(SL1)은 제1 방향으로 연장된 영역을 갖고, 제1 관통부(410)의 주변을 따라 제1 방향과 교차하는 제2 방향(도 9의 Y축 방향)으로 굴곡된 영역을 갖고, 제2 방향(도 9의 Y축 방향)으로 굴곡된 영역이란 제2 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제1 배선(SL1)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.One or more first wires SL1 to SL3 are electrically connected to the pixel PU. As an optional embodiment, the first wire SL1 may be electrically connected to each of a plurality of pixels PU in a row arranged in the first direction (X-axis direction in FIG. 5). The first wiring SL1 is formed to have at least a curve. That is, the first wiring SL1 has an area extending in the first direction and an area curved in a second direction (Y-axis direction in FIG. 9) that intersects the first direction along the periphery of the first through
선택적 실시예로서, 제1 배선(SL2)은 제1 배선(SL1)의 아래, 즉 제1 방향과 교차하는 제2 방향(도 9의 Y축 방향)으로 인접하도록 배치되고, 제1 방향(도 9의 X축 방향)으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다. As an optional embodiment, the first wiring SL2 is disposed adjacent to the first wiring SL1, that is, in a second direction (Y-axis direction in FIG. 9) that intersects the first direction, and is arranged in the first direction (FIG. It may be electrically connected to each of a plurality of pixels (PU) in a row arranged in the X-axis direction of 9.
제1 배선(SL2)은 적어도 굴곡을 갖도록 형성된다. 즉 제1 배선(SL2)은 제1 방향으로 연장된 영역을 갖고, 제1 관통부(410)의 주변을 따라 제2 방향으로 굴곡된 영역을 갖고, 제2 방향(도 9의 Y축 방향)으로 굴곡된 영역이란 제2 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제1 배선(SL2)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The first wiring SL2 is formed to have at least a curve. That is, the first wiring SL2 has an area extending in the first direction, has an area curved in the second direction along the periphery of the first through
선택적 실시예로서, 제1 배선(SL2)은 제1 배선(SL1)과 대칭된 형태를 가질 수 있고, 구체적으로 제1 배선(SL2)과 제1 배선(SL1)은 제2 관통부(420)를 기준으로 대칭된 형태를 가질 수 있다.As an optional embodiment, the first wiring SL2 may have a symmetrical shape with the first wiring SL1, and specifically, the first wiring SL2 and the first wiring SL1 are formed in the second through
제1 배선(SL3)은 제1 배선(SL1)과 동일한 형태를 갖는다. 제1 배선(SL3)은 제1 방향(도 9의 X축 방향)으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다. 제1 배선(SL3)은 적어도 굴곡을 갖도록 형성된다. 즉 제1 배선(SL3)은 제1 방향으로 연장된 영역을 갖고, 제1 관통부(410)의 주변을 따라 제1 방향과 교차하는 제2 방향(도 9의 Y축 방향)으로 굴곡된 영역을 갖고, 제2 방향(도 9의 Y축 방향)으로 굴곡된 영역이란 제2 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제1 배선(SL3)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The first wiring SL3 has the same shape as the first wiring SL1. The first wiring SL3 may be electrically connected to each of a plurality of pixels PU in a row arranged in the first direction (X-axis direction in FIG. 9). The first wiring SL3 is formed to have at least a curve. That is, the first wiring SL3 has an area extending in the first direction and an area curved in a second direction (Y-axis direction in FIG. 9) that intersects the first direction along the periphery of the first through
도시하지 않았으나, 제1 배선(SL3)의 아래에는 제1 배선(SL2)과 동일한 형태의 제1 배선(미도시)가 형성될 수 있다. 또한, 이러한 제1 배선(SL1, SL2, SL3)의 배열은 반복될 수 있다.Although not shown, a first wiring (not shown) of the same shape as the first wiring (SL2) may be formed below the first wiring (SL3). Additionally, the arrangement of the first wiring SL1, SL2, and SL3 may be repeated.
제1 배선(SL1, SL2, SL3)은 다양한 신호를 화소(PU)에 전달할 수 있는데, 선택적 실시예로서 제1 배선(SL1, SL2, SL3)은 화소(PU)에 스캔 신호를 전달할 수 있다. 또한 예로서, 제1 배선(SL1, SL2, SL3)은 도 7에 도시한 박막 트랜지스터의 게이트 전극(105)에 전기적으로 연결될 수 있다.The first wiring SL1, SL2, and SL3 may transmit various signals to the pixel PU. As an optional embodiment, the first wiring SL1, SL2, and SL3 may transmit a scan signal to the pixel PU. Also as an example, the first wires SL1, SL2, and SL3 may be electrically connected to the gate electrode 105 of the thin film transistor shown in FIG. 7.
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 하나 이상의 제2 배선(V1 내지 V3)을 포함할 수 있다. 하나 이상의 제2 배선(V1 내지 V3)은 화소(PU)에 전기적으로 연결된다. 선택적 실시예로서, 제2 배선(V1)은 제2 방향(도 5의 Y축 방향)으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다.One or more wires (SL1 to SL3, V1 to V3, and D1 to D3) may include one or more second wires (V1 to V3). One or more second wirings V1 to V3 are electrically connected to the pixel PU. As an optional embodiment, the second wiring V1 may be electrically connected to each of a plurality of pixels PU in a row arranged in the second direction (Y-axis direction in FIG. 5).
제2 배선(V1)은 적어도 굴곡을 갖도록 형성된다. 즉 제2 배선(V1)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향(도 9의 X축 방향)으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제2 배선(V1)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The second wiring V1 is formed to have at least a curve. That is, the second wiring V1 has an area extending in the second direction, has an area curved in the first direction (X-axis direction in FIG. 9) along the periphery of the second through
선택적 실시예로서, 제2 배선(V2)은 제2 배선(V1)의 측면 방향(예를들면 우측), 즉 제2 방향과 교차하는 제1 방향(도 5의 x축 방향)으로 인접하도록 배치되고, 제2 방향으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다.As an optional embodiment, the second wiring V2 is disposed adjacent to the second wiring V1 in a lateral direction (for example, to the right), that is, in a first direction (x-axis direction in FIG. 5) that intersects the second direction. and may be electrically connected to each of a plurality of pixels PU in a row arranged in the second direction.
제2 배선(V2)은 적어도 굴곡을 갖도록 형성된다. 즉 제2 배선(V2)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제2 배선(V2)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The second wiring V2 is formed to have at least a curve. That is, the second wiring V2 has a region extending in the second direction and a region curved in the first direction along the periphery of the second penetrating
선택적 실시예로서, 제2 배선(V2)은 제2 배선(V1)과 대칭된 형태를 가질 수 있고, 구체적으로 제2 배선(V2)과 제2 배선(V1)은 제1 관통부(410)를 기준으로 대칭된 형태를 가질 수 있다.As an optional embodiment, the second wiring (V2) may have a symmetrical shape with the second wiring (V1), and specifically, the second wiring (V2) and the second wiring (V1) are formed in the first through
제2 배선(V3)은 제2 배선(V1)과 동일한 형태를 갖는다. 제2 배선(V3)은 제2 방향으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다. 제2 배선(V3)은 적어도 굴곡을 갖도록 형성된다. 즉 제2 배선(V3)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제2 배선(V3)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The second wiring V3 has the same shape as the second wiring V1. The second wiring V3 may be electrically connected to each of the plurality of pixels PU in a row arranged in the second direction. The second wiring V3 is formed to have at least a curve. That is, the second wiring V3 has a region extending in the second direction and a region curved in the first direction along the periphery of the second through
도시하지 않았으나, 제2 배선(V3)의 우측에는 제2 배선(V2)과 동일한 형태의 제2 배선(미도시)이 형성될 수 있다. 또한, 이러한 제2 배선(V1, V2, V3)의 배열은 반복될 수 있다.Although not shown, a second wiring (not shown) of the same shape as the second wiring (V2) may be formed on the right side of the second wiring (V3). Additionally, the arrangement of the second wirings V1, V2, and V3 may be repeated.
제2 배선(V1, V2, V3)은 다양한 신호를 화소(PU)에 전달할 수 있는데, 선택적 실시예로서 제2 배선(V1, V2, V3)은 화소(PU)에 전원 공급을 위한 신호를 전달할 수 있다. 또한 예로서, 제2 배선(V1, V2, V3)은 도 6 또는 도 7에 도시한 제1 전극(131) 또는 제2 전극(132)에 전기적으로 연결될 수 있다.The second wiring (V1, V2, V3) can transmit various signals to the pixel (PU). As an optional embodiment, the second wiring (V1, V2, V3) can transmit a signal for supplying power to the pixel (PU). You can. Also as an example, the second wirings V1, V2, and V3 may be electrically connected to the first electrode 131 or the second electrode 132 shown in FIG. 6 or 7.
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 하나 이상의 제3 배선(D1 내지 D3)을 포함할 수 있다.One or more wires (SL1 to SL3, V1 to V3, and D1 to D3) may include one or more third wires (D1 to D3).
하나 이상의 제3 배선(D1 내지 D3)은 화소(PU)에 전기적으로 연결된다. 선택적 실시예로서, 제3 배선(D1)은 제2 방향(도 5의 Y축 방향)으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다.One or more third wires D1 to D3 are electrically connected to the pixel PU. As an optional embodiment, the third wiring D1 may be electrically connected to each of a plurality of pixels PU in a row arranged in the second direction (Y-axis direction in FIG. 5).
제3 배선(D1)은 적어도 굴곡을 갖도록 형성된다. 즉 제3 배선(D1)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향(도 9의 X축 방향)으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제3 배선(D1)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The third wiring D1 is formed to have at least a curve. That is, the third wiring D1 has an area extending in the second direction, has an area curved in the first direction (X-axis direction in FIG. 9) along the periphery of the second through
선택적 실시예로서 제3 배선(D1)은 제2 배선(V1 내지 V3)과 이격될 수 있다. 또한, 제3 배선(D1)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)와 제2 배선(V1 내지 V3)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)는 서로 다를 수 있고, 예를들면 서로 인접할 수 있다.As an optional embodiment, the third wiring (D1) may be spaced apart from the second wiring (V1 to V3). In addition, a second
선택적 실시예로서, 제3 배선(D2)은 제3 배선(D1)의 측면 방향(예를들면 우측), 즉 제2 방향과 교차하는 제1 방향(도 9의 x축 방향)으로 인접하도록 배치되고, 제2 방향으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다.As an optional embodiment, the third wire D2 is arranged adjacent to the third wire D1 in a lateral direction (for example, to the right), that is, in a first direction (x-axis direction in FIG. 9) crossing the second direction. and may be electrically connected to each of a plurality of pixels PU in a row arranged in the second direction.
제3 배선(D2)은 적어도 굴곡을 갖도록 형성된다. 즉 제3 배선(D2)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제3 배선(D2)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The third wiring D2 is formed to have at least a curve. That is, the third wiring D2 has a region extending in the second direction and a region curved in the first direction along the periphery of the second penetrating
선택적 실시예로서, 제3 배선(D2)은 제3 배선(D1)과 대칭된 형태를 가질 수 있고, 구체적으로 제3 배선(D2)과 제3 배선(D1)은 제1 관통부(410)를 기준으로 대칭된 형태를 가질 수 있다.As an optional embodiment, the third wiring D2 may have a symmetrical shape with the third wiring D1, and specifically, the third wiring D2 and the third wiring D1 are connected to the first through
선택적 실시예로서 제3 배선(D2)은 제2 배선(V1 내지 V3)과 이격될 수 있다. 또한, 제3 배선(D2)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)와 제2 배선(V1 내지 V3)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)는 서로 다를 수 있고, 예를들면 서로 인접할 수 있다.As an optional embodiment, the third wire D2 may be spaced apart from the second wires V1 to V3. In addition, a second
제3 배선(D3)은 제3 배선(D1)과 동일한 형태를 갖는다. 제3 배선(D3)은 제2 방향으로 배열된 일 열의 복수의 화소(PU)의 각각에 전기적으로 연결될 수 있다. 제3 배선(D3)은 적어도 굴곡을 갖도록 형성된다. 즉 제3 배선(D3)은 제2 방향으로 연장된 영역을 갖고, 제2 관통부(420)의 주변을 따라 제1 방향으로 굴곡된 영역을 갖고, 제1 방향으로 굴곡된 영역이란 제1 방향으로 돌출된 영역을 의미할 수 있다. 이를 통하여 제3 배선(D3)은 제1 관통부(410) 및 제2 관통부(420)와 이격되도록 한다.The third wiring D3 has the same shape as the third wiring D1. The third wiring D3 may be electrically connected to each of the plurality of pixels PU in a row arranged in the second direction. The third wiring D3 is formed to have at least a curve. That is, the third wiring D3 has a region extending in the second direction and a region curved in the first direction along the periphery of the second penetrating
선택적 실시예로서 제3 배선(D3)은 제2 배선(V1 내지 V3)과 이격될 수 있다. 또한, 제3 배선(D3)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)와 제2 배선(V1 내지 V3)의 제1 방향으로 굴곡된 영역에 대응되는 제2 관통부(420)는 서로 다를 수 있고, 예를들면 서로 인접할 수 있다. As an optional embodiment, the third wire D3 may be spaced apart from the second wires V1 to V3. In addition, a second
도시하지 않았으나, 제3 배선(D3)의 우측에는 제3 배선(D2)과 동일한 형태의 제3 배선(미도시)이 형성될 수 있다. 또한, 이러한 제3 배선(D1, D2, D3)의 배열은 반복될 수 있다.Although not shown, a third wiring (not shown) of the same shape as the third wiring (D2) may be formed on the right side of the third wiring (D3). Additionally, the arrangement of the third wirings D1, D2, and D3 may be repeated.
제3 배선(D1, D2, D3)은 다양한 신호를 화소(PU)에 전달할 수 있는데, 선택적 실시예로서 제3 배선(D1, D2, D3)은 화소(PU)에 데이터 신호를 전달할 수 있다. 또한 예로서, 제3 배선(D1, D2, D3)은 도 7에 도시한 소스 전극(107) 또는 드레인 전극(108)에 전기적으로 연결될 수 있다.The third wires D1, D2, and D3 may transmit various signals to the pixel PU. As an optional embodiment, the third wires D1, D2, and D3 may transmit data signals to the pixel PU. Also as an example, the third wires D1, D2, and D3 may be electrically connected to the source electrode 107 or the drain electrode 108 shown in FIG. 7.
도시하지 않았으나 본 실시예의 디스플레이 장치(1)에 도 3, 도 4 및 도 5중 어느 하나를 선택적으로 적용할 수 있다.Although not shown, any one of FIGS. 3, 4, and 5 can be selectively applied to the
본 실시예의 디스플레이 장치(1)는 기판(100)에 관통부(400)가 형성된다. 이를 통하여 기판(100)의 유연성을 향상하여 기판(100)의 무게를 감소할 수 있다. 또한 디스플레이 장치(1)가 벤딩(bending) 디스플레이 장치, 플렉시블(flexible) 디스플레이 장치 또는 스트레쳐블(stretchable) 디스플레이 장치로 적용 시 유연성을 향상하고 비정상적인 변형을 감소할 수 있다.In the
선택적 실시예로서 관통부(400)가 일 방향으로 연장된 형태의 제1 관통부(410)를 가지고, 이와 함께 상기 일 방향과 교차하는 일 방향으로 연장된 형태의 제2 관통부(420)를 가지므로 기판(100)에 대한 여러 방향으로의 휨, 구부림, 롤링 등의 변형시에도 기판(100)의 유연성을 확보하고, 기판(100)의 비정상적 변형을 방지하고 내구성을 향상할 수 있다. 이를 통하여 디스플레이 장치(1) 사용 시 사용자의 편의성을 향상할 수 있고, 특히 디스플레이 장치(1)를 웨어러블(wearable) 장치에 용이하게 적용할 수 있다.As an optional embodiment, the penetrating
또한, 선택적 실시예로서 관통부(400)의 제1 관통부(410)를 형성 시 일 방향으로 인접한 두 개의 화소(PU) 및 이와 인접한 또 다른 두 개의 화소(PU)에도 대응되도록 길게 연장된 형태로 형성할 수 있고, 이를 통하여 화소(PU)와 화소(PU)간 경계선에서의 변형 특성이 변하는 것을 완화하여 디스플레이 장치(1)의 내구성을 향상하고, 유연성이 필요한 디스플레이 장치(1), 예를들면 벤딩(bending) 디스플레이 장치, 플렉시블(flexible) 디스플레이 장치 또는 스트레쳐블(stretchable) 디스플레이 장치에 용이하게 적용할 수 있다.In addition, as an optional embodiment, when forming the first through
또한, 선택적 실시예로서 관통부(400)의 제2 관통부(420)를 형성 시 제1 관통부(410)와 교차하는 방향으로 형성하고, 두 개의 화소(PU) 및 이와 인접한 또 다른 두 개의 화소(PU)에도 대응되도록 길게 연장된 형태로 형성할 수 있고, 이를 통하여 화소(PU)와 화소(PU)간 경계선에서의 변형 특성이 변하는 것을 완화하여 디스플레이 장치(1)의 내구성을 향상하고, 유연성이 필요한 디스플레이 장치(1), 예를들면 벤딩(bending) 디스플레이 장치, 플렉시블(flexible) 디스플레이 장치 또는 스트레쳐블(stretchable) 디스플레이 장치에 용이하게 적용할 수 있다.In addition, as an optional embodiment, when forming the second through
또한, 본 실시예의 디스플레이 장치(1)는 화소(PU)와 전기적으로 연결되는 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)을 포함하고, 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 관통부(400)와 중첩되지 않고 이격되도록 형성된다. 이를 통하여 관통부(400)를 통한 기판(100)의 유연성 향상 및 내구성 향상 효과가 감소되지 않는다. 또한, 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)이 관통부(400)에 중첩되어 박리되거나 외부의 산소와 같은 기체에 오염되거나 수분에 의하여 변질되는 것을 차단할 수 있다.In addition, the
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)의 각 종류별 배선, 즉 배선(SL1 내지 SL3)은 일 방향으로 연장되고, 굴곡된 형태를 갖고, 일정한 주기를 갖고 반복될 수 있어, 배선(SL1 내지 SL3)으로 인한 화소(PU)별 불균일을 감소 또는 방지할 수 있다. Each type of one or more wires (SL1 to SL3, V1 to V3, D1 to D3), that is, wires (SL1 to SL3), extend in one direction, have a curved shape, and can be repeated at a certain cycle, Non-uniformity for each pixel (PU) due to wiring (SL1 to SL3) can be reduced or prevented.
또한 배선(V1 내지 V3)은 일 방향으로 연장되고, 굴곡된 형태를 갖고, 일정한 주기를 갖고 반복될 수 있어, 배선(V1 내지 V3)으로 인한 화소(PU)별 불균일을 감소 또는 방지할 수 있다.In addition, the wiring (V1 to V3) extends in one direction, has a curved shape, and can be repeated at a certain cycle, thereby reducing or preventing unevenness for each pixel (PU) due to the wiring (V1 to V3). .
또한 배선(D1 내지 D3)은 일 방향으로 연장되고, 굴곡된 형태를 갖고, 일정한 주기를 갖고 반복될 수 있어, 배선(D1 내지 D3)으로 인한 화소(PU)별 불균일을 감소 또는 방지할 수 있다.In addition, the wirings D1 to D3 extend in one direction, have a curved shape, and can be repeated at regular intervals, thereby reducing or preventing unevenness for each pixel PU due to the wirings D1 to D3. .
특히 동일한 방향으로 연장되고, 동일한 방향으로 배열된 화소(PU)들과 전기적으로 연결된 배선(V1 내지 V3) 및 배선(D1 내지 D3)을 서로 중첩되지 않도록 형성하여 서로간의 간섭을 최소화할 수 있다. 또한 배선(V1 내지 V3) 및 배선(D1 내지 D3)의 서로 굴곡된 영역이 서로 다른 제2 관통부(420)에 대응되도록 하여 배선(V1 내지 V3) 및 배선(D1 내지 D3)의 굴곡부에서의 간섭으로 인한 화소(PU)에서의 전기적 특성 감소를 방지할 수 있다.In particular, the wiring (V1 to V3) and the wiring (D1 to D3) extending in the same direction and electrically connected to the pixels (PU) arranged in the same direction are formed so as not to overlap each other, so that interference between them can be minimized. In addition, the curved areas of the wires V1 to V3 and D1 to D3 correspond to different second
도 6은 도 1의 A부분을 확대하여 개략적으로 도시하는 평면도이고, 도 7은 도 6의 K부분을 확대하여 개략적으로 도시하는 평면도이다.FIG. 6 is an enlarged plan view schematically showing part A of FIG. 1 , and FIG. 7 is an enlarged plan view schematically showing part K of FIG. 6 .
도 6 및 도 7를 참조하면, 디스플레이 장치(1)는 기판(100) 및 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)을 포함한다.Referring to FIGS. 6 and 7 , the
기판(100)상에는 표시 영역(DA) 및 비표시 영역(NDA)이 정의된다. 표시 영역(DA)에는 하나 이상의 화소(PU1, PU2, PU3) 및 관통부(400)가 형성된다. 화소(PU1, PU2, PU3)의 각각은 복수의 부화소(SP1, SP2, SP3)를 구비할 수 있다.A display area (DA) and a non-display area (NDA) are defined on the
기판(100)은 표시 영역(DA) 및 비표시 영역(NDA)으로 구획된다. 관통부(400)는 기판(100)에 형성된다. 기판(100) 및 관통부(400)는 전술한 실시예에서 설명한 바와 같으므로 구체적인 설명은 생략한다.The
본 실시예의 화소(PU1, PU2, PU3)의 각각은 하나 이상의 부화소(SP1, SP2, SP3)를 구비한다. 구체적인 예로서 화소(PU1)은 복수의 부화소(SP1, SP2, SP3)를 구비한다.Each of the pixels (PU1, PU2, and PU3) in this embodiment includes one or more subpixels (SP1, SP2, and SP3). As a specific example, the pixel PU1 includes a plurality of subpixels SP1, SP2, and SP3.
도 6에는 세 개의 부화소(SP1, SP2, SP3)가 도시되어 있으나, 본 실시예는 이에 한정되지 않고 한 개의 화소(PU1)에 두 개 또는 네 개 이상의 부화소가 구비될 수 있다. 선택적 실시예로서 일 화소(PU1)에 구비된 복수의 부화소(SP1, SP2, SP3)는 각각 다른 색의 가시 광선을 구현, 예를 들면 발광할 수 있다. 구체적인 예로서 복수의 부화소(SP1, SP2, SP3)는 각각 적색, 녹색 및 청색 계열의 가시 광선을 구현할 수 있다.Although three subpixels (SP1, SP2, and SP3) are shown in FIG. 6, this embodiment is not limited to this and one pixel (PU1) may be provided with two, four or more subpixels. As an optional embodiment, the plurality of subpixels SP1, SP2, and SP3 provided in one pixel PU1 may each implement, for example, emit different colors of visible light. As a specific example, the plurality of subpixels (SP1, SP2, and SP3) may respectively implement visible light in red, green, and blue colors.
일 화소(PU1)에 구비된 복수의 부화소(SP1, SP2, SP3)는 일 방향, 예를 들면 도 6을 기준으로 X축 방향으로 순서대로 배열될 수 있다. 또한, 일 화소(PU1)와 인접한 다른 화소(PU2)는 복수의 부화소(SP1, SP2, SP3)를 구비하는데, 복수의 부화소(SP1, SP2, SP3)는 상기 일 방향과 교차하는 방향, 예를 들면 도 6을 기준으로 Y축 방향으로 순서대로 배열될 수 있다.A plurality of subpixels (SP1, SP2, and SP3) provided in one pixel (PU1) may be arranged in order in one direction, for example, in the X-axis direction with respect to FIG. 6. In addition, another pixel (PU2) adjacent to one pixel (PU1) includes a plurality of sub-pixels (SP1, SP2, SP3), and the plurality of sub-pixels (SP1, SP2, SP3) have a direction intersecting the one direction, For example, they may be arranged in order in the Y-axis direction based on FIG. 6.
또한, 일 화소(PU2)와 인접한 다른 화소(PU3)는 복수의 부화소(SP1, SP2, SP3)를 구비하는데, 복수의 부화소(SP1, SP2, SP3)는 상기 일 방향과, 예를 들면 도 6을 기준으로 X축 방향으로 순서대로 배열될 수 있다. 선택적 실시예로서 화소(PU1, PU2, PU3)에 구비된 복수의 부화소(SP1, SP2, SP3)들이 모두 일 방향(X축 방향)으로 배열되거나 모두 이와 교차하는 일 방향(Y축 방향)으로 배열될 수 있다.In addition, another pixel (PU3) adjacent to one pixel (PU2) includes a plurality of sub-pixels (SP1, SP2, SP3), and the plurality of sub-pixels (SP1, SP2, SP3) are oriented in one direction, for example. Based on FIG. 6, they may be arranged in order in the X-axis direction. As an optional embodiment, the plurality of subpixels (SP1, SP2, SP3) provided in the pixels (PU1, PU2, PU3) are all arranged in one direction (X-axis direction) or are all arranged in one direction (Y-axis direction) intersecting therewith. can be arranged.
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 하나 이상의 제1 배선(SL1 내지 SL3), 제2 배선(V1 내지 V3) 및 제3 배선(D1 내지 D3)을 포함할 수 있다. 하나 이상의 제1 배선(SL1 내지 SL3), 제2 배선(V1 내지 V3) 및 제3 배선(D1 내지 D3)은 화소(PU1, PU2, PU3)에 전기적으로 연결된다. 제1 배선(SL1 내지 SL3), 제2 배선(V1 내지 V3) 및 제3 배선(D1 내지 D3)의 배치에 관하여는 전술한 실시예와 동일한 바, 구체적인 설명은 생략한다.One or more wires (SL1 to SL3, V1 to V3, D1 to D3) may include one or more first wires (SL1 to SL3), second wires (V1 to V3), and third wires (D1 to D3). . One or more first wires (SL1 to SL3), second wires (V1 to V3), and third wires (D1 to D3) are electrically connected to the pixels (PU1, PU2, and PU3). The arrangement of the first wiring (SL1 to SL3), the second wiring (V1 to V3), and the third wiring (D1 to D3) is the same as the above-described embodiment, and detailed description will be omitted.
도 7을 참조하면서 설명하기로 한다. 도 7은 도 6의 K를 확대한 도면이다.The description will be made with reference to FIG. 7 . Figure 7 is an enlarged view of K in Figure 6.
도 7을 참조하면 제1 배선(SL1)은 화소(PU1)의 부화소(SP1, SP2, SP3)에 전기적으로 연결된다. 제1 배선(SL1)은 다양한 형태를 가질 수 있다. 선택적 실시예로서 제1 배선(SL1)은 각 부화소(SP1, SP2, SP3)에 연결되도록 서로 이격 배치된 복수의 연결선(SL1c), 상기 복수의 연결선(SL1c)에 공통으로 연결된 공통선(SL1b) 및 상기 공통선(SL1b)과 연결되고 상기 부화소(SP1, SP2, SP3) 중 일 부화소, 예를들면 부화소(SP1)의 측면에 대응하도록 형성된 본체선(SP1a)을 구비한다.Referring to FIG. 7 , the first wire SL1 is electrically connected to the subpixels SP1, SP2, and SP3 of the pixel PU1. The first wiring SL1 may have various forms. As an optional embodiment, the first wire SL1 includes a plurality of connection lines SL1c spaced apart from each other to be connected to each subpixel SP1, SP2, and SP3, and a common line SL1b commonly connected to the plurality of connection lines SL1c. ) and a main body line (SP1a) connected to the common line (SL1b) and formed to correspond to a side of one of the subpixels (SP1, SP2, SP3), for example, the subpixel (SP1).
제2 배선(V1)은 화소(PU1)의 부화소(SP1, SP2, SP3)에 전기적으로 연결된다. 제2 배선(V1)은 다양한 형태를 가질 수 있다. 선택적 실시예로서 제2 배선(V1)은 각 부화소(SP1, SP2, SP3)에 연결되도록 서로 이격 배치된 복수의 연결선(V1c), 상기 복수의 연결선(V1c)에 공통으로 연결된 공통선(V1b) 및 상기 공통선(V1b)과 연결되고 상기 부화소(SP1, SP2, SP3) 중 일 부화소, 예를들면 부화소(SP1)의 측면에 대응하도록 형성된 본체선(V1a)을 구비한다.The second wiring V1 is electrically connected to the subpixels SP1, SP2, and SP3 of the pixel PU1. The second wiring V1 may have various forms. As an optional embodiment, the second wiring (V1) includes a plurality of connection lines (V1c) spaced apart from each other to be connected to each subpixel (SP1, SP2, and SP3), and a common line (V1b) commonly connected to the plurality of connection lines (V1c). ) and a main body line (V1a) connected to the common line (V1b) and formed to correspond to a side of one of the subpixels (SP1, SP2, SP3), for example, the subpixel (SP1).
제3 배선(D1)은 화소(PU1)의 부화소(SP1, SP2, SP3)에 전기적으로 연결된다. 제3 배선(D1)은 다양한 형태를 가질 수 있다. 선택적 실시예로서 제3 배선(D1)은 각 부화소(SP1, SP2, SP3)에 연결되도록 서로 이격 배치된 복수의 연결선(D1c), 상기 복수의 연결선(D1c)에 공통으로 연결된 공통선(D1b) 및 상기 공통선(D1b)과 연결되고 상기 부화소(SP1, SP2, SP3) 중 일 부화소, 예를들면 부화소(SP3)의 측면에 대응하도록 형성된 본체선(D1a)을 구비한다.The third wire D1 is electrically connected to the subpixels SP1, SP2, and SP3 of the pixel PU1. The third wiring D1 may have various forms. As an optional embodiment, the third wire D1 includes a plurality of connection lines D1c spaced apart from each other to be connected to each subpixel SP1, SP2, and SP3, and a common line D1b commonly connected to the plurality of connection lines D1c. ) and a main line (D1a) connected to the common line (D1b) and formed to correspond to a side of one of the subpixels (SP1, SP2, SP3), for example, the subpixel (SP3).
본 실시예의 디스플레이 장치(1)는 기판(100)에 관통부(400)가 형성된다. 이를 통하여 기판(100)의 유연성을 향상하여 기판(100)의 무게를 감소할 수 있다.In the
또한 기판(100)의 영역 중 화소(PU1, PU2, PU3)들 사이의 이격영역(BA)에 형성되어 기판(100)의 변형, 즉, 기판(100)에 대한 휨, 구부림, 롤링 등이 발생 시 화소(PU1, PU2, PU3)들 주변에서의 기판(100)의 변형을 용이하게 하고, 변형 시의 응력 발생을 용이하게 감소 또는 차단할 수 있다. 즉, 디스플레이 장치(1)가 벤딩(bending) 디스플레이 장치, 플렉시블(flexible) 디스플레이 장치 또는 스트레쳐블(stretchable) 디스플레이 장치로 적용 시 유연성을 향상하고 비정상적인 변형을 감소할 수 있다.In addition, it is formed in the spaced area BA between the pixels PU1, PU2, and PU3 among the areas of the
선택적 실시예로서 관통부(400)가 일 방향으로 연장된 형태의 제1 관통부(410)를 가지고, 이와 함께 상기 일 방향과 교차하는 일 방향으로 연장된 형태의 제2 관통부(420)를 가지므로 기판(100)에 대한 여러 방향으로의 휨, 구부림, 롤링 등의 변형시에도 기판(100)의 유연성을 확보하고, 기판(100)의 비정상적 변형을 방지하고 내구성을 향상할 수 있다. 이를 통하여 디스플레이 장치(1) 사용 시 사용자의 편의성을 향상할 수 있고, 특히 디스플레이 장치(1)를 웨어러블(wearable) 장치에 용이하게 적용할 수 있다.As an optional embodiment, the penetrating
또한 선택적 실시예로서 복수의 제1 관통부(410) 중 서로 인접한 2 개의 제1 관통부(410)의 사이에 제2 관통부(420)를 배치하여 제1 관통부(410)의 일 방향의 연장으로 인한 기판(100)의 제1 관통부(410)의 길이 방향으로 발생할 수 있는 크랙의 발생을 차단할 수 있다.In addition, as an optional embodiment, the
또한, 복수의 제2 관통부(420) 중 서로 인접한 2 개의 제2 관통부(420)의 사이에 제1 관통부(410)를 배치하여 제2 관통부(420)의 일 방향의 연장으로 인한 기판(100)의 제2 관통부(420)의 길이 방향으로 발생할 수 있는 크랙의 발생을 차단할 수 있다.In addition, the first penetrating
또한, 본 실시예의 화소(PU1, PU2, PU3)들은 복수의 부화소(SP1, SP2, SP3)를 구비하고, 복수의 부화소(SP1, SP2, SP3)는 일 방향으로 배열되는데, 화소(PU1)의 부화소(SP1, SP2, SP3)들이 배열된 방향과 이와 인접한 부화소(SP1, SP2, SP3)들이 배열된 방향이 서로 교차된다. 이를 통하여 제1 관통부(410) 및 제2 관통부(420)의 배열 방향과 대응되도록 부화소(SP1, SP2, SP3)를 배열할 수 있다. 이를 통하여 제1 관통부(410) 및 제2 관통부(420)의 배열 방향이 다르더라도 화소(PU1, PU2, PU3)들에 대한 시각적 영향의 불균일성을 최소화하여 디스플레이 장치(1)의 화질 특성을 향상할 수 있다.In addition, the pixels (PU1, PU2, PU3) of this embodiment include a plurality of sub-pixels (SP1, SP2, SP3), and the plurality of sub-pixels (SP1, SP2, SP3) are arranged in one direction, and the pixel (PU1) The direction in which the subpixels (SP1, SP2, SP3) of ) are arranged and the direction in which the adjacent subpixels (SP1, SP2, SP3) are arranged intersect. Through this, the subpixels SP1, SP2, and SP3 can be arranged to correspond to the arrangement direction of the first through
또한, 본 실시예의 디스플레이 장치(1)는 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)을 포함하고, 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)은 관통부(400)와 중첩되지 않고 이격되도록 형성된다. 이를 통하여 관통부(400)를 통한 기판(100)의 유연성 향상 및 내구성 향상 효과가 감소되지 않는다. 또한, 하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)이 관통부(400)에 중첩되어 박리되거나 외부의 산소와 같은 기체에 오염되거나 수분에 의하여 변질되는 것을 차단할 수 있다.In addition, the
하나 이상의 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)의 각 종류별 배선, 즉 배선(SL1 내지 SL3)은 일 방향으로 연장되고, 굴곡된 형태를 갖고, 일정한 주기를 갖고 반복될 수 있어, 배선(SL1 내지 SL3)으로 디스플레이 장치(1)의 불균일을 감소 또는 방지할 수 있다. 또한 배선(V1 내지 V3) 및 배선(D1 내지 D3)도 불균일을 감소 또는 방지할 수 있다.Each type of one or more wires (SL1 to SL3, V1 to V3, D1 to D3), that is, wires (SL1 to SL3), extend in one direction, have a curved shape, and can be repeated at a certain cycle, The wiring SL1 to SL3 can reduce or prevent unevenness of the
특히 동일한 방향으로 연장된, 배선(V1 내지 V3) 및 배선(D1 내지 D3)을 서로 중첩되지 않도록 형성하여 서로간의 간섭을 최소화할 수 있다. 또한 배선(V1 내지 V3) 및 배선(D1 내지 D3)의 서로 굴곡된 영역이 서로 다른 제2 관통부(420)에 대응되도록 하여 배선(V1 내지 V3) 및 배선(D1 내지 D3)의 굴곡부에서의 간섭으로 인한 디스플레이 장치(1)의 전기적 특성 감소를 방지할 수 있다.In particular, the interconnections V1 to V3 and D1 to D3 extending in the same direction can be formed so as not to overlap each other, thereby minimizing interference between them. In addition, the curved areas of the wires V1 to V3 and D1 to D3 correspond to different second
또한, 화소(PU1, PU2, PU3)이 각각 소정의 방향으로 배열된 부화소(SP1, SP2, SP3)을 구비하고, 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)의 각각이 부화소(SP1, SP2, SP3)에 연결되고, 관통부(400)와도 이격되도록 굴곡을 갖는데, 이를 위하여 배선들은 복수의 부화소(SP1, SP2, SP3)에 연결되는 복수의 연결선, 공통선 및 본체선을 가지므로 관통부(400)와 중첩됨 없이 배선(SL1 내지 SL3, V1 내지 V3, D1 내지 D3)을 복수의 부화소(SP1, SP2, SP3)에 용이하게 전기적으로 연결할 수 있다.In addition, the pixels PU1, PU2, and PU3 each have subpixels SP1, SP2, and SP3 arranged in a predetermined direction, and each of the wiring SL1 to SL3, V1 to V3, and D1 to D3 is a subpixel. It is connected to (SP1, SP2, SP3) and is curved to be spaced apart from the through
지금까지는 디스플레이 장치에 대해서만 주로 설명하였으나, 본 발명이 이에 한정되는 것은 아니다. 예컨대 이러한 디스플레이 장치를 제조하는 디스플레이 장치의 제조방법 역시 본 발명의 범위에 속한다고 할 것이다.So far, only the display device has been mainly described, but the present invention is not limited thereto. For example, a method of manufacturing such a display device may also be said to fall within the scope of the present invention.
도 8 내지 도 12는 본 발명의 일 실시예에 관한 디스플레이 장치를 제조하는 제조공정을 개략적으로 도시하는 단면도들이다.8 to 12 are cross-sectional views schematically showing a manufacturing process for manufacturing a display device according to an embodiment of the present invention.
도 8을 참조하면, 복수개의 화소부(PU)들이 위치하는 화소영역(PA) 및 복수개의 화소부(PU)들 중 서로 인접한 두 개의 화소부(PU)들 사이에 형성된 이격영역(BA)을 갖는 기판(100)을 준비하는 단계를 거칠 수 있다. 기판(100)은 다양한 소재를 포함할 수 있다. 구체적으로 기판(100)은 유리, 금속 또는 유기물 기타 재질로 형성할 수 있다. 선택적 실시예로서 기판(100)은 유연성을 갖는 플렉서블 소재로 형성할 수 있다.Referring to FIG. 8, a pixel area (PA) where a plurality of pixel units (PUs) are located and a separation area (BA) formed between two adjacent pixel units (PUs) among the plurality of pixel units (PUs). A step of preparing the
기판(100) 상에 버퍼층(110), 게이트절연막(130) 및 층간절연막(150)을 형성하는 단계를 거칠 수 있다. 또한 기판(100) 상에는 박막트랜지스터(TFT)를 형성하기 위한 반도체층(120), 게이트전극(140)을 형성하는 단계를 거칠 수 있다. 게이트전극(140) 상에 층간절연막(150)을 적층한 후, 소스전극(160) 및 드레인전극(162)이 반도체층(120)과 전기적으로 연결되도록 컨택홀(CNT)을 형성할 수 있다.A step of forming a
이때 컨택홀(H1)을 형성하는 과정에서, 이격영역(BA)에 제1 관통홀(401)을 동시에 형성할 수 있다. 이를 통해 이격영역(BA)에 제1 관통홀(401)을 형성하는 과정을 별도의 마스크 추가 없이 형성할 수 있어 제조 단가를 절감할 수 있다.At this time, in the process of forming the contact hole H1, the first through
제1 관통홀(401)을 통해, 버퍼층(110)의 단부면(110a), 게이트절연막(130)의 단부면(130a) 및 층간절연막(150)의 단부면(150a)이 노출될 수 있다. 단부면들(110a, 130a, 150a)은 제1 관통홀(401)의 제1 단부면(160a)일 수 있다. 이러한 제1 단부면(160a)은 동일면을 갖도록 형성될 수 있다. 이는 컨택홀(H1)을 형성하는 과정에서 제1 관통홀(401)을 형성하기 때문인 것으로 이해할 수 있다. 다른 실시예로 제1 단부면(160a)이 각각 다른 면을 갖도록 단차가 있는 형태로 형성될 수도 있다.Through the first through
도 9를 참조하면, 게이트전극(140) 상에 컨택홀(H1)을 통해 반도체층(120)과 전기적으로 연결되는 소스전극(160) 및 드레인전극(162)을 형성할 수 있다. 소스전극(160) 및 드레인전극(162) 상에는 제1 절연층(170)을 적층할 수 있다. 제1 절연층(170)에는 화소전극(210)이 소스전극(160) 및 드레인전극(162) 중 어느 하나와 전기적으로 연결되도록 비아홀(H2)을 형성하는 단계를 거칠 수 있다.Referring to FIG. 9, a
이때 비아홀(H2)을 형성하는 과정에서, 이격영역(BA)에 제2 관통부(420)을 동시에 형성할 수 있다. 이를 통해 이격영역(BA)에 제2 관통부(420)을 형성하는 과정을 별도의 마스크 추가 없이 형성할 수 있어 제조 단가를 절감할 수 있다.At this time, in the process of forming the via hole H2, the second penetrating
제2 관통부(420)을 통해, 제2 단부면(170a)이 노출될 수 있다. 이는 비아홀(H2)을 형성하는 과정에서 제2 관통부(420)을 형성하기 때문인 것으로 이해될 수 있다. 이때 제2 관통부(420)의 폭은 제1 관통홀(401)의 폭보다 크게 형성될 수 있다.The
도 10을 참조하면, 제1 절연층(170) 상에 화소전극(210)을 각 화소마다 패터닝하여 형성하는 단계를 거칠 수 있다. 화소전극(210)은 제1 절연층(170)에 형성된 비아홀(H2)을 통해 박막트랜지스터(TFT)의 소스전극(160) 또는 드레인전극(162) 중 어느 하나와 전기적으로 연결될 수 있다.Referring to FIG. 10 , the
화소전극(210)을 형성한 후, 화소전극(210)의 중앙부를 노출시키며 화소전극(210)의 가장자리를 덮도록 제2 절연층(180)을 형성하는 단계를 거칠 수 있다. 제2 절연층(180)은 화소정의막으로 이해될 수 있다.After forming the
제2 절연층(180)이 화소전극(210)의 중앙부를 노출시키는 개구(H3)를 형성하는 과정에서, 이격영역(BA)에 제3 관통홀(403)을 동시에 형성할 수 있다. 이를 통해 이격영역(BA)에 제3 관통홀(403)을 형성하는 과정을 별도의 마스크 추가 없이 형성할 수 있어 제조 단가를 절감할 수 있다.In the process of forming the opening H3 through which the second insulating
제3 관통홀(403)을 통해, 제3 단부면(180a)이 노출될 수 있다. 이는 개구(H3)를 형성하는 과정에서 제3 관통홀(403)을 형성하기 때문인 것으로 이해될 수 있다. 이때 제3 관통홀(403)의 폭은 제2 관통홀(402)의 폭보다 크게 형성될 수 있다.The
즉, 제1 관통홀(401)이 가장 작은 폭을 갖도록 형성되고, 그 위에 제2 관통부(420)이 형성되며, 제3 관통홀(403)이 가장 큰 폭을 갖도록 형성될 수 있다. 이로써 제1 단부면(160a), 제2 단부면(170a) 및 제3 단부면(180a)은 단차를 갖는 계단 구조를 갖도록 형성될 수 있다. 제1 단부면(160a)은 제2 단부면(170a)보다 돌출되도록 형성되고, 제2 단부면(170a)은 제3 단부면(180a) 보다 돌출되도록 형성될 수 있다. 도 9에서는 제1 단부면(160a), 제2 단부면(170a) 및 제3 단부면(180a)가 단차를 갖도록 형성한 구조를 도시하고 있다. 다만 이에 한정되는 것은 아니고, 관통홀의 단부면은 전술한 도 4a 내지 도 4c의 구조 중 하나를 가질 수 있다.That is, the first through-
도 11을 참조하면, 제2 절연층(180)에 의해 노출된 화소전극(210) 상에 발광층을 포함한 중간층(220)을 형성할 수 있다. 그 후 중간층(220)을 덮도록 제2 절연층(180) 상에 화소전극(210)과 대향하는 대향전극(230)을 형성하는 단계를 거칠 수 있다. 대향전극(230)은 기판(100) 전면(全面)에 형성될 수 있다. 따라서 도면에는 도시되지 않았으나, 제1 단부면(160a), 제2 단부면(170a) 및 제3 단부면(180a) 상에도 대향전극(230)이 형성될 수 있다.Referring to FIG. 11, an
그 후 제1 관통홀(401)과 동일하거나 더 작은 크기를 갖는 제4 관통홀(404)을 기판(100)에 형성할 수 있다. 제4 관통홀(404)을 기판(100)을 관통하도록 형성될 수 있다. 이러한 제4 관통홀(404)은 레이저 커팅을 이용하여 형성할 수 있고, 예컨대 펨토 레이저 등을 이용한 미세 패턴 가공을 통해 기판(100)의 일부를 제거할 수 있다.Thereafter, a fourth through
도 12를 참조하면, 제1 관통홀(401)에 대응하는 기판(100)의 일부가 제거되어 제4 관통홀(404)이 형성될 수 있다. 따라서 이격영역(BA)에 형성된 관통부(400)는 제1 관통홀(401) 내지 제4 관통홀(404)이 중첩되어 형성될 수 있다. 또한 제4 관통홀(404)에 의해 제4 단부면(100a)이 노출될 수 있다. 제1 단부면(160a) 내지 제4 단부면(100a)는 관통부(400)의 내측면(400a)으로 이해될 수 있다.Referring to FIG. 12 , a portion of the
관통부(400)의 내측면(400a)은 도 12와 같이 계단 형상으로 단차를 갖도록 형성되거나, 경사를 갖도록 형성될 수도 있다. 또한 관통부(400)의 내측면(400a)은 대향전극(230)에서 기판(100) 측으로 갈수록 폭이 좁아지도록 형성될 수 있다. 즉 하부가 개방된 V자 형상으로 형성될 수 있다.The
도 12에서는 대향전극(230)이 제2 절연층(180) 상에 형성되고, 제1 단부면(160a) 내지 제4 단부면(100a) 상에는 형성되지 않는 것으로 도시되어 있으나, 경우에 따라 대향전극(230)은 패터닝 되지 않고 기판(100) 전면(全面)에 형성되므로, 관통부(400)의 내측면(400a)에도 대향전극(230)이 형성될 수 있다.In FIG. 12, the
대향전극(230) 상에 봉지층(300)을 형성하는 단계를 거칠 수 있다. 도 12에는 도시되어 있지 않으나, 봉지층(300)은 유기막과 무기막이 교번하여 적층된 다층 구조로 형성될 수 있다.A step of forming an
봉지층(300)은 유기발광소자를 밀봉하도록 형성되며, 관통부(400)의 내측면(400a)을 덮도록 형성된다. 봉지층(300)이 관통부(400)의 내측면(400a)까지 덮도록 배치되지 않으면, 관통부(400)의 내측면(400a)으로 인해 단면이 노출된 하나 이상의 물질층들로 습기나 불순물이 유입되어 각종 소자부들을 손상시킬 수 있다. 따라서 봉지층(300)이 관통부(400)의 내측면(400a)을 덮도록 밀봉되어야 본 발명의 일 실시예에 따른 디스플레이 장치의 신뢰성을 향상시킬 수 있다.The
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 당해 기술분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것 이다. The present invention has been described with reference to the embodiments shown in the drawings, but these are merely exemplary, and those skilled in the art will understand that various modifications and equivalent other embodiments are possible therefrom. Therefore, the true technical protection scope of the present invention should be determined by the technical spirit of the attached patent claims.
100: 기판
200: 유기발광소자
300: 봉지층
400: 관통부
400a: 내측면
410: 제1 관통부
420: 제2 관통부
BA: 이격 영역
PU, PU1, PU2, PU3: 화소
SP1, SP2, SP3: 부화소100: substrate
200: Organic light emitting device
300: Encapsulation layer
400: Penetrating part
400a: medial side
410: first penetration portion
420: second penetration portion
BA: standoff area
PU, PU1, PU2, PU3: pixels
SP1, SP2, SP3: Subpixel
Claims (22)
상기 기판 상에 배치되며, 각각이 제1 부화소, 제2 부화소 및 제3 부화소를 포함하는, 복수의 화소들;
상기 복수의 화소들 사이에 위치하는, 관통부;
상기 관통부를 우회화여 제1 방향으로 연장된, 스캔선;
상기 관통부를 우회하여 상기 제1 방향과 교차하는 제2 방향으로 연장된, 데이터선;을 구비하고,
상기 관통부는 상기 스캔선 또는 상기 데이터선이 연장되는 방향과 직교하며, 상기 관통부는 상기 제2 방향으로 장변을 가지는 제1 관통부 및 상기 제1 방향으로 장변을 가지는 제2 관통부를 포함하며,
상기 제1 관통부 및 상기 제2 관통부는 서로 이격되어 배치된, 디스플레이 장치.Board;
a plurality of pixels disposed on the substrate, each of which includes a first subpixel, a second subpixel, and a third subpixel;
a penetrating portion located between the plurality of pixels;
a scan line extending in a first direction by bypassing the through portion;
a data line extending in a second direction that bypasses the through portion and intersects the first direction,
The penetrating portion is perpendicular to a direction in which the scan line or the data line extends, and the penetrating portion includes a first penetrating portion having a long side in the second direction and a second penetrating portion having a long side in the first direction,
The first penetration part and the second penetration part are arranged to be spaced apart from each other.
상기 제1 방향과 상기 제2 방향은 직교하는, 디스플레이 장치.According to paragraph 1,
The first direction and the second direction are orthogonal to each other.
상기 제1 부화소, 상기 제2 부화소 및 상기 제3 부화소는 각각 서로 다른 색을 발광하는, 디스플레이 장치.According to paragraph 1,
The first subpixel, the second subpixel, and the third subpixel each emit different colors.
상기 제1 관통부는 상기 제1 방향으로 이웃하여 배치된 두 개의 화소들 사이에 위치하고, 상기 제2 관통부는 상기 제2 방향으로 이웃하여 배치된 두 개의 화소들 사이에 위치하는, 디스플레이 장치.According to paragraph 1,
The first penetration part is located between two pixels arranged adjacent to each other in the first direction, and the second penetration part is located between two pixels arranged adjacent to each other in the second direction.
상기 제1 관통부와 상기 제2 관통부는 상호 이격된, 디스플레이 장치.According to paragraph 1,
A display device wherein the first through portion and the second through portion are spaced apart from each other.
상기 복수의 화소들 중 일 화소를 기준으로,
상기 관통부는 상기 화소를 둘러싸도록 복수 개 구비되고,
상기 화소는 상호 이격된 4개의 관통부들로 둘러싸인, 디스플레이 장치.According to paragraph 1,
Based on one pixel among the plurality of pixels,
A plurality of penetrating portions are provided to surround the pixel,
A display device wherein the pixel is surrounded by four penetrating portions spaced apart from each other.
상기 4개의 관통부들 중 2개는 상기 제1 방향으로 연장되며, 나머지 2개는 상기 제2 방향으로 연장된, 디스플레이 장치.According to clause 6,
Two of the four through parts extend in the first direction, and the remaining two extend in the second direction.
상기 데이터선은 상기 제1 관통부를 사이에 두고 인접한 제1 데이터선 및 제2 데이터선을 포함하고,
상기 제1 데이터선과 상기 제2 데이터선은 상기 제1 관통부를 기준으로 대칭적으로 배치된, 디스플레이 장치.According to paragraph 1,
The data line includes a first data line and a second data line adjacent to each other with the first through portion interposed therebetween,
The first data line and the second data line are arranged symmetrically with respect to the first through portion.
상기 스캔선은 상기 제2 관통부를 사이에 두고 인접한 제1 스캔선 및 제2 스캔선을 포함하고,
상기 제1 스캔선과 상기 제2 스캔선은 상기 제2 관통부를 기준으로 대칭적으로 배치된, 디스플레이 장치.According to paragraph 1,
The scan line includes a first scan line and a second scan line adjacent to each other with the second penetration part interposed therebetween,
The first scan line and the second scan line are symmetrically arranged with respect to the second through portion.
상기 기판 상에 배치되며, 각각이 제1 부화소, 제2 부화소 및 제3 부화소를 포함하는, 복수의 화소들; 및
상기 복수의 화소들 사이에 위치하는, 관통부;를 구비하고,
상기 복수의 화소들은 상기 제1 부화소, 상기 제2 부화소 및 상기 제3 부화소의 배열이 서로 상이한 제1 화소 및 제2 화소를 포함하고,
상기 제1 화소 및 상기 제2 화소는 제1 방향으로 교번하여 배치되는, 디스플레이 장치.Board;
a plurality of pixels disposed on the substrate, each of which includes a first subpixel, a second subpixel, and a third subpixel; and
A penetrating portion located between the plurality of pixels,
The plurality of pixels include first pixels and second pixels in which the first sub-pixel, the second sub-pixel, and the third sub-pixel have different arrangements,
The first pixel and the second pixel are arranged alternately in a first direction.
상기 관통부는 상기 제1 화소 및 상기 제2 화소 사이에 위치하는, 디스플레이 장치.According to clause 10,
The display device wherein the penetrating portion is located between the first pixel and the second pixel.
상기 제1 화소 및 상기 제2 화소는 상기 제1 방향과 교차하는 제2 방향으로 교번하여 배치되는, 디스플레이 장치.According to clause 10,
The first pixel and the second pixel are arranged alternately in a second direction intersecting the first direction.
상기 제1 화소 및 상기 제2 화소는 일정한 간격으로 이격되어 배치된, 디스플레이 장치.According to clause 10,
The first pixel and the second pixel are arranged to be spaced apart from each other at regular intervals.
상기 제1 화소 및 상기 제2 화소 사이의 이격 거리는, 상기 제1 부화소, 상기 제2 부화소 및 상기 제3 부화소 각각의 이격 거리보다 큰, 디스플레이 장치.According to clause 13,
A display device wherein the separation distance between the first pixel and the second pixel is greater than the separation distance between each of the first subpixel, the second subpixel, and the third subpixel.
상기 제1 방향으로 교번하여 배치된 상기 제1 화소 및 상기 제2 화소에 있어서,
상기 제1 화소 및 상기 제2 화소에 각각 포함된 상기 제1 부화소, 상기 제2 부화소 및 상기 제3 부화소 중 동일 색을 발광하는 부화소들 간의 거리는 서로 동일한, 디스플레이 장치.
기판;
상기 기판 상에 배치되며, 각각이 복수의 부화소들을 포함하는, 제1 화소, 제2 화소, 제3 화소 및 제4 화소; 및
상기 제1 화소 내지 상기 제4 화소 사이에 위치하는, 적어도 하나의 관통부;를 구비하고,
상기 제1 화소 내지 상기 제4 화소는 상기 적어도 하나의 관통부를 사이에 두고 마주보도록 배치되며,
상기 복수의 부화소들은 단변 및 상기 단변 보다 긴 장변을 가지는 사각형의 형상으로 구비되며,
상기 제1 방향을 따르는 상기 관통부의 길이는 상기 복수의 부화소들 각각의 장변의 길이의 2배 이상인, 디스플레이 장치.According to clause 10,
In the first pixels and the second pixels arranged alternately in the first direction,
A display device wherein distances between subpixels emitting the same color among the first subpixel, the second subpixel, and the third subpixel included in each of the first pixel and the second pixel are the same.
Board;
a first pixel, a second pixel, a third pixel, and a fourth pixel disposed on the substrate, each including a plurality of subpixels; and
and at least one penetrating portion located between the first pixel and the fourth pixel,
The first to fourth pixels are arranged to face each other with the at least one through portion interposed between them,
The plurality of subpixels are provided in a rectangular shape having a short side and a long side that is longer than the short side,
A display device wherein the length of the through portion along the first direction is at least twice the length of a long side of each of the plurality of subpixels.
상기 복수의 부화소들 각각은 제1 방향으로 연장된 장변을 갖는 사각형상인, 디스플레이 장치.According to clause 15,
Each of the plurality of subpixels is a rectangular shape with a long side extending in a first direction.
상기 복수의 부화소들 각각은 모퉁이가 라운드진 사각형상인, 디스플레이 장치.According to clause 16,
A display device wherein each of the plurality of subpixels is a rectangular shape with rounded corners.
상기 제1 화소 내지 상기 제4 화소에 각각 포함된 상기 복수의 부화소들은 모두 동일한 방향으로 배열된, 디스플레이 장치.According to clause 15,
A display device wherein the plurality of subpixels included in each of the first to fourth pixels are arranged in the same direction.
상기 복수의 부화소들 각각은 인접한 상기 관통부와 평행하게 배치되는, 디스플레이 장치.According to clause 15,
A display device, wherein each of the plurality of subpixels is arranged parallel to the adjacent through portion.
상기 제1 화소 내지 상기 제4 화소는 상기 관통부를 기준으로 대칭적으로 배치되는, 디스플레이 장치.According to clause 15,
The first to fourth pixels are arranged symmetrically with respect to the through portion.
상기 제1 화소 및 상기 제3 화소, 상기 제2 화소 및 상기 제4 화소는 각각 상기 관통부를 기준으로 대각선으로 배치되며,
상기 제1 화소 및 상기 제3 화소에 포함된 상기 복수의 부화소들은 동일한 배열로 배치되고,
상기 제2 화소 및 상기 제4 화소에 포함된 상기 복수의 부화소들은 동일한 배열로 배치되고, 디스플레이 장치.According to clause 20,
The first pixel, the third pixel, the second pixel, and the fourth pixel are each arranged diagonally with respect to the through portion,
The plurality of subpixels included in the first pixel and the third pixel are arranged in the same arrangement,
The plurality of subpixels included in the second pixel and the fourth pixel are arranged in the same arrangement, and the display device.
상기 제1 화소 및 상기 제3 화소에 포함된 상기 복수의 부화소들과 상기 제2 화소 및 상기 제4 화소에 포함된 상기 복수의 부화소들은 서로 다른 배열로 배치되는, 디스플레이 장치.According to clause 21,
A display device, wherein the plurality of subpixels included in the first pixel and the third pixel and the plurality of subpixels included in the second pixel and the fourth pixel are arranged in different arrangements.
Priority Applications (1)
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Applications Claiming Priority (3)
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Related Parent Applications (1)
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Family Applications (2)
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2024
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Publication number | Publication date |
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Legal Events
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A107 | Divisional application of patent |