KR20230032481A - 3레그 인버터의 전류 불평형 개선 전원장치 - Google Patents

3레그 인버터의 전류 불평형 개선 전원장치 Download PDF

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Abstract

본 발명은 3레그 인버터의 전원장치에 관한 것으로서, 직류전압원과, 짝수개의 스플리트 커패시터들이 상호 직렬로 접속되어 있고 양단이 직류전압원과 병렬상으로 결선된 직류 분압부와, 직류전압원 또는 직류 분압부에서 방전되는 직류 전원을 3상 교류 전원으로 변환하여 출력하는 3레그형 인버터와, 인버터에서 부하단으로 출력되는 3상 교류 전원이 각 상마다 개별적으로 제어되도록 인버터에 포함된 스위칭 소자를 제어하는 제어 신호를 출력하는 인버터 제어기 및 인버터의 출력단의 중성점과 직류전압원의 전압의 1/2배가 되는 직류 분압부의 분압점 사이에 접속된 인덕터를 구비한다. 이러한 3레그 인버터의 전류 불평형 개선 전원장치에 의하면, 간단한 구조변경에 의해 전류 불평형을 개선할 수 있는 장점을 제공한다.

Description

3레그 인버터의 전류 불평형 개선 전원장치{current unbalance improvement power supply with 3-leg inverter}
본 발명은 3레그 인버터의 전류 불평형 개선 전원장치에 관한 것으로서, 상세하게는 기존 3레그 인버터에 대한 구조 개량이 간단하면서도 전류 불평형을 개선할 수 있는 전원장치에 관한 것이다.
현재 전력 송배전 시스템은 3상 3선식으로 구성되어 있으며, 대부분의 저압 수용가는 3상 불평형 부하에 대응하기 위해 델타-와이(Δ-Y )변압기를 이용한 3상 4선식 배전 시스템을 적용하고 있으며, 이러한 불평형 현상을 감소시키기 위해 내선규정에서는 중성 선과 각 전압 측 전선 간의 부하에서 평형이 되도록 하는 것을 원칙으로 한다. 또한, 배전방식에 따라 설비 불평형율을 일정 범위 이내로 제한하고 있다. 그러나 저압 수용가에서는 단상 부하나 비선형 부하 등으로 인하여 불평형율이 급속히 증가하고 있으며, 이 경우 중성 선으로 전류가 과대하게 흘러 기기의 출력 저하, 손실 증가 등 부하 또는 전원 측에 여러 가지 문제를 초래한다.
기존에 설치된 ESS(Energy Storage System)가 적용된 PCS(Power control system)는 3상 3선식 방식으로 보급되었으며, 불평형 문제에 대응하기 위해서는 PCS의 출력단 구조를 3상 4선식으로 구조를 변경하여야 한다. 델타-와이(Δ-Y) 변압기를 이용하는 방법은 시스템의 용량이 커질수록 변압기의 부피와 무게가 커지는 문제점 있다. 스플리트(Split) 커패시터 3-레그(Leg) 인버터는 구현이 쉽고 중성 선을 이용하여 불평형률을 개선할 수 있지만, DC-link의 전압 오차로 출력전압의 불균형과 왜율 증가라는 문제가 있다. 4-레그(Leg) 인버터는 국내 등록특허 제10-1815401호 등 다양하게 개시되어 있고, 스위칭 제어가 쉽고 DC-link 전압 이용률이 높으며 중성 선 전류를 완전히 제어할 수 있어 불평형 보상에 용이한 구조를 갖는다. 그러므로 4-레그(Leg) 인버터를 사용하는 것이 계통 불평형 보상에 좋은 방법이나 기존에 설치된 PCS를 4-레그(Leg) 인버터로 바꾸는 것은 어려움이 있고, PCS를 교체하기에는 비용이 너무 많이 발생한다는 문제가 있다.
따라서, 기존 3-레그(Leg) 인버터에 대해 구조 변경이 용이하면서도 전류 불평형을 개선할 수 있는 방식이 요구되고 있다.
본 발명은 상기와 같은 요구사항을 해결하기 위하여 창안된 것으로서, 3레그 3상 인버터에 대한 구조 변경이 용이하면서도 전류 불평형을 개선할 수 있는 3레그 인버터의 전류 불평형 개선 전원장치를 제공하는데 그 목적이 있다.
상기의 목적을 달성하기 위하여 본 발명에 따른 3레그 인버터의 전류 불평형 개선 전원장치는 직류전압원과; 적어도 2개 이상 짝수개의 스플리트 커패시터들이 상호 직렬로 접속되어 있고 양단이 상기 직류전압원과 병렬상으로 결선된 직류 분압부와; 상기 직류전압원 또는 상기 직류 분압부에서 방전되는 직류 전원을 3상 교류 전원으로 변환하여 출력하는 3레그형 인버터와; 상기 인버터에서 부하단으로 출력되는 3상 교류 전원이 각 상마다 개별적으로 제어되도록 상기 인버터에 포함된 스위칭 소자를 제어하는 제어 신호를 출력하는 인버터 제어기; 및 상기 인버터의 출력단의 중성점과 상기 직류전압원의 전압의 1/2배가 되는 상기 직류 분압부의 분압점 사이에 접속된 인덕터;를 구비한다.
상기 인버터 제어기는 위상동기루프 제어에 의해 상기 인버터로부터 상기 부하단으로 이어지는 전압의 위상값을 산출하는 PLL부와; 상기 인버터에서 출력되는 각 상 출력전류와 상기 위상값을 참조하여 DQ변환을 수행하는 제1abc/dq부와; 상기 부하단으로 흐르는 각 상 부하전류와 상기 인버터로부터 상기 부하단 사이의 전압 및 위상값을 참조하여 DQ변환을 수행하는 제2abc/dq부와; 상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하고, 상기 제1abc/dq부에서 DQ변환되어 출력되는 인버터 출력전류값과 상기 보상신호의 차를 줄이는 비례적분을 수행하여 보상제어값을 출력하는 보상처리부와; 상기 보상처리부에서 출력되는 보상제어값을 DQ역변환을 통하여 a, b, c 전압으로 변환하는 dq/abc 부; 및 상기 dq/abc 부에서 출력되는 a, b, c 전압 신호로부터 상기 인버터에 포함된 3레그의 각 스위칭 소자들의 온/오프를 제어하는 펄스폭 제어신호로 변환하여 출력하는 PWM 변환부;를 포함한다.
또한, 상기 보상처리부는 상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하여 출력하는 레퍼런스 산출부와; 상기 레퍼런스 산출부에서 출력되는 각 상의 d축 및 q축 보상신호에서 상기 제1abc/dq부에서 DQ변환되어 출력되는 각 상의 d축 및 q축 인버터 출력전류값을 차감하여 메인 차감신호를 출력하는 메인 차감기들과; 상기 메인차감기들에서 출력되는 메인 차감신호가 줄어드는 비례적분을 수행하는 메인 PI부;를 구비한다.
또한, 상기 스플리트 커패시터는 교류용 전해 커패시터가 적용될 수 있다.
바람직하게는 상기 레퍼런스 산출부는 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류로부터 d축 보상신호를 생성하여 상기 메인 차감기로 출력하는 d축 보상신호 생성부와; 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 대해 q축 에러신호를 생성하는 q축 에러신호 생성부와; 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류와 전압 및 상기 q축 에러신호로부터 q축 보상신호를 생성하여 상기 메인차감기로 출력하는 q축 보상신호 생성부;를 구비하고, 상기 d축 보상신호 생성부는 0으로 설정된 제1기준값에서 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 d축 부하전류를 차감하는 제1서브차감기와; 상기 제1서브차감기에서 출력되는 신호에 대해 비례적분을 수행하는 제1서브PI부; 및 상기 제1서브PI부에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 d축 보상신호로 출력되게 처리하는 제1리미터들;을 구비하고, 상기 q축 에러신호 생성부는 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 대해 평균전류값을 산출하는 부하전류 평균산출부와; 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 설정된 기준 가산전류를 합산하고, 상기 부하전류 평균산출부에서 산출된 평균전류값을 차감하여 출력하는 제2서브차감기들과; 상기 제2서브차감기들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 q축 에러신호로 출력되게 처리하는 제2리미터들;을 구비하고, 상기 q축 보상신호 생성부는 상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 각 상의 부하전력 에 대한 평균부하전력값을 산출하는 부하전력 평균산출부와; 상기 제2abc/dq부에서 DQ변환된 각 상의 부하전력 각각에서 상기 평균부하전력값을 차감하는 제3서브 차감기들과; 상기 제3서브차감기들 각각에서 출력되는 신호를 전류신호로 변환하는 변환기들과; 상기 변환기들에서 각각 출력되는 신호에서 상기 q축 에러신호를 차감하여 출력하는 제4차감기들과; 상기 제4차감기들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내로 q축 보상신호로 출력되게 처리하는 제3리미터들;을 구비한다.
본 발명에 따른 3레그 인버터의 전류 불평형 개선 전원장치에 의하면, 간단한 구조변경에 의해 전류 불평형을 개선할 수 있는 장점을 제공한다.
도 1은 본 발명의 일 실시예에 따른 3레그 인버터의 전류 불평형 개선 전원장치를 나타내 보인 도면이고,
도 2는 도 1의 레퍼런스 산출부의 d축 보상신호 생성부를 나타내 보인 도면이고,
도 3은 도 1의 레퍼런스 산출부의 q축 보상신호 생성부를 나타내 보인 도면이고,
도 4 및 도 5는 도 3의 q축 에러신호를 생성하는 q축 에러신호 생성부를 나타내 보인 도면이고,
도 6 및 도 7은 본 발명의 또 다른 실시예에 따른 3레그 인버터의 전류 불평형 개선 전원장치를 나타내 보인 도면이다.
이하, 첨부된 도면을 참조하면서 본 발명의 바람직한 실시예에 따른 3레그 인버터의 전류 불평형 개선 전원장치를 더욱 상세하게 설명한다.
도 1은 본 발명의 일 실시예에 따른 3레그 인버터의 전류 불평형 개선 전원장치를 나타내 보인 도면이다.
도 1을 참조하면, 본 발명에 따른 3레그 인버터의 전류 불평형 개선 전원장치(100)는 직류전압원(Vdc)(110), 직류 분압부(120), 인버터(130), 인덕터(150), 인버터 제어기(200)를 구비한다.
직류전압원(110)은 태양광 발전장치에서 생성되는 전력을 저장하는 ESS(Energy Storage System) 등 다양한 전압원이 적용될 수 있다.
직류분압부(120)는 2개의 스플리트 커패시터(121)(122)들이 상호 직렬로 접속되어 있고 상하의 양단이 직류전압원(110)과 병렬상으로 결선되어 있다. 도시된 예에서 직류 분압부(120)는 2개의 스플리트 커패시터(121)(122)가 적용되었고, 적용되는 스플리트 커패시터는 4개 이상 짝수개로 적용될 수 있음은 물론이다.
여기서, 스플리트 커패시터(121)(122)는 후술되는 중성점(N)으로부터 중선선(145)을 통한 교류전류의 원활한 충방전을 지원하기 위해 교류용 전해 커패시터가 적용되는 것이 바람직하다.
3레그형 인버터(130)는 직류전압원(110) 및 직류 분압부(120)와 병렬상으로 접속되어 직류전압원(110) 또는 직류 분압부(120)에서 방전되는 직류 전원을 3상 교류 전원으로 변환하여 출력한다. 인버터(130)는 3레그(leg) 형태로 6개의 스위칭 소자가 적용되어 있고, r상 출력선(141), s상 출력선(142) 및 t상 출력선(143)이 접속되어 있다.
중성선(145)은 인버터(130)의 출력단의 중성점(N)(144)과 직류전압원(110)의 전압의 1/2배가 되는 직류 분압부(120)의 분압점(n)(125) 사이에 접속되어 있다.
인덕터(150)는 중선선(145) 상에 직렬상으로 장착되어 있다. 인덕터(150)는 중선선(145)을 통해 흐르는 불평형 교류전류의 크기를 감쇄시켜 직류분압부(120)에 적용된 스플리트 커패시터(121)(122)의 전압 변동 크기를 억제시켜 전류 불평등에 대한 제어효율을 향상시킨다.
참조부호 160은 필터로 적용된 리액터이다.
인버터 제어기(200)는 인버터(130)에서 부하단(10)으로 출력되는 3상 교류 전원이 각 상마다 개별적으로 제어되도록 인버터(130)에 포함된 스위칭 소자를 제어하는 제어 신호를 출력한다.
인버터 제어기(200)는 PLL부(201), 제1abc/dq부(210), 제2abc/dq부(220), 보상처리부(230), dq/abc 부(250), PWM 변환부(260)를 구비한다.
PLL부(201)는 위상동기루프(PLL) 제어에 의해 인버터(130)로부터 부하단(10)으로 이어지는 전압(Vrs, Vss, Vts)의 위상값(θ)을 산출한다.
제1abc/dq부(210)는 인버터(130)에서 출력되는 각 상 출력전류(ir, is, it)의 크기와 위상값(θ)을 참조하여 d축과 q축의 회전좌표계로 DQ변환을 수행하여 출력한다.
제1abc/dq부(210)는 인버터(130)에서 출력되는 각 상의 출력 전압을 입력받고, 90도 위상이 지연된 상 전압의 α,β 성분을 출력하는 전역통과필터를 적용하여 DQ변환을 수행하도록 구축되어 있다.
제2abc/dq부(220)는 부하단(10)으로 흐르는 각 상 부하전류(igrid_r, igrid_s, igrid_t)와 인버터(130)로부터 부하단(10) 사이의 전압전압(Vrs, Vss, Vts) 및 위상값(θ)을 참조하여 DQ변환을 수행하여 출력한다.
보상처리부(230)는 제2abc/dq부(220)에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하고, 제1abc/dq부(210)에서 DQ변환되어 출력되는 인버터 출력전류값과 보상신호의 차를 줄이는 비례적분을 수행하여 보상제어값을 출력한다.
보상처리부(230)는 레퍼런스 산출부(Reference Calculator)(240)와, 메인 차감기들(250)과, 메인 PI부(250)를 구비한다.
레퍼런스 산출부(240)는 제2abc/dq부(220)에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하여 출력하고, 도 2 내지 도 5를 함께 참조하여 설명한다.
레퍼런스 산출부(240)는 도 2에 도시된 d축 보상신호 생성부(241)와, 도 3에 도쇠된 q축 보상신호 생성부(243) 및 도 4 및 도 5에 도시된 q축 에러신호 생성부(245)를 구비한다.
d축 보상신호 생성부(241)는 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 부하전류로부터 d축 보상신호를 생성하여 각 상별로 대응되는 메인 차감기(250)에 각각 출력한다.
d축 보상신호 생성부(241)는 0(zero)으로 설정된 제1기준값에서 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 d축 부하전류(i_grid_r_dq_d, i_grid_s_dq_d, i_grid_t_dq_d)를 차감하는 제1서브차감기들(241a)과, 제1서브차감기(241a)들 각각에서 출력되는 신호에 대해 비례적분을 수행하는 제1서브PI(241b) 및 제1서브PI부(241b)에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 d축 보상신호로 출력되게 처리하는 제1리미터(241)들로 각 상별로 독립되게 구축되어 있다.
q축 에러신호 생성부(245)는 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 부하전류(i_grid_r, i_grid_s, i_grid_t)에 대해 q축 에러신호(iref-r_err_dq_q, iref-s_err_dq_q, iref-t_err_dq_q)를 생성하며 도 4 및 도 5를 함께 참조하여 설명한다.
q축 에러신호 생성부(245)는 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 부하전류에 대해 평균전류값을 산출하는 부하전류 평균산출부(245a)와, 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 부하전류에 설정된 기준 가산전류(Igen 또는 Ichg)를 합산하고, 부하전류 평균산출부(245a)에서 산출된 평균전류값을 차감하여 출력하는 제2서브차감기(245b)들과, 제2서브차감기(245b)들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 q축 에러신호로 출력되게 처리하는 제2리미터(245c)들이 각 상별로 독립되게 마련되어 있다.
여기서 기준 가산전류는 방전시에 Igen 충전시에 Ichg로 구별되게 설정될 수 있다.
q축 보상신호 생성부(243)는 도 3에 도시된 바와 같이 제2abc/dq부(220)에서 DQ변환되어 출력된 각 상의 부하전류와 전압 및 앞서 q축 에러신호 생성부(245)에서 생성된 q축 에러신호로부터 q축 보상신호를 생성하여 대응되는 메인차감기(250)로 출력한다.
q축 보상신호 생성부(243)는 부하전력 평균산출부(243a), 제3서브 차감기들(243b), 변환기들(243c), 제4차감기들(243d) 및 제3리미터(243e)들을 구비한다.
부하전력 평균산출부(243a)는 제2abc/dq부(220)에서 DQ변환된 부하전류 및 전압으로부터 각 상의 부하전력(Pgrid_r, Pgrid_s, Pgrid_t)에 대한 평균부하전력값(Pgrid_avg)을 산출한다.
제3서브 차감기(243b)들은 제2abc/dq부(220)에서 DQ변환된 각 상의 부하전력 각각에서 평균부하전력값을 차감하여 출력한다.
변환기(243c)들은 제3서브차감기(243b)들 각각에서 출력되는 신호를 전류신호로 변환한다. 변환기는 제3서브차감기(243b)들 각각에서 출력되는 신호에 전류신호로 변환하기 위한 제산값을 승산하여 출력하도록 구축되어 있다.
제4차감기(243d)들은 변환기(243c)들에서 각각 출력되는 신호에서 q축 에러신호를 차감하여 출력한다.
제3리미터(243e)들은 제4차감기(243d)들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내로 q축 보상신호로 출력되게 처리한다.
메인 차감기(250)들은 6개가 마련되어 3상 각각에 대해 레퍼런스 산출부(240)에서 출력되는 각 상의 d축 및 q축 보상신호에서 제1abc/dq부(210)에서 DQ변환되어 출력되는 각 상의 d축 및 q축 인버터 출력전류값을 차감하여 메인 차감신호를 출력하도록 되어 있다.
메인 PI부(260)는 메인차감기(250)들에서 출력되는 메인 차감신호가 줄어드는 비례적분을 수행하여 출력한다.
dq/abc 부(270)는 보상처리부(230)에서 출력되는 보상제어값을 DQ역변환을 통하여 각 상에 대응되는 a, b, c 전압으로 변환한다.
PWM 변환부(270)는 dq/abc 부(270)에서 출력되는 a, b, c 전압 신호(Vrs*, Vss*, Vts*)로부터 인버터(130)에 포함된 3레그의 각 스위칭 소자들의 온/오프를 제어하는 펄스폭 제어신호로 변환하여 출력한다.
이러한 인버터 제어기(200)에 의해 전류 불평형이 최소화될 수 있도록 제어되고, 이 과정에서 중선선(145)을 통해 흐르는 불평형 전류에 대한 스플리트 커패시터(121)(122)의 순간 전압변동이 인덕터(150)에 의해 억제되도록 처리됨으로써 불평형 전류를 억제하는 제어효율을 향상시킬 수 있다.
이러한 전원장치(100)는 도 6 및 도 7과 같이 LC필터를 적용하는 구조 또는 델타-와이(Δ-Y )변압기를 적용하는 전력공급구조에도 동일하게 적용될 수 있음은 물론이다.
이상에서 설명된 3레그 인버터의 전류 불평형 개선 전원장치에 의하면, 3레그 스플리트 커패시터 적용 인버터에 대해 인덕터가 적용된 중선선과 교류 전해커패시터를 적용하는 간단한 구조변경에 의해 전류 불평형을 개선할 수 있는 장점을 제공한다.
1110: 직류전압원 120: 직류 분압부
130: 인버터 150: 인덕터
200: 인버터 제어기

Claims (5)

  1. 직류전압원과;
    적어도 2개 이상 짝수개의 스플리트 커패시터들이 상호 직렬로 접속되어 있고 양단이 상기 직류전압원과 병렬상으로 결선된 직류 분압부와;
    상기 직류전압원 또는 상기 직류 분압부에서 방전되는 직류 전원을 3상 교류 전원으로 변환하여 출력하는 3레그형 인버터와;
    상기 인버터에서 부하단으로 출력되는 3상 교류 전원이 각 상마다 개별적으로 제어되도록 상기 인버터에 포함된 스위칭 소자를 제어하는 제어 신호를 출력하는 인버터 제어기; 및
    상기 인버터의 출력단의 중성점과 상기 직류전압원의 전압의 1/2배가 되는 상기 직류 분압부의 분압점 사이에 접속된 인덕터;를 구비하는 것을 특징으로 하는 3레그 인버터의 전원장치.
  2. 제1항에 있어서, 상기 인버터 제어기는
    위상동기루프 제어에 의해 상기 인버터로부터 상기 부하단으로 이어지는 전압의 위상값을 산출하는 PLL부와;
    상기 인버터에서 출력되는 각 상 출력전류와 상기 위상값을 참조하여 DQ변환을 수행하는 제1abc/dq부와;
    상기 부하단으로 흐르는 각 상 부하전류와 상기 인버터로부터 상기 부하단 사이의 전압 및 위상값을 참조하여 DQ변환을 수행하는 제2abc/dq부와;
    상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하고, 상기 제1abc/dq부에서 DQ변환되어 출력되는 인버터 출력전류값과 상기 보상신호의 차를 줄이는 비례적분을 수행하여 보상제어값을 출력하는 보상처리부와;
    상기 보상처리부에서 출력되는 보상제어값을 DQ역변환을 통하여 a, b, c 전압으로 변환하는 dq/abc 부; 및
    상기 dq/abc 부에서 출력되는 a, b, c 전압 신호로부터 상기 인버터에 포함된 3레그의 각 스위칭 소자들의 온/오프를 제어하는 펄스폭 제어신호로 변환하여 출력하는 PWM 변환부;를 포함하는 것을 특징으로 하는 3레그 인버터의 전원장치.
  3. 제2항에 있어서, 상기 보상처리부는
    상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 불평형 요소에 대한 보상신호를 산출하여 출력하는 레퍼런스 산출부와;
    상기 레퍼런스 산출부에서 출력되는 각 상의 d축 및 q축 보상신호에서 상기 제1abc/dq부에서 DQ변환되어 출력되는 각 상의 d축 및 q축 인버터 출력전류값을 차감하여 메인 차감신호를 출력하는 메인 차감기들과;
    상기 메인차감기들에서 출력되는 메인 차감신호가 줄어드는 비례적분을 수행하는 메인 PI부;를 구비하는 것을 특징으로 하는 3레그 인버터의 전원장치.
  4. 제2항에 있어서, 상기 스플리트 커패시터는 교류용 전해 커패시터가 적용된 것을 특징으로 하는 3레그 인버터의 전원장치.
  5. 제3항에 있어서, 상기 레퍼런스 산출부는
    상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류로부터 d축 보상신호를 생성하여 상기 메인 차감기로 출력하는 d축 보상신호 생성부와;
    상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 대해 q축 에러신호를 생성하는 q축 에러신호 생성부와;
    상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류와 전압 및 상기 q축 에러신호로부터 q축 보상신호를 생성하여 상기 메인차감기로 출력하는 q축 보상신호 생성부;를 구비하고,
    상기 d축 보상신호 생성부는
    0으로 설정된 제1기준값에서 상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 d축 부하전류를 차감하는 제1서브차감기와;
    상기 제1서브차감기에서 출력되는 신호에 대해 비례적분을 수행하는 제1서브PI부; 및
    상기 제1서브PI부에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 d축 보상신호로 출력되게 처리하는 제1리미터들;을 구비하고,
    상기 q축 에러신호 생성부는
    상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 대해 평균전류값을 산출하는 부하전류 평균산출부와;
    상기 제2abc/dq부에서 DQ변환되어 출력된 각 상의 부하전류에 설정된 기준 가산전류를 합산하고, 상기 부하전류 평균산출부에서 산출된 평균전류값을 차감하여 출력하는 제2서브차감기들과;
    상기 제2서브차감기들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내에서 q축 에러신호로 출력되게 처리하는 제2리미터들;을 구비하고,
    상기 q축 보상신호 생성부는
    상기 제2abc/dq부에서 DQ변환된 부하전류 및 전압으로부터 각 상의 부하전력 에 대한 평균부하전력값을 산출하는 부하전력 평균산출부와;
    상기 제2abc/dq부에서 DQ변환된 각 상의 부하전력 각각에서 상기 평균부하전력값을 차감하는 제3서브 차감기들과;
    상기 제3서브차감기들 각각에서 출력되는 신호를 전류신호로 변환하는 변환기들과;
    상기 변환기들에서 각각 출력되는 신호에서 상기 q축 에러신호를 차감하여 출력하는 제4차감기들과;
    상기 제4차감기들에서 각각 출력되는 신호에 대해 설정된 상한과 하한 범위내로 q축 보상신호로 출력되게 처리하는 제3리미터들;을 구비하는 것을 특징으로 하는 3레그 인버터의 전원장치.

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