KR20220096549A - Stepped fm modulated pulse signal count for synthetic aperture radar system - Google Patents

Stepped fm modulated pulse signal count for synthetic aperture radar system Download PDF

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KR20220096549A KR1020200189105A KR20200189105A KR20220096549A KR 20220096549 A KR20220096549 A KR 20220096549A KR 1020200189105 A KR1020200189105 A KR 1020200189105A KR 20200189105 A KR20200189105 A KR 20200189105A KR 20220096549 A KR20220096549 A KR 20220096549A
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신승하
최문석
최영우
강재구
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Abstract

The present invention relates to a step-modulation pulse signal count for a radar system. A radar system including an RF transmission unit having a transmission pulse check circuit comprises: a transmission driving module including an output unit for outputting an RF signal composed of long pulses and short pulses and a DAM transmission engine for outputting a timing signal earlier than the RF output by a first set time; and an up-conversion module for driving an LED indicating normality or abnormality by processing two different pairs of RFs with three input bits and one output bit, wherein the DAM transmission engine of the transmission driving module includes a reception check mode for outputting a signal inverted from an operation model when the timing signal is output, and the up-conversion module delays the first set time by more than 10 times and determines whether the short pulses and long pulses are normal or abnormal using delay logic. According to the present invention, the step-modulation pulse signal count for a radar system can drive a check LED by detecting missed transmission pulses.

Description

레이더 시스템을 위한 스텝 변조 펄스 신호 계수{STEPPED FM MODULATED PULSE SIGNAL COUNT FOR SYNTHETIC APERTURE RADAR SYSTEM}STEPPED FM MODULATED PULSE SIGNAL COUNT FOR SYNTHETIC APERTURE RADAR SYSTEM

본 발명은 레이더 시스템을 위한 스텝 변조 펄스 신호 계수에 관한 것이다.The present invention relates to step modulated pulse signal counting for radar systems.

레이더는 사용하는 전파에 따라 크게 연속파 레이더와 펄스파 레이더로 구분할 수 있다. 연속파 레이더는 특정 주파수의 진폭이 변하지 않는 전파를 연속적으로 방사하는 것을 말하고 펄스파 레이더는 특정 주파수에 진폭이 순간 커졌다가 다시 되돌아오는 전파를 단시간 방사하는 것을 말한다.Radar can be largely divided into continuous wave radar and pulse wave radar depending on the radio waves used. Continuous wave radar refers to continuously radiating radio waves whose amplitude does not change at a specific frequency, while pulse wave radar refers to radiating radio waves whose amplitude increases instantaneously at a specific frequency and returns for a short time.

펄스파를 사용하는 레이더는 일순간 진폭이 다른 파를 방사하기에 언제 반사파가 돌아왔는지 알수 있어 손쉽게 상대까지의 거리를 측정할 수 있다. 여기에 도플러 효과를 이용하여 상대의 속도, 고도같은 3차원 정보뿐만 아니라 지형지물에 의한 노이즈까지 제거할 수 있다. 하지만 고출력의 펄스파를 만드는 것이 어렵고 웜업이 필요로 하며 연속파에 비해 분해능이 낮은 문제점이 있다.Radar that uses pulse waves emits waves with different amplitudes in an instant, so you can easily measure the distance to the opponent by knowing when the reflected wave has returned. Here, by using the Doppler effect, not only 3D information such as the opponent's speed and altitude, but also noise caused by the terrain can be removed. However, there are problems in that it is difficult to make a high-power pulse wave, a warm-up is required, and the resolution is lower than that of a continuous wave.

연속파 레이더는 주파수도 진폭도 같은 전파를 발생시켜서 그 반사파를 검출하는 방식으로 계속 똑같은 전파가 지속적으로 들어오기 때문에 반사파가 언제 돌아왔는지 측정할 수 없다는 단점이 있다. 따라서, 연속파 레이더는 물체 사이의 거리를 측정하기 어려운 문제점이 있다.Continuous wave radar has a disadvantage in that it cannot measure when the reflected wave returns because the same radio wave continuously comes in by generating radio waves with the same frequency and amplitude and detecting the reflected wave. Accordingly, the continuous wave radar has a problem in that it is difficult to measure the distance between the objects.

레이더 시스템의 송신 구동 조립체는 다이버시티 방식을 사용하므로 2개의 가변 펄스가 한쌍으로 운용되며 장비의 특성상 각 회로카드의 LED를 사용하여 정상 및 고장을 표시해야 한다.Since the transmission driving assembly of the radar system uses the diversity method, two variable pulses are operated as a pair, and due to the characteristics of the equipment, normal and faulty conditions must be indicated using the LED of each circuit card.

송신 펄스가 누락되어 수신되는 문제점을 해결해야할 필요가 있다.There is a need to solve the problem that the transmission pulse is missing and received.

대한민국 등록 공고 제10-1320508호Republic of Korea Registration Notice No. 10-1320508 대한민국 등록 공고 제10-1437747호Republic of Korea Registration Notice No. 10-1437747

본 발명은 상기와 같은 문제점을 해결하기 위해 누락된 송신 펄스를 감지하여 점검 LED를 구동할 수 있는 레이더 시스템을 위한 스텝 변조 펄스 신호 계수를 제공하는 것을 목적으로 한다.An object of the present invention is to provide a step-modulated pulse signal coefficient for a radar system capable of driving a check LED by detecting a missing transmission pulse in order to solve the above problems.

본 발명은, 송신 펄스 점검 회로를 포함하는 RF 송신부를 포함하는 레이더 시스템의 에 있어서,The present invention relates to a radar system including an RF transmitter including a transmit pulse check circuit,

장펄스와 단펄스로 구성된 RF 신호를 출력부 및 상기 RF 출력보다 제1설정 시간 빠른 타이밍 신호를 출력하는 DAM 송신엔진을 포함하는 송신구동모듈; 및a transmission driving module including an output unit for outputting an RF signal composed of a long pulse and a short pulse and a DAM transmission engine for outputting a timing signal earlier than the RF output by a first set time; and

3개의 입력 BIT와 1개의 출력 BIT로 서로 다른 2개 쌍의 RF를 처리하여 정상 여부를 표시하는 LED를 구동하는 상향변환모듈;을 포함하고,It includes; an up-conversion module that processes two different pairs of RF with three input BIT and one output bit and drives an LED indicating whether it is normal or not;

상기 송신구동모듈의 상기 DAM 송신엔진은 상기 타이밍 신호 출력 시 운용 모드와 반전되는 신호를 출력하는 수신 점검 모드를 포함하고,The DAM transmission engine of the transmission driving module includes a reception check mode for outputting a signal reversed from an operation mode when the timing signal is output,

상기 상향변환모듈은 제1설정시간을 10배 이상 지연시키고, 지연 로직을 이용하여 단펄스와 장펄스의 정상 유무를 판변하는 것을 특징으로 하는 레이더 시스템을 위한 스텝 변조 펄스 신호 계수를 제공한다.The up-conversion module provides a step-modulated pulse signal coefficient for a radar system, characterized in that it delays the first set time by 10 times or more, and determines whether short pulses and long pulses are normal using delay logic.

본 발명의 실시예에 따르면 누락된 송신 펄스를 감지하여 점검 LED를 구동할 수 있는 합성 개구 레이더 시스템을 위한 스텝 변조 펄스 신호 계수를 제공할 수 있다.According to an embodiment of the present invention, it is possible to provide a step-modulated pulse signal coefficient for a synthetic aperture radar system capable of driving a check LED by detecting a missing transmit pulse.

도 1 은 본 발명에 따른 레이더 시스템의 송신타이밍을 나타낸 도면이다.
도 2 는 도 2 는 1개의 송신구동모듈(DAM)과 4개의 RF 발생부의 타이밍 신호를 나타낸 도면이다.
도 3 은 수신 점검 모드를 확대하여 나타낸 도면이다.
도 4 는 LOG 디텍터/컨트롤러인 AD8317의 구성을 나타내는 회로도이다.
도 5 및 7은 테스트 회로를 각각 나타낸다.
도 6 및 8은 도 5 및 7의 테스트 회로의 0.1μs 펄스 시험 결과를 각각 나타낸 도면이다.
도 9 는 본 발명의 실시예에 따른 UCM의 개념도이다.
도 10은 UCM LED 구동 회로를 나타낸 도면이다.
도 11은 도 10의 UCM LED 구동회로 동작을 나타낸 그래프이다.
도 12는 74HCT221의 지연을 나타내는 그래프이다.
1 is a diagram illustrating a transmission timing of a radar system according to the present invention.
FIG. 2 is a diagram illustrating timing signals of one transmission driving module (DAM) and four RF generators.
3 is an enlarged view showing a reception check mode.
4 is a circuit diagram showing the configuration of AD8317, which is a LOG detector/controller.
5 and 7 show a test circuit, respectively.
6 and 8 are diagrams showing 0.1 μs pulse test results of the test circuits of FIGS. 5 and 7, respectively.
9 is a conceptual diagram of UCM according to an embodiment of the present invention.
10 is a diagram illustrating a UCM LED driving circuit.
11 is a graph showing the operation of the UCM LED driving circuit of FIG.
12 is a graph showing the delay of 74HCT221.

본 명세서에 개시되어 있는 본 발명의 개념에 따른 실시예들에 대해서 특정한 구조적 또는 기능적 설명들은 단지 본 발명의 개념에 따른 실시예들을 설명하기 위한 목적으로 예시된 것으로서, 본 발명의 개념에 따른 실시예들은 다양한 형태로 실시될 수 있으며 본 명세서에 설명된 실시예들에 한정되지 않는다.Specific structural or functional descriptions of the embodiments according to the concept of the present invention disclosed in this specification are only exemplified for the purpose of explaining the embodiments according to the concept of the present invention, and the embodiment according to the concept of the present invention These may be embodied in various forms and are not limited to the embodiments described herein.

본 발명의 개념에 따른 실시예들은 다양한 변경들을 가할 수 있고 여러 가지 형태들을 가질 수 있으므로 실시예들을 도면에 예시하고 본 명세서에 상세하게 설명하고자 한다. 그러나, 이는 본 발명의 개념에 따른 실시예들을 특정한 개시형태들에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 변경, 균등물, 또는 대체물을 포함한다.Since the embodiments according to the concept of the present invention may have various changes and may have various forms, the embodiments will be illustrated in the drawings and described in detail herein. However, this is not intended to limit the embodiments according to the concept of the present invention to specific disclosed forms, and includes changes, equivalents, or substitutes included in the spirit and scope of the present invention.

제1 또는 제2 등의 용어를 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만, 예를 들어 본 발명의 개념에 따른 권리 범위로부터 이탈되지 않은 채, 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소는 제1 구성요소로도 명명될 수 있다.Terms such as first or second may be used to describe various elements, but the elements should not be limited by the terms. The above terms are used only for the purpose of distinguishing one component from other components, for example, without departing from the scope of rights according to the concept of the present invention, a first component may be named a second component, Similarly, the second component may also be referred to as the first component.

어떤 구성요소가 다른 구성요소에 "연결되어" 있다거나 "접속되어" 있다고 언급된 때에는, 그 다른 구성요소에 직접적으로 연결되어 있거나 또는 접속되어 있을 수도 있지만, 중간에 다른 구성요소가 존재할 수도 있다고 이해되어야 할 것이다. 반면에, 어떤 구성요소가 다른 구성요소에 "직접 연결되어" 있다거나 "직접 접속되어" 있다고 언급된 때에는, 중간에 다른 구성요소가 존재하지 않는 것으로 이해되어야 할 것이다. 구성요소들 간의 관계를 설명하는 표현들, 예를 들어 "~사이에"와 "바로~사이에" 또는 "~에 직접 이웃하는" 등도 마찬가지로 해석되어야 한다.When a component is referred to as being “connected” or “connected” to another component, it may be directly connected or connected to the other component, but it is understood that other components may exist in between. it should be On the other hand, when it is said that a certain element is "directly connected" or "directly connected" to another element, it should be understood that the other element does not exist in the middle. Expressions describing the relationship between elements, for example, “between” and “between” or “directly adjacent to”, etc. should be interpreted similarly.

본 명세서에서 사용한 용어는 단지 특정한 실시예들을 설명하기 위해 사용된 것으로, 본 발명을 한정하려는 의도가 아니다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다. 본 명세서에서, "포함하다" 또는 "가지다" 등의 용어는 설시된 특징, 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것이 존재함으로 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.The terminology used herein is used only to describe specific embodiments, and is not intended to limit the present invention. The singular expression includes the plural expression unless the context clearly dictates otherwise. In the present specification, terms such as "comprise" or "have" are intended to designate that the described feature, number, step, operation, component, part, or combination thereof exists, and includes one or more other features or numbers, It should be understood that the possibility of the presence or addition of steps, operations, components, parts or combinations thereof is not precluded in advance.

다르게 정의되지 않는 한, 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 모든 용어들은 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미를 가진다. 일반적으로 사용되는 사전에 정의되어 있는 것과 같은 용어들은 관련 기술의 문맥상 가지는 의미와 일치하는 의미를 갖는 것으로 해석되어야 하며, 본 명세서에서 명백하게 정의하지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않는다.Unless defined otherwise, all terms used herein, including technical or scientific terms, have the same meaning as commonly understood by one of ordinary skill in the art to which this invention belongs. Terms such as those defined in a commonly used dictionary should be interpreted as having a meaning consistent with the meaning in the context of the related art, and should not be interpreted in an ideal or excessively formal meaning unless explicitly defined in the present specification. does not

이하, 실시예들을 첨부된 도면을 참조하여 상세하게 설명한다. 그러나, 특허출원의 범위가 이러한 실시예들에 의해 제한되거나 한정되는 것은 아니다. 각 도면에 제시된 동일한 참조 부호는 동일한 부재를 나타낸다.Hereinafter, embodiments will be described in detail with reference to the accompanying drawings. However, the scope of the patent application is not limited or limited by these embodiments. Like reference numerals in each figure indicate like elements.

본 발명의 실시예에 따른 스텝 변조 펄스 신호 계수를 위한 송신부는 1개의 송신구동모듈(DAM)과 4개의 RF 발생부인 상향변환모듈(UCM), WGM, 기준신호합성모듈(SGM),LSM을 포함한다. 이하 도 1 및 2를 참조하여 본 발명의 실시예에 따른 송신 타이밍을 설명하기로 한다.The transmitter for step-modulated pulse signal counting according to an embodiment of the present invention includes one transmission drive module (DAM) and four RF generators, an up-conversion module (UCM), WGM, reference signal synthesis module (SGM), and LSM. do. Hereinafter, a transmission timing according to an embodiment of the present invention will be described with reference to FIGS. 1 and 2 .

도 1 은 레이더 시스템을 위한 송신 타이밍을 나타낸다. TXPW가 최종 출력 신호를 나타낸다. 도 2 는 1개의 송신구동모듈(DAM)과 4개의 RF 발생부의 타이밍 신호를 나타내고, 도 3 은 수신 점검 모드를 확대하여 나타낸 도면이다.1 shows transmission timing for a radar system. TXPW represents the final output signal. FIG. 2 shows timing signals of one transmission driving module (DAM) and four RF generators, and FIG. 3 is an enlarged view showing the reception check mode.

모든 타이밍 신호는 최종 출력신호보다 1μ초 먼저 시작한다. 출력신호는 장펄스(LP)와 단펄스(SP)로 구성된다. 장펄스와 단펄스는 가변펄스이고, 장펄스의 평균값은 86μ초, 단펄스의 가변범위는 0.1μ초 ~ 7μ초이다.All timing signals start 1 μsec before the final output signal. The output signal is composed of a long pulse (LP) and a short pulse (SP). The long and short pulses are variable pulses. The average value of the long pulses is 86 μs, and the variable range of the short pulses is 0.1 μs to 7 μs.

기준신호합성모듈(SGM)로부터 상향변환모듈(UCM)로 STALO3 신호가 공급되며 도 2의 기준신호합성모듈(SGM)의 타이밍 신호와 같이 동작되며, 기준신호합성모듈(SGM)의 RF 출력 지연은 약 600n초이다. UCM은 장펄스와 단펄스의 조합에 의해 도 2에 도시된 UCM의 타이밍 신호와 같이 동작되며, 내부적으로 장펄스와 단펄스의 선택에 의하여 필터가 절제된다.The STALO3 signal is supplied from the reference signal synthesis module (SGM) to the upconversion module (UCM) and operates like the timing signal of the reference signal synthesis module (SGM) of FIG. 2, and the RF output delay of the reference signal synthesis module (SGM) is about 600 n seconds. The UCM operates like the timing signal of the UCM shown in FIG. 2 by a combination of a long pulse and a short pulse, and the filter is cut internally by selecting the long pulse and the short pulse.

DAM은 도 3에 도시되는 바와 같이 수신점검모드를 포함한다. 수신점검모드는 다음 표 1과 같이 구동된다.The DAM includes a reception check mode as shown in FIG. 3 . The reception check mode is driven as shown in Table 1 below.

Figure pat00001
Figure pat00001

도 4 는 LOG 디텍터/컨트롤러인 AD8317의 구성을 나타내는 회로도이고, 표2는 AD8317 사용 조건을 나타낸다.4 is a circuit diagram showing the configuration of AD8317, which is a LOG detector/controller, and Table 2 shows the AD8317 usage conditions.

Figure pat00002
Figure pat00002

단펄스의 최소폭은 0.1μs이고, 0.1us의 펄스 입력 시 AD8317 로그 디텍터의 VSET 기능을 이용하여 로직 IC를 구동하기 위한 충분한 레벨로 출력되어야 한다.The minimum width of a short pulse is 0.1μs, and when a pulse of 0.1us is input, it should be output at a level sufficient to drive a logic IC using the VSET function of the AD8317 log detector.

0.1us의 펄스에서 AD8317의 출력이 CMOS IC의 입력 조건에 부합할 수 있도록 R값을 결정하기 위하여 도 5에 도시된 바과 같이 테스트 회로를 구성하여 테스트를 실시한다. 도 6은 도 5의 테스트 회로의 0.1μs 펄스 시험 결과를 나타낸 도면이다.In order to determine the R value so that the output of the AD8317 can meet the input condition of the CMOS IC at a pulse of 0.1us, a test circuit is constructed as shown in FIG. 5 and a test is performed. 6 is a view showing a 0.1 μs pulse test result of the test circuit of FIG. 5 .

도시된 바와 같이, AD8317의 4번 핀의 전압을 1.1V로 세팅하면 입력주파수 6.8GHz CW기준약-41dBm에서 “H”가 검출된다. 도 6에 도시된 바와 같이, MM74HC541MIC가 CMOS IC임에도 AD8317의 4번 pin VSET값이 낮은 레벨로 설정될 경우 AD8317 입력 레벨이 VSET값으로 근접할수록 펄스 폭의 변형이 생긴다. 도 6의 오렌지색 라인은 AD8317의 출력을 나타내고, 녹색 라인은 MM74HC541MIC의 출력을 나타낸다. 이러한 문제는 다음과 같이 회로카드에 문제를 발생시키고 회로 설계에 제약을 가한다. 먼저, 운용 최소 펄스 폭은 0.1us이며, 0.1us펄스에 낮은 레벨 입력일수록 AD8317 Log Detector의 출력 펄스 폭은 좁아진다. 도 6에 도시된 바와같이, 좁아진 펄스폭으로 인하여 LED 구동회로의 CMOS IC의 입력 레인지가 좁아지는 문제점이 있고, 이로 인하여 0.1us펄스 운용 시 RF 레벨 점검 신호의 분해능이 불분명해지는 문제점이 있어 펄스가 CMOS IC에서 동작을 못하는 문제점이 있다.As shown, if the voltage of pin 4 of AD8317 is set to 1.1V, “H” is detected at about -41dBm of input frequency 6.8GHz CW standard. As shown in FIG. 6 , even though the MM74HC541MIC is a CMOS IC, when the VSET value of pin 4 of AD8317 is set to a low level, the pulse width is deformed as the AD8317 input level approaches the VSET value. The orange line in Fig. 6 represents the output of the AD8317, and the green line represents the output of the MM74HC541MIC. These problems cause problems in circuit cards as follows and impose restrictions on circuit design. First, the minimum operating pulse width is 0.1us, and the output pulse width of AD8317 Log Detector becomes narrower as a low level input to 0.1us pulse becomes. As shown in FIG. 6 , there is a problem in that the input range of the CMOS IC of the LED driving circuit is narrowed due to the narrowed pulse width, and due to this, there is a problem in that the resolution of the RF level check signal becomes unclear during 0.1us pulse operation. There is a problem that the CMOS IC cannot operate.

도 6에 도시되는 바와 같이 오른쪽에 MM74HC541의 출력이 AD8317에 입력-28dBm에서 정상적인 동작을 하지 못하는 데 비해, 330Ω의 저항을 도 7에 도시되는 바와 같이 추가할 경우, 도 8에 도시되는 바와 같이, MM74HC541의 출력이 AD8317에 입력-37dBm에서 정상적인 동작을 한다.As shown in Figure 6, when the output of MM74HC541 on the right does not operate normally at -28dBm input to AD8317, when a resistance of 330Ω is added as shown in Figure 7, as shown in Figure 8, The output of MM74HC541 operates normally at -37dBm input to AD8317.

입출력 점검회로의 구성에 Coupler및 감쇠기를 사용하면, 도 5의 왼쪽의 시험결과 로직IC의 “L”레벨 검출 영역이 더 높은 RF 레벨입력에서 “L”의 영역이 되기 때에 입출력이 0.1us +5dBm에서 -10dBc이상에서 이상신호를 검출하는 회로를 구성하는 것이 어렵다. 도 7의 회로에서는 CW기준의 “L” 영역과 0.1usRF펄스폭의 “L”의 차이가 약 3dBc차이가 나므로 충분히 위의 조건의 검출회로에서 사용할 수 있다.When a coupler and an attenuator are used in the configuration of the input/output check circuit, the input/output is 0.1us +5dBm when the “L” level detection area of the logic IC becomes the “L” area at the higher RF level input as a result of the test on the left side of FIG. It is difficult to construct a circuit that detects an abnormal signal at -10dBc or higher. In the circuit of FIG. 7, the difference between the “L” region of the CW standard and the “L” of the 0.1usRF pulse width is about 3dBc, so it can be sufficiently used in the detection circuit under the above conditions.

도 9 는 본 발명의 실시예에 따른 UCM의 개념도이다. 도시되는 바와같이, 3개의 입력 BIT와 1개의 출력 BIT를 가지고. 서로 다른 2개쌍의 RF 펄스를 처리하여 정상 고장 유무를 LED로 표시하게 된다. 가장 짧은 펄스는 0.1us이다.9 is a conceptual diagram of UCM according to an embodiment of the present invention. As shown, with 3 input BIT and 1 output BIT. By processing two different pairs of RF pulses, the LED indicates whether there is a normal fault. The shortest pulse is 0.1us.

점검 LED 구동 회로는 다음 조건을 만족시켜야 한다. 전원 ON, 대기모드에서 정상상태를 표시하여야 한다(STALO1만 신호입력 되고 모든 신호 OFF). 단펄스와 장펄스 중 1개라도 이상이 있을 경우 고장 표시를 한다. 입출력 RF 기준으로 -10dBc이상 레벨이 떨어지면 고장으로 표시한다. 단펄스와 장펄스 모두 최소 펄스 폭이 0.1us이상에서도 정상적으로 LED구동회로가 동작해야 한다. AD8317시험결과에 의하여 LED 구동 회로의 입력 로직IC는 CMOS IC를 사용하여야 한다. 아래 표 3은 TTL 입력 조건이고, 표 4는 CMOS 입력조건이다.The check LED driving circuit must satisfy the following conditions. Normal status should be displayed in power ON and standby mode (only STALO1 signal is input and all signals are OFF). If there is an error in at least one of the short pulse and the long pulse, a fault is indicated. If the level falls by more than -10dBc based on input/output RF, it is indicated as a failure. For both short and long pulses, the LED driving circuit should operate normally even when the minimum pulse width is 0.1us or more. According to the AD8317 test result, the input logic IC of the LED driving circuit should use a CMOS IC. Table 3 below is the TTL input condition, and Table 4 is the CMOS input condition.

Figure pat00003
Figure pat00003

Figure pat00004
Figure pat00004

도 10은 UCM LED 구동 회로를 나타낸 도면이고, 도 11은 도 10의 UCM LED 구동회로 동작을 나타낸 그래프이고, 도 12는 74HCT221의 지연을 나타내는 그래프이다. 도 11의 A는 누락 탐지 카운트를 나타낸다. 도 10에 도시된 UCM의 LED 구동회로는 주요 IC로 74221 과 7474를 사용한다. 기본 구성은 74221를 사용하여 0.1us를 수us로 지연하고 이 지연된 로직을 7474를 사용하여 단펄스와 장펄스의 정상 유무를 판별한다. 도 11에 도시되는 바와 같이, 전원 ON 구간에서 DC전원이 공급되는 순간 도 11의 회로도 ①번의 RC시정수가 ②번의 시정수보다 충분히 크게 설계된다. 도 11의 ①, ②에 의하여 아래 표 5의 7474는 전원 ON구간 및 전원 OFF구간을 유지한다. ③은 국부신호합성회로카드의 FPGA가 동작하여 DDS가 주파수를 생성되어 UCM으로 RF신호가 공급될 때 “H" 동작을 하고 전원 ON 이후 국부 신호 합성모듈의 FPGA가 동작하여 RF 신호(STALO1)가 UCM으로 되면 정상으로 표시한다.10 is a diagram showing a UCM LED driving circuit, FIG. 11 is a graph showing the operation of the UCM LED driving circuit of FIG. 10, and FIG. 12 is a graph showing a delay of 74HCT221. 11A shows missing detection counts. The LED driving circuit of UCM shown in FIG. 10 uses 74221 and 7474 as main ICs. The basic configuration uses 74221 to delay 0.1us to several us, and 7474 is used for this delayed logic to determine whether short pulses and long pulses are normal. As shown in FIG. 11 , the RC time constant of No. ① in the circuit diagram of FIG. 11 is designed to be sufficiently larger than the time constant of No. ② at the moment when DC power is supplied in the power ON section. According to ① and ② of FIG. 11, 7474 of Table 5 below maintains the power ON section and the power OFF section. ③ shows “H” operation when the FPGA of the local signal synthesis circuit card operates and the DDS generates a frequency and the RF signal is supplied to the UCM. After the power is turned on, the FPGA of the local signal synthesis module operates and the RF signal (STALO1) When it becomes UCM, it is displayed as normal.

Figure pat00005
Figure pat00005

도 11의 정상 구간은 도 10의 ④⑤⑥의 74221의 RC시정수는 4.5us지연(AD8317출력신호 지연), ⑦은 도 12에 도시되는 바와 같이 2~2.5us지연(UCM_EN지연)된다. 도 10의 ⑦74221의 입력과 출력은 위 항목의 ④⑤⑥과 반대가 된다. 도 11의 ⑦은 도 10의 7474의 CLK입력으로 사용된다. 따라서, 도 12에서와 같이 정상 불량 판별을 할 수 있다. 결론적으로 4.5us지연된 ④⑤⑥ 신호의 중간 영역에서 정상 불량 판별을 알 수 있다. In the normal section of FIG. 11, the RC time constant of 74221 of ④⑤⑥ of FIG. 10 is delayed by 4.5us (AD8317 output signal delay), and ⑦ is delayed by 2 to 2.5us (UCM_EN delay) as shown in FIG. The input and output of ⑦74221 of FIG. 10 are opposite to ④⑤⑥ of the above item. 7 of FIG. 11 is used as a CLK input of 7474 of FIG. 10 . Therefore, as shown in FIG. 12 , it is possible to determine normal failure. In conclusion, it can be seen that normal failure is determined in the middle region of the 4.5us delayed ④⑤⑥ signal.

도 11의 단펄스 고장 구간은 도 11의 A와 같이 단펄스가 고장일 경우 도 10의 UCM_EN의 지연 출력 ⑦번에 의하여 ⑨(첫 번째 D Flip-Flops)의 출력은 “L” 따라서 고장을 판별한다. 이 동작 이후 LP펄스는 정상적으로 출력 되나 위의 “L”출력이 ⑩번(두 번째 D Flip-Flops)으로 이동하여 “L”출력한다. 단펄스와 장펄스 두개의 펄스 중 하나라도 불량이면 단펄스와 장펄스 2개 조합된 구간은 전체가 고장으로 표시된다.In the short pulse failure section of FIG. 11, as in A of FIG. 11, when the short pulse fails, the output of ⑨ (the first D Flip-Flops) is “L” by the delay output ⑦ of the UCM_EN of FIG. do. After this operation, the LP pulse is output normally, but the “L” output above moves to ⑩ (the second D Flip-Flops) to output “L”. If any one of the short pulse and the long pulse is defective, the entire section in which the short pulse and the long pulse are combined is marked as a failure.

따라서, 0.1us의 짧은 펄스의 처리를 수ms로 지연하여 사용하면 다른 길이의 펄스가 사용되는 경우 고장이 식별되지 않는 문제를 해결할 수 있고, RF Detector를 FPGA에서 슬라이딩 처리시의 문제를 해결할 수 있게 된다.Therefore, if the processing of short pulses of 0.1us is delayed by several ms, it is possible to solve the problem that failures are not identified when pulses of different lengths are used, and to solve the problem of sliding the RF Detector in the FPGA. do.

Claims (1)

송신 펄스 점검 회로를 포함하는 RF 송신부를 포함하는 레이더 시스템에 있어서, 장펄스와 단펄스로 구성된 RF 신호를 출력부 및 상기 RF 출력보다 제1설정 시간 빠른 타이밍 신호를 출력하는 DAM 송신엔진을 포함하는 송신구동모듈, 및 3개의 입력 BIT와 1개의 출력 BIT로 서로 다른 2개 쌍의 RF를 처리하여 정상 여부를 표시하는 LED를 구동하는 상향변환모듈을 포함하고, 상기 송신구동모듈의 상기 DAM 송신엔진은 상기 타이밍 신호 출력 시 운용 모드와 반전되는 신호를 출력하는 수신 점검 모드를 포함하고, 상기 상향변환모듈은 제1설정시간을 10배 이상 지연시키고, 지연 로직을 이용하여 단펄스와 장펄스의 정상 유무를 판별하는 것을 특징으로 하는 레이더 시스템을 위한 스텝 변조 펄스 신호 계수.A radar system including an RF transmitter including a transmit pulse check circuit, comprising: an output unit for outputting an RF signal composed of a long pulse and a short pulse; and a DAM transmission engine for outputting a timing signal that is earlier than the RF output by a first set time a transmission driving module, and an up-conversion module that processes two different pairs of RF with 3 input BIT and 1 output BIT to drive an LED indicating whether it is normal, wherein the DAM transmission engine of the transmission driving module includes a reception check mode that outputs a signal inverted from the operation mode when the timing signal is output, and the up-conversion module delays the first set time by 10 times or more, and uses delay logic to determine the normality of short pulses and long pulses Step-modulated pulse signal counting for a radar system, characterized in that it determines the presence or absence.
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