KR20220049376A - Display apparatus - Google Patents

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KR20220049376A
KR20220049376A KR1020200132919A KR20200132919A KR20220049376A KR 20220049376 A KR20220049376 A KR 20220049376A KR 1020200132919 A KR1020200132919 A KR 1020200132919A KR 20200132919 A KR20200132919 A KR 20200132919A KR 20220049376 A KR20220049376 A KR 20220049376A
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백승민
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Abstract

A display device according to an example of the present invention comprises: a substrate having a first sub-pixel, a second sub-pixel, and a third sub-pixel; a circuit element layer including a driving thin film transistor provided on the substrate; an insulating layer including a trench provided in a boundary region between the first to third sub-pixels on the circuit element layer; first electrodes respectively provided in the first to third sub-pixels to be spaced apart from the trench; an organic light emitting layer provided on the first electrode and the trench; a second electrode provided on the organic light emitting layer; and a step compensation unit formed to be wider than the trench and disposed to be in contact with the lower surface of the trench. The first electrode provided in the first sub-pixel includes a first upper electrode and a first lower electrode spaced apart from the first upper electrode toward the substrate. The first lower electrode may be provided on the same layer as the step compensation unit. Accordingly, light efficiency can be improved.

Description

표시장치{DISPLAY APPARATUS}display device {DISPLAY APPARATUS}

본 발명은 영상을 표시하는 표시장치에 관한 것이다.The present invention relates to a display device for displaying an image.

표시 장치는 애노드 전극과 캐소드 전극 사이에 발광층이 형성된 구조로 이루어져, 상기 두 개의 전극 사이의 전계에 의해 상기 발광층이 발광함으로써 화상을 표시하는 장치이다.A display device has a structure in which a light emitting layer is formed between an anode electrode and a cathode electrode, and the light emitting layer emits light by an electric field between the two electrodes to display an image.

상기 발광층은 전자와 정공의 결합에 의해 엑시톤(exciton)이 생성되고 생성된 엑시톤이 여기상태(excited state)에서 기저상태(ground state)로 떨어지면서 발광을 하는 유기물로 이루어질 수도 있고, 퀀텀 도트(Quantum dot)와 같은 무기물로 이루어질 수도 있다.The light emitting layer may be made of an organic material that emits light when excitons are generated by the combination of electrons and holes, and the generated excitons fall from an excited state to a ground state, or quantum dots (Quantum dot) dot) may be composed of inorganic substances such as

상기 발광층은 서브 화소 별로 상이한 색상, 예로서, 적색, 녹색, 및 청색의 광을 발광하도록 이루어질 수도 있고, 서브 화소 별로 동일한 색상, 예로서, 백색의 광을 발광하도록 이루어질 수도 있다.The light emitting layer may be configured to emit light of different colors, eg, red, green, and blue, for each sub-pixel, or may be configured to emit light of the same color, eg, white, for each sub-pixel.

상기 발광층이 서브 화소 별로 상이한 색상의 광이 발광하는 경우에는, 소정의 마스크를 이용하여 서브 화소 별로 상이한 발광층을 증착해야 하기 때문에, 마스크 공정이 추가되는 한계가 있고 또한 마스크를 정밀하게 얼라인하지 못할 경우 발광층을 서브 화소 별로 정밀하게 증착하기 어려운 문제가 있다. When the light-emitting layer emits light of a different color for each sub-pixel, different light-emitting layers must be deposited for each sub-pixel using a predetermined mask. In this case, there is a problem in that it is difficult to precisely deposit the emission layer for each sub-pixel.

그에 반하여, 상기 발광층이 서브 화소 별로 동일한 색상, 예로서, 백색의 광이 발광하는 경우에는, 상기 발광층 형성을 위한 마스크가 필요 없기 때문에 마스크 공정으로 인한 문제가 발생하지 않는다. On the other hand, when the light emitting layer emits light of the same color, eg, white, for each sub-pixel, a mask for forming the light emitting layer is not required, and thus a problem due to the mask process does not occur.

그러나, 상기 발광층이 백색의 광을 발광하도록 이루어진 경우에는 서브 화소 별로 컬러 필터가 추가로 구비되어야 하므로, 상기 발광층에서 발광된 광이 상기 컬러 필터에서 흡수되어 광효율이 떨어지는 단점이 있다. However, when the light emitting layer is configured to emit white light, since a color filter must be additionally provided for each sub-pixel, the light emitted from the light emitting layer is absorbed by the color filter, thereby reducing light efficiency.

본 발명은 전술한 종래의 문제점을 해결하기 위해 고안된 것으로서, 본 발명은 백색의 광을 발광하는 발광층을 포함하면서도 광효율을 향상시킬 수 있는 표시 장치를 제공하는 것을 목적으로 한다. SUMMARY OF THE INVENTION The present invention has been devised to solve the problems of the related art, and an object of the present invention is to provide a display device capable of improving light efficiency while including a light emitting layer emitting white light.

본 발명의 일 예에 따른 표시장치는 제1 서브 화소, 제2 서브 화소, 및 제3 서브 화소를 구비한 기판, 기판 상에서 제1 내지 제3 서브 화소에 각각 구비된 구동 박막 트랜지스터를 포함하는 회로 소자층, 회로 소자층 상에서 제1 내지 제3 서브 화소 사이의 경계 영역에 구비된 트렌치를 포함하는 절연층, 트렌치와 이격되도록 제1 내지 제3 서브 화소에 각각 구비된 제1 전극, 제1 전극과 트렌치 상에 구비된 유기발광층, 유기발광층 상에 구비된 제2 전극, 및 트렌치보다 넓은 폭으로 형성되어 트렌치의 하면에 접하도록 배치된 단차보상부를 포함하고, 제1 서브 화소에 구비된 제1 전극은 제1 상부전극 및 제1 상부전극으로부터 기판 쪽으로 이격된 제1 하부전극을 포함하고, 제1 하부전극은 단차보상부와 동일한 층에 구비될 수 있다.A display device according to an exemplary embodiment of the present invention includes a circuit including a substrate including a first sub-pixel, a second sub-pixel, and a third sub-pixel, and driving thin film transistors respectively provided in the first to third sub-pixels on the substrate The element layer, the insulating layer including the trench provided in the boundary region between the first to third sub-pixels on the circuit element layer, the first electrodes provided in the first to third sub-pixels respectively to be spaced apart from the trench, and the first electrode and an organic light emitting layer provided on the trench, a second electrode provided on the organic light emitting layer, and a step compensation part formed to have a width wider than the trench and disposed to contact the lower surface of the trench, and the first sub-pixel provided in the first sub-pixel The electrode may include a first upper electrode and a first lower electrode spaced apart from the first upper electrode toward the substrate, and the first lower electrode may be provided on the same layer as the step difference compensating part.

본 발명의 일 예에 따른 표시장치는 제1 발광 영역과 제1 콘택 영역을 구비한 제1 서브 화소, 제2 발광 영역과 제2 콘택 영역을 구비한 제2 서브 화소, 제3 발광 영역과 제3 콘택 영역을 구비한 제3 서브 화소, 제1 발광 영역에 구비된 제1 하부전극과 제1 상부전극, 제2 발광 영역에 구비된 제2 하부전극과 제2 상부전극, 제3 발광 영역에 구비된 제3 하부전극과 제3 상부전극, 제1 콘택 영역에 구비되고 제1 하부전극 및 제1 상부전극과 연결되는 제1 콘택 전극, 제2 콘택 영역에 구비되고 제2 상부전극에 연결되는 제2 콘택 전극, 제3 콘택 영역에 구비되고 제3 하부전극에 연결되는 제3 콘택 전극, 제1 내지 제3 서브 화소 사이의 경계 영역에 구비된 트렌치, 및 트렌치의 하면에 접하며 제1 내지 제3 하부전극 각각의 폭보다 좁고 트렌치의 폭보다 넓은 단차보상부를 포함하고, 제1 하부전극은 단차보상부와 동일한 층에 구비되고, 제2 하부전극과 제2 상부전극 사이의 거리는 제1 하부전극과 제1 상부전극 사이의 거리보다 작고 제3 하부전극과 제3 상부전극 사이의 거리보다 크게 구비될 수 있다.A display device according to an embodiment of the present invention includes a first sub-pixel having a first light-emitting area and a first contact area, a second sub-pixel having a second light-emitting area and a second contact area, a third light-emitting area and a second sub-pixel having a second light-emitting area and a second contact area. A third sub-pixel having three contact areas, a first lower electrode and a first upper electrode provided in the first light-emitting area, a second lower electrode and a second upper electrode provided in the second light-emitting area, and a third light-emitting area The third lower electrode and the third upper electrode are provided, the first contact electrode is provided in the first contact region and is connected to the first lower electrode and the first upper electrode, and the third lower electrode and the third upper electrode are provided in the second contact region and connected to the second upper electrode. The second contact electrode, the third contact electrode provided in the third contact region and connected to the third lower electrode, the trench provided in the boundary region between the first to third sub-pixels, and the first to third contact electrodes in contact with the lower surfaces of the trenches 3 including a step difference compensating part that is narrower than the width of each of the lower electrodes and wider than the width of the trench, the first lower electrode is provided on the same layer as the step compensating part, and the distance between the second lower electrode and the second upper electrode is the first lower electrode It may be provided to be smaller than the distance between the first upper electrode and the third lower electrode and larger than the distance between the third lower electrode and the third upper electrode.

본 발명에 따른 표시장치는 트렌치의 하면에 접하도록 배치된 단차보상부와 동일한 층에 구비된 제1 서브 화소의 제1 하부 전극과 제2 전극 간의 반사와 재반사를 통해 마이크로 캐버티 특성을 얻을 수 있고, 그에 따라 광 효율이 향상될 수 있다.In the display device according to the present invention, microcavity characteristics are obtained through reflection and re-reflection between the first lower electrode and the second electrode of the first sub-pixel provided on the same layer as the step difference compensator disposed in contact with the lower surface of the trench. and, accordingly, light efficiency may be improved.

본 발명에 따른 표시장치는 제1 하부 전극과 동일한 층에 구비된 단차보상부가 트렌치보다 넓은 폭으로 형성되어 트렌치의 하면 접하도록 구비됨으로써, 트렌치 주변에서 단차가 발생하는 것을 방지할 수 있다. 이에 따라, 본 발명에 따른 표시장치는 트렌치를 정상적인 형태로 형성할 수 있으므로 트렌치 상에서 심(seam) 등과 같은 균열이 발생하는 것을 방지하여 신뢰성이 향상될 수 있다.In the display device according to the present invention, the step difference compensating portion provided on the same layer as the first lower electrode is formed to be wider than the trench and provided to contact the lower surface of the trench, thereby preventing the step difference from occurring around the trench. Accordingly, in the display device according to the present invention, since the trench can be formed in a normal shape, cracks such as a seam are prevented from occurring in the trench, thereby improving reliability.

위에서 언급된 본 발명의 효과 외에도, 본 발명의 다른 특징 및 이점들이 이하에서 기술되거나, 그러한 기술 및 설명으로부터 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 명확하게 이해될 수 있을 것이다.In addition to the effects of the present invention mentioned above, other features and advantages of the present invention will be described below or will be clearly understood by those of ordinary skill in the art from such description and description.

도 1은 본 발명의 일 실시예에 따른 표시장치의 개략적인 평면도이다.
도 2a는 도 1에 도시된 선 Ⅰ-Ⅰ'의 개략적인 단면도이다.
도 2b는 도 2a에 도시된 A부분의 개략적인 확대도이다.
도 3은 도 1에 도시된 선 Ⅱ-Ⅱ'의 개략적인 단면도이다.
도 4는 본 발명의 일 실시예에 따른 표시장치의 제1 내지 제6 서브 화소를 개략적으로 나타낸 평면도이다.
도 5는 본 발명의 다른 실시예에 따른 표시장치의 개략적인 평면도이다.
도 6은 도 5에 도시된 선 Ⅲ-Ⅲ'의 개략적인 단면도이다.
도 7은 도 5에 도시된 선 Ⅳ-Ⅳ'의 개략적인 단면도이다.
도 8a 내지 도 8c는 본 발명의 또 다른 실시예에 따른 표시장치에 관한 것으로서, 이는 헤드 장착형 표시장치(HMD)에 관한 것이다.
1 is a schematic plan view of a display device according to an embodiment of the present invention.
FIG. 2A is a schematic cross-sectional view taken along line I-I' shown in FIG. 1 ;
FIG. 2B is a schematic enlarged view of part A shown in FIG. 2A.
3 is a schematic cross-sectional view taken along the line II-II' shown in FIG. 1 .
4 is a plan view schematically illustrating first to sixth sub-pixels of a display device according to an exemplary embodiment of the present invention.
5 is a schematic plan view of a display device according to another exemplary embodiment of the present invention.
FIG. 6 is a schematic cross-sectional view taken along line III-III' shown in FIG. 5 .
7 is a schematic cross-sectional view taken along line IV-IV' shown in FIG. 5 .
8A to 8C relate to a display device according to still another embodiment of the present invention, which relates to a head mounted display device (HMD).

본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.Advantages and features of the present invention, and a method of achieving them, will become apparent with reference to the examples described below in detail in conjunction with the accompanying drawings. However, the present invention is not limited to the examples disclosed below, but will be implemented in a variety of different forms, and only these examples allow the disclosure of the present invention to be complete, and to those of ordinary skill in the art to which the present invention belongs It is provided to fully understand the scope of the invention, and the present invention is only defined by the scope of the claims.

본 발명의 예를 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 발명이 도시된 사항에 한정되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 발명을 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다. 본 발명 상에서 언급한 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 '~만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.The shape, size, ratio, angle, number, etc. disclosed in the drawings for explaining an example of the present invention are exemplary, and thus the present invention is not limited to the illustrated matters. Like reference numerals refer to like elements throughout. In addition, in describing the present invention, if it is determined that a detailed description of a related known technology may unnecessarily obscure the gist of the present invention, the detailed description thereof will be omitted. When 'includes', 'have', 'consists of', etc. mentioned in the present invention are used, other parts may be added unless 'only' is used. When a component is expressed in the singular, the case in which the plural is included is included unless otherwise explicitly stated.

구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다.In interpreting the components, it is construed as including an error range even if there is no separate explicit description.

위치 관계에 대한 설명일 경우, 예를 들어, '~상에', '~상부에', '~하부에', '~옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.In the case of a description of the positional relationship, for example, when the positional relationship of two parts is described as 'on', 'on', 'on', 'beside', etc., 'right' Alternatively, one or more other parts may be positioned between two parts unless 'directly' is used.

제 1, 제 2 등이 다양한 구성요소들을 서술하기 위해서 사용되나, 이들 구성요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성 요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제 1 구성요소는 본 발명의 기술적 사상 내에서 제 2 구성요소일 수도 있다.Although the first, second, etc. are used to describe various elements, these elements are not limited by these terms. These terms are only used to distinguish one component from another. Accordingly, the first component mentioned below may be the second component within the spirit of the present invention.

본 발명의 구성 요소를 설명하는 데 있어서, 제 1, 제 2 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다. 어떤 구성 요소가 다른 구성요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 그 구성 요소는 그 다른 구성요소에 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성 요소 사이에 다른 구성 요소가 "개재"되거나, 각 구성 요소가 다른 구성 요소를 통해 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다.In describing the components of the present invention, terms such as first, second, etc. may be used. These terms are only for distinguishing the elements from other elements, and the essence, order, order, or number of the elements are not limited by the terms. When it is described that a component is “connected”, “coupled” or “connected” to another component, the component may be directly connected or connected to the other component, but other components may be interposed between each component. It should be understood that each component may be “interposed” or “connected”, “coupled” or “connected” through another component.

본 발명의 여러 실시예들의 각각 특징들이 부분적으로 또는 전체적으로 서로 결합 또는 조합 가능하고, 기술적으로 다양한 연동 및 구동이 가능하며, 각 실시예들이 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시할 수도 있다.Each feature of the various embodiments of the present invention can be partially or wholly combined or combined with each other, technically various interlocking and driving are possible, and each of the embodiments may be independently implemented with respect to each other or implemented together in a related relationship. may be

이하에서는 본 발명에 따른 표시장치의 예를 첨부된 도면을 참조하여 상세히 설명한다. 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다.Hereinafter, an example of a display device according to the present invention will be described in detail with reference to the accompanying drawings. In adding reference numerals to components of each drawing, the same components may have the same reference numerals as much as possible even though they are indicated in different drawings.

도 1은 본 발명의 일 실시예에 따른 표시장치의 개략적인 평면도이다. 도 1에는 3개의 서브 화소(SP1, SP2, SP3)만을 도시하였다.1 is a schematic plan view of a display device according to an embodiment of the present invention. 1 shows only three sub-pixels SP1, SP2, and SP3.

도 1에서 알 수 있듯이, 본 발명의 일 실시예에 따른 표시장치는 기판(2), 제1 전극(5), 제1 콘택전극(61)과 제2 콘택전극(62)과 제3 콘택전극(63)을 갖는 콘택전극(6), 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이에 배치되는 트렌치(T), 펜스(F), 및 절연부(IP)를 포함하여 이루어진다.As can be seen from FIG. 1 , in the display device according to an embodiment of the present invention, a substrate 2 , a first electrode 5 , a first contact electrode 61 , a second contact electrode 62 , and a third contact electrode It includes a contact electrode 6 having 63 , a trench T disposed between the first to third sub-pixels SP1 , SP2 , and SP3 , a fence F, and an insulating portion IP.

상기 기판(2) 상에는 복수의 서브 화소(SP1, SP2, SP3)가 형성되어 있다. A plurality of sub-pixels SP1 , SP2 , and SP3 are formed on the substrate 2 .

상기 복수의 서브 화소(SP1, SP2, SP3)에는 복수의 발광 영역(EA1, EA2, EA3) 및 복수의 콘택 영역(CA1, CA2, CA3)이 구비되어 있다. A plurality of light emitting areas EA1 , EA2 , EA3 and a plurality of contact areas CA1 , CA2 , CA3 are provided in the plurality of sub-pixels SP1 , SP2 , and SP3 .

구체적으로, 제1 서브 화소(SP1)에 제1 발광 영역(EA1) 및 제1 콘택 영역(CA1)이 구비되어 있고, 제2 서브 화소(SP2)에 제2 발광 영역(EA2) 및 제2 콘택 영역(CA2)이 구비되어 있고, 제3 서브 화소(SP3)에 제3 발광 영역(EA3) 및 제3 콘택 영역(CA3)이 구비되어 있다. Specifically, the first light-emitting area EA1 and the first contact area CA1 are provided in the first sub-pixel SP1 , and the second light-emitting area EA2 and the second contact are provided in the second sub-pixel SP2 . The area CA2 is provided, and the third light emitting area EA3 and the third contact area CA3 are provided in the third sub-pixel SP3 .

상기 복수의 발광 영역(EA1, EA2, EA3)은 상기 펜스(F)와 상기 절연부(IP)에 의해 정의된다. 즉, 상기 펜스(F)와 절연부(IP)에 의해 가려지지 않고 노출된 영역이 상기 복수의 발광 영역(EA1, EA2, EA3)이 된다. 상기 제1 발광 영역(EA1)은 적색 발광 영역으로 이루어지고, 상기 제2 발광 영역(EA2)은 녹색 발광 영역으로 이루어지고, 상기 제3 발광 영역(EA3)은 청색 발광 영역으로 이루어질 수 있지만, 반드시 그에 한정되는 것은 아니다. 상기 펜스(F)와 상기 절연부(IP)는 절연성을 갖는 물질로 구비될 수 있다.The plurality of light emitting areas EA1 , EA2 , and EA3 are defined by the fence F and the insulating part IP. That is, the exposed area without being covered by the fence F and the insulating portion IP becomes the plurality of light emitting areas EA1 , EA2 , and EA3 . The first light emitting area EA1 may be formed of a red light emitting area, the second light emitting area EA2 may be formed of a green light emitting area, and the third light emitting area EA3 may be formed of a blue light emitting area. It is not limited thereto. The fence F and the insulating part IP may be made of an insulating material.

상기 복수의 콘택 영역(CA1, CA2, CA3)은 상기 절연부(IP)에 의해 가려진 영역에 구비될 수 있다. 일 예에 따른 복수의 콘택 영역(CA1, CA2, CA3)은 상기 복수의 서브 화소(SP1, SP2, SP3)의 일측 중앙에 위치할 수 있다. 예컨대, 제1 서브 화소(SP1) 내부의 상측 중앙에 제1 콘택 영역(CA1)이 구비되고, 제2 서브 화소(SP2) 내부의 상측 중앙에 제2 콘택 영역(CA2)이 구비되고, 제3 서브 화소(SP3) 내부의 상측 중앙에 제3 콘택 영역(CA3)이 구비될 수 있다. 여기서, 복수의 서브 화소(SP1, SP2, SP3)의 일측은 도 1을 기준으로 각 서브 화소(SP1, SP2, SP3)의 상측 또는 하측을 의미하며, 예를 들어 트렌치(T)와 인접하지 않는 서브 화소의 일측을 의미할 수 있다.The plurality of contact areas CA1 , CA2 , and CA3 may be provided in an area covered by the insulating part IP. According to an example, the plurality of contact areas CA1 , CA2 , and CA3 may be located at the center of one side of the plurality of sub-pixels SP1 , SP2 , and SP3 . For example, the first contact area CA1 is provided at the upper center inside the first sub-pixel SP1 , the second contact area CA2 is provided at the upper center inside the second sub-pixel SP2 , and the third A third contact area CA3 may be provided at an upper center inside the sub-pixel SP3 . Here, one side of the plurality of sub-pixels SP1, SP2, and SP3 means an upper side or a lower side of each of the sub-pixels SP1, SP2, and SP3 based on FIG. 1 , for example, not adjacent to the trench T It may mean one side of the sub-pixel.

상기 복수의 콘택 영역(CA1, CA2, CA3)에는 복수의 콘택홀(PCNT, CNT11, CNT12, CNT21, CNT22, CNT31, CNT32)이 형성되어 있고, 그로 인해서 단차가 발생하게 된다. 따라서, 상기 복수의 콘택 영역(CA1, CA2, CA3)의 적어도 일부를 상기 절연부(IP)로 가리지 않고 노출시켜 상기 복수의 콘택 영역(CA1, CA2, CA3)의 적어도 일부를 상기 복수의 발광 영역(EA1, EA2, EA3)과 중첩시킬 경우, 상기 단차로 인해서 발광 영역(EA1, EA2, EA3)에서 발광이 균일하지 못하는 문제가 발생할 수 있다. 따라서, 본 발명의 일 실시예에서는 상기 복수의 콘택 영역(CA1, CA2, CA3)을 상기 절연부(IP)로 가림으로써 상기 복수의 콘택 영역(CA1, CA2, CA3)을 상기 복수의 발광 영역(EA1, EA2, EA3)과 중첩되지 않도록 형성한다. 다만, 반드시 그에 한정되는 것은 아니고, 상기 복수의 콘택 영역(CA1, CA2, CA3)의 적어도 일부를 상기 절연부(IP)로 가리지 않음으로써 상기 복수의 콘택 영역(CA1, CA2, CA3)의 적어도 일부를 상기 복수의 발광 영역(EA1, EA2, EA3)과 중첩되도록 형성하는 것도 가능하다.A plurality of contact holes PCNT, CNT11, CNT12, CNT21, CNT22, CNT31, and CNT32 are formed in the plurality of contact regions CA1 , CA2 , and CA3 , thereby generating a step. Accordingly, at least a portion of the plurality of contact areas CA1 , CA2 , and CA3 is exposed without being covered by the insulating portion IP, so that at least a portion of the plurality of contact areas CA1 , CA2 , and CA3 is exposed to the plurality of light emitting areas When overlapping with (EA1, EA2, EA3), light emission may not be uniform in the light emitting areas EA1, EA2, and EA3 due to the step difference. Accordingly, in an embodiment of the present invention, the plurality of contact areas CA1, CA2, CA3 is covered with the plurality of light emitting areas ( EA1, EA2, EA3) are formed so as not to overlap. However, the present invention is not limited thereto, and at least a portion of the plurality of contact areas CA1 , CA2 , and CA3 is not covered by the insulating part IP, so that at least a portion of the plurality of contact areas CA1 , CA2 , CA3 is not covered. It is also possible to form so as to overlap the plurality of light emitting areas EA1, EA2, and EA3.

상기 제1 전극(5)은 개별 서브 화소(SP1, SP2, SP3) 별로 패턴 형성되어 있다. 즉, 제1 서브 화소(SP1)에 하나의 제1 전극(51)이 형성되어 있고, 제2 서브 화소(SP2)에 다른 하나의 제1 전극(52)이 형성되어 있고, 제3 서브 화소(SP3)에 또 다른 하나의 제1 전극(53)이 형성되어 있다. 상기 제1 전극(51, 52, 53)은 표시장치의 양극으로 기능할 수 있다.The first electrode 5 is patterned for each individual sub-pixel SP1 , SP2 , and SP3 . That is, one first electrode 51 is formed in the first sub-pixel SP1 , the other first electrode 52 is formed in the second sub-pixel SP2 , and the third sub-pixel SP2 Another first electrode 53 is formed in SP3). The first electrodes 51 , 52 , and 53 may function as an anode of the display device.

상기 제1 서브 화소(SP1)의 제1 전극(51)은 제1 발광 영역(EA1)에서부터 제1 콘택 영역(CA1)까지 연장되어 있고, 상기 절연부(IP)와 펜스(F)에 의해 가려지지 않고 노출된 상기 제1 전극(51)의 노출 부분이 상기 제1 발광 영역(EA1)이 된다. 상기 제1 서브 화소(SP1)의 제1 전극(51)은 제1 콘택 영역(CA1)에서 제1 콘택 전극(61)과 연결되어 있다.The first electrode 51 of the first sub-pixel SP1 extends from the first emission area EA1 to the first contact area CA1 and is covered by the insulating part IP and the fence F. The exposed portion of the first electrode 51 exposed without being supported becomes the first light emitting area EA1 . The first electrode 51 of the first sub-pixel SP1 is connected to the first contact electrode 61 in the first contact area CA1 .

상기 제2 서브 화소(SP2)의 제1 전극(52)은 제2 발광 영역(EA2)에서부터 제2 콘택 영역(CA2)까지 연장되어 있고, 상기 절연부(IP)와 펜스(F)에 의해 가려지지 않고 노출된 상기 제1 전극(52)의 노출 부분이 상기 제2 발광 영역(EA2)이 된다. 상기 제2 서브 화소(SP2)의 제1 전극(52)은 제2 콘택 영역(CA2)에서 제2 콘택 전극(62)과 연결되어 있다.The first electrode 52 of the second sub-pixel SP2 extends from the second emission area EA2 to the second contact area CA2 and is covered by the insulating part IP and the fence F. The exposed portion of the first electrode 52 exposed without being supported becomes the second light emitting area EA2 . The first electrode 52 of the second sub-pixel SP2 is connected to the second contact electrode 62 in the second contact area CA2 .

상기 제3 서브 화소(SP3)의 제1 전극(53)은 제3 발광 영역(EA3)에서부터 제3 콘택 영역(CA3)까지 연장되어 있고, 상기 절연부(IP)와 펜스(F)에 의해 가려지지 않고 노출된 상기 제1 전극(53)의 노출 부분이 상기 제3 발광 영역(EA3)이 된다. 상기 제3 서브 화소(SP3)의 제1 전극(53)은 제3 콘택 영역(CA3)에서 제3 콘택 전극(63)과 연결되어 있다.The first electrode 53 of the third sub-pixel SP3 extends from the third light emitting area EA3 to the third contact area CA3 and is covered by the insulating part IP and the fence F. The exposed portion of the first electrode 53 exposed without being supported becomes the third light emitting area EA3 . The first electrode 53 of the third sub-pixel SP3 is connected to the third contact electrode 63 in the third contact area CA3 .

상기 콘택 전극(6)은 상기 콘택 영역(CA1, CA2, CA3)에 구비되어 있다. 구체적으로, 제1 콘택 전극(61)은 제1 콘택 영역(CA1)에 구비되어 있고, 제2 콘택 전극(62)은 제2 콘택 영역(CA2)에 구비되어 있고, 제3 콘택 전극(63)은 제3 콘택 영역(CA3)에 구비되어 있다. The contact electrode 6 is provided in the contact areas CA1 , CA2 , and CA3 . Specifically, the first contact electrode 61 is provided in the first contact area CA1 , the second contact electrode 62 is provided in the second contact area CA2 , and the third contact electrode 63 is provided in the second contact area CA2 . is provided in the third contact area CA3 .

상기 제1 콘택 전극(61)은 상기 제1 콘택 영역(CA1)에서 상기 제1 서브 화소(SP1)의 제1 전극(51)과 중첩되면서 상기 제1 전극(51)과 연결되어 있다. 제1 발광 영역(EA1)의 면적을 증가시키기 위해 상기 제1 콘택 전극(61)의 좌우 폭(CEW, 도 2a에 도시됨)은 상기 제1 전극(51)의 좌우 폭(EW, 도 2a에 도시됨)보다 작게 구비될 수 있다.The first contact electrode 61 overlaps the first electrode 51 of the first sub-pixel SP1 in the first contact area CA1 and is connected to the first electrode 51 . In order to increase the area of the first light emitting area EA1 , the left and right widths CEW of the first contact electrode 61 (shown in FIG. 2A ) are equal to the left and right widths EW of the first electrode 51 in FIG. 2A . shown) may be provided smaller than that.

상기 제2 콘택 전극(62)은 상기 제2 콘택 영역(CA2)에서 상기 제2 서브 화소(SP2)의 제1 전극(52)과 중첩되면서 상기 제1 전극(52)과 연결되어 있다. 제2 발광 영역(EA2)의 면적을 증가시키기 위해 상기 제2 콘택 전극(62)의 좌우 폭은 상기 제1 전극(52)의 좌우 폭보다 작게 구비될 수 있다.The second contact electrode 62 is connected to the first electrode 52 while overlapping the first electrode 52 of the second sub-pixel SP2 in the second contact area CA2 . In order to increase the area of the second light emitting area EA2 , the left and right widths of the second contact electrode 62 may be smaller than the left and right widths of the first electrode 52 .

상기 제3 콘택 전극(63)은 상기 제3 콘택 영역(CA3)에서 상기 제3 서브 화소(SP3)의 제1 전극(53)과 중첩되면서 상기 제1 전극(53)과 연결되어 있다. 제3 발광 영역(EA3)의 면적을 증가시키기 위해 상기 제3 콘택 전극(63)의 좌우 폭은 상기 제1 전극(53)의 좌우 폭보다 작게 구비될 수 있다.The third contact electrode 63 is connected to the first electrode 53 while overlapping the first electrode 53 of the third sub-pixel SP3 in the third contact area CA3 . In order to increase the area of the third light emitting area EA3 , the left and right widths of the third contact electrode 63 may be smaller than the left and right widths of the first electrode 53 .

상기 제2 콘택 전극(62)의 좌우 폭과 상기 제3 콘택 전극(63)의 좌우 폭 각각은 상기 제1 콘택 전극(61)의 좌우 폭(CEW)과 동일하게 구비될 수 있고, 상기 제1 전극(52)의 좌우 폭과 상기 제1 전극(53)의 좌우 폭 각각은 상기 제1 전극(51)의 좌우 폭(EW)과 동일하게 구비될 수 있다.A left and right width of the second contact electrode 62 and a left and right width of the third contact electrode 63 may be the same as the left and right width CEW of the first contact electrode 61 , and The left and right widths of the electrode 52 and the left and right widths of the first electrode 53 may be the same as the left and right widths EW of the first electrode 51 .

이하에서는 단면구조를 통해서 본 발명의 다양한 실시예에 대해서 상세히 설명하기로 한다.Hereinafter, various embodiments of the present invention will be described in detail through a cross-sectional structure.

도 2a는 본 발명의 일 실시예에 따른 표시장치의 개략적인 단면도로서, 이는 도 1에 도시된 선 Ⅰ-Ⅰ'의 단면에 해당하고, 도 2b는 도 2a에 도시된 A부분의 개략적인 확대도이며, 도 3은 도 1에 도시된 선 Ⅱ-Ⅱ'의 단면에 해당한다.FIG. 2A is a schematic cross-sectional view of a display device according to an embodiment of the present invention, which corresponds to a cross-section taken along line I-I' shown in FIG. 1 , and FIG. 2B is a schematic enlargement of a portion A shown in FIG. 2A . FIG. 3 is a cross-section taken along line II-II' shown in FIG. 1 .

도 2a 및 도 3에서 알 수 있듯이, 본 발명의 일 실시예에 따른 표시장치(1)는 기판(2), 회로 소자층(3), 제1 절연층(41)과 제2 절연층(42)을 갖는 절연층(4),제1 전극(51, 52, 53), 콘택 전극(61, 62, 63), 펜스(F), 유기발광층(7), 제2 전극(8), 트렌치(T), 단차보상부(9), 봉지층(10), 및 컬러 필터층(11)을 포함하여 이루어진다.As can be seen from FIGS. 2A and 3 , the display device 1 according to the exemplary embodiment includes a substrate 2 , a circuit element layer 3 , a first insulating layer 41 and a second insulating layer 42 . ) having an insulating layer 4, first electrodes 51, 52, 53, contact electrodes 61, 62, 63, fence F, organic light emitting layer 7, second electrode 8, trench ( T), a step compensation part 9 , an encapsulation layer 10 , and a color filter layer 11 .

상기 기판(2)은 유리 또는 플라스틱으로 이루어질 수 있지만, 반드시 그에 한정되는 것은 아니고, 실리콘 웨이퍼와 같은 반도체 물질로 이루어질 수도 있다.The substrate 2 may be made of glass or plastic, but is not limited thereto, and may be made of a semiconductor material such as a silicon wafer.

상기 기판(2)은 투명한 재료로 이루어질 수도 있고 불투명한 재료로 이루어질 수도 있다. 상기 기판(2) 상에는 제1 서브 화소(SP1), 제2 서브 화소(SP2), 및 제3 서브 화소(SP3)가 구비되어 있다. 상기 제1 서브 화소(SP1)는 적색 광을 방출하고, 상기 제2 서브 화소(SP2)는 녹색 광을 방출하고, 상기 제3 서브 화소(SP3)는 청색 광을 방출하도록 구비될 수 있지만, 반드시 그에 한정되는 것은 아니고, 예를 들어 각각의 서브 화소(SP1, SP2, SP3)들의 배열 순서는 다양하게 변경될 수 있다. The substrate 2 may be made of a transparent material or an opaque material. A first sub-pixel SP1 , a second sub-pixel SP2 , and a third sub-pixel SP3 are provided on the substrate 2 . The first sub-pixel SP1 may emit red light, the second sub-pixel SP2 may emit green light, and the third sub-pixel SP3 may be provided to emit blue light. The present invention is not limited thereto, and for example, the arrangement order of each of the sub-pixels SP1 , SP2 , and SP3 may be variously changed.

본 발명의 일 실시예에 따른 표시장치는 발광된 광이 상부쪽으로 방출되는 소위 상부 발광(Top emission) 방식으로 이루어지고, 따라서, 상기 기판(2)의 재료로는 투명한 재료뿐만 아니라 불투명한 재료가 이용될 수 있다. The display device according to an embodiment of the present invention is formed in a so-called top emission method in which emitted light is emitted upward. can be used

상기 회로 소자층(3)은 상기 기판(2) 상에 형성되어 있다. The circuit element layer 3 is formed on the substrate 2 .

상기 회로 소자층(3)에는 각종 신호 배선들, 박막 트랜지스터, 및 커패시터 등을 포함하는 회로 소자가 서브 화소(SP1, SP2, SP3) 별로 구비되어 있다. 상기 신호 배선들은 게이트 배선, 데이터 배선, 전원 배선, 및 기준 배선을 포함하여 이루어질 수 있고, 상기 박막 트랜지스터는 스위칭 박막 트랜지스터, 구동 박막 트랜지스터(31, 32, 33) 및 센싱 박막 트랜지스터를 포함하여 이루어질 수 있다. In the circuit element layer 3, circuit elements including various signal lines, thin film transistors, and capacitors are provided for each sub-pixel SP1, SP2, and SP3. The signal wirings may include a gate wiring, a data wiring, a power wiring, and a reference wiring, and the thin film transistor may include a switching thin film transistor, driving thin film transistors 31 , 32 , 33 , and sensing thin film transistors. there is.

상기 스위칭 박막 트랜지스터는 상기 게이트 배선에 공급되는 게이트 신호에 따라 스위칭되어 상기 데이터 배선으로부터 공급되는 데이터 전압을 상기 구동 박막 트랜지스터에 공급하는 역할을 한다. The switching thin film transistor is switched according to a gate signal supplied to the gate line to supply a data voltage supplied from the data line to the driving thin film transistor.

상기 구동 박막 트랜지스터(31, 32, 33)는 상기 스위칭 박막 트랜지스터로부터 공급되는 데이터 전압에 따라 스위칭되어 상기 전원 배선에서 공급되는 전원으로부터 데이터 전류를 생성하여 상기 제1 전극(51, 52, 53)에 공급하는 역할을 한다. The driving thin film transistors 31 , 32 , and 33 are switched according to the data voltage supplied from the switching thin film transistor to generate a data current from the power supplied from the power supply line to the first electrodes 51 , 52 , and 53 . serves to supply.

상기 센싱 박막 트랜지스터는 화질 저하의 원인이 되는 상기 구동 박막 트랜지스터의 문턱 전압 편차를 센싱하는 역할을 하는 것으로서, 상기 게이트 배선 또는 별도의 센싱 배선에서 공급되는 센싱 제어 신호에 응답하여 상기 구동 박막 트랜지스터의 전류를 상기 기준 배선으로 공급한다. The sensing thin film transistor serves to sense a threshold voltage deviation of the driving thin film transistor that causes image quality deterioration, and the current of the driving thin film transistor in response to a sensing control signal supplied from the gate line or a separate sensing line is supplied to the reference wiring.

상기 커패시터는 상기 구동 박막 트랜지스터(31, 32, 33)에 공급되는 데이터 전압을 한 프레임 동안 유지시키는 역할을 하는 것으로서, 상기 구동 박막 트랜지스터(31, 32, 33)의 게이트 단자 및 소스 단자에 각각 연결된다. The capacitor serves to maintain the data voltage supplied to the driving thin film transistors 31, 32, and 33 for one frame, and is connected to the gate terminal and the source terminal of the driving thin film transistors 31, 32, and 33, respectively. do.

상기 회로 소자층(3)에는 서브 화소(SP1, SP2, SP3) 별로 회로 콘택홀(PCNT)이 구비되어 있어, 상기 회로 콘택홀(PCNT)을 통해서 구동 박막 트랜지스터(31, 32, 33)의 소스 단자 또는 드레인 단자가 노출된다. A circuit contact hole PCNT is provided for each of the sub-pixels SP1, SP2, and SP3 in the circuit element layer 3, and the source of the driving thin film transistors 31, 32, and 33 is provided through the circuit contact hole PCNT. The terminal or drain terminal is exposed.

상기 제1 전극(51, 52, 53)과 상기 콘택 전극(61, 62, 63)은 상기 회로 소자층(3) 상에서 서브 화소(SP1, SP2, SP3) 별로 패턴 형성되어 있다. 제1 서브 화소(SP1)에 하나의 제1 전극(51)과 제1 콘택 전극(61)이 형성되고, 제2 서브 화소(SP2)에 다른 하나의 제1 전극(52)과 제2 콘택 전극(62)이 형성되고, 제3 서브 화소(SP3)에 또 다른 하나의 제1 전극(53)과 제3 콘택 전극(63)이 형성된다. The first electrodes 51 , 52 , 53 and the contact electrodes 61 , 62 , and 63 are patterned for each sub-pixel SP1 , SP2 , and SP3 on the circuit element layer 3 . One first electrode 51 and a first contact electrode 61 are formed in the first sub-pixel SP1 , and another first electrode 52 and a second contact electrode are formed in the second sub-pixel SP2 . 62 is formed, and another first electrode 53 and a third contact electrode 63 are formed in the third sub-pixel SP3 .

상기 제1 전극(51, 52, 53)은 상기 회로소자층(3)에 구비된 구동 박막 트랜지스터(31, 32, 33)와 연결되어 있다. 구체적으로, 상기 제1 전극(51, 52, 53)은 구동 박막 트랜지스터(31, 32, 33)의 소스 단자 또는 드레인 단자와 연결되어 있다. The first electrodes 51 , 52 , and 53 are connected to the driving thin film transistors 31 , 32 , and 33 provided in the circuit element layer 3 . Specifically, the first electrodes 51 , 52 , and 53 are connected to a source terminal or a drain terminal of the driving thin film transistors 31 , 32 and 33 .

상기 제1 서브 화소(SP1)에 구비된 제1 전극(51)은 제1 하부전극(511) 및 제1 상부전극(512)을 포함하여 이루어진다. 상기 제1 하부전극(511) 및 제1 상부전극(512)은 제1 발광 영역(EA1)에서 제1 콘택 영역(CA1)까지 연장되어 있다. The first electrode 51 provided in the first sub-pixel SP1 includes a first lower electrode 511 and a first upper electrode 512 . The first lower electrode 511 and the first upper electrode 512 extend from the first emission area EA1 to the first contact area CA1.

상기 제1 하부전극(511)은 제1 서브 화소(SP1) 영역에 구비된 상기 회로 소자층(3)의 회로 콘택홀(PCNT)을 통해서 구동 박막 트랜지스터(31)에 연결되어 있다. 경우에 따라서, 상기 제1 하부전극(511)은 회로 콘택홀(PCNT)에 채워진 도전물질을 통해서 상기 구동 박막 트랜지스터(31)에 연결될 수도 있으며, 이는 이하의 모든 실시예에 동일하게 적용될 수 있다.The first lower electrode 511 is connected to the driving thin film transistor 31 through the circuit contact hole PCNT of the circuit element layer 3 provided in the first sub-pixel SP1 region. In some cases, the first lower electrode 511 may be connected to the driving thin film transistor 31 through a conductive material filled in the circuit contact hole PCNT, and this may be equally applied to all embodiments below.

상기 제1 상부전극(512)은 제1 서브 화소(SP1) 영역에 구비된 제2 절연층(42) 상에 배치된 제1 콘택 전극(61)의 제1 상부 콘택전극(612)에 연결되어 있다.The first upper electrode 512 is connected to the first upper contact electrode 612 of the first contact electrode 61 disposed on the second insulating layer 42 provided in the first sub-pixel SP1 region. there is.

상기 제1 서브 화소(SP1)에 구비된 제1 콘택 전극(61)은 제1 하부 콘택전극(611) 및 제1 상부 콘택전극(612)을 포함하여 이루어진다. 상기 제1 하부 콘택전극(611)은 제1 서브 화소(SP1) 영역에 구비된 제1 절연층(41)의 제1 콘택홀(CNT11)을 통해서 상기 제1 하부전극(511)에 연결되고, 상기 제1 상부 콘택전극(612)은 제1 서브 화소(SP1) 영역에 구비된 제2 절연층(42)의 제2 콘택홀(CNT12)을 통해서 상기 제1 하부 콘택전극(611)에 연결된다.The first contact electrode 61 provided in the first sub-pixel SP1 includes a first lower contact electrode 611 and a first upper contact electrode 612 . The first lower contact electrode 611 is connected to the first lower electrode 511 through the first contact hole CNT11 of the first insulating layer 41 provided in the first sub-pixel SP1 region, The first upper contact electrode 612 is connected to the first lower contact electrode 611 through the second contact hole CNT12 of the second insulating layer 42 provided in the first sub-pixel SP1 region. .

상기 제1 서브 화소(SP1)에 있어서, 제1 하부전극(511)은 상기 회로소자층(3)에 구비된 구동 박막 트랜지스터(31)와 직접 연결되고, 제1 상부전극(512)은 상기 제1 하부 콘택전극(611) 및 제1 상부 콘택전극(612)을 통해서 상기 제1 하부전극(511)에 연결되어 있다. 따라서, 제1 하부전극(511)은 제1 하부 콘택전극(611)의 하면에 배치될 수 있다. 제1 서브 화소(SP1)의 제1 발광 영역(EA1)에서는 상기 제1 하부전극(511)과 제1 상부전극(512) 사이에 제1 절연층(41)과 제2 절연층(42)이 구비되어 있다.In the first sub-pixel SP1 , the first lower electrode 511 is directly connected to the driving thin film transistor 31 provided in the circuit element layer 3 , and the first upper electrode 512 is connected to the first It is connected to the first lower electrode 511 through a first lower contact electrode 611 and a first upper contact electrode 612 . Accordingly, the first lower electrode 511 may be disposed on the lower surface of the first lower contact electrode 611 . In the first emission area EA1 of the first sub-pixel SP1 , the first insulating layer 41 and the second insulating layer 42 are interposed between the first lower electrode 511 and the first upper electrode 512 . It is available.

상기 제2 서브 화소(SP2)에 구비된 제1 전극(52)은 제2 하부전극(521) 및 제2 상부전극(522)을 포함하여 이루어진다. 상기 제2 하부전극(521) 및 제2 상부전극(522)은 제2 발광 영역(EA2)에서 제2 콘택 영역(CA2)까지 연장되어 있다.The first electrode 52 provided in the second sub-pixel SP2 includes a second lower electrode 521 and a second upper electrode 522 . The second lower electrode 521 and the second upper electrode 522 extend from the second light emitting area EA2 to the second contact area CA2.

상기 제2 하부전극(521)은 제2 서브 화소(SP2) 영역에 구비된 제1 절연층(41)의 제1 콘택홀(CNT21)을 통해서 제2 콘택 전극(62)을 구성하는 제2 하부 콘택전극(621)에 연결되어 있다. 상기 제2 상부전극(522)은 제2 서브 화소(SP2) 영역에 구비된 제2 절연층(42) 상에 배치된 제2 콘택 전극(62)을 구성하는 제2 상부 콘택전극(622)에 연결되어 있다.The second lower electrode 521 is a second lower electrode constituting the second contact electrode 62 through the first contact hole CNT21 of the first insulating layer 41 provided in the second sub-pixel SP2 region. It is connected to the contact electrode 621 . The second upper electrode 522 is connected to the second upper contact electrode 622 constituting the second contact electrode 62 disposed on the second insulating layer 42 provided in the second sub-pixel SP2 region. connected.

상기 제2 서브 화소(SP2)에 구비된 제2 콘택 전극(62)은 제2 하부 콘택전극(621) 및 제2 상부 콘택전극(622)을 포함하여 이루어진다. 상기 제2 하부 콘택전극(621)은 제2 서브 화소(SP2) 영역에 구비된 상기 회로 소자층(3)의 회로 콘택홀(PCNT)을 통해서 구동 박막 트랜지스터(32)에 연결되고, 상기 제2 상부 콘택전극(622)은 제2 서브 화소(SP2) 영역에 구비된 제2 절연층(42)의 제2 콘택홀(CNT22)을 통해서 상기 제2 하부전극(521)에 연결된다. 경우에 따라서, 상기 제2 하부 콘택전극(621)은 회로 콘택홀(PCNT)에 채워진 도전물질을 통해서 상기 구동 박막 트랜지스터(32)에 연결될 수도 있으며, 이는 이하의 모든 실시예에 동일하게 적용될 수 있다.The second contact electrode 62 provided in the second sub-pixel SP2 includes a second lower contact electrode 621 and a second upper contact electrode 622 . The second lower contact electrode 621 is connected to the driving thin film transistor 32 through the circuit contact hole PCNT of the circuit element layer 3 provided in the second sub-pixel SP2 region, and the second The upper contact electrode 622 is connected to the second lower electrode 521 through the second contact hole CNT22 of the second insulating layer 42 provided in the second sub-pixel SP2 region. In some cases, the second lower contact electrode 621 may be connected to the driving thin film transistor 32 through a conductive material filled in the circuit contact hole PCNT, and this may be equally applied to all embodiments below. .

상기 제2 서브 화소(SP2)에 있어서, 상기 제2 하부전극(521)은 상기 제2 하부 콘택전극(621)을 통해서 상기 회로소자층(3)에 구비된 구동 박막 트랜지스터(32)와 연결되고, 제2 상부전극(522)은 상기 제2 상부 콘택전극(622)을 통해서 상기 제2 하부전극(521)에 연결되어 있다. 따라서, 제2 하부 전극(521)은 제2 하부 콘택전극(621)과 제2 상부 콘택전극(622) 사이에 배치될 수 있다. 제2 서브 화소(SP2)의 제2 발광 영역(EA2)에서는 상기 제2 하부전극(521)과 제2 상부전극(522) 사이에 상기 제2 절연층(42)이 구비되어 있다.In the second sub-pixel SP2 , the second lower electrode 521 is connected to the driving thin film transistor 32 provided in the circuit element layer 3 through the second lower contact electrode 621 , and , the second upper electrode 522 is connected to the second lower electrode 521 through the second upper contact electrode 622 . Accordingly, the second lower electrode 521 may be disposed between the second lower contact electrode 621 and the second upper contact electrode 622 . In the second emission area EA2 of the second sub-pixel SP2 , the second insulating layer 42 is provided between the second lower electrode 521 and the second upper electrode 522 .

상기 제3 서브 화소(SP3)에 구비된 제1 전극(53)은 제3 하부전극(531) 및 제3 상부전극(532)을 포함하여 이루어진다. 상기 제3 하부전극(531) 및 제3 상부전극(532)은 제3 발광 영역(EA3)에서 제3 콘택 영역(CA3)까지 연장되어 있다.The first electrode 53 provided in the third sub-pixel SP3 includes a third lower electrode 531 and a third upper electrode 532 . The third lower electrode 531 and the third upper electrode 532 extend from the third light emitting area EA3 to the third contact area CA3 .

상기 제3 하부전극(531)은 제3 서브 화소(SP3) 영역에 구비된 제2 절연층(42)의 제2 콘택홀(CNT32)을 통해서 제3 콘택 전극(63)을 구성하는 제3 상부 콘택전극(632)에 연결되어 있다. 상기 제3 상부전극(532)은 콘택홀 없이 상기 제3 하부전극(531)의 상면에 직접 접촉되어 연결되어 있다. The third lower electrode 531 is a third upper portion constituting the third contact electrode 63 through the second contact hole CNT32 of the second insulating layer 42 provided in the third sub-pixel SP3 region. It is connected to the contact electrode 632 . The third upper electrode 532 is directly contacted and connected to the upper surface of the third lower electrode 531 without a contact hole.

상기 제3 서브 화소(SP3)에 구비된 제3 콘택 전극(63)은 제3 하부 콘택전극(631) 및 제3 상부 콘택전극(632)을 포함하여 이루어진다. 상기 제3 하부 콘택전극(631)은 제3 서브 화소(SP3) 영역에 구비된 상기 회로 소자층(3)의 회로 콘택홀(PCNT)을 통해서 구동 박막 트랜지스터(33)에 연결되고, 상기 제3 상부 콘택전극(632)은 제3 서브 화소(SP3) 영역에 구비된 제1 절연층(41)의 제1 콘택홀(CNT31)을 통해서 상기 제3 하부 콘택전극(631)에 연결된다. The third contact electrode 63 provided in the third sub-pixel SP3 includes a third lower contact electrode 631 and a third upper contact electrode 632 . The third lower contact electrode 631 is connected to the driving thin film transistor 33 through the circuit contact hole PCNT of the circuit element layer 3 provided in the third sub-pixel SP3 region, and the third The upper contact electrode 632 is connected to the third lower contact electrode 631 through the first contact hole CNT31 of the first insulating layer 41 provided in the third sub-pixel SP3 region.

상기 제3 서브 화소(SP3)에 있어서, 상기 제3 하부전극(531)은 상기 제3 하부 콘택전극(631) 및 제3 상부 콘택전극(632)을 통해서 상기 회로소자층(3)에 구비된 구동 박막 트랜지스터(33)와 연결되고, 제3 상부전극(532)은 상기 제2 하부전극(521)에 직접 연결되어 있다. 따라서, 제3 하부 전극(531)은 제3 상부 콘택전극(622)의 상면에 배치될 수 있다. 제3 서브 화소(SP3)의 제3 발광 영역(EA3)에서는 상기 제3 하부전극(531)과 제3 상부전극(532) 사이에 어떠한 절연층도 구비되어 있지 않다. 경우에 따라서, 상기 제3 하부 콘택전극(631)은 회로 콘택홀(PCNT)에 채워진 도전물질을 통해서 상기 구동 박막 트랜지스터(33)에 연결될 수도 있으며, 이는 이하의 모든 실시예에 동일하게 적용될 수 있다.In the third sub-pixel SP3 , the third lower electrode 531 is provided in the circuit element layer 3 through the third lower contact electrode 631 and the third upper contact electrode 632 . It is connected to the driving thin film transistor 33 , and the third upper electrode 532 is directly connected to the second lower electrode 521 . Accordingly, the third lower electrode 531 may be disposed on the upper surface of the third upper contact electrode 622 . In the third emission area EA3 of the third sub-pixel SP3 , no insulating layer is provided between the third lower electrode 531 and the third upper electrode 532 . In some cases, the third lower contact electrode 631 may be connected to the driving thin film transistor 33 through a conductive material filled in the circuit contact hole PCNT, which may be equally applied to all embodiments below. .

이와 같이, 본 발명의 일 실시예에 따르면, 제1 서브 화소(SP1)에서의 상기 제1 하부전극(511)과 제1 상부전극(512) 사이의 거리, 제2 서브 화소(SP2)에서의 상기 제2 하부전극(521)과 제2 상부전극(522) 사이의 거리, 및 제3 서브 화소(SP3)에서의 상기 제3 하부전극(531)과 제3 상부전극(532) 사이의 거리가 모두 상이하게 구성되어 마이크로 캐버티 특성을 얻을 수 있는데, 이에 대한 구체적인 설명은 후술하기로 한다.As described above, according to an embodiment of the present invention, the distance between the first lower electrode 511 and the first upper electrode 512 in the first sub-pixel SP1 and the second sub-pixel SP2 The distance between the second lower electrode 521 and the second upper electrode 522 and the distance between the third lower electrode 531 and the third upper electrode 532 in the third sub-pixel SP3 are All are configured differently to obtain microcavity characteristics, which will be described later in detail.

상기 제1 절연층(41)은 상기 회로 소자층(3) 상에 구비되어 있다. 특히, 상기 제1 절연층(41)은 상기 제1 하부 콘택전극(611), 상기 제2 하부전극(521), 및 상기 제3 상부 콘택 전극(632) 아래에 구비되어 있다. 상기 제1 절연층(41)에는 서브 화소(SP1, SP2, SP3) 별로 제1 콘택홀(CNT11, CNT21, CNT31)이 구비되어 있다. 상기 제1 절연층(41)은 상기 제1 콘택홀(CNT11, CNT21, CNT31) 영역을 제외하고 복수의 서브 화소(SP1, SP2, SP3) 영역에 전체적으로 형성될 수 있으며, 그에 따라 제1 서브 화소(SP1)에 형성된 제1 절연층(41), 제2 서브 화소(SP2)에 형성된 제1 절연층(41) 및 제3 서브 화소(SP3)에 형성된 제1 절연층(41)은 서로 연결될 수 있다. The first insulating layer 41 is provided on the circuit element layer 3 . In particular, the first insulating layer 41 is provided under the first lower contact electrode 611 , the second lower electrode 521 , and the third upper contact electrode 632 . In the first insulating layer 41 , first contact holes CNT11 , CNT21 , and CNT31 are provided for each sub-pixel SP1 , SP2 , and SP3 . The first insulating layer 41 may be formed entirely in the regions of the plurality of sub-pixels SP1, SP2, and SP3 except for the regions of the first contact holes CNT11, CNT21, and CNT31, and thus the first sub-pixel The first insulating layer 41 formed on SP1, the first insulating layer 41 formed on the second sub-pixel SP2, and the first insulating layer 41 formed on the third sub-pixel SP3 may be connected to each other. there is.

상기 제2 절연층(42)은 상기 제1 절연층(41) 상에 구비되어 있다. 특히, 상기 제2 절연층(42)은 상기 제1 상부 콘택전극(612), 상기 제2 상부 콘택전극(622), 및 제3 하부전극(531) 아래에 구비되어 있다. 상기 제2 절연층(42)에는 서브 화소(SP1, SP2, SP3) 별로 제2 콘택홀(CNT12, CNT22, CNT32)이 구비되어 있다. 상기 제2 절연층(42)은 상기 제2 콘택홀(CNT12, CNT22, CNT32) 영역을 제외하고 복수의 서브 화소(SP1, SP2, SP3) 영역에 전체적으로 형성될 수 있으며, 그에 따라 제1 서브 화소(SP1)에 형성된 제2 절연층(42), 제2 서브 화소(SP2)에 형성된 제2 절연층(42) 및 제3 서브 화소(SP3)에 형성된 제2 절연층(42)은 서로 연결될 수 있다.The second insulating layer 42 is provided on the first insulating layer 41 . In particular, the second insulating layer 42 is provided under the first upper contact electrode 612 , the second upper contact electrode 622 , and the third lower electrode 531 . Second contact holes CNT12 , CNT22 , and CNT32 are provided in the second insulating layer 42 for each sub-pixel SP1 , SP2 , and SP3 . The second insulating layer 42 may be entirely formed in the plurality of sub-pixels SP1, SP2, and SP3 except for the second contact holes CNT12, CNT22, and CNT32, and thus the first sub-pixel The second insulating layer 42 formed on SP1, the second insulating layer 42 formed on the second sub-pixel SP2, and the second insulating layer 42 formed on the third sub-pixel SP3 may be connected to each other. there is.

도 2b를 참조하면, 제1 서브 화소(SP1)에 구비된 제1 콘택홀(CNT11)과 제2 콘택홀(CNT12)은 서로 중첩되도록 배치될 수 있다. 그리고, 제1 콘택홀(CNT11)의 폭(CNT11W)은 제2 콘택홀(CNT12)의 폭(CNT12W)보다 넓게 구비될 수 있다. 이에 따라, 제1 콘택홀(CNT11)의 일부는 제2 콘택홀(CNT12)의 내부에 위치될 수 있다. 이렇게 되면, 제2 절연층(42) 상에 형성되는 제1 상부 콘택전극(612)의 일부가 제1 절연층(41) 상에 형성되는 제1 하부 콘택전극(611)에 삽입될 수 있고, 제1 상부 콘택전극(612)과 제1 하부 콘택전극(611)이 절연층(4)의 두께 방향으로 대략 일치하는 위치에 배치될 수 있으므로, 제1 콘택 영역(CA1)의 양측에 위치하는 제1 상부 전극(512)들이 평탄화되는 길이를 증가시킬 수 있다. 이에 따라, 평탄화된 제1 상부 전극(512) 상에 배치되는 유기발광층(7)과 제2 전극(8)도 제1 상부 전극(512)과 같이 평탄화되는 길이가 증가될 수 있으므로, 결과적으로 마이크로 캐버티 효과가 구현되는 면적 증대에 따라 광 효율이 더 향상될 수 있다.Referring to FIG. 2B , the first contact hole CNT11 and the second contact hole CNT12 provided in the first sub-pixel SP1 may be disposed to overlap each other. In addition, the width CNT11W of the first contact hole CNT11 may be wider than the width CNT12W of the second contact hole CNT12 . Accordingly, a portion of the first contact hole CNT11 may be located inside the second contact hole CNT12 . In this way, a part of the first upper contact electrode 612 formed on the second insulating layer 42 may be inserted into the first lower contact electrode 611 formed on the first insulating layer 41, Since the first upper contact electrode 612 and the first lower contact electrode 611 may be disposed at positions substantially coincident with each other in the thickness direction of the insulating layer 4 , the first upper contact electrode 612 and the first lower contact electrode 611 may be disposed on both sides of the first contact area CA1 . 1 The length at which the upper electrodes 512 are planarized may be increased. Accordingly, the organic light emitting layer 7 and the second electrode 8 disposed on the planarized first upper electrode 512 may also increase in length to be planarized like the first upper electrode 512 , and consequently, the micro Light efficiency may be further improved as the area in which the cavity effect is implemented increases.

한편, 컨택 영역이 서브 화소의 중앙에 배치되지 않고 트렌치에 인접하게 배치되는 경우에 있어서, 제1 콘택홀과 제2 콘택홀이 중첩되지 않으면, 즉, 제1 상부 콘택전극의 일부가 제1 하부 콘택전극에 삽입되지 않으면 트렌치 부근에서 절연층과 제1 전극에 의한 단차가 크게 발생할 수 있고, 이러한 단차는 정상적인 트렌치 형성을 저해하며, 트렌치 상에 배치되는 봉지층에 균열과 같은 심(seam)을 발생시켜서 투습 불량을 발생시킬 수 있다.On the other hand, in the case where the contact region is not disposed in the center of the sub-pixel but adjacent to the trench, if the first contact hole and the second contact hole do not overlap, that is, a portion of the first upper contact electrode is formed adjacent to the first lower portion. If it is not inserted into the contact electrode, a large step may occur due to the insulating layer and the first electrode in the vicinity of the trench. This can cause moisture permeability failure.

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 제1 콘택홀(CNT11)의 폭(CNT11W)이 제2 콘택홀(CNT12)의 폭(CNT12W)보다 넓게 구비되고 제1 콘택홀(CNT11)과 제2 콘택홀(CNT12)이 서로 중첩되도록 배치하여 제1 콘택홀(CNT11)의 일부를 제2 콘택홀(CNT12)의 내부에 위치시킴으로써, 발광 면적 증대에 따라 광 효율을 향상시킬 수 있고, 상기와 같은 구조를 갖는 제1 콘택 영역(CA1)을 서브 화소의 중앙에 배치하여 비정상적인 형태의 트렌치 형성을 방지하여서 신뢰성을 향상시킬 수 있다.Accordingly, in the display device 1 according to an embodiment of the present invention, the width CNT11W of the first contact hole CNT11 is wider than the width CNT12W of the second contact hole CNT12, and the first contact hole ( CNT11) and the second contact hole CNT12 are arranged to overlap each other and a part of the first contact hole CNT11 is positioned inside the second contact hole CNT12, so that the light efficiency can be improved according to the increase in the emission area In addition, by arranging the first contact area CA1 having the above structure at the center of the sub-pixel, the formation of an abnormally shaped trench may be prevented, thereby improving reliability.

본 발명의 일 실시예에 따른 표시장치는 상부 발광 방식으로 이루어지며, 이를 위해서, 상기 제1 전극(51, 52, 53)은 상기 유기발광층(7)에서 발광된 광을 상부쪽으로 반사시키도록 구비된다. 이를 위해서, 2층 구조로 이루어진 상기 제1 전극(51, 52, 53)의 아래쪽에 위치하는 제1 내지 제3 하부 전극(511, 521, 531)은 반사전극으로 이루어지고, 상기 제1 전극(51, 52, 53)의 위쪽에 위치하는 제1 내지 제3 상부 전극(512, 522, 532)은 투명전극 또는 반투명전극으로 이루어진다. 이때, 상기 제1 내지 제3 상부 전극(512, 522, 532)은 제1 내지 제3 서브 화소(SP1, SP2, SP3)의 양극(Anode)으로 기능할 수 있다.The display device according to an embodiment of the present invention is formed in a top emission type. To this end, the first electrodes 51 , 52 , 53 are provided to reflect the light emitted from the organic emission layer 7 upward. do. To this end, the first to third lower electrodes 511, 521, and 531 positioned below the first electrodes 51, 52, 53 having a two-layer structure are formed of a reflective electrode, and the first electrode ( The first to third upper electrodes 512 , 522 , and 532 positioned above the 51 , 52 , and 53 are formed of a transparent electrode or a semi-transparent electrode. In this case, the first to third upper electrodes 512 , 522 , and 532 may function as anodes of the first to third sub-pixels SP1 , SP2 , and SP3 .

본 명세서 전체에서, 반사 전극은 입사되는 광을 반사시키는 전극이고, 투명 전극은 입사되는 광을 투과시키는 전극이고, 반투명 전극은 입사되는 광의 일부는 투과시키고 나머지는 반사시키는 전극으로서, 투명도 측면에서는 반사 전극, 반투명 전극, 및 투명 전극 순서로 투명도가 우수하고, 반사도 측면에서는 투명 전극, 반투명 전극, 및 반사 전극 순서로 반사도가 우수하게 된다. Throughout this specification, a reflective electrode is an electrode that reflects incident light, a transparent electrode is an electrode that transmits incident light, and a semi-transparent electrode is an electrode that transmits some of the incident light and reflects the rest, and reflects in terms of transparency. The electrode, the translucent electrode, and the transparent electrode are excellent in transparency in the order, and in terms of reflectivity, the reflectivity is excellent in the order of the transparent electrode, the translucent electrode, and the reflective electrode.

이때, 상기 제1 서브 화소(SP1)의 제1 하부전극(511)과 동일한 층에 위치하는 상기 제2 서브 화소(SP2)의 제2 하부 콘택전극(621) 및 상기 제3 서브 화소(SP3)의 제3 하부 콘택전극(631)은 상기 제1 하부전극(511)과 동일한 물질로 동일한 공정을 통해 패턴 형성된다.In this case, the second lower contact electrode 621 and the third sub-pixel SP3 of the second sub-pixel SP2 are positioned on the same layer as the first lower electrode 511 of the first sub-pixel SP1 . The third lower contact electrode 631 is patterned through the same process using the same material as the first lower electrode 511 .

한편, 상기 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이의 경계 부분에는 유기발광층(7)의 일부를 단절시키기 위한 트렌치(T)가 구비된다. 상기 트렌치(T)의 하면에는 상기 트렌치(T)의 양측에 인접한 절연층(4), 예로서, 도 2a를 기준으로 제1 서브 화소(SP1)에 위치된 제1 절연층(41)과 제2 절연층(42), 및 제2 서브 화소(SP)에 위치된 제1 절연층(41)과 제2 절연층(42) 간의 단차 발생을 방지하기 위한 단차보상부(9)가 배치될 수 있다.Meanwhile, a trench T for isolating a portion of the organic light emitting layer 7 is provided at a boundary between the first to third sub-pixels SP1 , SP2 , and SP3 . On the lower surface of the trench T, an insulating layer 4 adjacent to both sides of the trench T, for example, a first insulating layer 41 positioned in the first sub-pixel SP1 with reference to FIG. 2A and a second insulating layer 41 The second insulating layer 42 and the step difference compensating part 9 for preventing a step difference between the first insulating layer 41 and the second insulating layer 42 positioned in the second sub-pixel SP may be disposed. there is.

상기 제2 서브 화소(SP2)의 제2 하부전극(521)과 동일한 층에 위치하는 상기 제1 서브 화소(SP1)의 제1 하부 콘택전극(611) 및 상기 제3 서브 화소(SP3)의 제3 상부 콘택 전극(632)은 상기 제2 하부전극(521)과 동일한 물질로 동일한 공정을 통해 패턴 형성된다.The first lower contact electrode 611 of the first sub-pixel SP1 and the second lower electrode 521 of the third sub-pixel SP3 are positioned on the same layer as the second lower electrode 521 of the second sub-pixel SP2. 3 The upper contact electrode 632 is patterned through the same process using the same material as the second lower electrode 521 .

또한, 상기 제3 서브 화소(SP3)의 제3 하부전극(531)과 동일한 층에 위치하는 상기 제1 서브 화소(SP1)의 제1 상부 콘택전극(612) 및 상기 제2 서브 화소(SP2)의 제2 상부 콘택전극(622)은 상기 제3 하부전극(531)과 동일한 물질로 동일한 공정을 통해 패턴 형성된다. In addition, the first upper contact electrode 612 and the second sub-pixel SP2 of the first sub-pixel SP1 are positioned on the same layer as the third lower electrode 531 of the third sub-pixel SP3. of the second upper contact electrode 622 is patterned through the same process with the same material as that of the third lower electrode 531 .

또한, 서로 동일한 층에 위치하는 상기 제1 서브 화소(SP1)의 제1 상부전극(512), 상기 제2 서브 화소(SP2)의 제2 상부전극(522), 및 상기 제3 서브 화소(SP3)의 제3 상부전극(532)은 서로 동일한 물질로 동일한 공정을 통해 패턴 형성된다.In addition, the first upper electrode 512 of the first sub-pixel SP1 , the second upper electrode 522 of the second sub-pixel SP2 , and the third sub-pixel SP3 are positioned on the same layer as each other. ), the third upper electrode 532 is patterned through the same process using the same material.

상기 제1 내지 제3 하부 전극(511, 521, 531)이 반사전극으로 이루어지고 상기 제1 내지 제3 상부 전극(512, 522, 532)은 투명전극으로 이루어진 경우, 상기 유기발광층(7)에서 발광된 광의 일부는 상기 제1 내지 제3 하부 전극(511, 521, 531)에서 반사된 후 상기 제1 내지 제3 상부 전극(512, 522, 532)을 투과하여 상부 방향으로 방출된다. 이 경우, 상기 제1 내지 제3 상부 전극(512, 522, 532)을 투과한 광의 일부는 반투명전극으로 이루어진 제2 전극(8)에 의해 반사되어 제1 내지 제3 상부 전극(512, 522, 532)을 투과하여 하부에 위치된 제1 내지 제3 하부 전극(511, 521, 531)에서 재반사되면서 전술한 과정을 반복하게 된다. 이와 같이, 상기 제1 내지 제3 하부 전극(511, 521, 531)과 상기 제2 전극(8) 사이에서 반사와 재반사가 반복되면서 광이 증폭되어 광효율이 향상될 수 있다. When the first to third lower electrodes 511 , 521 , and 531 are reflective electrodes and the first to third upper electrodes 512 , 522 , and 532 are transparent electrodes, in the organic light emitting layer 7 , A portion of the emitted light is reflected by the first to third lower electrodes 511 , 521 , and 531 , and then passes through the first to third upper electrodes 512 , 522 , and 532 and is emitted upward. In this case, a portion of the light that has passed through the first to third upper electrodes 512 , 522 , and 532 is reflected by the second electrode 8 made of a semi-transparent electrode, and thus the first to third upper electrodes 512 , 522 , The above-described process is repeated while passing through 532 and being re-reflected from the first to third lower electrodes 511 , 521 , and 531 positioned below. As described above, light is amplified while reflection and re-reflection are repeated between the first to third lower electrodes 511 , 521 , and 531 and the second electrode 8 , so that light efficiency can be improved.

특히, 상기 제1 내지 제3 하부 전극(511, 521, 531)과 상기 제2 전극(8) 사이의 거리가 각 서브 화소(SP1, SP2, SP3)에서 방출되는 광의 반파장(λ/2)의 정수배가 되면 보강간섭이 일어나 광이 더욱 증폭되며, 전술한 반사 및 재반사 과정이 반복되면 광이 증폭되는 정도가 지속적으로 커져서 광의 외부 추출 효율이 향상될 수 있다. 이와 같은 특성을 마이크로 캐버티(microcavity) 특성이라 한다. In particular, the distance between the first to third lower electrodes 511 , 521 , and 531 and the second electrode 8 is a half wavelength (λ/2) of light emitted from each of the sub-pixels SP1 , SP2 , and SP3 . Constructive interference occurs to further amplify the light when it is an integer multiple of , and when the above-described reflection and re-reflection processes are repeated, the degree of amplification of the light is continuously increased, so that the external extraction efficiency of light can be improved. Such a characteristic is called a microcavity characteristic.

따라서, 본 발명의 일 실시예에 따르면, 제1 콘택 전극(61), 제2 콘택 전극(62), 및 제3 콘택 전극(63)을 이용하여, 제1 서브 화소(SP1)에서의 상기 제1 하부전극(511)과 제2 전극(8) 사이의 제1 거리(D1), 제2 서브 화소(SP2)에서의 상기 제2 하부전극(521)과 제2 전극(8) 사이의 제2 거리(D2), 및 제3 서브 화소(SP3)에서의 상기 제3 하부전극(531)과 제2 전극(8) 사이의 제3 거리(D3)를 모두 상이하게 구성할 수 있기 때문에, 각각의 서브 화소(SP1, SP2, SP3)에서 서로 다른 색의 광 추출 효율이 향상되는 마이크로 캐버티 특성을 얻을 수 있다.Accordingly, according to an embodiment of the present invention, the first contact electrode 61 , the second contact electrode 62 , and the third contact electrode 63 are used in the first sub-pixel SP1 . 1 A first distance D1 between the lower electrode 511 and the second electrode 8 , a second distance D1 between the second lower electrode 521 and the second electrode 8 in the second sub-pixel SP2 . Since the distance D2 and the third distance D3 between the third lower electrode 531 and the second electrode 8 in the third sub-pixel SP3 may be configured differently, each In the sub-pixels SP1 , SP2 , and SP3 , it is possible to obtain a microcavity characteristic in which light extraction efficiency of different colors is improved.

예를 들어, 장파장대인 적색의 광을 방출하는 제1 서브 화소(SP1)에서의 상기 제1 거리(D1)를 가장 길게 구성하고, 단파장대인 청색의 광을 방출하는 제3 서브 화소(SP3)에서의 상기 제3 거리(D3)를 가장 짧게 구성할 수 있지만, 반드시 그에 한정되는 것은 아니다.For example, in the third sub-pixel SP3 that configures the longest distance D1 from the first sub-pixel SP1 emitting red light having a long wavelength band and emitting blue light having a short wavelength band The third distance D3 of may be configured as the shortest, but is not necessarily limited thereto.

한편, 본 발명의 일 실시예에 따른 표시장치(1)는 콘택 영역(CA1, CA2, CA3) 각각의 양측에도 발광 영역(EA1, EA2, EA3)이 형성되기 때문에, 전술한 마이크로 캐버티 구조, 즉, 제1 서브 화소(SP1)에서 제1 거리(D1)로 배치된 제1 하부전극(511)과 제2 전극(8), 제2 서브 화소(SP2)에서 제2 거리(D2)로 배치된 제2 하부전극(521)과 제2 전극(8), 및 제3 서브 화소(SP3)에서 제3 거리(D3)로 배치된 제3 하부전극(531)과 제2 전극(8)은 콘택 영역(CA1, CA2, CA3) 각각의 양측에도 구비될 수 있다.On the other hand, in the display device 1 according to an embodiment of the present invention, since the light emitting areas EA1, EA2, EA3 are also formed on both sides of each of the contact areas CA1, CA2, CA3, the microcavity structure, That is, the first lower electrode 511 and the second electrode 8 are arranged at a first distance D1 from the first sub-pixel SP1 , and are arranged at a second distance D2 from the second sub-pixel SP2 . The second lower electrode 521 and the second electrode 8, and the third lower electrode 531 and the second electrode 8 disposed at a third distance D3 from the third sub-pixel SP3 are in contact. It may also be provided on both sides of each of the areas CA1 , CA2 , and CA3 .

본 발명의 일 실시예에 따르면, 복수의 서브 화소(SP1, SP2, SP3) 각각에서 제1 내지 제3 상부 전극(512, 522, 532)과 제2 전극(8) 사이의 거리는 모두 동일할 수 있고, 상기 제1 내지 제3 상부 전극(512, 522, 532)은 제2 절연층(42) 상에서 동일한 높이에 형성될 수 있다. 따라서, 상기 제1 내지 제3 상부 전극(512, 522, 532) 상에 형성되는 유기발광층(7)의 하면이 전체적으로 균일한 높이를 가지기 때문에, 상기 제1 내지 제3 상부 전극(512, 522, 532)이 서로 상이한 높이에 형성되는 경우보다 상기 유기발광층(7)의 프로파일이 개선될 수 있다. 이하의 다양한 실시예에서도 복수의 서브 화소(SP1, SP2, SP3) 각각에서 제1 내지 제3 상부 전극(512, 522, 532)과 제2 전극(8) 사이의 거리는 모두 동일하게 형성되고, 상기 제1 내지 제3 상부 전극(512, 522, 532)은 제2 절연층(42) 상에서 동일한 높이에 형성될 수 있지만, 반드시 그에 한정되는 것은 아니다.According to an embodiment of the present invention, the distance between the first to third upper electrodes 512 , 522 , 532 and the second electrode 8 in each of the plurality of sub-pixels SP1 , SP2 , and SP3 may be the same. and the first to third upper electrodes 512 , 522 , and 532 may be formed on the second insulating layer 42 at the same height. Accordingly, since the lower surface of the organic light emitting layer 7 formed on the first to third upper electrodes 512 , 522 , and 532 has a uniform height as a whole, the first to third upper electrodes 512 , 522 , The profile of the organic light emitting layer 7 may be improved compared to the case where 532 is formed at different heights. In various embodiments below, in each of the plurality of sub-pixels SP1, SP2, and SP3, the distances between the first to third upper electrodes 512, 522, 532 and the second electrode 8 are all formed to be the same, and The first to third upper electrodes 512 , 522 , and 532 may be formed at the same height on the second insulating layer 42 , but are not limited thereto.

한편, 복수의 서브 화소(SP1, SP2, SP3) 각각에서 제1 내지 제3 상부 전극(512, 522, 532)과 제2 전극(8) 사이의 거리는 모두 동일하기 때문에, 마이크로 캐버티 효과는 실질적으로 제1 서브 화소(SP1)에서 상기 제1 하부전극(511)과 제1 상부전극(512) 사이의 거리, 제2 서브 화소(SP2)에서 상기 제2 하부전극(521)과 제2 상부전극(522) 사이의 거리, 및 제3 서브 화소(SP3)에서 상기 제3 하부전극(531)과 제3 상부전극(532) 사이의 거리에 따라 구현될 수 있다. 따라서, 각각의 서브 화소(SP1, SP2, SP3)에서 서로 다른 색의 광 추출 효율이 향상될 수 있다.Meanwhile, since the distances between the first to third upper electrodes 512 , 522 , 532 and the second electrode 8 in each of the plurality of sub-pixels SP1 , SP2 , and SP3 are all the same, the microcavity effect is substantially reduced the distance between the first lower electrode 511 and the first upper electrode 512 in the first sub-pixel SP1, and the second lower electrode 521 and the second upper electrode in the second sub-pixel SP2 It may be implemented according to the distance between the 522 , and the distance between the third lower electrode 531 and the third upper electrode 532 in the third sub-pixel SP3 . Accordingly, light extraction efficiency of different colors from each of the sub-pixels SP1 , SP2 , and SP3 may be improved.

상기 펜스(F)는 제2 절연층(42) 상에서 상기 제1 전극(51, 52, 53)의 제1 내지 제3 상부 전극(512, 522, 532)의 끝단을 덮도록 형성되며, 그에 따라 상기 제1 내지 제3 상부 전극(512, 522, 532)의 끝단에 전류가 집중되어 발광효율이 저하되는 문제가 방지될 수 있다. 상기 펜스(F)는 상대적으로 얇은 두께의 무기 절연막으로 이루어질 수 있지만, 상대적으로 두꺼운 두께의 유기 절연막으로 이루어질 수도 있다.The fence F is formed on the second insulating layer 42 to cover the ends of the first to third upper electrodes 512 , 522 , and 532 of the first electrodes 51 , 52 , 53 , and accordingly A problem in which currents are concentrated at the ends of the first to third upper electrodes 512 , 522 , and 532 to lower luminous efficiency can be prevented. The fence F may be formed of an inorganic insulating film having a relatively thin thickness, or may be formed of an organic insulating film having a relatively thick thickness.

상기 펜스(F)는 복수의 서브 화소(SP1, SP2, SP3) 사이의 경계에 배치된 트렌치(T)를 기준으로 양측에 배치되고, 매트릭스 구조로 형성되면서 복수의 서브 화소(SP1, SP2, SP3) 각각에 발광 영역(EA1, EA2, EA3)을 정의한다. 즉, 각각의 서브 화소(SP1, SP2, SP3)에서 상기 펜스(F)와 절연부(IP)가 형성되지 않고 노출된 상기 제1 내지 제3 상부 전극(512, 522, 532)의 노출 영역이 발광 영역(EA1, EA2, EA3)이 된다.The fence F is disposed on both sides based on the trench T disposed at the boundary between the plurality of sub-pixels SP1, SP2, and SP3, and is formed in a matrix structure, and the plurality of sub-pixels SP1, SP2, SP3 ) define the light emitting regions EA1, EA2, EA3, respectively. That is, in each of the sub-pixels SP1, SP2, and SP3, the exposed areas of the first to third upper electrodes 512, 522, and 532 exposed without the fence F and the insulating part IP are formed. light emitting areas EA1, EA2, and EA3.

콘택 영역(CA1, CA2, CA3)이 갖는 콘택 전극(61, 62, 63) 상에는 절연부(IP)가 콘택 전극(61, 62, 63)과 오버랩되도록 형성될 수 있으며, 그에 따라, 단차진 상기 콘택 영역(CA1, CA2, CA3)은 상기 발광 영역(EA1, EA2, EA3)과 오버랩되지 않게 될 수 있다. 상기 절연부(IP)는 상기 펜스(F)와 동일한 층에 동일한 물질로 구비될 수 있다.An insulating portion IP may be formed on the contact electrodes 61 , 62 , and 63 of the contact regions CA1 , CA2 , and CA3 to overlap the contact electrodes 61 , 62 , and 63 . The contact areas CA1 , CA2 , and CA3 may not overlap the light emitting areas EA1 , EA2 , and EA3 . The insulating part IP may be provided on the same layer as the fence F and made of the same material.

한편, 상기 콘택 전극(61, 62, 63) 각각의 폭(CEW)은 제1 전극(51, 52, 53) 각각의 폭(EW)보다 좁게 구비될 수 있다. 즉, 제1 내지 제3 콘택전극(61, 62, 63) 각각은 각 서브 화소(SP1, SP2, SP3)의 제1 내지 제3 하부 전극(511, 521, 531)과 제1 내지 제3 상부 전극(512, 522, 532) 각각보다 좁은 폭으로 형성될 수 있다. 이에 따라, 콘택 전극이 제1 전극의 폭과 동일하게 구비되는 경우에 비해 발광 면적을 증가 수 있어서 광 효율이 향상될 수 있다.Meanwhile, a width CEW of each of the contact electrodes 61 , 62 , and 63 may be narrower than a width EW of each of the first electrodes 51 , 52 , and 53 . That is, each of the first to third contact electrodes 61 , 62 , and 63 includes the first to third lower electrodes 511 , 521 , and 531 and the first to third upper electrodes of each of the sub-pixels SP1 , SP2 , and SP3 . The electrodes 512 , 522 , and 532 may be formed to have a narrower width than each of the electrodes. Accordingly, compared to a case in which the contact electrode is provided to have the same width as the first electrode, the light emitting area may be increased, and thus light efficiency may be improved.

또한, 콘택 전극(61, 62, 63) 각각의 폭(CEW)이 제1 전극(51, 52, 53) 각각의 폭(EW)보다 좁게 구비됨으로써, 콘택영역(CA1, CA2, CA3) 각각의 양측에 배치되는 발광영역(EA1, EA2, EA3)에서도 제1 내지 제3 하부 전극(511, 521, 531)과 제2 전극(8) 간에 마이크로 캐버티 효과가 구현될 수 있다.In addition, the width CEW of each of the contact electrodes 61 , 62 , and 63 is provided to be smaller than the width EW of each of the first electrodes 51 , 52 , 53 , so that each of the contact regions CA1 , CA2 , and CA3 is formed. The microcavity effect may be implemented between the first to third lower electrodes 511 , 521 , 531 and the second electrode 8 in the light emitting areas EA1 , EA2 , and EA3 disposed on both sides.

도 1과 같이, 상기 제1 내지 제3 콘택 영역(CA1, CA2, CA3) 각각은 제1 방향(X축 방향)으로 서브 화소(SP1, SP2, SP3) 각각의 중앙에 배치되면서, 제2 방향(Y축 방향)으로 각 서브 화소(SP1, SP2, SP3)의 가장자리, 예로서 상측에 배치될 수 있다. 이는, 도 1과 같이, 콘택 영역(CA1, CA2, CA3) 각각의 양측에 발광 영역(EA1, EA2, EA3)를 형성하기 위함이다.As shown in FIG. 1 , each of the first to third contact areas CA1 , CA2 , and CA3 is disposed at the center of each of the sub-pixels SP1 , SP2 , and SP3 in the first direction (X-axis direction) while being disposed in the second direction. The (Y-axis direction) may be disposed at an edge, for example, an upper side of each of the sub-pixels SP1 , SP2 , and SP3 . This is to form the light emitting areas EA1 , EA2 , and EA3 on both sides of each of the contact areas CA1 , CA2 , and CA3 as shown in FIG. 1 .

상기 복수의 콘택 영역(CA1, CA2, CA3)이 상기 복수의 서브 화소(SP1, SP2, SP3)의 상측의 중앙에 위치되는 이유는, 상기 콘택 영역(CA1, CA2, CA3)이 트렌치(T)에 가깝게 배치되면, 트렌치(T)와 콘택 영역(CA1, CA2, CA3) 간에 단차가 커져서 트렌치(T)가 정상적인 형태로 형성되지 못하기 때문이다. 예컨대, 트렌치(T)의 좌측과 우측에 위치된 절연층의 높이가 서로 달라져서 트렌치(T) 상에 배치되는 유기발광층과 제2 전극과 봉지층이 비정상적인 트렌치(T)의 형태로 인해 기울어지거나 트렌치(T)에 삽입되는 비정상적인 형태를 갖게 될 수 있고, 이는 제2 전극이 단절되어 구동 불량이 발생되거나 봉지층에 심(seam)이 발생하여 수분 등의 투습으로 인해 신뢰성이 저하될 수 있다.The reason that the plurality of contact areas CA1 , CA2 , and CA3 is located at the center of the upper side of the plurality of sub-pixels SP1 , SP2 , and SP3 is that the contact areas CA1 , CA2 , and CA3 are formed in the trench T This is because, when disposed close to , the step difference between the trench T and the contact areas CA1 , CA2 , and CA3 increases, so that the trench T is not formed in a normal shape. For example, the heights of the insulating layers positioned on the left and right sides of the trench T are different from each other, so that the organic light emitting layer, the second electrode, and the encapsulation layer disposed on the trench T are inclined due to the abnormal shape of the trench T or the trench. It may have an abnormal shape inserted into (T), which may cause a driving failure due to disconnection of the second electrode or a seam in the encapsulation layer, thereby reducing reliability due to permeation of moisture or the like.

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 복수의 콘택 영역(CA1, CA2, CA3)이 상기 복수의 서브 화소(SP1, SP2, SP3)의 상측의 중앙에 위치하도록 구비됨으로써, 정상적인 형태의 트렌치(T)를 형성할 수 있고 이에 따라 트렌치(T) 상에서 제2 전극(8)의 단절을 방지하여 구동 불량을 방지할 수 있고 또한 심(seam) 발생을 방지하여 신뢰성을 향상시킬 수 있다.Accordingly, in the display device 1 according to an embodiment of the present invention, the plurality of contact areas CA1 , CA2 , and CA3 are provided to be located in the center of the upper side of the plurality of sub-pixels SP1 , SP2 and SP3, It is possible to form the trench T of a normal shape, thereby preventing the disconnection of the second electrode 8 on the trench T to prevent driving failure, and also to prevent the generation of a seam to improve reliability. can

결과적으로, 도 1과 같이, 제1 발광 영역(EA1)은 제1 콘택 영역(CA1)의 양측과 하측에 구비될 수 있고, 제2 발광 영역(EA2)은 제2 콘택 영역(CA2)의 양측과 하측에 구비될 수 있으며, 제3 발광 영역(EA3)은 제3 콘택 영역(CA3)의 양측과 하측에 구비될 수 있다. 이 경우, 각 서브 화소(SP1, SP2, SP3)의 제1 내지 제3 콘택 영역(CA1, CA2, CA3)을 덮는 절연부(IP1, IP2, IP3)는 제1 방향(X축 방향)으로 펜스(F)와 이격되고, 제2 방향(Y축 방향)으로 상측에 배치된 펜스(F)와 접촉될 수 있다. 상기 절연부(IP1, IP2, IP3)는 펜스(F)와 동일한 층에서 동일한 물질로 패턴되어 형성될 수 있다.As a result, as shown in FIG. 1 , the first light emitting area EA1 may be provided on both sides and below the first contact area CA1 , and the second light emitting area EA2 is formed on both sides of the second contact area CA2 . The third light emitting area EA3 may be provided on both sides and the lower side of the third contact area CA3 . In this case, the insulating portions IP1 , IP2 , and IP3 covering the first to third contact areas CA1 , CA2 , CA3 of each of the sub-pixels SP1 , SP2 , and SP3 are fenced in the first direction (X-axis direction). It is spaced apart from (F) and may be in contact with the fence (F) disposed on the upper side in the second direction (Y-axis direction). The insulating portions IP1 , IP2 , and IP3 may be patterned and formed from the same material on the same layer as the fence F .

그러므로, 제1 서브 화소(SP1)에서는 제1 콘택 영역(CA1)의 하측에 제1 폭(W1)의 제1 발광 영역(EA1)이 구비되고, 제1 콘택 영역(CA1)의 일측에 제2 폭(W2)의 제1 발광 영역(EA1)이 구비되며, 제1 콘택 영역(CA1)의 타측에 제2 폭(W2)의 제1 발광 영역(EA1)이 구비될 수 있다.Therefore, in the first sub-pixel SP1 , the first light emitting area EA1 of the first width W1 is provided below the first contact area CA1 , and the second light emitting area EA1 is provided on one side of the first contact area CA1 . A first light-emitting area EA1 having a width W2 may be provided, and a first light-emitting area EA1 having a second width W2 may be provided on the other side of the first contact area CA1.

제2 서브 화소(SP2)에서는 제2 콘택 영역(CA2)의 하측에 제1 폭(W1)의 제2 발광 영역(EA2)이 구비되고, 제2 콘택 영역(CA2)의 일측에 제2 폭(W2)의 제2 발광 영역(EA2)이 구비되며, 제2 콘택 영역(CA2)의 타측에 제2 폭(W2)의 제2 발광 영역(EA2)이 구비될 수 있다.In the second sub-pixel SP2 , the second light emitting area EA2 of the first width W1 is provided under the second contact area CA2 , and the second light emitting area EA2 is provided on one side of the second contact area CA2 . A second light emitting area EA2 of W2 may be provided, and a second light emitting area EA2 having a second width W2 may be provided on the other side of the second contact area CA2 .

제3 서브 화소(SP3)에서는 제3 콘택 영역(CA3)의 하측에 제1 폭(W1)의 제3 발광 영역(EA3)이 구비되고, 제3 콘택 영역(CA3)의 일측에 제2 폭(W2)의 제3 발광 영역(EA3)이 구비되며, 제3 콘택 영역(CA3)의 타측에 제2 폭(W2)의 제3 발광 영역(EA3)이 구비될 수 있다.In the third sub-pixel SP3 , a third light emitting area EA3 having a first width W1 is provided below the third contact area CA3 , and a second width EA3 is provided on one side of the third contact area CA3 . A third light emitting area EA3 of W2 may be provided, and a third light emitting area EA3 having a second width W2 may be provided on the other side of the third contact area CA3 .

상기 제1 폭(W1)은 상기 제2 폭(W2), 제3 폭(W3), 및 콘택영역(CA1, CA2, CA3) 각각의 폭을 합산한 폭과 동일할 수 있다. 상기 콘택영역(CA1, CA2, CA3) 각각의 폭은 도 2a에 도시된 절연부(IP)의 폭과 같을 수 있다.The first width W1 may be equal to the sum of the second width W2 , the third width W3 , and the widths of the contact regions CA1 , CA2 , and CA3 . The width of each of the contact areas CA1 , CA2 , and CA3 may be the same as the width of the insulating portion IP shown in FIG. 2A .

도 2a와 같이, 상기 제1 내지 제3 서브 화소(SP1, SP2, SP3) 각각의 제1 내지 제3 콘택 영역(CA1, CA2, CA3) 각각의 양측과 하측에 배치되는 제1 내지 제3 발광 영역(EA1, EA2, EA3)은 제1 내지 제3 상부 전극(512, 522, 532) 및 상기 제1 내지 제3 상부 전극(512, 522, 532)에 의해 덮이지 않는 절연층(4) 상에 펜스(F) 또는 절연부(IP)를 이루는 절연물질을 전면 증착한 후, 제1 내지 제3 콘택 영역(CA1, CA2, CA3) 및 제1 내지 제3 상부 전극(512, 522, 532) 각각의 끝단을 덮는 부분을 제외한 나머지를 패턴하여 제거함으로써 형성할 수 있다. 이 경우, 상기 트렌치(T) 상에 배치된 절연물질도 함께 제거될 수 있다.As shown in FIG. 2A , the first to third light emitting diodes are disposed on both sides and below each of the first to third contact areas CA1 , CA2 and CA3 of each of the first to third sub-pixels SP1 , SP2 , and SP3 , respectively. The areas EA1 , EA2 , and EA3 are formed on the insulating layer 4 not covered by the first to third upper electrodes 512 , 522 , and 532 and the first to third upper electrodes 512 , 522 , and 532 . After depositing an insulating material forming the fence F or the insulating portion IP on the entire surface, the first to third contact regions CA1 , CA2 , CA3 and the first to third upper electrodes 512 , 522 , and 532 . It can be formed by patterning and removing the remainder except for the portion covering each end. In this case, the insulating material disposed on the trench T may also be removed.

한편, 상기 복수의 콘택 영역(CA1, CA2, CA3)은 상기 복수의 서브 화소(SP1, SP2, SP3)의 하측의 중앙에 위치하도록 구비될 수도 있다. 이 경우, 제1 발광 영역(EA1)은 제1 콘택 영역(CA1)의 양측과 상측에 구비될 수 있고, 제2 발광 영역(EA2)은 제2 콘택 영역(CA2)의 양측과 상측에 구비될 수 있으며, 제3 발광 영역(EA3)은 제3 콘택 영역(CA3)의 양측과 상측에 구비될 수 있다. 이 경우, 절연부(IP1, IP2, IP3)는 제1 방향(X축 방향)으로 펜스(F)와 이격되고, 제2 방향(Y축 방향)으로 하측에 배치된 펜스(F)와 접촉될 수 있다.Meanwhile, the plurality of contact areas CA1 , CA2 , and CA3 may be provided to be positioned at the lower center of the plurality of sub-pixels SP1 , SP2 , and SP3 . In this case, the first light emitting area EA1 may be provided on both sides and an upper side of the first contact area CA1 , and the second light emitting area EA2 may be provided on both sides and an upper side of the second contact area CA2 . In addition, the third light emitting area EA3 may be provided on both sides and above the third contact area CA3 . In this case, the insulating portions IP1, IP2, IP3 are spaced apart from the fence F in the first direction (X-axis direction), and come into contact with the fence F disposed on the lower side in the second direction (Y-axis direction). can

상기 유기발광층(7)은 상기 제1 전극(51, 52, 53)의 제1 내지 제3 상부 전극(512, 522, 532) 상에 형성된다. 상기 유기발광층(7)은 상기 펜스(F)와 절연부(IP), 및 트렌치(T) 상에도 형성될 수 있다. 즉, 상기 유기발광층(7)은 각각의 서브 화소(SP1, SP2, SP3) 및 그들 사이의 경계 영역에도 형성된다.The organic light emitting layer 7 is formed on the first to third upper electrodes 512 , 522 , and 532 of the first electrodes 51 , 52 , and 53 . The organic light emitting layer 7 may also be formed on the fence F, the insulating portion IP, and the trench T. That is, the organic light emitting layer 7 is also formed in each of the sub-pixels SP1 , SP2 , and SP3 and a boundary region therebetween.

상기 유기발광층(7)은 백색(W) 광을 발광하도록 구비될 수 있다. 이를 위해서, 상기 유기발광층(7)은 서로 상이한 색상의 광을 발광하는 복수의 스택(stack)을 포함하여 이루어질 수 있다. 예를 들어, 상기 유기발광층(7)은 청색의 광을 발광하는 제1 스택(71), 황녹색의 광의 발광하는 제2 스택(73), 및 상기 제1 스택(71)과 제2 스택(73) 사이에 구비된 전하생성층(Charge generation layer; CGL)(72)을 포함하여 이루어질 수도 있고, 청색의 광을 발광하는 제1 스택, 녹색의 광의 발광하는 제2 스택, 적색의 광을 발광하는 제3 스택, 상기 제1 스택과 상기 제2 스택 사이에 구비된 제1 전하생성층 및 상기 제2 스택과 상기 제3 스택 사이에 구비된 제2 전하생성층을 포함하여 이루어질 수도 있다. 상기 각각의 스택은 차례로 적층된 정공수송층, 유기발광층 및 전자수송층을 포함하여 이루어질 수 있다. 이와 같은 유기발광층(7)의 구성은 당업계에 공지된 다양한 형태로 변경될 수 있다.The organic light emitting layer 7 may be provided to emit white (W) light. To this end, the organic light emitting layer 7 may include a plurality of stacks that emit light of different colors. For example, the organic light emitting layer 7 includes a first stack 71 emitting blue light, a second stack 73 emitting yellow green light, and the first stack 71 and a second stack ( 73) may include a charge generation layer (CGL) 72 provided therebetween, a first stack emitting blue light, a second stack emitting green light, and emitting red light and a third stack, a first charge generation layer provided between the first stack and the second stack, and a second charge generation layer provided between the second stack and the third stack. Each of the stacks may include a hole transport layer, an organic light emitting layer, and an electron transport layer sequentially stacked. The configuration of the organic light emitting layer 7 may be changed to various forms known in the art.

도 2a에 따르면, 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이의 경계에 트렌치(T)가 형성되어 있기 때문에, 유기발광층(7)이 트렌치(T) 내에 형성될 수 있다. 따라서, 인접하는 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이에 전류 패스가 길게 형성되어, 인접하는 서브 화소(SP1, SP2, SP3) 사이에 누설전류가 발생하는 것을 줄일 수 있다. 즉, 고해상도를 구현하기 위해서 서브 화소(SP1, SP2, SP3) 사이의 간격이 조밀하게 구성된 경우에 있어서, 어느 하나의 서브 화소(SP1, SP2, SP3) 내의 유기발광층(7)에서 발광이 이루어진 경우 그 유기발광층(7) 내의 전하가 인접하는 다른 서브 화소(SP1, SP2, SP3) 내의 유기발광층(7)으로 이동하여 누설전류가 발생할 가능성이 있다. Referring to FIG. 2A , since the trench T is formed at the boundary between the first to third sub-pixels SP1 , SP2 , and SP3 , the organic light emitting layer 7 may be formed in the trench T . Accordingly, a current path is formed between the adjacent first to third sub-pixels SP1 , SP2 , and SP3 to be long, so that it is possible to reduce leakage current between the adjacent sub-pixels SP1 , SP2 , and SP3 . That is, in the case where the distance between the sub-pixels SP1, SP2, and SP3 is densely configured to realize high resolution, when light is emitted from the organic light-emitting layer 7 in any one of the sub-pixels SP1, SP2, and SP3 There is a possibility that electric charges in the organic light emitting layer 7 move to the organic light emitting layer 7 in other adjacent sub-pixels SP1, SP2, and SP3, and a leakage current may occur.

따라서, 본 발명의 일 실시예에서는 서브 화소(SP1, SP2, SP3) 사이의 경계에 트렌치(T)를 형성하고 상기 유기발광층(7)을 트렌치(T)내에 형성함으로써, 인접하는 서브 화소(SP1, SP2, SP3) 사이의 전류 패스를 길게 형성하여 저항을 증가시킴으로써 누설전류 발생을 줄일 수 있도록 한 것이다.Accordingly, in an embodiment of the present invention, a trench T is formed at the boundary between the sub-pixels SP1, SP2, and SP3 and the organic light emitting layer 7 is formed in the trench T, thereby forming the adjacent sub-pixels SP1. , SP2, SP3) to increase the resistance by forming a long current path to reduce the leakage current.

한편, 상기 트렌치(T)는 서로 다른 색의 광을 방출하는 서브 화소들 각각이 갖는 펜스(F) 사이에만 형성될 수 있다. 또는, 상기 트렌치(T)는 상기 펜스(F) 및 제2 절연층(42) 뿐만 아니라 그 아래의 제1 절연층(41)의 내부, 또는 회로 소자층(3)의 내부까지 연장될 수도 있다. Meanwhile, the trench T may be formed only between the fences F of each of the sub-pixels emitting light of different colors. Alternatively, the trench T may extend not only to the fence F and the second insulating layer 42 , but also to the inside of the first insulating layer 41 below it or the inside of the circuit element layer 3 . .

특히, 도 3의 확대도를 참조하면, 상기 유기발광층(7)은 제1 색상의 광을 발광하는 제1 스택(71), 제2 색상의 광을 발광하는 제2 스택(73), 및 상기 제1 스택(71)과 제2 스택(73) 사이에 구비된 전하생성층(72)을 포함하여 이루어질 수 있다.In particular, referring to the enlarged view of FIG. 3 , the organic light emitting layer 7 includes a first stack 71 emitting light of a first color, a second stack 73 emitting light of a second color, and the The charge generation layer 72 provided between the first stack 71 and the second stack 73 may be included.

상기 제1 스택(71)은 상기 트렌치(T) 내부의 측면에 형성되며 상기 트렌치(T) 내부의 하면에도 형성될 수 있다. 이때, 상기 트렌치(T) 내부의 측면에 형성된 제1 스택(71)의 일 부분과 상기 트렌치(T) 내부의 하면에 형성된 제1 스택(71)의 일 부분은 서로 연결되지 않고 단절되어 있다. 따라서, 상기 트렌치(T) 내부의 일 측면, 예로서 좌측 측면에 형성된 제1 스택(71)의 일 부분과 상기 트렌치(T) 내부의 다른 측면, 예로서 우측 측면에 형성된 제1 스택(71)의 일 부분은 서로 연결되지 않고 단절되어 있다. 이에 따라, 상기 트렌치(T)를 사이에 두고 인접하게 배치된 서브 화소(SP1, SP2, SP3) 사이에서는 상기 제1 스택(71)을 통해 전하가 이동할 수는 없다.The first stack 71 is formed on the inner side of the trench T, and may also be formed on the lower surface of the inner side of the trench T. In this case, a portion of the first stack 71 formed on the inner side of the trench T and a portion of the first stack 71 formed on the lower surface of the inner side of the trench T are not connected to each other and are disconnected. Accordingly, a portion of the first stack 71 formed on one side, for example, the left side, inside the trench T and the first stack 71 formed on the other side, for example, the right side, inside the trench T Some parts of it are disconnected and not connected to each other. Accordingly, charges cannot move through the first stack 71 between the sub-pixels SP1 , SP2 , and SP3 disposed adjacent to each other with the trench T interposed therebetween.

또한, 상기 전하 생성층(72)은 상기 트렌치(T) 내부의 측면에서 상기 제1 스택(71) 상에 형성될 수 있다. 이때, 상기 트렌치(T) 내부의 일 측면, 예로서 좌측 측면에 형성된 전하 생성층(72)의 일 부분과 상기 트렌치(T) 내부의 다른 측면, 예로서 우측 측면에 형성된 전하 생성층(72)의 일 부분은 서로 연결되지 않고 단절되어 있다. 이에 따라, 상기 트렌치(T)를 사이에 두고 인접하게 배치된 제1 내지 제3서브 화소(SP1, SP2, SP3) 사이에서는 상기 전하 생성층(72)을 통해 전하가 이동할 수는 없다.In addition, the charge generation layer 72 may be formed on the first stack 71 at the inner side of the trench T. At this time, a portion of the charge generation layer 72 formed on one side, for example, the left side, inside the trench T and the other side inside the trench T, for example, the charge generation layer 72 formed on the right side. Some parts of it are disconnected and not connected to each other. Accordingly, charges cannot move through the charge generation layer 72 between the first to third sub-pixels SP1 , SP2 , and SP3 disposed adjacent to each other with the trench T interposed therebetween.

또한, 상기 제2 스택(73)은 상기 전하 생성층(72) 상에서 상기 트렌치(T)를 사이에 두고 인접하게 배치된 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이에서 단절되지 않고 서로 연결될 수 있다. 따라서, 상기 트렌치(T)를 사이에 두고 인접하게 배치된 서브 화소(SP1, SP2, SP3) 사이에서는 상기 제2 스택(73)을 통해 전하가 이동할 수는 있다. 다만, 반드시 그에 한정되는 것은 아니고, 상기 트렌치(T)의 형상 및 유기발광층(7)의 증착 공정을 적절히 조절함으로써, 상기 제2 스택(73)도 상기 트렌치(T)를 사이에 두고 인접하게 배치된 서브 화소(SP1, SP2, SP3) 사이에서 단절되도록 구성할 수도 있다. 특히, 상기 전하 생성층(72)과 인접하는 상기 제2 스택(73)의 하부 일 부분만이 서브 화소(SP1, SP2, SP3) 사이 영역에서 단절될 수 있다.In addition, the second stack 73 is not disconnected between the first to third sub-pixels SP1 , SP2 , and SP3 disposed adjacent to each other with the trench T interposed therebetween on the charge generation layer 72 . can be connected to each other. Accordingly, charges may move through the second stack 73 between the sub-pixels SP1 , SP2 , and SP3 disposed adjacent to each other with the trench T interposed therebetween. However, the present invention is not necessarily limited thereto, and by appropriately controlling the shape of the trench T and the deposition process of the organic light emitting layer 7 , the second stack 73 is also disposed adjacently with the trench T interposed therebetween. It may be configured to be disconnected between the sub-pixels SP1, SP2, and SP3. In particular, only a lower portion of the second stack 73 adjacent to the charge generation layer 72 may be disconnected from the region between the sub-pixels SP1 , SP2 , and SP3 .

상기 전하 생성층(72)은 상기 제1 스택(71) 및 상기 제2 스택(73)에 비하여 도전성이 크다. 특히, 상기 전하 생성층(72)을 구성하는 N형 전하 생성층은 금속 물질을 포함하여 이루어질 수 있기 때문에, 상기 제1 스택(71) 및 상기 제2 스택(73)에 비하여 도전성이 크다. 따라서, 서로 인접하게 배치된 서브 화소(SP1, SP2, SP3) 사이에서의 전하의 이동은 주로 전하 생성층(72)을 통해 이루어지고, 상기 제2 스택(73)을 통해서 이루어지는 전하의 이동량은 미미하다. The charge generating layer 72 has higher conductivity than the first stack 71 and the second stack 73 . In particular, since the N-type charge generation layer constituting the charge generation layer 72 may include a metal material, conductivity is higher than that of the first stack 71 and the second stack 73 . Accordingly, the movement of charges between the sub-pixels SP1 , SP2 and SP3 disposed adjacent to each other is mainly performed through the charge generation layer 72 , and the amount of movement of charges through the second stack 73 is insignificant. Do.

본 발명의 일 실시예에 따른 표시장치(1)에서는, 상기 유기발광층(7)이 상기 트렌치(T) 내에 형성될 때 상기 트렌치(T) 내에서 상기 유기발광층(7)의 일부가 단절되도록 구성함으로써, 특히, 상기 제1 스택(71)과 상기 전하생성층(72)이 단절되도록 구성함으로써 인접 하는 서브 화소(SP1, SP2, SP3) 사이에 누설전류가 발생하는 것을 방지할 수 있다. 이와 같은 도 3에 따른 트렌치(T)의 구성은 후술하는 다양한 실시예들에도 적용될 수 있다. In the display device 1 according to an embodiment of the present invention, when the organic light emitting layer 7 is formed in the trench T, a part of the organic light emitting layer 7 is cut off in the trench T. In particular, by configuring the first stack 71 and the charge generation layer 72 to be disconnected, it is possible to prevent a leakage current from occurring between the adjacent sub-pixels SP1 , SP2 , and SP3 . Such a configuration of the trench T according to FIG. 3 may be applied to various embodiments to be described later.

상기 제2 전극(8)은 상기 유기발광층(7) 상에 형성되어 있다. 상기 제2 전극(8)은 표시장치의 음극(Cathode)으로 기능할 수 있다. 상기 제2 전극(8)은 상기 유기발광층(7)과 마찬가지로 각각의 서브 화소(SP1, SP2, SP3) 및 그들 사이의 경계 영역에도 형성된다. 즉, 상기 제2 전극(8)은 공통층으로서, 상기 펜스(F), 절연부(IP), 및 트렌치(T)의 위쪽에도 형성될 수 있다.The second electrode 8 is formed on the organic light emitting layer 7 . The second electrode 8 may function as a cathode of the display device. Like the organic light emitting layer 7 , the second electrode 8 is also formed in each of the sub-pixels SP1 , SP2 , and SP3 and a boundary region therebetween. That is, as a common layer, the second electrode 8 may also be formed above the fence F, the insulating portion IP, and the trench T.

본 발명의 일 실시예에 따른 표시장치는 상부 발광 방식으로 이루어지고, 유기발광층(7)에서 발광된 광의 일부를 상부쪽으로 투과시키고 발광된 광의 나머지를 이용하여 마이크로 캐버티(Micro Cavity) 효과를 얻기 위해 제2 전극(8)은 반투명 전극으로 이루어질 수 있다. 그에 따라 제2 전극(8)과 상기 제1 전극(51, 52, 53)의 제1 내지 제3 하부 전극(511, 521, 531) 사이에서 광의 반사와 재반사가 반복되면서 서로 다른 색의 광, 예로서 적색 광, 녹색 광, 청색 광의 추출 효율이 향상되는 마이크로 캐버티 효과를 얻을 수 있다.A display device according to an embodiment of the present invention is made of a top emission method, a portion of the light emitted from the organic emission layer 7 is transmitted upward, and a micro-cavity effect is obtained using the remainder of the emitted light. To this end, the second electrode 8 may be formed of a translucent electrode. Accordingly, light of different colors is repeatedly reflected and re-reflected between the second electrode 8 and the first to third lower electrodes 511 , 521 , and 531 of the first electrodes 51 , 52 , 53 . , for example, it is possible to obtain a microcavity effect in which the extraction efficiency of red light, green light, and blue light is improved.

도 2a 및 도 3을 참조하면, 상기 단차보상부(9)는 상기 트렌치(T)의 폭(TW, 도 3에 도시됨)보다 넓은 폭으로 형성되어 상기 트렌치(T)의 하면에 접하도록 배치될 수 있다. 상기 단차보상부(9)는 상기 제1 서브 화소(SP1)의 제1 하부전극(511)과 동일한 층에 위치될 수 있다. 따라서, 상기 단차보상부(9)는 상기 제2 서브 화소(SP2)의 제2 하부 콘택전극(621) 및 상기 제3 서브 화소(SP3)의 제3 하부 콘택전극(631)과도 동일한 층에 배치될 수 있다. 예컨대, 상기 단차보상부(9), 제1 하부전극(511), 제2 하부 콘택전극(621), 및 제3 하부 콘택전극(631)은 도 2a와 같이 회로 소자층(3)과 제1 절연층(41) 사이에 배치될 수 있다. 상기 단차보상부(9)는 회로 소자층(3)과 트렌치(T) 사이에도 배치될 수 있다. 상기 단차보상부(9)는 상기 제1 하부전극(511), 상기 제2 하부 콘택전극(621), 및 제3 하부 콘택전극(631)과 동일한 물질로 동일한 공정을 통해 패턴 형성된다.2A and 3 , the step difference compensating part 9 is formed to be wider than the width TW (shown in FIG. 3 ) of the trench T, and is disposed to be in contact with the lower surface of the trench T can be The step compensation part 9 may be located on the same layer as the first lower electrode 511 of the first sub-pixel SP1 . Accordingly, the step compensation part 9 is disposed on the same layer as the second lower contact electrode 621 of the second sub-pixel SP2 and the third lower contact electrode 631 of the third sub-pixel SP3. can be For example, the step difference compensating part 9, the first lower electrode 511, the second lower contact electrode 621, and the third lower contact electrode 631, as shown in FIG. It may be disposed between the insulating layers 41 . The step difference compensating part 9 may also be disposed between the circuit element layer 3 and the trench T. The step difference compensating part 9 is patterned through the same process using the same material as the first lower electrode 511 , the second lower contact electrode 621 , and the third lower contact electrode 631 .

본 명세서에서는 단차보상부(9)가 트렌치(T)의 하면에 접하도록 배치되는 것으로 기재하였지만, 반드시 이에 한정되지 않으며, 단차보상부(9)와 트렌치(T)의 하면 사이에 절연층(4)이 배치되는 경우 단차보상부(9)는 트렌치(T)의 하면에 접하지 않고 트렌치(T)의 하면에 접하도록 배치된 절연층(4)의 하면에 접할 수도 있다.In this specification, although it has been described that the step compensating part 9 is disposed to be in contact with the lower surface of the trench T, it is not necessarily limited thereto, and the insulating layer 4 between the step compensating part 9 and the lower surface of the trench T ), the step difference compensating part 9 may be in contact with the lower surface of the insulating layer 4 disposed so as to be in contact with the lower surface of the trench T instead of the lower surface of the trench T.

상기 단차보상부(9)는 제1 내지 제3 서브 화소(SP1, SP2, SP3) 각각에 구비된 제1 전극(51, 52, 53)과 중첩되지 않도록 배치될 수 있다. 예컨대, 단차보상부가 제1 하부 전극과 중첩된다면, 중첩되는 부분 상에 배치되는 절연층과 중첩되지 않는 부분 상에 배치되는 절연층 간에 단차가 발생할 수 있고, 이는 후속 공정에서 형성되는 제1 상부 전극이 평탄하게 구비되지 못하게 할 수 있다. 제1 상부 전극이 평탄하게 구비되지 못하면, 제1 상부 전극 상에 형성되는 유기발광층과 제2 전극 또한 평탄하게 구비되지 못하기 때문에, 제1 하부 전극과 제2 전극 간에 이격 거리가 달라지므로 특정 색만이 아닌 다른 색의 광 추출도 향상되어 결과적으로 원치않는 색이 방출되는 문제가 발생할 수 있다.The step difference compensator 9 may be disposed so as not to overlap the first electrodes 51 , 52 , and 53 provided in each of the first to third sub-pixels SP1 , SP2 , and SP3 . For example, if the step difference compensating part overlaps the first lower electrode, a step may occur between the insulating layer disposed on the overlapping portion and the insulating layer disposed on the non-overlapping portion, which may be a first upper electrode formed in a subsequent process. This may prevent it from being provided flat. If the first upper electrode is not provided flat, the organic light emitting layer formed on the first upper electrode and the second electrode are also not provided flat, so that the separation distance between the first lower electrode and the second electrode is different, so that only a specific color Light extraction of other colors may also be improved, resulting in a problem in which unwanted colors are emitted.

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 단차보상부(9)를 각 서브 화소(SP1. SP2, SP3)에 배치된 제1 전극(5), 예로서 제1 내지 제3 하부 전극(511, 521, 531)과 제1 내지 제3 상부 전극(512, 522, 532) 각각과 비중첩되도록 구비됨으로써, 원하는 색만의 광 추출 효율을 향상시킬 수 있다.Accordingly, in the display device 1 according to the exemplary embodiment of the present invention, the step difference compensating unit 9 is disposed on the first electrode 5 disposed in each of the sub-pixels SP1, SP2, and SP3, for example, the first to third Since the lower electrodes 511 , 521 , and 531 and the first to third upper electrodes 512 , 522 , and 532 are provided so as to not overlap, respectively, light extraction efficiency of only a desired color may be improved.

한편, 상기 단차보상부(9)는 제1 하부 전극(511), 제2 하부 전극(521), 및 제3 하부 전극(531)과 동일한 두께로 구비될 수 있다. 즉, 단차보상부(9)의 두께(SRT, 도 2a에 도시됨)는 제1 하부 전극(511)의 두께(T1), 제2 하부 전극(521)의 두께(T2), 및 제3 하부 전극(531)의 두께(T3)와 동일하게 구비될 수 있다. 이에 따라, 단차보상부(91)는 제1 서브 화소(SP1)에서 단차보상부(9) 상에 배치되는 제1 절연층(41)과 제1 하부 전극(511) 상에 배치되는 제1 절연층(41) 간에 단차가 발생하는 것을 방지할 수 있고, 제2 서브 화소(SP2)에서 단차보상부(9) 상에 배치되는 제1 절연층(41)과 제2 하부 전극(521) 간에 단차가 발생하는 것을 방지할 수 있으며, 제3 서브 화소(SP3)에서 단차보상부(9) 상에 배치되는 제2 절연층(42)과 제3 하부 전극(531) 간에 단차가 발생하는 것을 방지할 수 있다.Meanwhile, the step difference compensating part 9 may have the same thickness as the first lower electrode 511 , the second lower electrode 521 , and the third lower electrode 531 . That is, the thickness (SRT, shown in FIG. 2A ) of the step compensation part 9 is the thickness T1 of the first lower electrode 511 , the thickness T2 of the second lower electrode 521 , and the third lower part. It may be provided to be the same as the thickness T3 of the electrode 531 . Accordingly, in the first sub-pixel SP1 , the step compensating part 91 is a first insulating layer 41 disposed on the step compensating part 9 and a first insulating layer disposed on the first lower electrode 511 . It is possible to prevent a step difference from occurring between the layers 41 , and a step difference between the first insulating layer 41 and the second lower electrode 521 disposed on the step difference compensating part 9 in the second sub-pixel SP2 . can be prevented from occurring, and a step can be prevented from occurring between the second insulating layer 42 and the third lower electrode 531 disposed on the step difference compensating part 9 in the third sub-pixel SP3. can

결과적으로, 본 발명의 일 실시예에 따른 표시장치(1)는 단차보상부(9)가 제1 내지 제3 서브 화소(SP1, SP2, SP3) 각각에 구비된 제1 전극(51, 52, 53)과 중첩되지 않으면서 제1 내지 제3 하부 전극(511, 521, 531) 각각과 동일한 두께로 구비됨으로써, 각 서브 화소(SP1, SP2, SP3)의 제2 절연층(42) 상에 배치되는 제1 내지 제3 상부 전극(512, 522, 532)을 평탄하게 구비하면서 단차 없이 동일한 높이로 위치시킬 수 있다.As a result, in the display device 1 according to an exemplary embodiment of the present invention, the first electrodes 51 , 52 , and the first electrodes 51 , 52 , and the step difference compensator 9 are provided in each of the first to third sub-pixels SP1 , SP2 and SP3 , respectively. 53 , and has the same thickness as each of the first to third lower electrodes 511 , 521 , and 531 , and is disposed on the second insulating layer 42 of each of the sub-pixels SP1 , SP2 , and SP3 The first to third upper electrodes 512 , 522 , and 532 used to be flat may be positioned at the same height without a step difference.

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 각 서브 화소(SP1, SP2, SP3)에 배치되는 제1 내지 제3 하부 전극(511, 521, 531)의 높이만을 조절하여 마이크로 캐버티를 용이하게 구현하여서 각 서브 화소(SP1, SP2, SP3) 간에 서로 다른 색의 광 추출 효율이 향상되도록 구비될 수 있다.Accordingly, in the display device 1 according to an embodiment of the present invention, only the heights of the first to third lower electrodes 511 , 521 , 531 disposed in each of the sub-pixels SP1 , SP2 , and SP3 are adjusted to adjust the micro-cache. By easily implementing the vertices, the light extraction efficiency of different colors may be improved between the respective sub-pixels SP1, SP2, and SP3.

도 3을 참조하면, 단차보상부(9)의 폭(SRW)은 제1 내지 제3 하부 전극(511, 521, 531) 각각의 폭(EW)보다 좁게 형성될 수 있다. 단차보상부의 폭이 하부 전극의 폭보다 넓으면 발광영역에 비해 상대적으로 비발광 영역의 폭이 증가되므로, 발광 효율이 저하될 수 있기 때문이다. 따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 단차보상부(9)의 폭(SRW)이 트렌치(T)의 폭(TW)보다 넓고 제1 내지 제3 하부 전극(511, 521, 531) 각각의 폭(EW)보다 좁게 구비됨으로써, 트렌치(T)에 인접한 절연층(4)에서 단차가 발생되는 것을 방지하여 정상적인 트렌치(T)가 형성될 수 있고, 발광 면적 증대에 따른 발광 효율이 향상될 수 있다.Referring to FIG. 3 , the width SRW of the step difference compensating part 9 may be narrower than the width EW of each of the first to third lower electrodes 511 , 521 , and 531 . This is because, when the width of the step difference compensating portion is wider than the width of the lower electrode, the width of the non-emission region is relatively increased compared to the width of the light emitting region, and thus luminous efficiency may be reduced. Accordingly, in the display device 1 according to the exemplary embodiment of the present invention, the width SRW of the step difference compensating part 9 is wider than the width TW of the trench T and the first to third lower electrodes 511 and 521 . , 531) is provided to be narrower than each width EW, thereby preventing a step difference from occurring in the insulating layer 4 adjacent to the trench T so that a normal trench T can be formed, and light emission according to an increase in the light emitting area Efficiency can be improved.

한편, 단차보상부(9)에서 트렌치(T)에 중첩되지 않는 부분은 펜스(F)의 일부와 중첩될 수 있다. 보다 구체적으로, 도 3과 같이, 트렌치(T)에 중첩되지 않는 단차보상부(9)의 부분은 제1 전극(5)(또는 제1 내지 제3 상부 전극(512, 522, 532))의 상면에 배치된 펜스(F)를 제외한 나머지 펜스(F), 예로서 제2 절연층(42)의 상면에 접촉된 펜스(F)와 중첩될 수 있다.On the other hand, the portion that does not overlap the trench (T) in the step difference compensating unit (9) may overlap a portion of the fence (F). More specifically, as shown in FIG. 3 , the portion of the step difference compensating part 9 that does not overlap the trench T is the first electrode 5 (or the first to third upper electrodes 512 , 522 , 532 ). The remaining fences F except for the fences F disposed on the top surface, for example, may overlap with the fence F in contact with the top surface of the second insulating layer 42 .

상기 단차보상부(9)는 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이의 트렌치(T)에 배치됨으로써, 제1 하부전극(511)과 제2 하부 콘택전극(621) 사이, 및 제2 하부 콘택전극(621)과 제3 하부 콘택전극(631) 사이에 배치될 수 있다. 따라서, 본 발명에 따른 표시장치(1)의 단차보상부(9)는 제1 서브 화소(SP1)와 제2 서브 화소(SP2) 사이에 배치된 제1 단차보상부(91), 및 제2 서브 화소(SP2)와 제3 서브 화소(SP3) 사이에 배치된 제2 단차보상부(92)를 포함할 수 있다.The step difference compensating part 9 is disposed in the trench T between the first to third sub-pixels SP1, SP2, and SP3, so that between the first lower electrode 511 and the second lower contact electrode 621, and between the second lower contact electrode 621 and the third lower contact electrode 631 . Accordingly, the step compensating unit 9 of the display device 1 according to the present invention includes the first step compensating unit 91 and the second step compensating unit 91 disposed between the first sub-pixel SP1 and the second sub-pixel SP2. A second step difference compensator 92 may be included between the sub-pixel SP2 and the third sub-pixel SP3 .

본 발명에 따른 표시장치(1)에 있어서, 상기 제1 단차보상부(91)는 실시예에 따라 제1 하부전극(511)과 연결되거나 제1 하부전극(511)과 이격되게 구비될 수 있다.In the display device 1 according to the present invention, the first step difference compensating part 91 may be connected to the first lower electrode 511 or provided to be spaced apart from the first lower electrode 511 according to an embodiment. .

도 2a와 같이, 제1 단차보상부(91)가 제1 하부전극(511)과 연결되는 일 실시예의 경우, 제2 단차보상부(92)는 제2 하부 콘택전극(621)과 제3 하부 콘택전극(631) 각각으로부터 이격될 수 있다. 그리고, 제1 단차보상부(91)가 제1 하부 전극(511)과 이격되는 다른 실시예의 경우, 제2 단차보상부(92)는 제2 하부 콘택전극(621)과 제3 하부 콘택전극(631) 각각으로부터 이격될 수 있다.As shown in FIG. 2A , in the case where the first step compensating part 91 is connected to the first lower electrode 511 , the second step compensating part 92 includes the second lower contact electrode 621 and the third lower electrode 511 . It may be spaced apart from each of the contact electrodes 631 . And, in another embodiment in which the first step compensating part 91 is spaced apart from the first lower electrode 511, the second step compensating part 92 includes the second lower contact electrode 621 and the third lower contact electrode ( 631) may be spaced apart from each other.

제2 단차보상부(92)와 달리 제1 단차보상부(91)만 제1 하부전극(511)과 연결되거나 이격되는 이유는, 제1 단차보상부(91)는 제2 단차보상부(91)보다 제1 방향(X축 방향)으로 제1 하부전극(511)에 더 가깝게 배치되며, 제1 서브 화소(SP1)에서 적색 광의 추출 효율을 향상시키기 위해서 제1 하부전극(511)이 제2 하부전극(521)과 제3 하부전극(531)보다 기판(2) 쪽으로 더 가깝게 배치되기 때문이다. 반면, 제2 단차보상부(92)는 제2 하부 전극(521) 및 제3 하부 전극(531)과 서로 다른 층에 배치되므로, 제2 하부 전극(521) 또는 제3 하부 전극(531)과 연결될 수 없다. 따라서, 제1 단차보상부(91)만이 제1 하부전극(511)에 연결되거나 이격될 수 있다.The reason why only the first step compensating part 91 is connected to or spaced apart from the first lower electrode 511 is that, unlike the second step compensating part 92 , the first step compensating part 91 is the second step compensating part 91 . ) is disposed closer to the first lower electrode 511 in the first direction (X-axis direction) than the first lower electrode 511 in order to improve red light extraction efficiency in the first sub-pixel SP1. This is because the lower electrode 521 and the third lower electrode 531 are disposed closer to the substrate 2 than the lower electrode 521 . On the other hand, since the second step difference compensating part 92 is disposed on a different layer from the second lower electrode 521 and the third lower electrode 531 , the second lower electrode 521 or the third lower electrode 531 and can't be connected Accordingly, only the first step difference compensating part 91 may be connected to or spaced apart from the first lower electrode 511 .

상기 제1 단차보상부(91)가 제1 하부전극(511)에 연결되는 일 실시예의 경우, 제1 하부전극(511)과 제1 단차보상부(91)를 패턴 없이 일체로 형성할 수 있기 때문에 제조 공정이 간소화될 수 있다. 상기 제1 단차보상부(91)가 제1 하부전극(511)과 이격되는 다른 실시예의 경우, 제1 단차보상부(91)를 인접한 서브 화소들, 예로서, 제1 내지 제3 서브 화소(SP1, SP2, SP3)가 배열되는 제1 방향(X축 방향)에 대해 수직한 제2 방향(Y축 방향)에 배치된 서브 화소들까지 연결되도록 스트라이프 형태로 구비할 수 있으므로 제조 공정이 간소화될 수 있다.In the case of an embodiment in which the first step compensating part 91 is connected to the first lower electrode 511, the first lower electrode 511 and the first step compensating part 91 can be integrally formed without a pattern. Therefore, the manufacturing process may be simplified. In another embodiment in which the first step compensating unit 91 is spaced apart from the first lower electrode 511 , the first step compensating unit 91 is connected to adjacent sub-pixels, for example, first to third sub-pixels ( Since SP1, SP2, SP3 may be provided in the form of a stripe so as to be connected to sub-pixels disposed in the second direction (Y-axis direction) perpendicular to the first direction (X-axis direction) in which they are arranged, the manufacturing process may be simplified. can

한편, 상기 단차보상부(9)를 제1 절연층(41) 또는 제2 절연층(42) 상에 배치시키지 않고 회로 소자층(3) 상에 배치시킨 이유는, 회로 소자층(3) 상에 처음 형성되는 제1 하부 전극(511)을 형성할 때 단차보상부(9)를 함께 형성함으로써, 후속 공정에 의해 형성되는 제1 절연층(41) 또는 제2 절연층(42)에 단차가 형성되는 것을 방지하고 트렌치(T)의 깊이를 깊게 하기 위함이다.On the other hand, the reason for disposing the step difference compensating part 9 on the circuit element layer 3 instead of on the first insulating layer 41 or the second insulating layer 42 is that on the circuit element layer 3 By forming the step difference compensating part 9 together when forming the first lower electrode 511 formed for the first time in This is to prevent formation and increase the depth of the trench (T).

예컨대, 단차보상부가 제1 하부 전극과 함께 형성되지 않는다면, 제1 하부 전극의 끝단 부분에서 회로 소자층과의 높이 차이에 의해 제1 절연층에 단차가 발생할 것이고, 이는 제1 절연층 상에 배치되는 제2 절연층에도 단차를 발생시킬 것이므로, 정상적인 트렌치(T) 형성을 어렵게 할 것이다. 또한, 단차보상부가 제1 하부 전극이 아닌 제1 절연층 또는 제2 절연층 상에 배치된다면, 트렌치의 깊이가 낮아질 것이므로, 트렌치 상에 배치되는 유기발광층의 일부, 예로서 전하생성층이 단절되지 않고 연결될 수 있기 때문에 인접한 서브 화소 간에 누설전류가 발생할 수 있다.For example, if the step difference compensating portion is not formed together with the first lower electrode, a step will occur in the first insulating layer due to a height difference from the circuit element layer at the end of the first lower electrode, which is disposed on the first insulating layer Since a step will also be generated in the second insulating layer, it will be difficult to form the normal trench T. In addition, if the step compensation part is disposed on the first insulating layer or the second insulating layer other than the first lower electrode, the depth of the trench will be lowered, so that a part of the organic light emitting layer disposed on the trench, for example, the charge generating layer is not cut off. Since the sub-pixels can be connected to each other, leakage current may occur between adjacent sub-pixels.

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 단차보상부(9)를 제1 하부 전극(511)과 동일한 층, 예로서 회로 소자층(3)의 상면에 형성함으로써, 비정상적인 트렌치(T) 형성을 방지하여 신뢰성을 향상시킬 수 있고, 트렌치(T)의 깊이를 증가시켜 트렌치(T)에서 유기발광층(7)의 일부, 특히 전하생성층(72)을 확실하게 단절시켜서 인접한 서브 화소 간의 누설전류를 방지하도록 구비될 수 있다.Accordingly, in the display device 1 according to the exemplary embodiment of the present invention, the step difference compensating part 9 is formed on the same layer as the first lower electrode 511 , for example, on the upper surface of the circuit element layer 3 , thereby forming an abnormal trench. (T) formation can be prevented to improve reliability, and by increasing the depth of the trench (T), a part of the organic light emitting layer 7, in particular, the charge generating layer 72, in the trench (T) can be reliably cut off to the adjacent sub It may be provided to prevent leakage current between pixels.

상기 봉지층(10)은 상기 제2 전극(8) 상에 형성되어 상기 유기발광층(7)으로 외부의 수분이 침투하는 것을 방지하는 역할을 한다. 이와 같은 봉지층(10)은 무기절연물로 이루어질 수도 있고 무기절연물과 유기절연물이 교대로 적층된 구조로 이루어질 수도 있지만, 반드시 그에 한정되는 것은 아니다. The encapsulation layer 10 is formed on the second electrode 8 to prevent external moisture from penetrating into the organic light emitting layer 7 . The encapsulation layer 10 may be formed of an inorganic insulating material or may have a structure in which an inorganic insulating material and an organic insulating material are alternately stacked, but is not necessarily limited thereto.

상기 컬러 필터층(11)은 상기 봉지층(10) 상에 형성된다. 상기 컬러 필터층(11)은 개별 서브 화소(SP1, SP2, SP3) 내의 발광 영역(EA1, EA2, EA3)과 마주하도록 형성된다. 상기 컬러 필터층(11)은 제1 서브 화소(SP1)에 구비된 적색 컬러 필터, 제2 서브 화소(SP2)에 구비된 녹색 컬러 필터, 및 제3 서브 화소(SP3)에 구비된 청색 컬러 필터를 포함하여 이루어질 수 있지만, 반드시 그에 한정되는 것은 아니다. 한편, 도시하지는 않았지만, 상기 컬러 필터층(11) 사이의 경계에 블랙 매트릭스가 추가로 형성되어 발광 영역(EA1, EA2, EA3) 이외의 영역으로 광이 누설되는 것을 방지할 수 있다.The color filter layer 11 is formed on the encapsulation layer 10 . The color filter layer 11 is formed to face the light emitting areas EA1 , EA2 , and EA3 in the individual sub-pixels SP1 , SP2 , and SP3 . The color filter layer 11 includes a red color filter provided in the first sub-pixel SP1, a green color filter provided in the second sub-pixel SP2, and a blue color filter provided in the third sub-pixel SP3. may be included, but is not necessarily limited thereto. Meanwhile, although not shown, a black matrix may be additionally formed at the boundary between the color filter layers 11 to prevent light from leaking to areas other than the light emitting areas EA1 , EA2 , and EA3 .

다시 도 3을 참조하면, 기판(2) 상에 회로 소자층(3)이 형성되어 있고, 상기 회로 소자층(3) 상의 제1 서브 화소(SP1)에는 제1 하부 전극(511)이 형성되어 있다.Referring back to FIG. 3 , the circuit element layer 3 is formed on the substrate 2 , and the first lower electrode 511 is formed in the first sub-pixel SP1 on the circuit element layer 3 . there is.

상기 제1 하부 전극(511) 상에는 제1 절연층(41)이 형성되어 있고, 상기 제1 절연층(41) 상의 제2 서브 화소(SP2)에는 제2 하부전극(521)이 형성되어 있다. A first insulating layer 41 is formed on the first lower electrode 511 , and a second lower electrode 521 is formed in the second sub-pixel SP2 on the first insulating layer 41 .

상기 제2 하부전극(521) 상에는 제2 절연층(42)이 형성되어 있고, 상기 제2 절연층(42) 상의 제1 서브 화소(SP1)에는 제1 상부전극(512)이 형성되어 있고, 상기 제2 절연층(42) 상의 제2 서브 화소(SP2)에는 제2 상부전극(522)이 형성되어 있으며, 상기 제2 절연층(42) 상의 제3 서브 화소(SP3)에는 제3 하부전극(531)이 형성되어 있다. 상기 제3 하부전극(531) 상에는 제3 상부전극(532)이 형성되어 있다.A second insulating layer 42 is formed on the second lower electrode 521, and a first upper electrode 512 is formed in the first sub-pixel SP1 on the second insulating layer 42, A second upper electrode 522 is formed on the second sub-pixel SP2 on the second insulating layer 42 , and a third lower electrode on the third sub-pixel SP3 on the second insulating layer 42 . (531) is formed. A third upper electrode 532 is formed on the third lower electrode 531 .

상기 제1 상부 전극(512), 제2 상부 전극(522), 및 제3 상부 전극(532)는 도 3과 같이 동일한 높이로 구비될 수 있다. 이는, 제1 하부 전극(511), 제2 하부 전극(521), 제3 하부 전극(531), 제1 단차보상부(91), 및 제2 단차보상부(92)가 동일한 두께로 구비됨과 동시에 도 3의 세로 방향으로 서로 중첩되지 않게 구비되기 때문이다.The first upper electrode 512 , the second upper electrode 522 , and the third upper electrode 532 may be provided at the same height as in FIG. 3 . This means that the first lower electrode 511, the second lower electrode 521, the third lower electrode 531, the first step difference compensating part 91, and the second step difference compensating part 92 are provided with the same thickness. This is because they are provided so as not to overlap each other in the vertical direction of FIG. 3 at the same time.

상기 제1 상부 전극(512), 상기 제2 상부 전극(522), 및 상기 제3 상부 전극(532) 상에는 그들의 양 끝단을 가리는 펜스(F)가 형성되어 있고, 제1 내지 제3 서브 화소(SP1, SP2, SP3) 사이의 경계 부분의 펜스(F)들 사이에는 트렌치(T)가 형성되어 있다.Fences F are formed on the first upper electrode 512 , the second upper electrode 522 , and the third upper electrode 532 to cover both ends thereof, and first to third sub-pixels ( A trench T is formed between the fences F at the boundary between SP1, SP2, and SP3.

상기 펜스(F) 상에는 유기발광층(7)이 형성되어 있고, 상기 유기발광층(7) 상에는 제2 전극(8)이 형성되어 있고, 상기 제2 전극(8) 상에는 봉지층(10)이 형성되어 있고, 상기 봉지층(10) 상에는 컬러 필터층(11)이 형성되어 있다.An organic light-emitting layer 7 is formed on the fence F, a second electrode 8 is formed on the organic light-emitting layer 7, and an encapsulation layer 10 is formed on the second electrode 8. and a color filter layer 11 is formed on the encapsulation layer 10 .

상기 유기발광층(7)은 상기 트렌치(T)내에 형성될 수 있다. 따라서, 인접하는 서브 화소(SP1, SP2, SP3) 사이에 전류 패스가 길게 형성되어, 인접하는 서브 화소(SP1, SP2, SP3) 사이에 누설전류가 발생하는 것을 줄일 수 있다.The organic light emitting layer 7 may be formed in the trench T. Accordingly, a current path is formed to be long between the adjacent sub-pixels SP1 , SP2 , and SP3 , so that it is possible to reduce leakage current between the adjacent sub-pixels SP1 , SP2 , and SP3 .

또는, 상기 유기발광층(7)의 일부, 예로서 제1 스택(71)과 전하생성층(72)은 트렌치(T)에 의해 단절됨으로써, 인접하는 서브 화소(SP1, SP2, SP3) 사이에 누설전류가 발생하는 것을 줄일 수 있다.Alternatively, a part of the organic light emitting layer 7, for example, the first stack 71 and the charge generation layer 72 is disconnected by the trench T, thereby leaking between the adjacent sub-pixels SP1, SP2, and SP3. Current generation can be reduced.

한편, 도 3에서는 각 서브 화소(SP1, SP2, SP3) 별로 콘택전극(61, 62, 63)이 형성되지 않기 때문에, 도 3의 발광 영역(EA1, EA2, EA3) 각각의 두께는 도 2a의 콘택영역(CA1, CA2, CA3) 각각의 두께보다 얇게 구비될 수 있다.Meanwhile, in FIG. 3 , since the contact electrodes 61 , 62 , and 63 are not formed for each sub-pixel SP1 , SP2 , and SP3 , the thickness of each of the light emitting areas EA1 , EA2 , EA3 of FIG. 3 is the same as that of FIG. 2A . It may be provided to be thinner than the thickness of each of the contact areas CA1 , CA2 , and CA3 .

도 4는 본 발명의 일 실시예에 따른 표시장치의 제1 내지 제6 서브 화소를 개략적으로 나타낸 평면도이다.4 is a plan view schematically illustrating first to sixth sub-pixels of a display device according to an exemplary embodiment of the present invention.

도 4와 같이, 본 발명의 일 실시예에 따른 표시장치(1)는 제1 서브 화소(SP1), 제2 서브 화소(SP2), 및 제3 서브 화소(SP3)가 배열된 제1 방향(X축 방향)에 대해 수직한 제2 방향(Y축 방향)으로 이격되어 배치된 제4 서브 화소(SP4), 제5 서브 화소(SP5), 및 제6 서브 화소(SP6)를 더 포함할 수 있다.As shown in FIG. 4 , in the display device 1 according to the exemplary embodiment of the present invention, the first sub-pixel SP1 , the second sub-pixel SP2 , and the third sub-pixel SP3 are arranged in a first direction ( The display device may further include a fourth sub-pixel SP4, a fifth sub-pixel SP5, and a sixth sub-pixel SP6 disposed to be spaced apart from each other in a second direction (Y-axis direction) perpendicular to the X-axis direction. there is.

상기 제4 내지 제6 서브 화소(SP4, SP5, SP6)은 제1 내지 제3 서브 화소(SP1, SP2, SP3)와 마찬가지로 발광영역(EA4, EA5, EA6)과 콘택영역(CA4, CA5, CA6)을 포함할 수 있다. 상기 발광영역(EA4, EA5, EA6)과 콘택영역(CA4, CA5, CA6)은 제1 내지 제3 서브 화소(SP1, SP2, SP3)의 발광영역(EA1, EA2, EA3) 및 콘택영역(CA1, CA2, CA3)과 동일한 구조로 구비될 수 있다.The fourth to sixth sub-pixels SP4, SP5, and SP6 have the light-emitting areas EA4, EA5, EA6 and the contact areas CA4, CA5, CA6 like the first to third sub-pixels SP1, SP2, and SP3. ) may be included. The light-emitting areas EA4, EA5, EA6 and the contact areas CA4, CA5, and CA6 are the light-emitting areas EA1, EA2, EA3 and the contact area CA1 of the first to third sub-pixels SP1, SP2, and SP3. , CA2, CA3) may be provided in the same structure.

또한, 제4 내지 제6 서브 화소(SP4, SP5, SP6) 사이의 경계 부분에는 트렌치(T)가 구비될 수 있으며, 상기 트렌치(T)를 따라 단차보상부(9')가 구비될 수 있다. 상기 단차보상부(9')는 제4 서브 화소(SP4)와 제5 서브 화소(SP5) 사이의 경계 부분에 배치된 제1 단차보상부(91')와 제5 서브 화소(SP5)와 제6 서브 화소(SP6) 사이의 경계 부분에 배치된 제2 단차보상부(92')를 포함할 수 있다.In addition, a trench T may be provided at a boundary portion between the fourth to sixth sub-pixels SP4 , SP5 , and SP6 , and a step compensation part 9 ′ may be provided along the trench T. . The step compensating unit 9' includes the first step compensating unit 91', the fifth sub-pixel SP5, and the fourth sub-pixel SP4 and the fifth sub-pixel SP5. A second step compensation part 92 ′ disposed at a boundary between the six sub-pixels SP6 may be included.

상기 제4 서브 화소(SP4)는 제1 서브 화소(SP1)와 동일한 색의 광, 예로서 적색 광을 발광하도록 구비되고, 상기 제5 서브 화소(SP5)는 제2 서브 화소(SP2)와 동일한 색의 광, 예로서 녹색 광을 발광하도록 구비되며, 제6 서브 화소(SP6)는 제3 서브 화소(SP3)와 동일한 색의 광, 예로서 청색 광을 발광하도록 구비될 수 있다. 따라서, 제2 방향(Y축 방향)으로 배치된 제1 서브 화소(SP1)와 제4 서브 화소(SP4) 사이의 경계 부분, 제2 방향(Y축 방향)으로 배치된 제2 서브 화소(SP2)와 제5 서브 화소(SP5) 사이의 경계 부분, 제2 방향(Y축 방향)으로 배치된 제3 서브 화소(SP3)와 제6 서브 화소(SP6) 사이의 경계 부분에는 트렌치(T)가 배치되지 않을 수 있다.The fourth sub-pixel SP4 is provided to emit light of the same color as that of the first sub-pixel SP1 , for example, red light, and the fifth sub-pixel SP5 is the same as the second sub-pixel SP2 . It is provided to emit light of a color, for example, green light, and the sixth sub-pixel SP6 may be provided to emit light of the same color as that of the third sub-pixel SP3, for example, blue light. Accordingly, a boundary portion between the first sub-pixel SP1 and the fourth sub-pixel SP4 disposed in the second direction (Y-axis direction), and the second sub-pixel SP2 disposed in the second direction (Y-axis direction) ) and the fifth sub-pixel SP5 and at the boundary between the third sub-pixel SP3 and the sixth sub-pixel SP6 arranged in the second direction (Y-axis direction), a trench T is formed. may not be placed.

트렌치(T)는 서로 다른 색의 광이 방출되도록 구비된 서브 화소들 사이에 배치되어서 상기 서브 화소 간의 누설전류 발생을 방지하여 서로 다른 색의 광이 혼색되는 것을 방지하는 것인데, 본 발명의 일 실시예에 따른 표시장치(1)는 제2 방향(Y축 방향)으로 동일한 색의 광이 방출되는 서브 화소들이 배치되기 때문에 트렌치(T)가 구비될 필요가 없는 것이다.The trench T is disposed between sub-pixels provided to emit light of different colors to prevent leakage current between the sub-pixels and to prevent light of different colors from being mixed. The display device 1 according to the example does not need to include the trench T because sub-pixels emitting light of the same color are disposed in the second direction (the Y-axis direction).

상기 제2 방향(Y축 방향)으로 서브 화소들 사이에 트렌치(T)가 배치되지 않기 때문에, 트렌치 주변의 단차를 보상하기 위한 단차보상부(9)도 배치되지 않을 수 있다. 따라서, 도 4와 같이, 상기 단차보상부(9)는 제1 서브 화소(SP1)와 제4 서브 화소(SP4) 사이, 제2 서브 화소(SP2)와 제5 서브 화소(SP5) 사이, 및 제3 서브 화소(SP3)와 제6 서브 화소(SP6) 사이에는 배치되지 않을 수 있다.Since the trench T is not disposed between the sub-pixels in the second direction (the Y-axis direction), the step compensation part 9 for compensating for the step difference around the trench may not be disposed either. Accordingly, as shown in FIG. 4 , the step difference compensator 9 is disposed between the first sub-pixel SP1 and the fourth sub-pixel SP4 , between the second sub-pixel SP2 and the fifth sub-pixel SP5 , and It may not be disposed between the third sub-pixel SP3 and the sixth sub-pixel SP6 .

한편, 서로 다른 색의 광이 방출되도록 구비된 서브 화소들 사이에는 누설전류 방지를 위해 트렌치(T)가 배치되어야 하므로, 트렌치(T)는 도 4와 같이 제2 방향(Y축 방향)을 따라 스트라이프 형태로 길게 구비될 수 있다.Meanwhile, since the trench T must be disposed between the sub-pixels provided to emit light of different colors to prevent leakage current, the trench T is formed along the second direction (Y-axis direction) as shown in FIG. 4 . It may be provided in a long stripe shape.

결과적으로, 본 발명의 일 실시예에 따른 표시장치(1)에 있어서, 트렌치(T)는 서브 화소들 사이에서 제2 방향(Y축 방향)으로 스트라이프 형태로 배치되고, 단차보상부(9)는 트렌치(T)를 따라 제2 방향(Y축 방향)으로 형성될 수 있다. 다만, 단차보상부(9)는 도 4와 같이, 제2 방향(Y축 방향)으로 배치된 서브 화소들 사이에 배치된 트렌치(T), 예로서 제1 서브 화소(SP1)와 제5 서브 화소(SP5) 사이, 및 제2 서브 화소(SP2)와 제4 서브 화소(SP4) 사이에 배치된 트렌치(T)에는 형성되지 않을 수 있다.As a result, in the display device 1 according to the embodiment of the present invention, the trench T is disposed in a stripe shape in the second direction (Y-axis direction) between the sub-pixels, and the step difference compensating part 9 is formed. may be formed in the second direction (Y-axis direction) along the trench T. However, as shown in FIG. 4 , the step compensation unit 9 includes a trench T disposed between sub-pixels disposed in the second direction (Y-axis direction), for example, the first sub-pixel SP1 and the fifth sub-pixel SP1 . It may not be formed in the trench T disposed between the pixel SP5 and between the second sub-pixel SP2 and the fourth sub-pixel SP4 .

상기 제1 서브 화소(SP1)와 제2 서브 화소(SP2) 사이에 배치된 제1 단차보상부(91)는 제1 서브 화소(SP1)의 제1 하부 전극(511)과 연결되고, 제4 서브 화소(SP4)와 제5 서브 화소(SP5) 사이에 배치된 제1 단차보상부(91')는 제4 서브 화소(SP4)의 제4 하부 전극과 연결되기 때문에, 제1 단차보상부(91)와 제1 단차보상부(91')가 연결되면, 제1 서브 화소(SP1)와 제4 서브 화소(SP4) 간에 쇼트가 발생될 수 있기 때문이다.The first step difference compensator 91 disposed between the first sub-pixel SP1 and the second sub-pixel SP2 is connected to the first lower electrode 511 of the first sub-pixel SP1, and a fourth Since the first step compensation part 91' disposed between the sub-pixel SP4 and the fifth sub-pixel SP5 is connected to the fourth lower electrode of the fourth sub-pixel SP4, the first step compensation part ( This is because, when the 91 ) and the first step difference compensator 91 ′ are connected, a short may occur between the first sub-pixel SP1 and the fourth sub-pixel SP4 .

따라서, 본 발명의 일 실시예에 따른 표시장치(1)는 단차보상부(9)가 제1 방향(X축 방향)으로 배치된 서브 화소들 사이의 경계 부분에만 배치되고, 제2 방향(Y축 방향)으로 배치된 서브 화소들 사이의 경계 부분에는 배치되지 않도록 구비될 수 있다. 이에 따라, 제1 단차보상부(91)는 제1 서브 화소(SP1)의 제1 하부 전극(511)과 연결되어 구동 박막트랜지스(31)로부터 인가되는 구동 전압을 인가받을 수 있고, 제1 단차보상부(91')는 제4 서브 화소(SP4)의 제4 하부 전극과 연결되어 구동 박막트랜지스로부터 인가되는 구동 전압을 인가받을 수 있고, 제2 단차보상부(92)는 제2 서브 화소(SP2)의 제2 하부 콘택전극(621)과 제3 서브 화소(SP3)의 제3 하부 콘택전극(631)에 연결되지 않으므로 구동 전압을 인가받을 수 없으며, 제2 단차보상부(92')는 제5 서브 화소(SP5)의 제5 하부 콘택전극과 제6 서브 화소(SP6)의 제6 하부 콘택전극에 연결되지 않으므로 구동 전압을 인가받을 수 없다.Accordingly, in the display device 1 according to the exemplary embodiment of the present invention, the step compensation part 9 is disposed only at a boundary portion between sub-pixels disposed in the first direction (X-axis direction), and in the second direction (Y-axis direction). It may be provided so as not to be disposed at a boundary between sub-pixels disposed in the axial direction). Accordingly, the first step difference compensator 91 may be connected to the first lower electrode 511 of the first sub-pixel SP1 to receive a driving voltage applied from the driving thin film transistor 31 , and the first The step difference compensator 91 ′ is connected to the fourth lower electrode of the fourth sub-pixel SP4 to receive a driving voltage applied from the driving thin film transistor, and the second step compensator 92 is connected to the second sub-pixel SP4 . Since it is not connected to the second lower contact electrode 621 of the pixel SP2 and the third lower contact electrode 631 of the third sub-pixel SP3, the driving voltage cannot be applied, and the second step difference compensator 92' ) is not connected to the fifth lower contact electrode of the fifth sub-pixel SP5 and the sixth lower contact electrode of the sixth sub-pixel SP6, and thus the driving voltage cannot be applied.

결과적으로, 도 4와 같이, 제1 단차보상부(91, 91')는 구동 전압을 인가하는 구동전극(또는 연결전극)으로 구비될 수 있고, 제2 단차보상부(92, 92')는 아일랜드 형태 또는 플로팅 형태로 구비될 수 있다.As a result, as shown in FIG. 4 , the first step difference compensating units 91 and 91 ′ may be provided as driving electrodes (or connection electrodes) for applying a driving voltage, and the second step compensating units 92 and 92 ′ are It may be provided in an island form or a floating form.

도 5는 본 발명의 다른 실시예에 따른 표시장치의 개략적인 평면도이고, 도 6은 도 5에 도시된 선 Ⅲ-Ⅲ'의 개략적인 단면도이며, 도 7은 도 5에 도시된 선 Ⅳ-Ⅳ'의 개략적인 단면도이다.5 is a schematic plan view of a display device according to another exemplary embodiment of the present invention, FIG. 6 is a schematic cross-sectional view taken along line III-III' shown in FIG. 5, and FIG. 7 is a line IV-IV shown in FIG. ' is a schematic cross-sectional view of

도 5를 참조하면, 본 출원의 다른 실시예에 따른 표시장치(1)는 제1 단차보상부(91)가 제1 서브 화소(SP1)의 제1 하부 전극(511)과 이격되고, 트렌치(T)를 따라 스트라이프 형태로 구비된 것을 제외하고, 전술한 도 1에 따른 표시장치와 동일하다. 따라서, 동일한 구성에 대해서 동일한 도면부호를 부여하였고, 이하에서는 상이한 구성에 대해서만 설명하기로 한다.Referring to FIG. 5 , in the display device 1 according to another embodiment of the present application, the first step difference compensating part 91 is spaced apart from the first lower electrode 511 of the first sub-pixel SP1, and a trench ( It is the same as the display device of FIG. 1 described above, except that it is provided in the form of a stripe along T). Accordingly, the same reference numerals are assigned to the same components, and only different components will be described below.

전술한 도 1에 따른 표시장치의 경우, 제1 단차보상부(91)가 제1 서브 화소(SP1)의 제1 하부 전극(511)과 연결되고, 제1 단차보상부(91')가 제4 서브 화소(SP4)의 제4 하부 전극에 연결되므로, 제1 단차보상부(91)와 제1 단차보상부(91')는 제2 방향(Y축 방향)으로 서로 이격되게 배치된다. 즉, 도 1에 따른 표시장치는 제1 단차보상부(91, 91')가 구동 전극으로 기능하므로, 서로 이격되어 배치된다.In the case of the above-described display device according to FIG. 1 , the first step compensating part 91 is connected to the first lower electrode 511 of the first sub-pixel SP1 , and the first step compensating part 91 ′ is the second Since it is connected to the fourth lower electrode of the 4 sub-pixel SP4 , the first step difference compensator 91 and the first step difference compensator 91 ′ are disposed to be spaced apart from each other in the second direction (Y-axis direction). That is, in the display device of FIG. 1 , since the first step difference compensators 91 and 91 ′ function as driving electrodes, they are disposed to be spaced apart from each other.

그에 반하여, 도 5의 다른 실시예에 따른 표시장치의 경우에는, 제1 단차보상부(91)가 제1 서브 화소(SP1)의 제1 하부 전극(511)과 이격되므로 구동 전극으로 기능하지 못하고, 제1 단차보상부(91')가 제4 서브 화소(SP4)의 제4 하부 전극과 이격되므로 구동 전극으로 기능하지 못한다. 따라서, 도 5와 같이 제1 단차보상부(91)와 제1 단차보상부(91')는 서로 연결되는 스트라이프 형태로 구비될 수 있다. 이 경우, 제1 서브 화소(SP1)에 인가되는 구동전압은 제1 단차보상부(91)를 통하지 않고 제1 하부 전극(511)과 제1 콘택 전극(61)을 통해 제1 상부 전극(512)에 인가될 수 있고, 제4 서브 화소(SP4)에 인가되는 구동전압은 제1 단차보상부(91')를 통하지 않고 제4 하부 전극과 제4 콘택 전극을 통해 제4 상부 전극에 인가될 수 있다.On the other hand, in the case of the display device according to another exemplary embodiment of FIG. 5 , the first step difference compensator 91 is spaced apart from the first lower electrode 511 of the first sub-pixel SP1, so it cannot function as a driving electrode. , since the first step difference compensator 91 ′ is spaced apart from the fourth lower electrode of the fourth sub-pixel SP4 , it does not function as a driving electrode. Accordingly, as shown in FIG. 5 , the first step difference compensating part 91 and the first step difference compensating part 91 ′ may be provided in the form of a stripe connected to each other. In this case, the driving voltage applied to the first sub-pixel SP1 passes through the first lower electrode 511 and the first contact electrode 61 without passing through the first step difference compensator 91 , but on the first upper electrode 512 . ) and the driving voltage applied to the fourth sub-pixel SP4 may be applied to the fourth upper electrode through the fourth lower electrode and the fourth contact electrode without passing through the first step difference compensator 91 ′. can

한편, 도 5의 다른 실시예에 따른 제2 단차보상부(92)는 제1 단차보상부(91)와 같이 제2 방향(Y축 방향)으로 배치된 트렌치(T)를 따라 스트라이프 형태로 배치될 수 있다. 이에 따라, 본 발명의 다른 실시예에 따른 표시장치(1)는 제2 단차보상부(92)를 제1 단차보상부(91)와 다른 형태, 예로서 아일랜드 형태 또는 플로팅 형태로 구비하는 경우에 비해, 제조 공정을 단순화시킬 수 있다. 그러나, 이에 한정되지 않으며, 제2 단차보상부(92)는 구동 전극으로 기능하지 못하기 때문에 아일랜드 형태 또는 플로팅 형태로 구비될 수도 있다.On the other hand, the second step compensating part 92 according to another embodiment of FIG. 5 is arranged in the form of a stripe along the trench T arranged in the second direction (Y-axis direction) like the first step compensating part 91 . can be Accordingly, when the display device 1 according to another embodiment of the present invention includes the second step compensation part 92 in a shape different from that of the first step compensation part 91, for example, in an island shape or a floating shape. In comparison, the manufacturing process can be simplified. However, the present invention is not limited thereto, and since the second step difference compensating unit 92 does not function as a driving electrode, it may be provided in an island form or a floating form.

결과적으로, 본 출원의 다른 실시예에 따른 표시장치(1)에 있어서, 제1 단차보상부(91)와 제2 단차보상부(92)를 포함하는 단차보상부(9)는 제1 하부 전극(511), 제2 하부 콘택전극(621), 및 제3 하부 콘택전극(631) 각각으로부터 이격되도록 구비될 수 있다.As a result, in the display device 1 according to another exemplary embodiment of the present application, the step compensating unit 9 including the first step compensating unit 91 and the second step compensating unit 92 is the first lower electrode 511 , the second lower contact electrode 621 , and the third lower contact electrode 631 may be spaced apart from each other.

도 6을 참조하면, 상기 제1 단차보상부(91)는 제1 하부 전극(511)과 이격되어 배치된다. 이를 위해, 도 5의 다른 실시예에 따른 표시장치의 제1 하부 전극(511)의 폭(EW')은 도 1의 일 실시예에 따른 표시장치의 제1 하부 전극(511)의 폭(EW)보다 좁게 구비될 수 있다. 예컨대, 도 5의 다른 실시예에 따른 표시장치(1)의 제1 하부 전극(511)의 폭(EW')은 펜스(F)에 가려지지 않는 제1 상부 전극(512)의 폭과 동일하게 형성될 수 있다. 그러나, 이에 한정되지 않으며 제1 하부 전극(511)의 폭(EW')은 제1 단차보상부(91)에 연결되지 않는 범위에서 펜스(F)에 가려지지 않는 제1 상부 전극(512)의 폭보다 넓게 구비될 수도 있다.Referring to FIG. 6 , the first step difference compensating part 91 is disposed to be spaced apart from the first lower electrode 511 . To this end, the width EW' of the first lower electrode 511 of the display device according to the embodiment of FIG. 5 is the width EW of the first lower electrode 511 of the display device according to the embodiment of FIG. 1 . ) can be narrower than For example, the width EW' of the first lower electrode 511 of the display device 1 according to another exemplary embodiment of FIG. 5 is the same as the width of the first upper electrode 512 not covered by the fence F. can be formed. However, the present invention is not limited thereto, and the width EW' of the first lower electrode 511 is in the range not connected to the first step difference compensating part 91 and is not covered by the fence F of the first upper electrode 512 . It may be provided wider than the width.

따라서, 제1 서브 화소(SP1)의 제1 하부 전극(511)과 제1 단차보상부(91) 사이에는 제1 절연층(41)이 회로 소자층(3)의 상면에 접촉되도록 삽입될 수 있고, 이에 따라 제1 하부 전극(511)과 제1 단차보상부(91)가 이격된 영역에서 제1 절연층(41)은 단차를 가질 수 있다. 그리고, 제1 절연층(41) 위에 순차적으로 배치되는 제2 절연층(42)과 제1 상부 전극(512) 역시 제1 하부 전극(511)과 제1 단차보상부(91)가 이격된 영역에서 단차를 갖도록 형성될 수 있다.Accordingly, the first insulating layer 41 may be inserted between the first lower electrode 511 of the first sub-pixel SP1 and the first step difference compensating part 91 to be in contact with the upper surface of the circuit element layer 3 . Accordingly, in a region where the first lower electrode 511 and the first step difference compensating part 91 are spaced apart, the first insulating layer 41 may have a step difference. In addition, the second insulating layer 42 and the first upper electrode 512 sequentially disposed on the first insulating layer 41 are also regions in which the first lower electrode 511 and the first step difference compensating part 91 are spaced apart from each other. may be formed to have a step difference in

한편, 서로 이격된 제1 하부 전극(511)과 제1 단차보상부(91)는 제1 서브 화소(SP1) 전체에 형성되므로, 제1 콘택영역(CA1)이 없는 부분에서도 동일한 구조로 형성될 수 있다. 따라서, 도 7과 같이 제1 서브 화소(SP1)에서 제1 하부 전극(511)과 제1 단차보상부(91)가 이격된 영역에서 제1 절연층(41), 제2 절연층(42), 및 제1 상부전극(512)은 단차를 가지도록 구비될 수 있다.On the other hand, since the first lower electrode 511 and the first step difference compensating part 91 spaced apart from each other are formed in the entire first sub-pixel SP1, the same structure can be formed even in a portion without the first contact area CA1. can Accordingly, as shown in FIG. 7 , in the region where the first lower electrode 511 and the first step difference compensating part 91 are spaced apart from each other in the first sub-pixel SP1 , the first insulating layer 41 and the second insulating layer 42 . , and the first upper electrode 512 may be provided to have a step difference.

반면, 제2 서브 화소(SP2)에서는 제2 하부 전극(521)의 좌측 끝단과 제1 단차보상부(91)의 우측 끝단이 제1 방향(X축 방향)으로 이격되지 않고, 제2 하부 전극(521)의 우측 끝단과 제2 단차보상부(92)의 좌측 끝단이 이격되지 않으므로, 제2 하부 전극(521)과 제1 단차보상부(91) 사이, 및 제2 하부 전극(521)과 제2 단차보상부(92) 사이에서는 단차가 발생하지 않을 수 있다. 따라서, 제2 서브 화소(SP2)의 제2 상부 전극(522)은 제1 상부 전극(512)과 달리 평탄한 형태로 구비될 수 있다.On the other hand, in the second sub-pixel SP2 , the left end of the second lower electrode 521 and the right end of the first step difference compensator 91 are not spaced apart in the first direction (X-axis direction), and the second lower electrode Since the right end of 521 and the left end of the second step difference compensating part 92 are not spaced apart, between the second lower electrode 521 and the first step difference compensating part 91 and the second lower electrode 521 and A step may not occur between the second step difference compensating units 92 . Accordingly, the second upper electrode 522 of the second sub-pixel SP2 may be provided in a flat shape, unlike the first upper electrode 512 .

제3 서브 화소(SP3)에서는 제3 하부 전극(531)의 좌측 끝단과 제2 단차보상부(92)의 우측 끝단이 제1 방향(X축 방향)으로 이격되지 않고, 제3 하부 전극(531)의 우측 끝단과 우측에 인접한 또 다른 서브 화소 사이에 배치된 단차보상부의 좌측 끝단이 이격되지 않으므로, 제3 하부 전극(531)과 제2 단차보상부(92) 사이, 및 제3 하부 전극(531)과 인접한 또 다른 서브 화소 사이에 배치된 단차보상부 사이에서는 단차가 발생하지 않을 수 있다. 따라서, 제3 서브 화소(SP3)의 제3 상부 전극(532)은 제2 상부 전극(522)과 같이 평탄한 형태로 구비될 수 있다.In the third sub-pixel SP3 , the left end of the third lower electrode 531 and the right end of the second step difference compensating part 92 are not spaced apart in the first direction (X-axis direction), and the third lower electrode 531 is not spaced apart from each other. ) and the left end of the step difference compensator disposed between another sub-pixel adjacent to the right are not spaced apart, between the third lower electrode 531 and the second step compensating part 92 and the third lower electrode ( 531) and the step difference compensator disposed between another adjacent sub-pixel may not have a step difference. Accordingly, the third upper electrode 532 of the third sub-pixel SP3 may be provided in a flat shape like the second upper electrode 522 .

도 8a 내지 도 8c는 본 발명의 또 다른 실시예에 따른 표시장치에 관한 것으로서, 이는 헤드 장착형 표시(HMD) 장치에 관한 것이다. 도 8a는 개략적인 사시도이고, 도 8b는 VR(Virtual Reality) 구조의 개략적인 평면도이고, 도 8c는 AR(Augmented Reality) 구조의 개략적인 단면도이다.8A to 8C relate to a display device according to still another embodiment of the present invention, which relates to a head mounted display (HMD) device. 8A is a schematic perspective view, FIG. 8B is a schematic plan view of a VR (Virtual Reality) structure, and FIG. 8C is a schematic cross-sectional view of an AR (Augmented Reality) structure.

도 8a에서 알 수 있듯이, 본 발명에 따른 헤드 장착형 표시 장치는 수납 케이스(12), 및 헤드 장착 밴드(14)를 포함하여 이루어진다.As can be seen from FIG. 8A , the head mounted display device according to the present invention includes a storage case 12 and a head mounted band 14 .

상기 수납 케이스(12)는 그 내부에 표시 장치, 렌즈 어레이, 및 접안 렌즈 등의 구성을 수납하고 있다.The storage case 12 houses a display device, a lens array, and an eyepiece lens therein.

상기 헤드 장착 밴드(14)는 상기 수납 케이스(12)에 고정된다. 상기 헤드 장착 밴드(14)는 사용자의 머리 상면과 양 측면들을 둘러쌀 수 있도록 형성된 것을 예시하였으나, 이에 한정되지 않는다. 상기 헤드 장착 밴드(14)는 사용자의 머리에 헤드 장착형 디스플레이를 고정하기 위한 것으로, 안경테 형태 또는 헬멧 형태의 구조물로 대체될 수 있다.The head mounting band 14 is fixed to the storage case 12 . The head mounting band 14 has been exemplified to be formed so as to surround the upper surface and both sides of the user's head, but is not limited thereto. The head mounting band 14 is for fixing the head mounted display to the user's head, and may be replaced with a structure in the form of an eyeglass frame or a helmet.

도 8b에서 알 수 있듯이, 본 발명에 따른 VR(Virtual Reality) 구조의 헤드 장착형 표시장치(1)는 좌안용 표시 장치(2a)와 우안용 표시 장치(2b), 렌즈 어레이(13), 및 좌안 접안 렌즈(20a)와 우안 접안 렌즈(20b) 를 포함할 수 있다.As can be seen from FIG. 8B , the head mounted display device 1 having a VR (Virtual Reality) structure according to the present invention includes a left-eye display device 2a, a right-eye display device 2b, a lens array 13, and a left eye. It may include an eyepiece 20a and a right eyepiece 20b.

상기 좌안용 표시 장치(2a)와 우안용 표시 장치(2b), 상기 렌즈 어레이(13), 및 상기 좌안 접안 렌즈(20a)와 우안 접안 렌즈(20b)는 전술한 수납 케이스(12)에 수납된다.The left eye display device 2a and the right eye display device 2b, the lens array 13, and the left eyepiece 20a and the right eyepiece 20b are accommodated in the storage case 12 described above. .

좌안용 표시 장치(2a)와 우안용 표시 장치(2b)는 동일한 영상을 표시할 수 있으며, 이 경우 사용자는 2D 영상을 시청할 수 있다. 또는, 좌안용 표시 장치(2a)는 좌안 영상을 표시하고 우안용 표시 장치(2b)는 우안 영상을 표시할 수 있으며, 이 경우 사용자는 입체 영상을 시청할 수 있다. 상기 좌안용 표시 장치(2a)와 상기 우안용 표시 장치(2b) 각각은 전술한 도 1 내지 도 7에 따른 표시 장치로 이루어질 수 있다. 예컨대, 좌안용 표시 장치(2a)와 우안용 표시 장치(2b) 각각은 유기발광 표시장치(Organic Light Emitting Display)일 수 있다.The left-eye display device 2a and the right-eye display device 2b may display the same image, and in this case, the user may view the 2D image. Alternatively, the left-eye display device 2a may display a left-eye image and the right-eye display device 2b may display a right-eye image. In this case, the user may view a stereoscopic image. Each of the left-eye display device 2a and the right-eye display device 2b may include the display device illustrated in FIGS. 1 to 7 . For example, each of the left-eye display device 2a and the right-eye display device 2b may be an organic light emitting display.

상기 좌안용 표시 장치(2a) 및 우안용 표시 장치(2b) 각각은 복수의 서브 화소, 회로 소자층(3), 절연층(4), 트렌치(T), 제1 전극(5), 펜스(F), 절연부(IP), 콘택전극(6), 유기발광층(7), 제2 전극(8), 단차보상부(9), 봉지층(10), 및 컬러필터층(11)을 포함할 수 있으며, 각 서브 화소에서 발광하는 광의 색을 다양한 방식으로 조합하여서 다양한 영상들을 표시할 수 있다.The left-eye display device 2a and the right-eye display device 2b each have a plurality of sub-pixels, a circuit element layer 3, an insulating layer 4, a trench T, a first electrode 5, and a fence ( F), an insulating part (IP), a contact electrode (6), an organic light emitting layer (7), a second electrode (8), a step compensation part (9), an encapsulation layer (10), and a color filter layer (11) In addition, various images can be displayed by combining the colors of light emitted from each sub-pixel in various ways.

상기 렌즈 어레이(13)는 상기 좌안 접안 렌즈(20a)와 상기 좌안용 표시 장치(2a) 각각과 이격되면서 상기 좌안 접안 렌즈(20a)와 상기 좌안용 표시 장치(2a) 사이에 구비될 수 있다. 즉, 상기 렌즈 어레이(13)는 상기 좌안 접안 렌즈(20a)의 전방 및 상기 좌안용 표시 장치(2a)의 후방에 위치할 수 있다. 또한, 상기 렌즈 어레이(13)는 상기 우안 접안 렌즈(20b)와 상기 우안용 표시 장치(2b) 각각과 이격되면서 상기 우안 접안 렌즈(20b)와 상기 우안용 표시 장치(2b) 사이에 구비될 수 있다. 즉, 상기 렌즈 어레이(13)는 상기 우안 접안 렌즈(20b)의 전방 및 상기 우안용 표시 장치(2b)의 후방에 위치할 수 있다.The lens array 13 may be provided between the left eyepiece 20a and the left eye display device 2a while being spaced apart from each of the left eyepiece 20a and the left eye display device 2a. That is, the lens array 13 may be positioned in front of the left eyepiece lens 20a and behind the left eye display device 2a. In addition, the lens array 13 may be provided between the right eyepiece 20b and the right eye display device 2b while being spaced apart from each of the right eyepiece 20b and the right eye display device 2b. there is. That is, the lens array 13 may be positioned in front of the right eye eyepiece 20b and behind the right eye display device 2b.

상기 렌즈 어레이(13)는 마이크로 렌즈 어레이(Micro Lens Array)일 수 있다. 렌즈 어레이(13)는 핀홀 어레이(Pin Hole Array)로 대체될 수 있다. 렌즈 어레이(13)로 인해 좌안용 표시 장치(2a) 또는 우안용 표시 장치(2b)에 표시되는 영상은 사용자에게 확대되어 보일 수 있다.The lens array 13 may be a micro lens array. The lens array 13 may be replaced with a pin hole array. Due to the lens array 13 , the image displayed on the left-eye display device 2a or the right-eye display device 2b may be enlarged to a user.

좌안 접안 렌즈(20a)에는 사용자의 좌안(LE)이 위치하고, 우안 접안 렌즈(20b)에는 사용자의 우안(RE)이 위치할 수 있다.The user's left eye LE may be located in the left eyepiece 20a, and the user's right eye RE may be located in the right eyepiece 20b.

도 8c에서 알 수 있듯이, 본 발명에 따른 AR(Augmented Reality) 구조의 헤드 장착형 표시 장치는 좌안용 표시 장치(2a), 렌즈 어레이(13), 좌안 접안 렌즈(20a), 투과 반사부(15), 및 투과창(16)을 포함하여 이루어진다. 도 8c에는 편의상 좌안쪽 구성만을 도시하였으며, 우안쪽 구성도 좌안쪽 구성과 동일하다. As can be seen from FIG. 8C , the head mounted display device having an AR (Augmented Reality) structure according to the present invention includes a left eye display device 2a, a lens array 13, a left eye eyepiece 20a, and a transmission reflector 15. , and a transmission window 16 . FIG. 8C shows only the left eye configuration for convenience, and the right eye configuration is also the same as the left eye configuration.

상기 좌안용 표시 장치(2a), 렌즈 어레이(13), 좌안 접안 렌즈(20a), 투과 반사부(15), 및 투과창(16)은 전술한 수납 케이스(12)에 수납된다. The left eye display device 2a, the lens array 13, the left eye eyepiece 20a, the transmissive reflector 15, and the transmissive window 16 are accommodated in the aforementioned storage case 12.

상기 좌안용 표시 장치(2a)는 상기 투과창(16)을 가리지 않으면서 상기 투과 반사부(15)의 일측, 예로서 상측에 배치될 수 있다. 이에 따라서, 상기 좌안용 표시 장치(2a)가 상기 투과창(16)을 통해 보이는 외부 배경을 가리지 않으면서 상기 투과 반사부(15)에 영상을 제공할 수 있다.The left-eye display device 2a may be disposed on one side, for example, an upper side, of the transmissive reflector 15 without blocking the transmissive window 16 . Accordingly, the left-eye display device 2a may provide an image to the transmissive reflector 15 without blocking the external background viewed through the transmissive window 16 .

상기 좌안용 표시 장치(2a)는 전술한 도 1 내지 도 7에 따른 표시장치로 이루어질 수 있다. 이때, 도 1 내지 도 7에서 화상이 표시되는 면에 해당하는 상측 부분, 예로서 봉지층(10) 또는 컬러 필터층(11)이 상기 투과 반사부(15)와 마주하게 된다.The left-eye display device 2a may include the display device according to FIGS. 1 to 7 described above. At this time, the upper portion corresponding to the surface on which the image is displayed in FIGS. 1 to 7 , for example, the encapsulation layer 10 or the color filter layer 11 faces the transmission reflection unit 15 .

상기 렌즈 어레이(13)는 상기 좌안 접안 렌즈(20a)와 상기 투과 반사부(15) 사이에 구비될 수 있다.The lens array 13 may be provided between the left eyepiece 20a and the transmissive reflector 15 .

상기 좌안 접안 렌즈(20a)에는 사용자의 좌안이 위치한다. The user's left eye is located in the left eye eyepiece 20a.

상기 투과 반사부(15)는 상기 렌즈 어레이(13)와 상기 투과창(16) 사이에 배치된다. 상기 투과 반사부(15)는 광의 일부를 투과시키고, 광의 다른 일부를 반사시키는 반사면(15a)을 포함할 수 있다. 상기 반사면(15a)은 상기 좌안용 표시 장치(2a)에 표시된 영상이 상기 렌즈 어레이(13)로 진행하도록 형성된다. 따라서, 사용자는 상기 투과창(16)을 통해서 외부의 배경과 상기 좌안용 표시 장치(2a)에 의해 표시되는 영상을 모두 볼 수 있다. 즉, 사용자는 현실의 배경과 가상의 영상을 겹쳐 하나의 영상으로 볼 수 있으므로, 증강현실(Augmented Reality, AR)이 구현될 수 있다.The transmissive reflector 15 is disposed between the lens array 13 and the transmissive window 16 . The transmissive reflector 15 may include a reflective surface 15a that transmits a part of light and reflects another part of the light. The reflective surface 15a is formed so that the image displayed on the left-eye display device 2a proceeds to the lens array 13 . Accordingly, the user can see both the external background and the image displayed by the left-eye display device 2a through the transmission window 16 . That is, since a user can view a single image by overlapping a real background and a virtual image, augmented reality (AR) can be implemented.

상기 투과창(16)은 상기 투과 반사부(15)의 전방에 배치되어 있다.The transmission window 16 is disposed in front of the transmission reflection unit 15 .

이상에서 설명한 본 발명은 전술한 실시 예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 있어 명백할 것이다. 그러므로, 본 발명의 범위는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.The present invention described above is not limited to the above-described embodiments and the accompanying drawings, and it is common in the technical field to which the present invention pertains that various substitutions, modifications and changes are possible without departing from the technical spirit of the present invention. It will be clear to those who have the knowledge of Therefore, the scope of the present invention is indicated by the following claims, and all changes or modifications derived from the meaning and scope of the claims and their equivalent concepts should be construed as being included in the scope of the present invention.

1: 표시장치
2: 기판 3: 회로 소자층
4: 절연층 5: 제1 전극
6: 콘택전극 7: 유기발광층
8: 제2 전극 9: 단차보상부
10: 봉지층 11: 컬러 필터
12: 수납 케이스 13: 렌즈 어레이
14: 헤드 장착 밴드 15: 투과 반사부
16: 투과창 F: 펜스
IP: 절연부
1: Display
2: substrate 3: circuit element layer
4: insulating layer 5: first electrode
6: contact electrode 7: organic light emitting layer
8: second electrode 9: step compensation part
10: encapsulation layer 11: color filter
12: storage case 13: lens array
14: head mounting band 15: transmissive reflector
16: transmission window F: fence
IP: Insulation

Claims (20)

제1 서브 화소, 제2 서브 화소, 및 제3 서브 화소를 구비한 기판;
상기 기판 상에서 상기 제1 내지 제3 서브 화소에 각각 구비된 구동 박막 트랜지스터를 포함하는 회로 소자층;
상기 회로 소자층 상에서 상기 제1 내지 제3 서브 화소 사이의 경계 영역에 구비된 트렌치를 포함하는 절연층;
상기 트렌치와 이격되도록 상기 제1 내지 제3 서브 화소에 각각 구비된 제1 전극;
상기 제1 전극과 상기 트렌치 상에 구비된 유기발광층;
상기 유기발광층 상에 구비된 제2 전극; 및
상기 트렌치보다 넓은 폭으로 형성되어 상기 트렌치의 하면에 접하도록 배치된 단차보상부를 포함하고,
상기 제1 서브 화소에 구비된 제1 전극은 제1 상부전극 및 상기 제1 상부전극으로부터 상기 기판 쪽으로 이격된 제1 하부전극을 포함하고,
상기 제1 하부전극은 상기 단차보상부와 동일한 층에 구비된 표시장치.
a substrate including a first sub-pixel, a second sub-pixel, and a third sub-pixel;
a circuit element layer including driving thin film transistors respectively provided in the first to third sub-pixels on the substrate;
an insulating layer including a trench provided in a boundary region between the first to third sub-pixels on the circuit element layer;
a first electrode provided in each of the first to third sub-pixels to be spaced apart from the trench;
an organic light emitting layer provided on the first electrode and the trench;
a second electrode provided on the organic light emitting layer; and
It is formed to have a wider width than the trench and includes a step difference compensating part disposed in contact with the lower surface of the trench,
The first electrode provided in the first sub-pixel includes a first upper electrode and a first lower electrode spaced apart from the first upper electrode toward the substrate;
The first lower electrode is provided on the same layer as the step difference compensating part.
제 1 항에 있어서,
상기 단차보상부는 상기 제1 내지 제3 서브 화소 각각에 구비된 제1 전극과 비중첩된 표시장치.
The method of claim 1,
The step difference compensator does not overlap the first electrode provided in each of the first to third sub-pixels.
제 1 항에 있어서,
상기 단차보상부는 상기 제1 하부 전극과 동일한 두께로 구비된 표시장치.
The method of claim 1,
The step difference compensator is provided with the same thickness as the first lower electrode.
제 1 항에 있어서,
상기 단차보상부는 상기 제1 하부 전극의 폭보다 좁은 표시장치.
The method of claim 1,
The step difference compensating part is narrower than a width of the first lower electrode.
제 1 항에 있어서,
상기 제2 서브 화소에 구비된 제1 전극은 제2 상부전극 및 상기 제2 상부전극으로부터 상기 기판 쪽으로 이격된 제2 하부전극을 포함하고,
상기 제3 서브 화소에 구비된 제1 전극은 제3 상부전극 및 상기 제3 상부전극의 하면에 접촉된 제3 하부전극을 포함하며,
상기 제1 하부 전극, 상기 제2 하부 전극, 및 상기 제3 하부 전극은 동일한 두께로 구비된 표시장치.
The method of claim 1,
The first electrode provided in the second sub-pixel includes a second upper electrode and a second lower electrode spaced apart from the second upper electrode toward the substrate;
The first electrode provided in the third sub-pixel includes a third upper electrode and a third lower electrode in contact with a lower surface of the third upper electrode,
The first lower electrode, the second lower electrode, and the third lower electrode have the same thickness.
제 5 항에 있어서,
상기 제1 하부전극과 상기 제1 상부전극 사이에 배치되어 상기 제1 하부 전극과 상기 제1 상부전극을 서로 연결시키는 제1 콘택전극을 포함하고,
상기 제1 콘택전극은 제1 하부 콘택전극 및 제1 상부 콘택전극을 포함하고,
상기 제1 하부 콘택전극은 상기 제1 하부전극과 상기 제1 상부 콘택전극 사이에 구비되어 상기 제1 하부전극과 상기 제1 상부 콘택전극을 연결하고,
상기 제1 상부 콘택전극은 상기 제1 하부 콘택전극과 상기 제1 상부전극 사이에 구비되어 상기 제1 하부 콘택전극과 상기 제1 상부전극을 연결하며,
상기 제1 하부 전극은 상기 회로 소자층에 구비된 회로 콘택홀을 통해서 상기 제1 서브 화소에 구비된 구동 박막 트랜지스터와 연결되는 표시장치.
6. The method of claim 5,
a first contact electrode disposed between the first lower electrode and the first upper electrode to connect the first lower electrode and the first upper electrode to each other;
The first contact electrode includes a first lower contact electrode and a first upper contact electrode,
the first lower contact electrode is provided between the first lower electrode and the first upper contact electrode to connect the first lower electrode and the first upper contact electrode;
the first upper contact electrode is provided between the first lower contact electrode and the first upper electrode to connect the first lower contact electrode and the first upper electrode;
The first lower electrode is connected to the driving thin film transistor provided in the first sub-pixel through a circuit contact hole provided in the circuit element layer.
제 6 항에 있어서,
상기 절연층은,
상기 제1 하부 콘택전극을 상기 제1 하부전극에 연결시키기 위한 제1 콘택홀이 형성되는 제1 절연층; 및
상기 제1 상부 콘택전극을 상기 제1 하부 콘택전극에 연결시키기 위한 제2 콘택홀이 형성되는 제2 절연층을 포함하고,
상기 제1 콘택홀과 상기 제2 콘택홀은 서로 중첩되며,
상기 제1 콘택홀의 폭은 상기 제2 콘택홀의 폭보다 넓은 표시장치.
7. The method of claim 6,
The insulating layer is
a first insulating layer in which a first contact hole for connecting the first lower contact electrode to the first lower electrode is formed; and
a second insulating layer in which a second contact hole for connecting the first upper contact electrode to the first lower contact electrode is formed;
The first contact hole and the second contact hole overlap each other,
A width of the first contact hole is wider than a width of the second contact hole.
제 6 항에 있어서,
상기 제2 하부전극과 상기 제2 상부전극 사이에 배치되어서 상기 제2 하부 전극과 상기 제2 상부전극을 서로 연결시키는 제2 콘택전극을 포함하고,
상기 제2 콘택전극은 제2 하부 콘택전극 및 제2 상부 콘택전극을 포함하고,
상기 제2 하부 콘택전극은 상기 회로 소자층에 구비된 회로 콘택홀을 통해서 상기 제2 서브 화소에 구비된 구동 박막 트랜지스터, 및 상기 제2 하부전극을 연결하고,
상기 제2 상부 콘택전극은 상기 제2 하부전극과 상기 제2 상부전극 사이에 구비되어 상기 제2 하부전극과 상기 제2 상부전극을 연결하고,
상기 제2 하부전극은 상기 제1 하부 콘택전극과 동일한 층에 구비되고,
상기 제2 하부 콘택전극은 상기 제1 하부전극 및 상기 단차보상부와 동일한 층에 구비되며,
상기 제2 상부 콘택전극은 상기 제1 상부 콘택전극과 동일한 층에 구비된 표시장치.
7. The method of claim 6,
a second contact electrode disposed between the second lower electrode and the second upper electrode to connect the second lower electrode and the second upper electrode to each other;
The second contact electrode includes a second lower contact electrode and a second upper contact electrode,
the second lower contact electrode connects the driving thin film transistor provided in the second sub-pixel and the second lower electrode through a circuit contact hole provided in the circuit element layer;
the second upper contact electrode is provided between the second lower electrode and the second upper electrode to connect the second lower electrode and the second upper electrode;
The second lower electrode is provided on the same layer as the first lower contact electrode,
The second lower contact electrode is provided on the same layer as the first lower electrode and the step difference compensating part,
The second upper contact electrode is provided on the same layer as the first upper contact electrode.
제 8 항에 있어서,
상기 제3 하부전극과 상기 제3 상부전극 사이에 배치되어서 상기 제3 하부 전극과 상기 제3 상부전극을 서로 연결시키는 제3 콘택전극을 포함하고,
상기 제3 콘택전극은 제3 하부 콘택전극 및 제3 상부 콘택전극을 포함하고,
상기 제3 하부 콘택전극은 상기 회로 소자층에 구비된 회로 콘택홀을 통해서 상기 제3 서브 화소에 구비된 구동 박막 트랜지스터, 및 상기 제3 상부 콘택전극을 연결하고,
상기 제3 상부 콘택전극은 상기 제3 하부 콘택전극과 상기 제3 하부전극 사이에 구비되어 상기 제3 하부 콘택전극과 상기 제3 하부전극을 연결하고,
상기 제3 하부전극은 상기 제1 상부 콘택전극 및 상기 제2 상부 콘택 전극과 동일한 층에 구비되고,
상기 제3 하부 콘택전극은 상기 제1 하부전극 및 상기 단차보상부와 동일한 층에 구비되며,
상기 제3 상부 콘택전극은 상기 제1 하부 콘택전극과 동일한 층에 구비된 표시장치.
9. The method of claim 8,
a third contact electrode disposed between the third lower electrode and the third upper electrode to connect the third lower electrode and the third upper electrode to each other;
The third contact electrode includes a third lower contact electrode and a third upper contact electrode,
the third lower contact electrode connects the driving thin film transistor provided in the third sub-pixel and the third upper contact electrode through a circuit contact hole provided in the circuit element layer;
the third upper contact electrode is provided between the third lower contact electrode and the third lower electrode to connect the third lower contact electrode and the third lower electrode;
the third lower electrode is provided on the same layer as the first upper contact electrode and the second upper contact electrode;
The third lower contact electrode is provided on the same layer as the first lower electrode and the step difference compensating part,
The third upper contact electrode is provided on the same layer as the first lower contact electrode.
제 1 항에 있어서,
상기 기판은 상기 제1 서브 화소, 상기 제2 서브 화소, 및 상기 제3 서브 화소가 배열된 제1 방향에 대해 수직한 제2 방향으로 이격되어 배치된 제4 서브 화소, 제5 서브 화소, 및 제6 서브 화소를 포함하고,
상기 제4 서브 화소는 상기 제1 서브 화소와 동일한 색의 광을 발광하도록 구비되고,
상기 제5 서브 화소는 상기 제2 서브 화소와 동일한 색의 광을 발광하도록 구비되며,
상기 제6 서브 화소는 상기 제3 서브 화소와 동일한 색의 광을 발광하도록 구비된 표시장치.
The method of claim 1,
The substrate may include a fourth sub-pixel, a fifth sub-pixel, and a fourth sub-pixel and a fifth sub-pixel spaced apart from each other in a second direction perpendicular to the first direction in which the first sub-pixel, the second sub-pixel, and the third sub-pixel are arranged; a sixth sub-pixel;
the fourth sub-pixel is provided to emit light of the same color as that of the first sub-pixel;
the fifth sub-pixel is provided to emit light of the same color as that of the second sub-pixel;
The sixth sub-pixel is provided to emit light having the same color as that of the third sub-pixel.
제 10 항에 있어서,
상기 단차보상부는 상기 제1 서브 화소와 상기 제4 서브 화소 사이, 상기 제2 서브 화소와 상기 제5 서브 화소 사이, 및 상기 제3 서브 화소와 상기 제6 서브 화소 사이에는 배치되지 않은 표시장치.
11. The method of claim 10,
The step difference compensator is not disposed between the first sub-pixel and the fourth sub-pixel, between the second sub-pixel and the fifth sub-pixel, and between the third sub-pixel and the sixth sub-pixel.
제 1 항에 있어서,
상기 제1 서브 화소는 상기 제1 하부전극과 상기 제1 상부전극을 연결시키기 위한 제1 콘택전극이 구비된 제1 콘택영역, 및 상기 제1 콘택영역과 접하는 제1 발광영역을 포함하고,
상기 제1 콘택영역은 상기 제1 내지 제3 서브 화소가 배열된 제1 방향으로 상기 제1 서브 화소의 중앙에 배치되면서 상기 제1 방향에 대해 수직한 제2 방향으로 상기 제1 서브 화소의 가장자리에 배치되며,
상기 제1 발광영역은 상기 제1 콘택영역의 양측과 하측에 배치되거나 상기 제1 콘택영역의 양측과 상측에 배치된 표시장치.
The method of claim 1,
The first sub-pixel includes a first contact region provided with a first contact electrode for connecting the first lower electrode and the first upper electrode, and a first light emitting region in contact with the first contact region;
The first contact area is disposed at the center of the first sub-pixel in a first direction in which the first to third sub-pixels are arranged, and an edge of the first sub-pixel in a second direction perpendicular to the first direction is placed in
The first light emitting region is disposed on both sides and a lower side of the first contact region, or is disposed on both sides and an upper side of the first contact region.
제 1 항에 있어서,
상기 제1 전극의 가장자리를 덮는 펜스; 및
상기 제1 내지 제3 서브 화소 각각의 콘택영역을 덮는 절연부를 포함하고,
상기 절연부는 상기 제1 내지 제3 서브 화소가 배열된 제1 방향으로 상기 펜스와 이격되며 상기 제1 방향에 대해 수직한 제2 방향으로 상기 펜스와 접촉된 표시장치.
The method of claim 1,
a fence covering an edge of the first electrode; and
an insulating part covering the contact area of each of the first to third sub-pixels;
The insulating part is spaced apart from the fence in a first direction in which the first to third sub-pixels are arranged, and is in contact with the fence in a second direction perpendicular to the first direction.
제 9 항에 있어서,
상기 단차보상부는,
상기 제1 서브 화소와 상기 제2 서브 화소 사이에 배치된 제1 단차보상부; 및
상기 제2 서브 화소와 상기 제3 서브 화소 사이에 배치된 제2 단차보상부를 포함하고,
상기 제1 단차보상부는 상기 제1 하부전극과 연결되고,
상기 제2 단차보상부는 상기 제2 하부 콘택전극 및 상기 제3 하부 콘택전극 각각으로부터 이격된 표시장치.
10. The method of claim 9,
The step difference compensation unit,
a first step difference compensator disposed between the first sub-pixel and the second sub-pixel; and
a second step compensator disposed between the second sub-pixel and the third sub-pixel;
The first step difference compensating part is connected to the first lower electrode,
The second step difference compensator is spaced apart from each of the second lower contact electrode and the third lower contact electrode.
제 9 항에 있어서,
상기 단차보상부는 상기 제1 하부전극, 상기 제2 하부 콘택전극, 및 상기 제3 하부 콘택전극 각각으로부터 이격된 표시장치.
10. The method of claim 9,
The step difference compensator is spaced apart from each of the first lower electrode, the second lower contact electrode, and the third lower contact electrode.
기판 상에 제1 발광 영역과 제1 콘택 영역을 구비한 제1 서브 화소;
상기 기판 상에 제2 발광 영역과 제2 콘택 영역을 구비한 제2 서브 화소;
상기 기판 상에 제3 발광 영역과 제3 콘택 영역을 구비한 제3 서브 화소;
상기 제1 발광 영역에 구비된 제1 하부전극과 제1 상부전극;
상기 제2 발광 영역에 구비된 제2 하부전극과 제2 상부전극;
상기 제3 발광 영역에 구비된 제3 하부전극과 제3 상부전극;
상기 제1 콘택 영역에 구비되고, 상기 제1 하부전극 및 상기 제1 상부전극과 연결되는 제1 콘택 전극;
상기 제2 콘택 영역에 구비되고, 상기 제2 상부전극에 연결되는 제2 콘택 전극;
상기 제3 콘택 영역에 구비되고, 상기 제3 하부전극에 연결되는 제3 콘택 전극;
상기 제1 내지 제3 서브 화소 사이의 경계 영역에 구비된 트렌치; 및
상기 트렌치의 하면에 접하며 상기 제1 내지 제3 하부전극 각각의 폭보다 좁고 상기 트렌치의 폭보다 넓은 단차보상부를 포함하고,
상기 제1 하부전극은 상기 단차보상부와 동일한 층에 구비되고,
상기 제2 하부전극과 상기 제2 상부전극 사이의 거리는 상기 제1 하부전극과 상기 제1 상부전극 사이의 거리보다 작고 상기 제3 하부전극과 상기 제3 상부전극 사이의 거리보다 큰 표시장치.
a first sub-pixel having a first light emitting area and a first contact area on a substrate;
a second sub-pixel having a second light emitting area and a second contact area on the substrate;
a third sub-pixel having a third light emitting area and a third contact area on the substrate;
a first lower electrode and a first upper electrode provided in the first light emitting region;
a second lower electrode and a second upper electrode provided in the second light emitting region;
a third lower electrode and a third upper electrode provided in the third light emitting region;
a first contact electrode provided in the first contact region and connected to the first lower electrode and the first upper electrode;
a second contact electrode provided in the second contact region and connected to the second upper electrode;
a third contact electrode provided in the third contact region and connected to the third lower electrode;
a trench provided in a boundary region between the first to third sub-pixels; and
and a step compensating part that is in contact with a lower surface of the trench and is narrower than each of the first to third lower electrodes and wider than the width of the trench;
The first lower electrode is provided on the same layer as the step difference compensating part,
A distance between the second lower electrode and the second upper electrode is smaller than a distance between the first lower electrode and the first upper electrode and greater than a distance between the third lower electrode and the third upper electrode.
제 16 항에 있어서,
상기 트렌치가 구비되는 절연층을 포함하고,
상기 제1 콘택전극은 제1 하부 콘택전극 및 제1 상부 콘택전극을 포함하고,
상기 제2 콘택전극은 제2 하부 콘택전극 및 제2 상부 콘택전극을 포함하고,
상기 제3 콘택전극은 제3 하부 콘택전극 및 제3 상부 콘택전극을 포함하고,
상기 절연층은,
상기 제1 하부 콘택전극을 상기 제1 하부전극에 연결시키기 위한 제1 콘택홀이 형성되는 제1 절연층; 및
상기 제1 상부 콘택전극을 상기 제1 하부 콘택전극에 연결시키기 위한 제2 콘택홀이 형성되는 제2 절연층을 포함하고,
상기 제1 콘택홀과 상기 제2 콘택홀은 서로 중첩되며,
상기 제1 콘택홀의 폭은 상기 제2 콘택홀의 폭보다 넓은 표시장치.
17. The method of claim 16,
Including an insulating layer provided with the trench,
The first contact electrode includes a first lower contact electrode and a first upper contact electrode,
The second contact electrode includes a second lower contact electrode and a second upper contact electrode,
The third contact electrode includes a third lower contact electrode and a third upper contact electrode,
The insulating layer is
a first insulating layer in which a first contact hole for connecting the first lower contact electrode to the first lower electrode is formed; and
a second insulating layer in which a second contact hole for connecting the first upper contact electrode to the first lower contact electrode is formed;
The first contact hole and the second contact hole overlap each other,
A width of the first contact hole is wider than a width of the second contact hole.
제 17 항에 있어서,
상기 단차보상부는,
상기 제1 서브 화소와 상기 제2 서브 화소 사이에 배치된 제1 단차보상부; 및
상기 제2 서브 화소와 상기 제3 서브 화소 사이에 배치된 제2 단차보상부를 포함하고,
상기 제1 단차보상부는 상기 제1 하부전극과 연결되며,
상기 제2 단차보상부는 상기 제2 하부 콘택전극 및 상기 제3 하부 콘택전극 각각으로부터 이격된 표시장치.
18. The method of claim 17,
The step difference compensation unit,
a first step difference compensator disposed between the first sub-pixel and the second sub-pixel; and
a second step compensator disposed between the second sub-pixel and the third sub-pixel;
The first step difference compensating part is connected to the first lower electrode,
The second step difference compensator is spaced apart from each of the second lower contact electrode and the third lower contact electrode.
제 17 항에 있어서,
상기 단차보상부는 상기 제1 하부전극, 상기 제2 하부 콘택전극, 및 상기 제3 하부 콘택전극 각각으로부터 이격된 표시장치.
18. The method of claim 17,
The step difference compensator is spaced apart from each of the first lower electrode, the second lower contact electrode, and the third lower contact electrode.
제 1 항 내지 제 19 항 중 어느 한 항에 있어서,
상기 기판과 이격되는 렌즈 어레이, 및 상기 기판과 상기 렌즈 어레이를 수납하는 수납 케이스를 추가로 포함하는 표시장치.
20. The method according to any one of claims 1 to 19,
A display device further comprising: a lens array spaced apart from the substrate; and a storage case accommodating the substrate and the lens array.
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