KR20120112176A - 필라멘트 검출 회로 - Google Patents

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KR20120112176A
KR20120112176A KR1020120032334A KR20120032334A KR20120112176A KR 20120112176 A KR20120112176 A KR 20120112176A KR 1020120032334 A KR1020120032334 A KR 1020120032334A KR 20120032334 A KR20120032334 A KR 20120032334A KR 20120112176 A KR20120112176 A KR 20120112176A
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준잉 왕
얀순 수
이롱 예
쿠오지 종
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오스람 아게
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Abstract

형광 램프의 필라멘트를 검출하기 위한 회로가 제공되는데, 여기서, 형광 램프의 제 1 필라멘트의 제 1 엔드는 발진 회로를 통해 제 1 필라멘트의 제 2 엔드에 접속되고, 제 1 필라멘트의 제 1 엔드는 인버터의 출력에 접속되고, 형광 램프의 제 2 필라멘트의 제 1 엔드는 발진 회로를 통해 제 2 필라멘트의 제 2 엔드에 접속되고, 회로는 제 2 필라멘트의 제 1 엔드가 내부 접지에 접속되고, 제 2 필라멘트의 제 2 엔드가 전원에 접속되고, 제 2 필라멘트의 제 2 엔드의 전압은 MOSFET의 온(ON) 및 오프(OFF)를 제어하는데 이용되고, MOSFET의 소스는 내부 접지에 접속되고, MOSFET의 드레인은 제 2 레지스터 및 제 3 레지스터를 통해 전원에 접속되고, 제 2 레지스터와 상기 제 3 레지스터 사이의 노드는 집적 회로의 VCC 핀에 접속된다.

Description

필라멘트 검출 회로{FILAMENT DETECTION CIRCUIT}
본 발명은 형광 램프의 필라멘트를 검출하기 위한 회로에 관한 것이다.
전자 밸러스트(electronic ballast)에서, 형광 램프의 콜드 엔드(cold end)는 일반적으로 내부 접지에 접속되지 않는다. 그렇지 않으면, 형광 램프의 콜드 엔드를 검출하는 것이 불가능할 수 있다.
본 발명은 종래 기술의 상술한 결함 및 문제를 해결하기 위해 제안된다.
본 발명은 형광 램프의 콜드 엔드를 접지시키고 간단한 필라멘트 검출 회로를 이용하여 형광 램프의 콜드 엔드를 검출함으로써 적어도 이 결함을 해결할 수 있으며, 그에 의해 램프 수명 종료의 방지를 간단하게 실현할 수 있다.
본 발명의 일 양상에 따라, 형광 램프의 필라멘트를 검출하기 위한 회로가 제공되며, 여기서, 형광 램프의 제 1 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 제 1 필라멘트의 제 2 엔드에 접속되고, 제 1 필라멘트의 제 1 엔드는 인버터의 출력에 접속되고, 형광 램프의 제 2 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 제 2 필라멘트의 제 2 엔드에 접속되고, 회로는, 제 2 필라멘트의 제 1 엔드가 내부 접지에 접속되고, 제 2 필라멘트의 제 2 엔드가 제 1 레지스터를 통해 전원에 접속되고, 제 2 필라멘트의 제 2 엔드의 전압은 MOSFET의 온 및 오프를 제어하는데 이용되고, MOSFET의 소스는 내부 접지에 접속되고, MOSFET의 드레인은 제 2 레지스터 및 제 3 레지스터를 통해 전원에 접속되고, 제 2 레지스터와 제 3 레지스터 사이의 노드는 집적 회로의 VCC 핀에 접속되는 것을 특징으로 한다.
일 양상에 따라, 제 2 필라멘트의 제 2 엔드는 제 4 레지스터와 제 5 레지스터를 통해 내부 접지에 접속되고, 제 4 레지스터와 제 5 레지스터 사이의 노드는 MOSFET의 게이트에 접속될 수 있다.
일 양상에 따라, 회로는 제 5 레지스터와 병렬로 접속되는 커패시터를 더 포함할 수 있다.
일 양상에 따라, 회로는 제 5 레지스터와 병렬로 접속되는 클램핑(clamping) 다이오드를 더 포함할 수 있다.
본 발명의 일 양상에 따라, 형광 램프의 필라멘트를 검출하기 위한 회로가 제공되며, 여기서 형광 램프는 제 1 램프 및 제 2 램프를 포함하고, 제 1 램프의 제 1 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 제 1 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 제 1 램프의 제 1 필라멘트의 제 1 엔드는 인버터의 출력에 접속되고, 제 2 램프의 제 2 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 제 2 램프의 제 2 필라멘트의 제 2 엔드에 접속되고, 제 1 램프의 제 2 필라멘트의 제 1 엔드는 제 2 램프의 제 1 필라멘트의 제 1 엔드에 접속되고, 제 1 램프의 제 2 필라멘트의 제 2 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 회로는, 제 2 램프의 제 2 필라멘트의 제 1 엔드는 내부 접지에 접속되고, 제 1 램프의 제 2 필라멘트의 제 2 엔드는 전원에 접속되고, 제 2 램프의 제 2 필라멘트의 제 2 엔드는 제 1 레지스터를 통해 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 제 2 램프의 제 2 필라멘트의 제 2 엔드의 전압은 MOSFET의 온 및 오프를 제어하는데 이용되고, MOSFET의 소스는 내부 접지에 접속되고, MOSFET의 드레인은 제 2 레지스터 및 제 3 레지스터를 통해 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 제 2 레지스터와 제 3 레지스터 사이의 노드는 집적 회로의 VCC 핀에 접속되는 것을 특징으로 한다.
일 양상에 따라, 제 2 램프의 제 2 필라멘트의 제 2 엔드는 제 4 레지스터 및 제 5 레지스터를 통해 내부 접지에 접속되고, 제 4 레지스터와 제 5 레지스터 사이의 노드는 MOSFET의 게이트에 접속된다.
일 양상에 따라, 회로는 제 5 레지스터와 병렬로 접속되는 커패시터를 더 포함할 수 있다.
일 양상에 따라, 회로는 제 5 레지스터와 병렬로 접속되는 클램핑 다이오드를 더 포함할 수 있다.
일 양상에 따라, 형광 램프는 하나 이상의 램프들을 더 포함할 수 있고, 여기서 제 1 램프의 제 2 필라멘트, 하나 이상의 램프들의 필라멘트들, 제 2 램프의 제 1 필라멘트는 커패시터 및 인덕터로 구성된 발진 회로를 통해 서로 접속되고, 하나 이상의 램프들 중 제 2 램프에 가장 근접한 하나의 램프의 제 2 필라멘트의 제 2 엔드는 전원에 접속되는 제 1 램프의 제 2 필라멘트의 제 2 엔드 대신에 전원에 접속된다.
위의 및 다른 양상들, 특징들 및 이점들은 도면들과 함께 본 발명의 몇몇의 예시적인 실시예들의 이어지는 설명으로부터 더 명백해질 것이다.
도 1은 본 발명의 일 실시예에 따라 형광 램프의 필라멘트를 검출하기 위한 회로도.
도 2는 본 발명의 다른 실시예에 따라 2개의 형광 램프들의 필라멘트들을 검출하기 위한 회로도.
이하 도면들을 참조하는 상세한 설명들에 의해, 본 발명은 더 쉽게 이해될 것이다. 명세서 전체에 걸쳐서 동일한 참조 번호는 동일한 구조를 갖는 엘리먼트들을 표시한다. 첨부 도면들을 참조함으로써 이루어지는 이하의 설명들은 본 발명의 예시적인 실시예들의 포괄적인 이해를 위해 제공된다. 이 설명들은 본 발명의 이해를 용이하게 하기 위한 상세들을 모두 포함하며, 단지 예시라고 간주되어야 한다. 이에 따라, 당업자들은 여기서 기술되는 실시예들에 대한 다양한 변경들 및 수정들이 본 발명의 범위 또는 사상으로부터 벗어남 없이 실시될 수 있다는 것이 이해될 것이다. 유사하게, 명확성 및 간결성을 위해 공통적인 기능 및 구조의 설명들은 생략된다.
여기서 이용되는 용어들은 본 발명을 제한하도록 의도되는 것이 아니라 실시예들을 설명하기 위해서만 이용된다. 명확하게 정의되지 않는 한, 여기서 이용되는 모든 용어들(기술적 및 과학적 용어들을 포함)은 본 발명에서 당업자들에 의해 일반적으로 이해되는 것과 동일한 의미를 갖는다.
본 발명의 상세한 설명들은 첨부 도면들을 참조함으로써 아래에서 제공될 것이다.
도 1은 본 발명의 일 실시예에 따라 형광 램프의 필라멘트를 검출하기 위한 회로도이다.
도 1에 도시된 바와 같이, 집적 회로(IC)(U1)의 제어 하에서, 레지스터들(R1, R3-R6), 커패시터들(C1-C7), 다이오드들(D1-D4), 트랜지스터 스위치들(Q1-Q2), 인덕터들(L1, L2-A) 등으로 구성된 인버터는 DC 전압(Vbus)을 형광 램프에 공급될 고주파 교류로 인버트한다. 여기서 이용된 인버터의 구조는 종래의 전자 발 밸러스트에서 이용되는 풀-브리지(full-bridge) 또는 하프-브릿지 회로의 것과 동일하기 때문에, 인버터의 상세한 설명은 여기서 생략된다. 또한, 당업자는 본 발명의 원리에 따라 적합한 구조를 갖는 풀-브릿지 또는 하프-브릿지 회로를 이용할 수 있다.
램프는 제 1 필라멘트(F1) 및 제 2 필라멘트(F2)를 갖는다. 제 1 필라멘트(F1)의 제 1 엔드는 커패시터(C8), 인덕터(L3) 및 인덕터(L2-B)(이들은 발진 회로를 구성함)를 통해 제 1 필라멘트(F1)의 제 2 엔드에 접속되고, 제 1 필라멘트(F1)의 제 1 엔드는 인버터의 출력에 접속된다. 제 2 필라멘트(F2)의 제 1 엔드는 커패시터(C11), 인덕터(L5) 및 인덕터(L2-D)을 통해 제 2 필라멘트(F2)의 제 2 엔드에 접속되고 제 2 필라멘트(F2)의 제 1 엔드는 내부 접지(GND)에 접속된다.
또한, 제 2 필라멘트(F2)의 제 2 엔드는 레지스터(R9)를 통해 전원(Vbus)에 접속되고, 제 2 필라멘트(F2)의 전압은 MOSFET(금속 산화물 반도체 필드 효과 트랜지스터)(Q3)의 게이트의 온(ON) 및 오프(OFF)를 제어하는데 이용된다. MOSFET(Q3)의 소스는 내부 접지(GND)에 접속되고, MOSFET(Q3)의 드레인은 레지스터들(R12 및 R7)을 통해 전원(Vbus)에 접속된다. 또한, 레지스터들(R12 및 R7) 사이의 노드(N2)는 IC(U1)의 VCC 핀에 접속된다. 또한, 레지스터(R8)는 레지스터(R7)와 전원(Vbus) 사이에서 접속될 수 있다.
일 실시예에서, 제 2 필라멘트(F2)의 제 2 엔드는 레지스터들(R10 및 R11)을 통해 내부 접지(GND)에 접속될 수 있다. 레지스터들(R10 및 R11) 사이의 노드(N1)는 MOSFET(Q3)의 게이트에 접속된다. 바람직하게는, 커패시터(C12)는 레지스터(R11)와 병렬로 접속된다. 보다 바람직하게는, 클램핑(clamping) 다이오드(D5)는 레지스터(R11)와 병렬로 접속된다.
본 발명의 일 실시예에 따른 필라멘트 검출 회로를 이용함으로써, 제 2 필라멘트(F2)가 삽입되는 경우 제 2 필라멘트(F2)의 저항이 매우 작기 때문에, 레지스터들(R9 및 R10) 사이의 노드의 전압은 로우(low)로 유지되어, 결과적으로 MOSFET(Q3)의 게이트 전압은 MOSFET(Q3)의 온(ON) 임계치보다 낮게 된다. 이 경우, MOSFET(Q3)는 오프(OFF) 상태로 유지되고, 이에 따라 핀(VCC)은 성공적으로 충전되고, 그에 의해 IC(U1)를 활성화시킨다. 다른 한편, 제 2 필라멘트(F2)가 삽입되지 않는 경우, 커패시터(C11)가 충전되고, 그에 따라 레지스터들(R9 및 R10) 사이의 노드의 전압은 하이(high)이고, MOSFET(Q3)의 게이트 전압은 레지스터들(R10 및 R11)의 전압 분할로 인해 MOSFET(Q3)의 온 임계치보다 높게 되도록 증가된다. 이 경우, MOSFET(Q3)는 온 상태에 있고, 핀(VCC)은 방전되어, 핀(VCC)은 성공적으로 충전되지 않는다. 따라서 램프 수명 종료의 방지를 실현하는데 용이하다.
즉, 핀(VCC)이 성공적으로 충전될 때, 필라멘트(F2)가 삽입되었다는 것이 검출될 수 있고, 핀(VCC)이 성공적으로 충전되지 않을 때, 필라멘트(F2)가 삽입되지 않았다는 것이 검출될 수 있다.
2개의 형광 램프들의 필라멘트들을 검출하기 위한 회로가 도 2를 참조하여 후술될 것이다.
도 2는 본 발명의 다른 실시예에 따라 2개의 형광 램프들의 필라멘트들을 검출하기 위한 회로도를 도시한다.
도 1에서와 동일하게, IC(U1)의 제어 하에, 레지스터들(R1, R3-R6), 커패시터들(C1-C7), 다이오드들(D1-D4), 트랜지스터 스위치들(Q1-Q2), 인덕터들(L1, L2-A)로 구성된 인버터는 DC 전압(Vbus)을 형광 램프에 공급되는 고주파수 교류로 인버트한다.
그러나, 도 2는 2개의 램프들 즉, 제 1 램프(Lamp1) 및 제 2 램프(Lamp2)를 도시한다.
제 1 램프(Lamp1)는 제 1 필라멘트(F1) 및 제 2 필라멘트(F2)를 갖는다. 제 1 필라멘트(F1)의 제 1 엔드는 커패시터(C8), 인덕터들(L3 및 L2-B)을 통해 제 1 필라멘트(F1)의 제 2 엔드에 접속되고, 제 1 필라멘트(F1)의 제 1 엔드는 인버터의 출력에 접속된다.
제 2 램프(Lamp2)는 제 1 필라멘트(F3) 및 제 2 필라멘트(F4)를 갖는다. 제 2 필라멘트(F4)의 제 1 엔드는 커패시터(C11), 인덕터들(L5 및 L2-D)을 통해 제 2 필라멘트(F4)의 제 2 엔드에 접속된다.
또한, 제 1 램프(Lamp1)의 제 2 필라멘트(F2)의 제 1 엔드는 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 1 엔드에 접속되고, 제 1 램프(Lamp1)의 제 2 필라멘트(F2)의 제 2 엔드는 인덕터들(L2-C 및 L4) 및 커패시터(C9)를 통해 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 2 엔드에 접속되고, 제 1 램프의 제 2 필라멘트(F2)의 제 2 엔드는 내부 접지(GND)에 접속된다.
또한, 제 2 램프(Lamp2)의 제 2 필라멘트(F4)의 제 2 엔드는 레지스터(R9)를 통해 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 2 엔드에 접속되고, 제 2 램프(Lamp2)의 제 2 필라멘트(F4)의 제 2 엔드의 전압은 MOSFET(금속 산화물 반도체 필드 효과 트랜지스터)(Q3)의 게이트의 온 및 오프를 제어하는데 이용된다. MOSFET(Q3)의 소스는 내부 접지(GND)에 접속되고, MOSFET(Q3)의 드레인은 레지스터들(R12 및 R7)을 통해 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 2 엔드에 접속된다. 또한, 레지스터들(R12 및 R7) 사이의 노드(N2)는 IC(U1)의 VCC 핀에 접속된다. 또한, 레지스터(R8)는 전원(Vbus)과 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 2 엔드 사이에 접속될 수 있다.
일 실시예에서, 제 2 램프(Lamp2)의 제 2 필라멘트(F4)의 제 2 엔드는 레지스터들(R10 및 R11)을 통해 내부 접지(GND)에 접속될 수 있다. 레지스터들(R10 및 R11) 사이의 노드(N1)는 MOSFET(Q3)의 게이트에 접속된다. 바람직하게는, 커패시터(C12)는 레지스터(R11)와 병렬로 접속된다. 더 바람직하게는, 클램핑 다이오드(D5)가 레지스터(R11)와 병렬로 접속된다.
본 발명의 일 실시예에 따른 필라멘트 검출 회로를 이용함으로써, 필라멘트들(F2 및 F3)이 삽입될 때만, 제 2 램프(Lamp2)의 제 1 필라멘트(F3)의 제 2 엔드가 (예를 들어, 레지스터(R8)를 통해) 전원(Vbus)에 접속된다. 또한, 도 1에서 도시된 회로와 유사하게, 제 2 램프(Lamp2)의 제 2 필라멘트(F4)가 삽입되는 경우, 제 2 필라멘트(F4)의 저항이 매우 작기 때문에, 레지스터들(R9 및 R10) 사이의 노드의 전압은 로우로 유지되어, 결과적으로 MOSFET(Q3)의 게이트 전압은 MOSFET(Q3)의 온 임계치보다 낮게 된다. 이 경우, MOSFET(Q3)는 오프 상태로 유지되고, 이에 따라 핀(VCC)은 성공적으로 충전되고, 그에 의해 IC(U1)를 활성화시킨다. 다른 한편, 제 2 램프(Lamp2)의 제 2 필라멘트(F4)가 삽입되지 않는 경우, 커패시터(C11)가 충전되고, 이에 따라 레지스터들(R9 및 R10) 사이의 노드의 전압은 하이이고, MOSFET(Q3)의 게이트 전압은 레지스터들(R10 및 R11)의 전압 분할로 인해 MOSFET(Q3)의 온 임계치보다 높게 되도록 증가된다. 이 경우, MOSFET(Q3)는 온 상태에 있고, 핀(VCC)은 방전되어, 핀(VCC)은 성공적으로 충전되지 않는다. 따라서, 램프 수명 종료의 방지를 실현하는데 용이하다.
즉, 핀(VCC)이 성공적으로 충전될 때, 모든 필라멘트들(F2, F3, F4)이 삽입되었다는 것이 검출될 수 있고, 핀(VCC)이 성공적으로 충전되지 않을 때, 필라멘트들(F2, F3, F4) 중 적어도 하나가 삽입되지 않았다는 것이 검출될 수 있다.
확실히, 본 발명에 따른 필라멘트 검출 회로는 하나 또는 2개의 램프들의 필라멘트(들)를 검출하는 것으로 제한되지 않고, 3개 이상의 램프들의 필라멘트들을 또한 검출할 수 있다. 예를 들어, 3개의 램프들이 존재하는 경우, 제 3 램프(Lamp3)(도시되지 않음)는 제 1 램프(Lamp1)와 제 2 램프(Lamp2) 사이에 접속될 수 있으며, 여기서 제 1 램프(Lamp1)의 제 2 필라멘트(F2)의 제 1 엔드는 제 3 램프(Lamp3)의 제 1 필라멘트의 제 1 엔드에 접속되고, 제 1 램프(Lamp1)의 제 2 필라멘트(F2)의 제 2 엔드는 커패시터 및 인덕터를 통해 제 3 램프(Lamp3)의 제 1 필라멘트의 제 2 엔드에 접속되고, 제 3 램프(Lamp3)의 제 2 필라멘트의 구조는 도 2에 도시된 제 1 램프(Lamp1)의 제 2 필라멘트(F2)의 구조와 동일하다.
요약하면, 본 발명에 따른 필라멘트 검출 회로는 램프 수명 종료의 방지를 간단히 실현할 수 있고, 형광 램프의 콜드 엔드를 유효하게 검출할 수 있다.
이 설명이 다수의 특정한 실시예들의 상세들을 포함하지만, 이 상세들은 청구될 수 있는 임의의 발명 또는 내용들의 범위를 제한하는 것으로서 해석되어선 안되며, 특정한 발명에서 특정될 수 있는 특정한 실시예들의 특징들을 기술하는 것으로서 해석되어야 한다.
위의 특정 실시예들은 본 발명의 보호의 범위를 제한하지 않는다. 당업자ㄷ들은, 다양한 변경들, 조합들, 서브조합들, 대체들이 설계를 위한 요건들 및 다른 인자들에 의존하여 실시될 수 있다는 것을 이해할 수 있다. 본 발명의 사상 및 원리 내에서 실시되는 임의의 변경들, 등가물 대체들, 개선들 등은 본 발명의 보호의 범위 내에 포함되어야 한다.

Claims (9)

  1. 형광 램프의 필라멘트를 검출하기 위한 회로로서,
    상기 형광 램프의 제 1 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 상기 제 1 필라멘트의 제 2 엔드에 접속되고, 상기 제 1 필라멘트의 제 1 엔드는 인버터의 출력에 접속되고,
    상기 형광 램프의 제 2 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 상기 제 2 필라멘트의 제 2 엔드에 접속되고,
    상기 회로는,
    상기 제 2 필라멘트의 제 1 엔드가 내부 접지에 접속되고,
    상기 제 2 필라멘트의 제 2 엔드가 제 1 레지스터를 통해 전원에 접속되고, 상기 제 2 필라멘트의 제 2 엔드의 전압은 MOSFET의 온(ON) 및 오프(OFF)를 제어하는데 이용되고, 상기 MOSFET의 소스는 상기 내부 접지에 접속되고, 상기 MOSFET의 드레인은 제 2 레지스터 및 제 3 레지스터를 통해 상기 전원에 접속되고, 및
    상기 제 2 레지스터와 상기 제 3 레지스터 사이의 노드는 집적 회로의 VCC 핀에 접속되는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  2. 제 1 항에 있어서,
    상기 제 2 필라멘트의 제 2 엔드는 제 4 레지스터와 제 5 레지스터를 통해 내부 접지에 접속되고, 상기 제 4 레지스터와 상기 제 5 레지스터 사이의 노드는 상기 MOSFET의 게이트에 접속되는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  3. 제 2 항에 있어서,
    상기 제 5 레지스터와 병렬로 접속되는 커패시터를 더 포함하는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  4. 제 2 항 또는 제 3 항에 있어서,
    상기 제 5 레지스터와 병렬로 접속되는 클램핑(clamping) 다이오드를 더 포함하는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  5. 형광 램프의 필라멘트를 검출하기 위한 회로로서,
    상기 형광 램프는 제 1 램프 및 제 2 램프를 포함하고,
    상기 제 1 램프의 제 1 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 상기 제 1 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 상기 제 1 램프의 제 1 필라멘트의 제 1 엔드는 인버터의 출력에 접속되고,
    상기 제 2 램프의 제 2 필라멘트의 제 1 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 상기 제 2 램프의 제 2 필라멘트의 제 2 엔드에 접속되고,
    상기 제 1 램프의 제 2 필라멘트의 제 1 엔드는 상기 제 2 램프의 제 1 필라멘트의 제 1 엔드에 접속되고, 상기 제 1 램프의 제 2 필라멘트의 제 2 엔드는 커패시터 및 인덕터로 구성된 발진 회로를 통해 상기 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고,
    상기 회로는,
    상기 제 2 램프의 제 2 필라멘트의 제 1 엔드는 내부 접지에 접속되고,
    상기 제 1 램프의 제 2 필라멘트의 제 2 엔드는 전원에 접속되고,
    상기 제 2 램프의 제 2 필라멘트의 제 2 엔드는 제 1 레지스터를 통해 상기 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고, 상기 제 2 램프의 제 2 필라멘트의 제 2 엔드의 전압은 MOSFET의 온 및 오프를 제어하는데 이용되고, 상기 MOSFET의 소스는 상기 내부 접지에 접속되고, 상기 MOSFET의 드레인은 제 2 레지스터 및 제 3 레지스터를 통해 상기 제 2 램프의 제 1 필라멘트의 제 2 엔드에 접속되고,
    상기 제 2 레지스터와 상기 제 3 레지스터 사이의 노드는 집적 회로의 VCC 핀에 접속되는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  6. 제 5 항에 있어서,
    상기 제 2 램프의 제 2 필라멘트의 제 2 엔드는 제 4 레지스터 및 제 5 레지스터를 통해 상기 내부 접지에 접속되고, 상기 제 4 레지스터와 상기 제 5 레지스터 사이의 노드는 상기 MOSFET의 게이트에 접속되는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  7. 제 6 항에 있어서,
    상기 제 5 레지스터와 병렬로 접속되는 커패시터를 더 포함하는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  8. 제 6 항 또는 제 7 항에 있어서,
    상기 제 5 레지스터와 병렬로 접속되는 클램핑 다이오드를 더 포함하는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
  9. 제 5 항에 있어서,
    상기 형광 램프는 하나 이상의 램프들을 더 포함하고,
    상기 제 1 램프의 제 2 필라멘트, 상기 하나 이상의 램프들의 필라멘트들, 상기 제 2 램프의 제 1 필라멘트는 커패시터 및 인덕터로 구성된 발진 회로를 통해 서로 접속되고,
    상기 하나 이상의 램프들 중 상기 제 2 램프에 가장 근접한 하나의 램프의 제 2 필라멘트의 제 2 엔드는 상기 전원에 접속되는 상기 제 1 램프의 제 2 필라멘트의 제 2 엔드 대신에 상기 전원에 접속되는,
    형광 램프의 필라멘트를 검출하기 위한 회로.
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