KR20100001707A - Ceramic package - Google Patents
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Abstract
Description
본 발명은 반도체칩을 수납하기 위한 세라믹 패키지에 관한 것으로서, 특히 세라믹 패키지에 부착되는 외부접속단자가 상기 패키지 본체의 정확한 위치에 부착될 수 있는 세라믹 패키지에 관한 것이다.The present invention relates to a ceramic package for accommodating a semiconductor chip, and more particularly, to a ceramic package in which an external connection terminal attached to a ceramic package can be attached to a correct position of the package body.
반도체 패키지는 반도체칩 등을 수납하기 위한 부품이다. 이러한 반도체 패키지는 반도체 소자에 필요한 전력을 공급하고, 반도체 소자에서 발생 되는 열을 방출시키며, 외부로부터 반도체 소자를 보호하는 기능을 가진다. The semiconductor package is a component for accommodating a semiconductor chip or the like. Such a semiconductor package has a function of supplying power required for a semiconductor device, dissipating heat generated from the semiconductor device, and protecting the semiconductor device from the outside.
이러한 반도체 패키지는 제조 목적 및 방법에 따라 다양하게 구분되는데, 특히 신호 전송 라인 임피던스 변동을 최소화하면서 신호 전송 라인의 저항 손실을 최소화하고, 인접 신호 전송 라인들 사이의 용량성 연결을 감소시키며 전력 및 접지 연결부들의 유도성 연결을 감소시키기 위하여 세라믹 재료를 사용하는 세라믹 패키지가 많이 사용된다.These semiconductor packages are classified according to manufacturing purpose and method, in particular, minimizing signal transmission line impedance variation, minimizing resistance loss of signal transmission lines, reducing capacitive connections between adjacent signal transmission lines, and reducing power and ground. Many ceramic packages using ceramic materials are used to reduce the inductive connection of the connections.
상기 세라믹 패키지의 일례가 도 1 내지 도 3에 도시되어 있다. 도 1 내지 도 3을 참조하면, 상기 세라믹 패키지(101)는 반도체칩(2)을 수용하는 캐비티(11)를 가지며 세라믹으로 이루어진 패키지 본체(10)와, 와이어(5)에 의해 상기 반도체 칩(2)의 각 전기단자(2a)와 전기적으로 연결되는 복수의 단자부(30)와, 상기 패키지 본체(10)의 측벽에 부착되며 상기 반도체칩(2)의 각 전기단자(2a)와 전기적으로 연결되는 복수의 외부접속단자(20)를 포함하여 구성된다.One example of the ceramic package is shown in FIGS. 1 to 3, the
상기 반도체칩(2)은 접착제(6)를 이용하여 상기 패키지 본체(10)의 캐비티(11) 바닥에 접착된다. 상기 반도체칩(2)의 고정 후에, 상기 반도체칩(2)의 각 전기단자(2a)와 패키지 본체(10)의 단자부(30)는 와이어(5)에 의해 전기적으로 연결된다. 상기 와이어 본딩 작업이 끝난 후에, 덮개(3)로 상기 캐비티(11)를 밀폐하는 봉합 작업을 함으로써, 상기 반도체칩(2)은 외부환경으로부터 보호된다.The
상기 외부접속단자(20)는 상기 세라믹 패키지(101)를 회로기판(미도시) 등과 같은 외부장치에 연결하기 위한 것으로서, 상기 패키지 본체(10)의 평탄한 측벽에 프린팅되는 도체인쇄부(12)에 솔더링에 의해 부착된다. 상기 도체인쇄부(12)은 상기 단자부(30)와 전기적으로 연결되어 있다. 그러므로 상기 외부접속단자(20)가 상기 외부장치에 접속되면 상기 패키지 본체(10)의 단자부(30)가 상기 외부장치에 전기적으로 연결되는 상태가 된다.The
그런데 상기 종래의 세라믹 패키지(101)에서는, 상기 도체인쇄부(12)이 상기 패키지 본체(10)의 평탄한 측벽에 프린팅되므로, 상기 외부접속단자(20)를 상기 도체인쇄부(12)에 부착하는 과정에서 상기 외부접속단자(20)의 부착 위치 조절이 어려워서, 상기 외부접속단자(20)가 상기 도체인쇄부(12)을 이탈하여 부착되는 경우가 종종 발생하는 문제점이 있다. However, in the conventional
이렇게 상기 외부접속단자(20)가 상기 도체인쇄부(12)에 정확하게 부착되지 못하고 이탈하여 부착되는 경우에는, 불량률 증가에 따른 세라믹 패키지의 제조비 상승과 제조 소요 시간의 지연이 발생되는 문제점이 있다.When the
따라서, 본 발명은 상기 문제를 해결하기 위해 안출된 것으로서, 그 목적은 상기 패키지 본체에 부착되는 외부접속단자의 일단부가 상기 패키지 본체의 정확한 위치에 부착될 수 있도록 구조가 개선된 세라믹 패키지를 제공하기 위함이다.Accordingly, the present invention has been made to solve the above problems, and an object thereof is to provide a ceramic package having an improved structure so that one end of an external connection terminal attached to the package body can be attached to the correct position of the package body. For sake.
상기 목적을 달성하기 위하여 본 발명에 따른 세라믹 패키지는, 복수의 전기단자를 가지는 반도체칩을 수용하며 세라믹으로 이루어진 패키지 본체와, 상기 패키지 본체의 측벽에 부착되며 상기 반도체칩의 각 전기단자와 전기적으로 연결되는 복수의 외부접속단자를 포함하여 구성되며, 상기 패키지 본체의 측벽에 복수의 홈부가 형성되고, 상기 각 외부접속단자의 일단부가 상기 패키지 본체의 측벽에 형성된 홈부에 수용된 상태로 상기 패키지 본체에 부착되는 것을 특징으로 한다.In order to achieve the above object, a ceramic package according to the present invention includes a package body made of ceramic and having a semiconductor chip having a plurality of electrical terminals and attached to a sidewall of the package body and electrically connected to each electrical terminal of the semiconductor chip. And a plurality of grooves formed on sidewalls of the package body, and one end of each external connection terminal is accommodated in a groove portion formed on the sidewall of the package body. It is characterized by being attached.
이상에서 설명한 바와 같이 본 발명에 따르면, 상기 외부접속단자의 일단부가 상기 패키지 본체의 측벽에 형성된 홈부에 수용된 상태로 상기 패키지 본체에 부착됨으로써, 상기 외부접속단자가 상기 패키지 본체의 정확한 위치에 부착되는 효과가 있다.As described above, according to the present invention, one end of the external connection terminal is attached to the package body in a state accommodated in a groove formed in the side wall of the package body, whereby the external connection terminal is attached to the correct position of the package body. It works.
이하에서, 첨부된 도면들을 참조하여 본 발명의 바람직한 실시예를 상세하게 설명하기로 한다.Hereinafter, with reference to the accompanying drawings will be described in detail a preferred embodiment of the present invention.
도 4는 본 발명의 일 실시예에 따른 세라믹 패키지의 사시도이며, 도 5는 도 4에 도시된 세라믹 패키지의 V-V선 단면도이다. 도 6은 도 5에 도시된 세라믹 패키지의 VI-VI선 단면도이다.Figure 4 is a perspective view of a ceramic package according to an embodiment of the present invention, Figure 5 is a cross-sectional view taken along the line V-V of the ceramic package shown in FIG. 6 is a cross-sectional view taken along the line VI-VI of the ceramic package shown in FIG.
도 4 내지 도 6을 참조하면, 본 발명의 바람직한 실시예에 따른 세라믹 패키지(1)는, 도 1 내지 도 3에 도시된 종래의 세라믹 패키지(101)와 마찬가지로, 반도체칩(2) 등을 수납하기 위한 것이다. 이 세라믹 패키지(1)는 패키지 본체(10), 외부접속단자(20)를 포함하여 구성된다. 4 to 6, the
상기 패키지 본체(10)는 세라믹으로 제조된다. 상기 패키지 본체(10)는 수용공간인 캐비티(11)를 가지는데, 이 캐비티(11)에 복수의 전기단자(2a)를 가지는 반도체칩(2)이 수용된다. The
상기 패키지 본체(10)의 캐비티(11) 내부에는 복수개의 단자부(30)가 마련되어 있다. 상기 반도체칩(2)의 각 전기단자(2a)와 상기 각 단자부(30)는 와이어(5)에 의해 전기적으로 연결된다.A plurality of
상기 패키지 본체(10)의 측벽에는 복수의 홈부(40)가 형성되어 있다. 상기 각 홈부(40)는 상기 패키지 본체(10)의 바닥부에서 상기 패키지 본체(10)의 상부를 향하여 연장된 형태로 형성되어 있다. 상기 홈부(40)에는 금속으로 이루어진 도체막(41)이 형성되어 있으며, 상기 도체막(41)은 상기 단자부(30)와 각각 전기적으로 연결되어 있다.A plurality of
상기 외부접속단자(20)는 상기 세라믹 패키지(1)가 회로기판(미도시) 등과 같은 외부장치에 전기적으로 연결된 상태로 장착될 수 있도록 하는 것이다. 상기 각 외부접속단자(20)의 일단부(도 4 및 도 5에서는 상단부)는 상기 패키지 본체(10)의 측벽에 형성된 홈부(40)에 수용된 상태로 솔더링에 의하여 상기 도체막(41)에 부착된다. 상기 각 외부접속단자(20)의 타단부(도 4 및 도 5에서는 하단부)는 상기 패키지 본체(10)의 바닥면보다 아래쪽으로 연장된다.The
이하 상기 홈부(40)와 상기 도체막(41)을 형성하는 일례에 대하여 상세히 설명하기로 한다.Hereinafter, an example of forming the
도 7을 참조하여 설명하면, 먼저 통상의 그린 시트 적층법 등으로, 상기 패키지 본체(10)가 될 세라믹 단위체(10a)가 가로 세로 방향으로 다수 배열되는 어레이 기판(200)에 상기 홈부(40)를 이루게 될 구멍(40a)을 형성한다. 이러한 구멍의 형성 후에, 상기 구멍(40a)들 모두에 대하여 동시에 도체막(41)을 형성하고, 상기 어레이 기판(200)으로부터 상기 세라믹 단위체(10a) 각각을 분리라인(7)을 따라서 절삭하여 분리하면 상기 구멍(40a)이 양분되면서 상기 홈부(40)가 측벽에 형성된 상기 패키지 본체(10)가 완성된다.Referring to FIG. 7, first, the
상기 구멍에 상기 도체막(41)을 형성하는 방법으로는, 도체 페이스트를 인쇄하는 방법을 사용하거나, 상기 구멍(40a)이 관통하는 부분만의 세라믹 그린 시트를 적층하고 상기 구멍(40a)을 절삭한 후에 도체 페이스트 흡입법을 이용하여 상기 도체막(41)을 형성한 후에 다른 세라믹 그린 시트를 적층하여 상기 패키지 본체(10)의 상부를 폐쇄하는 방법을 사용할 수 있다.As the method of forming the
상기한 방법으로 상기 외부접속단자(20)를 상기 패키지 본체(10)에 부착하게 되면, 도 1 내지 도 3에서 설명한 종래의 세라믹 패키지(101)의 경우와는 달리 상기 홈부(40)에 상기 외부접속단자(20)의 일단부가 수용되므로 상기 외부접속단자(20)의 부착 위치를 조절하기가 쉬워져서 불량률이 현저히 감소하는 효과가 있다.When the
또한 상기 홈부(40)에 상기 외부접속단자(20)의 일단부가 수용되므로 상기 외부접속단자(20)가 상기 패키지 본체(10)의 1개의 면과 접촉하는 종래의 세라믹 패키지(101)의 경우와는 달리, 상기 외부접속단자(20)가 상기 홈부(40)의 3개의 면에 둘러싸이는 효과가 있으므로 강한 부착 강도를 가지는 효과도 있다.In addition, since one end of the
또한 종래의 세라믹 패키지(101)의 경우에는 상기 도체인쇄부(12)을 상기 패키지 본체(10)의 측벽에 인쇄하는 공정이 어렵고, 상기 패키지 본체(10)의 양 측벽에 상기 도체인쇄부(12)을 인쇄하는 경우에는 대량 생산시의 공정이 복잡해지는 문제점도 있다. 그러나 본 발명의 실시예에서는 상기 패키지 본체(10)가 될 세라믹 단위체(10a)가 가로 세로 방향으로 다수 형성되어 있는 어레이 기판(200) 상태에서 한꺼번에 상기 도체막(41)들을 상기 홈부(40)에 형성할 수 있으므로 공정이 단순해지는 효과도 있다.In addition, in the case of the conventional
한편 도 8에는 본 발명에 따른 다른 실시예인 세라믹 패키지(1a)의 단면도가 도시되어 있다. 이 세라믹 패키지(1a)의 상기 외부접속단자(20a)는 상기 패키지 본체(10)의 바닥부를 향하여 "J"자 형태로 굽어진 형상을 가진다. 이러한 형상을 가지게 되면, 상기 세라믹 패키지(1a)가 상기 외부장치에 부착되는 경우, 상기 패키 지 본체(10)의 바닥부와 상기 외부장치와의 사이에 일정한 공간이 확보됨으로써, 상기 세라믹 패키지(1a)의 냉각효율이 높아지는 효과가 있다. 8 is a cross-sectional view of a
도 8에 도시된 세라믹 패키지(1a)에서의 패키지 본체(10)와 단자부(30)는 도 4 내지 도 6을 참조하면서 설명한 실시예에서의 패키지 본체(10)및 단자부(30)와 동일한 구성 및 기능을 가지는 것이므로 그에 대한 더 이상의 상세한 설명은 생략한다.The
상기한 실시예들에서는 상기 어레이 기판(200)의 구멍(40a)을 사각형 형상으로 형성하였으나, 원형 등 다양한 모양을 가질 수 있음은 물론이다.In the above embodiments, the
이상으로 본 발명을 설명하였는데, 본 발명의 기술적 범위는 상술한 실시예에 기재된 내용으로 한정되는 것은 아니며, 해당 기술분야의 통상의 지식을 가진 자에 의해 수정 또는 변경된 등가의 구성은 본 발명의 기술적 사상의 범위를 벗어나지 않는 것임은 명백하다.Although the present invention has been described above, the technical scope of the present invention is not limited to the contents described in the above-described embodiments, and equivalent configurations modified or changed by those skilled in the art may be described. Obviously, it is not beyond the scope of thought.
도 1은 종래의 세라믹 패키지의 사시도이다.1 is a perspective view of a conventional ceramic package.
도 2는 종래의 세라믹 패키지의 II-II선 단면도이다.2 is a cross-sectional view taken along the line II-II of the conventional ceramic package.
도 3은 종래의 세라믹 패키지의 III-III선 단면도이다.3 is a cross-sectional view taken along line III-III of a conventional ceramic package.
도 4는 본 발명의 일 실시예에 따른 세라믹 패키지의 사시도이다.4 is a perspective view of a ceramic package according to an embodiment of the present invention.
도 5는 도 4에 도시된 세라믹 패키지의 V-V선 단면도이다.5 is a cross-sectional view taken along the line V-V of the ceramic package shown in FIG.
도 6은 도 5에 도시된 세라믹 패키지의 VI-VI선 단면도이다.6 is a cross-sectional view taken along the line VI-VI of the ceramic package shown in FIG.
도 7은 본 발명의 일 실시예에 따른 어레이 기판의 평면도이다.7 is a plan view of an array substrate according to an embodiment of the present invention.
도 8은 본 발명에 따른 다른 실시예인 세라믹 패키지의 단면도이다.8 is a cross-sectional view of a ceramic package according to another embodiment of the present invention.
* 도면의 주요부위에 대한 부호의 설명 *Explanation of symbols on major parts of drawing
1 : 세라믹 패키지 2 : 반도체칩1: ceramic package 2: semiconductor chip
3 : 덮개 5 : 와이어3: cover 5: wire
6 : 접착제 10 : 패키지 본체6: adhesive 10: package body
20 : 외부접속단자 30 : 단자부20: External connection terminal 30: Terminal part
40 : 홈부 41 : 도체막40: groove 41: conductor film
200 : 어레이 기판200: array substrate
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020080061724A KR20100001707A (en) | 2008-06-27 | 2008-06-27 | Ceramic package |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020080061724A KR20100001707A (en) | 2008-06-27 | 2008-06-27 | Ceramic package |
Publications (1)
Publication Number | Publication Date |
---|---|
KR20100001707A true KR20100001707A (en) | 2010-01-06 |
Family
ID=41811979
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020080061724A KR20100001707A (en) | 2008-06-27 | 2008-06-27 | Ceramic package |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR20100001707A (en) |
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2008
- 2008-06-27 KR KR1020080061724A patent/KR20100001707A/en not_active Application Discontinuation
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A201 | Request for examination | ||
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