KR20090054918A - 수신 장치, 통신 시스템, 수신 방법 및 프로그램 - Google Patents

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소니 가부시끼 가이샤
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Abstract

본 발명에 따른 수신 장치는, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호를 출력하는 복수의 동기 회로와, 복수의 동기 회로로부터 출력된 동기 신호의 상관값을 비교하는 상관값 비교부와, 상관값 비교부에 의한 비교의 결과에 의거하여, 수신한 신호가 자장치용인지의 여부를 판정하는 동기부를 구비한다.
수신 장치, 수신 신호, 프리앰블 신호, 동기 신호, 동기 회로, 상관값, 상관값 비교

Description

수신 장치, 통신 시스템, 수신 방법 및 프로그램{RECEIVING APPARATUS, COMMUNICATION SYSTEM, RECEIVING METHOD AND PROGRAM}
본 발명은, 2007년 11월 27일자로 일본 특허청에 제출된 일본 특허 출원 JP 2007-305943의 기술 내용을 포함하며, 이하 그 전체 내용이 참조된다.
본 발명은 수신 장치, 통신 시스템, 수신 방법 및 프로그램에 관한 것이다.
예를 들어 UWB의 멀티밴드 OFDM 방식 등에서는 복수의 밴드를 호핑(hopping)한 신호가 송수신되고, 신호의 프리앰블 패턴은 호핑의 종류를 나타내는 TFC 패턴마다 상이한 신호로 설정된다. 예를 들어, 일본 공개특허 제2007-19985호 공보 및 일본 공개특허 제2006-197375호 공보에는 TFC 패턴에 대응한 복수의 동기 회로를 설치한 구성이 개시되어 있다.
그러나, 수신 장치 측에서는, 미리 설정된 TFC 패턴과 상이한 TFC 패턴의 신호가 수신된 경우에도 동기를 획득하게 되는 경우가 있다. 특히, 수신 장치와 송신 장치 간의 거리가 가까운 경우에 이 문제는 생기기 쉬워진다. 이 경우, 수신 장치는 동기를 획득할 수 있는 것으로 간주되어, 프리앰블 이후의 신호를 수신한다. 수신 장치가 헤더를 수신한 시점에 헤더에 포함되는 헤더 체크 시퀀스(HCS: Header Check Sequence)에 기초하여 수신 신호가 자장치(subject apparatus)용이 아니라고 판단된다. 이 때문에, 헤더를 수신할 때까지 불필요한 처리가 발생하게 된다. 그리고, MAC는 헤더 체크 시퀀스에 의한 에러가 상이한 TFC를 수신한 것에 기인하는 것인지, SN의 저하에 기인하는 것인지, 또는 신호의 충돌에 의한 것인지를 판단할 수 없다. 에러의 대책으로서, 수신 레이트를 낮추는 등 불필요한 처리가 행해질 가능성이 있다.
일본 공개특허 제2007-19985호 공보 및 일본 공개특허 제2006-197375호 공보에는 TFC 패턴에 대응한 복수의 동기 회로를 설치한 구성이 개시되어 있다. TFC 패턴에 따라 동기 회로를 전환시킬 수는 있지만, 동기 획득 시에 실수하여 자장치와 상이한 TFC 패턴에서 동기를 획득하게 되는 문제를 가정하지는 않았다.
따라서, 프리앰블 신호의 동기를 획득한 시점에, 수신 신호가 자장치에 송신된 것인지의 여부를 정확하게 판정하는 것이 가능한, 신규이며 개량된 수신 장치, 통신 시스템, 수신 방법 및 프로그램을 제공하는 것이 바람직하다.
본 발명의 일 실시 형태에 따르면, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 각각 출력하는 복수의 동기 회로; 상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 상관값 비교부; 및 상기 상관값 비교부에 의한 비교의 결과에 의 거하여 동기 획득 신호를 출력하는 동기부를 포함하는 수신 장치가 제공된다.
상기 구성에 의하면, 복수의 동기 회로는 수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 출력한다. 상관값 비교부는 복수의 동기 회로로부터 출력된 동기 신호의 상관값을 비교한다. 동기부는 상관값 비교부에 의한 비교의 결과에 의거하여 동기 획득 신호를 출력한다. 따라서, 복수의 동기 신호의 상관값을 비교한 결과에 의거하여, 수신 신호가 자장치용인 경우에만 동기 획득 신호를 정확하게 출력하는 것이 가능해진다.
또한, 상기 동기부는, 상기 상관값 비교부에 의한 비교의 결과에 의거하여, 가장 큰 상관값을 출력한 동기 회로가 자장치의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로인 경우, 해당 동기 회로의 출력을 상기 동기 획득 신호로서 출력할 수도 있다. 이러한 구성에 의하면, 가장 큰 상관값을 출력한 동기 회로가 자장치의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로인지의 여부에 의거하여, 수신한 신호가 자장치용인 경우에만 동기 획득 신호를 출력하는 것이 가능해진다.
또한, 상기 상관값 비교부에 의한 비교의 결과에 의거하여, 가장 큰 상관값을 출력한 동기 회로가 자장치의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로가 아닌 경우, 이후의 수신 처리를 중지하고, 상기 복수의 동기 회로에 의한 동기에 대한 처리를 대기한다. 이러한 구성에 의하면, 가장 큰 상관값을 출력한 동기 회로가 자장치의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로가 아닌 경우, 수신한 신호가 자장치용이 아니라고 판단할 수 있다. 그 때문에, 이후의 수신 처리 를 중지함으로써, 불필요한 수신 처리가 계속하여 행해지는 것을 억제할 수 있다.
상기 상관값 비교부는 프리앰블 신호, 또는 TFC 패턴에 따라 미리 정해진 소정 시간 내에 출력된 상기 상관값을 비교할 수도 있다. 이러한 구성에 의하면, 프리앰블 신호, 또는 TFC 패턴에 따라 동기를 획득하는 타이밍이 상이하기 때문에, 프리앰블 신호, 또는 TFC 패턴에 따라 미리 정해진 소정 시간 내에 출력된 상관값을 비교함으로써 상관값을 정확하게 비교할 수 있다.
본 발명의 다른 실시 형태에 따르면, 송신 장치와 수신 장치가 무선통신 네트워크를 통하여 접속된 통신 시스템이 제공되는데, 상기 수신 장치는, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 출력하는 복수의 동기 회로; 상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 상관값 비교부; 및 상기 상관값 비교부에 의한 비교의 결과에 의거하여, 동기 획득 신호를 출력하는 동기부를 포함한다.
상기 구성에 의하면, 송신 장치와 수신 장치가 무선통신 네트워크를 통하여 접속된 통신 시스템에 있어서, 수신 장치의 복수의 동기 회로는, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 출력한다. 상관값 비교부는 복수의 동기 회로로부터 출력된 동기 신호의 상관값을 비교한다. 동기부는 상관값 비교부에 의한 비교의 결과에 의거하여 동기 획득 신호를 출력한다. 따라서, 복수의 동기 신호의 상관값을 비교한 결과에 의거하여, 수신 신호가 자장치용인 경우에만 동기 획득 신호를 정확하게 출력하는 것이 가능해진다.
본 발명의 또 다른 실시 형태에 따르면, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로 각각으로부터 프리앰블 신호의 수신 시에 동기 신호의 상관값을 출력하는 단계; 상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 단계; 및 상기 상관값의 비교의 결과에 의거하여 동기 획득 신호를 출력하는 단계를 포함하는 수신 방법이 제공된다.
상기 구성에 의하면, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로 각각으로부터 프리앰블 신호의 수신 시에 동기 신호의 상관값이 출력된다. 또한, 복수의 동기 회로로부터 출력된 동기 신호의 상관값이 비교되고, 이 결과에 의거하여 동기 획득 신호가 출력된다. 따라서, 복수의 동기 신호의 상관값을 비교한 결과에 의거하여, 수신 신호가 자장치용인 경우에만 동기 획득 신호를 정확하게 출력하는 것이 가능해진다.
본 발명의 또 다른 실시 형태에 따르면, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로 각각으로부터 프리앰블 신호의 수신 시에 동기 신호의 상관값을 출력하는 유닛; 상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 유닛; 및 상기 상관값의 비교의 결과에 의거하여 동기 획득 신호를 출력하는 유닛으로서 컴퓨터를 기능시키기 위한 프로그램이 제공된다.
상기 구성에 의하면, 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로 각각으로부터 프리앰블 신호의 수신 시에 동기 신호의 상관값이 출력된다. 또한, 복수의 동기 회로로부터 출력된 동기 신호의 상관값이 비교되고, 이 결과에 의거하여 동기 획득 신호가 출력된다. 따라서, 복수의 동기 신호의 상 관값을 비교한 결과에 의거하여, 수신 신호가 자장치용인 경우에만 동기 획득 신호를 정확하게 출력하는 것이 가능해진다.
본 발명에 의하면, 프리앰블 신호의 동기를 획득한 시점에, 수신 신호가 자장치(subject apparatus)에 송신된 것인지의 여부를 정확하게 판정하는 것이 가능해진다.
이하, 첨부 도면을 참조하면서, 본 발명의 적합한 실시 형태에 대해서 상세하게 설명한다. 또한, 본 명세서 및 첨부 도면에 있어서, 실질적으로 동일한 기능 및 구성을 갖는 구성 요소에 대해서는 동일한 부호를 첨부함으로써 중복 설명을 생략한다.
도 1은 본 발명의 일 실시 형태에 따른 수신 장치(100)의 구성을 나타내는 모식도이다. 수신 장치(100)는, 예를 들어 UWB의 멀티밴드 OFDM 방식에 의한 수신 장치로서, 무선통신 네트워크를 통하여 통신 가능하게 접속된 송신 장치로부터 송신된 신호를 수신하는 것이다. 도 1에 나타낸 바와 같이, 수신 장치(100)는 안테나(102), RF 회로(104), AD 변환부(ADC)(106), FFT(110), 채널 보정부(112), 디인터리버(deinterleaver)(114), 디펑처(depuncture)(116), 디코더(118), MAC(120), 동기부(130), 컨트롤러(140)를 구비하고 있다.
도 1에 있어서, 안테나(102)에서 수신된 고주파 신호는 RF 회로(104)에 의해 증폭되고, AD 변환부(106)에 의해 디지털 신호로 변환된다. 디지털 신호로 변환된 수신 신호는 FFT(110)에 의해 고속 푸리에 변환되어 채널 보정부(112)에 송신된다. 채널 보정부(112)는, 수신 신호에 포함되는 채널 추정 신호(CE)에 의거하여, 채널을 보정하는 처리를 행한다.
채널 보정부(112)에 의해 보정된 신호는 디인터리버(114)에 송신된다. 디인터리버(114)는 인터리브되어 있는(interleaved) 수신 신호를 원래 상태로 되돌리는 처리를 행한다. 디인터리버(114)로부터 출력된 수신 신호는 디펑처(116)에 송신되어 디펑처의 처리가 행해진다. 디코더(118)는 디펑처(116)로부터 입력된 신호를 디코딩한다. 디코더(118)에서 디코딩된 신호는 MAC(120)에 입력된다.
동기부(130)는 AD 변환부(66, 86)에서 수신한 신호의 동기를 획득한다. 컨트롤러(140)는 동기부(130)에서 동기된된 신호의 수신 타이밍을 FFT(110)에 보낸다. FFT(110)는 동기부(130)로부터 보내진 수신 타이밍에 의거하여 고속 푸리에 변환을 행한다.
IEEE802.15.3 규격으로 규정된 통신 방식과 같이 주파수 호핑을 행하는 OFDM 방식을 통상 멀티밴드 OFDM(Multi-Band OFDM(MB-OFDM)) 방식이라고 한다. 이 방식에서는 주파수 획득용 신호인 프리앰블 신호의 송신에서도 호핑을 행하고, 그 호핑 패턴과 데이터 송신 패턴(Time Frequency Code; 이하 TFC라고 함)도 다양한 타입을 갖는 것이 규정되어 있다.
도 2의 (a) ~ (g)는 IEEE802.15.3 규격에서 규정된 7개의 TFC를 나타내는 모식도이다. 도 2의 (a) ~ (g)에 나타낸 바와 같이, TFC1에서부터 TFC7까지 7개의 패턴이 규정되어, 그 7개의 패턴 중 어느 하나에서 동기 신호인 프리앰블 신호가 송신된다. 구체적으로는, 송신 주파수로서 f1, f2, f3의 3개의 주파수가 준비되고, 이 3개의 주파수 f1, f2, f3 중 어느 하나를 사용하여 1단위의 프리앰블 신호(동기 신호)를 24회(24슬롯) 반복하여 보내게 된다. 도 2의 (a) ~ (g)에서는 12주기만을 나타내고 있다.
각 패턴에 대해서 설명한다. TFC1 패턴에서는, 도 2의 (a)에 나타낸 바와 같이, 1단위의 프리앰블 신호(동기 신호)마다 주파수가 f1, f2, f3의 순서로 변경된다. TFC2 패턴에서는, 도 2의 (b)에 나타낸 바와 같이, 1슬롯의 프리앰블 신호마다 주파수가 f1, f2, f3의 순서로 변경된다. TFC3 패턴에서는, 도 2의 (c)에 나타낸 바와 같이, 2슬롯의 프리앰블 신호마다 주파수가 f1, f2, f3의 순서로 변경된다. TFC4 패턴에서는, 도 2의 (d)에 나타낸 바와 같이, 2슬롯의 프리앰블 신호마다 주파수가 f1, f2, f3의 순서로 변경된다. TFC5 패턴에서는, 도 2의 (e)에 나타낸 바와 같이, 모든 슬롯의 프리앰블 신호가 주파수 f1로 송신된다. TFC6 패턴에서는, 도 2의 (f)에 나타낸 바와 같이, 모든 슬롯의 프리앰블 신호가 주파수 f2로 송신된다. TFC7 패턴에서는, 도 2의 (g)에 나타낸 바와 같이, 모든 슬롯의 프리앰블 신호가 주파수 f3으로 송신된다. 또한, 여기서는 나타내지 않지만, 프리앰블 신호의 신호 극성(+ 또는 -)에 대해서도 특정 패턴으로 설정되어 있다.
도 3은 수신 장치(100)가 수신하는 패킷 신호의 데이터 구성의 일례를 나타내는 모식도이다. 도 3에 나타낸 바와 같이, 패킷 신호는 프리앰블(Preamble), 채널 추정 신호(CE; channel estimating signal), 헤더(Header), 페이로드(Payload)를 포함한다. 헤더는 PHY 헤더, MAC 헤더, 헤더 체크 시퀀스(HCS)로 나뉜다. PHY 헤더에는 페이로드의 전송 레이트와 페이로드 길이 등의 정보가 포함되어 있다. 한편, MAC 헤더에는 패킷 신호의 수신처를 나타내는 MAC 어드레스가 포함되어 있다. 도 2에 나타낸 TFC1로부터 TFC7의 프리앰블 패턴에 따라 상이한 프리앰블이 설정되어 있다. 수신 장치(100)는 프리앰블 신호의 동기를 획득한 경우, 수신 신호의 TFC 패턴이 자장치에 대응한 TFC 패턴임을 인식할 수 있다.
이 때, 예를 들어 수신 장치(100)가 TFC1의 신호를 수신하도록 설정되어 있을 경우에, 다른 TFC2 ~ TFC7의 신호 수신에 의해 동기를 획득하게 되는 경우가 있다. 이러한 경우, 수신 장치(100)는 MAC 헤더에 이어지는 HCS에 의해 다른 TFC의 신호를 수신하였음을 판단할 수 있지만, 헤더의 HCS를 수신할 때까지는 수신 신호가 자장치용의 신호라고 판단한다. 이 때문에, 원래는 프리앰블을 수신한 시점에 수신 신호가 자장치용의 신호가 아니라고 판단할 수 있음에도 불구하고, 프리앰블로부터 HCS까지의 신호가 디코딩되어 불필요한 처리가 발생하게 된다.
이 때문에, 본 실시 형태의 수신 장치(100)에서는, 수신 신호의 TFC가 자장치용인지의 여부를 정확하게 판정할 수 있도록 복수의 동기 회로를 동기부(130)에 설치하고 있다. 도 4는 동기부(130)의 구성을 상세하게 나타내는 모식도이다. 도 4에 나타낸 바와 같이, 동기부(130)는 TFC1 동기 회로(132), TFC2의 동기 회로(134), …, TFCm의 동기 회로(136)를 구비하고 있다. 또한, 동기부(130)는 각 동기 회로(132, 134, 136)로부터 출력된 상관값을 비교하는 상관값 비교 회로(138)를 구비하고 있다.
TFC1 동기 회로(132)는 TFC1 수신 신호를 수신했을 때에 동기를 획득하고, 동기 신호의 상관값을 획득하는 회로이다. 마찬가지로, TFC2 동기 회로(134)는 TFC2 수신 신호를 수신했을 때에 동기를 획득하여 상관값을 출력하는 회로이다. TFCm 동기 회로(136)는 TFCm의 수신 신호를 수신했을 때에 동기를 획득하여 상관값을 출력하는 회로이다.
도 5는 수신 장치(100)가 TFC1 수신 신호를 수신했을 때에, 각 동기 회로(132, 134, 136)로부터 출력된 동기 신호의 상관값을 나타내는 모식도이다. 각 동기 회로는 신호를 수신했을 때에 동시에 동작한다. 도 5에 나타낸 바와 같이, 수신 장치(100)가 TFC1 수신 신호를 수신한 경우는, TFC1 동기 회로(132)에 있어서 피크값 1의 상관값이 검출된다. 한편, 동기 회로(134, 136)에서 검출되는 동기 신호의 상관값(피크값 2, 피크값 m)은 TFC1 동기 회로(132)에서 검출된 상관값보다도 작게 된다.
각 동기 회로(132, 134, 136)에서는, 상관값이 소정의 임계값 TH를 초과한 경우에 동기를 획득한다. 그런데, 도 5와 같이, 각 동기 회로(132, 134, 136)로부터 출력된 상관값이 임계값 TH를 초과할 경우, 어느 TFC 패턴에서 동기가 획득된 것인지 판단할 수 없는 경우가 있다.
이 때문에, 본 실시 형태의 수신 장치(100)에서는 각 동기 회로(132, 134, 136)에서 검출된 상관값을 상관값 비교 회로(138)에서 비교하여, 가장 큰 상관값이 출력된 동기 회로를 특정한다. 그 결과, TFC1 ~ TFC7 중 어느쪽의 신호를 수신했는지를 판단하게 된다. 도 5의 예에서는, TFC1 동기 회로(132)에서 획득된 상관값이 다른 동기 회로(134, 136)에서 획득된 상관값보다도 크기 때문에, 가장 상관값 이 큰 동기 회로가 TFC1에 대응한 동기 회로(132)라고 판단할 수 있다. 이것에 의해, 수신 신호가 TFC1의 패턴임을 확실하게 판단할 수 있다. 따라서, 페이로드를 수신한 시점에서 수신 신호가 자장치(subject apparatus)용의 TFC 패턴인지, 타장치(other apparatus)용의 TFC 패턴인지를 판단할 수 있다. 이것에 의해, 타장치용의 신호를 수신한 경우는 즉시 수신 처리를 정지할 수 있어, 불필요한 처리가 행해지는 것을 억제할 수 있다.
상관값의 비교는 동시각만의 비교가 아니라, 도 5에 나타낸 바와 같이, 소정의 구간 B 내에서 획득된 상관값에 대해서 행한다. 구간 B는 프리앰블 신호, 호핑 패턴 등에 따라 설정된다. 이것은 프리앰블 패턴, TFC 패턴, 또는 호핑 패턴의 변동(variations)에 따라 상관값이 검출되는 타이밍이 상이하기 때문이다.
다음으로, 도 6에 의거하여, 본 실시 형태의 수신 장치(100)에서의 처리 순서에 대해서 설명한다. 스텝 S1에서는, 수신 장치(100)가 사용하는 TFC가 TFC1 ~ TFC7 중 어느 것인지에 관한 정보가 취득된다. 수신 장치(100)가 어느 TFC를 사용할지는, 예를 들어 사용자에 의해 미리 설정될 수 있다. 여기서는, 수신 장치(100)가 TFCm 패턴의 신호를 사용하는 것으로 미리 설정된다.
다음 스텝 S2에서는 수신을 개시한다. AD 변환부(106)에서 디지털 변환된 수신 신호가 동기부(130)에 송신된다. 스텝 S3에서는 각 동기 회로(132, 134, 136)를 모두 동작시키고, 동기를 대기한다.
다음 스텝 S4에서는, 수신 장치(100)가 사용하는 TFCm에 대응하는 동기 회로(136)에서 동기가 획득된 경우, 즉, 동기 회로(136)에서 검출된 상관값이 임계값 TH보다도 큰 경우는 스텝 S5로 진행한다. 한편, 동기가 획득되지 않았을 경우는, 스텝 S3으로 리턴한다. 스텝 S5에서는 구간 B의 범위 내에서 각 동기 회로(132, 134, 136)의 상관값의 피크를 비교한다. 스텝 S6에서는 스텝 S5의 비교 결과에 의거하여 판정을 행한다. TFCm의 동기 회로(136)의 상관값이 최대인 경우는 스텝 S7로 진행한다. 스텝 S7에서는 TFCm의 동기 회로(136)로부터의 출력을 최종적인 동기 획득 신호로서 동기부(130)로부터 출력하고, 컨트롤러(140)에 보낸다. 이것에 의해, 동기 획득에 의한 수신 타이밍이 FFT(110)에 보내지고, 수신 신호가 고속 푸리에 변환된다. 다음 스텝 S8에서는 프리앰블 후의 헤더 등의 심볼 수신을 개시한다. 스텝 S8의 후는 TFC의 판정 처리를 종료한다(RETURN).
한편, 스텝 S6에서 TFCm의 동기 회로의 상관값이 최대가 아닐 경우는, TFCm 이외의 다른 TFC를 수신하고 있었다고 판단하여 스텝 S3으로 리턴하고, 이후의 처리를 반복한다. 이상의 처리에 의해, 수신 신호의 TFC 패턴이 수신 장치(100)가 사용하는 TFC 패턴인지의 여부를 정확하게 판정할 수 있다. 도 6의 처리는, 예를 들어 수신 장치(100)가 구비하는 메모리에 저장된 프로그램(소프트웨어)에 의해 컴퓨터로서의 수신 장치(100)를 기능시킴으로써 실현할 수도 있다.
이러한 실시 형태에 의하면, 복수의 TFC에 대응한 동기 회로(132, 134, 136)를 설치하고, 각 동기 회로(132, 134, 136)에서 검출된 상관값을 비교함으로써, 수신 신호의 TFC 패턴을 확실하게 인식할 수 있다. 따라서, TFC 패턴에 의거하여, 수신 신호가 자장치용의 신호인지, 또는 타장치용의 신호인지를 정확하게 판단하는 것이 가능해진다.
당업자라면 첨부된 특허청구범위 혹은 그의 등가물에 기재된 범위 내에서 설계 요구 조건 및 그 외의 인자들(factors)에 의존하여 각종 수정, 조합, 부-조합(sub-combination) 및 변경이 상도될 수 있음을 이해할 것이다.
도 1은 본 발명의 일 실시 형태에 따른 수신 장치의 구성을 나타낸 모식도.
도 2는 IEEE802.15.3 규격에서 규정된 7개의 TFC를 나타낸 모식도.
도 3은 수신 장치가 수신하는 패킷 신호의 데이터 구성의 일례를 나타낸 모식도.
도 4는 동기부의 구성을 상세하게 나타낸 모식도.
도 5는 수신 장치가 TFC1 수신 신호를 수신했을 때에, 각 동기 회로로부터 출력된 동기 신호의 상관값을 나타낸 모식도.
도 6은 본 실시 형태의 수신 장치에서의 처리 순서를 나타낸 플로우 차트.
*도면의 주요부분에 대한 부호의 설명
100 : 수신 장치
130 : 동기부
132, 134, 136 : 동기 회로
140 : 컨트롤러

Claims (7)

  1. 수신 신호가 상이한 프리앰블((preamble) 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 출력하는 복수의 동기 회로;
    상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 상관값 비교부; 및
    상기 상관값 비교부에 의한 비교의 결과에 의거하여, 동기 획득 신호를 출력하는 동기부
    를 포함하는 수신 장치.
  2. 제1항에 있어서,
    상기 상관값 비교부에 의한 비교의 결과에 의거하여 가장 큰 상관값을 출력한 동기 회로가 자장치(subject apparatus)의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로인 경우에, 상기 동기부는 해당 동기 회로의 출력을 상기 동기 획득 신호로서 출력하는 수신 장치.
  3. 제2항에 있어서,
    상기 상관값 비교부에 의한 비교의 결과에 의거하여 가장 큰 상관값을 출력한 동기 회로가 자장치의 TFC 패턴의 프리앰블 신호에 대응하는 동기 회로가 아닌 경우에는, 이후의 수신 처리를 중지하고, 상기 복수의 동기 회로에 의한 동기를 대기하는 수신 장치.
  4. 제1항에 있어서,
    상기 상관값 비교부는 프리앰블 신호 또는 TFC 패턴에 따라 미리 정해진 소정 시간 내에 출력된 상기 상관값들을 비교하는 수신 장치.
  5. 송신 장치와 수신 장치가 무선통신 네트워크를 통하여 접속된 통신 시스템으로서,
    상기 수신 장치는,
    수신 신호가 상이한 프리앰블 신호에 대응하여 설치되고, 프리앰블 신호의 수신 시에 동시에 동작하여 동기 신호의 상관값을 각각 출력하는 복수의 동기 회로;
    상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 상관값 비교부; 및
    상기 상관값 비교부에 의한 비교의 결과에 의거하여, 동기 획득 신호를 출력하는 동기부
    를 포함하는 통신 시스템.
  6. 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로로부 터 프리앰블 신호의 수신 시에 동기 신호의 상관값을 출력하는 단계;
    상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 단계; 및
    상기 상관값의 비교의 결과에 의거하여, 동기 획득 신호를 출력하는 단계
    를 포함하는 수신 방법.
  7. 수신 신호가 상이한 프리앰블 신호에 대응하여 설치된 복수의 동기 회로로부터 프리앰블 신호의 수신 시에 동기 신호의 상관값을 출력하는 유닛;
    상기 복수의 동기 회로로부터 출력된 상기 상관값을 비교하는 유닛; 및
    상기 상관값의 비교의 결과에 의거하여, 동기 획득 신호를 출력하는 유닛
    으로서 컴퓨터를 기능시키기 위한 프로그램.
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