KR20090043311A - Plasma display apparatus - Google Patents

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이병준
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Abstract

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.The present invention relates to a plasma display device (Plasma Display Apparatus).

본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과, 스캔 전극 및 서스테인 전극에 구동 신호를 공급하는 구동부를 포함하고, 구동부는 프레임의 복수의 서브필드의 초기화를 위한 리셋 기간 동안 스캔 전극으로 제 1 전압에서 제 2 전압까지 상승하는 제 1 상승 램프 신호 및 제 2 전압에서 제 3 전압까지 상승하는 제 2 상승 램프 신호를 포함하는 리셋 신호를 공급하고, 제 1 상승 램프 신호와 제 2 상승 램프 신호의 사이에 일정 전압이 유지되는 평탄 기간(Flat-Period)을 포함한다.According to an embodiment of the present invention, a plasma display apparatus includes a plasma display panel on which scan electrodes and sustain electrodes are disposed, and a driver supplying driving signals to the scan electrodes and the sustain electrodes, wherein the driver includes a plurality of subfields of the frame. Supplying a reset signal to the scan electrode including a first rising ramp signal rising from a first voltage to a second voltage and a second rising ramp signal rising from a second voltage to a third voltage during a reset period for initialization; And a flat-period in which a constant voltage is maintained between the first rising ramp signal and the second rising ramp signal.

본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 리셋 신호에 평탄 기간을 포함함으로써, 벽 전하의 분포를 균일하게 하여 오방전을 방지하고 방전이 안정적으로 일어날 수 있도록 하는 효과가 있다.Plasma display device according to an embodiment of the present invention includes the flat period in the reset signal, it is effective to uniformly distribute the wall charge to prevent the mis-discharge and to ensure the stable discharge.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}Plasma Display Apparatus {Plasma Display Apparatus}

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.The present invention relates to a plasma display device (Plasma Display Apparatus).

플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 구동 신호를 공급하는 구동부를 포함할 수 있다.The plasma display apparatus may include a plasma display panel having electrodes formed thereon, and a driving unit supplying driving signals to the electrodes of the plasma display panel.

플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.In the plasma display panel, a phosphor layer is formed in a discharge cell divided by a partition, and a plurality of electrodes are formed.

플라즈마 디스플레이 패널의 전극에 구동 신호를 공급하면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.When the drive signal is supplied to the electrode of the plasma display panel, the discharge is generated by the drive signal supplied in the discharge cell. Here, when discharged by a drive signal in the discharge cell, the discharge gas filled in the discharge cell generates vacuum ultraviolet rays, and the vacuum ultraviolet light emits the phosphor formed in the discharge cell to emit visible light. Generate. The visible light displays an image on the screen of the plasma display panel.

본 발명의 일실시예는 리셋 신호를 개선하여 구동의 안정성과 방전의 효율성이 향상된 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.One embodiment of the present invention is to provide a plasma display device having improved driving signal and improved discharge efficiency by improving a reset signal.

본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과, 스캔 전극 및 서스테인 전극에 구동 신호를 공급하는 구동부를 포함하고, 구동부는 프레임의 복수의 서브필드의 초기화를 위한 리셋 기간 동안 스캔 전극으로 제 1 전압에서 제 2 전압까지 상승하는 제 1 상승 램프 신호 및 제 2 전압에서 제 3 전압까지 상승하는 제 2 상승 램프 신호를 포함하는 리셋 신호를 공급하고, 제 1 상승 램프 신호와 제 2 상승 램프 신호의 사이에 일정 전압이 유지되는 평탄 기간(Flat-Period)을 포함한다.According to an embodiment of the present invention, a plasma display apparatus includes a plasma display panel on which scan electrodes and sustain electrodes are disposed, and a driver supplying driving signals to the scan electrodes and the sustain electrodes, wherein the driver includes a plurality of subfields of the frame. Supplying a reset signal to the scan electrode including a first rising ramp signal rising from a first voltage to a second voltage and a second rising ramp signal rising from a second voltage to a third voltage during a reset period for initialization; And a flat-period in which a constant voltage is maintained between the first rising ramp signal and the second rising ramp signal.

또한, 평탄 기간의 길이는 2㎛이상 300㎛이하인 것을 특징으로 한다.In addition, the length of the flat period is characterized in that more than 2 300㎛.

또한, 평탄 기간의 길이는 10㎛이상 100㎛이하인 것을 특징으로 한다.In addition, the length of the flat period is characterized in that the 10㎛ not more than 100㎛.

또한, 제 1 전압은 그라운드(GND) 전압인 것을 특징으로 한다.In addition, the first voltage is characterized in that the ground (GND) voltage.

또한, 제 2 전압은 서스테인 전압(Vs)인 것을 특징으로 한다.In addition, the second voltage is characterized in that the sustain voltage (Vs).

또한, 리셋 신호는 복수의 서브필드 중 적어도 하나의 서브필드에 공급되는 것을 특징으로 한다.The reset signal may be supplied to at least one of the plurality of subfields.

또한, 구동부는 리셋 기간 이전의 프리 리셋 기간 동안 스캔 전극으로 부극성 신호인 제 1 신호를 공급하고, 서스테인 전극으로 정극성 신호인 제 2 신호를 공급하는 것을 특징으로 한다.The driving unit may supply a first signal, which is a negative signal, to the scan electrode and a second signal, which is a positive signal, to the sustain electrode during the pre-reset period before the reset period.

또한, 플라즈마 디스플레이 패널 내부에는 크세논(Xe)을 포함하는 방전 가스가 채워지고, 크세논의 함량은 10%이상 20%이하인 것을 특징으로 한다.In addition, the plasma display panel is filled with a discharge gas containing xenon (Xe), the xenon content is characterized in that 10% or more and 20% or less.

또한, 크세논의 함량은 12%이상 15%이하인 것을 특징으로 한다.In addition, the content of xenon is characterized in that 12% or more and 15% or less.

본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 리셋 신호에 평탄 기간을 포함함으로써, 벽 전하의 분포를 균일하게 하여 오방전을 방지하고 방전이 안정적으로 일어날 수 있도록 하는 효과가 있다.Plasma display device according to an embodiment of the present invention includes the flat period in the reset signal, it is effective to uniformly distribute the wall charge to prevent the mis-discharge and to ensure the stable discharge.

이하, 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.Hereinafter, a plasma display device according to the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성에 대해 설명하기 위한 도면이다.41 is a view for explaining the configuration of a plasma display device according to an embodiment of the present invention.

도 1을 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 플라즈마 방전을 이용하여 영상을 구현하는 플라즈마 디스플레이 패널(100)과, 구동부(110)를 포함한다.Referring to FIG. 1, a plasma display apparatus according to an embodiment of the present invention includes a plasma display panel 100 for implementing an image using plasma discharge and a driver 110.

여기, 도 1에서는 구동부(110)가 하나의 보드(Board) 형태로 이루어지는 경우만 도시하고 있지만, 본 발명에서 구동부(110)는 플라즈마 디스플레이 패널(100)에 형성된 전극에 따라 복수개의 보드 형태로 나누어지는 것도 가능하다.Here, in FIG. 1, only the case in which the driving unit 110 is formed in one board form is illustrated, but in the present invention, the driving unit 110 is divided into a plurality of board forms according to electrodes formed on the plasma display panel 100. It is also possible to lose.

예를 들면, 본 발명의 플라즈마 디스플레이 장치는 스캔 전극(Y)을 구동시키 는 스캔 구동부(미도시)와, 서스테인 전극(Z)을 구동시키는 서스테인 구동부(미도시)와, 어드레스 전극(X)을 구동시키는 데이터 구동부(미도시)로 나누어질 수 있는 것이다.For example, the plasma display apparatus of the present invention includes a scan driver (not shown) for driving the scan electrode (Y), a sustain driver (not shown) for driving the sustain electrode (Z), and an address electrode (X). It can be divided into a data driver (not shown) for driving.

이러한 본 발명의 플라즈마 디스플레이 장치의 구동부(110)에 대해서는 이후에 보다 상세히 설명하도록 한다.The driving unit 110 of the plasma display device of the present invention will be described in detail later.

도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조를 설명하기 위한 도면이다.2 is a view for explaining the structure of a plasma display panel that can be included in a plasma display device according to an embodiment of the present invention.

도 2를 살펴보면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널(200)은 서로 나란한 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 배치되는 전면 기판(201)과, 전면 기판(201)에 대항되게 배치되며 스캔 전극(202) 및 서스테인 전극(203)과 교차하는 어드레스 전극(213)이 배치되는 후면 기판(211)이 실 층(Seal Layer, 미도시)에 의해 합착되어 이루어질 수 있다.2, the plasma display panel 200 according to an embodiment of the present invention includes a front substrate 201 and a front substrate 20 on which scan electrodes 202 and Y and sustain electrodes 203 and Z which are parallel to each other are disposed. A rear substrate 211 on which the address electrode 213 intersects with the scan electrode 202 and the sustain electrode 203 is disposed opposite to 201 may be bonded to each other by a seal layer (not shown). have.

스캔 전극(202)과 서스테인 전극(203)이 배치된 전면 기판(201)의 상부에는 스캔 전극(202)과 서스테인 전극(203)을 매립하는 상부 유전체 층(204)이 배치된다.An upper dielectric layer 204 filling the scan electrode 202 and the sustain electrode 203 is disposed on the front substrate 201 where the scan electrode 202 and the sustain electrode 203 are disposed.

상부 유전체 층(204)은 스캔 전극(202) 및 서스테인 전극(203)의 방전 전류를 제한하며 스캔 전극(202)과 서스테인 전극(203)간을 절연시킬 수 있다.The upper dielectric layer 204 limits the discharge current of the scan electrode 202 and the sustain electrode 203 and can insulate the scan electrode 202 and the sustain electrode 203.

상부 유전체 층(204) 상부에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 배치될 수 있다. 이러한 보호 층(205)은 이차전자 방출 계수가 높은 재질, 예컨대 산화마그네슘(MgO) 재질을 포함할 수 있다.A protective layer 205 may be disposed over the upper dielectric layer 204 to facilitate discharge conditions. The protective layer 205 may include a material having a high secondary electron emission coefficient such as magnesium oxide (MgO).

또한, 후면 기판(211)에는 전극, 예컨대 어드레스 전극(213)이 배치되고, 어드레스 전극(213)이 배치된 후면 기판(211)에는 어드레스 전극(213)을 덮으며 어드레스 전극(213)을 절연시킬 수 있는 유전체 층, 예컨대 하부 유전체 층(215)이 배치될 수 있다.In addition, an electrode, for example, an address electrode 213 is disposed on the rear substrate 211, and an address electrode 213 is covered on the rear substrate 211 on which the address electrode 213 is disposed to insulate the address electrode 213. A dielectric layer, such as lower dielectric layer 215, may be disposed.

하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하는 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(112)이 배치될 수 있다. 이러한 격벽(212)에 의해 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 방전 셀 등이 구비될 수 있다. 또한, 적색(R), 녹색(G), 청색(B) 방전 셀 이외에 백색(White : W) 또는 황색(Yellow : Y) 방전 셀이 더 구비되는 것도 가능하다.Discharge spaces, that is, partition 112 partitioning the discharge cells, that is, a partition type (Wipe Type, Well Type, Delta Type, Honeycomb type, etc.) may be disposed on the lower dielectric layer 215. Can be. The barrier rib 212 may be provided with a red (R), green (G), and blue (B) discharge cell between the front substrate 201 and the rear substrate 211. In addition, in addition to the red (R), green (G), and blue (B) discharge cells, white (W) or yellow (Yellow: Y) discharge cells may be further provided.

격벽(212)에 의해 구획된 방전 셀 내에는 크세논(Xe), 네온(Ne) 등의 방전 가스가 채워질 수 있다.In the discharge cells partitioned by the partition walls 212, a discharge gas such as xenon (Xe), neon (Ne), or the like may be filled.

아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 배치될 수 있다. 예를 들면, 적색(Red : R) 광을 발산하는 제 1 형광체 층, 청색(Blue, B) 광을 발산하는 제 2 형광체 층, 녹색(Green : G) 광을 발산하는 제 3 형광체 층이 배치될 수 있다. 또한, 적색(R), 녹색(G), 청색(B) 광 이외에 백색(White : W) 광 또는 황색(Yellow : Y) 광을 발산하는 다른 형광체 층이 더 배치되는 것도 가능하다.In addition, a phosphor layer 214 that emits visible light for image display may be disposed in the discharge cell partitioned by the partition wall 212. For example, a first phosphor layer emitting red (R) light, a second phosphor layer emitting blue (B) light, and a third phosphor layer emitting green (G) light are disposed. Can be. In addition to the red (R), green (G), and blue (B) light, it is also possible to further arrange other phosphor layers emitting white (W) light or yellow (Yellow: Y) light.

또한, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 적어도 어느 하나의 방전 셀에서의 형광체 층(214)의 두께가 다른 방전 셀과 상이할 수 있다. 예를 들면, 녹 색(G) 방전 셀의 형광체 층, 즉 제 3 형광체 층 또는 청색(B) 방전 셀에서의 형광체 층, 즉 제 2 형광체 층의 두께가 적색(R) 방전 셀에서의 형광체 층, 즉 제 1 형광체 층의 두께보다 더 두꺼울 수 있다. 여기서, 제 3 형광체 층의 두께는 제 2 형광체 층의 두께와 실질적으로 동일하거나 상이할 수 있다.In addition, the thickness of the phosphor layer 214 in at least one of the red (R), green (G), and blue (B) discharge cells may be different from other discharge cells. For example, a phosphor layer of a green (G) discharge cell, that is, a phosphor layer in a third phosphor layer or a blue (B) discharge cell, that is, a thickness of a second phosphor layer, may have a phosphor layer in a red (R) discharge cell. That is, it may be thicker than the thickness of the first phosphor layer. Here, the thickness of the third phosphor layer may be substantially the same or different from the thickness of the second phosphor layer.

또한, 발명의 일실시예에 따른 플라즈마 디스플레이 패널(200)에서는 적색(R), 녹색(G) 및 청색(B) 방전 셀의 폭은 실질적으로 동일할 수도 있지만, 적색(R), 녹색(G) 및 청색(B) 방전 셀 중 적어도 하나의 폭이 다른 방전 셀의 폭과 다른 것도 가능하다.In addition, in the plasma display panel 200 according to an embodiment of the present invention, the widths of the red (R), green (G), and blue (B) discharge cells may be substantially the same, but the red (R) and green (G) colors may be substantially the same. And at least one of the blue (B) discharge cells may be different from the widths of the other discharge cells.

예컨대, 적색(R) 방전 셀의 폭이 가장 작고, 녹색(G) 및 청색(B) 방전 셀의 폭을 적색(R) 방전 셀의 폭보다 크게 할 수 있다. 여기서, 녹색(G) 방전 셀의 폭은 청색(B) 방전 셀의 폭과 실질적으로 동일하거나 상이할 수 있다.For example, the width of the red (R) discharge cell is the smallest, and the width of the green (G) and blue (B) discharge cells can be made larger than the width of the red (R) discharge cell. Here, the width of the green (G) discharge cell may be substantially the same as or different from the width of the blue (B) discharge cell.

그러면 방전 셀 내에 배치되는 형광체 층(214)의 폭도 방전 셀의 폭에 관련하여 변경된다. 예를 들면, 청색(B) 방전 셀에 배치되는 제 2 형광체 층의 폭이 적색(R) 방전 셀 내에 배치되는 제 1 형광체 층의 폭보다 넓고, 아울러 녹색(G) 방전 셀에 배치되는 제 3 형광체 층의 폭이 적색(R) 방전 셀 내에 배치되는 제 1 형광체 층의 폭보다 넓을 수 있고, 이에 따라 구현되는 영상의 색온도 특성이 향상될 수 있다.The width of the phosphor layer 214 disposed in the discharge cell is then changed in relation to the width of the discharge cell. For example, the width of the second phosphor layer disposed in the blue (B) discharge cell is wider than the width of the first phosphor layer disposed in the red (R) discharge cell, and the third disposed in the green (G) discharge cell. The width of the phosphor layer may be wider than the width of the first phosphor layer disposed in the red (R) discharge cell, thereby improving the color temperature characteristics of the image implemented.

또한, 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널(200)은 도 2에 도시된 격벽(212)의 구조뿐만 아니라, 다양한 형상의 격벽의 구조도 가능하다. 예컨대, 격벽(212)은 제 1 격벽(212b)과 제 2 격벽(212a)을 포함하고, 여기서, 제 1 격벽(212b)의 높이와 제 2 격벽(212a)의 높이가 서로 다른 차등형 격벽 구조 등이 가능하다.In addition, the plasma display panel 200 according to an embodiment of the present invention may have not only the structure of the partition 212 illustrated in FIG. 2 but also the structure of the partition having various shapes. For example, the partition 212 includes a first partition 212b and a second partition 212a, where the height of the first partition 212b and the height of the second partition 212a are different from each other. Etc. are possible.

이러한, 차등형 격벽 구조인 경우에는 제 1 격벽(212b) 또는 제 2 격벽(212a) 중 제 1 격벽(212b)의 높이가 제 2 격벽(212a)의 높이보다 더 낮을 수 있다.In the case of such a differential partition structure, the height of the first partition 212b among the first partition 212b or the second partition 212a may be lower than the height of the second partition 212a.

또한, 도 2에서는 적색(R), 녹색(G) 및 청색(B) 방전 셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능하다. 예컨대, 적색(R), 녹색(G) 및 청색(B) 방전 셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능하다. 또한, 방전 셀의 형상도 사각형상뿐만 아니라 오각형, 육각형 등의 다양한 다각 형상도 가능하다.In addition, although the red (R), green (G), and blue (B) discharge cells are each shown and described as being arranged on the same line in FIG. 2, they may be arranged in other shapes. For example, a delta type arrangement in which red (R), green (G) and blue (B) discharge cells are arranged in a triangular shape is also possible. In addition, the shape of the discharge cell is not only rectangular but also various polygonal shapes such as pentagon and hexagon.

또한, 도 2에서는 후면 기판(211)에 격벽(212)이 형성된 경우만을 도시하고 있지만, 격벽(212)은 전면 기판(201) 또는 후면 기판(211) 중 적어도 어느 하나에 배치될 수 있다.In addition, in FIG. 2, only the case where the partition 212 is formed on the rear substrate 211 is illustrated, but the partition 212 may be disposed on at least one of the front substrate 201 and the rear substrate 211.

이상에서는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널(200)의 일례만을 도시하고 설명한 것으로써, 본 발명이 이상에서 설명한 구조의 플라즈마 디스플레이 패널(200)에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 이상의 설명에서는 번호 215의 하부 유전체 층 및 번호 204번의 상부 유전체 층이 하나의 층(Layer)인 경우만을 도시하고 있지만, 하부 유전체 층 또는 상부 유전체 층 중 적어도 하나는 복수의 층으로 이루지는 것도 가능한 것이다.In the above description, only one example of the plasma display panel 200 according to the exemplary embodiment of the present invention is illustrated and described, and the present invention is not limited to the plasma display panel 200 having the above-described structure. For example, the above description only shows the case where the lower dielectric layer 215 and the upper dielectric layer 204 are one layer, but at least one of the lower dielectric layer or the upper dielectric layer is not composed of a plurality of layers. It is also possible.

또한, 후면 기판(211)에 배치되는 어드레스 전극(213)은 폭이나 두께가 실질 적으로 일정할 수도 있지만, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 폭이나 두께와 다를 수도 있다. 예컨대, 방전 셀 내부에서의 폭이나 두께가 방전 셀 외부에서의 그것보다 더 넓거나 두꺼울 수 있다.In addition, although the width and thickness of the address electrode 213 disposed on the rear substrate 211 may be substantially constant, the width or thickness inside the discharge cell may be different from the width or thickness outside the discharge cell. For example, the width or thickness inside the discharge cell may be wider or thicker than that outside the discharge cell.

도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임(Frame)에 대해 설명하기 위한 도면이다.FIG. 3 is a diagram for describing an image frame for implementing gray levels of an image in a plasma display device according to an embodiment of the present invention.

도 3을 살펴보면 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 영상 프레임은 발광횟수가 다른 복수의 서브필드로 나누어질 수 있다.Referring to FIG. 3, an image frame for implementing gray levels of an image in a plasma display device according to an embodiment of the present invention may be divided into a plurality of subfields having different emission counts.

아울러, 도시하지는 않았지만 복수의 서브필드 중 하나 이상의 서브필드는 다시 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.Although not shown, one or more subfields among the plurality of subfields may be grayed out according to a reset period for initializing discharge cells, an address period for selecting discharge cells to be discharged, and the number of discharges. It can be divided into the sustain period to implement.

예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 예컨대 하나의 영상 프레임은, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어질 수 있다.For example, when an image is to be displayed with 256 gray scales, for example, one image frame is divided into eight subfields SF1 to SF8 as shown in FIG. 3, and each of the eight subfields SF1 to SF8, respectively. Can be subdivided into a reset period, an address period and a sustain period.

한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.The gray scale weight of the corresponding subfield may be set by adjusting the number of the sustain signals supplied in the sustain period. That is, a predetermined gray scale weight can be given to each subfield using the sustain period. For example, the gray scale weight of each subfield is 2 n by setting the gray scale weight of the first subfield to 2 0 and the gray scale weight of the second subfield to 2 1 (where n = 0, 1). , 2, 3, 4, 5, 6, and 7) to increase the gray scale weight of each subfield. As described above, the number of sustain signals supplied in the sustain period of each subfield is adjusted according to the gray scale weight in each subfield, thereby implementing gray levels of various images.

본 발명의 일실시예에 따른 플라즈마 디스플레이 장치는 영상을 구현하기 위해, 예컨대 1초의 영상을 표시하기 위해 복수의 영상 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 영상 프레임을 사용하는 것이다. 이러한 경우에 하나의 영상 프레임의 길이(T)는 1/60 초, 즉 16.67ms일 수 있다.The plasma display apparatus according to an exemplary embodiment uses a plurality of image frames to implement an image, for example, to display an image of 1 second. For example, 60 image frames are used to display an image of 1 second. In this case, the length T of one image frame may be 1/60 second, that is, 16.67 ms.

여기, 도 3에서는 하나의 영상 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 영상 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 영상 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 영상 프레임을 구성할 수도 있는 것이다.In FIG. 3, only one image frame is composed of eight subfields. However, the number of subfields constituting one image frame may be variously changed. For example, one video frame may be configured with 12 subfields from the first subfield to the twelfth subfield, or one video frame may be configured with 10 subfields.

또한, 여기 도 3에서는 하나의 영상 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 영상 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.In addition, in FIG. 3, subfields are arranged in the order of increasing magnitude of gray scale weight in one image frame. Alternatively, subfields may be arranged in order of decreasing gray scale weight in one image frame. Alternatively, subfields may be arranged regardless of the gray scale weight.

도 4는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례 를 설명하기 위한 도면이다. 여기, 도 4는 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널을 동작시키는 방법의 일례를 설명하는 것으로서, 본 발명이 도 4에 한정되는 것은 아니고, 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널을 동작시키는 방법은 다양하게 변경될 수 있다.4 is a view for explaining an example of the operation of the plasma display device according to an embodiment of the present invention. 4 is a view illustrating an example of a method of operating a plasma display panel according to an embodiment of the present invention. The present invention is not limited to FIG. 4, and the plasma display panel according to an embodiment of the present invention is described. The method of operation may be variously changed.

도 4를 살펴보면, 초기화를 위한 리셋 기간의 셋업(Set-Up) 기간에서는 구동부는 스캔 전극(Y)으로 상승 램프(Ramp-Up) 신호를 인가한다. 즉, 스캔 전극(Y)으로 전압이 점진적으로 상승하는 신호를 인가하는 것이다.Referring to FIG. 4, in the set-up period of the reset period for initialization, the driving unit applies a ramp-up signal to the scan electrode Y. That is, a signal in which the voltage gradually rises is applied to the scan electrode (Y).

여기서, 상승 램프 신호는 제 1 전압(V1)부터 제 2 전압(V2)까지 점진적으로 상승하는 제 1 상승 램프 신호와, 제 2 전압(V2)부터 제 3 전압(V3)까지 점진적으로 상승하는 제 2 상승 램프 신호를 포함할 수 있다.Here, the rising ramp signal is a first rising ramp signal that gradually rises from the first voltage V1 to the second voltage V2, and a rising ramp signal that gradually rises from the second voltage V2 to the third voltage V3. It may include a two rising ramp signal.

또한, 제 1 상승 램프 신호와 제 2 상승 램프 신호의 사이에는 평탄 기간이 포함될 수 있다.In addition, a flat period may be included between the first rising ramp signal and the second rising ramp signal.

이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓일 수 있다.In this setup period, a weak dark discharge, that is, setup discharge, occurs in the discharge cell by the rising ramp signal. By this setup discharge, some wall charges can be accumulated in the discharge cells.

이러한 제 1 상승 램프 신호와 제 2 상승 램프 신호 및 평탄 기간에 대해서는 도 5에서 상세히 설명하도록 한다.The first rising ramp signal, the second rising ramp signal, and the flat period will be described in detail with reference to FIG. 5.

여기서, 제 2 전압(V2)의 크기는 리셋 기간 이후의 어드레스 기간에서 스캔 전극(Y)으로 인가되는 스캔 바이어스 신호의 전압의 크기(Vsc)와 실질적으로 동일한 것이 바람직하다.Here, it is preferable that the magnitude of the second voltage V2 is substantially the same as the magnitude Vsc of the voltage of the scan bias signal applied to the scan electrode Y in the address period after the reset period.

그리고 제 3 전압(V3)의 크기는 리셋 기간 이후의 어드레스 기간에서 스캔 전극(Y)으로 인가되는 스캔 바이어스 신호의 전압의 크기(Vsc)와 어드레스 기간 이후의 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 인가되는 서스테인 신호의 전압의 크기(Vs)의 합과 실질적으로 동일한 것이 바람직하다.The magnitude of the third voltage V3 is the magnitude Vsc of the voltage of the scan bias signal applied to the scan electrode Y in the address period after the reset period and the scan electrode Y and / or in the sustain period after the address period. Alternatively, the sum of the magnitudes of the voltages Vs of the sustain signal applied to the sustain electrode Z may be substantially the same.

셋업 기간 이후의 셋다운(Set-Down) 기간에서는 제 3 전압(V)부터 제 4 전압(V4)까지 하강한 후 제 4 전압(V4)부터 제 5 전압(V5)까지 하강하고, 이후에 셋업 기간의 상승 램프 신호와 반대 극성 방향의 하강 램프(Ramp-Down) 신호가 스캔 전극에 공급될 수 있다.In the set-down period after the set-up period, the voltage drops from the third voltage V to the fourth voltage V4 and then drops from the fourth voltage V4 to the fifth voltage V5, and then the setup period. A ramp-down signal in a direction opposite to that of the rising ramp signal of may be supplied to the scan electrode.

여기서, 하강 램프 신호는 제 4 전압(V4)부터 제 5 전압(V5)까지 하강하는 것이 바람직하다.Here, the falling ramp signal is preferably lowered from the fourth voltage V4 to the fifth voltage V5.

이러한 하강 램프 신호가 공급됨에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.As the falling ramp signal is supplied, a weak erase discharge, that is, a setdown discharge, occurs in the discharge cell. By this set-down discharge, wall charges such that address discharge can be stably generated in the discharge cells remain uniformly.

리셋 기간 이후의 어드레스 기간에서는 하강 램프 신호의 최저 전압, 즉 제 5 전압(V5)보다는 높은 전압, 예컨대 제 6 전압(V6)을 실질적으로 유지하는 스캔 바이어스 신호가 스캔 전극에 공급된다.In the address period after the reset period, a scan bias signal that substantially maintains the lowest voltage of the falling ramp signal, that is, a voltage higher than the fifth voltage V5, for example, the sixth voltage V6, is supplied to the scan electrode.

여기서, 제 5 전압(V5)부터 제 6 전압(V6)까지 상승 램프 신호가 공급될 수 있고, 상승 램프 신호는 리셋 기간의 제 1 상승 램프 신호와 실질적으로 동일한 기울기로 상승할 수 있다.Here, the rising ramp signal may be supplied from the fifth voltage V5 to the sixth voltage V6, and the rising ramp signal may rise at substantially the same slope as the first rising ramp signal of the reset period.

이후, 스캔 바이어스 신호로부터 하강하는 스캔 신호가 스캔 전극에 공급될 수 있다.Thereafter, a scan signal falling from the scan bias signal may be supplied to the scan electrode.

한편, 적어도 하나의 서브필드의 어드레스 기간에서 스캔 전극으로 공급되는 스캔 신호(Scan)의 펄스폭은 다른 서브필드의 스캔 신호의 펄스폭과 다를 수 있다. 예컨대, 시간상 뒤에 위치하는 서브필드에서의 스캔 신호의 폭이 앞에 위치하는 서브필드에서의 스캔 신호의 폭보다 작을 수 있다. 또한, 서브필드의 배열 순서에 따른 스캔 신호 폭의 감소는 2.6㎲(마이크로초), 2.3㎲, 2.1㎲, 1.9㎲ 등과 같이 점진적으로 이루어질 수 있거나 2.6㎲, 2.3㎲, 2.3㎲, 2.1㎲......1.9㎲, 1.9㎲ 등과 같이 이루어질 수도 있다.Meanwhile, the pulse width of the scan signal Scan supplied to the scan electrode in the address period of at least one subfield may be different from the pulse width of the scan signal of another subfield. For example, the width of the scan signal in the subfield located later in time may be smaller than the width of the scan signal in the preceding subfield. In addition, the reduction of the scan signal width according to the arrangement order of the subfields can be made gradually, such as 2.6 Hz (microseconds), 2.3 Hz, 2.1 Hz, 1.9 Hz, or 2.6 Hz, 2.3 Hz, 2.3 Hz, 2.1 Hz. .... 1.9 ㎲, 1.9 ㎲ and so on.

이와 같이, 스캔 신호가 스캔 전극으로 공급될 때, 스캔 신호에 대응되게 어드레스 전극에 데이터 신호가 공급될 수 있다.As such, when the scan signal is supplied to the scan electrode, the data signal may be supplied to the address electrode corresponding to the scan signal.

이러한 스캔 신호와 데이터 신호가 공급되면, 스캔 신호와 데이터 신호 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호가 공급되는 방전 셀 내에는 어드레스 방전이 발생될 수 있다.When the scan signal and the data signal are supplied, an address discharge may be generated in the discharge cell to which the data signal is supplied while the voltage difference between the scan signal and the data signal and the wall voltage generated by the wall charges generated in the reset period are added. .

여기서, 어드레스 기간에서 서스테인 전극의 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 서스테인 전극에 서스테인 바이어스 신호가 공급될 수 있다.Here, the sustain bias signal may be supplied to the sustain electrode in order to prevent the address discharge from becoming unstable due to the interference of the sustain electrode in the address period.

서스테인 바이어스 신호는 서스테인 기간에서 공급되는 서스테인 신호의 전압보다는 작고 그라운드 레벨(GND)의 전압보다는 큰 서스테인 바이어스 전압(Vz)을 실질적으로 일정하게 유지할 수 있다.The sustain bias signal can keep the sustain bias voltage Vz smaller than the voltage of the sustain signal supplied in the sustain period and larger than the voltage of the ground level GND.

이후, 영상 표시를 위한 서스테인 기간에서는 스캔 전극 또는 서스테인 전극 중 적어도 하나에 서스테인 신호가 공급될 수 있다. 예를 들면, 스캔 전극과 서스테인 전극에 교번적으로 서스테인 신호가 공급될 수 있다.Subsequently, in the sustain period for displaying an image, a sustain signal may be supplied to at least one of the scan electrode and the sustain electrode. For example, a sustain signal may be alternately supplied to the scan electrode and the sustain electrode.

이러한 서스테인 신호가 공급되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호의 서스테인 전압(Vs)이 더해지면서 서스테인 신호가 공급될 때 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 발생될 수 있다.When such a sustain signal is supplied, the discharge cell selected by the address discharge is added with the wall voltage in the discharge cell and the sustain voltage Vs of the sustain signal, and a sustain discharge, i.e., display between the scan electrode and the sustain electrode when the sustain signal is supplied. Discharge may occur.

한편, 적어도 하나의 서브필드에서는 서스테인 기간에서 복수의 서스테인 신호가 공급되고, 복수의 서스테인 신호 중 적어도 하나의 서스테인 신호의 펄스폭은 다른 서스테인 신호의 펄스폭과 다를 수 있다. 예를 들면, 복수의 서스테인 신호 중 가장 먼저 공급되는 서스테인 신호의 펄스폭이 다른 서스테인 신호의 펄스폭보다 클 수 있다. 그러면, 서스테인 방전이 더욱 안정될 수 있다.Meanwhile, in the at least one subfield, a plurality of sustain signals are supplied in the sustain period, and the pulse width of at least one sustain signal of the plurality of sustain signals may be different from the pulse widths of other sustain signals. For example, the pulse width of the sustain signal that is supplied first of the plurality of sustain signals may be larger than the pulse width of other sustain signals. Then, the sustain discharge can be more stabilized.

도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 리셋 신호에 대해 설명하기 위한 도면이다.5 is a view for explaining a reset signal of the plasma display device according to an embodiment of the present invention.

도 5를 살펴보면, 서브필드의 초기화를 위한 리셋 기간 동안 스캔 전극에는 제 1 전압(V1)부터 제 2 전압(V2)까지 점진적으로 상승하는 제 1 상승 램프 신호가 공급되고, 제 2 전압(V2)이 유지되는 평탄 기간(h) 및 제 2 전압(V2)부터 제 3 전압(V3)까지 상승하는 제 2 상승 램프 신호가 공급될 수 있다.Referring to FIG. 5, the scan electrode is supplied with a first rising ramp signal that gradually rises from the first voltage V1 to the second voltage V2 during the reset period for initializing the subfield, and the second voltage V2. The flattened period h and the second rising ramp signal rising from the second voltage V2 to the third voltage V3 may be supplied.

또한, 제 3 전압(V3)에서 제 4 전압(V4)까지 전압이 하강하고, 제 4 전압(V4)에서 제 5 전압(V5)까지는 전압이 점진적으로 하강하는 하강 램프 신호가 더 공급될 수 있다.In addition, a falling ramp signal in which the voltage decreases from the third voltage V3 to the fourth voltage V4 and the voltage gradually decreases from the fourth voltage V4 to the fifth voltage V5 may be further supplied. .

여기서, 제 1 전압(V1)에서 제 3 전압(V3)까지 상승하면서 상승 램프 신호에 의해 방전 셀 내에는 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 벽 전하(Wall Charge)가 쌓일 수 있다.Here, the set-up discharge occurs in the discharge cell by the rising ramp signal while rising from the first voltage V1 to the third voltage V3. By this setup discharge, wall charges can accumulate in the discharge cells.

이 과정에서 전압이 상승함에 따라 벽 전하의 분포가 균일하지 못하여, 특정부분에 벽 전하가 모여있거나 혹은 특정부분에 벽 전하가 분포되지 않은 상태가 될 수 있다.In this process, as the voltage rises, the wall charge distribution may not be uniform, so that wall charges may be collected in a specific part or may be in a state in which wall charges are not distributed in a particular part.

따라서, 제 1 전압(V1)과 제 3 전압(V3)의 사이에 제 2 전압(V2)을 갖는 평탄 기간(h)을 삽입하여, 방전이 발생하는 중간에 끊어주는 역할을 할 수 있게 된다.Therefore, the planar period h having the second voltage V2 is inserted between the first voltage V1 and the third voltage V3 to serve as a breaker between discharges.

이에 따라 균일하게 분포되지 못한 벽 전하를 재분배할 수 있게 되어, 오방전 발생을 감소시키고 방전을 안정되게 할 수 있다.This makes it possible to redistribute wall charges which are not uniformly distributed, thereby reducing the occurrence of erroneous discharge and making the discharge stable.

여기서, 제 1 전압(V1)에서 제 2 전압(V2)까지 상승하는 제 1 상승 램프 신호의 기울기와, 제 2 전압에서 제 3 전압까지 상승하는 제 2 상승 램프 신호의 기울기는 서로 같을 수도 있고, 다를 수도 있다.Here, the slope of the first rising ramp signal rising from the first voltage V1 to the second voltage V2 and the slope of the second rising ramp signal rising from the second voltage to the third voltage may be equal to each other, It may be different.

하지만, 제 1 상승 램프 신호의 기울기가 제 2 상승 램프 신호의 기울기보다 더 큰 것이 바람직할 수 있다.However, it may be desirable for the slope of the first rising ramp signal to be greater than the slope of the second rising ramp signal.

제 1 상승 램프 신호의 기울기가 제 2 상승 램프 신호의 기울기보다 더 크면, 평탄 기간(h) 이전에는 전압을 신속히 상승시키고, 평탄 기간(h) 이후에는 전압을 상대적으로 천천히 상승시키는 효과를 획득할 수 있어서, 셋업 방전을 더욱 안정시키는 것이 가능하다.If the slope of the first rising ramp signal is greater than the slope of the second rising ramp signal, the effect of rapidly raising the voltage before the flat period h and increasing the voltage relatively slowly after the flat period h is obtained. It is possible to further stabilize the setup discharge.

이에 따라, 셋업 방전의 지속 시간이 상대적으로 길어지고 또한, 셋업 방전이 안정됨으로써 벽 전하의 분포를 균일하게 할 수 있는 것이다.As a result, the duration of the setup discharge becomes relatively long, and the setup discharge is stabilized, so that the distribution of the wall charges can be made uniform.

또한, 제 2 전압(V2)은 제 1 전압(V1)과 제 3 전압(V3) 사이의 전압 레벨이라면 어떠한 것도 가능하다.In addition, the second voltage V2 may be any voltage as long as it is a voltage level between the first voltage V1 and the third voltage V3.

그러나, 제 2 전압(V2)은 구동부에 포함되는 회로에서 적용되고 있는 전압원에서 공급되는 전압을 사용하는 것이 용이할 수 있다.However, the second voltage V2 may be easy to use a voltage supplied from a voltage source applied in a circuit included in the driver.

예를 들면, 어드레스 기간 이후의 서스테인 기간에서 스캔 전극으로 공급되는 서스테인 전압(Vs)인 것이 바람직할 수 있고, 리셋 기간 이후의 어드레스 기간에서 스캔 전극으로 공급되는 스캔 바이어스 전압(Vsc)일 수도 있다.For example, the sustain voltage Vs supplied to the scan electrode in the sustain period after the address period may be preferable, and the scan bias voltage Vsc supplied to the scan electrode in the address period after the reset period.

아울러, 제 2 전압(V2)과 제 4 전압(V4)은 같을 수도 다를 수도 있다.In addition, the second voltage V2 and the fourth voltage V4 may be the same or different.

구동의 편의상 제 2 전압(V2)과 제 4 전압(V4)은 같은 전압 레벨인 것이 바람직할 수 있으나, 전압의 크기에 구애받지 않고 서로 다른 전압 레벨로 다양한 형태의 적용이 가능하다.For convenience of driving, the second voltage V2 and the fourth voltage V4 may be preferably at the same voltage level, but various types of applications may be applied at different voltage levels regardless of the magnitude of the voltage.

또한, 평탄 기간(h)의 길이는 2㎲이상 300㎲이하인 것이 바람직할 수 있고, 더욱 바람직하게는 10㎲이상 100㎲이하로 설정할 수 있다.In addition, it is preferable that the length of the flat period h is 2 mW or more and 300 mW or less, and more preferably 10 mW or more and 100 mW or less.

여기서, 평탄 기간(h)의 길이가 과도하게 짧은 경우에는 벽 전하들을 균일하게 분포하기 위한 시간적 여유가 부족할 수 있고, 이에 따라 오방전이 발생할 가능성이 높다.In this case, when the length of the planar period h is excessively short, there may be a lack of time for uniformly distributing the wall charges, and thus, there is a high possibility of false discharge.

또한, 평탄 기간(h)의 길이가 과도하게 긴 경우에는 평탄 기간(h)을 포함하 는 리셋 기간의 길이가 과도하게 길어져 이후의 어드레스 기간이나 서스테인 기간의 길이가 상대적으로 짧아지게 되어 어드레싱 동작이나 서스테인 방전에 좋지않은 영향을 미칠 수 있다.In addition, when the length of the flat period h is excessively long, the length of the reset period including the flat period h becomes excessively long, so that the length of subsequent address periods or sustain periods becomes relatively short. This can adversely affect sustain discharge.

이러한 이유로 평탄 기간(h)의 길이는 2㎲이상 300㎲이하인 것이 바람직할 수 있고, 더욱 바람직하게는 10㎲이상 100㎲이하로 설정할 수 있다.For this reason, it may be preferable that the length of the flat period h is 2 mW or more and 300 mW or less, more preferably 10 mW or more and 100 mW or less.

도 6은 프리 리셋 신호에 대해 설명하기 위한 도면이다.6 is a diagram for explaining a pre-reset signal.

도 6을 살펴보면, 제 1 서브필드의 리셋 기간 이전에 프리 리셋 기간(Pre-Reset Period)이 더 포함될 수 있다. 이러한 프리 리셋 기간에서 스캔 전극에는 리셋 기간에서 스캔 전극에 공급되는 리셋 신호와 부극성인 제 1 신호가 공급될 수 있다.Referring to FIG. 6, a pre-reset period may be further included before the reset period of the first subfield. In this pre-reset period, the scan electrode may be supplied with a first signal that is negative from the reset signal supplied to the scan electrode in the reset period.

또한, 스캔 전극에 제 1 신호가 공급되는 동안 리셋 신호와 정극성인 제 2 신호가 서스테인 전극에 공급될 수 있다.In addition, while the first signal is supplied to the scan electrode, a second signal that is positive from the reset signal may be supplied to the sustain electrode.

제 2 신호의 전압의 크기는 서스테인 기간에서 공급되는 서스테인 신호의 전압, 즉 서스테인 전압(Vs)과 대략 동일할 수 있다.The magnitude of the voltage of the second signal may be approximately equal to the voltage of the sustain signal supplied in the sustain period, that is, the sustain voltage Vs.

이와 같이, 프리 리셋 기간에서 스캔 전극에 제 1 신호가 공급되고, 서스테인 전극에 제 2 신호가 공급되면 스캔 전극 상에 소정 극성의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극 상에는 스캔 전극과 반대 극성의 벽 전하들이 쌓인다. 예를 들면, 스캔 전극 상에는 양(+)의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극 상에는 음(-)의 벽 전하가 쌓일 수 있다.As such, when the first signal is supplied to the scan electrode and the second signal is supplied to the sustain electrode in the pre-reset period, wall charges of a predetermined polarity are accumulated on the scan electrode, and the polarity opposite to the scan electrode is on the sustain electrode. Wall charges accumulate. For example, a positive wall charge may be accumulated on the scan electrode, and a negative wall charge may be accumulated on the sustain electrode.

이에 따라, 프리 리셋 기간 이후의 리셋 기간에서 충분한 세기의 셋업 방전 을 발생시킬 수 있게 되고, 결국 초기화를 충분히 안정적으로 수행할 수 있게 된다.Accordingly, it is possible to generate a setup discharge of sufficient intensity in the reset period after the pre-reset period, and thus, the initialization can be sufficiently stable.

아울러, 리셋 기간에서 스캔 전극으로 공급되는 상승 램프 신호의 전압이 더 작아지더라도 충분한 세기의 셋업 방전을 발생시킬 수 있게 된다.In addition, even if the voltage of the rising ramp signal supplied to the scan electrode becomes smaller in the reset period, it is possible to generate the setup discharge of sufficient intensity.

구동 시간을 확보하는 관점에서 프레임의 서브필드 중에서 가장 먼저 배열되는 서브필드에서의 리셋 기간이전에 프리 리셋 기간이 포함되거나 2개 또는 3개의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되는 것도 가능하다.From the viewpoint of securing the driving time, the pre-reset period may be included before the reset period in the first subfield among the subfields of the frame or the pre-reset period before the reset period in the two or three subfields. Do.

도 7a 내지 도 7b는 리셋 신호의 다른 일례에 대해 설명하기 위한 도면이다.7A to 7B are diagrams for explaining another example of the reset signal.

먼저, 도 7a의 리셋 신호는 그라운드 전압으로부터 평탄 기간(h)까지 점진적으로 상승하는 상승 램프 신호를 포함할 수 있고, 이후 평탄 기간(h)을 포함하여 일정 전압을 유지하다가 추가의 상승 램프 신호의 공급 없이 전압이 하강한 후, 전압이 점진적으로 하강하는 램프 신호를 포함할 수 있다.First, the reset signal of FIG. 7A may include a rising ramp signal that gradually rises from the ground voltage to the flat period h, and then maintains a constant voltage, including the flat period h, of the additional rising ramp signal. After the voltage drops without supply, it may include a ramp signal in which the voltage gradually falls.

이러한 경우에도 평탄 기간(h) 길이는 도 5에서와 마찬가지로 2㎛이상 300㎛이하인 것이 바람직할 수 있고, 더욱 바람직하게는 10㎛이상 100㎛이하일 수 있다.In this case, the length of the flat period h may be preferably 2 μm or more and 300 μm or less, and more preferably 10 μm or more and 100 μm or less as in FIG. 5.

다음, 도 7b의 리셋 신호에서는 그라운드 전압으로부터 일정 전압까지 전압이 급격히 상승한 후, 평탄 기간(h)까지 점진적으로 상승하는 상승 램프 신호를 포함할 수 있고, 이후 평탄 기간(h)을 포함하여 일정 전압을 유지하다가 추가의 상승 램프 신호의 공급 없이 전압이 하강한 후, 전압이 점진적으로 하강하는 램프 신호를 포함할 수 있다.Next, the reset signal of FIG. 7B may include a rising ramp signal that gradually rises up to a flat period h after the voltage rises rapidly from the ground voltage to a predetermined voltage, and then includes a constant voltage including the flat period h. It may include a ramp signal that maintains and after the voltage falls without the supply of additional rising ramp signal, the voltage gradually falls.

또한, 이러한 경우에서도 평탄 기간(h) 길이는 2㎛이상 300㎛이하인 것이 바 람직할 수 있고, 더욱 바람직하게는 10㎛이상 100㎛이하일 수 있다.Also in this case, the flat period h may be preferably 2 µm or more and 300 µm or less, and more preferably 10 µm or more and 100 µm or less.

이상에서와 같이, 도 7a와 도 7b의 리셋 신호에서는 평탄 기간(h) 이후에 공급될 수 있는 상승 램프 신호가 생략된 형태일 수 있다.As described above, in the reset signal of FIGS. 7A and 7B, the rising ramp signal that may be supplied after the flat period h may be omitted.

아울러, 여기 도 7a 및 도 7b에서의 평탄 기간의 전압은 도 5와 마찬가지로 전압의 크기에 관계없이 어떠한 전압 레벨이라도 가능할 수 있지만, 리셋 기간 이후의 어드레스 기간에서 스캔 전극으로 공급되는 스캔 바이어스 전압(Vsc)이거나, 어드레스 기간 이후의 서스테인 기간에서 스캔 전극으로 공급되는 스캔 전압(Vs)인 것이 바람직할 수 있다.7A and 7B, the voltage of the flat period may be any voltage level regardless of the magnitude of the voltage as in FIG. 5, but the scan bias voltage Vsc supplied to the scan electrode in the address period after the reset period may be used. Or scan voltage Vs supplied to the scan electrodes in the sustain period after the address period.

이와 같이, 리셋 신호의 형태는 도 5에서 설명한 리셋 신호의 형태로만 제한되지않고, 여기 도 7a 내지 도 7b에서 설명한 리셋 신호뿐만 아니라, 설명하지 않은 다른 형태의 리셋 신호라도 리셋 신호에 평탄 기간(h)이 포함되는 것이라면 다양한 형태로 변경 및 적용이 가능하다.As such, the form of the reset signal is not limited to the form of the reset signal described with reference to FIG. 5, and the reset signal described with reference to FIGS. 7A to 7B as well as other types of reset signals not described herein may be used for the flat period h. ) Can be changed and applied in various forms.

한편, 플라즈마 디스플레이 패널의 방전 가스에는 크세논(Xe)이 포함될 수 있고, 크세논의 함량을 증가시키게 되면 방전 셀 내에서 진공 자외선의 발생량을 증가시킴으로써, 휘도를 증가시킬 수 있다.Meanwhile, xenon (Xe) may be included in the discharge gas of the plasma display panel, and when the xenon content is increased, the luminance may be increased by increasing the generation amount of vacuum ultraviolet rays in the discharge cell.

반면에, 크세논의 함량을 증가시키게 되면 벽 전하가 균일하게 분포되지 않고 특정부분에 많이 모이게 되는 현상이 더욱 빈번하게 발생할 수 있다.On the other hand, if the xenon content is increased, the wall charge is not uniformly distributed, and a lot of phenomenon may occur more frequently in a certain part.

이에 따라, 벽 전하가 뭉쳐있는 곳에서 과도하게 강한 방전이 발생하거나, 오방전이 발생할 확률이 더욱 증가하게 될 수 있다.Accordingly, an excessively strong discharge may occur in a place where the wall charges are aggregated, or the probability of occurrence of an erroneous discharge may be further increased.

따라서, 크세논이 많이 함유된 플라즈마 디스플레이 패널에 평탄 기간이 포 함된 리셋 신호를 공급하면, 크세논 함량이 증가함에 따라 특정부분에 뭉칠 수 있는 벽 전하를 균일하게 분포할 수 있고, 이에 따라 오방전을 방지할 수 있게 된다.Therefore, when a reset signal including a flat period is supplied to a plasma display panel containing a large amount of xenon, as the xenon content is increased, wall charges that may be collected in a specific portion may be uniformly distributed, thereby preventing mis-discharge. You can do it.

이에 따라, 크세논 함량의 증가에 따른 벽 전가 특정 부분에 뭉치게 되는 현상을 평탄 기간이 포함된 리셋 신호를 공급함으로써 더욱 효과적으로 방지할 수 있는 것이다.Accordingly, the phenomenon that the wall transfer due to the increase of the xenon content is agglomerated in a specific portion can be more effectively prevented by supplying a reset signal including a flat period.

이러한 크세논의 함량에 대해 첨부된 도 8a 내지 도 8b를 참조하여 살펴보면 다음과 같다.Looking at the content of such xenon with reference to the accompanying Figures 8a to 8b as follows.

도 8a 내지 도 8b는 방전 가스에 포함되는 크세논의 함유량에 대해 설명하기 위한 도면이다.8A to 8B are diagrams for explaining the content of xenon contained in the discharge gas.

도 8a 내지 도 8b에는 영상 필터의 유리 기판에는 코발트 재질의 청색 안료가 포함되어 있는 상태에서, 방전 가스에 크세논(Xe)이 포함되고, 크세논(Xe)의 함량을 5%에서 25%까지 변경하면서 25% 윈도우 패턴 영상을 화면에 표시할 때의 휘도 및 스캔 전극과 서스테인 전극 사이의 방전 개시 전압(Firing Voltage)을 측정한 데이터가 도시되어 있다.8A to 8B, xenon (Xe) is included in the discharge gas while the glass substrate of the image filter contains a blue pigment of cobalt material, and the content of xenon (Xe) is changed from 5% to 25%. Data showing luminance when the 25% window pattern image is displayed on the screen, and measuring a discharge start voltage (Firing Voltage) between the scan electrode and the sustain electrode are shown.

도 8a를 살펴보면, 방전 가스에서 크세논(Xe)의 함량이 대략 5%인 경우에는 구현되는 영상의 휘도가 328[cd/m2]이고, 9%인 경우에는 대략 345[cd/m2]로서, 상대적으로 작다.Referring to FIG. 8A, when the content of xenon (Xe) in the discharge gas is about 5%, the luminance of the implemented image is 328 [cd / m 2 ], and when 9% is about 345 [cd / m 2 ]. , Relatively small.

반면에, 크세논(Xe)의 함량이 10%인 경우에는 휘도가 대략 351[cd/m2]로 증가한다. 이와 같이, 크세논(Xe)의 함량이 증가함에 따라 휘도가 증가한 것은 크세 논(Xe)은 방전 시 진공 자외선의 발생을 증가시킬 수 있는 특성을 갖고, 이에 따라 방전 셀 내에 채워진 방전 가스의 크세논(Xe) 함량이 증가하게 되면 방전 셀에서 발생하는 광의 양이 증가하기 때문이다.On the other hand, when the content of xenon (Xe) is 10%, the luminance increases to approximately 351 [cd / m 2 ]. As such, as the content of xenon (Xe) is increased, the brightness is increased. Xenon (Xe) has a characteristic of increasing the generation of vacuum ultraviolet rays during discharge, and thus xenon (Xe) of the discharge gas filled in the discharge cell. This is because the amount of light generated in the discharge cell increases as the content increases.

또한, 크세논(Xe)의 함량이 11%인 경우에는 휘도가 대략 353[cd/m2]이고, 크세논(Xe)의 함량이 대략 12%이상 15%이하인 경우에는 휘도가 371[cd/m2]이상 391[cd/m2]이하의 높은 값을 갖는다.In addition, when the content of xenon (Xe) is 11%, the luminance is about 353 [cd / m 2 ], and when the content of xenon (Xe) is about 12% or more and 15% or less, the brightness is 371 [cd / m 2]. ] And higher than 391 [cd / m 2 ].

또한, 크세논(Xe)의 함량이 16%이상인 경우에는 휘도가 대략 395[cd/m2]이상이다.In addition, when the content of xenon (Xe) is 16% or more, the luminance is approximately 395 [cd / m 2 ] or more.

이상의 도 8a의 데이터를 살펴보면 크세논(Xe)의 함량이 10%이상 20%이하의 범위 내에서는 크세논(Xe)의 함량이 증가할수록 구현되는 영상의 휘도는 점진적으로 증가하지만, Referring to the data of FIG. 8A, when the xenon (Xe) content is in the range of 10% or more and 20% or less, as the xenon (Xe) content is increased, the luminance of the implemented image is gradually increased.

크세논(Xe)의 함량이 25%이상인 경우에는 휘도 향상 효과가 미미해짐을 알 수 있다.If the content of xenon (Xe) is more than 25% it can be seen that the effect of improving the brightness is insignificant.

다음, 도 8b를 살펴보면, 방전 가스에서 크세논(Xe)의 함량이 대략 5%인 경우에는 스캔 전극과 서스테인 전극 간의 방전 개시 전압이 대략 135V이고, 9%인 경우에는 대략 136V로서, 상대적으로 작다.Next, referring to FIG. 8B, when the content of xenon (Xe) in the discharge gas is about 5%, the discharge start voltage between the scan electrode and the sustain electrode is about 135V, and when it is 9%, it is about 136V, which is relatively small.

반면에, 크세논(Xe)의 함량이 10%인 경우에는 방전 개시 전압은 대략 137V로 증가한다.On the other hand, when the content of xenon (Xe) is 10%, the discharge start voltage increases to approximately 137V.

또한, 크세논(Xe)의 함량이 11%인 경우에는 방전 개시 전압이 대략 137V이고, 크세논(Xe)의 함량이 대략 12%이상 15%이하인 경우에는 방전 개시 전압이 대략 138V이상 140V이하이다.In addition, when the content of xenon (Xe) is 11%, the discharge start voltage is about 137V, and when the content of xenon (Xe) is about 12% or more and 15% or less, the discharge start voltage is about 138V or more and 140V or less.

또한, 크세논(Xe)의 함량이 16%이상 20%이하인 경우에는 방전 개시 전압이 대략 141V이상 143V이하이고, 크세논(Xe)의 함량이 25%이상인 경우에는 방전 개시 전압이 대략 153V이상으로 급격히 상승할 수 있다.In addition, when the content of xenon (Xe) is 16% or more and 20% or less, the discharge start voltage is approximately 141V or more and 143V or less, and when the content of xenon (Xe) is 25% or more, the discharge start voltage rapidly rises to approximately 153V or more. can do.

이상에서와 같이, 영상 필터의 유리 기판에 철이 포함되는 경우에도, 크세논(Xe)의 함량이 증가하면 구현되는 영상의 휘도가 증가하고, 이와는 반대로 스캔 전극과 서스테인 전극 사이의 방전 개시 전압이 상승함을 알 수 있다.As described above, even when iron is included in the glass substrate of the image filter, when the content of xenon (Xe) is increased, the luminance of the image is increased, and conversely, the discharge start voltage between the scan electrode and the sustain electrode is increased. It can be seen.

따라서 자외선 차단율을 높여 플라즈마 디스플레이 패널의 발광 효율을 향상시키면서도 구현되는 영상의 휘도를 충분히 높게 유지하기 위해, 전면 기판과 후면 기판 사이에는 채워지는 방전 가스는 크세논(Xe)을 10%이상 20%이하 포함하는 것이 바람직할 수 있고, 더욱 바람직하게는 12%이상 15%이하 포함할 수 있다.Therefore, in order to increase the UV blocking rate and improve the luminous efficiency of the plasma display panel while maintaining the luminance of the image sufficiently high, the discharge gas filled between the front substrate and the rear substrate contains 10% or more of xenon (Xe) to 20% or less. It may be preferable, and more preferably may comprise 12% or more and 15% or less.

이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.As such, the technical configuration of the present invention described above can be understood by those skilled in the art that the present invention can be implemented in other specific forms without changing the technical spirit or essential features of the present invention.

그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범 위에 포함되는 것으로 해석되어야 한다.Therefore, the exemplary embodiments described above are to be understood as illustrative and not restrictive in all respects, and the scope of the present invention is indicated by the appended claims rather than the foregoing detailed description, and the meaning and scope of the claims are as follows. And all changes or modifications derived from the equivalent concept should be interpreted as being included in the scope of the present invention.

도 1은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 구성에 대해 설명하기 위한 도면.1 is a view for explaining the configuration of a plasma display device according to an embodiment of the present invention.

도 2는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에 포함될 수 있는 플라즈마 디스플레이 패널의 구조를 설명하기 위한 도면.2 is a view for explaining the structure of a plasma display panel that can be included in a plasma display device according to an embodiment of the present invention.

도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 영상 프레임(Frame)에 대해 설명하기 위한 도면.FIG. 3 is a diagram illustrating an image frame for implementing grayscale of an image in a plasma display device according to an embodiment of the present invention. FIG.

도 4는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면.4 is a view for explaining an example of the operation of the plasma display device according to an embodiment of the present invention.

도 5는 본 발명의 일실시예에 따른 플라즈마 디스플레이 장치의 리셋 신호에 대해 설명하기 위한 도면.5 is a view for explaining a reset signal of the plasma display device according to an embodiment of the present invention.

도 6은 프리 리셋 신호에 대해 설명하기 위한 도면.6 is a diagram for explaining a pre-reset signal;

도 7a 내지 도 7b는 리셋 신호의 다른 일례에 대해 설명하기 위한 도면.7A to 7B are views for explaining another example of the reset signal.

도 8a 내지 도 8b는 방전 가스에 포함되는 크세논의 함유량에 대해 설명하기 위한 도면.8A to 8B are views for explaining the content of xenon contained in the discharge gas.

Claims (9)

스캔 전극과 서스테인 전극이 배치되는 플라즈마 디스플레이 패널과,A plasma display panel in which scan electrodes and sustain electrodes are disposed; 상기 스캔 전극 및 상기 서스테인 전극에 구동 신호를 공급하는 구동부A driver supplying a driving signal to the scan electrode and the sustain electrode 를 포함하고,Including, 상기 구동부는 프레임의 복수의 서브필드의 초기화를 위한 리셋 기간 동안 상기 스캔 전극으로 제 1 전압에서 제 2 전압까지 상승하는 제 1 상승 램프 신호 및 상기 제 2 전압에서 제 3 전압까지 상승하는 제 2 상승 램프 신호를 포함하는 리셋 신호를 공급하고,The driving unit includes a first rising ramp signal rising from a first voltage to a second voltage and a second rising ramp from a second voltage to a third voltage to the scan electrode during a reset period for initializing a plurality of subfields of a frame. Supply a reset signal comprising a ramp signal, 상기 제 1 상승 램프 신호와 상기 제 2 상승 램프 신호의 사이에 일정 전압이 유지되는 평탄 기간(Flat-Period)Flat-Period in which a constant voltage is maintained between the first rising ramp signal and the second rising ramp signal. 을 포함하는 플라즈마 디스플레이 장치.Plasma display device comprising a. 제 1 항에 있어서,The method of claim 1, 상기 평탄 기간의 길이는 2㎛이상 300㎛이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the flat period has a length of 2 m or more and 300 m or less. 제 2 항에 있어서,The method of claim 2, 상기 평탄 기간의 길이는 10㎛이상 100㎛이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the flat period has a length of 10 µm or more and 100 µm or less. 제 1 항에 있어서,The method of claim 1, 상기 제 1 전압은 그라운드(GND) 전압인 것을 특징으로 하는 플라즈마 디스플레이 장치.And the first voltage is a ground (GND) voltage. 제 1 항에 있어서,The method of claim 1, 상기 제 2 전압은 서스테인 전압(Vs)인 것을 특징으로 하는 플라즈마 디스플레이 장치.And said second voltage is a sustain voltage (Vs). 제 1 항에 있어서,The method of claim 1, 상기 리셋 신호는 상기 복수의 서브필드 중 적어도 하나의 서브필드에 공급되는 것을 특징으로 하는 플라즈마 디스플레이 장치.And the reset signal is supplied to at least one subfield of the plurality of subfields. 제 1 항에 있어서,The method of claim 1, 상기 구동부는 상기 리셋 기간 이전의 프리 리셋 기간 동안 상기 스캔 전극으로 부극성 신호인 제 1 신호를 공급하고, 상기 서스테인 전극으로 정극성 신호인 제 2 신호를 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.And the driver supplies a first signal, which is a negative signal, to the scan electrode and a second signal, which is a positive signal, to the sustain electrode during the pre-reset period before the reset period. 제 1 항에 있어서,The method of claim 1, 상기 플라즈마 디스플레이 패널 내부에는 크세논(Xe)을 포함하는 방전 가스 가 채워지고,The plasma display panel is filled with a discharge gas including xenon (Xe), 상기 크세논의 함량은 10%이상 20%이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.The xenon content is 10% or more 20% or less plasma display device. 제 8 항에 있어서,The method of claim 8, 상기 크세논의 함량은 12%이상 15%이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.The xenon content is 12% or more and 15% or less plasma display device.
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