KR20090034092A - 플라즈마 디스플레이 패널의 구동 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 패널을 구동시키기 위한 장치에 관한 것으로, 그 구동 장치는 패널의 스캔 전극에 공급될 서스테인 신호를 생성하는 서스테인 구동부; 스캔 전극에 공급될 리셋 신호를 생성하는 리셋 구동부; 및 서스테인 구동부 및 리셋 구동부로부터 신호를 입력받아 스캔 전극에 구동 신호를 공급하는 스캔 IC를 포함하고, 스캔 IC를 제어하기 위한 제1 제어 신호 및 제2 제어 신호는 리셋 구간 및 서스테인 구간에서 각각 하이 레벨(high level) 전압 및 로우(low level) 레벨 전압을 가지며, 어드레스 구간에서 스캔 IC가 스캔 전극에 스캔 신호를 인가하는 시점은 제1 제어 신호에 의해 제어되는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동 장치에 의하면, 스캔 IC를 제어하기 위한 신호의 개수를 감소시킬 수 있으며, 구동 신호의 노이즈(noise) 및스캔 IC의 발열을 감소시킬 수 있다.
PDP, 스캔 IC, 스캔 신호

Description

플라즈마 디스플레이 패널의 구동 장치{Apparatus for driving plasma display panel}
본 발명은 플라즈마 디스플레이 패널을 구동시키기 위한 장치에 관한 것으로서, 보다 상세하게는 상기 패널에 포함된 스캔 전극들에 구동 신호를 공급하는 스캔 IC를 제어하는 방법에 관한 것이다.
플라즈마 디스플레이 장치는 격벽이 형성된 배면기판 및 이와 대향되는 전면기판 사이에 복수의 방전셀들이 형성되는 패널을 포함하고, 입력되는 영상 신호에 따라 상기 복수의 방전셀들을 선택적으로 방전시켜 상기 방전에 의해 발생하는 진공 자외선이 형광체를 발광시키도록 함으로써 영상을 디스플레이하는 장치이다.
플라즈마 디스플레이 패널은 복수의 스캔 전극들, 서스테인 전극들 및 어드레스 전극들을 포함하고, 패널의 구동 장치는 상기 복수의 전극들 각각에 구동 신호를 공급하여 상기 패널을 구동시킨다.
상기 플라즈마 디스플레이 패널을 구동함에 있어, 구동 신호에 노이즈(noise)가 발생하는 경우 디스플레이 영상의 화질이 저하되거나 패널 구동에 오류가 발생하는 문제가 있을 수 있으며, 상기 패널의 구동 장치에 열이 발생하여 구 동 회로가 손상되는 문제가 있을 수 있다.
본 발명의 기술적 과제는 상기와 같은 문제를 개선하기 위해, 플라즈마 디스플레이 패널에 공급되는 구동 신호의 노이즈 및 구동 회로의 발열을 감소시킬 수 있는 플라즈마 디스플레이 패널의 구동 장치를 제공하는데 있다.
상기한 기술적 과제를 해결하기 위한 본 발명에 의한 플라즈마 디스플레이 패널 구동 장치는, 상기 패널의 스캔 전극에 공급될 서스테인 신호를 생성하는 서스테인 구동부; 상기 스캔 전극에 공급될 리셋 신호를 생성하는 리셋 구동부; 및 상기 서스테인 구동부 및 리셋 구동부로부터 신호를 입력받아 상기 스캔 전극에 구동 신호를 공급하는 스캔 IC를 포함하고, 상기 스캔 IC를 제어하기 위한 제1 제어 신호 및 제2 제어 신호는 리셋 구간 및 서스테인 구간에서 각각 하이 레벨(high level) 전압 및 로우(low level) 레벨 전압을 가지며, 어드레스 구간에서 상기 스캔 IC가 상기 스캔 전극에 스캔 신호를 인가하는 시점은 상기 제1 제어 신호에 의해 제어되는 것을 특징으로 한다.
상기한 바와 같이 구성되는 본 발명에 따른 플라즈마 디스플레이 패널의 구동 장치에 의하면, 스캔 IC를 제어하기 위한 신호의 개수를 감소시킬 수 있으며, 구동 신호의 노이즈(noise) 및스캔 IC의 발열을 감소시킬 수 있다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 패널을 구동시키기 위한 구동 장치에 관하여 상세히 설명한다. 도 1은 플라즈마 디스플레이 패널의 구조에 대한 일실시예를 사시도로 도시한 것이다.
도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 상부기판(10) 상에 형성되는 유지 전극 쌍인 스캔 전극(11) 및 서스테인 전극(12), 하부기판(20) 상에 형성되는 어드레스 전극(22)을 포함한다.
상기 유지 전극 쌍(11, 12)은 통상 인듐틴옥사이드(Indium-Tin-Oxide;ITO)로 형성된 투명전극(11a, 12a)과 버스 전극(11b, 12b)을 포함하며, 상기 버스 전극(11b, 12b)은 은(Ag), 크롬(Cr) 등의 금속 또는 크롬/구리/크롬(Cr/Cu/Cr)의 적층형이나 크롬/알루미늄/크롬(Cr/Al/Cr)의 적층형으로 형성될 수 있다. 버스 전극(11b, 12b)은 투명전극(11a, 12a) 상에 형성되어, 저항이 높은 투명전극(11a, 12a)에 의한 전압 강하를 줄이는 역할을 한다.
한편, 본 발명의 일실시예에 따르면 유지 전극쌍(11, 12)은 투명전극(11a 12a)과 버스 전극(11b, 12b)이 적층된 구조 뿐만 아니라, 투명 전극(11a, 12a)이 없이 버스 전극(11b, 12b)만으로도 구성될 수 있다. 이러한 구조는 투명 전극(11a, 12a)을 사용하지 않으므로, 패널 제조의 단가를 낮출 수 있는 장점이 있다. 이러한 구조에 사용되는 버스 전극(11b, 12b)은 위에 열거한 재료 이외에 감광성 재료등 다양한 재료가 가능할 것이다.
스캔 전극(11) 및 서스테인 전극(12)의 투명전극(11a, 12a)과 버스전극(11b, 11c)의 사이에는 상부 기판(10)의 외부에서 발생하는 외부광을 흡수하여 반사를 줄 여주는 광차단의 기능과 상부 기판(10)의 퓨리티(Purity) 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, BM, 15)가 배열된다.
본 발명의 일실시예에 따른 블랙 매트릭스(15)는 상부 기판(10)에 형성되는데, 격벽(21)과 중첩되는 위치에 형성되는 제1 블랙 매트릭스(15)와, 투명전극(11a, 12a)과 버스전극(11b, 12b)사이에 형성되는 제2 블랙 매트릭스(11c, 12c)로 구성될 수 있다. 여기서, 제 1 블랙 매트릭스(15)와 블랙층 또는 블랙 전극층이라고도 하는 제 2 블랙 매트릭스(11c, 12c)는 형성 과정에서 동시에 형성되어 물리적으로 연결될 수 있고, 동시에 형성되지 않아 물리적으로 연결되지 않을 수도 있다.
또한, 물리적으로 연결되어 형성되는 경우, 제 1 블랙 매트릭스(15)와 제 2 블랙 매트릭스(11c, 12c)는 동일한 재질로 형성되지만, 물리적으로 분리되어 형성되는 경우에는 다른 재질로 형성될 수 있다.
스캔 전극(11)과 서스테인 전극(12)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(13)과 보호막(14)이 적층된다. 상부 유전체층(13)에는 방전에 의하여 발생된 하전입자들이 축적되고, 유지 전극 쌍(11, 12)을 보호하는 기능을 수행할 수 있다. 보호막(14)은 가스 방전시 발생된 하전입자들의 스피터링으로부터 상부 유전체층(13)을 보호하고, 2차 전자의 방출 효율을 높이게 된다.
또한, 어드레스 전극(22)은 스캔 전극(11) 및 서스테인 전극(12)과 교차되는 방향으로 형성된다. 또한, 어드레스 전극(22)이 형성된 하부기판(20) 상에는 하부 유전체층(23)과 격벽(21)이 형성된다.
또한, 하부 유전체층(24)과 격벽(21)의 표면에는 형광체층(23)이 형성된다. 격벽(21)은 세로 격벽(21a)와 가로 격벽(21b)가 폐쇄형으로 형성되고, 방전셀을 물리적으로 구분하며, 방전에 의해 생성된 자외선과 가시광이 인접한 방전셀에 누설되는 것을 방지한다.
본 발명의 일실시예에는 도 1에 도시된 격벽(21)의 구조뿐만 아니라, 다양한 형상의 격벽(21)의 구조도 가능할 것이다. 예컨대, 세로 격벽(21a)과 가로 격벽(21b)의 높이가 다른 차등형 격벽 구조, 세로 격벽(21a) 또는 가로 격벽(21b) 중 적어도 하나 이상에 배기 통로로 사용 가능한 채널(Channel)이 형성된 채널형 격벽 구조, 세로 격벽(21a) 또는 가로 격벽(21b) 중 하나 이상에 홈(Hollow)이 형성된 홈형 격벽 구조 등이 가능할 것이다.
여기서, 차등형 격벽 구조인 경우에는 가로 격벽(21b)의 높이가 높은 것이 더 바람직하고, 채널형 격벽 구조나 홈형 격벽 구조인 경우에는 가로 격벽(21b)에 채널이 형성되거나 홈이 형성되는 것이 바람직할 것이다.
한편, 본 발명의 일실시예에서는 R, G 및 B 방전셀 각각이 동일한 선상에 배열되는 것으로 도시 및 설명되고 있지만, 다른 형상으로 배열되는 것도 가능할 것이다. 예컨대, R, G 및 B 방전셀이 삼각형 형상으로 배열되는 델타(Delta) 타입의 배열도 가능할 것이다. 또한, 방전셀의 형상도 사각형상 뿐만 아니라, 오각형, 육각형 등의 다양한 다각 형상도 가능할 것이다.
또한, 형광체층(23)은 가스 방전시 발생된 자외선에 의해 발광되어 적색(R), 녹색(G) 또는 청색(B) 중 어느 하나의 가시광을 발생하게 된다. 여기서, 상부/하부 기판(10, 20)과 격벽(21) 사이에 마련된 방전공간에는 방전을 위한 He+Xe, Ne+Xe 및 He+Ne+Xe 등의 불활성 혼합가스가 주입된다.
도 2는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 것으로, 플라즈마 디스플레이 패널을 구성하는 복수의 방전셀들은 도 2에 도시된 바와 같이 매트릭스 형태로 배치되는 것이 바람직하다. 복수의 방전셀들은 각각 스캔 전극 라인(Y1 내지 Ym), 서스테인 전극 라인(Z1 내지 Zm) 및 어드레스 전극 라인(X1 내지 Xn)의 교차부에 마련된다. 스캔 전극 라인(Y1 내지 Ym)은 순차적으로 구동되거나 동시에 구동될 수 있고, 서스테인 전극 라인(Z1 내지 Zm)은 동시에 구동될 수 있다. 어드레스 전극라인(X1 내지 Xn)은 기수 번째 라인들과 우수 번째 라인들로 분할되어 구동되거나 순차적으로 구동될 수 있다.
도 2에 도시된 전극 배치는 본 발명에 따른 플라즈마 패널의 전극 배치에 대한 일실시예에 불과하므로, 본 발명은 도 2에 도시된 플라즈마 디스플레이 패널의 전극 배치 및 구동 방식에 한정되지 아니한다. 예컨데, 상기 스캔 전극 라인(Y1 내지 Ym)들 중 2 개의 스캔 전극 라인이 동시에 스캐닝되는 듀얼 스캔(dual scan) 방식도 가능하다. 또한, 상기 어드레스 전극 라인(X1 내지 Xn)은 패널의 중앙 부분에서 상하 또는 좌우로 분할되어 구동될 수도 있다.
도 3은 하나의 프레임(frame)을 복수의 서브필드로 나누어 시분할 구동시키는 방법에 대한 일실시예를 타이밍도로 도시한 것이다. 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정 개수 예컨대 8개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ...SF8)는 리셋 구간(미도시)과, 어드레스 구간(A1, ..., A8)및, 서스테인 구간(S1, ..., S8)로 분할된다.
여기서, 본 발명의 일실시예에 따르면 리셋 구간은 복수 개의 서브필드 중 적어도 하나에서 생략될 수 있다. 예컨대, 리셋 구간은 최초의 서브필드에서만 존재하거나, 최초의 서브필드와 전체 서브필드 중 중간 정도의 서브필드에서만 존재할 수도 있다.
각 어드레스 구간(A1, ..., A8)에서는, 어드레스 전극(X)에 표시 데이터 신호가 인가되고, 각 스캔 전극(Y)에 상응하는 스캔 펄스가 순차적으로 인가된다.
각 서스테인 구간(S1, ...,S8)에서는, 스캔 전극(Y)과 서스테인 전극(Z)에 서스테인 펄스가 교호하게 인가되어, 어드레스 구간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 서스테인 방전을 일으킨다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 서스테인 방전 구간(S1, ..., S8)내의 서스테인 방전 펄스 개수에 비례한다. 1 화상을 형성하는 하나의 프레임이, 8개의 서브필드와 256계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64, 128의 비율로 서로 다른 서스테인 펄스의 수가 할당될 수 있다. 만일 133계조의 휘도를 얻기 위해서는, 서브필드1 구간, 서브필드3 구간 및 서브필드8 구간 동안 셀들을 어드레싱하여 서스테인 방전하면 된다.
각 서브필드에 할당되는 서스테인 방전 수는, APC(Automatic Power Control)단계에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 즉, 도 3에서는 한 프레임을 8개의 서브필드로 분할하는 경우를 예로 들어 설명하였으나 본 발명은 그에 한정되지 아니하며, 한 프레임을 형성하는 서브필드의 수를 설계사양 에 따라 다양하게 변형하는 것이 가능하다. 예를 들어, 한 프레임을 12 또는 16 서브필드 등과 같이, 8 서브필드 이상으로 분할하여 플라즈마 디스플레이 패널을 구동시킬 수 있다.
또한 각 서브필드에 할당되는 서스테인 방전 수는 감마특성이나 패널특성을 고려하여 다양하게 변형하는 것이 가능하다. 예컨대, 서브필드 4에 할당된 계조도를 8에서 6으로 낮추고, 서브필드 6 에 할당된 계조도를 32 에서 34 로 높일 수 있다.
도 4는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호에 대한 일실시예를 타이밍도로 도시한 것이다.
상기 서브필드는 스캔 전극들(Y) 상에 정극성 벽전하를 형성하고 서스테인 전극들(Z) 상에 부극성 벽전하를 형성하기 위한 프리 리셋(pre reset) 구간, 프리 리셋 구간에 의해 형성된 벽전하 분포를 이용하여 전 화면의 방전셀들을 초기화하기 위한 리셋(reset) 구간, 방전셀을 선택하기 위한 어드레스(address) 구간 및 선택된 방전셀들의 방전을 유지시키기 위한 서스테인(sustain) 구간을 포함할 수 있다.
리셋 구간은 셋업(setup) 구간 및 셋 다운(setdown) 구간으로 이루어지며, 상기 셋업 구간에서는 모든 스캔 전극으로 상승 램프 파형(Ramp-up)이 동시 인가되어 모든 방전셀에서 미세 방전이 발생되고, 이에 따라 벽전하가 생성된다. 상기 셋다운 구간에는 상기 상승 램프 파형(Ramp-up)의 피크 전압보다 낮은 정극성 전압에서 하강하는 하강 램프파형(Ramp-down)이 모든 스캔 전극(Y)으로 동시에 인가되어 모든 방전셀에서 소거방전이 발생되고, 이에 따라 셋업 방전에 의해 생성된 벽전하 및 공간전하 중 불요 전하를 소거시킨다.
어드레스 구간에는 스캔 전극으로 부극성의 스캔 전압(Vsc)을 가지는 스캔 신호가 순차적으로 인가되고, 이와 동시에 상기 어드레스 전극(X)으로 정극성의 데이터 신호가 인가된다. 이러한 상기 스캔 신호와 데이터 신호 간의 전압 차와 상기 리셋 구간 동안 생성된 벽전압에 의해 어드레스 방전이 발생 되어 셀이 선택된다. 한편, 어드레스 방전의 효율을 높이기 위해, 상기 어드레스 구간 동안 서스테인 바이어스 전압(Vzb)이 서스테인 전극에 인가된다.
서스테인 구간에는 스캔 전극과 서스테인 전극에 교번적으로 서스테인 전압(Vs)을 가지는 서스테인 펄스가 인가되어 스캔 전극과 서스테인 전극 사이에 면방전 형태로 서스테인 방전이 발생된다.
상기 서스테인 방전이 발생한 후, 어드레스 구간에서 선택된 온셀(ON cell)의 스캔 전극 또는 서스테인 전극에 남아있는 벽전하를 약한 방전을 발생시킴에 의해 소거시키는 소거 구간이 서스테인 구간 이후에 더 포함될 수 있다.
상기 소거 구간은 복수의 서브필드 전체 또는 그 중 일부의 서브필드에 포함될 수 있으며, 서스테인 구간에서 마지막 서스테인 펄스가 인가되지 않은 전극에 상기 약한 방전을 위한 소거 신호가 인가되는 것이 바람직하다.
상기 소거 신호는 점진적으로 증가하는 램프(ramp) 형태의 신호, 저전압 광폭 펄스(low-voltage wide pulse), 고전압 협폭 펄스(high-voltage narrow pulse), 기하급수적으로 증가하는 신호(exponential signal) 또는 half-sinusoidal pulse 등이 사용될 수 있다.
또한, 상기 약한 방전을 발생시키기 위해 스캔 전극 또는 서스테인 전극에 복수의 펄스가 순차적으로 인가될 수도 있다.
도 4에 도시된 구동 파형들은 본 발명에 따른 플라즈마 디스플레이 패널을 구동시키기 위한 신호들에 대한 일실시예로서, 상기 도 4에 도시된 파형들에 의해 본 발명은 한정되지 아니한다. 예컨데, 상기 프리 리셋 구간이 생략될 수 있으며, 도 4에 도시된 구동 신호들의 극성 및 전압 레벨은 필요에 따라 변경이 가능하고, 상기 서스테인 방전이 완료된 후에 벽전하 소거를 위한 소거 신호가 서스테인 전극에 인가될 수도 있다. 또한, 상기 서스테인 신호가 스캔 전극(Y)과 서스테인(Z) 전극 중 어느 하나에만 인가되어 서스테인 방전을 일으키는 싱글 서스테인(single sustain) 구동도 가능하다.
도 5는 패널의 스캔 전극에 구동 신호를 공급하는 스캔 구동 회로의 구성에 대한 일실시예를 회로도로 도시한 것으로, 도시된 스캔 구동 회로는 에너지 회수부(110), 서스테인 구동부(120), 리셋 구동부(130) 및 스캔 IC(140)를 포함하여 이루어질 수 있다.
도 5를 참조하면, 서스테인 구동부(120)는 서스테인 구간 동안 고전위 서스테인 전압(Vsus)을 공급하는 서스테인 전압 전원(Vsus)과, 서스테인 전압(Vsus)이 스캔 전극(100)에 인가되도록 턴온되는 서스-업 스위치(Sus_up)와, 스캔 전극(10)에 인가되는 전압이 그라운드 전압까지 하강하도록 턴온되는 서스-다운 스위치(Sus_dn)를 포함한다. 즉, 서스테인 구동부(120)는 서스-업 스위치(Sus_up)가 서 스테인 전압 전원(Vsus)과 연결되고, 서스-다운 스위치(Sus_dn)가 서스-업 스위치(Sus_up) 및 그라운드와 연결된다.
에너지 회수부(110)는 공급된 에너지를 회수하여 저장하는 소스 커패시터(Cs), 소스 커패시터(Cs)에 저장된 에너지가 스캔 전극(100)에 공급되도록 턴온되는 에너지 공급 스위치(ER_up) 및 스캔 전극(100)으로부터 에너지가 회수되도록 턴온되는 에너지 회수 스위치(ER_dn)를 포함한다.
리셋 구동부(130)는 점진적으로 상승하는 셋업 신호를 스캔 전극(100)에 공급하기 위해 턴온되는 셋-업 스위치(Set_up), 부극성 전압(-Vy)와 연결되어 부극성 전압(-Vy)까지 점진적으로 하강하는 셋다운 신호를 스캔 전극(100)에 공급하기 위해 턴온되는 셋-다운 스위치(Set_dn) 및 스캔 전극(100)과 전류 패스 경로를 형성하는 패스 스위치(Pass_sw)를 포함한다.
도 5에 도시된 바와 같이, 셋-업 스위치(Set_up)는 드레인(Drain)이 서스테인 전압 전원에 연결되고, 소오스(Source)가 패스 스위치(Pass_sw)와 연결되며, 게이트(Gate)가 가변 저항(미도시)과 연결되며, 상기 가변 저항의 저항값이 변함에 따라 점진적으로 상승하는 상기 셋업 신호가 생성된다.
셋다운 스위치(Set_dn)는 드레인(Drain)이 스캔 IC(140)와 연결되고, 소오스(Source)가 부극성 전압(-Vy)과 연결되고, 게이트(Gate)로 가변 저항(미도시)가 연결되며, 가변 저항(미도시)의 저항값이 변함에 따라 점진적으로 하강하는 셋다운 신호가 생성된다.
스캔 IC(140)는 스캔 전극(100)에 스캔 전압(Vsc)을 인가하기 위해 턴온되는 스캔 전압 전원과 연결된 스캔-업 스위치(Q1), 스캔 전극(100)에 그라운드 전압을 인가하기 위해 턴온되는 스캔-다운 스위치(Q2)를 포함한다. 또한, 스캔 IC(140)는 스캔-업 스위치(Q1)와 병렬로 연결되는 제1 다이오드(D1)와, 스캔-다운 스위치(Q2)와 병렬로 연결되는 제2 다이오드(D2)를 포함한다.
도 5에 도시된 바와 같이, 제1 다이오드(D1)는 캐소드(Cathode)가 스캔-업 스위치(Q1)의 드레인(Drain)에 연결되고 애노드(Anode)가 스캔-업 스위치(Q1)의 소오스(Source)와 연결되며, 제2 다이오드(D2)는 캐소드(Cathode)가 스캔-다운 스위치(Q2)의 드레인(Drain)과 연결되고 애노드(Anode)가 스캔-다운 스위치(Q2)의 소오스(Source)와 연결된다.
도 6은 스캔 IC(140)를 제어하기 위한 신호들의 파형을 타이밍도로 도시한 것이다.
스캔 IC(140)가 도 6에 도시된 바와 같은 구동 신호를 스캔 전극(Y)에 공급하기 위해, 스캔 IC(140)에는 OC1, OC2 및 STB 신호가 제어 신호로서 입력될 수 있다.
상기 제어 신호들을 이용하여 스캔 IC(140)를 제어하는 방법에 대한 일시예는 다음과 같다.
상기 OC1, OC2가 모두 로우 레벨 전압을 가지는 경우 스캔 IC(140)의 출력은 하이 임피던스(High Impedance)가 되며, 상기 OC1, OC2가 모두 하이 레벨 전압을 가지는 경우 상기 스캔 IC(140)로 입력되는 두 신호 중 스캔-업 스위치(Q1)를 통해 입력되는 고 전압 신호가 스캔 IC(140)로부터 출력된다.
상기 OC1이 하이 레벨 전압을 가지고 상기 OC2가 로우 레벨 전압을 가지는 경우 상기 스캔 IC(140)로 입력되는 두 신호 중 스캔-다운 스위치(Q2)를 통해 입력되는 저 전압 신호가 스캔 IC(140)로부터 출력된다.
또한, 상기 OC1이 로우 레벨 전압을 가지고 상기 OC2가 하이 레벨 전압을 가지는 경우, 상기 스캔 IC(140)로 입력되는 데이터 신호가 하이 레벨 전압을 가질 때에는 스캔-다운 스위치(Q2)를 통해 입력되는 저 전압 신호가 스캔 IC(140)로부터 출력되며, 상기 스캔 IC(140)로 입력되는 데이터 신호가 로우 레벨 전압을 가질 때에는 스캔-업 스위치(Q1)를 통해 입력되는 고 전압 신호가 스캔 IC(140)로부터 출력된다.
도 6에 도시된 바와 같이, 리셋 구간 동안에는 상기 OC1이 하이 레벨 전압을 가지고 상기 OC2가 로우 레벨 전압을 가지며, 그에 따라 스캔-다운 스위치(Q2)를 통해 스캔 IC(140)로 입력되는 리셋 신호 및 서스테인 신호가 스캔 전극(Y)에 공급된다.
또한, 어드레스 구간 동안에는 상기 OC1이 로우 레벨 전압을 가지고 상기 OC2가 하이 레벨 전압을 가지며, 스캔 전극(Y)에 스캔 신호(200)가 인가되는 시점 이외에는 스캔 IC(140)로 입력되는 데이터 신호가 로우 레벨 전압을 가짐에 따라, 스캔-업 스위치(Q1)를 통해 입력되는 스캔 전압(Vsc)이 스캔 전극(Y)에 공급된다.
도 6에 도시된 바와 같이, 스캔 전극(Y)에 스캔 신호(200)가 인가되는 시점은 상기 STB 제어 신호를 이용하여 제어될 수 있다. 즉, 어드레스 구간 중 스캔 IC(140)로 입력되는 데이터 신호가 로우 레벨 전압을 가지며, 상기 STB가 하이 레 벨 전압을 가지는 경우, 스캔-다운 스위치(Q2)를 통해 입력되는 그라운드 전압(GND)을 가지는 스캔 신호(200)가 스캔 전극(Y)에 공급될 수 있다.
도 6에 도시된 바와 같이, OC1, OC2와 별도의 제어 신호인 STB를 사용하여 스캔 신호 인가시점을 제어하는 경우, 어드레스 구간 동안은 OC1 및 OC2가 로우 및 하이 레벨 전압을 계속 유지하므로 상기 데이터 신호에 오류가 있으면 스캔 신호에 노이즈가 발생할 수 있다. 또한, 상기 STB가 하이 레벨 전압을 가지는 구간에서 데이터 레치가 계속해 발생하여, 스캔 IC(140)에 과도한 열이 발생할 수 있다.
도 7은 본 발명에 따른 스캔 IC 제어 신호에 대한 일실시예를 타이밍도로 도시한 것이다.
도 7에 도시된 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널 구동 장치에 있어서, 스캔 전극(Y)에 스캔 신호(200)가 인가되는 시점은 상기 OC1 제어 신호를 이용하여 제어되는 것이 바람직하다.
즉, 어드레스 구간 동안 OC1은 하이 레벨 전압과 로우 레벨 전압을 교번적으로 가지며, OC2는 하이 레벨 전압을 가진다. 그에 따라, 어드레스 구간 중 OC1 및 OC2가 하이 레벨 전압을 가지는 시점에서는 데이터 신호에 관계없이 스캔-업 스위치(Q1)를 통해 입력되는 스캔 전압(Vsc)이 스캔 전극(Y)에 공급된다. 또한, 어드레스 구간 중 OC1 및 OC2가 각각 로우 레벨 전압 및 하이 레벨 전압을 가지는 시점에서는, 데이터 신호가 하이 레벨 전압을 가지는 경우 스캔-다운 스위치(Q2)를 통해 입력되는 그라운드 전압을 가지는 스캔 신호(200)가 스캔 전극(Y)에 공급된다.
상기한 바와 같이 OC1 제어 신호를 이용하여 스캔 IC(140)로부터 스캔 전 극(Y)에 스캔 신호가 입력되는 시점을 제어함으로써, 도 6에 도시된 바와 같이 STB 신호는 계속 로우 레벨 전압을 가지도록 하거나, 그와 달리 STB 신호를 생략하여 스캔 IC를 제어하기 위한 신호의 개수를 줄일 수 있다.
또한, 상기한 바와 같이 어드레스 구간 중 스캔 신호(200) 인가 시점 이외의 구간에서는 데이터 신호에 관계없이 스캔 전압(Vsc)이 스캔 전극(Y)에 공급되도록 하여, 데이터 신호 오류에 의한 스캔 신호의 노이즈 발생을 감소시킬 수 있다.
그와 더불어, 어드레스 구간에서 데이터 신호를 레치시킬 필요가 없어지므로, 스캔 IC(140)의 발열을 감소시킬 수 있다.
도 7을 참조하면, 패널 구동 마진을 확보하는 동시에 방전셀을 선택하기 위해 충분한 방전 시간을 확보하기 위해, 스캔 신호(200)의 폭(c)은 720㎱ 내지 1.5㎲일 수 있다. 따라서, 상기 스캔 신호(200)의 인가 시점을 제어하기 위한 OC1의 로우 레벨 전압을 가지는 펄스의 폭(a)은 720㎱ 내지 1.5㎲일 수 있다.
또한, 어드레스 구간의 전체 길이 및 상기 OC1의 로우 레벨 전압을 가지는 펄스의 폭(a)의 범위를 고려하면, 상기 OC1의 하이 레벨 전압을 가지는 펄스의 폭(b)은 40㎱ 내지 300㎱일 수 있으며, 보다 바람직하게는 100㎱ 내지 300㎱일 수 있다.
이상 본 발명의 바람직한 실시예에 대해 상세히 기술하였지만, 본 발명이 속하는 기술분야에 있어서 통상의 지식을 가진 사람이라면, 첨부된 청구범위에 정의된 본 발명의 정신 및 범위에 벗어나지 않으면서 본 발명을 여러 가지로 변형 또는 변경하여 실시할 수 있음을 알 수 있을 것이다. 따라서, 본 발명의 앞으로의 실시 예들의 변경은 본 발명의 기술을 벗어날 수 없을 것이다.
도 1은 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 일실시예를 나타내는 사시도이다.
도 2 는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 도면이다.
도 3은 하나의 프레임(frame)을 복수의 서브필드(subfield)로 나누어 플라즈마 디스플레이 패널을 시분할 구동시키는 방법에 대한 일실시예를 나타내는 타이밍도이다.
도 4는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호의 파형에 대한 일실시예를 나타내는 타이밍도이다.
도 5는 패널의 스캔 전극에 구동 신호를 공급하는 스캔 구동 회로의 구성에 대한 일실시예를 나타내는 회로도이다.
도 6은 스캔 IC를 제어하기 위한 신호들을 나타내는 타이밍도이다.
도 7은 본 발명에 따른 스캔 IC 제어 신호에 대한 일실시예를 나타내는 타이밍도이다.

Claims (7)

  1. 플라즈마 디스플레이 패널을 구동시키기 위한 장치에 있어서,
    상기 패널의 스캔 전극에 공급될 서스테인 신호를 생성하는 서스테인 구동부;
    상기 스캔 전극에 공급될 리셋 신호를 생성하는 리셋 구동부; 및
    상기 서스테인 구동부 및 리셋 구동부로부터 신호를 입력받아 상기 스캔 전극에 구동 신호를 공급하는 스캔 IC를 포함하고,
    상기 스캔 IC를 제어하기 위한 제1 제어 신호 및 제2 제어 신호는 리셋 구간 및 서스테인 구간에서 각각 하이 레벨(high level) 전압 및 로우(low level) 레벨 전압을 가지며,
    어드레스 구간에서 상기 스캔 IC가 상기 스캔 전극에 스캔 신호를 인가하는 시점은 상기 제1 제어 신호에 의해 제어되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제1항에 있어서,
    상기 어드레스 구간동안 상기 제1 제어 신호는 하이 레벨 전압과 로우 레벨 전압을 교번적으로 가지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 제2항에 있어서,
    상기 제1 제어 신호 및 제2 제어 신호가 각각 로우 레벨 전압 및 하이 레벨 전압을 가질 때 상기 스캔 신호가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  4. 제2항에 있어서,
    상기 제1 제어 신호 중 로우 레벨 전압을 가지는 펄스의 폭은 720㎱ 내지 1.5㎲인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  5. 제2항에 있어서,
    상기 제1 제어 신호 중 하이 레벨 전압을 가지는 펄스의 폭은 40㎱ 내지 300㎱인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  6. 제2항에 있어서,
    상기 제1 제어 신호 중 하이 레벨 전압을 가지는 펄스의 폭은 100㎱ 내지 300㎱인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  7. 제1항에 있어서,
    상기 스캔 신호의 폭은 720㎱ 내지 1.5㎲인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
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