KR20080106134A - Method for signal transmitting and apparatus for the same, method for signal receiving and apparatus for the same - Google Patents

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Abstract

A method and an apparatus for transmitting and receiving a signal are provided to increase a signal transmission length by estimating a channel for a transmission channel with long delay spread and to improve data transmission rate based on a signal-to-noise ratio. Data is encoded with error correction. The error correction encoded data is mapped to data symbol(S8200). Period information to insert a first pilot symbol to a modulation frame is generated. A first modulation frame is generated so that a pilot symbol interval with the first pilot symbol and a data symbol interval with the mapped data symbol are repeated periodically in an odd carrier. A second modulation frame is generated so that the pilot symbol interval with the first pilot symbol and the data symbol interval with the mapped data symbol are repeated periodically in an even carrier. The formed first and second modulation frames are modulated in the orthogonal frequency division multiplexing method. The modulated signal is transmitted(S8204).

Description

신호 송수신 방법 및 신호 송수신 장치{Method for signal transmitting and apparatus for the same, Method for signal receiving and apparatus for the same}Method for signal transmitting and apparatus for the same, Method for signal receiving and apparatus for the same

본 발명은 신호 송수신 방법 및 신호 송수신 장치에 관한 것으로서, 더욱 자세하게는 데이터 전송 효율을 높일 수 있는 신호 송수신 방법 및 송수신 장치에 관한 것이다.The present invention relates to a signal transmission and reception method and a signal transmission and reception apparatus, and more particularly, to a signal transmission and reception method and a transmission and reception apparatus that can improve data transmission efficiency.

사용자는 디지털 방송(Digital Broadcasting) 기술의 발전으로 인해 HD(High Definition)급의 동영상과 디지털 음향 등의 뛰어남을 경험하게 되었고, 압축 알고리즘의 계속적인 발전과 하드웨어의 고성능화에 의해 앞으로 더 나은 환경을 접하게 될 것이다. 디지털 텔레비전(DTV)은 상기 디지털 방송신호를 수신하여 영상, 음성과 더불어 다양한 부가 서비스를 사용자에게 제공할 수 있다.Users have experienced superiority of HD (High Definition) video and digital sound due to the development of Digital Broadcasting technology, and the better environment is being developed through the continuous development of compression algorithms and high performance of hardware. Will be. The digital television (DTV) may receive the digital broadcast signal and provide various additional services in addition to video and audio to the user.

상기 디지털 방송의 보급과 더불어 더 나은 영상, 음향 등과 같은 서비스에 대한 요구가 증가하고 있고, 사용자가 원하는 데이터의 크기나 방송 채널의 수가 점차 커지고 있다.With the spread of digital broadcasting, demands for better services such as video and audio are increasing, and the size of data desired by the user and the number of broadcasting channels are gradually increasing.

그러나, 기존의 신호 송수신 방식으로는 증가하는 데이터의 크기나 방송 채 널의 수를 감당하기 어렵게 되었다. 따라서, 기존의 신호 송수신 방식보다 채널의 대역폭 효율이 높고, 신호 송수신 네트워크 망을 구성하는 비용이 적게 요구되는 새로운 신호 송수신 기술에 대한 요구가 늘어나고 있다.However, it is difficult to cope with the increased data size or the number of broadcast channels using the conventional signal transmission / reception scheme. Accordingly, there is an increasing demand for a new signal transmission / reception technique requiring higher bandwidth efficiency of a channel than a conventional signal transmission / reception scheme and requiring a low cost of configuring a signal transmission / reception network.

본 발명은 상기와 같은 문제점을 해결하기 위한 것으로서, 기존의 신호 송수신 네트워크 망을 이용할 수 있고, 데이터의 전송 효율을 높일 수 있는 신호 송수신 방법 및 송수신 장치를 제공하는 데 목적이 있다.The present invention has been made to solve the above problems, and an object of the present invention is to provide a signal transmission / reception method and a transmission / reception apparatus capable of using an existing signal transmission / reception network network and increasing data transmission efficiency.

본 발명은 데이터를 오류 정정 부호화하는 오류 정정 부호화부, 상기 오류 정정 부호화된 데이터를 데이터 심볼로 매핑하는 심볼 매퍼, 홀수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 1 변조 프레임을 형성하고, 상기 제 1 파일럿 심볼이 상기 제 1 변조 프레임에 삽입되는 주기 정보를 삽입하는 제 1 프레임 형성부, 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 2 변조 프레임을 형성하고, 상기 제 1 파일럿 심볼이 상기 제 2 변조 프레임에 삽입되는 주기 정보를 삽입하는 제 2 프레임 형성부, 상기 형성된 제 1 변조 프레임을 직교 주파수 다중 분할 방식으로 변조하는제 1 변조부, 상기 형성된 제 2 변조 프레임을 직교 주파수 다중 분할 방식으로 변조하는제 2 변조부, 상기 제 1 변조부가 출력한 신호를 전송하는 제 1 전송부 및 상기 제 2 변조부가 출력한 신호를 전송하는 제 2 전송부를 포함하는 신호 송신 장치 및 그 장치의 신호 송신 방법을 제공한다.The present invention provides an error correction encoder for error correcting data, a symbol mapper for mapping the error corrected coded data to a data symbol, a pilot symbol interval in which the first pilot symbol is located only on odd carriers, and the mapped data symbols A first frame forming unit for forming a first modulation frame so that the located data symbol interval is repeated periodically, and inserts period information into which the first pilot symbol is inserted in the first modulation frame, the first pilot symbol only in even carriers A second modulation frame is formed so that the pilot symbol section located thereon and the data symbol section in which the mapped data symbol is located are periodically repeated, and inserts period information into which the first pilot symbol is inserted into the second modulation frame. Two frame forming unit, orthogonal frequency multiplexing the formed first modulation frame A first modulator for modulating a second modulator, a second modulator for modulating the formed second modulated frame by an orthogonal frequency multiplexing scheme, a first transmitter for transmitting a signal output by the first modulator, and the second modulation A signal transmission device including a second transmission unit for transmitting an additionally output signal and a signal transmission method of the device are provided.

다른 관점에서 본 발명은 홀수 캐리어에만 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 1 변조 프레임을 가진 신호를 복조하는 제 1 복조부, 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 2 변조 프레임을 가진 신호를 복조하는 제 2 복조부, 상기 제 1 변조 프레임을 파싱하는 제 1 프레임 파싱부, 상기 제 2 변조 프레임을 파싱하는 제 2 프레임 파싱부, 상기 제 1 변조 프레임과 상기 제 2 변조 프레임에 각각 포함된 데이터 심볼을 하나의 심볼열로 출력하는 다중 입출력 디코더, 상기 심볼 열을 디매핑하는 심볼 디맵퍼 및 상기 디매핑한 데이터를 오류 정정 복호하는 오류 정정 복호부를 포함하는 신호 수신 장치및 그 장치의 신호 수신 방법을 제공한다.In another aspect, the present invention provides a first demodulator and an even carrier for demodulating a signal having a pilot symbol section in which a first pilot symbol is located only on an odd carrier, and a first modulation frame configured to periodically repeat the data symbol section in which a data symbol is located. Parsing the first modulation frame, the second demodulation unit for demodulating a signal having a pilot symbol period in which the first pilot symbol is located, a second modulation frame formed so that the data symbol interval in which the data symbol is located is periodically repeated A first frame parser, a second frame parser that parses the second modulated frame, a multiple input / output decoder configured to output data symbols included in each of the first and second modulated frames as a symbol string, A symbol demapper for demapping a symbol string and error correction decoding the demapped data. It provides a current correction decoding a signal receiving apparatus including a signal receiving method and of the device.

상기 제 1 변조 프레임 및 상기 제 2 변조 프레임 중 적어도 어느 하나는, 시간에 따라 일정한 캐리어 위치에 제 2 파일럿 심볼을 포함할 수 있다. At least one of the first modulation frame and the second modulation frame may include a second pilot symbol at a constant carrier position over time.

그리고 상기 제 2 파일럿 심볼은, 스크램블될 심볼일 수 있다. The second pilot symbol may be a symbol to be scrambled.

이상에서 설명한 바와 같이 본 발명의 신호 송수신 방법 및 신호 송수신 장치에 따르면, 기존의 신호 송수신 네트워크 망을 이용하여 제안된 신호 송수신 시스템으로의 전환이 용이하며, 비용을 절감할 수 있는 효과가 있다.As described above, according to the signal transmission / reception method and the signal transmission / reception apparatus of the present invention, it is easy to switch to the proposed signal transmission / reception system using an existing signal transmission / reception network network, and the cost can be reduced.

또한, SNR 이득을 바탕으로 데이터 전송률을 향상시킬 수 있고, 긴 지연 확산을 갖는 전송 채널에 대해서 채널 추정이 가능하게 되어 신호 송신 거리를 증가 시킬 수 있는 효과가 있다. 그리고, 제안된 프레임 구조를 이용하여, 보다 정확한 채널 추정을 할 수 있으며, TPS 동기를 위한 시간을 줄일 수 있다.In addition, the data rate can be improved based on the SNR gain, and channel estimation can be performed for a transmission channel having a long delay spread, thereby increasing the signal transmission distance. In addition, by using the proposed frame structure, more accurate channel estimation can be performed and time for TPS synchronization can be reduced.

따라서, 전체적인 송수신 시스템의 신호 송수신 성능을 높일 수 있는 효과가 있다. Therefore, there is an effect that can increase the signal transmission and reception performance of the overall transmission and reception system.

본 발명의 다른 목적, 특성 및 이점들은 첨부한 도면을 참조한 실시 예들의 상세한 설명을 통해 명백해질 것이다. 아울러, 본 발명에서 사용되는 용어는 가능한 한 현재 널리 사용되는 일반적인 용어를 선택하였으나, 특정한 경우는 출원인이 임의로 선정한 용어도 있으며 이 경우 해당되는 발명의 설명 부분에서 상세히 그 의미를 기재하였으므로, 단순한 용어의 명칭이 아닌 용어가 가지는 의미로서 본 발명을 파악하여야 함을 밝혀 두고자 한다.Other objects, features and advantages of the present invention will become apparent from the following detailed description of embodiments taken in conjunction with the accompanying drawings. In addition, the terms used in the present invention was selected as a general term widely used as possible now, but in certain cases, the term is arbitrarily selected by the applicant, in which case the meaning is described in detail in the corresponding description of the invention, It is to be clear that the present invention is to be understood as the meaning of terms rather than names.

이와 같이 구성된 본 발명에 따른 신호 송수신 방법 및 신호 송수신 장치의 동작을 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.Operation of the signal transmission and reception method and the signal transmission and reception device according to the present invention configured as described above will be described in detail with reference to the accompanying drawings.

도 1은 본 발명에 따른 일 실시예로서, 신호 송신 장치를 개략적으로 나타낸 블록도이다. 상기 송수신 시스템은 다중 입출력을 위한 MIMO(Multi Input Multi Output)를 사용할 수 있다.1 is a block diagram schematically showing a signal transmission apparatus according to an embodiment according to the present invention. The transmission and reception system may use MIMO (Multi Input Multi Output) for multiple input and output.

상기 도 1의 신호 송신 장치는 방송 신호 등 비디오 데이터를 전송하는 신호 송신 시스템이 될 수 있다. 예를 들어, DVB(digital video broadcasting) 시스템에 따른 신호 송신 시스템일 수 있다. 도 1을 참조하여 본 발명에 따른 신호 송신 시스템의 실시예를 설명하면 다음과 같다.The signal transmission apparatus of FIG. 1 may be a signal transmission system for transmitting video data such as a broadcast signal. For example, it may be a signal transmission system according to a digital video broadcasting (DVB) system. An embodiment of a signal transmission system according to the present invention will be described with reference to FIG. 1.

도 1의 실시예는 아웃터 인코더(outer encoder)(100) 제1인터리버(interleaver)(110), 인너 인코더(inner encoder)(120), 제2인터리버(130), 심볼맵퍼(symbol mapper)(140), 선형 프리코딩부(150), 제3인터리버(160), 다중 입출력 인코더(170), 제1프레임 형성부(frame builder)(180), 제2프레임 형성부(185), 제1변조부(190), 제2변조부(192), 제1전송부(194) 및 제2전송부(196)를 포함한다.1 illustrates an outer encoder 100, a first interleaver 110, an inner encoder 120, a second interleaver 130, and a symbol mapper 140. ), The linear precoding unit 150, the third interleaver 160, the multiple input / output encoder 170, the first frame builder 180, the second frame builder 185, the first modulator 190, a second modulator 192, a first transmitter 194, and a second transmitter 196.

아웃터 인코더(100)와 인너 인코더(120)는 입력된 신호를 부호화하여 출력함으로써, 전송되는 데이터에 발생한 오류를 수신기에서 검출하고, 상기 오류를 수정할 수 있도록 한다. 상기 인코더로서 순방향 오류정정 인코딩(Forward Error Correction : FEC)을 사용할 수 있다. 제1인터리버(110)는 상기 아웃터 인코더(100)에서 출력된 데이터 열을 섞어 랜덤한 위치로 분산시킨다. 상기 제1인터리버(110)에는 컨벌루션 인터리버(convolution interleaver), 블록 인터리버(block interleaver) 등을 사용할 수 있으며, 이는 전송 시스템에 따라 달라질 수 있다. 또한, 상기 제1인터리버(110)는 구현 예에 따라 사용되지 않을 수도 있다.The outer encoder 100 and the inner encoder 120 encode and output the input signal, thereby detecting an error in the transmitted data at the receiver and correcting the error. As the encoder, forward error correction encoding (FEC) may be used. The first interleaver 110 mixes the data streams output from the outer encoder 100 and distributes them to random positions. The first interleaver 110 may use a convolution interleaver, a block interleaver, and the like, which may vary depending on a transmission system. In addition, the first interleaver 110 may not be used depending on implementation.

도 2는 본 발명에 따른 일 실시예로서, 인터리버와 순방향 오류정정 인코더를 개략적으로 나타낸 블록도이다. 상기 순방향 오류정정 인코더는 아웃터 인코더(outer encoder)와 인너 인코더(inner encoder)로서 BCH(Bose-Chaudhuri-Hocquenghem) 인코더(100)와 LDPC(Low Density Parity Check) 인코더(120)를 포함한다.2 is a block diagram schematically illustrating an interleaver and a forward error correction encoder according to an embodiment of the present invention. The forward error correction encoder includes an outer encoder and an inner encoder, a BCH (Bose-Chaudhuri-Hocquenghem) encoder 100 and a Low Density Parity Check (LDPC) encoder 120.

LDPC 코드는 오류정정부호의 일종으로 데이터의 정보유실 확률을 가능한 한 적게 할 수 있다. 상기 LDPC 인코더(120)는 블록의 길이를 크게 하여 전송 데이터 가 전송 에러에 강인한 특성을 가지도록 할 수 있다. 또한, 블록 사이즈의 증가로 인한 하드웨어 복잡도 증가를 막기 위해서, 패리티 비트(parity bit)의 밀도를 작게 하여 복호화기의 복잡도를 감소시켜 줄 수 있다.The LDPC code is a type of error correcting code that can reduce the probability of data loss as much as possible. The LDPC encoder 120 may increase the length of the block so that the transmission data has a characteristic that is robust to a transmission error. In addition, in order to prevent an increase in hardware complexity due to an increase in the block size, the complexity of the decoder may be reduced by decreasing the density of parity bits.

수신측의 출력 데이터에 에러 플로어(error floor)가 발생하는 것을 방지하기 위해, 추가적인 아웃터 인코더(outer encoder)로 BCH 인코더(100)를 사용한다. 만약, 에러 플로어를 무시할 수 있을 정도의 LDPC 인코더(120)가 사용된다면 상기 BCH 인코더(100)는 사용되지 않을 수도 있다. 또는, 상기 BCH 인코더 이외의 다른 인코더를 아웃터 인코더로 사용할 수도 있다.In order to prevent an error floor from occurring in the output data of the receiving side, the BCH encoder 100 is used as an additional outer encoder. If the LDPC encoder 120 is used to ignore the error floor, the BCH encoder 100 may not be used. Alternatively, an encoder other than the BCH encoder may be used as the outer encoder.

상기 BCH 인코더(100)에서 인코딩되고 제1인터리버(110)에서 인터리빙된 데이터는 LDPC 인코더(120)를 거쳐 제2인터리버(130)로 출력된다.The data encoded by the BCH encoder 100 and interleaved by the first interleaver 110 are output to the second interleaver 130 via the LDPC encoder 120.

상기 제2인터리버(130)는 전송 시 발생하는 버스트 에러(burst error)에 강인하도록, 상기 순방향 오류정정된 데이터 열을 섞어 랜덤한 위치로 분산시킨다. 상기 제2인터리버(130)는 컨벌루션 인터리버(convolution interleaver), 블록 인터리버(block interleaver) 등을 사용할 수 있으며, 이는 전송 시스템에 따라 달라질 수 있다.The second interleaver 130 mixes and distributes the forward error corrected data sequence to a random position so as to be robust to a burst error occurring during transmission. The second interleaver 130 may use a convolution interleaver, a block interleaver, and the like, which may vary depending on a transmission system.

도 3은 본 발명에 따른 일 실시예로서, 입력 데이터를 인터리빙시키는 인터리버를 나타낸 도면이다. 상기 도 3의 인터리버는 블록 인터리버의 한 종류로 상기 제2인터리버(130)에 사용될 수 있는 인터리버의 한 예이다.3 is a diagram illustrating an interleaver for interleaving input data according to an embodiment of the present invention. 3 is an example of an interleaver that can be used for the second interleaver 130 as a type of block interleaver.

상기 도 3의 인터리버는 매트릭스(Matrix) 형태의 저장 공간(memory space)에 입력되는 데이터를 일정 패턴으로 저장하고, 상기 저장 패턴과 다른 패턴으로 데이터를 읽어 출력한다. 예를 들어, 도 3의 인터리버는 Nr의 행과 Nc의 열로 이루어진 저장공간(Nr×Nc)을 가지며, 상기 인터리버에 입력된 데이터는 상기 저장공간의 1열 1행 위치에서부터 채워진다. 1열의 1행에서부터 시작하여 1열의 Nr행까지 데이터를 저장하며, 상기 1열이 다 채워지면 그 다음 열(2열)의 1행에서부터 시작하여 Nr행까지 데이터를 저장한다. 상기와 같은 순서로 Nc열의 Nr행까지 데이터를 저장할 수 있다.The interleaver of FIG. 3 stores data input to a matrix-type storage space in a predetermined pattern and reads and outputs the data in a pattern different from the storage pattern. For example, the interleaver of FIG. 3 has a storage space (Nr × Nc) consisting of a row of Nr and a column of Nc, and data input to the interleaver is filled from the position of one column, one row of the storage space. Data is stored starting from row 1 of column 1 up to row Nr of column 1, and when the column 1 is filled up, data is stored starting from row 1 of the next column (column 2) up to row Nr. Data can be stored up to Nr rows of Nc columns in the above order.

그리고 상기 저장공간에 저장된 데이터를 읽는 경우에는, 저장공간의 1행 1열의 데이터에서부터 시작하여 1행 Nc열까지 해당 행의 데이터를 읽어서 출력한다. 그리고 해당 행의 데이터를 모두 읽으면, 다음 아래 행(2행)의 1열부터 시작하여 우측 방향으로 해당 행의 데이터를 읽어서 출력한다. 상기와 같은 순서로 Nr행의 Nc열까지 데이터를 읽어서 출력할 수 있다. 이때, 데이터 블록의 MSB(Most Significant Bit) 위치는 좌측 최상단이며, LSB(Least Significant Bit) 위치는 우측 최하단이다.When reading the data stored in the storage space, the data of the row is read and output from the data of the first row to the first column of the storage space up to the first row Nc column. If all the data of the row is read, starting from the first column of the next lower row (row 2), the data of the row is read and output in the right direction. Data can be read and output up to Nc columns of Nr rows in the same order as described above. At this time, the MSB (Most Significant Bit) position of the data block is at the top left, and the LSB (Least Significant Bit) position is at the bottom right.

상기 인터리버의 저장 블록의 크기, 저장 패턴, 읽기 패턴 등은 하나의 실시 예이며 이는 구현 예에 따라 달라질 수 있다.A size, a storage pattern, a read pattern, and the like of the storage block of the interleaver are one embodiment, which may vary depending on the implementation.

상기 제2인터리버(130)에서 인터리빙된 데이터는 심볼맵퍼(140)에 입력된다. 심볼맵퍼(symbol mapper)(140)는 전송 모드에 따른 파일럿 신호와 전송 매개 변수 신호 등을 고려하여, 송신 신호를 심볼로 맵핑(mapping)할 수 있다. 상기 맵핑 방식으로 QAM(Quadrature Amplitude Modulation), QPSK(Quadrature Phase Shift Keying), APSK(Amplitude Phase Shift Keying), PAM(Pulse Amplitude Modulation), 옵티멀 성상(optimal constellation) 등이 사용될 수 있다. 또는, 상기 심볼 맵퍼(140)에는 부호화된 심볼 맵핑 방식을 사용할 수도 있다. 예를 들어, 트렐리스(trellis) 코드 변조 등의 방식을 사용하여 부호화된 심볼로 맵핑할 수도 있다.Data interleaved by the second interleaver 130 is input to the symbol mapper 140. The symbol mapper 140 may map a transmission signal to a symbol in consideration of a pilot signal and a transmission parameter signal according to a transmission mode. Quadrature Amplitude Modulation (QAM), Quadrature Phase Shift Keying (QPSK), Amplitude Phase Shift Keying (APSK), Pulse Amplitude Modulation (PAM), and Optimal Constellation may be used as the mapping scheme. Alternatively, an encoded symbol mapping method may be used for the symbol mapper 140. For example, it may be mapped to a coded symbol using a method such as trellis code modulation.

선형 프리코딩부(150)는 입력된 심볼 데이터를 여러 개의 출력 심볼 데이터에 분산시켜, 주파수 선택적 페이딩 채널을 겪었을 때 모든 정보가 페이딩으로 손실될 확률을 줄여준다. 상기 선형 프리코딩부(150)는 입력된 데이터를 병렬(parallel) 데이터로 변환하여 인코딩 매트릭싱(matrixing)을 통해 여러 개의 데이터에 분산시킨 후 다시 직렬(Serial) 데이터로 변환하여 출력한다.The linear precoding unit 150 distributes the input symbol data to a plurality of output symbol data, thereby reducing the probability that all information is lost due to fading when experiencing a frequency selective fading channel. The linear precoding unit 150 converts the input data into parallel data, distributes the data to multiple data through encoding matrixing, and converts the data into serial data and outputs the serial data.

상기 인코딩 매트릭스는 출력 심볼과 입력 심볼을 비교해서, 상기 두 심볼이 틀릴 확률인 PEP(Pairwise Error Probability)가 최소화되도록 설계한다. PEP를 최소화하도록 설계하여 선형 프리코딩을 통해서 얻는 다이버시티 이득(diversity gain)과 코딩 이득(coding gain)을 최대로 할 수 있다. 또한, 상기 인코딩 매트릭스를 통해 선형 프리코딩된 심볼의 최소 유클리드 거리(Euclidean distance)가 최대가 되도록 하면, 수신단에서 ML(Maximum Likelihood) 디코더를 사용할 경우 오류 확률(error probability)을 최소화시킬 수 있다. The encoding matrix is designed to compare an output symbol with an input symbol so that Pairwise Error Probability (PEP), which is a probability that the two symbols are wrong, is minimized. Designed to minimize PEP, the diversity gain and coding gain obtained through linear precoding can be maximized. In addition, when the minimum Euclidean distance of a linear precoded symbol is maximized through the encoding matrix, an error probability may be minimized when the receiver uses a maximum likelihood (ML) decoder.

상기 인코딩 매트릭스의 예로, vanderMonde 매트릭스, Hadamard 매트릭스, Golden code 등을 사용할 수 있다. 상기 매트릭스는 일 예이며, 구현 예에 따라 적정한 매트릭스를 사용하여 데이터를 분산시킬 수 있다. As an example of the encoding matrix, a vanderMonde matrix, a Hadamard matrix, a golden code, or the like may be used. The matrix is an example, and according to an embodiment, the data may be distributed using an appropriate matrix.

또한, 상기 선형 프리코딩부(150)는 구현 예에 따라 사용되지 않을 수도 있다.In addition, the linear precoding unit 150 may not be used depending on implementation.

제3인터리버(160)는 상기 선형 프리코딩부(150)에서 출력된 심볼 데이터를 다시 인터리빙(interleaving)한다. 즉, 상기 제3인터리버(160)에서 인터리빙을 수행하여, 상기 선형 프리코딩부(150)에서 출력된 데이터들에 분산되어 있는 심볼 데이터가 동일한 주파수 선택적 페이딩을 겪지 않도록 한다. 상기 제3인터리버(160)에는 컨벌루션 인터리버(convolution interleaver), 블록 인터리버(block interleaver) 등을 사용할 수 있다.The third interleaver 160 interleaves the symbol data output from the linear precoding unit 150 again. That is, interleaving is performed in the third interleaver 160 so that symbol data dispersed in the data output from the linear precoding unit 150 does not experience the same frequency selective fading. A convolution interleaver, a block interleaver, or the like may be used for the third interleaver 160.

도 4는 본 발명에 따른 일 실시예로서, 인터리버의 일 예를 나타낸 도면이다. 상기 도 4의 인터리버는 심볼 길이 N을 갖는 OFDM 시스템에 대한 인터리버의 실시예로서 상기 도 1과 같은 송신 장치의 제3인터리버(160)에 사용될 수 있다.4 is a diagram illustrating an example of an interleaver according to an embodiment of the present invention. The interleaver of FIG. 4 may be used in the third interleaver 160 of the transmitting apparatus as shown in FIG. 1 as an embodiment of the interleaver for the OFDM system having the symbol length N.

N은 인터리버의 길이를 나타내며, i는 상기 인터리버의 길이만큼의 값 즉, 0에서 N-1까지의 정수 값을 갖는다. n은 송신 시스템에서 유효 전송 캐리어 만큼의 개수를 가진다. ∏(i)는 modulo-N 연산으로 이루어진 순열을 가리키며, dn은 N/2 값을 제외하고 유효 전송 캐리어 영역에 있는 ∏(i)값을 순서대로 갖는다. k는 실제 전송 캐리어의 인덱스 값을 나타내며, 상기 dn에서 N/2을 빼서 전송 대역폭의 가운데가 DC가 되도록 한다. P는 순열 상수로 구현 예에 따라 달라질 수 있다.N represents the length of the interleaver, i has a value equal to the length of the interleaver, that is, an integer value from 0 to N-1. n has the number of effective transport carriers in the transmission system. ∏ (i) denotes a permutation of modulo-N operations, and d n has values of ∏ (i) in the effective transport carrier region in order except N / 2 values. k represents the index value of the actual transport carrier, so that d / 2 is subtracted from d n so that the center of the transmission bandwidth is DC. P is a permutation constant and may vary depending on the embodiment.

도 5는 본 발명에 따른 일 실시예로서, 도 4의 인터리버의 구체적인 예를 나타낸 도면이다. 상기 도 5의 예는 OFDM 심볼의 길이와 인터리버의 길이(N)는 2048로 설정되었고, 유효 전송 캐리어의 개수는 1536(1792-256)개로 설정되었다.5 is a diagram illustrating a specific example of the interleaver of FIG. 4 as an embodiment according to the present invention. In the example of FIG. 5, the length of an OFDM symbol and the length N of an interleaver are set to 2048, and the number of effective transmission carriers is set to 1536 (1792-256).

따라서, i는 0~2047의 정수이고, n은 0~1535의 정수이다. ∏(i)는 modulo- 2048 연산으로 이루어진 순열이고, dn은 256≤∏(i)≤1792인 값에 대하여, 1024(N/2)를 제외하고 순서대로 ∏(i)값을 갖는다. k는 상기 dn에서 1024를 뺀 값이다. P는 13을 갖는다.Therefore, i is an integer of 0-2047, n is an integer of 0-1535. ∏ (i) is a permutation of modulo-2048 operations, and d n has a value of ∏ (i) in order except 1024 (N / 2) for a value of 256 ≦ ∏ (i) ≦ 1792. k is a value obtained by subtracting 1024 from d n . P has 13.

상기와 같은 인터리버를 이용하여, 입력되는 데이터(i)에 대응되는 데이터(k)를 출력하므로, 인터리버의 길이(N) 만큼의 데이터에 대하여 순서를 섞어서 전송할 수 있다.Since the data k corresponding to the input data i is output using the interleaver as described above, the data of the length N of the interleaver can be mixed and transmitted.

상기 선형 프리코딩부(150)와 제3인터리버(160)는 전송하고자 하는 데이터를 채널의 주파수 선택적 페이딩에 강인하도록 처리한다.The linear precoding unit 150 and the third interleaver 160 process the data to be transmitted to be robust to the frequency selective fading of the channel.

다중 입출력 인코더(170)는 상기 제3인터리버(160)에서 인터리빙된 데이터를 복수의 전송 안테나에 실리도록 인코딩한다. 다중 입출력 인코딩 방식에는 크게 공간 다중화(Spatial Multiplexing) 방식과 공간 다이버시티(Spatial Diversity) 방식이 있다. 공간 다중화는 송신기와 수신기에 다중의 안테나를 이용하여, 서로 다른 데이터를 동시에 전송함으로써 시스템의 대역폭을 더 증가시키지 않고, 보다 고속의 데이터를 전송할 수 있는 방식이다. 공간 다이버시티는 다중의 송신 안테나에서 같은 정보의 데이터를 전송하여 송신 다이버시티(diversity)를 얻는 방식이다.The multiple input / output encoder 170 encodes the data interleaved by the third interleaver 160 to be carried on a plurality of transmission antennas. There are two types of multiple input / output encoding methods, spatial multiplexing and spatial diversity. Spatial multiplexing is a method in which multiple antennas are transmitted to a transmitter and a receiver to transmit different data at the same time, thereby transmitting data at higher speed without further increasing the bandwidth of the system. Spatial diversity is a method of obtaining transmit diversity by transmitting data of the same information from multiple transmit antennas.

이때, 공간 다이버시티(spatial diversity) 방식의 다중 입출력 인코더(170)로는 STBC(space-time block code)와 SFBC(space-frequency block code), STTC(space-time trellis code) 등이 사용될 수 있다. 공간 다중화(Spatial multiplex) 방식의 다중 입출력 인코더(170)로는 단순히 데이터열을 송신 안테나 개수만큼 분리하여 전송하는 방식과 FDFR(full-diversity full-rate) code, LDC(linear dispersion code), V-BLAST(Vertical-Bell Lab. layered space-time)와 D-BLAST (diagonal-BLAST) 같은 방식이 사용될 수 있다.In this case, as the multiple diversity input / output encoder 170 having a spatial diversity scheme, a space-time block code (STBC), a space-frequency block code (SFBC), a space-time trellis code (STTC), or the like may be used. The spatial multiplex multiple input / output encoder 170 simply transmits data streams by separating the number of transmit antennas, and provides full-diversity full-rate (FDFR) code, linear dispersion code (LDC), and V-BLAST. (Vertical-Bell Lab. Layered space-time) and D-BLAST (diagonal-BLAST) can be used.

도 6은 본 발명에 따른 일 실시예로서, 다중 입출력 인코딩 방식의 일 예를 나타낸 도면이다. 상기 도 6의 실시예는 다중 입출력 인코딩 방식 가운데 하나인 STBC로 상기 도 1과 같은 송신 장치에 사용될 수 있다. 상기 인코딩 방식은 하나의 예이며, 다른 다중 입출력 인코딩 방식의 적용이 배제되지 않는다.6 is a diagram illustrating an example of a multiple input / output encoding scheme according to an embodiment of the present invention. The embodiment of FIG. 6 is STBC, which is one of multiple input / output encoding schemes, and may be used in the transmission apparatus of FIG. 1. The encoding scheme is one example, and the application of other multiple input / output encoding schemes is not excluded.

상기 STBC 인코더의 예에서 T는 심볼 전송 주기를 나타내며, s는 전송할 입력 심볼을, y는 출력 심볼을 나타낸다. *는 켤레 복소수(complex conjugate)를 나타내며, Tx #1, Tx #2는 각각 전송 안테나 1, 2를 나타낸다.In the example of the STBC encoder, T denotes a symbol transmission period, s denotes an input symbol to be transmitted, and y denotes an output symbol. * Denotes a complex conjugate, and Tx # 1 and Tx # 2 denote transmission antennas 1 and 2, respectively.

상기 예에 따르면, 시간 t에서 Tx #1은 s0를, Tx #2는 s1을 전송하고, 시간 t+T에서 Tx #1은 -s1 *를, Tx #2는 s0 *을 전송한다. 각 전송 안테나에서는 전송 주기 내에서 s0와 s1의 같은 정보의 데이터를 송신한다. 따라서, 상기 인코딩 방식은 공간 다이버시티 방식의 하나임을 알 수 있다.According to the above example, at time t Tx # 1 transmits s 0 , Tx # 2 transmits s 1 , and at time t + T Tx # 1 transmits -s 1 * and Tx # 2 transmits s 0 * do. Each transmitting antenna transmits data of the same information of s 0 and s 1 within a transmission period. Accordingly, it can be seen that the encoding scheme is one of spatial diversity schemes.

상기 다중 입출력 인코더(170)는 입력된 심볼 데이터를 복수의 전송 안테나에 실리도록 인코딩하여 출력한다. 예를 들어, 두 개의 전송 경로를 갖는 경우, 상기 다중 입출력 인코더(170)는 인코딩된 데이터를 제1프레임 형성부(180) 또는 제2프레임 형성부(185)로 출력한다. 상기 전송 경로의 수는 예에 불과하며, 다중 입출력 인코딩 방식에 따라 수개의 전송 경로를 가질 수 있다.The multiple input / output encoder 170 encodes and outputs the input symbol data to be carried on a plurality of transmission antennas. For example, when there are two transmission paths, the multiple input / output encoder 170 outputs the encoded data to the first frame forming unit 180 or the second frame forming unit 185. The number of the transmission paths is only an example and may have several transmission paths according to a multiple input / output encoding scheme.

제1프레임 형성부(180)와 제2프레임 형성부(185)는 상기 다중 입출력 인코더(170)에서 출력된 신호를 OFDM(Orthogonal Frequency Division Multiplex) 방식으로 변조할 수 있도록 파일럿(pilot) 신호를 삽입하여 프레임을 형성한다.The first frame forming unit 180 and the second frame forming unit 185 insert pilot signals to modulate the signals output from the multiple input / output encoder 170 in an orthogonal frequency division multiplex (OFDM) scheme. To form a frame.

도 7은 본 발명에 따른 일 실시예로서, 전송 프레임의 구조를 나타낸 도면이다. 상기 전송 프레임은 파일럿 캐리어(pilot carrier) 정보를 포함하는 파일럿 심볼 구간과 데이터 정보만을 포함하는 데이터 심볼 구간으로 구성된다.7 is a diagram illustrating a structure of a transmission frame according to an embodiment of the present invention. The transmission frame is composed of a pilot symbol period including pilot carrier information and a data symbol period including only data information.

상기 도 7에서 하나의 프레임은 M개의 구간을 포함하며, M-1개의 데이터 심볼 구간과 프리앰블(preamble)로 사용되는 한 개의 파일럿 심볼 구간으로 나뉜다. 그리고 상기와 같은 구조를 갖는 프레임이 반복된다.In FIG. 7, one frame includes M intervals, and is divided into M-1 data symbol intervals and one pilot symbol interval used as a preamble. The frame having the above structure is repeated.

각 심볼 구간에는 직교 주파수 다중 분할 (Orthogonal Frequency Division Multiplex : OFDM)방식의 각 서브 캐리어(sub carrier)의 수만큼 캐리어 정보가 포함된다. 파일럿 심볼 구간의 파일럿 캐리어 정보는 PAPR(Peak to Average Power Ratio)을 낮추기 위해 랜덤한 데이터로 구성된다. 그리고 상기 파일럿 캐리어 정보는 주파수 도메인(frequency domain)에서 자기상관값(auto-correlation)이 임펄스(impulse)인 형태를 갖는다.Each symbol period includes carrier information as many as the number of subcarriers of an Orthogonal Frequency Division Multiplex (OFDM) scheme. The pilot carrier information of the pilot symbol interval is composed of random data in order to lower the peak to average power ratio (PAPR). The pilot carrier information has a form in which auto-correlation is an impulse in the frequency domain.

데이터 심볼 구간에는 파일럿 캐리어 정보가 포함되지 않으며, 따라서 데이터 양(data capacity)을 늘릴 수 있다. DVB(Digital Video Broadcasting)의 경우를 예를 들면, 파일럿 캐리어가 전체 유효 캐리어에서 차지하는 비율이 약 10%정도 되므로, 데이터 양(data capacity)의 증가율은 다음 수학식 1과 같다.Pilot carrier information is not included in the data symbol interval, and thus data capacity can be increased. In the case of DVB (Digital Video Broadcasting), for example, since the pilot carrier occupies about 10% of the total effective carriers, the increase rate of data capacity is expressed by Equation 1 below.

Figure 112008039495204-PAT00001
Figure 112008039495204-PAT00001

상기 수학식 1에서 △는 증가율을 나타내며, M은 하나의 프레임에 포함된 구간의 수이다.In Equation 1, Δ represents an increase rate, and M is the number of sections included in one frame.

상기 도 1의 송신 시스템이 복수 개의 안테나를 사용하여 다중 입출력 인코딩을 수행하는 경우, 수신측에서 각 전송 경로(path)를 구별할 수 있도록 파이럿 심볼의 구조가 결정되어야 한다.When the transmission system of FIG. 1 performs multiple input / output encoding using a plurality of antennas, a structure of a pilot symbol should be determined so that each transmission path can be distinguished from a receiver.

도 8(a)는 본 발명에 따른 일 실시예로서, 파일럿 심볼구간의 구조를 나타낸 도면이다. 상기 도 8(a)의 파일럿 심볼구간의 구조는 도 1과 같이 2개의 전송 경로를 갖도록 다중 입출력 인코딩을 수행하는 경우에 사용될 수 있다.8 (a) is a diagram showing the structure of a pilot symbol interval according to an embodiment of the present invention. The structure of the pilot symbol interval of FIG. 8 (a) may be used when multiple input / output encoding is performed to have two transmission paths as shown in FIG.

상기 도 8(a)의 경우, 두 전송 경로를 구별하기 위해 파일럿 캐리어 정보를 인터리빙시켜 짝수(even), 홀수(odd) 파일럿으로 나눈다. 예를 들어, 파일럿 심볼 구간에 짝수의 파일럿 캐리어 정보를 포함하는 프레임 데이터의 경우 0번 안테나를 통해서 전송하며, 파일럿 심볼 구간에 홀수의 파일럿 캐리어 정보를 포함하는 프레임 데이터의 경우 1번 안테나를 통해서 전송한다. 따라서, 수신측에서는 상기 파일럿 심볼 구간의 해당 캐리어 인덱스를 이용하여 각 전송 경로를 구별할 수 있다.In the case of FIG. 8A, pilot carrier information is interleaved and divided into even and odd pilots in order to distinguish two transmission paths. For example, frame data including even pilot carrier information in a pilot symbol period is transmitted through antenna 0, and frame data including odd pilot carrier information in a pilot symbol period is transmitted through antenna 1. do. Accordingly, the receiving side can distinguish each transmission path using the corresponding carrier index of the pilot symbol interval.

상기 실시예의 경우, 하나의 심볼에서 절반의 서브 캐리어(subcarrier)에 해당하는 채널을 추정할 수 있다. 따라서, 짧은 코히어런스 시간(coherence time)을 갖는 전송 채널에 대해서도 높은 채널 추정(channel estimation) 성능을 얻을 수 있다.In the above embodiment, a channel corresponding to half of subcarriers may be estimated in one symbol. Therefore, high channel estimation performance can be obtained even for a transmission channel having a short coherence time.

도 8(b)는 본 발명에 따른 일 실시예로서, 파일럿 심볼구간의 다른 구조를 나타낸 도면이다. 상기 도 8(b)의 경우에도 도 1과 같이 2개의 전송 경로를 갖도록 다중 입출력 인코딩을 수행하는 경우에 사용될 수 있다.8 (b) is a diagram illustrating another structure of a pilot symbol period according to an embodiment of the present invention. 8 (b) may be used when multiple input / output encoding is performed to have two transmission paths as shown in FIG.

상기 도 8(b)의 경우 Hadamard 타입의 파일럿 심볼 구간의 실시예를 나타낸다. 상기 실시 예는 두 전송 경로를 구별하기 위해 심볼 구간 단위로 Hadamard 변환을 수행한다. 따라서 짝수 심볼 구간에는 각 전송 경로를 위한 두 파일럿 캐리어 정보가 합해진 값을 포함하고, 홀수 심볼 구간에는 두 파일럿 캐리어 정보의 차 값을 포함한다. 8 (b) shows an embodiment of a Hadamard type pilot symbol interval. In the above embodiment, Hadamard transformation is performed in units of symbol intervals to distinguish two transmission paths. Accordingly, the even symbol interval includes the sum of two pilot carrier information for each transmission path, and the odd symbol interval includes the difference between two pilot carrier information.

예를 들어, 짝수 심볼 구간에는 0번 안테나를 통해 전송할 파일럿 캐리어 정보(a)와 1번 안테나를 통해 전송할 파일럿 캐리어 정보(b)가 합해진 값(a+b)을 포함하며, 홀수 심볼 구간에는 0번 안테나를 통해 전송할 파일럿 캐리어 정보(a)와 1번 안테나를 통해 전송할 파일럿 캐리어 정보(b)의 차 값(a-b)을 포함한다. 수신측에서는 수신된 파일럿 인덱스를 통해 두 파일럿 캐리어 정보의 합/차를 알고 있는 경우, 각 전송 경로를 구별할 수 있다.For example, the even symbol interval includes a pilot value of a carrier (a) to be transmitted through antenna 0 and a pilot value of pilot carrier information (b) to be transmitted through antenna 1 (a + b). And a difference value ab of pilot carrier information a to be transmitted through the first antenna and pilot carrier information b to be transmitted through the first antenna. If the receiving side knows the sum / difference of the two pilot carrier information through the received pilot index, each transmission path can be distinguished.

상기 실시예의 경우, 모든 서브 캐리어에 해당하는 채널을 추정할 수 있으므로, 각 전송 경로에 대해서 처리할 수 있는 채널의 지연 확산(delay spread)이 심볼 길이만큼 확장될 수 있다.In the above embodiment, since channels corresponding to all subcarriers can be estimated, delay spread of a channel that can be processed for each transmission path can be extended by a symbol length.

상기 도 8(b)의 도면은 상기 두 파일럿 캐리어 정보의 구분이 용이하도록 도시된 것으로, 주파수 영역에서의 두 파일럿 캐리어 정보를 모두 도시하였다. 짝수 심볼 구간과 홀수 심볼 구간 도면의 경우, 두 파일럿 캐리어 정보의 임펄스는 같은 주파수 지점에 위치한다. 짝수 심볼 구간 도면의 경우, 구분의 용이를 위해 0번 안테나를 통해 전송할 파일럿 캐리어 정보와 1번 안테나를 통해 전송할 파일럿 캐리어 정보의 위치를 차이가 나도록 도시한 것이고, 상기 파일럿 캐리어 정보는 같은 주파수 지점에 위치한다.8 (b) is a diagram for easily distinguishing the two pilot carrier information, and shows both pilot carrier information in the frequency domain. In the case of the even symbol interval and the odd symbol interval diagram, impulses of two pilot carrier information are located at the same frequency point. In the case of the even-symbol interval diagram, the positions of the pilot carrier information to be transmitted through the antenna 0 and the pilot carrier information to be transmitted through the antenna 1 are shown to be different for ease of division, and the pilot carrier information is located at the same frequency point. Located.

상기 도 8(a)와 8(b)의 실시예는 전송 경로가 2개인 경우의 예이며, 전송 경로가 그 이상인 경우에는 파일럿 캐리어 정보를 홀,짝수가 아닌 전송 경로의 수만큼 구분될 수 있도록 나누거나, 심볼 구간 단위로 Hadamard 변환을 수행할 수 있다.8 (a) and 8 (b) are examples of two transmission paths, and when the transmission path is longer, pilot carrier information may be distinguished by the number of transmission paths, not odd or even. You can divide or perform Hadamard transformation on a symbol interval basis.

제1변조부(190)와 제2변조부(192)는 상기 제1프레임 형성부(180)와 제2프레임 형성부(185)에서 출력된 데이터들을 각각 OFDM의 서브 캐리어(sub carrier)들에 실어 전송할 수 있도록 보호 구간(guard interval)을 삽입하여 변조한다.The first modulator 190 and the second modulator 192 respectively transmit data output from the first frame former 180 and the second frame former 185 to subcarriers of OFDM. A guard interval is modulated by inserting a guard interval for transmission.

제1전송부(194)와 제2전송부(196)는 각각 제1변조부(190)와 제2변조부(192)에서 출력된 보호 구간과 데이터 구간을 가진 디지털 형식의 신호를 아날로그 신호로 변환하고, 상기 변환된 아날로그 신호를 송신(transmit)한다.The first transmitter 194 and the second transmitter 196 respectively convert a digital signal having a guard interval and a data interval output from the first modulator 190 and the second modulator 192 into analog signals. Convert, and transmit the converted analog signal.

상기에서 설명한 도 1의 신호 송신 장치는 일 예이며, 송신 시스템에 따라 필요한 구성요소가 더 추가되거나, 또는 필요하지 않은 구성요소는 사용되지 않을 수 있다.The signal transmission apparatus of FIG. 1 described above is an example, and a required component may be further added or an unnecessary component may not be used according to a transmission system.

도 9는 본 발명에 따른 일 실시예로서, 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 도 9의 실시예는 DVB 수신 장치 등에 포함될 수 있다.9 is a block diagram schematically illustrating an apparatus for receiving a signal according to an embodiment of the present invention. 9 may be included in a DVB receiver or the like.

도 9의 본 발명에 따른 실시예는 제1수신부(900), 제2수신부(905), 제1동기부(910), 제2동기부(915), 제1복조부(920), 제2복조부(925), 제1프레임 파싱(parsing)부(930), 제2프레임 파싱부(935), 다중 입출력 디코더(940), 제1디인터리버(deinterleaver)(950), 선형 프리코딩 디코더(960), 심볼디맵퍼(970), 제2디인터리버(980), 인너 디코더(990), 제3디인터리버(992) 및 아웃터 디코더(994)를 포함한다. 상기 도 9의 실시예는 설명의 편의를 위해 2개의 수신 경로를 사용한 것으로, 수신 경로의 수가 정해진 것은 아니다.9 illustrates a first receiver 900, a second receiver 905, a first synchronizer 910, a second synchronizer 915, a first demodulator 920, and a second receiver. A demodulator 925, a first frame parser 930, a second frame parser 935, a multiple input / output decoder 940, a first deinterleaver 950, a linear precoding decoder 960, a symbol demapper 970, a second deinterleaver 980, an inner decoder 990, a third deinterleaver 992, and an outer decoder 994. The embodiment of FIG. 9 uses two receive paths for convenience of description, and the number of receive paths is not determined.

제1수신부(900)와 제2수신부(905)는 RF 신호를 각각 수신하여, 주파수 대역을 다운 컨버전(down conversion)한 후 디지털 신호로 변환하여 출력한다. 제1동기부(910)와 제2동기부(915)는 각각 제1수신부(900)와 제2수신부(905)에서 출력된 수신 신호의 주파수 영역과 시간 영역의 동기를 획득하여 출력한다. 상기 제1동기부(910)와 제2동기부(915)는 주파수 영역 신호의 동기 획득을 위해 각각 제1복조부(920)와 제2복조부(925)가 출력하는 데이터의 주파수 영역의 오프셋(offset) 결과를 이용할 수 있다.The first receiver 900 and the second receiver 905 each receive an RF signal, down-convert the frequency band, and convert the digital signal into a digital signal. The first synchronizer 910 and the second synchronizer 915 obtain and synchronize the frequency domain and the time domain of the received signal output from the first receiver 900 and the second receiver 905, respectively. The first synchronization unit 910 and the second synchronization unit 915 are offsets of the frequency domain of data output from the first demodulator 920 and the second demodulator 925, respectively, in order to obtain synchronization of the frequency domain signal. (offset) results are available.

제1복조부(920)는 제1동기부(910)에서 출력된 수신 데이터를 복조한다. 이를 위해 제1복조부(920)는 수신 데이터를 주파수 영역으로 변환시키고, 서브 캐리어에 분산된 데이터 값을 각각의 서브 캐리어에 할당되었던 값으로 디코딩한다. 제2복조부(925)는 제2동기부(915)에서 출력된 수신 데이터를 복조한다.The first demodulator 920 demodulates the received data output from the first synchronizer 910. To this end, the first demodulator 920 converts the received data into the frequency domain, and decodes the data value distributed in the subcarriers into a value assigned to each subcarrier. The second demodulator 925 demodulates the received data output from the second synchronizer 915.

제1프레임 파싱부(930)와 제2프레임 파싱부(935)는 각각 제1복조부(920)와 제2복조부(925)에서 복조된 신호의 프레임 구조에 따라 수신 경로를 구별하여, 파 일럿 심볼을 제외한 데이터 심볼 구간의 심볼 데이터를 출력할 수 있다. The first frame parser 930 and the second frame parser 935 distinguish the reception paths according to the frame structures of the signals demodulated by the first demodulator 920 and the second demodulator 925, respectively. It is possible to output symbol data of a data symbol section excluding the idle symbol.

다중 입출력 디코더(940)는 상기 제1프레임 파싱부(930)와 제2프레임 파싱부(935)에서 각각 출력한 데이터를 수신하여 디코딩한 후 하나의 데이터 열을 출력한다. 상기 다중 입출력 디코더(940)는 상기 도 1의 다중 입출력 인코더(170)에서 복수의 전송 안테나에 실리도록 인코딩한 방식에 대응되는 방식에 따라 디코딩하여 하나의 데이터 열을 출력한다.The multiple input / output decoder 940 receives and decodes the data output from the first frame parser 930 and the second frame parser 935, respectively, and outputs one data string. The multiple input / output decoder 940 outputs one data string by decoding according to a scheme corresponding to a scheme encoded by the multiple input / output encoder 170 of FIG.

도 10은 본 발명에 따른 일 실시예로서, 다중 입출력 디코딩 방식의 일 예를 나타낸 도면이다. 상기 도 10은 송신측에서 STBC 방식으로 다중 입출력 인코딩하여 데이터를 전송한 경우에, 수신측에서의 대응되는 디코딩 예를 나타낸 것으로서 송신측에서 2개의 송신 안테나를 사용한 경우이다. 이는 하나의 예이며 다른 다중 입출력 방식의 적용이 배제되는 것은 아니다.10 is a diagram illustrating an example of a multiple input / output decoding scheme according to an embodiment of the present invention. FIG. 10 illustrates an example of decoding corresponding to a receiving side when the data is transmitted by multiple input / output encoding using the STBC method in the transmitting side, and the transmitting side uses two transmitting antennas. This is an example and the application of other multiple input / output methods is not excluded.

상기 수식의 r(k), h(k), s(k), n(k)는 각각 수신측에 수신된 심볼, 채널 응답, 송신측에서 전송한 심볼 값, 채널 잡음(noise)을 나타낸다. 그리고 아래 첨자의 s, i, 0, 1은 각각 s번째 전송 심볼, i번째 수신 안테나, 0번 송신 안테나, 1번 송신 안테나를 나타낸다. '*'는 켤레 복소수(complex conjugate)를 나타낸다. 예를 들어, hs ,1,i(k)는 1번 송신 안테나에서 s번째로 전송된 심볼이 i번째 수신 안테나에 수신된 경우, 상기 전송된 심볼이 겪은 채널의 응답을 나타낸다. rs +1,i(k)는 i번째 수신 안테나에 수신된 s+1번째 수신 심볼을 나타낸다.R (k), h (k), s (k), and n (k) in the above equations represent symbols received at the receiver, channel response, symbol values transmitted at the transmitter, and channel noise, respectively. Subscripts s, i, 0, and 1 denote an sth transmission symbol, an ith reception antenna, a 0th transmission antenna, and a 1st transmission antenna, respectively. '*' Represents a complex conjugate. For example, h s , 1, i (k) indicates a response of the channel experienced by the transmitted symbol when the s-th transmitted symbol is received by the i-th reception antenna. r s + 1, i (k) represents the s + 1 th received symbol received at the i th receive antenna.

상기 도 10의 수식에 따르면, i번째 수신 안테나에 수신된 s번째 수신 심볼 인 rs ,i(k)는 0번째 송신 안테나에서 i번째 수신 안테나에 채널을 거쳐 송신된 s번째 심볼 값, 1번째 송신 안테나에서 i번째 수신 안테나에 채널을 거쳐 송신된 s번째 심볼 값, 그리고 상기 각 채널의 채널 잡음의 합(ns(k))을 더한 값이 된다.According to the equation of FIG. 10, r s , i (k) , which is the s-th reception symbol received at the i-th reception antenna, is the s-th symbol value transmitted through the channel from the 0th transmission antenna to the i-th reception antenna, and the 1st In the transmitting antenna, the i-th receiving antenna is the sum of the s-th symbol value transmitted through the channel and the sum of the channel noise of each channel (n s (k)).

그리고 i번째 수신 안테나에 수신된 s+1번째 수신 심볼인 rs +1,i(k)는 0번째 송신 안테나에서 i번째 수신 안테나에 채널을 거쳐 송신된 s+1번째 심볼 값, 1번째 송신 안테나에서 i번째 수신 안테나에 채널을 거쳐 송신된 s+1번째 심볼 값, 그리고 상기 각 채널의 채널 잡음의 합(ns(k))을 더한 값이 된다.In addition, r s + 1, i (k), which is the s + 1 th received symbol received at the i th receive antenna, is the s + 1 th symbol value transmitted through the channel from the 0 th transmit antenna to the i th receive antenna, and the first transmit It is the sum of the s + 1th symbol value transmitted through the channel and the sum of the channel noise of each channel (n s (k)).

도 11은 본 발명에 따른 일 실시예로서, 도 10의 구체적인 예를 나타낸 도면이다. 상기 도 11은 송신측에서 STBC 방식으로 다중 입출력 인코딩하여 데이터를 전송한 경우의 디코딩 예로, 송신측에서 두 개의 전송 안테나를 이용하여 전송하고, 수신측의 하나의 안테나를 통해 수신한 경우의 디코딩 수식이다. 송신측에서 두 개의 전송 안테나를 이용하는 경우, 수신측의 하나의 안테나에 대한 전송 채널은 2개가 될 수 있다.11 is a diagram illustrating a specific example of FIG. 10 as an embodiment according to the present invention. 11 is an example of decoding when a transmitter transmits data by multiple input / output encoding using STBC, and the transmitter transmits data using two transmit antennas and receives through one antenna. to be. When two transmitting antennas are used at the transmitting side, there may be two transmission channels for one antenna at the receiving side.

상기 수식의 h0, s0는 각각 송신측 0번 안테나로부터 수신안테나까지의 전송 채널 응답, 송신측 0번 안테나에서 전송하는 심볼을 나타내며, h1, s1은 각각 송신측 1번 안테나로부터 수신 안테나까지의 전송 채널 응답, 송신측 1번 안테나에서 전송하는 심볼을 나타낸다. '*'는 켤레 복소수(complex conjugate)를 나타내며, 아래 식의 s0'와 s1'는 복원된 심볼을 나타낸다.H 0 and s 0 in the above equations represent the transmission channel response from the transmitting antenna 0 to the receiving antenna and the symbols transmitted from the transmitting antenna 0, respectively, and h 1 and s 1 are received from the transmitting antenna 1 respectively. The transmission channel response to the antenna and the symbol transmitted by the first antenna at the transmitting side are shown. '*' Represents a complex conjugate, and s 0 'and s 1 ' in the following formulas represent a restored symbol.

그리고, r0와 r1은 각각 t시간에 수신 안테나에 수신된 심볼, 전송주기(T)가 지난 t+T시간에 수신 안테나에 수신된 심볼을 나타내며, n0와 n1은 상기 각 수신시간에서 각 전송경로의 채널 잡음이 더해진 값을 나타낸다.And r 0 and r 1 represent symbols received at the receiving antenna at t time and symbols received at the receiving antenna at t + T time after the transmission period T, respectively, and n 0 and n 1 are the respective reception times. Denotes the sum of channel noise of each transmission path.

상기 도 11의 수식과 같이 수신 안테나에 수신된 신호는 각 송신 안테나에서 전송한 신호가 각 전송 채널을 겪은 값을 더한 값으로 표현될 수 있다. 그리고 복원된 심볼은 상기 수신된 값과 각 채널 응답값을 이용하여 산출한다.As shown in Equation 11 of FIG. 11, the signal received by the receiving antenna may be expressed as a value obtained by adding a value that the signal transmitted by each transmitting antenna has experienced each transmission channel. The recovered symbol is calculated using the received value and each channel response value.

제1디인터리버(950)는 상기 다중 입출력 디코더(940)에서 출력된 데이터 열에 대해 디인터리빙(de-interleaving)을 수행하여 데이터를 인터리빙되기 전의 순서로 복원시킨다. 상기 제1디인터리버(950)는 상기 도 1의 제3인터리버(160)에서 인터리빙한 방식에 대응되는 방식에 따라 디인터리빙하여 데이터 열의 순서를 복원한다.The first deinterleaver 950 performs de-interleaving on the data string output from the multiple input / output decoder 940 to restore the data in the order before interleaving. The first deinterleaver 950 restores the data sequence by deinterleaving according to a method corresponding to the method interleaved by the third interleaver 160 of FIG. 1.

선형 프리코딩 디코더(1360)는 신호 송신 장치에서 데이터를 분산한 과정의 역과정을 수행하여 데이터를 복원한다. 상기 선형 프리코딩 디코더(1360)는 상기 도 1의 선형 프리코딩부(150)의 인코딩 방식에 대응되는 방식으로 디코딩을 수행한다.The linear precoding decoder 1360 restores data by performing an inverse process of distributing data in the signal transmission apparatus. The linear precoding decoder 1360 performs decoding in a manner corresponding to the encoding scheme of the linear precoding unit 150 of FIG. 1.

상기 선형 프리코딩 디코더(1360)는 입력된 데이터를 병렬(parallel) 데이터로 변환한 후 디코딩 매트릭싱(matrixing)을 통해 분산되어진 데이터들로부터 본래의 데이터를 복원한다. 상기 디코딩을 수행하는 디코딩 매트릭스는 신호 송신 장치의 인코딩 매트릭스의 역 매트릭스(inverse matrix)를 사용할 수 있다. 또는, 수신 된 심볼 데이터를 상기 전송 방식에 대응되도록 ML(Maximum Likelyhood) 디코딩하여 상기 병렬 데이터에 분산되어 있는 본래의 데이터를 복원할 수 있다. 즉, 송신 측에서의 인코딩 룰(encoding rule)을 고려하여, 수신된 심볼 데이터를 ML 디코딩할 수 있다. 상기 복원된 데이터는 다시 직렬(serial) 데이터로 변환되어 출력된다.The linear precoding decoder 1360 converts the input data into parallel data and then restores original data from data distributed through decoding matrixing. The decoding matrix for performing the decoding may use an inverse matrix of the encoding matrix of the signal transmission apparatus. Alternatively, the received symbol data may be decoded to maximize the Like Likehood (ML) to correspond to the transmission scheme, thereby recovering original data distributed in the parallel data. That is, the received symbol data may be ML decoded in consideration of an encoding rule at the transmitter. The restored data is converted into serial data and output again.

상기 선형 프리코딩 디코더(1360)는 송신 측에서의 선형 프리코딩부(150)의 사용 여부에 따라, 수신 측에서 사용되거나 사용되지 않을 수 있다.The linear precoding decoder 1360 may or may not be used at the receiving side, depending on whether the linear precoding unit 150 is used at the transmitting side.

심볼디맵퍼(970)는 상기 선형 프리코딩 디코더(960)에서 디코딩된 심볼 데이터를 비트열로 복원할 수 있다. 제2디인터리버(980)는 상기 심볼디맵퍼(970)에서 출력된 데이터 열에 대해 디인터리빙(de-interleaving)을 수행하여 데이터를 인터리빙되기 전의 순서로 복원시킨다. 상기 제2디인터리버(980)는 상기 도 1의 제2인터리버(130)에서 인터리빙한 방식에 대응되는 방식에 따라 디인터리빙하여 데이터 열의 순서를 복원한다.The symbol demapper 970 may restore the symbol data decoded by the linear precoding decoder 960 into a bit string. The second deinterleaver 980 performs de-interleaving on the data string output from the symbol demapper 970 to restore the data in the order before interleaving. The second deinterleaver 980 restores the order of the data columns by deinterleaving according to a method corresponding to the method interleaved by the second interleaver 130 of FIG. 1.

인너 디코더(990)와 아웃터 디코더(994)는 상기 순서가 복원된 데이터를 각각 순방향 오류정정 복호화하여 수신 데이터에 발생한 오류를 검출하고, 상기 오류를 수정할 수 있다. 제3디인터리버(992)는 상기 인너 디코더(990)에서 디코딩되어 출력된 데이터를 디인터리빙하여 데이터의 순서를 복원한다. 상기 제3디인터리버(992)는 상기 도 1의 제1인터리버(110)에서 인터리빙한 방식에 대응되는 방식에 따라 디인터리빙을 수행한다. 마찬가지로 상기 제3디인터리버(992)는 상기 제1인터리버(110)의 사용 여부에 따라 수신 측에서 사용되거나 사용되지 않을 수 있다.The inner decoder 990 and the outer decoder 994 may forward error correct and decode the data whose order is restored, respectively, to detect an error occurring in the received data and correct the error. The third deinterleaver 992 deinterleaves the data decoded and output by the inner decoder 990 to restore the order of the data. The third deinterleaver 992 performs deinterleaving according to a method corresponding to the method interleaved by the first interleaver 110 of FIG. 1. Similarly, the third deinterleaver 992 may or may not be used at the receiving side depending on whether the first interleaver 110 is used.

도 12는 본 발명에 따른 일 실시예로서, 디인터리버와 순방향 오류정정 디코더를 개략적으로 나타낸 블록도이다. 상기 인너 디코더(990), 제3디인터리버(992), 및 아웃터 디코더(994)는 도 1의 인너 인코더(120), 제1인터리버(110), 및 아웃터 인코더(100)에 각각 대응되며, 인너 디코더(inner decoder)와 아웃터 디코더(outer decoder)로서 LDPC 디코더(990)와 BCH 디코더(994)를 포함한다.12 is a block diagram schematically illustrating a deinterleaver and a forward error correction decoder according to an embodiment of the present invention. The inner decoder 990, the third deinterleaver 992, and the outer decoder 994 correspond to the inner encoder 120, the first interleaver 110, and the outer encoder 100 of FIG. 1, respectively. The decoder includes an LDPC decoder 990 and a BCH decoder 994 as an inner decoder and an outer decoder.

LDPC 디코더(990)는 채널에서 발생한 전송 에러를 검출하여 오류를 정정하고, 제3디인터리버(992)는 입력된 데이터를 디인터리빙하여 출력한다. BCH 디코더(994)는 상기 LDPC 디코더(990)에서 디코딩된 데이터의 잔류 오류를 정정하여 에러 플로어(error floor)를 제거한다.The LDPC decoder 990 detects a transmission error occurring in the channel, corrects the error, and the third deinterleaver 992 deinterleaves the input data and outputs the data. The BCH decoder 994 corrects a residual error of the data decoded by the LDPC decoder 990 to remove an error floor.

도 13은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도이다. 도 14는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도이다.13 is a block diagram schematically showing another example of a signal transmission apparatus as an embodiment according to the present invention. 14 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention.

상기 도 13과 도 14는 다중 입출력 방식이 아닌 단일 입력 단일 출력(Single Input Single Output : SISO) 방식의 시스템에 적용된 예이다.13 and 14 illustrate an example applied to a system of a single input single output (SISO) system rather than a multiple input / output system.

상기 도 13의 신호 송신 장치는 아웃터 인코더(1300), 제1인터리버(1310), 인너 인코더(1320), 제2인터리버(1330), 심볼맵퍼(symbol mapper)(1340), 선형 프리코딩부(1350), 제3인터리버(1360), 프레임 형성부(frame builder)(1370), 변조부(1380) 및 전송부(1390)를 포함한다.The signal transmitting apparatus of FIG. 13 includes an outer encoder 1300, a first interleaver 1310, an inner encoder 1320, a second interleaver 1330, a symbol mapper 1340, and a linear precoding unit 1350. ), A third interleaver 1360, a frame builder 1370, a modulator 1380, and a transmitter 1390.

그리고 상기 도 14의 신호 수신 장치는 수신부(1400), 동기부(1410), 복조부(1420), 프레임 파싱(parsing)부(1430), 제1디인터리버(1440), 선형 프리코딩 디 코더(1450), 심볼디맵퍼(1460), 제2디인터리버(1470), 인너 디코더(1480), 제3디인터리버(1490) 및 아웃터 디코더(1495)를 포함한다.The signal receiver of FIG. 14 includes a receiver 1400, a synchronizer 1410, a demodulator 1420, a frame parsing unit 1430, a first deinterleaver 1440, and a linear precoding decoder ( 1450, a symbol demapper 1460, a second deinterleaver 1470, an inner decoder 1480, a third deinterleaver 1490, and an outer decoder 1495.

상기 신호 송신 장치와 신호 수신 장치는 각각 도 1과 도 9에서 설명한 바와 같은 처리과정을 거친다. 다만, 도 13과 도 14의 송수신 장치는 다중 입출력 방식이 아닌 단일 입력 단일 출력 방식이 적용되므로, 다중 입출력 인코딩 과정과 다중 입출력 디코딩 과정은 사용되지 아니한다.The signal transmission device and the signal reception device go through the processing as described with reference to FIGS. 1 and 9, respectively. However, in the transceivers of FIGS. 13 and 14, since a single input single output method is used instead of a multiple input / output method, a multiple input / output encoding process and a multiple input / output decoding process are not used.

즉, 채널의 주파수 선택적 페이딩에 강인하도록 제3인터리버(1370)에서 인터리빙을 거친 심볼 데이터는 프레임 형성부(1370)에 입력되며, 상기 프레임 형성부(1370)는 상기 입력된 심볼 데이터를 이용하여 프레임 데이터를 형성하여 출력한다. 마찬가지로, 상기 제1인터리빙 과정이나 선형 프리코딩 과정 등은 구현 예에 따라 사용되지 않을 수도 있다. 그리고 상기 단일 입력 단일 출력 방식의 경우에는, 상기 도 8(a), 도 8(b)와 같은 다중 입출력에 따른 전송 경로의 구분이 필요하지 아니하다.That is, the symbol data that has been interleaved by the third interleaver 1370 to be robust to the frequency selective fading of the channel is input to the frame forming unit 1370, and the frame forming unit 1370 uses the input symbol data to make a frame. Form data and output it. Similarly, the first interleaving process or the linear precoding process may not be used depending on implementation. In the single input single output method, it is not necessary to distinguish transmission paths according to multiple inputs and outputs as shown in FIGS. 8A and 8B.

신호 수신 장치의 경우, 프레임 파싱부(1430)에서 파싱(parsing)된 심볼 데이터를 제1디인터리버(1440)에 출력하여 송신 장치에서 채널의 주파수 선택적 페이딩에 강인하도록 처리한 과정의 역과정을 수행하도록 한다.In the case of the signal receiving apparatus, the symbol parsed by the frame parsing unit 1430 is output to the first deinterleaver 1440 to perform the reverse process of processing to make the transmitting apparatus robust to frequency selective fading of the channel. Do it.

상기 도 1 또는 도 13의 신호 송신 장치에서, 심볼 맵퍼(140 또는 1340)는 입력된 신호를 옵티멀 성상(optimal constellation) 방식에 따라 심볼 맵핑하여 출력할 수 있다.In the signal transmission apparatus of FIG. 1 or 13, the symbol mapper 140 or 1340 may symbol-map the input signal according to an optimal constellation scheme and output the symbol.

도 15는 본 발명에 따른 일 실시예로서, 옵티멀 성상(optimal constellation) 포인트의 위치를 개략적으로 나타낸 도면이다. 옵티멀 성상 맵핑을 위해 상기 포인트가 사용될 수 있다. 상기 성상 포인트의 숫자는 파워를 나타낸다.FIG. 15 is a diagram schematically illustrating a position of an optimal constellation point according to an embodiment of the present invention. The point may be used for optical constellation mapping. The number of constellation points represents power.

상기 옵티멀 성상 포인트들의 x축 값은 홀수(1, 3, 5, …) 또는 짝수(2, 4, 6, …)가 될 수 있으며, y축 값은

Figure 112008039495204-PAT00002
의 정수배가 될 수 있다.The x-axis value of the optical constellation points may be odd (1, 3, 5, ...) or even (2, 4, 6, ...), the y-axis value
Figure 112008039495204-PAT00002
It can be an integer multiple of.

예를 들어, x축 위에 위치한 포인트의 경우 1, 3, 5, …의 홀수 값을 가지며, 파워는 각각 1, 9, 25, … 이다. y축 위에 위치한 포인트의 경우

Figure 112008039495204-PAT00003
,
Figure 112008039495204-PAT00004
,
Figure 112008039495204-PAT00005
의 값을 가지며, 파워는 각각 3, 27, 75, … 이다. 파워가 13인 포인트의 경우, x축 값은 1이고, y축 값은
Figure 112008039495204-PAT00006
이다. 파워가 7인 포인트의 경우, x축 값은 2이고, y축 값은
Figure 112008039495204-PAT00007
이다. For example, for points located on the x-axis, 1, 3, 5,... Power values are 1, 9, 25,... to be. for points on the y axis
Figure 112008039495204-PAT00003
,
Figure 112008039495204-PAT00004
,
Figure 112008039495204-PAT00005
And the powers are 3, 27, 75,... to be. For points with a power of 13, the x-axis value is 1 and the y-axis value is
Figure 112008039495204-PAT00006
to be. For points with power of 7, the x-axis value is 2 and the y-axis value is
Figure 112008039495204-PAT00007
to be.

상기와 같이 포인트를 원형에 가깝게 위치시키고, 가능한 포인트의 위치를 DC위치에서 멀리함으로써, 전송 파워를 효율적으로 사용할 수 있다. As described above, by placing the point as close to the circle as possible and as far as possible from the DC position, the transmission power can be used efficiently.

상기 도 15와 같은 포인트들의 위치 이외에, 상기 포인트들을 x축, y축, 또는 원점에 대하여 대칭 시켜 얻어진 위치를 사용할 수도 있다. 또는, 상기 포인트들의 위치를 원점을 축으로 임의의 각도로 회전시켜 얻어진 위치를 사용할 수도 있다. 이는 구현 예에 따라 달라질 수 있다.In addition to the positions of the points shown in FIG. 15, a position obtained by symmetrical with respect to the x-axis, the y-axis, or the origin may be used. Alternatively, the positions obtained by rotating the positions of the points at arbitrary angles about the origin may be used. This may vary depending on implementation.

도 16은 본 발명에 따른 일 실시예로서, 옵티멀 성상의 포인트를 결정하는 순서를 나타낸 순서도이다. 상기 도 15와 같은 성상 포인트 가운데 필요한 수의 옵티멀 성상 포인트를 얻는다.FIG. 16 is a flowchart illustrating a procedure of determining an optical constellation point according to an embodiment of the present invention. The necessary number of optical constellation points are obtained among the constellation points as shown in FIG. 15.

먼저, 상기 도 15와 같은 성상 포인트 가운데 가장 작은 파워를 가지는 성상 포인트를 선택한다(S1600). 그리고 상기 선택된 성상 포인트의 수와 필요한 성상 포인트의 수를 비교한다(S1610). 만약, 상기 선택된 성상 포인트의 수가 더 적으면, 다시 S1600 단계를 수행하여 선택되지 않은 포인트 가운데 가장 작은 파워를 가지는 성상 포인트를 선택한다. 만약 상기 선택된 성상 포인트의 수가 더 크면, 넘은 포인트의 수만큼 파워가 큰 순서대로 성상 포인트를 제거한다(S1620). 상기와 같은 과정을 통해 원하는 수의 성상 포인트를 얻을 수 있으며, 상기 얻어진 성상 포인트를 이용하여 입력된 데이터를 심볼 데이터로 맵핑할 수 있다.First, a constellation point having the smallest power among constellation points as shown in FIG. 15 is selected (S1600). In operation S1610, the number of the selected constellation points and the number of necessary constellation points are compared. If the selected number of constellation points is smaller, step S1600 is performed again to select constellation points having the smallest power among the unselected points. If the selected number of constellation points is larger, the constellation points are removed in order of increasing power by the number of points exceeded (S1620). Through the above process, a desired number of constellation points can be obtained, and input data can be mapped to symbol data using the obtained constellation points.

도 17 내지 도 20은 본 발명에 따른 일 실시예로서, 상기와 같은 방식에 따라 선택된 포인트를 갖는 옵티멀 성상을 개략적으로 나타낸 도면이다. 즉, 도 17 내지 도 20은 각각 16포인트, 64포인트, 256포인트, 256포인트를 갖는 옵티멀 성상을 개략적으로 나타낸 도면이다. 다만, 도 19의 경우에는 상기 도 15에서 설명한 성상 포인트 위치와 다른 위치를 가지는 다른 실시예의 경우로서, DC위치에 가까운 성상 포인트를 가지는 경우이다.17 to 20 are diagrams illustrating an optical constellation having a point selected according to the above-described exemplary embodiment according to the present invention. That is, FIGS. 17 to 20 schematically illustrate an optical constellation having 16 points, 64 points, 256 points, and 256 points, respectively. 19 is a case of another embodiment having a position different from that of the constellation point described with reference to FIG. 15, and has a constellation point close to the DC position.

상기에서 설명한 바와 같이, 상기 도 17 내지 도 20의 포인트들의 위치 이외에, 상기 포인트들을 x축, y축, 또는 원점에 대하여 대칭 시켜 얻어진 위치를 사용할 수도 있다. 또는, 상기 포인트들의 위치를 원점을 축으로 임의의 각도로 회전시켜 얻어진 위치를 사용할 수도 있다. 이는 구현 예에 따라 달라질 수 있다.As described above, in addition to the positions of the points of FIGS. 17 to 20, positions obtained by symmetry of the points with respect to the x-axis, the y-axis, or the origin may be used. Alternatively, the positions obtained by rotating the positions of the points at arbitrary angles about the origin may be used. This may vary depending on implementation.

상기 심볼맵퍼(140 또는 1340)는 상기와 같이 정해진 포인트 수를 갖는 옵티멀 성상 맵핑 방식에 따라, 입력된 데이터를 심볼 맵핑하여 출력한다.The symbol mapper 140 or 1340 symbol-maps the input data and outputs the data according to the optical constellation mapping method having a predetermined number of points as described above.

상기와 같은 옵티멀 성상 방식에 따라 심볼 맵핑하여 전송하는 경우, 상기 도 9 또는 도 14의 신호 수신 장치에서, 심볼 디맵퍼(970 또는 1460)는 입력된 신호를 옵티멀 성상(optimal constellation) 방식에 따라 심볼을 디맵핑하여 출력한다. 이하 설명의 편의를 위해, 상기 도 1 또는 도 13의 심볼맵퍼(140 또는 1340)에서 64포인트를 갖는 옵티멀 성상 맵핑 방식에 따라 심볼 데이터를 맵핑하였다고 가정한다. 상기 포인트의 수는 설명의 편의를 위해 정한 하나의 실시 예에 불과하다.In the case of symbol mapping according to the optical constellation scheme as described above, in the signal receiving apparatus of FIG. 9 or 14, the symbol demapper 970 or 1460 may symbolize an input signal according to an optimal constellation scheme. Demap and print For convenience of explanation, it is assumed that symbol data is mapped according to an optical constellation mapping method having 64 points in the symbol mapper 140 or 1340 of FIG. 1 or 13. The number of points is only one embodiment determined for convenience of description.

도 21은 64포인트를 갖는 옵티멀 성상의 결정 경계(decision boundary)를 개략적으로 나타낸 블록도이다. 심볼디맵퍼(970 또는 1460)는 상기 도 21과 같은 결정 경계를 이용하여, 수신된 심볼 데이터를 디맵핑한다. 옵티멀 성상 맵핑 방식의 경우, 전송 파워를 효율적으로 사용하기 위해 벌집 구조의 성상을 가지며, 심볼디맵퍼(970 또는 1460)에서는 상기 도 21과 같이 심볼마다 육각형의 결정 경계를 갖는다. 다만, 가장 가장자리에 위치한 포인트에 해당하는 심볼은 육각형이 아닌 한 쪽면이 터진 형태의 결정 경계를 갖는다.21 is a block diagram schematically illustrating a decision boundary of an optical constellation having 64 points. The symbol demapper 970 or 1460 demaps the received symbol data using the decision boundary shown in FIG. 21. In the case of the optical constellation mapping scheme, the constellation has a honeycomb constellation in order to efficiently use transmission power, and the symbol demapper 970 or 1460 has hexagonal crystal boundaries for each symbol as shown in FIG. 21. However, the symbol corresponding to the point located at the edge has a crystal boundary of one side that is not hexagonal.

입력된 심볼 데이터가 상기 도 21과 같은 결정 경계 가운데 특정 육각형 내에 위치한 것으로 인식되면, 심볼디맵퍼(970 또는 1460)는 상기 입력된 심볼 데이터를 상기 특정 육각형에 해당하는 포인트의 심볼로 디맵핑한다.If it is recognized that the input symbol data is located in a specific hexagon among the crystal boundaries as shown in FIG. 21, the symbol demapper 970 or 1460 demaps the input symbol data into a symbol of a point corresponding to the specific hexagon.

도 22a는 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 심볼 디맵퍼를 개략적으로 나타낸 도면이고, 도 22b는 본 발명에 따른 일 실 시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 다른 심볼 디맵퍼를 개략적으로 나타낸 도면이다.22A is a diagram schematically illustrating a symbol demapper for demapping a received optical constellation symbol according to an embodiment of the present invention, and FIG. 22B is a diagram illustrating a received optical constellation symbol as an embodiment according to the present invention. FIG. Is a diagram schematically illustrating another symbol demapper to be mapped.

심볼디맵퍼(970 또는 1460)는 상기 도 21과 같은 옵티멀 성상의 결정 경계 전체를 한번에 이용하여 심볼 디맵핑을 할 수도 있고, 상기 도 22a, 22b의 심볼디맵퍼와 같이 직사각형 형태의 결정 경계를 사용하여 심볼 디맵핑을 할 수도 있다.The symbol demapper 970 or 1460 may perform symbol demapping using the entire crystal boundary of the optical property as shown in FIG. 21 at once, or use a rectangular crystal boundary as in the symbol demapper of FIGS. 22A and 22B. Symbol demapping.

상기 도 22a의 심볼디맵퍼는 제1결정부(2200), 제2결정부(2202), 제1회전부(2204), 제3결정부(2206), 제4결정부(2208), 제2회전부(2210), 제5결정부(2212), 제6결정부(2214), 및 비트 변환부(2216)를 포함한다. The symbol demapper of FIG. 22A includes a first determination unit 2200, a second determination unit 2202, a first rotation unit 2204, a third determination unit 2206, a fourth determination unit 2208, and a second rotation unit. 2210, a fifth decision unit 2212, a sixth decision unit 2214, and a bit converter 2216.

상기 심볼디맵퍼(970 또는 1460)에 심볼 데이터가 입력되면, 제1결정부(2200)는 육각형의 결정 경계 영역마다 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치하는지 결정한다. 제2결정부(2202)는 입력된 심볼 데이터가 성상 가장자리(constellation edge) 영역, 즉, 도 21과 같은 전체 결정 경계에서 도형을 이루지 않는 가장자리 영역에 위치하는 지에 대하여 결정을 내린다. 상기 제2결정부(2202)는 상기 가장자리 영역 가운데 실선으로 구분되는 결정 경계 영역에 위치하는지 결정한다. 상기 제1결정부(2200)와 제2결정부(2202)는 회전하지 않은 결정 경계를 이용하여, 입력된 심볼 데이터의 위치를 결정하는 결정부이다.When symbol data is input to the symbol demapper 970 or 1460, the first determination unit 2200 uses the rectangular crystal boundary region using two faces facing each other in the hexagonal crystal boundary region to input the symbol data. Determines whether is located in the crystal boundary region of the rectangular shape. The second decision unit 2202 makes a determination as to whether the input symbol data is located in a constellation edge region, that is, in an edge region which does not form a shape on the entire crystal boundary as shown in FIG. 21. The second determination unit 2202 determines whether the second determination unit 2202 is located in a crystal boundary region divided by a solid line among the edge regions. The first determination unit 2200 and the second determination unit 2202 are determination units that determine the position of the input symbol data by using a non-rotating decision boundary.

제1회전부(2204)는 상기 제1결정부(2200)와 제2결정부(2202)에서 사용된 결정 경계 전체를 60도 회전시키는 역할을 한다. 상기 제1회전부(2204)에서 출력된 데이터는 제3결정부(2206)에 입력된다. 상기 제3결정부(2206)는 상기 60도 회전된 전체 결정 경계 영역 가운데, 육각형의 결정 경계 영역마다 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치하는지 결정한다. 제4결정부(2208)는 입력된 심볼 데이터가 성상 가장자리 영역에 위치하는지에 대하여 결정을 내린다. 상기 제4결정부(2208)는 상기 가장자리 영역 가운데 1점 쇄선으로 구분되는 결정 경계 영역에 위치하는지 결정한다. 상기 제3결정부(2206)와 제4결정부(2208)는 1회 회전, 즉 60도 회전한 결정 경계를 이용하여, 입력된 심볼 데이터의 위치를 결정하는 결정부이다.The first rotating unit 2204 rotates the entire crystal boundary used by the first determining unit 2200 and the second determining unit 2202 by 60 degrees. Data output from the first rotating unit 2204 is input to the third determining unit 2206. The third crystal part 2206 uses a rectangular crystal boundary region using two faces facing each of the hexagonal crystal boundary regions among the entire crystal boundary regions rotated by 60 degrees, so that the input symbol data is in the rectangular form. Determine if it is located in the boundary area of the decision. The fourth decision unit 2208 determines whether the input symbol data is located in the constellation edge region. The fourth determination unit 2208 determines whether the fourth determination unit 2208 is located in a crystal boundary region divided by a dashed-dotted line among the edge regions. The third determination unit 2206 and the fourth determination unit 2208 are determination units that determine the position of the input symbol data by using the determination boundary rotated once, that is, rotated by 60 degrees.

제2회전부(2210)는 상기 제3결정부(2206)와 제4결정부(2208)에서 사용된 결정 경계 전체를 다시 60도 회전시키는 역할을 한다. 상기 제2회전부(2210)에서 출력된 데이터는 제5결정부(2212)에 입력된다. 제5결정부(2212)는 상기 다시 60도가 회전된 전체 결정 경계 영역 가운데 육각형의 결정 경계 영역마다 마주보는 두 면을 이용한 직사각형 형태의 결정 경계를 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계에 위치하는지 결정한다. 제6결정부(2214)는 입력된 심볼 데이터가 성상 가장자리 영역에 위치하는지에 대하여 결정을 내린다. 상기 제6결정부(2214)는 상기 가장자리 영역 가운데 점선으로 구분되는 결정 경계 영역에 위치하는지 결정한다. 상기 제5결정부(2212)와 제6결정부(2214)는 2회 회전, 즉 본래 결정 경계와 비교하여 120도 회전한 결정 경계를 이용하여, 입력된 심볼 데이터의 위치를 결정하는 결정부이다.The second rotating part 2210 rotates the entire crystal boundary used by the third and second crystal parts 2206 and 2208 by 60 degrees. Data output from the second rotating unit 2210 is input to the fifth determining unit 2212. The fifth decision unit 2212 uses the rectangular crystal boundary using two faces facing each of the hexagonal crystal boundary regions among the entire crystal boundary regions rotated by 60 degrees again, so that the input symbol data is determined in the rectangular form. Determine if you are at the boundary. The sixth decision unit 2214 determines whether the input symbol data is located in the constellation edge region. The sixth determination unit 2214 determines whether the sixth determination unit 2214 is located in a crystal boundary region divided by a dotted line among the edge regions. The fifth determination unit 2212 and the sixth determination unit 2214 are determination units that determine the position of the input symbol data by using a determination boundary that is rotated twice, that is, rotated 120 degrees relative to the original determination boundary. .

상기 제2결정부(2202), 제4결정부(2208), 제6결정부(2214)에서 성상 가장자 리 영역에 대하여 결정하는 경우, x축, y축에 평행한 위치에 대한 결정은 새츄레이션(saturation) 기법을 사용하고, 사선 형태의 위치에 대한 결정은 상기 사선에 해당하는 직선 방정식을 이용하여 결정한다.When the second crystal part 2202, the fourth crystal part 2208, and the sixth crystal part 2214 determine the edge region of the constellation, the decision on the position parallel to the x-axis and the y-axis is performed. The saturation technique is used, and the determination of the position of the oblique form is determined using the linear equation corresponding to the oblique line.

비트 변환부(2216)는 상기 각 결정부에서 결정된 정보 즉, 입력된 심볼 데이터를 대응되는 포인트의 심볼로 결정한 값을 이용하여, 상기 결정된 심볼 값에 해당하는 비트 데이터로 변환한다. The bit converter 2216 converts the information determined by the determination units, that is, the input symbol data into the bit data corresponding to the determined symbol value by using a value determined as a symbol of a corresponding point.

상기와 같이 2회의 회전과 6번의 결정 과정을 모두 수행할 수도 있고, 상기 6번의 결정 가운데 특정 결정에 의하여, 수신된 심볼 데이터에 대응되는 포인트의 심볼이 결정되면, 더 이상의 회전이나 결정은 하지 않고 바로 비트 변환부(2216)에 상기 결정 정보를 출력하여 비트 데이터로 변환할 수도 있다. 이는 구현 예에 따라 달라질 수 있다. 또한, 상기 각 회전부에서는 결정 경계를 각각 60도씩 회전시켰으나, 반대로 각각 -60도씩 회전시킬 수도 있다.As described above, both the two rotations and the six decision processes may be performed. If a symbol of a point corresponding to the received symbol data is determined by a specific decision among the six determinations, no further rotation or determination is performed. The decision information may be directly output to the bit converter 2216 and converted into bit data. This may vary depending on implementation. In addition, although the crystal boundaries are rotated by 60 degrees in each of the rotating units, they may be rotated by -60 degrees in the reverse direction.

도 22b는 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 다른 심볼 디맵퍼를 개략적으로 나타낸 도면이다. 상기 도 22b의 심볼 디맵퍼는 피드백(feed-back)을 이용한 반복(recursive) 디코딩 방식의 실시예이다.FIG. 22B is a diagram schematically illustrating another symbol demapper for demapping a received optical constellation symbol according to an embodiment of the present invention. The symbol demapper of FIG. 22B is an embodiment of a recursive decoding method using feedback.

상기 도 22b의 심볼 디맵퍼는 버퍼(2220), 선택부(2222), 제1결정부(2224), 제2결정부(2226), 회전부(2228), 및 비트 변환부(2230)를 포함한다.The symbol demapper of FIG. 22B includes a buffer 2220, a selector 2222, a first determiner 2224, a second determiner 2226, a rotater 2228, and a bit converter 2230. .

버퍼(2220)는 입력된 심볼 데이터를 임시 저장하였다 출력한다. 선택부(2222)는 상기 버퍼(2220)에서 출력된 심볼 데이터와 회전부(2228)에서 출력된 심볼 데이터를 입력받아, 하나의 심볼 데이터를 출력한다. 상기 선택부(2222)는 반 복 디코딩을 수행하는 경우 상기 회전부(2228)에서 피드백된 심볼 데이터를 출력하며, 새로운 심볼 데이터에 대하여 결정 과정을 수행하는 경우 상기 버퍼(2220)로부터 입력된 심볼 데이터를 출력한다.The buffer 2220 temporarily stores and outputs the input symbol data. The selector 2222 receives the symbol data output from the buffer 2220 and the symbol data output from the rotation unit 2228 and outputs one symbol data. The selector 2222 outputs symbol data fed back from the rotation unit 2228 when performing the repeated decoding, and when the decision process is performed on new symbol data, the selector 2222 outputs the symbol data input from the buffer 2220. Output

제1결정부(2224)는 육각형의 결정 경계 영역마다 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치하는지 결정한다. 그리고 제2결정부(2226)는 입력된 심볼 데이터가 성상 가장자리(constellation edge) 영역, 즉, 도 21과 같은 전체 결정 경계에서 도형을 이루지 않는 가장자리 영역에 위치하는 지에 대하여 결정을 내린다. 상기 제2결정부(2226)는 회전된 횟수에 따라, 각각 실선(0회 회전), 1점 쇄선(1회 회전), 점선(2회 회전)으로 구분되는 결정 경계 영역에 위치하는지 결정한다. 회전부(2228)는 상기 제1결정부(2224)와 제2결정부(2226)에서 사용된 결정 경계 전체를 60도 회전시키는 역할을 한다. 또는, 구현 예에 따라 -60도씩 회전시키도록 할 수도 있다.The first determination unit 2224 determines whether the input symbol data is located in the rectangular crystal boundary region by using a rectangular crystal boundary region using two faces facing each of the hexagonal crystal boundary regions. The second determination unit 2226 determines whether the input symbol data is located in a constellation edge region, that is, in an edge region which does not form a shape on the entire crystal boundary as shown in FIG. 21. The second determination unit 2226 determines whether the second determination unit 2226 is located in a crystal boundary region divided by a solid line (0 rotation), a dashed chain (1 rotation), and a dotted line (2 rotation), respectively. The rotating unit 2228 rotates the entire crystal boundary used by the first and second determination units 2224 and 2226 by 60 degrees. Or, it may be rotated by -60 degrees depending on the embodiment.

비트 변환부(2230)는 상기 각 결정부에서 결정된 정보 즉, 입력된 심볼 데이터를 대응되는 포인트의 심볼로 결정한 값을 이용하여, 상기 결정된 심볼 값에 해당하는 비트 데이터로 변환한다. The bit converter 2230 converts the information determined by each determiner, that is, the input symbol data into a bit data corresponding to the determined symbol value by using a value determined as a symbol of a corresponding point.

상기 22b의 심볼 디맵퍼는 2회의 회전과 6번의 결정 과정을 모두 수행할 수도 있고, 반복 디코딩 과정 중에 상기 제1결정부(2224)와 제2결정부(2226)에서, 입력된 심볼 데이터에 대응되는 포인트의 심볼을 결정하면 바로 비트 변환부(2230)에 상기 결정 정보를 출력하여 비트 데이터로 변환할 수도 있다. 이는 구현 예에 따라 달라질 수 있다.The symbol demapper of 22b may perform both two rotations and six determinations. The symbol demapper of the 22b may correspond to the input symbol data in the first determination unit 2224 and the second determination unit 2226 during an iterative decoding process. When the symbol of the point to be determined is determined, the determination information may be immediately output to the bit converter 2230 to be converted into bit data. This may vary depending on implementation.

도 23은 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 과정을 개략적으로 나타낸 도면이고, 도 24는 본 발명에 따른 일 실시예로서, 가장자리(edge) 영역의 수신된 옵티멀 성상 심볼을 디맵핑하는 과정을 개략적으로 나타낸 도면이다.FIG. 23 is a diagram schematically illustrating a process of demapping a received optical constellation symbol according to an embodiment of the present invention, and FIG. 24 is a diagram illustrating received optical of an edge region as an embodiment according to the present invention. A diagram schematically illustrating a process of demapping constellation symbols.

상기 도 23은 전체 결정 경계 가운데 4개의 육각형 형태의 결정 경계 영역을 나타낸 도면이다. 상기 도면은 상기 도 22a 또는 도 22b의 결정부 가운데, 육각형의 결정 경계 영역에서 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치하는지 결정하는 결정부의 결정 과정을 나타낸다.FIG. 23 is a view showing four hexagonal crystal boundary regions among the entire crystal boundaries. The figure determines whether symbol data is located in the rectangular crystal boundary region by using a rectangular crystal boundary region using two faces facing each other in the hexagonal crystal boundary region among the crystal portions of FIG. 22A or 22B. The decision process of the decision part is shown.

우선, 회전하지 않은 첫 번째 결정 경계 형태에서, 육각형의 결정 경계 영역마다 좌우의 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치하는지 결정한다. 상기 결정이 끝나면 상기 결정 경계 전체를 60도 회전시켜, 다시 육각형의 결정 경계 영역마다 좌우의 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 포함되는지 결정한다. 그리고 결정 경계 전체를 다시 60도 회전시켜, 육각형의 결정 경계 영역마다 좌우의 마주보는 두 면을 이용한 직사각형 형태의 결정 경계를 이용하여, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 포함되는지 결정한다. 상기 도 23에서 두 번째 결정 경계 형태와 세 번째 결정 경계 형태는 상기 회전을 거치면서 결정과정을 거치는 영역을 중첩적으로 표현하였다. First, in the first non-rotating crystal boundary form, the input symbol data is positioned in the rectangular crystal boundary region using a rectangular crystal boundary region using two opposite sides of the hexagonal crystal boundary region. Determine. After the determination is completed, the entire crystal boundary is rotated by 60 degrees, and the input symbol data is converted into the rectangular crystal boundary by using a rectangular crystal boundary region using two opposite sides of each hexagonal crystal boundary region. Determine if it is included in the zone. Then, the entire crystal boundary is rotated by 60 degrees again to determine whether the input symbol data is included in the rectangular crystal boundary region by using the rectangular crystal boundary using two opposite sides of the hexagonal crystal boundary region. do. In FIG. 23, the second crystal boundary shape and the third crystal boundary shape overlap with each other in the region undergoing the decision process while the rotation is performed.

상기와 같이 2회 회전을 통해, 상기 직사각형 형태의 결정 경계 영역은 육각형 내부의 모든 영역을 커버할 수 있다. 따라서, 상기 육각형의 결정 경계 영역 각각에 대해, 상기 육각형의 결정 경계 영역을 갖는 포인트에 대응되는 심볼로 디맵핑할 수 있다.Through two rotations as described above, the rectangular crystal boundary region may cover all regions inside the hexagon. Therefore, for each of the hexagonal crystal boundary regions, it is possible to demap to a symbol corresponding to a point having the hexagonal crystal boundary region.

구현 예에 따라, 입력된 심볼 데이터가 상기 직사각형 형태의 결정 경계 영역에 위치한 것으로 인식되면, 남은 회전과 결정을 수행하지 않고 결정 과정을 마무리할 수도 있다. 그리고, 상기 설명에서는 육각형의 좌우 마주보는 두 면을 이용한 직사각형 형태의 결정 경계 영역을 이용하였으나, 좌우 면 이외, 다른 마주보는 두 면을 이용한 영역, 예를 들어, 비스듬히 기울어진 직사각형 형태의 결정 경계 영역을 이용할 수도 있다.According to an embodiment, if it is recognized that the input symbol data is located in the crystal boundary region of the rectangular shape, the determination process may be completed without performing the remaining rotation and determination. In the above description, although a rectangular crystal boundary region using two opposite sides of a hexagon is used, an area using two opposite sides other than the left and right sides, for example, an obliquely inclined rectangular boundary region, is used. Can also be used.

상기 도 24는 64포인트 옵티멀 성상 맵핑 방식의 전체 결정 경계를 나타낸 도면이다. 상기 도 24는 상기 도 22a, 22b의 결정부 가운데 입력된 심볼 데이터가 성상 가장자리(constellation edge) 영역, 즉, 도형을 이루지 않는 가장자리 영역에 위치하는 지에 대하여 결정을 내리는 결정부의 결정 과정을 나타낸다.24 is a diagram illustrating an entire decision boundary of the 64-point optical constellation mapping method. FIG. 24 illustrates a determination process of a decision unit for making a determination as to whether the symbol data input among the determination units of FIGS. 22A and 22B is located in a constellation edge region, that is, an edge region that does not form a figure.

우선, 회전하지 않은 첫 번째 결정 경계 형태에서, 입력된 심볼 데이터가 성상 경계 영역 가운데, 실선으로 구분되는 영역에 위치하는지 결정한다. 상기 결정이 끝나면 상기 결정 경계 전체를 60도 회전시켜, 성상 경계 영역 가운데, 1점 쇄선으로 구분되는 영역에 위치하는지 결정한다. 그리고 결정 경계 전체를 다시 60도 회전시켜, 점선으로 구분되는 영역에 위치하는지 결정한다.First, in the first non-rotating decision boundary form, it is determined whether the input symbol data is located in a region separated by a solid line among the constellation boundary regions. After the determination is completed, the entire crystal boundary is rotated by 60 degrees to determine whether it is located in a region separated by a dashed line among constellation boundary regions. Then, the entire crystal boundary is rotated 60 degrees again to determine whether it is located in the area divided by a dotted line.

구현 예에 따라, 상기 실선으로 구분되는 영역, 1점 쇄선으로 구분되는 영역, 점선으로 구분되는 영역의 순서가 바뀔 수도 있다. 예를 들어, 도 24의 첫 번째 결정 경계 형태에서 점선으로 구분되는 영역의 결정 후에, 회전에 따라 각각 실선(1회 회전), 1점 쇄선(2회 회전)으로 구분되는 영역의 결정을 할 수도 있다. According to an embodiment, the order of the area divided by the solid line, the area divided by the dashed-dotted line, and the area divided by the dotted line may be changed. For example, after the determination of the area divided by the dotted line in the first crystal boundary form of FIG. 24, the area divided by the solid line (one rotation) and the dashed-dotted line (two rotations) may be determined according to the rotation. have.

마찬가지로 상기 도 23과 24의 예에서는 60도씩 회전시켰으나, 구현 예에 따라 반대로 -60도씩 회전시킬 수도 있다.Likewise, in the examples of FIGS. 23 and 24, the rotation is performed by 60 degrees. However, depending on the embodiment, the rotation may be rotated by -60 degrees.

도 25는 본 발명에 따른 일 실시예로서, 다른 신호 송신 장치를 개략적으로 나타낸 블록도이다. 상기 도 25의 신호 송신 장치는 도 1과 같은 신호 송신 장치에 다중 맵핑 방식을 사용하는 경우의 예이다.25 is a block diagram schematically showing another signal transmission apparatus according to an embodiment of the present invention. The signal transmission apparatus of FIG. 25 is an example of using a multiple mapping scheme for the signal transmission apparatus of FIG. 1.

도 25의 실시예는 아웃터 인코더(Outer encoder)(2500), 인너 인코더(Inner encoder)(2510), 제1인터리버(interleaver)(2520), 다중 맵퍼(mapper)(2530), 선형 프리코딩부(2540), 제2인터리버(2550), 프레임 형성부(frame builder)(2560), 변조부(modulator)(2570) 및 전송부(2580)를 포함한다. 그리고, 구현 예에 따라 상기 아웃터 인코더(2500)와 인너 인코더(2510) 사이에 아웃터 인터리버가 추가될 수도 있고, 제2인터리버(2550)와 프레임형성부(2560) 사이에 다중 입출력 인코더가 추가될 수도 있다.The embodiment of FIG. 25 includes an outer encoder 2500, an inner encoder 2510, a first interleaver 2520, a multiple mapper 2530, a linear precoding unit ( 2540, a second interleaver 2550, a frame builder 2560, a modulator 2570, and a transmitter 2580. An outer interleaver may be added between the outer encoder 2500 and the inner encoder 2510, and a multiple input / output encoder may be added between the second interleaver 2550 and the frame forming unit 2560, according to an embodiment. have.

상기 아웃터 인코더(2500)와 인너 인코더(2510)는 각각 입력된 신호를 부호화하여 출력함으로써, 전송되는 데이터에 발생한 오류를 수신기에서 검출하고, 상기 오류를 수정할 수 있도록 한다. 즉, 상기 아웃터 인코더(2500)와 인너 인코더(2510)는 순방향 오류정정 인코더(Forward Error Correcting : FEC)로 볼 수 있 다. 상기 각 인코더의 종류는, 해당하는 신호 송신 시스템에서 사용하는 코딩 방식에 따라 다를 수 있다.The outer encoder 2500 and the inner encoder 2510 encode and output the input signal, respectively, so that an error occurring in the transmitted data can be detected by the receiver and the error can be corrected. That is, the outer encoder 2500 and the inner encoder 2510 may be regarded as a forward error correcting encoder (FEC). The type of each encoder may vary according to a coding scheme used in a corresponding signal transmission system.

제1인터리버(2520)는 상기 인너 인코더(2510)에서 출력된 신호가 전송될 경우 겪을 수 있는 버스트 에러(burst error)에 강인하도록 데이터 열을 랜덤한 위치로 분산시키는 역할을 한다. 예를 들어, 상기 제1인터리버(2520)에는 블록(block) 인터리빙 방식이나 컨벌루션(convolution) 인터리빙 방식 등이 사용될 수 있다. 상기 제1인터리버(2520)의 종류는 해당하는 신호 송신 시스템에서 사용하는 방식에 따라 다를 수 있다.The first interleaver 2520 distributes the data sequence to a random position so as to be robust to a burst error that may occur when the signal output from the inner encoder 2510 is transmitted. For example, a block interleaving method or a convolution interleaving method may be used for the first interleaver 2520. The type of the first interleaver 2520 may vary depending on the method used in the corresponding signal transmission system.

다중 맵퍼(2530)는 상기 제1인터리버(2520)에서 인터리빙된 데이터를 전송 방식에 따른 심볼(symbol)로 맵핑한다. 상기 다중 맵퍼(2530)는 복수의 맵핑 방식을 혼합하여 사용함으로써, 입력된 데이터를 심볼 데이터로 맵핑한다. 상기 맵핑 방식으로 QAM(Quadrature Amplitude Modulation), QPSK(Quadrature Phase Shift Keying), APSK(Amplitude Phase Shift Keying), PAM(Pulse Amplitude Modulation), 옵티멀 성상(optimal constellation) 등이 사용될 수 있다.The multiple mapper 2530 maps the data interleaved in the first interleaver 2520 into symbols according to a transmission scheme. The multiple mapper 2530 mixes a plurality of mapping methods to map input data to symbol data. Quadrature Amplitude Modulation (QAM), Quadrature Phase Shift Keying (QPSK), Amplitude Phase Shift Keying (APSK), Pulse Amplitude Modulation (PAM), and Optimal Constellation may be used as the mapping scheme.

상기와 같은 다중 맵핑방식을 사용하여, 작은 성상(constellation) 사이즈(size)에 맵핑하는 방식으로부터는 SNR(Signal to Noise Ratio) 이득을 얻을 수 있고, 큰 성상 사이즈에 맵핑하는 방식으로부터는 전송률 이득(capacity gain)을 얻을 수 있다. 따라서, 상기 맵핑방식의 혼합 비율을 조절하여 SNR과 전송률 사이의 이득을 조정할 수 있고, 전송 효율을 높일 수 있다.Using the multiple mapping scheme as described above, a signal to noise ratio (SNR) gain can be obtained from the method of mapping to a small constellation size, and the rate gain (from a method of mapping to a large constellation size) can be obtained. capacity gain) can be obtained. Therefore, the gain between the SNR and the transmission rate can be adjusted by adjusting the mixing ratio of the mapping scheme, and the transmission efficiency can be improved.

도 26은 본 발명에 따른 일 실시예로서, 다중 맵퍼를 개략적으로 나타낸 블 록도이다. 상기 다중 맵퍼(2530)는 비트 스트림 분배부(2531), 제1맵퍼(2532), 제2맵퍼(2533), …, 제N맵퍼(2534), 및 심볼 인터리버(2535)를 포함한다.26 is a block diagram schematically illustrating a multiple mapper according to an embodiment of the present invention. The multiple mapper 2530 includes a bit stream distributor 2253, a first mapper 2532, a second mapper 2533,. , An N-th mapper 2534, and a symbol interleaver 2535.

상기 비트 스트림 분배부(2531)는 입력된 비트 데이터를 여러 개의 맵퍼에 분배한다. 상기 비트 스트림 분배부(2531)는 상기 각 맵퍼의 맵핑 방식에 따라 심볼에 맵핑하기 위해 필요한 수의 비트 데이터를 분배한다.The bit stream distributor 2253 distributes the input bit data to a plurality of mappers. The bit stream distributor 2253 distributes the required number of bit data for mapping to symbols according to the mapping method of each mapper.

도 27은 본 발명에 따른 일 실시예로서, 비트 스트림 분배 방식을 나타낸 도면이다. 즉, 상기 비트 스트림 분배 방식은 상기 비트 스트림 분배부(2531)에서 비트 스트림을 분배하는 방식의 일 예를 나타낸다.27 illustrates a bit stream distribution scheme according to an embodiment of the present invention. That is, the bit stream distribution method represents an example of a method of distributing a bit stream in the bit stream distribution unit 2531.

상기 도 27의 비트 스트림 분배 방식은, 입력되는 비트 데이터를 매트릭스(Matrix) 형태의 저장 공간(memory space)에 일정 패턴으로 저장하고, 상기 저장 패턴과 다른 패턴으로 데이터를 읽어 출력한다. 상기와 같은 경우, 일종의 가상 인터리버(virtual interleaver)의 효과를 얻을 수 있다. In the bit stream distribution method of FIG. 27, input bit data is stored in a matrix-type storage space in a predetermined pattern, and data is read and output in a pattern different from the storage pattern. In this case, the effect of a kind of virtual interleaver can be obtained.

설명의 편의를 위해, 입력된 비트 데이터를 분배할 맵퍼의 개수가 2개인 경우를 가정한다. 예를 들어, 상기 비트 스트림 분배부(2531)에 입력된 한 블럭의 길이를 M×N 비트(bit)라고 할 때, 상기 블록을 M등분으로 나누어 저장공간에 1열 1행 위치에서부터 채운다. 1열의 1행에서부터 시작하여 1열의 M행까지 데이터를 저장하며, 상기 1열이 다 채워지면 그 다음 열(2열)의 1행에서부터 시작하여 M행까지 데이터를 저장한다. 상기와 같은 순서로 N열의 M행까지 데이터를 저장할 수 있다. 이때, 상기 저장공간의 MSB(Most Significant Bit) 위치는 좌측 최상단이며, LSB(Least Significant Bit) 위치는 우측 최하단이다.For convenience of explanation, it is assumed that the number of mappers for distributing input bit data is two. For example, when the length of one block input to the bit stream distribution unit 2253 is M × N bits, the block is divided into M equal parts and filled in the storage space from one row to one row. Data is stored starting from row 1 of column 1 up to row M, and when the column 1 is filled up, data is stored starting from row 1 of the next column (column 2) up to row M. Data can be stored up to M rows of N columns in the above order. In this case, the MSB (Most Significant Bit) position of the storage space is at the top left, and the LSB (Least Significant Bit) position is at the bottom right.

상기 2개의 맵퍼에서, 첫 번째와 두 번째 맵퍼의 심볼에 대한 비트 비율이 M-R : M 이라고 할 경우, 상기 저장공간에 저장된 데이터를 각각 M-R개의 행과 R개의 행으로 나누어 분배한다. 상기 나누어진 비트 데이터는 행 방항으로 출력된다. 즉, 1행 1열의 데이터에서부터 시작하여 1행 N열까지 해당 행의 데이터를 읽어서 출력하고, 해당 행의 데이터를 모두 읽으면, 다음 아래 행(2행)의 1열부터 시작하여 우측 방향으로 해당 행의 데이터를 읽어서 출력한다. 상기와 같은 순서로 M-R행까지 데이터를 읽어서 첫 번째 맵퍼에 출력한다. 그리고 나머지 R개의 행에 대해서도 행 방향으로 데이터를 읽어서 두 번째 맵퍼에 출력한다. In the two mappers, when the bit ratio of the symbols of the first and second mappers is M-R: M, the data stored in the storage space is divided into M-R rows and R rows, respectively. The divided bit data is output in a row manner. In other words, starting from the data of 1 row and 1 column, reading the data of the row up to 1 row N column, and reading all the data of the row, starting from the 1 column of the next lower row (row 2) to the right direction Read and output the data. In the same order as above, the data is read up to the M-R line and output to the first mapper. The data of the remaining R rows is also read in the row direction and output to the second mapper.

상기 실시 예에서 블록의 크기, 저장 패턴, 읽기 패턴 등은 하나의 실시 예이며 이는 구현 예에 따라 달라질 수 있다. 예를 들어, 입력된 비트 데이터를 입력된 순서대로 각 맵퍼에 분배하는 것도 가능하다.In the above embodiment, the size of the block, the storage pattern, the read pattern, and the like are one embodiment, which may vary depending on the embodiment. For example, it is also possible to distribute the input bit data to each mapper in the input order.

상기 비트 스트림 분배부(2531)에서 분배된 비트 데이터는 각 맵퍼(제1맵퍼(2532) 내지 제N맵퍼(2534))에 출력된다. 상기 제1맵퍼(2532) 내지 제N맵퍼(2534)는 입력된 비트 데이터를 심볼 데이터로 맵핑하는 맵핑부로 볼 수 있다. 상기 각 맵퍼는 해당 맵핑 방식에 따라서, 입력된 비트 데이터를 심볼 데이터로 맵핑한다. 상기 맵핑 방식으로 QAM, QPSK, APSK, PAM, 옵티멀 성상(optimal constellation) 등이 사용될 수 있다.The bit data distributed by the bit stream distributor 2253 is output to each mapper (first mapper 2532 to N-th mapper 2534). The first mapper 2532 to the N-th mapper 2534 may be viewed as a mapping unit that maps the input bit data into symbol data. Each mapper maps the input bit data into symbol data according to a corresponding mapping scheme. QAM, QPSK, APSK, PAM, optimal constellation, etc. may be used as the mapping scheme.

상기 각 맵퍼(제1맵퍼(2532) 내지 제N맵퍼(2534))는 같은 종류의 맵핑 방식을 사용하면서, 한 심볼에 포함되는 비트 데이터의 수를 다르게 할 수도 있고, 각 맵퍼마다 다른 종류의 맵핑 방식을 사용할 수도 있다. 예를 들어, 제1맵퍼(2532) 내지 제N맵퍼(2534) 모두 QAM 방식을 사용하면서, 제1맵퍼(2532)는 16QAM, 제2맵퍼(2533)는 64QAM, 제N맵퍼(2534)는 256QAM으로 심볼 맵핑하도록 할 수 있다. 또는, 제1맵퍼(2532)는 QAM 방식으로 맵핑하고, 제N맵퍼(2534)는 옵티멀 성상 방식으로 맵핑할 수 있다. 상기 예는 구현 예에 따라 달라질 수 있다.Each of the mappers (the first mapper 2532 to the N-th mapper 2534) may use the same type of mapping scheme, and may vary the number of bit data included in one symbol, and different types of mapping for each mapper. You can also use the method. For example, while the first mapper 2532 to the N-th mapper 2534 use the QAM method, the first mapper 2532 is 16QAM, the second mapper 2533 is 64QAM, and the N-th mapper 2534 is 256QAM. Symbol mapping. Alternatively, the first mapper 2532 may map in a QAM scheme, and the N-th mapper 2534 may map in an optical constellation scheme. The example may vary depending on the implementation.

상기 각 맵퍼(제1맵퍼(2532) 내지 제N맵퍼(2534))는 정해진 맵핑 방식에 따라, 입력된 데이터를 심볼 맵핑하여 출력한다.Each mapper (the first mapper 2532 to the N-th mapper 2534) performs symbol mapping on the input data and outputs the data according to a predetermined mapping method.

심볼 인터리버(2535)는 상기 각 맵퍼에서 출력된 심볼데이터를 인터리빙하여 하나의 심볼열로 정렬하여 출력한다. 상기 인터리빙 방식으로 블록 인터리빙 방식, 컨벌루션 인터리빙, 또는 상기 심볼들을 하나의 블럭(block)으로 정한 후 블럭의 순서에 해당하는 어드레스(address)를 비트 역전시킨 순서로 출력하는 비트 역전 어드레싱(bit-reversed addressing)을 이용한 인터리빙 방식 등을 사용할 수 있다. 또는 상기 심볼을 인터리빙 시키지 않고, 단순히 상기 각 맵퍼에서 출력된 심볼데이터를 정해진 순서대로 단순히 정렬하여 출력할 수도 있다. 이는 구현 예에 따라 달라질 수 있다.The symbol interleaver 2535 interleaves the symbol data output from the mappers, sorts them into one symbol string, and outputs the result. Bit-reversed addressing, in which the block interleaving method, the convolutional interleaving method, or the symbols are designated as one block, and then the addresses corresponding to the order of the blocks are output in the order of bit inversion. ) May be used for interleaving. Alternatively, the symbol data output from the respective mappers may be simply arranged in a predetermined order and output without interleaving the symbols. This may vary depending on implementation.

선형 프리코딩부(2540)는 입력된 심볼 데이터를 여러 개의 출력 심볼 데이터에 분산시켜, 주파수 선택적 페이딩(frequency selective fading) 채널을 겪었을 때 모든 정보가 페이딩으로 손실될 확률을 줄여준다. 상기 선형 프리코딩부(2540)는 구현 예에 따라 사용되지 않을 수도 있다.The linear precoding unit 2540 distributes the input symbol data into a plurality of output symbol data to reduce the probability that all information is lost due to fading when subjected to a frequency selective fading channel. The linear precoding unit 2540 may not be used depending on implementation.

제2인터리버(2550)는 상기 선형프리코딩부(2540)에서 출력된 심볼 데이터를 다시 인터리빙하여, 상기 심볼 데이터가 동일한 주파수 선택적인 페이딩을 겪지 않 도록 한다. 상기 제2인터리버(2550)에는 블록 인터리빙 방식이나 컨벌루션 인터리빙 방식 등이 사용될 수 있다.The second interleaver 2550 interleaves the symbol data output from the linear precoding unit 2540 again so that the symbol data does not experience the same frequency selective fading. The second interleaver 2550 may use a block interleaving method or a convolutional interleaving method.

프레임 형성부(2560)는 상기 인터리빙된 신호를 직교 주파수 다중 분할(Orthogonal Frequency Division Multiplex : OFDM) 방식으로 변조할 수 있도록, 데이터 구간에 파일럿(pilot) 신호를 삽입하여 프레임을 형성한다. 변조부(2570)는 상기 프레임 형성부(2560)에서 출력된 데이터들을 각각 OFDM의 서브 캐리어들에 실어 전송할 수 있도록 보호 구간(guard interval)을 삽입하여 변조한다. 전송부(2580)는 변조부(2570)에서 출력된 보호 구간과 데이터 구간을 가진 디지털 형식의 신호를 아날로그 신호로 변환하여 송신(transmit)한다.The frame forming unit 2560 forms a frame by inserting a pilot signal in a data section so that the interleaved signal can be modulated by an orthogonal frequency division multiplex (OFDM) scheme. The modulator 2570 inserts a guard interval to modulate the data output from the frame forming unit 2560 on subcarriers of OFDM. The transmitter 2580 converts a digital signal having a guard period and a data period output from the modulator 2570 into an analog signal and transmits the signal.

도 28은 본 발명에 따른 일 실시예로서, 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 도 28의 실시예는 상기 도 25의 송신 장치에 대응되는 수신 장치로, 도 9와 같은 신호 수신 장치에 다중 맵핑 방식이 사용된 경우의 예이다.28 is a block diagram schematically illustrating an apparatus for receiving a signal according to an embodiment of the present invention. The embodiment of FIG. 28 is an example of a case where a multiple mapping scheme is used for the signal receiving apparatus of FIG. 9 as a receiving apparatus corresponding to the transmitting apparatus of FIG. 25.

도 28의 본 발명에 따른 실시예는 수신부(2800), 동기부(2810), 복조부(2820), 프레임 파싱(parsing)부(2830), 제1디인터리버(deinterleaver)(2840), 선형 프리코딩 디코더(2850), 다중 디맵퍼(demapper)(2860), 제2디인터리버(2870), 인너 디코더(inner decoder)(2880) 및 아웃터 디코더(outer decoder)(2890)를 포함한다. 그리고, 구현 예에 따라 상기 인너 디코더(2880)와 아웃터 디코더(2890) 사이에 아웃터 디인터리버가 추가될 수 있고, 프레임 파싱부(2830)와 제1디인터리버(2840) 사이에 다중 입출력 디코더가 추가될 수도 있다.An embodiment according to the present invention of FIG. 28 includes a receiver 2800, a synchronizer 2810, a demodulator 2820, a frame parsing unit 2830, a first deinterleaver 2840, and a linear free. A coding decoder 2850, a multiple demapper 2860, a second deinterleaver 2870, an inner decoder 2880 and an outer decoder 2890 are included. According to an embodiment, an outer deinterleaver may be added between the inner decoder 2880 and the outer decoder 2890, and a multiple input / output decoder may be added between the frame parser 2830 and the first deinterleaver 2840. May be

수신부(2800)는 수신된 RF 신호의 주파수 대역을 다운 컨버전(down conversion)한 후 디지털 신호로 변환하여 출력한다. 동기부(2810)는 수신부(2800)에서 출력된 수신 신호의 주파수 영역과 시간 영역의 동기를 획득하여 출력한다. 상기 동기부(2810)는 주파수 영역 신호의 동기 획득을 위해 복조부(2820)가 출력하는 데이터의 주파수 영역의 오프셋(offset) 결과를 이용할 수 있다.The receiver 2800 down-converts the frequency band of the received RF signal and converts the frequency band into a digital signal. The synchronizer 2810 obtains and outputs a synchronization between a frequency domain and a time domain of the received signal output from the receiver 2800. The synchronization unit 2810 may use an offset result of the frequency domain of data output by the demodulator 2820 to obtain synchronization of the frequency domain signal.

복조부(2820)는 상기 동기부(2810)에서 출력된 수신 데이터를 복조하고, 보호 구간(guard interval)을 제거한다. 이를 위해 복조부(2820)는 수신 데이터를 주파수 영역으로 변환시키고, 서브 캐리어(sub carrier)에 분산된 데이터 값을 각각의 서브 캐리어에 할당되었던 값으로 디코딩한다. 프레임 파싱부(2830)는 상기 복조부(2820)에서 복조된 신호의 프레임 구조에 따라 파일럿 심볼을 제외하고 데이터 심볼 구간의 심볼 데이터를 출력할 수 있다.The demodulator 2820 demodulates the received data output from the synchronizer 2810 and removes a guard interval. To this end, the demodulator 2820 converts the received data into the frequency domain, and decodes the data values distributed in the subcarriers into values assigned to each subcarrier. The frame parser 2830 may output symbol data of a data symbol period excluding pilot symbols according to the frame structure of the signal demodulated by the demodulator 2820.

제1디인터리버(2840)는 상기 프레임 파싱부(2830)에서 출력된 데이터 열에 대해 디인터리빙(de-interleaving)을 수행하여 데이터를 인터리빙되기 전의 순서로 복원시킨다. 상기 제1디인터리버(2840)는 상기 도 25의 제2인터리버(2550)에서 인터리빙한 방식에 대응되는 방식에 따라 디인터리빙하여 데이터 열의 순서를 복원한다.The first deinterleaver 2840 performs de-interleaving on the data string output from the frame parser 2830 to restore the data in the order before interleaving. The first deinterleaver 2840 deinterleaves the data sequence by deinterleaving according to a method corresponding to the interleaving method of the second interleaver 2550 of FIG. 25.

선형 프리코딩 디코더(2850)는 신호 송신 장치에서 데이터를 분산한 과정의 역과정을 수행하여, 상기 선형 프리코딩 디코더(2850)에 입력된 데이터에 분산되어 있는 본래의 데이터를 복원한다. 상기 선형 프리코딩 디코더(2850)는 송신 측에서 선형 프리코딩과정을 거친 경우에만 사용된다.The linear precoding decoder 2850 performs an inverse process of distributing data in the signal transmission apparatus, thereby restoring original data dispersed in the data input to the linear precoding decoder 2850. The linear precoding decoder 2850 is used only when the linear side has undergone a linear precoding process.

다중 디맵퍼(2860)는 상기 선형 프리코딩 디코더(2850)에서 복원된 심볼 데 이터를 비트열로 복원할 수 있다. 상기 다중 디맵퍼(2860)의 디맵핑 방식은 상기 도 25와 같은 송신 장치의 다중 맵퍼(2530)에서 사용한 맵핑 방식에 대응되는 방식을 사용한다.The multiple demapper 2860 may recover the symbol data recovered by the linear precoding decoder 2850 into a bit string. The demapping method of the multiple demapper 2860 uses a method corresponding to the mapping method used in the multiple mapper 2530 of the transmitting apparatus as illustrated in FIG. 25.

도 29는 본 발명에 따른 일 실시예로서, 다중 디맵퍼를 개략적으로 나타낸 블록도이다. 상기 다중 디맵퍼(2860)는 심볼 디인터리버(2861), 제1디맵퍼(2862), 제2디맵퍼(2863), …, 제N디맵퍼(2864), 및 비트 스트림 복원부(2865)를 포함한다.29 is a block diagram schematically illustrating multiple demappers according to an embodiment of the present invention. The multiple demapper 2860 includes a symbol deinterleaver 2861, a first demapper 2862, a second demapper 2863,. , An N-th demapper 2864, and a bit stream recovery unit 2865.

심볼 디인터리버(2861)는 입력된 심볼 데이터를 디인터리빙(deinterleaving)하여 본래의 심볼 데이터 순서를 복원한다. 상기 디인터리버(2861)의 디인터리빙 방식은 상기 도 26의 다중 맵퍼(2530)에서 심볼 인터리버(2535)가 인터리빙한 방식에 대응되는 방식을 사용한다. 그리고 상기 심볼 디인터리버(2861)는 디인터리빙된 심볼 데이터를, 맵핑된 방식에 해당하는 디맵퍼로 전송한다.The symbol deinterleaver 2861 deinterleaves the input symbol data to restore the original symbol data order. The deinterleaving method of the deinterleaver 2861 uses a method corresponding to a method in which the symbol interleaver 2535 interleaves in the multiple mapper 2530 of FIG. 26. The symbol deinterleaver 2861 transmits the deinterleaved symbol data to a demapper corresponding to the mapped scheme.

각 디맵퍼(제1디맵퍼(2862) 내지 제N디맵퍼(2864))는 상기 수신된 심볼 데이터를 해당하는 디맵핑 방식에 따라 비트 데이터로 변환한다. 상기 제1디맵퍼(2862) 내지 제N디맵퍼(2864)는 입력된 심볼 데이터를 비트 데이터로 디맵핑하는 디맵핑부로 볼 수 있다. 상기 제1디맵퍼(2862) 내지 제N디맵퍼(2864)의 디맵핑 방식은 도 26의 제1맵퍼(2532) 내지 제N맵퍼(2534)의 맵핑 방식에 각각 대응된다.Each demapper (first demapper 2862 to N-th demapper 2864) converts the received symbol data into bit data according to a corresponding demapping scheme. The first demapper 2862 to the N-th demapper 2864 may be viewed as a demapping unit for demapping input symbol data into bit data. The demapping schemes of the first demapper 2862 to the N-th demapper 2864 correspond to the mapping methods of the first mapper 2532 to the N-th mapper 2534 of FIG. 26.

비트 스트림 복원부(2865)는 각 디맵퍼에서 출력된 비트 데이터를 수신하여 하나의 비트 스트림을 출력한다. 상기 비트 스트림 복원부(2865)는 상기 도 26의 비트 스트림 분배부(2531)에서 분배한 방식에 대응되는 방식을 사용하여 비트 스트림을 복원한다.The bit stream recovery unit 2865 receives bit data output from each demapper and outputs one bit stream. The bit stream recovery unit 2865 restores the bit stream using a method corresponding to the method distributed by the bit stream distribution unit 2253 of FIG. 26.

제2디인터리버(2870)는 상기 다중 디맵퍼(2860)에서 디맵팽된 비트 데이터 열에 대해 인터리빙의 역과정을 수행한다. 상기 제2디인터리버(2870)는 도 25의 제1인터리버(2520)에 대응되는 디인터리빙을 수행한다. 인너 디코더(inner decoder)(2880)는 상기 디인터리빙된 데이터를 복호하여 데이터에 포함된 에러를 정정할 수 있다. 그리고, 아웃터 디코더(outer decoder)(2890)는 상기 인너 디코더(2880)에서 디코딩된 비트 데이터에 대해 다시 에러 정정 복호 과정을 수행하여 출력한다. 상기 인너 디코더(2880)과 아웃터 디코더(2890)는 각각 도 25의 인너 인코더(2510), 아웃터 인코더(2500)에 대응되는 디코딩 방식에 따라 데이터를 디코딩한다.The second deinterleaver 2870 performs an inverse process of interleaving on the bit data string demapped by the multiple demapper 2860. The second deinterleaver 2870 performs deinterleaving corresponding to the first interleaver 2520 of FIG. 25. An inner decoder 2880 may correct the error included in the data by decoding the deinterleaved data. The outer decoder 2890 performs an error correction decoding process on the bit data decoded by the inner decoder 2880 and outputs the same. The inner decoder 2880 and the outer decoder 2890 decode data according to decoding methods corresponding to the inner encoder 2510 and the outer encoder 2500 of FIG. 25, respectively.

도 30은 본 발명에 따른 일 실시예로서, 다중 인코딩을 이용한 신호 송신 장치를 개략적으로 나타낸 블록도이다. 상기 도 30의 신호 송신 장치는 도 1과 같은 신호 송신 장치에 다중 인코딩 방식을 사용하는 경우의 예이다.30 is a block diagram schematically illustrating an apparatus for transmitting a signal using multiple encodings according to an embodiment of the present invention. The signal transmission apparatus of FIG. 30 is an example of using a multiple encoding scheme for the signal transmission apparatus of FIG. 1.

상기 도 30의 실시예는 아웃터 인코더(3000), 다중 인코더(3010), 제1인터리버(interleaver)(3020), 심볼 맵퍼(3030), 선형 프리코딩부(3040), 제2인터리버(3050), 프레임 형성부(frame builder)(3060), 변조부(modulator)(3070) 및 전송부(3080)를 포함한다. 그리고, 구현 예에 따라 아웃터 인터리버, 다중 입출력 인코더가 추가될 수도 있다. 30 illustrates an outer encoder 3000, a multiple encoder 3010, a first interleaver 3020, a symbol mapper 3030, a linear precoding unit 3040, a second interleaver 3050, A frame builder 3060, a modulator 3070, and a transmitter 3080 are included. In addition, an outer interleaver and a multiple input / output encoder may be added according to an embodiment.

상기 아웃터 인코더(3000)와 다중 인코더(3010)는 각각 입력된 신호를 부호화하여 출력함으로써, 전송되는 데이터에 발생한 오류를 수신기에서 검출하고, 상기 오류를 수정할 수 있도록 한다. 상기 아웃터 인코더(3000)는 입력된 신호에 대 한 송신 성능을 향상시키기 위해 입력 데이터를 부호화한다. 상기 인코더의 종류는, 해당하는 신호 송신 시스템에서 사용하는 코딩 방식에 따라 다를 수 있다.The outer encoder 3000 and the multiple encoder 3010 encode and output the input signals, respectively, so that an error occurring in the transmitted data can be detected by the receiver and the error can be corrected. The outer encoder 3000 encodes input data to improve transmission performance for the input signal. The type of encoder may vary depending on the coding scheme used in the corresponding signal transmission system.

다중 인코더(3010)는 송신 과정에서 발생할 수 있는 에러에 대비하여 상기 아웃터 인코더(3000)에서 인코딩된 데이터를 다시 부호화한다. 상기 다중 인코더(3010)는 복수의 인코딩 방식을 혼합하여 사용함으로써, 입력된 데이터를 부호화한다. 예를 들어, 상기 인코딩 방식으로 컨벌루션(convolution) 코딩, RS(Reed-Solomon) 코딩, LDPC(Low Density Parity Check) 코딩, 터보(Turbo) 코딩 방식 등이 사용될 수 있다.The multiple encoder 3010 re-encodes the data encoded by the outer encoder 3000 in preparation for an error that may occur in the transmission process. The multiple encoder 3010 encodes the input data by mixing a plurality of encoding schemes. For example, convolutional coding, Reed-Solomon (RS) coding, low density parity check (LDPC) coding, turbo coding, and the like may be used as the encoding scheme.

상기와 같은 다중 인코딩 방식을 사용하여, 낮은 코드율(code rate)을 갖는 인코딩 방식으로부터는 SNR(Signal to Noise Ratio) 이득을 얻을 수 있고, 높은 코드율(code rate)을 갖는 인코딩 방식으로부터는 전송률 이득(capacity gain)을 얻을 수 있다. 따라서, 상기 인코딩 방식의 혼합 비율을 조절하여 SNR과 전송률 사이의 이득을 조정할 수 있고, 전송 효율을 높일 수 있다.By using the multiple encoding scheme as described above, a signal to noise ratio (SNR) gain can be obtained from an encoding scheme having a low code rate, and a transmission rate can be obtained from an encoding scheme having a high code rate. Gain can be obtained. Therefore, by adjusting the mixing ratio of the encoding scheme, it is possible to adjust the gain between the SNR and the transmission rate, and increase the transmission efficiency.

도 31은 본 발명에 따른 일 실시예로서, 다중 인코더를 개략적으로 나타낸 블록도이다. 상기 다중 인코더(3010)는 비트 스트림 분배부(3011), 제1인코더(3012), 제2인코더(3013), …, 제N인코더(3014), 및 비트 스트림 복원부(3015)를 포함한다.31 is a block diagram schematically illustrating a multiple encoder according to an embodiment of the present invention. The multiple encoder 3010 includes a bit stream distributor 3011, a first encoder 3012, a second encoder 3013,. , An Nth encoder 3014, and a bit stream recovery unit 3015.

상기 비트 스트림 분배부(3011)는 입력된 비트 데이터를 여러 개의 인코더에 분배한다. 상기 비트 스트림 분배부(3011)는 상기 각 인코더의 인코딩 방식에 따라 필요한 수의 비트 데이터를 분배한다. 상기 비트 스트림 분배부(3011)는 입력된 비 트 데이터를 상기 도 27과 같은 비트 스트림 분배 방식에 따라 분배할 수도 있고, 입력된 비트 데이터가 입력된 순서대로 각 맵퍼에 분배할 수도 있다. 상기와 같은 분배 방식은 구현 예에 따라 달라질 수 있다.The bit stream distributor 3011 distributes the input bit data to a plurality of encoders. The bit stream distributor 3011 distributes the required number of bit data according to the encoding scheme of each encoder. The bit stream distribution unit 3011 may distribute the input bit data according to the bit stream distribution scheme as shown in FIG. 27, or may distribute the input bit data to each mapper in the order in which the input bit data is input. Such a distribution scheme may vary depending on implementation.

상기 비트 스트림 분배부(3011)에서 분배된 비트 데이터는 각 인코더(제1인코더(3012) 내지 제N인코더(3014))에 출력된다. 상기 제1인코더(3012) 내지 제N인코더(3014)는 입력된 비트 데이터를 부호화하여 출력하는 인코딩부로 볼 수 있다. 각 인코더는 해당 인코딩 방식에 따라서, 입력된 비트 데이터를 부호화한다. 예를 들어, 상기 인코딩 방식으로 컨벌루션(convolution) 코딩, RS(Reed-Solomon) 코딩, LDPC(Low Density Parity Check) 코딩, 터보(Turbo) 코딩 방식 등이 사용될 수 있다.The bit data distributed by the bit stream distributor 3011 is output to each encoder (the first encoder 3012 to the Nth encoder 3014). The first encoder 3012 to the Nth encoder 3014 may be regarded as an encoding unit for encoding and outputting input bit data. Each encoder encodes input bit data according to the corresponding encoding scheme. For example, convolutional coding, Reed-Solomon (RS) coding, low density parity check (LDPC) coding, turbo coding, and the like may be used as the encoding scheme.

상기 각 인코더(제1인코더(3012) 내지 제N인코더(3014))는 같은 종류의 인코딩 방식을 사용하면서, 코드율을 다르게 할 수도 있고, 각 인코더마다 다른 종류의 인코딩 방식을 사용할 수도 있다. 예를 들어, 제1인코더(3012) 내지 제N인코더(3014) 모두 LDPC 방식을 사용하면서, 각 맵퍼의 코드 율을 다르게 할 수 있다. 또는, 제1인코더(3012)는 LDPC 방식으로 인코딩하고, 제N맵퍼(3014)는 터보 코딩 방식으로 인코딩할 수 있다. 상기 예는 구현예에 따라 달라질 수 있다.Each of the encoders (the first encoder 3012 to the Nth encoder 3014) may use a different encoding rate while using the same type of encoding scheme, or may use a different type of encoding scheme for each encoder. For example, while the first encoder 3012 to the Nth encoder 3014 both use the LDPC method, the code rate of each mapper can be changed. Alternatively, the first encoder 3012 may encode the LDPC method, and the N-th mapper 3014 may encode the turbo coding method. The example may vary depending on the embodiment.

비트 스트림 복원부(3015)는 상기 각 인코더에서 출력된 비트 데이터를 수신하여 하나의 비트 데이터 열로 복원(merging)한다. 상기 비트 스트림 복원부(3015)는 상기 비트 스트림 분배부(3015)의 분배 방식의 역으로 복원할 수도 있으나, 다른 정하여진 룰에 따라 하나의 비트 데이터 열로 복원할 수도 있다. 이는 구현 예 에 따라 달라질 수 있으며, 상기 복원 방식에 따라 가상 인터리빙(virtual interleaving) 효과를 얻을 수도 있다. The bit stream recovery unit 3015 receives the bit data output from the respective encoders, and recovers the bit data into one bit data string. The bit stream recovery unit 3015 may restore the reverse of the distribution method of the bit stream distribution unit 3015, or may restore the data to one bit data string according to another predetermined rule. This may vary depending on implementation, and a virtual interleaving effect may be obtained according to the restoration method.

제1인터리버(3020)는 상기 다중 인코더(3010)에서 출력된 신호가 전송될 경우 겪을 수 있는 버스트 에러(burst error)에 강인하도록 데이터 열을 랜덤한 위치로 분산시키는 역할을 한다. 심볼 맵퍼(3030)는 상기 제1인터리버(3020)로부터 수신된 비트 데이터를 심볼 데이터로 맵핑한다. 또는, 상기 심볼 맵퍼(3030)에는 부호화된 심볼 맵핑 방식을 사용할 수도 있다. 예를 들어, 트렐리스(trellis) 코드 변조 등의 방식을 사용하여 부호화된 심볼로 맵핑할 수도 있다.The first interleaver 3020 distributes the data sequence to a random position so as to be robust to a burst error that may occur when the signal output from the multiple encoder 3010 is transmitted. The symbol mapper 3030 maps bit data received from the first interleaver 3020 into symbol data. Alternatively, an encoded symbol mapping method may be used for the symbol mapper 3030. For example, it may be mapped to a coded symbol using a method such as trellis code modulation.

선형 프리코딩부(3040)는 입력된 심볼 데이터를 여러 개의 출력 심볼 데이터에 분산시켜, 주파수 선택적 페이딩(frequency selective fading) 채널을 겪었을 때 모든 정보가 페이딩으로 손실될 확률을 줄여준다. 상기 선형 프리코딩부(3040)는 구현 예에 따라 사용되지 않을 수도 있다. The linear precoding unit 3040 distributes the input symbol data into a plurality of output symbol data to reduce the probability that all information is lost due to fading when subjected to a frequency selective fading channel. The linear precoding unit 3040 may not be used depending on implementation.

제2인터리버(3050)는 상기 선형 프리코딩부(3040)에서 출력된 심볼 데이터를 다시 인터리빙하여, 상기 심볼 데이터가 동일한 주파수 선택적인 페이딩을 겪지 않도록 한다. 상기 제2인터리버(3050)에는 블록 인터리빙 방식이나 컨벌루션 인터리빙 방식 등이 사용될 수 있다.The second interleaver 3050 interleaves the symbol data output from the linear precoding unit 3040 again so that the symbol data does not experience the same frequency selective fading. The second interleaver 3050 may use a block interleaving method or a convolutional interleaving method.

프레임 형성부(3060)는 상기 인터리빙된 신호를 직교 주파수 다중 분할(Orthogonal Frequency Division Multiplex : OFDM) 방식으로 변조할 수 있도록, 데이터 구간에 파일럿(pilot)을 삽입하여 프레임을 형성한다. 변조부(3070)는 상기 프레임 형성부(3060)에서 출력된 데이터들을 각각 OFDM의 서브 캐리어들에 실어 전 송할 수 있도록 보호 구간(guard interval)을 삽입하여 변조한다. 전송부(2080)는 변조부(2070)에서 출력된 보호 구간과 데이터 구간을 가진 디지털 형식의 신호를 아날로그 신호로 변환하여 송신(transmit)한다.The frame forming unit 3060 forms a frame by inserting a pilot in the data section so that the interleaved signal can be modulated by an orthogonal frequency division multiplex (OFDM) scheme. The modulator 3070 inserts and modulates a guard interval so that the data output from the frame forming unit 3060 can be carried on each subcarrier of OFDM. The transmitter 2080 converts a digital signal having a guard interval and a data interval output from the modulator 2070 into an analog signal and transmits the signal.

도 32는 본 발명에 따른 일 실시예로서, 다중 인코딩된 신호를 수신하는 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 도 32의 수신 장치는 도 30의 송신 장치에 대응되는 수신 장치를 나타낸다.32 is a block diagram schematically showing a signal receiving apparatus for receiving a multi-encoded signal according to an embodiment of the present invention. The receiver of FIG. 32 represents a receiver corresponding to the transmitter of FIG. 30.

도 32의 본 발명에 따른 실시예는 수신부(3200), 동기부(3210), 복조부(3220), 프레임 파싱(parsing)부(3230), 제1디인터리버(deinterleaver)(3240), 선형 프리코딩 디코더(3250), 심볼 디맵퍼(3260), 제2디인터리버(3270), 다중 디코더(decoder)(3280) 및 아웃터 디코더(3290)를 포함한다.The embodiment according to the present invention of FIG. 32 includes a receiver 3200, a synchronizer 3210, a demodulator 3220, a frame parsing unit 3230, a first deinterleaver 3240, and a linear free. A coding decoder 3250, a symbol demapper 3260, a second deinterleaver 3270, a multiple decoder 3280, and an outer decoder 3290 are included.

상기 도 32의 수신 장치는 도 28에서 설명한 바와 동일하다. 이하 상기 도 28과 다른 부분에 대해 설명하도록 한다. The receiver of FIG. 32 is the same as that described with reference to FIG. 28. Hereinafter, different parts from FIG. 28 will be described.

트렐리스 코드 복호부(3260)는 선형 프리코딩 디코더(3250)에서 복원된 심볼 데이터를 비트열로 복원할 수 있다. 상기 심볼 디맵퍼(3260)는 상기 도 30의 심볼 맵퍼(3030)에서 맵핑한 방식에 대응되는 방식을 사용하여 심볼 데이터를 디맵핑한다.The trellis code decoder 3260 may restore the symbol data reconstructed by the linear precoding decoder 3250 into a bit string. The symbol demapper 3260 demaps symbol data using a method corresponding to the method mapped by the symbol mapper 3030 of FIG. 30.

다중 디코더(3280)는 제2디인터리버(3270)에서 디인터리빙된 비트 데이터를 입력받아 송신 측에서 인코딩한 방식에 따라 각각 디코딩한다. The multiple decoder 3280 receives the deinterleaved bit data from the second deinterleaver 3270 and decodes the bits according to a method encoded by the transmitter.

도 33은 본 발명에 따른 일 실시예로서, 다중 디코더를 개략적으로 나타낸 블록도이다. 상기 다중 디코더(3280)는 비트 스트림 분배부(3281), 제1디코 더(3282), 제2디코더(3283), …, 제N디코더(3284), 및 비트 스트림 복원부(3285)를 포함한다.33 is a block diagram schematically illustrating multiple decoders according to an embodiment of the present invention. The multiple decoder 3280 may include a bit stream distribution unit 3331, a first decoder 3302, a second decoder 3283,. , An N-th decoder 3284, and a bit stream recovery unit 3285.

비트 스트림 분배부(3281)는 입력된 비트 데이터를 여러 개의 디코더에 분배한다. 상기 비트 스트림 분배부(3281)는 상기 도 31의 다중 인코더에서 비트 스트림 복원부(3015)가 하나의 비트 데이터 열로 복원(merging)한 방식에 대응되는 방식에 따라 비트 데이터를 분배한다. 즉, 다중 인코더의 비트 스트림 복원부(3015)가 비트 데이터를 입력받아 비트 데이터 열을 만든 방식의 반대로 비트 데이터를 분배한다.The bit stream distribution unit 3331 distributes the input bit data to a plurality of decoders. The bit stream distribution unit 3231 distributes bit data in a manner corresponding to a method in which the bit stream recovery unit 3015 reconstructs one bit data string in the multiple encoder of FIG. 31. That is, the bit stream recovery unit 3015 of the multiple encoder receives the bit data and distributes the bit data as opposed to the method of forming the bit data string.

상기 비트 스트림 분배부(3281)에서 분배된 비트 데이터는 각 디코더(제1디코더(3282) 내지 제N디코더(3284))에 출력된다. 상기 제1디코더(3282) 내지 제N디코더(3284)는 입력된 비트 데이터를 디코딩하여 출력하는 디코딩부로 볼 수 있다. 각 디코더는 해당 디코딩 방식에 따라서, 입력된 비트 데이터를 부호화한다. 상기 디코딩 방식은 상기 도 31의 다중 인코더에서 인코딩한 방식에 대응되는 방식을 사용한다.The bit data distributed by the bit stream distribution unit 3331 is output to each decoder (first decoder 3302 to Nth decoder 3284). The first decoders 3328 to N-th decoders 3284 may be viewed as a decoding unit for decoding and outputting input bit data. Each decoder encodes the input bit data according to the corresponding decoding scheme. The decoding method uses a method corresponding to the method encoded by the multiple encoder of FIG. 31.

비트 스트림 복원부(3285)는 상기 각 디코더에서 출력된 비트 데이터를 수신하여 하나의 비트 데이터 열로 복원(merging)한다. 상기 비트 스트림 복원부(3285)는 상기 비트 스트림 분배부(3011)에서 비트 데이터를 분배한 방식의 역으로 순서를 복원한다.The bit stream recovery unit 3285 receives the bit data output from the respective decoders, and recovers the bit data into one bit data string. The bit stream recovery unit 3285 restores the order in the inverse of the manner in which the bit data distribution unit 3011 distributes the bit data.

아웃터 디코더(outer decoder)(3290)는 상기 다중 디코더(3280)에서 디코딩된 비트 데이터에 대해 다시 에러 정정 복호 과정을 수행하여 출력한다. 즉, 상기 다중 디코더(3280)과 아웃터 디코더(3290)는 각각 도 30의 다중 인코더(3010), 아웃터 인코더(3000)에 대응되는 디코딩 방식에 따라 데이터를 디코딩한다.An outer decoder 3290 performs an error correction decoding process on the bit data decoded by the multiple decoder 3280 and outputs the same. That is, the multiple decoder 3280 and the outer decoder 3290 decode data according to decoding methods corresponding to the multiple encoder 3010 and the outer encoder 3000 of FIG. 30, respectively.

도 34는 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑을 이용한 신호 송신 장치를 개략적으로 나타낸 블록도이다. 상기 도 34와 같이 도 25와 도 30에서 설명한 다중 인코딩 방식과 다중 맵핑 방식을 모두 사용하여 신호 송신 장치를 구현할 수도 있다.34 is a block diagram schematically illustrating an apparatus for transmitting a signal using multiple encoding and multiple mapping according to an embodiment of the present invention. As shown in FIG. 34, a signal transmission apparatus may be implemented using both the multiple encoding scheme and the multiple mapping scheme described with reference to FIGS. 25 and 30.

상기 신호 송신 장치는, 아웃터 인코더(3400), 다중 인코더(3410), 제1인터리버(3420), 다중 맵퍼(3430), 선형 프리코딩부(3440), 제2인터리버(3450), 프레임 형성부(3460), 변조부(3470), 및 전송부(3480)를 포함하며, 상기 각 블록에 대한 설명은 상기 도 25와 도 30에서 각각 설명한 바와 같다.The signal transmission apparatus includes an outer encoder 3400, a multiple encoder 3410, a first interleaver 3420, a multiple mapper 3430, a linear precoding unit 3440, a second interleaver 3450, and a frame forming unit ( 3460, a modulator 3470, and a transmitter 3480, and the description of each block is the same as described with reference to FIGS. 25 and 30, respectively.

도 35는 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑된 신호를 수신하는 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 도 35의 신호 수신 장치는 상기 도 34와 같은 신호 송신 장치에 대응되며, 수신부(3500), 동기부(3510), 복조부(3520), 프레임 파싱(parsing)부(3530), 제1디인터리버(deinterleaver)(3540), 선형 프리코딩 디코더(3550), 다중 디맵퍼(3560), 제2디인터리버(3570), 다중 디코더(decoder)(3580) 및 아웃터 디코더(3590)를 포함한다. 마찬가지로 상기 신호 수신 장치의 각 블록에 대한 설명은 상기 도 28과 도 32에서 각각 설명한 바와 같다.35 is a block diagram schematically illustrating a signal receiving apparatus for receiving multiple encoding and multiple mapped signals according to an embodiment of the present invention. The signal receiving apparatus of FIG. 35 corresponds to the signal transmitting apparatus of FIG. 34, and includes a receiver 3500, a synchronizer 3510, a demodulator 3520, a frame parsing unit 3530, and a first device. An interleaver 3540, a linear precoding decoder 3550, a multiple demapper 3560, a second deinterleaver 3570, a multiple decoder 3580, and an outer decoder 3590. Likewise, the description of each block of the signal receiving apparatus is the same as those described with reference to FIGS. 28 and 32, respectively.

도 36은 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑된 신호를 수신하는 다른 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 신호 수신 장치는 수신부(3600), 동기부(3610), 복조부(3620), 프레임 파싱(parsing)부(3630), 제1디인터리버(deinterleaver)(3640), 등화부(equalizer)(3650), 선형 프리코딩 디코더(3660), 다중 디맵퍼(3670), 채널 추정부(channel estimator)(3680), 제2디인터리버(3690), 다중 디코더(3692) 및 아웃터 디코더(3694)를 포함한다.36 is a block diagram schematically illustrating another signal receiving apparatus for receiving multiple encoding and multiple mapped signals according to an embodiment of the present invention. The signal receiving apparatus includes a receiver 3600, a synchronizer 3610, a demodulator 3620, a frame parser 3630, a first deinterleaver 3640, an equalizer 3650. ), A linear precoding decoder 3660, a multiple demapper 3670, a channel estimator 3680, a second deinterleaver 3690, a multiple decoder 3692, and an outer decoder 3694. .

다중 맵핑 방식이 적용되는 시스템의 경우, 작은 성상(constellation) 사이즈(size)를 갖는 심볼은 큰 성상 사이즈를 갖는 심볼에 비해서 상대적으로 낮은 최소 요구 SNR을 가진다. 따라서, 전송률(capacity)을 더욱 증가시키기 위해서 작은 성상 사이즈를 갖는 심볼을 파일럿(pilot) 심볼처럼 활용할 수 있다. 즉, 별도의 파일럿을 사용하지 않거나, 또는 일부 파일럿의 기능을 작은 성상 사이즈를 갖는 심볼을 이용하여 수행함으로써, 줄어든 파일럿의 수만큼 전송률이 증가한다. 상기 작은 성상 사이즈를 갖는 심볼을 이용하는 경우, 상기 심볼을 수신하여 결정한 값을 기준으로 채널을 추정한다.In a system to which the multiple mapping scheme is applied, a symbol having a small constellation size has a relatively low minimum required SNR compared to a symbol having a large constellation size. Therefore, in order to further increase the capacity, a symbol having a small constellation size may be used as a pilot symbol. That is, by not using a separate pilot or by performing a function of some pilots using a symbol having a small constellation size, the transmission rate is increased by the number of pilots reduced. In the case of using the symbol having the small constellation size, the channel is estimated based on the value determined by receiving the symbol.

상기 큰 성상 사이즈를 갖는 심볼의 최소 요구 SNR은 상대적으로 작은 성상 사이즈를 갖는 심볼의 최소 요구 SNR보다 높다. 따라서, 큰 성상 사이즈를 갖는 심볼이 복호화되는 SNR 구간에서는 작은 성상 사이즈를 갖는 심볼의 신뢰도(reliability)가 상대적으로 높아 파일럿 심볼로 사용할 수 있다.The minimum required SNR of the symbol with the large constellation size is higher than the minimum required SNR of the symbol with the relatively small constellation size. Therefore, in an SNR section in which a symbol having a large constellation size is decoded, reliability of a symbol having a small constellation size is relatively high and thus can be used as a pilot symbol.

상기 작은 성상 사이즈를 갖는 심볼과 큰 성상 사이즈를 갖는 심볼의 구분은 구현자의 구현 예에 따라 달라질 수 있다. 예를 들어, 특정 성상 포인트 이상을 큰 성상 사이즈로 구분하는 경우, 상기 기준이 되는 포인트의 수는 구현 예에 따라 달 라질 수 있다.The division of the symbol having the small constellation size and the symbol having the large constellation size may vary depending on the implementation of the implementer. For example, in the case where a specific constellation point or more is divided into a large constellation size, the number of reference points may vary depending on implementation.

상기와 같이 작은 성상 사이즈를 갖는 심볼 데이터와 큰 성상 사이즈를 갖는 심볼 데이터로 다중 맵핑한 경우, 신호 송신 장치에서는 상기 다중 맵핑된 심볼 데이터에 대해 파일럿을 삽입하여 전송할 수 있다. 상기에서 설명한 바와 같이 작은 성상 사이즈를 갖는 심볼 데이터를 파일럿 심볼로 사용하는 경우, 신호 송신 장치는 상기 파일럿의 삽입 위치에 파일럿 대신 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하여 전송할 수 있다.When multiple mapping is performed on the symbol data having a small constellation size and the symbol data having a large constellation size as described above, the signal transmission apparatus may insert and transmit a pilot to the multi-mapped symbol data. As described above, when symbol data having a small constellation size is used as a pilot symbol, the signal transmission apparatus may insert and transmit the symbol data having the small constellation size instead of a pilot at an insertion position of the pilot.

상기 작은 성상 사이즈를 갖는 심볼 데이터를 파일럿 삽입 위치에 삽입하는 경우, 파일럿의 삽입 위치 전부에 대해 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입할 수도 있고, 일부 위치에만 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하고 나머지 위치에는 파일럿을 삽입할 수도 있다.When the symbol data having the small constellation size is inserted into a pilot insertion position, symbol data having the small constellation size may be inserted into all of the pilot insertion positions, and symbol data having the small constellation size may be inserted only at a part of the positions. You can also insert the pilot in the rest position.

예를 들어, 상기 도 34와 같은 신호 송신장치에서 프레임 형성부(3460)는 파일럿 삽입 위치 전부에 대해 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하여 프레임을 형성할 수 있다. 또는, 상기 프레임 형성부(3460)는 일부 위치에만 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하고 나머지 위치에는 파일럿을 삽입하여 프레임을 형성할 수 있다. 채널 상황, 송수신 시스템 등을 고려하여 상기 방식 가운데 적당한 방식을 선택하여 구현할 수 있다.For example, in the signal transmission apparatus as shown in FIG. 34, the frame forming unit 3460 may form a frame by inserting symbol data having a small constellation size for all pilot insertion positions. Alternatively, the frame forming unit 3460 may insert a symbol data having a small constellation size in only a part of the position and insert a pilot in the other position to form a frame. In consideration of the channel situation, the transmission and reception system, etc., an appropriate method may be selected and implemented.

상기 도 34의 경우 다중 인코딩 방식도 사용되었으나, 상기 다중 인코딩 방식이 아닌 일반적인 인너 인코딩 방식으로 인코딩한 경우에도 적용 가능하다.In the case of FIG. 34, a multiple encoding scheme is also used. However, the present invention may also be applicable to a case of encoding with a general inner encoding scheme instead of the multiple encoding scheme.

상기 도 36은, 상기 도 34와 같은 신호 송신 장치에서 작은 사이즈를 갖는 심볼 데이터를 파일럿 심볼로 사용하여 신호를 전송한 경우, 상기 신호를 수신하여 처리하는 장치를 나타낸 도면이다.36 is a diagram illustrating an apparatus for receiving and processing a signal when a signal is transmitted using symbol data having a small size as a pilot symbol in the signal transmission apparatus as shown in FIG. 34.

이하 설명의 편의를 위해, 상기 도 36의 블록 가운데 상기 도 35의 블록과 중복되지 않는 부분을 중심으로 설명한다.Hereinafter, for convenience of description, a description will be given of parts of the block of FIG. 36 that do not overlap with the block of FIG. 35.

프레임 파싱부(3630)는 복조부(3620)에서 복조된 프레임 데이터를 파싱한다. 상기와 같이 신호 송신 장치에서 파일럿 삽입 위치 전부에 대해 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하여 프레임을 형성한 경우, 상기 프레임 파싱부(3630)는 파일럿 위치에 삽입된 상기 심볼 데이터를 추출하여 나머지 심볼 데이터와 함께 복원한다. 만약, 상기 신호 송신 장치에서 파일럿 삽입 위치 가운데 일부 위치에만 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하고, 나머지 위치에는 파일럿을 삽입하여 프레임을 형성한 경우, 상기 프레임 파싱부(3630)는 상기 작은 성상 사이즈를 갖는 심볼 데이터와 함께 파일럿을 추출하여 심볼 데이터를 복원한다.The frame parser 3630 parses the frame data demodulated by the demodulator 3620. When the frame is formed by inserting symbol data having a small constellation size for all pilot insertion positions in the signal transmission apparatus as described above, the frame parsing unit 3630 extracts the symbol data inserted at the pilot positions to extract the remaining symbols. Restore with the data. If, in the signal transmission apparatus, symbol data having a small constellation size is inserted only at a portion of pilot insertion positions, and a pilot is inserted at the remaining positions, the frame parsing unit 3630 may use the small constellation size. The pilot data is extracted together with the symbol data having a to recover the symbol data.

이하 설명의 편의를 위해 파일럿 삽입 위치 가운데 일부 위치에만 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하고, 나머지 위치에는 파일럿을 삽입하여 프레임을 형성한 경우를 중심으로 설명한다.For convenience of explanation, the following description will focus on a case in which symbol data having a small constellation size is inserted in only some of the pilot insertion positions and a pilot is inserted in the remaining positions.

채널 추정부(3680)는 상기 프레임 파싱부(3630)에서 출력된 파일럿과 다중 디맵퍼(3670)의 입출력 정보를 이용하여 전송 채널을 추정한다. 상기 프레임 파싱부(3630)에서 출력된 파일럿을 이용하여 채널을 추정하는 경우, k번째 반송파(carrier)에 실려 수신된 파일럿을 Pr(k)라 하고, 수신 측에서 알고 있는 약속된 파일럿을 Pt(k)라고 할 경우, 채널 전달 함수(Channel Transfer Function : CTF)는 다음 수학식 2와 같다.The channel estimator 3680 estimates a transmission channel using the pilot output from the frame parser 3630 and input / output information of the multiple demapper 3670. When estimating a channel using the pilot output from the frame parsing unit 3630, a pilot received on a k-th carrier is referred to as P r (k), and a promised pilot known to the receiver is referred to as P r. In the case of t (k), a channel transfer function (CTF) is represented by Equation 2 below.

Figure 112008039495204-PAT00008
Figure 112008039495204-PAT00008

상기 Hp(k)는 파일럿을 이용하여 추정된 채널 전달 함수를 말한다.H p (k) refers to a channel transfer function estimated using a pilot.

또한, 파일럿 삽입 위치에 삽입된 작은 성상 사이즈를 갖는 심볼 데이터를 이용하여 채널을 추정하는 경우, 상기 수신된 심볼 데이터, 즉, 다중 디맵퍼(3670)에 입력되는 심볼 데이터를 Yr(k)라 하고, 결정된 심볼 데이터, 즉, 다중 디맵퍼(3670)에서 출력되는 심볼 데이터를 Yt(k)라고 할 경우, 채널 전달 함수는 다음 수학식 3과 같다.In addition, when estimating a channel using symbol data having a small constellation size inserted at a pilot insertion position, the received symbol data, that is, symbol data input to the multiple demapper 3670 is referred to as Y r (k). When the determined symbol data, that is, symbol data output from the multiple demapper 3670 is referred to as Y t (k), the channel transfer function is expressed by Equation 3 below.

Figure 112008039495204-PAT00009
Figure 112008039495204-PAT00009

상기 Hd(k)는 작은 성상 사이즈를 갖는 심볼 데이터를 이용하여 추정된 채널 전달 함수를 말한다. 상기 나누기 연산은 직접 디바이더(divider)를 설계하여 수행할 수도 있고, 분모의 역수를 계산하거나 분자와 곱하여 수행할 수도 있다. 또는, 상기 분모의 역수 값을 저장하는 롬 테이블(ROM Table)을 참조하여 분자와 곱하여 수행할 수도 있다. 또는, 분모와 분자에 각각 분모의 켤레 복소수(complex conjugate) 값을 곱하여 상기 켤레 복소수가 곱해진 분모의 역수 값을 롬 테이블을 사용하여 구하고, 상기 분모의 켤레 복소수 값이 곱해진 분자와 상기 역수 값을 곱하여 수행할 수도 있다. 이는 구현 예에 따라 달라질 수 있다. The H d (k) refers to a channel transfer function estimated using symbol data having a small constellation size. The division operation may be performed by directly designing a divider, or may be performed by calculating the inverse of the denominator or multiplying by a numerator. Alternatively, the multiplication may be performed by referring to a ROM table that stores the reciprocal value of the denominator. Alternatively, the reciprocal value of the denominator multiplied by the complex conjugate of the denominator and the numerator complex number are multiplied, respectively, to obtain a reciprocal value of the denominator multiplied by the complex complex number. It can also be done by multiplying by. This may vary depending on implementation.

신호 송신 장치에서 파일럿 심볼을 전혀 사용하지 않은 경우에는, 상기 수학식 3과 같이 작은 성상 사이즈를 갖는 심볼 데이터를 이용한 채널 전송 함수만을 얻을 수 있다.When no pilot symbol is used in the signal transmission apparatus, only a channel transfer function using symbol data having a small constellation size can be obtained as shown in Equation 3 above.

상기 수학식 2 또는 3에서 추정된 채널 전송 함수는 채널 등화에 사용될 수 있다. 수신기에서는 상기 추정된 값 가운데, 하나의 값을 선택하여 채널을 등화하거나, 상기 추정된 2개의 값을 보간하여 등화할 수 있다. 예를 들어, 채널 상황 등을 고려하여 하나의 값을 선택하거나, 특정 추정 값이 급격히 변동하는 경우 다른 추정 값을 선택하여 사용하는 등 구현 예에 따라 선택 방법이 달라질 수 있다. 또는, 상기 추정된 2개의 값을 선형 보간 등을 통해 보간하여 얻어진 값으로 등화할 수도 있다. The channel transfer function estimated in Equation 2 or 3 may be used for channel equalization. The receiver may equalize a channel by selecting one value among the estimated values, or equalize by interpolating the two estimated values. For example, the selection method may vary depending on the implementation, such as selecting one value in consideration of a channel condition, or selecting and using a different estimated value when a specific estimated value changes abruptly. Alternatively, the estimated two values may be equalized to values obtained by interpolation through linear interpolation or the like.

도 37은 본 발명에 따른 일 실시예로서, 채널 추정부를 개략적으로 나타낸 블록도이다. 상기 채널 추정부는 결정부(3700), 제1연산부(3710), 제1곱셈부(3720), 제2곱셈부(3730), 제2연산부(3740), 파일럿 생성부(3750), 제3연산부(3760), 제3곱셈부(3770), 제4곱셈부(3780), 및 제4연산부(3790)를 포함한다. 만약, 파일럿 심볼을 삽입하지 않는 방식을 사용하는 경우라면, 상기 파일럿 생성부(3750), 제3연산부(3760), 제3곱셈부(3770), 제4곱셈부(3780), 및 제4연산 부(3790)는 사용되지 아니한다.37 is a block diagram schematically illustrating a channel estimator in accordance with an embodiment of the present invention. The channel estimator includes a determiner 3700, a first calculator 3710, a first multiplier 3720, a second multiplier 3730, a second calculator 3740, a pilot generator 3750, and a third calculator. 3760, a third multiplication unit 3770, a fourth multiplication unit 3780, and a fourth operation unit 3790. If a pilot symbol is not inserted, the pilot generator 3750, the third operator 3760, the third multiplier 3770, the fourth multiplier 3780, and the fourth operation are used. Part 3790 is not used.

상기 도 37의 채널 추정부는 분모와 분자에 각각 분모의 켤레 복소수(complex conjugate) 값을 곱하여 상기 켤레 복소수가 곱해진 분모의 역수 값을 구하고, 상기 분모의 켤레 복소수 값이 곱해진 분자와 상기 역수 값을 곱하여 채널 전송 함수를 구하는 예를 나타낸다.The channel estimator of FIG. 37 multiplies the denominator and the numerator by the complex conjugate value of the denominator to obtain the inverse value of the denominator multiplied by the conjugate complex number. This is an example of obtaining a channel transfer function by multiplying by.

우선, 상기 심볼 디맵퍼(3670)에 입력되는 파일럿 심볼 데이터(상기 예에서는 작은 성상 사이즈를 갖는 심볼 데이터)와 상기 심볼 디맵퍼(3670)에서 출력된 파일럿 심볼 데이터는 결정부(3700)로 입력된다. 상기 결정부(3700)는 상기 심볼 디맵퍼(3670)에서 출력된 심볼 데이터를 제1연산부(3710)와 제1곱셈부(3720)로 출력한다.First, pilot symbol data (symbol data having a small constellation size in this example) input to the symbol demapper 3670 and pilot symbol data output from the symbol demapper 3670 are input to the determining unit 3700. . The determiner 3700 outputs the symbol data output from the symbol demapper 3670 to the first operator 3710 and the first multiplier 3720.

상기 제1연산부(3710)는 상기 입력된 심볼 데이터의 켤레 복소수(complex conjugate) 값을 구하여 제1곱셈부(3720)와 제2곱셈부(3730)로 출력한다. 제1곱셈부(3720)는 상기 결정부(3700)에서 출력된 심볼 데이터와 제1연산부(3710)에서 출력된 켤레 복소수 값을 곱하여 제2연산부(3740)로 출력한다. 제2곱셈부(3730)는 상기 결정부(3700)에 입력되는 심볼 데이터 가운데 심볼 디맵퍼(3670)에 입력되는 심볼 데이터와 제1연산부(3710)에서 출력된 켤레 복소수 값을 곱하여 제2연산부(3740)로 출력한다.The first operator 3710 obtains a complex conjugate value of the input symbol data and outputs the complex conjugate value to the first multiplier 3720 and the second multiplier 3730. The first multiplier 3720 multiplies the symbol data output from the determiner 3700 and the conjugate complex value output from the first operator 3710 and outputs the multiplied complex value to the second operator 3740. The second multiplier 3730 may multiply the symbol data input to the symbol demapper 3670 among the symbol data input to the determiner 3700 and the conjugate complex value output from the first operator 3710 to obtain a second operator ( 3740).

제2연산부(3740)는 제1곱셈부(3720)에서 출력된 값에 대응되는 역수 값을 구하고, 상기 역수 값을 제2곱셈부(3730)에서 출력된 값과 곱하여 출력한다.The second calculator 3740 obtains an inverse value corresponding to the value output from the first multiplier 3720, and multiplies the inverse value by the value output from the second multiplier 3730.

파일럿 심볼을 이용하여 채널 전송 함수를 추정하는 경우, 프레임 파싱 부(3630)에서 추출된 파일럿 심볼을 이용한다. 파일럿 생성부(3750)는 송신 측과 미리 약속된 파일럿 심볼을 생성한다. 상기 생성된 파일럿 심볼은 제3연산부(3760)와 제3곱셈부(3770)로 출력된다.When estimating the channel transfer function using the pilot symbols, the pilot symbols extracted by the frame parser 3630 are used. The pilot generator 3750 generates a pilot symbol previously promised with the transmitting side. The generated pilot symbols are output to the third operator 3760 and the third multiplier 3770.

상기 제3연산부(3760)는 상기 입력된 파일럿 심볼의 켤레 복소수(complex conjugate) 값을 구하여 제3곱셈부(3770)와 제4곱셈부(3780)로 출력한다. 제3곱셈부(3770)는 상기 파일럿 생성부(3750)에서 출력된 파일럿 심볼과 제3연산부(3760)에서 출력된 켤레 복소수 값을 곱하여 제4연산부(3790)로 출력한다. 제4곱셈부(3780)는 상기 프레임 파싱부(3630)에서 추출된 파일럿 심볼과 제3연산부(3760)에서 출력된 켤레 복소수 값을 곱하여 제4연산부(3790)로 출력한다.The third operation unit 3760 obtains a complex conjugate value of the input pilot symbol and outputs the complex conjugate value to the third multiplier 3770 and the fourth multiplier 3780. The third multiplier 3770 multiplies the pilot symbol output from the pilot generator 3750 and the conjugate complex value output from the third operator 3760 and outputs the multiplied complex value to the fourth operator 3790. The fourth multiplier 3780 multiplies the pilot symbol extracted by the frame parser 3630 and the conjugate complex value output from the third operator 3760 and outputs the multiplied complex value to the fourth operator 3790.

제4연산부(3790)는 제3곱셈부(3770)에서 출력된 값에 대응되는 역수 값을 구하고, 상기 역수 값을 제4곱셈부(3780)에서 출력된 값과 곱하여 출력한다.The fourth calculator 3790 obtains an inverse value corresponding to the value output from the third multiplier 3770, and multiplies the inverse value by the value output from the fourth multiplier 3780.

제1디인터리버(3640)는 상기 프레임 파싱부(3630)에서 출력된 심볼 데이터를 디인터리빙하여 순서를 복원한다. 상기 디인터리빙된 데이터는 등화부(3650)로 출력된다. 상기 등화부(3650)는 채널 추정부(3680)에서 추정된 채널에 대한 채널 전송 함수를 이용하여 상기 순서가 복원된 심볼 데이터에 대해 전송 채널에 의한 왜곡을 보상한다.The first deinterleaver 3640 deinterleaves the symbol data output from the frame parser 3630 to restore the order. The deinterleaved data is output to the equalizer 3650. The equalizer 3650 compensates for the distortion due to the transmission channel with respect to the reconstructed symbol data by using a channel transfer function for the channel estimated by the channel estimator 3680.

예를 들어, 상기 등화부(3650)는 상기 채널 왜곡을 보상하기 위해 제로 포싱(zero forcing) 등화 방식을 사용할 수 있다. 수신 측에 수신된 심볼은 전송 심볼과 채널 전송 함수의 곱의 형태로 나타낼 수 있으므로, 수신된 심볼을 추정된 채널 전송 함수로 나누어 주면 전송 심볼 데이터 값을 복원할 수 있다. 즉, 수신된 심볼 데이터 값을 Yr(k), 추정된 채널 전송 함수를 H(k)라고 하면, 복원된 심볼 데이터 값 Yeq(k)는 수학식 4와 같다.For example, the equalizer 3650 may use a zero forcing equalization scheme to compensate for the channel distortion. Since the received symbol can be represented as a product of the transmission symbol and the channel transmission function, dividing the received symbol by the estimated channel transmission function can restore the transmission symbol data value. That is, if the received symbol data value is Yr (k) and the estimated channel transfer function is H (k), the recovered symbol data value Y eq (k) is expressed by Equation 4.

Figure 112008039495204-PAT00010
Figure 112008039495204-PAT00010

도 38은 본 발명에 따른 일 실시예로서, 등화부를 개략적으로 나타낸 블록도이다. 상기 등화부(3650)는 보간부(3800), 제5연산부(3810), 제5곱셈부(3820), 제6곱셈부(3830), 및 제6연산부(3840)를 포함한다. 상기 도 38의 등화부는 상기에서 설명한 바와 같은 제로 포싱 등화 방식을 구현한 예이다. 38 is a block diagram schematically illustrating an equalizer according to an embodiment of the present invention. The equalizer 3650 includes an interpolator 3800, a fifth operator 3810, a fifth multiplier 3820, a sixth multiplier 3830, and a sixth operator 3840. The equalizer of FIG. 38 is an example of implementing the zero forcing equalization scheme as described above.

나누기 연산을 수행하는 데에는 상기에서 설명한 바와 같이 여러가지 방법이 있으나, 도 38의 등화부에서는 상기 도 37에서 나누기 연산을 수행한 것과 동일한 과정을 사용한다.There are various methods for performing the division operation as described above, but the equalizer of FIG. 38 uses the same process as that of performing the division operation of FIG. 37.

보간부(3800)는 입력된 채널 전송 함수 값을 전 대역(bandwidth)의 값으로 보간(interpolation)한다. 상기 보간부(3800)에서 보간된 채널 전송 함수 값은 제5연산부(3810)와 제5곱셈부(3820)로 출력된다. 제5연산부(3810)는 상기 보간부(3800)에서 출력된 채널 전송 함수의 켤레 복소수(complex conjugate) 값을 계산하여 출력한다. The interpolator 3800 interpolates the input channel transfer function value to a value of full bandwidth. The channel transfer function values interpolated by the interpolator 3800 are output to the fifth operator 3810 and the fifth multiplier 3820. The fifth operator 3810 calculates and outputs a complex conjugate value of the channel transfer function output from the interpolator 3800.

제5곱셈부(3820)는 상기 보간부(3800)에서 출력된 채널 전송 함수 값과 상기 제5연산부(3810)에서 출력된 채널 전송 함수의 켤레 복소수 값을 곱셈 연산하여 제 6연산부(3840)로 출력한다. 제6곱셈부(3830)는 제5연산부(3810)에서 출력된 켤레 복소수 값을 수신된 심볼 데이터에 곱셈 연산하여 제6연산부(3840)로 출력한다.The fifth multiplier 3820 multiplies the channel transfer function value output from the interpolator 3800 and the conjugate complex value of the channel transfer function output from the fifth operator 3810 to the sixth operator 3840. Output The sixth multiplier 3830 multiplies the conjugate complex value output from the fifth operator 3810 by the received symbol data and outputs the multiplied complex value to the sixth operator 3840.

제6연산부(3840)는 제5곱셈부(3820)에서 출력된 값에 대응되는 역수 값을 구하고, 상기 역수 값을 제6곱셈부(3830)에서 출력된 값과 곱하여 출력한다.The sixth operator 3840 obtains an inverse value corresponding to the value output from the fifth multiplier 3820, and multiplies the inverse value by the value output from the sixth multiplier 3830.

상기 등화부(3650)에서 등화된 심볼 데이터는 선형 프리코딩 디코더(3660)로 출력된다. 상기 선형 프리코딩 디코더(3660)는 분산된 심볼 데이터를 복원하여 출력하며, 상기 복원된 심볼 데이터는 다중 디맵퍼(3670)와 채널 추정부(3680)로 입력된다. The symbol data equalized by the equalizer 3650 is output to the linear precoding decoder 3660. The linear precoding decoder 3660 reconstructs and outputs distributed symbol data, and the reconstructed symbol data is input to the multiple demapper 3670 and the channel estimator 3680.

다중 디맵퍼(3670)는 각 디맵퍼를 이용하여 수신된 심볼 데이터를 디맵핑하여 대응되는 비트 데이터를 출력한다. 그리고, 상기 다중 디맵퍼(3670)는 작은 성상 사이즈를 가지는 심볼 데이터에 대하여 결정된 심볼 데이터 값을 채널 추정부(3680)로 전송한다. 또는, 상기 작은 성상 사이즈를 가지는 심볼 데이터에 대하여 디맵핑된 비트 데이터를 상기 채널 추정부(3680)로 출력할 수 있다. 채널의 추정은 심볼 데이터 단위에서 이루어지므로, 작은 성상 사이즈를 가지는 심볼 데이터에 대하여 디맵핑된 비트 데이터를 상기 채널 추정부(3680)로 출력하는 경우, 상기 도 37의 결정부(3700)는 상기 입력받은 비트 데이터에 해당하는 심볼 데이터를 다시 결정하여야 한다.The multiple demapper 3670 demaps the received symbol data using each demapper and outputs corresponding bit data. The multiple demapper 3670 transmits the symbol data value determined for the symbol data having a small constellation size to the channel estimator 3680. Alternatively, the demapped bit data of the symbol data having the small constellation size may be output to the channel estimator 3680. Since the channel is estimated in the unit of symbol data, when outputting the demapped bit data for symbol data having a small constellation size to the channel estimator 3680, the determiner 3700 of FIG. The symbol data corresponding to the received bit data must be determined again.

제2디인터리버(3690)는 상기 다중 디맵퍼(3670)에서 수신된 비트 데이터를 디인터리빙하여 순서를 복원한다. 다중 디코더(3692)는 상기 순서가 복원된 비트 데이터를 다중 인코딩된 방식에 따라 다중 디코딩하여 출력한다. 만약 신호 송신 장치에서 다중 인코딩 방식을 사용하지 않고 하나의 인코딩 방식을 사용한 경우, 다중 디코더는 사용되지 않으며 상기 인코딩 방식에 대응되는 하나의 디코딩 방식이 사용된다.The second deinterleaver 3690 recovers the order by deinterleaving the bit data received by the multiple demapper 3670. The multiple decoder 3692 multiplexes and outputs the reconstructed bit data according to a multi-encoded scheme. If a signal transmission apparatus does not use multiple encoding schemes but uses one encoding scheme, multiple decoders are not used and one decoding scheme corresponding to the encoding scheme is used.

도 39는 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 신호 송신 장치를 개략적으로 나타낸 블록도이다. 상기 신호 송신 장치는 아웃터 인코더(3900), 인너 인코더(3910), 제1인터리버(3920), 심볼 맵퍼(3930), 선형 프리코딩부(3940), 제2인터리버(3950), 프레임 형성부(3960), 변조부(3970), 및 전송부(3980)를 포함한다.39 is a block diagram schematically illustrating a signal transmission apparatus of a data symbol channel estimation method according to an embodiment of the present invention. The signal transmitting apparatus includes an outer encoder 3900, an inner encoder 3910, a first interleaver 3920, a symbol mapper 3930, a linear precoding unit 3940, a second interleaver 3950, and a frame forming unit 3960. ), A modulator 3970, and a transmitter 3980.

상기에서 설명한 바와 같이 파일럿의 삽입 위치 전부에 대해 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하거나, 일부 위치에만 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하고 나머지 위치에는 파일럿을 삽입한 경우, 상기 파일럿 삽입 위치에 삽입된 심볼 데이터를 결정하고, 상기 결정된 심볼 데이터를 기반으로 채널을 추정할 수 있다. 상기 방식의 경우 채널 추정 성능을 높일 수 있고, 파일럿 심볼을 사용하지 않거나 일부만을 사용함으로써, 시스템 전체의 전송률(capacity)을 높일 수 있다.As described above, when the symbol data having the small constellation size is inserted in all the insertion positions of the pilot, or the symbol data having the small constellation size is inserted in only a partial position, and the pilot is inserted in the remaining positions, the pilot insertion is performed. The symbol data inserted at the position may be determined, and a channel may be estimated based on the determined symbol data. In the case of the above scheme, channel estimation performance can be increased, and the entire system can be increased by not using pilot symbols or using only a part of the pilot symbols.

그러나, 낮은 SNR 환경에서 결정 오류(decision error)가 발생하게 되면, 채널 추정에 오류가 발생할 수 있고, 상기 에러를 갖는 채널 추정 값으로 보상된 데이터의 에러는 더욱 커지게 되어 에러 확산(error propagation) 현상이 발생할 수 있다.However, if a decision error occurs in a low SNR environment, an error may occur in the channel estimation, and an error of data compensated with the channel estimation value having the error may become larger, resulting in error propagation. Symptoms may occur.

상기 에러 확산 현상을 방지하기 위해, 상기 수신된 심볼 데이터에 대한 결 정 값 가운데 신뢰도(reliability)가 높은 결정 값만을 이용하여 채널을 추정하도록 한다.In order to prevent the error spreading phenomenon, the channel is estimated using only a decision value having high reliability among decision values of the received symbol data.

예를 들어, 상기 도 39와 같은 신호 송신 장치에서 파일럿의 삽입 위치 전부에 대해 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입한 경우를 가정한다. 상기 도 39의 신호 송신 장치와 도 34의 신호 송신 장치의 각 블록은 동일하며, 다만 다중 맵핑 방식 대신에 다른 심볼 맵핑 방식을 사용한 경우이다. 예로서 QAM, QPSK, 옵티멀 성상 방식 등과 같은 심볼 맵핑 방식이 사용될 수도 있고, 부호화된 심볼 맵핑 방식으로 트렐리스 코드 변조 등이 사용될 수도 있다. 상기 도 39의 신호 송신 장치에 대한 설명은 상기 도 34의 경우와 동일하다.For example, it is assumed that the symbol data having the small constellation size is inserted into all of the pilot insertion positions in the signal transmission apparatus as shown in FIG. Each block of the signal transmission apparatus of FIG. 39 and the signal transmission apparatus of FIG. 34 is the same, except that a different symbol mapping scheme is used instead of the multiple mapping scheme. For example, a symbol mapping method such as QAM, QPSK, optical constellation method, or the like may be used, or trellis code modulation may be used as an encoded symbol mapping method. The description of the signal transmission device of FIG. 39 is the same as that of FIG. 34.

다만, 상기 도 39의 프레임 형성부(3960)는 파일럿을 삽입하지 않고, 파일럿 삽입 위치에 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입하였으므로, 상기 파일럿 삽입 위치에 삽입된 심볼 데이터를 추출하여 나머지 심볼 데이터와 함께 복원한다.However, the frame forming unit 3960 of FIG. 39 inserts the symbol data having the small constellation size at the pilot insertion position without inserting the pilot, and thus extracts the remaining symbol data by extracting the symbol data inserted at the pilot insertion position. Restore with

도 40은 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 신호 수신 장치를 개략적으로 나타낸 블록도이다. 상기 신호 수신 장치는 수신부(4000), 동기부(4002), 복조부(4004), 프레임 파싱(parsing)부(4008), 제1디인터리버(deinterleaver)(4010), 등화부(equalizer)(4012), 선형 프리코딩 디코더(4014), 심볼 디맵퍼(4016), 채널 상태(channel state) 추정부(4018), 채널 추정부(channel estimator)(4020), 제2디인터리버(4022), 인너 디코더(4024) 및 아웃터 디코더(4026)를 포함한다. 상기 도 40의 신호 수신 장치는 상기 도 39와 같은 신호 송 신 장치에서 송신한 신호를 수신하여 처리한다.40 is a block diagram schematically illustrating a signal receiving apparatus of a data symbol channel estimation method according to an embodiment of the present invention. The signal receiver includes a receiver 4000, a synchronizer 4002, a demodulator 4004, a frame parsing unit 4008, a first deinterleaver 4010, and an equalizer 4012. ), Linear precoding decoder 4014, symbol demapper 4016, channel state estimator 4018, channel estimator 4020, second deinterleaver 4022, inner decoder 4024 and an outer decoder 4026. The signal receiving device of FIG. 40 receives and processes a signal transmitted from the signal transmitting device of FIG. 39.

상기 도 40의 신호 수신 장치는 상기 도 36의 신호 수신 장치와 대응되며, 이하 설명의 편의를 위해, 공통되는 부분의 설명은 생략하도록 한다.The signal receiving apparatus of FIG. 40 corresponds to the signal receiving apparatus of FIG. 36, and a description of common parts will be omitted for convenience of description.

수신된 프레임 데이터에는 파일럿이 삽입되어 있지 않고, 파일럿 삽입 위치에 상기 작은 성상 사이즈를 갖는 심볼 데이터를 삽입되어 있으므로, 상기 도 40의 프레임 파싱부(4008)는 상기 파일럿 삽입 위치에 삽입된 심볼 데이터를 추출하여 나머지 심볼 데이터와 함께 복원한다.Since the pilot is not inserted into the received frame data and the symbol data having the small constellation size is inserted at the pilot insertion position, the frame parsing unit 4008 of FIG. 40 uses the symbol data inserted at the pilot insertion position. Extract and restore with the rest of the symbol data.

채널 상태 추정부(4018)는 각 심볼 데이터 위치 즉, 각 서브 캐리어에 대한 전송 채널의 상태를 추정한다. 상기 채널 상태를 추정하기 위해 심볼 데이터 결정에 사용하는 LLR(Log-Likelihood Ratio) 값이나, 채널의 SNR 등을 사용할 수 있다. 상기 채널 상태를 추정하는 서브 캐리어는 상기 파일럿 삽입 위치에 삽입된 심볼 데이터를 전송하는 서브 캐리어일 수도 있고, 프레임에 포함된 그 이외의 심볼 데이터를 전송하는 서브 캐리어일 수도 있다.The channel state estimator 4018 estimates the position of each symbol data, that is, the state of a transmission channel for each subcarrier. In order to estimate the channel state, a Log-Likelihood Ratio (LLR) value used for symbol data determination or an SNR of a channel may be used. The subcarrier for estimating the channel state may be a subcarrier for transmitting symbol data inserted at the pilot insertion position, or may be a subcarrier for transmitting other symbol data included in a frame.

채널 추정부(4020)는 상기 채널 상태 추정부(4018)에서 추정된 각 채널의 상태를 이용하여 상태가 좋은 채널을 판단하고, 상기 상태가 좋은 채널에서 수신된 심볼 데이터를 이용하여 채널을 추정한다. 예를 들어, 상기 상태가 좋은 채널은 채널의 SNR이 높거나, LLR 값이 큰 경우를 들 수 있다. 또한, 상기와 같은 정보들 이외에 작은 성상 사이즈를 갖는 심볼 데이터나 낮은 코드율로 코딩된 심볼 데이터를 수신한 채널에 대해 높은 신뢰도를 적용하면, 채널 추정 에러를 더욱 줄일 수 있다.The channel estimator 4020 determines a channel having a good state by using the state of each channel estimated by the channel state estimator 4018, and estimates a channel by using symbol data received from the channel having a good state. . For example, the good channel may be a case in which the SNR of the channel is high or the LLR value is high. In addition, if a high reliability is applied to a channel that receives symbol data having a small constellation size or symbol data coded at a low code rate in addition to the above information, the channel estimation error can be further reduced.

상기 채널 추정부(4020)는 상기 상태가 좋은 채널에 대하여 수신된 심볼 데이터와 심볼 디맵퍼(4016)에서 결정된 심볼 데이터를 이용하여 채널 추정 함수를 얻을 수 있다. 등화부(4012)는 상기 채널 추정부(4020)에서 출력된 채널 추정 함수를 이용하여 수신된 심볼 데이터의 채널 왜곡을 보상한다.The channel estimator 4020 may obtain a channel estimation function by using the received symbol data for the good channel and the symbol data determined by the symbol demapper 4016. The equalizer 4012 compensates for the channel distortion of the received symbol data by using the channel estimation function output from the channel estimator 4020.

상기에서 설명한 결정된 심볼 데이터를 이용하여 채널을 추정하는 방식과 함께 다중 인코딩 방식 또는 다중 맵핑 방식을 사용할 수 있다. 즉, 상기 결정된 심볼 데이터를 이용하여 채널을 추정하는 방식에 상기 다중 인코딩방식과 다중 맵핑 방식을 개별적으로 함께 사용할 수도 있고, 모두 적용하여 사용할 수도 있다.In addition to the method of estimating the channel using the determined symbol data described above, a multiple encoding scheme or a multiple mapping scheme may be used. That is, the multiple encoding scheme and the multiple mapping scheme may be separately used together or may be applied to the scheme of estimating the channel using the determined symbol data.

도 41은 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 다른 신호 송신 장치를 개략적으로 나타낸 블록도이고, 도 42는 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 다른 신호 수신 장치를 개략적으로 나타낸 블록도이다.FIG. 41 is a block diagram schematically illustrating another signal transmission apparatus of a data symbol channel estimation method according to an embodiment of the present invention, and FIG. 42 is another signal of the data symbol channel estimation method according to an embodiment of the present invention. A block diagram schematically showing a receiving device.

상기 도 41의 신호 송신 장치는 아웃터 인코더(4100), 다중 인코더(4110), 제1인터리버(4120), 다중 맵퍼(4130), 선형 프리코딩부(4140), 제2인터리버(4150), 프레임 형성부(4160), 변조부(4170), 및 전송부(4180)를 포함하며, 도 42의 신호 수신 장치는 상기 신호 수신 장치는 수신부(4200), 동기부(4202), 복조부(4204), 프레임 파싱(parsing)부(4206), 제1디인터리버(deinterleaver)(4208), 등화부(equalizer)(4210), 선형 프리코딩 디코더(4212), 다중 디맵퍼(4214), 채널 상태(channel state) 추정부(4216), 채널 추정부(channel estimator)(4218), 제2디인터리버(4220), 다중 디코더(4222) 및 아웃터 디코더(4224)를 포함한다.The signal transmission apparatus of FIG. 41 includes an outer encoder 4100, a multiple encoder 4110, a first interleaver 4120, a multiple mapper 4130, a linear precoding unit 4140, a second interleaver 4150, and frame formation. And a signal receiver 4160, a modulator 4170, and a transmitter 4180. The signal receiver of FIG. 42 includes a receiver 4200, a synchronizer 4202, a demodulator 4204, A frame parsing section 4206, a first deinterleaver 4208, an equalizer 4210, a linear precoding decoder 4212, a multiple demapper 4214, a channel state ) An estimator 4216, a channel estimator 4218, a second deinterleaver 4220, a multiple decoder 4222, and an outer decoder 4224.

상기 도 41과 도 42의 예는 결정된 심볼 데이터를 이용하여 채널을 추정하는 방식에 다중 인코딩 방식과 다중 맵핑 방식을 모두 사용한 예이며, 각 블록에 대한 설명은 상기 각 실시 예에서 설명한 바와 같다.41 and 42 are examples of using both a multiple encoding scheme and a multiple mapping scheme in a method of estimating a channel using the determined symbol data, and the description of each block is the same as described in the above embodiments.

상기 도 25 내지 도 42에서 설명한 각 실시 예의 경우, 도 1 또는 도 9와 같이 다중 입출력(Multi Input Multi Output : MIMO) 방식을 사용하여 송수신할 수도 있다. 상기와 같이 다중 입출력 방식을 사용하는 경우, 송신 측은 인터리버와 프레임 형성부 사이에 다중 입출력 인코더가 추가되며, 수신 측은 프레임 파싱부와 디인터리버 사이에 다중 입출력 디코더가 추가된다.In the exemplary embodiments described with reference to FIGS. 25 to 42, transmission and reception may be performed using a multi input multi output (MIMO) scheme as shown in FIG. 1 or 9. In the case of using the multiple input / output method as described above, a multiple input / output encoder is added between the interleaver and the frame forming unit at the transmitting side, and a multiple input / output decoder is added between the frame parsing unit and the deinterleaver at the receiving side.

도 43은 본 발명에 따른 일 실시예로서, 전송 프레임의 구조를 나타낸 도면이다. 상기 각 실시 예에서 설명한 송신 장치의 프레임 형성부에서는 상기 도 43과 같은 구조를 갖는 전송 프레임 데이터를 형성하여 출력할 수 있다.43 is a diagram showing the structure of a transport frame according to an embodiment according to the present invention. The frame forming unit of the transmitting apparatus described in the above embodiments may form and output transmission frame data having the structure as shown in FIG. 43.

상기 도 43의 전송 프레임은 파일럿 캐리어(pilot carrier) 정보를 포함하는 파일럿 심볼 구간, 데이터 정보와 추적 파일럿(tracking pilot) 정보를 포함하는 데이터 심볼 구간으로 구성된다. 상기 도 43의 전송 프레임은 상기 도 7의 전송 프레임 가운데 데이터 심볼 구간에 파일럿 신호가 삽입(또는 맵핑)된 실시 예이다.The transmission frame of FIG. 43 includes a pilot symbol period including pilot carrier information, and a data symbol period including data information and tracking pilot information. The transmission frame of FIG. 43 is an embodiment in which a pilot signal is inserted (or mapped) in a data symbol period among the transmission frames of FIG.

상기 도 43과 같은 구조를 갖는 프레임을 전송하는 경우, 수신 측에서는 상기 파일럿 심볼 구간에 위치한 파일럿 캐리어 정보를 이용하여 상기 프레임에 대한 채널 추정 등을 수행한다. 그러나, 채널 상태가 변동하는 경우, 수신 측에서는 상기 파일럿 심볼 구간에 위치한 파일럿 캐리어 정보만으로는 정확한 채널 추정을 하기 어렵다. 따라서, 상기 파일럿 심볼 구간에 위치한 파일럿 캐리어 정보 이외에 상기 데이터 심볼 구간에 포함된 추적 파일럿을 이용하여 상기 추적 파일럿이 포함되어 있는 구간에 대한 채널 추정을 정확하게 할 수 있다. 상기 추적 파일럿은 도 45에 나타난 바와 같이 스캐터드 파일럿(scattered pilot) 형태로 삽입될 수 있다.When transmitting a frame having the structure as shown in FIG. 43, the receiving side performs channel estimation on the frame using pilot carrier information located in the pilot symbol period. However, when the channel state changes, it is difficult for the receiving side to accurately estimate the channel only with the pilot carrier information located in the pilot symbol interval. Therefore, in addition to the pilot carrier information located in the pilot symbol interval, the channel pilot for the interval in which the tracking pilot is included can be accurately used using the tracking pilot included in the data symbol interval. The tracking pilot may be inserted in the form of a scattered pilot as shown in FIG. 45.

도 44는 본 발명에 따른 일 실시예로서, 프레임에 따른 추적 파일럿(tracking pilot)의 수를 나타낸 도면이다. OFDM 방식의 경우 푸리에 변환(Fourier Transform)을 이용하여 각 서브 캐리어에 심볼을 실어 전송할 수 있다.FIG. 44 is a diagram illustrating the number of tracking pilots according to a frame according to an embodiment of the present invention. FIG. In the OFDM method, a symbol may be transmitted on each subcarrier by using a Fourier transform.

상기 도 44는 패스트 푸리에 변환(Fast Fourier Transform : 이하 FFT)을 이용하여 심볼을 전송하는 경우, FFT 모드에 따른 사용 가능한 서브 캐리어의 수, 추적 파일럿의 수, 심볼 데이터의 수를 나타낸다. 상기 사용 가능한 서브 캐리어의 수는 총 서브 캐리어의 수에서 TPS(Transmission Parameter Signaling) 등을 위한 서브 캐리어의 수를 뺀 값을 나타내며, 추적 파일럿의 수는 데이터 심볼 구간에 삽입되는 추적 파일럿의 수를 나타낸다. 심볼 데이터의 수는 상기 사용 가능한 서브 캐리어의 수에서 추적 파일럿의 수를 뺀 값으로 심볼 데이터를 전송할 수 있는 서브 캐리어의 수를 나타낸다. 예를 들어, 2k 모드의 경우, 1688개의 사용 가능한 서브 캐리어 가운데 68개를 추적 파일럿을 전송하는 데 사용하며, 나머지 1620개의 서브 캐리어를 심볼 데이터를 전송하는 데 사용한다.FIG. 44 illustrates the number of usable subcarriers, the number of tracking pilots, and the number of symbol data according to the FFT mode when a symbol is transmitted using a Fast Fourier Transform (FFT). The number of usable subcarriers indicates the total number of subcarriers minus the number of subcarriers for TPS (Transmission Parameter Signaling) and the like, and the number of tracking pilots indicates the number of tracking pilots inserted in the data symbol interval. . The number of symbol data indicates the number of subcarriers that can transmit symbol data by subtracting the number of tracking pilots from the number of usable subcarriers. For example, in the 2k mode, 68 out of 1688 usable subcarriers are used to transmit tracking pilots, and the remaining 1620 subcarriers are used to transmit symbol data.

도 45는 본 발명에 따른 일 실시예로서, 추적 파일럿이 포함된 프레임을 나타낸 도면이다. 상기 도 45는 상기 도 44의 각 전송 모드 가운데 2k 모드에 따라 하나의 데이터 심볼 구간에 추적 파일럿이 삽입된 형태를 나타낸다.45 is a view illustrating a frame including a tracking pilot according to an embodiment of the present invention. 45 illustrates a form in which a tracking pilot is inserted in one data symbol period according to a 2k mode among the transmission modes of FIG. 44.

즉, 상기 도 45는, 1710개(0번째 ~ 1709번째)의 서브 캐리어에서 TPS 등을 위한 서브 캐리어를 제외한 1688개의 서브 캐리어 가운데, 68개의 서브 캐리어가 추적 파일럿 정보를 전송하는데 사용되며, 1620개의 서브 캐리어가 심볼 데이터를 전송하는데 사용되는 것을 나타낸다.That is, in FIG. 45, 68 subcarriers are used to transmit tracking pilot information among 1688 subcarriers except for the TPS in 1710 subcarriers (0th to 1709th). Indicates that a subcarrier is used to transmit symbol data.

상기 예에서 추적 파일럿은 5개의 패턴(패턴0 내지 패턴4)을 갖고, 스캐터드 파일럿(scattered pilot) 형태로 삽입된다. 한 패턴과 다음 패턴의 추적 파일럿간의 심볼 거리는 5이고, 한 패턴에서 추적 파일럿간의 심볼 거리는 25이다.In this example, the tracking pilot has five patterns (patterns 0 to 4) and is inserted in the form of a scattered pilot. The symbol distance between one pattern and the tracking pilot of the next pattern is 5, and the symbol distance between the tracking pilots in one pattern is 25.

도 46은 본 발명에 따른 일 실시예로서, 상기 도 45의 프레임에 따른 마진(margin)을 나타낸 도면이다. 상기 도 45와 같은 형태로 추적 파일럿을 삽입할 경우, 좌우로 각각 4 심볼 거리, 5 심볼 거리 만큼의 마진이 발생한다. 상기 마진이 발생한 영역에서는 채널 추정시 추적을 할 수 없으므로, 정확한 채널 추정을 위해 상기 마진을 줄여야 한다.FIG. 46 is a view illustrating a margin along the frame of FIG. 45 according to an embodiment of the present invention. FIG. When the tracking pilot is inserted in the form as shown in FIG. 45, margins are generated by 4 symbol distances and 5 symbol distances from side to side, respectively. Since the channel estimation cannot be tracked in the region where the margin occurs, the margin should be reduced for accurate channel estimation.

상기 도 46은 상기 도 45와 같은 형태의 프레임에 대해 FFT 각 모드에 따른 추적 파일럿의 수와 좌, 우 마진의 거리 수를 나타낸다. 예를 들어, 2k 모드의 경우, 좌우로 각각 4 심볼 거리, 5 심볼 거리 만큼의 마진이 발생하지만, 8k 모드에서는 좌우로 각각 48 심볼 거리, 58 심볼 거리 만큼의 마진이 발생한다. 즉, FFT 모드에 따라 심볼의 길이가 길수록 마진 영역이 커짐을 알 수 있다.FIG. 46 shows the number of tracking pilots and the number of distances of left and right margins according to each FFT mode for the frame of FIG. 45. For example, in the 2k mode, margins of 4 and 5 symbol distances are generated from left and right, respectively, but in 8k mode, margins of 48 and 58 symbol distances are generated from left and right, respectively. That is, the longer the length of the symbol according to the FFT mode, the larger the margin area.

도 47은 본 발명에 따른 일 실시예로서, 추적 파일럿이 포함된 다른 프레임을 나타낸 도면이다. 상기 도 47은 상기 도 44의 각 전송 모드 가운데 2k 모드에 따라 하나의 데이터 심볼 구간에 추적 파일럿이 삽입된 다른 형태를 나타낸다.47 is a view showing another frame including a tracking pilot according to an embodiment of the present invention. FIG. 47 illustrates another form in which a tracking pilot is inserted into one data symbol period according to a 2k mode among the transmission modes of FIG. 44.

즉, 상기 도 47은, 1710개(0번째 ~ 1709번째)의 서브 캐리어에서 TPS 등을 위한 서브 캐리어를 제외한 1688개의 서브 캐리어 가운데, 71개의 서브 캐리어가 추적 파일럿 정보를 전송하는데 사용되며, 1617개의 서브 캐리어가 심볼 데이터를 전송하는데 사용되는 것을 나타낸다.That is, in FIG. 47, 71 subcarriers are used to transmit tracking pilot information among 1688 subcarriers except for the TPS in 1710 subcarriers (0th to 1709th). Indicates that a subcarrier is used to transmit symbol data.

상기 추적 파일럿은 6개의 패턴(패턴0 내지 패턴6)을 갖고, 스캐터드 파일럿(scattered pilot) 형태로 삽입된다. 한 패턴과 다음 패턴의 추적 파일럿간의 심볼 거리는 4이고, 한 패턴에서 추적 파일럿간의 심볼 거리는 24이다. The tracking pilot has six patterns (patterns 0 to 6) and is inserted in the form of a scattered pilot. The symbol distance between one pattern and the tracking pilot of the next pattern is 4, and the symbol distance between the tracking pilots in one pattern is 24.

도 48은 본 발명에 따른 일 실시예로서, 상기 도 47의 프레임에 따른 마진(margin)을 나타낸 도면이다. 상기 도 47과 같은 형태로 추적 파일럿을 삽입할 경우, 좌우로 각각 2 심볼 거리, 2 심볼 거리 만큼의 마진이 발생한다.FIG. 48 is a diagram illustrating a margin according to the frame of FIG. 47 according to an embodiment of the present invention. FIG. When the tracking pilot is inserted in the form as shown in FIG. 47, margins are generated by 2 symbol distances and 2 symbol distances, respectively.

상기 도 48은 상기 도 47과 같은 형태의 프레임에 대해 FFT 각 모드에 따른 추적 파일럿의 수와 좌, 우 마진의 거리 수를 나타낸다. 상기와 같은 형태의 프레임은, 각 모드(2k, 4k, 8k)에 대해, 좌우로 각각 2 심볼 거리, 2 심볼 거리 만큼의 마진이 발생한다. 즉, 상기 도 47과 같은 형태의 프레임의 경우, 추적 파일럿의 수가 다소 늘었으나, 마진 영역을 줄여 좀 더 정확하게 채널을 추정할 수 있다.FIG. 48 shows the number of tracking pilots and the number of distances of left and right margins according to each FFT mode for the frame of FIG. 47. In the frame of the above-described form, margins are generated by two symbol distances and two symbol distances, respectively, for the respective modes 2k, 4k, and 8k. That is, in the case of the frame of FIG. 47, although the number of tracking pilots is slightly increased, it is possible to estimate the channel more accurately by reducing the margin area.

도 49는 본 발명에 따른 일 실시예로서, LDPC 블록에 포함되는 심볼의 개수를 나타낸 도면이다. 상기 각 실시예에서 설명한 송신 장치의 인너 인코더로 LDPC(Low Density Parity Check) 인코더를 사용하는 경우, 상기 LDPC 프레임의 크기와 상기 OFDM 방식의 프레임의 크기가 다르므로, 수신 측에서는 상기 LDPC 프레임의 동기를 맞추기 위한 별도의 과정이 필요하다. 따라서, 상기 OFDM 방식의 프레임을 효율적으로 구성하여 상기 LDPC 프레임의 동기를 용이하게 맞출 수 있도록 한 다.FIG. 49 is a diagram showing the number of symbols included in an LDPC block according to an embodiment of the present invention. FIG. In the case of using a Low Density Parity Check (LDPC) encoder as the inner encoder of the transmitter described in the above embodiments, since the size of the LDPC frame and the frame of the OFDM scheme are different, the receiving side may not synchronize the LDPC frame. A separate process is required to fit. Accordingly, the OFDM frame can be efficiently configured to easily synchronize the LDPC frame.

상기 도 49는 LDPC 모드와 심볼 맵핑 방식에 따라 하나의 LDPC 블록(block)에 해당하는 심볼의 개수를 각각 나타낸다. LDPC의 모드는 LDPC의 코드워드(codeword)의 길이가 64800비트인 경우와 16200비트인 경우를 예로 들며, 심볼 맵핑 방식으로 다중 맵핑 방식을 사용한 경우를 예로 든다. 상기 도 49는 256, 64, 16, 4 QAM(Quadrature Amplitude Modulation)을 사용하여 다중 맵핑한 경우의 예이다. 즉, 인너 인코더에서 LDPC로 인코딩된 데이터를 상기 256, 64, 16, 4 QAM 방식을 혼합하여 다중 맵핑한 경우의 예이다. 상기 맵핑 방식은 일 예이며, 상기 예로 든 수치나 방식에 본 발명의 사상이 한정되지 아니한다.49 illustrates the number of symbols corresponding to one LDPC block according to the LDPC mode and the symbol mapping method. The LDPC mode is a case where the codeword length of the LDPC is 64800 bits and 16200 bits, and the case where the multiple mapping method is used as the symbol mapping method is taken as an example. 49 illustrates an example of multiple mapping using 256, 64, 16, and 4 quadrature amplitude modulation (QAM). That is, an example is a case where the inner encoder multi-maps the LDPC encoded data by mixing the 256, 64, 16, and 4 QAM schemes. The mapping method is an example, and the spirit of the present invention is not limited to the above-described numerical values and methods.

상기 도 49에서 성상(constellation) 열은 다중 맵핑에서 사용된 맵핑 방식과 상기 맵핑 방식의 비율을 나타낸다. 예를 들어, 256 QAM은 256 QAM 방식만을 사용하여 맵핑한 경우이고, Hyb256-64_r8은 256 QAM과 64 QAM방식의 두 가지 맵핑방식을 사용하면서 상기 256 QAM방식의 비율이 전체의 80%인 경우를 나타낸다. 두번째 열은 큰 성상 사이즈를 갖는 맵핑 방식의 비율(Rate of larger constellation)을 나타낸다. 상기 비율이 1이면 큰 성상 사이즈를 갖는 맵핑 방식만을 사용하는 경우이다.In FIG. 49, the constellation column represents a ratio of the mapping scheme used in the multiple mapping to the mapping scheme. For example, 256 QAM is mapped using only 256 QAM, and Hyb256-64_r8 uses two mapping methods, 256 QAM and 64 QAM, while the ratio of 256 QAM is 80% of the total. Indicates. The second column shows the rate of larger constellation mapping. If the ratio is 1, only a mapping method having a large constellation size is used.

상기 도 49에서 256 QAM 방식만으로 맵핑하여 전송한 경우를 살펴본다. 상기 256 QAM 방식은 심볼 당 8비트를 전송할 수 있으므로, LDPC 코드워드의 길이가 64800인 경우 하나의 LDPC 블록에 해당하는 심볼의 개수는 64800/8 = 8100개가 된다. 그리고, LDPC 코드워드의 길이가 16200인 경우에는 하나의 LDPC 블록에 해당하 는 심볼의 개수는 2025개가 된다.Referring to FIG. 49, a case of mapping and transmitting using only 256 QAM scheme will be described. Since the 256 QAM scheme can transmit 8 bits per symbol, when the length of the LDPC codeword is 64800, the number of symbols corresponding to one LDPC block is 64800/8 = 8100. When the length of the LDPC codeword is 16200, the number of symbols corresponding to one LDPC block is 2025.

256 QAM 방식의 비율이 80%이고, 64 QAM 방식의 비율이 20%인 경우 즉, Hyb256-64_r8인 다중 맵핑 방식을 사용하여 전송한 경우를 살펴본다. 상기와 같은 경우, LDPC 코드워드의 길이가 64800이면 하나의 LDPC 블록에 해당하는 심볼의 개수는 8640개이며, LDPC 코드워드의 길이가 16200이면 하나의 LDPC 블록에 해당하는 심볼의 개수는 2160개이다. 나머지 예에 대한 심볼의 개수는 상기 도 49에 나타낸 바와 같다. 다만 상기 도 49의 맵핑 방식의 종류와 수는 일 예에 불과하며, 256 QAM 방식의 비율이 80%이고, 16 QAM 방식의 비율이 20%인 경우 즉, Hyb256-16_r8과 같은 다중 맵핑 방식도 사용될 수 있다. 또한, 상기 도 49와 같이 2가지 종류의 맵핑 방식을 혼합할 수도 있고, 2 종류 이상의 맵핑 방식을 혼합하여 사용할 수도 있다.The case where the ratio of the 256 QAM scheme is 80% and the ratio of the 64 QAM scheme is 20%, that is, the case of transmission using the multiple mapping scheme of Hyb256-64_r8 will be described. In this case, if the length of the LDPC codeword is 64800, the number of symbols corresponding to one LDPC block is 8640, and if the length of the LDPC codeword is 16200, the number of symbols corresponding to one LDPC block is 2160. The number of symbols for the remaining examples is as shown in FIG. However, the type and number of mapping schemes of FIG. 49 are merely examples, and when the ratio of the 256 QAM scheme is 80% and the ratio of the 16 QAM scheme is 20%, that is, a multiple mapping scheme such as Hyb256-16_r8 may also be used. Can be. In addition, as shown in FIG. 49, two types of mapping methods may be mixed, or two or more types of mapping methods may be mixed and used.

도 50은 본 발명에 따른 일 실시예로서, LDPC 프레임에 포함되는 LDPC 블록의 개수를 나타낸 도면이다. 상기 도 50은 LDPC의 코드워드 길이가 64800인 경우, 다중 맵핑 방식과 전송 모드(또는 FFT 모드)에 따라 하나의 LDPC 프레임을 구성하는 데 필요한 LDPC 블록의 수를 나타낸다.50 is a diagram illustrating the number of LDPC blocks included in an LDPC frame as an embodiment according to the present invention. 50 illustrates the number of LDPC blocks required to configure one LDPC frame according to a multiple mapping scheme and a transmission mode (or FFT mode) when the codeword length of an LDPC is 64800.

상기 도 50에서와 같이 256 QAM만을 이용하여 맵핑하는 경우, 8k FFT 모드에 대해서는 4개의 LDPC 블록이 포함되며, 2k FFT 모드에 대해서는 1개의 LDPC 블록이 포함됨을 알 수 있다. 그리고, 256 QAM 방식의 비율이 80%이고, 64 QAM 방식의 비율이 20%인 경우, 8k FFT 모드에 대해서는 3개의 LDPC 블록이 포함되며, 2k FFT 모드에 대해서도 3개의 LDPC 블록이 포함됨을 알 수 있다.When mapping using only 256 QAM as shown in FIG. 50, it can be seen that four LDPC blocks are included in the 8k FFT mode and one LDPC block is included in the 2k FFT mode. In addition, when the ratio of the 256 QAM scheme is 80% and the ratio of the 64 QAM scheme is 20%, it can be seen that three LDPC blocks are included in the 8k FFT mode and three LDPC blocks are included in the 2k FFT mode. have.

도 51은 본 발명에 따른 일 실시예로서, LDPC 프레임에 포함되는 OFDM 블록의 개수를 나타낸 도면이다. 상기 도 51은 LDPC의 코드워드 길이가 64800인 경우, 심볼 맵핑 방식과 FFT 모드에 따라 하나의 LDPC 프레임을 구성하는 데 필요한 OFDM 블록의 수를 나타낸다.51 is a diagram showing the number of OFDM blocks included in an LDPC frame according to an embodiment according to the present invention. FIG. 51 illustrates the number of OFDM blocks required to configure one LDPC frame according to a symbol mapping method and an FFT mode when the codeword length of an LDPC is 64800.

상기 도 51에서와 같이 256 QAM만을 이용하여 심볼 맵핑하는 경우, 8k FFT 모드에 대해서는 5개의 OFDM 블록이 포함되며, 2k FFT 모드에 대해서는 5개의 OFDM 블록이 포함됨을 알 수 있다. 그리고, 256 QAM 방식의 비율이 80%이고, 64 QAM 방식의 비율이 20%인 경우, 8k FFT 모드에 대해서는 4개의 OFDM 블록이 포함되며, 2k FFT 모드에 대해서는 16개의 OFDM 블록이 포함됨을 알 수 있다.When symbol mapping using only 256 QAM as shown in FIG. 51, five OFDM blocks are included in the 8k FFT mode and five OFDM blocks are included in the 2k FFT mode. When the ratio of the 256 QAM scheme is 80% and the ratio of the 64 QAM scheme is 20%, four OFDM blocks are included in the 8k FFT mode and 16 OFDM blocks are included in the 2k FFT mode. have.

도 52는 본 발명에 따른 일 실시예로서, 다른 모드의 LDPC 프레임에 포함되는 LDPC 블록의 개수를 나타낸 도면이고, 도 53은 본 발명에 따른 일 실시예로서, 다른 모드의 LDPC 프레임에 포함되는 OFDM 블록의 개수를 나타낸 도면이다. 상기 도 52와 도 53은 각각 LDPC의 코드워드 길이가 16200인 경우의 예이다. 상기 도 49 내지 도 53의 각 수치는 계산에 의해 산출된 수치이며, 설명의 편의를 위해 상기 각 수치에 대한 산출 방식은 생략하기로 한다.FIG. 52 is a diagram illustrating the number of LDPC blocks included in an LDPC frame of another mode according to an embodiment of the present invention, and FIG. 53 is a diagram illustrating the number of LDPC blocks included in an LDPC frame of another mode according to the present invention. It is a figure which shows the number of blocks. 52 and 53 are examples of the case where the codeword length of the LDPC is 16200, respectively. 49 to 53 are numerical values calculated by calculations, and calculation methods for the respective numerical values will be omitted for convenience of description.

도 54는 본 발명에 따른 일 실시예로서, LDPC 프레임 구조를 나타낸 도면이다. 상기 도 54는 하나의 LDPC 프레임과 LDPC 블록, OFDM 블록의 관계를 나타낸다. 54 illustrates an LDPC frame structure according to an embodiment of the present invention. 54 shows a relationship between one LDPC frame, LDPC block, and OFDM block.

상기 도 54의 예는 LDPC의 코드워드 길이가 64800이고, 심볼 맵핑 방식은 256 QAM, FFT 모드는 8k인 경우이다. 하나의 LDPC 프레임은 4개의 LDPC 블록을 포함하며, 5개의 OFDM 블록에 대응된다. 상기와 같은 조건에 대해, 도 50에서는 하나 의 LDPC 프레임에 포함되는 LDPC 블록의 개수가 4개인 것을 확인할 수 있고, 도 51에서는 하나의 LDPC 프레임에 포함되는 OFDM 블록의 개수가 5개인 것을 확인할 수 있다.In the example of FIG. 54, the codeword length of the LDPC is 64800, the symbol mapping method is 256 QAM, and the FFT mode is 8k. One LDPC frame includes four LDPC blocks and corresponds to five OFDM blocks. With respect to the above conditions, it can be seen in FIG. 50 that the number of LDPC blocks included in one LDPC frame is four, and in FIG. 51, it can be seen that the number of OFDM blocks included in one LDPC frame is five. .

상기 도 54에서 LDPC 블록의 시작점과 OFDM 블록의 시작점이 서로 일치하지 않는 것을 확인할 수 있다. 따라서, 수신 측의 프레임 파싱부에서는 수신된 OFDM 블록들로부터 다시 LDPC 블록을 구성하기 위해, LDPC 블록의 시작점을 알아내는 동기화(synchronization) 과정이 필요하다.In FIG. 54, it can be seen that the start point of the LDPC block and the start point of the OFDM block do not coincide with each other. Accordingly, in order to construct an LDPC block again from the received OFDM blocks, the frame parsing unit on the receiving side needs a synchronization process to find the starting point of the LDPC block.

즉, OFDM 블록의 시작점과 LDPC 시작점이 일치하는 곳을 LPDC 프레임의 시작점으로 할 수 있다. 따라서, LPDC 프레임의 시작점은 FDM 블록의 시작점과 LDPC 시작점이 일치한다. 바꾸어 말하면, LDPC 블록의 시작점은 LDPC 프레임 시작점과 일치하는 OFDM 블록의 시작점으로부터 알 수 있다. 따라서, 상기 동기화를 위해 하나의 LDPC 프레임을 구성하는 데 사용되고 있는 OFDM 블록의 인덱스(index)를 전송하는 방식을 사용할 수 있다. 이하 상기 방식에 대해 설명하도록 한다. That is, the start point of the LPDC may be a place where the start point of the OFDM block and the start point of the LDPC coincide. Therefore, the start point of the LPDC frame coincides with the start point of the FDM block and the LDPC start point. In other words, the start point of the LDPC block can be known from the start point of the OFDM block that coincides with the start point of the LDPC frame. Accordingly, a scheme of transmitting an index of an OFDM block used to configure one LDPC frame for the synchronization may be used. Hereinafter, the method will be described.

도 55는 본 발명에 따른 일 실시예로서, TPS의 구조를 나타낸 도면이다. TPS는 매 OFDM 블록마다 한 비트씩 전송되며, 한 개의 TPS 프레임은 총 68비트로 이루어져 있다. 따라서, 한 개의 TPS 프레임은 총 68개의 OFDM 블록을 통해 전송된다. 도 55의 비트 넘버는 하나의 TPS 프레임에 포함된 68개의 비트 넘버를 나타내며, 상기 비트 넘버는 상기 비트를 전송하는 OFDM 블록 넘버와 일치한다.55 is a diagram showing the structure of a TPS according to an embodiment according to the present invention. TPS is transmitted one bit per OFDM block, one TPS frame is a total of 68 bits. Thus, one TPS frame is transmitted on a total of 68 OFDM blocks. The bit number of FIG. 55 represents 68 bit numbers included in one TPS frame, and the bit number corresponds to the OFDM block number for transmitting the bit.

상기 하나의 TPS 프레임에 포함된 68개의 비트를 이용하여 상기 도 55의 우측 열에 도시한 정보를 전송할 수 있다. 예를 들어, 0번째 비트를 이용하여 초기 화(initialization) 정보를 전송할 수 있으며, 25번째와 26번째 비트를 이용하여 성상(constellation) 정보, 즉 맵핑 정보를 전송할 수 있다. 38번째 비트와 39번째 비트는 전송 모드에 대한 정보를 전송할 수 있다.Information shown in the right column of FIG. 55 may be transmitted using the 68 bits included in the one TPS frame. For example, initialization information may be transmitted using the 0 th bit, and constellation information, that is, mapping information may be transmitted using the 25 th and 26 th bits. The 38th bit and the 39th bit may transmit information on a transmission mode.

도 56은 본 발명에 따른 일 실시예로서, 성상(constellation) 정보를 나타낸 도면이다. 상기 도 55의 TPS 비트 가운데 25번째와 26번째 비트를 이용하는 경우 최대 4가지 종류에 대한 성상 정보를 전송할 수 있으므로, 더 많은 종류의 성상 정보를 전송하는 경우 상기 비트의 수를 늘려야 한다. 상기 도 56은 상기 두 비트가 늘어난 4개의 비트를 이용하여 식별되는 성상 정보를 나타낸다.56 illustrates constellation information according to an embodiment of the present invention. When the 25th and 26th bits of the TPS bits of FIG. 55 are used, constellation information for up to four types can be transmitted. Therefore, when more types of constellation information are transmitted, the number of bits must be increased. 56 shows constellation information identified using four bits in which the two bits are increased.

즉, 25번째 내지 28번째 비트를 사용하여 상기 25번째 내지 28번째 비트가 '0000'(25번째 비트 '0' , 26번째 비트 '0', 27번째 비트 '0' , 28번째 비트 '0')인 경우 QPSK만으로 맵핑된 심볼 데이터가 전송되며, '0111'인 경우 64 QAM 방식의 비율이 40%이고, 16 QAM 방식의 비율이 60%인 다중 맵핑 방식으로 맵핑된 심볼 데이터가 전송되는 것을 나타낸다. That is, using the 25th to 28th bits, the 25th to 28th bits are '0000' (25th bit '0', 26th bit '0', 27th bit '0', 28th bit '0' In case of), symbol data mapped using only QPSK is transmitted, and in case of '0111', symbol data mapped in a multiple mapping method with 64% of 64 QAM schemes and 60% of 16 QAM schemes is transmitted. .

상기 도 56의 예에서는 도 49 내지 도 53에서 예로 든 다중 맵핑 방식의 16가지 종류를 이용하였으므로, 4개(25번째 내지 28번째)의 비트를 사용하였으나, 다중 맵핑 방식의 종류가 늘어나거나 줄어드는 경우 상기 종류 수에 따라 사용하는 비트의 수를 조정할 수 있다.In the example of FIG. 56, since 16 types of the multiple mapping schemes illustrated in FIGS. 49 to 53 are used, four (25th to 28th) bits are used, but the type of the multiple mapping scheme increases or decreases. The number of bits to be used can be adjusted according to the kind number.

수신 측에서 LDPC 블록의 시작점을 알아내기 위한 동기화를 위해 상기 TPS에 맵핑 정보 이외에 LDPC 모드에 대한 정보를 더 포함하여 전송한다.The receiver further transmits information about the LDPC mode in addition to the mapping information in the TPS for synchronization to find the start point of the LDPC block.

도 57은 본 발명에 따른 일 실시예로서, LDPC 모드 정보를 나타낸 도면이다. 상기 도 55에는 LDPC 모드에 대한 정보를 전송하는 비트가 포함되어 있지않다. 따라서, 40비트 내지 53비트의 리저브드(reserved) 비트 가운데 42번째 비트와 43번째 비트를 이용하여 LDPC 모드 정보를 전송하도록 한다. 상기 도 57은 상기 두 개의 비트를 이용하여 식별되는 LDPC 모드 정보를 나타낸다.57 shows LDPC mode information according to an embodiment according to the present invention. 55 does not include bits for transmitting information about the LDPC mode. Therefore, the LDPC mode information is transmitted by using the 42nd bit and the 43rd bit among the reserved bits of 40 to 53 bits. 57 shows LDPC mode information identified using the two bits.

즉, 42번째와 43번째 비트가 '00'인 경우 사용된 LDPC는 64800의 코드워드 길이를 가지며, '01'인 경우 사용된 LDPC는 16200의 코드워드 길이를 가진다. 상기 예에서는 64800과 16200의 두 가지 모드를 예로 들었으므로, 두 개(42번째, 43번째)의 비트를 사용하였으나, 모드의 수가 늘어나는 경우 상기 모드 수에 따라 사용하는 비트의 수를 늘릴 수 있다.That is, the LDPC used when the 42nd and 43rd bits are '00' has a codeword length of 64800, and the used LDPC has a codeword length of 16200 when '01'. In the above example, since the two modes of 64800 and 16200 are used as examples, two (42th and 43rd) bits are used. However, when the number of modes increases, the number of bits used may be increased according to the number of modes.

도 58은 본 발명에 따른 일 실시예로서, 확장된 TPS의 구조를 나타낸 도면이다. 상기 도 58은 상기 도 56과 도 57의 정보를 포함하여 확장된 TPS의 구조를 나타낸다. 상기 도 58의 TPS 프레임에서는 도 56과 같이 성상 정보가 2비트 더 늘어남에 따라, 성상 정보 이후의 비트의 순서가 2비트씩 밀려 위치가 조정되었다. 수신 측에서는 상기 도 58과 같은 TPS 프레임을 수신하여 성상 정보와 LDPC 모드 정보, 전송 모드 정보 등을 알 수 있다.58 is a diagram illustrating a structure of an extended TPS according to an embodiment according to the present invention. 58 illustrates a structure of an extended TPS including the information of FIGS. 56 and 57. In the TPS frame of FIG. 58, as the constellation information is further increased by 2 bits as shown in FIG. 56, the position of the bits after the constellation information is pushed by two bits to adjust the position. The receiving side can receive the TPS frame as shown in FIG. 58 and know the constellation information, LDPC mode information, and transmission mode information.

도 59는 본 발명에 따른 일 실시예로서, OFDM 블록 인덱스 정보를 나타낸 도면이다. 상기 도 55의 TPS 프레임에는 OFDM 블록 인덱스에 대한 정보를 전송하는 비트가 포함되어 있지않다. 따라서, 리저브드(reserved) 비트 가운데 44번째 비트 내지 48번째 비트를 이용하여 OFDM 블록 인덱스 정보를 전송하도록 한다. 상기 도 59는 상기 5개의 비트를 이용하여 식별되는 OFDM 블록 인덱스 정보를 나타낸다.59 is a diagram showing OFDM block index information according to an embodiment according to the present invention. The TPS frame of FIG. 55 does not include bits for transmitting information on the OFDM block index. Therefore, the OFDM block index information is transmitted using the 44 th to 48 th bits among the reserved bits. 59 shows OFDM block index information identified using the five bits.

도 51과 도 53의 예에서는, 하나의 LDPC 프레임은 최대 28개의 OFDM 블록으로 구성될 수 있다. 따라서, 상기 28개의 OFDM 블록을 구분할 수 있는 OFDM 블록 인덱스를 상기 TPS 프레임에 포함하여 전송하여야 한다. 상기 OFDM 블록 인덱스가 가리키는 OFDM 블록은 TPS 프레임이 시작하는 OFDM 블록으로부터 마지막 OFDM 블록 가운데 임의의 블록이 될 수 있다. 예를 들어, 상기 인덱스는 상기 최대 28개의 OFDM 블록 가운데 첫번째 블록을 가리키는 인덱스일 수도 있고, 마지막 블록을 가리키는 인덱스일 수도 있다. 이는 구현 예에 따라 달라질 수 있으며, 송신 측과 수신 측의 약속에 따라 해당 블록을 식별할 수 있으면 된다.In the example of FIG. 51 and FIG. 53, one LDPC frame may consist of up to 28 OFDM blocks. Therefore, an OFDM block index that can distinguish the 28 OFDM blocks must be included in the TPS frame and transmitted. The OFDM block indicated by the OFDM block index may be any of the last OFDM blocks from the OFDM block at which the TPS frame starts. For example, the index may be an index indicating a first block of the maximum 28 OFDM blocks or an index indicating a last block. This may vary depending on the implementation, and the block may be identified according to the promise of the sender and the receiver.

상기 도 59에서 44번째 비트 내지 48번째 비트가 '00000'인 경우 OFDM 블록 인덱스는 1이며, '11111'인 경우 OFDM 블록 인덱스는 32이다. 비트 값이 1씩 늘어날 때마다 상기 인덱스 값도 1씩 증가한다. 상기 예에서는 최대 28개의 블록을 구별하여야 하므로, 5개(44번째 내지 48번째)의 비트를 사용하였으나, 최대 블록의 수에 따라 사용하는 비트의 수를 조정할 수 있다.In FIG. 59, when the 44th bit to the 48th bit are '00000', the OFDM block index is 1 and when the '11111', the OFDM block index is 32. Each time the bit value is increased by one, the index value is also increased by one. In the above example, since 28 blocks must be distinguished, 5 (44th to 48th) bits are used, but the number of bits used can be adjusted according to the maximum number of blocks.

도 60은 본 발명에 따른 일 실시예로서, OFDM 블록 인덱스 정보를 포함하는 TPS 구조를 나타낸 도면이다. 상기 TPS 프레임은 상기 도 56과 도 57에 대한 정보 및 도 59에 대한 정보를 포함한다.60 is a diagram illustrating a TPS structure including OFDM block index information according to an embodiment according to the present invention. The TPS frame includes information about FIGS. 56 and 57 and information about FIG. 59.

수신 측에서는 상기 도 60과 같은 TPS 프레임을 수신하여 성상 정보와 LDPC 모드 정보, 전송 모드 정보, 및 하나의 LDPC 프레임에 포함된 특정 OFDM 블록에 대한 인덱스 정보를 알 수 있다. 따라서, 상기 TPS 프레임에서 얻어진 성상 정보, LDPC 모드 정보, 및 전송 모드 정보와 상기 도 50 내지 도 53의 정보를 이용하여, 하나의 LDPC 프레임에 포함되는 LDPC 블록의 개수, OFDM 블록의 개수를 알 수 있다. 그리고, 상기 하나의 LDPC 프레임에 포함되는 LDPC 블록의 개수 정보와 OFDM 블록의 개수 정보, 및 상기 LDPC 프레임에 포함된 특정 OFDM 블록 정보를 이용하여, LDPC 블록의 시작점을 알아낼 수 있다.The receiving side may receive the TPS frame as shown in FIG. 60 to know constellation information, LDPC mode information, transmission mode information, and index information of a specific OFDM block included in one LDPC frame. Accordingly, the number of LDPC blocks and the number of OFDM blocks included in one LDPC frame can be known using the constellation information, the LDPC mode information, the transmission mode information, and the information of FIGS. 50 to 53 obtained from the TPS frame. have. The start point of the LDPC block may be determined using the number information of the LDPC blocks included in the one LDPC frame, the number information of the OFDM blocks, and the specific OFDM block information included in the LDPC frame.

예를 들어, 상기 OFDM 블록 인덱스 정보가 하나의 LDPC 프레임 내에 포함되는 OFDM 블록 가운데 3번째 블록을 가리킨다고 가정한다. 상기에서 설명한 바와 같이 하나의 LDPC 프레임에 포함되는 LDPC 블록의 개수와 OFDM 블록의 개수를 알 수 있고, 상기 OFDM 블록 가운데 상기 OFDM 블록 인덱스가 가리키는 블록의 2블록 앞에서 LDPC 블록과 OFDM 블록이 시작함을 알 수 있다. 다만, 수신 측에서는 상기 도 50 내지 도 53에 대한 정보를 미리 알고 있어야 한다.For example, it is assumed that the OFDM block index information indicates a third block among OFDM blocks included in one LDPC frame. As described above, the number of LDPC blocks and the number of OFDM blocks included in one LDPC frame can be known, and the LDPC block and the OFDM block start before two blocks of the block indicated by the OFDM block index among the OFDM blocks. Able to know. However, the receiving side should know the information about the above 50 to 53 in advance.

상기에서 설명한 바와 같이 도 60과 같은 구조를 가지는 TPS 프레임 정보를 이용하여, 수신 측에서는 LDPC 블록의 시작점을 알아낼 수 있다. 다만, 수신 측에서는 상기 도 50 내지 도 53에 대한 정보를 미리 알고 있어야 하며, 상기 정보와 수신된 TPS 프레임에 포함된 정보를 이용하여 LDPC 블록의 시작점을 알아낼 수 있다.As described above, using the TPS frame information having the structure as shown in FIG. 60, the receiving side can determine the start point of the LDPC block. However, the receiving side should know the information about the above 50 to 53 in advance, it is possible to find the starting point of the LDPC block using the information and the information contained in the received TPS frame.

이하에서는, 수신 측에서 상기 도 50 내지 도 53에 대한 정보를 사용하지 않고 바로 LDPC 블록의 시작점을 알아낼 수 있도록 하는 방법에 대해 설명한다.Hereinafter, a description will be given of a method for allowing a receiving side to immediately find a start point of an LDPC block without using the information of FIGS. 50 to 53.

도 61은 본 발명에 따른 일 실시예로서, LDPC 블록 정보를 나타낸 도면이다. 상기 도 61의 경우, TPS 프레임의 비트 가운데 사용하지 않는 리저브드(reserved) 영역의 비트를 이용하여 하나의 LDPC 프레임에 포함된 LDPC 블록의 개수에 대한 정 보를 전송할 수 있다.61 is a diagram showing LDPC block information according to an embodiment of the present invention. In FIG. 61, information on the number of LDPC blocks included in one LDPC frame may be transmitted using bits in a reserved area that are not used among the bits of the TPS frame.

예를 들어, 49번째 비트 내지 52번째 비트를 이용하여 상기 LDPC 블록의 개수에 대한 정보를 전송한다. 상기 도 50과 도 52에서 확인한 바와 같이, 각 LDPC 모드에 따라 하나의 LDPC 프레임에 포함될 수 있는 최대 LDPC 블록의 개수는 48개이다. 그러나, 상기에서 사용되는 블록 개수의 종류는 10개(1, 2, 3, 4, 6, 8, 12, 16, 24, 48)에 불과하므로 상기 도 61에서는 4비트를 이용하여 상기 LDPC 블록의 개수 정보를 전송한다.For example, information on the number of the LDPC blocks is transmitted using the 49 th bit to the 52 th bit. As shown in FIG. 50 and FIG. 52, the maximum number of LDPC blocks that can be included in one LDPC frame is 48 according to each LDPC mode. However, since the number of blocks used in the above is only 10 (1, 2, 3, 4, 6, 8, 12, 16, 24, 48), in FIG. 61, 4 bits are used for the LDPC block. Send count information.

상기 도 61에서 49번째 비트 내지 52번째 비트가 '0000'인 경우 하나의 LDPC 프레임에 포함된 LDPC 블록의 개수는 1이며, '0111'인 경우 16이다. 상기 도 61에서는 상기 도 50와 도 52에서 사용되는 블록 개수의 종류 10개에 대응되는 값 이외의 나머지 값은 리저브드 영역으로 남겨둔다. 상기 예에서는 10 종류의 값을 구별하여야 하므로, 4개(49번째 내지 52번째)의 비트를 사용하였으나, 상기 사용되는 블록 개수의 값 종류에 따라 사용하는 비트의 수를 조정할 수 있다. 또한, 상기 블록 개수 값에 대응되는 비트 값은 일 예이며, 구현 예에 따라 달라질 수 있다.In FIG. 61, when the 49th to 52nd bits are '0000', the number of LDPC blocks included in one LDPC frame is 1, and when '0111' is 16. In FIG. 61, the remaining values other than the values corresponding to the ten types of the blocks used in FIGS. 50 and 52 are reserved. In the above example, since 10 types of values must be distinguished, four (49th to 52nd) bits are used, but the number of bits used can be adjusted according to the value type of the number of blocks used. In addition, the bit value corresponding to the block number value is an example, and may vary depending on implementation.

도 62는 본 발명에 따른 일 실시예로서, OFDM 블록 정보를 나타낸 도면이다. 상기 도 62의 경우, 53번째 비트 내지 57번째 비트를 이용하여 상기 OFDM 블록의 개수에 대한 정보를 전송한다. 상기 도 51과 도 53에서 확인한 바와 같이, 각 LDPC 모드에 따라 하나의 LDPC 프레임에 포함될 수 있는 최대 OFDM 블록의 개수는 28개이다. 따라서, 상기 도 62에서는 5비트를 이용하여 상기 OFDM 블록의 개수 정보를 전송한다. 상기 도 62에서는 5비트를 이용하였으나, 상기 도 61과 같이 블록 개수 의 종류에 따라 필요한 비트 수를 사용할 수도 있다.62 is a diagram illustrating OFDM block information according to an embodiment of the present invention. In case of FIG. 62, information on the number of OFDM blocks is transmitted using 53rd to 57th bits. 51 and 53, the maximum number of OFDM blocks that can be included in one LDPC frame according to each LDPC mode is 28. Therefore, in FIG. 62, the number information of the OFDM block is transmitted using 5 bits. In FIG. 62, 5 bits are used. However, as shown in FIG. 61, the required number of bits may be used according to the type of the number of blocks.

상기 도 62에서 53번째 비트 내지 57번째 비트가 '00000'인 경우 하나의 LDPC 프레임에 포함된 OFDM 블록의 개수는 1이며, '11111'인 경우 32이다. 비트 값이 1씩 늘어날 때마다 상기 블록 개수의 값도 1씩 증가한다.In FIG. 62, when the 53 th to 57 th bits are '00000', the number of OFDM blocks included in one LDPC frame is 1, and when the 11 th bit is '11111'. Each time the bit value increases by 1, the value of the number of blocks also increases by one.

상기 예에서는 최대 28개의 블록 개수 값을 구별하기 위해 5개(53번째 내지 57번째)의 비트를 사용하였으나, 구별하여야 하는 블록 개수 값에 따라 사용하는 비트의 수를 조정할 수 있다.In the above example, five (53th to 57th) bits are used to distinguish up to 28 block number values, but the number of bits used may be adjusted according to the block number value to be distinguished.

도 63은 본 발명에 따른 일 실시예로서, 제안된 정보를 포함하는 TPS의 구조를 나타낸 도면이다. 상기 도 63은 상기 도 55의 TPS 프레임 구조에 상기 도 56, 도 57, 도 59, 도 61, 및 도 62의 정보가 포함된 구조이다. 따라서, 수신 측에서는 상기 도 63과 같은 구조를 갖는 TPS 프레임을 수신하여, 성상 정보와 LDPC 모드 정보, 전송 모드 정보, 하나의 LDPC 프레임에 포함된 특정 OFDM 블록에 대한 인덱스 정보, 하나의 LDPC 프레임에 포함되는 LDPC 블록 개수 정보, 하나의 LDPC 프레임에 포함되는 OFDM 블록 개수 정보 등을 얻을 수 있다.FIG. 63 is a diagram illustrating a structure of a TPS including proposed information according to an embodiment of the present invention. 63 is a structure in which the information of FIGS. 56, 57, 59, 61, and 62 is included in the TPS frame structure of FIG. 55. Accordingly, the receiving side receives the TPS frame having the structure as shown in FIG. 63, and includes the constellation information, the LDPC mode information, the transmission mode information, the index information for a specific OFDM block included in one LDPC frame, and one LDPC frame. LDPC block number information and OFDM block number information included in one LDPC frame may be obtained.

따라서, 수신 측에서는 도 50 내지 도 53에 대한 정보를 이용하지 않고, 상기 수신된 TPS 프레임에 포함된 정보를 이용하여 LDPC 블록의 시작점을 알 수 있다.Accordingly, the receiving side may know the starting point of the LDPC block by using the information included in the received TPS frame without using the information of FIGS. 50 to 53.

상기 도 63과 같은 TPS 구조를 갖는 경우, 58번째 비트 내지 71번째 비트는 BCH 에러 프로텍션(error protection) 정보를 포함한다. DVB의 경우, BCH(127,113,t=2)인 오리지널 시스테매틱 코드(original systematic code)를 이용 하여 상기 BCH 에러 프로텍션 정보를 얻을 수 있다. 상기 127은 총 전송 비트의 수를, 113은 메시지 비트의 수를 나타내며, 상기 총 전송 비트의 수에서 메시지 비트의 수를 뺀 만큼의 비트 수는 패리티 비트의 수를 나타낸다. 그리고, t=2는 오류 정정 가능한 비트의 수를 나타낸다.In the case of having the TPS structure as shown in FIG. 63, the 58 th to 71 th bits include BCH error protection information. In the case of DVB, the BCH error protection information can be obtained using an original systematic code of BCH (127, 113, t = 2). 127 denotes the total number of transmission bits, 113 denotes the number of message bits, and the number of bits corresponding to the total number of transmission bits minus the number of message bits indicates the number of parity bits. And t = 2 represents the number of bits which can be error corrected.

상기 BCH 에러 프로텍션 정보를 얻기 위해, BCH 인코더의 입력 비트열에 60비트의 제로를 삽입하여 인코딩한다. 상기 인코딩되어 출력된 비트 중에서 삽입된 60비트의 제로를 제거하면 BCH(67,53,t=2)인 단축(shortened) BCH 코드를 얻을 수 있다.In order to obtain the BCH error protection information, 60 bits of zero are inserted and encoded in an input bit string of a BCH encoder. By removing the inserted zero bits of the encoded and output bits, a shortened BCH code of BCH (67, 53, t = 2) can be obtained.

상기 도 63과 같이 57비트의 메시지 비트, 71비트의 총 전송 비트를 갖는 TPS에 대해 BCH 코드를 얻기 위해서는, BCH 인코더의 입력 비트열에 56비트의 제로를 삽입하여 인코딩한다. 그리고 상기 인코딩되어 출력된 비트 중에서 56비트의 제로를 제거하여 BCH(71,57,t=2)인 단축 BCH 코드를 얻을 수 있다.As shown in FIG. 63, in order to obtain a BCH code for a TPS having 57 bits of message bits and 71 bits of total transmission bits, 56 bits of zeros are inserted and encoded into an input bit string of the BCH encoder. A shortened BCH code of BCH (71, 57, t = 2) can be obtained by removing 56 bits of zero from the encoded and output bits.

도 64는 본 발명에 따른 일 실시예로서, 프리앰블 주기정보를 나타낸 도면이다. 상기 도 64의 경우, TPS 프레임에 프리앰블 주기 정보를 포함하여 전송할 수 있다. 상기에서 설명한 바와 같이 도 7 또는 도 43과 같은 전송 프레임에서 파일럿 심볼 구간이 프리앰블로 사용될 수 있으며, 이러한 경우, 상기 프리앰블의 주기는 상기 파일럿 심볼 구간의 주기를 말한다.64 is a diagram illustrating preamble period information according to an embodiment of the present invention. In case of FIG. 64, the preamble period information may be included in the TPS frame and transmitted. As described above, a pilot symbol period may be used as a preamble in a transmission frame as shown in FIG. 7 or 43. In this case, the period of the preamble refers to the period of the pilot symbol period.

상기 파일럿 심볼 구간은 파일럿으로 사용될 수 있는 기지(known) 신호를 포함하며, 수신단에서는 상기 파일럿 신호를 이용하여 신호 동기, 채널 추정, 채널 보상 등을 수행한다. 전송하고자 하는 데이터를 포함하는 데이터 심볼 구간은 상기 파일럿 심볼 구간과 다음 파일럿 심볼 구간 사이에 포함되어 전송된다. 송신단에서는 상기 파일럿 심볼 구간의 주기를 조정하여 데이터 전송량(capacity)과 전송 신뢰성 사이의 트레이드 오프를 얻을 수 있다.The pilot symbol period includes a known signal that can be used as a pilot, and the receiver performs signal synchronization, channel estimation, channel compensation, etc. using the pilot signal. The data symbol interval including the data to be transmitted is included between the pilot symbol interval and the next pilot symbol interval and transmitted. The transmitter may adjust the period of the pilot symbol interval to obtain a tradeoff between data capacity and transmission reliability.

예를 들어, 채널 환경이 좋지 않거나, 이동 수신환경과 같이 채널 환경이 변하는 경우에는 상기 파일럿 심볼 구간을 더 자주 삽입하여 주기를 빠르게 할 수 있다. 또는, 채널 환경이 좋거나, 고정 수신하는 경우 등은 상기 파일럿 심볼 구간을 덜 삽입할 수 있다.For example, when the channel environment is not good or the channel environment changes, such as a mobile reception environment, the pilot symbol section may be inserted more frequently to speed up the period. Alternatively, when the channel environment is good or fixed reception is performed, the pilot symbol interval may be inserted less.

상기와 같이 구현 예에 따라 상기 파일럿 심볼 구간의 주기를 다르게 할 수 있다. 따라서, 송신단에서는 수신단에서 상기 파일럿 심볼 구간의 주기를 알 수 있도록 상기 도 64와 같은 프리앰블 주기 정보를 포함하여 수신단에 전송한다. 상기 도 64의 예는 58번째 비트와 59번째 비트 2개의 비트를 이용하여, 프리앰블이 10심볼, 15심볼, 20심볼, 25심볼 구간마다 삽입되는 경우를 나타낸다. 다만, 상기 비트의 수나 주기 정보는 일 실시예이며, 상기 수치에 의해 본 발명의 사상이 한정되는 것은 아니다.As described above, the period of the pilot symbol interval may be different. Accordingly, the transmitting end transmits the preamble period information shown in FIG. 64 to the receiving end so that the receiving end can know the period of the pilot symbol interval. The example of FIG. 64 illustrates a case in which a preamble is inserted every 10 symbols, 15 symbols, 20 symbols, and 25 symbol intervals by using two bits of the 58th bit and the 59th bit. However, the number and period information of the bits is an embodiment, and the spirit of the present invention is not limited by the numerical values.

도 65는 본 발명에 따른 일 실시예로서, 프리앰블 주기 정보를 포함하는 TPS 구조를 나타낸 도면이다. 상기 도 65는 상기 도 63의 TPS에 프리앰블 주기 정보가 더 포함된 구조를 나타낸다.65 is a diagram illustrating a TPS structure including preamble period information according to an embodiment of the present invention. 65 shows a structure in which the preamble period information is further included in the TPS of FIG.

BCH(127,113,t=2)인 오리지널 시스테매틱 코드를 이용하여 상기 도 65와 같이 59비트의 메시지 비트, 73비트의 총 전송 비트를 갖는 TPS에 대해 BCH 코드를 얻기 위해서는, BCH 인코더의 입력 비트열에 54비트의 제로를 삽입하여 인코딩한 다. 그리고 상기 인코딩되어 출력된 비트 중에서 54비트의 제로를 제거하여 BCH(73,59,t=2)인 단축 BCH 코드를 얻을 수 있다.In order to obtain a BCH code for a TPS having 59 bits of message bits and 73 bits of total transmission bits using the original systematic code of BCH (127, 113, t = 2), an input bit of a BCH encoder is obtained. Encode the column by inserting 54 bits of zeros. A shortened BCH code of BCH (73,59, t = 2) can be obtained by removing 54 bits of zero from the encoded and output bits.

도 66은 본 발명에 따른 일 실시예로서, 파일럿 심볼 구간과 단일 주파수 망의 관계를 나타낸 도면이다. 상기 도 7 또는 도 43에서 설명한 바와 같은 전송 프레임에서, 파일럿 심볼 구간은 상기 도 8(a)에서 설명한 바와 같은 구조를 가질 수 있다.66 is a diagram illustrating a relationship between a pilot symbol interval and a single frequency network according to an embodiment of the present invention. In the transmission frame as described with reference to FIG. 7 or 43, the pilot symbol period may have a structure as described with reference to FIG. 8A.

상기 도 66에 도시된 파일럿 심볼 구간은 파일럿 캐리어 정보를 인터리빙시켜 짝수(even), 홀수(odd) 파일럿으로 나눈다. 그리고 단일 주파수 망(SFN : Single Frequency Network)을 짝수 캐리어 지역(A)과 홀수 캐리어 지역(B)으로 나누어, 각각 짝수 파일럿, 홀수 파일럿에 해당하는 정보를 이용하여 데이터를 송신한다.The pilot symbol interval shown in FIG. 66 is divided into even and odd pilots by interleaving pilot carrier information. In addition, a single frequency network (SFN) is divided into an even carrier region (A) and an odd carrier region (B), and data is transmitted using information corresponding to an even pilot and an odd pilot, respectively.

도 67은 본 발명에 따른 일 실시예로서, 파일럿 심볼의 구조를 나타낸 도면이다. 상기 도 67의 상부 있는 도면은 짝수 파일럿 캐리어를 포함하는 파일럿 심볼 구간의 구조이며, 하부에 있는 도면은 홀수 파일럿 캐리어를 포함하는 파일럿 심볼 구간의 구조이다. 각 짝수 파일럿 캐리어, 홀수 파일럿 캐리어 정보 이외에는 널(NULL) 캐리어 정보가 포함된다.67 is a diagram showing the structure of a pilot symbol according to an embodiment of the present invention. The upper diagram of FIG. 67 is a structure of a pilot symbol interval including an even pilot carrier, and the lower diagram is a structure of a pilot symbol interval including an odd pilot carrier. Null carrier information is included in addition to each even pilot carrier and odd pilot carrier information.

즉, 짝수 캐리어 지역(A)의 안테나에서는 상기 도 67의 상부에 있는 도면과 같이 짝수 파일럿 캐리어를 포함하는 파일럿 심볼 구간을 이용하여 데이터를 전송하며, 홀수 캐리어 지역(B)의 안테나에서는 상기 도 67의 하부에 있는 도면과 같이 홀수 파일럿 캐리어를 포함하는 파일럿 심볼 구간을 이용하여 데이터를 전송한다. 상기 짝수 캐리어 지역(A)과 홀수 캐리어 지역(B)에서 전송되는 데이터 심볼 구간의 데이터는 동일하며, 다만 파일럿 심볼 구간의 파일럿 캐리어 정보가 홀수 캐리어와 짝수 캐리어로 다르다.That is, the antenna of the even carrier region (A) transmits data using a pilot symbol interval including an even pilot carrier as shown in the upper part of FIG. 67, and the antenna of the odd carrier region (B) is shown in FIG. Data is transmitted using a pilot symbol period including an odd pilot carrier as shown in the lower part of the figure. The data of the data symbol interval transmitted in the even carrier region A and the odd carrier region B is the same, except that the pilot carrier information of the pilot symbol interval is different from the odd carrier and the even carrier.

상기와 같이 짝수 파일럿과 홀수 파일럿을 나누어 파일럿 심볼 구간을 구성하는 경우, 파일럿 심볼 구간에 포함된 파일럿의 파워를 2배로 크게 하더라도 전체적인 파워에서는 변화가 없다. 따라서, 수신단에서는 상기 2배 크기의 파워를 갖는 파일럿을 이용하여 채널을 추정할 수 있으며, 더 정확한 채널 추정이 가능하다.As described above, when the even pilot and the odd pilot are divided to form a pilot symbol interval, even if the power of the pilot included in the pilot symbol interval is doubled, the overall power does not change. Therefore, the receiver can estimate the channel by using the pilot having the power of twice the size, and more accurate channel estimation is possible.

또한, 상기 도 66과 같이 짝수 캐리어 지역(A)과 홀수 캐리어 지역(B)이 겹치는 지역(C)에서는 짝수 파일럿, 홀수 파일럿 신호를 동시에 수신할 수 있다. 따라서, 상기 C지역에서는 짝수 파일럿과 홀수 파일럿 신호를 이용하여 더욱 정확한 채널 추정을 할 수 있다. 예를 들어, 채널 상황이 더 좋은 쪽의 파일럿을 이용하여 채널 추정을 하거나, 양쪽 파일럿을 이용하여 채널을 보상하고 채널 추정을 할 수 있다. 따라서, 상기 도 66과 같이 하나의 캐리어 지역(ex, A) 주변에 다른 종류의 캐리어 지역(ex, B)이 일부 겹치도록 안테나를 배치하여, 상대적으로 안테나로부터 먼 지역이더라도 정확한 채널 추정을 할 수 있다.In addition, as shown in FIG. 66, in the region C where the even carrier region A and the odd carrier region B overlap, the even pilot and the odd pilot signals may be simultaneously received. Therefore, in the region C, more accurate channel estimation can be performed using an even pilot and an odd pilot signal. For example, channel estimation may be performed using a pilot having a better channel condition, or both pilots may be compensated for and channel estimation may be performed using both pilots. Accordingly, as shown in FIG. 66, antennas are arranged such that some other carrier regions ex and B overlap with each other around one carrier region ex and A, so that accurate channel estimation can be performed even in a region relatively far from the antenna. have.

상기와 같이 짝수 파일럿, 홀수 파일럿을 각각 포함하는 파일럿 심볼 구간을 이용하는 경우, 수신단에서는 상기 파일럿 심볼 구간을 용이하게 검출하여 동기를 맞출 수 있다. 상기 도 67과 같이 파일럿 심볼 구간에는 널(NULL) 정보(에너지 0) 캐리어가 포함되나, 데이터 심볼 구간에는 상기와 같이 에너지가 0인 캐리어가 존재하지 않으므로, 캐리어의 파워를 검출하는 방식만으로 파일럿 심볼 구간(또는 프 리앰블)의 동기를 맞출 수 있다.When using a pilot symbol interval including an even pilot and an odd pilot as described above, the receiver can easily detect and synchronize the pilot symbol interval. As shown in FIG. 67, a null symbol (zero energy) carrier is included in the pilot symbol period, but since there is no carrier having zero energy in the data symbol period as described above, the pilot symbol is detected only by detecting the power of the carrier. The interval (or preamble) can be synchronized.

도 68은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도이다. 상기 도 68은 상기에서 설명한 각 실시예의 신호 송신 장치 가운데, 다중 인코딩, 다중 맵핑 방식과 상기 도 67에서 설명한 파일럿 심볼 구조를 이용하여 신호를 송신하는 장치를 나타낸다. 즉, 상기 도 67에서 설명한 파일럿 심볼 구조는 상기 실시예 이외에 도 1, 도 13, 도 25, 도 30, 도 34, 도 39, 도 41 등과 같은 모든 실시예에서도 사용될 수 있다. 또한, 상기 도 68의 구성요소에서 아웃터 인코더와 인너 인코더 사이에 인터리빙 과정을 수행하거나, 선형 프리코딩 과정을 수행하지 않는 실시예 등과 같이 구현 예에 따라 필요한 구성요소가 더 추가되거나 필요하지 않은 구성요소가 사용되지 않을 수 있다. 상기 도 68의 신호 송신 장치의 각 구성 요소는 상기 각 실시예에서 설명한 바와 같으며, 이하 차이가 있는 부분을 중심으로 설명하기로 한다. 68 is a block diagram schematically showing another example of a signal transmission apparatus according to an embodiment of the present invention. FIG. 68 shows an apparatus for transmitting signals using the multiple encoding and multiple mapping schemes and the pilot symbol structure described with reference to FIG. 67 among the signal transmission apparatuses of the above-described embodiments. That is, the pilot symbol structure described with reference to FIG. 67 may be used in all embodiments, such as FIGS. 1, 13, 25, 30, 34, 39, and 41, in addition to the above embodiment. In addition, in the component of FIG. 68, an additional component that does not need to be added or required according to an implementation example, such as an interleaving process between an outer encoder and an inner encoder, or a linear precoding process, is not performed. May not be used. Each component of the signal transmission apparatus of FIG. 68 is the same as described in each of the above embodiments, and will be described below with reference to differences.

제2인터리버(6850)에서 인터리빙된 심볼 데이터는 프레임 형성부(6860)로 입력된다. 상기 프레임 형성부(6860)는 출력된 신호를 OFDM 방식으로 변조할 수 있도록 파일럿 신호를 삽입하여 프레임을 형성한다. 이때, 상기 프레임 형성부(6860)는 상기 도 67과 같은 구조의 파일럿 심볼 구간을 갖는 프레임을 형성한다. 예를 들어, 짝수 캐리어 지역의 프레임 형성부는 상기 도 67의 상부 도면과 같은 구조의 파일럿 심볼 구간을 갖는 프레임을 형성하며, 홀수 캐리어 지역의 프레임 형성부는 상기 도 67의 하부 도면과 같은 구조의 파일럿 심볼 구간을 갖는 프레임을 형성한다.The symbol data interleaved by the second interleaver 6850 is input to the frame forming unit 6860. The frame forming unit 6860 forms a frame by inserting a pilot signal to modulate the output signal by the OFDM method. In this case, the frame forming unit 6860 forms a frame having a pilot symbol interval having the structure as shown in FIG. For example, the frame forming portion of the even carrier region forms a frame having a pilot symbol section having the same structure as in the upper view of FIG. 67, and the frame forming portion of the odd carrier region has a pilot symbol having the structure shown in the lower view of FIG. 67. Form a frame with sections.

상기 프레임 형성부(6860)에서 각각 형성된 전송 프레임은 변조부(6870)를 거쳐 OFDM 변조되어 전송된다.Each transmission frame formed by the frame forming unit 6860 is OFDM modulated and transmitted through the modulator 6070.

도 69는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도이다. 상기 도 69는 상기에서 설명한 각 실시예의 신호 수신 장치 가운데, 다중 인코딩, 다중 맵핑 방식과 상기 도 67에서 설명한 파일럿 심볼 구조를 이용하여 송신된 신호를 수신하는 장치를 나타낸다. 상기 도 69의 수신장치는 상기 도 68의 송신 장치에 대응된다.69 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention. 69 illustrates an apparatus for receiving a signal transmitted using a multiple encoding and a multiple mapping scheme and the pilot symbol structure described with reference to FIG. 67 among the signal receiving apparatuses of the above-described embodiments. The receiver of FIG. 69 corresponds to the transmitter of FIG.

마찬가지로 상기 도 69의 신호 수신 장치의 각 구성 요소는 상기 각 실시예에서 설명한 바와 같으며, 이하 차이가 있는 부분을 중심으로 설명하기로 한다.Likewise, each component of the signal receiving apparatus of FIG. 69 is the same as described in each of the above embodiments, and will be described below with reference to differences.

복조부(6920)에서 복조된 데이터는 프레임 파싱부(6930)에 입력된다. 상기 프레임 파싱부(6930)는 상기 복조부(6920)에서 입력된 프레임을 파싱(parsing)하여, 파일럿 심볼을 제외한 데이터 심볼 구간의 심볼 데이터를 출력할 수 있다. 이때, 상기 프레임 파싱부(6930)는 캐리어의 파워를 검출하는 방식만으로 파일럿 심볼 구간(또는 프리앰블)의 동기를 맞출 수 있다.Data demodulated by the demodulator 6920 is input to the frame parser 6930. The frame parser 6930 may parse the frame input from the demodulator 6920 and output symbol data of a data symbol interval excluding a pilot symbol. In this case, the frame parsing unit 6930 may synchronize the pilot symbol period (or preamble) only by detecting the power of the carrier.

상기 프레임 파싱부(6930)에서 파싱된 심볼 데이터는 제1디인터리버(6950)로 출력된다. 제1디인터리버(6950)는 상기 도 68의 제2인터리버(6850)에서 인터리빙한 방식에 대응되는 방식으로 디인터리빙하여 심볼 데이터의 순서를 복원한다.The symbol data parsed by the frame parser 6930 is output to the first deinterleaver 6950. The first deinterleaver 6950 recovers the order of the symbol data by deinterleaving in a manner corresponding to the method interleaved by the second interleaver 6850 of FIG. 68.

상기 프레임 파싱부(6930)에서 파싱된 파일럿 데이터는 채널 추정부(6940)로 출력된다. 상기 채널 추정부(6940)는 상기 프레임 파싱부(6930)에서 출력된 파일럿과 기지(known) 파일럿 정보를 이용하여 채널을 추정하며, 상기 추정된 결과 값을 등화부(6960)로 출력한다. 등화부(6960)는 상기 채널 추정 값을 이용하여 제1디인터리버(6950)에서 순서가 복원된 심볼 데이터를 등화한다.The pilot data parsed by the frame parser 6930 is output to the channel estimator 6940. The channel estimator 6940 estimates a channel by using the pilot and known pilot information output from the frame parser 6930 and outputs the estimated result to the equalizer 6960. The equalizer 6960 equalizes the symbol data whose order is restored in the first deinterleaver 6950 by using the channel estimate value.

도 70a와 70b는 본 발명에 따른 일 실시예로서, 제안된 프레임 구조를 나타낸 도면이다. 상기와 같이 제안된 프레임 구조는 상기에서 설명한 각 송수신 실시예에 적용하여 사용할 수 있다. 상기 도 70a와 도 70b에서 1 행은 파일럿 심볼 구간(프리앰블)을 나타낸다. 상기 프리앰블과 프리앰블 사이에는 프리앰블 주기(P)보다 하나 적은 수(1 ~ P-1)의 데이터 심볼 구간이 포함된다.70A and 70B illustrate a proposed frame structure according to an embodiment of the present invention. The proposed frame structure can be applied to each of the above-described transmission and reception embodiments. In FIG. 70A and FIG. 70B, row 1 shows a pilot symbol period (preamble). The preamble and the preamble include a number (1 ~ P-1) of the number of data symbol intervals less than the preamble period (P).

상기 도 67에서 설명한 바와 같이, 도 7 또는 도 43과 같은 프레임의 파일럿 심볼 구간에는 짝수 또는 홀수 파일럿 캐리어 정보만을 포함하여 전송할 수 있다. 상기 도 70a는 짝수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간과, 전송할 심볼 데이터와 함께 CP(Continual Pilot) 파일럿 정보를 포함하는 데이터 심볼 구간으로 구성된 프레임을 나타낸 도면이다. 상기 CP 파일럿은 수신단에서 채널 변화를 추적하고 주파수 오프셋(offset)을 추정하는 데 사용될 수 있다.As described with reference to FIG. 67, only even or odd pilot carrier information may be transmitted in a pilot symbol period of a frame as illustrated in FIG. 7 or 43. FIG. 70A illustrates a frame including a pilot symbol interval including only even pilot carrier information and a data symbol interval including continuous pilot (CP) pilot information along with symbol data to be transmitted. The CP pilot can be used to track channel changes and estimate frequency offset at the receiving end.

상기 도 44에서 설명한 바와 같이, 2k 모드의 경우, 데이터 심볼 구간에는 1688개의 데이터 전송 가능한 서브 캐리어가 있다. 도 70a는 그 가운데 68개를 CP 파일럿을 전송하는 데 사용하며, 나머지 1620개의 서브 캐리어를 심볼 데이터를 전송하는 데 사용하는 경우의 실시 예이다.As described above with reference to FIG. 44, in the 2k mode, there are 1688 data transmission subcarriers in the data symbol period. FIG. 70A illustrates an embodiment in which 68 of them are used to transmit a CP pilot and the remaining 1620 subcarriers are used to transmit symbol data.

상기 도 70a와 같이, 2k 모드의 경우 하나의 심볼 구간은 1705(0 ~ 1704)개의 서브 캐리어 정보를 포함한다. 파일럿 심볼 구간에는 상기 캐리어 가운데 짝수 캐리어(k=0, 2, 4, …, 1704)의 위치에만 파일럿 정보가 포함된다. 데이터 심볼 구 간에는 심볼 데이터와 함께 CP 파일럿 정보가 포함된다. 각 데이터 심볼 구간에는 68개의 서브 캐리어에 CP 파일럿 정보가 삽입된다. 상기 도 70a은 짝수 캐리어 위치에 68개의 CP 파일럿 정보가 삽입된 예이다. 예를 들어, 0번째, 24번째, …, 1682번째, 1704번째 서브 캐리어에 CP 파일럿 정보가 삽입된다. 상기 CP 파일럿의 위치는 일 실시예이다. CP 파일럿의 위치는 모든 채널에서 평균 CP의 SNR이 유지되도록 불규칙적으로 배치하여 채널에 상관없이 채널 추적 성능을 확보할 수 있도록 한다. 상기 70a에서 짝수가 아닌 홀수 캐리어 위치에 CP 파일럿을 삽일할 수도 있고, 짝, 홀수를 가리지 않고 삽입할 수도 있다.As shown in FIG. 70A, in the 2k mode, one symbol period includes 1705 (0 to 1704) subcarrier information. In the pilot symbol period, pilot information is included only at positions of even carriers (k = 0, 2, 4, ..., 1704) among the carriers. The CP symbol information is included in the data symbol section together with the symbol data. CP pilot information is inserted into 68 subcarriers in each data symbol period. 70A shows an example of inserting 68 CP pilot information into an even carrier position. For example, the 0th, 24th,... CP pilot information is inserted into the 1682 th and 1704 th subcarriers. The location of the CP pilot is one embodiment. The position of the CP pilot is irregularly arranged to maintain the SNR of the average CP in all channels to ensure channel tracking performance regardless of the channel. In the 70a, a CP pilot may be inserted at an odd carrier position which is not even, or may be inserted evenly and evenly.

도 70b는 홀수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간과, 전송할 심볼 데이터와 함께 CP 파일럿 정보를 포함하는 데이터 심볼 구간으로 구성된 프레임을 나타낸 도면이다. 도 70b는 1688개의 데이터 전송 가능한 서브 캐리어 가운데 68개를 CP 파일럿 정보를 전송하는 데 사용하며, 나머지 1620개의 서브 캐리어를 심볼 데이터를 전송하는 데 사용하는 경우의 실시 예이다.70B illustrates a frame including a pilot symbol period including only odd pilot carrier information and a data symbol period including CP pilot information together with symbol data to be transmitted. FIG. 70B illustrates an embodiment in which 68 out of 1688 subcarriers capable of transmitting data are used to transmit CP pilot information and the remaining 1620 subcarriers are used to transmit symbol data.

파일럿 심볼 구간에는 상기 캐리어 가운데 홀수 캐리어(k=1, 3, 5, …, 1703)의 위치에만 파일럿 정보가 포함된다. 데이터 심볼 구간에는 심볼 데이터와 함께 CP 파일럿 정보가 포함된다. 각 데이터 심볼 구간에는 68개의 서브 캐리어에 CP 파일럿 정보가 삽입된다. 상기 도 70b는 홀수 캐리어 위치에 68개의 CP 파일럿 정보가 삽입된 예이다. 마찬가지로 상기 CP 파일럿의 위치는 일 실시예이며, 홀수가 아닌 짝수 캐리어 위치에 CP 파일럿을 삽입할 수도 있고, 짝, 홀수를 가리지 않고 삽입할 수도 있다.In the pilot symbol period, pilot information is included only in positions of odd carriers (k = 1, 3, 5, ..., 1703) among the carriers. The data symbol interval includes CP pilot information together with symbol data. CP pilot information is inserted into 68 subcarriers in each data symbol period. FIG. 70B shows an example of inserting 68 CP pilot information into an odd carrier position. Similarly, the position of the CP pilot is an embodiment, and the CP pilot may be inserted in an even carrier position instead of an odd number, or may be inserted evenly or evenly.

도 71 내지 도 73은 본 발명에 따른 일 실시예로서, 각 모드에 따른 CP 파일럿 정보의 삽입 위치를 나타내는 도면이다. 도 71은 2k 모드의 경우, 68개의 CP 파일럿 정보가 삽입되는 위치를 나타내며, 도 72는 4k 모드의 경우, 135개의 CP 파일럿 정보가 삽입되는 위치를 나타낸다. 또한, 도 73은 8k 모드의 경우, 269개의 CP 파일럿 정보가 삽입되는 위치를 나타낸다. 상기 도 72의 4k 모드와 도 73의 8k 모드의 위치는 상기 도 71의 2k 모드의 배치를 각각 2번, 4번 반복시킨 예이다. 다만, 4k 모드와 8k 모드의 경우, 상기 도 72, 도 73과 같이 2k 모드의 배치를 각각 2번, 4번 반복한 위치를 이용할 수도 있고, 다른 위치를 이용할 수도 있다.71 to 73 are diagrams illustrating insertion positions of CP pilot information according to respective modes according to an embodiment of the present invention. FIG. 71 illustrates a position where 68 CP pilot information is inserted in the 2k mode, and FIG. 72 illustrates a position where 135 CP pilot information is inserted in the 4k mode. 73 shows a position where 269 CP pilot information are inserted in the 8k mode. The positions of the 4k mode of FIG. 72 and the 8k mode of FIG. 73 are examples of repeating the arrangement of the 2k mode of FIG. 71 twice and four times, respectively. However, in the case of the 4k mode and the 8k mode, as shown in FIG. 72 and FIG. 73, the position where the arrangement of the 2k mode is repeated twice and four times may be used, or other positions may be used.

상기 도 71 내지 도 73의 예에서는 짝수 캐리어 위치에 CP 파일럿 정보를 삽입하였으나, 홀수 캐리어 위치에 CP 파일럿 정보를 삽입할 수도 있고, 짝, 홀수를 가리지 않고 삽입할 수도 있다.In the example of FIGS. 71 to 73, CP pilot information is inserted at even carrier positions, but CP pilot information may be inserted at odd carrier positions, or may be inserted at even and odd positions.

도 74a와 도 74b는 본 발명에 따른 일 실시예로서, 동일한 CP 파일럿 위치를 갖는 프레임의 구조를 나타낸 도면이다. 상기 도 74a와 도 74b의 파일럿 심볼 구간(프리앰블)에는, 각각 짝수 캐리어 위치, 홀수 캐리어 위치에 파일럿정보가 삽입된다. 그리고 데이터 심볼 구간에는 동일한 캐리어 위치에 CP 파일럿 정보를 삽입(common CP)하여 데이터를 전송한다. 예를 들어, 상기 도 74a와 도 74b에는 0번째, 25번째, …, 1682번째, 1704번째 서브 캐리어 위치에 각각 CP 파일럿 정보가 삽입되어 있다. 다만, 상기 CP 파일럿의 위치는 일 실시예이며, 짝수 캐리어 위치 또는, 홀수 캐리어 위치에 삽입될 수도 있고, 또는 짝, 홀수 캐리어 위치를 구분하지 않고 삽입될 수도 있다.74A and 74B illustrate a structure of a frame having the same CP pilot position as an embodiment according to the present invention. In pilot symbol intervals (preambles) shown in FIGS. 74A and 74B, pilot information is inserted into even and odd carrier positions, respectively. In the data symbol period, CP pilot information is inserted in the same carrier position (common CP) to transmit data. For example, in FIGS. 74A and 74B, 0th, 25th,... CP pilot information is inserted into the 1682th and 1704th subcarrier positions, respectively. However, the position of the CP pilot is an embodiment, and may be inserted in the even carrier position, the odd carrier position, or may be inserted without distinguishing the even, odd carrier position.

상기 도 74a와 도 74b와 같은 구조를 갖는 프레임은, 상기 도 66에서 설명한 바와 같이, 단일 주파수 망에서 짝수 캐리어 지역(A)과 홀수 캐리어 지역(B)을 구분하여 신호를 송신하는 경우에 사용될 수 있다. 짝수 캐리어 지역(A)의 송신 신호에는 파일럿 심볼 구간에 짝수 파일럿 캐리어 정보가 포함되고, 홀수 캐리어 지역(B)의 송신 신호에는 파일럿 심볼 구간에 홀수 파일럿 캐리어 정보가 포함된다. 이때, 상기 각 지역의 송신 신호에 포함되어 있는 데이터 심볼 구간에는 CP 파일럿 정보가 삽입되며, 상기 CP 파일럿 정보는 동일한 위치에 삽입된다.74A and 74B, the frame having the structure as shown in FIG. 66 may be used when transmitting signals by dividing the even carrier region (A) and the odd carrier region (B) in a single frequency network. have. The transmission signal of the even carrier region A includes even pilot carrier information in the pilot symbol period, and the transmission signal of the odd carrier region B includes odd pilot carrier information in the pilot symbol period. In this case, CP pilot information is inserted in the data symbol period included in the transmission signal of each region, and the CP pilot information is inserted in the same position.

예를 들어, 상기 도 74a와 같이 파일럿 심볼 구간에 짝수 파일럿 캐리어 정보를 포함하는 프레임은 짝수 캐리어 지역(A)의 안테나를 통하여 송신될 수 있으며, 도 74b와 같이 파일럿 심볼 구간에 홀수 파일럿 캐리어 정보를 포함하는 프레임은 홀수 캐리어 지역(B)의 안테나를 통하여 송신될 수 있다. For example, a frame including even pilot carrier information in a pilot symbol period as shown in FIG. 74A may be transmitted through an antenna of an even carrier region (A), and odd pilot carrier information may be transmitted in a pilot symbol period as shown in FIG. 74B. The containing frame may be transmitted via an antenna of an odd carrier zone (B).

도 75는 본 발명에 따른 일 실시예로서, common CP 파일럿 정보의 삽입 위치를 나타내는 도면이다. 상기 도 75는 2k 모드의 경우, 68개의 CP 파일럿 정보가 삽입되는 위치를 나타낸다. 4k 모드와 8k 모드의 경우에는, 상기 도 75의 2k 모드의 배치를 각각 2번, 4번 반복한 위치를 이용할 수도 있고, 다른 위치를 이용할 수도 있다. 마찬가지로 상기 common CP 파일럿 정보는 짝수 캐리어 위치에 삽입할 수도 있고, 홀수 캐리어 위치에 삽입할 수도 있다. 또는, 짝, 홀수를 가리지 않고 삽입할 수도 있다.75 is a diagram illustrating an insertion position of common CP pilot information according to an embodiment of the present invention. 75 illustrates a position where 68 CP pilot information is inserted in the 2k mode. In the case of the 4k mode and the 8k mode, the position where the arrangement of the 2k mode of FIG. 75 is repeated two or four times may be used, or another position may be used. Similarly, the common CP pilot information may be inserted at even carrier positions or at odd carrier positions. Alternatively, even and odd numbers may be inserted.

상기 도 74a, 74b에서는 단일 주파수 망을 이용한 단일 입출력(SISO) 송수신의 경우를 예로 들었으나, 상기와 같은 프레임 구조를 다중 입출력(MIMO) 송수신에 적용하여 사용할 수도 있다.74A and 74B illustrate a case of transmitting / receiving a single input / output (SISO) using a single frequency network, but the above frame structure may be applied to multiple input / output (MIMO) transmission and reception.

도 76a 내지 도 76c는 본 발명에 따른 일실시예로서, 다중 입출력 전송 프레임의 구조를 나타낸 도면이다. 상기 도 76a 내지 도 76c는 각각 전송 경로에 따른 프리앰블의 파일럿과 CP 파일럿의 위치 등을 한 도면에 도시한 도면이다. 상기 도 76a 내지 도 76c의 예에서는 2개의 전송경로(ant 1, ant 2)를 이용하여 데이터를 송신한다. 그리고, 데이터 심볼 구간에 삽입된 CP 파일럿의 서브 캐리어 위치는 2개의 전송경로에 대해 모두 동일하다.76A to 76C illustrate a structure of a multi-input / output transmission frame according to an embodiment of the present invention. 76A to 76C are diagrams illustrating positions of a pilot and a CP pilot of a preamble along a transmission path, respectively. In the example of FIGS. 76A to 76C, data is transmitted using two transmission paths ant 1 and ant 2. Subcarrier positions of the CP pilot inserted in the data symbol interval are the same for both transmission paths.

상기 도 1에서 설명한 바와 같이 다중 입출력 방식의 경우, 수신단에서 각 전송경로를 구분하도록 하여야 한다. 상기 도 76a 내지 도 76c의 예에서는, 파일럿 심볼 구간(프리앰블)의 파일럿 삽입위치를 이용하여 전송 경로를 구분할 수 있다.As described above with reference to FIG. 1, in the multi-input / output method, the receiving end should distinguish each transmission path. In the example of FIGS. 76A to 76C, a transmission path may be distinguished by using a pilot insertion position of a pilot symbol period (preamble).

예를 들어, 제1 전송경로(ant 1)의 송신 신호에는 파일럿 심볼 구간에 짝수 파일럿 캐리어 정보를 포함하며, 제2 전송경로(ant 2)의 송신 신호에는 파일럿 심볼 구간에 홀수 파일럿 캐리어 정보를 포함한다. 수신단에서는 수신된 프레임의 파일럿 심볼 구간에 삽입된 파일럿의 위치를 이용하여 전송경로를 구분할 수 있다.For example, the transmission signal of the first transmission path ant 1 includes even pilot carrier information in a pilot symbol period, and the transmission signal of the second transmission path ant 2 includes odd pilot carrier information in a pilot symbol period. do. The receiver may distinguish the transmission path by using the position of the pilot inserted in the pilot symbol interval of the received frame.

상기 각 전송경로를 통해 송신되는 신호의 데이터 심볼 구간에는 CP 파일럿 정보가 삽입된다. 상기 CP 파일럿 정보는 각 전송경로마다 동일한 위치에 삽입할 수도 있고, 다른 위치에 삽입할 수도 있다.CP pilot information is inserted into a data symbol section of a signal transmitted through each transmission path. The CP pilot information may be inserted in the same position for each transmission path or in another position.

상기 도 76a 내지 도 76c는 각 전송경로마다 동일한 위치에 CP 파일럿 정보를 삽입한 예이다. 도 76a는 짝수 캐리어 위치에 CP 파일럿 정보를 삽입한 예이며, 도 76b는 홀수 캐리어 위치에 CP 파일럿 정보를 삽입한 예이다. 그리고, 도 76c는 짝, 홀수 캐리어 위치를 가리지 않고 CP 파일럿 정보를 삽입한 예이다.76A to 76C illustrate an example of inserting CP pilot information in the same position for each transmission path. 76A illustrates an example of inserting CP pilot information into even carrier positions, and FIG. 76B illustrates an example of inserting CP pilot information into odd carrier positions. 76C shows an example of inserting CP pilot information regardless of even and odd carrier positions.

상기 도 76a 내지 도 76c의 CP 파일럿 정보의 위치는 일 실시예이며, 구현 예에 따라 다른 위치를 이용할 수 있다.The location of the CP pilot information of FIGS. 76A through 76C is one embodiment, and another location may be used according to an implementation example.

상기에서 설명한 파일럿 심볼 구간과 CP 파일럿 정보를 포함하는 프레임 구조에서, 파일럿 심볼 구간의 파일럿과 데이터 심볼 구간의 CP 파일럿 정보를 스크램블(scramble)하여 사용할 수 있다. 상기 파일럿 정보의 스크램블을 이용하여 송신 신호의 DC 성분을 제거하고, 수신단에서 프리앰블의 검출과 주파수 오프셋 보정을 용이하게 할 수 있도록 한다.In the frame structure including the pilot symbol period and the CP pilot information described above, the pilot and the CP pilot information of the data symbol period may be scrambled. The scrambling of the pilot information is used to remove the DC component of the transmission signal and to facilitate detection of the preamble and correction of the frequency offset at the receiving end.

예를 들어, 상기 파일럿 정보의 스크램블을 위해 슈도 랜덤 이진열(Pseudo Random Binary Sequence : 이하 PRBS)을 이용할 수 있다. 이때, 상기 파일럿 심볼 구간의 파일럿과 데이터 심볼 구간의 CP 파일럿 정보에 대해 같은 PRBS를 사용할 수도 있고, 다른 PRBS를 사용하여 스크램블할 수도 있다. For example, Pseudo Random Binary Sequence (PRBS) may be used to scramble the pilot information. In this case, the same PRBS may be used for the pilot of the pilot symbol period and the CP pilot information of the data symbol period, or scrambled using different PRBSs.

이하 수학식 5는 상기 스크램블을 위한 일 실시예이다. 수학식 5와 같은 수학식을 이용하여 파일럿 심볼 구간의 파일럿과 데이터 심볼 구간의 CP 파일럿 정보를 스크램블 할 수 있다. 또는, CP 파일럿 정보를 수학식 5를 이용하여 스크램블하고, 파일럿 심볼 구간의 파일럿은 수학식을 이용하여 스크램블하거나 스크램블을 안 할 수도 있다. 상기 예로 든 수학식을 이용하여 스크램블할 파일럿을 정하는 것은 구현 예에 따라 달라질 수 있다.Equation 5 below is an embodiment for the scramble. The pilot of the pilot symbol interval and the CP pilot information of the data symbol interval may be scrambled using the equation (5). Alternatively, the CP pilot information may be scrambled using Equation 5, and the pilot of the pilot symbol interval may be scrambled or not scrambled using the equation. Determining a pilot to scramble using the above-described equation may vary according to implementation.

Figure 112008039495204-PAT00011
Figure 112008039495204-PAT00011

Figure 112008039495204-PAT00012
Figure 112008039495204-PAT00012

상기 수학식 5에서 'Ck'는 'k'에 대응되는 위치에서의 파일럿 정보, 'Wk'는 스크램블을 위한 PRBS 값을 나타낸다. 그리고 'Re(Ck)'는 상기 'Ck' 값의 실수(real) 값을, 'Im(Ck)'는 'Ck' 값의 허수(imaginary) 값을 나타낸다. 상기 'bf'는 파워 부스팅 팩터(power boosting factor)이다. 상기 파워 부스팅 팩터의 수치는 일 실시예이며, 상기 수치를 조정하여 채널 추정 성능과 데이터의 SNR 향상 사이에 트레이드 오프를 얻을 수 있다.In Equation 5, 'C k ' represents pilot information at a position corresponding to 'k', and 'W k ' represents a PRBS value for scramble. 'Re (C k )' represents a real value of the 'C k ' value, and 'Im (C k )' represents an imaginary value of the 'C k ' value. 'Bf' is a power boosting factor. The numerical value of the power boosting factor is an embodiment, and the numerical value can be adjusted to obtain a tradeoff between channel estimation performance and SNR improvement of data.

상기 수학식 5를 이용하여 상기에서 설명한 각 프레임 구조의 CP 파일럿 정보를 스크램블하는 경우, CP 파일럿만을 사용하므로 DVB-T에 비해 부스팅으로 인한 데이터의 파워 감소가 적고, DVB-T보다 더 많은 CP 파일럿을 사용하므로 더 나은 채널 추적 성능을 얻을 수 있다.When scrambling CP pilot information of each frame structure described above using Equation 5, since only the CP pilot is used, the power reduction of data due to boosting is smaller than that of DVB-T, and more CP pilots than DVB-T are. Better channel tracking performance.

도 77은 본 발명에 따른 일 실시예로서, 슈도 랜덤 이진열(PRBS) 발생기를 나타낸 도면이다. 상기 발생기를 이용하여 상기 수학식 5의 PRBS 값(Wk)을 얻을 수 있다.FIG. 77 is a diagram illustrating a pseudo random binary generator (PRBS) generator according to an embodiment of the present invention. The PRBS value W k of Equation 5 may be obtained using the generator.

상기 PRBS 발생기는 비트 지연부(7700)와 연산부(7710)를 포함한다. 상기 도 77의 실시예에서는 11개의 1비트 지연부와 XOR 게이트를 포함한다. 상기 비트 지연부의 수와 게이트의 종류는 일 실시예이며, 구현 예에 따라 상기 지연부의 수나 게이트의 종류, 위치는 달라질 수 있다.The PRBS generator includes a bit delay unit 7700 and an operation unit 7710. The embodiment of FIG. 77 includes eleven one-bit delay units and an XOR gate. The number of bit delay units and the types of gates are exemplary embodiments, and the number of gate delay units, types, and positions of the delay units may vary according to implementation.

상기 도 77의 PRBS 발생기의 각 비트 지연부에는 초기값으로 1이 입력되어 있으며, XOR 게이트(7710)는 9번째 비트 지연부의 출력과 11번째 비트 지연부의 출력을 입력으로 하여 XOR 연산을 수행한다. 상기 XOR 게이트(7710)에서 연산된 출력은 1번째 비트 지연부로 입력되며, 11번째 비트 지연부의 출력 값은 상기 수학식 5의 PRBS 값(Wk)으로 사용될 수 있다. 상기 도 77의 PRBS 발생기의 경우, 11개의 초기값이 모두 출력된 후에 XOR 게이트(7710)에서 연산된 값이 출력된다.Each bit delay unit of the PRBS generator of FIG. 77 is input with an initial value of 1, and the XOR gate 7710 performs an XOR operation by inputting an output of a 9th bit delay unit and an output of an 11th bit delay unit. The output calculated by the XOR gate 7710 may be input to the 1st bit delay unit, and the output value of the 11th bit delay unit may be used as the PRBS value W k of Equation 5 above. In the case of the PRBS generator of FIG. 77, after all 11 initial values are output, a value calculated by the XOR gate 7710 is output.

상기와 같이 PRBS 발생기에서는 1 또는 0 값이 출력될 수 있으며, 상기 1 또는 0 값을 수학식 5에 대입하면, 파일럿의 실수 값(Re(Ck))으로

Figure 112008039495204-PAT00013
또는
Figure 112008039495204-PAT00014
를 얻을 수 있다.As described above, the PRBS generator may output a value of 1 or 0. Substituting the value of 1 or 0 into Equation 5 results in a pilot real value Re (C k ).
Figure 112008039495204-PAT00013
or
Figure 112008039495204-PAT00014
Can be obtained.

도 78은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도이다. 상기 도 78은 상기에서 설명한 각 실시예의 신호 송신 장치 가운데, 다중 인코딩, 다중 맵핑 방식과 상기 실시 예에서 설명한 CP 파일럿 정보를 포함하는 프레임 구조를 이용하여 신호를 송신하는 장치를 나타낸다.78 is a block diagram schematically showing another example of a signal transmission apparatus according to an embodiment of the present invention. FIG. 78 is a view illustrating an apparatus for transmitting signals using a frame structure including multiple encoding and multiple mapping schemes and CP pilot information described in the embodiments, among the signal transmission apparatuses according to the above-described embodiments.

상기 도 78의 신호 송신 장치는 상기 도 68의 신호 송신 장치에서 설명한 바 와 같으며, 다만 전송 프레임의 데이터 심볼 구간에 상기에서 설명한 각 실시예에서와 같이 CP 파일럿 정보가 삽입되는 것이 다르다. 상기 도 78의 신호 송신 장치에서 아웃터 인코더와 인너 인코더 사이에 인터리빙 과정을 수행하거나, 선형 프리코딩 과정을 수행하지 않는 실시예 등과 같이 구현 예에 따라 필요한 구성요소가 더 추가되거나 필요하지 않은 구성요소가 사용되지 않을 수 있다. 이하 차이가 있는 부분을 중심으로 설명하기로 한다.The signal transmission apparatus of FIG. 78 is the same as that described with respect to the signal transmission apparatus of FIG. 68 except that CP pilot information is inserted in the data symbol interval of the transmission frame as in the above-described embodiments. In the signal transmission apparatus of FIG. 78, necessary components may be added or unnecessary according to an implementation example, such as an embodiment for performing an interleaving process between an outer encoder and an inner encoder, or not performing a linear precoding process. May not be used. Hereinafter, a description will be given of the differences.

제2인터리버(7850)에서 인터리빙된 심볼 데이터는 프레임 형성부(7860)로 입력된다. 상기 프레임 형성부(7860)는 출력된 신호를 OFDM 방식으로 변조할 수 있도록 파일럿 신호를 삽입하여 프레임을 형성한다. 이때, 상기 프레임 형성부(7860)는 상기 각 실시예에서 설명한 바와 같이 파일럿 심볼 구간과 데이터 심볼 구간을 포함하는 프레임을 형성한다. 상기 데이터 심볼 구간에는 상기에서 설명한 바와 같은 CP 파일럿 정보를 삽입한다. 상기 프레임 형성부(7860)에서 형성된 전송 프레임은 변조부(7870)를 거쳐 OFDM 변조되어 전송된다.The symbol data interleaved by the second interleaver 7850 is input to the frame forming unit 7860. The frame forming unit 7860 forms a frame by inserting a pilot signal to modulate the output signal by the OFDM method. In this case, the frame forming unit 7860 forms a frame including a pilot symbol period and a data symbol period as described in the above embodiments. CP pilot information as described above is inserted into the data symbol period. The transmission frame formed by the frame forming unit 7860 is OFDM modulated and transmitted through the modulator 7780.

도 79는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도이다. 상기 도 79의 수신장치는 상기 도 78의 송신 장치에 대응된다. 상기 도 79의 신호 수신 장치는 구현 예에 따라 필요한 구성요소가 더 추가되거나 필요하지 않은 구성요소가 사용되지 않을 수 있다.79 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention. The receiver of FIG. 79 corresponds to the transmitter of FIG. 78. In the signal receiving apparatus of FIG. 79, a necessary component may be further added or an unnecessary component may not be used according to an embodiment.

마찬가지로 상기 도 79의 신호 수신 장치의 각 구성 요소는 상기 각 실시예에서 설명한 바와 같으며, 이하 차이가 있는 부분을 중심으로 설명하기로 한다.Similarly, each component of the signal receiving apparatus of FIG. 79 is the same as described in each of the above embodiments, and will be described below with reference to differences.

상기 제1동기부(7910)는 주파수 영역 신호의 동기 획득을 위해 복조부(7920) 와 제2동기부(7930)에서 출력하는 데이터의 주파수 영역의 오프셋(offset) 결과를 이용할 수 있다. 제2동기부(7930)는 복조부(7920)에서 출력된 프레임을 파싱하여 CP 파일럿 정보를 추출하고 채널을 추적(tracking)한다. 즉, 상기 제2동기부(7930)는 프레임의 각 데이터 심볼 구간에 포함된 CP 파일럿 정보를 이용하여 수신신호의 주파수 오프셋 보정 정보를 제1동기부(7910)로 출력한다. 상기 제1동기부(7910)에서는 상기 제2동기부(7930)에서 출력된 주파수 오프셋 보정 정보를 이용하여 더 정확하게 동기를 맞출 수 있다.The first synchronizer 7910 may use an offset result of the frequency domain of data output from the demodulator 7920 and the second synchronizer 7730 to obtain synchronization of a frequency domain signal. The second synchronizer 7930 parses the frame output from the demodulator 7920 to extract CP pilot information and track the channel. That is, the second synchronizer 7930 outputs frequency offset correction information of the received signal to the first synchronizer 7910 using CP pilot information included in each data symbol section of the frame. The first synchronization unit 7910 may synchronize more precisely by using the frequency offset correction information output from the second synchronization unit 7930.

복조부(7920)에서 복조된 데이터는 프레임 파싱부(7940)로 출력된다. 상기 프레임 파싱부(7940)는 상기 복조부(7920)에서 입력된 프레임을 파싱하여, 파일럿 심볼을 제외한 데이터 심볼 구간의 심볼 데이터를 출력할 수 있다. 이때, 상기 프레임 파싱부(7940)는 캐리어의 파워를 검출하는 방식만으로 파일럿 심볼 구간(또는 프리앰블)의 동기를 맞출 수 있다.Data demodulated by the demodulator 7920 is output to the frame parser 7940. The frame parser 7940 may parse a frame input from the demodulator 7920 and output symbol data of a data symbol period excluding a pilot symbol. In this case, the frame parser 7940 may synchronize the pilot symbol period (or preamble) only by detecting the power of the carrier.

만약, 상기 송신 장치에서 PRBS를 이용하여 CP 파일럿 또는 파일럿 심볼 구간의 파일럿 정보를 스크램블한 경우, 상기 제2동기부(7930) 또는 프레임 파싱부(7940)에서는 이를 디스크램블(descramble)하여야 한다.If the transmitter scrambles pilot information of a CP pilot or a pilot symbol interval using PRBS, the second synchronizer 7730 or the frame parser 7940 must descramble it.

도 80은 본 발명에 따른 일 실시예로서, 디스크램블 장치를 나타낸 도면이다. 상기 디스크램블 장치는 PRBS 생성부(8000), 선택 출력부(8010), 및 연산부(8020)를 포함한다.80 is a diagram illustrating a descramble device according to one embodiment according to the present invention. The descrambler includes a PRBS generator 8000, a selection output unit 8010, and an operation unit 8020.

PRBS 생성부(8000)는 상기 도 77에서 설명한 PRBS 발생기와 같은 이진열(binary sequence)를 생성하여 출력한다. 상기 PRBS 생성부(8000)에서는 0 또는 1이 출력되며, 상기 출력은 선택 출력부(8010)에 입력된다.The PRBS generator 8000 generates and outputs a binary sequence such as the PRBS generator described with reference to FIG. 77. The PRBS generation unit 8000 outputs 0 or 1, and the output is input to the selection output unit 8010.

상기 선택 출력부(8010)는 0(false) 또는 1(true) 값을 제어 값으로 하여, 두 개의 입력(1 또는 -1) 가운데 하나를 선택적으로 출력한다. 예를 들어, 상기 도 80에서 PRBS 생성부(8000)로부터 0이 입력되면 선택 출력부(8010)는 1을 출력하고, PRBS 생성부(8000)로부터 1이 입력되면 선택 출력부(8010)는 -1을 출력한다. 상기 선택 출력부(8010)에서 출력된 값은 연산부(8020)로 입력된다.The selection output unit 8010 selectively outputs one of two inputs (1 or -1) using a value of 0 (false) or 1 (true) as a control value. For example, when 0 is input from the PRBS generator 8000 in FIG. 80, the selection output unit 8010 outputs 1, and when 1 is input from the PRBS generator 8000, the selection output unit 8010 is-. Outputs 1 The value output from the selection output unit 8010 is input to the operation unit 8020.

연산부(8020)는 채널을 거쳐 수신된 파일럿과 상기 선택 출력부(8010)에서 출력된 값을 곱셈 연산하여 출력한다. 만약 수학식 5와 같은 형식에 따라 파일럿을 스크램블하여 송신한 경우, 상기 채널을 거친 파일럿은

Figure 112008039495204-PAT00015
값을 갖는다. 즉, 상기 채널을 거친 파일럿은 스크램블된 파일럿(
Figure 112008039495204-PAT00016
)에 채널 전달함수(CTF : Channel Transfer Function)를 컨벌루션(convolution)한 값이 된다.The calculation unit 8020 multiplies and outputs the pilot received through the channel and the value output from the selection output unit 8010. If the pilot is scrambled and transmitted according to the equation (5), the pilot passing through the channel
Figure 112008039495204-PAT00015
Has a value. That is, the pilot that passed through the channel is a scrambled pilot (
Figure 112008039495204-PAT00016
) Is the value of convolution of the channel transfer function (CTF).

상기 수학식 5에서 설명한 바와 같이 스크램블된 파일럿은 Wk가 0인 경우 bf×1 값을 가지며, Wk가 1인 경우 bf×-1 값을 가진다. 그리고, 상기 도 80의 선택 출력부(8010) 는 0이 입력되면 1을 출력하고, 1이 입력되면 -1을 출력한다.As described in Equation 5, the scrambled pilot has a bf × 1 value when W k is 0 and a bf × -1 value when W k is 1. The select output unit 8010 of FIG. 80 outputs 1 when 0 is input and -1 when 1 is input.

따라서, 연산부(8020)에서는 송신 장치에서 PRBS에 따라 스크램블한 파일럿을 디스크램블하여 출력할 수 있다. 상기 도 80에서 상기 디스크램블된 값은

Figure 112008039495204-PAT00017
이 된다.Accordingly, the operation unit 8020 may descramble and output the pilot scrambled according to the PRBS by the transmitter. 80, the descrambled value is
Figure 112008039495204-PAT00017
Becomes

상기 프레임 파싱부(7940)에서 파싱된 심볼 데이터는 제1디인터리버(7960)로 출력된다. 제1디인터리버(7960)는 상기 도 78의 제2인터리버(7850)에서 인터리빙한 방식에 대응되는 방식으로 디인터리빙하여 심볼 데이터의 순서를 복원한다.The symbol data parsed by the frame parser 7940 is output to the first deinterleaver 7960. The first deinterleaver 7960 deinterleaves the interleaved symbol data in a manner corresponding to the interleaving method of the second interleaver 7850 of FIG. 78 to restore the order of symbol data.

상기 프레임 파싱부(7940)에서 파싱된 파일럿 데이터는 채널 추정부(7950)로 출력된다. 상기 채널 추정부(7950)는 상기 프레임 파싱부(7940)에서 출력된 파일럿과 기지(known) 파일럿 정보를 이용하여 채널을 추정하며, 상기 추정된 결과 값을 등화부(7970)로 출력한다. 등화부(7970)는 상기 채널 추정 값을 이용하여 제1디인터리버(7960)에서 순서가 복원된 심볼 데이터를 등화한다.The pilot data parsed by the frame parser 7940 is output to the channel estimator 7950. The channel estimator 7950 estimates a channel by using the pilot and known pilot information output from the frame parser 7940 and outputs the estimated result to the equalizer 7970. The equalizer 7970 equalizes the symbol data whose order is restored in the first deinterleaver 7960 by using the channel estimate value.

도 81은 본 발명에 따른 일 실시예로서, 심볼 당 TPS 전송 비트의 수를 비교한 도면이다. 수신단에서는 한 주기의 TPS 정보를 모두 받아야 TPS 정보를 디코딩할 수 있으며, 상기 TPS의 경우 하나의 심볼에 하나의 TPS 비트가 포함되어 전송된다. 이러한 경우, TPS 동기를 위해 TPS 비트 수만큼의 심볼 시간이 걸린다. FIG. 81 is a diagram of comparing TPS transmission bits per symbol according to an embodiment of the present invention. FIG. The receiving end can decode the TPS information only after receiving all the TPS information in one cycle. In the case of the TPS, one TPS bit is included in one symbol and transmitted. In this case, it takes symbol time as many as TPS bits for TPS synchronization.

따라서, 상기 데이터 심볼 구간에 TPS 정보를 더 포함하여 전송함으로써, TPS 동기를 위한 시간을 줄일 수 있다. 예를 들어, 상기 CP 파일럿 삽입 위치 가운데 일부를 TPS를 전송하는 데 사용하여 TPS 동기를 위한 시간을 줄일 수 있다. 즉, 기존의 TPS 정보 전송을 위한 서브 캐리어 이외에, 상기 데이터 심볼 구간의 CP 파일럿 정보 삽입 위치에 상기 파일럿 정보 대신에 적어도 하나 이상의 TPS 정보를 더 포함하여 전송할 수 있다. 또한, 데이터 심볼 구간에 하나의 CP 파일럿 정보 삽 입 위치에만 TPS 비트를 포함하여 전송할 수도 있고, 하나의 데이터 심볼 구간의 다수의 CP 파일럿 정보 삽입 위치에 상기 TPS 비트를 반복적으로 포함하여 전송할 수도 있다.Accordingly, by further including TPS information in the data symbol period, time for TPS synchronization can be reduced. For example, some of the CP pilot insertion positions may be used to transmit TPS to reduce time for TPS synchronization. That is, in addition to the subcarrier for transmitting the existing TPS information, at least one piece of TPS information may be further included in place of the pilot information at the CP pilot information insertion position of the data symbol period. In addition, the TPS bit may be transmitted only in one CP pilot information insertion position in a data symbol period, or the TPS bit may be repeatedly transmitted in multiple CP pilot information insertion positions in one data symbol interval.

예를 들어, 상기 하나의 데이터 심볼 구간에 하나의 TPS 비트가 17번 반복적으로 포함되어 전송되는 경우를 가정한다. 이러한 경우, 2k 모드에서는 68개의 파일럿 캐리어 위치 가운데 17개의 서브 캐리어에 TPS 비트를 포함하여 전송하고, 남은 51개의 서브 캐리어에 CP 파일럿 정보를 포함하여 전송할 수 있다. 그리고, 4k 모드와 8k 모드에서는 각각 101개, 201개의 서브 캐리어에 CP 파일럿 정보를 포함하여 전송할 수 있다.For example, it is assumed that one TPS bit is repeatedly transmitted 17 times in one data symbol period. In this case, in the 2k mode, the TPS bit may be transmitted in 17 subcarriers among the 68 pilot carrier positions and the CP pilot information may be transmitted in the remaining 51 subcarriers. In the 4k mode and the 8k mode, CP pilot information may be included in 101 and 201 subcarriers, respectively.

상기 도 81은 상기 도 63에서 제안된 TPS를 기준으로, 하나의 심볼에 1비트의 TPS 비트를 전송할 때와 2비트의 TPS 비트를 전송할 때 걸리는 TPS 동기 대기 시간(latency)을 나타낸 도면이다. 상기 도면에서 시간(time)은 하나의 심볼 길이를 1120usec(DVB-T, 8k-mode)로 가정했을 때의 예상 대기 시간을 나타내며, 이는 total symbol에 상기 심볼 길이를 곱한 값이다. FIG. 81 is a diagram illustrating TPS synchronization latency when transmitting 1-bit TPS bits and transmitting 2-bit TPS bits in one symbol based on the TPS proposed in FIG. In the figure, time represents an expected waiting time when one symbol length is assumed to be 1120usec (DVB-T, 8k-mode), which is a value obtained by multiplying the symbol length by a total symbol.

하나의 심볼에 1비트의 TPS 비트를 전송하는 경우, TPS 동기를 위해 72개의 심볼이 수신되어야 하며, 8k-mode의 경우 도 51에서와 같이 LDPC 동기를 위해 최대 19개의 심볼이 수신되어야 한다. total symbol은 하나의 심볼을 놓친 경우, 다음 동기를 위해 걸리는 최대 심볼 시간을 말한다. 예를 들어, 첫 심볼을 놓친 경우에 다음 동기를 위해 최대 심볼 시간이 걸린다. 하나의 심볼에 1비트의 TPS 비트를 전송하는 경우, 최대 심볼 시간은 72(TPS 동기)×2 + 19(LDPC 동기) - 1 = 162이 되 며, 하나의 심볼에 2비트의 TPS 비트를 전송하는 경우, 최대 심볼 시간은 36(TPS 동기)×2 + 19(LDPC 동기) - 1 = 90이 된다. 상기에서 든 예와 같이 대기 시간(latency)이나 데이터 측면에서 효율적으로 데이터를 전송할 수 있다. When transmitting one bit of TPS bit in one symbol, 72 symbols should be received for TPS synchronization, and in case of 8k-mode, up to 19 symbols should be received for LDPC synchronization as shown in FIG. 51. The total symbol is the maximum symbol time taken for the next sync if one symbol is missed. For example, if the first symbol is missed, the maximum symbol time is taken for the next synchronization. When transmitting one bit of TPS bits in one symbol, the maximum symbol time is 72 (TPS sync) x 2 + 19 (LDPC sync)-1 = 162, and two bits of TPS bits are transmitted in one symbol. In this case, the maximum symbol time is 36 (TPS sync) x 2 + 19 (LDPC sync)-1 = 90. As described above, data can be efficiently transmitted in terms of latency or data.

도 82a는 본 발명에 따른 일 실시예로서, 신호 송신 과정을 나타낸 순서도이다.82A is a flowchart illustrating a signal transmission process according to an embodiment of the present invention.

신호 송신 장치에서는 전송 데이터의 오류를 발견하고 정정할 수 있도록 순방향 오류정정 인코딩된 데이터를 심볼 데이터로 맵핑한다(S8200). 예를 들어, 상기 순방향 오류정정 인코딩을 위해 LDPC 인코딩 Turbo 인코딩 등을 사용할 수 있으며, 또한 다중 인코딩 방식을 사용할 수도 있다. 그리고 상기 맵핑 방식으로 QAM, QPSK, 옵티멀 성상 맵핑 방식 등을 사용할 수 있으며, 또한 다중 맵핑 방식을 사용할 수도 있다.The signal transmission apparatus maps forward error correction encoded data to symbol data so that an error of the transmission data can be detected and corrected (S8200). For example, LDPC encoding Turbo encoding may be used for the forward error correction encoding, and multiple encoding schemes may also be used. As the mapping method, a QAM, QPSK, an optical constellation mapping method, or the like may be used, and a multiple mapping method may also be used.

그리고 상기 심볼 맵핑된 데이터를 이용하여 전송 프레임을 형성한다(S8202). 예를 들어, 상기 전송 프레임은 파일럿 심볼 구간과 데이터 심볼 구간을 포함하며, 상기 데이터 심볼 구간에는 CP 파일럿 정보가 포함될 수 있다.In operation S8202, a transmission frame is formed using the symbol-mapped data. For example, the transmission frame may include a pilot symbol interval and a data symbol interval, and the data symbol interval may include CP pilot information.

신호 송신 장치는 상기 형성된 전송 프레임을 전송 방식에 따라 변조하여 전송한다(S8204). 만약, 신호 송신 장치가 상기 짝수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간과 홀수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간을 이용하여 데이터를 전송하는 경우, 도 66과 같이 짝수 캐리어 지역과 홀수 캐리어 지역을 구분하여 데이터를 전송할 수 있다.The signal transmission apparatus modulates and transmits the formed transmission frame according to a transmission scheme (S8204). If the signal transmission apparatus transmits data using a pilot symbol section including only the even pilot carrier information and a pilot symbol section including only the odd pilot carrier information, the even and odd carrier regions are distinguished as shown in FIG. 66. Data can be transferred.

도 82b는 본 발명에 따른 일 실시예로서, 신호 수신 과정을 나타낸 순서도이 다. 82B is a flowchart illustrating a signal reception process according to an embodiment of the present invention.

신호 수신 장치에서는 송신 장치에서 송신한 신호를 수신하여 동기화하고, 프레임 데이터로 복조한다(S8210). 그리고 상기 복조된 프레임 데이터를 파싱하여, 상기 프레임에 포함된 파일럿과 심볼 데이터를 추출한다(S8212).The signal receiving apparatus receives and synchronizes a signal transmitted from the transmitting apparatus, and demodulates the frame data (S8210). The demodulated frame data is parsed to extract pilot and symbol data included in the frame (S8212).

상기와 같이 짝수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간과 홀수 파일럿 캐리어 정보만을 포함하는 파일럿 심볼 구간을 포함하는 프레임의 경우, 캐리어의 파워를 검출하는 방식으로 파일럿 심볼 구간의 동기를 맞춰 파일럿과 심볼 데이터를 추출할 수 있다.As described above, in the case of a frame including a pilot symbol section including only even pilot carrier information and a pilot symbol section including only odd pilot carrier information, the pilot and symbol data are synchronized by synchronizing the pilot symbol period by detecting the power of the carrier. Can be extracted.

데이터 심볼 구간에 CP 파일럿 정보가 포함되어 있는 경우, 상기 파일럿 정보를 추출하여 채널을 추적(tracking)하여 더 정확하게 주파수 오프셋을 보정할 수 있다.When the CP pilot information is included in the data symbol interval, the pilot information can be extracted to track the channel to more accurately correct the frequency offset.

수신 장치에서는 상기 파일럿 심볼 구간에서 추출된 파일럿 정보를 이용하여 전송 채널을 추정하고, 상기 추정된 채널을 이용하여 상기 추출된 심볼 데이터를 등화한다(S8114). 그리고 상기 등화된 심볼 데이터를 디맵핑(de-mapping)하여 대응되는 비트 데이터로 복원하고, 상기 비트 데이터를 순방향 오류정정 디코딩하여 에러를 정정한다(S8116). 상기 디맵핑 방식과 오류정정 디코딩 방식은 송신단에서 맵핑한 방식과 오류정정 인코딩한 방식에 대응되는 방식을 이용할 수 있다.The receiving apparatus estimates a transmission channel using the pilot information extracted in the pilot symbol period, and equalizes the extracted symbol data using the estimated channel (S8114). The equalized symbol data is de-mapping to be restored to the corresponding bit data, and the error is corrected by performing forward error correction decoding on the bit data (S8116). The demapping method and the error correction decoding method may use a method corresponding to the method mapped by the transmitter and the error correction encoded method.

상기 신호 송수신 방법 및 신호 송수신 장치는 상기 예에 한정되지 않으며, 방송이나 통신 등의 모든 신호 송수신 시스템에 적용될 수 있다.The signal transceiving method and the signal transceiving apparatus are not limited to the above examples, and may be applied to all signal transceiving systems such as broadcasting or communication.

본 발명은 상술한 실시예에 한정되지 않으며, 첨부된 청구범위에서 알 수 있 는 바와 같이 본 발명이 속한 분야의 통상의 지식을 가진 자에 의해 변형이 가능하고 이러한 변형은 본 발명의 범위에 속한다.The present invention is not limited to the above-described embodiments, and can be modified by those skilled in the art as can be seen from the appended claims, and such variations are within the scope of the present invention. .

도 1은 본 발명에 따른 일 실시예로서, 신호 송신 장치를 개략적으로 나타낸 블록도1 is a block diagram schematically showing an apparatus for transmitting a signal as an embodiment according to the present invention;

도 2는 본 발명에 따른 일 실시예로서, 인터리버와 순방향 오류 정정 인코더를 개략적으로 나타낸 블록도2 is a block diagram schematically illustrating an interleaver and a forward error correction encoder according to an embodiment of the present invention.

도 3은 본 발명에 따른 일 실시예로서, 입력 데이터를 인터리빙시키는 인터리버를 나타낸 도면3 illustrates an interleaver for interleaving input data according to an embodiment of the present invention.

도 4는 본 발명에 따른 일 실시예로서, 다른 인터리버의 일 예를 나타낸 도면4 is a diagram illustrating an example of another interleaver according to an embodiment of the present invention.

도 5는 본 발명에 따른 일 실시예로서, 도 4의 인터리버의 구체적인 예를 나타낸 도면5 is a diagram illustrating a specific example of the interleaver of FIG. 4 as an embodiment according to the present invention.

도 6은 본 발명에 따른 일 실시예로서, 다중 입출력 인코딩 방식의 일 예를 나타낸 도면6 is a diagram illustrating an example of a multiple input / output encoding scheme according to an embodiment of the present invention.

도 7은 본 발명에 따른 일 실시예로서, 전송 프레임의 구조를 나타낸 도면7 is a diagram illustrating a structure of a transmission frame according to an embodiment of the present invention.

도 8(a)는 본 발명에 따른 일 실시예로서, 파일럿 심볼구간의 구조를 나타낸 도면8 (a) is a diagram illustrating a structure of a pilot symbol interval according to an embodiment of the present invention.

도 8(b)는 본 발명에 따른 일 실시예로서, 파일럿 심볼구간의 다른 구조를 나타낸 도면8 (b) illustrates another structure of a pilot symbol period according to an embodiment of the present invention.

도 9는 본 발명에 따른 일 실시예로서, 신호 수신 장치를 개략적으로 나타낸 블록도9 is a block diagram schematically illustrating an apparatus for receiving a signal according to an embodiment of the present invention.

도 10은 본 발명에 따른 일 실시예로서, 다중 입출력 디코딩 방식의 일 예를 나타낸 도면10 is a diagram illustrating an example of a multiple input / output decoding scheme according to an embodiment of the present invention.

도 11은 본 발명에 따른 일 실시예로서, 도 10의 구체적인 예를 나타낸 도면11 is a diagram illustrating a specific example of FIG. 10 as an embodiment according to the present invention.

도 12는 본 발명에 따른 일 실시예로서, 디인터리버와 순방향 오류정정 디코더를 개략적으로 나타낸 블록도12 is a block diagram schematically illustrating a deinterleaver and a forward error correction decoder according to an embodiment of the present invention.

도 13은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도13 is a block diagram schematically showing another example of a signal transmission apparatus according to an embodiment of the present invention.

도 14는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도14 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention.

도 15는 본 발명에 따른 일 실시예로서, 옵티멀 성상(optimal constellation) 포인트의 위치를 개략적으로 나타낸 도면FIG. 15 is a view schematically showing the position of an optimal constellation point according to an embodiment of the present invention.

도 16은 본 발명에 따른 일 실시예로서, 옵티멀 성상의 포인트를 결정하는 순서를 나타낸 순서도16 is a flowchart illustrating a procedure of determining an optical constellation point according to an embodiment of the present invention.

도 17은 본 발명에 따른 일 실시예로서, 16포인트를 갖는 옵티멀 성상을 개략적으로 나타낸 도면17 is a diagram schematically showing an optical constellation having 16 points as an embodiment according to the present invention.

도 18은 본 발명에 따른 일 실시예로서, 64포인트를 갖는 옵티멀 성상을 개략적으로 나타낸 도면18 is a diagram schematically showing an optical constellation having 64 points as an embodiment according to the present invention.

도 19는 본 발명에 따른 일 실시예로서, 256포인트를 갖는 옵티멀 성상을 개략적으로 나타낸 도면19 is a view schematically showing an optical constellation having 256 points as an embodiment according to the present invention.

도 20은 본 발명에 따른 일 실시예로서, 256포인트를 갖는 다른 옵티멀 성상 을 개략적으로 나타낸 도면20 is a view schematically showing another optical constellation having 256 points as an embodiment according to the present invention.

도 21은 64포인트를 갖는 옵티멀 성상의 결정 경계(decision boundary)를 개략적으로 나타낸 블록도21 is a block diagram schematically illustrating a decision boundary of an optical constellation having 64 points;

도 22a는 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 심볼 디맵퍼를 개략적으로 나타낸 도면FIG. 22A schematically illustrates a symbol demapper for demapping a received optical constellation symbol according to an embodiment of the present invention. FIG.

도 22b는 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 다른 심볼 디맵퍼를 개략적으로 나타낸 도면FIG. 22B is a schematic representation of another symbol demapper for demapping received optical constellation symbols as an embodiment in accordance with the present invention. FIG.

도 23은 본 발명에 따른 일 실시예로서, 수신된 옵티멀 성상 심볼을 디맵핑하는 과정을 개략적으로 나타낸 도면FIG. 23 is a diagram schematically illustrating a process of demapping a received optical constellation symbol according to an embodiment of the present invention.

도 24는 본 발명에 따른 일 실시예로서, 경계(edge) 영역의 수신된 옵티멀 성상 심볼을 디맵핑하는 과정을 개략적으로 나타낸 도면24 is a diagram schematically illustrating a process of demapping a received optical constellation symbol in an edge region according to an embodiment of the present invention.

도 25는 본 발명에 따른 일 실시예로서, 신호 송신 장치를 개략적으로 나타낸 블록도25 is a block diagram schematically illustrating an apparatus for transmitting a signal according to an embodiment of the present invention.

도 26은 본 발명에 따른 일 실시예로서, 다중 맵퍼를 개략적으로 나타낸 블록도FIG. 26 is a block diagram schematically illustrating a multiple mapper according to an embodiment of the present invention. FIG.

도 27은 본 발명에 따른 일 실시예로서, 비트 스트림 분배 방식을 나타낸 도면27 illustrates a bit stream distribution scheme according to an embodiment of the present invention.

도 28은 본 발명에 따른 일 실시예로서, 신호 수신 장치를 개략적으로 나타낸 블록도28 is a block diagram schematically illustrating an apparatus for receiving a signal according to an embodiment of the present invention.

도 29는 본 발명에 따른 일 실시예로서, 다중 디맵퍼를 개략적으로 나타낸 블록도29 is a block diagram schematically illustrating a multiple demapper according to an embodiment of the present invention.

도 30은 본 발명에 따른 일 실시예로서, 다중 인코딩을 이용한 신호 송신 장치를 개략적으로 나타낸 블록도30 is a block diagram schematically illustrating an apparatus for transmitting a signal using multiple encodings according to an embodiment of the present invention.

도 31은 본 발명에 따른 일 실시예로서, 다중 인코더를 개략적으로 나타낸 블록도31 is a block diagram schematically showing multiple encoders according to an embodiment of the present invention.

도 32는 본 발명에 따른 일 실시예로서, 다중 인코딩된 신호를 수신하는 신호 수신 장치를 개략적으로 나타낸 블록도32 is a block diagram schematically illustrating a signal receiving apparatus for receiving a multi-encoded signal according to an embodiment of the present invention.

도 33은 본 발명에 따른 일 실시예로서, 다중 디코더를 개략적으로 나타낸 블록도33 is a block diagram schematically illustrating multiple decoders according to an embodiment of the present invention.

도 34는 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑을 이용한 신호 송신 장치를 개략적으로 나타낸 블록도34 is a block diagram schematically illustrating an apparatus for transmitting a signal using multiple encoding and multiple mapping according to an embodiment of the present invention.

도 35는 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑된 신호를 수신하는 신호 수신 장치를 개략적으로 나타낸 블록도35 is a block diagram schematically illustrating a signal receiving apparatus for receiving a multi-encoded and multi-mapped signal according to an embodiment of the present invention.

도 36은 본 발명에 따른 일 실시예로서, 다중 인코딩과 다중 맵핑된 신호를 수신하는 다른 신호 수신 장치를 개략적으로 나타낸 블록도36 is a block diagram schematically illustrating another signal receiving apparatus for receiving multiple encoding and multiple mapped signals according to an embodiment of the present invention.

도 37은 본 발명에 따른 일 실시예로서, 채널 추정부를 개략적으로 나타낸 블록도37 is a block diagram schematically illustrating a channel estimator in accordance with an embodiment of the present invention.

도 38은 본 발명에 따른 일 실시예로서, 등화부를 개략적으로 나타낸 블록도38 is a block diagram schematically illustrating an equalization unit according to an embodiment of the present invention.

도 39는 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 신호 송신 장치를 개략적으로 나타낸 블록도39 is a block diagram schematically illustrating an apparatus for transmitting a signal according to a data symbol channel estimation method according to an embodiment of the present invention.

도 40은 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 신호 수신 장치를 개략적으로 나타낸 블록도40 is a block diagram schematically illustrating an apparatus for receiving a signal according to a data symbol channel estimation method according to an embodiment of the present invention.

도 41은 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 다른 신호 송신 장치를 개략적으로 나타낸 블록도41 is a block diagram schematically illustrating another signal transmission apparatus of a data symbol channel estimation method according to an embodiment of the present invention.

도 42는 본 발명에 따른 일 실시예로서, 데이터 심볼 채널 추정 방식의 다른 신호 수신 장치를 개략적으로 나타낸 블록도42 is a block diagram schematically illustrating another signal receiving apparatus of a data symbol channel estimation method according to an embodiment of the present invention.

도 43은 본 발명에 따른 일 실시예로서, 전송 프레임의 구조를 나타낸 도면43 is a view illustrating a structure of a transmission frame according to an embodiment of the present invention.

도 44는 본 발명에 따른 일 실시예로서, 프레임에 따른 추적 파일럿(tracking pilot)의 수를 나타낸 도면44 is a diagram illustrating the number of tracking pilots according to a frame according to an embodiment of the present invention.

도 45는 본 발명에 따른 일 실시예로서, 추적 파일럿이 포함된 프레임을 나타낸 도면45 illustrates a frame including a tracking pilot according to an embodiment of the present invention.

도 46은 본 발명에 따른 일 실시예로서, 상기 도 45의 프레임에 따른 마진(margin)을 나타낸 도면46 is a view illustrating a margin according to the frame of FIG. 45 according to an embodiment of the present invention.

도 47은 본 발명에 따른 일 실시예로서, 추적 파일럿이 포함된 다른 프레임을 나타낸 도면47 illustrates another frame including a tracking pilot according to an embodiment of the present invention.

도 48은 본 발명에 따른 일 실시예로서, 상기 도 47의 프레임에 따른 마진을 나타낸 도면48 is a diagram illustrating a margin according to the frame of FIG. 47 according to an embodiment of the present invention.

도 49는 본 발명에 따른 일 실시예로서, LDPC(Low Density Parity Check) 블록에 포함되는 심볼의 개수를 나타낸 도면49 is a diagram illustrating the number of symbols included in a low density parity check (LDPC) block according to an embodiment of the present invention.

도 50은 본 발명에 따른 일 실시예로서, LDPC 프레임에 포함되는 LDPC 블록 의 개수를 나타낸 도면50 is a view illustrating the number of LDPC blocks included in an LDPC frame according to an embodiment of the present invention.

도 51은 본 발명에 따른 일 실시예로서, LDPC 프레임에 포함되는 OFDM 블록의 개수를 나타낸 도면51 is a diagram showing the number of OFDM blocks included in an LDPC frame according to an embodiment of the present invention.

도 52는 본 발명에 따른 일 실시예로서, 다른 모드의 LDPC 프레임에 포함되는 LDPC 블록의 개수를 나타낸 도면52 is a view illustrating the number of LDPC blocks included in an LDPC frame of another mode according to an embodiment of the present invention.

도 53은 본 발명에 따른 일 실시예로서, 다른 모드의 LDPC 프레임에 포함되는 OFDM 블록의 개수를 나타낸 도면53 is a view showing the number of OFDM blocks included in an LDPC frame in another mode according to an embodiment of the present invention.

도 54는 본 발명에 따른 일 실시예로서, LDPC 프레임 구조를 나타낸 도면54 illustrates an LDPC frame structure according to an embodiment of the present invention.

도 55는 본 발명에 따른 일 실시예로서, TPS의 구조를 나타낸 도면55 is a diagram showing the structure of a TPS as an embodiment according to the present invention;

도 56은 본 발명에 따른 일 실시예로서, 성상(constellation) 정보를 나타낸 도면56 illustrates constellation information according to an embodiment of the present invention.

도 57은 본 발명에 따른 일 실시예로서, LDPC 모드 정보를 나타낸 도면57 illustrates LDPC mode information according to an embodiment according to the present invention.

도 58은 본 발명에 따른 일 실시예로서, 도 58과 도 59의 정보를 포함하는 TPS의 구조를 나타낸 도면58 is a diagram illustrating a structure of a TPS including information of FIGS. 58 and 59 according to an embodiment of the present invention.

도 59는 본 발명에 따른 일 실시예로서, OFDM 블록 인덱스 정보를 나타낸 도면59 is a diagram illustrating OFDM block index information according to an embodiment of the present invention.

도 60은 본 발명에 따른 일 실시예로서, OFDM 블록 인덱스 정보를 포함하는 TPS 구조를 나타낸 도면60 is a diagram illustrating a TPS structure including OFDM block index information according to an embodiment of the present invention.

도 61은 본 발명에 따른 일 실시예로서, LDPC 블록 정보를 나타낸 도면61 is a diagram illustrating LDPC block information according to an embodiment of the present invention.

도 62는 본 발명에 따른 일 실시예로서, OFDM 블록 정보를 나타낸 도면62 illustrates OFDM block information according to an embodiment of the present invention.

도 63은 본 발명에 따른 일 실시예로서, 제안된 정보를 포함하는 TPS의 구조를 나타낸 도면63 is a diagram showing the structure of a TPS including proposed information according to an embodiment of the present invention.

도 64는 본 발명에 따른 일 실시예로서, 프리앰블(preamble) 주기 정보를 나타낸 도면64 is a diagram illustrating preamble period information according to an embodiment of the present invention.

도 65는 본 발명에 따른 일 실시예로서, 프리앰블 주기 정보를 포함하는 TPS 구조를 나타낸 도면65 is a diagram illustrating a TPS structure including preamble period information according to an embodiment of the present invention.

도 66은 본 발명에 따른 일 실시예로서, 파일럿 심볼 구간과 단일 주파수 망의 관계를 나타낸 도면66 is a diagram illustrating a relationship between a pilot symbol interval and a single frequency network according to an embodiment of the present invention.

도 67은 본 발명에 따른 일 실시예로서, 파일럿 심볼의 구조를 나타낸 도면67 is a view showing a structure of a pilot symbol according to an embodiment of the present invention.

도 68은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도68 is a block diagram schematically showing another example of a signal transmission apparatus according to an embodiment of the present invention.

도 69는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도69 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention.

도 70a와 70b는 본 발명에 따른 일 실시예로서, 제안된 프레임 구조를 나타낸 도면70A and 70B illustrate a proposed frame structure as an embodiment according to the present invention.

도 71 내지 도 73은 본 발명에 따른 일 실시예로서, 각 모드에 따른 CP 파일럿의 삽입 위치를 나타내는 도면71 to 73 illustrate an insertion position of a CP pilot according to each mode according to an embodiment of the present invention.

도 74a와 도 74b는 본 발명에 따른 일 실시예로서, 동일한 CP 파일럿 위치를 갖는 프레임의 구조를 나타낸 도면74A and 74B illustrate a structure of a frame having the same CP pilot position as an embodiment according to the present invention.

도 75는 본 발명에 따른 일 실시예로서, common CP 파일럿의 삽입 위치를 나 타내는 도면75 is a view showing an insertion position of a common CP pilot according to an embodiment of the present invention.

도 76a 내지 도 76c는 본 발명에 따른 일실시예로서, 다중 입출력 전송 프레임의 구조를 나타낸 도면76A to 76C illustrate a structure of a multi-input / output transmission frame according to an embodiment of the present invention.

도 77은 본 발명에 따른 일 실시예로서, 슈도 랜덤 이진열(PRBS) 발생기를 나타낸 도면77 is a diagram illustrating a pseudo random binary (PRBS) generator according to an embodiment of the present invention.

도 78은 본 발명에 따른 일 실시예로서, 신호 송신 장치의 다른 예를 개략적으로 나타낸 블록도78 is a block diagram schematically showing another example of a signal transmission apparatus according to an embodiment of the present invention.

도 79는 본 발명에 따른 일 실시예로서, 신호 수신 장치의 다른 예를 개략적으로 나타낸 블록도79 is a block diagram schematically showing another example of a signal receiving apparatus according to an embodiment of the present invention.

도 80은 본 발명에 따른 일 실시예로서, 디스크램블 장치를 나타낸 도면80 illustrates a descramble device according to an embodiment of the present invention.

도 81은 본 발명에 따른 일 실시예로서, 심볼 당 TPS 전송 비트의 수를 비교한 도면81 is a diagram illustrating the comparison of the number of TPS transmission bits per symbol according to an embodiment of the present invention.

도 82a는 본 발명에 따른 일 실시예로서, 신호 송신 과정을 나타낸 순서도82A is a flowchart illustrating a signal transmission process according to an embodiment of the present invention.

도 82b는 본 발명에 따른 일 실시예로서, 신호 수신 과정을 나타낸 순서도82B is a flowchart illustrating a signal receiving process according to an embodiment of the present invention.

*도면의 주요 부분에 대한 부호의 설명* Explanation of symbols for the main parts of the drawings

7800 : 아웃터 인코더 7810 : 인너 인코더7800: Outer Encoder 7810: Inner Encoder

7820 : 제1인터리버 7830 : 다중 맵퍼7820: First Interleaver 7830: Multiple Mapper

7840 : 선형 프리코딩부 7850 : 제2인터리버7840: linear precoding unit 7850: second interleaver

7860 : 프레임 형성부 7870 : 변조부7860 frame forming unit 7870 modulator

7880 : 전송부7880: transmission unit

Claims (12)

데이터를 오류 정정 부호화하는 단계;Error correcting encoding data; 상기 오류 정정 부호화된 데이터를 데이터 심볼로 매핑하는 단계;Mapping the error correction coded data to a data symbol; 제 1 파일럿 심볼이 변조 프레임에 삽입되는 주기 정보를 생성하는 단계;Generating period information in which the first pilot symbol is inserted into a modulation frame; 홀수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 1 변조 프레임을 형성하고, 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 2 변조 프레임을 형성하는 단계;A pilot symbol period in which the first pilot symbol is located only on odd carriers and a data symbol period in which the mapped data symbols are located are formed periodically, and a pilot symbol in which the first pilot symbol is located only in even carriers. Forming a second modulation frame such that a section and a data symbol section in which the mapped data symbol is located are periodically repeated; 상기 형성된 제 1 및 제 2 변조 프레임을 직교 주파수 다중 분할 방식으로 각각 변조하는 단계; 및Modulating the formed first and second modulation frames in an orthogonal frequency multiplexing scheme, respectively; And 상기 변조한 신호를 각각 전송하는 단계를 포함하는 신호 송신 방법.And transmitting each of the modulated signals. 제 1항에 있어서,The method of claim 1, 상기 제 1 변조 프레임 및 상기 제 2 변조 프레임 중 적어도 어느 하나는, 시간에 따라 일정한 캐리어 위치에 제 2 파일럿 심볼을 포함하는 신호 송신 방법.At least one of the first modulation frame and the second modulation frame includes a second pilot symbol at a constant carrier position over time. 제 2항에 있어서,The method of claim 2, 상기 제 2 파일럿 심볼은 스크램블된 신호 송신 방법.And the second pilot symbol is scrambled. 홀수 캐리어에만 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 1 변조 프레임을 가진 신호를 복조하고, 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 2 변조 프레임을 가진 신호를 복조하는 단계;Demodulates a signal having a pilot symbol section in which a first pilot symbol is located only in odd carriers and a first modulation frame formed such that the data symbol section in which data symbols are located is periodically repeated, and a pilot symbol in which the first pilot symbol is located only in even carriers Demodulating a signal having a section and a second modulation frame formed such that the data symbol section in which the data symbol is located is periodically repeated; 상기 제 1 변조 프레임과 상기 제 2 변조 프레임을 각각 파싱하는 단계; Parsing the first modulated frame and the second modulated frame, respectively; 상기 제 1 변조 프레임과 상기 제 2 변조 프레임에 각각 포함된 데이터 심볼을 하나의 심볼열로 출력하는 단계;Outputting data symbols included in the first modulation frame and the second modulation frame as one symbol string; 상기 심볼 열을 디매핑하는 단계; 및Demapping the symbol string; And 상기 디매핑한 데이터를 오류 정정 복호하는 단계를 포함하는 신호 수신 방법.Error correcting decoding the de-mapped data. 제 4항에 있어서,The method of claim 4, wherein 상기 제 1 변조 프레임 및 상기 제 2 변조 프레임 중 적어도 어느 하나는, 시간에 따라 일정한 캐리어 위치에 제 2 파일럿 심볼을 포함하는 신호 수신 방법.At least one of the first modulated frame and the second modulated frame includes a second pilot symbol at a constant carrier position over time. 제 5항에 있어서,The method of claim 5, 상기 제 2 파일럿 심볼은 스크램블된 신호 송신 방법.And the second pilot symbol is scrambled. 데이터를 오류 정정 부호화하는 오류 정정 부호화부;An error correction encoding unit for error correcting encoding data; 상기 오류 정정 부호화된 데이터를 데이터 심볼로 매핑하는 심볼 매퍼;A symbol mapper for mapping the error correction coded data to a data symbol; 홀수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 1 변조 프레임을 형성하고, 상기 제 1 파일럿 심볼이 상기 제 1 변조 프레임에 삽입되는 주기 정보를 삽입하는 제 1 프레임 형성부;A first modulation frame is formed such that a pilot symbol section in which the first pilot symbol is located and only a data symbol section in which the mapped data symbol is located periodically repeats, and the first pilot symbol is in the first modulation frame. A first frame forming unit to insert period information to be inserted; 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 매핑된 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 제 2 변조 프레임을 형성하고, 상기 제 1 파일럿 심볼이 상기 제 2 변조 프레임에 삽입되는 주기 정보를 삽입하는 제 2 프레임 형성부;A second modulation frame is formed such that a pilot symbol period in which the first pilot symbol is located and a data symbol period in which the mapped data symbol is located are periodically repeated only in even carriers, and the first pilot symbol is in the second modulation frame. A second frame forming unit which inserts period information to be inserted; 상기 형성된 제 1 변조 프레임을 직교 주파수 다중 분할 방식으로 변조하는제 1 변조부;A first modulator for modulating the formed first modulated frame in an orthogonal frequency multiplexing scheme; 상기 형성된 제 2 변조 프레임을 직교 주파수 다중 분할 방식으로 변조하는제 2 변조부; A second modulator for modulating the formed second modulated frame in an orthogonal frequency multiplexing scheme; 상기 제 1 변조부가 출력한 신호를 전송하는 제 1 전송부; 및A first transmitter to transmit a signal output from the first modulator; And 상기 제 2 변조부가 출력한 신호를 전송하는 제 2 전송부를 포함하는 신호 송신 장치.And a second transmitter for transmitting the signal output by the second modulator. 제 7항에 있어서,The method of claim 7, wherein 상기 제 1 변조 프레임 및 상기 제 2 변조 프레임 중 적어도 어느 하나는, 시간에 따라 일정한 캐리어 위치에 제 2 파일럿 심볼을 포함하는 신호 송신 장치.At least one of the first modulated frame and the second modulated frame includes a second pilot symbol at a constant carrier position over time. 제 8항에 있어서,The method of claim 8, 상기 제 2 파일럿 심볼은, 스크램블된 신호 송신 장치.The second pilot symbol is scrambled signal transmission device. 홀수 캐리어에만 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 1 변조 프레임을 가진 신호를 복조하는 제 1 복조부;A first demodulation unit configured to demodulate a signal having a pilot symbol section in which a first pilot symbol is located only on an odd carrier and a first modulation frame configured to periodically repeat the data symbol section in which a data symbol is located; 짝수 캐리어에만 상기 제 1 파일럿 심볼이 위치한 파일럿 심볼 구간과, 상기 데이터 심볼이 위치한 데이터 심볼 구간이 주기적으로 반복되도록 형성된 제 2 변조 프레임을 가진 신호를 복조하는 제 2 복조부;A second demodulator for demodulating a signal having a pilot symbol section in which the first pilot symbol is located only on an even carrier and a second modulation frame formed such that the data symbol section in which the data symbol is located is periodically repeated; 상기 제 1 변조 프레임을 파싱하는 제 1 프레임 파싱부;A first frame parser that parses the first modulated frame; 상기 제 2 변조 프레임을 파싱하는 제 2 프레임 파싱부;A second frame parser that parses the second modulated frame; 상기 제 1 변조 프레임과 상기 제 2 변조 프레임에 각각 포함된 데이터 심볼을 하나의 심볼열로 출력하는 다중 입출력 디코더;A multiple input / output decoder configured to output data symbols included in each of the first modulation frame and the second modulation frame as one symbol string; 상기 심볼 열을 디매핑하는 심볼 디맵퍼; 및A symbol demapper for demapping the symbol strings; And 상기 디매핑한 데이터를 오류 정정 복호하는 오류 정정 복호부를 포함하는 신호 수신 장치.And an error correction decoding unit configured to error correct and decode the de-mapped data. 제 10항에 있어서,The method of claim 10, 상기 제 1 변조 프레임 및 상기 제 2 변조 프레임 중 적어도 어느 하나는, 시간에 따라 일정한 캐리어 위치에 제 2 파일럿 심볼을 포함하는 신호 수신 장치.At least one of the first modulated frame and the second modulated frame includes a second pilot symbol at a constant carrier position over time. 제 11항에 있어서,The method of claim 11, 상기 제 2 파일럿 심볼은 스크램블된 신호 수신 장치.And the second pilot symbol is scrambled.
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