KR20080038800A - 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어이중화 장치 및 방법 - Google Patents

이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어이중화 장치 및 방법 Download PDF

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KR20080038800A KR1020060106205A KR20060106205A KR20080038800A KR 20080038800 A KR20080038800 A KR 20080038800A KR 1020060106205 A KR1020060106205 A KR 1020060106205A KR 20060106205 A KR20060106205 A KR 20060106205A KR 20080038800 A KR20080038800 A KR 20080038800A
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Abstract

본 발명은 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어(MAC) 이중화 장치 및 방법에 관한 것으로, 네트워크 상태 정보를 획득하여 제 1 매체접근제어에서 제 2 매체접근제어로 전환할지를 결정하는 제어부와, 상기 제 1 매체접근제어에서 상기 제 2 매체접근제어로 전환해야 할 경우, 디버깅 모드에서 이더넷 데이터 전송모드로 스위칭하는 인터페이스 연결부를 포함하여, 기존 1개의 MAC 불량시 이중화 절체에 소요되는 기능 및 비용적인 손실을 줄일 수 있고. 두 개의 MAC에 대한 이더넷 스위치를 통한 링크 애그리케이션(Link Aggregation) 가능하다.
Figure P1020060106205
이중화, 이더넷 스위치, GMII 인터페이스, Copper 인터페이스, serdes 인터페이스, 이중화 성형 토폴로지(dual star topology).

Description

이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어 이중화 장치 및 방법{APPARATUS AND METHOD FOR DUAL MEDIA ACCESS CONTROL IN COMMUNICATION SYSTEM USING ETHERNET HUB BOARD}
도 1은 종래 기술에 따른 이중화 성형 토폴로지의 개념도,
도 2는 종래 기술에 따른 물리 슬롯(Physical Slot)과 논리 슬롯(Logical Slot)의 포지션(Position)을 나타낸 이중화 성형 시스템,
도 3은 종래 기술에 따른 허브 보드 내에서의 이중화 장치 구성도,
도 4는 본 발명의 실시 예에 따른 허브 보드 내에서의 이중화 장치 구성도,
도 5는 본 발명에 따른 이중화 초기 동작 흐름도 및,
도 6은 본 발명에 따른 이중화 스위칭 동작 흐름도.
본 발명은 기지국 시스템에서 이더넷 허브 보드를 이용한 MAC 이중화 장치 및 방법에 관한 것으로, 특히 상기 기지국 시스템에서 이더넷 허브 보드의 디버깅 용도로 사용하는 MAC을 이더넷 스위치와 스위칭하는 MAC 이중화 장치 및 방법에 관한 것이다.
AdvancedTCA(Advanced Telecom Computing Architecture)는 표준화된 모듈러 플랫폼을 기반으로 다양한 벤더의 제품을 함께 사용할 수 있게 하는 차세대 이동통신 장비를 위한 새로운 보드, 백플레인, 소프트웨어 규격을 말한다. 다양한 유무선의 통신 환경의 변화와 휴대인터넷의 등장으로 이에 대응하는 기술로써 출현한 AdvancedTCA Base는 통신 장비간의 상호 호환성, 시스템의 성능향상, 비용절감, 개발기간의 단축의 이점을 제공한다. 상기 AdvancedTCA Base의 응용분야는 소프트 스위치(Softswitch), 미디어 게이트웨이(Media Gateway), 신호 게이트웨이(Signaling Gateway), SGSN(Serving GPRS Service Node), GGSN(Gateway GPRS Service Node)등 다양하게 사용되고 있다.
상기 AdvancedTCA 기반의 시스템에서 허브 보드(Hub Board)는 셀프(Shelf)내의 이중 성형 토폴로지(Dual Star Topology)에 따른 보드 이중화를 제공한다. 따라서, 액티브 보드(Active Board)의 실패(Fail) 상태(MAC Fail 포함) 발생하면, 스탠바이(Stand-by) 상태의 허브 보드가 액티브 상태로 절체되는 이중화 구조로 되어있다.
도 1은 종래 기술에 따른 이중화 성형 토폴로지의 개념도를 도시하고 있다.
상기 도 1을 참조하면, 이중화 성형 토폴로지는 여러 개 의 노드(100~ 107)와 두 개의 허브(110,120)로 구성된다.
상기 각 노드(100~107)는 이더넷 스위칭 제어를 담당하는 상기 허 브(110,120)와 점-대-점(point-to-point) 링크를 갖는다. 따라서, 모든 통신은 상기 허브(110,120)를 경유해서 이루어진다.
여기서, 만약 허브(120)가 액티브 상태이고 허브(110)가 스탠바이 상태라고 가정하면, 상기 액티브 허브(120)에 문제가 발행하면 상기 스탠바이 허브(110)가 액티브 상태로 절체된다. 따라서, 어느 한쪽에 문제가 생겨도 스탠바이 보드로 절체되기 때문에 통신을 유지할 수 있다.
도 2는 종래 기술에 따른 물리계층 슬롯(Physical Slot)과 논리계층 슬롯(Logical Slot)의 포지션(Position)을 나타낸 이중화 성형 시스템을 도시하고 있다.
상기 도 2를 참조하면, 이중화 성형 토폴로지에서 백플레인(Backplane)은 허브 보드(215,217)에 대하여 두 개의 할당된 슬롯, 즉 허브 슬롯을 필요로 한다. Physical Slot 8과 9(Logical Slot 1과 2)가 이 허브 슬롯으로 할당되어 있다. 상기 도 1의 이중화 성형 토폴로지에서 볼 수 있듯이 이러한 허브 슬롯은 각각의 노드 슬롯(201~213, 219~231)과 1개의 이더넷 채널(Ethernet Channel)로 연결된다.
이와 같은 구조에서 노드 슬롯은 1개의 채널은 Logical Slot 1의 허브 슬롯에 연결되고, 이중화를 위해 다른 1개의 채널은 Logical Slot 2의 허브 슬롯에 연결된다. 따라서, 노드 슬롯은 2개의 채널이 있어야 한다.
또한, 셀프내의 허브 슬롯 사이에도 1개 이상의 이더넷 채널이 연결되어져 있다. 만약 허브 슬롯과 노드 슬롯 사이에 1개 이상의 이더넷 채널이 필요하면 허 브 슬롯에서 각각의 노드 슬롯에 2개 이상의 채널을 할당하여 이중화 성형 토폴로지를 확장할 수 있다.
위와 같은 이중화 성형 토폴로지에서는 허브 보드의 이중화를 지원하여, 액티브(active)상태의 허브 보드가 실패(Fail) 상태에 들어가도 이중화 절체를 통해 액티브 상태를 스탠바이 상태의 허브 보드에 넘겨 시스템이 계속해서 정상동작 할 수 있도록 한다.
도 3은 종래 기술에 따른 허브 보드 내에서의 이중화 장치 구성도를 도시하고 있다.
상기 도 3을 참조하면, 허브 보드(300)는 제어부(CPU)(310), 인터페이스 연결부(Physical Layer Interface Device)(320,330), 이더넷 스위칭부(350), 콘넥터부(340)로 구성된다.
상기 제어부(310)는 MAC 프로토콜(312)을 제어하여 이더넷 스위치(350)의 노드간 연결을 제어한다. 또한, 상기 제어부(310)는 MAC 프로토콜(314)을 제어하여 허브 보드(300)의 디버깅하기 위한 제어를 담당한다.
제 1 인터페이스 연결부(320)는 상기 제어부(310)의 제 1 MAC 프로토콜(312)과 이더넷 스위치(350)를 물리적으로 연결해준다. 제 1 인터페이스 연결부(320)는 GMII(Gigabit Media Independent Interface) 인터페이스(313)를 사용하여 상기 제어부(310)의 상기 제 1 MAC 프로토콜(312)과 연결된다. 그리고, 상기 제 1 인터페이스 연결부(320)는 serdes 인터페이스(321)를 사용하여 상기 이더넷 스위치(350) 와 연결된다.
제 2 인터페이스 연결부(330)는 상기 제어부(310)의 제 2 MAC 프로토콜(312)과 콘넥터부(340)를 물리적으로 연결해 준다. 상기 제 2 인터페이스 연결부(330)는 GMII(Gigabit Media Independent Interface) 인터페이스(315)를 사용하여 상기 제어부(310)의 제 2 MAC 프로토콜(314)과 연결된다. 그리고, 상기 제 2 인터페이스 연결부(330)는 copper 인터페이스(323)를 사용하여 상기 콘넥터부(340)와 연결된다.
상기 콘넥터부(340)는 외부입력단자로서 사용자가 디버깅을 하기 위해 접속하는 단자로 사용되고 RJ-45 규격을 따른다.
종래 기술은 셀프내 허브 보드에 대한 이중화는 지원되나, 허브 보드내의 이더넷 스위칭 용도의 MAC은 1개만 존재한다. 따라서, 만약 1개의 MAC이 불량시, 셀프내의 스탠바이 상태로 대기하고 있는 다른 허브 보드에게 이중화 절체를 통해 액티브 상태를 넘겨줘야 한다. 이와 같은 이중화 절체는 수초가 소요되는데 그 동안은 이더넷 데이터를 처리할 수 없다.
또한, 1개의 MAC만을 이더넷 데이터 경로(Ethernet Data Path)만을 사용했을 때, 허브 보드내의 이더넷 스위치를 통해 스위칭되는 이더넷 데이터를 제외한, 허브 보드의 MAC으로 들어오는 이더넷 데이터가 집중될 경우 상기 이더넷 데이터를 분산할 수 있는 경로가 별도로 없어 허브 보드내의 이더넷 스위치에서 많은 양의 데이터를 버퍼링해야 한다.
따라서, MAC 이중화를 제공하여 1개의 MAC 불량 발생시, 허브 보드의 이중화 절체를 수행하지 않고 나머지 MAC을 통해 이더넷 데이터 전송할 수 있는 장치 및 방법이 필요하다.
또한 허브 보드의 MAC으로 들어오는 이더넷 데이터가 많을 경우 링크 애그리게이션(Link Aggregation)을 제공하여 이더넷 스위치에서 버퍼링(Buffering)하는 데이터의 양을 줄일 수 있는 장치 및 방법이 필요하다.
따라서, 본 발명의 목적은 이더넷 허브 보드에서 MAC 이중화를 제공하기 위한 장치 및 방법을 제공함에 있다.
본 발명의 다른 목적은 이더넷 허브 보드의 물리적인 이중화 절체없이 MAC 이중화를 통한 논리적으로 이중화를 수행하는 장치 및 방법을 제공함에 있다.
본 발명의 또 다른 목적은 이더넷 허브 보드의 MAC으로 들어오는 이더넷 데이터가 많을 경우 트래픽 밸런싱을 위한 링크 애그리게이션(Link Aggregation)을 제공하여 이더넷 스위치에서 버퍼링(Buffering)하는 데이터 양을 줄일 수 있는 장치 및 방법을 제공함에 있다.
상기한 목적들을 달성하기 위한 본 발명의 제 1 견지에 따르면, 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어(MAC) 이중화 장치에 있어서, 네트워크 상태 정보를 획득하여 제 1 매체접근제어에서 제 2 매체접근제어로 전환할지를 결정하는 제어부와, 상기 제 1 매체접근제어에서 상기 제 2 매체접근제어로 전환해야 할 경우, 디버깅 모드에서 이더넷 데이터 전송모드로 스위칭하는 인터페이스 연결부를 포함하는 것을 특징으로 한다.
상기한 목적들을 달성하기 위한 본 발명의 제 2 견지에 따르면, 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어(MAC) 이중화 방법에 있어서, 네트워크 상태 정보를 획득하여 제 1 매체접근제어에서 제 2 매체접근제어로 전환할지를 결정하는 과정과, 상기 제 1 매체접근제어에서 상기 제 2 매체접근제어로 전환해야 할 경우, 디버깅 모드에서 이더넷 데이터 전송모드로 스위칭하는 과정을 포함하는 것을 특징으로 한다.
이하 본 발명의 바람직한 실시 예를 첨부된 도면의 참조와 함께 상세히 설명한다. 그리고, 본 발명을 설명함에 있어서, 관련된 공지기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단된 경우 그 상세한 설명은 생략한다.
이하, 본 발명은 이더넷 허브 보드에서 디버깅용도로 사용하는 MAC를 이용한 이중화 장치 및 방법에 대해 설명하기로 한다.
도 4은 본 발명의 실시 예에 따른 허브 보드 내에서의 이중화 장치 구성도를 도시하고 있다.
상기 도 4를 참조하면, 허브 보드(400)는 제어부(CPU)(410), 인터페이스 연 결부(Physical Layer Interface Device)(420,430), 이더넷 스위칭부(450), 콘넥터부(440)로 구성된다.
상기 제어부(410)는 MAC 프로토콜(412)을 제어하여 이더넷 스위치(450)의 노드간 연결을 제어한다. 또한, 상기 제어부(410)는 MAC 프로토콜(414)을 제어하여 허브 보드(400)의 디버깅하기 위한 제어를 담당하고 액티브 허브 보드에 문제가 있거나 처리할 이더넷 데이터가 많을 경우, 제 2 인터페이스 연결부(430)를 통해 액티브 모드로 동작하도록 제어한다.
제 1 인터페이스 연결부(420)는 상기 제어부(410)의 제 1 MAC 프로토콜(412)과 이더넷 스위치(450)를 물리적으로 연결해준다. 다시 말해, 제 1 인터페이스 연결부(420)는 GMII(Gigabit Media Independent Interface) 인터페이스(413)를 사용하여 상기 제어부(410)의 상기 제 1 MAC 프로토콜(412)과 연결된다. 그리고, 상기 제 1 인터페이스 연결부(420)는 serdes 인터페이스(421)를 사용하여 상기 이더넷 스위치(450)와 연결된다.
제 2 인터페이스 연결부(430)는 상기 제어부(310)의 제 2 MAC 프로토콜(414)과 콘넥터부(440)를 물리적으로 연결해 준다. 상기 제 2 인터페이스 연결부(430)는 GMII(Gigabit Media Independent Interface) 인터페이스(415)를 사용하여 상기 제어부(410)의 제 2 MAC 프로토콜(414)과 연결된다. 그리고, 상기 제 2 인터페이스 연결부(430)는 초기copper 인터페이스(425)를 사용하여 상기 콘넥터부(440)와 연결된다. 하지만, 절체 이벤트가 발행하면 serdes 인터페이스(423)를 통해 상기 이더넷 스위치(450)와 연결된다.
상기 콘넥터부(440)는 외부입력단자로서 사용자가 디버깅을 하기 위해 접속하는 단자로 사용되고 RJ-45 규격을 따른다.
본 발명은 아래 그림 4와 같이 제어부(MAC_0(412), MAC_1(414) 내장)(410)와 제 1 인터페이스부(420)와 제 2 인터페이스부(423), 콘넥터부(440), 이더넷 스위치(450)로 구성된다.
상술한 바와 같이, 본 발명은 기존 허브 보드에서 디버그(Debug)용으로 할당된 MAC_1을 이용하여 MAC 이중화를 구현한 것이다. 상기 MAC_1에 연결된 인터페이스부(430)를 사용 용도에 따라 디버그 포트(Debug Port)로 사용시는 Copper Mode로 설정하여 우리가 흔히 랜포트(LAN Port)로 사용하는 RJ-45 콘넥터를 통해 디버그 포트로 사용한다. 그리고, MAC 이중화 용도로 사용시는 Serdes Mode로 설정하여 이더넷 스위치(450)에 연결하여 사용한다. 즉, 하나의 인터페이스 연결부(430)를 이용하여 구성한 후, 제 2 인터페이스 연결부(430)의 내부 레지스터(Internal Register)를 제어하여 두 가지 용도로 스위칭 변경하여 사용할 수 있다.
예를 들어, 부팅(Booting)시 제 2 인터페이스부(430)는 Copper Interface로 초기화되어, 상기 MAC_1은 디버그용으로 사용된다. 상기 초기화 이후, MAC_0 또는 MAC_1에 연결된 제 1 인터페이스부(420)의 실패(Fail) 상태가 발생하여, MAC_0을 통한 이더넷 데이터 통신에 대한 실패상태가 보고된다. 이후, 허브 보드(400)는 이중화 절체를 수행하지 않고 MAC_0를 disable 시키고, MAC_1에 대한 제 2 인터페이스부(430)를 Serdes Mode로 변경하여 MAC_1을 통해 이더넷 데이터 통신을 한다.
만약, MAC_0를 향하여 들어오는 데이터가 많은 상황에서는 MAC_1에 대한 PHY를 Serdes Mode로 변경하여 MAC_0와 MAC_1을 모두 사용하여 Ethernet Data 통신을 한다.
이와 같이 두 개의 MAC을 사용하여 이더넷 데이터 통신을 하게 되면, 이더넷 스위치(450)에서 링크 애그리게이션(link aggregation)하여 두 개의 MAC으로 나누어서 데이터를 전송하게 된다. 따라서 이더넷 스위치(450)에서 버퍼링(Buffering)는 데이터 양도 줄어들게 된다.
제 1 허브 보드와 제 2 허브 보드가 이더넷 장치내에 셀프에 실장될 때, 먼저 제 1 허브 보드가 실장되고 다음에 제 2 허브 보드가 실장된다고 가정한다.
도 5는 본 발명에 따른 이중화 초기 흐름도를 도시하고 있다.
상기 도 5를 참조하면, 먼저 501 단계에서 제 1 허브 논리 슬롯(500)에 제 1 허브 보드가 실장되면, 상기 제 1 허브 논리 슬롯(500)은 디폴트 액티브 논리 슬롯을 diable 요청하는 메시지를 BSM(530)으로 전송한다.
이후, 503 단계에서 상기 제 1 허브 논리 슬롯은 부팅을 시작하여 상기 BSM으로부터 프로그램을 로딩(code/configuation download)(505)한다.
이후, 506 단계에서 상기 제 1 허브 논리 슬롯은 초기화 상태가 된다.
여기서, 제 2 허브 논리 슬롯도 상기 제 1 허브 논리 슬롯과 마찬가지로 504 단계, 508 단계와 510 단계를 거쳐서 초기화 상태가 된다.
상기 제 1 허브 논리 슬롯과 상기 제 2 허브 논리 슬롯이 초기화되면, 511 단계에서 상기 제 1 허브 논리 슬롯과 상기 제 2 허브 논리 슬롯은 액티브 스탠바이 조정(active/standby arbitration)을 위한 정보를 교환한다. 즉, 상기 제 1 허브 논리 슬롯과 상기 제 2 허브 논리 슬롯 중 정보를 교환하여 누가 액티스 상태로 동작할지 누가 스탠바이 상태로 동작할지를 결정한다. 초기 스탠바이/액티브 상태를 결정하는 것은 먼저 실장되어 부팅되는 슬롯이 먼저 액티브로 결정된다. 하지만, 상기 스탠바이/액티브 상태를 결정은 시스템 운영자에 따라 다양하게 구현될 수 있다.
만약, 상기 제 1 허브 논리 슬롯이 액티브 상태로 결정되면, 상기 제 1 허브 논리 슬롯은 512 단계에서 액티브 논리 슬롯으로 인에이블(enable) 시키는 메시지를 상기 BSM(530)으로 전송한다. 전송 후 513 단계에서 프로세서간 통신(inter-process communicaiton)를 통해 액티브 상태임을 통보한다.
여기서, 상기 제 1 허브 논리 슬롯과 상기 제 2 허브 논리 슬롯은 액티브 스탠바이 조정(active/standby arbitration)은 주기적으로 계속 수행된다. 514 단계에서 두 논리 슬롯간 액티브 스탠바이 조정(active/standby arbitration)하여 만약 상기 제 2 허브 논리 슬롯이 액티브 상태로 결정되면, 상기 제 1 허브 논리 슬롯은 515 단계에서 액티브 논리 슬롯으로 인에이블(enable) 시키는 메시지를 상기 BSM(530)으로 전송한다. 전송 후 516 단계에서 프로세서간 통신(inter-process communicaiton)를 통해 액티브 상태임을 통보한다.
도 6은 본 발명에 따른 이중화 스위칭 흐름도를 도시하고 있다.
상기 도 6을 참조하면, 상기 도 5 이중화 초기화 흐름도를 통해 액티브/스탠바이 상태가 정해진 상태에서, 제 1 허브 논리 슬롯(600)과 제 2 허브 논리 슬롯(610)은 601 단계에서 주기적으로 상태정보를 교환한다.
이후, 602 단계에서 절체 이벤트가 발행한다.
이후, 603 단계에서 상기 제 1 허브 논리 슬롯은 절체 결정을 한다.
이후, 604 단계에서 제 1 허브 논리 슬롯(600)은 IPC 통신을 통해 데이터베이스(DB) 동기를 획득한다.
이후, 605 단계에서 제 1 허브 논리 슬롯(600)은 현 액티브 논리 슬롯 디스에이블(disable) 메시지를 BSM(620)으로 통보해준다.
이후, 606 단계에서 제 2 허브 논리 슬롯(610)은 액티브 논리 슬롯 인에이블(enable) 메시지를 BSM(620)으로 통보해준다.
이후, 607 단계에서 제 2 허브 논리 슬롯(610)은 IPC 통신을 통해 액티브 상태 변경을 BSM(620)으로 통보해준다.
이후, 본 이중화 절차 흐름도를 종료한다.
한편 본 발명의 상세한 설명에서는 구체적인 실시 예에 관해 설명하였으나, 본 발명의 범위에서 벗어나지 않는 한도 내에서 여러 가지 변형이 가능함은 물론이다. 그러므로 본 발명의 범위는 설명된 실시 예에 국한되어 정해져서는 아니 되며 후술하는 특허청구의 범위뿐만 아니라 이 특허청구의 범위와 균등한 것들에 의해 정해져야 한다.
상술한 바와 같이, 디버깅을 위한 MAC를 인터페이스 연결부내의 내부 레지스터 제어한 MAC 이중화로써, 기존 1개의 MAC 불량시 이중화 절체에 소요되는 기능 및 비용적인 손실을 줄일 수 있고. 두 개의 MAC에 대한 이더넷 스위치를 통한 링크 애그리케이션(Link Aggregation)이 가능하다.

Claims (11)

  1. 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어(MAC) 이중화 장치에 있어서,
    네트워크 상태 정보를 획득하여 제 1 매체접근제어에서 제 2 매체접근제어로 전환할지를 결정하는 제어부와,
    상기 제 1 매체접근제어에서 상기 제 2 매체접근제어로 전환해야 할 경우, 디버깅 모드에서 이더넷 데이터 전송모드로 스위칭하는 인터페이스 연결부를 포함하는 것을 특징으로 하는 이중화 장치.
  2. 제 1항 있어서,
    상기 제 1 매체접근제어는 기설정된 serdes 인터페이스로 통해 이더넷 데이터를 전송할 수 있는 것을 특징으로 하는 이중화 장치.
  3. 제 1항 있어서,
    상기 인터페이스 연결부는 초기 설정시 상기 제 2 매체접근제어가 디버그 모드로 설정되도록 하는 것을 특징으로 하는 이중화 장치.
  4. 제 1항 있어서,
    상기 제 1 매체접근제어와 상기 제 2 매체접근제어는 GMII 인터페이스로 상기 인터페이스 연결부와 연결되는 것을 특징으로 하는 이중화 장치.
  5. 제 1항 있어서,
    상기 인터페이스 연결부와 상기 이더넷 스위치는 serdes 인터페이스로 연결되는 것을 특징으로 하는 이중화 장치.
  6. 제 1항 있어서,
    디버깅 모드는 상기 인터페이스 연결부가 외부연결 인터페이스를 통해 네트워크 디버깅을 수행할 수 있는 모드이고, 상기 이더넷 데이터 전송모드는 상기 인터페이스 연결부가 이더넷 스위치와 연결되어 이더넷 데이터를 전송할 수 있는 모드인 것을 특징으로 하는 이중화 장치.
  7. 이더넷 허브 보드를 사용하는 통신시스템의 매체접근제어(MAC) 이중화 방법에 있어서,
    네트워크 상태 정보를 획득하여 제 1 매체접근제어에서 제 2 매체접근제어로 전환할지를 결정하는 과정과,
    상기 제 1 매체접근제어에서 상기 제 2 매체접근제어로 전환해야 할 경우, 디버깅 모드에서 이더넷 데이터 전송모드로 스위칭하는 과정을 포함하는 것을 특징으로 하는 이중화 방법.
  8. 제 7항 있어서,
    상기 제 1 매체접근제어는 기설정된 serdes 인터페이스로 통해 이더넷 데이터를 전송할 수 있는 것을 특징으로 하는 이중화 방법.
  9. 제 7항 있어서,
    상기 제 1 매체접근제어와 상기 제 2 매체접근제어는 GMII 인터페이스로 상기 인터페이스 연결부와 연결되는 것을 특징으로 하는 이중화 방법.
  10. 제 7항 있어서,
    상기 인터페이스 연결부와 상기 이더넷 스위치는 serdes 인터페이스로 연결되는 것을 특징으로 하는 이중화 방법.
  11. 제 7항 있어서,
    디버깅 모드는 상기 인터페이스 연결부가 외부연결 인터페이스를 통해 네트워크 디버깅을 수행할 수 있는 모드이고, 상기 이더넷 데이터 전송모드는 상기 인터페이스 연결부가 이더넷 스위치와 연결되어 이더넷 데이터를 전송할 수 있는 모드인 것을 특징으로 하는 이중화 방법.
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* Cited by examiner, † Cited by third party
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CN106230718A (zh) * 2016-08-03 2016-12-14 天津光电聚能专用通信设备有限公司 基于XilinxFPGA多千兆网合流系统及实现方法
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