KR20080023472A - Manufacturing method of thin-film transistors - Google Patents

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Abstract

A method for manufacturing a thin film transistor is provided to perform precise control of overlap and channel width between a gate electrode and a source/drain electrode by controlling exposure time and light intensity of a photo resist. A method for manufacturing a thin film transistor comprises the steps of: forming a gate electrode(102) on a transparent substrate(101); forming a transparent source/drain electrode(104); coating a negative photo resist(105) over the source/drain electrode; exposing the substrate until the negative photo resist is overlapped with the gate electrode from the opposite side of deposition and developing it; etching a channel of the source/drain electrode; removing the photo resist; and forming a semiconductor layer.

Description

박막 트랜지스터 제조방법 {Manufacturing method of thin-film transistors}Manufacturing method of thin-film transistors

도1a 내지 도1d는 본 발명에 따른 박막 트랜지스터 제조 방법을 나타낸다.1A to 1D show a method of manufacturing a thin film transistor according to the present invention.

도2a 내지 도2d는 본 발명에 따른 박막 트랜지스터 제조방법으로서, 도1a 내지 도1d에 이어지는 반도체층의 형성방법을 나타낸다.2A to 2D illustrate a method of manufacturing a thin film transistor according to the present invention, and a method of forming a semiconductor layer subsequent to FIGS. 1A to 1D.

※도면의 주요 부분에 대한 설명※※ Description of main part of drawing ※

101 : 투명 기판 102 : 게이트 전극101: transparent substrate 102: gate electrode

103 : 게이트 절연층 104 : 소스/드레인 전극103: gate insulating layer 104: source / drain electrode

105 : 포토 레지스트 106 : 반도체층105: photoresist 106: semiconductor layer

본 발명은 박막 트랜지스터 제조 방법에 관한 것이다.The present invention relates to a method for manufacturing a thin film transistor.

보다 구체적으로, 본 발명은 광 투과성의 게이트 절연막과 소스/드레인 전극을 사용하여 기판의 반대쪽에서 노광을 하고, 네거티브 포토 레지스트를 과도하게 노광시킴으로써 게이트 전극과 소스/드레인 전극과의 오버랩을 기판 전체에 걸쳐 균일하게 형성할 수 있는 박막 트랜지스터 제조 방법에 관한 것이다.More specifically, the present invention uses an optically transmissive gate insulating film and a source / drain electrode to expose the opposite side of the substrate, and exposes the overlap of the gate electrode and the source / drain electrode to the entire substrate by overexposing the negative photoresist. It relates to a thin film transistor manufacturing method which can be formed uniformly over.

고도의 정보화 시대가 진행되며, 대량의 정보처리를 위한 소자와 이를 표시하기 위한 디스플레이 소자들이 빠른 속도로 개발되고 있다. 디스플레이 소자들은 기존의 브라운관에서 OLED (organic light emitting diode), PDP (plasma display panel) 등 평면표시소자로 급속히 바뀌어가고 있다. As the information age progresses, elements for mass information processing and display elements for displaying the same are being rapidly developed. Display devices are rapidly changing from conventional CRTs to flat panel display devices such as OLED (organic light emitting diode) and plasma display panel (PDP).

이중에서도 OLED는 자발광, 저전력 등의 장점으로 차세대 디스플레이로 중요성을 더해가고 있다. 이러한 OLED는 고해상도와 저전력의 장점을 가지는 능동구형방식의 경우 각 픽셀당 트랜지스터를 필요로 하고 있다. 이 트랜지스터를 유기물을 이용한 소자로 제작할 경우 저비용과 유연성으로 OLED는 더 많은 장점을 지니게 된다. Among them, OLED is becoming more important as next generation display with advantages such as self-luminous and low power. Such OLEDs require transistors for each pixel in an active spherical method having high resolution and low power. When the transistors are fabricated using organic materials, OLEDs have more advantages due to their low cost and flexibility.

이 유기물 트랜지스터 중에서도 기존의 반도체 재료인 실리콘 트랜지스터에 근접하는 성능을 보이는 것에는 유기물인 펜타센(Pentacene) 등이 있다. 펜타센 등의 유기반도체를 이용한 소자구조는 크게 전극과 유기반도체와의 접촉방식에 따라 Top contact 구조 (펜타센 위에 전극을 형성)과 Bottom contact 구조(전극을 먼저 형성하고 그 위에 펜타센 형성) 두가지로 나눌 수 있다. Among these organic transistors, pentacene, which is an organic material, exhibits performance similar to that of a silicon transistor, which is an existing semiconductor material. Device structures using organic semiconductors such as pentacene are classified into two types: top contact structure (the electrode is formed on the pentacene) and bottom contact structure (the electrode is formed first and the pentacene is formed thereon) according to the contact method between the electrode and the organic semiconductor. Can be divided into:

각 구조의 장단점을 비교해보면 탑 콘택(Top contact) 구조의 경우 바텀콘택 (Bottom contact) 구조보다 소자특성이 우수하다는 장점과 먼저 형성된 유기물의 성능을 저하시키지 하지 않기 위해 전극을 쉐도우 마스크를 통해 진공챔버 내에서 제작해야 하므로 집적화에 문제가 있다는 단점이 있다. Comparing the advantages and disadvantages of each structure, the top contact structure has superior device characteristics than the bottom contact structure, and the vacuum chamber is formed through the shadow mask electrode in order not to degrade the performance of the organic material formed. There is a problem in that there is a problem in the integration because it must be produced in-house.

바텀 콘택 구조의 경우 소자특성은 탑 콘택 구조보다 떨어지나 공정상 집적화가 가능하다는 장점으로 실제 디스플레이 적용할 수 있다는 장점을 가지고 있다. In the case of the bottom contact structure, the device characteristics are lower than that of the top contact structure, but since the integration is possible in the process, the actual display can be applied.

위와 같은 유기 반도체를 사용하는 박막 트랜지스터의 경우 유기 반도체층의 채널 폭이 불규칙적으로 형성되어 기판 전체에서 성능이 일정치 않은 문제점이 존재한다.In the case of the thin film transistor using the organic semiconductor as described above, the channel width of the organic semiconductor layer is irregularly formed, so that there is a problem in that the performance of the entire substrate is not constant.

다양한 박막 트랜지스터, 특히 유기 반도체를 사용하는 유기 반도체 박막 트랜지스터의 문제점을 해결할 수 있는 방법이 요구된다.There is a need for a method capable of solving the problems of various thin film transistors, particularly organic semiconductor thin film transistors using organic semiconductors.

본 발명은 박막 트랜지스터 기판 전체에 걸쳐 게이트 전극과 소스/드레인 전극과의 오버랩과 채널폭을 일정하게 형성할 수 있는 방법을 제공하는 것을 목적으로 한다.An object of the present invention is to provide a method in which overlap between a gate electrode and a source / drain electrode and a channel width can be uniformly formed over a thin film transistor substrate.

또한, 본 발명은 전체에 걸쳐 게이트 전극과 소스/드레인 전극과의 오버랩과 채널폭을 매우 정밀하게 제어할 수 있는 방법을 제공하는 것을 목적으로 한다.It is also an object of the present invention to provide a method capable of very precisely controlling the overlap between the gate electrode and the source / drain electrode and the channel width.

본 발명의 일 실시예에 따른 박막 트랜지스터 제조방법은, 투명 기판에 게이트 전극을 형성하는 단계; 투명 소스/드레인 전극을 형성하는 단계; 상기 소스/드레인 전극 위에 네거티브 포토 레지스트를 도포하는 단계; 상기 기판을 적층 방향 의 반대쪽에서 노광시키고 현상하는 단계; 상기 소스/드레인 전극의 채널부를 에칭하는 단계; 상기 포토 레지스트를 제거하는 단계; 및 반도체층을 형성하는 단계를 포함하는 것을 특징으로 한다.According to one or more exemplary embodiments, a method of manufacturing a thin film transistor includes: forming a gate electrode on a transparent substrate; Forming a transparent source / drain electrode; Applying a negative photoresist over said source / drain electrodes; Exposing and developing the substrate on opposite sides of the stacking direction; Etching the channel portion of the source / drain electrode; Removing the photoresist; And forming a semiconductor layer.

이하 도면을 참조하여 본 발명의 제조방법을 보다 상세히 설명한다.Hereinafter, the manufacturing method of the present invention will be described in detail with reference to the accompanying drawings.

도1a 내지 도1d는 본 발명에 따른 박막 트랜지스터 제조 방법을 나타낸다.1A to 1D show a method of manufacturing a thin film transistor according to the present invention.

도1a에 도시된 바와 같이, 유리 또는 플라스틱 등의 투명 기판(101)에 게이트 전극(102)을 형성한다. 게이트 전극(102)으로는 Al/Nd을 차례로 적층한 메탈층, Cr/Mo의 합금 등 실시예에 따라 다양한 재료가 사용될 수 있다. As shown in Fig. 1A, a gate electrode 102 is formed on a transparent substrate 101 such as glass or plastic. As the gate electrode 102, various materials may be used according to embodiments, such as a metal layer in which Al / Nd is sequentially stacked and an alloy of Cr / Mo.

도1b에 도시된 바와 같이, 기판(101) 위에 게이트 전극(102)을 덮도록 게이트 절연층(103)을 적층하고, 그 위에 소스/드레인 전극(104)을 적층한다.As shown in FIG. 1B, a gate insulating layer 103 is stacked on the substrate 101 to cover the gate electrode 102, and a source / drain electrode 104 is stacked thereon.

게이트 절연층(103)은 포토 레지스트 노광용 자외선이 통과할 수 있어야 하므로 광투과성 재질이어야 하며, SiO2, SiNx 등의 무기 재료도 사용 가능하고, PVP (poly vinyl phenol)이나 피릴린 등의 유기 절연막도 사용할 수 있다.The gate insulating layer 103 must be a light transmissive material because ultraviolet rays for photoresist exposure can pass therethrough, and inorganic materials such as SiO 2 and SiNx can be used, and organic insulating films such as polyvinyl phenol (PVP) and pyriline can also be used. Can be.

마찬가지로, 본 발명에 따른 제조 방법에서, 소스/드레인 전극(104)도 빛이 투과할 수 있는 광 투과성 금속이어야 한다. 소스/드레인 전극(104)으로는 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide), ZTO(Zinc Tin Oxide), PDOT( poly 3,4-ethylenedioxythiophene)등의 투명 금속을 사용할 수 있다.Likewise, in the manufacturing method according to the present invention, the source / drain electrode 104 should also be a light transmissive metal through which light can pass. As the source / drain electrode 104, a transparent metal such as indium tin oxide (ITO), indium zinc oxide (IZO), zinc tin oxide (ZTO), or poly 3,4-ethylenedioxythiophene (PDOT) may be used.

그리고 나서, 도1c에서, 소스/드레인 전극(104)의 채널부(중심부)를 제외한 나머지 부분을 패터닝한다. 포토 리소그래피 방식을 사용하여 에칭에 의해 에칭할 수 있다. 본 발명의 방법에 있어서, 소스/드레인 전극(104)의 채널부의 패터닝은 별도의 패터닝 공정을 통해 보다 정확하게 수행된다.Then, in FIG. 1C, the remaining portions except for the channel portion (center portion) of the source / drain electrode 104 are patterned. It can be etched by etching using a photolithography method. In the method of the present invention, the patterning of the channel portions of the source / drain electrodes 104 is performed more accurately through a separate patterning process.

도1d와 같이, 기판 전면에 네거티브 포토 레지스트(105)를 도포하고, 기판의 적층 방향의 반대쪽, 즉 기판의 아래쪽에서 자외선을 조사하여 포토 레지스트(105)를 노광한다. 이 때, 게이트 전극(102)이 마스크 역할을 하게 된다. As shown in Fig. 1D, a negative photoresist 105 is applied to the entire surface of the substrate, and the photoresist 105 is exposed by irradiating ultraviolet rays on the opposite side of the substrate stacking direction, that is, under the substrate. At this time, the gate electrode 102 serves as a mask.

포토 레지스트(105)는 네거티브 타입이므로, 노광된 부분이 남게되며, 게이트 전극(102)으로 가려진 부분은 현상으로 제거된다. Since the photoresist 105 is a negative type, the exposed portion remains, and the portion covered by the gate electrode 102 is removed by development.

노광시에는 노광시간을 길게 하거나, 또는 광의 세기를 강하게 하여, 게이트 전극(102)으로 가려진 부분도 노광이 되도록 한다. 즉, 마스크 역할을 하는 게이트 전극(102)의 주변부들도 소정 폭만큼 노광이 되도록 한다. 게이트 전극(102)의 안쪽까지 노광되는 부분은 게이트 전극(102)과 소스/드레인 전극(104)의 오버랩을 형성하게 된다.At the time of exposure, exposure time is lengthened or light intensity is strengthened so that the part covered by the gate electrode 102 may also be exposed. That is, the peripheral portions of the gate electrode 102 serving as a mask are also exposed by a predetermined width. The portion exposed to the inner side of the gate electrode 102 forms an overlap of the gate electrode 102 and the source / drain electrode 104.

박막 트랜지스터 기판의 전기광학적 특성 확보를 위해 게이트 전극(102)과 소스/드레인 전극 사이에는 소정 폭만큼의 오버랩이 요구된다.In order to secure the electro-optic characteristics of the thin film transistor substrate, an overlap of a predetermined width is required between the gate electrode 102 and the source / drain electrodes.

노광 정도는 노광 시간 및 광의 세기 모두에 비례하므로, 실시예에 따라서는, 노광 시간은 종래와 같도록 두고, 광의 세기를 강하게 하므로서, 게이트 전극(102)과 소스/드레인 전극(104)의 오버랩을 형성할 수도 있다.Since the exposure degree is proportional to both the exposure time and the light intensity, in some embodiments, the exposure time is the same as before, and the intensity of the light is strengthened, thereby overlapping the overlap between the gate electrode 102 and the source / drain electrode 104. It may be formed.

또한, 기판의 반대쪽에서 게이트 절연층(103)과 소스/드레인 전극(104)을 통과하면서 노광이 수행되어야 하므로, 종래의 통상적인 노광 공정보다 광의 세기를 훨씬 강하게 하는 것이 바람직하다.In addition, since the exposure must be performed while passing through the gate insulating layer 103 and the source / drain electrodes 104 on the opposite side of the substrate, it is preferable to make the intensity of light much stronger than that of a conventional conventional exposure process.

도2a 내지 도2d는 본 발명에 따른 박막 트랜지스터 제조방법으로서, 도1a 내지 도1d에 이어지는 채널층, 즉 반도체층의 형성방법을 나타낸다.2A to 2D illustrate a method of manufacturing a thin film transistor according to the present invention, and show a method of forming a channel layer, that is, a semiconductor layer, continued from FIGS. 1A to 1D.

도2a와 같이, 네거티브 포토 레지스트(105) 중 노광되지 않은 부분을 현상하여 포토 레지스트(105) 패턴을 형성한다.As shown in FIG. 2A, an unexposed portion of the negative photoresist 105 is developed to form a photoresist 105 pattern.

그리고 나서, 도2b와 같이, 소스/드레인 전극(104)을 패터닝하여 소스/드레인 전극(104)의 중심부에 반도체층이 형성될 채널부를 형성한다.Then, as shown in FIG. 2B, the source / drain electrode 104 is patterned to form a channel portion in which a semiconductor layer is to be formed in the center of the source / drain electrode 104.

게이트 전극(102)을 마스크로 사용하여 기판의 반대측에서 노광시에 노광 시간 또는 광의 세기를 조정하여 게이트 전극(102)으로 덮혀진 부분까지 일부분 노광이 되었으므로 소스/드레인 전극(104)과 게이트 전극(102) 사이에는 서로 겹치는 영역, 즉 오버랩이 형성된다.Using the gate electrode 102 as a mask, the exposure time or the intensity of the light was adjusted at the time of exposure on the opposite side of the substrate to partially cover the portion covered with the gate electrode 102, so that the source / drain electrode 104 and the gate electrode ( An area overlapping each other, that is, an overlap, is formed between the 102.

본 발명에 따른 박막 트랜지스터 제조방법에서 노광 시간 또는 노광시 광의 세기를 조절함으로써 게이트 전극(102)과 소스/드레인 전극(104) 사이의 오버랩을 기판 전체에 걸쳐 균일하고 정밀하게 제어할 수 있게 된다.In the manufacturing method of the thin film transistor according to the present invention, the overlap between the gate electrode 102 and the source / drain electrode 104 can be uniformly and precisely controlled over the entire substrate by adjusting the exposure time or the intensity of light during exposure.

그리고 나서, 도2c에 도시된 바와 같이, 포토 레지스트(105)를 제거한다. 포토 레지스터(105)에 맞는 적절한 스트리퍼 액을 사용하여 제거할 수 있다.Then, as shown in Fig. 2C, the photoresist 105 is removed. It can be removed using a suitable stripper liquid suitable for the photoresist 105.

도2d에 도시된 바와 같이, 채널부, 즉 소스/드레인 전극(105) 중심부에 반도체층(106)을 형성한다. 펜타센 등의 유기 물질을 사용할 수도 있고, a-Si, poly Si 등의 무기물을 사용할 수도 있다.As shown in FIG. 2D, the semiconductor layer 106 is formed in the center of the channel portion, that is, the source / drain electrode 105. Organic materials, such as pentacene, may be used, and inorganic materials, such as a-Si and poly Si, may be used.

반도체층(106)으로 최근에 개발된 솔루어블(soluable) 펜타센 또는 액상 유기 물질을 사용하는 경우에는, 잉크젯 공정을 통해 소스/드레인 전극(104) 중심부 에 형성된 채널부에 반도체층(106)을 보다 안정적으로 형성할 수 있다.In the case of using a recently developed soluable pentacene or liquid organic material as the semiconductor layer 106, the semiconductor layer 106 is formed in a channel portion formed at the center of the source / drain electrode 104 through an inkjet process. Can be formed more stably.

위와 같이 본 발명에 따른 박막 트랜지스터 제조방법에서는, 포토 레지스트(105)의 노광 시간 및 광의 세기를 조절함으로써 게이트 전극(102)과 소스/드레인 전극(104) 사이의 오버랩을 제어하게 된다.As described above, in the thin film transistor manufacturing method according to the present invention, the overlap between the gate electrode 102 and the source / drain electrode 104 is controlled by adjusting the exposure time and the light intensity of the photoresist 105.

본 발명의 박막 트랜지스터 제조방법에 따르면, 박막 트랜지스터 기판 전체에 걸쳐 게이트 전극과 소스/드레인 전극과의 오버랩과 채널폭을 일정하게 형성할 수 있다.According to the method of manufacturing the thin film transistor of the present invention, the overlap between the gate electrode and the source / drain electrode and the channel width can be uniformly formed over the thin film transistor substrate.

Claims (4)

투명 기판에 게이트 전극을 형성하는 단계;Forming a gate electrode on the transparent substrate; 투명 소스/드레인 전극을 형성하는 단계;Forming a transparent source / drain electrode; 상기 소스/드레인 전극 위에 네거티브 포토 레지스트를 도포하는 단계;Applying a negative photoresist over said source / drain electrodes; 상기 기판을 적층 방향의 반대쪽에서 노광시키고 현상하는 단계;Exposing and developing the substrate on opposite sides of the stacking direction; 상기 소스/드레인 전극의 채널부를 에칭하는 단계;Etching the channel portion of the source / drain electrode; 상기 포토 레지스트를 제거하는 단계; 및Removing the photoresist; And 반도체층을 형성하는 단계;Forming a semiconductor layer; 를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조방법.Thin film transistor manufacturing method comprising a. 제1항에 있어서, The method of claim 1, 상기 기판을 적층 방향의 반대쪽에서 노광시키고 현상하는 단계는, Exposing and developing the substrate on the opposite side of the stacking direction, 상기 네거티브 포토 레지스트가 상기 게이트 전극과 오버랩되는 부분까지 노광시키는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조방법.And exposing the negative photoresist to a portion overlapping with the gate electrode. 제1항에 있어서,The method of claim 1, 상기 소스/드레인 전극은 ITO, IZO, ZTO, PDOT 중 어느 하나인 것을 특징으로 하는 박막 트랜지스터 제조방법.The source / drain electrode may be any one of ITO, IZO, ZTO, and PDOT. 제1항에 있어서,The method of claim 1, 상기 반도체층을 형성하는 단계는, Forming the semiconductor layer, 상기 반도체 층은 액상 유기 반도체이고,The semiconductor layer is a liquid organic semiconductor, 상기 반도체 층을 잉크젯 공정으로 형성하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조방법.Forming the semiconductor layer by an inkjet process.
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