KR20070118430A - Array substrate for liquid crystall display device and methode for fabricating the same - Google Patents
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Abstract
Description
도 1은 일반적인 액정표시장치를 개략적으로 도시한 분해사시도.1 is an exploded perspective view schematically showing a general liquid crystal display device.
도 2a 내지 2i는 본 발명의 제 1 실시예에 따른 구리마그네슘 합금(Cu-Mg alloy)을 이용한 액정표시장치용 어레이 기판의 4마스크 공정에 따른 제조 단계별 단면을 도시한 것으로써 스위칭 소자인 박막트랜지스터를 포함하는 하나의 화소영역에 대한 단면도.2A to 2I illustrate cross-sectional views of manufacturing steps according to a four-mask process of an array substrate for a liquid crystal display device using a Cu-Mg alloy according to a first embodiment of the present invention. Cross-sectional view of one pixel region comprising a.
도 3은 액정표시장치용 어레이기판의 일부를 개략적으로 도시한 평면도이고,3 is a plan view schematically showing a part of an array substrate for a liquid crystal display device;
도 4a 내지 도 4g는 도 3의 Ⅳ-Ⅳ를 따라 절단하여, 본 발명의 공정순서에 따라 도시한 공정 단면도이다.4A to 4G are cross-sectional views taken along the line IV-IV of FIG. 3 and shown in the process sequence of the present invention.
〈도면의 주요부분에 대한 부호의 설명〉<Explanation of symbols for main parts of drawing>
101 : 기판 105 : 게이트 전극 101
107, 143 : 산화마그네슘막 109 : 게이트 절연막107, 143: magnesium oxide film 109: gate insulating film
120 : 반도체층 122 : 액티브층120: semiconductor layer 122: active layer
124 : 오믹콘택층 125a, 125b : 순수 및 불순불 비정질 패턴 124:
128 : 황화물층(황화구리층) 130 : 데이터 배선 128: sulfide layer (copper sulfide layer) 130: data wiring
135 : 소스 전극 137 : 드레인 전극 135
150 : 보호층 155 : 드레인 콘택홀150: protective layer 155: drain contact hole
160 : 화소전극 160: pixel electrode
P : 화소영역 TrA : 스위칭 영역 P: pixel area TrA: switching area
본 발명은 구리배선을 포함하는 액정표시장치용 어레이기판과 그 제조방법에 관한 것이다.The present invention relates to an array substrate for a liquid crystal display device including a copper wiring and a manufacturing method thereof.
최근에 액정표시장치는 소비전력이 낮고, 휴대성이 양호한 기술 집약적이며, 부가가치가 높은 차세대 첨단 디스플레이(display)소자로 각광받고 있다. Recently, liquid crystal displays have been spotlighted as next generation advanced display devices having low power consumption, good portability, high technology value, and high added value.
이러한 액정표시장치 중에서도 각 화소(pixel)별로 전압의 온(on),오프(off)를 조절할 수 있는 스위칭 소자인 박막트랜지스터가 구비된 액티브 매트릭스형 액정표시장치가 해상도 및 동영상 구현능력이 뛰어나 가장 주목받고 있다.Among the liquid crystal display devices, an active matrix liquid crystal display device having a thin film transistor, which is a switching element that can control voltage on and off for each pixel, has the best resolution and video performance. I am getting it.
일반적으로, 액정표시장치는 박막트랜지스터 및 화소전극을 형성하는 어레이 기판 제조 공정과 컬러필터 및 공통 전극을 형성하는 컬러필터 기판 제조 공정을 통해 각각 어레이 기판 및 컬러필터 기판을 형성하고, 이 두 기판 사이에 액정을 개재하는 액정 셀 공정을 거쳐 완성된다. In general, a liquid crystal display device forms an array substrate and a color filter substrate through an array substrate manufacturing process for forming a thin film transistor and a pixel electrode and a color filter substrate manufacturing process for forming a color filter and a common electrode, and between the two substrates. It completes through the liquid crystal cell process through liquid crystal in the process.
도 1은 일반적인 액정표시장치의 구성을 개략적으로 도시한 분해 사시도이다.1 is an exploded perspective view schematically illustrating a configuration of a general liquid crystal display device.
도시한 바와 같이, 도시한 바와 같이, 액정층(30)을 사이에 두고 어레이 기판(10)과 컬러필터 기판(20)이 대면 합착된 구성을 갖는데, 이중 하부의 어레이 기판(10)은 서로 교차 배열되어 다수의 화소영역(P)을 정의하는 다수의 게이트 배선(14)과 데이터 배선(16)이 형성되어 있으며, 이들 두 배선(14, 16)의 교차지점에는 스위칭 소자인 박막트랜지스터(T)가 구비되어 상기 각 화소영역(P)에 마련된 화소전극(18)과 일대일 대응 접속되어 있다.As shown in the figure, the
또한, 상기 어레이 기판과 마주보는 상부의 컬러필터 기판(20)은 투명기판(22)의 배면으로 상기 게이트 배선(14)과 데이터 배선(16) 그리고 박막트랜지스터(T) 등의 비표시영역을 가리도록 각 화소영역(P)을 테두리하는 격자 형상의 블랙매트릭스(25)가 형성되어 있으며, 이들 격자 내부에서 각 화소영역(P)에 대응되게 순차적으로 반복 배열된 적, 녹, 청색 컬러필터층(26)이 형성되어 있으며, 상기 블랙매트릭스(25)와 적, 녹 ,청색 컬러필터층(26)의 전면에 걸쳐 투명한 공통전극(28)이 구비되어 있다.In addition, the upper
그리고, 도면상에 도시되지는 않았지만, 이들 두 기판(10, 20)은 그 사이로 개재된 액정층(30)의 누설을 방지하기 위하여 가장자리 따라 실링제(sealant) 등으로 봉함(封函)된 상태에서 각 기판(10, 20)과 액정층(30)의 경계부분에는 액정의 분자배열 방향에 신뢰성을 부여하는 상, 하부 배향막이 개재되며, 각 기판(10, 20)의 적어도 하나의 외측면에는 편광판이 구비되어 있다. Although not shown in the drawings, these two
또한, 어레이 기판의 외측면으로는 백라이트(back-light)가 구비되어 빛을 공급하는 바, 게이트 배선(14)으로 박막트랜지스터(T)의 온(on)/오프(off) 신호가 순차적으로 스캔 인가되어 선택된 화소영역(P)의 화소전극(18)에 데이터배선(16)의 화상신호가 전달되면 이들 사이의 수직전계에 의해 그 사이의 액정분자가 구동되고, 이에 따른 빛의 투과율 변화로 여러 가지 화상을 표시할 수 있다.In addition, a back-light is provided on the outer surface of the array substrate to supply light. The on / off signals of the thin film transistor T are sequentially scanned by the
전술한 바와 같은 구성을 갖는 액정표시장치용 어레이 기판에 있어서, 상기 데이터 배선은 크롬(Cr)과 몰리브덴(Mo) 또는 탄탈륨(Ta)과 같은 도전성 금속으로 제작되고 있는데, 이들 금속은 열적 안정성(thermal stability)이 우수하여 힐락(hillock)과 같은 결함이 발생하지 않는 장점을 가진다. In the array substrate for a liquid crystal display device having the above-described configuration, the data line is made of a conductive metal such as chromium (Cr), molybdenum (Mo), or tantalum (Ta), and these metals have thermal stability. Excellent stability has the advantage that a defect such as hillock does not occur.
이러한 금속들은 일반적으로 스퍼터링(sputtering)에 의해 기판 위에 증착하고, 포토레지스트의 도포, 노광, 현상 및 식각 공정을 진행하여 상기 데이터 배선을 형성하게 된다.These metals are generally deposited on a substrate by sputtering, and the photo wiring is formed by applying, exposing, developing, and etching the photoresist to form the data line.
그러나, 상기 금속들은 앞서 설명한 열적 안정성 등의 장점을 가지고 있으나, 액정표시장치가 점점 대면적화 되어 가면서 이들 금속이 가지는 높은 비저항으로 인해 신호지연(signal delay)을 유발하는 문제가 발생하고 있다. However, the metals have advantages such as thermal stability as described above, but as the liquid crystal display devices become larger and larger, the high specific resistance of these metals causes a signal delay.
따라서, 비저항이 낮으며 힐락을 형성하지 않는 금속물질이 액정표시장치용 어레이 기판을 제작하는데 있어서 필수적이다.Therefore, a metal material having a low specific resistance and not forming a hillock is essential for manufacturing an array substrate for a liquid crystal display device.
현재로서는 구리(Cu) 또는 알루미늄(Al)이 가장 낮은 비저항으로 인해 가장 적절한 배선재료로 인식되고 있는 상황이지만, 알루미늄(Al)의 경우 힐락이 발생하는 것이 문제가 되며, 이를 해결하기 위한 제안된 알루미늄 합금은 비저항이 높은 문제가 있다.At present, copper (Cu) or aluminum (Al) is recognized as the most suitable wiring material due to the lowest resistivity, but in the case of aluminum (Al), it is a problem that the heel lock occurs, and the proposed aluminum to solve this problem. Alloys have a problem of high resistivity.
따라서, 최근에는 구리를 이용하여 게이트 또는 데이터 배선을 형성하고자 많은 연구가 이루어지고 있으나, 상기 구리는 타 물질층과의 접착(adhesion)특성이 좋지 않아 식각 진행시 기판으로부터 분리되는 불량이 발생한 가능성이 있다. Therefore, in recent years, many studies have been conducted to form gates or data lines using copper. However, since copper has poor adhesion characteristics with other material layers, there is a possibility that defects may be separated from the substrate during etching. have.
전술한 문제를 해결하기 위하여 본원발명은 구리 단일 물질 대신 구리합금을 이용하여 데이터 배선과 소스 및 드레인 전극을 형성함으로써 접촉특성을 향상시키는 것을 특징으로 하는 액정표시장치용 어레이 기판 및 그 제조 방법을 제공하는 것을 그 목적으로 한다.In order to solve the above problems, the present invention provides an array substrate for a liquid crystal display device and a method of manufacturing the same, characterized in that the contact characteristics are improved by forming a data line, a source and a drain electrode using a copper alloy instead of a single copper material. It is for that purpose.
전술한 목을 달성하기 위한 본 발명의 제 1 특징에 따른 액정표시장치용 어레이 기판의 제조방법은 화소영역이 정의된 기판 상에 제 1 금속물질을 증착하고 패터닝하여 일방향으로 연장하는 게이트 배선과 상기 화소영역에 게이트 전극을 형성하는 단계와; 상기 게이트 배선과 게이트 전극 상부에 게이트 절연막을 형성하는 단계와; 상기 게이트 절연막 위로 상기 게이트 전극에 대응하여 반도체 패턴을 형성하는 단계와; 상기 반도체 패턴이 형성된 기판을 황화수소(H2S) 분위기에서 제 1 플라즈마 처리함으로써 상기 반도체 패턴 위로 황 물질층을 형성하는 단계와; 상기 황 물질층 상부에 구리합금을 증착하고 패터닝하여 상기 게이트 배선과 교차하여 상기 화소영역을 정의하는 데이터 배선과, 상기 화소영역에 상기 황 물질층 상부에서 서로 이격하는 소스 및 드레인 전극을 형성하는 단계와; 상기 소스 및 드레인 전극 위로 상기 드레인 전극 일부를 노출시키는 드레인 콘택홀을 갖는 보호층을 형성하는 단계와; 상기 보호층 위로 상기 드레인 콘택홀을 통해 상기 드레인 전극과 접촉하는 화소전극을 형성하는 단계를 포함한다. According to a first aspect of the present invention, there is provided a method of fabricating an array substrate for a liquid crystal display device, including: a gate wiring extending in one direction by depositing and patterning a first metal material on a substrate on which a pixel region is defined; Forming a gate electrode in the pixel region; Forming a gate insulating film on the gate wiring and the gate electrode; Forming a semiconductor pattern on the gate insulating layer corresponding to the gate electrode; Forming a sulfur material layer over the semiconductor pattern by first plasma treating the substrate on which the semiconductor pattern is formed in a hydrogen sulfide (H 2 S) atmosphere; Depositing and patterning a copper alloy on the sulfur material layer to form a data line crossing the gate line to define the pixel area, and forming source and drain electrodes spaced apart from each other on the sulfur material layer in the pixel area. Wow; Forming a protective layer having a drain contact hole exposing a portion of the drain electrode over the source and drain electrodes; Forming a pixel electrode contacting the drain electrode through the drain contact hole on the passivation layer.
이때, 상기 반도체 패턴은, 순수 비정질 실리콘의 액티브층과 불순물 비정질 실리콘 패턴을 포함하며, 상기 서로 이격하는 소스 및 드레인 전극 사이로 상기 불순물 비정질 실리콘 패턴을 제거함으로서 상기 액티브층을 노출시키며 서로 이격하는 오믹콘택층을 형성하는 단계를 더욱 포함한다. The semiconductor pattern may include an active layer of pure amorphous silicon and an impurity amorphous silicon pattern. The semiconductor pattern may expose the active layer and be spaced apart from each other by removing the impurity amorphous silicon pattern between the source and drain electrodes spaced apart from each other. Forming a layer further.
또한, 상기 황 물질층과 이와 접촉하며 형성된 소스 및 드레인 전극 사이에 도전성의 황화구리(CuS)막이 더욱 형성되는 것이 특징이다. In addition, a conductive copper sulfide (CuS) film is further formed between the sulfur material layer and the source and drain electrodes formed in contact with the sulfur material layer.
본 발명의 제 2 특징에 따른 다른 액정표시장치용 어레이 기판의 제조 방법은 화소영역이 정의된 기판 상에 제 1 금속물질을 증착하고 패터닝하여 일방향으로 연장하는 게이트 배선과 상기 화소영역에 게이트 전극을 형성하는 단계와; 상기 게이트 배선과 게이트 전극 상부에 게이트 절연막을 형성하는 단계와; 상기 게이트 절연막 위로 순수 비정질 실리콘과 불순물 비정질 실리콘층을 형성하는 단계와; 상기 불순물 비정질 실리콘층이 형성된 기판을 황화수소(H2S) 분위기에서 제 1 플라즈마 처리하는 단계와; 상기 황화수소(H2S) 분위기에서 플라즈마 처리된 불순물 비정질 실리콘층 위로 구리합금을 증착하여 금속층을 형성하는 단계와; 상기 금속층과 불순물 비정질 실리콘층과 순수 비정질 실리콘층을 패터닝함으로써 상기 게이트 전극에 대응해서는 최상층으로부터 서로 이격하는 소스 및 드레인 전극과, 불순물 비정질 실리콘의 오믹콘택층과 그 하부로 그 일부가 노출된 순수 비정질 실리콘의 액티브층을 형성하고, 상기 게이트 절연막 위로는 상기 게이트 배선과 교차하여 상기 화소영역을 정의하며 상기 소스 전극과 연결된 데이터 배선을 형성하는 단계와; 상기 데이터 배선과 소스 및 드레인 전극 위로 상기 드레인 전극 일부를 노출시키는 드레인 콘택홀을 갖는 보호층을 형성하는 단계와; 상기 보호층 위로 상기 드레인 콘택홀을 통해 상기 드레인 전극과 접촉하는 화소전극을 형성하는 단계를 포함한다. In another method of manufacturing an array substrate for a liquid crystal display device according to the second aspect of the present invention, a gate wiring extending in one direction by depositing and patterning a first metal material on a substrate in which a pixel region is defined and a gate electrode in the pixel region are provided. Forming; Forming a gate insulating film on the gate wiring and the gate electrode; Forming a layer of pure amorphous silicon and an impurity amorphous silicon over the gate insulating film; First plasma treating the substrate on which the impurity amorphous silicon layer is formed in a hydrogen sulfide (H 2 S) atmosphere; Depositing a copper alloy on a plasma-treated impurity amorphous silicon layer in the hydrogen sulfide (H 2 S) atmosphere to form a metal layer; By patterning the metal layer, the impurity amorphous silicon layer, and the pure amorphous silicon layer, source and drain electrodes spaced apart from each other from the uppermost layer corresponding to the gate electrode, an ohmic contact layer of impurity amorphous silicon, and a pure amorphous portion of which is partially exposed thereunder. Forming an active layer of silicon, and defining a pixel area on the gate insulating layer to define the pixel area, and forming a data line connected to the source electrode; Forming a protective layer having a drain contact hole exposing a portion of the drain electrode over the data line and a source and drain electrode; Forming a pixel electrode contacting the drain electrode through the drain contact hole on the passivation layer.
이때, 상기 금속층과 불순물 비정질 실리콘층 사이에 황화구리(CuS)막이 더욱 형성되는 것이 특징이다. At this time, the copper sulfide (CuS) film is further formed between the metal layer and the impurity amorphous silicon layer.
제 1, 2 특징에 따른 액정표시장치에 있어서, 상기 제 1 금속물질은 구리마그네슘 합금(Cu-Mg alloy)인 것이 바람직하며, 상기 구리 합금은 구리마그네슘 합금(Cu-Mg alloy)인 것이 바람직하다.In the liquid crystal display device according to the first and second features, the first metal material is preferably a copper magnesium alloy, and the copper alloy is preferably a copper magnesium alloy. .
또한, 상기 게이트 배선과 게이트 전극 상부에는 산화마그네슘(MgO)막이 더욱 형성되며, 상기 드레인 콘택홀을 갖는 보호층을 형성한 후에는 황화수소(H2S) 분위기에서 제 2 플라즈마 처리를 실시하는 단계를 더욱 포함하며, 이때, 상기 드레인 콘택홀 내의 상기 드레인 전극과 화소전극 사이에는 황화구리(CuS)막이 더욱 형성된다. In addition, a magnesium oxide (MgO) film is further formed on the gate wiring and the gate electrode, and after forming a protective layer having the drain contact hole, performing a second plasma treatment in a hydrogen sulfide (H 2 S) atmosphere. Further, in this case, a copper sulfide (CuS) film is further formed between the drain electrode and the pixel electrode in the drain contact hole.
본 발명에 따른 액정표시장치용 어레이 기판은 화소영역이 정의된 기판 상에 일방향으로 연장하는 게이트 배선과 상기 게이트 배선에서 상기 화소영역으로 분기한 게이트 전극과; 상기 게이트 배선과 게이트 전극 상부로 전면에 형성된 게이트 절연막; 상기 게이트 절연막 상부로 상기 게이트 전극에 대응하여 형성된 반도체층과; 상기 반도체층 상부로 서로 이격하며 형성된 황화구리(CuS)막과; 상기 황화구리(CuS)막 상부로 구리합금으로써 서로 이격하며 형성된 소스 및 드레인 전극과, 상기 소스 및 드레인 전극과 동일한 물질로 형성되며 상기 게이트 절연막 상부로 게이트 배선과 교차하여 상기 화소영역을 정의하며 형성된 데이터 배선과; 상기 데이터배선과 소스 및 드레인 전극 상부에 형성되며 상기 드레인 전극을 노출시키는 드레인 콘택홀을 갖는 보호층과; 상기 보호층 상부로 상기 드레인 콘택홀을 통해 상기 드레인 전극과 접촉하며 형성된 화소전극을 포함한다. An array substrate for a liquid crystal display according to the present invention includes a gate wiring extending in one direction on a substrate on which a pixel region is defined, and a gate electrode branched from the gate wiring to the pixel region; A gate insulating film formed over the gate wiring and the gate electrode; A semiconductor layer formed on the gate insulating layer to correspond to the gate electrode; A copper sulfide (CuS) film formed on the semiconductor layer and spaced apart from each other; A source and drain electrode formed to be spaced apart from each other by a copper alloy on the copper sulfide (CuS) layer and the same material as the source and drain electrode, and formed to define the pixel region by crossing the gate wiring on the gate insulating layer. Data wiring; A protective layer formed on the data line and on the source and drain electrodes and having a drain contact hole exposing the drain electrode; And a pixel electrode formed on the passivation layer and in contact with the drain electrode through the drain contact hole.
이때, 상기 구리합금은 구리마그네슘 합금(Cu-Mg alloy)인 것이 특징이다. At this time, the copper alloy is characterized in that the copper magnesium alloy (Cu-Mg alloy).
또한, 상기 반도체층은, 상기 게이트 전극에 대응하여 연결된 상태로 비정질 실리콘의 액티브층과 그 상부로 상기 게이트 전극에 대응해서 서로 이격하는 불순물 비정질 실리콘의 오믹콘택층을 포함하며, 이때, 상기 황화구리(CuS)막은 상기 서로 이격하는 오믹콘택층 상부에 형성된 것이 특징이다. The semiconductor layer may include an active layer of amorphous silicon and an ohmic contact layer of impurity amorphous silicon spaced apart from each other in correspondence with the gate electrode in a state in which the semiconductor layer is connected to the gate electrode. The (CuS) film is formed on the ohmic contact layer spaced apart from each other.
또한, 상기 데이터 배선, 소스 및 드레인 전극과 상기 보호층 사이에는 산화마그네슘(MgO)막이 더욱 형성된 것이 특징이다. In addition, a magnesium oxide (MgO) film is further formed between the data line, the source and drain electrodes, and the protective layer.
또한, 상기 드레인 콘택홀 내에서 상기 화소전극과 드레인 전극 사이에는 황화구리(CuS)막이 더욱 형성되며, 상기 게이트 배선과 게이트 전극은 구리마그네슘 합금으로 이루어진 것이 특징이며, 이때, 상기 게이트 배선과 게이트 전극과 상기 게이트 절연막 사이에는 산화마그네슘(MgO)막이 더욱 형성된 것이 특징이다.In addition, a copper sulfide (CuS) film may be further formed between the pixel electrode and the drain electrode in the drain contact hole, and the gate wiring and the gate electrode may be made of a copper magnesium alloy. And a magnesium oxide (MgO) film is further formed between the gate insulating film and the gate insulating film.
이하, 첨부한 도면을 참조하여 본 발명에 따른 바람직한 실시예를 설명한다.Hereinafter, exemplary embodiments of the present invention will be described with reference to the accompanying drawings.
<제 1 실시예><First Embodiment>
도 2a 내지 2i는 본 발명의 제 1 실시예에 따른 구리마그네슘 합금(Cu-Mg alloy)을 이용한 액정표시장치용 어레이 기판의 4마스크 공정에 따른 제조 단계별 단면을 도시한 것으로써 스위칭 소자인 박막트랜지스터를 포함하는 하나의 화소영역에 대한 단면도이다. 이때, 상기 박막트랜지스터가 형성되는 영역을 스위칭 영역이라 정의한다.2A to 2I illustrate cross-sectional views of manufacturing steps according to a four-mask process of an array substrate for a liquid crystal display device using a Cu-Mg alloy according to a first embodiment of the present invention. A cross-sectional view of one pixel area including a. In this case, an area in which the thin film transistor is formed is defined as a switching area.
우선, 도 2a에 도시한 바와 같이, 투명한 절연기판(101) 상에 저저항 특성을 가지며 접촉특성 또한 우수한 금속물질로써 구리와 마그네슘이 적절이 섞인 구리-마그네슘 합금(Cu-Mg alloy)을 증착하여 제 1 금속층(미도시)을 형성하고, 상기 제 1 금속층(미도시) 상부로 포토레지스트를 도포하고, 마스크를 이용한 노광 및 현상을 실시하여 소정의 형태의 포토레지스트 패턴(미도시)을 형성하고, 이렇게 형성된 포토레지스트 패턴(미도시) 외부로 노출된 구리마그네슘 합금(Cu-Mg alloy)으로 이루어진 제 1 금속층(미도시)을 식각함으로써 일방향으로 연장하는 게이트 배선(미도시)과, 상기 게이트 배선(미도시)에서 각 화소영역(P)으로 분기한 형태의 게이트 전극(105)을 형성한다.First, as shown in FIG. 2A, a copper-magnesium alloy (Cu-Mg alloy) in which copper and magnesium are properly mixed as a metal material having low resistance and excellent contact characteristics is deposited on a transparent insulating
다음, 도 2b에 도시한 바와 같이, 상기 게이트 배선(미도시)과 게이트 전극(105) 위로 절연물질 예를들면 산화실리콘(SiO2) 또는 질화실리콘(SiNx)을 증착하여 게이트 절연막(109)을 형성한다. Next, as shown in FIG. 2B, an insulating material such as silicon oxide (SiO 2 ) or silicon nitride (SiNx) is deposited on the gate wiring (not shown) and the
이때 상기 게이트 절연막(109) 하부에 위치한 게이트 배선(미도시)과 게이트 전극(105)의 표면에는 이를 이루는 금속물질 중 반응성이 매우 좋은 물질인 마그네슘(Mg)이 포함되어 있는 바, 상기 마그네슘(Mg)이 특히 산소와 반응하여 상기 게이트 배선(미도시)과 게이트 전극(105)이 표면과 상기 기판(101)과의 계면을 따라 산화마그네슘(MgO)막(107)이 형성되어 진다. At this time, the surface of the gate wiring (not shown) and the
따라서, 실질적으로 상기 게이트 전극(105)과 게이트 배선(미도시) 상부에는 상기 산화마그네슘(MgO)막(107)과 게이트 절연막(109)이 형성되게 되며, 이렇게 게이트 절연막(109) 하부로 상기 게이트 배선(미도시)과 게이트 전극(105)과의 계면에 형성된 산화마그네슘(MgO)막(107)은 비록 그 두께가 수십 나노미터(nanometer) ~ 수 옹거스트롱(Å) 정도로 형성되지만 비록 미미할지라도 상기 게이트 절연막(109)과 더불어 절연특성을 향상시키게 되는 효과를 갖게 된다.Therefore, the magnesium oxide (MgO)
다음, 도 2c에 도시한 바와 같이, 상기 게이트 절연막(109) 위로 순수 비정질 실리콘층(115)과 불순물 비정질 실리콘층(116)을 형성한다. Next, as shown in FIG. 2C, a pure
이후, 상기 순수 및 불순물 비정질 실리콘층(115, 116)이 형성된 기판(101)을 황화수소(H2S) 분위기에서 플라즈마 처리한다. Subsequently, the
본 발명의 특성상 게이트 또는 데이터 배선 형성 시 이용되는 금속물질인 구 리마그네슘 합금(Cu-Mg alloy)은 그 내부에 마그네슘(Mg)을 포함하고 있으며, 상기 마그네슘(Mg)은 반응성이 커 상기 구리마그네슘 합금(Cu-Mg alloy)을 증착하여 구리마그네슘층을 형성하게 되면 상기 구리마그네슘층 표면을 포함하여 하부층의 계면에 있어서도 산화마그네슘(MgO)막이 형성되는데, 상기 산화마그네슘층 하부에 형성되는 상기 산화마그네슘(MgO)막의 형성을 억제하기 위하여 상기 황화수소(H2S) 분위기에서 플라즈마 처리한다.Due to the characteristics of the present invention, a copper magnesium alloy (Cu-Mg alloy), which is a metal material used to form a gate or data wiring, includes magnesium (Mg) therein, and the magnesium (Mg) is highly reactive and thus the copper magnesium When a copper magnesium layer is formed by depositing an alloy (Cu-Mg alloy), a magnesium oxide (MgO) film is also formed at the interface of the lower layer including the surface of the copper magnesium layer, and the magnesium oxide is formed below the magnesium oxide layer. In order to suppress the formation of a (MgO) film, plasma treatment is performed in the hydrogen sulfide (H 2 S) atmosphere.
게이트 배선(미도시)을 상기 구리마그네슘 합금(Cu-Mg alloy)으로 형성한 경우, 상기 산화마그네슘(MgO)막이 그 상부에 형성된 상기 게이트 절연막(109)의 절연특성을 더욱 향상시키는 바 문제되지 않지만, 추후 공정에서 데이터 배선과 소스 및 드레인 전극을 구리마그네슘 합금(Cu-Mg alloy)으로 형성할 경우, 특히 상기 소스 및 드레인 전극 하부에는 반도체층 더욱 정확히는 불순물이 도핑된 비정질 실리콘으로 이루어진 오믹콘택층에 형성되며 이 경우는 접촉특성을 저하시켜 접촉저항을 크게함으로써 오믹콘택층으로서의 역할을 저해하는 요소가 되기 때문이다. When a gate wiring (not shown) is formed of the Cu-Mg alloy, the magnesium oxide (MgO) film is not a problem because it further improves the insulating properties of the
따라서, 본 발명에서는 추후 형성될 소스 및 드레인 전극과의 계면에서 산화마그네슘(MgO)막의 형성을 억제하여 접촉특성을 향상시키고자 상기 불순물 비정질 실리콘층(116) 표면에 대해 황화수소(H2S) 분위기에서 플라즈마 처리를 하는 것이다. Therefore, in the present invention, hydrogen sulfide (H 2 S) atmosphere is applied to the surface of the impurity
상기 불순물 비정질 실리콘층(116) 상부로 황화수소(H2S) 분위기에서 플라즈마 처리를 하는 경우, 상기 불순물 비정질 실리콘층(116) 표면에 수십 나노미터 ~ 수 옹거스트롱(Å) 정도의 두께를 갖는 황 물질층(127)이 형성되어지는데, 황과 타물질과의 반응성은 아래 표1(황과 타 물질과의 반응성(엔탈피)에 대한 것을 나타내 표. 엔탈피 값이 낮을수록 반응이 잘 일어나게 됨)을 참조하면 구리(Cu)>실리콘(Si)>마그네슘(Mg) 순으로 상대적으로 황의 마그네슘(Mg)과의 반응성이 구리(Cu)나 실리콘(Si)에 비해 떨어지게 됨을 알 수 있다. In the case of performing a plasma treatment on the impurity
<표 1> TABLE 1
293℃에서 ΔHf(엔탈피)ΔH f (enthalpy) at 293 ° C
따라서, 상기 황화수소(H2S) 분위기에서 플라즈마 처리를 한 불순물 비정질 실리콘층(116) 상부로 구리마그네슘 합금(Cu-Mg alloy)을 증착 시 그 계면에는 산화마그네슘(MgO)막이 생성되지 않게 되고 대신 상기 황 물질층(127)에 의해 상기 황 물질층(127)이 구리(Cu)와 반응하여 황화구리(CuS)막이 형성되게 된다. 이때, 생성되는 황화구리(CuS)막은 상기 절연특성을 갖는 산화마그네슘(MgO)막과는 달리 도전특성을 갖는 바, 상기 불순물 비정질 실리콘으로 이루어진 오믹콘택층과의 구리마그네슘 합금(Cu-Mg alloy)의 소스 및 드레인 전극과의 오믹특성을 향상시키게 된다.Therefore, when a copper magnesium alloy (Cu-Mg alloy) is deposited on the impurity
다음, 도 2d에 도시한 바와 같이, 황화수소(H2S)의 분위기에서 플라즈마 처리된 불순물 비정질 실리콘층(116) 위로 구리마그네슘 합금(Cu-Mg alloy)을 증착함으로써 제 2 금속층(129)을 형성한다. 이때, 상기 제 2 금속층(129)의 표면에는 반 응성이 좋은 마그네슘(Mg)에 의해 제 2 산화마그네슘(MgO)막(143)이 자연적으로 형성되지만, 상기 제 2 금속층(129)과 그 하부의 불순물 비정질 실리콘층(116) 사이의 계면에는 산화마그네슘(MgO)막 대신 황화구리(CuS) 등의 황화물층(128)이 형성됨으로써 상기 산화마그네슘(MgO)막의 형성은 억제되게 된다. Next, as shown in FIG. 2D, the
또한, 이 경우 상기 구리마그네슘 합금(Cu-Mg alloy)은 타 물질층과의 접착력 또한 우수하므로 구리 단일물질로 금속층을 형성한 경우, 기판으로부터 떨어져 나가는 문제 또한 해결하게 된다. In addition, in this case, the Cu-Mg alloy also has excellent adhesion to other material layers, and thus, when the metal layer is formed of a single copper material, the problem of being separated from the substrate is also solved.
다음, 상기 제 2 금속층(129) 위로 포토레지스트를 도포하여 제 2 포토레지스트층(191)을 형성하고, 차단영역(BA)과, 투과영역(TA) 그리고 슬릿구조의 반투과영역(HTA)으로 이루어지는 노광 마스크(195)를 상기 제 2 포토레지스트층(191) 상부에 위치시킨다. Next, a
이때, 조금 더 상세히 상기 노광 마스크(195)의 노광 위치에 대해서 설명하면, 상기 노광 마스크(195)는 차단영역(BA)이 데이터 배선을 포함하여 소스 및 드레인 전극이 형성될 영역에 대응되도록 하며, 상기 스위칭 영역(TrA) 중 게이트 전극(109)에 대응되는 부분에는 슬릿구조의 반투과영역(HTA)이 대응하도록 하고, 상기 데이터 배선과 소스 및 드레인 전극이 형성되지 않는 부분에 대응해서는 투과영역(TA)되도록 위치시킨다. In this case, the exposure position of the
다음, 도 2e에 도시한 바와 같이, 전술한 바와같이 상기 제 2 포토레지스트층(191)에 대응하여 위치한 상기 노광 마스크(도 2d의 195)를 통해 상기 제 2 포토레지스트층(191)을 노광하고, 상기 노광된 제 2 포토레지스트층(191)을 현상함으로 써, 상기 데이터 배선과 소스 및 드레인 전극을 형성할 제 2 금속층(129) 더욱 정확히는 상기 제 2 금속층(129) 표면에 형성된 제 2 산화마그네슘(MgO)막(143) 위에는 두꺼운 제 1 포토레지스트 패턴(191a)을 형성하고, 동시에 상기 게이트 전극(109)과 대응하는 부분의 제 2 금속층(129) 상부에는 상기 제 1 포토레지스트 패턴(191a)보다 얇은 두께를 갖는 제 2 포토레지스트 패턴(191b)을 형성하며 그 이외의 제 2 금속층(129) 상부에 대해서는 상기 제 2 산화마그네슘(MgO)막(143)이 노출되도록 한다. Next, as shown in FIG. 2E, as described above, the
이렇게 반투과영역(도 2d의 HTA)을 포함하는 노광 마스크(도 2d의 195)를 이용하여 1회의 노광을 실시함으로써 두께를 달리하는 포토레지스트 패턴을 형성하는 노광을 회절노광이라 칭하며, 본 발명의 제 1 실시예의 경우 이러한 회절노광을 통해 마스크 공정 수를 줄인 것이다. 이렇게 두께를 달리하는 포토레지스트 패턴을 형성하는 방법에는 전술한 회절노광 이외에 반투과영역(도 2d의 HTA)을 슬릿이 아닌 빛의 투과량을 조절하기 위한 다수의 코팅층을 더욱 포함하도록 구성한 것을 특징으로 한 노광 마스크를 이용한 하프톤 노광도 있으며 이러한 하프톤 노광을 실시해도 동일한 결과를 얻을 수 있다. The exposure that forms a photoresist pattern having a different thickness by performing one exposure using an exposure mask (195 in FIG. 2D) including the transflective region (HTA in FIG. 2D) is called diffraction exposure. In the case of the first embodiment, the number of mask processes is reduced through such diffraction exposure. In the method of forming a photoresist pattern having a different thickness, the semi-transmissive region (HTA of FIG. 2D) is configured to further include a plurality of coating layers for controlling the amount of light transmission instead of the slit. There is also halftone exposure using an exposure mask, and the same result can be obtained by performing such halftone exposure.
또한, 본 발명의 경우, 상기 노광 마스크(도 2d의 195)의 투과영역(도 2d의 에 TA)대응하는 포토레지스트층 부분이 현상 시 제거됨을 특징으로 하는 포지티브타입(positive type) 포토레지스트를 이용한 것을 일례로 보인 것이며, 반대의 특성 즉 빛을 받은 부분이 현상 후 남게되는 네가티브 타입(negative type) 포토레지스트를 이용할 수도 있음은 자명하며 이 경우, 상기 노광 마스크의 투과영역과 차 단영역의 위치가 바뀐 노광 마스크를 이용하여 노광함으로써 동일한 결과를 얻을 수 있다.Further, in the case of the present invention, a portion of the photoresist layer corresponding to the transmissive region (TA in FIG. 2D) of the exposure mask (195 in FIG. 2D) is removed during development, using a positive type photoresist. As an example, it is apparent that a negative type photoresist may be used in which the opposite characteristic, ie, a portion of the light, is left after development, in which case the position of the transmission region and the blocking region of the exposure mask may be The same result can be obtained by exposing using the changed exposure mask.
다음, 도 2f에 도시한 바와 같이, 두께를 달리하는 제 1, 2 포토레지스트 패턴(191a, 미도시)이 형성된 기판(101)에 식각 공정을 진행하여 상기 제 1, 2 포토레지스트 패턴(191a, 미도시) 외부로 노출된 제 2 산화마그네슘(MgO)막(143)과 그하부의 제 2 금속층(도 2e의 129)과 그 하부의 상기 불순물 비정질 실리콘층(도 2d의 116)의 계면에 생성된 황화물층(도 2d의 128)과 그 하부의 불순물 비정질 실리콘층(도 2d의 116)과 순수 비정질 실리콘층(도 2d의 115)을 순차적으로 식각하여 상기 게이트 절연막(109)이 노출되도록 한다. Next, as shown in FIG. 2F, an etching process is performed on the
이때, 상기 제 1, 2 포토레지스트 패턴(191a, 미도시) 하부의 제 2 금속층과 황화물층(128)과 불순물 비정질 실리콘층과 순수 비정질 실리콘층은 상기 제 1, 2 포토레지스트 패턴(181a, 미도시)이 식각 마스크로 작용하여 식각되지 않고 그대로 남아있게 되며, 상기 남아있는 제 2 금속층은 각각 연결된 상태의 소스 드레인 패턴(131)과 데이터 배선(130)을, 불순물 비정질 실리콘층은 연결된 상태의 불순물 비정질 실리콘 패턴(123)을 그리고 순수 비정질 실리콘층은 액티브층(122)을 이루게 된다. 이때, 공정 특성상 상기 데이터 배선(130)의 하부에도 불순물 비정질 실리콘과 순수 비정질 실리콘의 패턴(125b, 125a)이 남아있게 된다. In this case, the second metal layer, the
다음, 상기 제 1, 2포토레지스트 패턴(191a, 미도시)에 드라이 에칭(dry etching)을 진행하여 상기 게이트 전극(105)과 대응되는 부분의 두께가 얇게 형성된 제 2 포토레지스트 패턴(미도시)을 제거한다. 이때, 제 2 포토레지스트 패턴(미 도시)의 두께보다 두껍게 형성된 제 1 포토레지스트 패턴(191a)에 있어서도 식각되어 그 두께가 얇아지게 된다. Next, dry etching is performed on the first and
다음, 도 2g에 도시한 바와 같이, 상기 남아있는 제 1 포토레지스트 패턴(도 2f의 191a)을 마스크로 하여 상기 스위칭 영역(TrA)의 상기 제 1 포토레지스트 패턴(도 2f의 191a) 사이의 노출된 소스 드레인 패턴(도 2f의 131)을 식각하고, 연속하여 상기 소스 드레인 패턴(도 2f의 131) 하부의 황화물층(128)과 불순물 비정질 실리콘 패턴(도 2f의 123)을 드라이 에칭하여 제거함으로써 상기 불순물 비정질 실리콘 패턴(도 2f의 123) 하부의 순수 비정질 실리콘의 액티브층(122)을 노출시킨다. Next, as shown in FIG. 2G, exposure between the first photoresist pattern (191a in FIG. 2F) of the switching region TrA using the remaining first photoresist pattern (191a in FIG. 2F) as a mask. The
이때, 상기 스위칭 영역(TrA)에 있어, 상기 제 1 포토레지스트 패턴(도 2f의 191a)에 의해 식각되지 않고 남아있는 소스 드레인 패턴(도 2f의 131)은 서로 이격하는 소스 및 드레인 전극(135, 137)을 형성하게 된다. At this time, in the switching region TrA, the source drain pattern (131 of FIG. 2F) remaining without being etched by the first photoresist pattern (191a of FIG. 2F) is spaced apart from each other. 137).
또한, 상기 소스 및 드레인 전극(135, 137) 하부의 서로 이격하는 불순물 비정질 실리콘 패턴(124)은 오믹콘택층(124)을 이루게 되고, 이는 그 하부의 순수 비정질 실리콘의 액티브층(122)과 더불어 반도체층(124)을 형성한다. 이때, 상기 소스 및 드레인 전극(135, 137)과 상기 오믹콘택층(124) 사이의 계면에 형성된 황화물층(128) 더욱 정확히는 황화구리(CuS)막은 상기 도전성 물질층이 되는 바 상기 오믹콘택층(124)의 특성을 더욱 향상시키게 됨과 동시에 이들 두 층(소스 및 드레인 전극(135, 137))과 오믹콘택층(124)의 접착 특성 또한 향상시키는 역할을 하게 된다. In addition, the impurity
또한, 상기 소스 및 드레인 전극(135, 137)과 데이터 배선(130)의 상부로 자연적으로 형성된 제 2 산화마그네슘(MgO)막(143)은 비록 그 두께가 매우 얇더라도 절연층을 이루게 된다. In addition, the second magnesium oxide (MgO)
또한, 상기 스위칭 영역(TrA)에 기판(101)면으로부터 순차적층 형성된 게이트 전극(109), 상기 제 1 산화마그네슘막(107) 포함하는 게이트 절연막(109), 반도체층(120), 소스 및 드레인 전극(135, 137)은 박막트랜지스터(Tr)를 형성하게 된다. In addition, the
이후, 상기 데이터 배선(130)과 소스 및 드레인 전극(135, 137) 상부로 남아있는 제 2 포토레지스트 패턴(도 2f의 191a)을 스트립(strip)하여 제거한다. Thereafter, the second photoresist pattern (191a of FIG. 2F) remaining on the
다음, 도 2h에 도시한 바와 같이, 상기 데이터 배선(130)과 소스 및 드레인 전극(135, 137) 위로 절연물질인 산화실리콘(SiO2) 또는 질화실리콘(SiNx)을 증착하거나 또는 유기절연물질인 포토아크릴 또는 벤조사이클로부텐(BCB)을 도포함으로써 보호층(150)을 형성하고, 마스크 공정을 통해 패터닝함으로써 상기 드레인 전극(137)을 노출시키는 드레인 콘택홀(155)을 형성한다. Next, as shown in FIG. 2H, silicon oxide (SiO 2 ) or silicon nitride (SiNx), which is an insulating material, is deposited on the
다음, 도 2i에 도시한 바와 같이, 상기 드레인 콘택홀(155)이 형성된 보호층(150) 위로 투명 도전성 물질인 인듐-틴-옥사이드(ITO) 또는 인듐-징크-옥사이드(IZO)를 증착하고 이를 마스크 공정을 통해 패터닝함으로써 상기 드레인 콘택홀(155)을 통해 상기 드레인 전극(137)과 접촉하는 화소전극(160)을 형성함으로써 어레이 기판(101)을 완성한다. Next, as shown in FIG. 2I, an indium tin oxide (ITO) or indium zinc oxide (IZO), which is a transparent conductive material, is deposited on the
이때, 상기 드레인 콘택홀(155)을 통해 노출된 구리마그네슘 합금(Cu-Mg alloy)으로 이루어진 드레인 전극(137) 표면에도 제 2 산화마그네슘(MgO)(143)막이 형성되었지만, 이는 매우 얇은 수준이 되는 바, 상기 드레인 전극(137)과 오믹콘택층과(124)의 접촉부에서는 오믹특성을 저하시키는 문제를 발생시키지만 모두 금속 또는 도전성 물질로 이루어진 상기 드레인 전극(137)과 화소전극(160)간에는 그 두께가 너무나 얇게 형성되는 바, 그 자체로서는 절연층으로서의 역할이 미미하여 이들 두 전극(137, 160)간의 도통에는 별 영향이 없다. At this time, a second magnesium oxide (MgO) film was formed on the surface of the
하지만, 변형예로서 보호층 형성 이후의 제조 공정 단면도를 나타낸 도 3a와 도 3b(제 1 실시예의 제조 공정 단면도와 동일한 부분에 대한 제조 공정 단면도로서 동일한 구성요소에 대해서는 100을 더하여 도면부호를 부여하였다.)를 참조하면, 도시한 바와같이, 상기 보호층(250)의 드레인 콘택홀(255) 내에서 서로 접촉하는 드레인 전극(237)과 화소전극(260)의 계면에 형성된 제 2 산화마그네슘(MgO)막(243)의 발생을 억제하고 도통에 영향을 주는 요소를 제거하기 위해서 상기 드레인 콘택홀(255)을 갖는 보호층(250)에 대해 상기 화소전극(260)을 형성하기 전 황화수소(H2S) 분위기에서 플라즈마 처리를 함으로서 상기 드레인 콘택홀(255)을 통해 노출된 드레인 전극(237)의 표면에 제 2 황 물질층(미도시)을 형성하고 이후 상기 화소전극(260)을 형성함으로써 해결할 수도 있다. 이 경우, 상기 드레인 콘택홀(255) 내부에서 상기 드레인 전극(237)과 화소전극(260) 사이에는 상기 제 2 황물질층(미도시)과 구리(Cu)가 반응하여 제 2 황화구리(CuS)막(257)이 형성되며 상 기 제 2 황화구리(CuS)막(257)은 도전특성을 갖는 바, 비록 그 수준이 미미할지라도 전술한 제 1 실시예의 드레인 콘택홀(도 2i의 255) 내부의 드레인 전극(도 2i의 137)과 화소전극(도 2i의 160)의 계면에 형성된 제 2 산화마그네슘(MgO)막(도 2i의 143)에 의한 도통 특성 저하를 더욱 방지할 수 있다. However, as a modified example, FIGS. 3A and 3B (FIG. 3A and 3B) showing the cross-sectional view of the manufacturing process after forming the protective layer (the manufacturing process cross-sectional view of the same part as the cross-sectional view of the manufacturing process of the first embodiment are denoted by adding 100 to the same component. .), As illustrated, the second magnesium oxide (MgO) formed at an interface between the
전술한 바와 같이, 회절노광을 포함하여 총 4회의 마스크 공정을 통해 완성된 본 발명에 따른 액정표시장치용 어레이 기판은 게이트 배선과 게이트 전극과, 데이터 배선과 소스 및 드레인 전극을 모두 저저항 금속물질인 구리마그네슘 합금(Cu-Mg alloy)을 이용하여 형성함으로써 대면적화에 따른 배선의 신호지연 등의 문제를 해결함과 동시에 구리 단일 물질로 배선 및 전극을 형성했을 때의 문제점인 약한 접착력에 의한 기판으로부터의 분리 문제를 해결한 것이 특징이다.As described above, the array substrate for a liquid crystal display device according to the present invention, which is completed through a total of four mask processes including diffraction exposure, has a low resistance metal material in which both the gate wiring and the gate electrode, and the data wiring and the source and drain electrodes are all formed. Formation using Cu-Mg alloy solves problems such as signal delay of wiring due to large area, and at the same time, it is weak substrate due to weak adhesion. It is characterized by solving the problem of separation from water.
또한, 나아가 구리마그네슘 합금(Cu-Mg alloy)으로 전극 또는 배선을 형성 시 발생되는 문제, 즉 타물질층과의 계면 또는 표면에 강한 반응성을 갖는 마그네슘의 반응에 의한 산화마그네슘(MgO)막이 형성됨으로써 특히 소스 및 드레인 전극과 그 하부에 위치한 오믹콘택층과의 접촉저항을 크게하여 오믹특성을 저하시키는 문제를 상기 산화마그네슘(MgO)을 증착전에 불순물 비정질 실리콘층을 황화수소(H2S) 분위기에서 플라즈마 처리를 함으로써 상기 구리마그네슘과 불순물 비정질 실리콘층의 계면에서 산화마그네슘(MgO)막의 형성을 억제하며 동시에 황화구리(CuS)막을 더욱 형성하도록 함으로서 오믹특성을 향상시킨 것을 특징으로 한다. In addition, a magnesium oxide (MgO) film is formed by a reaction of magnesium having a strong reactivity at the interface or surface with another material layer, that is, a problem caused when forming an electrode or a wiring from a Cu-Mg alloy. In particular, the problem of lowering ohmic characteristics by increasing the contact resistance between the source and drain electrodes and the ohmic contact layer disposed below the impurity amorphous silicon layer is deposited in a hydrogen sulfide (H 2 S) atmosphere before deposition of the magnesium oxide (MgO). The treatment suppresses the formation of a magnesium oxide (MgO) film at the interface between the copper magnesium and the impurity amorphous silicon layer, and simultaneously forms a copper sulfide (CuS) film, thereby improving ohmic characteristics.
전술한 제 1 실시예에 있어서는 게이트 배선과 게이트 전극 그리고 데이터 배선과 소스 및 드레인 전극을 모두 구리마그네슘 합금(Cu-Mg alloy)으로 형성한 것을 보이고 있으나, 게이트 배선과 게이트 전극은 알루미늄 또는 알루미늄 합금으로 형성할 수도 있다. In the first embodiment described above, the gate wirings and the gate electrodes, the data wirings, the source and the drain electrodes are all formed of Cu-Mg alloy, but the gate wirings and the gate electrodes are made of aluminum or an aluminum alloy. It may be formed.
이는 본 발명은 상기 구리마그네슘 합금(Cu-Mg alloy)으로 소스 및 드레인 전극을 형성 시 오믹특성 저하의 문제가 발생하는 바, 이를 개선시키는 제조방법에 특징적인 면이 있기 때문이다. This is because the present invention causes a problem of deterioration of ohmic characteristics when the source and drain electrodes are formed of the Cu-Mg alloy, which is characteristic of a manufacturing method for improving the same.
<제 2 실시예>Second Embodiment
본 발명의 제 2 실시예는 5마스크 공정에 의한 액정표시장치용 어레이 기판의 제조 방법에 대한 것이다.A second embodiment of the present invention relates to a method of manufacturing an array substrate for a liquid crystal display device by a five mask process.
도 4a 내지 4i는 본 발명의 제 2 실시예에 따른 구리마그네슘 합금(Cu-Mg alloy)을 이용한 액정표시장치용 어레이 기판의 5마스크 공정에 따른 제조 단계별 단면을 도시한 것으로써 스위칭 소자인 박막트랜지스터를 포함하는 하나의 화소영역에 대한 단면도이다. 이때, 상기 박막트랜지스터가 형성되는 영역을 스위칭 영역이라 정의한다.4A to 4I illustrate cross-sectional views of manufacturing steps according to a five-mask process of an array substrate for a liquid crystal display device using a Cu-Mg alloy according to a second embodiment of the present invention. A cross-sectional view of one pixel area including a. In this case, an area in which the thin film transistor is formed is defined as a switching area.
우선, 도 4a에 도시한 바와 같이, 투명한 절연기판(301) 상에 구리마그네슘 합금(Cu-Mg alloy)을 증착하여 제 1 금속층(미도시)을 형성한 후, 이를 제 1 마스크 공정을 실시하여 패터닝함으로써 일방향으로 연장하는 게이트 배선(미도시)과, 상기 게이트 배선(미도시)에서 각 화소영역(P)으로 분기한 형태의 게이트 전극(305)을 형성한다.First, as shown in FIG. 4A, a Cu-Mg alloy is deposited on a transparent insulating
다음, 도 4b에 도시한 바와 같이, 상기 게이트 배선(미도시)과 게이트 전극(305) 위로 절연물질 예를들면 산화실리콘(SiO2) 또는 질화실리콘(SiNx)을 증착하여 게이트 절연막(309)을 형성한다. 이때 상기 게이트 절연막(309) 하부에 위치한 게이트 배선(미도시)과 게이트 전극(305)은 이를 이루는 금속물질인 구리마그네슘 합금(Cu-Mg alloy) 내에 반응성이 매우 좋은 물질인 마그네슘(Mg)이 포함되어 있는 바, 상기 마그네슘(Mg)이 특히 산소와 반응하여 그 표면 및 상기 기판(301)과의 계면에는 자연적으로 제 1 산화마그네슘(MgO)막(307)이 형성되어 진다. Next, as shown in FIG. 4B, an insulating material, for example, silicon oxide (SiO 2 ) or silicon nitride (SiNx), is deposited on the gate wiring (not shown) and the
다음, 도 4c에 도시한 바와 같이, 상기 게이트 절연막(309) 위로 순수 비정질 실리콘과 불순물 비정질 실리콘을 순차적으로 증착하여 순수 비정질 실리콘층(미도시)과 불순물 비정질 실리콘층(미도시)을 형성하고, 이에 제 2 마스크 공정을 실시하여 패터닝함으로써 상기 스위칭 영역(Tr)의 상기 게이트 전극(305)에 대응하여 순수 및 불순물 비정질 실리콘 패턴(322, 323)의 이중층 구조의 반도체 패턴(320)을 형성한다. Next, as shown in FIG. 4C, pure amorphous silicon and impurity amorphous silicon are sequentially deposited on the
다음, 도 4d에 도시한 바와 같이, 상기 이중층 구조의 반도체 패턴(320)이 형성된 기판(301)을 황화수소(H2S) 분위기에서 플라즈마 처리함으로서 상기 불순물 반도체 패턴(323) 상부에 수십 나노미터 ~ 수 옹거스트롱(Å)정도의 얇은 두께를 갖는 황 물질층(327)을 형성한다. 이를 형성한 이유에 대해서는 제 1 실시예에 상세히 설명하였으므로 그 설명은 생략한다. Next, as shown in FIG. 4D, the
다음, 도 4e에 도시한 바와 같이, 상기 반도체 패턴(도 4d의 320) 상부로 황 물질층(도 4d의 327)이 형성된 기판(301)에 구리마그네슘 합금(Cu-Mg alloy)을 증착하여 제 2 금속층(미도시)을 형성하고, 제 3 마스크 공정을 실시함으로써 이를 패터닝하여 상기 게이트 배선(미도시)과 교차하여 화소영역(P)을 정의하는 데이터 배선(330)과, 상기 스위칭 영역(TrA)에 상기 데이터 배선(330)에서 분기하여 상기 반도체 패턴(도 4d의 320) 더욱 정확히는 상기 반도체 패턴(도 4d의 320) 상부의 황 물질층(도 4d의 327)과 접촉하는 소스 전극(335)과, 상기 소스 전극(335)에서 이격하여 상기 황 물질층(도 4d의 327)과 접촉하는 드레인 전극(337)을 형성한다. Next, as shown in FIG. 4E, a Cu-Mg alloy is deposited on the
이때, 상기 소스 및 드레인 전극(335, 337)의 상부 표면에는 제 2 산화마그네슘(MgO)막(343)이 자연적으로 형성되며 그 하부는 상기 황 물질층(도 4d의 327)과 구리(Cu)가 반응하여 황화물층인 황화구리(CuS)막(328)을 형성하게 된다. 즉, 상기 황 물질층(도 4d의 327)이 그 상부에 형성된 구리 마그네슘 합금(Cu-Mg alloy)과 반응하여 황화구리(CuS)막으로 변하게 된다. In this case, a second magnesium oxide (MgO)
또한 상기 데이터 배선(330)에 대해서도 그 상부 표면에는 제 2 산화마그네슘(MgO)막(343)이 형성되고 상기 게이트 절연막(309)과의 계면에서는 황화구리(CuS)막(328)이 형성된다. A second magnesium oxide (MgO)
이는 상기 반도체 패턴(도 4d의 320)을 형성한 후, 상기 반도체 패턴(도 4d의 320)을 포함하여 기판(301) 전면에 대해 상기 황화수소(H2S) 분위기에서 플라즈마 처리함으로써 상기 반도체 패턴(도 4d의 320) 상부 뿐 아니라 상기 반도체 패턴(도 4d의 320) 외부로 노출된 게이트 절연막(309) 상부에도 상기 황 물질층(도 4d의 327)이 형성되었기 때문이다. After the semiconductor pattern (320 of FIG. 4D) is formed, the semiconductor pattern (320) of the semiconductor pattern (320 of FIG. 4D) may be plasma-processed in the hydrogen sulfide (H 2 S) atmosphere on the entire surface of the
이때, 상기 도전성 특성을 갖는 상기 황화구리(CuS)막(328)은 실제적으로 상기 제 2 금속층(미도시) 하부에 대해 전면적으로 형성되었지만, 이를 패터닝하여 상기 데이터 배선(330)과 소스 및 드레인 전극(335, 337)을 형성하는 단계에서 식각되어 제거되며 최종적으로는 상기 데이터 배선(330)과 소스 및 드레인 전극(335, 337)의 하부에만 형성되게 된다.In this case, the copper sulfide (CuS)
다음, 상기 서로 이격하는 소스 및 드레인 전극(335, 337) 외부로 노출된 황물질층(도 4d의 327)과 그 하부의 이중층 구조의 반도체 패턴(도 4d의 320) 중 불순물 비정질 실리콘 패턴(도 4d의 323)을 상기 소스 및 드레인 전극(335, 337)을 마스크로 하여 드라이 에칭함으로써 서로 이격하는 불순물 비정질 실리콘의 오믹콘택층(324)을 형성한다. 이때, 연결된 상태로 남아있는 순수 비정질 실리콘 패턴(322)은 액티브층(322)을 이루게 된다.Next, an impurity amorphous silicon pattern (FIG. Dry etching of
다음, 도 4f에 도시한 바와 같이, 상기 데이터 배선(330)과 소스 및 드레인 전극(335, 337)에 대응하여 그 표면에 제 2 산화마그네슘(MgO)막(343)이 형성된 기판(301) 위로 전면에 무기절연물질인 산화실리콘(SiO2) 또는 질화실리콘(SiNx)을 증착하거나 또는 유기절연물질인 포토아크릴 또는 벤조사이클로부텐(BCB을 도포함으로써 보호층(350)을 형성하고, 마스크 공정을 통해 패터닝함으로써 상기 드레인 전극(337)을 노출시키는 드레인 콘택홀(355)을 형성한다. Next, as shown in FIG. 4F, on the
다음, 도 4g에 도시한 바와 같이, 상기 드레인 콘택홀(355)이 형성된 보호 층(350) 위로 투명 도전성 물질인 인듐-틴-옥사이드(ITO) 또는 인듐-징크-옥사이드(IZO)를 증착하고 이를 마스크 공정을 통해 패터닝함으로써 상기 드레인 콘택홀(355)을 통해 상기 드레인 전극(337)과 접촉하는 화소전극(360)을 형성함으로써 어레이 기판(301)을 완성한다. Next, as shown in FIG. 4G, an indium tin oxide (ITO) or an indium zinc oxide (IZO), which is a transparent conductive material, is deposited on the
전술한 제 2 실시예도 마찬가지로 실제적으로는 상기 드레인 콘택홀(355) 내에 서로 접촉하는 화소전극(360)과 드레인 전극(337) 사이에는 수십 나노미터 ~ 수 옹거스트롱(Å) 수준의 제 2 산화마그네슘(MgO)막(343)이 형성되는 바, 이들 두 전극(337, 360)의 전기적 도통에는 미미하지만 영향을 줄 수 있다. 따라서 그 변형예로써 도면으로 나타내지는 않았지만, 제 1 실시예의 변형예와 같이 상기 보호층 내에 상기 드레인 콘택홀을 노출시키는 드레인 콘택홀을 형성한 후, 황화수소(H2S) 분위기에서 제 2 차 플라즈마 처리를 함으로써 상기 드레인 콘택홀 내의 상기 노출된 드레인 전극 상부에 제 2 황 물질층을 형성한 후, 화소영역별로 패터닝된 화소전극을 형성함으로써 상기 드레인 콘택홀 내에서 노출된 드레인 전극과 그 상부에 위치한 화소전극 사이에 상기 제 2 산화마그네슘(MgO)막(343) 대신 도전성 특성을 갖는 황화구리(CuS)막이 형성되도록 하여 도통 특성을 더욱 향상시킬 수도 있다. Similarly, the second embodiment described above also has a second magnesium oxide having a level of several tens of nanometers to several angstroms between the pixel electrode 360 and the
전술한 바와 같이, 저항이 비교적 낮은 구리마그네슘 합금(Cu-Mg alloy)으로 게이트 배선 및 게이트 전극과 데이터 배선과 소스 및 드레인 전극을 형성하게 되 면, As described above, when the gate wiring, the gate electrode, the data wiring, the source and the drain electrode are formed of a Cu-Mg alloy having a relatively low resistance,
첫째, 표시소자의 면적이 커져도 신호배선에 의한 신호 지연이 발생하지 않기 때문에 액정표시장치가 대면적화 될 수 있는 효과가 있으며.First, even if the area of the display device is increased, the signal delay due to signal wiring does not occur, so that the liquid crystal display device can have a large area.
둘째, 순수한 구리로써 배선을 형성할 경우 상기 구리의 약한 접착력 특성에 의한 기판으로부터의 분리되는 문제를 해결하는 효과가 있으며, 나아가 황화수소(H2S) 분위기에서 플라즈마 처리를 실시함으로써 마그네슘의 반응성에 의한 산화마그네슘(MgO)막 형성을 억제함으로서 오믹 특성을 향상시키는 효과가 있다.Second, when the wiring is formed of pure copper, there is an effect of solving the problem of separation from the substrate due to the weak adhesive property of the copper, and further, by performing a plasma treatment in hydrogen sulfide (H2S) atmosphere, magnesium oxide due to the reactivity of magnesium By suppressing the (MgO) film formation, there is an effect of improving ohmic characteristics.
세째, 신호배선을 구리마그네슘으로 사용하게 되면 그 고유저항이 매우 낮으므로, 신호배선의 폭을 현저히 줄일 수 있기 때문에 개구율을 개선할 수 있는 효과가 있다.Third, when the signal wiring is used as copper magnesium, its resistivity is very low, so that the width of the signal wiring can be significantly reduced, thereby improving the aperture ratio.
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