KR20070071415A - 액정 표시 장치 - Google Patents

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KR20070071415A
KR20070071415A KR1020050134822A KR20050134822A KR20070071415A KR 20070071415 A KR20070071415 A KR 20070071415A KR 1020050134822 A KR1020050134822 A KR 1020050134822A KR 20050134822 A KR20050134822 A KR 20050134822A KR 20070071415 A KR20070071415 A KR 20070071415A
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최남곤
전병길
박재형
박보윤
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삼성전자주식회사
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Abstract

액정 패널의 한 화소를 세 개의 부화소로 나누고, 두 개의 부화소에는 서로 다른 레벨의 데이터 전압을 인가하여 액정 패널의 측면 시인성을 향상시키고, 하나의 부화소는 임펄시브 구동용 화소로 이용하여 액정 패널의 블러링 현상을 제거하여 액정 표시 장치의 표시 품질을 향상시킨다.

Description

액정 표시 장치{Liquid Crystal Display Device}
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 블록도이다.
도 2는 도 1에 도시된 액정 패널의 한 화소의 구성을 보여주는 것이다.
도 3은 도 1에 도시된 액정 패널의 한 화소에 대한 등가 회로도이다.
도 4는 도 1에 도시된 제 2 계조전압 생성부의 동작 방법을 보여주는 것이다.
도 5는 도 1에 도시된 제 2 데이터 구동부의 구체적인 블록도이다.
도 6은 도 1에 도시된 액정 표시 장치의 구동 신호를 보여주는 타이밍도이다.
* 도면의 주요 부분에 대한 부호의 설명 *
10: 액정 표시 장치 100: 액정 패널
200: 타이밍 컨트롤러 300a: 제 1 계조전압 생성부
300b: 제 2 계조전압 생성부 400a: 제 1 데이터 구동부
400b: 제 2 데이터 구동부 410: 쉬프트 레지스터
420: 래치 430: 디지털-아날로그 변환부
440: 출력 버퍼 500: 게이트 구동부
본 발명은 표시 장치(Display Device)에 관한 것으로, 구체적으로 액정 표시 장치(LCD: Liquid Crystal Display Device)에 관한 것이다.
음극선관(Cathode Ray Tube)을 이용한 표시 장치와 더불어 영상 표시 장치의 중요한 분야를 차지하고 있는 것 중에 하나가 액정 표시 장치이다. 액정 표시 장치는 일정한 공간을 갖고 합착된 두 개의 기판(유리 기판) 사이에 액정이 주입된 표시장치이다. 액정 표시 장치는 액정에 전계를 인가하고, 이 전계의 세기를 조절함으로써 기판에 투과되는 빛의 양을 조절하는 것이 가능하다. 이러한 제어 방식으로 원하는 화상 신호가 표시된다.
최근 들어, 액정 표시 장치는 더 많은 화상 정보를 표현하기 위해 대형화되는 추세이다. 대면적 액정 패널을 채택하는 액정 표시 장치는 화면을 바라보는 위치에 따라 표시된 영상 이미지가 왜곡되어 표시 품질이 저하된다. 또한, 액정 표시 장치는 동영상을 표시할 때 물체의 윤곽이 선명하지 못하고 흐릿해지는 문제점이 있다.
본 발명의 목적은 영상의 표시 품질을 높이면서도, 측면 시인성이 향상된 액정 표시 장치를 제공하는데 있다.
본 발명에 따른 액정 표시 장치는 액정 패널, 타이밍 컨트롤러, 그리고 구동 부를 포함한다. 액정 패널은 매트릭스 형태로 배열된 다수의 화소를 포함하고, 타이밍 컨트롤러는 영상 데이터 신호를 입력받아 제어 신호를 출력한다. 구동부는 상기 제어 신호에 응답하여 상기 액정 패널을 구동한다. 액정 패널의 각 화소는 화소 전극, 제 1, 제 2 및 제 3 박막 트랜지스터, 제 1, 제 2 및 제 3 데이터 라인, 제 1 및 제 2 게이트 라인을 포함한다. 화소 전극은 제 1, 제 2 및 제 3 부화소 전극을 포함하고, 제 1, 제 2 및 제 3 박막 트랜지스터는 상기 제 1, 제 2 및 제 3 부화소 전극에 각각 연결된다. 제 1, 제 2 및 제 3 데이터 라인은 상기 제 1, 제 2 및 제 3 박막 트랜지스터의 소스와 각각 연결된다. 제 1 게이트 라인은 상기 제 1 및 제 2 박막 트랜지스터의 게이트에 공통으로 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차한다. 제 2 게이트 라인은 상기 제 3 박막 트랜지스터의 게이트와 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차한다.
본 발명에 따른 액정 표시 장치는 액정 패널, 타이밍 컨트롤러, 게이트 구동부, 데이터 구동부, 그리고 계조전압 생성부를 포함한다. 액정 패널은 매트릭스 형태로 배열된 다수의 화소를 포함하고, 타이밍 컨트롤러는 영상 데이터 신호를 입력받아 제어 신호들 및 데이터 신호를 출력한다. 게이트 구동부는 상기 타이밍 컨트롤러로부터의 제어 신호들에 응답하여 상기 액정 패널을 구동한다. 데이터 구동부는 상기 데이터 신호를 입력받고, 서로 다른 레벨을 갖는 제 1 계조전압 및 제 2 계조전압에 응답하여, 서로 다른 레벨을 갖는 제 1, 제 2 및 제 3 데이터 전압을 상기 화소로 제공한다. 계조전압 생성부는 상기 제 1 및 제 2 계조전압을 상기 데이터 구동부로 제공한다.
이하 본 발명에 따른 실시예를 첨부된 도면들을 참조하여 상세히 설명하도록 한다.
본 발명을 설명함에 있어, 액정 표시 장치는 측면 시인성을 향상시키기 위해 액정의 수직 배향(Vertical Alignment) 모드를 이용한다. 수직 배향 모드는 전기장이 인가되지 않은 상태에서는 액정 분자가 수직으로 분포하며, 액정에 전압이 인가되면 전기장 방향에 수직하게 배열되는 액정을 이용한다. 수직 배향 모드 중 S-PVA(Super-Patterned Vertical Alignment)는 한 화소를 두 개의 부화소로 구분하여 각 부화소에 대한 액정의 충전율을 서로 다르게 조절한다. 두 개의 부화소에 대한 충전율 차이는 투과율 차이를 유도하여 액정 표시 장치의 측면 시인성을 향상시키게 된다.
또한, 본 발명의 액정 표시 장치는 임펄시브(Impulsive) 구동 방식을 이용한다. 임펄시브 구동 방식은 액정 표시 장치에서 동영상을 표시할 때 물체의 윤곽이 선명하지 못하고 흐릿해지는 블러링(Blurring) 현상을 제거하기 위하여, 원하는 정규 영상을 표시하면서 그 중간에 검은색(블랙) 영상을 표시하는 방식이다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 블록도이고, 도 2는 도 1에 도시된 액정 패널의 한 화소의 구성을 보여주는 것이다.
도 1을 참조하면, 액정 표시 장치(10)는 액정 패널(100), 타이밍 컨트롤러(200), 계조전압 생성부(300a, 300b), 데이터 구동부(400a, 400b), 그리고 게이트 구동부(300)를 포함한다.
액정 패널(100)은 복수의 데이터 라인(D1a~Dmc), 복수의 게이트 라인 (G1a~Gnb), 그리고 데이터 라인(D1a~Dmc)과 게이트 라인(G1a~Gnb)으로 둘러싸이며, 매트릭스(Matrix) 형태로 배열된 복수의 화소(PX)를 포함한다. 데이터 라인들(D1a~Dmc)은 액정 패널(100)의 열 방향으로 서로 평행하게 배열되고, 게이트 라인들(G1a~Gnb)은 액정 패널(100)의 행 방향으로 서로 평행하게 배열된다.
도 2를 참조하면, 액정 패널(100)의 각 화소(PX)는 서로 마주보는 하부 및 상부 기판(110, 120)과, 하부 기판(110)과 상부 기판(120) 사이에 들어있는 액정층(130)을 포함한다. 각 화소(PX)는 세 개의 부화소를 포함하며, 각 부화소는 액정 축전기(Liquid Crystal Capacitor)(CLCa, CLCb, CLCc)를 갖는다. 액정 축전기(CLCa, CLCb, CLCc)는 하부 기판(110)의 부화소 전극(PEa, PEb, PEc)과 상부 기판(120)의 공통 전극(CE)을 두 단자로 하며, 두 단자 사이의 액정층(130)은 유전체로서 기능한다.
세 개의 부화소 전극(PEa, PEb, PEc)은 서로 분리되어 있으며, 하나의 화소 전극(PE)을 이룬다. 공통 전극(CE)은 상부 기판(120)의 일면에 형성되어 있으며, 공통 전압(Common Voltage, VCOM)을 인가받는다. 액정층(130)은 음의 유전율 이방성을 가지며, 액정층(130)의 액정 분자는 전기장이 없는 상태에서 그 장축이 하부 및 상부 기판(110, 120)의 표면에 대하여 수직하게 배향된다.
타이밍 컨트롤러(200)는 데이터 구동부(400a, 400b) 및 게이트 구동부(500)에서 요구되는 타이밍에 맞도록 영상 데이터 신호들(R, G, B)을 조절하여 출력한다. 또한, 타이밍 컨트롤러(200)는 데이터 구동부(400a, 400b) 및 게이트 구동부(500)를 제어하는 제 1 및 제 2 제어 신호들(CNTL1, CNTL2)을 출력한다. 타이밍 컨 트롤러(200)로부터 데이터 구동부(400a, 400b)로 제공되는 제 1 제어 신호(CNTL1)에는 수평 동기 시작 신호(STH), 데이터 출력 신호(TP) 등이 있다. 타이밍 컨트롤러(200)로부터 게이트 구동부(500)로 제공되는 제 2 제어 신호(CNTL2)에는 주사 시작 신호(STV), 게이트 클럭 신호(CPV), 출력 인에이블 신호(OE) 등이 있다.
타이밍 컨트롤러(200)에서 제 1 및 제 2 데이터 구동부(400a, 400b)로 출력되는 출력 영상 신호(DAT)는 입력 영상 신호(R, G, B)에 대응한 디지털 신호 값으로, 영상 데이터 신호와 임펄시브 구동을 위한 임펄시브 데이터 신호를 포함한다.
제 1 및 제 2 계조전압 생성부(300a, 300b)는 액정 패널(100)의 상하에 위치한다. 제 1 계조전압 생성부(300a)는 화소(PX)의 투과율과 관련된 복수의 계조전압을 생성한다. 두 개의 계조전압은 한 화소(PX)에 대한 두 부화소 전극(PEa, PEb)에 각각 인가되며, 두 계조전압의 레벨은 서로 상이한 것을 특징으로 한다. 제 2 계조전압 생성부(300b)는 임펄시브 데이터 전압에 대응하는 기준 계조전압을 생성한다.
상기에서 제 1 및 제 2 계조전압 생성부(300a, 300b)는 별도로 형성되어 있는 것으로 설명하였으나, 제 1 및 제 2 계조전압 생성부(300a, 300b)는 하나의 계조전압 생성부가 두 부분으로 나뉘어 있을 수도 있다.
제 1 및 제 2 데이터 구동부(400a, 400b)는 액정 패널(100)의 상하에 위치한다. 제 1 데이터 구동부(400a)는 제 1 계조전압 생성부(300a)와 연결되고, 제 2 데이터 구동부(400b)는 제 2 계조전압 생성부(300b)와 연결된다.
제 1 및 제 2 데이터 구동부(400a, 400b)는 타이밍 컨트롤러(200)로부터 인가되는 제 1 제어 신호(CNTL1)와, 제 1 및 제 2 계조전압 생성부(300a, 300b)로부 터 인가되는 계조전압에 응답하여, 액정 패널(100)의 데이터 라인들(D1a~Dmc)을 구동한다. 제 1 및 제 2 데이터 구동부(400a, 400b)는 액정 패널(100)을 기준으로 한 쪽에 모두 형성될 수도 있다.
제 1 데이터 구동부(400a)는 타이밍 컨트롤러(200)로부터 제 1 제어 신호(CNTL1)와 한 화소 행에 대한 출력 영상 신호(DAT)를 입력받아, 제 1 계조전압 생성부(300a)에서 생성한 계조전압 중 각 출력 영상 신호(DAT)에 대응하는 계조전압을 선택한다. 이후, 제 1 데이터 구동부(400a)는 선택된 계조전압을 대응하는 아날로그 영상 데이터 전압으로 변환한 후, 이를 해당하는 데이터 라인들(D1a, D1b, D2a, D2b, ..., Dma, Dmb)에 인가한다.
제 2 데이터 구동부(400b)는 타이밍 컨트롤러(200)로부터 제 1 제어 신호(CNTL1)와 한 화소 행에 대한 출력 영상 신호(DAT)를 입력받아, 제 2 계조전압 생성부(300b)에서 생성한 계조전압 중 각 출력 영상 신호(DAT)에 대응하는 계조전압을 선택한다. 이후, 제 2 데이터 구동부(400b)는 선택된 계조전압을 대응하는 아날로그 영상 데이터 전압으로 변환한 후, 이를 해당하는 데이터 라인들(D1c, D2c, ..., Dmc)에 인가한다. 이때, 해당 데이터 라인들(D1c, D2c, ..., Dmc)로 인가되는 영상 데이터 전압은 임펄시브 데이터가 변환된 임펄시브 데이터 전압이다.
게이트 구동부(500)는 타이밍 컨트롤러(200)로부터 입력된 제 2 제어 신호(CNTL2)와 구동 전압 생성부(미 도시됨)로부터 출력된 게이트 온 전압(VON) 및 게이트 오프 전압(VOFF)에 응답하여, 액정 패널(100)의 게이트 라인들(G1a~Gnb)을 구동한다. 게이트 구동부(500)는 게이트 라인들(G1a~Gnb)을 통해 각 화소(PX)로 게이 트 전압을 인가하여, 각 화소(PX)를 구성하는 박막 트랜지스터를 턴온 또는 턴오프시킨다.
도 3은 도 1에 도시된 액정 패널의 한 화소에 대한 등가 회로도이다.
도 3을 참조하면, 한 화소(PX)는 세 개의 데이터 라인(D1a, D1b, D1c)과 두 개의 게이트 라인(G1a, G1b)과, 세 개의 부화소(PXa, PXb, PXc)를 포함한다.
제 1 부화소(PXa)는 제 1 박막 트랜지스터(Ta)와 제 1 액정 커패시터(CLCa)로 구성된다. 제 1 박막 트랜지스터(Ta)의 게이트는 제 1 게이트 라인(G1a)과 연결되고, 소스는 제 1 데이터 라인(D1a)과 연결되며, 드레인은 제 1 액정 커패시터(CLCa)의 일단자와 연결된다.
제 2 부화소(PXb)는 제 2 박막 트랜지스터(Tb)와 제 2 액정 커패시터(CLCb)로 구성된다. 제 2 박막 트랜지스터(Tb)의 게이트는 제 1 게이트 라인(G1a)과 연결되고, 소스는 제 2 데이터 라인(D1b)과 연결되며, 드레인은 제 2 액정 커패시터(CLCb)의 일단자와 연결된다.
제 3 부화소(PXc)는 제 3 박막 트랜지스터(Tc)와 제 3 액정 커패시터(CLCc)로 구성된다. 제 3 박막 트랜지스터(Tc)의 게이트는 제 2 게이트 라인(G1b)과 연결되고, 소스는 제 3 데이터 라인(D1c)과 연결되며, 드레인은 제 3 액정 커패시터(CLCc)의 일단자와 연결된다.
도 3에 도시된 제 1 및 제 2 데이터 라인(D1a, D1b)은 도 1에 도시된 제 1 데이터 구동부(400a)와 연결되어, 제 1 및 제 2 부화소(PXa, PXb)에 다른 레벨의 영상 데이터 전압을 인가한다. 도 3에 도시된 제 3 데이터 라인(D1c)은 도 1에 도 시된 제 2 데이터 구동부(400b)와 연결되어, 제 3 부화소(PXc)에 임펄시브 데이터 전압을 인가한다.
제 1 게이트 라인(G1a)은 도 1에 도시된 게이트 구동부(500)와 연결되며, 제 1 게이트 라인(G1a)을 통해 인가되는 게이트 전압은 제 1 및 제 2 부화소(PXa, PXb)의 제 1 및 제 2 박막 트랜지스터(Ta, Tb)를 동시에 턴온시킨다. 제 2 게이트 라인(G1b)은 도 1에 도시된 게이트 구동부(500)와 연결되며, 제 2 게이트 라인(G1b)을 통해 인가되는 게이트 전압은 제 3 부화소(PXc)의 제 3 박막 트랜지스터(Tc)를 턴온시킨다.
도 4는 도 1에 도시된 제 2 계조전압 생성부의 동작 방법을 보여주는 것이다.
도 4를 참조하면, 제 2 계조전압 생성부(300b)는 기준 계조전압을 임펄시브 계조전압으로 변환한다. 임펄시브 데이터 전압은 블랙을 표시하는 계조의 전압이다. 예를 들어, 기준 계조전압의 수가 정극성(+)이 9개(GAMMA 1~9)이고, 부극성(-)이 9개(GAMMA 18~10)인 경우에는 정극성(+)의 기준 계조전압은 모두 블랙을 표시하는 계조전압 1로 변환하고, 부극성(-)의 기준 계조전압은 모두 블랙을 표시하는 계조전압 18로 변환한다. 따라서, 제 2 계조전압 생성부(300b)는 모든 기준 계조전압을 블랙을 표시하는 계조전압으로 변환한 후, 제 2 데이터 구동부(400b)로 인가한다.
도 5는 도 1에 도시된 제 2 데이터 구동부의 구체적인 블록도이다.
도 5를 참조하면, 제 2 데이터 구동부(400b)는 쉬프트 레지스터(410), 래치 (420), 디지털-아날로그 변환부(430), 그리고 출력 버퍼(440)를 포함한다.
쉬프트 레지스터(410)는 타이밍 컨트롤러(200)로부터 인가된 데이터 클럭 신호(HCLK)에 따라 입력된 영상 데이터(DAT)를 차례로 쉬프트시켜 래치(420)로 전달한다.
래치(420)는 쉬프트 레지스터(410)로부터 영상 데이터(DAT)를 차례로 입력받아 기억한다. 래치(420)는 타이밍 컨트롤러(200)로부터 출력된 데이터 출력 신호(TP)에 응답하여, 저장된 영상 데이터(DAT)를 디지털-아날로그 변환부(430)로 전송한다.
디지털-아날로그 변환부(430)는 래치(420)로부터 출력된 디지털 영상 데이터(DAT)를 제 2 계조전압 생성부(300b)로부터 인가받은 임펄시브 계조전압(BLACK GAMMA)에 따라 아날로그 데이터 전압으로 변환하여 출력 버퍼(440)로 전송한다.
출력 버퍼(440)는 디지털-아날로그 변환부(430)로부터 출력된 임펄시브 데이터 전압을 출력 단자(Y1~Yn)를 통하여 전송한다. 출력 버퍼(440)의 출력 단자(Y1~Yn)는 제 3 데이터 라인(D1c, D2c, ..., Dmc)과 연결된다.
도 6은 도 1에 도시된 액정 표시 장치의 구동 신호를 보여주는 타이밍도이다.
도 6을 참조하면, 먼저 블랙 주사 시작 신호(BLACK STV)가 제 2 게이트 라인(G1b)에 인가되고, 이어서 블랙 게이트 클럭 신호(BLACK CPV)가 제 2 게이트 라인(G1b)에 인가된다. 이에 따라, 제 2 게이트 라인(G1b)을 통해 게이트 온 전압(VON)이 제 3 박막 트랜지스터(Tc)의 게이트로 인가되어, 제 3 박막 트랜지스터(Tc)가 턴온된다. 제 3 박막 트랜지스터(Tc)가 턴온되면, 제 3 데이터 라인(D1c)을 통해 임펄시브 데이터 전압이 제 3 부화소(PXc)로 인가된다.
이어서, 1/2 프레임에 해당하는 시간이 지난 후에, 데이터 주사 시작 신호(DATA STV)가 제 1 게이트 라인(G1a)에 인가되고, 데이터 게이트 클럭 신호(DATA CPV)가 제 1 게이트 라인(G1a)에 인가된다. 이에 따라, 제 1 게이트 라인(G1a)을 통해 게이트 온 전압(VON)이 제 1 및 제 2 박막 트랜지스터(Ta, Tb)의 게이트로 인가되어, 제 1 및 제 2 박막 트랜지스터(Ta, Tb)가 동시에 턴온된다. 제 1 및 제 2 박막 트랜지스터(Ta, Tb)가 턴온되면, 제 1 및 제 2 데이터 라인(D1a, D1b)을 통해 서로 다른 레벨의 데이터 전압이 제 1 및 제 2 부화소(PXa, PXb)로 인가된다.
여기서, 제 1 및 제 2 게이트 라인(G1a, G1b)에 각각 인가되는 블랙 및 데이터 주사 시작 신호(BLACK STV, DATA STV)와 블랙 및 데이터 게이트 클럭 신호(BLACK CPV, DATA CPV)는 약 1/2 프레임에 해당하는 시간을 두고 인가되는 것을 설명하였으나, 이러한 시간 간격은 다양하게 변화할 수 있다.
이와 같이, 액정 패널(100)의 한 화소(PX)는 영상 데이터 전압을 인가받는 제 1 및 제 2 부화소(PXa, PXb)와 임펄시브 데이터 전압을 인가받는 제 3 부화소(PXc)를 포함한다. 본 발명의 액정 패널(100)은 복수의 화소 행에 대해 임펄시브 데이터 전압과 영상 데이터 전압을 순차적으로 인가하여, 정규 영상과 블랙 영상을 교대로 표시함으로써 영상의 블러링 현상을 방지한다.
한편, 액정 패널(100)의 제 1 및 제 2 부화소(PXa, PXb)는 별개의 데이터 라인들(D1a, D1b)을 통해 서로 다른 레벨의 데이터 전압을 인가받는다. 예를 들어, 제 1 데이터 라인(D1a)을 통해 제 1 부화소(PXa)로 인가되는 전압의 레벨은 제 2 데이터 라인(D1b)을 통해 제 2 부화소(PXb)로 인가되는 전압의 레벨보다 크다.
이렇게 제 1 및 제 2 데이터 라인(D1a, D1b)을 통해 제 1 및 제 2 부화소(PXa, PXb)로 인가된 서로 다른 레벨의 데이터 전압은 제 1 및 제 2 액정 커패시터(CLCa, CLCb) 양단에 서로 다른 전위차를 발생시킨다. 제 1 및 제 2 액정 커패시터(CLCa, CLCb) 양단의 서로 다른 전위차는 액정 분자들의 기울어지는 각도의 차이를 유발하고, 이에 따라 제 1 및 제 2 부화소(PXa, PXb)의 휘도가 달라진다. 따라서, 제 1 액정 커패시터(CLCa)의 전압과 제 2 액정 커패시터(CLCb)의 전압을 적절하게 조정하면, 액정 패널(100)의 측면에서 바라보는 영상이 정면에서 바라보는 영상에 최대한 가깝게 할 수 있다. 즉, 측면 감마 곡선을 정면 감마 곡선에 최대한 가깝게 할 수 있으며, 이에 따라, 액정 패널(100)의 측면 시인성이 향상된다.
이상과 같이 도면과 명세서에서 최적 실시 예가 개시되었다. 여기서 특정한 용어들이 사용되었으나, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미한정이나 특허청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의해 정해져야 할 것이다.
이상과 같은 본 발명에 의하면, 액정 패널의 한 화소를 세 개의 부화소로 나 누고, 두 개의 부화소에는 서로 다른 레벨의 데이터 전압을 인가하여 액정 패널의 측면 시인성을 향상시키고, 하나의 부화소는 임펄시브 구동용 화소로 이용하여 액정 패널의 블러링 현상을 제거하여 액정 표시 장치의 표시 품질을 향상시킨다.

Claims (12)

  1. 매트릭스 형태로 배열된 다수의 화소를 갖는 액정 패널;
    영상 데이터 신호를 입력받아 제어 신호를 출력하는 타이밍 컨트롤러; 및
    상기 제어 신호에 응답하여 상기 액정 패널을 구동하는 구동부를 포함하며,
    상기 다수의 화소 각각은,
    제 1, 제 2 및 제 3 부화소 전극을 갖는 화소 전극;
    상기 제 1, 제 2 및 제 3 부화소 전극에 각각 연결되는 제 1, 제 2 및 제 3 박막 트랜지스터;
    상기 제 1, 제 2 및 제 3 박막 트랜지스터의 소스와 각각 연결되는 제 1, 제 2 및 제 3 데이터 라인;
    상기 제 1 및 제 2 박막 트랜지스터의 게이트에 공통으로 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차하는 제 1 게이트 라인; 및
    상기 제 3 박막 트랜지스터의 게이트와 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차하는 제 2 게이트 라인을 포함하는 것을 특징으로 하는 액정 표시 장치.
  2. 제 1 항에 있어서,
    상기 제 1 및 제 2 게이트 라인은 제 1 및 제 2 게이트 온 전압을 상기 제 1, 제 2 및 제 3 박막 트랜지스터의 게이트로 각각 전달하고,
    상기 제 1 및 제 2 데이터 라인은 제 1 및 제 2 영상 데이터 전압을 상기 제 1 및 제 2 박막 트랜지스터의 소스로 각각 전달하며,
    상기 제 3 데이터 라인은 임펄시브 데이터 전압을 상기 제 3 박막 트랜지스터의 소스로 전달하는 것을 특징으로 하는 액정 표시 장치.
  3. 제 2 항에 있어서,
    상기 구동부는,
    상기 제 1 및 제 2 게이트 라인으로 상기 제 1 및 제 2 게이트 온 전압을 인가하는 게이트 구동부;
    제 1 계조전압에 응답하여, 상기 제 1 및 제 2 데이터 라인으로 상기 제 1 및 제 2 영상 데이터 전압을 인가하는 제 1 데이터 구동부;
    제 2 계조전압에 응답하여, 상기 제 3 데이터 라인으로 상기 임펄시브 데이터 전압을 인가하는 제 2 데이터 구동부를 포함하는 것을 특징으로 하는 액정 표시 장치.
  4. 제 3 항에 있어서,
    상기 제 1 및 제 2 계조전압을 상기 제 1 및 제 2 데이터 구동부로 각각 인가하는 제 1 및 제 2 계조전압 생성부를 더 포함하는 것을 특징으로 하는 액정 표시 장치.
  5. 제 2 항에 있어서,
    상기 제 1 영상 데이터 전압은 상기 제 2 영상 데이터 전압보다 큰 것을 특징으로 하는 액정 표시 장치.
  6. 제 5 항에 있어서,
    상기 임펄시브 데이터 전압은 상기 제 1 및 제 2 영상 데이터 전압보다 작은 것을 특징으로 하는 액정 표시 장치.
  7. 제 6 항에 있어서,
    상기 임펄시브 데이터 전압은 검은색을 표시하는 계조의 전압인 것을 특징으로 하는 액정 표시 장치.
  8. 제 2 항에 있어서,
    상기 임펄시브 데이터 전압이 상기 제 3 부화소 전극에 인가된 후에, 상기 제 1 및 제 2 영상 데이터 전압이 상기 제 1 및 제 2 부화소 전극에 동시에 각각 인가되는 것을 특징으로 하는 액정 표시 장치.
  9. 제 8 항에 있어서,
    상기 제 2 게이트 온 전압이 상기 제 3 박막 트랜지스터의 게이트로 인가된 시점으로부터 1/2 프레임에 해당하는 시간이 지난 후에, 상기 제 1 게이트 온 전압 이 상기 제 1 및 제 2 박막 트랜지스터의 게이트로 동시에 인가되는 것을 특징으로 하는 액정 표시 장치.
  10. 매트릭스 형태로 배열된 다수의 화소를 갖는 액정 패널;
    영상 데이터 신호를 입력받아 제어 신호들 및 데이터 신호를 출력하는 타이밍 컨트롤러;
    상기 타이밍 컨트롤러로부터의 제어 신호에 응답하여 상기 액정 패널을 구동하는 게이트 구동부;
    상기 데이터 신호를 입력받고, 상기 제어 신호와 서로 다른 레벨을 갖는 제 1 계조전압 및 제 2 계조전압에 응답하여, 서로 다른 레벨을 갖는 제 1, 제 2 및 제 3 데이터 전압을 상기 화소로 제공하는 데이터 구동부; 및
    상기 제 1 및 제 2 계조전압을 상기 데이터 구동부로 제공하는 계조전압 생성부를 포함하는 것을 특징으로 하는 액정 표시 장치.
  11. 제 10 항에 있어서,
    상기 다수의 화소 각각은,
    제 1, 제 2 및 제 3 부화소 전극을 갖는 화소 전극;
    상기 제 1, 제 2 및 제 3 부화소 전극에 각각 연결되는 제 1, 제 2 및 제 3 박막 트랜지스터;
    상기 데이터 구동부로부터 상기 제 1, 제 2 및 제 3 데이터 전압을 상기 제 1, 제 2 및 제 3 박막 트랜지스터의 소스로 각각 전달하는 제 1, 제 2 및 제 3 데이터 라인;
    상기 제 1 및 제 2 박막 트랜지스터의 게이트에 공통으로 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차하는 제 1 게이트 라인; 및
    상기 제 3 박막 트랜지스터의 게이트와 연결되며, 상기 제 1, 제 2 및 제 3 데이터 라인과 교차하는 제 2 게이트 라인을 포함하는 것을 특징으로 하는 액정 표시 장치.
  12. 제 11 항에 있어서,
    상기 데이터 구동부는, 상기 제 1 계조전압에 응답하여 상기 제 1 및 제 2 데이터 라인으로 상기 제 1 및 제 2 데이터 전압을 인가하는 제 1 데이터 구동부와, 상기 제 2 계조전압에 응답하여 상기 제 3 데이터 라인으로 상기 제 3 데이터 전압을 인가하는 제 2 데이터 구동부를 포함하고,
    상기 계조전압 생성부는, 상기 제 1 및 제 2 계조전압을 각각 생성하는 제 1 및 제 2 계조전압 생성부를 포함하는 것을 특징으로 하는 액정 표시 장치.
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