KR20070051576A - Minimize error propagation of channel equalizer apparatus and method thereof - Google Patents

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KR20070051576A
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Abstract

에러 전파를 최소화한 채널등화장치 및 그 방법이 제안된다. 본 발명에 따르면, 수신된 신호에 대하여 채널을 추정하고, 추정한 채널로부터 기준 탭과 이 기준 탭의 위치를 선택하며, 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정해서, 추정된 탭 계수를 이용하여 수신된 신호를 등화한다.A channel equalizer and a method for minimizing error propagation are proposed. According to the present invention, a channel is estimated for a received signal, a reference tap and a position of the reference tap are selected from the estimated channel, and based on the estimated channel, the reference tap, and the position of the reference tap, a tap coefficient is calculated. Estimate and equalize the received signal using the estimated tap coefficients.

에러 전파, 채널 추정, 기준 탭 위치, 채널 등화 Error Propagation, Channel Estimation, Reference Tap Position, Channel Equalization

Description

에러 전파를 최소화한 채널등화장치 및 그 방법{Minimize error propagation of channel equalizer apparatus and method thereof}Minimized error propagation of channel equalizer apparatus and method

도 1은 본 발명의 일 실시 예에 따른 채널등화장치의 구성 블럭도,1 is a block diagram of a channel equalizer according to an embodiment of the present invention;

도 2는 본 발명의 일 실시 예에 따른 채널추정부의 구성 블럭도,2 is a block diagram of a channel estimation unit according to an embodiment of the present invention;

도 3는 본 발명의 일 실시 예에 따른 훈련 등화부의 상세한 구성도,3 is a detailed configuration diagram of the training equalizer according to one embodiment of the present invention;

도 4은 본 발명의 일 실시 예에 따른 판정부의 구성 블럭도,4 is a block diagram illustrating a determination unit according to an embodiment of the present invention;

도 5은 본 발명의 일 실시 예에 따른 채널등화방법의 설명에 제공되는 흐름도,5 is a flowchart provided to explain a channel equalization method according to an embodiment of the present invention;

도 6a와 도 6b는 본 발명의 일 실시 예에 따른 브라질 A 및 D 채널에서의 RMSE(Root Mean Square Error)를 나타낸 그래프,6A and 6B are graphs illustrating root mean square error (RMSE) in Brazilian A and D channels according to an embodiment of the present invention;

도 7a 내지 도 7d는 본 발명의 일 실시 예에 따른 브라질 A, C, D, 및 E채널에서 등화부의 신호대 잡음+간섭비율(SINR: Signal to Interface plus Ratio)을 나타낸 그래프, 및7A to 7D are graphs showing signal to interface plus ratios (SINRs) of equalizers in channels A, C, D, and E of Brazil according to an embodiment of the present invention, and

도 8a 내지 도 8c은 본 발명의 일 실시 예에 따른 브라질 E 및 C 채널에서 등화부의 SER(Symbol Error Rate)를 나타낸 그래프이다.8A to 8C are graphs illustrating SER (Symbol Error Rate) of the equalizer in the Brazilian E and C channels according to an embodiment of the present invention.

* 도면의 주요 부분에 대한 설명 *Description of the main parts of the drawing

301: 버퍼 303: 채널 추정부301: buffer 303: channel estimator

305: 훈련 등화부 307: 피드-포워드 필터(FFF)305: training equalizer 307: feed-forward filter (FFF)

309: 감산기 311: 판정부309: Subtractor 311: Determination unit

313: 피드-백 필터(FBF) 315: 판정 피드백 등화부313: Feed-back filter (FBF) 315: Decision feedback equalizer

501: 상관부 503: 노이즈 제거부501: correlation unit 503: noise removing unit

505: LMS부 507: 선택부505: LMS section 507: Selection section

본 발명은 채널등화장치 및 그 방법에 관한 것으로, 더욱 상세하게는 에러전파를 최소화한 채널등화장치 및 그 방법에 관한 것이다.The present invention relates to a channel equalizer and a method thereof, and more particularly, to a channel equalizer and a method for minimizing error propagation.

무선 통신 시스템에서 버스트 에러 플로어(burst error floor)와 같은 에러 전파(error propagation)로 인한 등화기의 성능 열화를 극복하기 위한 노력해 왔다. 이와 같은 에러 전파는, 주로 잘못된 판정 심볼이 피드-백 필터(FBF: Feedback Filter)를 통과하면서 발생된다. 따라서, 에러 전파를 방지 하기 위해 제안된 기술들의 대부분은 DFE 기반의 비터비(Viterbi-based DFE)를 적용하여 판정 에러 확률을 줄이는 것이다. 그러나, 에러 전파는 크기가 큰 프리커서들에 의해서도 유발될 수 있다. 이러한, 에러 전파는 추정된 채널의 임퍼스 응답(CIR)으로부터 얻어지는 기준 탭(DFE의 심볼 타이밍)과 기준 탭의 위치(예를 들면, 판정 딜레이(Decision error propagation))와 관련하여 피드-포워드 필터(FFF: Feedforward filter)에서 유발된다.Efforts have been made to overcome performance degradation of the equalizer due to error propagation, such as burst error floor in wireless communication systems. This error propagation is mainly caused by a bad decision symbol passing through a feedback filter (FBF). Therefore, most of the proposed techniques for preventing error propagation are to reduce the probability of decision error by applying DFE-based Viterbi-based DFE. However, error propagation can also be caused by large precursors. This error propagation is a feed-forward filter in relation to the reference tap (symbol timing of the DFE) obtained from the estimated channel impulse response (CIR) and the position of the reference tap (e.g., Decision error propagation). Caused by (FFF: Feedforward filter).

종래의 기준 탭은 등화 이전에 수행되는 심볼 리커버리에 의해 얻을 수 있었다. 다르게는,기준 탭을 등화기의 훈련(training)기간 동안 선택될 수 있었지만, 이 방법은 무선 통신 시스템에 대하여 광역 등화를 한다는 점을 고려하면 너무 복잡하여 사용하기 힘들다. 통상적으로 기준 탭은 FFF의 중앙, FFF의 가장 오른쪽, 또는 광범위한 시뮬레이션을 통해서 찾은 FFF에서의 임의의 위치에 고정된다. 이처럼 기준탭을 고정시키는 기술들은 매우 간단한 반면에, 성능이 딜레이 스프레드와 멀티패스의 크기와 같은 채널 조건들에 의존한다. 따라서, 이러한 기술들은 알려지지 않은 채널 환경들에 대하여는 적절하지 못하다. Conventional reference taps can be obtained by symbol recovery performed prior to equalization. Alternatively, the reference tap could be selected during the training period of the equalizer, but this method is too complex and difficult to use given the wide area equalization for the wireless communication system. Typically the reference tap is fixed at the center of the FFF, to the far right of the FFF, or anywhere in the FFF found through extensive simulation. While the techniques for fixing the reference taps are very simple, performance depends on channel conditions such as delay spread and the size of the multipath. Thus, these techniques are not appropriate for unknown channel environments.

본 발명은 상술한 바와 같은 필요에 부응하기 위해 제안된 것으로서, 기준 탭의 위치를 채널의 특성에 따라서 변화시킴으로써, 에러전파를 최소화한 채널등화장치 및 그 방법을 제공하는 것이다.SUMMARY OF THE INVENTION The present invention has been proposed to meet the needs as described above, and provides a channel equalization apparatus and method for minimizing error propagation by changing the position of a reference tap according to the characteristics of a channel.

상기 목적을 달성하기 위해, 본 발명에 따른 에러 전파를 최소화한 채널등화장치는, 수신된 신호에 대하여 채널을 추정하고, 추정한 채널로부터 기준 탭과 이 기준 탭의 위치를 선택하는 채널 추정부; 상기 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정하는 훈련 등화부(DFE); 및 추정된 상기 탭 계수를 이용하여 수신된 신호를 등화하는 등화부(DFE: Decision Feedback Equalizer);를 포함하는 것이 바람직하다.In order to achieve the above object, the channel equalization apparatus which minimizes error propagation according to the present invention comprises: a channel estimator for estimating a channel with respect to a received signal and selecting a reference tap and a position of the reference tap from the estimated channel; A training equalizer (DFE) for estimating a tap coefficient based on the estimated channel, the reference tap, and the position of the reference tap; And an equalization unit (DFE: Decision Feedback Equalizer) for equalizing the received signal by using the estimated tap coefficient.

또한, 상기 채널 추정부는, 수신된 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하는 상관부; 상기 상관부가 추정한 채널의 노이즈를 제거하는 노이즈 제거부; 수신된 신호와 상기 노이즈가 제거된 채널에 MA-VSS(Moving-Average Variable Step-Size) LMS 알고리즘을 적용하여 채널을 추정하는 LMS 부; 및 상기 LMS 부가 추정한 채널 중에서 기준 탭 과 기준 탭 위치를 선택하는 선택부;를 더 포함하는 것을 특징으로 하는 것이 바람직하다.The channel estimator may include a correlator configured to estimate a channel by applying a correlation algorithm to a received signal; A noise removing unit for removing noise of the channel estimated by the correlation unit; An LMS unit for estimating a channel by applying a moving-average variable step-size (MA-VSS) LMS algorithm to a received signal and the channel from which the noise is removed; And a selector for selecting a reference tap and a reference tap position from the channel estimated by the LMS.

여기서, 상기 선택부는, 상기 LMS 부가 추정한 채널 중에서, 임계값보다 큰 크기를 가진 채널을 기준 탭으로 선택하고, 선택한 기준 탭 신호의 크기의 1/2보다 큰 채널이 위치된 곳을 기준 탭의 위치로 선택하는 것을 특징으로 하는 것이 바람직하다.Herein, the selector selects a channel having a size larger than a threshold value as a reference tap among the channels estimated by the LMS, and selects a channel that is larger than 1/2 of the size of the selected reference tap signal. It is preferable to select by position.

상기 목적을 달성하기 위해, 본 발명에 따른 에러 전파를 최소화한 채널등화방법은, a) 수신된 신호에 대하여 채널을 추정하고, 추정한 채널로부터 기준 탭과 이 기준 탭의 위치를 선택하는 단계; b) 상기 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정하는 단계; 및 c) 추정된 상기 탭 계수를 이용하여 수신된 신호를 등화하는 단계;를 포함하는 것이 바람직하다.In order to achieve the above object, the channel equalization method of minimizing error propagation according to the present invention comprises the steps of: a) estimating a channel with respect to a received signal and selecting a reference tap and a position of the reference tap from the estimated channel; b) estimating a tap coefficient based on the estimated channel, reference tap, and position of the reference tap; And c) equalizing the received signal using the estimated tap coefficients.

여기서, 상기 a) 단계는, 수신된 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하는 단계; 상기 추정한 채널의 노이즈를 제거하는 노이즈 제거 단계; 수신된 신호와 상기 노이즈가 제거된 채널에 MA-VSS(Moving-Average Variable Step-Size) LMS 알고리즘을 적용하여 채널을 추정하는 단계; 및 상기 LMS 알고리즘을 적용하여 추정한 채널 중에서 기준 탭 과 기준 탭 위치를 선택하는 단계;를 포함할 수 있다.Here, the step a) comprises: estimating a channel by applying a correlation algorithm to the received signal; A noise removing step of removing noise of the estimated channel; Estimating a channel by applying a moving-average variable step-size (MA-VSS) LMS algorithm to the received signal and the channel from which the noise is removed; And selecting a reference tap and a reference tap position among channels estimated by applying the LMS algorithm.

본 발명의 다른 목적 및 추가적인 특징은 첨부 도면과 함께 후술하는 상세한 설명을 읽으면 명확해질 것이다.Other objects and further features of the present invention will become apparent from the following detailed description when read in conjunction with the accompanying drawings.

도 1은 본 발명의 일 실시 예에 따른 채널등화장치의 구성 블럭도이다.1 is a block diagram of a channel equalization apparatus according to an embodiment of the present invention.

도 1을 참조하면, 채널등화장치는 버퍼(301), 채널추정부(303), 훈련 등화부(305), 및 등화부(315)를 포함한다.Referring to FIG. 1, the channel equalizer includes a buffer 301, a channel estimator 303, a training equalizer 305, and an equalizer 315.

버퍼(301)는 수신된 신호를 저장할 수 있다.The buffer 301 may store the received signal.

채널 추정부(303)는 상기 저장된 신호를 수신하고 상관 알고리즘을 적용하여 채널을 추정할 수 있다. 본 발명의 일 실시 예에 따른 채널 추정부(303)는 추정한 채널로부터 기준 탭과 기준 탭의 위치를 선택할 수 있다. The channel estimator 303 may receive the stored signal and estimate a channel by applying a correlation algorithm. The channel estimator 303 according to an embodiment of the present invention may select a reference tap and a position of the reference tap from the estimated channel.

상세하게, 채널 추정부(303)는, 수신한 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하여 추정한 채널의 노이즈를 제거하고, 수신한 신호와 상기 노이즈가 제거된 채널에 MA-VSS(Moving-Average Variable Step-Size) LMS 알고리즘을 적용하여 채널을 추정하며, 이 추정된 채널 중에서 기준 탭과 기준 탭 위치를 소정의 기준에 의해 선택할 수 있다.In detail, the channel estimator 303 estimates a channel by applying a correlation algorithm to the received signal to remove noise of the estimated channel, and performs MA-VSS (Moving) on the received signal and the channel from which the noise is removed. Average Variable Step-Size) A channel is estimated by applying an LMS algorithm, and among the estimated channels, a reference tap and a reference tap position can be selected by a predetermined criterion.

훈련 등화부(305)는 상기 추정된 채널의 탭 계수를 산출할 수 있다. 바람직하게는, 훈련 등화부(305)는 상기 채널 추정부가 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여 탭 계수를 추정할 수 있다. 훈련 등화부(305)에 의해 추정되는 탭 계수는, 피드-포워드 필터의 탭 계수(307)와 피드-백 필터의 탭계수(313)이다.The training equalizer 305 may calculate the tap coefficient of the estimated channel. Preferably, the training equalizer 305 may estimate the tap coefficient based on the channel, the reference tap, and the position of the reference tap estimated by the channel estimator. The tap coefficients estimated by the training equalizer 305 are tap coefficients 30 7 of the feed-forward filter and tap coefficients 313 of the feed-back filter.

등화부(307, 315)는, 상기 훈련 등화부(305)에 의해 추정된 탭 계수들을 사 용하여 수신된 신호를 등화할 수 있다.The equalizers 307 and 315 may equalize the received signal using tap coefficients estimated by the training equalizer 305.

등화부(307, 315)는, 심볼간 간섭(inter-symbol interference: 이하 "ISI"라 한다)를 제거한다. 이러한 ISI는 통상적으로 프리 커서(precursor) ISI 와 포스트 커서(post cursor) ISI로 구분된다. The equalizers 307 and 315 remove inter-symbol interference (hereinafter referred to as "ISI"). These ISIs are typically divided into precursor ISIs and post cursor ISIs.

도 1을 참조하면, 등화부(315)는 피드-포워드 필터(Feed-Forward Filter: 이하 "FFF") 필터(307), 판정 피드백 등화부(Decision Feedback equalization: 이하 "DFE"라 한다)(315)를 포함한다. Referring to FIG. 1, the equalizer 315 may include a feed-forward filter (“FFF”) filter 307 and a decision feedback equalization unit (“DFE”) 315. ).

FFF(307)는 전송 채널로부터 수신되는 신호를 필터링하여 프리 커서 ISI를 제거하며, DFE는 주로 포스트 커서 ISI를 제거한다. DFE는 포스트 커서 ISI 만을 제거하는 것은 아니며 프리 커서 ISI도 같이 제거할 수 있다.FFF 307 filters the signal received from the transport channel to remove precursor ISI, while DFE mainly removes postcursor ISI. The DFE not only removes the post cursor ISI but also the free cursor ISI.

FFF(307)는, 훈련 등화부(305)가 제공하는 FFF 필터 탭 계수를 사용한다.The FFF 307 uses the FFF filter tap coefficients provided by the training equalizer 305.

DFE(315)는 예를 들면 널리 알려진 MMSE-DFE equalizer(Minimum mean square error decision feed-back equalizer)일 수 있다. 도 1을 참조하면, DFE(315)는, 감산부(309), 판정부(315), 및 피드-백 필터(Feed-Back Filter: 이하 "FBF"라 한다)(313)를 포함한다.The DFE 315 may be, for example, a well-known minimum mean square error decision feed-back equalizer (MMSE-DFE equalizer). Referring to FIG. 1, the DFE 315 includes a subtraction unit 309, a determination unit 315, and a feed-back filter (hereinafter referred to as “FBF”) 313.

감산부(309)는 FFF(307)가 필터링한 신호와 FBF(313)가 필터링한 신호를 감산하여 출력한다. 당해 출력신호는 수신기에 수신되는 신호로부터 프리 커서 ISI 와 포스트 커서 ISI 가 제거된 신호가 된다.The subtraction unit 309 subtracts and outputs the signal filtered by the FFF 307 and the signal filtered by the FBF 313. The output signal is precursor ISI from the signal received at the receiver. And post cursor ISI become the removed signal.

판정부(315)는 감산기(309)로부터 출력되는 신호를 심볼로 판정하여 당해 판정값을 출력할 수 있다. 판정부(315)로는 예를 들면 널리 알려진 Schimtt trigger circuit가 사용될 수 있다. 판정부(315)는 감산기(309)로부터 출력되는 신호를 8레벨 심볼로 판정할 수 있다. 등화된 신호는 추가적인 처리를 위해서 디코더(미도시)에 제공될 수 있다.The determination unit 315 may determine the signal output from the subtractor 309 as a symbol and output the determination value. As the determination unit 315, a well-known Schimtt trigger circuit may be used, for example. The determination unit 315 may determine the signal output from the subtractor 309 as an eight-level symbol. The equalized signal may be provided to a decoder (not shown) for further processing.

상기 FBF(313)는 판정부(315)에 의해 판정된 신호를 입력받아서 필터링을 수행한다. FBF(313)는, 예를 들면, 다음과 같은 식으로 표현될 수 있다.The FBF 313 receives the signal determined by the determination unit 315 and performs filtering. The FBF 313 may be expressed by, for example, the following equation.

Figure 112005065731045-PAT00001
Figure 112005065731045-PAT00001

여기서, gi는 FFF(313)의 필터 계수이고, Sk -N은 판정부(311)의 출력이고, L은 FBF(313)의 차수(order)이고, N은 FFF의 차수(order)이다.Where g i is the filter coefficient of the FFF 313, S k -N is the output of the determination unit 311, L is the order of the FBF 313, and N is the order of the FFF. .

도 2는 본 발명의 일 실시 예에 따른 채널추정부(303)의 구성 블럭도이다.2 is a block diagram of the channel estimation unit 303 according to an embodiment of the present invention.

도 2를 참조하면, 채널추정부(303)는 상관부(501), 노이즈 제거부(503), LMS부(505) 및 선택부(507)를 포함한다.Referring to FIG. 2, the channel estimator 303 includes a correlation unit 501, a noise removing unit 503, an LMS unit 505, and a selection unit 507.

본원 발명에 따른 채널 추정부(303)는, 바람직하게는 채널 추정의 범위가 충분히 크다는 조건과 채널을 정확하게 추정한다는 조건하에 채널 추정을 수행한다.The channel estimating unit 303 according to the present invention preferably performs channel estimation under the condition that the range of channel estimation is sufficiently large and the channel is accurately estimated.

상관부(501)는 수신된 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하고, 노이즈 제거부(503)는 상관부(501)가 추정한 채널에서 노이즈를 제거하며, LMS부(505)는 상기 버퍼(301)에 의해 수신된 신호와 상기 노이즈 제거부(503)에 의해 노이즈가 제거된 채널 MA-VSS(Moving-Average Variable Step-size) LMS 알고리즘을 적용하여 채널을 추정하며, 선택부(507)는 LMS부(505)가 추정한 채널 중에서 기준 탭과 기준 탭 위치를 선택한다.The correlator 501 estimates a channel by applying a correlation algorithm to the received signal, the noise remover 503 removes noise from the channel estimated by the correlator 501, and the LMS unit 505 A channel is estimated by applying a signal received by the buffer 301 and a channel moving-average variable step-size (MA-VSS) LMS algorithm from which the noise is removed by the noise removing unit 503, and the selecting unit 507 ) Selects a reference tap and a reference tap position among channels estimated by the LMS unit 505.

채널 추정부(303)의 구성요소들을 보다 상세히 설명하기 전에, 필요한 몇 가지 사항들에 대하여 기술한다.Before describing the components of the channel estimator 303 in more detail, some necessary details will be described.

8 VSB DTV 시스템의 프레임 구조는, 두 개의 데이터 필드를 포함하며, 각각의 데이터 필드는 한 필드의 세그먼트와 313개의 데이터 세그먼트를 포함한다. 각 데이터 세그먼트는 832개의 심볼을 포함하며, 이 832개의 심볼에서 각 필드의 첫번째 세그먼트는 필드 동기(field sync) 또는 훈련 열(TS)를 위해 사용된다. 이러한 데이터 필드의 구조에서 알 수 있듯이, 훈련열은 데이터 열(DS)보다 상대적으로 적다. The frame structure of an 8 VSB DTV system includes two data fields, each data field including a segment of one field and 313 data segments. Each data segment contains 832 symbols, in which the first segment of each field is used for field sync or training sequence (TS). As can be seen from the structure of this data field, the training sequence is relatively smaller than the data sequence DS.

백색잡음(AWGN)과 멀티패스 채널을 통해서 등화 장치에 수신되는 신호는 하기 수학식 1로 나타낼 수 있다.The signal received by the equalizer through the white noise (AWGN) and the multipath channel may be represented by Equation 1 below.

Figure 112005065731045-PAT00002
Figure 112005065731045-PAT00002

여기서

Figure 112005065731045-PAT00003
Figure 112005065731045-PAT00004
은 각각, 시간
Figure 112005065731045-PAT00005
(T는 심볼 주기)에서 샘플링된 수신 신호와 전송 신호이다.
Figure 112005065731045-PAT00006
는 물리적인 멀티패스 채널, 전송 필터, 및 수신 필터를 포함한 채널 임펄스 응답(CIR)을 나타내고,
Figure 112005065731045-PAT00007
는 전체 채널 메모리 길이 를 나타내고,
Figure 112005065731045-PAT00008
은 AWGN 샘플이며, 이것은 통계적으로 i.i.d로 가정된다. 전송 시퀀스
Figure 112005065731045-PAT00009
은 2-레벨 펄스 진폭 변조(2-PAM) 심볼
Figure 112005065731045-PAT00010
(예를 들면 훈련 열(TS)과 세그먼트 동기)으로 구성되며, 8-PAM 데이터 시퀀스(DS)
Figure 112005065731045-PAT00011
은 하기 식 2와 같다.here
Figure 112005065731045-PAT00003
and
Figure 112005065731045-PAT00004
Each time
Figure 112005065731045-PAT00005
(T is a received signal and a transmitted signal sampled in a symbol period).
Figure 112005065731045-PAT00006
Represents the channel impulse response (CIR), including the physical multipath channel, the transmit filter, and the receive filter,
Figure 112005065731045-PAT00007
Represents the total channel memory length,
Figure 112005065731045-PAT00008
Is an AWGN sample, which is assumed to be iid statistically. Transmission sequence
Figure 112005065731045-PAT00009
Is a 2-level pulse amplitude modulation (2-PAM) symbol
Figure 112005065731045-PAT00010
(E.g., training sequence (TS) and segment sync), 8-PAM data sequence (DS)
Figure 112005065731045-PAT00011
Is equal to the following Equation 2.

Figure 112005065731045-PAT00012
Figure 112005065731045-PAT00012

여기서, A는 PAM 심볼을 나타낸다.  Here, A represents a PAM symbol.

출력

Figure 112005065731045-PAT00013
은 기준 탭
Figure 112005065731045-PAT00014
에서 계산되며, 이 기준탭의 위치는 FFF의 가장 오른쪽으로부터 d 만큼 떨어진 곳에 위치된다. 그리고,
Figure 112005065731045-PAT00015
은 하기 식 (3)으로 표현될 수 있다.Print
Figure 112005065731045-PAT00013
Silver base tab
Figure 112005065731045-PAT00014
The position of this reference tab is located d from the rightmost side of the FFF. And,
Figure 112005065731045-PAT00015
Can be represented by the following formula (3).

Figure 112005065731045-PAT00016
Figure 112005065731045-PAT00016

여기서 {

Figure 112005065731045-PAT00017
,
Figure 112005065731045-PAT00018
}는 각각
Figure 112005065731045-PAT00019
, ..., -d, 및 m=1, ...,
Figure 112005065731045-PAT00020
에 대한 FFF 및 FBF의 계수이다. {
Figure 112005065731045-PAT00021
,
Figure 112005065731045-PAT00022
}는 각 필터의 탭 길이이고,
Figure 112005065731045-PAT00023
은 판정부에 의해 판정된 심볼을 나타낸다.here {
Figure 112005065731045-PAT00017
,
Figure 112005065731045-PAT00018
} Are each
Figure 112005065731045-PAT00019
, ..., -d, and m = 1, ...,
Figure 112005065731045-PAT00020
Is the coefficient of FFF and FBF for. {
Figure 112005065731045-PAT00021
,
Figure 112005065731045-PAT00022
} Is the tab length for each filter,
Figure 112005065731045-PAT00023
Represents a symbol determined by the determination unit.

이제, 채널 추정부(303)의 구성요소들을 보다 상세히 설명한다.Now, the components of the channel estimator 303 will be described in more detail.

상관부(501)는, 버퍼(301)가 수신한 신호에 대하여 다음과 같은 수학식 4로 정의되는 상관 알고리즘을 적용하여 채널을 추정한다. 수학식 4과 같이 정의되는 상관 알고리즘은, 채널 메모리보다 훈련 시퀀스(TS)가 충분히 크다는 전제하에서는, 상기 채널 추정의 범위가 충분히 크다는 조건을 충족할 수 있다.The correlator 501 estimates a channel by applying a correlation algorithm defined by Equation 4 to the signal received by the buffer 301. The correlation algorithm defined as Equation 4 can satisfy the condition that the range of the channel estimation is sufficiently large, provided that the training sequence TS is sufficiently larger than the channel memory.

Figure 112005065731045-PAT00024
Figure 112005065731045-PAT00024

여기서

Figure 112005065731045-PAT00025
은 CIR(채널 임펄스 응답: Channel Impulse Response)을 나타내고, ra(0)은 상관관계 놈(correlation norm)
Figure 112005065731045-PAT00026
을 나타내며, (*)는 공액 복소수(complex conjugate)를 나타낸다. 한편, 상관 알고리즘만으로 채널을 추정하는 것은 상관 노이즈 때문에 채널 추정의 정확성이 떨어질 수 있다. 따라서, 본 실시 예에서는 다음에서 설명하는 과정이 채널추정부(303)에서 추가적으로 수행된다. here
Figure 112005065731045-PAT00025
Represents CIR (Channel Impulse Response), and r a (0) is the correlation norm
Figure 112005065731045-PAT00026
(*) Represents a complex conjugate. On the other hand, estimating a channel using only the correlation algorithm may reduce the accuracy of channel estimation due to the correlation noise. Therefore, in the present embodiment, the process described below is additionally performed by the channel estimator 303.

노이즈 제거부(503)는, 상관부(501)가 추정한 CIR에서 노이즈를 제거한다. 상관 노이즈의 영향은, 다음과 같이 수식 5에 의해 나타낼 수 있다.The noise removing unit 503 removes noise from the CIR estimated by the correlation unit 501. The influence of the correlation noise can be expressed by the following expression (5).

Figure 112005065731045-PAT00027
Figure 112005065731045-PAT00027

수학식 5는, 수학식 4에 상기 수학식 1을 삽입한 것이다.Equation 5 inserts Equation 1 above into Equation 4.

수학식 5에서, 첫 번째 부분은 원하는 CIR을 나타내고, 두 번째 및 세 번째 부분은 상관 노이즈를 나타낸다. 만약

Figure 112005065731045-PAT00028
의 크기가 상관 노이즈보다 작으면,
Figure 112005065731045-PAT00029
은 상관 노이즈 아래 묻힐수 있다(buried). 정확한 채널 추정을 위해서는, 묻힌
Figure 112005065731045-PAT00030
이 복원되어야 한다. In Equation 5, the first part represents the desired CIR, and the second and third parts represent correlation noise. if
Figure 112005065731045-PAT00028
If the magnitude of is smaller than the correlation noise,
Figure 112005065731045-PAT00029
Can be buried under correlation noise. For accurate channel estimation, buried
Figure 112005065731045-PAT00030
This must be restored.

본 발명의 일 실시 예에 따르면,

Figure 112005065731045-PAT00031
복원을 위해서, 임계치 방법(threshold method)과 적응적 채널 추정(adaptive channel estimation)을 사용한다.According to an embodiment of the present invention,
Figure 112005065731045-PAT00031
For reconstruction, a threshold method and adaptive channel estimation are used.

우선 상관 노이즈는 하기 수학식 6로 정의되는 임계 방법으로 제거될 수 있 다.First, the correlation noise may be removed by a threshold method defined by Equation 6 below.

Figure 112005065731045-PAT00032
Figure 112005065731045-PAT00032

여기서 T ch 는 상관 노이즈를 제거하기 위한 소정의 임계값이다. 만약 n=0,...,Nc-1에 대하여 |

Figure 112005065731045-PAT00033
|이 T ch 보다 작으면,
Figure 112005065731045-PAT00034
은 제로로 설정된다. 수학식 6에서, 임계값 T ch 의 크기가 수학식 1의
Figure 112005065731045-PAT00035
의 성능에 영향을 주지 않으면서 결정되어야 한다. Where T ch is a predetermined threshold for removing correlation noise. If n = 0, ..., Nc-1 |
Figure 112005065731045-PAT00033
Is less than T ch ,
Figure 112005065731045-PAT00034
Is set to zero. In Equation 6, the magnitude of the threshold value T ch is
Figure 112005065731045-PAT00035
Should be determined without affecting the performance of the system.

상기 수학식 4과 수학식 6의 임계화된 상관 알고리즘을 사용함으로써, 그럴듯한 채널 탭들만을 잔존시킬 수 있다.By using the thresholded correlation algorithms of Equations 4 and 6 above, only plausible channel taps can be left.

노이즈 제거부(503)는, 상기 임계값 T ch 의 크기 보다 작은

Figure 112005065731045-PAT00036
은 상관 노이즈로 취급하여 제거한다. 상세하게는, 상술한 수학식 4과 수학식 6의 임계화된 상관 알고리즘을, 상기 상관부(501)가 추정한 채널에 적용하여 상관 노이즈를 제거한다.The noise removing unit 503 is smaller than the size of the threshold value T ch .
Figure 112005065731045-PAT00036
Is treated as correlation noise and removed. In detail, the thresholded correlation algorithms of Equations 4 and 6 described above are applied to the channel estimated by the correlation unit 501 to remove correlation noise.

한편, 버려진 채널 탭들(discarded channel taps)을 복원할 필요가 있다.On the other hand, there is a need to restore discarded channel taps.

LMS(Least-mean-square)부(505)는, 버려진 채널의 탭을 Moving Average Variable step-size(MA-VSS) LMS 알고리즘을 적용하여 되살려 낼 수 있다. LMS(Least-mean-square)부(505)에서는, 훈련열(TS)이 반복적으로 사용되어 LMS 알고리즘이 충분히 수렴(converge)하도록 한다.The Least-mean-square (LMS) unit 505 may restore the tap of the discarded channel by applying a Moving Average Variable step-size (MA-VSS) LMS algorithm. In the Least-mean-square (LMS) unit 505, the training sequence TS is used repeatedly to allow the LMS algorithm to fully converge.

LMS 채널부(505)는 하기 수학식 7에 의해 정의될 수 있다.The LMS channel unit 505 may be defined by Equation 7 below.

Figure 112005065731045-PAT00037
Figure 112005065731045-PAT00037

여기서

Figure 112005065731045-PAT00038
은, 시간 n에서dml 채널 추정기의 Nf×1 계수 백터이며,
Figure 112005065731045-PAT00039
는 식(4)가 적용된 후 남은 채널 탭으로 초기화 된다. a(n)은 Nf×1 입력 훈련렬(TS) 벡터이며, r(n)은 수신받은 신호 샘플들이다. 윗 첨자 T는 백터의 트랜스포즈(transpose)이고, e(n)은 에러 추정이다. 식 7에서, μ(n)은 하기 수학식 8에 정의된바 와 같은 MA-VSS(Moving-average variable step-size) 알고리즘을 이용하여 업데이트 된다.here
Figure 112005065731045-PAT00038
Is the N f × 1 coefficient vector of the dml channel estimator at time n,
Figure 112005065731045-PAT00039
Is initialized to the remaining channel tap after equation (4) is applied. a (n) is an N f x1 input training sequence (TS) vector, and r (n) is received signal samples. The superscript T is the transpose of the vector and e (n) is the error estimate. In Equation 7, μ (n) is updated using a moving-average variable step-size (MA-VSS) algorithm as defined in Equation 8 below.

Figure 112005065731045-PAT00040
Figure 112005065731045-PAT00040

여기서 브래킷(bracket)은

Figure 112005065731045-PAT00041
인 제약조건을 나타내고, {α, β, γ}는 LMS 알고리즘의 추적(tracking) 특성을 제어하기 위한 상수들이다. L은 MA 프로세싱을 위한 창 크기(window size)로서, 그 값은 충분히 커야 한다. 에러 거동(behavior)이 평균을 함(average function)으로써 충분히 획득될 수 있어야 하기 때문이다. 한편으로는, 훈련 열(TS)이 반복되는 동안에는 스텝 사이즈가 충분히 업데이트 되도록, L값은 작아야 한다. 결국, 스텝 사이즈가 에러를 자승함(squared error)으로써 업데이트 될 때, 수학식 8에서의
Figure 112005065731045-PAT00042
부분에 대한 평균화에 의해, 수학식 1에서의 독립적인(independent) 노이즈의 효과가 부드럽게 감소될 것이다. MA-VSS 알고리즘은, LMS 채널 추정기를 위해 훈련 열(TS)의 적은 횟수의 반복과 빠른 수렴 속도를 제공한다.Where the bracket is
Figure 112005065731045-PAT00041
, {Α, β, γ} are constants for controlling the tracking characteristics of the LMS algorithm. L is the window size for MA processing, which must be large enough. This is because the error behavior must be sufficiently obtained by an average function. On the one hand, the L value must be small so that the step size is sufficiently updated while the training sequence TS is repeated. As a result, when the step size is updated by squared error,
Figure 112005065731045-PAT00042
By averaging over the part, the effect of independent noise in equation (1) will be smoothly reduced. The MA-VSS algorithm provides a small number of iterations of the training sequence (TS) and a fast convergence rate for the LMS channel estimator.

선택부(507)는, LMS부(505)가 추정한 채널 중에서 기준 탭과 기준 탭 위치를 선택한다.The selector 507 selects a reference tap and a reference tap position among the channels estimated by the LMS unit 505.

우선, FBF의 탭 길이(N b )가 하기 수학식 9을 만족한다고 가정한다. 이 수학식 9을 사용함으로써, CIR의 비등화된 부분에 의해 야기된 ISI는 발생하지 않을 것이다.First, it is assumed that the tap length N b of FBF satisfies Equation 9 below. By using this equation (9), the ISI caused by the unboiled portion of the CIR will not occur.

Figure 112005065731045-PAT00043
Figure 112005065731045-PAT00043

여기서, △는

Figure 112005065731045-PAT00044
에서 기준 탭의 위치를 나타낸다.Where Δ is
Figure 112005065731045-PAT00044
Indicates the position of the reference tab.

선택부(507)는 하기 수학식 10과 같은 간단한 기술을 사용함으로써 기준 탭을 선택할 수 있다.The selector 507 may select the reference tap by using a simple technique as shown in Equation 10 below.

Figure 112005065731045-PAT00045
Figure 112005065731045-PAT00045

여기서,

Figure 112005065731045-PAT00046
Figure 112005065731045-PAT00047
중에서 선택된 기준 탭을 나타낸다.
Figure 112005065731045-PAT00048
Figure 112005065731045-PAT00049
를 선택하기 위한 임계값들
Figure 112005065731045-PAT00050
의 룩업 데이블이고, N은 임계값의 개수(個數)이다.here,
Figure 112005065731045-PAT00046
silver
Figure 112005065731045-PAT00047
Selected from among the criteria tab.
Figure 112005065731045-PAT00048
silver
Figure 112005065731045-PAT00049
Thresholds for Selecting
Figure 112005065731045-PAT00050
Is a lookup table of N, where N is the number of thresholds.

임계값들은, 크기가 큰 프리커서들의 영향이 최소화되도록 선택되며, 예를 들면 브라질 채널하에서는 하기 수학식 11에 의해 선택될 수 있다.The thresholds are chosen such that the influence of large precursors is minimized, for example under Equation 11 under the Brazilian channel.

Figure 112005065731045-PAT00051
Figure 112005065731045-PAT00051

Figure 112005065731045-PAT00052
은, 채널 상기 수학식 10을 만족하는 채널 탭
Figure 112005065731045-PAT00053
이 k=1, 2,에 대해서 존재하면,
Figure 112005065731045-PAT00054
으로 선택된다. 만약 존재하지 않는다면, 가장 크기가 큰
Figure 112005065731045-PAT00055
Figure 112005065731045-PAT00056
으로 선택된다.
Figure 112005065731045-PAT00052
Is a channel tap that satisfies the above equation (10).
Figure 112005065731045-PAT00053
If is present for k = 1, 2,
Figure 112005065731045-PAT00054
Is selected. If not present, the largest
Figure 112005065731045-PAT00055
this
Figure 112005065731045-PAT00056
Is selected.

큰 프리커서에 의해 야기된 에러 전파를 최소화하기 위해서, FFF에서의 기준 탭의 위치는 하기 수학식 12에 의해 선택될 수 있다.In order to minimize the error propagation caused by the large precursor, the position of the reference tap in the FFF can be selected by Equation 12 below.

Figure 112005065731045-PAT00057
Figure 112005065731045-PAT00057

여기서,

Figure 112005065731045-PAT00058
은, 상기 조건을 만족하는
Figure 112005065731045-PAT00059
Figure 112005065731045-PAT00060
간의 샘플 딜레이를 나타낸다. 따라서, FFF에서의 판정 딜레이는
Figure 112005065731045-PAT00061
이다. 수학식 10를 살펴보면,
Figure 112005065731045-PAT00062
Figure 112005065731045-PAT00063
에 기초하여 변화됨을 알 수 있다.here,
Figure 112005065731045-PAT00058
To satisfy the above conditions
Figure 112005065731045-PAT00059
and
Figure 112005065731045-PAT00060
Sample delay in the liver. Therefore, the decision delay in FFF is
Figure 112005065731045-PAT00061
to be. Looking at Equation 10,
Figure 112005065731045-PAT00062
Is
Figure 112005065731045-PAT00063
It can be seen that based on the change.

도 3는 본 발명의 일 실시 예에 따른 훈련 등화부의 상세한 구성도이다.Figure 3 is a detailed block diagram of the training equalizer according to an embodiment of the present invention.

훈련 등화부(305)는 채널 추정부(303)에 의해 추정된 채널, 기준 탭, 및 기준 탭의 위치에 기초하여 FFF와 FBF의 탭 계수를 산출할 수 있다. 산출된 기준 탭과 기준 탭 위치는 FFF 탭 계수와 함께, FFF로 제공되며, FBF 탭 계수는 FBF로 제공된다. 본원 명세서에서는, 도 3과 같이 구현된 본원 발명의 일 실시 예에 따른 훈련 등화부(305)를 GT-DFE(General Training DFE)로 부르며, 통상적인 종래의 기술에 따른 훈련 등화부를 CT-DFE로 부른다. 본원 발명의 일 실시 예에 따른 채널등화장치(예를 들면 도1)는 GT-DFE와 CT-DFE를 모두 사용할 수 있다. 양자는 선택적으로 본원 발명의 일 실시 예에 따른 채널등화장치에 사용될 수 있다. 본원 명세서에서, GT-DFE와 CT-DFE를 특별히 구분할 필요가 있는 경우에는 서로 달리 호칭하지만 구분의 실익이 없는 경우에는 훈련 등화부로서 부른다, The training equalizer 305 may calculate tap coefficients of the FFF and the FBF based on the positions of the channel, the reference tap, and the reference tap estimated by the channel estimator 303. The calculated reference tap and reference tap positions are provided in FFF, along with the FFF tap coefficients, and the FBF tap coefficients are provided in FBF. In the present specification, the training equalizer 305 according to an embodiment of the present invention implemented as shown in FIG. 3 is called GT-DFE (General Training DFE), and the training equalizer according to a conventional conventional technology is referred to as CT-DFE. Call. A channel equalizer (eg, FIG. 1) according to an embodiment of the present invention may use both GT-DFE and CT-DFE. Both may optionally be used in the channel equalizer according to one embodiment of the present invention. In the present specification, when GT-DFE and CT-DFE need to be specifically distinguished, they are called differently, but when they do not have the benefit of the division, they are referred to as training equalizers.

GT-DFE(305)는 도3에 나타나 있듯이 안티-코우절 FFF(GT-FFF), 코우절 FBF(GT-FBF), 추가적인 코우절 FBF(GT-aFBF)를 포함한다.GT-DFE 305 includes an anti-Koseol FFF (GT-FFF), a Koseol FBF (GT-FBF), and an additional Koseol FBF (GT-aFBF).

GT-DFE(305)는 채널추정부(303)의 추정 정보 {

Figure 112005065731045-PAT00064
, △,
Figure 112005065731045-PAT00065
} 와 버퍼(301)에서의
Figure 112005065731045-PAT00066
에 대응되는 수신된 신호 샘플들 rn을 수신한다. 만약
Figure 112005065731045-PAT00067
가 영이 아니라면, 다음과 같은 수학식 13처럼 메트릭스 형태로 바꿔 쓸 수 있다.The GT-DFE 305 estimates information of the channel estimate 303 {
Figure 112005065731045-PAT00064
, △,
Figure 112005065731045-PAT00065
} And in buffer 301
Figure 112005065731045-PAT00066
Receive received signal samples r n corresponding to. if
Figure 112005065731045-PAT00067
If is not zero, it can be rewritten in matrix form as shown in Equation 13.

Figure 112005065731045-PAT00068
Figure 112005065731045-PAT00068

일반성(generality)을 유지하기 위해서, 본 발명의 일 실시 예에 따른 GT-DFE(305)의 출력

Figure 112005065731045-PAT00069
은,
Figure 112005065731045-PAT00070
Figure 112005065731045-PAT00071
로 주어진 GT-FFF에서의 기준 탭
Figure 112005065731045-PAT00072
의 위치에서 계산된다. 따라서, {r, a, w}는 추정된 {△,
Figure 112005065731045-PAT00073
}에 의해 하기 수학식 14, 15, 16, 및 17 처럼 기술할 수 있다.In order to maintain generality, the output of the GT-DFE 305 according to an embodiment of the present invention
Figure 112005065731045-PAT00069
silver,
Figure 112005065731045-PAT00070
Wow
Figure 112005065731045-PAT00071
Tab in GT-FFF given by
Figure 112005065731045-PAT00072
Is calculated at the position of. Thus, { r, a, w } is estimated {△,
Figure 112005065731045-PAT00073
} By the following equations (14), (15), (16), and (17).

Figure 112005065731045-PAT00074
Figure 112005065731045-PAT00074

Figure 112005065731045-PAT00075
Figure 112005065731045-PAT00075

Figure 112005065731045-PAT00076
Figure 112005065731045-PAT00076

Figure 112005065731045-PAT00077
Figure 112005065731045-PAT00077

여기서, {r, w}는

Figure 112005065731045-PAT00078
벡터이고, a는 시간 n에서
Figure 112005065731045-PAT00079
벡터이다. 상기 수학식 13의
Figure 112005065731045-PAT00080
채널 H 는, 상기 수학식 17에서 주어진 서브 메트릭스들 H 1, H 2, 및 H 3로 주어진다. GT-DFE(305)에서, 채널 출력 벡터 r은 GT-FFF로 제공되어, 로부터 야기되는 포스트 커서 ISI를 제외한 포스트 커서 ISI 일부분이 제거되며, 이
Figure 112005065731045-PAT00082
는 상기 수학식 12에서
Figure 112005065731045-PAT00083
Figure 112005065731045-PAT00084
사이의 채널 탭들에 해당한다.Where { r, w } is
Figure 112005065731045-PAT00078
Vector and a is at time n
Figure 112005065731045-PAT00079
Vector. Of Equation 13
Figure 112005065731045-PAT00080
Channel H is given by the sub-metrics H 1 , H 2 , and H 3 given in Equation 17 above. In GT-DFE 305, the channel output vector r is provided as GT-FFF, A portion of the post cursor ISI is removed except for the post cursor ISI resulting from
Figure 112005065731045-PAT00082
In Equation 12
Figure 112005065731045-PAT00083
Wow
Figure 112005065731045-PAT00084
Corresponds to channel taps in between.

Figure 112005065731045-PAT00085
Figure 112005065731045-PAT00085

여기서, 콜론에 의해 분리된 첫 번째와 두 번째 첨자는 GT-FBF의 출력과 벡터의 구성성분들을 나타낸 것이며, GT-FFF의 입력 벡터

Figure 112005065731045-PAT00086
는 하기 수학식 19처럼 정의된다.Here, the first and second subscripts separated by colons represent the output of the GT-FBF and the components of the vector, and the input vector of the GT-FFF.
Figure 112005065731045-PAT00086
Is defined as in Equation 19 below.

Figure 112005065731045-PAT00087
Figure 112005065731045-PAT00087

식 (18)에서, GT-FBF의 탭 길이는 GT-FFF의 탭 길이와 동등하다면(예를 들면

Figure 112005065731045-PAT00088
), 부분적인 포스트커서 ISI인
Figure 112005065731045-PAT00089
Figure 112005065731045-PAT00090
인 경우
Figure 112005065731045-PAT00091
라고 가정하면 다음 수학식 20와 같이 나타낼 수 있다.In equation (18), if the tap length of the GT-FBF is equal to the tap length of the GT-FFF (eg
Figure 112005065731045-PAT00088
), Which is a partial postcursor ISI
Figure 112005065731045-PAT00089
Is
Figure 112005065731045-PAT00090
If
Figure 112005065731045-PAT00091
If it is assumed that can be expressed as shown in the following equation (20).

Figure 112005065731045-PAT00092
Figure 112005065731045-PAT00092

여기에서,

Figure 112005065731045-PAT00093
은 시간 n에서의 V (n) 구성 요소이다. 상기 수학식 18에 상기 수학식 13을 대입하고 채널 매트릭스 H 3가 완벽하게 추정될 수 있다고 가정하면, 상기 수학식 (18)을 하기 수학식 21처럼 재기술될 수 있다.From here,
Figure 112005065731045-PAT00093
Is the V (n) component at time n. Substituting Equation 13 into Equation 18 and assuming that channel matrix H 3 can be perfectly estimated, Equation (18) can be rewritten as Equation 21 below.

Figure 112005065731045-PAT00094
Figure 112005065731045-PAT00094

상기 수학식 13과 수학식 21로부터, 채널 매트릭스 H의 유효 디멘션 (effective dimension)은

Figure 112005065731045-PAT00095
채널 메트릭스
Figure 112005065731045-PAT00096
로 감소 된다. 따라서,
Figure 112005065731045-PAT00097
에서 원치 않는 채널 탭에 의해 야기된 ISI는 도 2의 GT-FFF와 GT-aFBF에 의해 제거될 수 있다. From Equations 13 and 21, the effective dimension of the channel matrix H is
Figure 112005065731045-PAT00095
Channel metrics
Figure 112005065731045-PAT00096
Is reduced to. therefore,
Figure 112005065731045-PAT00097
The ISI caused by unwanted channel taps at can be removed by the GT-FFF and GT-aFBF of FIG.

채널 디멘션 감소는, GT-DFE에 의해 출력되는 신호의 SINR(Signal to interference plus noise ratio)와 수렴 속도에 영향을 미친다. 즉, GT-DFE의 SINR은 CT-DFE의 SINR보다 더 높은

Figure 112005065731045-PAT00098
이다. 결과적으로, GT-DFE의 수렴 속도는 증가한다. GT-DFE의 출력
Figure 112005065731045-PAT00099
하기 수식 22처럼 나타낼 수 있다.Channel dimension reduction affects the signal to interference plus noise ratio (SINR) and convergence speed of the signal output by the GT-DFE. That is, the SINR of GT-DFE is higher than that of CT-DFE.
Figure 112005065731045-PAT00098
to be. As a result, the convergence speed of the GT-DFE increases. GT-DFE output
Figure 112005065731045-PAT00099
It can be expressed as Equation 22 below.

Figure 112005065731045-PAT00100
Figure 112005065731045-PAT00100

여기서,

Figure 112005065731045-PAT00101
Figure 112005065731045-PAT00102
에 대한
Figure 112005065731045-PAT00103
는 GT-FFF와 GT-FBF 각각의 계수이다. GT-FBF의 계수는 도 2에 나타낸 것처럼
Figure 112005065731045-PAT00104
에 대하여
Figure 112005065731045-PAT00105
로 설정된다.here,
Figure 112005065731045-PAT00101
Wow
Figure 112005065731045-PAT00102
For
Figure 112005065731045-PAT00103
Is the coefficient of GT-FFF and GT-FBF respectively. The coefficient of GT-FBF is as shown in FIG.
Figure 112005065731045-PAT00104
about
Figure 112005065731045-PAT00105
Is set to.

k=△+1, ...,

Figure 112005065731045-PAT00106
를 위한
Figure 112005065731045-PAT00107
로 설정될 수 있다. 상기 수학식 22에서, 상기 수학식 20과 관련된
Figure 112005065731045-PAT00108
는, GT-FFF 이전에, 하기 수학식 23과 같이 정의되는 시프트 특성에 의해 제거될 수 있다. k = △ + 1, ...,
Figure 112005065731045-PAT00106
for
Figure 112005065731045-PAT00107
It can be set to. In Equation 22, Equation 20
Figure 112005065731045-PAT00108
May be removed by a shift characteristic defined as in Equation 23 before GT-FFF.

Figure 112005065731045-PAT00109
Figure 112005065731045-PAT00109

본 수학식 23은, GT-FBF의 탭 길이가 GF-FFF의 탭 길이보다 길다는 전제에 정의된 것이다. 채널 추정이 완벽하다면,

Figure 112005065731045-PAT00110
이고, 상기 수학식 22는 하기 수학식 24처럼 재 기술될 수 있다.Equation 23 is defined on the premise that the tap length of GT-FBF is longer than the tap length of GF-FFF. If channel estimation is perfect,
Figure 112005065731045-PAT00110
Equation 22 may be rewritten as in Equation 24 below.

Figure 112005065731045-PAT00111
Figure 112005065731045-PAT00111

상기 수학식 24에서,

Figure 112005065731045-PAT00112
가 제로(0)인 경우, GT-DFE의 출력은 CT-DFE의 값과 동일함에 주목하라. 이러한 사실로부터, GT-DFE의 구조는
Figure 112005065731045-PAT00113
에 따라 달라질 수 있으므로, CT-DFE의 구조보다 플렉서블하다는 것을 알 수 있다.In Equation 24,
Figure 112005065731045-PAT00112
Note that if is zero, the output of the GT-DFE is equal to the value of the CT-DFE. From this fact, the structure of the GT-DFE
Figure 112005065731045-PAT00113
Since it can vary depending on, it can be seen that more flexible than the structure of the CT-DFE.

훈련 열(TS)이 짧은 단점을 극복하기 위해서, GT-FFF의

Figure 112005065731045-PAT00114
Figure 112005065731045-PAT00115
로 초기화된 후에 GT-DFE가 수렴하도록 훈련 열(TS)는 여러 번 반복된다. 훈련 동안에, GT-DFE의 계수들은, 하기 수학식 25와 같은 LMS 알고리즘을 사용하여 업데이트 된다.To overcome the shortcomings of short training trains, the GT-FFF
Figure 112005065731045-PAT00114
end
Figure 112005065731045-PAT00115
After initialization, the training sequence TS is repeated several times for the GT-DFE to converge. During training, the coefficients of the GT-DFE are updated using an LMS algorithm, such as

Figure 112005065731045-PAT00116
Figure 112005065731045-PAT00116

여기서,

Figure 112005065731045-PAT00117
는 각각 GT-FFF의
Figure 112005065731045-PAT00118
계수 벡터이고, GT-aFBF 의
Figure 112005065731045-PAT00119
계수 벡터이다. a(n)은 GT-aFBF 의
Figure 112005065731045-PAT00120
입력 벡터이고, 스텝 사이 즈
Figure 112005065731045-PAT00121
은 상기 수학식 8의 MA-VSSS 알고리즘에 의해 업데이트 된다.here,
Figure 112005065731045-PAT00117
Each of the GT-FFF
Figure 112005065731045-PAT00118
Coefficient vector, and the value of GT-aFBF
Figure 112005065731045-PAT00119
Coefficient vector. a (n) is the GT-aFBF
Figure 112005065731045-PAT00120
Input vector, step size
Figure 112005065731045-PAT00121
Is updated by the MA-VSSS algorithm of Equation 8.

훈련이 완결된 후에, GT-FFF의 계수

Figure 112005065731045-PAT00122
는 FFF의 계수들을 위해서 저장되고(save), GT-aFBF 의 계수
Figure 112005065731045-PAT00123
는 사용되지 않는다. 상기 수학식 3의 FBF의 계수는 하기 수학식 26의 관계식을 사용하여 계산된다.After the training is completed, the coefficient of GT-FFF
Figure 112005065731045-PAT00122
Is saved for the coefficients of the FFF, and the coefficients of the GT-aFBF
Figure 112005065731045-PAT00123
Is not used. The coefficient of FBF in Equation 3 is calculated using the relation in Equation 26 below.

Figure 112005065731045-PAT00124
Figure 112005065731045-PAT00124

도3의 GT-DFE 의 구조로부터, 상기 수학식 17에서 서브 매트릭스 H2와 관련된 크기가 큰 포스트 커서들의 영향이 GT-aFBF 및 GT-FFF에 의해 제거됨을 알 수 있다. 결과적으로, 상기 수학식 26에서

Figure 112005065731045-PAT00125
의 크기는 에러 전파를 방지되도록 하는 조건을 대략적으로 만족하면서 작아지게 된다.From the structure of the GT-DFE of FIG. 3, it can be seen that the influence of the large post cursors associated with the sub-matrix H2 in Equation 17 is eliminated by the GT-aFBF and GT-FFF. As a result, in Equation 26
Figure 112005065731045-PAT00125
The size of becomes small while approximately satisfying the condition for preventing error propagation.

GT-DFE에 의해 FFF(307)와 FBF(313)의 계수들이 초기화되면, 버퍼(301)에 저장된 수신된 신호 샘플들은 FFF(307)과 DFE(315)로 공급되어 복원된다. 미세한 튜닝(fining tuning)은, 수신된 신호들 중에서 훈련 열(TS)에 해당하는 신호들에 의해 수행된다. FFF(307)와 FBF(313)의 계수들을 업데이트 하기 위해서, MA-VSS LMS 알고리즘이 훈련 기간("TS 모드") 동안 적용되며, 변형된 스탑 앤 고우(stop and go) 알고리즘(참조문헌: M. Ghosh, blind Decision Feedback Equalization for Terrestrial Television Receivers,"in Processings of the IEEE, vol.86, no.10, Oct. 1998.) 이 데이터 열 등화 기간("DS 모드")에 사용된다. 변형된 스탑 앤 고우 알고리즘에서는, 고정된 스텝 사이즈가 MAVSS 알고리즘으로 대치된 것이다. When the coefficients of the FFF 307 and the FBF 313 are initialized by the GT-DFE, the received signal samples stored in the buffer 301 are supplied to the FFF 307 and the DFE 315 and restored. Fine tuning is performed by the signals corresponding to the training sequence TS among the received signals. In order to update the coefficients of the FFF 307 and the FBF 313, a MA-VSS LMS algorithm is applied during the training period (“TS mode”), and a modified stop and go algorithm (reference: M Ghosh, blind Decision Feedback Equalization for Terrestrial Television Receivers, " in Processings of the IEEE , vol. 86, no. 10, Oct. 1998.) This data is used for the data equalization period (" DS mode "). In the N Go algorithm, the fixed step size is replaced by the MAVSS algorithm.

후술하는 본원 발명의 일 실시 예인 도4의 판정부를 사용하는 경우, 판정 에러 확률을 감소시킬 뿐만 아니라 과거 부정확한 판정 심볼들을 교정함으로써 에러 전파를 감소시킬 수 있게 된다.In the case of using the determination unit of FIG. 4, which is an embodiment of the present invention described below, error propagation can be reduced by correcting past incorrect determination symbols as well as reducing the probability of determination error.

도 4는 본 발명의 일 실시 예에 따른 판정부의 구성 블럭도이다.4 is a block diagram illustrating a determination unit according to an embodiment of the present invention.

본 발명의 일 실시 예에 따른 판정부는, 감산기 출력(yn)에 대한 판정 에러 확률을 줄이고 FBF에서의 과거 판정 심볼을 정정함으로써 포스트 커서 ISI를 최소화하는 FBF 와 Viterbi decoder의 결합 구조이다. The determination unit according to an embodiment of the present invention is a combined structure of an FBF and a Viterbi decoder that minimizes the post cursor ISI by reducing the probability of determination error on the subtractor output yn and correcting past determination symbols in the FBF.

도 4를 참조하면, FBF는 12 개의 비터비 코더를 병렬로 사용하며, 각 비터비 디코더의 입력은 심볼 디 인터리버(Symbol de-interleaver)(601)에 의해 재구성된다. 심볼 디 인터리버(601)는 트렐리스 코더 인터리버의 정확히 반대되는 기능을 수행하며, 트렐리스 코더로 인터리빙되는 않은 다른 모든 심볼들은 통과시킨다. 도 4의 필터 저장부들(603a 내지 603T)은 비터비 디코드 동작후에 심볼 인터리버로서의 기능을 수행하며, 이러한 기능은 임의의 비터비 디코더의 판정 심볼들을 각각의 필터 뱅크의 첫 번째 위치에 위치시켜 과거 판정 심볼들을 정정함으로써 수행된다. 여기서, 필터 뱅크의 각각은 12개의 symbol spaced-register V으로 구성된다.Referring to FIG. 4, the FBF uses 12 Viterbi coders in parallel, and the input of each Viterbi decoder is reconstructed by a symbol de-interleaver 601. The symbol deinterleaver 601 performs the exact opposite function of the trellis coder interleaver, passing all other symbols that are not interleaved with the trellis coder. The filter storages 603a to 603T of FIG. 4 perform a function as a symbol interleaver after a Viterbi decode operation, which places past decision symbols of any Viterbi decoder at the first position of each filter bank to determine past determination. This is done by correcting the symbols. Here, each of the filter banks is composed of 12 symbol spaced-register V.

도 4의 비터비 디코더의 각각은 시간(time) n에 다음과 같은 주요 단계들을 수행함으로써 시험 판정 심볼(tentative decision symbol)을 출력한다.Each of the Viterbi decoders of FIG. 4 outputs a tentative decision symbol by performing the following main steps at time n.

1) 브랜치 메트릭 발생(branch methric generation)1) branch methric generation

2) 서바이버 패스(survivor path)와 모든 상태에 대한 패스 메트릭 업데이트(path metric update)2) Survivor path and path metric update for all states

3) 가장 바람직한 패스(most likely path)를 역 추적(trace back)3) Trace back the most likely path

임의의 비터비 디코더에서, 세 번째 단계를 통과하여 결정된 심볼들은 하기 수학식 27로 표현된다.In any Viterbi decoder, the symbols determined through the third step are represented by Equation 27 below.

Figure 112005065731045-PAT00126
Figure 112005065731045-PAT00126

여기서

Figure 112005065731045-PAT00127
은 도 4의 i번째 비터비 디코더의 판정 심볼 벡터를 나타낸다. i번째 비터비 디코더는 도 4의 i번째 트렐리스 인코더에 대응된다.
Figure 112005065731045-PAT00128
는 비터비 디코더의 역 추적(trace back) 길이를 나타내며,
Figure 112005065731045-PAT00129
는 i번째 비터비 디코더의 j 번째 패스(path)의 역 추적에서의 판정된 심볼을 나타낸다.
Figure 112005065731045-PAT00130
≥15에 대하여 비터비 디코더는 최적화된 비터비 디코더에 비교할 때 무시할 만한 성능 열화를 가져온다. 그러나,
Figure 112005065731045-PAT00131
≥의 조건이 8VSB DTV 시스템에 적용되면, 판정 딜레이 12(
Figure 112005065731045-PAT00132
-1)가 12개의 비터비 디코더에 의해 생긴다. 이로 인하여, DFE의 초기 수렴(Initial convergence)에 영향을 미친다. 따라서, 본 발명에서는 판정 딜레이로 인한 영향을 없애기 위해서 초기 12(
Figure 112005065731045-PAT00133
-1) 심볼 주기 동안
Figure 112005065731045-PAT00134
=1인 비터비 디코더를 사용한다. 도 4에서, 각각의 디터비 디코더로(311)부터 FBF(313)까지의 정정 과정은, 심볼 디 인터리버가 송신기에서의 트렐리스 코드 인터리버와 완벽히 동기화 된다는 전제하에, 통상적으로 다음 세 가지 경우로 수행된다.here
Figure 112005065731045-PAT00127
Denotes a decision symbol vector of the i-th Viterbi decoder of FIG. The i-th Viterbi decoder corresponds to the i-th trellis encoder of FIG. 4.
Figure 112005065731045-PAT00128
Denotes the trace back length of the Viterbi decoder,
Figure 112005065731045-PAT00129
Denotes the determined symbol in the backward tracking of the j th path of the i th Viterbi decoder.
Figure 112005065731045-PAT00130
For ≥ 15, the Viterbi decoder results in negligible performance degradation when compared to the optimized Viterbi decoder. But,
Figure 112005065731045-PAT00131
If the condition of ≥ is applied to the 8VSB DTV system, decision delay 12 (
Figure 112005065731045-PAT00132
-1) is generated by twelve Viterbi decoders. This affects the initial convergence of the DFE. Therefore, in the present invention, in order to eliminate the effects of the decision delay, the initial 12 (
Figure 112005065731045-PAT00133
-1) during symbol period
Figure 112005065731045-PAT00134
Use a Viterbi decoder with = 1. In FIG. 4, the correction process from each diterbi decoder 311 to the FBF 313 is generally performed in the following three cases, provided that the symbol deinterleaver is completely synchronized with the trellis code interleaver at the transmitter. Is performed.

경우 1: 본 과정은 임의의 필드의 첫 번째 세그먼트가 수신된 후에 적용된다. 두 번째 세그먼트의 세그먼트 동기 입력(segment sync input) 동안, 도3의 심볼 디 인터리버의 암(arm)은 송신기의 재배열(reordering)와 매칭되도록 회전(circulation)한다. 이후에, i 번째 트렐리스 인코더의 출력심볼에 대응하여 yn에 대한 I번 째 비터비 디코더가 동작되고, (16)식의

Figure 112005065731045-PAT00135
중 첫 번째 판정 심볼
Figure 112005065731045-PAT00136
은, 비-트렐리스 코딩된 심볼들이
Figure 112005065731045-PAT00137
번째 필터 뱅크를 통과할 때까지, 첫 번째 필터 뱅크로 전달되기만 한다. 경우 1은, 12(
Figure 112005065731045-PAT00138
-1) 심볼 동안 FBF에서의 정정없이
Figure 112005065731045-PAT00139
=1 인 비터비 디코더와 유사한 과정을 가진다.Case 1: This procedure is applied after the first segment of any field is received. During the segment sync input of the second segment, the arm of the symbol deinterleaver of FIG. 3 rotates to match the reordering of the transmitter. Thereafter, the I-th Viterbi decoder for yn is operated in response to the output symbol of the i-th trellis encoder,
Figure 112005065731045-PAT00135
First judgment symbol
Figure 112005065731045-PAT00136
Is a non-trellis coded symbol
Figure 112005065731045-PAT00137
It only passes to the first filter bank until it passes through the first filter bank. Case 1 is 12 (
Figure 112005065731045-PAT00138
-1) without correction in FBF during symbol
Figure 112005065731045-PAT00139
It has a similar process to the Viterbi decoder with = 1.

경우 2: 비-트렐리스 코딩된 심볼들이

Figure 112005065731045-PAT00140
-필터 뱅크를 통과한 후에, 후속하는 입력 심볼들에 대한 i번째 비터비 디코더의 판정 심볼 벡터
Figure 112005065731045-PAT00141
가 FBF로 전달되어 마지막 832-12(
Figure 112005065731045-PAT00142
-1) 심볼들 동안에 과거 판정 심볼을 하기 수학식 28과 같이 정정한다.Case 2: non-trellis coded symbols
Figure 112005065731045-PAT00140
After passing through the filter bank, the decision symbol vector of the i-th Viterbi decoder for subsequent input symbols
Figure 112005065731045-PAT00141
Is passed to FBF and the last 832-12 (
Figure 112005065731045-PAT00142
-1) During past symbols, the past decision symbol is corrected as in Equation 28 below.

Figure 112005065731045-PAT00143
Figure 112005065731045-PAT00143

여기서, 수식

Figure 112005065731045-PAT00144
은 i번째 트렐리스 코더의 출력 심볼들에 대한 과거 판정 심볼 벡터이고,
Figure 112005065731045-PAT00145
은 시간 n에서 k번째 필터 뱅크의 첫 번째 심볼이다. 따라서,
Figure 112005065731045-PAT00146
에 대하여
Figure 112005065731045-PAT00147
이면,
Figure 112005065731045-PAT00148
Figure 112005065731045-PAT00149
에 의해 정정된다.Where formula
Figure 112005065731045-PAT00144
Is the past decision symbol vector for the output symbols of the i th trellis coder,
Figure 112005065731045-PAT00145
Is the first symbol of the k-th filter bank at time n. therefore,
Figure 112005065731045-PAT00146
about
Figure 112005065731045-PAT00147
If,
Figure 112005065731045-PAT00148
silver
Figure 112005065731045-PAT00149
Corrected by

경우 3: 본 과정은 임의의 필드의 세 번째 세그먼트부터 적용되며, 송신기의 멀티플렉서의 구조, 예를 들면 세그먼트들사이에 삽입된 세그먼트의 동기(sinc)와 3개의 세그먼트의 패턴들에 의존한다. 즉, 세그먼트 동기가 수신되면, 4개의 비터비 디코더들은 입력없이 순환(cycle)하며 이로써 스킵된(skipped) 4개의 비터비 디코더들은 다음 순환시에 correction ordering을 변화시킨다. 스킵된 i 번째 비터비 디코더에 의한 FBF의 정정 과정에서, 세그먼트 동기의 영향은 다음 수학식 29처럼 반영된다.Case 3: This procedure applies from the third segment of any field and depends on the structure of the transmitter's multiplexer, for example the segment's sync and the three segment's patterns inserted between the segments. That is, when segment synchronization is received, the four Viterbi decoders cycle without input and the four Viterbi decoders that are skipped change the correction ordering on the next cycle. In the process of correcting the FBF by the skipped i-th Viterbi decoder, the effect of segment synchronization is reflected as in Equation 29 below.

Figure 112005065731045-PAT00150
Figure 112005065731045-PAT00150

여기서,

Figure 112005065731045-PAT00151
은 시간 n에서 k 번째 필터 뱅크의 첫 번째 위치에 위치하는 세그먼트 동기를 나타낸다. 상기 식 29는, 28식에서
Figure 112005065731045-PAT00152
부터
Figure 112005065731045-PAT00153
까지에 대응하는 과거 판정 심볼들을 필트 뱅크 하나 더 만큼 예를 들면
Figure 112005065731045-PAT00154
부터
Figure 112005065731045-PAT00155
까지 시프트하는 것을 보여준다. 따라서, 식 28의 정정 과정은, 세그먼트 동기 입력에 앞서서 판정된 심볼들에는 적용될 수 없으며, 수행될 딜레이된 정정과정은 다음과 같다.here,
Figure 112005065731045-PAT00151
Denotes segment synchronization located at the first position of the k th filter bank at time n. Equation 29 is represented by 28 equations
Figure 112005065731045-PAT00152
from
Figure 112005065731045-PAT00153
Past determination symbols corresponding to up to one more filter bank, for example
Figure 112005065731045-PAT00154
from
Figure 112005065731045-PAT00155
Show shift up to. Therefore, the correction process of Equation 28 cannot be applied to the symbols determined before the segment synchronization input, and the delayed correction process to be performed is as follows.

만약 (k+1)=j,에 대하여

Figure 112005065731045-PAT00156
이면,
Figure 112005065731045-PAT00157
Figure 112005065731045-PAT00158
에 의해 정정된다. 그리고, k번째 필터 뱅크에서는 정정이 수행되지 않는다. 이 것은 상기 식 29에서 ‘0’으로 나타난다. 이 딜레이된 정정 과정은 세그먼트 동기가
Figure 112005065731045-PAT00159
번째 필터 뱅크를 통과할 때까지 계속되며, 그 후에 식 28의 정정과정은, 모든 비터비 디코드들에 대하여 이상적으로 적용된다. 경우 3의 정정 패턴은, 필드의 311 데이터 세그먼트를 통해서 반복된다. 경우 1부터 경우 3까지의 정정 과정은 또한 연속적인 데이터 필드에 대하여 정확히 반복된다.For (k + 1) = j,
Figure 112005065731045-PAT00156
If,
Figure 112005065731045-PAT00157
silver
Figure 112005065731045-PAT00158
Corrected by The correction is not performed in the k-th filter bank. This is represented by '0' in Equation 29. This delayed correction process
Figure 112005065731045-PAT00159
It continues until it passes through the first filter bank, after which the correction process of equation 28 is ideally applied for all Viterbi decodes. The correction pattern of case 3 is repeated through 311 data segments of the field. The correction process from Case 1 to Case 3 is also repeated exactly for successive data fields.

도 5는 발명의 일 실시 예에 따른 채널등화방법의 설명에 제공되는 흐름도이다. 5 is a flowchart provided to explain a channel equalization method according to an embodiment of the present invention.

도 5 및 도 1을 참조하면, 버퍼(301)는 수신 신호를 저장한다(S701). 채널 추정부(303)의 상관부(501)는 상기 버퍼(301)에 저장된 수신신호에 상관 알고리즘을 적용하여 채널 추정을 한다(S703). 노이즈 제거부(503)는 상관 알고리즘을 적용함으로써 나타나는 상기 채널의 상관 노이즈를 제거한다(S705). LMS부(505)는 상관 노이즈가 제거된 상기 채널에 버퍼(301)에 저장된 수신 신호를 참조하여 MA-VSS LMS 알고리즘을 적용하여 채널 추정을 한 후(S707), 선택부(507)는 LMS부(505)가 추정한 채널 중에서, 임계값보다 큰 크기를 가진 채널을 기준 탭으로 선택하고, 선 택한 기준 탭 신호의 크기의 1/2보다 큰 채널이 위치된 곳을 기준 탭의 위치로 선택한다(S709). 훈련 등화부(305)는 채널추정부(303)에서 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정한다(S711). 만약 훈련 등화부(305)의 출력 SINR이 15dB 이상인 경우(S713: Y), 등화부(315)는 버퍼(301)에 저장된 수신 신호에 훈련 등화부(305)의 탭 계수를 이용하여 채널 등화 수행한다(S715). 판정부(311)는 등화된 신호의 출력에 대해 신뢰성을 판정한다(S717). 한편, 훈련 등화기(305)의 출력 SINR이 15dB 미만인 경우(S713: N), 채널 추정부(303)의 선택부(507)는 LMS부(505)가 추정한 채널 중에서, 또 다른 기준 탭과 그 위치를 선택한다(S709).5 and 1, the buffer 301 stores a received signal (S701). The correlator 501 of the channel estimator 303 estimates a channel by applying a correlation algorithm to the received signal stored in the buffer 301 (S703). The noise removing unit 503 removes correlation noise of the channel indicated by applying a correlation algorithm (S705). After the LMS unit 505 performs channel estimation by applying a MA-VSS LMS algorithm with reference to the received signal stored in the buffer 301 to the channel from which the correlation noise is removed (S707), the selection unit 507 selects the LMS unit. From among the channels estimated by 505, a channel having a size larger than the threshold is selected as the reference tap, and a position where a channel larger than 1/2 of the size of the selected reference tap signal is located as the reference tap position. (S709). The training equalizer 305 estimates the tap coefficient based on the channel, the reference tap, and the position of the reference tap estimated by the channel estimator 303 (S711). If the output SINR of the training equalizer 305 is 15 dB or more (S713: Y), the equalizer 315 performs channel equalization using the tap coefficient of the training equalizer 305 on the received signal stored in the buffer 301. (S715). The determination unit 311 determines the reliability of the output of the equalized signal (S717). On the other hand, when the output SINR of the training equalizer 305 is less than 15 dB (S713: N), the selecting unit 507 of the channel estimating unit 303 may select another reference tap from among the channels estimated by the LMS unit 505. The position is selected (S709).

하기 표1과 같은 스태틱(static) 및 변형된 브라질 채널에서, 본원 발명의 실시 예들을 컴퓨터 시뮬레이션하였다.In the static and modified Brazilian channels as shown in Table 1, the examples of the present invention were computer simulated.

Figure 112005065731045-PAT00160
Figure 112005065731045-PAT00160

표 1에서, 변형된 브라질 채널의 path4는 0dB 크기와 0.05Hz 도플러 위상 시프트를 가지는 반면, 브라질 채널의 path4는 -0.1 dB 크기와 0 도 위상을 가지는 점에 주목하라. 즉, pate4는, 그 크기가 0.05 Hz 사이클이 되는, 플랫한 패이딩 환경(flat fading environment)을 생성하였다. 변형된 채널 D에서, 0.15㎲에 위치한 path1은 0.05 Hz의 도플러 위상 시프트를 가진 프랫한 패이딩 환경을 생성한다. 성능은 dB 스케일의 RMSE(root mean square error)와 dB 스케일의 SINR, 및 SER(Symbol error rate)로 측정하였다. SINR 과 SER의 결과는 40필드(약 107 개의 심볼)에 대하여 50번 독립적으로 측정하여 평균한 것이다. 일반적으로, RMSE는 채널 추정기의 성능을 비교하는데 있어서 mean-square-error보다 적합하다. 추정된 CIR의 크기 옵셋(offset)은 채널 추정에 기초하여 등화기의 계수를 계산하는데 영향을 미친다. SINR은 등화기의 수렴 속도를 비교하는데 좋은 수단이다. SER은 0.2의 TOV(threshold of visibility)를 만족하데 필요한 SNR을 측정하는데 사용될 수 있다.In Table 1, note that path4 of the modified Brazilian channel has 0 dB magnitude and 0.05 Hz Doppler phase shift, while path4 of the Brazilian channel has -0.1 dB magnitude and 0 degree phase. That is, pate4 created a flat fading environment whose size is 0.05 Hz cycles. In modified channel D, path1 located at 0.15 Hz creates a flat fading environment with a Doppler phase shift of 0.05 Hz. Performance was measured by root mean square error (RMS) on dB scale, SINR on dB scale, and symbol error rate (SER). The SINR and SER results are averaged from 50 independent measurements over 40 fields (approximately 10 7 symbols). In general, RMSE is better than mean-square-error in comparing the performance of channel estimators. The magnitude offset of the estimated CIR affects calculating the coefficients of the equalizer based on the channel estimate. SINR is a good way to compare the convergence speed of an equalizer. SER can be used to measure the SNR required to satisfy a threshold of visibility (TOV) of 0.2.

도 6a와 도 6b는 본 발명의 일 실시 예에 따른 브라질 A 및 D 채널에서의 RMSE(Root Mean Square Error)를 나타낸 그래프이다. 도 6a 내지 6b와 도 8a 내지 8c에서 A, B, C, D, E, F, G는 각각 다음을 의미한다.6A and 6B are graphs illustrating Root Mean Square Error (RMSE) in Brazilian A and D channels according to an embodiment of the present invention. 6A to 6B and 8A to 8C, A, B, C, D, E, F, and G respectively mean the following.

A : DFEA: DFE

B : DFE with VD-TBl-1B: DFE with VD-TBl-1

C : DFE with VD-TBl-15C: DFE with VD-TBl-15

D : CT-DFE based DFE with VD-TBL-1D: CT-DFE based DFE with VD-TBL-1

E : CT-DFE based DFE with VD-TBL-15E: CT-DFE based DFE with VD-TBL-15

F : GT-DFE based DFE with VD-TBL-1F: GT-DFE based DFE with VD-TBL-1

G : GT-DFE based DFE with VD-TBL-15G: GT-DFE based DFE with VD-TBL-15

여기서, VD-TBL-1는 비터비 디코더의 트레이스 백의 길이가 1임을 나타내며, VD-TBL-15는 비터비 디코더의 트레이스 백의 길이가 15임을 나타낸다.Here, VD-TBL-1 indicates that the length of the traceback of the Viterbi decoder is 1, and VD-TBL-15 indicates that the length of the traceback of the Viterbi decoder is 15.

도 6a와 도 6b에서는, 4가지의 서로 다른 채널 추정 기법들 즉, (a) correlation, (b) MA-VSS LMS 알고리즘, (c) correlation 과 MA-VSS LMS 알고리즘, 및 (d) 본원 발명의 일 실시예(수학식 6에서 4개의 서로 다른 임계값들

Figure 112005065731045-PAT00161
로 행함) 등으로 RMSE의 성능을 비교하였다. MA-VSS LMS 알고리즘의 파라미터의 파라미터는, 다음과 같다.6A and 6B, four different channel estimation techniques, namely (a) correlation, (b) MA-VSS LMS algorithm, (c) correlation and MA-VSS LMS algorithm, and (d) of the present invention One embodiment (four different thresholds in equation (6)
Figure 112005065731045-PAT00161
The performance of RMSE was compared. The parameters of the parameters of the MA-VSS LMS algorithm are as follows.

Figure 112005065731045-PAT00162
Figure 112005065731045-PAT00162

도 6a 와 도 6b에서 알 수 있듯이, 임계값(

Figure 112005065731045-PAT00163
)을 사용하지 않은 경우(예를 들면 (a), (c))에는 상관 노이즈 때문에 성능 열화가 발생한다. MA-VSS LMS 알고리즘의 RMSE는 불충분한 훈련 열 길이에 기인한 성능 손실 때문에 브라질 D와 같은 채널에서 증가된다. 한편, 본원 발명의 실시예들에서는, MA-VSS LMS 알고리즘의 계수들을 thresholded 상관 알고리즘 적용후에 잔존한 탭들로 초기화하였으므로, 훈련 열의 길이가 짧음으로 인한 단점을 극복하였다. As can be seen in Figures 6a and 6b, the threshold (
Figure 112005065731045-PAT00163
) Is not used (for example, (a) and (c)), performance degradation occurs due to correlation noise. The RMSE of the MA-VSS LMS algorithm is increased in channels such as Brazil D due to performance loss due to insufficient training column length. On the other hand, in the embodiments of the present invention, since the coefficients of the MA-VSS LMS algorithm are initialized with the remaining taps after the thresholded correlation algorithm is applied, the shortcomings due to the short training string are overcome.

도 6b를 참조하면, 본원 발명의 실시예들은,

Figure 112005065731045-PAT00164
의 크기에 따라서 다른 성능을 보여줌을 알 수 있다.
Figure 112005065731045-PAT00165
가 0.2 인 경우는
Figure 112005065731045-PAT00166
={0.1, 0.3, 0.4}인 경우보다, 입력되는 SNR이 증가됨에 따라서, RMSE가 더 작아진다.
Figure 112005065731045-PAT00167
=0.1 인 경우와
Figure 112005065731045-PAT00168
={0.3, 0.4}인 경우는, 각각 잔류 상관 노이즈와 버려진 큰 채널 탭들로부터 기인한 MA-VSS LMA 알고리즘의 불충분한 초기화 때문이다. 따라서,
Figure 112005065731045-PAT00169
=0.2 인 경우가 이상적이다.Referring to Figure 6b, embodiments of the present invention,
Figure 112005065731045-PAT00164
It can be seen that it shows different performance depending on the size of.
Figure 112005065731045-PAT00165
Is 0.2
Figure 112005065731045-PAT00166
As the input SNR is increased, the RMSE becomes smaller than the case of = {0.1, 0.3, 0.4}.
Figure 112005065731045-PAT00167
With = 0.1 and
Figure 112005065731045-PAT00168
The case of = {0.3, 0.4} is due to insufficient initialization of the MA-VSS LMA algorithm resulting from residual correlation noise and discarded large channel taps, respectively. therefore,
Figure 112005065731045-PAT00169
Ideally, = 0.2.

도 7a 내지 도 7d는 본 발명의 일 실시 예에 따른 브라질 A, C, D, 및 E채널에서 등화부의 신호대 잡음+간섭비율(SINR: Signal to Interface plus Ratio)을 나타낸 그래프이다. 도 7a 내지 도7d에서, A : DFE, B : CT-DFE-based DFE, C : GT-DFE-based DFE를 나타낸다.7A to 7D are graphs showing signal to interface plus ratios (SINRs) of equalizers in Brazilian A, C, D, and E channels according to an embodiment of the present invention. 7A to 7D, A: DFE, B: CT-DFE-based DFE, and C: GT-DFE-based DFE are shown.

등화부의 수렴 특성 예를 들면 start-up SINR, 수렴 속도, 및 수렴 후의 SINR을 각각 다음의 경우들에서 비교하였다.Convergence characteristics of the equalizer, for example start-up SINR, convergence rate, and SINR after convergence were compared in the following cases, respectively.

가) GT-DFE based 등화부GT-DFE based equalizer

나) CT-DFE based 등화부B) CT-DFE based equalizer

다) GT-DFE가 없는 등화부C) Equalizer without GT-DFE

CT-DFE based 등화부에서는, 기준 탭이 채널 특성에 따라서 선택된 후, 기준 탭이 CT-DFE의 FFF의 최우측에 위치된다. 탭 400개의 FFF와 탭620개의 FBF가 사용된다. 탭 400개의 GT-FFF와 CT-FFF도 사용되며 GT-aFBF 의 탭 길이는

Figure 112005065731045-PAT00170
에 따라서 변화된다. GT-DFE, CT-DFE 및 DFE의 MA-VSS LMS 알고리즘의 파라미터 값들은 하기 표2로 요약하였다.In the CT-DFE based equalizer, after the reference tap is selected according to the channel characteristics, the reference tap is located at the rightmost side of the FFF of the CT-DFE. 400 tabs FFF and 620 tabs FBF are used. 400 tabs GT-FFF and CT-FFF are also used, and the tap length of GT-aFBF
Figure 112005065731045-PAT00170
Will change accordingly. The parameter values of the MA-VSS LMS algorithm of GT-DFE, CT-DFE and DFE are summarized in Table 2 below.

Figure 112005065731045-PAT00171
Figure 112005065731045-PAT00171

표2에서, (*) 마크를 가진 파라미터들은 CT-DFE에서 사용되지 않았다. GT-DFE와 CT-DFE의 훈련이 수렴하도록 하기 위해서, 훈련 열에 해당되는 신호 샘플들을 18회 반복하였다. 사용된 비터비 디코더의 추적 백 길이(trace back length)는 15이다. 후술하는 도7a-7d에서 등화부의 SINR 곡선은, 심볼 개수(個數)의 함수로서 주어지며, 각 점(point)은 1000개 이상의 심볼의 평균을 나타낸다.In Table 2, parameters with a (*) mark were not used in the CT-DFE. In order for the training of the GT-DFE and CT-DFE to converge, the signal samples corresponding to the training sequence were repeated 18 times. The trace back length of the Viterbi decoder used is 15. In Figs. 7A to 7D described later, the SINR curve of the equalizer is given as a function of the number of symbols, and each point represents an average of 1000 or more symbols.

도 7a 내지 도 7d 참조하면, 기준 탭의 위치는 DFE의 초기화를 위해서 주의 깊게 선별되어야 하고, CT-DFE에서는 에러 전파에 의한 SINR 손실이 FBF가 없는 SINR 이득보다 더 크며, GT-DFE는 빠른 start-up, 수렴 속도, 고출력 SINR 을 보여준다. 결과적으로, 계수들의 초기화는 등화부를 광대역화하는 데 필요하고, GT-DFE는 CT-DFE보다 8VSB DTV에 적합하다. 7A to 7D, the position of the reference tap should be carefully selected for the initialization of the DFE, and in CT-DFE, the SINR loss due to error propagation is greater than the SINR gain without FBF, and the GT-DFE starts fast. -up, convergence speed, high power SINR As a result, initialization of the coefficients is necessary to widen the equalizer, and the GT-DFE is more suitable for 8VSB DTV than the CT-DFE.

도 8a 내지 도 8c은 본 발명의 일 실시 예에 따른 브라질 E 및 C 채널에서 등화부의 SER(Symbol Error Rate)를 나타낸 그래프이다.8A to 8C are graphs illustrating SER (Symbol Error Rate) of the equalizer in the Brazilian E and C channels according to an embodiment of the present invention.

GT-DFE based 등화부, CT-DFE based 등화부, 등화부의 SER 성능을 입력 SNR의 함수로서 비교하였다. SER은 10,000개의 심볼에 대하여 계산되었다. The SER performances of the GT-DFE based equalizer, CT-DFE based equalizer, and equalizer were compared as a function of the input SNR. SER was calculated for 10,000 symbols.

도 8a를 참조하면, 브라질 E 채널에서 SER은 커브를 형성한다. 도 8a에서, GT-DFE based DFE는 입력 SNR이 23 dB보다 큰 경우에는 DFE 보다 더 낮은 SER을 보여준다. 특히, 주목할 것은 E(GT-DFE based DFE)의 경우가 G의 경우(DFE)보다 성능이 좋다는 점이다. 입력 SNR의 크기가 23dB이 상인 경우, 비터비 디코드의 트레이스 백의 길이가 15인 경우(E, G)가 1인 경우(A, F)보다 약 1dB 정도 입력 SNR이 개선된다는 것을 알 수 있다. 이와 반대로, CT-DFE based DFE는, 도7d에 나타난 것처럼, 에러 전파 때문에 최악의 SER 성능을 보여준다. 도8a에서, GT-DFE based DFE는 입력 SNR이 22 dB 이상인 경우에는 TOV를 만족한다.Referring to FIG. 8A, the SER forms a curve in the Brazilian E channel. In FIG. 8A, the GT-DFE based DFE shows a lower SER than the DFE when the input SNR is greater than 23 dB. In particular, it is noted that the performance of E (GT-DFE based DFE) is better than that of G (DFE). It can be seen that when the magnitude of the input SNR is 23 dB or more, the input SNR is improved by about 1 dB compared to the case where the traceback length of Viterbi decode is 15 (E, G) is 1 (A, F). In contrast, the CT-DFE based DFE shows the worst SER performance due to error propagation, as shown in FIG. 7D. In FIG. 8A, the GT-DFE based DFE satisfies TOV when the input SNR is 22 dB or more.

도 8b 및 도 8c를 참조하면, 변형된 브라질 C 및 D 채널에서의 SER 성능을 보여준다. 이들 채널에서, GT-DFE에서의 기준 탭과 그 위치는브라질 채널 C와 D채널의 것과 동일하다. 도 8b는, 비터비 디코더의 트레이스 백의 길이가 15인 경우 GT-DFE based DFE가 다른 것들과 비교할 때 최상의 성능을 보여 줌을 나타내며, 반면에 비터비 디코더의 트레이스 백의 길이가 1인 경우의 GT-DFE based DFE는 비터비 디코더의 트레이스 백의 길이가 1인 경우의 DFE 와 유사한 성능을 보여준다. CT-DFE based DFE의 성능 열화는 도 7b로부터 분석될 수 있다. 도 8c를 참조하면, 비터비 디코더의 트레이스 백의 길이가 15인 등화장치는, 비터비 디코더의 트레이스 백의 길이가 1인 등화장치보다 나은 성능을 보여준다. 기준 탭의 효과는 비터비 디코더의 트레이스 백의 길이가 15로 함으로써 최소화 될 수 있다. 도 8b 와 8c로부터, 입력 SNR이 20dB 인 경우, TOV를 매우 잘 만족함을 알 수 있다.8B and 8C show SER performance in modified Brazilian C and D channels. In these channels, the reference taps and their positions in the GT-DFE are the same as those of the Brazilian channel C and D channels. 8B shows that the GT-DFE based DFE shows the best performance when compared to the others when the traceback length of the Viterbi decoder is 15, whereas the GT- when the traceback length of the Viterbi decoder is 1 DFE based DFE shows similar performance to DFE when the traceback length of the Viterbi decoder is one. Performance degradation of the CT-DFE based DFE can be analyzed from FIG. 7B. Referring to FIG. 8C, an equalizer having a traceback length of 15 in a Viterbi decoder exhibits better performance than an equalizer having a traceback length of 1 in a Viterbi decoder. The effect of the reference tap can be minimized by making the traceback length of the Viterbi decoder 15. 8B and 8C, it can be seen that the TOV is very well satisfied when the input SNR is 20 dB.

상술한 바와 같이 본 발명의 채널등화장치 및 그 방법에 따르면, 기준 탭의 위치를 채널의 특성에 따라서 변화시킴으로써, 에러 전파를 최소화한다.As described above, according to the channel equalizer and the method of the present invention, error propagation is minimized by changing the position of the reference tap in accordance with the characteristics of the channel.

비록 실시 예가 첨부된 도면을 참고로 설명되었지만 본 방법은 상술한 실시 예에 국한되지 않고 다양한 다른 변화 및 변경이 당업자에 의해 본 발명의 정신 및 범위를 벗어나지 않고 이루어질 수 있을 것이다. 그러한 모든 변화 및 변경은 첨부된 청구범위에 의해 정의된 본 발명의 범위 내에 포함되도록 한다. Although the embodiments have been described with reference to the accompanying drawings, the method is not limited to the above-described embodiments and various other changes and modifications can be made by those skilled in the art without departing from the spirit and scope of the invention. All such changes and modifications are intended to be included within the scope of the invention as defined by the appended claims.

Claims (5)

수신된 신호에 대하여 채널을 추정하고, 추정한 채널로부터 기준 탭과 이 기준 탭의 위치를 선택하는 채널 추정부;A channel estimator for estimating a channel with respect to the received signal and selecting a reference tap and a position of the reference tap from the estimated channel; 상기 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정하는 훈련 등화부(DFE); 및 A training equalizer (DFE) for estimating a tap coefficient based on the estimated channel, the reference tap, and the position of the reference tap; And 추정된 상기 탭 계수를 이용하여 수신된 신호를 등화하는 등화부(DFE: Decision Feedback Equalizer);를 포함하는 에러 전파를 최소화한 채널등화장치.And an equalization unit (DFE: Decision Feedback Equalizer) for equalizing the received signal by using the estimated tap coefficients. 제1항에 있어서, The method of claim 1, 상기 채널 추정부는,The channel estimator, 수신된 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하는 상관부;A correlator configured to estimate a channel by applying a correlation algorithm to the received signal; 상기 상관부가 추정한 채널의 노이즈를 제거하는 노이즈 제거부; A noise removing unit for removing noise of the channel estimated by the correlation unit; 수신된 신호와 상기 노이즈가 제거된 채널에 MA-VSS(Moving-Average Variable Step-Size) LMS 알고리즘을 적용하여 채널을 추정하는 LMS 부; 및An LMS unit for estimating a channel by applying a moving-average variable step-size (MA-VSS) LMS algorithm to a received signal and the channel from which the noise is removed; And 상기 LMS 부가 추정한 채널 중에서 기준 탭 과 기준 탭 위치를 선택하는 선택부;를 더 포함하는 것을 특징으로 하는 에러 전파를 최소화한 채널등화장치.And a selector for selecting a reference tap and a reference tap position from among the channel estimated by the LMS. 제2항에 있어서, The method of claim 2, 상기 선택부는, The selection unit, 상기 LMS 부가 추정한 채널 중에서, 임계값보다 큰 크기를 가진 채널을 기준 탭으로 선택하고, 선택한 기준 탭 신호의 크기의 1/2보다 큰 채널이 위치된 곳을 기준 탭의 위치로 선택하는 것을 특징으로 하는 에러 전파를 최소화한 채널등화장치. From among the channels estimated by the LMS, a channel having a size larger than a threshold value is selected as a reference tap, and a location where a channel larger than 1/2 of the size of the selected reference tap signal is located is selected as a reference tap position. Channel equalizer with minimal error propagation. a) 수신된 신호에 대하여 채널을 추정하고, 추정한 채널로부터 기준 탭과 이 기준 탭의 위치를 선택하는 단계;a) estimating a channel for the received signal and selecting a reference tap and a position of the reference tap from the estimated channel; b) 상기 추정한 채널, 기준 탭, 및 기준 탭의 위치에 기초하여, 탭 계수를 추정하는 단계; 및 b) estimating a tap coefficient based on the estimated channel, reference tap, and position of the reference tap; And c) 추정된 상기 탭 계수를 이용하여 수신된 신호를 등화하는 단계;를 포함하는 에러 전파를 최소화한 채널등화방법.and c) equalizing the received signal using the estimated tap coefficients. 제4항에 있어서,The method of claim 4, wherein 상기 a) 단계는,Step a) is 수신된 신호에 대하여 상관 알고리즘을 적용하여 채널을 추정하는 단계;Estimating a channel by applying a correlation algorithm to the received signal; 상기 추정한 채널의 노이즈를 제거하는 노이즈 제거 단계; A noise removing step of removing noise of the estimated channel; 수신된 신호와 상기 노이즈가 제거된 채널에 MA-VSS(Moving-Average Variable Step-Size) LMS 알고리즘을 적용하여 채널을 추정하는 단계; 및Estimating a channel by applying a moving-average variable step-size (MA-VSS) LMS algorithm to the received signal and the channel from which the noise is removed; And 상기 LMS 알고리즘을 적용하여 추정한 채널 중에서 기준 탭 과 기준 탭 위치를 선택하는 단계;를 포함하는 것을 특징으로 하는 에러 전파를 최소화한 채널등화 방법.Selecting a reference tap and a reference tap position from among estimated channels by applying the LMS algorithm.
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