KR20060113001A - Defect detecting method for light emitting display - Google Patents

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KR20060113001A KR1020050035776A KR20050035776A KR20060113001A KR 20060113001 A KR20060113001 A KR 20060113001A KR 1020050035776 A KR1020050035776 A KR 1020050035776A KR 20050035776 A KR20050035776 A KR 20050035776A KR 20060113001 A KR20060113001 A KR 20060113001A
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Abstract

A defect judging method of a light emitting display is provided to determine that defective pixels are included in the light emitting display, if the amount of leak current is over 1muA in applying inverse voltage. A defect judging method of a light emitting display includes the steps of: manufacturing the light emitting display displaying an image by pixels including a light emitting element and a pixel circuit; applying inverse voltage to the light emitting element; and judging defects of the light emitting display by measuring the leak current flowing in light emitting element. The defect judging method determines that the light emitting display is defective if the absolute value of the leak current is over a predetermined value.

Description

발광 표시장치의 불량판단방법{DEFECT DETECTING METHOD FOR LIGHT EMITTING DISPLAY}DEFECT DETECTING METHOD FOR LIGHT EMITTING DISPLAY}

도 1은 일반적인 발광소자를 나타내는 도면이다. 1 is a view showing a general light emitting device.

도 2는 본 발명에 따른 발광표시장치의 제 1 실시예를 구조도이다. 2 is a structural diagram of a first embodiment of a light emitting display device according to the present invention;

도 3은 도 2의 발광 표시장치에서 채용된 화소를 나타내는 회로도이다. 3 is a circuit diagram illustrating a pixel employed in the light emitting display device of FIG. 2.

도 4는 본 발명에 따른 발광 표시장치의 제 2 실시예를 나타내는 구조도이다. 4 is a structural diagram illustrating a second embodiment of a light emitting display device according to the present invention.

도 5는 도 4의 발광 표시장치에 채용된 화소의 제 1 실시예를 나타내는 회로도이다. FIG. 5 is a circuit diagram illustrating a first embodiment of a pixel employed in the light emitting display device of FIG. 4.

도 6은 도 4의 발광 표시장치에 채용된 화소의 제 2 실시예를 나타내는 회로도이다. 6 is a circuit diagram illustrating a second embodiment of a pixel employed in the light emitting display device of FIG. 4.

도 7a 및 도 7b는 역전압이 인가된 발광표시장치에 흐르는 누설전류의 양을 나타내는 도면이다. 7A and 7B are diagrams showing the amount of leakage current flowing through the light emitting display device to which the reverse voltage is applied.

***도면의 주요부분에 대한 부호 설명****** Explanation of symbols on main parts of drawings ***

100: 화소부 200: 데이터구동부100: pixel portion 200: data driver

300: 주사구동부 400: 전원공급부300: scan driver 400: power supply

본 발명은 발광표시장치의 불량을 판단하는 방법에 관한 것으로, 더욱 상세히 설명하면, 발광소자에 역전압을 인가함으로써 누설전류를 측정하여 불량화소가 있는 패널을 파악하도록 하는 발광 표시장치의 불량을 판단하는 방법에 관한 것이다. The present invention relates to a method of determining a failure of a light emitting display device. In detail, a failure of a light emitting display device for determining a panel having defective pixels by measuring a leakage current by applying a reverse voltage to the light emitting device is determined. It is about how to.

퍼스널 컴퓨터, 휴대전화기, PDA 등의 휴대 정보단말기 등의 표시장치나 각종 정보기기의 모니터로서 박형 경량의 평판 표시장치가 이용되고 있다. 이러한 평판 표시장치에는 액정 패널을 이용한 LCD, 유기발광 소자를 이용한 유기발광 표시장치, 플라즈마 패널을 이용한 PDP 등이 알려져 있다. BACKGROUND ART A thin, lightweight flat panel display is used as a display device of a portable information terminal such as a personal computer, a cellular phone, a PDA, or a monitor of various information devices. Such flat panel displays include LCDs using liquid crystal panels, organic light emitting displays using organic light emitting diodes, and PDPs using plasma panels.

이러한 평판 표시장치는 기판 상에 매트릭스 형태로 복수의 화소를 배치하여 표시영역으로 하고, 각 화소에 주사선과 데이터선을 연결하여 화소에 데이터신호를 선택적으로 인가하여 디스플레이를 한다. In such a flat panel display, a plurality of pixels are arranged on a substrate to form a display area, and a scan line and a data line are connected to each pixel to selectively apply a data signal to the pixel for display.

이러한 현재 평판 표시장치들 중에서 발광 표시장치는 LCD 소자에 비해 약 30,000배 이상의 빠른 응답 속도를 가지고 있어 동영상의 구현이 용이하고, 자체적으로 발광하여 휘도가 높고, 시야각이 넓은 장점이 있어 차세대 디스플레이로 주목받고 있다. Among the current flat panel display devices, the light emitting display device has a response speed of about 30,000 times faster than the LCD device, and thus, it is easy to implement a video, emits light by itself, and has a high brightness and wide viewing angle. I am getting it.

발광 표시장치로는 유기 발광 소자를 이용한 유기 발광 표시장치와 무기 발광 소자를 이용한 무기 발광 표시장치가 있다. 유기 발광 소자는 유기 발광 다이오드(organic light emitting diode, OLED)로도 호칭되며, 애노드 전극, 캐소드 전극 및 이들 사이에 위치하여 전자와 정공의 결합에 의하여 발광하는 유기 발광층을 포함한다. 무기 발광 소자는 발광 다이오드(light emitting diode, LED)로도 호칭되며, 유기 발광 다이오드와 달리 무기물인 발광층, 일례로 PN 접합된 반도체로 이루어진 발광층을 포함한다. The light emitting display includes an organic light emitting display using an organic light emitting element and an inorganic light emitting display using an inorganic light emitting element. The organic light emitting diode is also referred to as an organic light emitting diode (OLED), and includes an anode, a cathode, and an organic light emitting layer disposed therebetween to emit light by a combination of electrons and holes. The inorganic light emitting device is also referred to as a light emitting diode (LED) and, unlike an organic light emitting diode, includes an inorganic light emitting layer, for example, a light emitting layer made of a PN bonded semiconductor.

도 1은 일반적인 발광소자를 나타내는 도면이다. 도 1을 참조하면, 발광소자는 애노드전극(20)과 캐소드전극(21) 사이에 형성된 발광층(Emitting Layer : EL), 정공 수송층(Hole Transfer Layer : HTL)과, 전자 수송층(Eltctron Transfer Layer : ETL)을 구비한다.1 is a view showing a general light emitting device. Referring to FIG. 1, the light emitting device includes an emission layer (EL), a hole transfer layer (HTL), and an electron transport layer (ETL) formed between the anode electrode 20 and the cathode electrode 21. ).

애노드전극(20)은 발광층(EL)으로 정공을 공급할 수 있도록 제 1전원과 접속된다. 캐소드전극(21)은 발광층(EL)으로 전자를 공급할 수 있도록 제 1전원보다 낮은 제 2전원과 접속된다. 즉, 애노드전극(20)은 캐소드전극(21)에 비하여 상대적으로 높은 정극성(+)의 전위를 갖고, 캐소드전극(21)은 애노드전극(20)에 비하여 상대적으로 낮은 부극성(-)의 전위를 갖는다. The anode electrode 20 is connected to the first power source to supply holes to the light emitting layer EL. The cathode electrode 21 is connected to a second power source lower than the first power source to supply electrons to the light emitting layer EL. That is, the anode electrode 20 has a higher potential of positive polarity (+) than the cathode electrode 21, and the cathode electrode 21 has a relatively low polarity (−) than the anode electrode 20. Has a potential.

정공 수송층(HTL)은 애노드전극(20)으로부터 공급되는 정공을 가속하여 발광층(EL)으로 공급한다. 전자 수송층(ETL)은 캐소드전극(21)으로부터 공급되는 전자를 가속하여 발광층(EL)으로 공급한다. 정공 수송층(HTL)으로부터 공급되는 정공과 전자 수송층(ETL)으로부터 공급되는 전자는 발광층(EL)에서 충돌한다. 이때, 발광층(EL)에서 전자와 정공이 재결합하게 되고, 이에 따라 소정의 빛이 생성된다. 실질적으로 발광층(EL)은 유기물질 등으로 형성되어 전자와 정공이 재결합할 때 적 색(R), 녹색(G) 및 청색(B) 중 어느 하나의 빛을 생성한다. The hole transport layer HTL accelerates holes supplied from the anode electrode 20 and supplies them to the light emitting layer EL. The electron transport layer ETL accelerates and supplies electrons supplied from the cathode electrode 21 to the emission layer EL. Holes supplied from the hole transport layer HTL and electrons supplied from the electron transport layer ETL collide in the emission layer EL. In this case, electrons and holes are recombined in the emission layer EL, thereby generating predetermined light. Subsequently, the emission layer EL is formed of an organic material to generate light of any one of red (R), green (G), and blue (B) when electrons and holes recombine.

한편, 발광소자는 정공 수송층(HTL)과 애노드전극(20) 사이에 위치되는 정공 주입층(Hole Injection Layer : HIL)과, 전자 수송층(ETL)과 캐소드전극(21) 사이에 위치되는 전자 주입층(Electron Injection Layer : EIL)을 더 포함한다. 정공 주입층(HIL)은 정공을 정공 수송층(HTL)으로 공급한다. 전자 주입층(EIL)은 전자를 전자 수송층(ETL)으로 공급한다. Meanwhile, the light emitting device includes a hole injection layer (HIL) located between the hole transport layer (HTL) and the anode electrode 20, and an electron injection layer located between the electron transport layer (ETL) and the cathode electrode 21. (Electron Injection Layer: EIL) is further included. The hole injection layer HIL supplies holes to the hole transport layer HTL. The electron injection layer EIL supplies electrons to the electron transport layer ETL.

상기와 같이 구성되는 발광소자를 포함하는 화소를 이용하여 화상을 표시하는 발광표시장치는 화소를 형성하는 과정 중에 화소에 불량화소가 발생할 우려가 있으며, 이러한 불량화소에 의해 발광표시장치의 화상을 표현하는 품위가 낮아지게 되는 문제점이 있다. 또한, 발광 표시장치를 장시간 사용하는 경우에 화소에 불량이 나타나는 문제점이 있다. In the light emitting display device which displays an image using a pixel including the light emitting device configured as described above, a bad pixel may be generated in the pixel during the pixel formation process, and the bad pixel expresses the image of the light emitting display device. There is a problem that the dignity is lowered. In addition, when the light emitting display device is used for a long time, a defect occurs in the pixel.

따라서, 본 발명은 상기 종래 기술의 문제점을 해결하기 위하여 창출된 것으로, 본 발명의 목적은 발광소자에 역전압을 인가함으로써 발생하는 누설전류의 양을 파악하여 누설전류의 양이 높게 나온 발광 표시장치는 불량화소가 있는 발광 표시장치로 파악하도록 하는 발광 표시장치의 불량 판단방법을 제공하는 것이다. Accordingly, the present invention has been made to solve the problems of the prior art, and an object of the present invention is to identify the amount of leakage current generated by applying a reverse voltage to the light emitting device, and the amount of leakage current is high. The present invention provides a method for determining a failure of a light emitting display device, which allows the light emitting display device having a bad pixel to be identified.

상기 목적을 달성하기 위하여 본 발명의 제 1 측면은, 발광소자 및 화소회로 를 구비하는 화소에 의해 화상을 표시하는 발광표시장치를 제조하는 단계, 상기 발광소자에 역전압을 인가하는 단계 및 상기 역전압을 인가하는 단계에서 발광소자에 흐르는 누설전류를 측정하여 상기 발광표시장치의 불량을 판단하는 단계를 포함하는 발광표시장치의 불량 판단방법을 제공하는 것이다. In order to achieve the above object, a first aspect of the present invention provides a method of manufacturing a light emitting display device that displays an image by a pixel including a light emitting element and a pixel circuit, applying a reverse voltage to the light emitting element, and A method of determining a failure of a light emitting display device, the method including determining a failure of the light emitting display device by measuring a leakage current flowing through the light emitting device in a step of applying a voltage.

본 발명의 제 2 측면은, 제 1 단자를 통해 제 1 전압레벨과 제 2 단자를 통해 상기 제 1 전압레벨보다 낮은 제 2 전압레벨을 전달받으며, 데이터선을 통해 데이터신호를 전달받아 상기 제 1 단자에서 상기 제 2 단자 방향으로 전류를 구동하여 발광하는 화소를 포함하는 발광표시장치를 제조하는 단계, 상기 제 1 단자에 제 3 전압레벨과 상기 제 2 단자에 상기 제 3 전압레벨보다 전압레벨이 높은 제 4 전압레벨을 전달하되, 상기 제 3 전압레벨과 상기 제 4 전압레벨의 차이는 상기 제 1 전압레벨과 상기 제 2 전압레벨의 차이보다 더 크게 인가하는 역전압인가단계 및 상기 역전압인가단계에서 상기 제 1 단자와 상기 제 2 단자 사이에 흐르는 전류량을 측정하여 발광표시장치의 불량을 판단하는 단계를 포함하는 발광표시장치의 불량판단방법을 제공하는 것이다. According to a second aspect of the present invention, a first voltage level is received through a first terminal and a second voltage level lower than the first voltage level through a second terminal, and a data signal is received through a data line. Manufacturing a light emitting display device including a pixel which emits light by driving a current toward a second terminal from a terminal, wherein the voltage level is higher than the third voltage level at the first terminal and the third voltage level at the second terminal; A high voltage level is transferred, and a difference between the third voltage level and the fourth voltage level is greater than a difference between the first voltage level and the second voltage level; A method of determining a failure of a light emitting display device may include determining a failure of a light emitting display device by measuring an amount of current flowing between the first terminal and the second terminal in the step.

이하, 본 발명의 실시예를 첨부한 도면을 참조하여 설명하면 다음과 같다.Hereinafter, an embodiment of the present invention will be described with reference to the accompanying drawings.

도 2는 본 발명에 따른 발광표시장치의 제 1 실시예를 구조도이다. 도 2을 참조하여 설명하면, 발광 표시장치는 화상을 표시하는 화소부(100), 데이터신호를 전달하는 데이터구동부(200), 주사신호를 전달하는 주사구동부(300) 및 전원공급부(400)를 포함한다. 2 is a structural diagram of a first embodiment of a light emitting display device according to the present invention; Referring to FIG. 2, the light emitting display device includes a pixel unit 100 for displaying an image, a data driver 200 for transmitting a data signal, a scan driver 300 for transmitting a scan signal, and a power supply unit 400. Include.

화소부(100)는 가로방향으로 배열된 주사선(S1,S2,...Sn-1,Sn)과 세로방향으로 배열된 데이터선(D1,D2,..Dm-1,Dm)이 형성되며 주사선(S1,S2,...Sn-1,Sn)과 데이터선(D1,D2,..Dm-1,Dm) 교차한 영역에 복수의 화소(110)가 형성되어 주사선 및 데이터선을 통해 전달받은 신호를 이용하여 화상을 표시한다. 또한, 복수의 화소(110)는 전원공급부(400)로부터 제 1 전원(ELVdd)과 제 2 전원(ELVss)을 공급받아 구동하게 된다. 제 1 전원(ELVdd)은 화소부(100)에 배선의 형태로 연결되어 각 화소에 제 1 전원(ELVdd)의 전압을 전달하고 제 2 전원(ELVss)는 화소부(100)의 전면에 층착되어 화소에 흐르는 전류가 제 2 전원(ELVss)로 흘러나가도록 할 수 있다. The pixel unit 100 includes scan lines S1, S2, ... Sn-1, Sn arranged in the horizontal direction and data lines D1, D2, .. Dm-1, Dm arranged in the vertical direction. A plurality of pixels 110 are formed in a region where the scan lines S1, S2, ... Sn-1, Sn and the data lines D1, D2, .. Dm-1, Dm cross each other to form a plurality of pixels 110 through the scan lines and the data lines. The image is displayed using the received signal. In addition, the plurality of pixels 110 may be driven by receiving the first power source ELVdd and the second power source ELVss from the power supply unit 400. The first power source ELVdd is connected to the pixel unit 100 in the form of a wire to transfer the voltage of the first power source ELVdd to each pixel, and the second power source ELVss is laminated on the front surface of the pixel unit 100. The current flowing in the pixel may flow out to the second power source ELVss.

데이터구동부(200)는 데이터신호를 출력하며, 화소부(100)의 세로방향으로 배열된 데이터선(D1,D2...Dm-1,Dm)에 연결되어 데이터신호를 화소부(100)에 전달한다. 데이터구동부(200)는 발광표시장치에 역바이어스 전압을 인가하는 경우에는 데이터신호의 전압레벨이 제 1 전원(ELVdd)의 전압레벨보다 더 낮은 전압레벨을 갖도록 한다. The data driver 200 outputs a data signal, and is connected to the data lines D1, D2... Dm-1, Dm arranged in the vertical direction of the pixel unit 100 to transmit the data signal to the pixel unit 100. To pass. When the reverse bias voltage is applied to the light emitting display device, the data driver 200 has a voltage level lower than that of the first power supply ELVdd.

주사구동부(300)는 전원공급부(400)으로부터 제 3 및 제 4 전원(VVdd 및 VVss)를 전달받아 구동하여 주사신호를 출력하며, 화소부(100)의 가로 방향으로 배열된 주사선(S1,S2,...Sn-1,Sn)에 연결되어 주사신호를 화소부(100)에 전달한다. The scan driver 300 receives and drives the third and fourth power sources VVdd and VVss from the power supply unit 400 to output scan signals, and scan lines S1 and S2 arranged in the horizontal direction of the pixel unit 100. And ... are connected to Sn-1 and Sn to transfer the scanning signal to the pixel unit 100.

전원공급부(400)는 화소부(100)에 제 1 전원(ELVdd)와 제 2 전원(ELVss)을 전달한다. 전원공급부(400)는 발광표시장치가 정상적인 동작을 하는 경우에 제 1 전원(ELVdd)가 제 2 전원(ELVss) 보다 더 높은 전압레벨을 갖도록 한다. 그리고, 발광표시장치에 역전압을 인가하는 경우에 제 1 전원(ELVdd)의 전압레벨은 제 2 전 원(ELVss)의 전압레벨보다 더 낮은 전압레벨을 갖도록 한다. The power supply unit 400 transfers the first power source ELVdd and the second power source ELVss to the pixel unit 100. The power supply unit 400 allows the first power source ELVdd to have a higher voltage level than the second power source ELVss when the light emitting display device operates normally. When the reverse voltage is applied to the light emitting display device, the voltage level of the first power source ELVdd is lower than the voltage level of the second power source ELVss.

도 3은 도 2의 발광 표시장치에서 채용된 화소를 나타내는 회로도이다. 도 3을 참조하여 설명하면, 화소는 발광소자(OLED)와 화소회로를 포함하며, 화소회로는 제 1 트랜지스터(M1), 제 2 트랜지스터(M2), 제 3 트랜지스터(M3), 제 4 트랜지스터(M4), 제 5 트랜지스터(M5), 제 1 캐패시터(Cst) 및 제 2 캐패시터(Cvth)를 포함한다. 제 1 트랜지스터(M1) 내지 제 5 트랜지스터(M5)는 소스, 드레인 및 게이트를 구비하며, 소스와 드레인은 물리적으로 차이가 없으며 제 1 및 제 2 전극으로 칭할 수 있다. 그리고, 제 1 캐패시터(Cst) 및 제 2 캐패시터(Cvth)는 제 1 및 제 2 전극을 포함한다. 그리고, 제 1 내지 제 4 트랜지스터(M1 내지 M4)는 P 모스 트랜지스터로 구현되고 제 5 트랜지스터는 N 모스 트랜지스터로 구현된다. 3 is a circuit diagram illustrating a pixel employed in the light emitting display device of FIG. 2. Referring to FIG. 3, a pixel includes a light emitting element OLED and a pixel circuit, and the pixel circuit includes a first transistor M1, a second transistor M2, a third transistor M3, and a fourth transistor ( M4), a fifth transistor M5, a first capacitor Cst, and a second capacitor Cvth. The first to fifth transistors M1 to M5 have a source, a drain, and a gate, and the source and the drain are not physically different and may be referred to as first and second electrodes. In addition, the first capacitor Cst and the second capacitor Cvth include first and second electrodes. The first to fourth transistors M1 to M4 are implemented as P MOS transistors, and the fifth transistor is implemented as N MOS transistors.

또한, 주사선(Sn), 데이타선(Dm) 및 제 1 전원(ELVdd)이 화소에 연결된다. 주사선(Sn)은 행 방향으로 형성되고, 데이터선(Dm) 및 제 1 전원(ELVdd)은 열 방향으로 형성된다. In addition, the scan line Sn, the data line Dm, and the first power supply ELVdd are connected to the pixel. The scanning line Sn is formed in the row direction, and the data line Dm and the first power source ELVdd are formed in the column direction.

제 1 트랜지스터(M1)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 1 노드(A)에 연결되며 게이트는 제 2 노드(B)에 연결되어 제 2 노드(B)에 전달되는 전압에 대응하여 제 1 노드(A)로 구동전류를 흐르도록 한다. The first transistor M1 has a source connected to a first power source ELVdd, a drain connected to a first node A, a gate connected to a second node B, and transmitted to a second node B. In response to this, the driving current flows to the first node A. FIG.

제 2 트랜지스터(M2)는 소스는 데이터선(Dm)에 연결되고 드레인은 제 3 노드(C)에 연결되며 게이트는 제 1 주사선에 연결되어 제 1 주사선을 통해 전달되는 제 1 주사신호에 의해 선택적으로 데이터신호를 제 3 노드(C)에 전달한다. The second transistor M2 has a source connected to the data line Dm, a drain connected to the third node C, and a gate connected to the first scan line and selectively transmitted by the first scan signal transmitted through the first scan line. The data signal is transmitted to the third node C.

제 3 트랜지스터(M3)는 소스는 제 1 노드(A)에 연결되고 드레인은 제 2 노드(B)에 연결되며 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 제 1 노드(A)와 제 2 노드(B)의 전압을 같게 하여 제 1 트랜지스터(M1)가 선택적으로 다이오드 연결이 되도록 한다. 제 2 주사신호는 하나의 화소행에 위치하는 제 2 트랜지스터(M2)를 선택하여 데이터신호를 전달하는 제 1 주사신호보다 이전 행에 위치하는 화소에 데이터신호를 전달하도록 선택하는 주사신호이다. The third transistor M3 has a source connected to the first node A, a drain connected to the second node B, a gate connected to the second scan line Sn-1, and a second scan line Sn-1. The first transistor M1 is selectively diode-connected by equalizing the voltages of the first node A and the second node B by the second scan signal transmitted through the same. The second scan signal is a scan signal that selects the second transistor M2 located in one pixel row to transmit the data signal to a pixel located in a row before the first scan signal that transfers the data signal.

제 4 트랜지스터(M4)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 3 노드(C)에 연결되며 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 제 1 전원선의 전압을 제 3 노드에 선택적으로 전달한다. The fourth transistor M4 has a source connected to the first power supply ELVdd, a drain connected to the third node C, and a gate connected to the second scan line Sn-1, so that the second scan line Sn-1 The voltage of the first power line is selectively transferred to the third node by the second scan signal transmitted through the second scan signal.

제 5 트랜지스터(M5)는 소스는 제 1 노드(A)에 연결되고 드레인은 발광소자에 연결되며 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 제 1 노드(A)를 통해 전달되는 구동전류를 발광소자에 전달한다. 이때, 제 5 트랜지스터(M5)가 N 모스 트랜지스터로 구현되어 제 2 주사신호에 의해 동작되는 P 모스 트랜지스터로 구현된 제 3 트랜지스터(M3)와 제 4 트랜지스터(M4)가 온 상태가 되어 있는 시간에 오프 상태가 되는 것을 제외하고 그 외의 시간에서 온상태가 된다. The fifth transistor M5 has a source connected to the first node A, a drain connected to the light emitting device, and a gate connected to the second scan line Sn-1, and transmitted through the second scan line Sn-1. The driving current transmitted through the first node A is transmitted to the light emitting device by the second scan signal. At this time, the third transistor M3 and the fourth transistor M4, which are implemented by the N MOS transistor and are implemented by the P MOS transistor operated by the second scan signal, are turned on. It is on at any other time except to be off.

제 1 캐패시터(Cst)는 제 1 전극은 제 1 전원(ELVdd)에 연결되고 제 2 전극은 제 3 노드(C)에 연결되어 제 4 트랜지스터(M4)의 동작에 따라 제 1 전원(ELVdd) 의 전압과 데이터신호의 전압에 대응되는 전압을 저장하여 일정시간 동안 유지한다. The first capacitor Cst has a first electrode connected to the first power source ELVdd and a second electrode connected to the third node C, so that the first capacitor Cst has the power of the first power source ELVdd according to the operation of the fourth transistor M4. The voltage corresponding to the voltage and the voltage of the data signal is stored and maintained for a predetermined time.

제 2 캐패시터(Cvth)는 제 1 전극은 제 2 노드(B)에 연결되고 제 2 전극은 제 3 노드(C)에 연결되어 제 3 트랜지스터(M3)의 동작에 따라 제 1 트랜지스터(M1)의 문턱전압을 저장하여 일정시간 동안 유지한다. The second capacitor Cvth has a first electrode connected to the second node B and a second electrode connected to the third node C, so that the second transistor Cvth is connected to the third node M1 according to the operation of the third transistor M3. The threshold voltage is stored and maintained for a certain time.

발광소자(OLED)는 애노드 전극은 제 5 트랜지스터(M5)에 연결되고 캐소드 전극은 제 2 전원(ELVss)에 연결되어 제 5 트랜지스터(M5)로부터 유입되는 전류에 의해 발광한다. The light emitting device OLED has an anode electrode connected to the fifth transistor M5 and a cathode electrode connected to the second power source ELVss to emit light by a current flowing from the fifth transistor M5.

상기와 같이 구성된 화소를 복수 개 포함하는 화소에 역전압을 전달하면 화소회로에 누설전류가 발생하게 되는데, 불량화소는 화소회로의 단락 등에 의하여 불량화소에 흐르는 누설전류의 양이 정상화소에 흐르는 누설전류의 양보다 크게 나타나게 된다. When a reverse voltage is transmitted to a pixel including a plurality of pixels configured as described above, a leakage current is generated in the pixel circuit. In the case of a defective pixel, a leakage current flowing through the defective pixel due to a short circuit of the pixel circuit flows through the normal pixel. It will be larger than the amount of current.

표 1은 정상 동작할 때의 전압(정상조건)과 화소에 역전압을 인가하여 누설전류를 측정할 때의 전압(역에이징 조건)을 나타낸다. Table 1 shows the voltage (normal condition) during normal operation and the voltage (reverse aging condition) when the leakage current is measured by applying a reverse voltage to the pixel.

정상조건Normal condition 역에이징조건Reverse Aging Condition 제 1 전원First power 5V 5 V 1V 1 V 제 2 전원2nd power -6V-6V 13V13 V 제 3 전원Third power source 5V5 V 5V5 V 제 4 전원4th power -7V-7V -7V-7V 데이터신호Data signal 0~5V 0-5V -2V-2V 발광소자 애노드전압Light emitting element anode voltage -- 1V1 V

표 1을 참조하여 역에이징조건에서 제 1 전원은 1V의 전압을 갖고 제 2 전원은 13V의 전압을 갖게 된다. 이러한 상태가 되면 발광소자(OLED)의 캐소드 전극에는 13V의 전압이 인가되고 발광소자(OLED)의 애노드 전극에는 1V의 전압이 인가되어 캐소드에 높은 전압이 인가되고 애노드 전극에 낮은 전압이 인가되어 발광소자(OLED)에는 12V 차이의 역전압이 인가된다. 그리고, 이러한 역전압이 인가되면 발광소자(OLED)의 캐소드에서 애노드 방향으로 누설전류가 흐르게 된다. Referring to Table 1, in the reverse aging condition, the first power supply has a voltage of 1V and the second power supply has a voltage of 13V. In this state, a voltage of 13 V is applied to the cathode electrode of the light emitting device OLED, and a voltage of 1 V is applied to the anode electrode of the light emitting device OLED so that a high voltage is applied to the cathode and a low voltage is applied to the anode electrode to emit light. A reverse voltage of 12V difference is applied to the device OLED. When the reverse voltage is applied, a leakage current flows in the anode direction from the cathode of the light emitting device OLED.

이때, 주사구동부(300)는 역에이징 조건일 때 정상조건과 동일한 조건이 되어 동일한 신호를 발생하여 주사구동부(300)에 의해 출력되는 제 2 주사신호는 동일한 전압레벨을 갖게 된다. 그리고, 데이터신호는 -2V의 전압을 갖도록 하여 제 1 트랜지스터(M1)에 의해 누설전류가 흐르는 것이 차단되는 것을 막는다. At this time, the scan driver 300 becomes the same condition as the normal condition under the reverse aging condition, generates the same signal, and the second scan signal output by the scan driver 300 has the same voltage level. The data signal has a voltage of −2 V to prevent the leakage current from being blocked by the first transistor M1.

그리고, 흐르는 전류량을 파악하여 전류량이 기준치 이상이 되면 불량화소로 파악하고 전류량이 기준치 이하이면 정상적인 화소로 파악을 한다. If the current amount exceeds the reference value, the current is measured as a defective pixel, and if the current amount is below the reference value, the current pixel is identified.

도 4는 본 발명에 따른 발광 표시장치의 제 2 실시예를 나타내는 구조도이다. 도 4를 참조하여 설명하면, 발광 표시장치는 화상을 표시하는 화소부(100), 데이터신호를 전달하는 데이터구동부(200), 주사신호와 발광제어신호를 전달하는 주사구동부(300) 및 전원공급부(400)를 포함한다. 4 is a structural diagram illustrating a second embodiment of a light emitting display device according to the present invention. Referring to FIG. 4, the light emitting display device includes a pixel unit 100 for displaying an image, a data driver 200 for transmitting a data signal, a scan driver 300 for transmitting a scan signal and a light emission control signal, and a power supply unit. 400.

화소부(100)는 가로방향으로 배열된 주사선(S1,S2,...Sn-1,Sn)과 발광제어선(E1,E2,...En-1,En), 세로방향으로 배열된 데이터선(D1,D2,..Dm-1,Dm)이 형성되며 주사선(S1,S2,...Sn-1,Sn)과 데이터선(D1,D2,..Dm-1,Dm) 교차한 영역에 복수의 화소(110)가 형성되어 주사선, 발광제어선 및 데이터선을 통해 전달받은 신호를 이용하여 화상을 표시한다. 또한, 복수의 화소(110)는 전원공급부(400)으로부터 제 1 전원(ELVdd)과 제 2 전원(ELVss)을 공급받아 구동하게 된다. 제 1 전원(ELVdd)은 화소부(100)에 배선의 형태로 연결되어 각 화소에 제 1 전원(ELVdd)의 전압을 전달하고 제 2 전원(ELVss)는 화소부(100)의 전면에 층착되어 화소에 흐르는 전류가 제 2 전원(ELVss)로 흘러나가도록 할 수 있다. The pixel unit 100 has scan lines S1, S2, ... Sn-1, Sn arranged in the horizontal direction, and emission control lines E1, E2, En-1, En arranged in the vertical direction. Data lines D1, D2, .. Dm-1, Dm are formed and the scan lines S1, S2, ... Sn-1, Sn intersect with the data lines D1, D2, .. Dm-1, Dm. A plurality of pixels 110 are formed in one region to display an image by using signals transmitted through a scan line, a light emission control line, and a data line. In addition, the plurality of pixels 110 are driven by receiving the first power source ELVdd and the second power source ELVss from the power supply unit 400. The first power source ELVdd is connected to the pixel unit 100 in the form of a wire to transfer the voltage of the first power source ELVdd to each pixel, and the second power source ELVss is laminated on the front surface of the pixel unit 100. The current flowing in the pixel may flow out to the second power source ELVss.

데이터구동부(200)는 데이터신호를 출력하며, 화소부(100)의 세로방향으로 배열된 데이터선(D1,D2...Dm-1,Dm)에 연결되어 데이터신호를 화소부(100)에 전달한다. 데이터구동부(200)는 발광표시장치에 역전압을 인가하는 경우에는 데이터신호의 전압레벨이 제 1 전원(ELVdd)의 전압레벨보다 더 낮은 전압레벨을 갖도록 한다. The data driver 200 outputs a data signal, and is connected to the data lines D1, D2... Dm-1, Dm arranged in the vertical direction of the pixel unit 100 to transmit the data signal to the pixel unit 100. To pass. When the reverse voltage is applied to the light emitting display device, the data driver 200 has a voltage level lower than that of the first power supply ELVdd.

주사구동부(300)는 전원공급부(400)으로부터 제 3 및 제 4 전원(VVdd 및 VVss)를 전달받아 구동하여 주사신호와 발광제어신호를 출력하며, 화소부(100)의 가로 방향으로 배열된 주사선(S1,S2,...Sn-1,Sn)과 발광제어선(E1,E2,...En-1,En)에 연결되어 주사신호와 발광제어신호를 화소부(100)에 전달한다. The scan driver 300 receives and drives the third and fourth power sources VVdd and VVss from the power supply unit 400 to output scan signals and emission control signals, and scan lines arranged in the horizontal direction of the pixel unit 100. (S1, S2, ... Sn-1, Sn) and the light emission control lines E1, E2, ... En-1, En transfer the scan signal and the light emission control signal to the pixel portion 100. .

전원공급부(400)는 화소부(100)에 제 1 전원(ELVdd)와 제 2 전원(ELVss)를 전달한다. 전원공급부(400)는 발광표시장치가 정상적인 동작을 하는 경우에 제 1 전원(ELVdd)가 제 2 전원(ELVss) 보다 더 높은 전압레벨을 갖도록 한다. 그리고, 발광표시장치에 역바이어스 전압을 인가하는 경우에 제 1 전원(ELVdd)의 전압레벨은 제 2 전원(ELVss)의 전압레벨보다 더 낮은 전압레벨을 갖도록 한다. The power supply unit 400 transfers the first power source ELVdd and the second power source ELVss to the pixel unit 100. The power supply unit 400 allows the first power source ELVdd to have a higher voltage level than the second power source ELVss when the light emitting display device operates normally. When the reverse bias voltage is applied to the light emitting display device, the voltage level of the first power supply ELVdd is lower than the voltage level of the second power supply ELVss.

도 5는 도 4의 발광 표시장치에 채용된 화소의 제 1 실시예를 나타내는 회로도이다. 도 5를 참조하여 설명하면, 화소는 발광소자와 화소회로를 포함하며 화소회로는 제 1 내지 제 5 트랜지스터(M1 내지 M5)와 제 1 및 제 2 캐패시터(Cst 및 Cvth)를 포함한다. 또한, 제 1 내지 제 4 트랜지스터(M1 내지 M4)는 P 모스 트랜지스터로 구현되고 제 5 트랜지스터(M5)는 N 모스 트랜지스터로 구현되도록 한다. FIG. 5 is a circuit diagram illustrating a first embodiment of a pixel employed in the light emitting display device of FIG. 4. Referring to FIG. 5, a pixel includes a light emitting element and a pixel circuit, and the pixel circuit includes first to fifth transistors M1 to M5 and first and second capacitors Cst and Cvth. In addition, the first to fourth transistors M1 to M4 are implemented as P MOS transistors, and the fifth transistor M5 is implemented as N MOS transistors.

제 1 트랜지스터(M1)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 1 노드(A)에 연결되며 게이트는 제 2 노드(B)에 연결되어 제 2 노드(B)에 인가된 전압에 의해 소스에서 드레인방향으로 전류를 흐르게 한다. The first transistor M1 has a source connected to a first power source ELVdd, a drain connected to a first node A, a gate connected to a second node B, and a voltage applied to the second node B. This causes the current to flow from the source to the drain.

제 2 트랜지스터(M2)는 소스는 데이터선(Dm)에 연결되고 드레인은 제 3 노드(C)에 연결되고 게이트는 제 1 주사선(Sn)에 연결되어 제 1 주사선(Sn)을 통해 전달되는 제 1 주사신호에 의해 데이터신호를 선택적으로 제 3 노드(C)에 전달한다. The second transistor M2 has a source connected to the data line Dm, a drain connected to the third node C, a gate connected to the first scan line Sn, and transferred through the first scan line Sn. The data signal is selectively transmitted to the third node C by one scanning signal.

제 3 트랜지스터(M3)는 소스는 제 1 노드(A)에 연결되고 드레인은 제 2 노드(B)에 연결되고 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 선택적으로 제 1 트랜지스터(M1)가 다이오드 연결이 되도록 한다. The third transistor M3 has a source connected to the first node A, a drain connected to the second node B, a gate connected to the second scan line Sn-1, and a second scan line Sn-1. The first transistor M1 is selectively diode-connected by the second scan signal transmitted through the second scan signal.

제 4 트랜지스터(M4)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 3 노드(C)에 연결되며 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 선택적으로 제 1 전원(ELVdd)의 전압레벨을 제 3 노드(C)에 전달하도록 한다. The fourth transistor M4 has a source connected to the first power supply ELVdd, a drain connected to the third node C, and a gate connected to the second scan line Sn-1, so that the second scan line Sn-1 The voltage level of the first power source ELVdd is selectively transmitted to the third node C by the second scan signal transmitted through the second scan signal.

제 5 트랜지스터(M5)는 소스는 제 1 노드(A)에 전달되고 드레인은 발광소자(OLED)의 애노드 전극에 연결되며 게이트는 발광제어선(En)에 연결되어 선택적으로 발광제어선(En)을 통해 전달되는 발광제어신호에 의해 제 1 트랜지스터(M1)의 소스에서 드레인 방향으로 흐르는 전류를 선택적으로 발광소자(OLED)에 전달하도록 한다. In the fifth transistor M5, a source is transferred to the first node A, a drain is connected to an anode electrode of the light emitting device OLED, and a gate is connected to an emission control line En to selectively emit an emission control line En. The current flowing in the direction from the source to the drain of the first transistor M1 is selectively transmitted to the light emitting device OLED by the light emission control signal transmitted through the light emitting control signal.

제 1 캐패시터(Cst)는 제 1 전극은 제 1 전원(ELVdd)에 연결되고 제 2 전극은 제 3 노드(C)에 연결되어 제 3 노드(C)에 데이터신호가 전달되면 데이터신호와 제 1 전원(ELVdd)에 의한 전압을 저장하도록 한다. When the first capacitor Cst has a first electrode connected to a first power source ELVdd and a second electrode connected to a third node C to transmit a data signal to the third node C, the data signal and the first To store the voltage by the power source (ELVdd).

제 2 캐패시터(Cvth)는 제 1 전극은 제 3 노드(C)에 연결되고 제 2 전극은 제 2 노드(B)에 연결되어 제 3 트랜지스터(M3)에 의해 제 1 트랜지스터(M1)가 다이오드 연결이 되면 제 1 트랜지스터(M1)의 문턱전압을 저장하게 된다. In the second capacitor Cvth, the first electrode is connected to the third node C and the second electrode is connected to the second node B so that the first transistor M1 is diode-connected by the third transistor M3. In this case, the threshold voltage of the first transistor M1 is stored.

발광소자(OLED)는 애노드 전극은 제 5 트랜지스터(M5)에 연결되고 캐소드 전극은 제 2 전원(ELVss)에 연결되어 제 5 트랜지스터(M5)로부터 유입되는 전류에 의해 발광한다. The light emitting device OLED has an anode electrode connected to the fifth transistor M5 and a cathode electrode connected to the second power source ELVss to emit light by a current flowing from the fifth transistor M5.

상기와 같이 구현된 발광 표시장치의 화소에는 상기 표 1에 해당하는 전압을 인가한다. Voltages corresponding to Table 1 are applied to the pixels of the light emitting display device implemented as described above.

역에이징조건의 전압을 화소에 전달하면, 화소회로에 누설전류가 발생하게 되는데, 화소회로의 단락 등에 의하여 불량화소에 흐르는 누설전류의 양이 정상화소에 흐르는 누설전류의 양보다 크게 나타나게 된다. When the voltage under the reverse aging condition is transmitted to the pixel, a leakage current is generated in the pixel circuit. The leakage current flowing through the defective pixel is larger than the leakage current flowing through the normal pixel due to a short circuit of the pixel circuit.

도 6은 도 4의 발광 표시장치에 채용된 화소의 제 2 실시예를 나타내는 회로도이다. 도 6을 참조하여 설명하면, 화소는 발광소자와 화소회로를 포함하며 화소회로는 제 1 내지 제 5 트랜지스터(M1 내지 M5)와 제 1 및 제 2 캐패시터(Cst 및 Cvth)를 포함한다. 6 is a circuit diagram illustrating a second embodiment of a pixel employed in the light emitting display device of FIG. 4. Referring to FIG. 6, a pixel includes a light emitting element and a pixel circuit, and the pixel circuit includes first to fifth transistors M1 to M5 and first and second capacitors Cst and Cvth.

제 1 트랜지스터(M1)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 1 노드(A)에 연결되며 게이트는 제 2 노드(B)에 연결되어 제 2 노드(B)에 인가된 전압에 의해 소스에서 드레인방향으로 전류를 흐르게 한다. The first transistor M1 has a source connected to a first power source ELVdd, a drain connected to a first node A, a gate connected to a second node B, and a voltage applied to the second node B. This causes the current to flow from the source to the drain.

제 2 트랜지스터(M2)는 소스는 데이터선(Dm)에 연결되고 드레인은 제 3 노드(C)에 연결되고 게이트는 제 1 주사선(Sn)에 연결되어 제 1 주사선(Sn)을 통해 전달되는 제 1 주사신호에 의해 데이터신호를 선택적으로 제 3 노드(C)에 전달한다. The second transistor M2 has a source connected to the data line Dm, a drain connected to the third node C, a gate connected to the first scan line Sn, and transferred through the first scan line Sn. The data signal is selectively transmitted to the third node C by one scanning signal.

제 3 트랜지스터(M3)는 소스는 제 1 노드(A)에 연결되고 드레인은 제 2 노드(B)에 연결되고 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 선택적으로 제 1 트랜지스터(M1)가 다이오드 연결이 되도록 한다. The third transistor M3 has a source connected to the first node A, a drain connected to the second node B, a gate connected to the second scan line Sn-1, and a second scan line Sn-1. The first transistor M1 is selectively diode-connected by the second scan signal transmitted through the second scan signal.

제 4 트랜지스터(M4)는 소스는 제 1 전원(ELVdd)에 연결되고 드레인은 제 3 노드(C)에 연결되며 게이트는 제 2 주사선(Sn-1)에 연결되어 제 2 주사선(Sn-1)을 통해 전달되는 제 2 주사신호에 의해 선택적으로 제 1 전원(ELVdd)의 전압을 제 3 노드(C)에 전달하도록 한다. The fourth transistor M4 has a source connected to the first power supply ELVdd, a drain connected to the third node C, and a gate connected to the second scan line Sn-1, so that the second scan line Sn-1 The voltage of the first power source ELVdd is selectively transferred to the third node C by the second scan signal transmitted through the second scan signal.

제 5 트랜지스터(M5)는 소스는 제 1 노드(A)에 전달되고 드레인은 발광소자(OLED)의 애노드 전극에 연결되며 게이트는 발광제어선(En)에 연결되어 선택적으로 발광제어선(En)을 통해 전달되는 발광제어신호에 의해 제 1 트랜지스터(M1)의 소스에서 드레인 방향으로 흐르는 전류를 선택적으로 발광소자(OLED)에 전달하도록 한다. In the fifth transistor M5, a source is transferred to the first node A, a drain is connected to an anode electrode of the light emitting device OLED, and a gate is connected to an emission control line En to selectively emit an emission control line En. The current flowing in the direction from the source to the drain of the first transistor M1 is selectively transmitted to the light emitting device OLED by the light emission control signal transmitted through the light emitting control signal.

제 1 캐패시터(Cst)는 제 1 전극은 제 1 전원(ELVdd)에 연결되고 제 2 전극은 제 3 노드(C)에 연결되어 제 3 노드(C)에 데이터신호가 전달되면 데이터신호와 제 1 전원(ELVdd)의 전압에 의해 소정의 전압을 저장하도록 한다. When the first capacitor Cst has a first electrode connected to a first power source ELVdd and a second electrode connected to a third node C to transmit a data signal to the third node C, the data signal and the first The predetermined voltage is stored by the voltage of the power supply ELVdd.

제 2 캐패시터(Cvth)는 제 1 전극은 제 3 노드(C)에 연결되고 제 2 전극은 제 2 노드(B)에 연결되어 제 3 트랜지스터(M3)에 의해 제 1 트랜지스터(M1)가 다이오드 연결이 되면 제 1 트랜지스터(M1)의 문턱전압을 저장하게 된다. In the second capacitor Cvth, the first electrode is connected to the third node C and the second electrode is connected to the second node B so that the first transistor M1 is diode-connected by the third transistor M3. In this case, the threshold voltage of the first transistor M1 is stored.

발광소자(OLED)는 애노드 전극은 제 5 트랜지스터(M5)에 연결되고 캐소드 전극은 제 2 전원(ELVss)에 연결되어 제 5 트랜지스터(M5)로부터 유입되는 전류에 의해 발광한다. The light emitting device OLED has an anode electrode connected to the fifth transistor M5 and a cathode electrode connected to the second power source ELVss to emit light by a current flowing from the fifth transistor M5.

표 2는 정상 동작할 때의 전압(정상조건)과 화소에 역전압을 인가하여 누설전류를 측정할 때의 전압(역에이징 조건)을 나타낸다. Table 2 shows the voltage (normal condition) during normal operation and the voltage (reverse aging condition) when the leakage current is measured by applying a reverse voltage to the pixel.

정상조건Normal condition 역에이징조건Reverse Aging Condition 제 1 전원First power 5V 5 V 1V 1 V 제 2 전원2nd power -6V-6V 20V20 V 제 3 전원Third power source 5V5 V 5V5 V 제 4 전원4th power -7V-7V -7V-7V 데이터신호Data signal 0~5V 0-5V -2V-2V 발광소자 애노드 전압Light emitting element anode voltage -- 8V8V

표 2를 보면 역에이징 조건일 때 발광소자의 애노드 전극에 8V 의 전압이 인가되어 제 2 전원 전압을 20V로 하였을 때 발광소자의 양단에 12V의 전압이 인가된다. 따라서, 제 5 트랜지스터(M5)가 N 모스 트랜지스터로 구현된 도 3 및 도 5에 도시된 회로와 달리 제 5 트랜지스터(M5)가 P 모스 트랜지스터로 구현되어 제 2 전원에 더 큰 전압을 인가하여야 발광소자(OLED)에 누설전류가 발생하게 된다. Referring to Table 2, a voltage of 8V is applied to the anode electrode of the light emitting device under the reverse aging condition, and a voltage of 12V is applied to both ends of the light emitting device when the second power supply voltage is 20V. Therefore, unlike the circuits of FIGS. 3 and 5 in which the fifth transistor M5 is implemented as an N MOS transistor, the fifth transistor M5 is implemented as a P MOS transistor to emit light when a larger voltage is applied to the second power source. A leakage current is generated in the device OLED.

도 7a 및 도 7b는 역전압이 인가된 발광표시장치에 흐르는 누설전류의 양을 나타내는 도면이다. 도 7a는 도 2 및 도 4에 도시된 발광표시장치에 흐르는 전류량을 나타내며, 도 7b는 누설전류 범위가 10㎂ 이하의 범위를 확대하여 나타낸다. 7A and 7B are diagrams showing the amount of leakage current flowing through the light emitting display device to which the reverse voltage is applied. FIG. 7A illustrates an amount of current flowing through the light emitting display device shown in FIGS. 2 and 4, and FIG. 7B shows an enlarged range of a leakage current of 10 mA or less.

역전압 인가조건은 발광소자의 애노드와 캐소드 전극 사이에 12V의 전압차이의 역전압이 1분동안 유지되도록 하였다. 도 7a 및 도 7b를 참조하여 설명하면, 1에서 23은 발광 표시장치의 각 번호를 나타내며 각 번호에는 역전압을 인가하여 흐르는 누설전류량이 표현된다. 이 중 5, 10, 11, 16은 불량화소가 포함되지 않은 발광표시장치에 역전압을 인가하여 흐르는 누설전류량을 나타낸다. 불량화소가 나타난 발광표시장치는 누설전류의 전류량이 1㎂ 이상이고, 불량화소가 나타나지 않은 발광표시장치는 누설전류의 전류량이 0.5㎂ 이하이다. The reverse voltage application condition was such that the reverse voltage of the voltage difference of 12V was maintained between the anode and the cathode of the light emitting device for 1 minute. Referring to FIGS. 7A and 7B, 1 to 23 represent respective numbers of the light emitting display devices, and the numbers of leakage currents flowing by applying a reverse voltage to each number are represented. 5, 10, 11, and 16 represent the amount of leakage current flowing by applying a reverse voltage to the light emitting display device which does not include the defective pixel. In the light emitting display device in which the defective pixel appears, the current amount of leakage current is 1 mA or more, and in the light emitting display device in which the defective pixel does not appear, the current amount of the leakage current is 0.5 mA or less.

따라서, 역전압을 인가하였을때 누설전류의 전류량이 1㎂를 넘어가게 되면 불량화소가 포함되어 있는 발광표시장치로 파악할 수 있다. Therefore, when the reverse current is applied, if the current amount of the leakage current exceeds 1 mA, it can be regarded as a light emitting display device including a defective pixel.

본 발명의 바람직한 실시예가 특정 용어들을 사용하여 기술되어 왔지만, 그러한 기술은 단지 설명을 하기 위한 것이며, 다음의 청구범위의 기술적 사상 및 범위로부터 이탈되지 않고 여러 가지 변경 및 변화가 가해질 수 있는 것으로 이해되어져야 한다. While preferred embodiments of the present invention have been described using specific terms, such descriptions are for illustrative purposes only and it is understood that various changes and modifications may be made without departing from the spirit and scope of the following claims. You must lose.

본 발명에 따른 발광 표시장치 불량판단방법에 의하면, 발광소자에 역전압을 인가한 상태에서 발광소자에 흐르는 누설전류를 측정하여 발광표시장치에 잠재적인 불량화소가 포함되어 있는 여부를 파악하도록 한다. According to the method of determining a failure of a light emitting display device according to the present invention, the leakage current flowing through the light emitting device is measured while a reverse voltage is applied to the light emitting device to determine whether a latent defective pixel is included in the light emitting display device.

따라서, 불량화소가 포함되어 있는 발광표시장치가 시중에 유통되는 것을 방지할 수 있다. Therefore, it is possible to prevent the light emitting display device containing defective pixels from being distributed on the market.

Claims (17)

발광소자 및 화소회로를 구비하는 화소에 의해 화상을 표시하는 발광표시장치를 제조하는 단계;Manufacturing a light emitting display device for displaying an image by a pixel having a light emitting element and a pixel circuit; 상기 발광소자에 역전압을 인가하는 단계; 및Applying a reverse voltage to the light emitting device; And 상기 역전압을 인가하는 단계에서 발광소자에 흐르는 누설전류를 측정하여 상기 발광표시장치의 불량을 판단하는 단계를 포함하는 발광표시장치의 불량 판단방법. And measuring the leakage current flowing through the light emitting device in the step of applying the reverse voltage to determine the failure of the light emitting display device. 제 1 항에 있어서, The method of claim 1, 상기 누설전류의 절대값이 소정값 이상이면 상기 발광표시장치를 불량으로 판단하는 발광표시장치의 불량판단방법. And determining that the light emitting display device is defective if the absolute value of the leakage current is greater than or equal to a predetermined value. 제 2 항에 있어서, The method of claim 2, 상기 소정값은 1㎂ 인 발광 표시장치의 불량 판단방법. And the predetermined value is 1 ms. 제 1 항에 있어서, The method of claim 1, 상기 역전압은 적어도 12V 차이를 갖는 발광표시장치의 불량판단방법. And the reverse voltage has a difference of at least 12V. 제 1 항에 있어서, 상기 화소회로는 The method of claim 1, wherein the pixel circuit 게이트에 인가되는 전압에 의해 구동전류를 생성하는 제 1 트랜지스터; A first transistor generating a driving current by a voltage applied to the gate; 제 1 주사신호에 의해 데이터신호를 전달하는 제 2 트랜지스터; A second transistor which transfers the data signal by the first scan signal; 제 1 전원과 상기 데이터신호의 차이에 해당하는 전압을 저장하는 제 1 캐패시터;A first capacitor for storing a voltage corresponding to a difference between a first power supply and the data signal; 상기 제 1 트랜지스터의 문턱전압을 저장하는 제 2 캐패시터;A second capacitor storing the threshold voltage of the first transistor; 제 2 주사신호에 의해 상기 제 1 트랜지스터가 다이오드 연결되도록 하여 상기 제 1 트랜지스터의 문턱전압이 상기 제 2 캐패시터에 저장되도록 하는 제 3 트랜지스터;A third transistor configured to diode-connect the first transistor by a second scan signal such that the threshold voltage of the first transistor is stored in the second capacitor; 상기 제 2 주사신호에 의해 상기 제 1 캐패시터에 상기 제 1 전원과 상기 데이터신호의 차이에 해당하는 전압이 저장되도록 하는 제 4 트랜지스터; 및A fourth transistor configured to store a voltage corresponding to a difference between the first power supply and the data signal in the first capacitor by the second scan signal; And 상기 제 2 주사신호에 의해 상기 구동전류를 상기 발광소자에 전달하는 제 5 트랜지스터를 포함하는 발광 표시장치의 불량 판단방법. And a fifth transistor configured to transfer the driving current to the light emitting device by the second scan signal. 제 5 항에 있어서, The method of claim 5, 상기 제 2 주사신호는 상기 제 1 주사신호 보다 이전 행을 선택하는 주사신 호인 발광표시장치의 불량판단방법.And the second scan signal is a scan signal for selecting a row before the first scan signal. 제 1 항에 있어서, 상기 화소회로는 The method of claim 1, wherein the pixel circuit 게이트에 인가되는 전압에 의해 구동전류를 생성하는 제 1 트랜지스터; A first transistor generating a driving current by a voltage applied to the gate; 제 1 주사신호에 의해 데이터신호를 전달하는 상기 제 1 트랜지스터의 게이트에 전달하는 제 2 트랜지스터; A second transistor which transfers a data signal by a first scan signal to a gate of the first transistor; 제 1 전원과 상기 데이터신호의 차이에 해당하는 전압을 저장하는 제 1 캐패시터;A first capacitor for storing a voltage corresponding to a difference between a first power supply and the data signal; 상기 제 1 트랜지스터의 문턱전압을 저장하는 제 2 캐패시터;A second capacitor storing the threshold voltage of the first transistor; 제 2 주사신호에 의해 상기 제 1 트랜지스터가 다이오드 연결되도록 하여 상기 제 1 트랜지스터의 문턱전압이 상기 제 2 캐패시터에 저장되도록 하는 제 3 트랜지스터;A third transistor configured to diode-connect the first transistor by a second scan signal such that the threshold voltage of the first transistor is stored in the second capacitor; 상기 제 2 주사신호에 의해 상기 제 1 캐패시터에 상기 제 1 전원과 상기 데이터신호의 차이에 해당하는 전압이 저장되도록 하는 제 4 트랜지스터; 및A fourth transistor configured to store a voltage corresponding to a difference between the first power supply and the data signal in the first capacitor by the second scan signal; And 발광제어신호에 의해 상기 구동전류를 상기 발광소자에 전달하는 제 5 트랜지스터를 포함하는 발광 표시장치의 불량 판단방법. And a fifth transistor configured to transmit the driving current to the light emitting device by a light emission control signal. 제 7 항에 있어서,The method of claim 7, wherein 상기 제 2 주사신호는 상기 제 1 주사신호보다 이전 행을 선택하는 주사신호이고, 상기 발광제어신호는 상기 제 1 주사신호와 상기 제 2 주사신호가 온신호일때 오프 신호인 발광표시장치의 불량판단방법.The second scan signal is a scan signal for selecting a row before the first scan signal, and the emission control signal is an off signal when the first scan signal and the second scan signal are on signals. Way. 제 7 항에 있어서, The method of claim 7, wherein 상기 제 1 내지 제 4 트랜지스터는 P 모스 트랜지스터로 구현되고 상기 제 5 트랜지스터는 N 모스 트랜지스터로 구현되는 발광 표시장치의 불량판단방법. The first to fourth transistors are implemented as P-MOS transistors, and the fifth transistor is implemented as an N-MOS transistor. 제 7 항에 있어서, The method of claim 7, wherein 상기 제 1 내지 제 5 트랜지스터는 P 모스 트랜지스터로 구현되는 발광 표시장치의 불량 판단방법. The method of claim 1, wherein the first to fifth transistors are implemented with P MOS transistors. 제 1 단자를 통해 제 1 전압레벨과 제 2 단자를 통해 상기 제 1 전압레벨보다 낮은 제 2 전압레벨을 전달받으며, 데이터선을 통해 데이터신호를 전달받아 상기 제 1 단자에서 상기 제 2 단자 방향으로 전류를 구동하여 발광하는 화소를 포함하는 발광표시장치를 제조하는 단계;A first voltage level is received through a first terminal and a second voltage level lower than the first voltage level through a second terminal, and a data signal is received through a data line from the first terminal to the second terminal. Manufacturing a light emitting display device including a pixel for driving a current to emit light; 상기 제 1 단자에 제 3 전압레벨과 상기 제 2 단자에 상기 제 3 전압레벨보 다 전압레벨이 높은 제 4 전압레벨을 전달하되, 상기 제 3 전압레벨과 상기 제 4 전압레벨의 차이는 상기 제 1 전압레벨과 상기 제 2 전압레벨의 차이보다 더 크게 인가하는 역전압인가단계; 및 The third terminal transmits a third voltage level to the first terminal and a fourth voltage level higher than the third voltage level to the second terminal, and the difference between the third voltage level and the fourth voltage level is determined by the third voltage level. Applying a reverse voltage greater than the difference between the first voltage level and the second voltage level; And 상기 역전압인가단계에서 상기 제 1 단자와 상기 제 2 단자 사이에 흐르는 전류량을 측정하여 발광표시장치의 불량을 판단하는 단계를 포함하는 발광표시장치의 불량판단방법. And determining the failure of the light emitting display device by measuring the amount of current flowing between the first terminal and the second terminal in the reverse voltage applying step. 제 11 항에 있어서, The method of claim 11, 상기 제 3 전압레벨과 상기 제 4 전압레벨의 차이는 상기 제 1 전압레벨과 상기 제 2 전압레벨의 차이보다 더 큰 발광 표시장치의 불량판단방법. And the difference between the third voltage level and the fourth voltage level is greater than the difference between the first voltage level and the second voltage level. 제 11 항에 있어서, The method of claim 11, 상기 데이터신호의 전압레벨은 상기 제 3 전원의 전압레벨보다 낮은 발광표시장치의 불량판단방법. And a voltage level of the data signal is lower than a voltage level of the third power supply. 제 11 항에 있어서, 상기 화소는The method of claim 11, wherein the pixel is 발광소자; Light emitting element; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 제 1 노드에 연결되며 게이트는 제 1 노드에 연결되는 제 1 트랜지스터; A first transistor connected to a first electrode, a second electrode to a first node, and a gate connected to the first node; 제 1 전극은 상기 데이터선에 연결되고 제 2 전극은 상기 제 2 노드에 연결되며 게이트는 제 1 주사선에 연결되는 제 2 트랜지스터; A second transistor having a first electrode connected to the data line, a second electrode connected to the second node, and a gate connected to the first scan line; 제 1 전극은 상기 제 1 노드에 연결되고 제 2 전극은 제 3 노드에 연결되며 게이트는 제 2 주사선에 연결되는 제 3 트랜지스터;A third transistor having a first electrode connected to the first node, a second electrode connected to a third node, and a gate connected to a second scan line; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 상기 제 2 노드에 연결되며 게이트는 상기 제 2 주사선에 연결되는 제 4 트랜지스터;A fourth transistor connected to the first terminal, a second electrode connected to the second node, and a gate connected to the second scan line; 제 1 전극은 상기 제 1 노드에 연결되고 제 2 전극은 상기 발광소자에 연결되며 게이트는 상기 제 2 주사선에 연결되는 제 5 트랜지스터;A fifth transistor having a first electrode connected to the first node, a second electrode connected to the light emitting element, and a gate connected to the second scan line; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 상기 제 2 노드에 연결되는 제 1 캐패시터; 및A first capacitor connected to the first terminal and a second electrode connected to the second node; And 제 1 전극은 상기 제 2 노드에 연결되고 제 2 전극은 제 2 캐패시터를 포함하며, 상기 제 5 트랜지스터는 상기 제 3 및 제 4 트랜지스터와 다른 상태를 유지하도록 하는 발광 표시장치의 불량 판단방법. The method of claim 1, wherein the first electrode is connected to the second node, the second electrode includes a second capacitor, and the fifth transistor maintains a different state from the third and fourth transistors. 제 1 항에 있어서, 상기 화소는 The method of claim 1, wherein the pixel 발광소자;Light emitting element; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 제 1 노드에 연결되며 게이트는 제 1 노드에 연결되는 제 1 트랜지스터; A first transistor connected to a first electrode, a second electrode to a first node, and a gate connected to the first node; 제 1 전극은 상기 데이터선에 연결되고 제 2 전극은 상기 제 2 노드에 연결되며 게이트는 제 1 주사선에 연결되는 제 2 트랜지스터; A second transistor having a first electrode connected to the data line, a second electrode connected to the second node, and a gate connected to the first scan line; 제 1 전극은 상기 제 1 노드에 연결되고 제 2 전극은 제 3 노드에 연결되며 게이트는 제 2 주사선에 연결되는 제 3 트랜지스터;A third transistor having a first electrode connected to the first node, a second electrode connected to a third node, and a gate connected to a second scan line; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 상기 제 2 노드에 연결되며 게이트는 상기 제 2 주사선에 연결되는 제 4 트랜지스터;A fourth transistor connected to the first terminal, a second electrode connected to the second node, and a gate connected to the second scan line; 제 1 전극은 상기 제 1 노드에 연결되고 제 2 전극은 상기 발광소자에 연결되며 게이트는 발광제어선에 연결되는 제 5 트랜지스터;A fifth transistor having a first electrode connected to the first node, a second electrode connected to the light emitting element, and a gate connected to a light emission control line; 제 1 전극은 상기 제 1 단자에 연결되고 제 2 전극은 상기 제 2 노드에 연결되는 제 1 캐패시터; 및A first capacitor connected to the first terminal and a second electrode connected to the second node; And 제 1 전극은 상기 제 2 노드에 연결되고 제 2 전극은 제 2 캐패시터를 포함하며, 상기 제 5 트랜지스터는 상기 제 3 및 제 4 트랜지스터와 다른 상태를 유지하도록 하는 발광 표시장치의 불량 판단방법.The method of claim 1, wherein the first electrode is connected to the second node, the second electrode includes a second capacitor, and the fifth transistor maintains a different state from the third and fourth transistors. 제 15 항에 있어서, The method of claim 15, 상기 제 1 내지 제 4 트랜지스터는 P 모스 트랜지스터로 구현되고 상기 제 5 트랜지스터는 N 모스 트랜지스터로 구현되는 발광 표시장치의 불량판단방법. The first to fourth transistors are implemented as P-MOS transistors, and the fifth transistor is implemented as an N-MOS transistor. 제 15 항에 있어서, The method of claim 15, 상기 제 1 내지 제 5 트랜지스터는 P 모스 트랜지스터로 구현되는 발광 표시장치의 불량 판단방법. The method of claim 1, wherein the first to fifth transistors are implemented with P MOS transistors.
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