KR20060108544A - 램프용 전자 안정기 - Google Patents

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KR20060108544A
KR20060108544A KR1020060033933A KR20060033933A KR20060108544A KR 20060108544 A KR20060108544 A KR 20060108544A KR 1020060033933 A KR1020060033933 A KR 1020060033933A KR 20060033933 A KR20060033933 A KR 20060033933A KR 20060108544 A KR20060108544 A KR 20060108544A
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KR1020060033933A
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마르쿠스 헥크만
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파텐트-트로이한트-게젤샤프트 퓌어 엘렉트리쉐 글뤼람펜 엠베하
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Abstract

본 발명은 공급 전압에 대한 접속부 및 접지 전위에 대한 접속부 사이에 결합된 적어도 하나의 제 1 스위치(S1) 및 제 2 스위치(S2)를 포함하는 브리지 회로를 포함하는데, 상기 브리지 회로의 중심점(M)은 제 1 스위치(S1) 및 제 2 스위치(S2) 사이에 형성되고; 램프(La)에 대한 제 1 접속부(A1) 및 제 2 접속부(A2)를 포함하는데, 상기 제 1 접속부(A1)는 인덕턴스(L1)를 통하여 브리지 회로의 중심점(M)에 결합되고; 및 신호 평가 유니트(20)를 가지는 램프용 전자 안정기에 관한 것이고, 상기 신호 평가 유니트(20)는 제 1 입력(24) 및 제 2 입력(22)을 포함하고, 상기 제 1 입력(24)은 램프(La)에 대한 제 1 접속부(A1)의 DC 전압 레벨인 신호에 결합되고, 제 2 입력(22)은 램프(La)에 대한 제 2 접속부(A2)의 DC 전압 레벨인 신호에 결합되고, 상기 신호 평가 유니트(20)에 대한 DC 전압 기준 전위는 접지 전위보다 크거나 같고 공급 전압 전위보다 작거나 같은 값 범위내에서 가변하도록 설계된다.

Description

램프용 전자 안정기{ELECTRONIC BALLAST FOR A LAMP}
도 1은 본 발명에 따른 전자 안정기 단면의 개략도.
도 2는 액티브 구성요소들을 가진 신호 평가 유니트의 구현예를 가진 도 1의 상세 단면도.
도 3a는 도 2에 도시된 신호 평가 유니트 및 결함 램프의 구현예로 인한 EoL 신호의 시간 프로파일을 도시한 도.
도 3b는 도 2에 도시된 신호 평가 유니트 및 완전한 램프의 구현예로 인한 EoL 신호의 시간 프로파일을 도시한 도.
도 4는 패시브 구성요소들을 가진 신호 평가 유니트의 구현예를 가진 도 1로부터의 상세 단면도.
도 5a는 포지티브 DC 전압 이용 신호의 경우 도 4에 도시된 신호 평가 유니트의 구현예로 인한 EoL 신호의 시간 프로파일을 도시한 도.
도 5b는 네가티브 DC 전압 이용 신호의 경우 도 4에 도시된 신호 평가 유니트의 구현예로 인한 EoL 신호의 시간 프로파일을 도시한 도.
도 5c는 완전한 램프를 가진 도 4에 도시된 신호 평가 유니트의 구현예로 인한 EoL 신호의 시간 프로파일을 도시한 도.
*도면의 주요 부분에 대한 부호의 설명*
Uv : 공급 전압 14 : 제어 유니트
D1,C3 : 부트 스트랩 회로 S1,S2 : 제 1 및 제 2 스위치
A1,A2 : 제 1 및 제 2 접속부 C1,C2 : 결합 캐패시터
La : 램프
본 발명은 램프용 전자 안정기, 특히 공급 전압에 대한 접속부 및 접지 전위에 대한 접속부 사이에 결합된 적어도 하나의 제 1 스위치 및 제 2 스위치를 포함하는 브리지 회로를 포함하는데, 상기 브리지 회로의 중심점은 제 1 스위치 및 제 2 스위치 사이에 형성되고; 램프에 대한 제 1 접속부 및 제 2 접속부를 포함하는데, 상기 제 1 접속부는 인덕턴스를 통하여 브리지 회로의 중심점에 결합되고; 및 신호 평가 유니트를 포함하는 전자 안정기에 관한 것이고, 상기 신호 평가 유니트는 제 1 입력 및 제 2 입력을 포함하고, 제 1 입력은 램프에 대한 제 1 접속부의 DC 전압 레벨인 신호에 결합되고, 제 2 입력은 램프에 대한 제 2 접속부의 DC 전압 레벨인 신호에 결합된다.
램프에 대한 전자 안정기는 공지되었다. 이 경우, 램프에 대한 제 1 접속부 및 램프에 대한 제 2 접속부의 DC 전압 레벨 사이의 차이는 램프의 나머지 수명 정보를 제공하기 위하여 기준 전위로서 접지 전위에 접속된 신호 평가 유니트에서 결 정 및 평가된다. 특히, 램프가 수명 종료시점(EoL)에 접근할때, 브리지 회로의 구동은 전자 안정기의 손상을 방지하기 위하여 분리된다. 브리지 회로의 중심 포인트 DC 전압 전위의 레벨에서 DC 전압은 실제 DC 전압 이용 신호에 겹쳐진다. 평가를 위하여 요구된 전압 분할기들 및 보상기 회로들이 종래 허용 오차에 종속하기 때문에, 이것은 통상적으로 1% 허용 오차를 가진 레지스터들을 사용할때 전압 분할기에 의해 측정된 값의 에러로서 브리지 회로의 중심점에서 +/-4%의 전위가 형성되는 것을 의미한다. 공급 전압은 예를들어 450V이다; 그러므로 브리지 회로의 중심점에서 전위는 대략 225V이다. +/-4%의 에러로 인해, 측정된 값의 에러는 대략 +/-9V이다. "EoL 상황"을 식별하기 위하여 DC 전압 이용 신호가 일반적으로 10 내지 20V의 크기 정도이기 때문에, 신뢰적인 EoL 검출은 가능하지 않다.
본 발명의 목적은 보다 신뢰적인 EoL 검출이 가능하도록 처음에 언급된 전자 안정기를 개발하는 것에 있다.
이 목적은 청구항 제 1 항의 특징부들을 가진 전자 안정기에 의해 달성된다.
본 발명은 평가 동안 신호 평가 유니트에 대한 DC 전압 기준 전위가 접지 전위를 나타내는 것이 아니라, 경계들이 접지 전위 및 공급 전압 전위에 의해 형성되는 일정한 값 범위내에서 가변하도록 설계된 전위를 나타내면, 보다 작은 결함들에 영향을 받는 DC 전압 이용 신호의 평가가 EoL 검출동안 달성될 수 있다는 지식을 바탕으로 한다. 따라서, DC 전압 이용 신호에 중첩된 DC 전압 성분이 작아질수록, 측정 결과의 에러가 작아진다.
그러므로, 하나의 특히 바람직한 실시예는 신호 평가 유니트에 대한 DC 전압 기준 전위가 필수적으로 하프 브리지 회로의 중심 포인트의 전위라는 사실을 특징으로 한다. 이런 방식으로 크기가 설정된 "플로팅" EoL 검출의 경우, DC 전압 이용 신호는 임의의 간섭 DC 전압에 의해 중첩되지 않는다. 그러므로, 성분 허용 오차들로 인한 측정 에러는 최소가 되고, 결과의 신뢰성은 최대가 된다.
하나의 바람직한 실시예는 제 1 스위치 및 제 2 스위치를 구동하기 위하여 제어 유니트를 포함하고, 상기 제어 유니트는 신호 평가 유니트에 결합되는 분리 또는 조절 입력을 가지며, 상기 제어 유니트 및 신호 평가 유니트는 상호 작용하도록 설계되어, 미리 결정할 수 있는 제한 값인 신호 평가 유니트의 두개의 입력들에서 신호들의 DC 성분 사이의 차이가 발생하는 경우, 신호 평가 유니트는 제 1 스위치 및/또는 제 2 스위치의 구동이 수행되지 않거나 제 1 스위치 및/또는 제 2 스위치가 구동되도록 분리 또는 조절 입력을 통하여 제어 유니트를 구동함으로써 전자 안정기의 출력 전력은 감소된다. 이런 방법으로 인해, 전자 안정기에 대한 손상은 EoL 상황이 검출될때 신뢰적으로 방지된다. EoL 상황에서 램프를 계속 동작시킬때, 램프 과열 위험성이 있으므로, 램프의 파손 또는 용융이 발생하고 따라서 상기 램프 환경에서 사람이 위험하게 된다.
하나의 다른 바람직한 실시예에서, 제어 유니트는 공급 전압 접속부를 가지며 DC 전압 기준 전위로서 접지 전위에 접속된다. 신호 평가 유니트는 래치를 포함하고 만약 신호 평가 유니트의 두개의 입력들에서 신호들의 DC 전압 성분의 차이 가 미리 결정할 수 있는 제한 값 이상이면, 래치를 활성화하도록 설계되고, 상기 래치의 출력은 다이오드 및 비리액티브 레지스터를 포함하는 직렬 회로를 통하여 제어 유니트 및/또는 신호 평가 유니트의 공급 전압 접속부에 결합된다. 이런 변형에서, 신호 평가 유니트는 액티브 회로 형태이고, 일반적으로 15V 크기 정도 및 따라서 EoL DC 전압 이용 신호 크기 정도인 제어 유니트 및/또는 신호 평가 유니트의 공급 전압은 숙련된 방식으로 평가를 위하여 사용된다. 만약 신호 평가 유니트의 출력 신호가 이런 방식으로 제어 유니트의 공급 전압 및/또는 신호 평가 유니트와 결합되면, 다이오드 및 비리액티브 레지스트 사이의 접속점에서 분기될 수 있는 신호, 소위 EoL 신호는 완전한 램프의 경우, 일정한 크기를 가지는 신호이고, 반면 이 신호가 결함 램프의 경우 사각파 신호라는 사실을 특징으로 한다. DC 전압 신호 및 사각파 신호 사이의 차이는 매우 간단한 방식으로 평가될 수 있다. 결과적으로, 극히 경제적이고 신뢰적인 EoL 검출을 실행하는 것이 가능하다.
패시브 구성요소들을 사용하는 신호 평가 유니트의 구현예의 경우, 신호 평가 유니트는 신호 평가 유니트의 두개의 입력들에서 신호들의 DC 전압 성분의 차이에 해당하는 양단 전압을 가지도록 배열된 캐패시터를 가지며, 상기 캐패시터는 다이오드 및 비리액티브 레지스터를 포함하는 직렬 회로를 통하여 제어 유니트의 공급 전압 접속부에 결합된다. 만약, 차례로 다이오드 및 비리액티브 레지스터 사이의 접속점에서 소위 EoL 신호가 고려되면, 포지티브 사각파 신호에 의해 완전한 램프가 형성되는 것이 가능하다. 결함 램프는 포지티브 DC 전압 이용 신호의 경우 일정한 크기를 가진 신호를 특징으로 하고, 사각파형을 가진 EoL 신호는 네가티브 DC 전압 이용 신호의 경우에 형성되지만, 상기 EoL 신호는 완전한 램프의 경우의 사각파 신호와 대조하여 네가티브 진폭 성분들을 가진다. 이들 세개의 신호들은 매우 간단한 방식으로 서로 구별될 수 있고 경제적이고 램프의 신뢰적인 EoL 검출을 가능하게 한다.
그러므로, 다이오드 및 비리액티브 레지스터 사이의 접속점은 바람직하게 제어 유니트의 분리 또는 조절 입력에 결합된다.
그 두개의 출력들에서 신호들의 전압 성분들의 비교를 수행하기 위하여, 신호 평가 유니트는 비교기 유니트를 포함할 수 있다.
다른 바람직한 실시예들은 종속항들에 기술된다.
본 발명의 하나의 예시적인 실시예는 첨부된 도면들을 참조하여 하기에 보다 상세히 기술될 것이다.
도 1은 본 발명에 따른 램프용 전자 안정기를 개략적으로 도시한다. 상기 전자 안정기들은 일반적으로 공지되어 있기 때문에, 간략화를 위하여 본 발명에 관련된 부분만이 개략적으로 도시된다. 이 경우, 사이에 중심점(M)을 형성하는 제 1 스위치(S1) 및 제 2 스위치(S2)는 상기 스위치들 사이에 인가된 소위 중간 회로 전압(UZW)을 가진다. 중심점(M)은 인덕턴스(L1)를 통하여 램프(La)의 제 1 접속부(A1)에 결합된다. 게다가, 접속부(A1)는 결합 캐패시터(C1)를 통하여 접지 전위에 접속된다. 램프(La)에 대한 제 2 접속부(A2)는 결합 캐패시터(C2)를 통하여 접지 전위에 결합된다. 인덕턴스(L1)는 하프 브리지 회로의 중심점(M) 및 램프에 대한 제 1 접속부(A1) 사이에 접속된다. 전자 안정기는 고주파 사각파 신호를 사용하는 공지된 방식과 반대로 출력(10)을 통하여 스위치(S1) 및 출력(12)을 통하여 스위치(S2)를 구동시키는 제어 유니트(14)를 포함한다. 제어 유니트(14)의 공급 전압(UV)은 제어 유니트(14)의 입력(16)에 제공된다. UV는 15V이다. 공급 전압(UV)은 캐패시터(C3) 및 다이오드(D1)를 포함하는 부트스트랩(bootstrap) 회로에 의해 브리지 회로의 중심점에서 전압(UM)으로부터 형성된다. 캐패시터(C3) 전위는 제어 유니트(14)의 입력(18)에 인가되고 제어 유니트(14)내에 배열된 제어 유니트(14)의 출력(10) 신호를 구동 회로(도시되지 않음)에 공급하기 위하여 사용된다. 본 발명에 따른 전자 안정기는 램프(La)에 대한 접속부(A2)의 DC 전압 레벨인 신호를 입력부(22)에 공급받는 신호 평가 유니트(20)를 포함한다. 입력부(24)에서, 신호 평가 유니트(20)는 램프(La)에 대한 접속부(A1)의 DC 전압 레벨인 신호를 공급받는다. 상기 신호 평가 유니트의 출력(26)에서, 제어 유니트(20)는 제어 유니트(14)의 입력(25)에 결합되는 소위 EoL 신호를 이용할 수 있게 된다. 게다가 제어 유니트(14)의 입력부(25)는 레지스터(R1)를 통하여 제어 유니트(14)에 대한 공급 전압(UV)에 접속된다. 신호 평가 유니트(20)는 선택적 라인(29)을 통하여 캐패시터(C3)에 결합된다. 신호 평가 유니트(20)는 전압(UV)이 접지 전위와 고정되게 연관된 전압이고 공진 기준 전위에 대응하는 신호 평가 유니트(20)가 공진 공급 전압을 요구하기 때문에, 제어 유니트(14)에 공급하기 위하여 사용된 전압(UV)이 아닌 공급 전압 으로서 C3 양단 전위를 공급받는다. 라인(29)은 액티브 구성요소들을 가진 신호 평가 유니트(20)의 설계의 경우 요구되고, 패시브 구성요소들을 가진 신호 평가 유니트(20)의 구현예의 경우 필요하지 않다. 입력(24)을 통하여 신호 평가 유니트(20)에 결합되는 브리지 회로의 중심점(M) 전위는 신호 평가 유니트(20)에 대한 DC 전압 기준 전위로서 작동한다.
도 2는 도 1의 단면도를 상세히 도시하고, 신호 평가 유니트는 액티브 회로 형태이다. 신호 평가 유니트는 입력들(22 및 24)에 공급되는 두개의 신호들 사이의 DC 전압 차를 결정하는 신호 처리 유니트(30)를 포함한다. 또한, 신호 평가 유니트는 신호 처리 유니트의 출력 신호를 공급받는 지연 유니트(32)를 포함하고, 상기 지연 유니트(32)는 분리 조건의 결과로서 이른 분리가 짧은 시간 기간 동안만 충족되는 것을 방지하는데 사용된다. 특히, 대략 0.5초 보다 짧은 시간 기간 동안 지속되는 분리 상태들은 필터된다. 지연 유니트(32)의 출력 신호는 메모리 유니트(34), 특히 래치 메모리에 공급된다. 다이오드(D2)는 메모리 유니트(34)의 출력 및 신호 평가 유니트(20)의 출력(26) 사이에 배열된다. 램프 결함후, 래치 메모리는 메모리 유니트(34)의 출력에서 이용되는 전압이 전압(UM)에 대응하도록 응답한다. UM은 사각파 신호로서, 접지 전위, 즉 0V, 및 중간 회로 전압(UZW) 사이에서 변화한다. 메모리 유니트(34)는 액티브 상태에서 그 출력에 이용할 수 있는 "로우" 신호를 형성하도록 설계된다. 신호 평가 유니트(20)의 기준 전위가 전압(UM)이라는 사실로 인해, 이에 따라 활성화된 메모리 유니트의 경우, 즉, EoL 상황이 형 성될때, 전압(UM)은 메모리 유니트(34)의 출력에 전압(U34)로서 제공된다. 전압(U34)이 기준 전위 0V에 관련된 시점들에서, 다이오드는 온되고 다이오드 전압(UD2)과 무관할때 EoL 신호는 0V가 된다. 만약 U34가 UZW와 동일하면, 다이오드(D2)는 오프되고 EoL 신호는 15V와 동일한 UV가 된다. 이런 상황에서, 도 3a의 도면이 참조된다.
완전한 램프의 경우, 메모리 유니트(34)는 출력에서 이용할 수 있는 "하이" 신호를 형성한다, 즉 U34가 UM+UV이다. 0 및 UZW 사이의 UM에 의해 이루어진 변화들과 무관하게, 다이오드(D2)의 캐소드 전위는 항상 UV이고, 그 결과 다이오드(D2)는 항상 오프이다. 그러므로, EoL 신호는 도 3b의 도면에서 UV와 항상 동일하다.
도 4는 패시브 구성요소들에 의해 신호 평가 유니트(20)의 구현예를 가진 도 1로부터 도 2에 대응하는 단면이다. 이 경우, 신호 평가 유니트(20) 입력(24) 신호는 캐패시터(C4) 및 비리액티브 레지스터(R3)를 포함하는 병렬 회로에 공급되고, 신호 평가 유니트(20)의 입력(22)에서의 신호는 비리액티브 레지스터(R2)를 통하여 캐패시터(C4) 및 비리액티브 레지스터(R3)를 포함하는 직렬 회로에 결합된다. 다이오드(D2)는 도 2의 실시예 처럼 제공된다. 도 5를 참조하여, 다양한 상태들은 입력들(22 및 24)에서의 신호들 사이의 DC 전압 차의 함수로서 발생할 수 있다: 이 경우, UC4는 다이오드(D2)에 접속되는 캐패시터(C4)의 접속부와 접지 전위 사이의 전압이다.
도 5a는 EoL 신호, 즉 포지티브 DC 전압 이용 신호의 경우, 제어 유니트(14)의 입력(25) 전압의 시간 프로파일을 도시한다. 전압(UC4)이 UV + UM와 크거나 같은한, 다이오드(D2)는 오프되고 EoL 신호는 높은 저항성 레지스터(R1)를 통하여 발생하는 전압(UV)에 대응한다. 만약 전압(UC4)이 UM 보다 크고 UV+UM 미만이면, 다이오드(D2)는 UM이 UZW와 동일한 시점에서 오프된다. UM이 0과 동일한 시간들에서, 다이오드(D2)는 온되고 전압(UC4)을 제어 유니트(14)의 EoL 입력에 전달한다. 전압(UV)은 높은 저항성 레지스터(R1)로 인해 억제되고 포함되지 않는다.
도 5b는 네가티브 DC 전압 이용 신호의 경우 EoL 신호의 시간 프로파일을 도시한다. 캐패시터(C4)는 네가티브적으로 충전된다. UM이 UZW와 동일한 시간들에서, 이런 네가티브 전하는 높은 전압(UZW)의 결과로 인해 임의의 효과를 가지지 않고, 다이오드(D2)는 오프되고 EoL 신호는 UV와 동일하다. UM이 0과 동일한 시간들에서, 다이오드(D2)는 온되고 C4가 충전된 네가티브 전압은 R1이 높은 저항성을 가지기 때문에 EoL 신호가 지배적이다.
도 5c는 완전한 램프의 경우 EoL 신호의 시간 프로파일을 도시한다. UC4는 UM과 동일하고, 그 결과 다이오드는 UM이 0V이고 EoL 신호가 0V일때 온된다. 만약 UM이 UZW와 동일하면, 다이오드(D2)는 오프되고 EoL 신호는 UV와 동일하다.
EoL 신호의 대응 평가는 제어 유니트(14)에서 구현된다. 스위치들(S1 및 S2)은 평가 결과를 바탕으로 제어 유니트(14)의 출력들(10 및 12)을 통하여 대응하는 방식으로 구동된다.
본 발명의 전자 안정기는 보다 신뢰적인 EoL 검출이 가능하다는 효과를 가진다.

Claims (7)

  1. 공급 전압에 대한 접속부(A1) 및 접지 전위에 대한 접속부(A2) 사이에 결합된 적어도 하나의 제 1 스위치(S1) 및 제 2 스위치(S2)를 포함하는 브리지 회로 - 상기 브리지 회로의 중심점(M)은 제 1 스위치(S1) 및 제 2 스위치(S2) 사이에 형성됨 -;
    램프(La)에 대한 제 1 접속부(A1) 및 제 2 접속부(A2) - 상기 제 1 접속부(A1)는 인덕턴스(L1)를 통하여 브리지 회로의 중심점(M)에 결합됨 -; 및
    제 1 입력(24) 및 제 2 입력(22)을 포함하는 신호 평가 유니트(20) - 상기 제 1 입력(24)은 램프(La)에 대한 제 1 접속부(A1)의 DC 전압 레벨인 신호에 결합되고, 제 2 입력(22)은 램프(La)에 대한 제 2 접속부(A2)의 DC 전압 레벨인 신호에 결합됨 -;을 가진 램프용 전자 안정기로서,
    신호 평가 유니트(20)에 대한 DC 전압 기준 전위는 접지 전위보다 크거나 같고 공급 전압 전위 미만이거나 같은 값 범위내에서 가변하도록 설계되는,
    전자 안정기.
  2. 제 1 항에 있어서, 상기 신호 평가 유니트(20)에 대한 DC 전압 기준 전위는 필수적으로 브리지 회로의 중심점(M) 전위(UM)인,
    전자 안정기.
  3. 제 1 항 또는 제 2 항에 있어서, 상기 전자 안정기는 제 1 스위치(S1) 및 제 2 스위치(S2)를 구동하기 위하여 제어 유니트(14)를 포함하고, 상기 제어 유니트(14)는 신호 평가 유니트(20)에 결합된 분리 또는 조절 입력을 가지며, 상기 제어 유니트(14) 및 신호 평가 유니트(20)는 상호작용하도록 설계되어, 미리 결정할 수 있는 제한 값 이상인 신호 평가 유니트의 두개의 입력들(22,24)에서의 신호들의 DC 전압 성분 사이의 차가 발생하는 경우, 신호 평가 유니트(20)는 제 1 스위치(S1) 및/또는 제 2 스위치(S2)의 구동이 수행되지 않거나 제 1 스위치(S1) 및/또는 제 2 스위치(S2)가 구동되지 않도록 분리 또는 조절 입력을 통하여 제어 유니트(14)를 구동함으로써, 전자 안정기의 출력 전력이 감소되는,
    전자 안정기.
  4. 제 3 항에 있어서, 상기 제어 유니트(14)는 공급 전압 접속부를 가지며 DC 전압 기준 전위로서 접지 전위에 접속되고, 상기 신호 평가 유니트(20)는 래치를 포함하고 만약 신호 평가 유니트(20)의 두개의 입력들(22,24)에서 신호들의 DC 전압 성분의 차가 미리 결정할 수 있는 제한값 이상이면 래치를 활성화도록 설계되고, 래치의 출력(26)은 다이오드(D2) 및 비리액티브 레지스터(R1)를 포함하는 직렬 회로를 통하여 제어 유니트(14) 및/또는 신호 평가 유니트(20)의 공급 전압 접속부(16)에 결합되는,
    전자 안정기.
  5. 제 3 항에 있어서, 상기 제어 유니트(14)는 공급 전압 접속부를 가지며 기준 전위로서 접지 전위에 접속되고, 상기 신호 평가 유니트(20)는 신호 평가 유니트(20)의 두개의 입력들(22,24)에서 신호들의 DC 전압 성분 차에 대응하는 양단 전압을 가지도록 설계되고, 캐패시터(C4)는 다이오드(D2) 및 비리액티브 레지스터(R1)를 포함하는 직렬 회로를 통하여 제어 유니트(14)의 공급 전압 접속부(16)에 결합되는,
    전자 안정기.
  6. 제 4 항 또는 제 5 항에 있어서, 상기 다이오드(D2) 및 비리액티브 레지스터(R1) 사이의 접속 포인트는 제어 유니트(14)의 분리 또는 조절 입력에 결합되는,
    전자 안정기.
  7. 제 1 항 내지 제 6 항중 어느 한 항에 있어서, 상기 신호 평가 유니트(20)는 비교기 유니트를 포함하는,
    전자 안정기.
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