KR20050120201A - 플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치 - Google Patents

플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치 Download PDF

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Abstract

본 발명에 따른 플라즈마 표시 장치에서 주사 전극에 주사 전압이 인가되는 동안 선택할 어드레스 전극에 어드레스 전압을 인가하는 구동 회로는, 복수의 어드레스 전극에 각각 전기적으로 연결되어 상기 어드레스 기간에서 어드레스 전압과 비어드레스 전압을 각각 전달하는 제1 스위칭 소자와 제2 스위칭 소자를 각각 포함하는 복수의 선택 회로, 상기 어드레스 전압을 공급하는 제1 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제1 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제3 스위칭 소자, 그리고 상기 비어드레스 전압을 공급하는 제2 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제2 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제4 스위칭 소자를 포함한다. 그리고 어드레스 기간 직전에, 제2 스위칭 소자 및 제3 스위칭 소자가 턴온되어 있다. 이렇게 하면 어드레스 기간에서 시간적으로 최초의 주사 전압이 상기 주사 전극에 인가될 때, 선택할 어드레스 전극에 연결된 상기 선택 회로의 상기 제2 스위칭 소자를 턴오프하고 상기 제1 스위칭 소자를 턴온하면 상기 선택할 어드레스 전극에 상기 어드레스 전압이 곧바로 전달된다.

Description

플라즈마 표시 패널의 구동 방법 및 플라즈마 표시 장치{A DRIVING METHOD OF PLASMA DISPLAY PANEL AND PLASMA DISPLAY DEVICE}
본 발명은 플라즈마 표시 패널(plasma display panel, PDP)의 구동 방법에 관한 것이다.
플라즈마 표시 패널은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 이러한 플라즈마 표시 패널은 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형과 교류형으로 구분된다.
직류형 플라즈마 표시 패널은 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전공간에 그대로 흐르게 되며, 이를 위해 전류 제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 플라즈마 표시 패널에서는 전극을 유전체층이 덮고 있어 자연스러운 커패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
이러한 교류형 플라즈마 표시 패널에는 그 한쪽 면에 서로 평행인 주사 전극 및 유지 전극이 형성되고 다른 쪽 면에 이들 전극과 직교하는 방향으로 어드레스 전극이 형성된다. 그리고 유지 전극은 각 주사 전극에 대응해서 형성되며, 그 일단이 서로 공통으로 연결되어 있다.
도 1은 종래의 플라즈마 표시 패널의 구동 파형도이다.
도 1에 나타낸 바와 같이 플라즈마 표시 패널의 구동 방법에 따르면 각 서브필드는 리셋 기간(reset period)(Pr), 어드레스 기간(address period)(Pa) 및 유지 기간(sustain period)(Ps)으로 이루어진다.
리셋 기간(Pr)은 이전의 유지방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업(setup) 하는 역할을 한다. 어드레스 기간(Pa)은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다. 그리고 유지 기간(Ps)은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지방전을 수행하는 기간이다.
종래 플라즈마 디스플레이 패널의 구동 파형에서 어드레스 기간(Pa)을 보면, 어드레스 기간(Pa)에서는 표시하고자 하는 방전 셀을 선택하기 위해 순차적으로 주사 전극(Y)과 어드레스 전극(A)에 스캔 펄스 및 어드레스 펄스가 인가된다. 이 때, 스캔 펄스는 다른 주사 전극(Y)을 VscH 전압으로 유지한 상태에서 주사 전극(Y)에 순차적으로 VscL 전압을 인가하여 주사 전극(Y)을 선택하는 펄스이고 어드레스 펄스는 VscL 전압이 인가된 주사 전극(Y)에 의해 형성되는 방전 셀 중 선택하고자 하는 방전 셀을 형성하는 어드레스 전극(A)에 어드레스 전압(Va)을 인가하는 펄스이다. 이렇게 하면, 어드레스 전극(A)에 인가된 전압(Va)과 주사 전극(Y)에 인가된 전압(VscL)의 차이에 의해 어드레스 방전이 이루어진다.
일반적으로 주사 전극과 유지 전극 사이, 어드레스 전극이 형성된 면과 주사 및 유지 전극이 형성된 면 사이의 방전 공간 등은 용량성 부하(이하, 패널 커패시터라 함)로 작용하기 때문에 패널에는 커패시턴스가 존재하게 된다. 따라서, 어드레싱을 위한 파형을 인가하기 위해서는 어드레싱을 위한 전력 이외에 무효 전력이 필요하다. 따라서, 플라즈마 디스플레이 패널의 어드레스 구동 회로는 무효 전력을 회수하여 재사용하는 전력 회수 회로를 일반적으로 포함한다. 이러한 전력 회수 회로로서 L.F.Weber에 의해 제안된 회로(미국특허 제4,866,349호 및 제5,081,400호)가 있다.
전력 회수 회로는 용량성 부하와 인턱터의 공진을 이용하여 무효 전력을 회수하여 재사용하는 방법으로, 전력 회수 회로를 사용하면 무효 전력을 회수하여 재사용할 수는 있지만 LC 공진 이후에 어드레스 전극에 Va 전압이 인가되어 공진 시간 만큼 Va 전압의 인가 시기가 늦어져 어드레스 방전이 늦게 형성된다. 또한 공진 시간이 필요하므로 Va 전압 인가 기간이 짧아져 어드레스 방전이 약해진다. 만약 리셋 기간 종료 후에 방전 프라이밍이 거의 없는 상태에서 이처럼 전력 회수 회로를 사용하여 Va 전압을 인가하게 되면 어드레스 방전이 잘 일어나지 않게 되어 저방전이 발생할 수 있다.
특히, 직전 서브필드에서 유지 방전이 일어난 방전 셀에 대해서만 초기화를 수행하는 리셋의 경우에는 직전 서브필드의 리셋 기간 종료 후의 벽 전하 상태를 유지하므로 직전 서브필드에서 어드레싱된 방전 셀은 유지방전이 일어나 방전 프라이밍이 많이 형성되지만 직전 서브필드에서 어드레싱되지 않은 방전 셀은 유지방전이 일어나지 않아 직전 서브필드의 리셋 기간 종료 후의 방전 프라이밍을 그대로 유지하게 된다. 그런데 이 방전 프라이밍은 시간이 지남에 따라 소멸되기 때문에 직전 서브필드에서 어드레싱되지 않은 방전 셀에 대해서 어드레싱을 하고자 하는 경우에는 방전 프라이밍이 거의 소멸되어 첫 번째 주사 라인에서의 어드레스 방전이 더 잘 일어나지 않게 된다.
본 발명이 이루고자 하는 기술적 과제는 이와 같은 종래의 문제점을 해결하기 위한 것으로서, 어드레스 기간에서 첫 번째 주사 라인에서의 어드레스 방전을 안정적으로 일으킬 수 있는 플라즈마 디스플레이 패널의 구동 방법을 제공하고자 하는 것이다.
본 발명의 한 특징에 따르면, 복수의 주사 전극과 상기 복수의 어드레스 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널, 어드레스 기간에서 상기 복수의 주사 전극에 선택적으로 주사 전압을 인가하는 제1 구동 회로, 그리고 상기 주사 전극에 주사 전압이 인가되는 동안 선택할 상기 어드레스 전극에 어드레스 전압을 인가하는 제2 구동 회로를 포함하는 플라즈마 표시 장치가 제공된다. 이 때, 상기 제2 구동 회로는, 복수의 어드레스 전극에 각각 전기적으로 연결되어 상기 어드레스 기간에서 어드레스 전압과 비어드레스 전압을 각각 전달하는 제1 스위칭 소자와 제2 스위칭 소자를 각각 포함하는 복수의 선택 회로, 상기 어드레스 전압을 공급하는 제1 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제1 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제3 스위칭 소자, 그리고 상기 비어드레스 전압을 공급하는 제2 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제2 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제4 스위칭 소자를 포함하며, 상기 어드레스 기간 직전에, 상기 제2 스위칭 소자 및 제3 스위칭 소자가 턴온되어 있다.
그리고 어드레스 기간에서 시간적으로 최초의 주사 전압이 상기 주사 전극에 인가될 때, 상기 제2 구동 회로는, 선택할 어드레스 전극에 연결된 상기 선택 회로의 상기 제2 스위칭 소자를 턴오프하고 상기 제1 스위칭 소자를 턴온하여 상기 선택할 어드레스 전극에 상기 어드레스 전압을 인가한다.
또한, 상기 제2 구동 회로는, 상기 어드레스 전극에 제1단이 연결되는 적어도 하나의 인덕터를 더 포함하며, 어드레스 기간에서 상기 최초의 주사 전압이 인가되는 주사 전극 이외의 적어도 일부의 주사 전극에 상기 주사 전압이 인가될 때,
상기 인덕터와의 공진을 통하여 상기 선택할 어드레스 전극의 전압을 변경한 후 상기 선택할 어드레스 전극에 어드레스 전압을 인가하며, 상기 제2 구동 회로는, 상기 인덕터의 제2단과 상기 어드레스 전압과 상기 비어드레스 전압 사이의 제1 전압을 공급하는 제3 전원 사이에 전기적으로 연결되는 제5 스위칭 소자, 그리고 상기 인덕터의 제2단과 상기 제3 전원 사이에 전기적으로 연결되는 제6 스위칭 소자를 더 포함할 수 있으며, 상기 선택할 어드레스 전극에 연결된 선택 회로의 제1 스위칭 소자와 상기 제5 스위칭 소자가 턴온되어 상기 어드레스 전극의 전압을 변경한 후 상기 제3 스위칭 소자를 턴온하여 상기 어드레스 전압을 상기 선택할 어드레스 전극에 인가한다.
본 발명의 다른 특징에 따르면, 복수의 주사 전극 및 복수의 어드레스 전극을 포함하며, 복수의 어드레스 전극에 각각 전기적으로 연결되어 어드레스 기간에서 상기 어드레스 전극에 어드레스 전압과 비어드레스 전압을 선택적으로 전달하는 복수의 선택 회로를 포함하는 플라즈마 표시 패널을 구동하는 방법이 제공된다. 이 구동 방법은, 어드레스 기간 직전에, 상기 선택 회로에 어드레스 전압을 인가하는 제1 단계, 그리고 어드레스 기간에서, 상기 복수의 주사 전극 중 시간적으로 최초의 주사 전압이 주사 전극에 인가될 때, 상기 선택 회로를 통하여 상기 선택할 어드레스 전극에 상기 어드레스 전압을 전달하는 제2 단계를 포함한다.
그리고 어드레스 기간에서, 상기 선택 회로를 통하여 상기 어드레스 전극에 전기적으로 연결된 인덕터와 의 공진으로 상기 어드레스 전극의 전압을 변경한 후 상기 어드레스 전극에 비어드레스 전압을 인가하는 단계를 더 포함할 수 있으며, 어드레스 기간에서 상기 최초의 주사 전압이 인가되는 주사 전극 이외의 적어도 일부의 주사 전극에 상기 주사 전압이 인가될 때, 상기 선택 회로를 통하여 선택할 어드레스 전극에는 상기 공진으로 상기 어드레스 전극의 전압을 변경한 후 상기 어드레스 전압을 인가하는 단계를 더 포함할 수 있다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 그리고 어떤 부분이 다른 부분과 연결되어 있다고 할 때, 이는 직접적으로 연결되어 있는 경우 뿐 아니라 그 중간에 다른 소자를 사이에 두고 간접적으로 연결되어 있는 경우도 포함한다.
이하, 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
먼저, 본 발명의 실시예에 따른 플라즈마 표시 장치의 개략적인 구조에 대해서 도 2를 참조하여 자세하게 설명한다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 2에 나타낸 바와 같이 본 발명의 실시 예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 구동부(300), 유지전극 구동부(400) 및 주사전극 구동부(500)를 포함한다.
플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(A1∼Am), 그리고 행 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 X 전극(X1∼Xn) 및 Y 전극(Y1∼Yn)을 포함한다. X 전극(X1∼Xn)은 각 Y 전극(Y1∼Yn)에 대응해서 형성되며, 일반적으로 그 일단이 서로 공통으로 연결되어 있다. 그리고 플라즈마 표시 패널(100)은 X 및 Y 전극(X1∼Xn, Y1∼Yn)이 배열된 유리 기판(도시하지 않음)과 어드레스 전극(A1∼Am)이 배열된 유리 기판(도시하지 않음)으로 이루어진다. 두 유리 기판은 Y 전극(Y1∼Yn)과 어드레스 전극(A1∼Am) 및 유지 전극(X1∼Xn)과 어드레스 전극(A1∼Am)이 각각 직교하도록 방전 공간을 사이에 두고 대향하여 배치된다. 이때, 어드레스 전극(A1∼Am)과 X 및 Y 전극(X1∼Xn, Y1∼Yn)의 교차부에 있는 방전 공간이 방전 셀을 형성한다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스구동 제어 신호, 유지 전극(X) 구동 제어신호 및 주사 전극(Y) 구동 제어신호를 출력한다.
어드레스 구동부(300)는 제어부(200)로부터 어드레스구동 제어신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
유지전극 구동부(400)는 제어부(200)로부터 유지전극(X)구동 제어신호를 수신하여 유지 전극(X)에 구동 전압을 인가한다.
주사전극 구동부(500)는 제어부(200)로부터 주사전극(Y)구동 제어신호를 수신하여 주사 전극(Y)에 구동 전압을 인가한다.
다음, 도 3을 참조하여 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형에 대해서 설명한다.
도 3은 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형도이다. 도 3에서는 복수의 주사 전극(Y)에 주사 전압이 인가되는 순서에 따라 첫 번째 주사 전극(Y1)과 두 번째 주사 전극(Y2) 및 마지막 주사 전극(Yn) 만을 도시하였다. 그리고 아래에서는 리셋 기간 및 유지 기간에 대한 설명은 생략하고 어드레스 기간에 대해서만 상세하게 설명한다.
도 3을 보면, 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형에서 하나의 프레임은 복수의 서브필드로 나누어져 구동되고 각 서브필드는 리셋 기간(Pr), 어드레스 기간(Pa) 및 유지 기간(Ps)을 포함한다. 그리고 리셋 기간은 상승 램프 기간 및 하강 램프 기간을 포함한다.
리셋 기간(Pr)의 상승 램프 기간은 주사 전극(Y), 유지 전극(X) 및 어드레스 전극(A)에 벽 전하를 형성하는 기간이며, 하강 램프 기간은 상승 램프 기간에서 형성된 벽 전하를 일부 소거하여 어드레스 방전에 용이하도록 하는 기간이다. 그리고 어드레스 기간(Pa)은 복수의 방전 셀 중에서 유지 기간에서 유지방전을 일으킬 방전 셀을 선택하는 기간이며, 유지 기간(Ps)은 주사 전극(Y)과 유지 전극(X)에 차례로 유지 펄스를 인가하여 어드레스 기간(Pa)에서 선택된 방전 셀을 유지방전시키는 기간이다.
도 3에 나타낸 바와 같이, 어드레스 기간(Pa)에서는 복수의 방전 셀 중 방전될 방전 셀이 선택된다. 이 때, 방전 셀을 선택하기 위해서 주사 전극에 순차적으로 주사 전압(VscL)을 인가하고 주사 전압이 인가되지 않는 주사 전극을 양의 전압(VscH)으로 바이어스한다. 그리고 주사 전압(VscL)이 인가된 주사 전극에 의해 형성되는 복수의 방전 셀 중에서 선택하고자 하는 방전 셀을 통과하는 어드레스 전극에 어드레싱을 위한 어드레스 전압(Va)을 인가하고, 선택하지 않는 어드레스 전극에는 비어드레스 전압(0V)을 인가한다. 이 때, 본 발명의 실시 예에 따르면, 첫 번째 주사 전극(Y1)에 VscL 전압이 인가되는 동안 어드레스 전극(A)에 인가되는 어드레스 전압(Va)과 두 번째 주사 전극(Y2)부터 마지막 주사 전극(Yn)에 V scL 전압이 인가되는 동안 각각의 어드레스 전극(A)에 인가되는 어드레스 전압(Va)이 서로 다른 방법에 의해서 생성된다.
구체적으로 설명하면, 리셋 기간 종료 후에 방전 프라이밍이 없는 경우에는 첫 번째 주사 전극(Y1)에서의 어드레스 방전이 잘 일어나지 않으므로 첫 번째 주사 전극(Y1)에 VscL 전압이 인가되는 동안 어드레스 전극(A)에는 공진을 이용하지 않고 곧바로 Va 전압까지 증가시킨 다음에 공진을 이용하여 0V까지 감소시킨다. 이 때, Va 전압은 선택하고자 하는 어드레스 전극에 인가되는 어드레스 전압이며, 0V는 선택되지 않는 어드레스 전극에 인가되는 비어드레스 전압이다. 이렇게 하면, 첫 번째 주사 주사 전극(Y1)에 VscL 전압이 인가되는 동안 어드레스 전극에 어드레스 전압이 인가되기까지 걸리는 시간이 종래보다 짧아지며 그로 인하여 어드레스 전극(A)에 인가되는 어드레스 전압 유지 시간이 길어지므로 안정적인 어드레스 방전을 발생시킬 수 있다.
그리고 두 번째 주사 전극(Y2)부터 마지막 주사 전극(Yn)에 VscL 전압이 인가되는 동안에는 각각의 어드레스 전극(A)에 공진을 이용하여 Va 전압까지 증가시킨 다음에 공진을 이용하여 0V까지 감소시킨다. 두 번째 주사 전극(Y2)부터 마지막 주사 전극(Yn)에서의 어드레스 방전은 이전의 어드레스 방전으로 인해 방전 프라이밍이 발생한 상태에서 어드레스 방전이 일어나게 되므로 어드레스 전극의 어드레스 전압 유지 시간이 공진 시간만큼 짧아져도 어드레스 방전이 잘 일어날 수가 있다.
아래에서는 선택하는 주사 전극에 인가되는 주사 전압(VscL)과 선택하지 않는 어드레스 전극에 인가되는 비어드레스 전압(0V)을 각각 접지 전압으로 가정하여 어드레스 구동부에 포함된 어드레스 구동 회로에 대해서 도 4를 참고로 하여 상세하게 설명한다.
도 4는 본 발명의 실시 예에 따른 어드레스 구동 회로를 나타내는 도면이다. 도 4에서는 스위칭 소자를 바디 다이오드를 가지는 n 채널 전계 효과 트랜지스터(FET)로 도시하였으며, 동일 또는 유사한 기능을 하는 다른 스위칭 소자로 이루어질 수 있다.
도 4에 나타낸 바와 같이, 본 발명의 실시 예에 따른 어드레스 구동 회로는 어드레스 전력 회수 회로(310), 어드레스 전압 공급부(320) 및 어드레스 선택 회로(3301∼330m)를 포함한다. 어드레스 선택 회로(3301∼330m )는 복수의 어드레스 전극(A1∼Am)에 각각 연결되며, 각각 두 개의 스위칭 소자(AH, A L)를 포함한다.
스위칭 소자(AH)는 전력 회수 회로(310)와 어드레스 전극(A1∼Am) 사이에 연결되며, 스위칭 소자(AL)는 어드레스 전극(A1∼Am)과 접지 전압 사이에 연결되어 스위칭 소자(AH, AL)의 턴온 또는 턴오프에 의해 어드레스 전극이 선택되거나 또는 선택되지 않는다. 즉, 어드레스 기간(Pa)에서 스위칭 소자(AH)가 턴온되어 어드레스 전압이 인가된 어드레스 전극은 선택되고 스위칭 소자(AL)가 턴온되어 접지 전압이 인가된 어드레스 전극은 선택되지 않는다.
어드레스 전압 공급부(320)는 어드레스 전력 회수 회로(310)와 어드레스 선택 회로(3301∼330m) 사이에 연결되며, 어드레스 전압 공급부(320)는 두 개의 스위칭 소자(Aa, Ag)를 포함한다. 스위칭 소자(Aa)는 어드레스 전압(V a)을 공급하는 전원과 어드레스 선택 회로(3301∼330m)의 스위칭 소자(AH) 사이에 연결되어 있으며, 스위칭 소자(Ag)는 접지 전압을 공급하는 전원과 어드레스 선택 회로(3301∼330 m)의 스위칭 소자(AH) 사이에 연결되어 있다. 이 스위칭 소자(Aa, Ag)는 패널 커패시터(CP)에 Va 전압과 접지 전압을 각각 공급한다.
전력 회수 회로(310)는 스위칭 소자(Ar, Af), 인덕터(L), 다이오드(D1, D2) 및 커패시터(Ca)를 포함한다. 스위칭 소자(Ar)의 드레인과 스위칭 소자(Af )의 소스 사이에 패시터(Ca)가 전기적으로 연결되며, 스위칭 소자(Ar, Af)에 각각 다이오드(D1, D2)가 직렬로 연결된다. 그리고 다이오드(D1, D2 ) 간 접점과 어드레스 전압 구동부(320)의 스위칭 소자(As, Ag) 간 접점 사이에 인덕터(Lerc)의 일단이 전기적으로 연결되며, 인덕터(Lerc)의 타단에는 패널 커패시터(CP)가 직렬로 연결된다. 다이오드(D1)는 스위칭 소자(Yr)가 바디 다이오드를 가질 경우 패널 커패시터(C P)의 전압을 증가시키는 상승 경로를 설정하기 위한 것이다. 그리고 다이오드(D2)는 스위칭 소자(Yf)가 바디 다이오드를 가질 경우 패널 커패시터(CP)의 전압을 하강시키는 하강 경로를 설정하기 위한 것이다. 이 때, 스위칭(Yr, Yf)가 바디 다이오드를 가지지 않는다면 다이오드(D1, D2)가 제거될 수도 있다.
그리고 전력 회수 회로(310)에서 인덕터(L), 다이오드(D1) 및 스위칭 소자(Ar) 사이의 연결 순서는 바뀔 수 있으며, 마찬가지로 인덕터(L), 다이오드(D2 ) 및 스위칭 소자(Af) 사이의 연결 순서도 바뀔 수 있다. 이와 같이 연결된 전력 회수 회로(310)는 패널 커패시터(CP)의 전압을 Va 전압으로 충전시키거나 접지 전압으로 방전시킨다.
다음, 도 5 및 도 6a 내지 도 6d를 참조하여 본 발명의 실시 예에 따른 어드레스 구동 회로의 동작에 대해서 설명한다.
도 5는 도 3의 구동 파형의 어드레스 기간에서 어드레스 전극에 인가되는 구동 파형을 생성하기 위한 구동 타이밍도이고, 도 6a 내지 도 6d는 도 3의 구동 파형의 어드레스 기간에서의 어드레스 전압을 생성하기 위한 도 4의 구동 회로의 각 모드에서의 전류 경로를 나타내는 도면이다. 도 5 및 도 6a 내지 도 6d에서는 설명의 편의상 하나의 어드레스 선택 회로만을 도시하였으며, 어드레스 전극(A)과 주사 전극(Y)에 의해 형성되는 용량성 성분을 패널 커패시터(CP)로 도시하였다. 앞에서 설명한 바와 같이 패널 커패시터(CP)의 주사 전극(Y) 측에는 접지 전압이 인가되는 것으로 도시하였다. 그리고 커패시터(Ca)에는 외부 인가 전압(Va)의 1/2만큼의 전압(Va/2)이 미리 충전되어 있는 것으로 가정한다.
먼저 도 5 및 도 6a에 나타낸 바와 같이, 시점(t1) 이전, 즉 어드레스 전극에 첫 번째 어드레스 전압이 인가되기 전, 즉 어드레스 기간 직전에서는 스위칭 소자(Aa, AL)를 계속 온시킨다. 그러면 패널 커패시터(CP)―스위칭 소자(A L) 및 스위칭 소자(Aa)―노드 n의 경로가 형성되어(①. ①′) 어드레스 전극에는 접지 전압이 인가되고 노드 n(Vn)에는 Va 전압이 인가된다.
그리고 도 5 및 도 6b에 나타낸 바와 같이, 시점(t1)에서는 스위칭 소자(Aa, AL)가 온되어 있는 상태에서 스위칭 소자(AH)를 턴온하고 스위칭 소자(AL )를 턴오프한다. 그러면 스위칭 소자(Aa)―스위칭 소자(AH)―패널 커패시터(CP)의 경로가 형성되어(②) 어드레스 전극에 곧바로 Va 전압이 인가된다. 이처럼 노드 n(Vn)에 V a 전압이 인가된 상태에서 스위칭 소자(AH)를 턴온하면 어드레스 전극에 Va 전압 인가 시간이 매우 짧아지며 그로 인하여 어드레스 전극에 Va 전압 유지 시간이 길어지게 된다.
이어서 도 5 및 도 6c에 나타낸 바와 같이, 시점(t2)에서는 스위칭 소자(Aa, AH)가 온되어 있는 상태에서 스위칭 소자(Af)를 턴온하고 스위칭 소자(Aa )를 턴오프한다. 그러면 패널 커패시터(CP)―스위칭 소자(AH)―인덕터(L)―다이오드(D2 )―스위칭 소자(Af)―커패시터(Ca)의 경로가 형성된다③. 이 경로에 의해 LC 공진 회로가 형성되어 패널 커패시터(CP)에 충전되어 있던 전압이 방전되어 어드레스 전극의 전압이 0V 전압 근처까지 감소한다.
그리고 시점(t3)에서는 스위칭 소자(AH, Af)가 온되어 있는 상태에서 스위칭 소자(Ag)를 턴온하고 스위칭 소자(Af)를 턴오프한다. 그러면, 패널 커패시터(C P)―스위칭 소자(AH)―스위칭 소자(Ag)―전원(0V)의 경로(M4)가 형성되어(④) 어드레스 전극의 전압은 0V 전압을 유지한다.
즉, 어드레스 기간(Pa) 직전에 선택 회로에 어드레스 전압(Va)을 인가한 상태에서 어드레스 기간(Pa)에 첫 번째 주사 전극(Y1)에 주사 전압(VscL)이 인가될 때 선택 회로의 스위칭 소자(AH)를 턴온시켜 곧바로 어드레스 전극(A)에 어드레스 전압(Va)을 인가한 다음에 어드레스 전극(A)의 전압을 LC 공진을 이용하여 접지 전압까지 감소시킨다.
다음으로 도 5 및 도 6d에 나타낸 바와 같이 시점(t4)에서는 스위칭 소자(Ag, AH)가 온되어 있는 상태에서 스위칭 소자(Ar)를 턴온하고 스위칭 소자(Ag)를 턴오프한다. 그러면 커패시터(Ca)―스위칭 소자(Ar)―다이오드(D1)―인덕터(L)―스위칭 소자(AH)―패널 커패시터(CP)의 경로가 형성된다(⑤). 이 경로에 의해 LC 공진 회로가 형성되어 인덕터(L)와 패널 커패시터(CP)로 전류가 주입되며, 패널 커패시터(CP)에 전압이 충전되어 어드레스 전극의 전압이 Va 전압 근처까지 증가한다.
이어서 시점(t5)에서는 스위칭 소자(AH, Ar)가 온되어 있는 상태에서 스위칭 소자(Aa)를 턴온하고 스위칭 소자(Ar)를 턴오프한다. 그러면, 전원(Va)―스위칭 소자(Aa)―스위칭 소자(AH)―패널 커패시터(CP)의 경로가 형성된다⑥. 이 경로에 의해 어드레스 전극의 전압이 Va 전압으로 유지된다.
그리고 시점(t6)에서는 스위칭 소자(AH, Aa)가 온되어 있는 상태에서 스위칭 소자(Af)를 턴온하고 스위칭 소자(Aa)를 턴오프한다. 패널 커패시터(CP )―스위칭 소자(AH)―인덕터(L)―다이오드(D2)―스위칭 소자(Af)―커패시터(C a)의 경로가 형성된다. 이 경로에 의해 LC 공진 회로가 형성되어 패널 커패시터(CP)에 충전되어 있던 전압이 방전되어 어드레스 전극의 전압이 0V 전압 근처까지 감소한다. 이는 앞서 설명한 경로와 동일하다(③).
그리고 나서 시점(t7)에서는 스위칭 소자(AH, Af)가 온되어 있는 상태에서 스위칭 소자(Ag)를 턴온하고 스위칭 소자(Af)를 턴오프한다. 그러면, 패널 커패시터(CP)―스위칭 소자(AH)―스위칭 소자(Ag)―전원(0V)의 경로가 형성되어 어드레스 전극의 전압이 0V를 유지하게 된다. 이 또한 앞서 설명한 경로와 동일하다(④).
즉, 복수의 주사 전극 중 두 번째 주사 전극(Y2)부터 마지막 주사 전극(Yn)에 주사 전압(VscL)이 인가될 때 선택할 어드레스 전극(A)에 어드레싱을 위한 전압(Va)을 인가하기 위해 어드레스 전극의 전압을 인덕터(L)와 패널 커패시터(CP)의 공진을 통하여 어드레스 전압(Va)까지 증가시킨 후에 인덕터(L)와 패널 커패시터(CP)의 공진을 통하여 0V까지 감소시킨다.
이처럼 어드레스 기간(Pa)에서 복수의 주사 전극 중 시간적으로 가장 먼저 주사 전압이 주사 전극에 인가되기 전에 스위칭 소자(Aa, AL)를 계속 온시킴으로써 노드 n의 전압(Vn)을 계속 어드레스 전압으로 유지하고 있다가 어드레스 기간(Pa)에서 복수의 주사 전극 중 시간적으로 가장 먼저 주사 전압이 주사 전극에 인가될 때, 선택할 어드레스 전극(A)의 스위칭 소자(AH)를 턴온하고 스위칭 소자(AL)를 턴오프함으로써 곧바로 어드레스 전극에 어드레스 전압이 인가될 수가 있다. 이렇게 하면 어드레스 전극에 어드레스 전압 유지 시간이 길어지게 되어 공간 프라이밍이 없는 상태에서도 어드레스 방전이 잘 일어날 수가 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이와 같이 본 발명에 의하면, 어드레스 기간에서 복수의 주사 전극 중 시간적으로 최초에 주사 전압이 주사 전극에 인가될 때, 선택 회로를 통하여 상기 선택할 어드레스 전극에 어드레스 전압을 곧바로 인가할 수 있어 어드레스 방전을 안정적으로 일으킬 수 있으므로 플라즈마 표시 패널의 저방전을 방지할 수 있다.
도 1은 종래의 플라즈마 표시 패널의 구동 파형도이다.
도 2는 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 3은 본 발명의 실시 예에 따른 플라즈마 표시 패널의 구동 파형도이다.
도 4는 본 발명의 실시 예에 따른 어드레스 구동 회로를 나타내는 도면이다.
도 5는 도 3의 어드레스 기간에서 어드레스 전극에 인가되는 구동 파형을 생성하기 위한 구동 타이밍도이다.
도 6a 내지 도 6d는 도 3의 구동 파형의 어드레스 기간에서의 어드레스 전압을 생성하기 위한 도 4의 구동 회로의 각 모드에서의 전류 경로를 나타내는 도면이다.

Claims (7)

  1. 복수의 주사 전극과 상기 복수의 어드레스 전극에 의해 용량성 부하가 형성되는 플라즈마 표시 패널,
    어드레스 기간에서 상기 복수의 주사 전극에 선택적으로 주사 전압을 인가하는 제1 구동 회로, 그리고
    상기 주사 전극에 주사 전압이 인가되는 동안 선택할 상기 어드레스 전극에 어드레스 전압을 인가하는 제2 구동 회로를 포함하며,
    상기 제2 구동 회로는,
    복수의 어드레스 전극에 각각 전기적으로 연결되어 상기 어드레스 기간에서 어드레스 전압과 비어드레스 전압을 각각 전달하는 제1 스위칭 소자와 제2 스위칭 소자를 각각 포함하는 복수의 선택 회로,
    상기 어드레스 전압을 공급하는 제1 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제1 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제3 스위칭 소자, 그리고
    상기 비어드레스 전압을 공급하는 제2 전원에 제1단이 연결되고 상기 복수의 선택 회로의 상기 제2 스위칭 소자를 통하여 상기 복수의 어드레스 전극에 제2단이 연결되는 제4 스위칭 소자를 포함하며,
    상기 어드레스 기간 직전에, 상기 제2 스위칭 소자 및 제3 스위칭 소자가 턴온되어 있는 플라즈마 표시 장치.
  2. 제 1항에 있어서,
    어드레스 기간에서 시간적으로 최초의 주사 전압이 상기 주사 전극에 인가될 때,
    상기 제2 구동 회로는,
    선택할 어드레스 전극에 연결된 상기 선택 회로의 상기 제2 스위칭 소자를 턴오프하고 상기 제1 스위칭 소자를 턴온하여 상기 선택할 어드레스 전극에 상기 어드레스 전압을 인가하는 플라즈마 표시 장치.
  3. 제 2항에 있어서,
    상기 제2 구동 회로는,
    상기 어드레스 전극에 제1단이 연결되는 적어도 하나의 인덕터
    를 더 포함하며,
    어드레스 기간에서 상기 최초의 주사 전압이 인가되는 주사 전극 이외의 적어도 일부의 주사 전극에 상기 주사 전압이 인가될 때,
    상기 인덕터와의 공진을 통하여 상기 선택할 어드레스 전극의 전압을 변경한 후 상기 선택할 어드레스 전극에 어드레스 전압을 인가하는 플라즈마 표시 장치.
  4. 제 3항에 있어서,
    상기 제2 구동 회로는,
    상기 인덕터의 제2단과 상기 어드레스 전압과 상기 비어드레스 전압 사이의 제1 전압을 공급하는 제3 전원 사이에 전기적으로 연결되는 제5 스위칭 소자, 그리고
    상기 인덕터의 제2단과 상기 제3 전원 사이에 전기적으로 연결되는 제6 스위칭 소자
    를 더 포함하며.
    상기 선택할 어드레스 전극에 연결된 선택 회로의 제1 스위칭 소자와 상기 제5 스위칭 소자가 턴온되어 상기 어드레스 전극의 전압을 변경한 후 상기 제3 스위칭 소자를 턴온하여 상기 어드레스 전압을 상기 선택할 어드레스 전극에 인가하는 플라즈마 표시 장치.
  5. 복수의 주사 전극 및 복수의 어드레스 전극을 포함하며, 복수의 어드레스 전극에 각각 전기적으로 연결되어 어드레스 기간에서 상기 어드레스 전극에 어드레스 전압과 비어드레스 전압을 선택적으로 전달하는 복수의 선택 회로를 포함하는 플라즈마 표시 패널을 구동하는 방법에 있어서,
    어드레스 기간 직전에, 상기 선택 회로에 어드레스 전압을 인가하는 제1 단계, 그리고
    어드레스 기간에서, 상기 복수의 주사 전극 중 시간적으로 최초의 주사 전압이 주사 전극에 인가될 때, 상기 선택 회로를 통하여 상기 선택할 어드레스 전극에 상기 어드레스 전압을 전달하는 제2 단계
    를 포함하는 플라즈마 표시 패널의 구동 방법.
  6. 제 5항에 있어서,
    어드레스 기간에서,
    상기 선택 회로를 통하여 상기 어드레스 전극에 전기적으로 연결된 인덕터와 의 공진으로 상기 어드레스 전극의 전압을 변경한 후 상기 어드레스 전극에 비어드레스 전압을 인가하는 단계
    를 더 포함하는 플라즈마 표시 패널의 구동 방법.
  7. 제 5항에 있어서,
    어드레스 기간에서 상기 최초의 주사 전압이 인가되는 주사 전극 이외의 적어도 일부의 주사 전극에 상기 주사 전압이 인가될 때,
    상기 선택 회로를 통하여 선택할 어드레스 전극에는 상기 공진으로 상기 어드레스 전극의 전압을 변경한 후 상기 어드레스 전압을 인가하는 단계
    를 더 포함하는 플라즈마 표시 패널의 구동 방법.
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